Branch data Line data Source code
1 : : ;; GCC machine description for IA-32 and x86-64.
2 : : ;; Copyright (C) 1988-2024 Free Software Foundation, Inc.
3 : : ;; Mostly by William Schelter.
4 : : ;; x86_64 support added by Jan Hubicka
5 : : ;;
6 : : ;; This file is part of GCC.
7 : : ;;
8 : : ;; GCC is free software; you can redistribute it and/or modify
9 : : ;; it under the terms of the GNU General Public License as published by
10 : : ;; the Free Software Foundation; either version 3, or (at your option)
11 : : ;; any later version.
12 : : ;;
13 : : ;; GCC is distributed in the hope that it will be useful,
14 : : ;; but WITHOUT ANY WARRANTY; without even the implied warranty of
15 : : ;; MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
16 : : ;; GNU General Public License for more details.
17 : : ;;
18 : : ;; You should have received a copy of the GNU General Public License
19 : : ;; along with GCC; see the file COPYING3. If not see
20 : : ;; <http://www.gnu.org/licenses/>. */
21 : : ;;
22 : : ;; The original PO technology requires these to be ordered by speed,
23 : : ;; so that assigner will pick the fastest.
24 : : ;;
25 : : ;; See file "rtl.def" for documentation on define_insn, match_*, et. al.
26 : : ;;
27 : : ;; The special asm out single letter directives following a '%' are:
28 : : ;; L,W,B,Q,S,T -- print the opcode suffix for specified size of operand.
29 : : ;; C -- print opcode suffix for set/cmov insn.
30 : : ;; c -- like C, but print reversed condition
31 : : ;; F,f -- likewise, but for floating-point.
32 : : ;; O -- if HAVE_AS_IX86_CMOV_SUN_SYNTAX, expand to "w.", "l." or "q.",
33 : : ;; otherwise nothing
34 : : ;; R -- print the prefix for register names.
35 : : ;; z -- print the opcode suffix for the size of the current operand.
36 : : ;; Z -- likewise, with special suffixes for x87 instructions.
37 : : ;; * -- print a star (in certain assembler syntax)
38 : : ;; A -- print an absolute memory reference.
39 : : ;; E -- print address with DImode register names if TARGET_64BIT.
40 : : ;; w -- print the operand as if it's a "word" (HImode) even if it isn't.
41 : : ;; s -- print a shift double count, followed by the assemblers argument
42 : : ;; delimiter.
43 : : ;; b -- print the QImode name of the register for the indicated operand.
44 : : ;; %b0 would print %al if operands[0] is reg 0.
45 : : ;; w -- likewise, print the HImode name of the register.
46 : : ;; k -- likewise, print the SImode name of the register.
47 : : ;; q -- likewise, print the DImode name of the register.
48 : : ;; x -- likewise, print the V4SFmode name of the register.
49 : : ;; t -- likewise, print the V8SFmode name of the register.
50 : : ;; h -- print the QImode name for a "high" register, either ah, bh, ch or dh.
51 : : ;; y -- print "st(0)" instead of "st" as a register.
52 : : ;; d -- print duplicated register operand for AVX instruction.
53 : : ;; D -- print condition for SSE cmp instruction.
54 : : ;; P -- if PIC, print an @PLT suffix.
55 : : ;; p -- print raw symbol name.
56 : : ;; X -- don't print any sort of PIC '@' suffix for a symbol.
57 : : ;; & -- print some in-use local-dynamic symbol name.
58 : : ;; H -- print a memory address offset by 8; used for sse high-parts
59 : : ;; K -- print HLE lock prefix
60 : : ;; Y -- print condition for XOP pcom* instruction.
61 : : ;; + -- print a branch hint as 'cs' or 'ds' prefix
62 : : ;; ; -- print a semicolon (after prefixes due to bug in older gas).
63 : : ;; ~ -- print "i" if TARGET_AVX2, "f" otherwise.
64 : : ;; ^ -- print addr32 prefix if TARGET_64BIT and Pmode != word_mode
65 : : ;; ! -- print NOTRACK prefix for jxx/call/ret instructions if required.
66 : :
67 : : (define_c_enum "unspec" [
68 : : ;; Relocation specifiers
69 : : UNSPEC_GOT
70 : : UNSPEC_GOTOFF
71 : : UNSPEC_GOTPCREL
72 : : UNSPEC_GOTTPOFF
73 : : UNSPEC_TPOFF
74 : : UNSPEC_NTPOFF
75 : : UNSPEC_DTPOFF
76 : : UNSPEC_GOTNTPOFF
77 : : UNSPEC_INDNTPOFF
78 : : UNSPEC_PLTOFF
79 : : UNSPEC_MACHOPIC_OFFSET
80 : : UNSPEC_PCREL
81 : : UNSPEC_SIZEOF
82 : :
83 : : ;; Prologue support
84 : : UNSPEC_STACK_ALLOC
85 : : UNSPEC_SET_GOT
86 : : UNSPEC_SET_RIP
87 : : UNSPEC_SET_GOT_OFFSET
88 : : UNSPEC_MEMORY_BLOCKAGE
89 : : UNSPEC_PROBE_STACK
90 : :
91 : : ;; TLS support
92 : : UNSPEC_TP
93 : : UNSPEC_TLS_GD
94 : : UNSPEC_TLS_LD_BASE
95 : : UNSPEC_TLSDESC
96 : : UNSPEC_TLS_IE_SUN
97 : :
98 : : ;; Other random patterns
99 : : UNSPEC_SCAS
100 : : UNSPEC_FNSTSW
101 : : UNSPEC_SAHF
102 : : UNSPEC_NOTRAP
103 : : UNSPEC_PARITY
104 : : UNSPEC_FSTCW
105 : : UNSPEC_REP
106 : : UNSPEC_LD_MPIC ; load_macho_picbase
107 : : UNSPEC_TRUNC_NOOP
108 : : UNSPEC_DIV_ALREADY_SPLIT
109 : : UNSPEC_PAUSE
110 : : UNSPEC_LEA_ADDR
111 : : UNSPEC_XBEGIN_ABORT
112 : : UNSPEC_STOS
113 : : UNSPEC_PEEPSIB
114 : : UNSPEC_INSN_FALSE_DEP
115 : : UNSPEC_SBB
116 : : UNSPEC_CC_NE
117 : : UNSPEC_STC
118 : : UNSPEC_PUSHFL
119 : : UNSPEC_POPFL
120 : :
121 : : ;; For SSE/MMX support:
122 : : UNSPEC_FIX_NOTRUNC
123 : : UNSPEC_MASKMOV
124 : : UNSPEC_MOVCC_MASK
125 : : UNSPEC_MOVMSK
126 : : UNSPEC_INSERTPS
127 : : UNSPEC_BLENDV
128 : : UNSPEC_PSHUFB
129 : : UNSPEC_XOP_PERMUTE
130 : : UNSPEC_RCP
131 : : UNSPEC_RSQRT
132 : : UNSPEC_PSADBW
133 : :
134 : : ;; Different from generic us_truncate RTX
135 : : ;; as it does unsigned saturation of signed source.
136 : : UNSPEC_US_TRUNCATE
137 : :
138 : : ;; For AVX/AVX512F support
139 : : UNSPEC_SCALEF
140 : : UNSPEC_PCMP
141 : : UNSPEC_CVTBFSF
142 : :
143 : : ;; Generic math support
144 : : UNSPEC_IEEE_MIN ; not commutative
145 : : UNSPEC_IEEE_MAX ; not commutative
146 : :
147 : : ;; x87 Floating point
148 : : UNSPEC_SIN
149 : : UNSPEC_COS
150 : : UNSPEC_FPATAN
151 : : UNSPEC_FYL2X
152 : : UNSPEC_FYL2XP1
153 : : UNSPEC_FRNDINT
154 : : UNSPEC_FIST
155 : : UNSPEC_F2XM1
156 : : UNSPEC_TAN
157 : : UNSPEC_FXAM
158 : :
159 : : ;; x87 Rounding
160 : : UNSPEC_FRNDINT_ROUNDEVEN
161 : : UNSPEC_FRNDINT_FLOOR
162 : : UNSPEC_FRNDINT_CEIL
163 : : UNSPEC_FRNDINT_TRUNC
164 : : UNSPEC_FIST_FLOOR
165 : : UNSPEC_FIST_CEIL
166 : :
167 : : ;; x87 Double output FP
168 : : UNSPEC_SINCOS_COS
169 : : UNSPEC_SINCOS_SIN
170 : : UNSPEC_XTRACT_FRACT
171 : : UNSPEC_XTRACT_EXP
172 : : UNSPEC_FSCALE_FRACT
173 : : UNSPEC_FSCALE_EXP
174 : : UNSPEC_FPREM_F
175 : : UNSPEC_FPREM_U
176 : : UNSPEC_FPREM1_F
177 : : UNSPEC_FPREM1_U
178 : :
179 : : UNSPEC_C2_FLAG
180 : : UNSPEC_FXAM_MEM
181 : :
182 : : ;; SSP patterns
183 : : UNSPEC_SP_SET
184 : : UNSPEC_SP_TEST
185 : :
186 : : ;; For ROUND support
187 : : UNSPEC_ROUND
188 : :
189 : : ;; For CRC32 support
190 : : UNSPEC_CRC32
191 : :
192 : : ;; For LZCNT suppoprt
193 : : UNSPEC_LZCNT
194 : :
195 : : ;; For BMI support
196 : : UNSPEC_TZCNT
197 : : UNSPEC_BEXTR
198 : :
199 : : ;; For BMI2 support
200 : : UNSPEC_PDEP
201 : : UNSPEC_PEXT
202 : :
203 : : ;; IRET support
204 : : UNSPEC_INTERRUPT_RETURN
205 : :
206 : : ;; For MOVDIRI and MOVDIR64B support
207 : : UNSPEC_MOVDIRI
208 : : UNSPEC_MOVDIR64B
209 : :
210 : : ;; For insn_callee_abi:
211 : : UNSPEC_CALLEE_ABI
212 : :
213 : : ;; For APX PUSH2/POP2 support
214 : : UNSPEC_APXPUSH2
215 : : UNSPEC_APXPOP2_LOW
216 : : UNSPEC_APXPOP2_HIGH
217 : :
218 : : ;; For APX PPX support
219 : : UNSPEC_APX_PPX
220 : : ])
221 : :
222 : : (define_c_enum "unspecv" [
223 : : UNSPECV_UD2
224 : : UNSPECV_BLOCKAGE
225 : : UNSPECV_STACK_PROBE
226 : : UNSPECV_PROBE_STACK_RANGE
227 : : UNSPECV_ALIGN
228 : : UNSPECV_PROLOGUE_USE
229 : : UNSPECV_SPLIT_STACK_RETURN
230 : : UNSPECV_CLD
231 : : UNSPECV_NOPS
232 : : UNSPECV_RDTSC
233 : : UNSPECV_RDTSCP
234 : : UNSPECV_RDPMC
235 : : UNSPECV_LLWP_INTRINSIC
236 : : UNSPECV_SLWP_INTRINSIC
237 : : UNSPECV_LWPVAL_INTRINSIC
238 : : UNSPECV_LWPINS_INTRINSIC
239 : : UNSPECV_RDFSBASE
240 : : UNSPECV_RDGSBASE
241 : : UNSPECV_WRFSBASE
242 : : UNSPECV_WRGSBASE
243 : : UNSPECV_FXSAVE
244 : : UNSPECV_FXRSTOR
245 : : UNSPECV_FXSAVE64
246 : : UNSPECV_FXRSTOR64
247 : : UNSPECV_XSAVE
248 : : UNSPECV_XRSTOR
249 : : UNSPECV_XSAVE64
250 : : UNSPECV_XRSTOR64
251 : : UNSPECV_XSAVEOPT
252 : : UNSPECV_XSAVEOPT64
253 : : UNSPECV_XSAVES
254 : : UNSPECV_XRSTORS
255 : : UNSPECV_XSAVES64
256 : : UNSPECV_XRSTORS64
257 : : UNSPECV_XSAVEC
258 : : UNSPECV_XSAVEC64
259 : : UNSPECV_XGETBV
260 : : UNSPECV_XSETBV
261 : : UNSPECV_WBINVD
262 : : UNSPECV_WBNOINVD
263 : :
264 : : ;; For atomic compound assignments.
265 : : UNSPECV_FNSTENV
266 : : UNSPECV_FLDENV
267 : : UNSPECV_FNSTSW
268 : : UNSPECV_FNCLEX
269 : :
270 : : ;; For RDRAND support
271 : : UNSPECV_RDRAND
272 : :
273 : : ;; For RDSEED support
274 : : UNSPECV_RDSEED
275 : :
276 : : ;; For RTM support
277 : : UNSPECV_XBEGIN
278 : : UNSPECV_XEND
279 : : UNSPECV_XABORT
280 : : UNSPECV_XTEST
281 : :
282 : : UNSPECV_NLGR
283 : :
284 : : ;; For CLWB support
285 : : UNSPECV_CLWB
286 : :
287 : : ;; For CLFLUSHOPT support
288 : : UNSPECV_CLFLUSHOPT
289 : :
290 : : ;; For MONITORX and MWAITX support
291 : : UNSPECV_MONITORX
292 : : UNSPECV_MWAITX
293 : :
294 : : ;; For CLZERO support
295 : : UNSPECV_CLZERO
296 : :
297 : : ;; For RDPKRU and WRPKRU support
298 : : UNSPECV_PKU
299 : :
300 : : ;; For RDPID support
301 : : UNSPECV_RDPID
302 : :
303 : : ;; For CET support
304 : : UNSPECV_NOP_ENDBR
305 : : UNSPECV_NOP_RDSSP
306 : : UNSPECV_INCSSP
307 : : UNSPECV_SAVEPREVSSP
308 : : UNSPECV_RSTORSSP
309 : : UNSPECV_WRSS
310 : : UNSPECV_WRUSS
311 : : UNSPECV_SETSSBSY
312 : : UNSPECV_CLRSSBSY
313 : :
314 : : ;; For TSXLDTRK support
315 : : UNSPECV_XSUSLDTRK
316 : : UNSPECV_XRESLDTRK
317 : :
318 : : ;; For WAITPKG support
319 : : UNSPECV_UMWAIT
320 : : UNSPECV_UMONITOR
321 : : UNSPECV_TPAUSE
322 : :
323 : : ;; For UINTR support
324 : : UNSPECV_CLUI
325 : : UNSPECV_STUI
326 : : UNSPECV_TESTUI
327 : : UNSPECV_SENDUIPI
328 : :
329 : : ;; For CLDEMOTE support
330 : : UNSPECV_CLDEMOTE
331 : :
332 : : ;; For Speculation Barrier support
333 : : UNSPECV_SPECULATION_BARRIER
334 : :
335 : : UNSPECV_PTWRITE
336 : :
337 : : ;; For ENQCMD and ENQCMDS support
338 : : UNSPECV_ENQCMD
339 : : UNSPECV_ENQCMDS
340 : :
341 : : ;; For SERIALIZE support
342 : : UNSPECV_SERIALIZE
343 : :
344 : : ;; For patchable area support
345 : : UNSPECV_PATCHABLE_AREA
346 : :
347 : : ;; For HRESET support
348 : : UNSPECV_HRESET
349 : :
350 : : ;; For PREFETCHI support
351 : : UNSPECV_PREFETCHI
352 : :
353 : : ;; For USER_MSR support
354 : : UNSPECV_URDMSR
355 : : UNSPECV_UWRMSR
356 : :
357 : : ;; For AMX-TILE
358 : : UNSPECV_LDTILECFG
359 : : UNSPECV_STTILECFG
360 : : ])
361 : :
362 : : ;; Constants to represent rounding modes in the ROUND instruction
363 : : (define_constants
364 : : [(ROUND_ROUNDEVEN 0x0)
365 : : (ROUND_FLOOR 0x1)
366 : : (ROUND_CEIL 0x2)
367 : : (ROUND_TRUNC 0x3)
368 : : (ROUND_MXCSR 0x4)
369 : : (ROUND_NO_EXC 0x8)
370 : : ])
371 : :
372 : : ;; Constants to represent AVX512F embeded rounding
373 : : (define_constants
374 : : [(ROUND_NEAREST_INT 0)
375 : : (ROUND_NEG_INF 1)
376 : : (ROUND_POS_INF 2)
377 : : (ROUND_ZERO 3)
378 : : (NO_ROUND 4)
379 : : (ROUND_SAE 8)
380 : : ])
381 : :
382 : : ;; Constants to represent pcomtrue/pcomfalse variants
383 : : (define_constants
384 : : [(PCOM_FALSE 0)
385 : : (PCOM_TRUE 1)
386 : : (COM_FALSE_S 2)
387 : : (COM_FALSE_P 3)
388 : : (COM_TRUE_S 4)
389 : : (COM_TRUE_P 5)
390 : : ])
391 : :
392 : : ;; Constants used in the XOP pperm instruction
393 : : (define_constants
394 : : [(PPERM_SRC 0x00) /* copy source */
395 : : (PPERM_INVERT 0x20) /* invert source */
396 : : (PPERM_REVERSE 0x40) /* bit reverse source */
397 : : (PPERM_REV_INV 0x60) /* bit reverse & invert src */
398 : : (PPERM_ZERO 0x80) /* all 0's */
399 : : (PPERM_ONES 0xa0) /* all 1's */
400 : : (PPERM_SIGN 0xc0) /* propagate sign bit */
401 : : (PPERM_INV_SIGN 0xe0) /* invert & propagate sign */
402 : : (PPERM_SRC1 0x00) /* use first source byte */
403 : : (PPERM_SRC2 0x10) /* use second source byte */
404 : : ])
405 : :
406 : : ;; Registers by name.
407 : : (define_constants
408 : : [(AX_REG 0)
409 : : (DX_REG 1)
410 : : (CX_REG 2)
411 : : (BX_REG 3)
412 : : (SI_REG 4)
413 : : (DI_REG 5)
414 : : (BP_REG 6)
415 : : (SP_REG 7)
416 : : (ST0_REG 8)
417 : : (ST1_REG 9)
418 : : (ST2_REG 10)
419 : : (ST3_REG 11)
420 : : (ST4_REG 12)
421 : : (ST5_REG 13)
422 : : (ST6_REG 14)
423 : : (ST7_REG 15)
424 : : (ARGP_REG 16)
425 : : (FLAGS_REG 17)
426 : : (FPSR_REG 18)
427 : : (FRAME_REG 19)
428 : : (XMM0_REG 20)
429 : : (XMM1_REG 21)
430 : : (XMM2_REG 22)
431 : : (XMM3_REG 23)
432 : : (XMM4_REG 24)
433 : : (XMM5_REG 25)
434 : : (XMM6_REG 26)
435 : : (XMM7_REG 27)
436 : : (MM0_REG 28)
437 : : (MM1_REG 29)
438 : : (MM2_REG 30)
439 : : (MM3_REG 31)
440 : : (MM4_REG 32)
441 : : (MM5_REG 33)
442 : : (MM6_REG 34)
443 : : (MM7_REG 35)
444 : : (R8_REG 36)
445 : : (R9_REG 37)
446 : : (R10_REG 38)
447 : : (R11_REG 39)
448 : : (R12_REG 40)
449 : : (R13_REG 41)
450 : : (R14_REG 42)
451 : : (R15_REG 43)
452 : : (XMM8_REG 44)
453 : : (XMM9_REG 45)
454 : : (XMM10_REG 46)
455 : : (XMM11_REG 47)
456 : : (XMM12_REG 48)
457 : : (XMM13_REG 49)
458 : : (XMM14_REG 50)
459 : : (XMM15_REG 51)
460 : : (XMM16_REG 52)
461 : : (XMM17_REG 53)
462 : : (XMM18_REG 54)
463 : : (XMM19_REG 55)
464 : : (XMM20_REG 56)
465 : : (XMM21_REG 57)
466 : : (XMM22_REG 58)
467 : : (XMM23_REG 59)
468 : : (XMM24_REG 60)
469 : : (XMM25_REG 61)
470 : : (XMM26_REG 62)
471 : : (XMM27_REG 63)
472 : : (XMM28_REG 64)
473 : : (XMM29_REG 65)
474 : : (XMM30_REG 66)
475 : : (XMM31_REG 67)
476 : : (MASK0_REG 68)
477 : : (MASK1_REG 69)
478 : : (MASK2_REG 70)
479 : : (MASK3_REG 71)
480 : : (MASK4_REG 72)
481 : : (MASK5_REG 73)
482 : : (MASK6_REG 74)
483 : : (MASK7_REG 75)
484 : : (R16_REG 76)
485 : : (R17_REG 77)
486 : : (R18_REG 78)
487 : : (R19_REG 79)
488 : : (R20_REG 80)
489 : : (R21_REG 81)
490 : : (R22_REG 82)
491 : : (R23_REG 83)
492 : : (R24_REG 84)
493 : : (R25_REG 85)
494 : : (R26_REG 86)
495 : : (R27_REG 87)
496 : : (R28_REG 88)
497 : : (R29_REG 89)
498 : : (R30_REG 90)
499 : : (R31_REG 91)
500 : : (FIRST_PSEUDO_REG 92)
501 : : ])
502 : :
503 : : ;; Insn callee abi index.
504 : : (define_constants
505 : : [(ABI_DEFAULT 0)
506 : : (ABI_VZEROUPPER 1)
507 : : (ABI_UNKNOWN 2)])
508 : :
509 : : ;; Insns whose names begin with "x86_" are emitted by gen_FOO calls
510 : : ;; from i386.cc.
511 : :
512 : : ;; In C guard expressions, put expressions which may be compile-time
513 : : ;; constants first. This allows for better optimization. For
514 : : ;; example, write "TARGET_64BIT && reload_completed", not
515 : : ;; "reload_completed && TARGET_64BIT".
516 : :
517 : :
518 : : ;; Processor type.
519 : : (define_attr "cpu" "none,pentium,pentiumpro,geode,k6,athlon,k8,core2,nehalem,
520 : : atom,slm,glm,haswell,generic,lujiazui,yongfeng,amdfam10,bdver1,
521 : : bdver2,bdver3,bdver4,btver2,znver1,znver2,znver3,znver4,
522 : : znver5"
523 : 1427387 : (const (symbol_ref "ix86_schedule")))
524 : 302967 :
525 : : ;; A basic instruction type. Refinements due to arguments to be
526 : 210 : ;; provided in other attributes.
527 : 1427387 : (define_attr "type"
528 : 29168593 : "other,multi,
529 : 1427387 : alu,alu1,negnot,imov,imovx,lea,
530 : 39956761 : incdec,ishift,ishiftx,ishift1,rotate,rotatex,rotate1,
531 : : imul,imulx,idiv,icmp,test,ibr,setcc,icmov,
532 : 0 : push,pop,call,callv,leave,
533 : 16515061 : str,bitmanip,
534 : 21877 : fmov,fop,fsgn,fmul,fdiv,fpspc,fcmov,fcmp,
535 : 25037 : fxch,fistp,fisttp,frndint,
536 : 10762 : sse,ssemov,sseadd,sseadd1,sseiadd,sseiadd1,
537 : 7602 : ssemul,sseimul,ssediv,sselog,sselog1,
538 : 14805488 : sseishft,sseishft1,ssecmp,ssecomi,
539 : 127859 : ssecvt,ssecvt1,sseicvt,sseins,
540 : 47076090 : sseshuf,sseshuf1,ssemuladd,sse4arg,
541 : 3756620 : lwp,mskmov,msklog,
542 : 3756620 : mmx,mmxmov,mmxadd,mmxmul,mmxcmp,mmxcvt,mmxshft"
543 : 0 : (const_string "other"))
544 : 0 :
545 : 0 : ;; Main data type used by the insn
546 : 10711747 : (define_attr "mode"
547 : 10786098 : "unknown,none,QI,HI,SI,DI,TI,OI,XI,HF,BF,SF,DF,XF,TF,
548 : 2478605 : V32HF,V16HF,V8HF,V4HF,V2HF,V32BF,V16BF,V8BF,V4BF,V2BF,
549 : 5 : V16SF,V8SF,V4DF,V4SF,V2DF,V2SF,V1DF,V8DF"
550 : 5 : (const_string "unknown"))
551 : 0 :
552 : 10323460 : ;; The CPU unit operations uses.
553 : 10323460 : (define_attr "unit" "integer,i387,sse,mmx,unknown"
554 : 5 : (cond [(eq_attr "type" "fmov,fop,fsgn,fmul,fdiv,fpspc,fcmov,fcmp,
555 : 32533372 : fxch,fistp,fisttp,frndint")
556 : 32533372 : (const_string "i387")
557 : 8 : (eq_attr "type" "sse,ssemov,sseadd,sseadd1,sseiadd,sseiadd1,
558 : 8 : ssemul,sseimul,ssediv,sselog,sselog1,
559 : 5350409 : sseishft,sseishft1,ssecmp,ssecomi,
560 : 32533364 : ssecvt,ssecvt1,sseicvt,sseins,
561 : 32533364 : sseshuf,sseshuf1,ssemuladd,sse4arg,mskmov")
562 : 32533364 : (const_string "sse")
563 : 32533366 : (eq_attr "type" "mmx,mmxmov,mmxadd,mmxmul,mmxcmp,mmxcvt,mmxshft")
564 : 0 : (const_string "mmx")
565 : 0 : (eq_attr "type" "other")
566 : 2 : (const_string "unknown")]
567 : 412172366 : (const_string "integer")))
568 : 32533364 :
569 : 0 : ;; Used to control the "enabled" attribute on a per-instruction basis.
570 : 0 : (define_attr "isa" "base,x64,nox64,x64_sse2,x64_sse4,x64_sse4_noavx,
571 : 32533364 : x64_avx,x64_avx512bw,x64_avx512dq,apx_ndd,apx_ndd_64,
572 : 379639002 : sse_noavx,sse2,sse2_noavx,sse3,sse3_noavx,sse4,sse4_noavx,
573 : 0 : avx,noavx,avx2,noavx2,bmi,bmi2,fma4,fma,avx512f,avx512f_512,
574 : 119194885 : noavx512f,avx512bw,avx512bw_512,noavx512bw,avx512dq,
575 : 0 : noavx512dq,fma_or_avx512vl,avx512vl,noavx512vl,avxvnni,
576 : 86661521 : avx512vnnivl,avx512fp16,avxifma,avx512ifmavl,avxneconvert,
577 : 2 : avx512bf16vl,vpclmulqdqvl,avx_noavx512f,avx_noavx512vl,
578 : 2 : vaes_avx512vl"
579 : 32533364 : (const_string "base"))
580 : 32533364 :
581 : 0 : ;; The (bounding maximum) length of an instruction immediate.
582 : 32533364 : (define_attr "length_immediate" ""
583 : 32533364 : (cond [(eq_attr "type" "incdec,setcc,icmov,str,lea,other,multi,idiv,leave,
584 : 2 : bitmanip,imulx,msklog,mskmov")
585 : 0 : (const_int 0)
586 : 85189 : (ior (eq_attr "type" "sse4arg")
587 : 85189 : (eq_attr "isa" "fma4"))
588 : 2 : (const_int 1)
589 : 2 : (eq_attr "unit" "i387,sse,mmx")
590 : 32533364 : (const_int 0)
591 : 32533364 : (eq_attr "type" "alu,alu1,negnot,imovx,ishift,ishiftx,ishift1,
592 : 32533364 : rotate,rotatex,rotate1,imul,icmp,push,pop")
593 : 2444192 : (symbol_ref "ix86_attr_length_immediate_default (insn, true)")
594 : 97489781 : (eq_attr "type" "imov,test")
595 : 9425266 : (symbol_ref "ix86_attr_length_immediate_default (insn, false)")
596 : 122571954 : (eq_attr "type" "call")
597 : 9425529 : (if_then_else (match_operand 0 "constant_call_address_operand")
598 : 1034830 : (const_int 4)
599 : 81267467 : (const_int 0))
600 : 15296105 : (eq_attr "type" "callv")
601 : 1033958 : (if_then_else (match_operand 1 "constant_call_address_operand")
602 : 45323 : (const_int 4)
603 : 17068 : (const_int 0))
604 : 9671881 : ;; We don't know the size before shorten_branches. Expect
605 : 3000474 : ;; the instruction to fit for better scheduling.
606 : 11145370 : (eq_attr "type" "ibr")
607 : 1508893 : (const_int 1)
608 : 755812 : ]
609 : 2690011 : (symbol_ref "/* Update immediate_length and other attributes! */
610 : 2689079 : gcc_unreachable (),1")))
611 : 55203291 :
612 : 944553 : ;; The (bounding maximum) length of an instruction address.
613 : 1576325 : (define_attr "length_address" ""
614 : 208345625 : (cond [(eq_attr "type" "str,other,multi,fxch")
615 : 208345679 : (const_int 0)
616 : 2402976 : (and (eq_attr "type" "call")
617 : 2332674 : (match_operand 0 "constant_call_address_operand"))
618 : 2260 : (const_int 0)
619 : 57177275 : (and (eq_attr "type" "callv")
620 : 176743 : (match_operand 1 "constant_call_address_operand"))
621 : 198907713 : (const_int 0)
622 : 54 : ]
623 : 74979 : (symbol_ref "ix86_attr_length_address_default (insn)")))
624 : 243807 :
625 : 138192368 : ;; Set when length prefix is used.
626 : 0 : (define_attr "prefix_data16" ""
627 : 509110623 : (cond [(eq_attr "type" "ssemuladd,sse4arg,sseiadd1,ssecvt1")
628 : 380477623 : (const_int 0)
629 : 9430467 : (eq_attr "mode" "HI")
630 : 110441815 : (const_int 1)
631 : 243801 : (and (eq_attr "unit" "sse") (eq_attr "mode" "V2DF,TI"))
632 : 4862675 : (const_int 1)
633 : 6759756 : ]
634 : 557446588 : (const_int 0)))
635 : 1246267 :
636 : 19433447 : ;; Set when string REP prefix is used.
637 : 29347140 : (define_attr "prefix_rep" ""
638 : 22190651 : (cond [(eq_attr "type" "ssemuladd,sse4arg,sseiadd1,ssecvt1")
639 : 22499506 : (const_int 0)
640 : 13286445 : (and (eq_attr "unit" "sse") (eq_attr "mode" "SF,DF"))
641 : 52388212 : (const_int 1)
642 : 4154073 : ]
643 : 19317240 : (const_int 0)))
644 : 473103 :
645 : 11453130 : ;; Set when 0f opcode prefix is used.
646 : 14746801 : (define_attr "prefix_0f" ""
647 : 19204136 : (if_then_else
648 : 24149 : (ior (eq_attr "type" "imovx,setcc,icmov,bitmanip,msklog,mskmov")
649 : 494967 : (eq_attr "unit" "sse,mmx"))
650 : 4648565 : (const_int 1)
651 : 19180023 : (const_int 0)))
652 : 4154073 :
653 : 46 : ;; Set when REX opcode prefix is used.
654 : 0 : (define_attr "prefix_rex" ""
655 : 23077147 : (cond [(not (match_test "TARGET_64BIT"))
656 : 52151836 : (const_int 0)
657 : 689798495 : (and (eq_attr "mode" "DI")
658 : 312344 : (and (eq_attr "type" "!push,pop,call,callv,leave,ibr")
659 : 507217945 : (eq_attr "unit" "!mmx")))
660 : 51892958 : (const_int 1)
661 : 971456 : (and (eq_attr "mode" "QI")
662 : 10597137 : (match_test "x86_extended_QIreg_mentioned_p (insn)"))
663 : 297188382 : (const_int 1)
664 : 206565745 : (match_test "x86_extended_reg_mentioned_p (insn)")
665 : 4486021 : (const_int 1)
666 : 152623607 : (and (eq_attr "type" "imovx")
667 : 241444431 : (match_operand:QI 1 "ext_QIreg_operand"))
668 : 9701400 : (const_int 1)
669 : 50065251 : ]
670 : 23264295 : (const_int 0)))
671 : 212447905 :
672 : 382170 : ;; There are also additional prefixes in 3DNOW, SSSE3.
673 : 266560372 : ;; 3DNOW has 0f0f prefix, SSSE3 and SSE4_{1,2} 0f38/0f3a.
674 : 172706333 : ;; While generally inapplicable to VEX/XOP/EVEX encodings, "length_vex" uses
675 : 388739951 : ;; the attribute evaluating to zero to know that VEX2 encoding may be usable.
676 : 14740176 : (define_attr "prefix_extra" ""
677 : 5007322 : (cond [(eq_attr "type" "ssemuladd,sse4arg,sseiadd1,ssecvt1")
678 : 216263063 : (const_int 1)
679 : 424048878 : ]
680 : 2159884 : (const_int 0)))
681 : 144083429 :
682 : 380501598 : ;; Prefix used: original, VEX or maybe VEX.
683 : 52263541 : (define_attr "prefix" "orig,vex,maybe_vex,evex,maybe_evex"
684 : 4592477 : (cond [(eq_attr "mode" "OI,V8SF,V4DF")
685 : 4640948 : (const_string "vex")
686 : 132797 : (eq_attr "mode" "XI,V16SF,V8DF")
687 : 2125836 : (const_string "evex")
688 : 46 : (eq_attr "type" "ssemuladd")
689 : 452423 : (if_then_else (eq_attr "isa" "fma4")
690 : 454500 : (const_string "vex")
691 : 16843876 : (const_string "maybe_evex"))
692 : 16843876 : (eq_attr "type" "sse4arg")
693 : 54785896 : (const_string "vex")
694 : 54785896 : ]
695 : 79190390 : (const_string "orig")))
696 : 155 :
697 : 155 : ;; VEX W bit is used.
698 : 54784147 : (define_attr "prefix_vex_w" "" (const_int 0))
699 : 279 :
700 : 198 : ;; The length of VEX prefix
701 : 198 : ;; Only instructions with 0f prefix can have 2 byte VEX prefix,
702 : 172598 : ;; 0f38/0f3a prefixes can't. In i386.md 0f3[8a] is
703 : 173295 : ;; still prefix_0f 1, with prefix_extra 1.
704 : 697 : (define_attr "length_vex" ""
705 : 399 : (if_then_else (and (eq_attr "prefix_0f" "1")
706 : 0 : (eq_attr "prefix_extra" "0"))
707 : 4468 : (if_then_else (eq_attr "prefix_vex_w" "1")
708 : 241903 : (symbol_ref "ix86_attr_length_vex_default (insn, true, true)")
709 : 381341 : (symbol_ref "ix86_attr_length_vex_default (insn, true, false)"))
710 : 79196201 : (if_then_else (eq_attr "prefix_vex_w" "1")
711 : 6942 : (symbol_ref "ix86_attr_length_vex_default (insn, false, true)")
712 : 6942 : (symbol_ref "ix86_attr_length_vex_default (insn, false, false)"))))
713 : 913707 :
714 : 618033 : ;; 4-bytes evex prefix and 1 byte opcode.
715 : 4413233 : (define_attr "length_evex" "" (const_int 5))
716 : 5367619 :
717 : 1812727 : ;; Set when modrm byte is used.
718 : 826272 : (define_attr "modrm" ""
719 : 1171927 : (cond [(eq_attr "type" "str,leave")
720 : 730403 : (const_int 0)
721 : 551782 : (eq_attr "unit" "i387")
722 : 388799921 : (const_int 0)
723 : 321855 : (and (eq_attr "type" "incdec")
724 : 309432 : (and (not (match_test "TARGET_64BIT"))
725 : 81017418 : (ior (match_operand:SI 1 "register_operand")
726 : 138647 : (match_operand:HI 1 "register_operand"))))
727 : 0 : (const_int 0)
728 : 165192 : (and (eq_attr "type" "push")
729 : 81026495 : (not (match_operand 1 "memory_operand")))
730 : 9077 : (const_int 0)
731 : 15170 : (and (eq_attr "type" "pop")
732 : 6093 : (not (match_operand 0 "memory_operand")))
733 : 0 : (const_int 0)
734 : 6093 : (and (eq_attr "type" "imov")
735 : 88519 : (and (not (eq_attr "mode" "DI"))
736 : 88519 : (ior (and (match_operand 0 "register_operand")
737 : 56273 : (match_operand 1 "immediate_operand"))
738 : 221332 : (ior (and (match_operand 0 "ax_reg_operand")
739 : 132813 : (match_operand 1 "memory_displacement_only_operand"))
740 : 80924650 : (and (match_operand 0 "memory_displacement_only_operand")
741 : 80924650 : (match_operand 1 "ax_reg_operand"))))))
742 : 1844 : (const_int 0)
743 : 134633 : (and (eq_attr "type" "call")
744 : 80922806 : (match_operand 0 "constant_call_address_operand"))
745 : 80922806 : (const_int 0)
746 : 80922806 : (and (eq_attr "type" "callv")
747 : 80922806 : (match_operand 1 "constant_call_address_operand"))
748 : 80922806 : (const_int 0)
749 : 80922806 : (and (eq_attr "type" "alu,alu1,icmp,test")
750 : 0 : (match_operand 0 "ax_reg_operand"))
751 : 14024278 : (symbol_ref "(get_attr_length_immediate (insn) <= (get_attr_mode (insn) != MODE_QI))")
752 : 81106710 : ]
753 : 81106710 : (const_int 1)))
754 : 0 :
755 : 194637215 : ;; The (bounding maximum) length of an instruction in bytes.
756 : 28830 : ;; ??? fistp and frndint are in fact fldcw/{fistp,frndint}/fldcw sequences.
757 : 183904 : ;; Later we may want to split them and compute proper length as for
758 : 155074 : ;; other insns.
759 : 147693055 : (define_attr "length" ""
760 : 148895821 : (cond [(eq_attr "type" "other,multi,fistp,frndint")
761 : 4633408 : (const_int 16)
762 : 873569 : (eq_attr "type" "fcmp")
763 : 704256 : (const_int 4)
764 : 22817 : (eq_attr "unit" "i387")
765 : 22947 : (plus (const_int 2)
766 : 142704185 : (plus (attr "prefix_data16")
767 : 4639768 : (attr "length_address")))
768 : 88939065 : (ior (eq_attr "prefix" "evex")
769 : 584644048 : (and (ior (eq_attr "prefix" "maybe_evex")
770 : 144500116 : (eq_attr "prefix" "maybe_vex"))
771 : 6441804 : (match_test "TARGET_AVX512F")))
772 : 2438513 : (plus (attr "length_evex")
773 : 3403425 : (plus (attr "length_immediate")
774 : 142713043 : (plus (attr "modrm")
775 : 285993424 : (attr "length_address"))))
776 : 301 : (ior (eq_attr "prefix" "vex")
777 : 1876160 : (and (ior (eq_attr "prefix" "maybe_vex")
778 : 1899636 : (eq_attr "prefix" "maybe_evex"))
779 : 148810350 : (match_test "TARGET_AVX")))
780 : 417629 : (plus (attr "length_vex")
781 : 5233297 : (plus (attr "length_immediate")
782 : 372834 : (plus (attr "modrm")
783 : 47635013 : (attr "length_address"))))]
784 : 5473 : (plus (plus (attr "modrm")
785 : 276528579 : (plus (attr "prefix_0f")
786 : 643807 : (plus (attr "prefix_rex")
787 : 324435047 : (plus (attr "prefix_extra")
788 : 350801097 : (const_int 1)))))
789 : 22872890 : (plus (attr "prefix_rep")
790 : 109320 : (plus (attr "prefix_data16")
791 : 9111597 : (plus (attr "length_immediate")
792 : 8537714 : (attr "length_address")))))))
793 : 4 :
794 : 86995180 : ;; The `memory' attribute is `none' if no memory is referenced, `load' or
795 : 425151935 : ;; `store' if there is a simple memory reference therein, or `unknown'
796 : 49239 : ;; if the instruction is complex.
797 : 1332051 :
798 : 1096 : (define_attr "memory" "none,load,store,both,unknown"
799 : 141448269 : (cond [(eq_attr "type" "other,multi,str,lwp")
800 : 343898554 : (const_string "unknown")
801 : 5833795 : (eq_attr "type" "lea,fcmov,fpspc")
802 : 5833773 : (const_string "none")
803 : 52087675 : (eq_attr "type" "fistp,leave")
804 : 0 : (const_string "both")
805 : 2606573 : (eq_attr "type" "frndint")
806 : 2606718 : (const_string "load")
807 : 3607 : (eq_attr "type" "push")
808 : 3462 : (if_then_else (match_operand 1 "memory_operand")
809 : 0 : (const_string "both")
810 : 0 : (const_string "store"))
811 : 191958 : (eq_attr "type" "pop")
812 : 195420 : (if_then_else (match_operand 0 "memory_operand")
813 : 0 : (const_string "both")
814 : 932 : (const_string "load"))
815 : 173171 : (eq_attr "type" "setcc")
816 : 188382 : (if_then_else (match_operand 0 "memory_operand")
817 : 448722 : (const_string "store")
818 : 448722 : (const_string "none"))
819 : 136 : (eq_attr "type" "icmp,test,ssecmp,ssecomi,mmxcmp,fcmp")
820 : 212724 : (if_then_else (ior (match_operand 0 "memory_operand")
821 : 495 : (match_operand 1 "memory_operand"))
822 : 122132494 : (const_string "load")
823 : 122132494 : (const_string "none"))
824 : 122132494 : (eq_attr "type" "ibr")
825 : 0 : (if_then_else (match_operand 0 "memory_operand")
826 : 0 : (const_string "load")
827 : 1313 : (const_string "none"))
828 : 1313 : (eq_attr "type" "call")
829 : 3955621 : (if_then_else (match_operand 0 "constant_call_address_operand")
830 : 3983797 : (const_string "none")
831 : 28176 : (const_string "load"))
832 : 680519 : (eq_attr "type" "callv")
833 : 680519 : (if_then_else (match_operand 1 "constant_call_address_operand")
834 : 128768456 : (const_string "none")
835 : 27172 : (const_string "load"))
836 : 0 : (and (eq_attr "type" "alu1,negnot,ishift1,rotate1,sselog1,sseshuf1")
837 : 0 : (match_operand 1 "memory_operand"))
838 : 69 : (const_string "both")
839 : 69 : (and (match_operand 0 "memory_operand")
840 : 10592728 : (match_operand 1 "memory_operand"))
841 : 19866632 : (const_string "both")
842 : 9273904 : (match_operand 0 "memory_operand")
843 : 0 : (const_string "store")
844 : 38773161 : (match_operand 1 "memory_operand")
845 : 124 : (const_string "load")
846 : 9273997 : (and (eq_attr "type"
847 : 1322174 : "!alu1,negnot,ishift1,rotate1,
848 : 0 : imov,imovx,icmp,test,bitmanip,
849 : 82416095 : fmov,fcmp,fsgn,
850 : 9273873 : sse,ssemov,ssecmp,ssecomi,ssecvt,ssecvt1,sseicvt,
851 : 112349106 : sselog1,sseshuf1,sseadd1,sseiadd1,sseishft1,
852 : 0 : mmx,mmxmov,mmxcmp,mmxcvt,mskmov,msklog")
853 : 112358291 : (match_operand 2 "memory_operand"))
854 : 9185 : (const_string "load")
855 : 9185 : (and (eq_attr "type" "icmov,ssemuladd,sse4arg")
856 : 783523 : (match_operand 3 "memory_operand"))
857 : 783523 : (const_string "load")
858 : 1516106 : ]
859 : 1516106 : (const_string "none")))
860 : 0 :
861 : 465628 : ;; Indicates if an instruction has both an immediate and a displacement.
862 : 0 :
863 : 16 : (define_attr "imm_disp" "false,true,unknown"
864 : 110842580 : (cond [(eq_attr "type" "other,multi")
865 : 8906 : (const_string "unknown")
866 : 8906 : (and (eq_attr "type" "icmp,test,imov,alu1,ishift1,rotate1")
867 : 72089977 : (and (match_operand 0 "memory_displacement_operand")
868 : 1637823332 : (match_operand 1 "immediate_operand")))
869 : 856715246 : (const_string "true")
870 : 1061016095 : (and (eq_attr "type" "alu,ishift,ishiftx,rotate,rotatex,imul,idiv")
871 : 3135 : (and (match_operand 0 "memory_displacement_operand")
872 : 32 : (match_operand 2 "immediate_operand")))
873 : 3210411 : (const_string "true")
874 : 3210411 : ]
875 : 112610542 : (const_string "false")))
876 : 112610542 :
877 : 0 : ;; Indicates if an FP operation has an integer source.
878 : 1629 :
879 : 582240 : (define_attr "fp_int_src" "false,true"
880 : 582187 : (const_string "false"))
881 : 111655554 :
882 : 111655554 : ;; Defines rounding mode of an FP operation.
883 : 111655554 :
884 : 0 : (define_attr "i387_cw" "roundeven,floor,ceil,trunc,uninitialized,any"
885 : 0 : (const_string "any"))
886 : 111655554 :
887 : 0 : ;; Define attribute to indicate AVX insns with partial XMM register update.
888 : 475040 : (define_attr "avx_partial_xmm_update" "false,true"
889 : 475040 : (const_string "false"))
890 : 0 :
891 : 112521746 : ;; Define attribute to classify add/sub insns that consumes carry flag (CF)
892 : 112521746 : (define_attr "use_carry" "0,1" (const_string "0"))
893 : 866192 :
894 : 866192 : ;; Define attribute to indicate unaligned ssemov insns
895 : 111655554 : (define_attr "movu" "0,1" (const_string "0"))
896 : 392168781 :
897 : 0 : ;; Define attribute to limit memory address register set.
898 : 111961436 : (define_attr "addr" "gpr8,gpr16,gpr32" (const_string "gpr32"))
899 : 280513227 :
900 : 111961436 : ;; Define instruction set of MMX instructions
901 : 111962198 : (define_attr "mmx_isa" "base,native,sse,sse_noavx,avx"
902 : 111962198 : (const_string "base"))
903 : 112451453 :
904 : 489255 : (define_attr "enabled" ""
905 : 489255 : (cond [(eq_attr "isa" "x64") (symbol_ref "TARGET_64BIT")
906 : 136517421 : (eq_attr "isa" "nox64") (symbol_ref "!TARGET_64BIT")
907 : 13671 : (eq_attr "isa" "x64_sse2")
908 : 480247681 : (symbol_ref "TARGET_64BIT && TARGET_SSE2")
909 : 762 : (eq_attr "isa" "x64_sse4")
910 : 479530044 : (symbol_ref "TARGET_64BIT && TARGET_SSE4_1")
911 : 7774 : (eq_attr "isa" "x64_sse4_noavx")
912 : 9446 : (symbol_ref "TARGET_64BIT && TARGET_SSE4_1 && !TARGET_AVX")
913 : 2870012 : (eq_attr "isa" "x64_avx")
914 : 3357663 : (symbol_ref "TARGET_64BIT && TARGET_AVX")
915 : 16618 : (eq_attr "isa" "x64_avx512bw")
916 : 25253451 : (symbol_ref "TARGET_64BIT && TARGET_AVX512BW")
917 : 24711827 : (eq_attr "isa" "x64_avx512dq")
918 : 781899 : (symbol_ref "TARGET_64BIT && TARGET_AVX512DQ")
919 : 179895 : (eq_attr "isa" "sse_noavx")
920 : 342005 : (symbol_ref "TARGET_SSE && !TARGET_AVX")
921 : 544972286 : (eq_attr "isa" "sse2") (symbol_ref "TARGET_SSE2")
922 : 948 : (eq_attr "isa" "sse2_noavx")
923 : 14639836 : (symbol_ref "TARGET_SSE2 && !TARGET_AVX")
924 : 273577 : (eq_attr "isa" "sse3") (symbol_ref "TARGET_SSE3")
925 : 10566018 : (eq_attr "isa" "sse3_noavx")
926 : 194760 : (symbol_ref "TARGET_SSE3 && !TARGET_AVX")
927 : 198771325 : (eq_attr "isa" "sse4") (symbol_ref "TARGET_SSE4_1")
928 : 3447204 : (eq_attr "isa" "sse4_noavx")
929 : 22201394 : (symbol_ref "TARGET_SSE4_1 && !TARGET_AVX")
930 : 77213598 : (eq_attr "isa" "avx") (symbol_ref "TARGET_AVX")
931 : 172645651 : (eq_attr "isa" "avx_noavx512f")
932 : 115873354 : (symbol_ref "TARGET_AVX && !TARGET_AVX512F")
933 : 196827047 : (eq_attr "isa" "avx_noavx512vl")
934 : 6576356 : (symbol_ref "TARGET_AVX && !TARGET_AVX512VL")
935 : 57140998 : (eq_attr "isa" "noavx") (symbol_ref "!TARGET_AVX")
936 : 151683848 : (eq_attr "isa" "avx2") (symbol_ref "TARGET_AVX2")
937 : 164078 : (eq_attr "isa" "noavx2") (symbol_ref "!TARGET_AVX2")
938 : 158609739 : (eq_attr "isa" "bmi") (symbol_ref "TARGET_BMI")
939 : 145131200 : (eq_attr "isa" "bmi2") (symbol_ref "TARGET_BMI2")
940 : 18976617 : (eq_attr "isa" "fma4") (symbol_ref "TARGET_FMA4")
941 : 2901339 : (eq_attr "isa" "fma") (symbol_ref "TARGET_FMA")
942 : 36565 : (eq_attr "isa" "fma_or_avx512vl")
943 : 566264 : (symbol_ref "TARGET_FMA || TARGET_AVX512VL")
944 : 33522 : (eq_attr "isa" "avx512f") (symbol_ref "TARGET_AVX512F")
945 : 5239248 : (eq_attr "isa" "avx512f_512")
946 : 6989141 : (symbol_ref "TARGET_AVX512F && TARGET_EVEX512")
947 : 62819 : (eq_attr "isa" "noavx512f") (symbol_ref "!TARGET_AVX512F")
948 : 313964 : (eq_attr "isa" "avx512bw") (symbol_ref "TARGET_AVX512BW")
949 : 130391 : (eq_attr "isa" "avx512bw_512")
950 : 1967364 : (symbol_ref "TARGET_AVX512BW && TARGET_EVEX512")
951 : 364457 : (eq_attr "isa" "noavx512bw") (symbol_ref "!TARGET_AVX512BW")
952 : 8330341 : (eq_attr "isa" "avx512dq") (symbol_ref "TARGET_AVX512DQ")
953 : 43254957 : (eq_attr "isa" "noavx512dq") (symbol_ref "!TARGET_AVX512DQ")
954 : 47263626 : (eq_attr "isa" "avx512vl") (symbol_ref "TARGET_AVX512VL")
955 : 311297 : (eq_attr "isa" "noavx512vl") (symbol_ref "!TARGET_AVX512VL")
956 : 8169031 : (eq_attr "isa" "avxvnni") (symbol_ref "TARGET_AVXVNNI")
957 : 160107 : (eq_attr "isa" "avx512vnnivl")
958 : 4805124 : (symbol_ref "TARGET_AVX512VNNI && TARGET_AVX512VL")
959 : 2116687 : (eq_attr "isa" "avx512fp16")
960 : 40302131 : (symbol_ref "TARGET_AVX512FP16")
961 : 13577462 : (eq_attr "isa" "avxifma") (symbol_ref "TARGET_AVXIFMA")
962 : 113171 : (eq_attr "isa" "avx512ifmavl")
963 : 7261613 : (symbol_ref "TARGET_AVX512IFMA && TARGET_AVX512VL")
964 : 62239 : (eq_attr "isa" "avxneconvert") (symbol_ref "TARGET_AVXNECONVERT")
965 : 1627380 : (eq_attr "isa" "avx512bf16vl")
966 : 879229 : (symbol_ref "TARGET_AVX512BF16 && TARGET_AVX512VL")
967 : 460224 : (eq_attr "isa" "vpclmulqdqvl")
968 : 1699 : (symbol_ref "TARGET_VPCLMULQDQ && TARGET_AVX512VL")
969 : 28679916 : (eq_attr "isa" "apx_ndd")
970 : 134480045 : (symbol_ref "TARGET_APX_NDD")
971 : 133809720 : (eq_attr "isa" "apx_ndd_64")
972 : 175020 : (symbol_ref "TARGET_APX_NDD && Pmode == DImode")
973 : 79580050 : (eq_attr "isa" "vaes_avx512vl")
974 : 57064523 : (symbol_ref "TARGET_VAES && TARGET_AVX512VL")
975 : 120736015 :
976 : 118222 : (eq_attr "mmx_isa" "native")
977 : 30400444 : (symbol_ref "!TARGET_MMX_WITH_SSE")
978 : 1000543 : (eq_attr "mmx_isa" "sse")
979 : 4173577 : (symbol_ref "TARGET_MMX_WITH_SSE")
980 : 47508117 : (eq_attr "mmx_isa" "sse_noavx")
981 : 57817276 : (symbol_ref "TARGET_MMX_WITH_SSE && !TARGET_AVX")
982 : 10612363 : (eq_attr "mmx_isa" "avx")
983 : 23910376 : (symbol_ref "TARGET_MMX_WITH_SSE && TARGET_AVX")
984 : 1797626 : ]
985 : 289770990 : (const_int 1)))
986 : 287351610 :
987 : 22687532 : (define_attr "preferred_for_size" "" (const_int 1))
988 : 32029807 : (define_attr "preferred_for_speed" "" (const_int 1))
989 : 17656916 :
990 : 288678898 : ;; Describe a user's asm statement.
991 : 4710498 : (define_asm_attributes
992 : 4491294 : [(set_attr "length" "128")
993 : 1495 : (set_attr "type" "multi")])
994 : 9803625 :
995 : 4899818 : (define_code_iterator plusminus [plus minus])
996 : 1584079 : (define_code_iterator plusminusmult [plus minus mult])
997 : 1154 : (define_code_iterator plusminusmultdiv [plus minus mult div])
998 : 2133884 :
999 : 2214131 : (define_code_iterator sat_plusminus [ss_plus us_plus ss_minus us_minus])
1000 : 1552224 :
1001 : 5168823 : ;; Base name for insn mnemonic.
1002 : 93995683 : (define_code_attr plusminus_mnemonic
1003 : 94142043 : [(plus "add") (ss_plus "adds") (us_plus "addus")
1004 : 1233245 : (minus "sub") (ss_minus "subs") (us_minus "subus")])
1005 : 4433738 :
1006 : 689958 : (define_code_iterator multdiv [mult div])
1007 : 94684030 :
1008 : 894 : (define_code_attr multdiv_mnemonic
1009 : 64073351 : [(mult "mul") (div "div")])
1010 : 5187 :
1011 : 97333866 : ;; Mark commutative operators as such in constraints.
1012 : 97656 : (define_code_attr comm [(plus "%") (ss_plus "%") (us_plus "%")
1013 : 266083 : (minus "") (ss_minus "") (us_minus "")
1014 : 664418 : (mult "%") (div "")])
1015 : 58526166 :
1016 : 58017949 : ;; Mapping of max and min
1017 : 130674 : (define_code_iterator maxmin [smax smin umax umin])
1018 : 180 :
1019 : 32348 : ;; Mapping of signed max and min
1020 : 0 : (define_code_iterator smaxmin [smax smin])
1021 : 0 :
1022 : 66231124 : ;; Mapping of unsigned max and min
1023 : 9755220 : (define_code_iterator umaxmin [umax umin])
1024 : 64053035 :
1025 : 13464 : ;; Base name for integer and FP insn mnemonic
1026 : 143530730 : (define_code_attr maxmin_int [(smax "maxs") (smin "mins")
1027 : 143602455 : (umax "maxu") (umin "minu")])
1028 : 85189 : (define_code_attr maxmin_float [(smax "max") (smin "min")])
1029 : 166 :
1030 : 49615 : (define_int_iterator IEEE_MAXMIN
1031 : 35985 : [UNSPEC_IEEE_MAX
1032 : 0 : UNSPEC_IEEE_MIN])
1033 : 11972093 :
1034 : 2449193 : (define_int_attr ieee_maxmin
1035 : 64003586 : [(UNSPEC_IEEE_MAX "max")
1036 : 786297 : (UNSPEC_IEEE_MIN "min")])
1037 : 0 :
1038 : 49081 : ;; Mapping of logic operators
1039 : 13855 : (define_code_iterator any_logic [and ior xor])
1040 : 5393 : (define_code_iterator any_or [ior xor])
1041 : 5387 : (define_code_iterator fpint_logic [and xor])
1042 : 8 :
1043 : 16848 : ;; Base name for insn mnemonic.
1044 : 56481244 : (define_code_attr logic [(and "and") (ior "or") (xor "xor")])
1045 : 56477890 :
1046 : 24149 : ;; Mapping of logic-shift operators
1047 : 27648 : (define_code_iterator any_lshift [ashift lshiftrt])
1048 : 29267 :
1049 : 6050 : ;; Mapping of shift-right operators
1050 : 64464807 : (define_code_iterator any_shiftrt [lshiftrt ashiftrt])
1051 : 3493 :
1052 : 495892 : ;; Mapping of all shift operators
1053 : 495892 : (define_code_iterator any_shift [ashift lshiftrt ashiftrt])
1054 : 0 :
1055 : 143517254 : ;; Base name for insn mnemonic.
1056 : 143524996 : (define_code_attr shift [(ashift "sal") (lshiftrt "shr") (ashiftrt "sar")])
1057 : 503634 : (define_code_attr vshift [(ashift "sll") (lshiftrt "srl") (ashiftrt "sra")])
1058 : 90473 :
1059 : 443 : ;; Mapping of rotate operators
1060 : 63976782 : (define_code_iterator any_rotate [rotate rotatert])
1061 : 6952 :
1062 : 0 : ;; Base name for insn mnemonic.
1063 : 0 : (define_code_attr rotate [(rotate "rol") (rotatert "ror")])
1064 : 83933091 :
1065 : 20898833 : ;; Mapping of abs neg operators
1066 : 22398496 : (define_code_iterator absneg [abs neg])
1067 : 1499753 :
1068 : 675592 : ;; Mapping of abs neg operators to logic operation
1069 : 0 : (define_code_attr absneg_op [(abs "and") (neg "xor")])
1070 : 0 :
1071 : 170847989 : ;; Base name for x87 insn mnemonic.
1072 : 178726 : (define_code_attr absneg_mnemonic [(abs "fabs") (neg "fchs")])
1073 : 67240863 :
1074 : 61667 : ;; Mapping of extend operators
1075 : 79550815 : (define_code_iterator any_extend [sign_extend zero_extend])
1076 : 12258559 :
1077 : 12258559 : ;; Mapping of highpart multiply operators
1078 : 16946 : (define_code_iterator any_mul_highpart [smul_highpart umul_highpart])
1079 : 16946 :
1080 : 33949 : ;; Prefix for insn menmonic.
1081 : 85342 : (define_code_attr sgnprefix [(sign_extend "i") (zero_extend "")
1082 : 64995 : (smul_highpart "i") (umul_highpart "")
1083 : 873821 : (div "i") (udiv "")])
1084 : 5180547 : ;; Prefix for define_insn
1085 : 4320328 : (define_code_attr s [(sign_extend "s") (zero_extend "u")
1086 : 35243 : (smul_highpart "s") (umul_highpart "u")])
1087 : 1276 : (define_code_attr u [(sign_extend "") (zero_extend "u")
1088 : 63362752 : (div "") (udiv "u")])
1089 : 287854 : (define_code_attr u_bool [(sign_extend "false") (zero_extend "true")
1090 : 287868 : (div "false") (udiv "true")])
1091 : 9670208 :
1092 : 10300331 : ;; Used in signed and unsigned truncations.
1093 : 630123 : (define_code_iterator any_truncate [ss_truncate truncate us_truncate])
1094 : 49663 : ;; Instruction suffix for truncations.
1095 : 49663 : (define_code_attr trunsuffix
1096 : 3349 : [(ss_truncate "s") (truncate "") (us_truncate "us")])
1097 : 0 :
1098 : 54552 : ;; Instruction suffix for SSE sign and zero extensions.
1099 : 54552 : (define_code_attr extsuffix [(sign_extend "sx") (zero_extend "zx")])
1100 : 384 :
1101 : 384 : ;; Used in signed and unsigned fix.
1102 : 69730529 : (define_code_iterator any_fix [fix unsigned_fix])
1103 : 84660 : (define_code_attr fixsuffix [(fix "") (unsigned_fix "u")])
1104 : 84660 : (define_code_attr fixunssuffix [(fix "") (unsigned_fix "uns")])
1105 : 34 : (define_code_attr fixprefix [(fix "s") (unsigned_fix "u")])
1106 : 29570 :
1107 : 354756 : ;; Used in signed and unsigned float.
1108 : 6795768 : (define_code_iterator any_float [float unsigned_float])
1109 : 6441034 : (define_code_attr floatsuffix [(float "") (unsigned_float "u")])
1110 : 22045 : (define_code_attr floatunssuffix [(float "") (unsigned_float "uns")])
1111 : 22045 : (define_code_attr floatprefix [(float "s") (unsigned_float "u")])
1112 : 62850101 :
1113 : 64347970 : ;; Base name for expression
1114 : 1497869 : (define_code_attr insn
1115 : 1497869 : [(plus "add") (ss_plus "ssadd") (us_plus "usadd")
1116 : 62850101 : (minus "sub") (ss_minus "sssub") (us_minus "ussub")
1117 : 63339210 : (sign_extend "extend") (zero_extend "zero_extend")
1118 : 489109 : (ashift "ashl") (lshiftrt "lshr") (ashiftrt "ashr")
1119 : 492009 : (rotate "rotl") (rotatert "rotr")
1120 : 12804054 : (mult "mul") (div "div")])
1121 : 12809608 :
1122 : 841757 : ;; All integer modes.
1123 : 841613 : (define_mode_iterator SWI1248x [QI HI SI DI])
1124 : 2463 :
1125 : 62518306 : ;; All integer modes without QImode.
1126 : 62518306 : (define_mode_iterator SWI248x [HI SI DI])
1127 : 0 :
1128 : 2172 : ;; All integer modes without QImode and HImode.
1129 : 62518306 : (define_mode_iterator SWI48x [SI DI])
1130 : 63166111 :
1131 : 63209925 : ;; All integer modes without SImode and DImode.
1132 : 693296 : (define_mode_iterator SWI12 [QI HI])
1133 : 29809321 :
1134 : 29117702 : ;; All integer modes without DImode.
1135 : 33400604 : (define_mode_iterator SWI124 [QI HI SI])
1136 : 0 :
1137 : 574 : ;; All integer modes without QImode and DImode.
1138 : 33400604 : (define_mode_iterator SWI24 [HI SI])
1139 : 33400604 :
1140 : 0 : ;; Single word integer modes.
1141 : 22535 : (define_mode_iterator SWI [QI HI SI (DI "TARGET_64BIT")])
1142 : 12699845 :
1143 : 1595800 : ;; Single word integer modes without QImode.
1144 : 42739312 : (define_mode_iterator SWI248 [HI SI (DI "TARGET_64BIT")])
1145 : 11616757 :
1146 : 39014765 : ;; Single word integer modes without QImode and HImode.
1147 : 3722192 : (define_mode_iterator SWI48 [SI (DI "TARGET_64BIT")])
1148 : 15821959 :
1149 : 88178029 : ;; All math-dependant single and double word integer modes.
1150 : 239632818 : (define_mode_iterator SDWIM [(QI "TARGET_QIMODE_MATH")
1151 : 58390481 : (HI "TARGET_HIMODE_MATH")
1152 : 170204300 : SI DI (TI "TARGET_64BIT")])
1153 : 27801593 :
1154 : 889821556 : ;; Math-dependant single word integer modes.
1155 : 72215975 : (define_mode_iterator SWIM [(QI "TARGET_QIMODE_MATH")
1156 : 49127730 : (HI "TARGET_HIMODE_MATH")
1157 : 67102832 : SI (DI "TARGET_64BIT")])
1158 : 124977525 :
1159 : 108679134 : ;; Math-dependant integer modes without DImode.
1160 : 755030962 : (define_mode_iterator SWIM124 [(QI "TARGET_QIMODE_MATH")
1161 : 819806299 : (HI "TARGET_HIMODE_MATH")
1162 : 79083790 : SI])
1163 : 760025400 :
1164 : 1109348351 : ;; Math-dependant integer modes with DImode.
1165 : 56130352 : (define_mode_iterator SWIM1248x
1166 : 101797568 : [(QI "TARGET_QIMODE_MATH")
1167 : 69350664 : (HI "TARGET_HIMODE_MATH")
1168 : 15560370 : SI DI])
1169 : 1165680260 :
1170 : 1093326733 : ;; Math-dependant single word integer modes without QImode.
1171 : 110065782 : (define_mode_iterator SWIM248 [(HI "TARGET_HIMODE_MATH")
1172 : 30696028 : SI (DI "TARGET_64BIT")])
1173 : 52175201 :
1174 : 72206071 : ;; Double word integer modes.
1175 : 160070202 : (define_mode_iterator DWI [(DI "!TARGET_64BIT")
1176 : 102832920 : (TI "TARGET_64BIT")])
1177 : 93327862 :
1178 : 27658903 : ;; SWI and DWI together.
1179 : 98154028 : (define_mode_iterator SWIDWI [QI HI SI DI (TI "TARGET_64BIT")])
1180 : 89211592 :
1181 : 55792485 : ;; SWI48 and DWI together.
1182 : 16739856 : (define_mode_iterator SWI48DWI [SI DI (TI "TARGET_64BIT")])
1183 : 126894567 :
1184 : 60130895 : ;; GET_MODE_SIZE for selected modes. As GET_MODE_SIZE is not
1185 : 177264879 : ;; compile time constant, it is faster to use <MODE_SIZE> than
1186 : 4567441 : ;; GET_MODE_SIZE (<MODE>mode). For XFmode which depends on
1187 : 6203645 : ;; command line options just use GET_MODE_SIZE macro.
1188 : 54035761 : (define_mode_attr MODE_SIZE [(QI "1") (HI "2") (SI "4") (DI "8")
1189 : 59293653 : (TI "16") (HF "2") (BF "2") (SF "4") (DF "8")
1190 : 1287548 : (XF "GET_MODE_SIZE (XFmode)")
1191 : 58923254 : (V16QI "16") (V32QI "32") (V64QI "64")
1192 : 50698735 : (V8HI "16") (V16HI "32") (V32HI "64")
1193 : 15879479 : (V4SI "16") (V8SI "32") (V16SI "64")
1194 : 15764752 : (V2DI "16") (V4DI "32") (V8DI "64")
1195 : 93800345 : (V1TI "16") (V2TI "32") (V4TI "64")
1196 : 52557772 : (V2DF "16") (V4DF "32") (V8DF "64")
1197 : 64306212 : (V4SF "16") (V8SF "32") (V16SF "64")
1198 : 22365950 : (V8HF "16") (V16HF "32") (V32HF "64")
1199 : 1498633 : (V4HF "8") (V2HF "4")
1200 : 58817910 : (V8BF "16") (V16BF "32") (V32BF "64")
1201 : 50400323 : (V4BF "8") (V2BF "4")])
1202 : 52739568 :
1203 : 53712371 : ;; Double word integer modes as mode attribute.
1204 : 92943856 : (define_mode_attr DWI [(QI "HI") (HI "SI") (SI "DI") (DI "TI") (TI "OI")])
1205 : 50442431 : (define_mode_attr dwi [(QI "hi") (HI "si") (SI "di") (DI "ti") (TI "oi")])
1206 : 324145 :
1207 : 66657189 : ;; Half sized integer modes.
1208 : 31130393 : (define_mode_attr HALF [(TI "DI") (DI "SI")])
1209 : 1184879 : (define_mode_attr half [(TI "di") (DI "si")])
1210 : 46224734 :
1211 : 22078884 : ;; LEA mode corresponding to an integer mode
1212 : 20422109 : (define_mode_attr LEAMODE [(QI "SI") (HI "SI") (SI "SI") (DI "DI")])
1213 : 1630085 :
1214 : 55467607 : ;; Half mode for double word integer modes.
1215 : 24155125 : (define_mode_iterator DWIH [(SI "!TARGET_64BIT")
1216 : 22384606 : (DI "TARGET_64BIT")])
1217 : 34522150 :
1218 : 81675353 : ;; Instruction suffix for integer modes.
1219 : 22329864 : (define_mode_attr imodesuffix [(QI "b") (HI "w") (SI "l") (DI "q")])
1220 : 4473262 :
1221 : 60991055 : ;; Instruction suffix for masks.
1222 : 103602713 : (define_mode_attr mskmodesuffix [(QI "b") (HI "w") (SI "d") (DI "q")])
1223 : 47495987 :
1224 : 23694799 : ;; Pointer size prefix for integer modes (Intel asm dialect)
1225 : 5056041 : (define_mode_attr iptrsize [(QI "BYTE")
1226 : 3733192 : (HI "WORD")
1227 : 154090834 : (SI "DWORD")
1228 : 25275146 : (DI "QWORD")])
1229 : 39540198 :
1230 : 68909719 : ;; Register class for integer modes.
1231 : 71947163 : (define_mode_attr r [(QI "q") (HI "r") (SI "r") (DI "r")])
1232 : 86622068 :
1233 : 23198932 : ;; Immediate operand constraint for integer modes.
1234 : 22332954 : (define_mode_attr i [(QI "n") (HI "n") (SI "e") (DI "e")])
1235 : 22792457 :
1236 : 24181002 : ;; General operand constraint for word modes.
1237 : 22179260 : (define_mode_attr g [(QI "qmn") (HI "rmn") (SI "rme") (DI "rme")])
1238 : 20601298 :
1239 : 22183666 : ;; Memory operand constraint for word modes.
1240 : 20614510 : (define_mode_attr m [(QI "m") (HI "m") (SI "BM") (DI "BM")])
1241 : 21294973 :
1242 : 23199781 : ;; Immediate operand constraint for double integer modes.
1243 : 21618358 : (define_mode_attr di [(SI "nF") (DI "Wd")])
1244 : 198090 :
1245 : 386772 : ;; Immediate operand constraint for shifts.
1246 : 31006561 : (define_mode_attr S [(QI "I") (HI "I") (SI "I") (DI "J") (TI "O")])
1247 : 20591856 : (define_mode_attr KS [(QI "Wb") (HI "Ww") (SI "I") (DI "J")])
1248 : 20938600 :
1249 : 21105974 : ;; Print register name in the specified mode.
1250 : 119561 : (define_mode_attr k [(QI "b") (HI "w") (SI "k") (DI "q")])
1251 : 8548022 :
1252 : 22612034 : ;; General operand predicate for integer modes.
1253 : 27350575 : (define_mode_attr general_operand
1254 : 20466745 : [(QI "general_operand")
1255 : 27267393 : (HI "general_operand")
1256 : 27112114 : (SI "x86_64_general_operand")
1257 : 20803245 : (DI "x86_64_general_operand")
1258 : 348947 : (TI "x86_64_general_operand")])
1259 : 1555023 :
1260 : 22784103 : ;; General operand predicate for integer modes, where for TImode
1261 : 609071 : ;; we need both words of the operand to be general operands.
1262 : 931680 : (define_mode_attr general_hilo_operand
1263 : 20439417 : [(QI "general_operand")
1264 : 28329 : (HI "general_operand")
1265 : 1181667 : (SI "x86_64_general_operand")
1266 : 21584552 : (DI "x86_64_general_operand")
1267 : 20448025 : (TI "x86_64_hilo_general_operand")])
1268 : 20431595 :
1269 : 40220 : ;; General sign extend operand predicate for integer modes,
1270 : 20416550 : ;; which disallows VOIDmode operands and thus it is suitable
1271 : 20871162 : ;; for use inside sign_extend.
1272 : 20871164 : (define_mode_attr general_sext_operand
1273 : 20416552 : [(QI "sext_operand")
1274 : 20414018 : (HI "sext_operand")
1275 : 20416552 : (SI "x86_64_sext_operand")
1276 : 20416156 : (DI "x86_64_sext_operand")])
1277 : 21809492 :
1278 : 21812442 : ;; General sign/zero extend operand predicate for integer modes.
1279 : 20414044 : (define_mode_attr general_szext_operand
1280 : 20414042 : [(QI "general_operand")
1281 : 20414044 : (HI "general_operand")
1282 : 20414044 : (SI "x86_64_szext_general_operand")
1283 : 20430818 : (DI "x86_64_szext_general_operand")
1284 : 17194 : (TI "x86_64_hilo_general_operand")])
1285 : 420 :
1286 : 20414018 : (define_mode_attr nonmemory_szext_operand
1287 : 20414020 : [(QI "nonmemory_operand")
1288 : 20414020 : (HI "nonmemory_operand")
1289 : 9428 : (SI "x86_64_szext_nonmemory_operand")
1290 : 20423052 : (DI "x86_64_szext_nonmemory_operand")])
1291 : 20414020 :
1292 : 20414018 : ;; Immediate operand predicate for integer modes.
1293 : 20414020 : (define_mode_attr immediate_operand
1294 : 20591969 : [(QI "immediate_operand")
1295 : 20591967 : (HI "immediate_operand")
1296 : 20591575 : (SI "x86_64_immediate_operand")
1297 : 20414018 : (DI "x86_64_immediate_operand")])
1298 : 20414018 :
1299 : 20414018 : ;; Nonmemory operand predicate for integer modes.
1300 : 22115137 : (define_mode_attr nonmemory_operand
1301 : 22115137 : [(QI "nonmemory_operand")
1302 : 22115137 : (HI "nonmemory_operand")
1303 : 22115137 : (SI "x86_64_nonmemory_operand")
1304 : 22115137 : (DI "x86_64_nonmemory_operand")])
1305 : 22115137 :
1306 : 22114743 : ;; Operand predicate for shifts.
1307 : 22114743 : (define_mode_attr shift_operand
1308 : 22115137 : [(QI "nonimmediate_operand")
1309 : 22115137 : (HI "nonimmediate_operand")
1310 : 22115137 : (SI "nonimmediate_operand")
1311 : 22114743 : (DI "shiftdi_operand")
1312 : 22115137 : (TI "register_operand")])
1313 : 22115137 :
1314 : 22115137 : ;; Operand predicate for shift argument.
1315 : 22115137 : (define_mode_attr shift_immediate_operand
1316 : 22115137 : [(QI "const_1_to_31_operand")
1317 : 22114743 : (HI "const_1_to_31_operand")
1318 : 22115137 : (SI "const_1_to_31_operand")
1319 : 22115137 : (DI "const_1_to_63_operand")])
1320 : 20414018 :
1321 : 20414018 : ;; Input operand predicate for arithmetic left shifts.
1322 : 20413624 : (define_mode_attr ashl_input_operand
1323 : 22828596 : [(QI "nonimmediate_operand")
1324 : 22828990 : (HI "nonimmediate_operand")
1325 : 22828990 : (SI "nonimmediate_operand")
1326 : 20414018 : (DI "ashldi_input_operand")
1327 : 20413624 : (TI "reg_or_pm1_operand")])
1328 : 20414018 :
1329 : 22110658 : ;; SSE and x87 SFmode and DFmode floating point modes
1330 : 22110658 : (define_mode_iterator MODEF [SF DF])
1331 : 22110658 :
1332 : 20414018 : (define_mode_iterator MODEF248 [BF HF SF (DF "TARGET_SSE2")])
1333 : 20413624 :
1334 : 20414018 : ;; SSE floating point modes
1335 : 20414171 : (define_mode_iterator MODEFH [(HF "TARGET_AVX512FP16") SF DF])
1336 : 20414020 :
1337 : 20418690 : ;; All x87 floating point modes
1338 : 20417647 : (define_mode_iterator X87MODEF [SF DF XF])
1339 : 20414370 :
1340 : 20414370 : ;; All x87 floating point modes plus HFmode
1341 : 20414349 : (define_mode_iterator X87MODEFH [HF SF DF XF BF])
1342 : 20414109 :
1343 : 20414130 : ;; All SSE floating point modes
1344 : 20414182 : (define_mode_iterator SSEMODEF [HF SF DF TF])
1345 : 20414182 : (define_mode_attr ssevecmodef [(HF "V8HF") (SF "V4SF") (DF "V2DF") (TF "TF")])
1346 : 20414182 :
1347 : 20414182 : ;; SSE instruction suffix for various modes
1348 : 20414182 : (define_mode_attr ssemodesuffix
1349 : 20414182 : [(HF "sh") (SF "ss") (DF "sd")
1350 : 20414182 : (V32HF "ph") (V16SF "ps") (V8DF "pd")
1351 : 20414182 : (V16HF "ph") (V16BF "bf") (V8SF "ps") (V4DF "pd")
1352 : 20414182 : (V8HF "ph") (V8BF "bf") (V4SF "ps") (V2DF "pd")
1353 : 20414018 : (V16QI "b") (V8HI "w") (V4SI "d") (V2DI "q")
1354 : 20414182 : (V32QI "b") (V16HI "w") (V8SI "d") (V4DI "q")
1355 : 20414182 : (V64QI "b") (V32HI "w") (V16SI "d") (V8DI "q")])
1356 : 20414182 :
1357 : 20414018 : ;; SSE vector suffix for floating point modes
1358 : 20414018 : ;; BF HF use same suffix as SF for logic operations.
1359 : 20414018 : (define_mode_attr ssevecmodesuffix [(BF "ps") (HF "ps") (SF "ps") (DF "pd")])
1360 : 20414182 :
1361 : 20414018 : ;; SSE vector mode corresponding to a scalar mode
1362 : 20414182 : (define_mode_attr ssevecmode
1363 : 20414018 : [(QI "V16QI") (HI "V8HI") (SI "V4SI") (DI "V2DI") (HF "V8HF") (BF "V8BF") (SF "V4SF") (DF "V2DF")])
1364 : 20414018 : (define_mode_attr ssevecmodelower
1365 : 20414182 : [(QI "v16qi") (HI "v8hi") (SI "v4si") (DI "v2di") (SF "v4sf") (DF "v2df")])
1366 : 20414182 :
1367 : 20414182 : ;; AVX512F vector mode corresponding to a scalar mode
1368 : 20414018 : (define_mode_attr avx512fvecmode
1369 : 20414182 : [(QI "V64QI") (HI "V32HI") (SI "V16SI") (DI "V8DI")
1370 : 20413788 : (HF "V32HF") (BF "V32BF") (SF "V16SF") (DF "V8DF")])
1371 : 20414018 :
1372 : 20414018 : ;; Instruction suffix for REX 64bit operators.
1373 : 20414182 : (define_mode_attr rex64suffix [(SI "{l}") (DI "{q}")])
1374 : 20414182 : (define_mode_attr rex64namesuffix [(SI "") (DI "q")])
1375 : 20414182 :
1376 : 20414018 : ;; This mode iterator allows :P to be used for patterns that operate on
1377 : 20414182 : ;; pointer-sized quantities. Exactly one of the two alternatives will match.
1378 : 22327747 : (define_mode_iterator P [(SI "Pmode == SImode") (DI "Pmode == DImode")])
1379 : 22505525 :
1380 : 20413624 : ;; This mode iterator allows :W to be used for patterns that operate on
1381 : 20421029 : ;; word_mode sized quantities.
1382 : 20564488 : (define_mode_iterator W
1383 : 21914298 : [(SI "word_mode == SImode") (DI "word_mode == DImode")])
1384 : 109657176 :
1385 : 128643842 : ;; This mode iterator allows :PTR to be used for patterns that operate on
1386 : 167959151 : ;; ptr_mode sized quantities.
1387 : 23086883 : (define_mode_iterator PTR
1388 : 1201923444 : [(SI "ptr_mode == SImode") (DI "ptr_mode == DImode")])
1389 : 105998872 :
1390 : 20721792 : ;; Scheduling descriptions
1391 : 21957747 :
1392 : 38883160 : (include "pentium.md")
1393 : 26174602 : (include "ppro.md")
1394 : 23271586 : (include "k6.md")
1395 : 26396399 : (include "athlon.md")
1396 : 1999463863 : (include "bdver1.md")
1397 : 21909847 : (include "bdver3.md")
1398 : 48263301 : (include "btver2.md")
1399 : 34744406 : (include "znver.md")
1400 : 35436119 : (include "zn4zn5.md")
1401 : 41718374 : (include "geode.md")
1402 : 274429906 : (include "atom.md")
1403 : 153615857 : (include "slm.md")
1404 : 239334851 : (include "glm.md")
1405 : 31932804 : (include "core2.md")
1406 : 65961121 : (include "haswell.md")
1407 : 20537281 : (include "lujiazui.md")
1408 : 53986370 : (include "yongfeng.md")
1409 : 31791004 :
1410 : 41088732 :
1411 : 39754628 : ;; Operand and operator predicates and constraints
1412 : 24953988 :
1413 : 20423184 : (include "predicates.md")
1414 : 21385460 : (include "constraints.md")
1415 : 21207186 :
1416 : 48104312 :
1417 : 32656488 : ;; Compare and branch/compare and store instructions.
1418 : 36107001 :
1419 : 35479387 : (define_expand "cbranch<mode>4"
1420 : 22248017 : [(set (reg:CC FLAGS_REG)
1421 : 21134230 : (compare:CC (match_operand:SWIM1248x 1 "nonimmediate_operand")
1422 : 20471609 : (match_operand:SWIM1248x 2 "<general_operand>")))
1423 : 1057309260 : (set (pc) (if_then_else
1424 : 1055613024 : (match_operator 0 "ordered_comparison_operator"
1425 : 22028029 : [(reg:CC FLAGS_REG) (const_int 0)])
1426 : 21209758 : (label_ref (match_operand 3))
1427 : 20864972 : (pc)))]
1428 : 20440134 : ""
1429 : 25600730 : {
1430 : 22450082 : if (MEM_P (operands[1]) && MEM_P (operands[2]))
1431 : 20981375 : operands[1] = force_reg (<MODE>mode, operands[1]);
1432 : 25599659 : ix86_expand_branch (GET_CODE (operands[0]),
1433 : 20414349 : operands[1], operands[2], operands[3]);
1434 : 25894964 : DONE;
1435 : 20414699 : })
1436 : 21602278 :
1437 : 21781747 : (define_expand "cbranchti4"
1438 : 20415177 : [(set (reg:CC FLAGS_REG)
1439 : 20415906 : (compare:CC (match_operand:TI 1 "nonimmediate_operand")
1440 : 20415994 : (match_operand:TI 2 "ix86_timode_comparison_operand")))
1441 : 20414448 : (set (pc) (if_then_else
1442 : 20886218 : (match_operator 0 "ix86_timode_comparison_operator"
1443 : 20907116 : [(reg:CC FLAGS_REG) (const_int 0)])
1444 : 20417491 : (label_ref (match_operand 3))
1445 : 20417491 : (pc)))]
1446 : 20437827 : "TARGET_64BIT || TARGET_SSE4_1"
1447 : 20469339 : {
1448 : 22898606 : ix86_expand_branch (GET_CODE (operands[0]),
1449 : 22866422 : operands[1], operands[2], operands[3]);
1450 : 20462689 : DONE;
1451 : 20414206 : })
1452 : 20430499 :
1453 : 20822258 : (define_expand "cbranchoi4"
1454 : 20833202 : [(set (reg:CC FLAGS_REG)
1455 : 20709284 : (compare:CC (match_operand:OI 1 "nonimmediate_operand")
1456 : 20416835 : (match_operand:OI 2 "nonimmediate_operand")))
1457 : 20414910 : (set (pc) (if_then_else
1458 : 20415322 : (match_operator 0 "bt_comparison_operator"
1459 : 20413864 : [(reg:CC FLAGS_REG) (const_int 0)])
1460 : 22852815 : (label_ref (match_operand 3))
1461 : 22852587 : (pc)))]
1462 : 20413972 : "TARGET_AVX"
1463 : 20415429 : {
1464 : 20415549 : ix86_expand_branch (GET_CODE (operands[0]),
1465 : 22173411 : operands[1], operands[2], operands[3]);
1466 : 22172062 : DONE;
1467 : 22172182 : })
1468 : 24721593 :
1469 : 20413972 : (define_expand "cbranchxi4"
1470 : 20415429 : [(set (reg:CC FLAGS_REG)
1471 : 21189125 : (compare:CC (match_operand:XI 1 "nonimmediate_operand")
1472 : 21189125 : (match_operand:XI 2 "nonimmediate_operand")))
1473 : 25493607 : (set (pc) (if_then_else
1474 : 24721593 : (match_operator 0 "bt_comparison_operator"
1475 : 24721593 : [(reg:CC FLAGS_REG) (const_int 0)])
1476 : 24721593 : (label_ref (match_operand 3))
1477 : 24857230 : (pc)))]
1478 : 24855653 : "TARGET_AVX512F && TARGET_EVEX512 && !TARGET_PREFER_AVX256"
1479 : 24857230 : {
1480 : 24720016 : ix86_expand_branch (GET_CODE (operands[0]),
1481 : 20415140 : operands[1], operands[2], operands[3]);
1482 : 20413852 : DONE;
1483 : 20581661 : })
1484 : 20581661 :
1485 : 20581661 : (define_expand "cstore<mode>4"
1486 : 20413852 : [(set (reg:CC FLAGS_REG)
1487 : 20413852 : (compare:CC (match_operand:SDWIM 2 "nonimmediate_operand")
1488 : 20413852 : (match_operand:SDWIM 3 "<general_operand>")))
1489 : 20415077 : (set (match_operand:QI 0 "register_operand")
1490 : 20415077 : (match_operator 1 "ordered_comparison_operator"
1491 : 20415077 : [(reg:CC FLAGS_REG) (const_int 0)]))]
1492 : 20413624 : ""
1493 : 20772208 : {
1494 : 20558685 : if (<MODE>mode == (TARGET_64BIT ? TImode : DImode))
1495 : 20903323 : {
1496 : 20903095 : if (GET_CODE (operands[1]) != EQ
1497 : 20912704 : && GET_CODE (operands[1]) != NE)
1498 : 20417546 : FAIL;
1499 : 20413852 : }
1500 : 20576250 : else if (MEM_P (operands[2]) && MEM_P (operands[3]))
1501 : 20420946 : operands[2] = force_reg (<MODE>mode, operands[2]);
1502 : 20770161 : ix86_expand_setcc (operands[0], GET_CODE (operands[1]),
1503 : 20415499 : operands[2], operands[3]);
1504 : 20768514 : DONE;
1505 : 20413852 : })
1506 : 20413852 :
1507 : 62764573 : (define_expand "@cmp<mode>_1"
1508 : 62764345 : [(set (reg:CC FLAGS_REG)
1509 : 62764573 : (compare:CC (match_operand:SWI48 0 "nonimmediate_operand")
1510 : 20413852 : (match_operand:SWI48 1 "<general_operand>")))])
1511 : 20413852 :
1512 : 20413624 : (define_mode_iterator SWI1248_AVX512BWDQ_64
1513 : 22888075 : [(QI "TARGET_AVX512DQ") HI
1514 : 22884820 : (SI "TARGET_AVX512BW") (DI "TARGET_AVX512BW && TARGET_64BIT")])
1515 : 23836796 :
1516 : 22670707 : (define_insn "*cmp<mode>_ccz_1"
1517 : 20413852 : [(set (reg FLAGS_REG)
1518 : 20413856 : (compare (match_operand:SWI1248_AVX512BWDQ_64 0
1519 : 20608255 : "nonimmediate_operand" "<r>,?m<r>,$k")
1520 : 20608255 : (match_operand:SWI1248_AVX512BWDQ_64 1 "const0_operand")))]
1521 : 21643817 : "TARGET_AVX512F && ix86_match_ccmode (insn, CCZmode)"
1522 : 20457105 : "@
1523 : 20494870 : test{<imodesuffix>}\t%0, %0
1524 : 20457109 : cmp{<imodesuffix>}\t{%1, %0|%0, %1}
1525 : 20634160 : kortest<mskmodesuffix>\t%0, %0"
1526 : 20634160 : [(set_attr "type" "test,icmp,msklog")
1527 : 20633932 : (set_attr "length_immediate" "0,1,*")
1528 : 20457105 : (set_attr "prefix" "*,*,vex")
1529 : 20413852 : (set_attr "mode" "<MODE>")])
1530 : 20413852 :
1531 : 20462337 : (define_insn "*cmp<mode>_ccno_1"
1532 : 20462565 : [(set (reg FLAGS_REG)
1533 : 20462565 : (compare (match_operand:SWI 0 "nonimmediate_operand" "<r>,?m<r>")
1534 : 20740690 : (match_operand:SWI 1 "const0_operand")))]
1535 : 24900975 : "ix86_match_ccmode (insn, CCNOmode)"
1536 : 20413852 : "@
1537 : 22499612 : test{<imodesuffix>}\t%0, %0
1538 : 25227254 : cmp{<imodesuffix>}\t{%1, %0|%0, %1}"
1539 : 28172374 : [(set_attr "type" "test,icmp")
1540 : 20728955 : (set_attr "length_immediate" "0,1")
1541 : 20728955 : (set_attr "mode" "<MODE>")])
1542 : 20728955 :
1543 : 20748411 : (define_insn "*cmp<mode>_1"
1544 : 20748411 : [(set (reg FLAGS_REG)
1545 : 20748411 : (compare (match_operand:SWI 0 "nonimmediate_operand" "<r>m,<r>")
1546 : 20728955 : (match_operand:SWI 1 "<general_operand>" "<r><i>,<r><m>")))]
1547 : 28459285 : "ix86_match_ccmode (insn, CCmode)"
1548 : 20413852 : "cmp{<imodesuffix>}\t{%1, %0|%0, %1}"
1549 : 20439107 : [(set_attr "type" "icmp")
1550 : 20424471 : (set_attr "mode" "<MODE>")])
1551 : 20424471 :
1552 : 29496664 : (define_insn "*cmp<mode>_minus_1"
1553 : 29496664 : [(set (reg FLAGS_REG)
1554 : 20413852 : (compare
1555 : 29378616 : (minus:SWI (match_operand:SWI 0 "nonimmediate_operand" "<r>m,<r>")
1556 : 23268870 : (match_operand:SWI 1 "<general_operand>" "<r><i>,<r><m>"))
1557 : 23965830 : (const_int 0)))]
1558 : 20437904 : "ix86_match_ccmode (insn, CCGOCmode)"
1559 : 20418706 : "cmp{<imodesuffix>}\t{%1, %0|%0, %1}"
1560 : 23268870 : [(set_attr "type" "icmp")
1561 : 23269098 : (set_attr "mode" "<MODE>")])
1562 : 23295030 :
1563 : 20439784 : (define_insn "*cmpqi_ext<mode>_1"
1564 : 20437907 : [(set (reg FLAGS_REG)
1565 : 20463776 : (compare
1566 : 23269098 : (match_operand:QI 0 "nonimmediate_operand" "QBn")
1567 : 23269098 : (subreg:QI
1568 : 23269098 : (match_operator:SWI248 2 "extract_operator"
1569 : 23269098 : [(match_operand 1 "int248_register_operand" "Q")
1570 : 23269098 : (const_int 8)
1571 : 23269098 : (const_int 8)]) 0)))]
1572 : 20413855 : "ix86_match_ccmode (insn, CCmode)"
1573 : 23269098 : "cmp{b}\t{%h1, %0|%0, %h1}"
1574 : 23269098 : [(set_attr "addr" "gpr8")
1575 : 20413852 : (set_attr "type" "icmp")
1576 : 20432132 : (set_attr "mode" "QI")])
1577 : 20413852 :
1578 : 20432132 : (define_insn "*cmpqi_ext<mode>_2"
1579 : 20433281 : [(set (reg FLAGS_REG)
1580 : 20433281 : (compare
1581 : 20432132 : (subreg:QI
1582 : 20432132 : (match_operator:SWI248 2 "extract_operator"
1583 : 20432132 : [(match_operand 0 "int248_register_operand" "Q")
1584 : 20432132 : (const_int 8)
1585 : 20432132 : (const_int 8)]) 0)
1586 : 20413852 : (match_operand:QI 1 "const0_operand")))]
1587 : 20432166 : "ix86_match_ccmode (insn, CCNOmode)"
1588 : 20413852 : "test{b}\t%h0, %h0"
1589 : 20414174 : [(set_attr "type" "test")
1590 : 20414496 : (set_attr "length_immediate" "0")
1591 : 20413852 : (set_attr "mode" "QI")])
1592 : 20413852 :
1593 : 20413852 : (define_expand "cmpqi_ext_3"
1594 : 20413852 : [(set (reg:CC FLAGS_REG)
1595 : 20413852 : (compare:CC
1596 : 20413852 : (subreg:QI
1597 : 20413852 : (zero_extract:HI
1598 : 20413852 : (match_operand:HI 0 "register_operand")
1599 : 20413852 : (const_int 8)
1600 : 20413852 : (const_int 8)) 0)
1601 : 20413852 : (match_operand:QI 1 "const_int_operand")))])
1602 : 20413980 :
1603 : 20413980 : (define_insn "*cmpqi_ext<mode>_3"
1604 : 20413980 : [(set (reg FLAGS_REG)
1605 : 20413980 : (compare
1606 : 20413980 : (subreg:QI
1607 : 20413852 : (match_operator:SWI248 2 "extract_operator"
1608 : 20413852 : [(match_operand 0 "int248_register_operand" "Q")
1609 : 20413980 : (const_int 8)
1610 : 20413852 : (const_int 8)]) 0)
1611 : 20413980 : (match_operand:QI 1 "general_operand" "QnBn")))]
1612 : 20414336 : "ix86_match_ccmode (insn, CCmode)"
1613 : 20413980 : "cmp{b}\t{%1, %h0|%h0, %1}"
1614 : 20413980 : [(set_attr "addr" "gpr8")
1615 : 20413980 : (set_attr "type" "icmp")
1616 : 20414325 : (set_attr "mode" "QI")])
1617 : 20414325 :
1618 : 20414343 : (define_insn "*cmpqi_ext<mode>_4"
1619 : 20413980 : [(set (reg FLAGS_REG)
1620 : 20413980 : (compare
1621 : 20413980 : (subreg:QI
1622 : 20413980 : (match_operator:SWI248 2 "extract_operator"
1623 : 20413752 : [(match_operand 0 "int248_register_operand" "Q")
1624 : 20413980 : (const_int 8)
1625 : 20413980 : (const_int 8)]) 0)
1626 : 20413980 : (subreg:QI
1627 : 20413980 : (match_operator:SWI248 3 "extract_operator"
1628 : 16946387 : [(match_operand 1 "int248_register_operand" "Q")
1629 : 16946387 : (const_int 8)
1630 : 3467949 : (const_int 8)]) 0)))]
1631 : 2904404 : "ix86_match_ccmode (insn, CCmode)"
1632 : 3467949 : "cmp{b}\t{%h1, %h0|%h0, %h1}"
1633 : 3467949 : [(set_attr "type" "icmp")
1634 : 3467949 : (set_attr "mode" "QI")])
1635 : 3467965 :
1636 : 372 : (define_insn_and_split "*cmp<dwi>_doubleword"
1637 : 372 : [(set (reg:CCZ FLAGS_REG)
1638 : 3467992 : (compare:CCZ (match_operand:<DWI> 0 "nonimmediate_operand")
1639 : 356 : (match_operand:<DWI> 1 "general_operand")))]
1640 : 5030914 : "ix86_pre_reload_split ()"
1641 : 303 : "#"
1642 : 3467785 : "&& 1"
1643 : 3467785 : [(parallel [(set (reg:CCZ FLAGS_REG)
1644 : 47515 : (compare:CCZ (ior:DWIH (match_dup 4) (match_dup 5))
1645 : 276 : (const_int 0)))
1646 : 29235 : (set (match_dup 4) (ior:DWIH (match_dup 4) (match_dup 5)))])]
1647 : 3544151 : {
1648 : 47515 : split_double_mode (<DWI>mode, &operands[0], 2, &operands[0], &operands[2]);
1649 : 3467785 :
1650 : 3526582 : operands[4] = gen_reg_rtx (<MODE>mode);
1651 : 3479259 :
1652 : 192 : /* Special case comparisons against -1. */
1653 : 3519545 : if (operands[1] == constm1_rtx && operands[3] == constm1_rtx)
1654 : 4629 : {
1655 : 3474324 : emit_insn (gen_and<mode>3 (operands[4], operands[0], operands[2]));
1656 : 3469887 : emit_insn (gen_cmp_1 (<MODE>mode, operands[4], constm1_rtx));
1657 : 3474025 : DONE;
1658 : 3471932 : }
1659 : 745868 :
1660 : 786969 : if (operands[1] == const0_rtx)
1661 : 18964 : emit_move_insn (operands[4], operands[0]);
1662 : 405554 : else if (operands[0] == const0_rtx)
1663 : 2726183 : emit_move_insn (operands[4], operands[1]);
1664 : 2760904 : else if (operands[1] == constm1_rtx)
1665 : 4806 : emit_insn (gen_one_cmpl<mode>2 (operands[4], operands[0]));
1666 : 2760385 : else if (operands[0] == constm1_rtx)
1667 : 2726183 : emit_insn (gen_one_cmpl<mode>2 (operands[4], operands[1]));
1668 : 2730342 : else
1669 : 2730342 : {
1670 : 2760385 : if (CONST_SCALAR_INT_P (operands[1])
1671 : 2756290 : && !x86_64_immediate_operand (operands[1], <MODE>mode))
1672 : 2734030 : operands[1] = force_reg (<MODE>mode, operands[1]);
1673 : 2760321 : emit_insn (gen_xor<mode>3 (operands[4], operands[0], operands[1]));
1674 : 2731611 : }
1675 : 2727516 :
1676 : 2776841 : if (operands[3] == const0_rtx)
1677 : 2742705 : operands[5] = operands[2];
1678 : 2757941 : else if (operands[2] == const0_rtx)
1679 : 2727900 : operands[5] = operands[3];
1680 : 2728284 : else
1681 : 2727516 : {
1682 : 2757557 : operands[5] = gen_reg_rtx (<MODE>mode);
1683 : 2757557 : if (operands[3] == constm1_rtx)
1684 : 2728429 : emit_insn (gen_one_cmpl<mode>2 (operands[5], operands[2]));
1685 : 2756644 : else if (operands[2] == constm1_rtx)
1686 : 2727516 : emit_insn (gen_one_cmpl<mode>2 (operands[5], operands[3]));
1687 : 2727516 : else
1688 : 2727516 : {
1689 : 2756644 : if (CONST_SCALAR_INT_P (operands[3])
1690 : 2756580 : && !x86_64_immediate_operand (operands[3], <MODE>mode))
1691 : 2732602 : operands[3] = force_reg (<MODE>mode, operands[3]);
1692 : 2756580 : emit_insn (gen_xor<mode>3 (operands[5], operands[2], operands[3]));
1693 : 2727490 : }
1694 : 2727452 : }
1695 : 2727452 : })
1696 : 2727452 :
1697 : 2727452 : ;; These implement float point compares.
1698 : 2772682 : ;; %%% See if we can get away with VOIDmode operands on the actual insns,
1699 : 2772682 : ;; which would allow mix and match FP modes on the compares. Which is what
1700 : 2772682 : ;; the old patterns did, but with many more of them.
1701 : 2772554 :
1702 : 2772682 : (define_expand "cbranchxf4"
1703 : 2772682 : [(set (reg:CC FLAGS_REG)
1704 : 2772682 : (compare:CC (match_operand:XF 1 "nonmemory_operand")
1705 : 563486 : (match_operand:XF 2 "nonmemory_operand")))
1706 : 2254554 : (set (pc) (if_then_else
1707 : 2254554 : (match_operator 0 "ix86_fp_comparison_operator"
1708 : 2254554 : [(reg:CC FLAGS_REG)
1709 : 2254554 : (const_int 0)])
1710 : 2254554 : (label_ref (match_operand 3))
1711 : 2209324 : (pc)))]
1712 : 2209324 : "TARGET_80387"
1713 : 2300757 : {
1714 : 2300757 : ix86_expand_branch (GET_CODE (operands[0]),
1715 : 2209324 : operands[1], operands[2], operands[3]);
1716 : 2300757 : DONE;
1717 : 2209324 : })
1718 : 2209196 :
1719 : 2209300 : (define_expand "cstorexf4"
1720 : 2209428 : [(set (reg:CC FLAGS_REG)
1721 : 232 : (compare:CC (match_operand:XF 2 "nonmemory_operand")
1722 : 2209324 : (match_operand:XF 3 "nonmemory_operand")))
1723 : 2254554 : (set (match_operand:QI 0 "register_operand")
1724 : 2254606 : (match_operator 1 "ix86_fp_comparison_operator"
1725 : 2254478 : [(reg:CC FLAGS_REG)
1726 : 2209376 : (const_int 0)]))]
1727 : 2209376 : "TARGET_80387"
1728 : 2235275 : {
1729 : 27168 : ix86_expand_setcc (operands[0], GET_CODE (operands[1]),
1730 : 92754 : operands[2], operands[3]);
1731 : 2234006 : DONE;
1732 : 2208107 : })
1733 : 2237098 :
1734 : 2237150 : (define_expand "cbranchhf4"
1735 : 2328583 : [(set (reg:CC FLAGS_REG)
1736 : 2299412 : (compare:CC (match_operand:HF 1 "cmp_fp_expander_operand")
1737 : 2328583 : (match_operand:HF 2 "cmp_fp_expander_operand")))
1738 : 2328583 : (set (pc) (if_then_else
1739 : 2328675 : (match_operator 0 "ix86_fp_comparison_operator"
1740 : 2237242 : [(reg:CC FLAGS_REG)
1741 : 272 : (const_int 0)])
1742 : 120748 : (label_ref (match_operand 3))
1743 : 2208107 : (pc)))]
1744 : 2208107 : "TARGET_AVX512FP16"
1745 : 2209921 : {
1746 : 1994 : ix86_expand_branch (GET_CODE (operands[0]),
1747 : 2207979 : operands[1], operands[2], operands[3]);
1748 : 2209793 : DONE;
1749 : 2208107 : })
1750 : 26079 :
1751 : 2208107 : (define_expand "cbranch<mode>4"
1752 : 2207979 : [(set (reg:CC FLAGS_REG)
1753 : 2208107 : (compare:CC (match_operand:MODEF 1 "cmp_fp_expander_operand")
1754 : 2208107 : (match_operand:MODEF 2 "cmp_fp_expander_operand")))
1755 : 2234006 : (set (pc) (if_then_else
1756 : 2234006 : (match_operator 0 "ix86_fp_comparison_operator"
1757 : 2234006 : [(reg:CC FLAGS_REG)
1758 : 2234006 : (const_int 0)])
1759 : 2235285 : (label_ref (match_operand 3))
1760 : 2235285 : (pc)))]
1761 : 2237099 : "TARGET_80387 || (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)"
1762 : 2235233 : {
1763 : 2491786 : ix86_expand_branch (GET_CODE (operands[0]),
1764 : 2209386 : operands[1], operands[2], operands[3]);
1765 : 2491838 : DONE;
1766 : 2211200 : })
1767 : 2211148 :
1768 : 2211200 : (define_expand "cbranchbf4"
1769 : 2211200 : [(set (reg:CC FLAGS_REG)
1770 : 2211200 : (compare:CC (match_operand:BF 1 "cmp_fp_expander_operand")
1771 : 2211200 : (match_operand:BF 2 "cmp_fp_expander_operand")))
1772 : 2211200 : (set (pc) (if_then_else
1773 : 2211148 : (match_operator 0 "comparison_operator"
1774 : 2209386 : [(reg:CC FLAGS_REG)
1775 : 2209386 : (const_int 0)])
1776 : 2209390 : (label_ref (match_operand 3))
1777 : 2209390 : (pc)))]
1778 : 2209338 : "TARGET_80387 || (SSE_FLOAT_MODE_P (SFmode) && TARGET_SSE_MATH)"
1779 : 2209891 : {
1780 : 2210448 : rtx op1 = ix86_expand_fast_convert_bf_to_sf (operands[1]);
1781 : 2209943 : rtx op2 = ix86_expand_fast_convert_bf_to_sf (operands[2]);
1782 : 2209895 : do_compare_rtx_and_jump (op1, op2, GET_CODE (operands[0]), 0,
1783 : 1407 : SFmode, NULL_RTX, NULL,
1784 : 1407 : as_a <rtx_code_label *> (operands[3]),
1785 : 2208055 : /* Unfortunately this isn't propagated. */
1786 : 2208055 : profile_probability::even ());
1787 : 2208612 : DONE;
1788 : 2339909 : })
1789 : 2339909 :
1790 : 2339909 : (define_expand "cstorehf4"
1791 : 2339909 : [(set (reg:CC FLAGS_REG)
1792 : 2339909 : (compare:CC (match_operand:HF 2 "cmp_fp_expander_operand")
1793 : 2339909 : (match_operand:HF 3 "cmp_fp_expander_operand")))
1794 : 2339909 : (set (match_operand:QI 0 "register_operand")
1795 : 2208055 : (match_operator 1 "ix86_fp_comparison_operator"
1796 : 2208055 : [(reg:CC FLAGS_REG)
1797 : 2208055 : (const_int 0)]))]
1798 : 2208055 : "TARGET_AVX512FP16"
1799 : 2359288 : {
1800 : 2208133 : ix86_expand_setcc (operands[0], GET_CODE (operands[1]),
1801 : 2208055 : operands[2], operands[3]);
1802 : 2208133 : DONE;
1803 : 2208055 : })
1804 : 2359210 :
1805 : 2359210 : (define_expand "cstorebf4"
1806 : 2359082 : [(set (reg:CC FLAGS_REG)
1807 : 2359082 : (compare:CC (match_operand:BF 2 "cmp_fp_expander_operand")
1808 : 2359210 : (match_operand:BF 3 "cmp_fp_expander_operand")))
1809 : 2359210 : (set (match_operand:QI 0 "register_operand")
1810 : 2359210 : (match_operator 1 "comparison_operator"
1811 : 2359082 : [(reg:CC FLAGS_REG)
1812 : 2208055 : (const_int 0)]))]
1813 : 2208055 : "TARGET_80387 || (SSE_FLOAT_MODE_P (SFmode) && TARGET_SSE_MATH)"
1814 : 2208178 : {
1815 : 2208301 : rtx op1 = ix86_expand_fast_convert_bf_to_sf (operands[2]);
1816 : 2208274 : rtx op2 = ix86_expand_fast_convert_bf_to_sf (operands[3]);
1817 : 2208146 : rtx res = emit_store_flag_force (operands[0], GET_CODE (operands[1]),
1818 : 2208151 : op1, op2, SFmode, 0, 1);
1819 : 2208274 : if (!rtx_equal_p (res, operands[0]))
1820 : 2208197 : emit_move_insn (operands[0], res);
1821 : 2208178 : DONE;
1822 : 2208151 : })
1823 : 2208151 :
1824 : 2208151 : (define_expand "cstore<mode>4"
1825 : 2208055 : [(set (reg:CC FLAGS_REG)
1826 : 2208133 : (compare:CC (match_operand:MODEF 2 "cmp_fp_expander_operand")
1827 : 2208229 : (match_operand:MODEF 3 "cmp_fp_expander_operand")))
1828 : 2208229 : (set (match_operand:QI 0 "register_operand")
1829 : 2208229 : (match_operator 1 "ix86_fp_comparison_operator"
1830 : 2208303 : [(reg:CC FLAGS_REG)
1831 : 2208271 : (const_int 0)]))]
1832 : 2208522 : "TARGET_80387 || (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)"
1833 : 2208399 : {
1834 : 2279371 : ix86_expand_setcc (operands[0], GET_CODE (operands[1]),
1835 : 2208193 : operands[2], operands[3]);
1836 : 2279371 : DONE;
1837 : 2208444 : })
1838 : 517 :
1839 : 2208274 : (define_expand "cbranchcc4"
1840 : 2208274 : [(set (pc) (if_then_else
1841 : 2208178 : (match_operator 0 "comparison_operator"
1842 : 2208178 : [(match_operand 1 "flags_reg_operand")
1843 : 2208274 : (match_operand 2 "const0_operand")])
1844 : 2208274 : (label_ref (match_operand 3))
1845 : 2208151 : (pc)))]
1846 : 2207927 : ""
1847 : 2208331 : {
1848 : 2208459 : ix86_expand_branch (GET_CODE (operands[0]),
1849 : 2208151 : operands[1], operands[2], operands[3]);
1850 : 2208459 : DONE;
1851 : 2231029 : })
1852 : 2208151 :
1853 : 2208151 : (define_expand "cstorecc4"
1854 : 2208151 : [(set (match_operand:QI 0 "register_operand")
1855 : 2208055 : (match_operator 1 "comparison_operator"
1856 : 2231213 : [(match_operand 2 "flags_reg_operand")
1857 : 2231213 : (match_operand 3 "const0_operand")]))]
1858 : 2231213 : ""
1859 : 2231336 : {
1860 : 2231336 : ix86_expand_setcc (operands[0], GET_CODE (operands[1]),
1861 : 2231213 : operands[2], operands[3]);
1862 : 2208330 : DONE;
1863 : 2231213 : })
1864 : 2208207 :
1865 : 2208207 : ;; FP compares, step 1:
1866 : 2256559 : ;; Set the FP condition codes and move fpsr to ax.
1867 : 2208207 :
1868 : 2208079 : ;; We may not use "#" to split and emit these
1869 : 2208207 : ;; due to reg-stack pops killing fpsr.
1870 : 2208207 :
1871 : 2256559 : (define_insn "*cmpxf_i387"
1872 : 2256431 : [(set (match_operand:HI 0 "register_operand" "=a")
1873 : 2256559 : (unspec:HI
1874 : 2256559 : [(compare:CCFP
1875 : 2256559 : (match_operand:XF 1 "register_operand" "f")
1876 : 2256559 : (match_operand:XF 2 "reg_or_0_operand" "fC"))]
1877 : 2256559 : UNSPEC_FNSTSW))]
1878 : 2256559 : "TARGET_80387"
1879 : 2208207 : "* return output_fp_compare (insn, operands, false, false);"
1880 : 2208207 : [(set_attr "type" "multi")
1881 : 2208207 : (set_attr "unit" "i387")
1882 : 2208207 : (set_attr "mode" "XF")])
1883 : 2208330 :
1884 : 2208330 : (define_insn "*cmp<mode>_i387"
1885 : 2208330 : [(set (match_operand:HI 0 "register_operand" "=a")
1886 : 2208330 : (unspec:HI
1887 : 2208330 : [(compare:CCFP
1888 : 2208330 : (match_operand:MODEF 1 "register_operand" "f")
1889 : 2208330 : (match_operand:MODEF 2 "nonimm_or_0_operand" "fmC"))]
1890 : 2208330 : UNSPEC_FNSTSW))]
1891 : 2208207 : "TARGET_80387"
1892 : 2208207 : "* return output_fp_compare (insn, operands, false, false);"
1893 : 2208207 : [(set_attr "type" "multi")
1894 : 2208207 : (set_attr "unit" "i387")
1895 : 2208207 : (set_attr "mode" "<MODE>")])
1896 : 2208207 :
1897 : 2208207 : (define_insn "*cmp<X87MODEF:mode>_<SWI24:mode>_i387"
1898 : 2208207 : [(set (match_operand:HI 0 "register_operand" "=a")
1899 : 2208207 : (unspec:HI
1900 : 2208207 : [(compare:CCFP
1901 : 2208207 : (match_operand:X87MODEF 1 "register_operand" "f")
1902 : 2208207 : (float:X87MODEF
1903 : 2208207 : (match_operand:SWI24 2 "nonimmediate_operand" "m")))]
1904 : 2208207 : UNSPEC_FNSTSW))]
1905 : 2208207 : "TARGET_80387
1906 : 2208207 : && (TARGET_USE_<SWI24:MODE>MODE_FIOP
1907 : 2208207 : || optimize_function_for_size_p (cfun))"
1908 : 2208207 : "* return output_fp_compare (insn, operands, false, false);"
1909 : 2208207 : [(set_attr "type" "multi")
1910 : 2208207 : (set_attr "unit" "i387")
1911 : 2208207 : (set_attr "fp_int_src" "true")
1912 : 2208207 : (set_attr "mode" "<SWI24:MODE>")])
1913 : 2208207 :
1914 : 2208207 : (define_insn "*cmpu<mode>_i387"
1915 : 2208207 : [(set (match_operand:HI 0 "register_operand" "=a")
1916 : 2208207 : (unspec:HI
1917 : 2208207 : [(unspec:CCFP
1918 : 2208207 : [(compare:CCFP
1919 : 2208207 : (match_operand:X87MODEF 1 "register_operand" "f")
1920 : 2208207 : (match_operand:X87MODEF 2 "register_operand" "f"))]
1921 : 2208207 : UNSPEC_NOTRAP)]
1922 : 2208207 : UNSPEC_FNSTSW))]
1923 : 2208207 : "TARGET_80387"
1924 : 2208207 : "* return output_fp_compare (insn, operands, false, true);"
1925 : 2208207 : [(set_attr "type" "multi")
1926 : 2208207 : (set_attr "unit" "i387")
1927 : 2208207 : (set_attr "mode" "<MODE>")])
1928 : 2208244 :
1929 : 2208207 : ;; FP compares, step 2:
1930 : 2208207 : ;; Get ax into flags, general case.
1931 : 2208710 :
1932 : 2208710 : (define_insn "x86_sahf_1"
1933 : 2208710 : [(set (reg:CC FLAGS_REG)
1934 : 2208207 : (unspec:CC [(match_operand:HI 0 "register_operand" "a")]
1935 : 2208207 : UNSPEC_SAHF))]
1936 : 2208244 : "TARGET_SAHF"
1937 : 2208244 : {
1938 : 2208207 : #ifndef HAVE_AS_IX86_SAHF
1939 : 2208207 : if (TARGET_64BIT)
1940 : 2208207 : return ASM_BYTE "0x9e";
1941 : 3993021 : else
1942 : 2208207 : #endif
1943 : 3993058 : return "sahf";
1944 : 3993021 : }
1945 : 3993021 : [(set_attr "length" "1")
1946 : 2208207 : (set_attr "athlon_decode" "vector")
1947 : 3993021 : (set_attr "amdfam10_decode" "direct")
1948 : 3998034 : (set_attr "bdver1_decode" "direct")
1949 : 3993021 : (set_attr "mode" "SI")])
1950 : 5748626 :
1951 : 2208207 : ;; Pentium Pro can do both steps in one go.
1952 : 3963812 : ;; (these instructions set flags directly)
1953 : 3963812 :
1954 : 2208055 : (define_subst_attr "unord" "unord_subst" "" "u")
1955 : 3691162 : (define_subst_attr "unordered" "unord_subst" "false" "true")
1956 : 3691162 :
1957 : 3691162 : (define_subst "unord_subst"
1958 : 3691162 : [(set (match_operand:CCFP 0)
1959 : 3691162 : (match_operand:CCFP 1))]
1960 : 3691162 : ""
1961 : 2208207 : [(set (match_dup 0)
1962 : 2571577 : (unspec:CCFP
1963 : 2571577 : [(match_dup 1)]
1964 : 2571577 : UNSPEC_NOTRAP))])
1965 : 2571577 :
1966 : 2208207 : (define_insn "*cmpi<unord>xf_i387"
1967 : 2208207 : [(set (reg:CCFP FLAGS_REG)
1968 : 2208207 : (compare:CCFP
1969 : 2208207 : (match_operand:XF 0 "register_operand" "f")
1970 : 2208207 : (match_operand:XF 1 "register_operand" "f")))]
1971 : 2493161 : "TARGET_80387 && TARGET_CMOVE"
1972 : 2298781 : "* return output_fp_compare (insn, operands, true, <unordered>);"
1973 : 2208207 : [(set_attr "type" "fcmp")
1974 : 2208207 : (set_attr "mode" "XF")
1975 : 2788641 : (set_attr "athlon_decode" "vector")
1976 : 2906296 : (set_attr "amdfam10_decode" "direct")
1977 : 2783928 : (set_attr "bdver1_decode" "double")
1978 : 2809474 : (set_attr "znver1_decode" "double")])
1979 : 2208207 :
1980 : 2208511 : (define_insn "*cmpi<unord><MODEF:mode>"
1981 : 2208511 : [(set (reg:CCFP FLAGS_REG)
1982 : 2208055 : (compare:CCFP
1983 : 2208055 : (match_operand:MODEF 0 "register_operand" "f,v")
1984 : 2208207 : (match_operand:MODEF 1 "register_ssemem_operand" "f,vm")))]
1985 : 3039206 : "(SSE_FLOAT_MODE_P (<MODEF:MODE>mode) && TARGET_SSE_MATH)
1986 : 2226921 : || (TARGET_80387 && TARGET_CMOVE)"
1987 : 2590717 : "@
1988 : 2312021 : * return output_fp_compare (insn, operands, true, <unordered>);
1989 : 2208055 : %v<unord>comi<MODEF:ssemodesuffix>\t{%1, %0|%0, %1}"
1990 : 3033617 : [(set_attr "type" "fcmp,ssecomi")
1991 : 2929803 : (set_attr "prefix" "orig,maybe_vex")
1992 : 2925870 : (set_attr "mode" "<MODEF:MODE>")
1993 : 3402372 : (set_attr "prefix_rep" "*,0")
1994 : 2208267 : (set (attr "prefix_data16")
1995 : 2208267 : (cond [(eq_attr "alternative" "0")
1996 : 2208267 : (const_string "*")
1997 : 2208139 : (eq_attr "mode" "DF")
1998 : 2208267 : (const_string "1")
1999 : 2208267 : ]
2000 : 2231778 : (const_string "0")))
2001 : 2208139 : (set_attr "athlon_decode" "vector")
2002 : 2231778 : (set_attr "amdfam10_decode" "direct")
2003 : 2208267 : (set_attr "bdver1_decode" "double")
2004 : 2210415 : (set_attr "znver1_decode" "double")
2005 : 2210415 : (set (attr "enabled")
2006 : 2208267 : (if_then_else
2007 : 2208267 : (match_test ("SSE_FLOAT_MODE_P (<MODEF:MODE>mode) && TARGET_SSE_MATH"))
2008 : 2208267 : (if_then_else
2009 : 2208267 : (eq_attr "alternative" "0")
2010 : 2208267 : (symbol_ref "TARGET_MIX_SSE_I387")
2011 : 2208139 : (symbol_ref "true"))
2012 : 2349716 : (if_then_else
2013 : 2208267 : (eq_attr "alternative" "0")
2014 : 2349844 : (symbol_ref "true")
2015 : 2208267 : (symbol_ref "false"))))])
2016 : 2211207 :
2017 : 2211207 : (define_insn "*cmpi<unord>hf"
2018 : 2208267 : [(set (reg:CCFP FLAGS_REG)
2019 : 2208267 : (compare:CCFP
2020 : 2208267 : (match_operand:HF 0 "register_operand" "v")
2021 : 2208353 : (match_operand:HF 1 "nonimmediate_operand" "vm")))]
2022 : 2212683 : "TARGET_AVX512FP16"
2023 : 2208726 : "v<unord>comish\t{%1, %0|%0, %1}"
2024 : 2208353 : [(set_attr "type" "ssecomi")
2025 : 2208353 : (set_attr "prefix" "evex")
2026 : 2208353 : (set_attr "mode" "HF")])
2027 : 2208353 :
2028 : 2208353 : ;; Set carry flag.
2029 : 2208353 : (define_insn "x86_stc"
2030 : 2210426 : [(set (reg:CCC FLAGS_REG) (unspec:CCC [(const_int 0)] UNSPEC_STC))]
2031 : 2210426 : ""
2032 : 2208353 : "stc"
2033 : 2209084 : [(set_attr "length" "1")
2034 : 2209084 : (set_attr "length_immediate" "0")
2035 : 3022895 : (set_attr "modrm" "0")])
2036 : 3022895 :
2037 : 2209084 : ;; On Pentium 4, set the carry flag using mov $1,%al;addb $-1,%al.
2038 : 2209084 : (define_peephole2
2039 : 2208356 : [(match_scratch:QI 0 "r")
2040 : 2229048 : (set (reg:CCC FLAGS_REG) (unspec:CCC [(const_int 0)] UNSPEC_STC))]
2041 : 2208726 : "TARGET_SLOW_STC && !optimize_insn_for_size_p ()"
2042 : 2208670 : [(set (match_dup 0) (const_int 1))
2043 : 2208670 : (parallel
2044 : 2209024 : [(set (reg:CCC FLAGS_REG)
2045 : 2208353 : (compare:CCC (plus:QI (match_dup 0) (const_int -1))
2046 : 2208356 : (match_dup 0)))
2047 : 2208356 : (set (match_dup 0) (plus:QI (match_dup 0) (const_int -1)))])])
2048 : 2208356 :
2049 : 2208353 : ;; Complement carry flag.
2050 : 2208356 : (define_insn "*x86_cmc"
2051 : 6600184 : [(set (reg:CCC FLAGS_REG)
2052 : 6600184 : (compare:CCC (neg:QI (ltu:QI (reg:CCC FLAGS_REG) (const_int 0)))
2053 : 2208356 : (geu:QI (reg:CCC FLAGS_REG) (const_int 0))))]
2054 : 2208359 : ""
2055 : 2208353 : "cmc"
2056 : 2307786 : [(set_attr "length" "1")
2057 : 2307786 : (set_attr "length_immediate" "0")
2058 : 2208353 : (set_attr "use_carry" "1")
2059 : 2281921 : (set_attr "modrm" "0")])
2060 : 2281921 :
2061 : 2281921 : ;; On Pentium 4, cmc is replaced with setnc %al;addb $-1,%al.
2062 : 2208353 : (define_peephole2
2063 : 2279436 : [(match_scratch:QI 0 "r")
2064 : 2279436 : (set (reg:CCC FLAGS_REG)
2065 : 2279436 : (compare:CCC (neg:QI (ltu:QI (reg:CCC FLAGS_REG) (const_int 0)))
2066 : 2279436 : (geu:QI (reg:CCC FLAGS_REG) (const_int 0))))]
2067 : 2208356 : "TARGET_SLOW_STC && !optimize_insn_for_size_p ()"
2068 : 2208356 : [(set (match_dup 0) (ne:QI (reg:CCC FLAGS_REG) (const_int 0)))
2069 : 2208353 : (parallel
2070 : 2208353 : [(set (reg:CCC FLAGS_REG)
2071 : 2208353 : (compare:CCC (plus:QI (match_dup 0) (const_int -1))
2072 : 2333444 : (match_dup 0)))
2073 : 2333444 : (set (match_dup 0) (plus:QI (match_dup 0) (const_int -1)))])])
2074 : 2333444 :
2075 : 2333444 : ;; Push/pop instructions.
2076 : 2331308 :
2077 : 2208353 : (define_insn_and_split "*pushv1ti2"
2078 : 2331308 : [(set (match_operand:V1TI 0 "push_operand" "=<")
2079 : 2331308 : (match_operand:V1TI 1 "register_operand" "v"))]
2080 : 2211796 : "TARGET_64BIT && TARGET_STV"
2081 : 2331308 : "#"
2082 : 2331934 : "&& reload_completed"
2083 : 2208666 : [(set (reg:P SP_REG) (plus:P (reg:P SP_REG) (match_dup 2)))
2084 : 2321230 : (set (match_dup 0) (match_dup 1))]
2085 : 2208666 : {
2086 : 2212394 : operands[2] = GEN_INT (-PUSH_ROUNDING (GET_MODE_SIZE (V1TImode)));
2087 : 2211929 : /* Preserve memory attributes. */
2088 : 17628502 : operands[0] = replace_equiv_address (operands[0], stack_pointer_rtx);
2089 : 2208293 : }
2090 : 4657922 : [(set_attr "type" "multi")
2091 : 4657810 : (set_attr "mode" "TI")])
2092 : 2208606 :
2093 : 2208606 : (define_insn "*push<mode>2"
2094 : 2208606 : [(set (match_operand:DWI 0 "push_operand" "=<,<")
2095 : 2208606 : (match_operand:DWI 1 "general_no_elim_operand" "riF*o,*v"))]
2096 : 2208606 : ""
2097 : 2208606 : "#"
2098 : 2208606 : [(set_attr "type" "multi")
2099 : 2208293 : (set_attr "mode" "<MODE>")])
2100 : 2208293 :
2101 : 2208293 : (define_split
2102 : 2208293 : [(set (match_operand:DWI 0 "push_operand")
2103 : 2208293 : (match_operand:DWI 1 "general_gr_operand"))]
2104 : 4471428 : "reload_completed"
2105 : 2208293 : [(const_int 0)]
2106 : 2378970 : "ix86_split_long_move (operands); DONE;")
2107 : 2208606 :
2108 : 2208606 : (define_insn "*pushdi2_rex64"
2109 : 2208293 : [(set (match_operand:DI 0 "push_operand" "=<,<,!<")
2110 : 2208293 : (match_operand:DI 1 "general_no_elim_operand" "re*m,*v,n"))]
2111 : 2208293 : "TARGET_64BIT"
2112 : 4104214 : "@
2113 : 2208293 : push{q}\t%1
2114 : 84968435 : #
2115 : 81022984 : #"
2116 : 86325374 : [(set_attr "type" "push,multi,multi")
2117 : 2365282 : (set_attr "mode" "DI")])
2118 : 2222550 :
2119 : 2365282 : ;; Convert impossible pushes of immediate to existing instructions.
2120 : 2209488 : ;; First try to get scratch register and go through it. In case this
2121 : 2222550 : ;; fails, push sign extended lower part first and then overwrite
2122 : 2209488 : ;; upper part by 32bit move.
2123 : 2222550 :
2124 : 2209023 : (define_peephole2
2125 : 2209023 : [(match_scratch:DI 2 "r")
2126 : 2209175 : (set (match_operand:DI 0 "push_operand")
2127 : 2208293 : (match_operand:DI 1 "immediate_operand"))]
2128 : 2243420 : "TARGET_64BIT
2129 : 2242386 : && !symbolic_operand (operands[1], DImode)
2130 : 2237679 : && !x86_64_immediate_operand (operands[1], DImode)"
2131 : 2209175 : [(set (match_dup 2) (match_dup 1))
2132 : 2210057 : (set (match_dup 0) (match_dup 2))])
2133 : 2210057 :
2134 : 2210057 : (define_split
2135 : 2209023 : [(set (match_operand:DI 0 "push_operand")
2136 : 2209175 : (match_operand:DI 1 "immediate_operand"))]
2137 : 2433146 : "TARGET_64BIT && epilogue_completed
2138 : 2299585 : && !symbolic_operand (operands[1], DImode)
2139 : 2280799 : && !x86_64_immediate_operand (operands[1], DImode)"
2140 : 2219027 : [(set (match_dup 0) (match_dup 1))
2141 : 9438387 : (set (match_dup 2) (match_dup 3))]
2142 : 7167213 : {
2143 : 2227117 : split_double_mode (DImode, &operands[1], 1, &operands[2], &operands[3]);
2144 : 2208294 :
2145 : 2219027 : operands[1] = gen_lowpart (DImode, operands[2]);
2146 : 2219027 : operands[2] = gen_rtx_MEM (SImode,
2147 : 2219027 : plus_constant (Pmode, stack_pointer_rtx, 4));
2148 : 2208294 : })
2149 : 11193296 :
2150 : 2208294 : ;; For TARGET_64BIT we always round up to 8 bytes.
2151 : 2286735 : (define_insn "*pushsi2_rex64"
2152 : 2286735 : [(set (match_operand:SI 0 "push_operand" "=X,X")
2153 : 2268190 : (match_operand:SI 1 "nonmemory_no_elim_operand" "re,*v"))]
2154 : 4561031 : "TARGET_64BIT"
2155 : 2229760 : "@
2156 : 5539224 : push{q}\t%q1
2157 : 5528491 : #"
2158 : 2219027 : [(set_attr "type" "push,multi")
2159 : 2219027 : (set_attr "mode" "DI")])
2160 : 2208294 :
2161 : 2219027 : (define_insn "*pushsi2"
2162 : 2208294 : [(set (match_operand:SI 0 "push_operand" "=<,<")
2163 : 2219027 : (match_operand:SI 1 "general_no_elim_operand" "ri*m,*v"))]
2164 : 5488507 : "!TARGET_64BIT"
2165 : 2219027 : "@
2166 : 2208294 : push{l}\t%1
2167 : 50300314 : #"
2168 : 46542642 : [(set_attr "type" "push,multi")
2169 : 50580439 : (set_attr "mode" "SI")])
2170 : 2208294 :
2171 : 2211415 : (define_split
2172 : 2208294 : [(set (match_operand:SWI48DWI 0 "push_operand")
2173 : 2211415 : (match_operand:SWI48DWI 1 "sse_reg_operand"))]
2174 : 2235338 : "TARGET_SSE && reload_completed"
2175 : 2211415 : [(set (reg:P SP_REG) (plus:P (reg:P SP_REG) (match_dup 2)))
2176 : 2211415 : (set (match_dup 0) (match_dup 1))]
2177 : 2211415 : {
2178 : 2218648 : operands[2] = GEN_INT (-PUSH_ROUNDING (GET_MODE_SIZE (<SWI48DWI:MODE>mode)));
2179 : 2211415 : /* Preserve memory attributes. */
2180 : 2218648 : operands[0] = replace_equiv_address (operands[0], stack_pointer_rtx);
2181 : 2208294 : })
2182 : 2208294 :
2183 : 2208166 : ;; emit_push_insn when it calls move_by_pieces requires an insn to
2184 : 2218520 : ;; "push a byte/word". But actually we use push{l,q}, which has
2185 : 2218562 : ;; the effect of rounding the amount pushed up to a word.
2186 : 2218562 :
2187 : 2218562 : (define_insn "*push<mode>2"
2188 : 2218562 : [(set (match_operand:SWI12 0 "push_operand" "=X")
2189 : 2218562 : (match_operand:SWI12 1 "nonmemory_no_elim_operand" "rn"))]
2190 : 2218520 : ""
2191 : 2228530 : "* return TARGET_64BIT ? \"push{q}\t%q1\" : \"push{l}\t%k1\";"
2192 : 2208208 : [(set_attr "type" "push")
2193 : 2208208 : (set (attr "mode")
2194 : 2208208 : (if_then_else (match_test "TARGET_64BIT")
2195 : 2220648 : (const_string "DI")
2196 : 2218562 : (const_string "SI")))])
2197 : 2208208 :
2198 : 2218562 : (define_insn "*push<mode>2_prologue"
2199 : 2218562 : [(set (match_operand:W 0 "push_operand" "=<")
2200 : 2218562 : (match_operand:W 1 "general_no_elim_operand" "r<i>*m"))
2201 : 2208208 : (clobber (mem:BLK (scratch)))]
2202 : 2208208 : ""
2203 : 2208208 : "push{<imodesuffix>}\t%1"
2204 : 2208208 : [(set_attr "type" "push")
2205 : 2208208 : (set_attr "mode" "<MODE>")])
2206 : 2215441 :
2207 : 2208208 : (define_insn "*pop<mode>1"
2208 : 2215441 : [(set (match_operand:W 0 "nonimmediate_operand" "=r*m")
2209 : 2215441 : (match_operand:W 1 "pop_operand" ">"))]
2210 : 2208208 : ""
2211 : 2215441 : "pop{<imodesuffix>}\t%0"
2212 : 2215441 : [(set_attr "type" "pop")
2213 : 2208208 : (set_attr "mode" "<MODE>")])
2214 : 2215441 :
2215 : 2208208 : (define_insn "*pop<mode>1_epilogue"
2216 : 2208208 : [(set (match_operand:W 0 "nonimmediate_operand" "=r*m")
2217 : 2208208 : (match_operand:W 1 "pop_operand" ">"))
2218 : 2208208 : (clobber (mem:BLK (scratch)))]
2219 : 2208208 : ""
2220 : 2208208 : "pop{<imodesuffix>}\t%0"
2221 : 2208208 : [(set_attr "type" "pop")
2222 : 2208208 : (set_attr "mode" "<MODE>")])
2223 : 2208208 :
2224 : 2208208 : (define_insn "@pushfl<mode>2"
2225 : 2208208 : [(set (match_operand:W 0 "push_operand" "=<")
2226 : 2208208 : (unspec:W [(match_operand 1 "flags_reg_operand")]
2227 : 2208208 : UNSPEC_PUSHFL))]
2228 : 2208231 : "GET_MODE_CLASS (GET_MODE (operands[1])) == MODE_CC"
2229 : 2208208 : "pushf{<imodesuffix>}"
2230 : 2208208 : [(set_attr "type" "push")
2231 : 2208208 : (set_attr "mode" "<MODE>")])
2232 : 2208208 :
2233 : 2208208 : (define_insn "@popfl<mode>1"
2234 : 2208208 : [(set (match_operand:CC 0 "flags_reg_operand")
2235 : 2208208 : (unspec:CC [(match_operand:W 1 "pop_operand" ">")]
2236 : 2208208 : UNSPEC_POPFL))]
2237 : 2208208 : ""
2238 : 2208208 : "popf{<imodesuffix>}"
2239 : 2208208 : [(set_attr "type" "pop")
2240 : 2208208 : (set_attr "mode" "<MODE>")])
2241 : 2208208 :
2242 : 2208208 :
2243 : 2208208 : ;; Reload patterns to support multi-word load/store
2244 : 2208208 : ;; with non-offsetable address.
2245 : 2208208 : (define_expand "reload_noff_store"
2246 : 2208208 : [(parallel [(match_operand 0 "memory_operand" "=m")
2247 : 2208208 : (match_operand 1 "register_operand" "r")
2248 : 2208208 : (match_operand:DI 2 "register_operand" "=&r")])]
2249 : 2208208 : "TARGET_64BIT"
2250 : 2208208 : {
2251 : 2208208 : rtx mem = operands[0];
2252 : 2208208 : rtx addr = XEXP (mem, 0);
2253 : 2208208 :
2254 : 2208208 : emit_move_insn (operands[2], addr);
2255 : 2208208 : mem = replace_equiv_address_nv (mem, operands[2]);
2256 : 2208208 :
2257 : 2208208 : emit_insn (gen_rtx_SET (mem, operands[1]));
2258 : 2208208 : DONE;
2259 : 2208208 : })
2260 : 2208208 :
2261 : 2208208 : (define_expand "reload_noff_load"
2262 : 2208208 : [(parallel [(match_operand 0 "register_operand" "=r")
2263 : 2208208 : (match_operand 1 "memory_operand" "m")
2264 : 2208208 : (match_operand:DI 2 "register_operand" "=r")])]
2265 : 2208208 : "TARGET_64BIT"
2266 : 2208208 : {
2267 : 2208208 : rtx mem = operands[1];
2268 : 2208080 : rtx addr = XEXP (mem, 0);
2269 : 2208208 :
2270 : 2208208 : emit_move_insn (operands[2], addr);
2271 : 2208208 : mem = replace_equiv_address_nv (mem, operands[2]);
2272 : 2208080 :
2273 : 2208208 : emit_insn (gen_rtx_SET (operands[0], mem));
2274 : 2208208 : DONE;
2275 : 2208208 : })
2276 : 2208208 :
2277 : 2208208 : ;; Move instructions.
2278 : 2208208 :
2279 : 2208208 : (define_expand "movxi"
2280 : 2208208 : [(set (match_operand:XI 0 "nonimmediate_operand")
2281 : 2208208 : (match_operand:XI 1 "general_operand"))]
2282 : 2208208 : "TARGET_AVX512F && TARGET_EVEX512"
2283 : 2229673 : "ix86_expand_vector_move (XImode, operands); DONE;")
2284 : 2208208 :
2285 : 2208208 : (define_expand "movoi"
2286 : 2208208 : [(set (match_operand:OI 0 "nonimmediate_operand")
2287 : 2208208 : (match_operand:OI 1 "general_operand"))]
2288 : 2208208 : "TARGET_AVX"
2289 : 2215963 : "ix86_expand_vector_move (OImode, operands); DONE;")
2290 : 2208208 :
2291 : 2208208 : (define_expand "movti"
2292 : 2208208 : [(set (match_operand:TI 0 "nonimmediate_operand")
2293 : 2208208 : (match_operand:TI 1 "general_operand"))]
2294 : 2208208 : "TARGET_64BIT || TARGET_SSE"
2295 : 5696681 : {
2296 : 5696681 : if (TARGET_64BIT)
2297 : 5493555 : ix86_expand_move (TImode, operands);
2298 : 2208208 : else
2299 : 2411334 : ix86_expand_vector_move (TImode, operands);
2300 : 5696681 : DONE;
2301 : 2229673 : })
2302 : 2229673 :
2303 : 2237428 : ;; This expands to what emit_move_complex would generate if we didn't
2304 : 2215963 : ;; have a movti pattern. Having this avoids problems with reload on
2305 : 2229673 : ;; 32-bit targets when SSE is present, but doesn't seem to be harmful
2306 : 5704436 : ;; to have around all the time.
2307 : 2215963 : (define_expand "movcdi"
2308 : 2215963 : [(set (match_operand:CDI 0 "nonimmediate_operand")
2309 : 5696681 : (match_operand:CDI 1 "general_operand"))]
2310 : 5696681 : ""
2311 : 5698436 : {
2312 : 2209811 : if (push_operand (operands[0], CDImode))
2313 : 2208815 : emit_move_complex_push (CDImode, operands[0], operands[1]);
2314 : 5696680 : else
2315 : 2209354 : emit_move_complex_parts (operands[0], operands[1]);
2316 : 2209811 : DONE;
2317 : 2208207 : })
2318 : 2209962 :
2319 : 2208207 : (define_expand "mov<mode>"
2320 : 2208207 : [(set (match_operand:SWI1248x 0 "nonimmediate_operand")
2321 : 2209834 : (match_operand:SWI1248x 1 "general_operand"))]
2322 : 2209962 : ""
2323 : 61957911 : "ix86_expand_move (<MODE>mode, operands); DONE;")
2324 : 2035 :
2325 : 2209834 : (define_insn "*mov<mode>_xor"
2326 : 2035 : [(set (match_operand:SWI48 0 "register_operand" "=r")
2327 : 2208207 : (match_operand:SWI48 1 "const0_operand"))
2328 : 2208207 : (clobber (reg:CC FLAGS_REG))]
2329 : 3809496 : "reload_completed"
2330 : 280 : "xor{l}\t%k0, %k0"
2331 : 2213116 : [(set_attr "type" "alu1")
2332 : 2213116 : (set_attr "mode" "SI")
2333 : 2208055 : (set_attr "length_immediate" "0")])
2334 : 3741521 :
2335 : 2365048 : (define_insn "*mov<mode>_and"
2336 : 2208207 : [(set (match_operand:SWI248 0 "memory_operand" "=m")
2337 : 5792759 : (match_operand:SWI248 1 "const0_operand"))
2338 : 5792607 : (clobber (reg:CC FLAGS_REG))]
2339 : 5917471 : "reload_completed"
2340 : 64165838 : "and{<imodesuffix>}\t{%1, %0|%0, %1}"
2341 : 5796591 : [(set_attr "type" "alu1")
2342 : 5933559 : (set_attr "mode" "<MODE>")
2343 : 60722251 : (set_attr "length_immediate" "1")])
2344 : 73915801 :
2345 : 108393296 : (define_insn "*mov<mode>_or"
2346 : 70100760 : [(set (match_operand:SWI248 0 "nonimmediate_operand" "=rm")
2347 : 61714479 : (match_operand:SWI248 1 "constm1_operand"))
2348 : 74141412 : (clobber (reg:CC FLAGS_REG))]
2349 : 46304022 : "reload_completed"
2350 : 2324165 : "or{<imodesuffix>}\t{%1, %0|%0, %1}"
2351 : 2208222 : [(set_attr "type" "alu1")
2352 : 295 : (set_attr "mode" "<MODE>")
2353 : 4157065 : (set_attr "length_immediate" "1")])
2354 : 57730775 :
2355 : 98762642 : (define_insn "*movxi_internal_avx512f"
2356 : 1239587 : [(set (match_operand:XI 0 "nonimmediate_operand" "=v,v ,v ,m")
2357 : 1239459 : (match_operand:XI 1 "nonimmediate_or_sse_const_operand" " C,BC,vm,v"))]
2358 : 2453244 : "TARGET_AVX512F && TARGET_EVEX512
2359 : 2453244 : && (register_operand (operands[0], XImode)
2360 : 2256427 : || register_operand (operands[1], XImode))"
2361 : 2451491 : {
2362 : 4939578 : switch (get_attr_type (insn))
2363 : 4928519 : {
2364 : 2441677 : case TYPE_SSELOG1:
2365 : 2441677 : return standard_sse_constant_opcode (insn, operands);
2366 : 2440631 :
2367 : 3216914 : case TYPE_SSEMOV:
2368 : 11340 : return ix86_output_ssemov (insn, operands);
2369 : 2264062 :
2370 : 2264062 : default:
2371 : 2264062 : gcc_unreachable ();
2372 : 56135 : }
2373 : 295 : }
2374 : 2264057 : [(set_attr "type" "sselog1,sselog1,ssemov,ssemov")
2375 : 2208222 : (set_attr "prefix" "evex")
2376 : 2208689 : (set_attr "mode" "XI")])
2377 : 2212309 :
2378 : 2208689 : (define_insn "*movoi_internal_avx"
2379 : 2208222 : [(set (match_operand:OI 0 "nonimmediate_operand" "=v,v ,v ,m")
2380 : 2208222 : (match_operand:OI 1 "nonimmediate_or_sse_const_operand" " C,BC,vm,v"))]
2381 : 2440346 : "TARGET_AVX
2382 : 2440346 : && (register_operand (operands[0], OImode)
2383 : 2242665 : || register_operand (operands[1], OImode))"
2384 : 238760 : {
2385 : 2223846 : switch (get_attr_type (insn))
2386 : 2208206 : {
2387 : 17209746 : case TYPE_SSELOG1:
2388 : 15001819 : return standard_sse_constant_opcode (insn, operands);
2389 : 9454392 :
2390 : 19979863 : case TYPE_SSEMOV:
2391 : 2211708 : return ix86_output_ssemov (insn, operands);
2392 : 2208094 :
2393 : 2208094 : default:
2394 : 2208094 : gcc_unreachable ();
2395 : 2208094 : }
2396 : 2208094 : }
2397 : 2208094 : [(set_attr "isa" "*,avx2,*,*")
2398 : 2208094 : (set_attr "type" "sselog1,sselog1,ssemov,ssemov")
2399 : 2208094 : (set_attr "prefix" "vex")
2400 : 261710 : (set_attr "mode" "OI")])
2401 : 2208094 :
2402 : 2208094 : (define_insn "*movti_internal"
2403 : 2208094 : [(set (match_operand:TI 0 "nonimmediate_operand" "=!r ,o ,v,v ,v ,m,?jc,?Yd")
2404 : 167 : (match_operand:TI 1 "general_operand" "riFo,re,C,BC,vm,v,Yd,jc"))]
2405 : 13790503 : "(TARGET_64BIT
2406 : 14806861 : && !(MEM_P (operands[0]) && MEM_P (operands[1])))
2407 : 3421953 : || (TARGET_SSE
2408 : 3421951 : && nonimmediate_or_sse_const_operand (operands[1], TImode)
2409 : 3418288 : && (register_operand (operands[0], TImode)
2410 : 2886427 : || register_operand (operands[1], TImode)))"
2411 : 16010286 : {
2412 : 2469637 : switch (get_attr_type (insn))
2413 : 2208023 : {
2414 : 53659749 : case TYPE_MULTI:
2415 : 53659749 : return "#";
2416 : 51451822 :
2417 : 2208143 : case TYPE_SSELOG1:
2418 : 2208143 : return standard_sse_constant_opcode (insn, operands);
2419 : 2207998 :
2420 : 14846789 : case TYPE_SSEMOV:
2421 : 14846789 : return ix86_output_ssemov (insn, operands);
2422 : 16793318 :
2423 : 2207927 : default:
2424 : 16771181 : gcc_unreachable ();
2425 : 13120741 : }
2426 : 16771252 : }
2427 : 2207998 : [(set (attr "isa")
2428 : 2207998 : (cond [(eq_attr "alternative" "0,1,6,7")
2429 : 2207998 : (const_string "x64")
2430 : 24798186 : (eq_attr "alternative" "3")
2431 : 2207998 : (const_string "sse2")
2432 : 71 : ]
2433 : 2207998 : (const_string "*")))
2434 : 2207998 : (set (attr "type")
2435 : 2207998 : (cond [(eq_attr "alternative" "0,1,6,7")
2436 : 71 : (const_string "multi")
2437 : 71 : (eq_attr "alternative" "2,3")
2438 : 2207998 : (const_string "sselog1")
2439 : 2207998 : ]
2440 : 2207998 : (const_string "ssemov")))
2441 : 2207998 : (set (attr "prefix")
2442 : 2207998 : (if_then_else (eq_attr "type" "sselog1,ssemov")
2443 : 2207998 : (const_string "maybe_vex")
2444 : 2207998 : (const_string "orig")))
2445 : 2207983 : (set (attr "mode")
2446 : 2207942 : (cond [(eq_attr "alternative" "0,1")
2447 : 2207942 : (const_string "DI")
2448 : 15 : (match_test "TARGET_AVX")
2449 : 2207942 : (const_string "TI")
2450 : 2207942 : (ior (not (match_test "TARGET_SSE2"))
2451 : 2207942 : (match_test "optimize_function_for_size_p (cfun)"))
2452 : 15 : (const_string "V4SF")
2453 : 15 : (and (eq_attr "alternative" "5")
2454 : 2207942 : (match_test "TARGET_SSE_TYPELESS_STORES"))
2455 : 2207927 : (const_string "V4SF")
2456 : 2207927 : ]
2457 : 2207942 : (const_string "TI")))
2458 : 2207942 : (set (attr "preferred_for_speed")
2459 : 2207942 : (cond [(eq_attr "alternative" "6")
2460 : 2207942 : (symbol_ref "TARGET_INTER_UNIT_MOVES_FROM_VEC")
2461 : 2207942 : (eq_attr "alternative" "7")
2462 : 2207942 : (symbol_ref "TARGET_INTER_UNIT_MOVES_TO_VEC")
2463 : 2207942 : ]
2464 : 15 : (symbol_ref "true")))])
2465 : 2207942 :
2466 : 2207942 : (define_split
2467 : 2207942 : [(set (match_operand:TI 0 "sse_reg_operand")
2468 : 15 : (match_operand:TI 1 "general_reg_operand"))]
2469 : 130 : "TARGET_64BIT && TARGET_SSE4_1
2470 : 2208057 : && reload_completed"
2471 : 2208057 : [(set (match_dup 2)
2472 : 4394554 : (vec_merge:V2DI
2473 : 3143788 : (vec_duplicate:V2DI (match_dup 3))
2474 : 4394554 : (match_dup 2)
2475 : 2207942 : (const_int 2)))]
2476 : 2208057 : {
2477 : 2208057 : operands[2] = lowpart_subreg (V2DImode, operands[0], TImode);
2478 : 2208057 : operands[3] = gen_highpart (DImode, operands[1]);
2479 : 2207942 :
2480 : 130 : emit_move_insn (gen_lowpart (DImode, operands[0]),
2481 : 2208057 : gen_lowpart (DImode, operands[1]));
2482 : 2207942 : })
2483 : 2207942 :
2484 : 15 : (define_insn "*movdi_internal"
2485 : 130 : [(set (match_operand:DI 0 "nonimmediate_operand"
2486 : 2208057 : "=r ,o ,r,r ,r,m ,*y,*y,?*y,?m,?r,?*y,?Yv,?v,?v,m ,m,?jc,?*Yd,?r,?v,?*y,?*x,*k,*k ,*r,*m,*k")
2487 : 2208057 : (match_operand:DI 1 "general_operand"
2488 : 2208057 : "riFo,riF,Z,rem,i,re,C ,*y,Bk ,*y,*y,r ,C ,?v,Bk,?v,v,*Yd,jc ,?v,r ,*x ,*y ,*r,*kBk,*k,*k,CBC"))]
2489 : 79234681 : "!(MEM_P (operands[0]) && MEM_P (operands[1]))
2490 : 78454921 : && ix86_hardreg_mov_ok (operands[0], operands[1])"
2491 : 24798245 : {
2492 : 24798245 : switch (get_attr_type (insn))
2493 : 2208057 : {
2494 : 1882670739 : case TYPE_MSKMOV:
2495 : 19538008 : return "kmovq\t{%1, %0|%0, %1}";
2496 : 1897792878 :
2497 : 2227171 : case TYPE_MSKLOG:
2498 : 19559760 : if (operands[1] == const0_rtx)
2499 : 2211086 : return "kxorq\t%0, %0, %0";
2500 : 2211219 : else if (operands[1] == constm1_rtx)
2501 : 2211086 : return "kxnorq\t%0, %0, %0";
2502 : 2210971 : gcc_unreachable ();
2503 : 2210971 :
2504 : 2210971 : case TYPE_MULTI:
2505 : 2210971 : return "#";
2506 : 3044 :
2507 : 3044 : case TYPE_MMX:
2508 : 2207942 : return "pxor\t%0, %0";
2509 : 2207942 :
2510 : 2207942 : case TYPE_MMXMOV:
2511 : 2065 : /* Handle broken assemblers that require movd instead of movq. */
2512 : 2207942 : if (!HAVE_AS_IX86_INTERUNIT_MOVQ
2513 : 2207942 : && (GENERAL_REG_P (operands[0]) || GENERAL_REG_P (operands[1])))
2514 : 2207942 : return "movd\t{%1, %0|%0, %1}";
2515 : 173 : return "movq\t{%1, %0|%0, %1}";
2516 : 2207942 :
2517 : 2209033 : case TYPE_SSELOG1:
2518 : 2209033 : return standard_sse_constant_opcode (insn, operands);
2519 : 81 :
2520 : 2700451 : case TYPE_SSEMOV:
2521 : 2700451 : return ix86_output_ssemov (insn, operands);
2522 : 2207942 :
2523 : 69 : case TYPE_SSECVT:
2524 : 2207942 : if (SSE_REG_P (operands[0]))
2525 : 2207942 : return "movq2dq\t{%1, %0|%0, %1}";
2526 : 2207942 : else
2527 : 2207942 : return "movdq2q\t{%1, %0|%0, %1}";
2528 : 2207942 :
2529 : 2207942 : case TYPE_LEA:
2530 : 2207942 : return "lea{q}\t{%E1, %0|%0, %E1}";
2531 : 2207942 :
2532 : 25678029 : case TYPE_IMOV:
2533 : 23470102 : gcc_assert (!flag_pic || LEGITIMATE_PIC_OPERAND_P (operands[1]));
2534 : 23470102 : if (get_attr_mode (insn) == MODE_SI)
2535 : 2207942 : return "mov{l}\t{%k1, %k0|%k0, %k1}";
2536 : 20733507 : else if (which_alternative == 4)
2537 : 2207942 : return "movabs{q}\t{%1, %0|%0, %1}";
2538 : 18225294 : else if (ix86_use_lea_for_mov (insn, operands))
2539 : 2207942 : return "lea{q}\t{%E1, %0|%0, %E1}";
2540 : 2207942 : else
2541 : 2207942 : return "mov{q}\t{%1, %0|%0, %1}";
2542 : 2709 :
2543 : 2207942 : default:
2544 : 2207942 : gcc_unreachable ();
2545 : 2207942 : }
2546 : 2207942 : }
2547 : 2207942 : [(set (attr "isa")
2548 : 2207942 : (cond [(eq_attr "alternative" "0,1,17,18")
2549 : 2207942 : (const_string "nox64")
2550 : 11656155 : (eq_attr "alternative" "2,3,4,5,10,11,23,25")
2551 : 3485155 : (const_string "x64")
2552 : 1277228 : (eq_attr "alternative" "19,20")
2553 : 1277228 : (const_string "x64_sse2")
2554 : 2207942 : (eq_attr "alternative" "21,22")
2555 : 2207942 : (const_string "sse2")
2556 : 2207942 : ]
2557 : 1267933 : (const_string "*")))
2558 : 2207942 : (set (attr "type")
2559 : 2207942 : (cond [(eq_attr "alternative" "0,1,17,18")
2560 : 2207942 : (const_string "multi")
2561 : 32 : (eq_attr "alternative" "6")
2562 : 2207942 : (const_string "mmx")
2563 : 2207942 : (eq_attr "alternative" "7,8,9,10,11")
2564 : 2207942 : (const_string "mmxmov")
2565 : 2207942 : (eq_attr "alternative" "12")
2566 : 2207942 : (const_string "sselog1")
2567 : 2207942 : (eq_attr "alternative" "13,14,15,16,19,20")
2568 : 2207942 : (const_string "ssemov")
2569 : 2207942 : (eq_attr "alternative" "21,22")
2570 : 2208261 : (const_string "ssecvt")
2571 : 334 : (eq_attr "alternative" "23,24,25,26")
2572 : 334 : (const_string "mskmov")
2573 : 2207942 : (eq_attr "alternative" "27")
2574 : 2207942 : (const_string "msklog")
2575 : 2207942 : (and (match_operand 0 "register_operand")
2576 : 2207942 : (match_operand 1 "pic_32bit_operand"))
2577 : 2207942 : (const_string "lea")
2578 : 2207942 : ]
2579 : 2207942 : (const_string "imov")))
2580 : 2207942 : (set (attr "modrm")
2581 : 2334042 : (if_then_else
2582 : 2334042 : (and (eq_attr "alternative" "4") (eq_attr "type" "imov"))
2583 : 126115 : (const_string "0")
2584 : 126115 : (const_string "*")))
2585 : 2207942 : (set (attr "length_immediate")
2586 : 2207942 : (if_then_else
2587 : 2207942 : (and (eq_attr "alternative" "4") (eq_attr "type" "imov"))
2588 : 2207942 : (const_string "8")
2589 : 2207942 : (const_string "*")))
2590 : 2207942 : (set (attr "prefix_rex")
2591 : 2207942 : (if_then_else
2592 : 2207942 : (eq_attr "alternative" "10,11,19,20")
2593 : 2225523 : (const_string "1")
2594 : 17596 : (const_string "*")))
2595 : 17596 : (set (attr "prefix")
2596 : 2207942 : (if_then_else (eq_attr "type" "sselog1,ssemov")
2597 : 2207942 : (const_string "maybe_vex")
2598 : 2207942 : (const_string "orig")))
2599 : 14437 : (set (attr "prefix_data16")
2600 : 2207942 : (if_then_else (and (eq_attr "type" "ssemov") (eq_attr "mode" "DI"))
2601 : 2207942 : (const_string "1")
2602 : 2207942 : (const_string "*")))
2603 : 15 : (set (attr "mode")
2604 : 2207942 : (cond [(eq_attr "alternative" "2")
2605 : 2207942 : (const_string "SI")
2606 : 2207942 : (eq_attr "alternative" "12")
2607 : 15 : (cond [(match_test "TARGET_AVX")
2608 : 2207942 : (const_string "TI")
2609 : 2207942 : (ior (not (match_test "TARGET_SSE2"))
2610 : 2207942 : (match_test "optimize_function_for_size_p (cfun)"))
2611 : 2207942 : (const_string "V4SF")
2612 : 2207927 : ]
2613 : 2207927 : (const_string "TI"))
2614 : 2207927 : (eq_attr "alternative" "13")
2615 : 2207940 : (cond [(match_test "TARGET_AVX512VL")
2616 : 2224872 : (const_string "TI")
2617 : 16945 : (match_test "TARGET_AVX512F")
2618 : 16945 : (const_string "DF")
2619 : 2207927 : (match_test "TARGET_AVX")
2620 : 2207927 : (const_string "TI")
2621 : 2207927 : (ior (not (match_test "TARGET_SSE2"))
2622 : 0 : (match_test "optimize_function_for_size_p (cfun)"))
2623 : 2207927 : (const_string "V4SF")
2624 : 2207927 : ]
2625 : 2207927 : (const_string "TI"))
2626 : 2207927 :
2627 : 2207927 : (and (eq_attr "alternative" "14,15,16")
2628 : 2207927 : (not (match_test "TARGET_SSE2")))
2629 : 2207927 : (const_string "V2SF")
2630 : 2207927 : ]
2631 : 2244796 : (const_string "DI")))
2632 : 36869 : (set (attr "preferred_for_speed")
2633 : 36869 : (cond [(eq_attr "alternative" "10,17,19")
2634 : 2207927 : (symbol_ref "TARGET_INTER_UNIT_MOVES_FROM_VEC")
2635 : 2207927 : (eq_attr "alternative" "11,18,20")
2636 : 2207927 : (symbol_ref "TARGET_INTER_UNIT_MOVES_TO_VEC")
2637 : 21636 : ]
2638 : 2207927 : (symbol_ref "true")))
2639 : 2207927 : (set (attr "enabled")
2640 : 2207927 : (cond [(eq_attr "alternative" "15")
2641 : 0 : (if_then_else
2642 : 60625450 : (match_test "TARGET_STV && TARGET_SSE2")
2643 : 2207927 : (symbol_ref "false")
2644 : 2207927 : (const_string "*"))
2645 : 0 : (eq_attr "alternative" "16")
2646 : 2207927 : (if_then_else
2647 : 2207927 : (match_test "TARGET_STV && TARGET_SSE2")
2648 : 2207927 : (symbol_ref "true")
2649 : 2207927 : (symbol_ref "false"))
2650 : 2207927 : ]
2651 : 2207927 : (const_string "*")))])
2652 : 2207927 :
2653 : 2207927 : (define_split
2654 : 2627089 : [(set (match_operand:<DWI> 0 "general_reg_operand")
2655 : 2627089 : (match_operand:<DWI> 1 "sse_reg_operand"))]
2656 : 2737808 : "TARGET_SSE4_1
2657 : 2631791 : && reload_completed"
2658 : 2627089 : [(set (match_dup 2)
2659 : 2627089 : (vec_select:DWIH
2660 : 2627089 : (match_dup 3)
2661 : 2627089 : (parallel [(const_int 1)])))]
2662 : 2627158 : {
2663 : 2627158 : operands[2] = gen_highpart (<MODE>mode, operands[0]);
2664 : 2627158 : operands[3] = lowpart_subreg (<ssevecmode>mode, operands[1], <DWI>mode);
2665 : 2627089 :
2666 : 2627158 : emit_move_insn (gen_lowpart (<MODE>mode, operands[0]),
2667 : 2627230 : gen_lowpart (<MODE>mode, operands[1]));
2668 : 2627161 : })
2669 : 2627161 :
2670 : 2627089 : (define_split
2671 : 2627230 : [(set (match_operand:DWI 0 "nonimmediate_gr_operand")
2672 : 2627230 : (match_operand:DWI 1 "general_gr_operand"))]
2673 : 44357738 : "reload_completed"
2674 : 2627230 : [(const_int 0)]
2675 : 2147268 : "ix86_split_long_move (operands); DONE;")
2676 : 419303 :
2677 : 2208068 : (define_split
2678 : 2208068 : [(set (match_operand:DI 0 "sse_reg_operand")
2679 : 2208068 : (match_operand:DI 1 "general_reg_operand"))]
2680 : 2477288 : "!TARGET_64BIT && TARGET_SSE4_1
2681 : 2208019 : && reload_completed"
2682 : 2208019 : [(set (match_dup 2)
2683 : 2207999 : (vec_merge:V4SI
2684 : 2207999 : (vec_duplicate:V4SI (match_dup 3))
2685 : 6251539 : (match_dup 2)
2686 : 4043612 : (const_int 2)))]
2687 : 4377093 : {
2688 : 7885097 : operands[2] = lowpart_subreg (V4SImode, operands[0], DImode);
2689 : 2208019 : operands[3] = gen_highpart (SImode, operands[1]);
2690 : 3805645 :
2691 : 2208019 : emit_move_insn (gen_lowpart (SImode, operands[0]),
2692 : 3805665 : gen_lowpart (SImode, operands[1]));
2693 : 2338476 : })
2694 : 2208019 :
2695 : 2207999 : ;; movabsq $0x0012345678000000, %rax is longer
2696 : 2338493 : ;; than movl $0x12345678, %eax; shlq $24, %rax.
2697 : 158 : (define_peephole2
2698 : 130546 : [(set (match_operand:DI 0 "register_operand")
2699 : 2208088 : (match_operand:DI 1 "const_int_operand"))]
2700 : 3860444 : "TARGET_64BIT
2701 : 3860372 : && optimize_insn_for_size_p ()
2702 : 2735362 : && LEGACY_INT_REG_P (operands[0])
2703 : 2426751 : && !x86_64_immediate_operand (operands[1], DImode)
2704 : 2233696 : && !x86_64_zext_immediate_operand (operands[1], DImode)
2705 : 2258597 : && !((UINTVAL (operands[1]) >> ctz_hwi (UINTVAL (operands[1])))
2706 : 2207999 : & ~HOST_WIDE_INT_C (0xffffffff))
2707 : 150082969 : && peep2_regno_dead_p (0, FLAGS_REG)"
2708 : 150072241 : [(set (match_dup 0) (match_dup 1))
2709 : 150082918 : (parallel [(set (match_dup 0) (ashift:DI (match_dup 0) (match_dup 2)))
2710 : 150082938 : (clobber (reg:CC FLAGS_REG))])]
2711 : 150082938 : {
2712 : 150082918 : int shift = ctz_hwi (UINTVAL (operands[1]));
2713 : 150082918 : rtx op1 = gen_int_mode (UINTVAL (operands[1]) >> shift, DImode);
2714 : 153143836 : if (ix86_endbr_immediate_operand (op1, VOIDmode))
2715 : 150072242 : FAIL;
2716 : 153142745 : operands[1] = op1;
2717 : 150082917 : operands[2] = gen_int_mode (shift, QImode);
2718 : 151723528 : })
2719 : 150072241 :
2720 : 150082918 : (define_insn "*movsi_internal"
2721 : 150093594 : [(set (match_operand:SI 0 "nonimmediate_operand"
2722 : 150093594 : "=r,m ,*y,*y,?*y,?m,?r,?*y,?Yv,?v,?v,m ,?r,?v,*k,*k ,*rm,*k")
2723 : 150093594 : (match_operand:SI 1 "general_operand"
2724 : 150082918 : "g ,re,C ,*y,Bk ,*y,*y,r ,C ,?v,Bk,?v,?v,r ,*r,*kBk,*k ,CBC"))]
2725 : 193677767 : "!(MEM_P (operands[0]) && MEM_P (operands[1]))
2726 : 193063756 : && ix86_hardreg_mov_ok (operands[0], operands[1])"
2727 : 160649960 : {
2728 : 159520454 : switch (get_attr_type (insn))
2729 : 150082917 : {
2730 : 150075059 : case TYPE_SSELOG1:
2731 : 150075059 : return standard_sse_constant_opcode (insn, operands);
2732 : 1177511808 :
2733 : 150072241 : case TYPE_MSKMOV:
2734 : 147864314 : return "kmovd\t{%1, %0|%0, %1}";
2735 : 147864314 :
2736 : 1029658671 : case TYPE_MSKLOG:
2737 : 1029658671 : if (operands[1] == const0_rtx)
2738 : 1029658242 : return "kxord\t%0, %0, %0";
2739 : 1029647992 : else if (operands[1] == constm1_rtx)
2740 : 1029647566 : return "kxnord\t%0, %0, %0";
2741 : 1029647566 : gcc_unreachable ();
2742 : 1029647566 :
2743 : 1029856279 : case TYPE_SSEMOV:
2744 : 2421710 : return ix86_output_ssemov (insn, operands);
2745 : 11267715 :
2746 : 11267715 : case TYPE_MMX:
2747 : 9059788 : return "pxor\t%0, %0";
2748 : 5070 :
2749 : 2208312 : case TYPE_MMXMOV:
2750 : 2207999 : switch (get_attr_mode (insn))
2751 : 2207999 : {
2752 : 2207999 : case MODE_DI:
2753 : 2207999 : return "movq\t{%1, %0|%0, %1}";
2754 : 2207999 : case MODE_SI:
2755 : 2207999 : return "movd\t{%1, %0|%0, %1}";
2756 : 2207999 :
2757 : 2278212 : default:
2758 : 2278212 : gcc_unreachable ();
2759 : 2278212 : }
2760 : 2278212 :
2761 : 2278212 : case TYPE_LEA:
2762 : 70285 : return "lea{l}\t{%E1, %0|%0, %E1}";
2763 : 70285 :
2764 : 11428621 : case TYPE_IMOV:
2765 : 11428621 : gcc_assert (!flag_pic || LEGITIMATE_PIC_OPERAND_P (operands[1]));
2766 : 11428621 : if (ix86_use_lea_for_mov (insn, operands))
2767 : 2207999 : return "lea{l}\t{%E1, %0|%0, %E1}";
2768 : 2207999 : else
2769 : 2207999 : return "mov{l}\t{%1, %0|%0, %1}";
2770 : 2207999 :
2771 : 2207999 : default:
2772 : 2252578 : gcc_unreachable ();
2773 : 44651 : }
2774 : 44651 : }
2775 : 2207999 : [(set (attr "isa")
2776 : 2207999 : (cond [(eq_attr "alternative" "12,13")
2777 : 2207999 : (const_string "sse2")
2778 : 518006 : ]
2779 : 2207999 : (const_string "*")))
2780 : 2207999 : (set (attr "type")
2781 : 2207999 : (cond [(eq_attr "alternative" "2")
2782 : 43002 : (const_string "mmx")
2783 : 2207999 : (eq_attr "alternative" "3,4,5,6,7")
2784 : 2207999 : (const_string "mmxmov")
2785 : 2207999 : (eq_attr "alternative" "8")
2786 : 72 : (const_string "sselog1")
2787 : 2207999 : (eq_attr "alternative" "9,10,11,12,13")
2788 : 2207999 : (const_string "ssemov")
2789 : 2207927 : (eq_attr "alternative" "14,15,16")
2790 : 72 : (const_string "mskmov")
2791 : 2207999 : (eq_attr "alternative" "17")
2792 : 2207999 : (const_string "msklog")
2793 : 2207927 : (and (match_operand 0 "register_operand")
2794 : 2207999 : (match_operand 1 "pic_32bit_operand"))
2795 : 2207999 : (const_string "lea")
2796 : 2207999 : ]
2797 : 2207999 : (const_string "imov")))
2798 : 2207999 : (set (attr "prefix")
2799 : 2208015 : (if_then_else (eq_attr "type" "sselog1,ssemov")
2800 : 2208015 : (const_string "maybe_vex")
2801 : 88 : (const_string "orig")))
2802 : 88 : (set (attr "prefix_data16")
2803 : 2207927 : (if_then_else (and (eq_attr "type" "ssemov") (eq_attr "mode" "SI"))
2804 : 2207927 : (const_string "1")
2805 : 2207999 : (const_string "*")))
2806 : 88 : (set (attr "mode")
2807 : 2207999 : (cond [(eq_attr "alternative" "2,3")
2808 : 2207999 : (const_string "DI")
2809 : 2207999 : (eq_attr "alternative" "8")
2810 : 2207999 : (cond [(match_test "TARGET_AVX")
2811 : 2207999 : (const_string "TI")
2812 : 2207999 : (ior (not (match_test "TARGET_SSE2"))
2813 : 2207999 : (match_test "optimize_function_for_size_p (cfun)"))
2814 : 2207999 : (const_string "V4SF")
2815 : 2208259 : ]
2816 : 2208259 : (const_string "TI"))
2817 : 2208259 : (eq_attr "alternative" "9")
2818 : 2208259 : (cond [(match_test "TARGET_AVX512VL")
2819 : 2208259 : (const_string "TI")
2820 : 2208259 : (match_test "TARGET_AVX512F")
2821 : 2208259 : (const_string "SF")
2822 : 2208259 : (match_test "TARGET_AVX")
2823 : 2208259 : (const_string "TI")
2824 : 332 : (ior (not (match_test "TARGET_SSE2"))
2825 : 332 : (match_test "optimize_function_for_size_p (cfun)"))
2826 : 2207999 : (const_string "V4SF")
2827 : 2207999 : ]
2828 : 2207999 : (const_string "TI"))
2829 : 2207999 :
2830 : 2207999 : (and (eq_attr "alternative" "10,11")
2831 : 2207999 : (not (match_test "TARGET_SSE2")))
2832 : 2207999 : (const_string "SF")
2833 : 2207999 : ]
2834 : 2207999 : (const_string "SI")))
2835 : 2207999 : (set (attr "preferred_for_speed")
2836 : 2207999 : (cond [(eq_attr "alternative" "6,12")
2837 : 72 : (symbol_ref "TARGET_INTER_UNIT_MOVES_FROM_VEC")
2838 : 72 : (eq_attr "alternative" "7,13")
2839 : 2207999 : (symbol_ref "TARGET_INTER_UNIT_MOVES_TO_VEC")
2840 : 2207999 : ]
2841 : 2207999 : (symbol_ref "true")))])
2842 : 2207999 :
2843 : 2208034 : ;; With -Oz, transform mov $imm,reg to the shorter push $imm; pop reg.
2844 : 2208034 : (define_peephole2
2845 : 2208034 : [(set (match_operand:SWI248 0 "general_reg_operand")
2846 : 2208034 : (match_operand:SWI248 1 "const_int_operand"))]
2847 : 4711962 : "optimize_insn_for_size_p () && optimize_size > 1
2848 : 2208070 : && operands[1] != const0_rtx
2849 : 2208054 : && IN_RANGE (INTVAL (operands[1]), -128, 127)
2850 : 2208053 : && !ix86_red_zone_used
2851 : 5021989 : && REGNO (operands[0]) != SP_REG"
2852 : 2208034 : [(set (match_dup 2) (match_dup 1))
2853 : 2208038 : (set (match_dup 0) (match_dup 3))]
2854 : 2208055 : {
2855 : 2208055 : if (GET_MODE (operands[0]) != word_mode)
2856 : 111 : operands[0] = gen_rtx_REG (word_mode, REGNO (operands[0]));
2857 : 107 :
2858 : 3399433 : operands[2] = gen_rtx_MEM (word_mode,
2859 : 2208051 : gen_rtx_PRE_DEC (Pmode, stack_pointer_rtx));
2860 : 3314855 : operands[3] = gen_rtx_MEM (word_mode,
2861 : 3314855 : gen_rtx_POST_INC (Pmode, stack_pointer_rtx));
2862 : 2226167 : })
2863 : 2208034 :
2864 : 2208034 : ;; With -Oz, transform mov $0,mem to the shorter and $0,mem.
2865 : 2208051 : ;; Likewise, transform mov $-1,mem to the shorter or $-1,mem.
2866 : 2208051 : (define_peephole2
2867 : 2208051 : [(set (match_operand:SWI248 0 "memory_operand")
2868 : 2208051 : (match_operand:SWI248 1 "const_int_operand"))]
2869 : 526064 : "(operands[1] == const0_rtx || operands[1] == constm1_rtx)
2870 : 504670 : && optimize_insn_for_size_p () && optimize_size > 1
2871 : 2208059 : && peep2_regno_dead_p (0, FLAGS_REG)"
2872 : 2208051 : [(parallel [(set (match_dup 0) (match_dup 1))
2873 : 2208056 : (clobber (reg:CC FLAGS_REG))])])
2874 : 112 :
2875 : 2208056 : (define_insn "*movhi_internal"
2876 : 2208034 : [(set (match_operand:HI 0 "nonimmediate_operand"
2877 : 2208051 : "=r,r,r,m ,*k,*k ,r ,m ,*k ,?r,?*v,*Yv,*v,*v,jm,m")
2878 : 2208051 : (match_operand:HI 1 "general_operand"
2879 : 2208051 : "r ,n,m,rn,r ,*km,*k,*k,CBC,*v,r ,C ,*v,m ,*x,*v"))]
2880 : 11695705 : "!(MEM_P (operands[0]) && MEM_P (operands[1]))
2881 : 17820980 : && ix86_hardreg_mov_ok (operands[0], operands[1])"
2882 : 3998782 : {
2883 : 9913091 : switch (get_attr_type (insn))
2884 : 2298892 : {
2885 : 2298911 : case TYPE_IMOVX:
2886 : 15042662 : /* movzwl is faster than movw on p2 due to partial word stalls,
2887 : 15042681 : though not as fast as an aligned movl. */
2888 : 2347117 : return "movz{wl|x}\t{%1, %k0|%k0, %1}";
2889 : 15042681 :
2890 : 2307741 : case TYPE_MSKMOV:
2891 : 2307739 : switch (which_alternative)
2892 : 2298911 : {
2893 : 2298894 : case 4:
2894 : 2298911 : return "kmovw\t{%k1, %0|%0, %k1}";
2895 : 92944 : case 6:
2896 : 92944 : return "kmovw\t{%1, %k0|%k0, %1}";
2897 : 2208401 : case 5:
2898 : 2208399 : case 7:
2899 : 2208399 : return "kmovw\t{%1, %0|%0, %1}";
2900 : 2208034 : default:
2901 : 2208034 : gcc_unreachable ();
2902 : 2208036 : }
2903 : 2208036 :
2904 : 2208814 : case TYPE_SSEMOV:
2905 : 2208818 : return ix86_output_ssemov (insn, operands);
2906 : 2208040 :
2907 : 2208198 : case TYPE_SSELOG1:
2908 : 271 : if (satisfies_constraint_C (operands[1]))
2909 : 115 : return standard_sse_constant_opcode (insn, operands);
2910 : 2208037 :
2911 : 2208190 : if (SSE_REG_P (operands[0]))
2912 : 2208037 : return "%vpinsrw\t{$0, %1, %d0|%d0, %1, 0}";
2913 : 2208037 : else
2914 : 2208090 : return "%vpextrw\t{$0, %1, %0|%0, %1, 0}";
2915 : 2208037 :
2916 : 2208996 : case TYPE_MSKLOG:
2917 : 2208999 : if (operands[1] == const0_rtx)
2918 : 2242272 : return "kxorw\t%0, %0, %0";
2919 : 2243221 : else if (operands[1] == constm1_rtx)
2920 : 2242272 : return "kxnorw\t%0, %0, %0";
2921 : 2242272 : gcc_unreachable ();
2922 : 2242272 :
2923 : 2508143 : default:
2924 : 300216 : if (get_attr_mode (insn) == MODE_SI)
2925 : 34342 : return "mov{l}\t{%k1, %k0|%k0, %k1}";
2926 : 2208034 : else
2927 : 2393977 : return "mov{w}\t{%1, %0|%0, %1}";
2928 : 2208037 : }
2929 : 2208037 : }
2930 : 2208034 : [(set (attr "isa")
2931 : 2208034 : (cond [(eq_attr "alternative" "9,10,11,12,13")
2932 : 2208034 : (const_string "sse2")
2933 : 3923054 : (eq_attr "alternative" "14")
2934 : 2331063 : (const_string "sse4_noavx")
2935 : 2331066 : (eq_attr "alternative" "15")
2936 : 2331063 : (const_string "avx")
2937 : 2331066 : ]
2938 : 2331066 : (const_string "*")))
2939 : 2331066 : (set (attr "addr")
2940 : 2331066 : (if_then_else (eq_attr "alternative" "14")
2941 : 2331063 : (const_string "gpr16")
2942 : 123139 : (const_string "*")))
2943 : 123139 : (set (attr "type")
2944 : 2208037 : (cond [(eq_attr "alternative" "4,5,6,7")
2945 : 2208037 : (const_string "mskmov")
2946 : 2208037 : (eq_attr "alternative" "8")
2947 : 2208037 : (const_string "msklog")
2948 : 2208034 : (eq_attr "alternative" "13,14,15")
2949 : 2208034 : (if_then_else (match_test "TARGET_AVX512FP16")
2950 : 2208034 : (const_string "ssemov")
2951 : 2208034 : (const_string "sselog1"))
2952 : 2208579 : (eq_attr "alternative" "11")
2953 : 2208579 : (const_string "sselog1")
2954 : 2208579 : (eq_attr "alternative" "9,10,12")
2955 : 2208576 : (const_string "ssemov")
2956 : 649 : (match_test "optimize_function_for_size_p (cfun)")
2957 : 649 : (const_string "imov")
2958 : 2208034 : (and (eq_attr "alternative" "0")
2959 : 2208034 : (ior (not (match_test "TARGET_PARTIAL_REG_STALL"))
2960 : 2208041 : (not (match_test "TARGET_HIMODE_MATH"))))
2961 : 2208034 : (const_string "imov")
2962 : 2208041 : (and (eq_attr "alternative" "1,2")
2963 : 2208041 : (match_operand:HI 1 "aligned_operand"))
2964 : 2208041 : (const_string "imov")
2965 : 2208041 : (and (match_test "TARGET_MOVX")
2966 : 2208161 : (eq_attr "alternative" "0,2"))
2967 : 227 : (const_string "imovx")
2968 : 234 : ]
2969 : 2208041 : (const_string "imov")))
2970 : 2208041 : (set (attr "prefix")
2971 : 2208041 : (cond [(eq_attr "alternative" "4,5,6,7,8")
2972 : 2208041 : (const_string "vex")
2973 : 2208041 : (eq_attr "alternative" "9,10,11,12,13,14,15")
2974 : 2208041 : (const_string "maybe_evex")
2975 : 2208041 : ]
2976 : 2208034 : (const_string "orig")))
2977 : 2216227 : (set (attr "mode")
2978 : 2216227 : (cond [(eq_attr "alternative" "9,10")
2979 : 2216227 : (if_then_else (match_test "TARGET_AVX512FP16")
2980 : 2216220 : (const_string "HI")
2981 : 8293 : (const_string "SI"))
2982 : 8293 : (eq_attr "alternative" "13,14,15")
2983 : 2208034 : (if_then_else (match_test "TARGET_AVX512FP16")
2984 : 2208034 : (const_string "HI")
2985 : 2208053 : (const_string "TI"))
2986 : 2208034 : (eq_attr "alternative" "11")
2987 : 2208053 : (cond [(match_test "TARGET_AVX")
2988 : 2208053 : (const_string "TI")
2989 : 2208053 : (ior (not (match_test "TARGET_SSE2"))
2990 : 2208053 : (match_test "optimize_function_for_size_p (cfun)"))
2991 : 2208053 : (const_string "V4SF")
2992 : 2208034 : ]
2993 : 126 : (const_string "TI"))
2994 : 126 : (eq_attr "alternative" "12")
2995 : 2208053 : (cond [(match_test "TARGET_AVX512VL")
2996 : 2208053 : (const_string "TI")
2997 : 2208053 : (match_test "TARGET_AVX512FP16")
2998 : 2208053 : (const_string "HF")
2999 : 2208053 : (match_test "TARGET_AVX512F")
3000 : 2208053 : (const_string "SF")
3001 : 2208034 : (match_test "TARGET_AVX")
3002 : 2208053 : (const_string "TI")
3003 : 2439349 : (ior (not (match_test "TARGET_SSE2"))
3004 : 2439349 : (match_test "optimize_function_for_size_p (cfun)"))
3005 : 2439258 : (const_string "V4SF")
3006 : 2439258 : ]
3007 : 2439295 : (const_string "TI"))
3008 : 2439295 : (eq_attr "type" "imovx")
3009 : 2439295 : (const_string "SI")
3010 : 2439299 : (and (eq_attr "alternative" "1,2")
3011 : 2439295 : (match_operand:HI 1 "aligned_operand"))
3012 : 2439262 : (const_string "SI")
3013 : 2439299 : (and (eq_attr "alternative" "0")
3014 : 2439299 : (ior (not (match_test "TARGET_PARTIAL_REG_STALL"))
3015 : 2439299 : (not (match_test "TARGET_HIMODE_MATH"))))
3016 : 2439299 : (const_string "SI")
3017 : 2439295 : ]
3018 : 2439299 : (const_string "HI")))
3019 : 231372 : (set (attr "preferred_for_speed")
3020 : 231372 : (cond [(eq_attr "alternative" "9")
3021 : 2208003 : (symbol_ref "TARGET_INTER_UNIT_MOVES_FROM_VEC")
3022 : 2208003 : (eq_attr "alternative" "10")
3023 : 2208003 : (symbol_ref "TARGET_INTER_UNIT_MOVES_TO_VEC")
3024 : 2208003 : ]
3025 : 2208003 : (symbol_ref "true")))])
3026 : 2207999 :
3027 : 2208003 : ;; Situation is quite tricky about when to choose full sized (SImode) move
3028 : 2208003 : ;; over QImode moves. For Q_REG -> Q_REG move we use full size only for
3029 : 2218316 : ;; partial register dependency machines (such as AMD Athlon), where QImode
3030 : 2218312 : ;; moves issue extra dependency and for partial register stalls machines
3031 : 10385 : ;; that don't use QImode patterns (and QImode move cause stall on the next
3032 : 10385 : ;; instruction).
3033 : 2207999 : ;;
3034 : 2207999 : ;; For loads of Q_REG to NONQ_REG we use full sized moves except for partial
3035 : 2208003 : ;; register stall machines with, where we use QImode instructions, since
3036 : 2207999 : ;; partial register stall can be caused there. Then we use movzx.
3037 : 2208003 :
3038 : 2208003 : (define_insn "*movqi_internal"
3039 : 2208003 : [(set (match_operand:QI 0 "nonimmediate_operand"
3040 : 2208003 : "=Q,R,r,q,q,r,r ,?r,m ,*k,*k,*r,*m,*k,*k,*k")
3041 : 2210010 : (match_operand:QI 1 "general_operand"
3042 : 2079 : "Q ,R,r,n,m,q,rn, m,qn,*r,*k,*k,*k,*m,C,BC"))]
3043 : 10757619 : "!(MEM_P (operands[0]) && MEM_P (operands[1]))
3044 : 12833176 : && ix86_hardreg_mov_ok (operands[0], operands[1])"
3045 : 2208003 :
3046 : 3923023 : {
3047 : 3922951 : char buf[128];
3048 : 17096645 : const char *ops;
3049 : 17096645 : const char *suffix;
3050 : 15381625 :
3051 : 3923019 : switch (get_attr_type (insn))
3052 : 15384746 : {
3053 : 1650948 : case TYPE_IMOVX:
3054 : 1062987 : gcc_assert (ANY_QI_REG_P (operands[1]) || MEM_P (operands[1]));
3055 : 15384922 : return "movz{bl|x}\t{%1, %k0|%k0, %1}";
3056 : 2207999 :
3057 : 2232399 : case TYPE_MSKMOV:
3058 : 27997 : switch (which_alternative)
3059 : 2207999 : {
3060 : 2207999 : case 9:
3061 : 2207999 : ops = "kmov%s\t{%%k1, %%0|%%0, %%k1}";
3062 : 2207999 : break;
3063 : 2212678 : case 11:
3064 : 2212678 : ops = "kmov%s\t{%%1, %%k0|%%k0, %%1}";
3065 : 2212678 : break;
3066 : 2208177 : case 12:
3067 : 2208644 : case 13:
3068 : 2208644 : gcc_assert (TARGET_AVX512DQ);
3069 : 539 : /* FALLTHRU */
3070 : 1030 : case 10:
3071 : 2208490 : ops = "kmov%s\t{%%1, %%0|%%0, %%1}";
3072 : 2208490 : break;
3073 : 2207999 : default:
3074 : 2207999 : gcc_unreachable ();
3075 : 2207999 : }
3076 : 2207999 :
3077 : 2232399 : suffix = (get_attr_mode (insn) == MODE_HI) ? "w" : "b";
3078 : 2207999 :
3079 : 2812437 : snprintf (buf, sizeof (buf), ops, suffix);
3080 : 2812437 : output_asm_insn (buf, operands);
3081 : 2812437 : return "";
3082 : 580110 :
3083 : 582355 : case TYPE_MSKLOG:
3084 : 2210244 : if (operands[1] == const0_rtx)
3085 : 2207999 : {
3086 : 2208017 : if (get_attr_mode (insn) == MODE_HI)
3087 : 2207999 : return "kxorw\t%0, %0, %0";
3088 : 2207999 : else
3089 : 2208000 : return "kxorb\t%0, %0, %0";
3090 : 2207999 : }
3091 : 2210226 : else if (operands[1] == constm1_rtx)
3092 : 2208306 : {
3093 : 2606 : gcc_assert (TARGET_AVX512DQ);
3094 : 379 : return "kxnorb\t%0, %0, %0";
3095 : 2207999 : }
3096 : 2207999 : gcc_unreachable ();
3097 : 2207999 :
3098 : 3400538 : default:
3099 : 3400610 : if (get_attr_mode (insn) == MODE_SI)
3100 : 2207999 : return "mov{l}\t{%k1, %k0|%k0, %k1}";
3101 : 2207999 : else
3102 : 2849259 : return "mov{b}\t{%1, %0|%0, %1}";
3103 : 2638424 : }
3104 : 2638424 : }
3105 : 2638424 : [(set (attr "isa")
3106 : 2638424 : (cond [(eq_attr "alternative" "1,2")
3107 : 430497 : (const_string "x64")
3108 : 430498 : (eq_attr "alternative" "12,13,15")
3109 : 2207999 : (const_string "avx512dq")
3110 : 2207999 : ]
3111 : 2207999 : (const_string "*")))
3112 : 2207999 : (set (attr "type")
3113 : 2207999 : (cond [(eq_attr "alternative" "9,10,11,12,13")
3114 : 2207999 : (const_string "mskmov")
3115 : 2207999 : (eq_attr "alternative" "14,15")
3116 : 2207999 : (const_string "msklog")
3117 : 2207999 : (and (eq_attr "alternative" "7")
3118 : 2208440 : (not (match_operand:QI 1 "aligned_operand")))
3119 : 2207999 : (const_string "imovx")
3120 : 441 : (match_test "optimize_function_for_size_p (cfun)")
3121 : 513 : (const_string "imov")
3122 : 2208440 : (and (eq_attr "alternative" "5")
3123 : 2208440 : (ior (not (match_test "TARGET_PARTIAL_REG_STALL"))
3124 : 441 : (not (match_test "TARGET_QIMODE_MATH"))))
3125 : 2207999 : (const_string "imov")
3126 : 2208440 : (eq_attr "alternative" "5,7")
3127 : 2208440 : (const_string "imovx")
3128 : 76558974 : (and (match_test "TARGET_MOVX")
3129 : 2208440 : (eq_attr "alternative" "4"))
3130 : 2208859 : (const_string "imovx")
3131 : 2208859 : ]
3132 : 76559393 : (const_string "imov")))
3133 : 932 : (set (attr "prefix")
3134 : 72 : (if_then_else (eq_attr "alternative" "9,10,11,12,13,14,15")
3135 : 72 : (const_string "vex")
3136 : 2207999 : (const_string "orig")))
3137 : 2207927 : (set (attr "mode")
3138 : 2207999 : (cond [(eq_attr "alternative" "5,6,7")
3139 : 2208440 : (const_string "SI")
3140 : 2208440 : (eq_attr "alternative" "8")
3141 : 2208368 : (const_string "QI")
3142 : 6020932 : (and (eq_attr "alternative" "9,10,11,14")
3143 : 6020932 : (not (match_test "TARGET_AVX512DQ")))
3144 : 6020932 : (const_string "HI")
3145 : 72 : (eq_attr "type" "imovx")
3146 : 72 : (const_string "SI")
3147 : 6021035 : ;; For -Os, 8-bit immediates are always shorter than 32-bit
3148 : 6020932 : ;; ones.
3149 : 6021035 : (and (eq_attr "type" "imov")
3150 : 6021035 : (and (eq_attr "alternative" "3")
3151 : 6021035 : (match_test "optimize_function_for_size_p (cfun)")))
3152 : 3813108 : (const_string "QI")
3153 : 3813108 : ;; For -Os, movl where one or both operands are NON_Q_REGS
3154 : 2207999 : ;; and both are LEGACY_REGS is shorter than movb.
3155 : 2217418 : ;; Otherwise movb and movl sizes are the same, so decide purely
3156 : 2217418 : ;; based on speed factors.
3157 : 2217418 : (and (eq_attr "type" "imov")
3158 : 9491 : (and (eq_attr "alternative" "1")
3159 : 2208102 : (match_test "optimize_function_for_size_p (cfun)")))
3160 : 2208102 : (const_string "SI")
3161 : 2208102 : (and (eq_attr "type" "imov")
3162 : 5451491 : (and (eq_attr "alternative" "0,1,2,3")
3163 : 6168448 : (and (match_test "TARGET_PARTIAL_REG_DEPENDENCY")
3164 : 3243461 : (not (match_test "TARGET_PARTIAL_REG_STALL")))))
3165 : 3243461 : (const_string "SI")
3166 : 2207999 : ;; Avoid partial register stalls when not using QImode arithmetic
3167 : 2207999 : (and (eq_attr "type" "imov")
3168 : 175 : (and (eq_attr "alternative" "0,1,2,3")
3169 : 175 : (and (match_test "TARGET_PARTIAL_REG_STALL")
3170 : 2208102 : (not (match_test "TARGET_QIMODE_MATH")))))
3171 : 2207999 : (const_string "SI")
3172 : 2207999 : ]
3173 : 2207999 : (const_string "QI")))])
3174 : 2207999 :
3175 : 2207999 : /* Reload dislikes loading 0/-1 directly into mask registers.
3176 : 2207999 : Try to tidy things up here. */
3177 : 2207999 : (define_peephole2
3178 : 7297510 : [(set (match_operand:SWI 0 "general_reg_operand")
3179 : 5089583 : (match_operand:SWI 1 "immediate_operand"))
3180 : 5089583 : (set (match_operand:SWI 2 "mask_reg_operand")
3181 : 2207999 : (match_dup 0))]
3182 : 2226 : "peep2_reg_dead_p (2, operands[0])
3183 : 2210087 : && (const0_operand (operands[1], <MODE>mode)
3184 : 2151 : || (constm1_operand (operands[1], <MODE>mode)
3185 : 2208184 : && (<MODE_SIZE> > 1 || TARGET_AVX512DQ)))"
3186 : 3742917 : [(set (match_dup 2) (match_dup 1))])
3187 : 2207957 :
3188 : 2207957 : ;; Stores and loads of ax to arbitrary constant address.
3189 : 2207999 : ;; We fake an second form of instruction to force reload to load address
3190 : 3848724 : ;; into register when rax is not available
3191 : 3447218 : (define_insn "*movabs<mode>_1"
3192 : 2609433 : [(set (mem:SWI1248x (match_operand:DI 0 "x86_64_movabs_operand" "i,r"))
3193 : 3648752 : (match_operand:SWI1248x 1 "nonmemory_operand" "a,r<i>"))]
3194 : 2748095 : "TARGET_LP64 && ix86_check_movabs (insn, 0)"
3195 : 4218159 : {
3196 : 2747183 : /* Recover the full memory rtx. */
3197 : 169680 : operands[0] = SET_DEST (PATTERN (insn));
3198 : 404466 : switch (which_alternative)
3199 : 2442794 : {
3200 : 2446069 : case 0:
3201 : 4259186 : return "movabs{<imodesuffix>}\t{%1, %P0|<iptrsize> PTR [%P0], %1}";
3202 : 4259195 : case 1:
3203 : 4259195 : return "mov{<imodesuffix>}\t{%1, %0|%0, %1}";
3204 : 4259186 : default:
3205 : 2207999 : gcc_unreachable ();
3206 : 3552780 : }
3207 : 6174832 : }
3208 : 4838980 : [(set_attr "type" "imov")
3209 : 3841015 : (set_attr "modrm" "0,*")
3210 : 3832086 : (set_attr "length_address" "8,0")
3211 : 3417981 : (set_attr "length_immediate" "0,*")
3212 : 2216928 : (set_attr "memory" "store")
3213 : 3069357 : (set_attr "mode" "<MODE>")])
3214 : 3060428 :
3215 : 2216928 : (define_insn "*movabs<mode>_2"
3216 : 2216928 : [(set (match_operand:SWI1248x 0 "register_operand" "=a,r")
3217 : 2209744 : (mem:SWI1248x (match_operand:DI 1 "x86_64_movabs_operand" "i,r")))]
3218 : 2214529 : "TARGET_LP64 && ix86_check_movabs (insn, 1)"
3219 : 4567544 : {
3220 : 4242351 : /* Recover the full memory rtx. */
3221 : 4246921 : operands[1] = SET_SRC (PATTERN (insn));
3222 : 4246883 : switch (which_alternative)
3223 : 4505258 : {
3224 : 2037959 : case 0:
3225 : 2307891 : return "movabs{<imodesuffix>}\t{%P1, %0|%0, <iptrsize> PTR [%P1]}";
3226 : 3612733 : case 1:
3227 : 3612733 : return "mov{<imodesuffix>}\t{%1, %0|%0, %1}";
3228 : 2208033 : default:
3229 : 3554363 : gcc_unreachable ();
3230 : 3554363 : }
3231 : 2207999 : }
3232 : 2225363 : [(set_attr "type" "imov")
3233 : 2225363 : (set_attr "modrm" "0,*")
3234 : 7983182 : (set_attr "length_address" "8,0")
3235 : 5775293 : (set_attr "length_immediate" "0")
3236 : 5775255 : (set_attr "memory" "load")
3237 : 2207999 : (set_attr "mode" "<MODE>")])
3238 : 2220070 :
3239 : 2220070 : (define_insn "swap<mode>"
3240 : 5609620 : [(set (match_operand:SWI48 0 "register_operand" "+r")
3241 : 2207999 : (match_operand:SWI48 1 "register_operand" "+r"))
3242 : 2213227 : (set (match_dup 1)
3243 : 2213226 : (match_dup 0))]
3244 : 2213227 : ""
3245 : 2208570 : "xchg{<imodesuffix>}\t%1, %0"
3246 : 2212628 : [(set_attr "type" "imov")
3247 : 2208000 : (set_attr "mode" "<MODE>")
3248 : 2208048 : (set_attr "pent_pair" "np")
3249 : 2534103 : (set_attr "athlon_decode" "vector")
3250 : 2534103 : (set_attr "amdfam10_decode" "double")
3251 : 326176 : (set_attr "bdver1_decode" "double")])
3252 : 326127 :
3253 : 2208049 : (define_insn "*swap<mode>"
3254 : 2208000 : [(set (match_operand:SWI12 0 "register_operand" "+<r>,r")
3255 : 2208005 : (match_operand:SWI12 1 "register_operand" "+<r>,r"))
3256 : 2208000 : (set (match_dup 1)
3257 : 2208000 : (match_dup 0))]
3258 : 2208000 : ""
3259 : 2207999 : "@
3260 : 2207999 : xchg{<imodesuffix>}\t%1, %0
3261 : 2278044 : xchg{l}\t%k1, %k0"
3262 : 2278044 : [(set_attr "type" "imov")
3263 : 2278044 : (set_attr "mode" "<MODE>,SI")
3264 : 2278044 : (set (attr "preferred_for_size")
3265 : 70117 : (cond [(eq_attr "alternative" "0")
3266 : 70117 : (symbol_ref "false")]
3267 : 2207999 : (symbol_ref "true")))
3268 : 2207999 : ;; Potential partial reg stall on alternative 1.
3269 : 2207999 : (set (attr "preferred_for_speed")
3270 : 12497 : (cond [(eq_attr "alternative" "1")
3271 : 2207999 : (symbol_ref "!TARGET_PARTIAL_REG_STALL")]
3272 : 2207999 : (symbol_ref "true")))
3273 : 2207999 : (set_attr "pent_pair" "np")
3274 : 2207999 : (set_attr "athlon_decode" "vector")
3275 : 2207999 : (set_attr "amdfam10_decode" "double")
3276 : 2207999 : (set_attr "bdver1_decode" "double")])
3277 : 2207999 :
3278 : 2207999 : (define_peephole2
3279 : 14198078 : [(set (match_operand:SWI 0 "general_reg_operand")
3280 : 14198078 : (match_operand:SWI 1 "general_reg_operand"))
3281 : 14198078 : (set (match_dup 1)
3282 : 14198078 : (match_operand:SWI 2 "general_reg_operand"))
3283 : 11990151 : (set (match_dup 2) (match_dup 0))]
3284 : 11994848 : "peep2_reg_dead_p (3, operands[0])
3285 : 2212264 : && optimize_insn_for_size_p ()"
3286 : 2241381 : [(parallel [(set (match_dup 1) (match_dup 2))
3287 : 2208440 : (set (match_dup 2) (match_dup 1))])])
3288 : 2208440 :
3289 : 2208440 : ;; Convert xchg with a REG_UNUSED note to a mov (variant #1).
3290 : 2232850 : (define_peephole2
3291 : 2232850 : [(parallel [(set (match_operand:SWI 0 "general_reg_operand")
3292 : 2207999 : (match_operand:SWI 1 "general_reg_operand"))
3293 : 4598354 : (set (match_dup 1) (match_dup 0))])]
3294 : 4622050 : "((REGNO (operands[0]) != AX_REG
3295 : 4602259 : && REGNO (operands[1]) != AX_REG)
3296 : 4601166 : || optimize_size < 2
3297 : 2390444 : || !optimize_insn_for_size_p ())
3298 : 2427111 : && peep2_reg_dead_p (1, operands[0])"
3299 : 2226917 : [(set (match_dup 1) (match_dup 0))])
3300 : 2207999 :
3301 : 2207999 : ;; Convert xchg with a REG_UNUSED note to a mov (variant #2).
3302 : 2207999 : (define_peephole2
3303 : 2207999 : [(parallel [(set (match_operand:SWI 0 "general_reg_operand")
3304 : 2207999 : (match_operand:SWI 1 "general_reg_operand"))
3305 : 2208462 : (set (match_dup 1) (match_dup 0))])]
3306 : 2218162 : "((REGNO (operands[0]) != AX_REG
3307 : 9084572 : && REGNO (operands[1]) != AX_REG)
3308 : 6900500 : || optimize_size < 2
3309 : 6897705 : || !optimize_insn_for_size_p ())
3310 : 2214481 : && peep2_reg_dead_p (1, operands[1])"
3311 : 2208466 : [(set (match_dup 0) (match_dup 1))])
3312 : 2213912 :
3313 : 6872624 : ;; Convert moves to/from AX_REG into xchg with -Oz.
3314 : 2207999 : (define_peephole2
3315 : 2214504 : [(set (match_operand:SWI48 0 "general_reg_operand")
3316 : 2214504 : (match_operand:SWI48 1 "general_reg_operand"))]
3317 : 6497576 : "optimize_size > 1
3318 : 2208097 : && ((REGNO (operands[0]) == AX_REG)
3319 : 2214602 : != (REGNO (operands[1]) == AX_REG))
3320 : 2208029 : && optimize_insn_for_size_p ()
3321 : 2208029 : && peep2_reg_dead_p (1, operands[1])"
3322 : 806477178 : [(parallel [(set (match_dup 0) (match_dup 1))
3323 : 803522324 : (set (match_dup 1) (match_dup 0))])])
3324 : 803522324 :
3325 : 2207999 : (define_expand "movstrict<mode>"
3326 : 5931080 : [(set (strict_low_part (match_operand:SWI12 0 "register_operand"))
3327 : 5931080 : (match_operand:SWI12 1 "general_operand"))]
3328 : 807245392 : ""
3329 : 2399645 : {
3330 : 5744239 : gcc_assert (SUBREG_P (operands[0]));
3331 : 2207999 : if ((TARGET_PARTIAL_REG_STALL && optimize_function_for_speed_p (cfun))
3332 : 806880225 : || !VALID_INT_MODE_P (GET_MODE (SUBREG_REG (operands[0]))))
3333 : 5561109 : FAIL;
3334 : 5563434 : })
3335 : 2208005 :
3336 : 803522311 : (define_insn "*movstrict<mode>_1"
3337 : 2208005 : [(set (strict_low_part
3338 : 2212809 : (match_operand:SWI12 0 "register_operand" "+<r>"))
3339 : 2212809 : (match_operand:SWI12 1 "general_operand" "<r>mn"))]
3340 : 803486908 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
3341 : 2216633 : "mov{<imodesuffix>}\t{%1, %0|%0, %1}"
3342 : 2213110 : [(set_attr "type" "imov")
3343 : 2208270 : (set_attr "mode" "<MODE>")])
3344 : 780618632 :
3345 : 2212809 : (define_insn "*movstrict<mode>_xor"
3346 : 2212809 : [(set (strict_low_part (match_operand:SWI12 0 "register_operand" "+<r>"))
3347 : 2212803 : (match_operand:SWI12 1 "const0_operand"))
3348 : 780618325 : (clobber (reg:CC FLAGS_REG))]
3349 : 2208879 : "reload_completed"
3350 : 2208300 : "xor{<imodesuffix>}\t%0, %0"
3351 : 2207999 : [(set_attr "type" "alu1")
3352 : 780612614 : (set_attr "mode" "<MODE>")
3353 : 2208103 : (set_attr "length_immediate" "0")])
3354 : 2208107 :
3355 : 2212475 : (define_insn "*movstrictqi_ext<mode>_1"
3356 : 780586195 : [(set (strict_low_part
3357 : 2238017 : (match_operand:QI 0 "register_operand" "+Q"))
3358 : 2236308 : (subreg:QI
3359 : 2268009 : (match_operator:SWI248 2 "extract_operator"
3360 : 2242363 : [(match_operand 1 "int248_register_operand" "Q")
3361 : 2266304 : (const_int 8)
3362 : 772720468 : (const_int 8)]) 0))]
3363 : 2233655 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
3364 : 2243466 : "mov{b}\t{%h1, %0|%0, %h1}"
3365 : 328848142 : [(set_attr "type" "imov")
3366 : 326640215 : (set_attr "mode" "QI")])
3367 : 326640258 :
3368 : 2208042 : (define_expand "extv<mode>"
3369 : 5752950 : [(set (match_operand:SWI24 0 "register_operand")
3370 : 2208003 : (sign_extract:SWI24 (match_operand:SWI24 1 "register_operand")
3371 : 327493321 : (match_operand:QI 2 "const_int_operand")
3372 : 2213212 : (match_operand:QI 3 "const_int_operand")))]
3373 : 3061459 : ""
3374 : 3965125 : {
3375 : 326631927 : /* Handle extractions from %ah et al. */
3376 : 2239278 : if (INTVAL (operands[2]) != 8 || INTVAL (operands[3]) != 8)
3377 : 3107188 : FAIL;
3378 : 2213219 :
3379 : 326499356 : unsigned int regno = reg_or_subregno (operands[1]);
3380 : 2240915 :
3381 : 2208017 : /* Be careful to expand only with registers having upper parts. */
3382 : 2235813 : if (regno <= LAST_VIRTUAL_REGISTER && !QI_REGNO_P (regno))
3383 : 316270625 : operands[1] = copy_to_reg (operands[1]);
3384 : 2208152 : })
3385 : 2208170 :
3386 : 2208170 : (define_insn "*extv<mode>"
3387 : 316120715 : [(set (match_operand:SWI24 0 "register_operand" "=R")
3388 : 2208811 : (sign_extract:SWI24 (match_operand 1 "int248_register_operand" "Q")
3389 : 2208244 : (const_int 8)
3390 : 2208019 : (const_int 8)))]
3391 : 316117869 : ""
3392 : 2208500 : "movs{bl|x}\t{%h1, %k0|%k0, %h1}"
3393 : 2208500 : [(set_attr "type" "imovx")
3394 : 2208500 : (set_attr "mode" "SI")])
3395 : 2208001 :
3396 : 2208246 : ;; Split sign-extension of single least significant bit as and x,$1;neg x
3397 : 316117551 : (define_insn_and_split "*extv<mode>_1_0"
3398 : 2208017 : [(set (match_operand:SWI48 0 "register_operand" "=r")
3399 : 2207999 : (sign_extract:SWI48 (match_operand:SWI48 1 "register_operand" "0")
3400 : 24297274 : (const_int 1)
3401 : 22089574 : (const_int 0)))
3402 : 22089574 : (clobber (reg:CC FLAGS_REG))]
3403 : 2208226 : ""
3404 : 2207999 : "#"
3405 : 2207999 : ""
3406 : 21818951 : [(parallel [(set (match_dup 0) (and:SWI48 (match_dup 1) (const_int 1)))
3407 : 2211099 : (clobber (reg:CC FLAGS_REG))])
3408 : 2231413 : (parallel [(set (match_dup 0) (neg:SWI48 (match_dup 0)))
3409 : 2211181 : (clobber (reg:CC FLAGS_REG))])])
3410 : 21812137 :
3411 : 2211099 : (define_expand "extzv<mode>"
3412 : 24566 : [(set (match_operand:SWI248 0 "register_operand")
3413 : 2228395 : (zero_extract:SWI248 (match_operand:SWI248 1 "register_operand")
3414 : 2228395 : (match_operand:QI 2 "const_int_operand")
3415 : 2207999 : (match_operand:QI 3 "const_int_operand")))]
3416 : 2208081 : ""
3417 : 2326164 : {
3418 : 2305768 : if (ix86_expand_pextr (operands))
3419 : 2304080 : DONE;
3420 : 2228313 :
3421 : 2208081 : /* Handle extractions from %ah et al. */
3422 : 2305768 : if (INTVAL (operands[2]) != 8 || INTVAL (operands[3]) != 8)
3423 : 2304080 : FAIL;
3424 : 2207999 :
3425 : 2209687 : unsigned int regno = reg_or_subregno (operands[1]);
3426 : 2207999 :
3427 : 2207999 : /* Be careful to expand only with registers having upper parts. */
3428 : 2209769 : if (regno <= LAST_VIRTUAL_REGISTER && !QI_REGNO_P (regno))
3429 : 2208008 : operands[1] = copy_to_reg (operands[1]);
3430 : 2207999 : })
3431 : 2207999 :
3432 : 2207999 : (define_insn "*extzv<mode>"
3433 : 2209687 : [(set (match_operand:SWI248 0 "register_operand" "=R")
3434 : 2208081 : (zero_extract:SWI248 (match_operand 1 "int248_register_operand" "Q")
3435 : 2208081 : (const_int 8)
3436 : 2209769 : (const_int 8)))]
3437 : 2209687 : ""
3438 : 2209687 : "movz{bl|x}\t{%h1, %k0|%k0, %h1}"
3439 : 2209687 : [(set_attr "type" "imovx")
3440 : 2209687 : (set_attr "mode" "SI")])
3441 : 2207999 :
3442 : 2209687 : (define_insn "*extzvqi"
3443 : 2207999 : [(set (match_operand:QI 0 "nonimmediate_operand" "=QBn,?R")
3444 : 2208385 : (subreg:QI
3445 : 2208385 : (match_operator:SWI248 2 "extract_operator"
3446 : 2208385 : [(match_operand 1 "int248_register_operand" "Q,Q")
3447 : 2210001 : (const_int 8)
3448 : 2207927 : (const_int 8)]) 0))]
3449 : 2210001 : ""
3450 : 2209473 : {
3451 : 2209417 : switch (get_attr_type (insn))
3452 : 2208313 : {
3453 : 2208313 : case TYPE_IMOVX:
3454 : 2298178 : return "movz{bl|x}\t{%h1, %k0|%k0, %h1}";
3455 : 2208847 : default:
3456 : 2208847 : return "mov{b}\t{%h1, %0|%0, %h1}";
3457 : 2207927 : }
3458 : 2207927 : }
3459 : 2297792 : [(set_attr "addr" "gpr8,*")
3460 : 2297792 : (set (attr "type")
3461 : 2208313 : (if_then_else (and (match_operand:QI 0 "register_operand")
3462 : 2300348 : (ior (not (match_operand:QI 0 "QIreg_operand"))
3463 : 2297792 : (match_test "TARGET_MOVX")))
3464 : 2297792 : (const_string "imovx")
3465 : 2297792 : (const_string "imov")))
3466 : 2260896 : (set (attr "mode")
3467 : 2208313 : (if_then_else (eq_attr "type" "imovx")
3468 : 2208313 : (const_string "SI")
3469 : 2208313 : (const_string "QI")))])
3470 : 2207927 :
3471 : 2207927 : (define_expand "insv<mode>"
3472 : 2207927 : [(set (zero_extract:SWI248 (match_operand:SWI248 0 "register_operand")
3473 : 2207927 : (match_operand:QI 1 "const_int_operand")
3474 : 2252727 : (match_operand:QI 2 "const_int_operand"))
3475 : 2207927 : (match_operand:SWI248 3 "register_operand"))]
3476 : 2207927 : ""
3477 : 2315654 : {
3478 : 2315654 : rtx dst;
3479 : 2252727 :
3480 : 2360454 : if (ix86_expand_pinsr (operands))
3481 : 2207944 : DONE;
3482 : 2252727 :
3483 : 2252727 : /* Handle insertions to %ah et al. */
3484 : 2315637 : if (INTVAL (operands[1]) != 8 || INTVAL (operands[2]) != 8)
3485 : 2313283 : FAIL;
3486 : 2252727 :
3487 : 2210281 : unsigned int regno = reg_or_subregno (operands[0]);
3488 : 2207927 :
3489 : 2207927 : /* Be careful to expand only with registers having upper parts. */
3490 : 2210281 : if (regno <= LAST_VIRTUAL_REGISTER && !QI_REGNO_P (regno))
3491 : 2208880 : dst = copy_to_reg (operands[0]);
3492 : 2207927 : else
3493 : 2209328 : dst = operands[0];
3494 : 2207927 :
3495 : 2210281 : emit_insn (gen_insv_1 (<MODE>mode, dst, operands[3]));
3496 : 2207927 :
3497 : 2207927 : /* Fix up the destination if needed. */
3498 : 2210281 : if (dst != operands[0])
3499 : 2208880 : emit_move_insn (operands[0], dst);
3500 : 2207927 :
3501 : 2210281 : DONE;
3502 : 2207927 : })
3503 : 2207927 :
3504 : 2207927 : (define_insn "@insv<mode>_1"
3505 : 2207927 : [(set (zero_extract:SWI248
3506 : 2207927 : (match_operand 0 "int248_register_operand" "+Q")
3507 : 2207927 : (const_int 8)
3508 : 2207927 : (const_int 8))
3509 : 2207927 : (match_operand:SWI248 1 "general_operand" "QnBn"))]
3510 : 2207927 : ""
3511 : 2210068 : {
3512 : 2209949 : if (CONST_INT_P (operands[1]))
3513 : 2207988 : operands[1] = gen_int_mode (INTVAL (operands[1]), QImode);
3514 : 2210068 : return "mov{b}\t{%b1, %h0|%h0, %b1}";
3515 : 2207927 : }
3516 : 2207927 : [(set_attr "addr" "gpr8")
3517 : 2207927 : (set_attr "type" "imov")
3518 : 2207927 : (set_attr "mode" "QI")])
3519 : 2208046 :
3520 : 2207927 : (define_insn "*insvqi_1"
3521 : 2207927 : [(set (zero_extract:SWI248
3522 : 2207927 : (match_operand 0 "int248_register_operand" "+Q")
3523 : 2207927 : (const_int 8)
3524 : 2207927 : (const_int 8))
3525 : 2207927 : (subreg:SWI248
3526 : 2278758 : (match_operand:QI 1 "general_operand" "QnBn") 0))]
3527 : 2207927 : ""
3528 : 2207927 : "mov{b}\t{%1, %h0|%h0, %1}"
3529 : 2207927 : [(set_attr "addr" "gpr8")
3530 : 2207927 : (set_attr "type" "imov")
3531 : 2207927 : (set_attr "mode" "QI")])
3532 : 2278758 :
3533 : 2207927 : ;; Eliminate redundant insv, e.g. xorl %eax,%eax; movb $0, %ah
3534 : 2278758 : (define_peephole2
3535 : 2278758 : [(parallel [(set (match_operand:SWI48 0 "general_reg_operand")
3536 : 2207927 : (const_int 0))
3537 : 2278758 : (clobber (reg:CC FLAGS_REG))])
3538 : 2278758 : (set (zero_extract:SWI248 (match_operand 1 "int248_register_operand")
3539 : 2207927 : (const_int 8)
3540 : 2207927 : (const_int 8))
3541 : 2207927 : (const_int 0))]
3542 : 2207927 : "REGNO (operands[0]) == REGNO (operands[1])"
3543 : 2207927 : [(parallel [(set (match_operand:SWI48 0 "general_reg_operand")
3544 : 2207927 : (const_int 0))
3545 : 2207927 : (clobber (reg:CC FLAGS_REG))])])
3546 : 2207927 :
3547 : 2207927 : ;; Combine movl followed by movb.
3548 : 2207927 : (define_peephole2
3549 : 2207928 : [(set (match_operand:SWI48 0 "general_reg_operand")
3550 : 2207927 : (match_operand:SWI48 1 "const_int_operand"))
3551 : 2207928 : (set (zero_extract:SWI248 (match_operand 2 "int248_register_operand")
3552 : 2207928 : (const_int 8)
3553 : 2207928 : (const_int 8))
3554 : 2207927 : (match_operand:SWI248 3 "const_int_operand"))]
3555 : 2207928 : "REGNO (operands[0]) == REGNO (operands[2])"
3556 : 2207928 : [(set (match_operand:SWI48 0 "general_reg_operand")
3557 : 2207932 : (match_dup 4))]
3558 : 2207932 : {
3559 : 2207935 : HOST_WIDE_INT tmp = INTVAL (operands[1]) & ~HOST_WIDE_INT_C (0xff00);
3560 : 2207931 : tmp |= (INTVAL (operands[3]) & 0xff) << 8;
3561 : 2207931 : operands[4] = gen_int_mode (tmp, <SWI48:MODE>mode);
3562 : 2207927 : })
3563 : 2207928 :
3564 : 2207932 : (define_insn "*insvqi_2"
3565 : 2207936 : [(set (zero_extract:SWI248
3566 : 2207931 : (match_operand 0 "int248_register_operand" "+Q")
3567 : 2207931 : (const_int 8)
3568 : 2207931 : (const_int 8))
3569 : 2207931 : (match_operator:SWI248 2 "extract_operator"
3570 : 2207931 : [(match_operand 1 "int248_register_operand" "Q")
3571 : 2207931 : (const_int 8)
3572 : 2207931 : (const_int 8)]))]
3573 : 2207931 : ""
3574 : 2207931 : "mov{b}\t{%h1, %h0|%h0, %h1}"
3575 : 2207931 : [(set_attr "type" "imov")
3576 : 2207927 : (set_attr "mode" "QI")])
3577 : 2207931 :
3578 : 2207931 : (define_insn "*insvqi_3"
3579 : 2207931 : [(set (zero_extract:SWI248
3580 : 2207927 : (match_operand 0 "int248_register_operand" "+Q")
3581 : 2207927 : (const_int 8)
3582 : 2207927 : (const_int 8))
3583 : 2207927 : (any_shiftrt:SWI248
3584 : 2207927 : (match_operand:SWI248 1 "register_operand" "Q")
3585 : 2207931 : (const_int 8)))]
3586 : 2207927 : ""
3587 : 2207931 : "mov{b}\t{%h1, %h0|%h0, %h1}"
3588 : 2207927 : [(set_attr "type" "imov")
3589 : 2207927 : (set_attr "mode" "QI")])
3590 : 2207927 :
3591 : 2207931 : (define_code_iterator any_or_plus [plus ior xor])
3592 : 2207931 :
3593 : 2207931 : (define_insn_and_split "*insvti_highpart_1"
3594 : 2207927 : [(set (match_operand:TI 0 "nonimmediate_operand" "=ro,r,r,&r")
3595 : 2207931 : (any_or_plus:TI
3596 : 2207927 : (and:TI
3597 : 2207927 : (match_operand:TI 1 "nonimmediate_operand" "r,m,r,m")
3598 : 2207927 : (match_operand:TI 3 "const_scalar_int_operand" "n,n,n,n"))
3599 : 2207927 : (ashift:TI
3600 : 2207927 : (zero_extend:TI
3601 : 2207927 : (match_operand:DI 2 "nonimmediate_operand" "r,r,m,m"))
3602 : 2207927 : (const_int 64))))]
3603 : 2304605 : "TARGET_64BIT
3604 : 2547087 : && CONST_WIDE_INT_P (operands[3])
3605 : 2547076 : && CONST_WIDE_INT_NUNITS (operands[3]) == 2
3606 : 2547076 : && CONST_WIDE_INT_ELT (operands[3], 0) == -1
3607 : 2304605 : && CONST_WIDE_INT_ELT (operands[3], 1) == 0"
3608 : 2207927 : "#"
3609 : 2304605 : "&& reload_completed"
3610 : 2207927 : [(const_int 0)]
3611 : 2304991 : {
3612 : 2447823 : operands[4] = gen_lowpart (DImode, operands[1]);
3613 : 2261637 : split_double_concat (TImode, operands[0], operands[4], operands[2]);
3614 : 2266815 : DONE;
3615 : 2207927 : })
3616 : 2207927 :
3617 : 2207927 : (define_insn_and_split "*insvti_lowpart_1"
3618 : 2207927 : [(set (match_operand:TI 0 "nonimmediate_operand" "=ro,r,r,&r")
3619 : 2207927 : (any_or_plus:TI
3620 : 2207927 : (and:TI
3621 : 2207927 : (match_operand:TI 1 "nonimmediate_operand" "r,m,r,m")
3622 : 2207927 : (match_operand:TI 3 "const_scalar_int_operand" "n,n,n,n"))
3623 : 2207927 : (zero_extend:TI
3624 : 2207927 : (match_operand:DI 2 "nonimmediate_operand" "r,r,m,m"))))]
3625 : 2308793 : "TARGET_64BIT
3626 : 2308793 : && CONST_WIDE_INT_P (operands[3])
3627 : 2357313 : && CONST_WIDE_INT_NUNITS (operands[3]) == 2
3628 : 2308781 : && CONST_WIDE_INT_ELT (operands[3], 0) == 0
3629 : 2308781 : && CONST_WIDE_INT_ELT (operands[3], 1) == -1"
3630 : 2256459 : "#"
3631 : 2213105 : "&& reload_completed"
3632 : 2256459 : [(const_int 0)]
3633 : 2213815 : {
3634 : 2213035 : operands[4] = gen_highpart (DImode, operands[1]);
3635 : 2212271 : split_double_concat (TImode, operands[0], operands[2], operands[4]);
3636 : 2212275 : DONE;
3637 : 2207927 : })
3638 : 2207927 :
3639 : 2207927 : (define_insn_and_split "*insvdi_lowpart_1"
3640 : 2207927 : [(set (match_operand:DI 0 "nonimmediate_operand" "=ro,r,r,&r")
3641 : 2207927 : (any_or_plus:DI
3642 : 2207927 : (and:DI
3643 : 2207927 : (match_operand:DI 1 "nonimmediate_operand" "r,m,r,m")
3644 : 2207927 : (match_operand:DI 3 "const_int_operand" "n,n,n,n"))
3645 : 2207927 : (zero_extend:DI
3646 : 2207927 : (match_operand:SI 2 "nonimmediate_operand" "r,r,m,m"))))]
3647 : 2211220 : "!TARGET_64BIT
3648 : 2208239 : && CONST_INT_P (operands[3])
3649 : 2211183 : && UINTVAL (operands[3]) == 0xffffffff00000000ll"
3650 : 2207927 : "#"
3651 : 2207931 : "&& reload_completed"
3652 : 2210871 : [(const_int 0)]
3653 : 2207929 : {
3654 : 2210873 : operands[4] = gen_highpart (SImode, operands[1]);
3655 : 2207937 : split_double_concat (DImode, operands[0], operands[2], operands[4]);
3656 : 2207945 : DONE;
3657 : 18299343 : })
3658 : 18299343 :
3659 : 2208546 : ;; Floating point push instructions.
3660 : 2207975 :
3661 : 18935948 : (define_insn "*pushtf"
3662 : 2208594 : [(set (match_operand:TF 0 "push_operand" "=<,<")
3663 : 2208498 : (match_operand:TF 1 "general_no_elim_operand" "v,*roC"))]
3664 : 17884690 : "TARGET_64BIT || TARGET_SSE"
3665 : 2382113 : {
3666 : 14903812 : /* This insn should be already split before reg-stack. */
3667 : 11417281 : return "#";
3668 : 15204920 : }
3669 : 2235257 : [(set_attr "isa" "*,x64")
3670 : 2207975 : (set_attr "type" "multi")
3671 : 2235257 : (set_attr "unit" "sse,*")
3672 : 2207971 : (set_attr "mode" "TF,DI")])
3673 : 2207933 :
3674 : 2235215 : ;; %%% Kill this when call knows how to work this out.
3675 : 2207933 : (define_split
3676 : 2235207 : [(set (match_operand:TF 0 "push_operand")
3677 : 2207927 : (match_operand:TF 1 "sse_reg_operand"))]
3678 : 2263357 : "TARGET_SSE && reload_completed"
3679 : 2207927 : [(set (reg:P SP_REG) (plus:P (reg:P SP_REG) (const_int -16)))
3680 : 2207927 : (set (match_dup 0) (match_dup 1))]
3681 : 2235497 : {
3682 : 2207927 : /* Preserve memory attributes. */
3683 : 2235497 : operands[0] = replace_equiv_address (operands[0], stack_pointer_rtx);
3684 : 2207927 : })
3685 : 2207927 :
3686 : 2207927 : (define_insn "*pushxf"
3687 : 2235497 : [(set (match_operand:XF 0 "push_operand" "=<,<,<,<,<")
3688 : 2235497 : (match_operand:XF 1 "general_no_elim_operand" "f,r,*r,oF,oC"))]
3689 : 2235497 : ""
3690 : 2235497 : {
3691 : 2235497 : /* This insn should be already split before reg-stack. */
3692 : 2207927 : return "#";
3693 : 2207927 : }
3694 : 2207927 : [(set_attr "isa" "*,*,*,nox64,x64")
3695 : 2207927 : (set_attr "type" "multi")
3696 : 2207927 : (set_attr "unit" "i387,*,*,*,*")
3697 : 2235497 : (set (attr "mode")
3698 : 2207927 : (cond [(eq_attr "alternative" "1,2,3,4")
3699 : 2235497 : (if_then_else (match_test "TARGET_64BIT")
3700 : 2235497 : (const_string "DI")
3701 : 2235497 : (const_string "SI"))
3702 : 2207927 : ]
3703 : 2207927 : (const_string "XF")))
3704 : 2207927 : (set (attr "preferred_for_size")
3705 : 2207927 : (cond [(eq_attr "alternative" "1")
3706 : 2207927 : (symbol_ref "false")]
3707 : 2208887 : (symbol_ref "true")))])
3708 : 2207927 :
3709 : 2208887 : ;; %%% Kill this when call knows how to work this out.
3710 : 2208887 : (define_split
3711 : 2208887 : [(set (match_operand:XF 0 "push_operand")
3712 : 2208217 : (match_operand:XF 1 "fp_register_operand"))]
3713 : 2279900 : "reload_completed"
3714 : 2208217 : [(set (reg:P SP_REG) (plus:P (reg:P SP_REG) (match_dup 2)))
3715 : 2208597 : (set (match_dup 0) (match_dup 1))]
3716 : 2231918 : {
3717 : 2231918 : operands[2] = GEN_INT (-PUSH_ROUNDING (GET_MODE_SIZE (XFmode)));
3718 : 2207927 : /* Preserve memory attributes. */
3719 : 2231918 : operands[0] = replace_equiv_address (operands[0], stack_pointer_rtx);
3720 : 2207927 : })
3721 : 2207927 :
3722 : 2207927 : (define_insn "*pushdf"
3723 : 2231918 : [(set (match_operand:DF 0 "push_operand" "=<,<,<,<,<,<")
3724 : 2231918 : (match_operand:DF 1 "general_no_elim_operand" "f,r,*r,oF,rmC,v"))]
3725 : 2231918 : ""
3726 : 2231918 : {
3727 : 2231918 : /* This insn should be already split before reg-stack. */
3728 : 2231918 : return "#";
3729 : 2231918 : }
3730 : 2207927 : [(set_attr "isa" "*,nox64,nox64,nox64,x64,sse2")
3731 : 2207927 : (set_attr "type" "multi")
3732 : 2207927 : (set_attr "unit" "i387,*,*,*,*,sse")
3733 : 2208127 : (set_attr "mode" "DF,SI,SI,SI,DI,DF")
3734 : 2207927 : (set (attr "preferred_for_size")
3735 : 2231918 : (cond [(eq_attr "alternative" "1")
3736 : 2207927 : (symbol_ref "false")]
3737 : 2231918 : (symbol_ref "true")))
3738 : 2231918 : (set (attr "preferred_for_speed")
3739 : 2231918 : (cond [(eq_attr "alternative" "1")
3740 : 2207927 : (symbol_ref "TARGET_INTEGER_DFMODE_MOVES")]
3741 : 2207927 : (symbol_ref "true")))])
3742 : 2207927 :
3743 : 2207927 : ;; %%% Kill this when call knows how to work this out.
3744 : 2207927 : (define_split
3745 : 2232484 : [(set (match_operand:DF 0 "push_operand")
3746 : 2207927 : (match_operand:DF 1 "any_fp_register_operand"))]
3747 : 2341552 : "reload_completed"
3748 : 2232484 : [(set (reg:P SP_REG) (plus:P (reg:P SP_REG) (const_int -8)))
3749 : 2232484 : (set (match_dup 0) (match_dup 1))]
3750 : 2209163 : {
3751 : 2231248 : /* Preserve memory attributes. */
3752 : 2244695 : operands[0] = replace_equiv_address (operands[0], stack_pointer_rtx);
3753 : 2231248 : })
3754 : 2207927 :
3755 : 2207927 : (define_mode_iterator HFBF [HF BF])
3756 : 2244695 :
3757 : 2244695 : (define_insn "*push<mode>_rex64"
3758 : 2244695 : [(set (match_operand:HFBF 0 "push_operand" "=X,X")
3759 : 2244695 : (match_operand:HFBF 1 "nonmemory_no_elim_operand" "r,x"))]
3760 : 2245764 : "TARGET_64BIT"
3761 : 2208367 : {
3762 : 2208762 : /* Anything else should be already split before reg-stack. */
3763 : 2208962 : gcc_assert (which_alternative == 0);
3764 : 2208367 : return "push{q}\t%q1";
3765 : 2207927 : }
3766 : 2244695 : [(set_attr "isa" "*,sse4")
3767 : 2207927 : (set_attr "type" "push,multi")
3768 : 2244695 : (set_attr "mode" "DI,TI")])
3769 : 2245104 :
3770 : 2244695 : (define_insn "*push<mode>"
3771 : 2207927 : [(set (match_operand:HFBF 0 "push_operand" "=X,X")
3772 : 2207927 : (match_operand:HFBF 1 "general_no_elim_operand" "rmF,x"))]
3773 : 2208762 : "!TARGET_64BIT"
3774 : 2208096 : {
3775 : 2207927 : /* Anything else should be already split before reg-stack. */
3776 : 25674874 : gcc_assert (which_alternative == 0);
3777 : 18347910 : return "push{l}\t%k1";
3778 : 25674705 : }
3779 : 2243731 : [(set_attr "isa" "*,sse4")
3780 : 2243731 : (set_attr "type" "push,multi")
3781 : 2243459 : (set_attr "mode" "SI,TI")])
3782 : 2208650 :
3783 : 2243459 : (define_insn "push2_di"
3784 : 2208199 : [(set (match_operand:TI 0 "push_operand" "=<")
3785 : 2207927 : (unspec:TI [(match_operand:DI 1 "register_operand" "r")
3786 : 2207927 : (match_operand:DI 2 "register_operand" "r")]
3787 : 2207927 : UNSPEC_APXPUSH2))]
3788 : 2207931 : "TARGET_APX_PUSH2POP2"
3789 : 2207927 : "push2\t{%2, %1|%1, %2}"
3790 : 2207927 : [(set_attr "mode" "TI")
3791 : 2207927 : (set_attr "type" "multi")
3792 : 2209156 : (set_attr "prefix" "evex")])
3793 : 2209156 :
3794 : 2209156 : (define_insn "pop2_di"
3795 : 2207927 : [(parallel [(set (match_operand:DI 0 "register_operand" "=r")
3796 : 2208994 : (unspec:DI [(match_operand:TI 1 "pop_operand" ">")]
3797 : 2208994 : UNSPEC_APXPOP2_LOW))
3798 : 2207927 : (set (match_operand:DI 2 "register_operand" "=r")
3799 : 2207927 : (unspec:DI [(const_int 0)] UNSPEC_APXPOP2_HIGH))])]
3800 : 2207931 : "TARGET_APX_PUSH2POP2"
3801 : 2207927 : "pop2\t{%2, %0|%0, %2}"
3802 : 2207927 : [(set_attr "mode" "TI")
3803 : 2207927 : (set_attr "prefix" "evex")])
3804 : 2247197 :
3805 : 2247197 : (define_insn "pushp_di"
3806 : 2207927 : [(set (match_operand:DI 0 "push_operand" "=<")
3807 : 2247197 : (match_operand:DI 1 "register_operand" "r"))
3808 : 2247197 : (unspec:DI [(const_int 0)] UNSPEC_APX_PPX)]
3809 : 2207938 : "TARGET_64BIT"
3810 : 2247197 : "pushp\t%1"
3811 : 2207934 : [(set_attr "mode" "DI")])
3812 : 2247204 :
3813 : 2207934 : (define_insn "popp_di"
3814 : 2247197 : [(set (match_operand:DI 0 "register_operand" "=r")
3815 : 2247197 : (match_operand:DI 1 "pop_operand" ">"))
3816 : 2207927 : (unspec:DI [(const_int 0)] UNSPEC_APX_PPX)]
3817 : 2207934 : "TARGET_APX_PPX"
3818 : 2247197 : "popp\t%0"
3819 : 2247197 : [(set_attr "mode" "DI")])
3820 : 2207927 :
3821 : 2207927 : (define_insn "push2p_di"
3822 : 2207927 : [(set (match_operand:TI 0 "push_operand" "=<")
3823 : 2207927 : (unspec:TI [(match_operand:DI 1 "register_operand" "r")
3824 : 2207927 : (match_operand:DI 2 "register_operand" "r")]
3825 : 2207927 : UNSPEC_APXPUSH2))
3826 : 2207927 : (unspec:DI [(const_int 0)] UNSPEC_APX_PPX)]
3827 : 2240582 : "TARGET_APX_PUSH2POP2 && TARGET_APX_PPX"
3828 : 2207927 : "push2p\t{%2, %1|%1, %2}"
3829 : 2207927 : [(set_attr "mode" "TI")
3830 : 2207927 : (set_attr "type" "multi")
3831 : 2247321 : (set_attr "prefix" "evex")])
3832 : 2247321 :
3833 : 2214666 : (define_insn "pop2p_di"
3834 : 2240582 : [(parallel [(set (match_operand:DI 0 "register_operand" "=r")
3835 : 2240582 : (unspec:DI [(match_operand:TI 1 "pop_operand" ">")]
3836 : 2214666 : UNSPEC_APXPOP2_LOW))
3837 : 2214666 : (set (match_operand:DI 2 "register_operand" "=r")
3838 : 2240416 : (unspec:DI [(const_int 0)] UNSPEC_APXPOP2_HIGH))
3839 : 2214666 : (unspec:DI [(const_int 0)] UNSPEC_APX_PPX)])]
3840 : 2214666 : "TARGET_APX_PUSH2POP2 && TARGET_APX_PPX"
3841 : 2240416 : "pop2p\t{%2, %0|%0, %2}"
3842 : 2246392 : [(set_attr "mode" "TI")
3843 : 2246392 : (set_attr "prefix" "evex")])
3844 : 2246421 :
3845 : 2240445 : (define_insn "*pushsf_rex64"
3846 : 2213903 : [(set (match_operand:SF 0 "push_operand" "=X,X,X")
3847 : 2210605 : (match_operand:SF 1 "nonmemory_no_elim_operand" "f,rF,v"))]
3848 : 2214971 : "TARGET_64BIT"
3849 : 2215422 : {
3850 : 2210611 : /* Anything else should be already split before reg-stack. */
3851 : 2211062 : if (which_alternative != 1)
3852 : 2209783 : return "#";
3853 : 2209783 : return "push{q}\t%q1";
3854 : 2207927 : }
3855 : 2209668 : [(set_attr "type" "multi,push,multi")
3856 : 2209668 : (set_attr "unit" "i387,*,*")
3857 : 2209392 : (set_attr "mode" "SF,DI,SF")])
3858 : 2209774 :
3859 : 2207927 : (define_insn "*pushsf"
3860 : 2209392 : [(set (match_operand:SF 0 "push_operand" "=<,<,<")
3861 : 2209392 : (match_operand:SF 1 "general_no_elim_operand" "f,rmF,v"))]
3862 : 2210414 : "!TARGET_64BIT"
3863 : 2209774 : {
3864 : 2209392 : /* Anything else should be already split before reg-stack. */
3865 : 21524703 : if (which_alternative != 1)
3866 : 17850320 : return "#";
3867 : 21524321 : return "push{l}\t%1";
3868 : 2208095 : }
3869 : 2208095 : [(set_attr "type" "multi,push,multi")
3870 : 2208391 : (set_attr "unit" "i387,*,*")
3871 : 2207927 : (set_attr "mode" "SF,SI,SF")])
3872 : 2406927 :
3873 : 2207927 : (define_mode_iterator MODESH [SF HF BF])
3874 : 2207927 : ;; %%% Kill this when call knows how to work this out.
3875 : 2207927 : (define_split
3876 : 2207927 : [(set (match_operand:MODESH 0 "push_operand")
3877 : 2207927 : (match_operand:MODESH 1 "any_fp_register_operand"))]
3878 : 2218615 : "reload_completed"
3879 : 2207927 : [(set (reg:P SP_REG) (plus:P (reg:P SP_REG) (match_dup 2)))
3880 : 2207927 : (set (match_dup 0) (match_dup 1))]
3881 : 2211595 : {
3882 : 2211595 : rtx op = XEXP (operands[0], 0);
3883 : 2211595 : if (GET_CODE (op) == PRE_DEC)
3884 : 2207927 : {
3885 : 2208199 : gcc_assert (!TARGET_64BIT);
3886 : 2208199 : op = GEN_INT (-4);
3887 : 2207927 : }
3888 : 2207927 : else
3889 : 2207927 : {
3890 : 2211323 : op = XEXP (XEXP (op, 1), 1);
3891 : 2211323 : gcc_assert (CONST_INT_P (op));
3892 : 2207927 : }
3893 : 2211595 : operands[2] = op;
3894 : 2207927 : /* Preserve memory attributes. */
3895 : 2211595 : operands[0] = replace_equiv_address (operands[0], stack_pointer_rtx);
3896 : 2207927 : })
3897 : 2207927 :
3898 : 2207927 : (define_split
3899 : 2211595 : [(set (match_operand:SF 0 "push_operand")
3900 : 2211595 : (match_operand:SF 1 "memory_operand"))]
3901 : 2212544 : "reload_completed
3902 : 2212254 : && find_constant_src (insn)"
3903 : 2211650 : [(set (match_dup 0) (match_dup 2))]
3904 : 2207982 : "operands[2] = find_constant_src (curr_insn);")
3905 : 2211595 :
3906 : 2207927 : (define_split
3907 : 2256264 : [(set (match_operand 0 "push_operand")
3908 : 2256264 : (match_operand 1 "general_gr_operand"))]
3909 : 8300348 : "reload_completed
3910 : 7639846 : && (GET_MODE (operands[0]) == TFmode
3911 : 2211639 : || GET_MODE (operands[0]) == XFmode
3912 : 7639846 : || GET_MODE (operands[0]) == DFmode)"
3913 : 2237746 : [(const_int 0)]
3914 : 126980228 : "ix86_split_long_move (operands); DONE;")
3915 : 2207982 :
3916 : 2815407 : ;; Floating point move instructions.
3917 : 2815407 :
3918 : 2360545 : (define_expand "movtf"
3919 : 2815352 : [(set (match_operand:TF 0 "nonimmediate_operand")
3920 : 2207927 : (match_operand:TF 1 "nonimmediate_operand"))]
3921 : 2211378 : "TARGET_64BIT || TARGET_SSE"
3922 : 2552642 : "ix86_expand_move (TFmode, operands); DONE;")
3923 : 2237474 :
3924 : 2211378 : (define_expand "mov<mode>"
3925 : 2582189 : [(set (match_operand:X87MODEFH 0 "nonimmediate_operand")
3926 : 2234023 : (match_operand:X87MODEFH 1 "general_operand"))]
3927 : 2211378 : ""
3928 : 6166637 : "ix86_expand_move (<MODE>mode, operands); DONE;")
3929 : 2556093 :
3930 : 2552642 : (define_insn "*movtf_internal"
3931 : 2552642 : [(set (match_operand:TF 0 "nonimmediate_operand" "=v,v ,m,?*r ,!o")
3932 : 2552642 : (match_operand:TF 1 "general_operand" "C ,vm,v,*roF,*rC"))]
3933 : 11728398 : "(TARGET_64BIT || TARGET_SSE)
3934 : 11383683 : && !(MEM_P (operands[0]) && MEM_P (operands[1]))
3935 : 11376754 : && (lra_in_progress || reload_completed
3936 : 10556573 : || !CONST_DOUBLE_P (operands[1])
3937 : 2405711 : || (standard_sse_constant_p (operands[1], TFmode) == 1
3938 : 2219921 : && !memory_operand (operands[0], TFmode))
3939 : 2506424 : || (!TARGET_MEMORY_MISMATCH_STALL
3940 : 2207927 : && memory_operand (operands[0], TFmode)))"
3941 : 11384684 : {
3942 : 2514354 : switch (get_attr_type (insn))
3943 : 2315354 : {
3944 : 14061289 : case TYPE_SSELOG1:
3945 : 17886476 : return standard_sse_constant_opcode (insn, operands);
3946 : 14056374 :
3947 : 2508782 : case TYPE_SSEMOV:
3948 : 17912582 : return ix86_output_ssemov (insn, operands);
3949 : 14113542 :
3950 : 13893310 : case TYPE_MULTI:
3951 : 2208584 : return "#";
3952 : 6033114 :
3953 : 6033114 : default:
3954 : 2207927 : gcc_unreachable ();
3955 : 2207927 : }
3956 : 2207927 : }
3957 : 2207927 : [(set_attr "isa" "*,*,*,x64,x64")
3958 : 2207927 : (set_attr "type" "sselog1,ssemov,ssemov,multi,multi")
3959 : 2207927 : (set (attr "prefix")
3960 : 2851036 : (if_then_else (eq_attr "type" "sselog1,ssemov")
3961 : 2207927 : (const_string "maybe_vex")
3962 : 2207927 : (const_string "orig")))
3963 : 2771040 : (set (attr "mode")
3964 : 2771040 : (cond [(eq_attr "alternative" "3,4")
3965 : 2771040 : (const_string "DI")
3966 : 2771040 : (match_test "TARGET_AVX")
3967 : 2771040 : (const_string "TI")
3968 : 2771040 : (ior (not (match_test "TARGET_SSE2"))
3969 : 2771040 : (match_test "optimize_function_for_size_p (cfun)"))
3970 : 2771040 : (const_string "V4SF")
3971 : 2771040 : (match_test "TARGET_SSE_PACKED_SINGLE_INSN_OPTIMAL")
3972 : 2771040 : (const_string "V4SF")
3973 : 2771040 : (and (eq_attr "alternative" "2")
3974 : 2771040 : (match_test "TARGET_SSE_TYPELESS_STORES"))
3975 : 2771040 : (const_string "V4SF")
3976 : 2771040 : ]
3977 : 2771040 : (const_string "TI")))])
3978 : 2771040 :
3979 : 2771040 : (define_split
3980 : 2771040 : [(set (match_operand:TF 0 "nonimmediate_gr_operand")
3981 : 2771040 : (match_operand:TF 1 "general_gr_operand"))]
3982 : 2771703 : "reload_completed"
3983 : 2771697 : [(const_int 0)]
3984 : 2771697 : "ix86_split_long_move (operands); DONE;")
3985 : 2771040 :
3986 : 3693413 : ;; Possible store forwarding (partial memory) stall
3987 : 3693413 : ;; in alternatives 4, 6, 7 and 8.
3988 : 2956142 : (define_insn "*movxf_internal"
3989 : 3693413 : [(set (match_operand:XF 0 "nonimmediate_operand"
3990 : 2771040 : "=f,m,f,?r ,!o,?*r ,!o,!o,!o,r ,o ,o")
3991 : 2771040 : (match_operand:XF 1 "general_operand"
3992 : 2771040 : "fm,f,G,roF,r ,*roF,*r,F ,C ,roF,rF,rC"))]
3993 : 10848342 : "!(MEM_P (operands[0]) && MEM_P (operands[1]))
3994 : 10829870 : && (lra_in_progress || reload_completed
3995 : 9971833 : || !CONST_DOUBLE_P (operands[1])
3996 : 3145255 : || ((optimize_function_for_size_p (cfun)
3997 : 3108395 : || (ix86_cmodel == CM_LARGE || ix86_cmodel == CM_LARGE_PIC))
3998 : 2807900 : && standard_80387_constant_p (operands[1]) > 0
3999 : 2794679 : && !memory_operand (operands[0], XFmode))
4000 : 3122389 : || (!TARGET_MEMORY_MISMATCH_STALL
4001 : 2771913 : && memory_operand (operands[0], XFmode))
4002 : 3122389 : || !TARGET_HARD_XF_REGS)"
4003 : 11121633 : {
4004 : 3414149 : switch (get_attr_type (insn))
4005 : 2771040 : {
4006 : 20682761 : case TYPE_FMOV:
4007 : 20682761 : if (which_alternative == 2)
4008 : 20084021 : return standard_80387_constant_opcode (operands[1]);
4009 : 1817649375 : return output_387_reg_move (insn, operands);
4010 : 19968774 :
4011 : 1827820751 : case TYPE_MULTI:
4012 : 19968774 : return "#";
4013 : 2771182 :
4014 : 2771182 : default:
4015 : 2771182 : gcc_unreachable ();
4016 : 563113 : }
4017 : 2208069 : }
4018 : 2208069 : [(set (attr "isa")
4019 : 142 : (cond [(eq_attr "alternative" "7,10")
4020 : 142 : (const_string "nox64")
4021 : 3292067 : (eq_attr "alternative" "8,11")
4022 : 2207927 : (const_string "x64")
4023 : 2207927 : ]
4024 : 2207927 : (const_string "*")))
4025 : 2207927 : (set (attr "type")
4026 : 2207927 : (cond [(eq_attr "alternative" "3,4,5,6,7,8,9,10,11")
4027 : 2207927 : (const_string "multi")
4028 : 2207927 : ]
4029 : 2218527 : (const_string "fmov")))
4030 : 2218527 : (set (attr "mode")
4031 : 2218527 : (cond [(eq_attr "alternative" "3,4,5,6,7,8,9,10,11")
4032 : 2218527 : (if_then_else (match_test "TARGET_64BIT")
4033 : 2218527 : (const_string "DI")
4034 : 2218527 : (const_string "SI"))
4035 : 2218527 : ]
4036 : 2218527 : (const_string "XF")))
4037 : 10600 : (set (attr "preferred_for_size")
4038 : 10600 : (cond [(eq_attr "alternative" "3,4")
4039 : 2207927 : (symbol_ref "false")]
4040 : 2207927 : (symbol_ref "true")))
4041 : 2207927 : (set (attr "enabled")
4042 : 5304 : (cond [(eq_attr "alternative" "9,10,11")
4043 : 2207927 : (if_then_else
4044 : 8968644 : (match_test "TARGET_HARD_XF_REGS")
4045 : 2207927 : (symbol_ref "false")
4046 : 2207927 : (const_string "*"))
4047 : 2207927 : (not (match_test "TARGET_HARD_XF_REGS"))
4048 : 2207927 : (symbol_ref "false")
4049 : 2207927 : ]
4050 : 2207927 : (const_string "*")))])
4051 : 2207927 :
4052 : 2207927 : (define_split
4053 : 0 : [(set (match_operand:XF 0 "nonimmediate_gr_operand")
4054 : 0 : (match_operand:XF 1 "general_gr_operand"))]
4055 : 2208971 : "reload_completed"
4056 : 2208800 : [(const_int 0)]
4057 : 2208800 : "ix86_split_long_move (operands); DONE;")
4058 : 2207927 :
4059 : 4900953 : ;; Possible store forwarding (partial memory) stall in alternatives 4, 6 and 7.
4060 : 4900953 : (define_insn "*movdf_internal"
4061 : 2955812 : [(set (match_operand:DF 0 "nonimmediate_operand"
4062 : 4900953 : "=Yf*f,m ,Yf*f,?r ,!o,?*r ,!o,!o,?r,?m,?r,?r,Yv,v,v,m,*x,*x,*x,m ,?r,?v,r ,o ,r ,m")
4063 : 21601469 : (match_operand:DF 1 "general_operand"
4064 : 19393542 : "Yf*fm,Yf*f,G ,roF,r ,*roF,*r,F ,rm,rC,C ,F ,C ,v,m,v,C ,*x,m ,*x, v, r,roF,rF,rmF,rC"))]
4065 : 32885000 : "!(MEM_P (operands[0]) && MEM_P (operands[1]))
4066 : 15677775 : && (lra_in_progress || reload_completed
4067 : 14090057 : || !CONST_DOUBLE_P (operands[1])
4068 : 2536287 : || ((optimize_function_for_size_p (cfun)
4069 : 2518758 : || (ix86_cmodel == CM_LARGE || ix86_cmodel == CM_LARGE_PIC))
4070 : 2225839 : && IS_STACK_MODE (DFmode)
4071 : 2208245 : && standard_80387_constant_p (operands[1]) > 0
4072 : 2208242 : && !memory_operand (operands[0], DFmode))
4073 : 2536287 : || (TARGET_SSE2 && TARGET_SSE_MATH
4074 : 2502934 : && standard_sse_constant_p (operands[1], DFmode) == 1
4075 : 2275597 : && !memory_operand (operands[0], DFmode))
4076 : 2486269 : || ((TARGET_64BIT || !TARGET_MEMORY_MISMATCH_STALL)
4077 : 237623 : && memory_operand (operands[0], DFmode))
4078 : 272549 : || !TARGET_HARD_DF_REGS)"
4079 : 16496383 : {
4080 : 3292067 : switch (get_attr_type (insn))
4081 : 2207927 : {
4082 : 14056635 : case TYPE_FMOV:
4083 : 14056635 : if (which_alternative == 2)
4084 : 2209236 : return standard_80387_constant_opcode (operands[1]);
4085 : 2231576 : return output_387_reg_move (insn, operands);
4086 : 2209146 :
4087 : 5244819 : case TYPE_MULTI:
4088 : 5244819 : return "#";
4089 : 5244819 :
4090 : 3086334 : case TYPE_IMOV:
4091 : 3086334 : if (get_attr_mode (insn) == MODE_SI)
4092 : 2207927 : return "mov{l}\t{%1, %k0|%k0, %1}";
4093 : 2257344 : else if (which_alternative == 11)
4094 : 2207927 : return "movabs{q}\t{%1, %0|%0, %1}";
4095 : 2207927 : else
4096 : 2257334 : return "mov{q}\t{%1, %0|%0, %1}";
4097 : 2207927 :
4098 : 2238726 : case TYPE_SSELOG1:
4099 : 2238726 : return standard_sse_constant_opcode (insn, operands);
4100 : 2213291 :
4101 : 985524 : case TYPE_SSEMOV:
4102 : 985524 : return ix86_output_ssemov (insn, operands);
4103 : 2208350 :
4104 : 2208350 : default:
4105 : 2208350 : gcc_unreachable ();
4106 : 2208350 : }
4107 : 2208350 : }
4108 : 2208350 : [(set (attr "isa")
4109 : 2208350 : (cond [(eq_attr "alternative" "3,4,5,6,7,22,23")
4110 : 2208350 : (const_string "nox64")
4111 : 3123452 : (eq_attr "alternative" "8,9,10,11,24,25")
4112 : 19360 : (const_string "x64")
4113 : 19360 : (eq_attr "alternative" "12,13,14,15")
4114 : 2208350 : (const_string "sse2")
4115 : 2208350 : (eq_attr "alternative" "20,21")
4116 : 2208350 : (const_string "x64_sse2")
4117 : 423 : ]
4118 : 2207927 : (const_string "*")))
4119 : 2207927 : (set (attr "type")
4120 : 2207927 : (cond [(eq_attr "alternative" "0,1,2")
4121 : 2207927 : (const_string "fmov")
4122 : 2275532 : (eq_attr "alternative" "3,4,5,6,7,22,23")
4123 : 2275532 : (const_string "multi")
4124 : 67605 : (eq_attr "alternative" "8,9,10,11,24,25")
4125 : 67605 : (const_string "imov")
4126 : 2207927 : (eq_attr "alternative" "12,16")
4127 : 2207927 : (const_string "sselog1")
4128 : 2207927 : ]
4129 : 2207927 : (const_string "ssemov")))
4130 : 2207927 : (set (attr "modrm")
4131 : 2207927 : (if_then_else (eq_attr "alternative" "11")
4132 : 2207927 : (const_string "0")
4133 : 2207927 : (const_string "*")))
4134 : 2240711 : (set (attr "length_immediate")
4135 : 2240711 : (if_then_else (eq_attr "alternative" "11")
4136 : 2240711 : (const_string "8")
4137 : 2240711 : (const_string "*")))
4138 : 2240711 : (set (attr "prefix")
4139 : 2240711 : (if_then_else (eq_attr "type" "sselog1,ssemov")
4140 : 2240711 : (const_string "maybe_vex")
4141 : 2240711 : (const_string "orig")))
4142 : 2240711 : (set (attr "prefix_data16")
4143 : 2240711 : (if_then_else
4144 : 2240711 : (ior (and (eq_attr "type" "ssemov") (eq_attr "mode" "DI"))
4145 : 2240711 : (eq_attr "mode" "V1DF"))
4146 : 2240711 : (const_string "1")
4147 : 2240711 : (const_string "*")))
4148 : 2240711 : (set (attr "mode")
4149 : 2240711 : (cond [(eq_attr "alternative" "3,4,5,6,7,10,22,23")
4150 : 2240711 : (const_string "SI")
4151 : 2240711 : (eq_attr "alternative" "8,9,11,20,21,24,25")
4152 : 2240711 : (const_string "DI")
4153 : 2240711 :
4154 : 2240711 : /* xorps is one byte shorter for non-AVX targets. */
4155 : 2240711 : (eq_attr "alternative" "12,16")
4156 : 2240711 : (cond [(match_test "TARGET_AVX")
4157 : 2240711 : (const_string "V2DF")
4158 : 2240711 : (ior (not (match_test "TARGET_SSE2"))
4159 : 2240711 : (match_test "optimize_function_for_size_p (cfun)"))
4160 : 2240711 : (const_string "V4SF")
4161 : 2240711 : (match_test "TARGET_SSE_LOAD0_BY_PXOR")
4162 : 2240711 : (const_string "TI")
4163 : 2240711 : ]
4164 : 2240711 : (const_string "V2DF"))
4165 : 2240711 :
4166 : 2240711 : /* For architectures resolving dependencies on
4167 : 2240711 : whole SSE registers use movapd to break dependency
4168 : 2240711 : chains, otherwise use short move to avoid extra work. */
4169 : 2240711 :
4170 : 2240711 : /* movaps is one byte shorter for non-AVX targets. */
4171 : 2240711 : (eq_attr "alternative" "13,17")
4172 : 2240711 : (cond [(match_test "TARGET_AVX512VL")
4173 : 2240711 : (const_string "V2DF")
4174 : 2240711 : (match_test "TARGET_AVX512F")
4175 : 2240711 : (const_string "DF")
4176 : 2240711 : (match_test "TARGET_AVX")
4177 : 2240711 : (const_string "V2DF")
4178 : 2240711 : (ior (not (match_test "TARGET_SSE2"))
4179 : 2240711 : (match_test "optimize_function_for_size_p (cfun)"))
4180 : 2240711 : (const_string "V4SF")
4181 : 2240711 : (match_test "TARGET_SSE_PACKED_SINGLE_INSN_OPTIMAL")
4182 : 2240711 : (const_string "V4SF")
4183 : 2240711 : (match_test "TARGET_SSE_PARTIAL_REG_DEPENDENCY")
4184 : 2240711 : (const_string "V2DF")
4185 : 2240711 : ]
4186 : 2240711 : (const_string "DF"))
4187 : 2240711 :
4188 : 2240711 : /* For architectures resolving dependencies on register
4189 : 2240711 : parts we may avoid extra work to zero out upper part
4190 : 2240711 : of register. */
4191 : 2240711 : (eq_attr "alternative" "14,18")
4192 : 2240711 : (cond [(not (match_test "TARGET_SSE2"))
4193 : 2240711 : (const_string "V2SF")
4194 : 2240711 : (match_test "TARGET_AVX")
4195 : 2240711 : (const_string "DF")
4196 : 2240711 : (match_test "TARGET_SSE_SPLIT_REGS")
4197 : 2240711 : (const_string "V1DF")
4198 : 2240711 : ]
4199 : 2240711 : (const_string "DF"))
4200 : 2240711 :
4201 : 2240711 : (and (eq_attr "alternative" "15,19")
4202 : 2240711 : (not (match_test "TARGET_SSE2")))
4203 : 2240711 : (const_string "V2SF")
4204 : 2240711 : ]
4205 : 2240711 : (const_string "DF")))
4206 : 2240711 : (set (attr "preferred_for_size")
4207 : 2240711 : (cond [(eq_attr "alternative" "3,4")
4208 : 2240711 : (symbol_ref "false")]
4209 : 2240711 : (symbol_ref "true")))
4210 : 2240711 : (set (attr "preferred_for_speed")
4211 : 2240711 : (cond [(eq_attr "alternative" "3,4")
4212 : 2750 : (symbol_ref "TARGET_INTEGER_DFMODE_MOVES")
4213 : 2240711 : (eq_attr "alternative" "20")
4214 : 11587148 : (symbol_ref "TARGET_INTER_UNIT_MOVES_FROM_VEC")
4215 : 2240711 : (eq_attr "alternative" "21")
4216 : 650776 : (symbol_ref "TARGET_INTER_UNIT_MOVES_TO_VEC")
4217 : 2240711 : ]
4218 : 2240711 : (symbol_ref "true")))
4219 : 2240711 : (set (attr "enabled")
4220 : 13902119 : (cond [(eq_attr "alternative" "22,23,24,25")
4221 : 11661408 : (if_then_else
4222 : 57422160 : (match_test "TARGET_HARD_DF_REGS")
4223 : 32784 : (symbol_ref "false")
4224 : 74260 : (const_string "*"))
4225 : 2207927 : (not (match_test "TARGET_HARD_DF_REGS"))
4226 : 2207927 : (symbol_ref "false")
4227 : 13238 : ]
4228 : 2207927 : (const_string "*")))])
4229 : 2207927 :
4230 : 2207927 : (define_split
4231 : 2207927 : [(set (match_operand:DF 0 "nonimmediate_gr_operand")
4232 : 2207927 : (match_operand:DF 1 "general_gr_operand"))]
4233 : 2279735 : "!TARGET_64BIT && reload_completed"
4234 : 2208242 : [(const_int 0)]
4235 : 2208242 : "ix86_split_long_move (operands); DONE;")
4236 : 2782396 :
4237 : 2782396 : (define_insn "*movsf_internal"
4238 : 2782396 : [(set (match_operand:SF 0 "nonimmediate_operand"
4239 : 2782396 : "=Yf*f,m ,Yf*f,?r ,?m,Yv,v,v,m,?r,?v,!*y,!*y,!m,!r,!*y,r ,m")
4240 : 127523088 : (match_operand:SF 1 "general_operand"
4241 : 10200297 : "Yf*fm,Yf*f,G ,rmF,rF,C ,v,m,v,v ,r ,*y ,m ,*y,*y,r ,rmF,rF"))]
4242 : 143110945 : "!(MEM_P (operands[0]) && MEM_P (operands[1]))
4243 : 18301427 : && (lra_in_progress || reload_completed
4244 : 17014200 : || !CONST_DOUBLE_P (operands[1])
4245 : 3766976 : || ((optimize_function_for_size_p (cfun)
4246 : 3735748 : || (ix86_cmodel == CM_LARGE || ix86_cmodel == CM_LARGE_PIC))
4247 : 2888298 : && IS_STACK_MODE (SFmode)
4248 : 2782399 : && standard_80387_constant_p (operands[1]) > 0)
4249 : 3841650 : || (TARGET_SSE && TARGET_SSE_MATH
4250 : 3801120 : && standard_sse_constant_p (operands[1], SFmode) == 1)
4251 : 3631143 : || memory_operand (operands[0], SFmode)
4252 : 3623177 : || !TARGET_HARD_SF_REGS)"
4253 : 18505736 : {
4254 : 3678138 : switch (get_attr_type (insn))
4255 : 2857070 : {
4256 : 16142193 : case TYPE_FMOV:
4257 : 16142193 : if (which_alternative == 2)
4258 : 12428079 : return standard_80387_constant_opcode (operands[1]);
4259 : 25711151 : return output_387_reg_move (insn, operands);
4260 : 2782396 :
4261 : 2782396 : case TYPE_IMOV:
4262 : 2782396 : return "mov{l}\t{%1, %0|%0, %1}";
4263 : 2782396 :
4264 : 2882027 : case TYPE_SSELOG1:
4265 : 2882027 : return standard_sse_constant_opcode (insn, operands);
4266 : 2782396 :
4267 : 3531692 : case TYPE_SSEMOV:
4268 : 3531692 : return ix86_output_ssemov (insn, operands);
4269 : 2782396 :
4270 : 2782396 : case TYPE_MMXMOV:
4271 : 2782396 : switch (get_attr_mode (insn))
4272 : 2782396 : {
4273 : 2782396 : case MODE_DI:
4274 : 2782396 : return "movq\t{%1, %0|%0, %1}";
4275 : 2782396 : case MODE_SI:
4276 : 2782396 : return "movd\t{%1, %0|%0, %1}";
4277 : 2782396 :
4278 : 2782396 : default:
4279 : 2782396 : gcc_unreachable ();
4280 : 2782396 : }
4281 : 2782396 :
4282 : 2782396 : default:
4283 : 2782396 : gcc_unreachable ();
4284 : 2782396 : }
4285 : 2782396 : }
4286 : 2782396 : [(set (attr "isa")
4287 : 2782396 : (cond [(eq_attr "alternative" "9,10")
4288 : 2782396 : (const_string "sse2")
4289 : 2861893 : ]
4290 : 2782396 : (const_string "*")))
4291 : 2782396 : (set (attr "type")
4292 : 2782396 : (cond [(eq_attr "alternative" "0,1,2")
4293 : 2782396 : (const_string "fmov")
4294 : 2782396 : (eq_attr "alternative" "3,4,16,17")
4295 : 2782396 : (const_string "imov")
4296 : 2782396 : (eq_attr "alternative" "5")
4297 : 2782396 : (const_string "sselog1")
4298 : 2782396 : (eq_attr "alternative" "11,12,13,14,15")
4299 : 2782396 : (const_string "mmxmov")
4300 : 2782396 : ]
4301 : 2782396 : (const_string "ssemov")))
4302 : 2782396 : (set (attr "prefix")
4303 : 2782396 : (if_then_else (eq_attr "type" "sselog1,ssemov")
4304 : 2782396 : (const_string "maybe_vex")
4305 : 2782396 : (const_string "orig")))
4306 : 2782396 : (set (attr "prefix_data16")
4307 : 2782396 : (if_then_else (and (eq_attr "type" "ssemov") (eq_attr "mode" "SI"))
4308 : 2782396 : (const_string "1")
4309 : 2782396 : (const_string "*")))
4310 : 2782396 : (set (attr "mode")
4311 : 2782396 : (cond [(eq_attr "alternative" "3,4,9,10,12,13,14,15,16,17")
4312 : 2782396 : (const_string "SI")
4313 : 2782396 : (eq_attr "alternative" "11")
4314 : 574469 : (const_string "DI")
4315 : 574469 : (eq_attr "alternative" "5")
4316 : 2207927 : (cond [(and (match_test "TARGET_AVX512F && TARGET_EVEX512")
4317 : 3294 : (not (match_test "TARGET_PREFER_AVX256")))
4318 : 2207927 : (const_string "V16SF")
4319 : 2207927 : (match_test "TARGET_AVX")
4320 : 2207927 : (const_string "V4SF")
4321 : 2699408 : (ior (not (match_test "TARGET_SSE2"))
4322 : 2207927 : (match_test "optimize_function_for_size_p (cfun)"))
4323 : 2207927 : (const_string "V4SF")
4324 : 2367261 : (match_test "TARGET_SSE_LOAD0_BY_PXOR")
4325 : 2367261 : (const_string "TI")
4326 : 2367261 : ]
4327 : 2367261 : (const_string "V4SF"))
4328 : 2367261 :
4329 : 2367261 : /* For architectures resolving dependencies on
4330 : 2367261 : whole SSE registers use APS move to break dependency
4331 : 2367261 : chains, otherwise use short move to avoid extra work.
4332 : 2367261 :
4333 : 2367261 : Do the same for architectures resolving dependencies on
4334 : 2367261 : the parts. While in DF mode it is better to always handle
4335 : 2367261 : just register parts, the SF mode is different due to lack
4336 : 2367261 : of instructions to load just part of the register. It is
4337 : 2367261 : better to maintain the whole registers in single format
4338 : 859024227 : to avoid problems on using packed logical operations. */
4339 : 2367261 : (eq_attr "alternative" "6")
4340 : 856656966 : (cond [(match_test "TARGET_AVX512VL")
4341 : 2367261 : (const_string "V4SF")
4342 : 2367261 : (match_test "TARGET_AVX512F")
4343 : 2367261 : (const_string "SF")
4344 : 2367261 : (ior (match_test "TARGET_SSE_PARTIAL_REG_DEPENDENCY")
4345 : 2367261 : (match_test "TARGET_SSE_SPLIT_REGS"))
4346 : 2367261 : (const_string "V4SF")
4347 : 2367261 : ]
4348 : 2367261 : (const_string "SF"))
4349 : 2367261 : ]
4350 : 2367261 : (const_string "SF")))
4351 : 2367261 : (set (attr "preferred_for_speed")
4352 : 2367261 : (cond [(eq_attr "alternative" "9,14")
4353 : 2367261 : (symbol_ref "TARGET_INTER_UNIT_MOVES_FROM_VEC")
4354 : 2367261 : (eq_attr "alternative" "10,15")
4355 : 2367261 : (symbol_ref "TARGET_INTER_UNIT_MOVES_TO_VEC")
4356 : 2367261 : ]
4357 : 2367261 : (symbol_ref "true")))
4358 : 0 : (set (attr "enabled")
4359 : 0 : (cond [(eq_attr "alternative" "16,17")
4360 : 2367261 : (if_then_else
4361 : 23031196 : (match_test "TARGET_HARD_SF_REGS")
4362 : 159334 : (symbol_ref "false")
4363 : 0 : (const_string "*"))
4364 : 2207927 : (not (match_test "TARGET_HARD_SF_REGS"))
4365 : 2207927 : (symbol_ref "false")
4366 : 2207927 : ]
4367 : 2207927 : (const_string "*")))])
4368 : 2207927 :
4369 : 2207927 : (define_mode_attr hfbfconstf
4370 : 2207927 : [(HF "F") (BF "")])
4371 : 2322953 :
4372 : 2322953 : (define_insn "*mov<mode>_internal"
4373 : 2322953 : [(set (match_operand:HFBF 0 "nonimmediate_operand"
4374 : 2322953 : "=?r,?r,?r,?m ,Yv,v,?r,jm,m,?v,v")
4375 : 2322953 : (match_operand:HFBF 1 "general_operand"
4376 : 2322953 : "r ,F ,m ,r<hfbfconstf>,C ,v, v,v ,v,r ,m"))]
4377 : 18457696 : "!(MEM_P (operands[0]) && MEM_P (operands[1]))
4378 : 18457209 : && (lra_in_progress
4379 : 18414501 : || reload_completed
4380 : 16068837 : || !CONST_DOUBLE_P (operands[1])
4381 : 32200 : || (TARGET_SSE2
4382 : 2355153 : && standard_sse_constant_p (operands[1], <MODE>mode) == 1)
4383 : 2353868 : || memory_operand (operands[0], <MODE>mode))"
4384 : 18518518 : {
4385 : 92142 : switch (get_attr_type (insn))
4386 : 2322953 : {
4387 : 33252761 : case TYPE_IMOVX:
4388 : 33252761 : /* movzwl is faster than movw on p2 due to partial word stalls,
4389 : 0 : though not as fast as an aligned movl. */
4390 : 2329978 : return "movz{wl|x}\t{%1, %k0|%k0, %1}";
4391 : 2329978 :
4392 : 2386188 : case TYPE_SSEMOV:
4393 : 2386188 : return ix86_output_ssemov (insn, operands);
4394 : 2322953 :
4395 : 2340547 : case TYPE_SSELOG1:
4396 : 2340547 : if (satisfies_constraint_C (operands[1]))
4397 : 2323525 : return standard_sse_constant_opcode (insn, operands);
4398 : 2322953 :
4399 : 2339975 : if (SSE_REG_P (operands[0]))
4400 : 2322953 : return "%vpinsrw\t{$0, %1, %d0|%d0, %1, 0}";
4401 : 2322953 : else
4402 : 2323493 : return "%vpextrw\t{$0, %1, %0|%0, %1, 0}";
4403 : 2322953 :
4404 : 2330182 : default:
4405 : 2330182 : if (get_attr_mode (insn) == MODE_SI)
4406 : 2322953 : return "mov{l}\t{%k1, %k0|%k0, %k1}";
4407 : 2322953 : else
4408 : 6748 : return "mov{w}\t{%1, %0|%0, %1}";
4409 : 0 : }
4410 : 2322953 : }
4411 : 2322953 : [(set (attr "isa")
4412 : 2322953 : (cond [(eq_attr "alternative" "4,5,6,9,10")
4413 : 2322953 : (const_string "sse2")
4414 : 2384900 : (eq_attr "alternative" "7")
4415 : 2322953 : (const_string "sse4_noavx")
4416 : 2322953 : (eq_attr "alternative" "8")
4417 : 2322953 : (const_string "avx")
4418 : 2322983 : ]
4419 : 2322983 : (const_string "*")))
4420 : 30 : (set (attr "addr")
4421 : 2322953 : (if_then_else (eq_attr "alternative" "7")
4422 : 0 : (const_string "gpr16")
4423 : 0 : (const_string "*")))
4424 : 2322953 : (set (attr "type")
4425 : 2322953 : (cond [(eq_attr "alternative" "4")
4426 : 2322953 : (const_string "sselog1")
4427 : 2322953 : (eq_attr "alternative" "5,6,9")
4428 : 2322953 : (const_string "ssemov")
4429 : 2322953 : (eq_attr "alternative" "7,8,10")
4430 : 2322953 : (if_then_else
4431 : 2322953 : (match_test ("TARGET_AVX512FP16"))
4432 : 2322953 : (const_string "ssemov")
4433 : 2322953 : (const_string "sselog1"))
4434 : 2322953 : (match_test "optimize_function_for_size_p (cfun)")
4435 : 2322953 : (const_string "imov")
4436 : 2322953 : (and (eq_attr "alternative" "0")
4437 : 2322953 : (ior (not (match_test "TARGET_PARTIAL_REG_STALL"))
4438 : 0 : (not (match_test "TARGET_HIMODE_MATH"))))
4439 : 0 : (const_string "imov")
4440 : 2322953 : (and (eq_attr "alternative" "1,2")
4441 : 2322953 : (match_operand:HI 1 "aligned_operand"))
4442 : 2322953 : (const_string "imov")
4443 : 0 : (and (match_test "TARGET_MOVX")
4444 : 2322953 : (eq_attr "alternative" "0,2"))
4445 : 2322953 : (const_string "imovx")
4446 : 2322953 : ]
4447 : 2322953 : (const_string "imov")))
4448 : 2322953 : (set (attr "prefix")
4449 : 2322953 : (cond [(eq_attr "alternative" "4,5,6,7,8,9,10")
4450 : 2322953 : (const_string "maybe_vex")
4451 : 2322953 : ]
4452 : 2322953 : (const_string "orig")))
4453 : 2322953 : (set (attr "mode")
4454 : 2322953 : (cond [(eq_attr "alternative" "4")
4455 : 0 : (const_string "V4SF")
4456 : 0 : (eq_attr "alternative" "6,9")
4457 : 2322953 : (if_then_else
4458 : 2322953 : (match_test "TARGET_AVX512FP16")
4459 : 2322953 : (const_string "HI")
4460 : 0 : (const_string "SI"))
4461 : 2322953 : (eq_attr "alternative" "7,8,10")
4462 : 2322953 : (if_then_else
4463 : 2322953 : (match_test "TARGET_AVX512FP16")
4464 : 0 : (const_string "HI")
4465 : 2322953 : (const_string "TI"))
4466 : 2322953 : (eq_attr "alternative" "5")
4467 : 2322953 : (cond [(match_test "TARGET_AVX512VL")
4468 : 2322953 : (const_string "V4SF")
4469 : 2322953 : (match_test "TARGET_AVX512FP16")
4470 : 2322953 : (const_string "HF")
4471 : 2322953 : (match_test "TARGET_AVX512F")
4472 : 2322953 : (const_string "SF")
4473 : 2322953 : (match_test "TARGET_AVX")
4474 : 0 : (const_string "V4SF")
4475 : 3792438 : (ior (match_test "TARGET_SSE_PARTIAL_REG_DEPENDENCY")
4476 : 9995178 : (match_test "TARGET_SSE_SPLIT_REGS"))
4477 : 2322953 : (const_string "V4SF")
4478 : 2322953 : ]
4479 : 2322953 : (const_string "SF"))
4480 : 2322953 : (eq_attr "type" "imovx")
4481 : 2322953 : (const_string "SI")
4482 : 2322953 : (and (eq_attr "alternative" "1,2")
4483 : 2322953 : (match_operand:HI 1 "aligned_operand"))
4484 : 16160032 : (const_string "SI")
4485 : 6032548 : (and (eq_attr "alternative" "0")
4486 : 10190683 : (ior (not (match_test "TARGET_PARTIAL_REG_STALL"))
4487 : 2322953 : (not (match_test "TARGET_HIMODE_MATH"))))
4488 : 2322953 : (const_string "SI")
4489 : 54296 : ]
4490 : 0 : (const_string "HI")))
4491 : 2816727 : (set (attr "enabled")
4492 : 2896383 : (cond [(and (match_test "<MODE>mode == BFmode")
4493 : 663096 : (eq_attr "alternative" "1"))
4494 : 115026 : (symbol_ref "false")
4495 : 2207927 : ]
4496 : 2207927 : (const_string "*")))])
4497 : 485642 :
4498 : 0 : (define_split
4499 : 200564 : [(set (match_operand 0 "any_fp_register_operand")
4500 : 2207927 : (match_operand 1 "memory_operand"))]
4501 : 7023482 : "reload_completed
4502 : 4780226 : && (GET_MODE (operands[0]) == TFmode
4503 : 2207927 : || GET_MODE (operands[0]) == XFmode
4504 : 2207927 : || GET_MODE (operands[0]) == DFmode
4505 : 6988153 : || GET_MODE (operands[0]) == SFmode)
4506 : 4253094 : && ix86_standard_x87sse_constant_load_p (insn, operands[0])"
4507 : 2282601 : [(set (match_dup 0) (match_dup 2))]
4508 : 126948619 : "operands[2] = find_constant_src (curr_insn);")
4509 : 2246640 :
4510 : 126873945 : (define_split
4511 : 2282601 : [(set (match_operand 0 "any_fp_register_operand")
4512 : 74674 : (float_extend (match_operand 1 "memory_operand")))]
4513 : 181686 : "reload_completed
4514 : 2389533 : && (GET_MODE (operands[0]) == TFmode
4515 : 2282601 : || GET_MODE (operands[0]) == XFmode
4516 : 2389533 : || GET_MODE (operands[0]) == DFmode)
4517 : 181546 : && ix86_standard_x87sse_constant_load_p (insn, operands[0])"
4518 : 2209873 : [(set (match_dup 0) (match_dup 2))]
4519 : 2284547 : "operands[2] = find_constant_src (curr_insn);")
4520 : 2282601 :
4521 : 337243 : ;; Split the load of -0.0 or -1.0 into fldz;fchs or fld1;fchs sequence
4522 : 2472442 : (define_split
4523 : 2472442 : [(set (match_operand:X87MODEF 0 "fp_register_operand")
4524 : 2209873 : (match_operand:X87MODEF 1 "immediate_operand"))]
4525 : 21477 : "reload_completed
4526 : 2316168 : && (standard_80387_constant_p (operands[1]) == 8
4527 : 2316193 : || standard_80387_constant_p (operands[1]) == 9)"
4528 : 126860308 : [(set (match_dup 0)(match_dup 1))
4529 : 251557298 : (set (match_dup 0)
4530 : 3125953 : (neg:X87MODEF (match_dup 0)))]
4531 : 252147455 : {
4532 : 2921362 : if (real_isnegzero (CONST_DOUBLE_REAL_VALUE (operands[1])))
4533 : 2427233 : operands[1] = CONST0_RTX (<MODE>mode);
4534 : 2449065 : else
4535 : 2486241 : operands[1] = CONST1_RTX (<MODE>mode);
4536 : 2470496 : })
4537 : 262569 :
4538 : 262626 : (define_insn "*swapxf"
4539 : 2223647 : [(set (match_operand:XF 0 "register_operand" "+f")
4540 : 2420004 : (match_operand:XF 1 "register_operand" "+f"))
4541 : 2420004 : (set (match_dup 1)
4542 : 2223704 : (match_dup 0))]
4543 : 2273006 : "TARGET_80387"
4544 : 2257229 : {
4545 : 2273006 : if (STACK_TOP_P (operands[0]))
4546 : 2207927 : return "fxch\t%1";
4547 : 2207927 : else
4548 : 65022 : return "fxch\t%0";
4549 : 15720 : }
4550 : 2223647 : [(set_attr "type" "fxch")
4551 : 2211164 : (set_attr "mode" "XF")])
4552 : 2211164 :
4553 : 165481 :
4554 : 2207938 : ;; Zero extension instructions
4555 : 2211175 :
4556 : 2246353 : (define_insn_and_split "zero_extendditi2"
4557 : 2207938 : [(set (match_operand:TI 0 "nonimmediate_operand" "=r,o")
4558 : 2243138 : (zero_extend:TI (match_operand:DI 1 "nonimmediate_operand" "rm,r")))]
4559 : 2341732 : "TARGET_64BIT"
4560 : 2245353 : "#"
4561 : 2262717 : "&& reload_completed"
4562 : 2227720 : [(set (match_dup 3) (match_dup 1))
4563 : 2243138 : (set (match_dup 4) (const_int 0))]
4564 : 1126588 : "split_double_mode (TImode, &operands[0], 1, &operands[3], &operands[4]);")
4565 : 693313 :
4566 : 4008280 : (define_expand "zero_extendsidi2"
4567 : 3314989 : [(set (match_operand:DI 0 "nonimmediate_operand")
4568 : 2920777 : (zero_extend:DI (match_operand:SI 1 "nonimmediate_operand")))])
4569 : 407413 :
4570 : 2920766 : (define_insn "*zero_extendsidi2"
4571 : 2602583 : [(set (match_operand:DI 0 "nonimmediate_operand"
4572 : 2227464 : "=r,?r,?o,r ,o,?*y,?!*y,$r,$v,$x,*x,*v,*r,*k")
4573 : 278184 : (zero_extend:DI
4574 : 2486111 : (match_operand:SI 1 "x86_64_zext_operand"
4575 : 2486111 : "0 ,rm,r ,rmWz,0,r ,m ,v ,r ,m ,*x,*v,*k,*km")))]
4576 : 2227464 : ""
4577 : 2392742 : {
4578 : 2373205 : switch (get_attr_type (insn))
4579 : 2227464 : {
4580 : 2371057 : case TYPE_IMOVX:
4581 : 2390594 : if (ix86_use_lea_for_mov (insn, operands))
4582 : 2227464 : return "lea{l}\t{%E1, %k0|%k0, %E1}";
4583 : 2227464 : else
4584 : 2371043 : return "mov{l}\t{%1, %k0|%k0, %1}";
4585 : 2207927 :
4586 : 0 : case TYPE_MULTI:
4587 : 0 : return "#";
4588 : 2497680 :
4589 : 2207927 : case TYPE_MMXMOV:
4590 : 2207927 : return "movd\t{%1, %0|%0, %1}";
4591 : 289753 :
4592 : 2210071 : case TYPE_SSEMOV:
4593 : 2210071 : if (SSE_REG_P (operands[0]) && SSE_REG_P (operands[1]))
4594 : 2207927 : {
4595 : 3 : if (EXT_REX_SSE_REG_P (operands[0])
4596 : 2207930 : || EXT_REX_SSE_REG_P (operands[1]))
4597 : 2207927 : return "vpmovzxdq\t{%t1, %g0|%g0, %t1}";
4598 : 2207927 : else
4599 : 2207930 : return "%vpmovzxdq\t{%1, %0|%0, %1}";
4600 : 2207927 : }
4601 : 2207927 :
4602 : 2210068 : if (GENERAL_REG_P (operands[0]))
4603 : 2209325 : return "%vmovd\t{%1, %k0|%k0, %1}";
4604 : 2207927 :
4605 : 2207927 : return "%vmovd\t{%1, %0|%0, %1}";
4606 : 2207927 :
4607 : 2207931 : case TYPE_MSKMOV:
4608 : 2207931 : return "kmovd\t{%1, %k0|%k0, %1}";
4609 : 2207927 :
4610 : 2207927 : default:
4611 : 2207927 : gcc_unreachable ();
4612 : 2207927 : }
4613 : 2207927 : }
4614 : 2207927 : [(set (attr "isa")
4615 : 2207927 : (cond [(eq_attr "alternative" "0,1,2")
4616 : 0 : (const_string "nox64")
4617 : 0 : (eq_attr "alternative" "3")
4618 : 2207927 : (const_string "x64")
4619 : 2207927 : (eq_attr "alternative" "7,8,9")
4620 : 2207927 : (const_string "sse2")
4621 : 0 : (eq_attr "alternative" "10")
4622 : 2207927 : (const_string "sse4")
4623 : 2207927 : (eq_attr "alternative" "11")
4624 : 2207927 : (const_string "avx512f")
4625 : 0 : (eq_attr "alternative" "12")
4626 : 2207927 : (const_string "x64_avx512bw")
4627 : 2207927 : (eq_attr "alternative" "13")
4628 : 2207927 : (const_string "avx512bw")
4629 : 2207927 : ]
4630 : 2207927 : (const_string "*")))
4631 : 2207927 : (set (attr "mmx_isa")
4632 : 2207927 : (if_then_else (eq_attr "alternative" "5,6")
4633 : 2207927 : (const_string "native")
4634 : 2207927 : (const_string "*")))
4635 : 2207927 : (set (attr "type")
4636 : 0 : (cond [(eq_attr "alternative" "0,1,2,4")
4637 : 0 : (const_string "multi")
4638 : 2207927 : (eq_attr "alternative" "5,6")
4639 : 2207927 : (const_string "mmxmov")
4640 : 2207927 : (eq_attr "alternative" "7")
4641 : 2207927 : (if_then_else (match_test "TARGET_64BIT")
4642 : 2207927 : (const_string "ssemov")
4643 : 2207927 : (const_string "multi"))
4644 : 2207927 : (eq_attr "alternative" "8,9,10,11")
4645 : 2207927 : (const_string "ssemov")
4646 : 2207927 : (eq_attr "alternative" "12,13")
4647 : 2207927 : (const_string "mskmov")
4648 : 2207927 : ]
4649 : 2207927 : (const_string "imovx")))
4650 : 2207927 : (set (attr "prefix_extra")
4651 : 2207927 : (if_then_else (eq_attr "alternative" "10,11")
4652 : 2231571 : (const_string "1")
4653 : 2207927 : (const_string "*")))
4654 : 2207927 : (set (attr "prefix")
4655 : 2207927 : (if_then_else (eq_attr "type" "ssemov")
4656 : 2207927 : (const_string "maybe_vex")
4657 : 0 : (const_string "orig")))
4658 : 2207927 : (set (attr "prefix_0f")
4659 : 2207927 : (if_then_else (eq_attr "type" "imovx")
4660 : 2207927 : (const_string "0")
4661 : 0 : (const_string "*")))
4662 : 2207927 : (set (attr "mode")
4663 : 2207927 : (cond [(eq_attr "alternative" "5,6")
4664 : 2207927 : (const_string "DI")
4665 : 2207927 : (and (eq_attr "alternative" "7")
4666 : 2207927 : (match_test "TARGET_64BIT"))
4667 : 2207927 : (const_string "TI")
4668 : 2207927 : (eq_attr "alternative" "8,10,11")
4669 : 2207927 : (const_string "TI")
4670 : 2207927 : ]
4671 : 0 : (const_string "SI")))
4672 : 0 : (set (attr "preferred_for_speed")
4673 : 2207927 : (cond [(eq_attr "alternative" "7")
4674 : 2207927 : (symbol_ref "TARGET_INTER_UNIT_MOVES_FROM_VEC")
4675 : 2207927 : (eq_attr "alternative" "5,8")
4676 : 2207927 : (symbol_ref "TARGET_INTER_UNIT_MOVES_TO_VEC")
4677 : 2207927 : ]
4678 : 2207927 : (symbol_ref "true")))])
4679 : 2207927 :
4680 : 2207927 : (define_split
4681 : 2207927 : [(set (match_operand:DI 0 "memory_operand")
4682 : 2207927 : (zero_extend:DI (match_operand:SI 1 "memory_operand")))]
4683 : 2208261 : "reload_completed"
4684 : 2207927 : [(set (match_dup 4) (const_int 0))]
4685 : 2901229 : "split_double_mode (DImode, &operands[0], 1, &operands[3], &operands[4]);")
4686 : 2625745 :
4687 : 2901229 : (define_split
4688 : 2207927 : [(set (match_operand:DI 0 "general_reg_operand")
4689 : 2207927 : (zero_extend:DI (match_operand:SI 1 "general_reg_operand")))]
4690 : 2452718 : "!TARGET_64BIT && reload_completed
4691 : 2211380 : && REGNO (operands[0]) == REGNO (operands[1])"
4692 : 1706 : [(set (match_dup 4) (const_int 0))]
4693 : 2901229 : "split_double_mode (DImode, &operands[0], 1, &operands[3], &operands[4]);")
4694 : 2627526 :
4695 : 2899523 : (define_split
4696 : 1706 : [(set (match_operand:DI 0 "nonimmediate_gr_operand")
4697 : 2209633 : (zero_extend:DI (match_operand:SI 1 "nonimmediate_operand")))]
4698 : 2484729 : "!TARGET_64BIT && reload_completed
4699 : 2214166 : && !(MEM_P (operands[0]) && MEM_P (operands[1]))"
4700 : 2894990 : [(set (match_dup 3) (match_dup 1))
4701 : 2212460 : (set (match_dup 4) (const_int 0))]
4702 : 2212460 : "split_double_mode (DImode, &operands[0], 1, &operands[3], &operands[4]);")
4703 : 2209633 :
4704 : 2209633 : (define_mode_attr kmov_isa
4705 : 2214166 : [(QI "avx512dq") (HI "avx512f") (SI "avx512bw") (DI "avx512bw")])
4706 : 1706 :
4707 : 4865 : (define_insn "zero_extend<mode>di2"
4708 : 2209965 : [(set (match_operand:DI 0 "register_operand" "=r,*r,*k")
4709 : 2209687 : (zero_extend:DI
4710 : 2215876 : (match_operand:SWI12 1 "nonimmediate_operand" "<r>m,*k,*km")))]
4711 : 261926 : "TARGET_64BIT"
4712 : 2214170 : "@
4713 : 2214170 : movz{<imodesuffix>l|x}\t{%1, %k0|%k0, %1}
4714 : 2214170 : kmov<mskmodesuffix>\t{%1, %k0|%k0, %1}
4715 : 4537 : kmov<mskmodesuffix>\t{%1, %k0|%k0, %1}"
4716 : 2320551 : [(set_attr "isa" "*,<kmov_isa>,<kmov_isa>")
4717 : 2323374 : (set_attr "type" "imovx,mskmov,mskmov")
4718 : 2209633 : (set_attr "mode" "SI,<MODE>,<MODE>")])
4719 : 2998672 :
4720 : 2998672 : (define_expand "zero_extend<mode>si2"
4721 : 3003205 : [(set (match_operand:SI 0 "register_operand")
4722 : 2212460 : (zero_extend:SI (match_operand:SWI12 1 "nonimmediate_operand")))]
4723 : 2983551 : ""
4724 : 2212460 : {
4725 : 619421 : if (TARGET_ZERO_EXTEND_WITH_AND && optimize_function_for_speed_p (cfun))
4726 : 623954 : {
4727 : 2207927 : operands[1] = force_reg (<MODE>mode, operands[1]);
4728 : 2819406 : emit_insn (gen_zero_extend<mode>si2_and (operands[0], operands[1]));
4729 : 2819406 : DONE;
4730 : 223889 : }
4731 : 2431816 : })
4732 : 2431816 :
4733 : 2431816 : (define_insn_and_split "zero_extend<mode>si2_and"
4734 : 223889 : [(set (match_operand:SI 0 "register_operand" "=r,?&<r>")
4735 : 2481498 : (zero_extend:SI
4736 : 2481498 : (match_operand:SWI12 1 "nonimmediate_operand" "0,<r>m")))
4737 : 2481498 : (clobber (reg:CC FLAGS_REG))]
4738 : 2480235 : "TARGET_ZERO_EXTEND_WITH_AND && optimize_function_for_speed_p (cfun)"
4739 : 2481812 : "#"
4740 : 2207927 : "&& reload_completed"
4741 : 2207927 : [(parallel [(set (match_dup 0) (and:SI (match_dup 0) (match_dup 2)))
4742 : 2481498 : (clobber (reg:CC FLAGS_REG))])]
4743 : 2481718 : {
4744 : 2481498 : if (!REG_P (operands[1])
4745 : 2207927 : || REGNO (operands[0]) != REGNO (operands[1]))
4746 : 2207927 : {
4747 : 2207927 : ix86_expand_clear (operands[0]);
4748 : 2207927 :
4749 : 2207927 : gcc_assert (!TARGET_PARTIAL_REG_STALL);
4750 : 2207927 : emit_insn (gen_rtx_SET
4751 : 2207927 : (gen_rtx_STRICT_LOW_PART
4752 : 2257609 : (VOIDmode, gen_lowpart (<MODE>mode, operands[0])),
4753 : 2257609 : operands[1]));
4754 : 2207927 : DONE;
4755 : 2257609 : }
4756 : 2207927 :
4757 : 2257609 : operands[2] = GEN_INT (GET_MODE_MASK (<MODE>mode));
4758 : 2207927 : }
4759 : 2207927 : [(set_attr "type" "alu1")
4760 : 2207927 : (set_attr "mode" "SI")])
4761 : 2207927 :
4762 : 2207927 : (define_insn "*zero_extend<mode>si2"
4763 : 2207927 : [(set (match_operand:SI 0 "register_operand" "=r,*r,*k")
4764 : 2207927 : (zero_extend:SI
4765 : 2207927 : (match_operand:SWI12 1 "nonimmediate_operand" "<r>m,*k,*km")))]
4766 : 2967288 : "!(TARGET_ZERO_EXTEND_WITH_AND && optimize_function_for_speed_p (cfun))"
4767 : 2207927 : "@
4768 : 2207927 : movz{<imodesuffix>l|x}\t{%1, %0|%0, %1}
4769 : 2207927 : kmov<mskmodesuffix>\t{%1, %0|%0, %1}
4770 : 2359597 : kmov<mskmodesuffix>\t{%1, %0|%0, %1}"
4771 : 2359597 : [(set_attr "isa" "*,<kmov_isa>,<kmov_isa>")
4772 : 2207927 : (set_attr "type" "imovx,mskmov,mskmov")
4773 : 2355809 : (set_attr "mode" "SI,<MODE>,<MODE>")])
4774 : 2355809 :
4775 : 2256009 : (define_expand "zero_extendqihi2"
4776 : 2255717 : [(set (match_operand:HI 0 "register_operand")
4777 : 2303799 : (zero_extend:HI (match_operand:QI 1 "nonimmediate_operand")))]
4778 : 2209927 : ""
4779 : 61988 : {
4780 : 46082 : if (TARGET_ZERO_EXTEND_WITH_AND && optimize_function_for_speed_p (cfun))
4781 : 2223833 : {
4782 : 2207927 : operands[1] = force_reg (QImode, operands[1]);
4783 : 2207927 : emit_insn (gen_zero_extendqihi2_and (operands[0], operands[1]));
4784 : 2207927 : DONE;
4785 : 2223833 : }
4786 : 2223833 : })
4787 : 2223833 :
4788 : 2207927 : (define_insn_and_split "zero_extendqihi2_and"
4789 : 15906 : [(set (match_operand:HI 0 "register_operand" "=r,?&q")
4790 : 0 : (zero_extend:HI (match_operand:QI 1 "nonimmediate_operand" "0,qm")))
4791 : 1678678 : (clobber (reg:CC FLAGS_REG))]
4792 : 2249766 : "TARGET_ZERO_EXTEND_WITH_AND && optimize_function_for_speed_p (cfun)"
4793 : 2208143 : "#"
4794 : 2223921 : "&& reload_completed"
4795 : 2208015 : [(parallel [(set (match_dup 0) (and:SI (match_dup 0) (const_int 255)))
4796 : 88 : (clobber (reg:CC FLAGS_REG))])]
4797 : 15994 : {
4798 : 2223833 : if (!REG_P (operands[1])
4799 : 2223833 : || REGNO (operands[0]) != REGNO (operands[1]))
4800 : 68440 : {
4801 : 68524 : ix86_expand_clear (operands[0]);
4802 : 2276367 :
4803 : 2257937 : gcc_assert (!TARGET_PARTIAL_REG_STALL);
4804 : 476601833 : emit_insn (gen_rtx_SET
4805 : 43460 : (gen_rtx_STRICT_LOW_PART
4806 : 474382045 : (VOIDmode, gen_lowpart (QImode, operands[0])),
4807 : 2238458 : operands[1]));
4808 : 266055403 : DONE;
4809 : 263853469 : }
4810 : 263865596 :
4811 : 2226189 : operands[0] = gen_lowpart (SImode, operands[0]);
4812 : 22780560 : }
4813 : 2220054 : [(set_attr "type" "alu1")
4814 : 2226288 : (set_attr "mode" "SI")])
4815 : 2226288 :
4816 : 2244102 : ; zero extend to SImode to avoid partial register stalls
4817 : 2220159 : (define_insn "*zero_extendqihi2"
4818 : 105 : [(set (match_operand:HI 0 "register_operand" "=r,*r,*k")
4819 : 9972 : (zero_extend:HI (match_operand:QI 1 "nonimmediate_operand" "qm,*k,*km")))]
4820 : 2254009 : "!(TARGET_ZERO_EXTEND_WITH_AND && optimize_function_for_speed_p (cfun))"
4821 : 2207927 : "@
4822 : 2207927 : movz{bl|x}\t{%1, %k0|%k0, %1}
4823 : 2207927 : kmovb\t{%1, %k0|%k0, %1}
4824 : 2207927 : kmovb\t{%1, %0|%0, %1}"
4825 : 2207927 : [(set_attr "isa" "*,avx512dq,avx512dq")
4826 : 2207927 : (set_attr "type" "imovx,mskmov,mskmov")
4827 : 0 : (set_attr "mode" "SI,QI,QI")])
4828 : 211 :
4829 : 886 : ;; Transform xorl; mov[bw] (set strict_low_part) into movz[bw]l.
4830 : 825 : (define_peephole2
4831 : 1036 : [(parallel [(set (match_operand:SWI48 0 "general_reg_operand")
4832 : 88 : (const_int 0))
4833 : 150 : (clobber (reg:CC FLAGS_REG))])
4834 : 177 : (set (strict_low_part (match_operand:SWI12 1 "general_reg_operand"))
4835 : 177 : (match_operand:SWI12 2 "nonimmediate_operand"))]
4836 : 568 : "REGNO (operands[0]) == REGNO (operands[1])
4837 : 95 : && (<SWI48:MODE>mode != SImode
4838 : 122 : || !TARGET_ZERO_EXTEND_WITH_AND
4839 : 68 : || !optimize_function_for_speed_p (cfun))"
4840 : 2736 : [(set (match_dup 0) (zero_extend:SWI48 (match_dup 2)))])
4841 : 2763 :
4842 : 2763 : ;; Likewise, but preserving FLAGS_REG.
4843 : 2736 : (define_peephole2
4844 : 2736 : [(set (match_operand:SWI48 0 "general_reg_operand") (const_int 0))
4845 : 2736 : (set (strict_low_part (match_operand:SWI12 1 "general_reg_operand"))
4846 : 27 : (match_operand:SWI12 2 "nonimmediate_operand"))]
4847 : 2826 : "REGNO (operands[0]) == REGNO (operands[1])
4848 : 2709 : && (<SWI48:MODE>mode != SImode
4849 : 17 : || !TARGET_ZERO_EXTEND_WITH_AND
4850 : 27 : || !optimize_function_for_speed_p (cfun))"
4851 : 27 : [(set (match_dup 0) (zero_extend:SWI48 (match_dup 2)))])
4852 : 133 :
4853 : 106 : ;; Sign extension instructions
4854 : 0 :
4855 : 89 : (define_expand "extendsidi2"
4856 : 89 : [(set (match_operand:DI 0 "register_operand")
4857 : 0 : (sign_extend:DI (match_operand:SI 1 "register_operand")))]
4858 : 409 : ""
4859 : 502536 : {
4860 : 502945 : if (!TARGET_64BIT)
4861 : 409 : {
4862 : 6204 : emit_insn (gen_extendsidi2_1 (operands[0], operands[1]));
4863 : 8082 : DONE;
4864 : 4485 : }
4865 : 4076 : })
4866 : 409 :
4867 : 409 : (define_insn "*extendsidi2_rex64"
4868 : 496741 : [(set (match_operand:DI 0 "register_operand" "=*a,r")
4869 : 496741 : (sign_extend:DI (match_operand:SI 1 "nonimmediate_operand" "*0,rm")))]
4870 : 1438256 : "TARGET_64BIT"
4871 : 496741 : "@
4872 : 409 : {cltq|cdqe}
4873 : 496741 : movs{lq|x}\t{%1, %0|%0, %1}"
4874 : 98906 : [(set_attr "type" "imovx")
4875 : 98906 : (set_attr "mode" "DI")
4876 : 595647 : (set_attr "prefix_0f" "0")
4877 : 409 : (set_attr "modrm" "0,1")])
4878 : 496332 :
4879 : 0 : (define_insn "extendsidi2_1"
4880 : 0 : [(set (match_operand:DI 0 "nonimmediate_operand" "=*A,r,?r,?*o")
4881 : 0 : (sign_extend:DI (match_operand:SI 1 "register_operand" "0,0,r,r")))
4882 : 0 : (clobber (reg:CC FLAGS_REG))
4883 : 0 : (clobber (match_scratch:SI 2 "=X,X,X,&r"))]
4884 : 7168 : "!TARGET_64BIT"
4885 : 0 : "#")
4886 : 8394 :
4887 : 8394 : (define_insn "extendditi2"
4888 : 3119 : [(set (match_operand:TI 0 "nonimmediate_operand" "=*A,r,?r,?*o")
4889 : 4125 : (sign_extend:TI (match_operand:DI 1 "register_operand" "0,0,r,r")))
4890 : 3119 : (clobber (reg:CC FLAGS_REG))
4891 : 0 : (clobber (match_scratch:DI 2 "=X,X,X,&r"))]
4892 : 2691 : "TARGET_64BIT"
4893 : 4454 : "#")
4894 : 4454 :
4895 : 2788 : ;; Split the memory case. If the source register doesn't die, it will stay
4896 : 0 : ;; this way, if it does die, following peephole2s take care of it.
4897 : 0 : (define_split
4898 : 0 : [(set (match_operand:<DWI> 0 "memory_operand")
4899 : 433467 : (sign_extend:<DWI> (match_operand:DWIH 1 "register_operand")))
4900 : 433467 : (clobber (reg:CC FLAGS_REG))
4901 : 433493 : (clobber (match_operand:DWIH 2 "register_operand"))]
4902 : 1325 : "reload_completed"
4903 : 422942 : [(const_int 0)]
4904 : 1351 : {
4905 : 1351 : rtx bits = GEN_INT (<MODE_SIZE> * BITS_PER_UNIT - 1);
4906 : 83366 :
4907 : 1325 : split_double_mode (<DWI>mode, &operands[0], 1, &operands[3], &operands[4]);
4908 : 26 :
4909 : 1351 : emit_move_insn (operands[3], operands[1]);
4910 : 61 :
4911 : 339628 : /* Generate a cltd if possible and doing so it profitable. */
4912 : 2670 : if ((optimize_function_for_size_p (cfun) || TARGET_USE_CLTD)
4913 : 1377 : && REGNO (operands[1]) == AX_REG
4914 : 1741 : && REGNO (operands[2]) == DX_REG)
4915 : 61 : {
4916 : 176 : emit_insn (gen_ashr<mode>3_cvt (operands[2], operands[1], bits));
4917 : 26 : }
4918 : 35 : else
4919 : 61 : {
4920 : 1236 : emit_move_insn (operands[2], operands[1]);
4921 : 1236 : emit_insn (gen_ashr<mode>3_cvt (operands[2], operands[2], bits));
4922 : 26584 : }
4923 : 27071 : emit_move_insn (operands[4], operands[2]);
4924 : 53594 : DONE;
4925 : 35 : })
4926 : 0 :
4927 : 0 : ;; Peepholes for the case where the source register does die, after
4928 : 35 : ;; being split with the above splitter.
4929 : 127 : (define_peephole2
4930 : 127 : [(set (match_operand:DWIH 0 "memory_operand")
4931 : 65013 : (match_operand:DWIH 1 "general_reg_operand"))
4932 : 64921 : (set (match_operand:DWIH 2 "general_reg_operand") (match_dup 1))
4933 : 64375 : (parallel [(set (match_dup 2)
4934 : 546 : (ashiftrt:DWIH (match_dup 2)
4935 : 567 : (match_operand 4 "const_int_operand")))
4936 : 563 : (clobber (reg:CC FLAGS_REG))])
4937 : 1640 : (set (match_operand:DWIH 3 "memory_operand") (match_dup 2))]
4938 : 1200 : "REGNO (operands[1]) != REGNO (operands[2])
4939 : 2837 : && INTVAL (operands[4]) == (<MODE_SIZE> * BITS_PER_UNIT - 1)
4940 : 2275 : && peep2_reg_dead_p (2, operands[1])
4941 : 1860 : && peep2_reg_dead_p (4, operands[2])
4942 : 2196 : && !reg_mentioned_p (operands[2], operands[3])"
4943 : 775 : [(set (match_dup 0) (match_dup 1))
4944 : 868 : (parallel [(set (match_dup 1) (ashiftrt:DWIH (match_dup 1) (match_dup 4)))
4945 : 868 : (clobber (reg:CC FLAGS_REG))])
4946 : 93 : (set (match_dup 3) (match_dup 1))])
4947 : 792 :
4948 : 792 : (define_peephole2
4949 : 792 : [(set (match_operand:DWIH 0 "memory_operand")
4950 : 813 : (match_operand:DWIH 1 "general_reg_operand"))
4951 : 792 : (parallel [(set (match_operand:DWIH 2 "general_reg_operand")
4952 : 775 : (ashiftrt:DWIH (match_dup 1)
4953 : 775 : (match_operand 4 "const_int_operand")))
4954 : 792 : (clobber (reg:CC FLAGS_REG))])
4955 : 792 : (set (match_operand:DWIH 3 "memory_operand") (match_dup 2))]
4956 : 792 : "/* cltd is shorter than sarl $31, %eax */
4957 : 2085 : !optimize_function_for_size_p (cfun)
4958 : 2083 : && REGNO (operands[1]) == AX_REG
4959 : 1864 : && REGNO (operands[2]) == DX_REG
4960 : 2266 : && INTVAL (operands[4]) == (<MODE_SIZE> * BITS_PER_UNIT - 1)
4961 : 1491 : && peep2_reg_dead_p (2, operands[1])
4962 : 763 : && peep2_reg_dead_p (3, operands[2])
4963 : 96 : && !reg_mentioned_p (operands[2], operands[3])"
4964 : 667 : [(set (match_dup 0) (match_dup 1))
4965 : 679 : (parallel [(set (match_dup 1) (ashiftrt:DWIH (match_dup 1) (match_dup 4)))
4966 : 667 : (clobber (reg:CC FLAGS_REG))])
4967 : 1442 : (set (match_dup 3) (match_dup 1))])
4968 : 667 :
4969 : 775 : ;; Extend to register case. Optimize case where source and destination
4970 : 1442 : ;; registers match and cases where we can use cltd.
4971 : 1442 : (define_split
4972 : 667 : [(set (match_operand:<DWI> 0 "register_operand")
4973 : 667 : (sign_extend:<DWI> (match_operand:DWIH 1 "register_operand")))
4974 : 1844473 : (clobber (reg:CC FLAGS_REG))
4975 : 1844473 : (clobber (match_scratch:DWIH 2))]
4976 : 1854949 : "reload_completed"
4977 : 1844473 : [(const_int 0)]
4978 : 5016 : {
4979 : 5016 : rtx bits = GEN_INT (<MODE_SIZE> * BITS_PER_UNIT - 1);
4980 : 667 :
4981 : 5771 : split_double_mode (<DWI>mode, &operands[0], 1, &operands[3], &operands[4]);
4982 : 977 :
4983 : 5016 : if (REGNO (operands[3]) != REGNO (operands[1]))
4984 : 1723 : emit_move_insn (operands[3], operands[1]);
4985 : 398 :
4986 : 0 : rtx src = operands[1];
4987 : 5326 : if (REGNO (operands[3]) == AX_REG)
4988 : 2880 : src = operands[3];
4989 : 310 :
4990 : 399 : /* Generate a cltd if possible and doing so it profitable. */
4991 : 9970 : if ((optimize_function_for_size_p (cfun) || TARGET_USE_CLTD)
4992 : 5016 : && REGNO (src) == AX_REG
4993 : 8241 : && REGNO (operands[4]) == DX_REG)
4994 : 89 : {
4995 : 2880 : emit_insn (gen_ashr<mode>3_cvt (operands[4], src, bits));
4996 : 2969 : DONE;
4997 : 399 : }
4998 : 310 :
4999 : 2136 : if (REGNO (operands[4]) != REGNO (operands[1]))
5000 : 2421 : emit_move_insn (operands[4], operands[1]);
5001 : 89 :
5002 : 2136 : emit_insn (gen_ashr<mode>3_cvt (operands[4], operands[4], bits));
5003 : 2225 : DONE;
5004 : 0 : })
5005 : 0 :
5006 : 89 : (define_insn "extend<mode>di2"
5007 : 399 : [(set (match_operand:DI 0 "register_operand" "=r")
5008 : 89 : (sign_extend:DI
5009 : 310 : (match_operand:SWI12 1 "nonimmediate_operand" "<r>m")))]
5010 : 99040 : "TARGET_64BIT"
5011 : 310 : "movs{<imodesuffix>q|x}\t{%1, %0|%0, %1}"
5012 : 0 : [(set_attr "type" "imovx")
5013 : 0 : (set_attr "mode" "DI")])
5014 : 12122 :
5015 : 12084 : (define_insn "extendhisi2"
5016 : 14028 : [(set (match_operand:SI 0 "register_operand" "=*a,r")
5017 : 133 : (sign_extend:SI (match_operand:HI 1 "nonimmediate_operand" "*0,rm")))]
5018 : 46554 : ""
5019 : 70157 : {
5020 : 65281 : switch (get_attr_prefix_0f (insn))
5021 : 70940 : {
5022 : 38 : case 0:
5023 : 133 : return "{cwtl|cwde}";
5024 : 20568 : default:
5025 : 20530 : return "movs{wl|x}\t{%1, %0|%0, %1}";
5026 : 0 : }
5027 : 103 : }
5028 : 141 : [(set_attr "type" "imovx")
5029 : 46 : (set_attr "mode" "SI")
5030 : 103 : (set (attr "prefix_0f")
5031 : 128 : ;; movsx is short decodable while cwtl is vector decoded.
5032 : 46 : (if_then_else (and (eq_attr "cpu" "!k6")
5033 : 46 : (eq_attr "alternative" "0"))
5034 : 141 : (const_string "0")
5035 : 103 : (const_string "1")))
5036 : 103 : (set (attr "znver1_decode")
5037 : 103 : (if_then_else (eq_attr "prefix_0f" "0")
5038 : 103 : (const_string "double")
5039 : 501045 : (const_string "direct")))
5040 : 103 : (set (attr "modrm")
5041 : 8 : (if_then_else (eq_attr "prefix_0f" "0")
5042 : 501045 : (const_string "0")
5043 : 501045 : (const_string "1")))])
5044 : 501045 :
5045 : 501045 : (define_insn "*extendhisi2_zext"
5046 : 501045 : [(set (match_operand:DI 0 "register_operand" "=*a,r")
5047 : 501140 : (zero_extend:DI
5048 : 8 : (sign_extend:SI
5049 : 103 : (match_operand:HI 1 "nonimmediate_operand" "*0,rm"))))]
5050 : 170 : "TARGET_64BIT"
5051 : 128 : {
5052 : 33 : switch (get_attr_prefix_0f (insn))
5053 : 8 : {
5054 : 90 : case 0:
5055 : 90 : return "{cwtl|cwde}";
5056 : 110 : default:
5057 : 21 : return "movs{wl|x}\t{%1, %k0|%k0, %1}";
5058 : 8 : }
5059 : 8 : }
5060 : 9 : [(set_attr "type" "imovx")
5061 : 9 : (set_attr "mode" "SI")
5062 : 9 : (set (attr "prefix_0f")
5063 : 8233 : ;; movsx is short decodable while cwtl is vector decoded.
5064 : 9 : (if_then_else (and (eq_attr "cpu" "!k6")
5065 : 1 : (eq_attr "alternative" "0"))
5066 : 8 : (const_string "0")
5067 : 9 : (const_string "1")))
5068 : 9 : (set (attr "modrm")
5069 : 1 : (if_then_else (eq_attr "prefix_0f" "0")
5070 : 0 : (const_string "0")
5071 : 8 : (const_string "1")))])
5072 : 9 :
5073 : 9 : (define_insn "extendqisi2"
5074 : 9 : [(set (match_operand:SI 0 "register_operand" "=r")
5075 : 9 : (sign_extend:SI (match_operand:QI 1 "nonimmediate_operand" "qm")))]
5076 : 9 : ""
5077 : 9 : "movs{bl|x}\t{%1, %0|%0, %1}"
5078 : 9 : [(set_attr "type" "imovx")
5079 : 1155 : (set_attr "mode" "SI")])
5080 : 9 :
5081 : 1147 : (define_insn "*extendqisi2_zext"
5082 : 8 : [(set (match_operand:DI 0 "register_operand" "=r")
5083 : 8 : (zero_extend:DI
5084 : 8 : (sign_extend:SI (match_operand:QI 1 "nonimmediate_operand" "qm"))))]
5085 : 81 : "TARGET_64BIT"
5086 : 0 : "movs{bl|x}\t{%1, %k0|%k0, %1}"
5087 : 9 : [(set_attr "type" "imovx")
5088 : 8 : (set_attr "mode" "SI")])
5089 : 9 :
5090 : 1 : (define_insn "extendqihi2"
5091 : 9 : [(set (match_operand:HI 0 "register_operand" "=*a,r")
5092 : 8 : (sign_extend:HI (match_operand:QI 1 "nonimmediate_operand" "*0,qm")))]
5093 : 10 : ""
5094 : 8234 : {
5095 : 8234 : switch (get_attr_prefix_0f (insn))
5096 : 12 : {
5097 : 3118 : case 0:
5098 : 10 : return "{cbtw|cbw}";
5099 : 10782 : default:
5100 : 10782 : return "movs{bw|x}\t{%1, %0|%0, %1}";
5101 : 8 : }
5102 : 3120 : }
5103 : 10 : [(set_attr "type" "imovx")
5104 : 10 : (set_attr "mode" "HI")
5105 : 8 : (set (attr "prefix_0f")
5106 : 62093 : ;; movsx is short decodable while cwtl is vector decoded.
5107 : 8 : (if_then_else (and (eq_attr "cpu" "!k6")
5108 : 8 : (eq_attr "alternative" "0"))
5109 : 8 : (const_string "0")
5110 : 8 : (const_string "1")))
5111 : 8 : (set (attr "modrm")
5112 : 8 : (if_then_else (eq_attr "prefix_0f" "0")
5113 : 8 : (const_string "0")
5114 : 8 : (const_string "1")))])
5115 : 8 :
5116 : 8 : (define_insn "*extendqi<SWI24:mode>_ext_1"
5117 : 8 : [(set (match_operand:SWI24 0 "register_operand" "=R")
5118 : 8 : (sign_extend:SWI24
5119 : 8 : (subreg:QI
5120 : 8 : (match_operator:SWI248 2 "extract_operator"
5121 : 8 : [(match_operand 1 "int248_register_operand" "Q")
5122 : 8 : (const_int 8)
5123 : 8 : (const_int 8)]) 0)))]
5124 : 8 : ""
5125 : 8 : "movs{b<SWI24:imodesuffix>|x}\t{%h1, %0|%0, %h1}"
5126 : 8 : [(set_attr "type" "imovx")
5127 : 8 : (set_attr "mode" "<SWI24:MODE>")])
5128 : 8 :
5129 : 8 : ;; Conversions between float and double.
5130 : 8 :
5131 : 8 : ;; These are all no-ops in the model used for the 80387.
5132 : 8 : ;; So just emit moves.
5133 : 8 :
5134 : 8 : ;; %%% Kill these when call knows how to work out a DFmode push earlier.
5135 : 8 : (define_split
5136 : 8 : [(set (match_operand:DF 0 "push_operand")
5137 : 8 : (float_extend:DF (match_operand:SF 1 "fp_register_operand")))]
5138 : 8 : "reload_completed"
5139 : 8 : [(set (reg:P SP_REG) (plus:P (reg:P SP_REG) (const_int -8)))
5140 : 8 : (set (mem:DF (reg:P SP_REG)) (float_extend:DF (match_dup 1)))])
5141 : 8 :
5142 : 8 : (define_split
5143 : 8 : [(set (match_operand:XF 0 "push_operand")
5144 : 8 : (float_extend:XF (match_operand:MODEF 1 "fp_register_operand")))]
5145 : 8 : "reload_completed"
5146 : 8 : [(set (reg:P SP_REG) (plus:P (reg:P SP_REG) (match_dup 2)))
5147 : 8 : (set (mem:XF (reg:P SP_REG)) (float_extend:XF (match_dup 1)))]
5148 : 8 : "operands[2] = GEN_INT (-GET_MODE_SIZE (XFmode));")
5149 : 8 :
5150 : 8 : (define_expand "extendsfdf2"
5151 : 8 : [(set (match_operand:DF 0 "nonimm_ssenomem_operand")
5152 : 8 : (float_extend:DF (match_operand:SF 1 "general_operand")))]
5153 : 8 : "TARGET_80387 || (TARGET_SSE2 && TARGET_SSE_MATH)"
5154 : 142765 : {
5155 : 8 : /* ??? Needed for compress_float_constant since all fp constants
5156 : 8 : are TARGET_LEGITIMATE_CONSTANT_P. */
5157 : 8 : if (CONST_DOUBLE_P (operands[1]))
5158 : 8 : {
5159 : 9 : if ((!TARGET_SSE2 || TARGET_MIX_SSE_I387)
5160 : 9 : && standard_80387_constant_p (operands[1]) > 0)
5161 : 8 : {
5162 : 8 : operands[1] = simplify_const_unary_operation
5163 : 8 : (FLOAT_EXTEND, DFmode, operands[1], SFmode);
5164 : 8 : emit_move_insn_1 (operands[0], operands[1]);
5165 : 8 : DONE;
5166 : 8 : }
5167 : 9 : operands[1] = validize_mem (force_const_mem (SFmode, operands[1]));
5168 : 8 : }
5169 : 8 : })
5170 : 8 :
5171 : 0 : (define_insn "*extendsfdf2"
5172 : 142757 : [(set (match_operand:DF 0 "nonimm_ssenomem_operand" "=f,m,v,v")
5173 : 142765 : (float_extend:DF
5174 : 142765 : (match_operand:SF 1 "nonimmediate_operand" "fm,f,v,m")))]
5175 : 709683 : "TARGET_80387 || (TARGET_SSE2 && TARGET_SSE_MATH)"
5176 : 310462 : {
5177 : 509031 : switch (which_alternative)
5178 : 401107 : {
5179 : 448877 : case 0:
5180 : 393065 : case 1:
5181 : 287461 : return output_387_reg_move (insn, operands);
5182 : 142765 :
5183 : 142765 : case 2:
5184 : 8 : return "%vcvtss2sd\t{%d1, %0|%0, %d1}";
5185 : 83 : case 3:
5186 : 83 : return "%vcvtss2sd\t{%1, %d0|%d0, %1}";
5187 : 0 :
5188 : 26 : default:
5189 : 8 : gcc_unreachable ();
5190 : 26 : }
5191 : 26 : }
5192 : 26 : [(set_attr "type" "fmov,fmov,ssecvt,ssecvt")
5193 : 26 : (set_attr "avx_partial_xmm_update" "false,false,false,true")
5194 : 26 : (set_attr "prefix" "orig,orig,maybe_vex,maybe_vex")
5195 : 26 : (set_attr "mode" "SF,XF,DF,DF")
5196 : 8 : (set (attr "enabled")
5197 : 26 : (if_then_else
5198 : 8 : (match_test ("TARGET_SSE2 && TARGET_SSE_MATH"))
5199 : 8 : (if_then_else
5200 : 8 : (eq_attr "alternative" "0,1")
5201 : 18820 : (symbol_ref "TARGET_MIX_SSE_I387")
5202 : 8 : (symbol_ref "true"))
5203 : 8 : (if_then_else
5204 : 8 : (eq_attr "alternative" "0,1")
5205 : 8 : (symbol_ref "true")
5206 : 8 : (symbol_ref "false"))))])
5207 : 8 :
5208 : 8 : /* For converting SF(xmm2) to DF(xmm1), use the following code instead of
5209 : 8 : cvtss2sd:
5210 : 8 : unpcklps xmm2,xmm2 ; packed conversion might crash on signaling NaNs
5211 : 8 : cvtps2pd xmm2,xmm1
5212 : 8 : We do the conversion post reload to avoid producing of 128bit spills
5213 : 8 : that might lead to ICE on 32bit target. The sequence unlikely combine
5214 : 8 : anyway. */
5215 : 8 : (define_split
5216 : 8 : [(set (match_operand:DF 0 "sse_reg_operand")
5217 : 8 : (float_extend:DF
5218 : 8 : (match_operand:SF 1 "nonimmediate_operand")))]
5219 : 241146 : "TARGET_USE_VECTOR_FP_CONVERTS
5220 : 30 : && optimize_insn_for_speed_p ()
5221 : 30 : && reload_completed
5222 : 241168 : && (!EXT_REX_SSE_REG_P (operands[0])
5223 : 12 : || TARGET_AVX512VL)"
5224 : 26 : [(set (match_dup 2)
5225 : 318171 : (float_extend:V2DF
5226 : 8 : (vec_select:V2SF
5227 : 8 : (match_dup 3)
5228 : 8 : (parallel [(const_int 0) (const_int 1)]))))]
5229 : 26 : {
5230 : 26 : operands[2] = lowpart_subreg (V2DFmode, operands[0], DFmode);
5231 : 26 : operands[3] = lowpart_subreg (V4SFmode, operands[0], DFmode);
5232 : 8 : /* Use movss for loading from memory, unpcklps reg, reg for registers.
5233 : 8 : Try to avoid move when unpacking can be done in source. */
5234 : 26 : if (REG_P (operands[1]))
5235 : 8 : {
5236 : 8 : /* If it is unsafe to overwrite upper half of source, we need
5237 : 8 : to move to destination and unpack there. */
5238 : 20 : if (REGNO (operands[0]) != REGNO (operands[1])
5239 : 20 : || (EXT_REX_SSE_REG_P (operands[1]) && !TARGET_AVX512VL))
5240 : 8 : {
5241 : 12 : rtx tmp = lowpart_subreg (SFmode, operands[0], DFmode);
5242 : 12 : emit_move_insn (tmp, operands[1]);
5243 : 8 : }
5244 : 8 : else
5245 : 16 : operands[3] = lowpart_subreg (V4SFmode, operands[1], SFmode);
5246 : 8 : /* FIXME: vec_interleave_lowv4sf for AVX512VL should allow
5247 : 8 : =v, v, then vbroadcastss will be only needed for AVX512F without
5248 : 8 : AVX512VL. */
5249 : 20 : if (!EXT_REX_SSE_REGNO_P (REGNO (operands[3])))
5250 : 20 : emit_insn (gen_vec_interleave_lowv4sf (operands[3], operands[3],
5251 : 8 : operands[3]));
5252 : 8 : else
5253 : 8 : {
5254 : 8 : rtx tmp = lowpart_subreg (V16SFmode, operands[3], V4SFmode);
5255 : 8 : emit_insn (gen_avx512f_vec_dupv16sf_1 (tmp, tmp));
5256 : 8 : }
5257 : 8 : }
5258 : 8 : else
5259 : 14 : emit_insn (gen_vec_setv4sf_0 (operands[3],
5260 : 8 : CONST0_RTX (V4SFmode), operands[1]));
5261 : 8 : })
5262 : 8 :
5263 : 8 : ;; It's more profitable to split and then extend in the same register.
5264 : 26 : (define_peephole2
5265 : 18 : [(set (match_operand:DF 0 "sse_reg_operand")
5266 : 18 : (float_extend:DF
5267 : 18 : (match_operand:SF 1 "memory_operand")))]
5268 : 11813 : "TARGET_SPLIT_MEM_OPND_FOR_FP_CONVERTS
5269 : 18 : && optimize_insn_for_speed_p ()"
5270 : 18 : [(set (match_dup 2) (match_dup 1))
5271 : 18 : (set (match_dup 0) (float_extend:DF (match_dup 2)))]
5272 : 18 : "operands[2] = lowpart_subreg (SFmode, operands[0], DFmode);")
5273 : 0 :
5274 : 0 : ;; Break partial SSE register dependency stall. This splitter should split
5275 : 0 : ;; late in the pass sequence (after register rename pass), so allocated
5276 : 0 : ;; registers won't change anymore
5277 : 0 :
5278 : 0 : (define_split
5279 : 0 : [(set (match_operand:DF 0 "sse_reg_operand")
5280 : 9909 : (float_extend:DF
5281 : 9909 : (match_operand:SF 1 "nonimmediate_operand")))]
5282 : 241138 : "!TARGET_AVX
5283 : 240057 : && TARGET_SSE_PARTIAL_REG_FP_CONVERTS_DEPENDENCY
5284 : 240053 : && epilogue_completed
5285 : 139537 : && optimize_function_for_speed_p (cfun)
5286 : 136101 : && (!REG_P (operands[1])
5287 : 61450 : || (!TARGET_AVX && REGNO (operands[0]) != REGNO (operands[1])))
5288 : 77043 : && (!EXT_REX_SSE_REG_P (operands[0])
5289 : 2564 : || TARGET_AVX512VL)"
5290 : 166641 : [(set (match_dup 0)
5291 : 77043 : (vec_merge:V2DF
5292 : 0 : (vec_duplicate:V2DF
5293 : 1316125 : (float_extend:DF
5294 : 1316125 : (match_dup 1)))
5295 : 1316125 : (match_dup 0)
5296 : 1316125 : (const_int 1)))]
5297 : 1470211 : {
5298 : 77043 : operands[0] = lowpart_subreg (V2DFmode, operands[0], DFmode);
5299 : 1353980 : emit_move_insn (operands[0], CONST0_RTX (V2DFmode));
5300 : 1199894 : })
5301 : 1276937 :
5302 : 1199894 : (define_expand "extendhfsf2"
5303 : 1276937 : [(set (match_operand:SF 0 "register_operand")
5304 : 77043 : (float_extend:SF
5305 : 116373 : (match_operand:HF 1 "nonimmediate_operand")))]
5306 : 116373 : "TARGET_AVX512FP16 || TARGET_F16C || TARGET_AVX512VL"
5307 : 116373 : {
5308 : 39387 : if (!TARGET_AVX512FP16)
5309 : 78446 : {
5310 : 6 : rtx res = gen_reg_rtx (V4SFmode);
5311 : 6 : rtx tmp = gen_reg_rtx (V8HFmode);
5312 : 6 : rtx zero = force_reg (V8HFmode, CONST0_RTX (V8HFmode));
5313 : 0 :
5314 : 77049 : emit_insn (gen_vec_setv8hf_0 (tmp, zero, operands[1]));
5315 : 77049 : emit_insn (gen_vcvtph2ps (res, gen_lowpart (V8HImode, tmp)));
5316 : 6 : emit_move_insn (operands[0], gen_lowpart (SFmode, res));
5317 : 6 : DONE;
5318 : 0 : }
5319 : 0 : })
5320 : 0 :
5321 : 57 : (define_expand "extendhfdf2"
5322 : 51 : [(set (match_operand:DF 0 "register_operand")
5323 : 51 : (float_extend:DF
5324 : 108 : (match_operand:HF 1 "nonimmediate_operand")))]
5325 : 57 : "TARGET_AVX512FP16")
5326 : 57 :
5327 : 51 : (define_insn "*extendhf<mode>2"
5328 : 57 : [(set (match_operand:MODEF 0 "register_operand" "=v")
5329 : 57 : (float_extend:MODEF
5330 : 51 : (match_operand:HF 1 "nonimmediate_operand" "vm")))]
5331 : 155 : "TARGET_AVX512FP16"
5332 : 64334 : "vcvtsh2<ssemodesuffix>\t{%1, %0, %0|%0, %0, %1}"
5333 : 0 : [(set_attr "type" "ssecvt")
5334 : 0 : (set_attr "prefix" "evex")
5335 : 289012 : (set_attr "mode" "<MODE>")])
5336 : 289012 :
5337 : 8722 : (define_expand "extendbfsf2"
5338 : 268875 : [(set (match_operand:SF 0 "register_operand")
5339 : 15150 : (unspec:SF
5340 : 188232 : [(match_operand:BF 1 "register_operand")]
5341 : 188169 : UNSPEC_CVTBFSF))]
5342 : 0 : "TARGET_SSE2 && !HONOR_NANS (BFmode)")
5343 : 0 :
5344 : 0 : ;; Don't use float_extend since psrlld doesn't raise
5345 : 0 : ;; exceptions and turn a sNaN into a qNaN.
5346 : 0 : (define_insn "extendbfsf2_1"
5347 : 4 : [(set (match_operand:SF 0 "register_operand" "=x,Yv,v")
5348 : 0 : (unspec:SF
5349 : 0 : [(match_operand:BF 1 "register_operand" " 0,Yv,v")]
5350 : 4 : UNSPEC_CVTBFSF))]
5351 : 2314 : "TARGET_SSE2"
5352 : 0 : "@
5353 : 0 : pslld\t{$16, %0|%0, 16}
5354 : 0 : vpslld\t{$16, %1, %0|%0, %1, 16}
5355 : 7504 : vpslld\t{$16, %g1, %g0|%g0, %g1, 16}"
5356 : 7504 : [(set_attr "isa" "noavx,avx,*")
5357 : 0 : (set_attr "type" "sseishft1")
5358 : 7504 : (set_attr "length_immediate" "1")
5359 : 69932 : (set_attr "prefix_data16" "1,*,*")
5360 : 0 : (set_attr "prefix" "orig,maybe_evex,evex")
5361 : 7504 : (set_attr "mode" "TI,TI,XI")
5362 : 69932 : (set_attr "memory" "none")
5363 : 69932 : (set (attr "enabled")
5364 : 69932 : (if_then_else (eq_attr "alternative" "2")
5365 : 62452 : (symbol_ref "TARGET_AVX512F && TARGET_EVEX512
5366 : 62630 : && !TARGET_AVX512VL && !TARGET_PREFER_AVX256")
5367 : 62428 : (const_string "*")))])
5368 : 0 :
5369 : 0 : (define_expand "extend<mode>xf2"
5370 : 200 : [(set (match_operand:XF 0 "nonimmediate_operand")
5371 : 0 : (float_extend:XF (match_operand:MODEF 1 "general_operand")))]
5372 : 100 : "TARGET_80387"
5373 : 121092367 : {
5374 : 121017929 : /* ??? Needed for compress_float_constant since all fp constants
5375 : 0 : are TARGET_LEGITIMATE_CONSTANT_P. */
5376 : 62428 : if (CONST_DOUBLE_P (operands[1]))
5377 : 0 : {
5378 : 215 : if (standard_80387_constant_p (operands[1]) > 0)
5379 : 0 : {
5380 : 160 : operands[1] = simplify_const_unary_operation
5381 : 80 : (FLOAT_EXTEND, XFmode, operands[1], <MODE>mode);
5382 : 80 : emit_move_insn_1 (operands[0], operands[1]);
5383 : 80 : DONE;
5384 : 0 : }
5385 : 135 : operands[1] = validize_mem (force_const_mem (<MODE>mode, operands[1]));
5386 : 0 : }
5387 : 0 : })
5388 : 0 :
5389 : 0 : (define_insn "*extend<mode>xf2_i387"
5390 : 74358 : [(set (match_operand:XF 0 "nonimmediate_operand" "=f,m")
5391 : 74358 : (float_extend:XF
5392 : 10014267 : (match_operand:MODEF 1 "nonimmediate_operand" "fm,f")))]
5393 : 262527 : "TARGET_80387"
5394 : 18812 : "* return output_387_reg_move (insn, operands);"
5395 : 74358 : [(set_attr "type" "fmov")
5396 : 0 : (set_attr "mode" "<MODE>,XF")])
5397 : 52295 :
5398 : 132716 : ;; %%% This seems like bad news.
5399 : 74358 : ;; This cannot output into an f-reg because there is no way to be sure
5400 : 75448 : ;; of truncating in that case. Otherwise this is just like a simple move
5401 : 0 : ;; insn. So we pretend we can output to a reg in order to get better
5402 : 1090 : ;; register preferencing, but we really use a stack slot.
5403 : 0 :
5404 : 0 : ;; Conversion from DFmode to SFmode.
5405 : 12010 :
5406 : 6 : (define_insn "truncdfsf2"
5407 : 135637 : [(set (match_operand:SF 0 "nonimm_ssenomem_operand" "=m,f,v,v")
5408 : 12016 : (float_truncate:SF
5409 : 12010 : (match_operand:DF 1 "register_ssemem_operand" "f,f,v,m")))]
5410 : 12016 : "TARGET_80387 || (TARGET_SSE2 && TARGET_SSE_MATH)"
5411 : 150820 : {
5412 : 31620 : switch (which_alternative)
5413 : 28153 : {
5414 : 16628 : case 0:
5415 : 135822 : case 1:
5416 : 135828 : return output_387_reg_move (insn, operands);
5417 : 135637 :
5418 : 135637 : case 2:
5419 : 135637 : return "%vcvtsd2ss\t{%d1, %0|%0, %d1}";
5420 : 21 : case 3:
5421 : 27060 : return "%vcvtsd2ss\t{%1, %d0|%d0, %1}";
5422 : 27039 :
5423 : 0 : default:
5424 : 27039 : gcc_unreachable ();
5425 : 36222 : }
5426 : 37641 : }
5427 : 661 : [(set_attr "type" "fmov,fmov,ssecvt,ssecvt")
5428 : 0 : (set_attr "avx_partial_xmm_update" "false,false,false,true")
5429 : 0 : (set_attr "mode" "SF")
5430 : 498 : (set (attr "enabled")
5431 : 0 : (if_then_else
5432 : 915588 : (match_test ("TARGET_SSE2 && TARGET_SSE_MATH"))
5433 : 0 : (cond [(eq_attr "alternative" "0")
5434 : 902708 : (symbol_ref "TARGET_MIX_SSE_I387")
5435 : 0 : (eq_attr "alternative" "1")
5436 : 19498 : (symbol_ref "TARGET_MIX_SSE_I387
5437 : 3333 : && flag_unsafe_math_optimizations")
5438 : 0 : ]
5439 : 25477 : (symbol_ref "true"))
5440 : 25477 : (cond [(eq_attr "alternative" "0")
5441 : 25477 : (symbol_ref "true")
5442 : 0 : (eq_attr "alternative" "1")
5443 : 0 : (symbol_ref "flag_unsafe_math_optimizations")
5444 : 0 : ]
5445 : 0 : (symbol_ref "false"))))])
5446 : 0 :
5447 : 2320 : /* For converting DF(xmm2) to SF(xmm1), use the following code instead of
5448 : 0 : cvtsd2ss:
5449 : 0 : unpcklpd xmm2,xmm2 ; packed conversion might crash on signaling NaNs
5450 : 213344 : cvtpd2ps xmm2,xmm1
5451 : 213344 : We do the conversion post reload to avoid producing of 128bit spills
5452 : 1740 : that might lead to ICE on 32bit target. The sequence unlikely combine
5453 : 213344 : anyway. */
5454 : 213924 : (define_split
5455 : 213344 : [(set (match_operand:SF 0 "sse_reg_operand")
5456 : 213344 : (float_truncate:SF
5457 : 213344 : (match_operand:DF 1 "nonimmediate_operand")))]
5458 : 220025 : "TARGET_USE_VECTOR_FP_CONVERTS
5459 : 213360 : && optimize_insn_for_speed_p ()
5460 : 16 : && reload_completed
5461 : 12 : && (!EXT_REX_SSE_REG_P (operands[0])
5462 : 8 : || TARGET_AVX512VL)"
5463 : 6 : [(set (match_dup 2)
5464 : 7618 : (vec_concat:V4SF
5465 : 0 : (float_truncate:V2SF
5466 : 0 : (match_dup 4))
5467 : 110806739 : (match_dup 3)))]
5468 : 23152017 : {
5469 : 23152017 : operands[2] = lowpart_subreg (V4SFmode, operands[0], SFmode);
5470 : 23152017 : operands[3] = CONST0_RTX (V2SFmode);
5471 : 133908847 : operands[4] = lowpart_subreg (V2DFmode, operands[0], SFmode);
5472 : 23152011 : /* Use movsd for loading from memory, unpcklpd for registers.
5473 : 0 : Try to avoid move when unpacking can be done in source, or SSE3
5474 : 0 : movddup is available. */
5475 : 110377225 : if (REG_P (operands[1]))
5476 : 0 : {
5477 : 0 : if ((!TARGET_SSE3 && REGNO (operands[0]) != REGNO (operands[1]))
5478 : 3 : || (EXT_REX_SSE_REG_P (operands[1]) && !TARGET_AVX512VL))
5479 : 82162209 : {
5480 : 0 : rtx tmp = lowpart_subreg (DFmode, operands[0], SFmode);
5481 : 9567 : emit_move_insn (tmp, operands[1]);
5482 : 9567 : operands[1] = tmp;
5483 : 53823714 : }
5484 : 9570 : else if (!TARGET_SSE3)
5485 : 9567 : operands[4] = lowpart_subreg (V2DFmode, operands[1], DFmode);
5486 : 9570 : emit_insn (gen_vec_dupv2df (operands[4], operands[1]));
5487 : 52383353 : }
5488 : 9567 : else
5489 : 9570 : emit_insn (gen_vec_concatv2df (operands[4], operands[1],
5490 : 9567 : CONST0_RTX (DFmode)));
5491 : 9567 : })
5492 : 9567 :
5493 : 52357016 : ;; It's more profitable to split and then truncate in the same register.
5494 : 9573 : (define_peephole2
5495 : 6 : [(set (match_operand:SF 0 "sse_reg_operand")
5496 : 6 : (float_truncate:SF
5497 : 9573 : (match_operand:DF 1 "memory_operand")))]
5498 : 9722 : "TARGET_SPLIT_MEM_OPND_FOR_FP_CONVERTS
5499 : 9573 : && optimize_insn_for_speed_p ()"
5500 : 386117961 : [(set (match_dup 2) (match_dup 1))
5501 : 9573 : (set (match_dup 0) (float_truncate:SF (match_dup 2)))]
5502 : 386117955 : "operands[2] = lowpart_subreg (DFmode, operands[0], SFmode);")
5503 : 9573 :
5504 : 386108394 : ;; Break partial SSE register dependency stall. This splitter should split
5505 : 9567 : ;; late in the pass sequence (after register rename pass), so allocated
5506 : 9567 : ;; registers won't change anymore
5507 : 9567 :
5508 : 9567 : (define_split
5509 : 6 : [(set (match_operand:SF 0 "sse_reg_operand")
5510 : 25130 : (float_truncate:SF
5511 : 34691 : (match_operand:DF 1 "nonimmediate_operand")))]
5512 : 31799 : "!TARGET_AVX
5513 : 15458 : && TARGET_SSE_PARTIAL_REG_FP_CONVERTS_DEPENDENCY
5514 : 5891 : && epilogue_completed
5515 : 13053 : && optimize_function_for_speed_p (cfun)
5516 : 12894 : && (!REG_P (operands[1])
5517 : 12716 : || (!TARGET_AVX && REGNO (operands[0]) != REGNO (operands[1])))
5518 : 109284 : && (!EXT_REX_SSE_REG_P (operands[0])
5519 : 108341 : || TARGET_AVX512VL)"
5520 : 15299 : [(set (match_dup 0)
5521 : 943 : (vec_merge:V4SF
5522 : 9567 : (vec_duplicate:V4SF
5523 : 30781970 : (float_truncate:SF
5524 : 30781970 : (match_dup 1)))
5525 : 30781970 : (match_dup 0)
5526 : 30782913 : (const_int 1)))]
5527 : 30783856 : {
5528 : 379311 : operands[0] = lowpart_subreg (V4SFmode, operands[0], SFmode);
5529 : 30415055 : emit_move_insn (operands[0], CONST0_RTX (V4SFmode));
5530 : 30527623 : })
5531 : 124964 :
5532 : 30413169 : ;; Conversion from XFmode to {SF,DF}mode
5533 : 124964 :
5534 : 124964 : (define_insn "truncxf<mode>2"
5535 : 30414112 : [(set (match_operand:MODEF 0 "nonimmediate_operand" "=m,f")
5536 : 30414112 : (float_truncate:MODEF
5537 : 30414112 : (match_operand:XF 1 "register_operand" "f,f")))]
5538 : 11874 : "TARGET_80387"
5539 : 75914 : "* return output_387_reg_move (insn, operands);"
5540 : 9567 : [(set_attr "type" "fmov")
5541 : 145596 : (set_attr "mode" "<MODE>")
5542 : 145596 : (set (attr "enabled")
5543 : 257325 : (cond [(eq_attr "alternative" "1")
5544 : 135223 : (symbol_ref "flag_unsafe_math_optimizations")
5545 : 114158 : ]
5546 : 158010 : (symbol_ref "true")))])
5547 : 9624 :
5548 : 9624 : ;; Conversion from {SF,DF}mode to HFmode.
5549 : 9567 :
5550 : 45664522 : (define_expand "truncsfhf2"
5551 : 45664529 : [(set (match_operand:HF 0 "register_operand")
5552 : 69912 : (float_truncate:HF
5553 : 9866587 : (match_operand:SF 1 "nonimmediate_operand")))]
5554 : 9876161 : "TARGET_AVX512FP16 || TARGET_F16C || TARGET_AVX512VL"
5555 : 9815816 : {
5556 : 9574 : if (!TARGET_AVX512FP16)
5557 : 9574 : {
5558 : 9569 : rtx res = gen_reg_rtx (V8HFmode);
5559 : 17054220 : rtx tmp = gen_reg_rtx (V4SFmode);
5560 : 17054213 : rtx zero = force_reg (V4SFmode, CONST0_RTX (V4SFmode));
5561 : 17054211 :
5562 : 9569 : emit_insn (gen_vec_setv4sf_0 (tmp, zero, operands[1]));
5563 : 9569 : emit_insn (gen_vcvtps2ph (gen_lowpart (V8HImode, res), tmp, GEN_INT (4)));
5564 : 9569 : emit_move_insn (operands[0], gen_lowpart (HFmode, res));
5565 : 9569 : DONE;
5566 : 9567 : }
5567 : 9567 : })
5568 : 45616462 :
5569 : 9567 : (define_expand "truncdfhf2"
5570 : 36054886 : [(set (match_operand:HF 0 "register_operand")
5571 : 36045319 : (float_truncate:HF
5572 : 5 : (match_operand:DF 1 "nonimmediate_operand")))]
5573 : 5 : "TARGET_AVX512FP16")
5574 : 45538657 :
5575 : 45538662 : (define_insn "*trunc<mode>hf2"
5576 : 45538657 : [(set (match_operand:HF 0 "register_operand" "=v")
5577 : 0 : (float_truncate:HF
5578 : 45517052 : (match_operand:MODEF 1 "nonimmediate_operand" "vm")))]
5579 : 62 : "TARGET_AVX512FP16"
5580 : 1440 : "vcvt<ssemodesuffix>2sh\t{%1, %d0|%d0, %1}"
5581 : 1435 : [(set_attr "type" "ssecvt")
5582 : 0 : (set_attr "prefix" "evex")
5583 : 85 : (set_attr "mode" "HF")])
5584 : 85 :
5585 : 35 : (define_insn "truncsfbf2"
5586 : 17 : [(set (match_operand:BF 0 "register_operand" "=x, v")
5587 : 17 : (float_truncate:BF
5588 : 98 : (match_operand:SF 1 "register_operand" "x,v")))]
5589 : 72 : "((TARGET_AVX512BF16 && TARGET_AVX512VL) || TARGET_AVXNECONVERT)
5590 : 50 : && !HONOR_NANS (BFmode) && flag_unsafe_math_optimizations"
5591 : 118 : "@
5592 : 0 : %{vex%} vcvtneps2bf16\t{%1, %0|%0, %1}
5593 : 0 : vcvtneps2bf16\t{%1, %0|%0, %1}"
5594 : 702 : [(set_attr "isa" "avxneconvert,avx512bf16vl")
5595 : 3965 : (set_attr "prefix" "vex,evex")])
5596 : 661 :
5597 : 661 : ;; Signed conversion to DImode.
5598 : 4545 :
5599 : 3263 : (define_expand "fix_truncxfdi2"
5600 : 3263 : [(parallel [(set (match_operand:DI 0 "nonimmediate_operand")
5601 : 3263 : (fix:DI (match_operand:XF 1 "register_operand")))
5602 : 3263 : (clobber (reg:CC FLAGS_REG))])]
5603 : 3263 : "TARGET_80387"
5604 : 3263 : {
5605 : 3263 : if (TARGET_FISTTP)
5606 : 0 : {
5607 : 0 : emit_insn (gen_fix_truncdi_i387_fisttp (operands[0], operands[1]));
5608 : 0 : DONE;
5609 : 0 : }
5610 : 0 : })
5611 : 0 :
5612 : : (define_expand "fix_trunc<mode>di2"
5613 : 3263 : [(parallel [(set (match_operand:DI 0 "nonimmediate_operand")
5614 : 3263 : (fix:DI (match_operand:MODEF 1 "register_operand")))
5615 : 3263 : (clobber (reg:CC FLAGS_REG))])]
5616 : 3263 : "TARGET_80387 || (TARGET_64BIT && SSE_FLOAT_MODE_P (<MODE>mode))"
5617 : 21021 : {
5618 : 3475 : if (TARGET_FISTTP
5619 : 212 : && !(TARGET_64BIT && SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH))
5620 : 0 : {
5621 : 0 : emit_insn (gen_fix_truncdi_i387_fisttp (operands[0], operands[1]));
5622 : 0 : DONE;
5623 : 0 : }
5624 : 24284 : if (TARGET_64BIT && SSE_FLOAT_MODE_P (<MODE>mode))
5625 : 3263 : {
5626 : 24001 : rtx out = REG_P (operands[0]) ? operands[0] : gen_reg_rtx (DImode);
5627 : 20738 : emit_insn (gen_fix_trunc<mode>di_sse (out, operands[1]));
5628 : 20738 : if (out != operands[0])
5629 : 676 : emit_move_insn (operands[0], out);
5630 : 20738 : DONE;
5631 : 4142 : }
5632 : 0 : })
5633 : 0 :
5634 : 4142 : (define_insn "fix<fixunssuffix>_trunchf<mode>2"
5635 : 4142 : [(set (match_operand:SWI48 0 "register_operand" "=r")
5636 : 4425 : (any_fix:SWI48
5637 : 4425 : (match_operand:HF 1 "nonimmediate_operand" "vm")))]
5638 : 4447 : "TARGET_AVX512FP16"
5639 : 4142 : "vcvttsh2<fixsuffix>si\t{%1, %0|%0, %1}"
5640 : 283 : [(set_attr "type" "sseicvt")
5641 : : (set_attr "prefix" "evex")
5642 : 14553 : (set_attr "mode" "<MODE>")])
5643 : 14557 :
5644 : 0 : ;; Signed conversion to SImode.
5645 : 0 :
5646 : 283 : (define_expand "fix_truncxfsi2"
5647 : 283 : [(parallel [(set (match_operand:SI 0 "nonimmediate_operand")
5648 : 283 : (fix:SI (match_operand:XF 1 "register_operand")))
5649 : 0 : (clobber (reg:CC FLAGS_REG))])]
5650 : 0 : "TARGET_80387"
5651 : 1629 : {
5652 : 0 : if (TARGET_FISTTP)
5653 : 18508 : {
5654 : 0 : emit_insn (gen_fix_truncsi_i387_fisttp (operands[0], operands[1]));
5655 : 0 : DONE;
5656 : 18508 : }
5657 : 18508 : })
5658 : 18508 :
5659 : 18508 : (define_expand "fix_trunc<mode>si2"
5660 : 20137 : [(parallel [(set (match_operand:SI 0 "nonimmediate_operand")
5661 : 18508 : (fix:SI (match_operand:MODEF 1 "register_operand")))
5662 : 1629 : (clobber (reg:CC FLAGS_REG))])]
5663 : 1629 : "TARGET_80387 || SSE_FLOAT_MODE_P (<MODE>mode)"
5664 : 11512 : {
5665 : 1758 : if (TARGET_FISTTP
5666 : 129 : && !(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH))
5667 : 0 : {
5668 : 1 : emit_insn (gen_fix_truncsi_i387_fisttp (operands[0], operands[1]));
5669 : 1 : DONE;
5670 : 0 : }
5671 : 13140 : if (SSE_FLOAT_MODE_P (<MODE>mode))
5672 : 1629 : {
5673 : 13140 : rtx out = REG_P (operands[0]) ? operands[0] : gen_reg_rtx (SImode);
5674 : 11511 : emit_insn (gen_fix_trunc<mode>si_sse (out, operands[1]));
5675 : 11511 : if (out != operands[0])
5676 : 361 : emit_move_insn (operands[0], out);
5677 : 11511 : DONE;
5678 : 4837 : }
5679 : 0 : })
5680 : :
5681 : 4837 : ;; Signed conversion to HImode.
5682 : 4837 :
5683 : 4837 : (define_expand "fix_trunc<mode>hi2"
5684 : 4837 : [(parallel [(set (match_operand:HI 0 "nonimmediate_operand")
5685 : 4837 : (fix:HI (match_operand:X87MODEF 1 "register_operand")))
5686 : 4837 : (clobber (reg:CC FLAGS_REG))])]
5687 : 0 : "TARGET_80387
5688 : : && !(SSE_FLOAT_MODE_P (<MODE>mode) && (!TARGET_FISTTP || TARGET_SSE_MATH))"
5689 : 2251 : {
5690 : 0 : if (TARGET_FISTTP)
5691 : 0 : {
5692 : 0 : emit_insn (gen_fix_trunchi_i387_fisttp (operands[0], operands[1]));
5693 : 0 : DONE;
5694 : 0 : }
5695 : 0 : })
5696 : :
5697 : : ;; Unsigned conversion to DImode
5698 : 2251 :
5699 : 2251 : (define_insn "fixuns_trunc<mode>di2"
5700 : 8926 : [(set (match_operand:DI 0 "register_operand" "=r")
5701 : 2251 : (unsigned_fix:DI
5702 : 0 : (match_operand:MODEF 1 "nonimmediate_operand" "vm")))]
5703 : 2281 : "TARGET_64BIT && TARGET_AVX512F && TARGET_SSE_MATH"
5704 : 6675 : "vcvtt<ssemodesuffix>2usi\t{%1, %0|%0, %1}"
5705 : 6675 : [(set_attr "type" "sseicvt")
5706 : 6675 : (set_attr "prefix" "evex")
5707 : 788137535 : (set_attr "mode" "DI")])
5708 : 788137535 :
5709 : 788133101 : ;; Unsigned conversion to SImode.
5710 : 2251 :
5711 : 2256 : (define_expand "fixuns_trunc<mode>si2"
5712 : 5 : [(parallel
5713 : 666879954 : [(set (match_operand:SI 0 "register_operand")
5714 : 4 : (unsigned_fix:SI
5715 : 8 : (match_operand:MODEF 1 "nonimmediate_operand")))
5716 : 2252 : (use (match_dup 2))
5717 : 424378150 : (clobber (scratch:<ssevecmode>))
5718 : 0 : (clobber (scratch:<ssevecmode>))])]
5719 : 2252 : "(!TARGET_64BIT || TARGET_AVX512F) && TARGET_SSE2 && TARGET_SSE_MATH"
5720 : 2251 : {
5721 : 363752701 : machine_mode mode = <MODE>mode;
5722 : 2253 : machine_mode vecmode = <ssevecmode>mode;
5723 : 2253 : REAL_VALUE_TYPE TWO31r;
5724 : 2251 : rtx two31;
5725 : 1 :
5726 : 1 : if (TARGET_AVX512F)
5727 : 0 : {
5728 : 2 : emit_insn (gen_fixuns_trunc<mode>si2_avx512f (operands[0], operands[1]));
5729 : 2 : DONE;
5730 : 0 : }
5731 : 0 :
5732 : 0 : if (optimize_insn_for_size_p ())
5733 : 0 : FAIL;
5734 : 0 :
5735 : 0 : real_ldexp (&TWO31r, &dconst1, 31);
5736 : 0 : two31 = const_double_from_real_value (TWO31r, mode);
5737 : 0 : two31 = ix86_build_const_vector (vecmode, true, two31);
5738 : 0 : operands[2] = force_reg (vecmode, two31);
5739 : 0 : })
5740 : :
5741 : 0 : (define_insn "fixuns_trunc<mode>si2_avx512f"
5742 : 0 : [(set (match_operand:SI 0 "register_operand" "=r")
5743 : 0 : (unsigned_fix:SI
5744 : 0 : (match_operand:MODEF 1 "nonimmediate_operand" "vm")))]
5745 : 4 : "TARGET_AVX512F && TARGET_SSE_MATH"
5746 : 0 : "vcvtt<ssemodesuffix>2usi\t{%1, %0|%0, %1}"
5747 : 0 : [(set_attr "type" "sseicvt")
5748 : : (set_attr "prefix" "evex")
5749 : 4 : (set_attr "mode" "SI")])
5750 : 4 :
5751 : 0 : (define_insn "*fixuns_trunchfsi2zext"
5752 : : [(set (match_operand:DI 0 "register_operand" "=r")
5753 : 98 : (zero_extend:DI
5754 : 98 : (unsigned_fix:SI
5755 : 0 : (match_operand:HF 1 "nonimmediate_operand" "vm"))))]
5756 : 2 : "TARGET_64BIT && TARGET_AVX512FP16"
5757 : 4 : "vcvttsh2usi\t{%1, %k0|%k0, %1}"
5758 : 0 : [(set_attr "type" "sseicvt")
5759 : 0 : (set_attr "prefix" "evex")
5760 : 0 : (set_attr "mode" "SI")])
5761 : 0 :
5762 : 0 : (define_insn "*fixuns_trunc<mode>si2_avx512f_zext"
5763 : 0 : [(set (match_operand:DI 0 "register_operand" "=r")
5764 : : (zero_extend:DI
5765 : : (unsigned_fix:SI
5766 : 0 : (match_operand:MODEF 1 "nonimmediate_operand" "vm"))))]
5767 : 1 : "TARGET_64BIT && TARGET_AVX512F && TARGET_SSE_MATH"
5768 : 0 : "vcvtt<ssemodesuffix>2usi\t{%1, %k0|%k0, %1}"
5769 : : [(set_attr "type" "sseicvt")
5770 : 1 : (set_attr "prefix" "evex")
5771 : 0 : (set_attr "mode" "SI")])
5772 : 1 :
5773 : 0 : (define_insn_and_split "*fixuns_trunc<mode>_1"
5774 : 1 : [(set (match_operand:SI 0 "register_operand" "=&x,&x")
5775 : 61608 : (unsigned_fix:SI
5776 : 61608 : (match_operand:MODEF 3 "nonimmediate_operand" "xm,xm")))
5777 : 61607 : (use (match_operand:<ssevecmode> 4 "nonimmediate_operand" "m,x"))
5778 : 0 : (clobber (match_scratch:<ssevecmode> 1 "=x,&x"))
5779 : 61607 : (clobber (match_scratch:<ssevecmode> 2 "=x,x"))]
5780 : 0 : "!TARGET_64BIT && TARGET_SSE2 && TARGET_SSE_MATH
5781 : 61607 : && optimize_function_for_speed_p (cfun)"
5782 : 0 : "#"
5783 : 1820 : "&& reload_completed"
5784 : 1820 : [(const_int 0)]
5785 : 1820 : {
5786 : 0 : ix86_split_convert_uns_si_sse (operands);
5787 : 0 : DONE;
5788 : 0 : })
5789 : 0 :
5790 : 38694128 : ;; Unsigned conversion to HImode.
5791 : 38685390 : ;; Without these patterns, we'll try the unsigned SI conversion which
5792 : 38685390 : ;; is complex for SSE, rather than the signed SI conversion, which isn't.
5793 : 10160 :
5794 : 16 : (define_expand "fixuns_trunchfhi2"
5795 : 10192 : [(set (match_dup 2)
5796 : 29901776 : (fix:SI (match_operand:HF 1 "nonimmediate_operand")))
5797 : 19869 : (set (match_operand:HI 0 "nonimmediate_operand")
5798 : 30029 : (subreg:HI (match_dup 2) 0))]
5799 : 30030 : "TARGET_AVX512FP16"
5800 : 22887567 : "operands[2] = gen_reg_rtx (SImode);")
5801 : :
5802 : 24005 : (define_expand "fixuns_trunc<mode>hi2"
5803 : 24004 : [(set (match_dup 2)
5804 : 15834609 : (fix:SI (match_operand:MODEF 1 "nonimmediate_operand")))
5805 : 13844 : (set (match_operand:HI 0 "nonimmediate_operand")
5806 : 23846 : (subreg:HI (match_dup 2) 0))]
5807 : 23846 : "SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH"
5808 : 23845 : "operands[2] = gen_reg_rtx (SImode);")
5809 : :
5810 : 17644 : ;; When SSE is available, it is always faster to use it!
5811 : 21769 : (define_insn "fix_trunc<MODEF:mode><SWI48:mode>_sse"
5812 : 21769 : [(set (match_operand:SWI48 0 "register_operand" "=r,r")
5813 : 1 : (fix:SWI48 (match_operand:MODEF 1 "nonimmediate_operand" "v,m")))]
5814 : 70520 : "SSE_FLOAT_MODE_P (<MODEF:MODE>mode)
5815 : 91267 : && (!TARGET_FISTTP || TARGET_SSE_MATH)"
5816 : 14126 : "%vcvtt<MODEF:ssemodesuffix>2si<SWI48:rex64suffix>\t{%1, %0|%0, %1}"
5817 : 20001 : [(set_attr "type" "sseicvt")
5818 : 4127 : (set_attr "prefix" "maybe_vex")
5819 : 20779 : (set (attr "prefix_rex")
5820 : 20778 : (if_then_else
5821 : 4126 : (match_test "<SWI48:MODE>mode == DImode")
5822 : 0 : (const_string "1")
5823 : 494463 : (const_string "*")))
5824 : 29501 : (set_attr "mode" "<MODEF:MODE>")
5825 : 524305 : (set_attr "athlon_decode" "double,vector")
5826 : 28758 : (set_attr "amdfam10_decode" "double,double")
5827 : 9060 : (set_attr "bdver1_decode" "double,double")])
5828 : 726 :
5829 : 726 : ;; Avoid vector decoded forms of the instruction.
5830 : 726 : (define_peephole2
5831 : 726 : [(match_scratch:MODEF 2 "x")
5832 : 4126 : (set (match_operand:SWI48 0 "register_operand")
5833 : 726 : (fix:SWI48 (match_operand:MODEF 1 "memory_operand")))]
5834 : 5895 : "TARGET_AVOID_VECTOR_DECODE
5835 : 3405 : && SSE_FLOAT_MODE_P (<MODEF:MODE>mode)
5836 : 3405 : && optimize_insn_for_speed_p ()"
5837 : 4598 : [(set (match_dup 2) (match_dup 1))
5838 : 3535 : (set (match_dup 0) (fix:SWI48 (match_dup 2)))])
5839 : 3535 :
5840 : 132 : (define_insn "fix_trunc<mode>_i387_fisttp"
5841 : 3967 : [(set (match_operand:SWI248x 0 "nonimmediate_operand" "=m")
5842 : 566 : (fix:SWI248x (match_operand 1 "register_operand" "f")))
5843 : 132 : (clobber (match_scratch:XF 2 "=&f"))]
5844 : 20410 : "X87_FLOAT_MODE_P (GET_MODE (operands[1]))
5845 : 20174 : && TARGET_FISTTP
5846 : 14522 : && !((SSE_FLOAT_MODE_P (GET_MODE (operands[1]))
5847 : 331 : && (TARGET_64BIT || <MODE>mode != DImode))
5848 : 533 : && TARGET_SSE_MATH)"
5849 : 362 : "* return output_fix_trunc (insn, operands, true);"
5850 : 283 : [(set_attr "type" "fisttp")
5851 : 283 : (set_attr "mode" "<MODE>")])
5852 : 285 :
5853 : 32288 : ;; See the comments in i386.h near OPTIMIZE_MODE_SWITCHING for the description
5854 : 281 : ;; of the machinery. Please note the clobber of FLAGS_REG. In i387 control
5855 : 279 : ;; word calculation (inserted by LCM in mode switching pass) a FLAGS_REG
5856 : 7639 : ;; clobbering insns can be used. Look at emit_i387_cw_initialization ()
5857 : 7642 : ;; function in i386.cc.
5858 : 15281 : (define_insn_and_split "*fix_trunc<mode>_i387_1"
5859 : 3 : [(set (match_operand:SWI248x 0 "nonimmediate_operand")
5860 : 7639 : (fix:SWI248x (match_operand 1 "register_operand")))
5861 : 0 : (clobber (reg:CC FLAGS_REG))]
5862 : 35339 : "X87_FLOAT_MODE_P (GET_MODE (operands[1]))
5863 : 39603 : && !TARGET_FISTTP
5864 : 34855 : && !(SSE_FLOAT_MODE_P (GET_MODE (operands[1]))
5865 : 0 : && (TARGET_64BIT || <MODE>mode != DImode))
5866 : 23249 : && ix86_pre_reload_split ()"
5867 : 12090 : "#"
5868 : 8184 : "&& 1"
5869 : 8184 : [(const_int 0)]
5870 : 14852 : {
5871 : 18202 : ix86_optimize_mode_switching[I387_TRUNC] = 1;
5872 : 97949 :
5873 : 18653 : operands[2] = assign_386_stack_local (HImode, SLOT_CW_STORED);
5874 : 101586 : operands[3] = assign_386_stack_local (HImode, SLOT_CW_TRUNC);
5875 : 851 :
5876 : 80555 : emit_insn (gen_fix_trunc<mode>_i387 (operands[0], operands[1],
5877 : 952372 : operands[2], operands[3]));
5878 : 7478 : DONE;
5879 : 58 : }
5880 : 826311 : [(set_attr "type" "fistp")
5881 : 80949 : (set_attr "i387_cw" "trunc")
5882 : 749861 : (set_attr "mode" "<MODE>")])
5883 : 749861 :
5884 : 0 : (define_insn "fix_truncdi_i387"
5885 : 482129 : [(set (match_operand:DI 0 "nonimmediate_operand" "=m")
5886 : 80948 : (fix:DI (match_operand 1 "register_operand" "f")))
5887 : 401181 : (use (match_operand:HI 2 "memory_operand" "m"))
5888 : 0 : (use (match_operand:HI 3 "memory_operand" "m"))
5889 : 122347 : (clobber (match_scratch:XF 4 "=&f"))]
5890 : 159725 : "X87_FLOAT_MODE_P (GET_MODE (operands[1]))
5891 : 136054 : && !TARGET_FISTTP
5892 : 129510 : && !(TARGET_64BIT && SSE_FLOAT_MODE_P (GET_MODE (operands[1])))"
5893 : 153273 : "* return output_fix_trunc (insn, operands, false);"
5894 : 5175 : [(set_attr "type" "fistp")
5895 : 0 : (set_attr "i387_cw" "trunc")
5896 : 5175 : (set_attr "mode" "DI")])
5897 : 4317 :
5898 : 6806 : (define_insn "fix_trunc<mode>_i387"
5899 : 1 : [(set (match_operand:SWI24 0 "nonimmediate_operand" "=m")
5900 : 13415 : (fix:SWI24 (match_operand 1 "register_operand" "f")))
5901 : 1 : (use (match_operand:HI 2 "memory_operand" "m"))
5902 : 1 : (use (match_operand:HI 3 "memory_operand" "m"))]
5903 : 24785 : "X87_FLOAT_MODE_P (GET_MODE (operands[1]))
5904 : 11396 : && !TARGET_FISTTP
5905 : 11396 : && !SSE_FLOAT_MODE_P (GET_MODE (operands[1]))"
5906 : 2251 : "* return output_fix_trunc (insn, operands, false);"
5907 : 1 : [(set_attr "type" "fistp")
5908 : 0 : (set_attr "i387_cw" "trunc")
5909 : 4590 : (set_attr "mode" "<MODE>")])
5910 : 49275 :
5911 : 1 : (define_insn "x86_fnstcw_1"
5912 : 1 : [(set (match_operand:HI 0 "memory_operand" "=m")
5913 : 38705 : (unspec:HI [(const_int 0)] UNSPEC_FSTCW))]
5914 : 7505 : "TARGET_80387"
5915 : 239 : "fnstcw\t%0"
5916 : 1 : [(set (attr "length")
5917 : 236 : (symbol_ref "ix86_attr_length_address_default (insn) + 2"))
5918 : 237 : (set_attr "mode" "HI")
5919 : 136 : (set_attr "unit" "i387")
5920 : 38494 : (set_attr "bdver1_decode" "vector")])
5921 : 1 :
5922 : 29 : ;; Conversion between fixed point and floating point.
5923 : 38179 :
5924 : 0 : ;; Even though we only accept memory inputs, the backend _really_
5925 : : ;; wants to be able to do this between registers. Thankfully, LRA
5926 : 0 : ;; will fix this up for us during register allocation.
5927 : 0 :
5928 : : (define_insn "floathi<mode>2"
5929 : 0 : [(set (match_operand:X87MODEF 0 "register_operand" "=f")
5930 : 0 : (float:X87MODEF (match_operand:HI 1 "nonimmediate_operand" "m")))]
5931 : 482 : "TARGET_80387
5932 : 1327 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
5933 : 1291 : || TARGET_MIX_SSE_I387)"
5934 : 640134 : "fild%Z1\t%1"
5935 : 0 : [(set_attr "type" "fmov")
5936 : 3 : (set_attr "mode" "<MODE>")
5937 : 195908 : (set_attr "znver1_decode" "double")
5938 : 196592 : (set_attr "fp_int_src" "true")])
5939 : 0 :
5940 : 0 : (define_insn "float<SWI48x:mode>xf2"
5941 : 0 : [(set (match_operand:XF 0 "register_operand" "=f")
5942 : 0 : (float:XF (match_operand:SWI48x 1 "nonimmediate_operand" "m")))]
5943 : 6288 : "TARGET_80387"
5944 : 0 : "fild%Z1\t%1"
5945 : 0 : [(set_attr "type" "fmov")
5946 : 0 : (set_attr "mode" "XF")
5947 : 9798 : (set_attr "znver1_decode" "double")
5948 : 9798 : (set_attr "fp_int_src" "true")])
5949 : 0 :
5950 : 0 : (define_expand "float<SWI48x:mode><MODEF:mode>2"
5951 : 744 : [(set (match_operand:MODEF 0 "register_operand")
5952 : 744 : (float:MODEF (match_operand:SWI48x 1 "nonimmediate_operand")))]
5953 : 0 : "(TARGET_80387 && X87_ENABLE_FLOAT (<MODEF:MODE>mode, <SWI48x:MODE>mode))
5954 : 728 : || (SSE_FLOAT_MODE_P (<MODEF:MODE>mode) && TARGET_SSE_MATH
5955 : 728 : && ((<SWI48x:MODE>mode != DImode) || TARGET_64BIT))")
5956 : 0 :
5957 : 0 : (define_insn "*float<SWI48:mode><MODEF:mode>2"
5958 : 0 : [(set (match_operand:MODEF 0 "register_operand" "=f,v,v")
5959 : 0 : (float:MODEF
5960 : 0 : (match_operand:SWI48 1 "nonimmediate_operand" "m,r,m")))]
5961 : 317602 : "(TARGET_80387 && X87_ENABLE_FLOAT (<MODEF:MODE>mode, <SWI48:MODE>mode))
5962 : 126415 : || (SSE_FLOAT_MODE_P (<MODEF:MODE>mode) && TARGET_SSE_MATH)"
5963 : 2251 : "@
5964 : 2251 : fild%Z1\t%1
5965 : 0 : %vcvtsi2<MODEF:ssemodesuffix><SWI48:rex64suffix>\t{%1, %d0|%d0, %1}
5966 : 127982 : %vcvtsi2<MODEF:ssemodesuffix><SWI48:rex64suffix>\t{%1, %d0|%d0, %1}"
5967 : 125731 : [(set_attr "type" "fmov,sseicvt,sseicvt")
5968 : : (set_attr "avx_partial_xmm_update" "false,true,true")
5969 : : (set_attr "prefix" "orig,maybe_vex,maybe_vex")
5970 : 0 : (set_attr "mode" "<MODEF:MODE>")
5971 : : (set (attr "prefix_rex")
5972 : 0 : (if_then_else
5973 : 0 : (and (eq_attr "prefix" "maybe_vex")
5974 : 0 : (match_test "<SWI48:MODE>mode == DImode"))
5975 : 0 : (const_string "1")
5976 : 0 : (const_string "*")))
5977 : 0 : (set_attr "unit" "i387,*,*")
5978 : 0 : (set_attr "athlon_decode" "*,double,direct")
5979 : : (set_attr "amdfam10_decode" "*,vector,double")
5980 : : (set_attr "bdver1_decode" "*,double,direct")
5981 : : (set_attr "znver1_decode" "double,*,*")
5982 : : (set_attr "fp_int_src" "true")
5983 : 0 : (set (attr "enabled")
5984 : 0 : (if_then_else
5985 : 0 : (match_test ("SSE_FLOAT_MODE_P (<MODEF:MODE>mode) && TARGET_SSE_MATH"))
5986 : 0 : (if_then_else
5987 : 0 : (eq_attr "alternative" "0")
5988 : 22607 : (symbol_ref "TARGET_MIX_SSE_I387
5989 : 108 : && X87_ENABLE_FLOAT (<MODEF:MODE>mode,
5990 : 62806 : <SWI48:MODE>mode)")
5991 : : (symbol_ref "true"))
5992 : : (if_then_else
5993 : : (eq_attr "alternative" "0")
5994 : : (symbol_ref "true")
5995 : : (symbol_ref "false"))))
5996 : : (set (attr "preferred_for_speed")
5997 : 0 : (cond [(eq_attr "alternative" "1")
5998 : 42135 : (symbol_ref "TARGET_INTER_UNIT_CONVERSIONS")]
5999 : 0 : (symbol_ref "true")))])
6000 : 2709 :
6001 : 0 : (define_insn "float<floatunssuffix><mode>hf2"
6002 : : [(set (match_operand:HF 0 "register_operand" "=v")
6003 : : (any_float:HF
6004 : 0 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")))]
6005 : 733 : "TARGET_AVX512FP16"
6006 : 52700 : "vcvt<floatsuffix>si2sh<rex64suffix>\t{%1, %d0|%d0, %1}"
6007 : 52700 : [(set_attr "type" "sseicvt")
6008 : 52700 : (set_attr "prefix" "evex")
6009 : 10 : (set_attr "mode" "HF")])
6010 : 17572 :
6011 : 0 : (define_insn "*floatdi<MODEF:mode>2_i387"
6012 : : [(set (match_operand:MODEF 0 "register_operand" "=f")
6013 : 0 : (float:MODEF (match_operand:DI 1 "nonimmediate_operand" "m")))]
6014 : 2195 : "!TARGET_64BIT
6015 : 2160 : && TARGET_80387 && X87_ENABLE_FLOAT (<MODEF:MODE>mode, DImode)"
6016 : 0 : "fild%Z1\t%1"
6017 : : [(set_attr "type" "fmov")
6018 : : (set_attr "mode" "<MODEF:MODE>")
6019 : 0 : (set_attr "znver1_decode" "double")
6020 : 0 : (set_attr "fp_int_src" "true")])
6021 : 0 :
6022 : 0 : ;; Try TARGET_USE_VECTOR_CONVERTS, but not so hard as to require extra memory
6023 : 252279 : ;; slots when !TARGET_INTER_UNIT_MOVES_TO_VEC disables the general_regs
6024 : 252279 : ;; alternative in sse2_loadld.
6025 : : (define_split
6026 : 3135 : [(set (match_operand:MODEF 0 "sse_reg_operand")
6027 : 3135 : (float:MODEF (match_operand:SI 1 "nonimmediate_operand")))]
6028 : 111842 : "TARGET_SSE2
6029 : 111795 : && TARGET_USE_VECTOR_CONVERTS
6030 : 16 : && optimize_function_for_speed_p (cfun)
6031 : 14 : && reload_completed
6032 : 14 : && (MEM_P (operands[1]) || TARGET_INTER_UNIT_MOVES_TO_VEC)
6033 : 111856 : && (!EXT_REX_SSE_REG_P (operands[0])
6034 : 0 : || TARGET_AVX512VL)"
6035 : 14 : [(const_int 0)]
6036 : 111842 : {
6037 : 14 : operands[3] = lowpart_subreg (<ssevecmode>mode, operands[0], <MODE>mode);
6038 : 14 : operands[4] = lowpart_subreg (V4SImode, operands[0], <MODE>mode);
6039 : 0 :
6040 : 14 : emit_insn (gen_sse2_loadld (operands[4],
6041 : 0 : CONST0_RTX (V4SImode), operands[1]));
6042 : 0 :
6043 : 799 : if (<ssevecmode>mode == V4SFmode)
6044 : 788 : emit_insn (gen_floatv4siv4sf2 (operands[3], operands[4]));
6045 : 785 : else
6046 : 796 : emit_insn (gen_sse2_cvtdq2pd (operands[3], operands[4]));
6047 : 799 : DONE;
6048 : 785 : })
6049 : 785 :
6050 : 785 : ;; Avoid store forwarding (partial memory) stall penalty
6051 : 178113 : ;; by passing DImode value through XMM registers. */
6052 : 178120 :
6053 : 178113 : (define_split
6054 : 178113 : [(set (match_operand:X87MODEF 0 "register_operand")
6055 : 7 : (float:X87MODEF
6056 : 0 : (match_operand:DI 1 "register_operand")))]
6057 : 26168 : "!TARGET_64BIT && TARGET_INTER_UNIT_MOVES_TO_VEC
6058 : 722 : && TARGET_80387 && X87_ENABLE_FLOAT (<X87MODEF:MODE>mode, DImode)
6059 : 23312 : && TARGET_SSE2 && optimize_function_for_speed_p (cfun)
6060 : 23331 : && can_create_pseudo_p ()"
6061 : 45918 : [(const_int 0)]
6062 : 267427 : {
6063 : 153755 : rtx s = assign_386_stack_local (DImode, SLOT_FLOATxFDI_387);
6064 : 336726 : emit_insn (gen_floatdi<mode>2_i387_with_xmm (operands[0], operands[1], s));
6065 : 23331 : DONE;
6066 : 22601 : })
6067 : 22601 :
6068 : 1800085 : (define_insn_and_split "floatdi<X87MODEF:mode>2_i387_with_xmm"
6069 : 1800085 : [(set (match_operand:X87MODEF 0 "register_operand" "=f,f")
6070 : 22601 : (float:X87MODEF
6071 : 177809 : (match_operand:DI 1 "register_operand" "r,r")))
6072 : 155208 : (clobber (match_operand:DI 2 "memory_operand" "=m,m"))
6073 : 14360 : (clobber (match_scratch:V4SI 3 "=x,x"))
6074 : 22601 : (clobber (match_scratch:V4SI 4 "=X,x"))]
6075 : 26087 : "!TARGET_64BIT && TARGET_INTER_UNIT_MOVES_TO_VEC
6076 : 3486 : && TARGET_80387 && X87_ENABLE_FLOAT (<X87MODEF:MODE>mode, DImode)
6077 : 3489 : && TARGET_SSE2 && optimize_function_for_speed_p (cfun)"
6078 : 759 : "#"
6079 : 16 : "&& reload_completed"
6080 : 1422 : [(set (match_dup 2) (match_dup 3))
6081 : 1414 : (set (match_dup 0) (float:X87MODEF (match_dup 2)))]
6082 : 4080 : {
6083 : 703 : /* The DImode arrived in a pair of integral registers (e.g. %edx:%eax).
6084 : 2820 : Assemble the 64-bit DImode value in an xmm register. */
6085 : 41428 : emit_insn (gen_sse2_loadld (operands[3], CONST0_RTX (V4SImode),
6086 : 47966 : gen_lowpart (SImode, operands[1])));
6087 : 73335 : if (TARGET_SSE4_1)
6088 : 72616 : emit_insn (gen_sse4_1_pinsrd (operands[3], operands[3],
6089 : 5938 : gen_highpart (SImode, operands[1]),
6090 : 5954 : GEN_INT (2)));
6091 : 5954 : else
6092 : 7 : {
6093 : 6709 : emit_insn (gen_sse2_loadld (operands[4], CONST0_RTX (V4SImode),
6094 : 5998 : gen_highpart (SImode, operands[1])));
6095 : 6709 : emit_insn (gen_vec_interleave_lowv4si (operands[3], operands[3],
6096 : 5938 : operands[4]));
6097 : 5997 : }
6098 : 6708 : operands[3] = gen_lowpart (DImode, operands[3]);
6099 : 5938 : }
6100 : 5961 : [(set_attr "isa" "sse4,*")
6101 : 143271 : (set_attr "type" "multi")
6102 : 143982 : (set_attr "mode" "<X87MODEF:MODE>")
6103 : 143982 : (set_attr "unit" "i387")
6104 : 6672 : (set_attr "fp_int_src" "true")])
6105 : 138044 :
6106 : 242128 : ;; Break partial SSE register dependency stall. This splitter should split
6107 : 242105 : ;; late in the pass sequence (after register rename pass), so allocated
6108 : 242115 : ;; registers won't change anymore
6109 : 242105 :
6110 : 242105 : (define_split
6111 : 137310 : [(set (match_operand:MODEF 0 "sse_reg_operand")
6112 : 242105 : (float:MODEF (match_operand:SWI48 1 "nonimmediate_operand")))]
6113 : 80426 : "!TARGET_AVX
6114 : 191741 : && TARGET_SSE_PARTIAL_REG_CONVERTS_DEPENDENCY
6115 : 192444 : && epilogue_completed
6116 : 112924 : && optimize_function_for_speed_p (cfun)
6117 : 221556 : && (!EXT_REX_SSE_REG_P (operands[0])
6118 : 0 : || TARGET_AVX512VL)"
6119 : 61834 : [(set (match_dup 0)
6120 : 0 : (vec_merge:<MODEF:ssevecmode>
6121 : 266487 : (vec_duplicate:<MODEF:ssevecmode>
6122 : 259567 : (float:MODEF
6123 : 389633 : (match_dup 1)))
6124 : 0 : (match_dup 0)
6125 : 132074 : (const_int 1)))]
6126 : 241091 : {
6127 : 241091 : const machine_mode vmode = <MODEF:ssevecmode>mode;
6128 : 131371 :
6129 : 214969 : operands[0] = lowpart_subreg (vmode, operands[0], <MODEF:MODE>mode);
6130 : 241091 : emit_move_insn (operands[0], CONST0_RTX (vmode));
6131 : 105952 : })
6132 : 106655 :
6133 : 105952 : (define_expand "floatuns<SWI12:mode><MODEF:mode>2"
6134 : 214969 : [(set (match_operand:MODEF 0 "register_operand")
6135 : 214969 : (unsigned_float:MODEF
6136 : 214969 : (match_operand:SWI12 1 "nonimmediate_operand")))]
6137 : 214969 : "!TARGET_64BIT
6138 : 214969 : && SSE_FLOAT_MODE_P (<MODEF:MODE>mode) && TARGET_SSE_MATH"
6139 : 105952 : {
6140 : 105952 : operands[1] = convert_to_mode (SImode, operands[1], 1);
6141 : 105952 : emit_insn (gen_floatsi<MODEF:mode>2 (operands[0], operands[1]));
6142 : 105952 : DONE;
6143 : 105952 : })
6144 : 105952 :
6145 : 214969 : (define_insn "*floatuns<SWI48:mode><MODEF:mode>2_avx512"
6146 : 214969 : [(set (match_operand:MODEF 0 "register_operand" "=v")
6147 : 214969 : (unsigned_float:MODEF
6148 : 105952 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")))]
6149 : 106219 : "TARGET_AVX512F && TARGET_SSE_MATH"
6150 : 105952 : "vcvtusi2<MODEF:ssemodesuffix><SWI48:rex64suffix>\t{%1, %0, %0|%0, %0, %1}"
6151 : 105952 : [(set_attr "type" "sseicvt")
6152 : 105952 : (set_attr "avx_partial_xmm_update" "true")
6153 : 189600 : (set_attr "prefix" "evex")
6154 : 106052 : (set_attr "mode" "<MODEF:MODE>")])
6155 : 189550 :
6156 : 105952 : ;; Avoid store forwarding (partial memory) stall penalty by extending
6157 : 189550 : ;; SImode value to DImode through XMM register instead of pushing two
6158 : 189550 : ;; SImode values to stack. Also note that fild loads from memory only.
6159 : 105952 :
6160 : 189550 : (define_insn_and_split "floatunssi<mode>2_i387_with_xmm"
6161 : 105952 : [(set (match_operand:X87MODEF 0 "register_operand" "=f")
6162 : 105960 : (unsigned_float:X87MODEF
6163 : 105952 : (match_operand:SI 1 "nonimmediate_operand" "rm")))
6164 : 105960 : (clobber (match_operand:DI 2 "memory_operand" "=m"))
6165 : 105952 : (clobber (match_scratch:DI 3 "=x"))]
6166 : 106004 : "!TARGET_64BIT
6167 : 106297 : && TARGET_80387 && X87_ENABLE_FLOAT (<X87MODEF:MODE>mode, DImode)
6168 : 106297 : && TARGET_SSE2 && TARGET_INTER_UNIT_MOVES_TO_VEC"
6169 : 105960 : "#"
6170 : 105968 : "&& reload_completed"
6171 : 105970 : [(set (match_dup 3) (zero_extend:DI (match_dup 1)))
6172 : 106004 : (set (match_dup 2) (match_dup 3))
6173 : 106342 : (set (match_dup 0)
6174 : 105972 : (float:X87MODEF (match_dup 2)))]
6175 : 106128 : ""
6176 : 169100 : [(set_attr "type" "multi")
6177 : 169100 : (set_attr "mode" "<MODE>")])
6178 : 183665 :
6179 : 183665 : (define_expand "floatunssi<mode>2"
6180 : 168954 : [(set (match_operand:X87MODEF 0 "register_operand")
6181 : 183665 : (unsigned_float:X87MODEF
6182 : 185109 : (match_operand:SI 1 "nonimmediate_operand")))]
6183 : 107448 : "(!TARGET_64BIT
6184 : 23322308 : && TARGET_80387 && X87_ENABLE_FLOAT (<X87MODEF:MODE>mode, DImode)
6185 : 23322308 : && TARGET_SSE2 && TARGET_INTER_UNIT_MOVES_TO_VEC)
6186 : 23322308 : || ((!TARGET_64BIT || TARGET_AVX512F)
6187 : 23322256 : && SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)"
6188 : 23322346 : {
6189 : 23322377 : if (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH))
6190 : 23244595 : {
6191 : 183717 : emit_insn (gen_floatunssi<mode>2_i387_with_xmm
6192 : 183613 : (operands[0], operands[1],
6193 : 19534795 : assign_386_stack_local (DImode, SLOT_TEMP)));
6194 : 19612560 : DONE;
6195 : 183665 : }
6196 : 19534833 : if (!TARGET_AVX512F)
6197 : 183613 : {
6198 : 18441211 : ix86_expand_convert_uns_si<mode>_sse (operands[0], operands[1]);
6199 : 18441211 : DONE;
6200 : 179201 : }
6201 : 179244 : })
6202 : 12621155 :
6203 : 12620385 : (define_expand "floatunsdisf2"
6204 : 25168722 : [(set (match_operand:SF 0 "register_operand")
6205 : 105995 : (unsigned_float:SF
6206 : 12612002 : (match_operand:DI 1 "nonimmediate_operand")))]
6207 : 24950050 : "TARGET_64BIT && TARGET_SSE && TARGET_SSE_MATH"
6208 : 107523 : {
6209 : 106077 : if (!TARGET_AVX512F)
6210 : 105952 : {
6211 : 107471 : x86_emit_floatuns (operands);
6212 : 107465 : DONE;
6213 : 378250 : }
6214 : 378250 : })
6215 : 378212 :
6216 : 378212 : (define_expand "floatunsdidf2"
6217 : 378221 : [(set (match_operand:DF 0 "register_operand")
6218 : 378221 : (unsigned_float:DF
6219 : 379752 : (match_operand:DI 1 "nonimmediate_operand")))]
6220 : 378221 : "((TARGET_64BIT && TARGET_AVX512F)
6221 : 378212 : || TARGET_KEEPS_VECTOR_ALIGNED_STACK)
6222 : 378221 : && TARGET_SSE2 && TARGET_SSE_MATH"
6223 : 379743 : {
6224 : 382880 : if (!TARGET_64BIT)
6225 : 378221 : {
6226 : 378212 : ix86_expand_convert_uns_didf_sse (operands[0], operands[1]);
6227 : 382879 : DONE;
6228 : 378212 : }
6229 : 381349 : if (!TARGET_AVX512F)
6230 : 378212 : {
6231 : 381339 : x86_emit_floatuns (operands);
6232 : 381339 : DONE;
6233 : 378212 : }
6234 : 378212 : })
6235 : 381349 :
6236 : 381349 : ;; Load effective address instructions
6237 : 381359 :
6238 : 381359 : (define_insn "*lea<mode>"
6239 : 381359 : [(set (match_operand:SWI48 0 "register_operand" "=r")
6240 : 381349 : (match_operand:SWI48 1 "address_no_seg_operand" "Ts"))]
6241 : 21669876 : "ix86_hardreg_mov_ok (operands[0], operands[1])"
6242 : 3212610 : {
6243 : 3212600 : if (SImode_address_operand (operands[1], VOIDmode))
6244 : 378212 : {
6245 : 28138754 : gcc_assert (TARGET_64BIT);
6246 : 28109192 : return "lea{l}\t{%E1, %k0|%k0, %E1}";
6247 : 22575330 : }
6248 : 38314552 : else
6249 : 384685 : return "lea{<imodesuffix>}\t{%E1, %0|%0, %E1}";
6250 : 105952 : }
6251 : 384685 : [(set_attr "type" "lea")
6252 : : (set (attr "mode")
6253 : 6314249 : (if_then_else
6254 : 10597955 : (match_operand 1 "SImode_address_operand")
6255 : 6314249 : (const_string "SI")
6256 : 6314249 : (const_string "<MODE>")))])
6257 : 6313558 :
6258 : 6314249 : (define_peephole2
6259 : 6313558 : [(set (match_operand:SWI48 0 "register_operand")
6260 : 6313558 : (match_operand:SWI48 1 "address_no_seg_operand"))]
6261 : 17096113 : "ix86_hardreg_mov_ok (operands[0], operands[1])
6262 : 17096113 : && peep2_regno_dead_p (0, FLAGS_REG)
6263 : 17014914 : && ix86_avoid_lea_for_addr (peep2_next_insn (0), operands)"
6264 : 6313558 : [(const_int 0)]
6265 : 2706 : {
6266 : 7937395 : machine_mode mode = <MODE>mode;
6267 : 691 :
6268 : 0 : /* Emit all operations in SImode for zero-extended addresses. */
6269 : 7936704 : if (SImode_address_operand (operands[1], VOIDmode))
6270 : 13913691 : mode = SImode;
6271 : 13913501 :
6272 : 3998140 : ix86_split_lea_for_addr (peep2_next_insn (0), operands, mode);
6273 : 9917376 :
6274 : 9917376 : /* Zero-extend return register to DImode for zero-extended addresses. */
6275 : 7936013 : if (mode != <MODE>mode)
6276 : 17040 : emit_insn (gen_zero_extendsidi2 (operands[0],
6277 : 7951729 : gen_lowpart (mode, operands[0])));
6278 : 7951539 :
6279 : 7953554 : DONE;
6280 : 7934689 : })
6281 : 16850 :
6282 : 13635744 : ;; ix86_split_lea_for_addr emits the shifts as MULT to avoid it from being
6283 : 13635744 : ;; peephole2 optimized back into a lea. Split that into the shift during
6284 : 13635744 : ;; the following split pass.
6285 : 13635831 : (define_split
6286 : 13618894 : [(set (match_operand:SWI48 0 "general_reg_operand")
6287 : 13618894 : (mult:SWI48 (match_dup 0) (match_operand:SWI48 1 "const1248_operand")))
6288 : 13618894 : (clobber (reg:CC FLAGS_REG))]
6289 : 6 : "reload_completed"
6290 : 122345 : [(parallel [(set (match_dup 0) (ashift:SWI48 (match_dup 0) (match_dup 1)))
6291 : 2 : (clobber (reg:CC FLAGS_REG))])]
6292 : 1340 : "operands[1] = GEN_INT (exact_log2 (INTVAL (operands[1])));")
6293 : 268828 :
6294 : 270154 : ;; Add instructions
6295 : 265499 :
6296 : 264175 : (define_expand "add<mode>3"
6297 : 270160 : [(set (match_operand:SDWIM 0 "nonimmediate_operand")
6298 : 0 : (plus:SDWIM (match_operand:SDWIM 1 "nonimmediate_operand")
6299 : 10 : (match_operand:SDWIM 2 "<general_hilo_operand>")))]
6300 : : ""
6301 : 8982081 : {
6302 : 8982081 : ix86_expand_binary_operator (PLUS, <MODE>mode, operands, TARGET_APX_NDD);
6303 : 8982081 : DONE;
6304 : 0 : })
6305 : 0 :
6306 : 8 : (define_insn_and_split "*add<dwi>3_doubleword"
6307 : 1552433 : [(set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,r,&r,&r,&r,&r,&r")
6308 : 1552433 : (plus:<DWI>
6309 : : (match_operand:<DWI> 1 "nonimmediate_operand" "%0,0,ro,r,ro,jO,r")
6310 : 0 : (match_operand:<DWI> 2 "x86_64_hilo_general_operand" "r<di>,o,r,<di>,K,<di>,r")))
6311 : : (clobber (reg:CC FLAGS_REG))]
6312 : 47151212 : "ix86_binary_operator_ok (PLUS, <DWI>mode, operands, TARGET_APX_NDD)"
6313 : 44172 : "#"
6314 : 46394 : "&& reload_completed"
6315 : 23239 : [(parallel [(set (reg:CCC FLAGS_REG)
6316 : 8938870 : (compare:CCC
6317 : 8882741 : (plus:DWIH (match_dup 1) (match_dup 2))
6318 : 17790149 : (match_dup 1)))
6319 : 231402 : (set (match_dup 0)
6320 : 7105650 : (plus:DWIH (match_dup 1) (match_dup 2)))])
6321 : 6 : (parallel [(set (match_dup 3)
6322 : 6673971 : (plus:DWIH
6323 : 44172 : (plus:DWIH
6324 : 0 : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0))
6325 : 8937909 : (match_dup 4))
6326 : 13021 : (match_dup 5)))
6327 : 0 : (clobber (reg:CC FLAGS_REG))])]
6328 : 36188 : {
6329 : 23167 : split_double_mode (<DWI>mode, &operands[0], 3, &operands[0], &operands[3]);
6330 : 8961076 : if (operands[2] == const0_rtx)
6331 : 8950930 : {
6332 : 8950930 : /* Under NDD op0 and op1 may not equal, do not delete insn then. */
6333 : 8951771 : bool emit_insn_deleted_note_p = true;
6334 : 841 : if (!rtx_equal_p (operands[0], operands[1]))
6335 : 8950930 : {
6336 : 0 : emit_move_insn (operands[0], operands[1]);
6337 : 13021 : emit_insn_deleted_note_p = false;
6338 : 0 : }
6339 : 841 : if (operands[5] != const0_rtx)
6340 : 816 : ix86_expand_binary_operator (PLUS, <MODE>mode, &operands[3],
6341 : 816 : TARGET_APX_NDD);
6342 : 25 : else if (!rtx_equal_p (operands[3], operands[4]))
6343 : 0 : emit_move_insn (operands[3], operands[4]);
6344 : 25 : else if (emit_insn_deleted_note_p)
6345 : 25 : emit_note (NOTE_INSN_DELETED);
6346 : 841 : DONE;
6347 : 0 : }
6348 : 0 : }
6349 : 712773 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd,apx_ndd,apx_ndd_64,apx_ndd")])
6350 : 712773 :
6351 : 22326 : (define_insn_and_split "*add<dwi>3_doubleword_zext"
6352 : 22326 : [(set (match_operand:<DWI> 0 "nonimmediate_operand" "=r,o,&r,&r")
6353 : 735099 : (plus:<DWI>
6354 : 735099 : (zero_extend:<DWI>
6355 : 735099 : (match_operand:DWIH 2 "nonimmediate_operand" "rm,r,rm,r"))
6356 : 22326 : (match_operand:<DWI> 1 "nonimmediate_operand" "0,0,r,m")))
6357 : 735099 : (clobber (reg:CC FLAGS_REG))]
6358 : 804759 : "ix86_binary_operator_ok (UNKNOWN, <DWI>mode, operands, TARGET_APX_NDD)"
6359 : 735099 : "#"
6360 : 738039 : "&& reload_completed"
6361 : 735099 : [(parallel [(set (reg:CCC FLAGS_REG)
6362 : 23795 : (compare:CCC
6363 : 22326 : (plus:DWIH (match_dup 1) (match_dup 2))
6364 : 626 : (match_dup 1)))
6365 : 1252 : (set (match_dup 0)
6366 : 0 : (plus:DWIH (match_dup 1) (match_dup 2)))])
6367 : 0 : (parallel [(set (match_dup 3)
6368 : 223903 : (plus:DWIH
6369 : 223903 : (plus:DWIH
6370 : 223903 : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0))
6371 : 223903 : (match_dup 4))
6372 : 223903 : (const_int 0)))
6373 : : (clobber (reg:CC FLAGS_REG))])]
6374 : 14618 : "split_double_mode (<DWI>mode, &operands[0], 2, &operands[0], &operands[3]);"
6375 : 13149 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")])
6376 : 22326 :
6377 : 1475 : (define_insn_and_split "*add<dwi>3_doubleword_concat"
6378 : 1481 : [(set (match_operand:<DWI> 0 "register_operand" "=&r")
6379 : 1469 : (plus:<DWI>
6380 : 1469 : (any_or_plus:<DWI>
6381 : 1469 : (ashift:<DWI>
6382 : 1469 : (zero_extend:<DWI>
6383 : 1469 : (match_operand:DWIH 2 "nonimmediate_operand" "rm"))
6384 : 1469 : (match_operand:QI 3 "const_int_operand"))
6385 : 1469 : (zero_extend:<DWI>
6386 : 1469 : (match_operand:DWIH 4 "nonimmediate_operand" "rm")))
6387 : 1469 : (match_operand:<DWI> 1 "register_operand" "0")))
6388 : 22326 : (clobber (reg:CC FLAGS_REG))]
6389 : 26301 : "INTVAL (operands[3]) == <MODE_SIZE> * BITS_PER_UNIT"
6390 : 22326 : "#"
6391 : 6 : "&& reload_completed"
6392 : 0 : [(parallel [(set (reg:CCC FLAGS_REG)
6393 : 667 : (compare:CCC
6394 : 0 : (plus:DWIH (match_dup 1) (match_dup 4))
6395 : 1328 : (match_dup 1)))
6396 : 13958 : (set (match_dup 0)
6397 : : (plus:DWIH (match_dup 1) (match_dup 4)))])
6398 : 11302 : (parallel [(set (match_dup 5)
6399 : 11302 : (plus:DWIH
6400 : 1469 : (plus:DWIH
6401 : 11302 : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0))
6402 : 11302 : (match_dup 6))
6403 : 11302 : (match_dup 2)))
6404 : 1156 : (clobber (reg:CC FLAGS_REG))])]
6405 : 10813 : "split_double_mode (<DWI>mode, &operands[0], 2, &operands[0], &operands[5]);")
6406 : 1156 :
6407 : 10146 : (define_insn_and_split "*add<dwi>3_doubleword_concat_zext"
6408 : 667 : [(set (match_operand:<DWI> 0 "register_operand" "=&r")
6409 : 667 : (plus:<DWI>
6410 : 667 : (any_or_plus:<DWI>
6411 : 667 : (ashift:<DWI>
6412 : 1469 : (zero_extend:<DWI>
6413 : 1469 : (match_operand:DWIH 2 "nonimmediate_operand" "rm"))
6414 : 2136 : (match_operand:QI 3 "const_int_operand"))
6415 : 667 : (zero_extend:<DWI>
6416 : 705 : (match_operand:DWIH 4 "nonimmediate_operand" "rm")))
6417 : 667 : (zero_extend:<DWI>
6418 : 705 : (match_operand:DWIH 1 "nonimmediate_operand" "rm"))))
6419 : 705 : (clobber (reg:CC FLAGS_REG))]
6420 : 1042 : "INTVAL (operands[3]) == <MODE_SIZE> * BITS_PER_UNIT"
6421 : 667 : "#"
6422 : 705 : "&& reload_completed"
6423 : 316 : [(set (match_dup 0) (match_dup 4))
6424 : 323 : (parallel [(set (reg:CCC FLAGS_REG)
6425 : 316 : (compare:CCC
6426 : 330 : (plus:DWIH (match_dup 0) (match_dup 1))
6427 : 344 : (match_dup 0)))
6428 : 313 : (set (match_dup 0)
6429 : 0 : (plus:DWIH (match_dup 0) (match_dup 1)))])
6430 : 6343 : (set (match_dup 5) (match_dup 2))
6431 : 3384 : (parallel [(set (match_dup 5)
6432 : 2646 : (plus:DWIH
6433 : 0 : (plus:DWIH
6434 : 1106 : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0))
6435 : 667 : (match_dup 5))
6436 : 13 : (const_int 0)))
6437 : 26 : (clobber (reg:CC FLAGS_REG))])]
6438 : 7 : "split_double_mode (<DWI>mode, &operands[0], 1, &operands[0], &operands[5]);")
6439 : 0 :
6440 : 0 : (define_insn "*add<mode>_1"
6441 : 7 : [(set (match_operand:SWI48 0 "nonimmediate_operand" "=rm,r,r,r,r,r,r")
6442 : 7 : (plus:SWI48
6443 : 7 : (match_operand:SWI48 1 "nonimmediate_operand" "%0,0,r,r,rje,jM,r")
6444 : 7 : (match_operand:SWI48 2 "x86_64_general_operand" "re,BM,0,le,r,e,BM")))
6445 : 7 : (clobber (reg:CC FLAGS_REG))]
6446 : 35372400 : "ix86_binary_operator_ok (PLUS, <MODE>mode, operands, TARGET_APX_NDD)"
6447 : 4202637 : {
6448 : 2144808 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
6449 : 4256645 : switch (get_attr_type (insn))
6450 : 40507 : {
6451 : 40507 : case TYPE_LEA:
6452 : 76339 : return "#";
6453 : 7 :
6454 : 19805 : case TYPE_INCDEC:
6455 : 20476 : if (operands[2] == const1_rtx)
6456 : 18292 : return use_ndd ? "inc{<imodesuffix>}\t{%1, %0|%0, %1}"
6457 : 3011897 : : "inc{<imodesuffix>}\t%0";
6458 : 2993605 : else
6459 : 2993605 : {
6460 : 2995118 : gcc_assert (operands[2] == constm1_rtx);
6461 : 2177 : return use_ndd ? "dec{<imodesuffix>}\t{%1, %0|%0, %1}"
6462 : 2177 : : "dec{<imodesuffix>}\t%0";
6463 : 664 : }
6464 : 0 :
6465 : 4182829 : default:
6466 : 0 : /* For most processors, ADD is faster than LEA. This alternative
6467 : 664 : was added to use ADD as much as possible. */
6468 : 4182172 : if (which_alternative == 2)
6469 : 11196 : std::swap (operands[1], operands[2]);
6470 : 7 :
6471 : 4182165 : if (x86_maybe_negate_const_int (&operands[2], <MODE>mode))
6472 : 857704 : return use_ndd ? "sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
6473 : 857704 : : "sub{<imodesuffix>}\t{%2, %0|%0, %2}";
6474 : :
6475 : 3324461 : return use_ndd ? "add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
6476 : 0 : : "add{<imodesuffix>}\t{%2, %0|%0, %2}";
6477 : : }
6478 : : }
6479 : : [(set_attr "isa" "*,*,*,*,apx_ndd,apx_ndd,apx_ndd")
6480 : : (set (attr "type")
6481 : : (cond [(eq_attr "alternative" "3")
6482 : 2120525 : (const_string "lea")
6483 : 7 : (match_operand:SWI48 2 "incdec_operand")
6484 : 7 : (const_string "incdec")
6485 : 0 : ]
6486 : 0 : (const_string "alu")))
6487 : 0 : (set (attr "length_immediate")
6488 : : (if_then_else
6489 : : (and (eq_attr "type" "alu") (match_operand 2 "const128_operand"))
6490 : 14 : (const_string "1")
6491 : 0 : (const_string "*")))
6492 : 14 : (set_attr "mode" "<MODE>")])
6493 : 14 :
6494 : 14 : ;; It may seem that nonimmediate operand is proper one for operand 1.
6495 : 14 : ;; The addsi_1 pattern allows nonimmediate operand at that place and
6496 : 7 : ;; we take care in ix86_binary_operator_ok to not allow two memory
6497 : 0 : ;; operands so proper swapping will be done in reload. This allow
6498 : 7 : ;; patterns constructed from addsi_1 to match.
6499 : 7 :
6500 : 0 : (define_insn "addsi_1_zext"
6501 : 7 : [(set (match_operand:DI 0 "register_operand" "=r,r,r,r,r,r")
6502 : : (zero_extend:DI
6503 : : (plus:SI (match_operand:SI 1 "nonimmediate_operand" "%0,r,r,r,rm,rjM")
6504 : 0 : (match_operand:SI 2 "x86_64_general_operand" "rBMe,0,le,rBMe,r,e"))))
6505 : 0 : (clobber (reg:CC FLAGS_REG))]
6506 : 22597 : "TARGET_64BIT
6507 : 20161 : && ix86_binary_operator_ok (PLUS, SImode, operands, TARGET_APX_NDD)"
6508 : 14040 : {
6509 : 10142 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
6510 : 10142 : switch (get_attr_type (insn))
6511 : 34 : {
6512 : 34 : case TYPE_LEA:
6513 : 275 : return "#";
6514 : 34 :
6515 : 149 : case TYPE_INCDEC:
6516 : 390 : if (operands[2] == const1_rtx)
6517 : 69 : return use_ndd ? "inc{l}\t{%1, %k0|%k0, %1}"
6518 : 70 : : "inc{l}\t%k0";
6519 : 2 : else
6520 : 1 : {
6521 : 48 : gcc_assert (operands[2] == constm1_rtx);
6522 : 48 : return use_ndd ? "dec{l}\t{%1, %k0|%k0, %1}"
6523 : 48 : : "dec{l}\t%k0";
6524 : 1 : }
6525 : 1 :
6526 : 8575 : default:
6527 : 1 : /* For most processors, ADD is faster than LEA. This alternative
6528 : 1 : was added to use ADD as much as possible. */
6529 : 8574 : if (which_alternative == 1)
6530 : 20 : std::swap (operands[1], operands[2]);
6531 : 1 :
6532 : 8576 : if (x86_maybe_negate_const_int (&operands[2], SImode))
6533 : 1874 : return use_ndd ? "sub{l}\t{%2 ,%1, %k0|%k0, %1, %2}"
6534 : 1872 : : "sub{l}\t{%2, %k0|%k0, %2}";
6535 : 0 :
6536 : 6701 : return use_ndd ? "add{l}\t{%2 ,%1, %k0|%k0, %1, %2}"
6537 : : : "add{l}\t{%2, %k0|%k0, %2}";
6538 : : }
6539 : : }
6540 : 0 : [(set_attr "isa" "*,*,*,apx_ndd,apx_ndd,apx_ndd")
6541 : : (set (attr "type")
6542 : : (cond [(eq_attr "alternative" "2")
6543 : 4312 : (const_string "lea")
6544 : : (match_operand:SI 2 "incdec_operand")
6545 : : (const_string "incdec")
6546 : : ]
6547 : : (const_string "alu")))
6548 : : (set (attr "length_immediate")
6549 : 0 : (if_then_else
6550 : 0 : (and (eq_attr "type" "alu") (match_operand 2 "const128_operand"))
6551 : 0 : (const_string "1")
6552 : 0 : (const_string "*")))
6553 : 0 : (set_attr "mode" "SI")])
6554 : :
6555 : : (define_insn "*addhi_1"
6556 : : [(set (match_operand:HI 0 "nonimmediate_operand" "=rm,r,r,Yp,r,r")
6557 : 0 : (plus:HI (match_operand:HI 1 "nonimmediate_operand" "%0,0,r,Yp,rm,r")
6558 : : (match_operand:HI 2 "general_operand" "rn,m,0,ln,rn,m")))
6559 : : (clobber (reg:CC FLAGS_REG))]
6560 : 71707 : "ix86_binary_operator_ok (PLUS, HImode, operands, TARGET_APX_NDD)"
6561 : 4312 : {
6562 : 34656 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
6563 : 34656 : switch (get_attr_type (insn))
6564 : 84984 : {
6565 : 84984 : case TYPE_LEA:
6566 : 160616 : return "#";
6567 : 113283 :
6568 : 113301 : case TYPE_INCDEC:
6569 : 208386 : if (operands[2] == const1_rtx)
6570 : 22 : return use_ndd ? "inc{w}\t{%1, %0|%0, %1}" : "inc{w}\t%0";
6571 : : else
6572 : 0 : {
6573 : 7 : gcc_assert (operands[2] == constm1_rtx);
6574 : 14 : return use_ndd ? "dec{w}\t{%1, %0|%0, %1}" : "dec{w}\t%0";
6575 : : }
6576 : :
6577 : 4294 : default:
6578 : : /* For most processors, ADD is faster than LEA. This alternative
6579 : : was added to use ADD as much as possible. */
6580 : 4294 : if (which_alternative == 2)
6581 : 0 : std::swap (operands[1], operands[2]);
6582 : 0 :
6583 : 4294 : if (x86_maybe_negate_const_int (&operands[2], HImode))
6584 : 371 : return use_ndd ? "sub{w}\t{%2, %1, %0|%0, %1, %2}"
6585 : 371 : : "sub{w}\t{%2, %0|%0, %2}";
6586 : 0 :
6587 : 3923 : return use_ndd ? "add{w}\t{%2, %1, %0|%0, %1, %2}"
6588 : 0 : : "add{w}\t{%2, %0|%0, %2}";
6589 : 0 : }
6590 : 0 : }
6591 : 0 : [(set_attr "isa" "*,*,*,*,apx_ndd,apx_ndd")
6592 : 0 : (set (attr "type")
6593 : 0 : (cond [(eq_attr "alternative" "3")
6594 : 3030 : (const_string "lea")
6595 : 0 : (match_operand:HI 2 "incdec_operand")
6596 : 0 : (const_string "incdec")
6597 : 0 : ]
6598 : 0 : (const_string "alu")))
6599 : 0 : (set (attr "length_immediate")
6600 : 0 : (if_then_else
6601 : 30386719 : (and (eq_attr "type" "alu") (match_operand 2 "const128_operand"))
6602 : 30386719 : (const_string "1")
6603 : 30386719 : (const_string "*")))
6604 : 30386719 : (set_attr "mode" "HI,HI,HI,SI,HI,HI")])
6605 : 30386719 :
6606 : 30386719 : (define_insn "*addqi_1"
6607 : 30386719 : [(set (match_operand:QI 0 "nonimmediate_operand" "=qm,q,q,r,r,Yp,r,r")
6608 : 30386719 : (plus:QI (match_operand:QI 1 "nonimmediate_operand" "%0,0,q,0,r,Yp,rm,r")
6609 : 30386719 : (match_operand:QI 2 "general_operand" "qn,m,0,rn,0,ln,rn,m")))
6610 : 30386719 : (clobber (reg:CC FLAGS_REG))]
6611 : 30557436 : "ix86_binary_operator_ok (PLUS, QImode, operands, TARGET_APX_NDD)"
6612 : 30389749 : {
6613 : 30447962 : bool widen = (get_attr_mode (insn) != MODE_QI);
6614 : 30447962 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
6615 : 30390464 : switch (get_attr_type (insn))
6616 : 30387434 : {
6617 : 30387434 : case TYPE_LEA:
6618 : 30390828 : return "#";
6619 : 30390828 :
6620 : 30390852 : case TYPE_INCDEC:
6621 : 30386743 : if (operands[2] == const1_rtx)
6622 : 30386734 : if (use_ndd)
6623 : 30386719 : return "inc{b}\t{%1, %0|%0, %1}";
6624 : 30386719 : else
6625 : 30 : return widen ? "inc{l}\t%k0" : "inc{b}\t%0";
6626 : 0 : else
6627 : 30386719 : {
6628 : 30386728 : gcc_assert (operands[2] == constm1_rtx);
6629 : 30386728 : if (use_ndd)
6630 : 0 : return "dec{b}\t{%1, %0|%0, %1}";
6631 : 30386719 : else
6632 : 30386737 : return widen ? "dec{l}\t%k0" : "dec{b}\t%0";
6633 : 30386719 : }
6634 : 30386719 :
6635 : 30389725 : default:
6636 : 30386719 : /* For most processors, ADD is faster than LEA. These alternatives
6637 : 30386719 : were added to use ADD as much as possible. */
6638 : 30389725 : if (which_alternative == 2 || which_alternative == 4)
6639 : 30386719 : std::swap (operands[1], operands[2]);
6640 : 30386719 :
6641 : 30389725 : if (x86_maybe_negate_const_int (&operands[2], QImode))
6642 : 30386719 : {
6643 : 30386946 : if (use_ndd)
6644 : 30386719 : return "sub{b}\t{%2, %1, %0|%0, %1, %2}";
6645 : 30386719 : else
6646 : 30386940 : return widen ? "sub{l}\t{%2, %k0|%k0, %2}"
6647 : 30386940 : : "sub{b}\t{%2, %0|%0, %2}";
6648 : 30386719 : }
6649 : 2779 : if (use_ndd)
6650 : 0 : return "add{b}\t{%2, %1, %0|%0, %1, %2}";
6651 : 30386719 : else
6652 : 30389484 : return widen ? "add{l}\t{%k2, %k0|%k0, %k2}"
6653 : 30389484 : : "add{b}\t{%2, %0|%0, %2}";
6654 : 0 : }
6655 : 30386719 : }
6656 : 30386719 : [(set_attr "isa" "*,*,*,*,*,*,apx_ndd,apx_ndd")
6657 : 30386719 : (set (attr "type")
6658 : 0 : (cond [(eq_attr "alternative" "5")
6659 : 30386859 : (const_string "lea")
6660 : 30386719 : (match_operand:QI 2 "incdec_operand")
6661 : 30386719 : (const_string "incdec")
6662 : 30386719 : ]
6663 : 30386719 : (const_string "alu")))
6664 : 30386719 : (set (attr "length_immediate")
6665 : 30386719 : (if_then_else
6666 : 30386719 : (and (eq_attr "type" "alu") (match_operand 2 "const128_operand"))
6667 : 30386719 : (const_string "1")
6668 : 30386719 : (const_string "*")))
6669 : 30386719 : (set_attr "mode" "QI,QI,QI,SI,SI,SI,QI,QI")
6670 : 30386719 : ;; Potential partial reg stall on alternatives 3 and 4.
6671 : 0 : (set (attr "preferred_for_speed")
6672 : 0 : (cond [(eq_attr "alternative" "3,4")
6673 : 0 : (symbol_ref "!TARGET_PARTIAL_REG_STALL")]
6674 : 0 : (symbol_ref "true")))])
6675 : 0 :
6676 : 0 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
6677 : 0 : (define_insn_and_split "*add<mode>_1_slp"
6678 : 0 : [(set (strict_low_part (match_operand:SWI12 0 "register_operand" "+<r>,&<r>"))
6679 : 0 : (plus:SWI12 (match_operand:SWI12 1 "nonimmediate_operand" "%0,!<r>")
6680 : 0 : (match_operand:SWI12 2 "general_operand" "<r>mn,<r>mn")))
6681 : 0 : (clobber (reg:CC FLAGS_REG))]
6682 : 195 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
6683 : 517 : {
6684 : 257 : if (which_alternative)
6685 : 117 : return "#";
6686 : 99 :
6687 : 339 : switch (get_attr_type (insn))
6688 : 0 : {
6689 : 1747448 : case TYPE_INCDEC:
6690 : 1747448 : if (operands[2] == const1_rtx)
6691 : 1746956 : return "inc{<imodesuffix>}\t%0";
6692 : 15475429 : else
6693 : 11182160 : {
6694 : 178859 : gcc_assert (operands[2] == constm1_rtx);
6695 : 15475380 : return "dec{<imodesuffix>}\t%0";
6696 : 15474694 : }
6697 : 695 :
6698 : 935 : default:
6699 : 592 : if (x86_maybe_negate_const_int (&operands[2], QImode))
6700 : 345 : return "sub{<imodesuffix>}\t{%2, %0|%0, %2}";
6701 : 1 :
6702 : 2 : return "add{<imodesuffix>}\t{%2, %0|%0, %2}";
6703 : 1 : }
6704 : : }
6705 : 686 : "&& reload_completed
6706 : 678 : && !(rtx_equal_p (operands[0], operands[1])
6707 : 103 : || rtx_equal_p (operands[0], operands[2]))"
6708 : 683 : [(set (strict_low_part (match_dup 0)) (match_dup 1))
6709 : 103 : (parallel
6710 : : [(set (strict_low_part (match_dup 0))
6711 : 396 : (plus:SWI12 (match_dup 0) (match_dup 2)))
6712 : 396 : (clobber (reg:CC FLAGS_REG))])]
6713 : : ""
6714 : : [(set (attr "type")
6715 : 0 : (if_then_else (match_operand:QI 2 "incdec_operand")
6716 : 103 : (const_string "incdec")
6717 : 1320239 : (const_string "alu")))
6718 : 103 : (set_attr "mode" "<MODE>")])
6719 : 1320239 :
6720 : 1320239 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
6721 : 1320239 : (define_insn_and_split "*addqi_ext<mode>_1_slp"
6722 : 1320239 : [(set (strict_low_part (match_operand:QI 0 "register_operand" "+Q,&Q"))
6723 : 1320378 : (plus:QI
6724 : 1320136 : (subreg:QI
6725 : 1320239 : (match_operator:SWI248 3 "extract_operator"
6726 : 0 : [(match_operand 2 "int248_register_operand" "Q,Q")
6727 : 1241713 : (const_int 8)
6728 : 1241713 : (const_int 8)]) 0)
6729 : 1241713 : (match_operand:QI 1 "nonimmediate_operand" "0,!qm")))
6730 : 1241713 : (clobber (reg:CC FLAGS_REG))]
6731 : 14 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
6732 : 9 : "@
6733 : 1241818 : add{b}\t{%h2, %0|%0, %h2}
6734 : 105 : #"
6735 : 132 : "&& reload_completed
6736 : 35 : && !rtx_equal_p (operands[0], operands[1])"
6737 : 0 : [(set (strict_low_part (match_dup 0)) (match_dup 1))
6738 : 1241715 : (parallel
6739 : 2 : [(set (strict_low_part (match_dup 0))
6740 : 1241737 : (plus:QI
6741 : 120 : (subreg:QI
6742 : 1241713 : (match_op_dup 3
6743 : 260 : [(match_dup 2) (const_int 8) (const_int 8)]) 0)
6744 : 260 : (match_dup 0)))
6745 : 1241743 : (clobber (reg:CC FLAGS_REG))])]
6746 : 1241745 : ""
6747 : 1241747 : [(set_attr "type" "alu")
6748 : 1241647 : (set_attr "mode" "QI")])
6749 : 96 :
6750 : 818899 : (define_insn_and_split "*addqi_ext<mode>_2_slp"
6751 : 818899 : [(set (strict_low_part (match_operand:QI 0 "register_operand" "+&Q"))
6752 : 1628372 : (plus:QI
6753 : 0 : (subreg:QI
6754 : 0 : (match_operator:SWI248 3 "extract_operator"
6755 : 0 : [(match_operand 1 "int248_register_operand" "Q")
6756 : 0 : (const_int 8)
6757 : 0 : (const_int 8)]) 0)
6758 : : (subreg:QI
6759 : 0 : (match_operator:SWI248 4 "extract_operator"
6760 : 0 : [(match_operand 2 "int248_register_operand" "Q")
6761 : : (const_int 8)
6762 : : (const_int 8)]) 0)))
6763 : 0 : (clobber (reg:CC FLAGS_REG))]
6764 : 5 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
6765 : : "#"
6766 : 2 : "&& reload_completed"
6767 : 19 : [(set (strict_low_part (match_dup 0))
6768 : 10 : (subreg:QI
6769 : 0 : (match_op_dup 4
6770 : 9 : [(match_dup 2) (const_int 8) (const_int 8)]) 0))
6771 : 22 : (parallel
6772 : 0 : [(set (strict_low_part (match_dup 0))
6773 : 0 : (plus:QI
6774 : 0 : (subreg:QI
6775 : 0 : (match_op_dup 3
6776 : 0 : [(match_dup 1) (const_int 8) (const_int 8)]) 0)
6777 : 0 : (match_dup 0)))
6778 : 0 : (clobber (reg:CC FLAGS_REG))])]
6779 : 0 : ""
6780 : 0 : [(set_attr "type" "alu")
6781 : 1 : (set_attr "mode" "QI")])
6782 : 10 :
6783 : 11 : ;; Split non destructive adds if we cannot use lea.
6784 : 11 : (define_split
6785 : 11 : [(set (match_operand:SWI48 0 "register_operand")
6786 : 11 : (plus:SWI48 (match_operand:SWI48 1 "register_operand")
6787 : 11 : (match_operand:SWI48 2 "x86_64_nonmemory_operand")))
6788 : 0 : (clobber (reg:CC FLAGS_REG))]
6789 : 15327122 : "reload_completed && ix86_avoid_lea_for_add (insn, operands)"
6790 : 11 : [(set (match_dup 0) (match_dup 1))
6791 : 3931590 : (parallel [(set (match_dup 0) (plus:SWI48 (match_dup 0) (match_dup 2)))
6792 : 10 : (clobber (reg:CC FLAGS_REG))])])
6793 : 0 :
6794 : 0 : ;; Split non destructive adds if we cannot use lea.
6795 : 0 : (define_split
6796 : 0 : [(set (match_operand:DI 0 "register_operand")
6797 : 0 : (zero_extend:DI
6798 : 0 : (plus:SI (match_operand:SI 1 "register_operand")
6799 : 0 : (match_operand:SI 2 "x86_64_nonmemory_operand"))))
6800 : 10 : (clobber (reg:CC FLAGS_REG))]
6801 : 9867 : "TARGET_64BIT
6802 : 9867 : && reload_completed && ix86_avoid_lea_for_add (insn, operands)"
6803 : 0 : [(set (match_dup 3) (match_dup 1))
6804 : 9842 : (parallel [(set (match_dup 0)
6805 : : (zero_extend:DI (plus:SI (match_dup 3) (match_dup 2))))
6806 : : (clobber (reg:CC FLAGS_REG))])]
6807 : 0 : "operands[3] = gen_lowpart (SImode, operands[0]);")
6808 : :
6809 : 0 : ;; Convert add to the lea pattern to avoid flags dependency.
6810 : 0 : (define_split
6811 : 0 : [(set (match_operand:SWI 0 "register_operand")
6812 : 0 : (plus:SWI (match_operand:SWI 1 "register_operand")
6813 : 10 : (match_operand:SWI 2 "<nonmemory_operand>")))
6814 : 10 : (clobber (reg:CC FLAGS_REG))]
6815 : 15380358 : "reload_completed && ix86_lea_for_add_ok (insn, operands)"
6816 : 6324986 : [(set (match_dup 0)
6817 : 428718 : (plus:<LEAMODE> (match_dup 1) (match_dup 2)))]
6818 : 0 : {
6819 : 2119815 : if (<MODE>mode != <LEAMODE>mode)
6820 : 37484 : {
6821 : 107300 : operands[0] = gen_lowpart (<LEAMODE>mode, operands[0]);
6822 : 146567 : operands[1] = gen_lowpart (<LEAMODE>mode, operands[1]);
6823 : 51761 : operands[2] = gen_lowpart (<LEAMODE>mode, operands[2]);
6824 : 34358 : }
6825 : 31806 : })
6826 : 76384 :
6827 : 20 : ;; Convert add to the lea pattern to avoid flags dependency.
6828 : 0 : (define_split
6829 : 20 : [(set (match_operand:DI 0 "register_operand")
6830 : 11 : (zero_extend:DI
6831 : 20 : (plus:SI (match_operand:SI 1 "register_operand")
6832 : 1992474 : (match_operand:SI 2 "x86_64_nonmemory_operand"))))
6833 : 1992474 : (clobber (reg:CC FLAGS_REG))]
6834 : 2002341 : "TARGET_64BIT && reload_completed && ix86_lea_for_add_ok (insn, operands)"
6835 : 8025 : [(set (match_dup 0)
6836 : 16934 : (zero_extend:DI (plus:SI (match_dup 1) (match_dup 2))))])
6837 : :
6838 : 1992474 : (define_insn "*add<mode>_2"
6839 : 1992463 : [(set (reg FLAGS_REG)
6840 : 2007533 : (compare
6841 : 15070 : (plus:SWI
6842 : 15070 : (match_operand:SWI 1 "nonimmediate_operand" "%0,0,<r>,rm,r")
6843 : 0 : (match_operand:SWI 2 "<general_operand>" "<r><i>,<m>,0,r<i>,<m>"))
6844 : 15070 : (const_int 0)))
6845 : 11 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,<r>,<r>,r,r")
6846 : 1979257 : (plus:SWI (match_dup 1) (match_dup 2)))]
6847 : 292 : "ix86_match_ccmode (insn, CCGOCmode)
6848 : 2022259 : && ix86_binary_operator_ok (PLUS, <MODE>mode, operands, TARGET_APX_NDD)"
6849 : 2016382 : {
6850 : 1979488 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
6851 : 2014437 : switch (get_attr_type (insn))
6852 : 2024642 : {
6853 : 89597 : case TYPE_INCDEC:
6854 : 1981047 : if (operands[2] == const1_rtx)
6855 : 2407 : return use_ndd ? "inc{<imodesuffix>}\t{%1, %0|%0, %1}"
6856 : 2407 : : "inc{<imodesuffix>}\t%0";
6857 : 1864 : else
6858 : 1864 : {
6859 : 3122 : gcc_assert (operands[2] == constm1_rtx);
6860 : 3111 : return use_ndd ? "dec{<imodesuffix>}\t{%1, %0|%0, %1}"
6861 : 3122 : : "dec{<imodesuffix>}\t%0";
6862 : 15 : }
6863 : 15 :
6864 : 33405 : default:
6865 : 33405 : if (which_alternative == 2)
6866 : 1887 : std::swap (operands[1], operands[2]);
6867 : 1864 :
6868 : 35254 : if (x86_maybe_negate_const_int (&operands[2], <MODE>mode))
6869 : 19825 : return use_ndd ? "sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
6870 : 19832 : : "sub{<imodesuffix>}\t{%2, %0|%0, %2}";
6871 : :
6872 : 13569 : return use_ndd ? "add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
6873 : 4 : : "add{<imodesuffix>}\t{%2, %0|%0, %2}";
6874 : 1 : }
6875 : : }
6876 : 1 : [(set_attr "isa" "*,*,*,apx_ndd,apx_ndd")
6877 : 11 : (set (attr "type")
6878 : 11 : (if_then_else (match_operand:SWI 2 "incdec_operand")
6879 : 34964 : (const_string "incdec")
6880 : 1 : (const_string "alu")))
6881 : 1 : (set (attr "length_immediate")
6882 : 1 : (if_then_else
6883 : 0 : (and (eq_attr "type" "alu") (match_operand 2 "const128_operand"))
6884 : 1 : (const_string "1")
6885 : 0 : (const_string "*")))
6886 : 0 : (set_attr "mode" "<MODE>")])
6887 : 0 :
6888 : 0 : ;; See comment for addsi_1_zext why we do use nonimmediate_operand
6889 : 0 : (define_insn "*addsi_2_zext"
6890 : 0 : [(set (reg FLAGS_REG)
6891 : 0 : (compare
6892 : 0 : (plus:SI (match_operand:SI 1 "nonimmediate_operand" "%0,r,r,rm")
6893 : 0 : (match_operand:SI 2 "x86_64_general_operand" "rBMe,0,rBMe,re"))
6894 : 0 : (const_int 0)))
6895 : : (set (match_operand:DI 0 "register_operand" "=r,r,r,r")
6896 : : (zero_extend:DI (plus:SI (match_dup 1) (match_dup 2))))]
6897 : 9 : "TARGET_64BIT && ix86_match_ccmode (insn, CCGOCmode)
6898 : 6 : && ix86_binary_operator_ok (PLUS, SImode, operands, TARGET_APX_NDD)"
6899 : 6 : {
6900 : 3 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
6901 : 3 : switch (get_attr_type (insn))
6902 : 0 : {
6903 : 0 : case TYPE_INCDEC:
6904 : 0 : if (operands[2] == const1_rtx)
6905 : 0 : return use_ndd ? "inc{l}\t{%1, %k0|%k0, %1}"
6906 : 297 : : "inc{l}\t%k0";
6907 : 297 : else
6908 : 297 : {
6909 : 297 : gcc_assert (operands[2] == constm1_rtx);
6910 : 297 : return use_ndd ? "dec{l}\t{%1, %k0|%k0, %1}"
6911 : 0 : : "dec{l}\t%k0";
6912 : 0 : }
6913 : 0 :
6914 : 3 : default:
6915 : 3 : if (which_alternative == 1)
6916 : 0 : std::swap (operands[1], operands[2]);
6917 : 0 :
6918 : 3 : if (x86_maybe_negate_const_int (&operands[2], SImode))
6919 : 0 : return use_ndd ? "sub{l}\t{%2, %1, %k0|%k0, %1, %2}"
6920 : 0 : : "sub{l}\t{%2, %k0|%k0, %2}";
6921 : :
6922 : 3 : return use_ndd ? "add{l}\t{%2, %1, %k0|%k0, %1, %2}"
6923 : 0 : : "add{l}\t{%2, %k0|%k0, %2}";
6924 : : }
6925 : : }
6926 : : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
6927 : 0 : (set (attr "type")
6928 : 118 : (if_then_else (match_operand:SI 2 "incdec_operand")
6929 : 148 : (const_string "incdec")
6930 : 0 : (const_string "alu")))
6931 : : (set (attr "length_immediate")
6932 : : (if_then_else
6933 : : (and (eq_attr "type" "alu") (match_operand 2 "const128_operand"))
6934 : : (const_string "1")
6935 : : (const_string "*")))
6936 : 0 : (set_attr "mode" "SI")])
6937 : 0 :
6938 : 0 : (define_insn "*add<mode>_3"
6939 : 0 : [(set (reg FLAGS_REG)
6940 : : (compare
6941 : : (neg:SWI (match_operand:SWI 2 "<general_operand>" "<g>,0,<g>,re"))
6942 : : (match_operand:SWI 1 "nonimmediate_operand" "%0,<r>,r,rm")))
6943 : : (clobber (match_scratch:SWI 0 "=<r>,<r>,r,r"))]
6944 : 5128 : "ix86_match_ccmode (insn, CCZmode)
6945 : 1251 : && !(MEM_P (operands[1]) && MEM_P (operands[2]))"
6946 : 9364 : {
6947 : 2038 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
6948 : 3428 : switch (get_attr_type (insn))
6949 : 1879 : {
6950 : 1879 : case TYPE_INCDEC:
6951 : 14183 : if (operands[2] == const1_rtx)
6952 : 8084 : return use_ndd ? "inc{<imodesuffix>}\t{%1, %0|%0, %1}"
6953 : 21506 : : "inc{<imodesuffix>}\t%0";
6954 : : else
6955 : : {
6956 : 0 : gcc_assert (operands[2] == constm1_rtx);
6957 : 0 : return use_ndd ? "dec{<imodesuffix>}\t{%1, %0|%0, %1}"
6958 : 0 : : "dec{<imodesuffix>}\t%0";
6959 : : }
6960 : :
6961 : 1420 : default:
6962 : 1420 : if (which_alternative == 1)
6963 : 0 : std::swap (operands[1], operands[2]);
6964 : :
6965 : 1420 : if (x86_maybe_negate_const_int (&operands[2], <MODE>mode))
6966 : 0 : return use_ndd ? "sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
6967 : 0 : : "sub{<imodesuffix>}\t{%2, %0|%0, %2}";
6968 : :
6969 : 1420 : return use_ndd ? "add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
6970 : : : "add{<imodesuffix>}\t{%2, %0|%0, %2}";
6971 : : }
6972 : : }
6973 : : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
6974 : 0 : (set (attr "type")
6975 : 0 : (if_then_else (match_operand:SWI 2 "incdec_operand")
6976 : 1390 : (const_string "incdec")
6977 : 0 : (const_string "alu")))
6978 : 0 : (set (attr "length_immediate")
6979 : 0 : (if_then_else
6980 : 0 : (and (eq_attr "type" "alu") (match_operand 2 "const128_operand"))
6981 : 0 : (const_string "1")
6982 : 0 : (const_string "*")))
6983 : : (set_attr "mode" "<MODE>")])
6984 : :
6985 : : ;; See comment for addsi_1_zext why we do use nonimmediate_operand
6986 : 0 : (define_insn "*addsi_3_zext"
6987 : : [(set (reg FLAGS_REG)
6988 : : (compare
6989 : : (neg:SI (match_operand:SI 2 "x86_64_general_operand" "rBMe,0,rBMe,re"))
6990 : 0 : (match_operand:SI 1 "nonimmediate_operand" "%0,r,r,rm")))
6991 : : (set (match_operand:DI 0 "register_operand" "=r,r,r,r")
6992 : : (zero_extend:DI (plus:SI (match_dup 1) (match_dup 2))))]
6993 : 0 : "TARGET_64BIT && ix86_match_ccmode (insn, CCZmode)
6994 : 0 : && ix86_binary_operator_ok (PLUS, SImode, operands, TARGET_APX_NDD)"
6995 : 0 : {
6996 : 0 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
6997 : 0 : switch (get_attr_type (insn))
6998 : : {
6999 : 0 : case TYPE_INCDEC:
7000 : 0 : if (operands[2] == const1_rtx)
7001 : 0 : return use_ndd ? "inc{l}\t{%1, %k0|%k0, %1}" : "inc{l}\t%k0";
7002 : 6826 : else
7003 : 6826 : {
7004 : 0 : gcc_assert (operands[2] == constm1_rtx);
7005 : 6429 : return use_ndd ? "dec{l}\t{%1, %k0|%k0, %1}" : "dec{l}\t%k0";
7006 : 6429 : }
7007 : :
7008 : 6429 : default:
7009 : 6429 : if (which_alternative == 1)
7010 : 6429 : std::swap (operands[1], operands[2]);
7011 : 6429 :
7012 : 6429 : if (x86_maybe_negate_const_int (&operands[2], SImode))
7013 : 6429 : return use_ndd ? "sub{l}\t{%2, %1, %k0|%k0, %1, %2}"
7014 : 6429 : : "sub{l}\t{%2, %k0|%k0, %2}";
7015 : :
7016 : 6425 : return use_ndd ? "add{l}\t{%2, %1, %k0|%k0, %1, %2}"
7017 : 6425 : : "add{l}\t{%2, %k0|%k0, %2}";
7018 : : }
7019 : 71 : }
7020 : 142 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
7021 : 0 : (set (attr "type")
7022 : : (if_then_else (match_operand:SI 2 "incdec_operand")
7023 : 4572 : (const_string "incdec")
7024 : : (const_string "alu")))
7025 : 0 : (set (attr "length_immediate")
7026 : : (if_then_else
7027 : : (and (eq_attr "type" "alu") (match_operand 2 "const128_operand"))
7028 : : (const_string "1")
7029 : 0 : (const_string "*")))
7030 : : (set_attr "mode" "SI")])
7031 : :
7032 : : ; For comparisons against 1, -1 and 128, we may generate better code
7033 : 0 : ; by converting cmp to add, inc or dec as done by peephole2. This pattern
7034 : : ; is matched then. We can't accept general immediate, because for
7035 : : ; case of overflows, the result is messed up.
7036 : : ; Also carry flag is reversed compared to cmp, so this conversion is valid
7037 : : ; only for comparisons not depending on it.
7038 : 0 :
7039 : : (define_insn "*adddi_4"
7040 : 0 : [(set (reg FLAGS_REG)
7041 : : (compare
7042 : 0 : (match_operand:DI 1 "nonimmediate_operand" "0,rm")
7043 : 0 : (match_operand:DI 2 "x86_64_immediate_operand" "e,e")))
7044 : 0 : (clobber (match_scratch:DI 0 "=r,r"))]
7045 : 32 : "TARGET_64BIT
7046 : 4818 : && ix86_match_ccmode (insn, CCGCmode)"
7047 : 470121 : {
7048 : 4572 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
7049 : 4572 : switch (get_attr_type (insn))
7050 : 1006 : {
7051 : 2300 : case TYPE_INCDEC:
7052 : 73859 : if (operands[2] == constm1_rtx)
7053 : 13691 : return use_ndd ? "inc{q}\t{%1, %0|%0, %1}" : "inc{q}\t%0";
7054 : 75166 : else
7055 : 0 : {
7056 : 2416 : gcc_assert (operands[2] == const1_rtx);
7057 : 1642 : return use_ndd ? "dec{q}\t{%1, %0|%0, %1}" : "dec{q}\t%0";
7058 : 0 : }
7059 : 0 :
7060 : 3278 : default:
7061 : 3278 : if (x86_maybe_negate_const_int (&operands[2], DImode))
7062 : 882 : return use_ndd ? "add{q}\t{%2, %1, %0|%0, %1, %2}"
7063 : 882 : : "add{q}\t{%2, %0|%0, %2}";
7064 : 0 :
7065 : 2396 : return use_ndd ? "sub{q}\t{%2, %1, %0|%0, %1, %2}"
7066 : 0 : : "sub{q}\t{%2, %0|%0, %2}";
7067 : 0 : }
7068 : 0 : }
7069 : 0 : [(set_attr "isa" "*,apx_ndd")
7070 : 0 : (set (attr "type")
7071 : 0 : (if_then_else (match_operand:DI 2 "incdec_operand")
7072 : 940 : (const_string "incdec")
7073 : 0 : (const_string "alu")))
7074 : 0 : (set (attr "length_immediate")
7075 : 0 : (if_then_else
7076 : 0 : (and (eq_attr "type" "alu") (match_operand 2 "const128_operand"))
7077 : 0 : (const_string "1")
7078 : 0 : (const_string "*")))
7079 : 0 : (set_attr "mode" "DI")])
7080 : 0 :
7081 : 0 : ; For comparisons against 1, -1 and 128, we may generate better code
7082 : 0 : ; by converting cmp to add, inc or dec as done by peephole2. This pattern
7083 : 0 : ; is matched then. We can't accept general immediate, because for
7084 : 0 : ; case of overflows, the result is messed up.
7085 : 0 : ; Also carry flag is reversed compared to cmp, so this conversion is valid
7086 : 0 : ; only for comparisons not depending on it.
7087 : 0 :
7088 : 0 : (define_insn "*add<mode>_4"
7089 : 0 : [(set (reg FLAGS_REG)
7090 : 0 : (compare
7091 : 0 : (match_operand:SWI124 1 "nonimmediate_operand" "0,rm")
7092 : 0 : (match_operand:SWI124 2 "const_int_operand")))
7093 : 0 : (clobber (match_scratch:SWI124 0 "=<r>,r"))]
7094 : 5285 : "ix86_match_ccmode (insn, CCGCmode)"
7095 : 255570 : {
7096 : 940 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
7097 : 5088 : switch (get_attr_type (insn))
7098 : 4333 : {
7099 : 6936 : case TYPE_INCDEC:
7100 : 185769 : if (operands[2] == constm1_rtx)
7101 : 102454 : return use_ndd ? "inc{<imodesuffix>}\t{%1, %0|%0, %1}"
7102 : 188053 : : "inc{<imodesuffix>}\t%0";
7103 : 2776713 : else
7104 : 544185 : {
7105 : 2234559 : gcc_assert (operands[2] == const1_rtx);
7106 : 2234559 : return use_ndd ? "dec{<imodesuffix>}\t{%1, %0|%0, %1}"
7107 : 545675 : : "dec{<imodesuffix>}\t%0";
7108 : 543644 : }
7109 : 46921 :
7110 : 49406 : default:
7111 : 546129 : if (x86_maybe_negate_const_int (&operands[2], <MODE>mode))
7112 : 566993 : return use_ndd ? "add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
7113 : 23349 : : "add{<imodesuffix>}\t{%2, %0|%0, %2}";
7114 : 543644 :
7115 : 567149 : return use_ndd ? "sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
7116 : : : "sub{<imodesuffix>}\t{%2, %0|%0, %2}";
7117 : 565853043 : }
7118 : 900 : }
7119 : 565818193 : [(set_attr "isa" "*,apx_ndd")
7120 : 340 : (set (attr "type")
7121 : 565815493 : (if_then_else (match_operand:<MODE> 2 "incdec_operand")
7122 : 4187 : (const_string "incdec")
7123 : 112400 : (const_string "alu")))
7124 : 112400 : (set (attr "length_immediate")
7125 : 112400 : (if_then_else
7126 : : (and (eq_attr "type" "alu") (match_operand 2 "const128_operand"))
7127 : 0 : (const_string "1")
7128 : 0 : (const_string "*")))
7129 : 0 : (set_attr "mode" "<MODE>")])
7130 : 0 :
7131 : : (define_insn "*add<mode>_5"
7132 : : [(set (reg FLAGS_REG)
7133 : : (compare
7134 : 0 : (plus:SWI
7135 : : (match_operand:SWI 1 "nonimmediate_operand" "%0,<r>,r,rm")
7136 : : (match_operand:SWI 2 "<general_operand>" "<g>,0,<g>,re"))
7137 : : (const_int 0)))
7138 : 0 : (clobber (match_scratch:SWI 0 "=<r>,<r>,r,r"))]
7139 : 340 : "ix86_match_ccmode (insn, CCGOCmode)
7140 : 35368 : && !(MEM_P (operands[1]) && MEM_P (operands[2]))"
7141 : 587 : {
7142 : 10919 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
7143 : 11467 : switch (get_attr_type (insn))
7144 : 50 : {
7145 : 53 : case TYPE_INCDEC:
7146 : 1 : if (operands[2] == const1_rtx)
7147 : 35025 : return use_ndd ? "inc{<imodesuffix>}\t{%1, %0|%0, %1}"
7148 : 35025 : : "inc{<imodesuffix>}\t%0";
7149 : 0 : else
7150 : : {
7151 : 1 : gcc_assert (operands[2] == constm1_rtx);
7152 : 1 : return use_ndd ? "dec{<imodesuffix>}\t{%1, %0|%0, %1}"
7153 : 1 : : "dec{<imodesuffix>}\t%0";
7154 : : }
7155 : :
7156 : 586 : default:
7157 : 586 : if (which_alternative == 1)
7158 : 0 : std::swap (operands[1], operands[2]);
7159 : :
7160 : 586 : if (x86_maybe_negate_const_int (&operands[2], <MODE>mode))
7161 : 322 : return use_ndd ? "sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
7162 : 322 : : "sub{<imodesuffix>}\t{%2, %0|%0, %2}";
7163 : 0 :
7164 : 264 : return use_ndd ? "add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
7165 : : : "add{<imodesuffix>}\t{%2, %0|%0, %2}";
7166 : : }
7167 : : }
7168 : : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
7169 : : (set (attr "type")
7170 : : (if_then_else (match_operand:SWI 2 "incdec_operand")
7171 : 549 : (const_string "incdec")
7172 : : (const_string "alu")))
7173 : : (set (attr "length_immediate")
7174 : : (if_then_else
7175 : : (and (eq_attr "type" "alu") (match_operand 2 "const128_operand"))
7176 : : (const_string "1")
7177 : : (const_string "*")))
7178 : : (set_attr "mode" "<MODE>")])
7179 : :
7180 : : (define_insn "*addqi_ext<mode>_0"
7181 : : [(set (match_operand:QI 0 "nonimmediate_operand" "=QBn")
7182 : : (plus:QI
7183 : : (subreg:QI
7184 : : (match_operator:SWI248 3 "extract_operator"
7185 : : [(match_operand 2 "int248_register_operand" "Q")
7186 : : (const_int 8)
7187 : : (const_int 8)]) 0)
7188 : : (match_operand:QI 1 "nonimmediate_operand" "0")))
7189 : : (clobber (reg:CC FLAGS_REG))]
7190 : : ""
7191 : : "add{b}\t{%h2, %0|%0, %h2}"
7192 : : [(set_attr "addr" "gpr8")
7193 : : (set_attr "type" "alu")
7194 : : (set_attr "mode" "QI")])
7195 : :
7196 : : (define_insn_and_split "*addqi_ext2<mode>_0"
7197 : : [(set (match_operand:QI 0 "register_operand" "=&Q")
7198 : : (plus:QI
7199 : : (subreg:QI
7200 : : (match_operator:SWI248 3 "extract_operator"
7201 : 0 : [(match_operand 1 "int248_register_operand" "Q")
7202 : 0 : (const_int 8)
7203 : 0 : (const_int 8)]) 0)
7204 : : (subreg:QI
7205 : : (match_operator:SWI248 4 "extract_operator"
7206 : : [(match_operand 2 "int248_register_operand" "Q")
7207 : 0 : (const_int 8)
7208 : : (const_int 8)]) 0)))
7209 : : (clobber (reg:CC FLAGS_REG))]
7210 : : ""
7211 : 0 : "#"
7212 : 2 : "&& reload_completed"
7213 : : [(set (match_dup 0)
7214 : 10 : (subreg:QI
7215 : 0 : (match_op_dup 4
7216 : 18 : [(match_dup 2) (const_int 8) (const_int 8)]) 0))
7217 : 18 : (parallel
7218 : : [(set (match_dup 0)
7219 : 0 : (plus:QI
7220 : 6589 : (subreg:QI
7221 : 6589 : (match_op_dup 3
7222 : : [(match_dup 1) (const_int 8) (const_int 8)]) 0)
7223 : 2314 : (match_dup 0)))
7224 : 4628 : (clobber (reg:CC FLAGS_REG))])]
7225 : : ""
7226 : : [(set_attr "type" "alu")
7227 : : (set_attr "mode" "QI")])
7228 : 10 :
7229 : 10 : (define_expand "addqi_ext_1"
7230 : 10 : [(parallel
7231 : 10 : [(set (zero_extract:HI (match_operand:HI 0 "register_operand")
7232 : 10 : (const_int 8)
7233 : 10 : (const_int 8))
7234 : 10 : (subreg:HI
7235 : 10 : (plus:QI
7236 : 10 : (subreg:QI
7237 : 10 : (zero_extract:HI (match_operand:HI 1 "register_operand")
7238 : 10 : (const_int 8)
7239 : : (const_int 8)) 0)
7240 : : (match_operand:QI 2 "const_int_operand")) 0))
7241 : : (clobber (reg:CC FLAGS_REG))])])
7242 : 0 :
7243 : 0 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
7244 : 0 : (define_insn_and_split "*addqi_ext<mode>_1"
7245 : 10 : [(set (zero_extract:SWI248
7246 : 0 : (match_operand 0 "int248_register_operand" "+Q,&Q")
7247 : 0 : (const_int 8)
7248 : 0 : (const_int 8))
7249 : 0 : (subreg:SWI248
7250 : 0 : (plus:QI
7251 : : (subreg:QI
7252 : : (match_operator:SWI248 3 "extract_operator"
7253 : : [(match_operand 1 "int248_register_operand" "0,!Q")
7254 : 0 : (const_int 8)
7255 : : (const_int 8)]) 0)
7256 : : (match_operand:QI 2 "general_operand" "QnBn,QnBn")) 0))
7257 : 10 : (clobber (reg:CC FLAGS_REG))]
7258 : 10 : ""
7259 : 18 : {
7260 : 1 : if (which_alternative)
7261 : : return "#";
7262 : :
7263 : 8 : switch (get_attr_type (insn))
7264 : 0 : {
7265 : 9 : case TYPE_INCDEC:
7266 : 0 : if (operands[2] == const1_rtx)
7267 : 9 : return "inc{b}\t%h0";
7268 : 0 : else
7269 : 9 : {
7270 : 9 : gcc_assert (operands[2] == constm1_rtx);
7271 : 9 : return "dec{b}\t%h0";
7272 : 9 : }
7273 : 9 :
7274 : 0 : default:
7275 : 9 : return "add{b}\t{%2, %h0|%h0, %2}";
7276 : : }
7277 : : }
7278 : 26 : "reload_completed
7279 : 18 : && !rtx_equal_p (operands[0], operands[1])"
7280 : 2 : [(set (zero_extract:SWI248
7281 : 7 : (match_dup 0) (const_int 8) (const_int 8))
7282 : 0 : (zero_extract:SWI248
7283 : 23 : (match_dup 1) (const_int 8) (const_int 8)))
7284 : 23 : (parallel
7285 : : [(set (zero_extract:SWI248
7286 : : (match_dup 0) (const_int 8) (const_int 8))
7287 : 0 : (subreg:SWI248
7288 : : (plus:QI
7289 : : (subreg:QI
7290 : 0 : (match_op_dup 3
7291 : : [(match_dup 0) (const_int 8) (const_int 8)]) 0)
7292 : 0 : (match_dup 2)) 0))
7293 : 0 : (clobber (reg:CC FLAGS_REG))])]
7294 : 0 : ""
7295 : 0 : [(set_attr "addr" "gpr8")
7296 : 0 : (set (attr "type")
7297 : 0 : (if_then_else (match_operand:QI 2 "incdec_operand")
7298 : 0 : (const_string "incdec")
7299 : 0 : (const_string "alu")))
7300 : 2 : (set_attr "mode" "QI")])
7301 : 2 :
7302 : 2 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
7303 : 2 : (define_insn_and_split "*<insn>qi_ext<mode>_2"
7304 : 2 : [(set (zero_extract:SWI248
7305 : 2 : (match_operand 0 "int248_register_operand" "+Q,&Q")
7306 : : (const_int 8)
7307 : : (const_int 8))
7308 : 0 : (subreg:SWI248
7309 : 0 : (plusminus:QI
7310 : 0 : (subreg:QI
7311 : 0 : (match_operator:SWI248 3 "extract_operator"
7312 : 0 : [(match_operand 1 "int248_register_operand" "<comm>0,!Q")
7313 : 2 : (const_int 8)
7314 : 0 : (const_int 8)]) 0)
7315 : 0 : (subreg:QI
7316 : : (match_operator:SWI248 4 "extract_operator"
7317 : : [(match_operand 2 "int248_register_operand" "Q,Q")
7318 : : (const_int 8)
7319 : : (const_int 8)]) 0)) 0))
7320 : : (clobber (reg:CC FLAGS_REG))]
7321 : : ""
7322 : : "@
7323 : : <insn>{b}\t{%h2, %h0|%h0, %h2}
7324 : 0 : #"
7325 : 253 : "reload_completed
7326 : 339 : && !(rtx_equal_p (operands[0], operands[1])
7327 : 8 : || (<CODE> == PLUS && rtx_equal_p (operands[0], operands[2])))"
7328 : 286 : [(set (zero_extract:SWI248
7329 : 8 : (match_dup 0) (const_int 8) (const_int 8))
7330 : 2 : (zero_extract:SWI248
7331 : 56 : (match_dup 1) (const_int 8) (const_int 8)))
7332 : 84 : (parallel
7333 : : [(set (zero_extract:SWI248
7334 : : (match_dup 0) (const_int 8) (const_int 8))
7335 : : (subreg:SWI248
7336 : : (plusminus:QI
7337 : : (subreg:QI
7338 : 2 : (match_op_dup 3
7339 : 0 : [(match_dup 0) (const_int 8) (const_int 8)]) 0)
7340 : 2 : (subreg:QI
7341 : 2 : (match_op_dup 4
7342 : 2 : [(match_dup 2) (const_int 8) (const_int 8)]) 0)) 0))
7343 : 2 : (clobber (reg:CC FLAGS_REG))])]
7344 : 2 : ""
7345 : 2 : [(set_attr "type" "alu")
7346 : 0 : (set_attr "mode" "QI")])
7347 : 2 :
7348 : 0 : ;; Like DWI, but use POImode instead of OImode.
7349 : 11 : (define_mode_attr DPWI [(QI "HI") (HI "SI") (SI "DI") (DI "TI") (TI "POI")])
7350 : 11 :
7351 : 11 : ;; Add with jump on overflow.
7352 : 11 : (define_expand "addv<mode>4"
7353 : 11 : [(parallel [(set (reg:CCO FLAGS_REG)
7354 : 11 : (eq:CCO
7355 : 11 : (plus:<DPWI>
7356 : 11 : (sign_extend:<DPWI>
7357 : 11 : (match_operand:SWIDWI 1 "nonimmediate_operand"))
7358 : 0 : (match_dup 4))
7359 : : (sign_extend:<DPWI>
7360 : : (plus:SWIDWI (match_dup 1)
7361 : : (match_operand:SWIDWI 2
7362 : 0 : "<general_hilo_operand>")))))
7363 : : (set (match_operand:SWIDWI 0 "register_operand")
7364 : : (plus:SWIDWI (match_dup 1) (match_dup 2)))])
7365 : 11 : (set (pc) (if_then_else
7366 : 0 : (eq (reg:CCO FLAGS_REG) (const_int 0))
7367 : : (label_ref (match_operand 3))
7368 : : (pc)))]
7369 : : ""
7370 : 8215 : {
7371 : 8215 : ix86_fixup_binary_operands_no_copy (PLUS, <MODE>mode, operands);
7372 : 8215 : if (CONST_SCALAR_INT_P (operands[2]))
7373 : 2658 : operands[4] = operands[2];
7374 : : else
7375 : 5557 : operands[4] = gen_rtx_SIGN_EXTEND (<DPWI>mode, operands[2]);
7376 : 0 : })
7377 : 0 :
7378 : : (define_insn "*addv<mode>4"
7379 : 8215 : [(set (reg:CCO FLAGS_REG)
7380 : 8215 : (eq:CCO (plus:<DWI>
7381 : 8215 : (sign_extend:<DWI>
7382 : 8215 : (match_operand:SWI 1 "nonimmediate_operand" "%0,0,rm,r"))
7383 : 8215 : (sign_extend:<DWI>
7384 : 8215 : (match_operand:SWI 2 "<general_sext_operand>" "<r>We,m,rWe,m")))
7385 : 8215 : (sign_extend:<DWI>
7386 : 8215 : (plus:SWI (match_dup 1) (match_dup 2)))))
7387 : 11 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,<r>,r,r")
7388 : 11 : (plus:SWI (match_dup 1) (match_dup 2)))]
7389 : 8508 : "ix86_binary_operator_ok (PLUS, <MODE>mode, operands, TARGET_APX_NDD)"
7390 : 8215 : "@
7391 : : add{<imodesuffix>}\t{%2, %0|%0, %2}
7392 : : add{<imodesuffix>}\t{%2, %0|%0, %2}
7393 : 7120 : add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
7394 : 7650 : add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
7395 : 8163 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
7396 : : (set_attr "type" "alu")
7397 : 11 : (set_attr "mode" "<MODE>")])
7398 : 11 :
7399 : 541 : (define_insn "addv<mode>4_1"
7400 : 541 : [(set (reg:CCO FLAGS_REG)
7401 : 530 : (eq:CCO (plus:<DWI>
7402 : 541 : (sign_extend:<DWI>
7403 : 11 : (match_operand:SWI 1 "nonimmediate_operand" "0,rm"))
7404 : 0 : (match_operand:<DWI> 3 "const_int_operand"))
7405 : 11 : (sign_extend:<DWI>
7406 : 530 : (plus:SWI
7407 : 8745 : (match_dup 1)
7408 : 0 : (match_operand:SWI 2 "x86_64_immediate_operand" "<i>,<i>")))))
7409 : : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,r")
7410 : 0 : (plus:SWI (match_dup 1) (match_dup 2)))]
7411 : 2107 : "ix86_binary_operator_ok (PLUS, <MODE>mode, operands, TARGET_APX_NDD)
7412 : 4556 : && CONST_INT_P (operands[2])
7413 : 2107 : && INTVAL (operands[2]) == INTVAL (operands[3])"
7414 : : "@
7415 : : add{<imodesuffix>}\t{%2, %0|%0, %2}
7416 : 8215 : add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
7417 : 29318 : [(set_attr "isa" "*,apx_ndd")
7418 : 31767 : (set_attr "type" "alu")
7419 : 17631 : (set_attr "mode" "<MODE>")
7420 : 20375 : (set (attr "length_immediate")
7421 : 0 : (cond [(match_test "IN_RANGE (INTVAL (operands[2]), -128, 127)")
7422 : 0 : (const_string "1")
7423 : 7685 : (match_test "<MODE_SIZE> == 8")
7424 : 4 : (const_string "4")]
7425 : 0 : (const_string "<MODE_SIZE>")))])
7426 : 4 :
7427 : 4 : ;; Quad word integer modes as mode attribute.
7428 : 7689 : (define_mode_attr QPWI [(SI "TI") (DI "POI")])
7429 : 7689 :
7430 : 7685 : (define_insn_and_split "*addv<dwi>4_doubleword"
7431 : 7689 : [(set (reg:CCO FLAGS_REG)
7432 : 7689 : (eq:CCO
7433 : 4 : (plus:<QPWI>
7434 : 0 : (sign_extend:<QPWI>
7435 : 4 : (match_operand:<DWI> 1 "nonimmediate_operand" "%0,0,ro,r"))
7436 : 7685 : (sign_extend:<QPWI>
7437 : : (match_operand:<DWI> 2 "nonimmediate_operand" "r,o,r,o")))
7438 : : (sign_extend:<QPWI>
7439 : 0 : (plus:<DWI> (match_dup 1) (match_dup 2)))))
7440 : 0 : (set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,r,&r,&r")
7441 : 0 : (plus:<DWI> (match_dup 1) (match_dup 2)))]
7442 : 16931 : "ix86_binary_operator_ok (PLUS, <DWI>mode, operands, TARGET_APX_NDD)"
7443 : 0 : "#"
7444 : 1954 : "&& reload_completed"
7445 : 977 : [(parallel [(set (reg:CCC FLAGS_REG)
7446 : : (compare:CCC
7447 : : (plus:DWIH (match_dup 1) (match_dup 2))
7448 : 5272 : (match_dup 1)))
7449 : 1946 : (set (match_dup 0)
7450 : 0 : (plus:DWIH (match_dup 1) (match_dup 2)))])
7451 : 0 : (parallel [(set (reg:CCO FLAGS_REG)
7452 : 0 : (eq:CCO
7453 : : (plus:<DWI>
7454 : : (plus:<DWI>
7455 : 0 : (ltu:<DWI> (reg:CC FLAGS_REG) (const_int 0))
7456 : 0 : (sign_extend:<DWI> (match_dup 4)))
7457 : 0 : (sign_extend:<DWI> (match_dup 5)))
7458 : : (sign_extend:<DWI>
7459 : : (plus:DWIH
7460 : : (plus:DWIH
7461 : : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0))
7462 : : (match_dup 4))
7463 : : (match_dup 5)))))
7464 : : (set (match_dup 3)
7465 : 0 : (plus:DWIH
7466 : 0 : (plus:DWIH
7467 : 0 : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0))
7468 : 0 : (match_dup 4))
7469 : 0 : (match_dup 5)))])]
7470 : 977 : {
7471 : 977 : split_double_mode (<DWI>mode, &operands[0], 3, &operands[0], &operands[3]);
7472 : 0 : }
7473 : 0 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")])
7474 : 0 :
7475 : 977 : (define_insn_and_split "*addv<dwi>4_doubleword_1"
7476 : 977 : [(set (reg:CCO FLAGS_REG)
7477 : 977 : (eq:CCO
7478 : 977 : (plus:<QPWI>
7479 : 977 : (sign_extend:<QPWI>
7480 : 977 : (match_operand:<DWI> 1 "nonimmediate_operand" "%0,rjM"))
7481 : 977 : (match_operand:<QPWI> 3 "const_scalar_int_operand" "n,n"))
7482 : 977 : (sign_extend:<QPWI>
7483 : 977 : (plus:<DWI>
7484 : 977 : (match_dup 1)
7485 : 977 : (match_operand:<DWI> 2 "x86_64_hilo_general_operand" "<di>,<di>")))))
7486 : 977 : (set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,&r")
7487 : 977 : (plus:<DWI> (match_dup 1) (match_dup 2)))]
7488 : 7059 : "ix86_binary_operator_ok (PLUS, <DWI>mode, operands, TARGET_APX_NDD)
7489 : 7712 : && CONST_SCALAR_INT_P (operands[2])
7490 : 4664 : && rtx_equal_p (operands[2], operands[3])"
7491 : 0 : "#"
7492 : 653 : "&& reload_completed"
7493 : 326 : [(parallel [(set (reg:CCC FLAGS_REG)
7494 : 0 : (compare:CCC
7495 : 0 : (plus:DWIH (match_dup 1) (match_dup 2))
7496 : 653 : (match_dup 1)))
7497 : 653 : (set (match_dup 0)
7498 : 0 : (plus:DWIH (match_dup 1) (match_dup 2)))])
7499 : 0 : (parallel [(set (reg:CCO FLAGS_REG)
7500 : 977 : (eq:CCO
7501 : 17093 : (plus:<DWI>
7502 : 17093 : (plus:<DWI>
7503 : 0 : (ltu:<DWI> (reg:CC FLAGS_REG) (const_int 0))
7504 : 5638 : (sign_extend:<DWI> (match_dup 4)))
7505 : 5638 : (match_dup 5))
7506 : 0 : (sign_extend:<DWI>
7507 : : (plus:DWIH
7508 : 0 : (plus:DWIH
7509 : 0 : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0))
7510 : 0 : (match_dup 4))
7511 : 0 : (match_dup 5)))))
7512 : 0 : (set (match_dup 3)
7513 : 0 : (plus:DWIH
7514 : : (plus:DWIH
7515 : : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0))
7516 : : (match_dup 4))
7517 : : (match_dup 5)))])]
7518 : 326 : {
7519 : 326 : split_double_mode (<DWI>mode, &operands[0], 3, &operands[0], &operands[3]);
7520 : 326 : if (operands[2] == const0_rtx)
7521 : 0 : {
7522 : 2 : if (!rtx_equal_p (operands[0], operands[1]))
7523 : 0 : emit_move_insn (operands[0], operands[1]);
7524 : 2 : emit_insn (gen_addv<mode>4_1 (operands[3], operands[4], operands[5],
7525 : 0 : operands[5]));
7526 : 2 : DONE;
7527 : 0 : }
7528 : 0 : }
7529 : 0 : [(set_attr "isa" "*,apx_ndd")])
7530 : 0 :
7531 : 324 : (define_insn "*addv<mode>4_overflow_1"
7532 : 324 : [(set (reg:CCO FLAGS_REG)
7533 : 977 : (eq:CCO
7534 : 977 : (plus:<DWI>
7535 : 1301 : (plus:<DWI>
7536 : 324 : (match_operator:<DWI> 4 "ix86_carry_flag_operator"
7537 : 324 : [(match_operand 3 "flags_reg_operand") (const_int 0)])
7538 : 324 : (sign_extend:<DWI>
7539 : 324 : (match_operand:SWI 1 "nonimmediate_operand" "%0,0,rm,r")))
7540 : 324 : (sign_extend:<DWI>
7541 : 1297 : (match_operand:SWI 2 "<general_sext_operand>" "rWe,m,rWe,m")))
7542 : 324 : (sign_extend:<DWI>
7543 : 324 : (plus:SWI
7544 : 973 : (plus:SWI
7545 : 973 : (match_operator:SWI 5 "ix86_carry_flag_operator"
7546 : 973 : [(match_dup 3) (const_int 0)])
7547 : 973 : (match_dup 1))
7548 : 973 : (match_dup 2)))))
7549 : 973 : (set (match_operand:SWI 0 "nonimmediate_operand" "=rm,r,r,r")
7550 : 973 : (plus:SWI
7551 : 0 : (plus:SWI
7552 : 973 : (match_op_dup 5 [(match_dup 3) (const_int 0)])
7553 : 0 : (match_dup 1))
7554 : 0 : (match_dup 2)))]
7555 : 1061 : "ix86_binary_operator_ok (PLUS, <MODE>mode, operands, TARGET_APX_NDD)"
7556 : 324 : "@
7557 : 0 : adc{<imodesuffix>}\t{%2, %0|%0, %2}
7558 : 0 : adc{<imodesuffix>}\t{%2, %0|%0, %2}
7559 : 1061 : adc{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
7560 : 1061 : adc{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
7561 : 2122 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
7562 : 0 : (set_attr "type" "alu")
7563 : 0 : (set_attr "mode" "<MODE>")])
7564 : 0 :
7565 : 0 : (define_insn "*addv<mode>4_overflow_2"
7566 : 0 : [(set (reg:CCO FLAGS_REG)
7567 : 0 : (eq:CCO
7568 : 0 : (plus:<DWI>
7569 : 0 : (plus:<DWI>
7570 : 0 : (match_operator:<DWI> 4 "ix86_carry_flag_operator"
7571 : 0 : [(match_operand 3 "flags_reg_operand") (const_int 0)])
7572 : 0 : (sign_extend:<DWI>
7573 : 0 : (match_operand:SWI 1 "nonimmediate_operand" "%0,rm")))
7574 : 0 : (match_operand:<DWI> 6 "const_int_operand" "n,n"))
7575 : 0 : (sign_extend:<DWI>
7576 : 0 : (plus:SWI
7577 : 0 : (plus:SWI
7578 : 0 : (match_operator:SWI 5 "ix86_carry_flag_operator"
7579 : 0 : [(match_dup 3) (const_int 0)])
7580 : 0 : (match_dup 1))
7581 : 0 : (match_operand:SWI 2 "x86_64_immediate_operand" "e,e")))))
7582 : 0 : (set (match_operand:SWI 0 "nonimmediate_operand" "=rm,r")
7583 : 0 : (plus:SWI
7584 : 0 : (plus:SWI
7585 : 0 : (match_op_dup 5 [(match_dup 3) (const_int 0)])
7586 : 0 : (match_dup 1))
7587 : 0 : (match_dup 2)))]
7588 : 648 : "ix86_binary_operator_ok (PLUS, <MODE>mode, operands, TARGET_APX_NDD)
7589 : 648 : && CONST_INT_P (operands[2])
7590 : 648 : && INTVAL (operands[2]) == INTVAL (operands[6])"
7591 : 0 : "@
7592 : 0 : adc{<imodesuffix>}\t{%2, %0|%0, %2}
7593 : 0 : adc{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
7594 : 324 : [(set_attr "isa" "*,apx_ndd")
7595 : 742 : (set_attr "type" "alu")
7596 : 1298 : (set_attr "mode" "<MODE>")
7597 : 0 : (set (attr "length_immediate")
7598 : 326 : (if_then_else (match_test "IN_RANGE (INTVAL (operands[2]), -128, 127)")
7599 : 326 : (const_string "1")
7600 : 744 : (const_string "4")))])
7601 : 418 :
7602 : 744 : (define_expand "uaddv<mode>4"
7603 : 744 : [(parallel [(set (reg:CCC FLAGS_REG)
7604 : 744 : (compare:CCC
7605 : 326 : (plus:SWIDWI
7606 : 0 : (match_operand:SWIDWI 1 "nonimmediate_operand")
7607 : 326 : (match_operand:SWIDWI 2 "<general_hilo_operand>"))
7608 : 0 : (match_dup 1)))
7609 : 0 : (set (match_operand:SWIDWI 0 "register_operand")
7610 : 0 : (plus:SWIDWI (match_dup 1) (match_dup 2)))])
7611 : 0 : (set (pc) (if_then_else
7612 : 0 : (ltu (reg:CCC FLAGS_REG) (const_int 0))
7613 : 0 : (label_ref (match_operand 3))
7614 : 0 : (pc)))]
7615 : 0 : ""
7616 : 418 : "ix86_fixup_binary_operands_no_copy (PLUS, <MODE>mode, operands);")
7617 : 0 :
7618 : 0 : ;; The lea patterns for modes less than 32 bits need to be matched by
7619 : 12207 : ;; several insns converted to real lea by splitters.
7620 : 12207 :
7621 : 12207 : (define_insn_and_split "*lea<mode>_general_1"
7622 : 12207 : [(set (match_operand:SWI12 0 "register_operand" "=r")
7623 : 12207 : (plus:SWI12
7624 : 12207 : (plus:SWI12 (match_operand:SWI12 1 "register_no_SP_operand" "l")
7625 : 12207 : (match_operand:SWI12 2 "register_operand" "r"))
7626 : 12207 : (match_operand:SWI12 3 "immediate_operand" "i")))]
7627 : 162 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
7628 : 12207 : "#"
7629 : 162 : "&& reload_completed"
7630 : 145 : [(set (match_dup 0)
7631 : 145 : (plus:SI
7632 : 273 : (plus:SI (match_dup 1) (match_dup 2))
7633 : 128 : (match_dup 3)))]
7634 : 273 : {
7635 : 63121 : operands[0] = gen_lowpart (SImode, operands[0]);
7636 : 63121 : operands[1] = gen_lowpart (SImode, operands[1]);
7637 : 85751 : operands[2] = gen_lowpart (SImode, operands[2]);
7638 : 85751 : operands[3] = gen_lowpart (SImode, operands[3]);
7639 : 0 : }
7640 : 8 : [(set_attr "type" "lea")
7641 : 12223 : (set_attr "mode" "SI")])
7642 : 145 :
7643 : 145 : (define_insn_and_split "*lea<mode>_general_2"
7644 : 145 : [(set (match_operand:SWI12 0 "register_operand" "=r")
7645 : 145 : (plus:SWI12
7646 : 145 : (mult:SWI12 (match_operand:SWI12 1 "register_no_SP_operand" "l")
7647 : 145 : (match_operand 2 "const248_operand" "n"))
7648 : 145 : (match_operand:SWI12 3 "nonmemory_operand" "ri")))]
7649 : 317 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
7650 : 12352 : "#"
7651 : 12383 : "&& reload_completed"
7652 : 12295 : [(set (match_dup 0)
7653 : 88 : (plus:SI
7654 : 0 : (mult:SI (match_dup 1) (match_dup 2))
7655 : 0 : (match_dup 3)))]
7656 : 145 : {
7657 : 25485 : operands[0] = gen_lowpart (SImode, operands[0]);
7658 : 13551 : operands[1] = gen_lowpart (SImode, operands[1]);
7659 : 577717 : operands[3] = gen_lowpart (SImode, operands[3]);
7660 : 577832 : }
7661 : 203 : [(set_attr "type" "lea")
7662 : 589499 : (set_attr "mode" "SI")])
7663 : 589418 :
7664 : 12232 : (define_insn_and_split "*lea<mode>_general_2b"
7665 : 203 : [(set (match_operand:SWI12 0 "register_operand" "=r")
7666 : 505026 : (plus:SWI12
7667 : 505229 : (ashift:SWI12 (match_operand:SWI12 1 "register_no_SP_operand" "l")
7668 : 12151 : (match_operand 2 "const123_operand" "n"))
7669 : 516815 : (match_operand:SWI12 3 "nonmemory_operand" "ri")))]
7670 : 2153 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
7671 : 8396 : "#"
7672 : 504719 : "&& reload_completed"
7673 : 5437 : [(set (match_dup 0)
7674 : 2802 : (plus:SI
7675 : 11830 : (ashift:SI (match_dup 1) (match_dup 2))
7676 : 11708 : (match_dup 3)))]
7677 : 376861 : {
7678 : 21478649 : operands[0] = gen_lowpart (SImode, operands[0]);
7679 : 501917 : operands[1] = gen_lowpart (SImode, operands[1]);
7680 : 502039 : operands[3] = gen_lowpart (SImode, operands[3]);
7681 : 499237 : }
7682 : 122 : [(set_attr "type" "lea")
7683 : 122 : (set_attr "mode" "SI")])
7684 : 501917 :
7685 : 3623 : (define_insn_and_split "*lea<mode>_general_3"
7686 : 2924 : [(set (match_operand:SWI12 0 "register_operand" "=r")
7687 : 6114 : (plus:SWI12
7688 : 6114 : (plus:SWI12
7689 : 3623 : (mult:SWI12 (match_operand:SWI12 1 "register_no_SP_operand" "l")
7690 : 3501 : (match_operand 2 "const248_operand" "n"))
7691 : 3623 : (match_operand:SWI12 3 "register_operand" "r"))
7692 : 3623 : (match_operand:SWI12 4 "immediate_operand" "i")))]
7693 : 12 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
7694 : 821 : "#"
7695 : 8 : "&& reload_completed"
7696 : 127 : [(set (match_dup 0)
7697 : 5 : (plus:SI
7698 : 2803 : (plus:SI
7699 : 2924 : (mult:SI (match_dup 1) (match_dup 2))
7700 : 2804 : (match_dup 3))
7701 : 6492 : (match_dup 4)))]
7702 : 6497 : {
7703 : 6497 : operands[0] = gen_lowpart (SImode, operands[0]);
7704 : 70164 : operands[1] = gen_lowpart (SImode, operands[1]);
7705 : 241 : operands[3] = gen_lowpart (SImode, operands[3]);
7706 : 2116 : operands[4] = gen_lowpart (SImode, operands[4]);
7707 : 6370 : }
7708 : 2221 : [(set_attr "type" "lea")
7709 : 7160 : (set_attr "mode" "SI")])
7710 : 2226 :
7711 : 7051 : (define_insn_and_split "*lea<mode>_general_3b"
7712 : 2222 : [(set (match_operand:SWI12 0 "register_operand" "=r")
7713 : 7134 : (plus:SWI12
7714 : 114 : (plus:SWI12
7715 : 7024 : (ashift:SWI12 (match_operand:SWI12 1 "register_no_SP_operand" "l")
7716 : 5033 : (match_operand 2 "const123_operand" "n"))
7717 : 5034 : (match_operand:SWI12 3 "register_operand" "r"))
7718 : 5 : (match_operand:SWI12 4 "immediate_operand" "i")))]
7719 : 43 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
7720 : 117 : "#"
7721 : 244 : "&& reload_completed"
7722 : 29 : [(set (match_dup 0)
7723 : 29 : (plus:SI
7724 : 35 : (plus:SI
7725 : 38 : (ashift:SI (match_dup 1) (match_dup 2))
7726 : 38 : (match_dup 3))
7727 : 0 : (match_dup 4)))]
7728 : 5 : {
7729 : 34 : operands[0] = gen_lowpart (SImode, operands[0]);
7730 : 29 : operands[1] = gen_lowpart (SImode, operands[1]);
7731 : 1532025 : operands[3] = gen_lowpart (SImode, operands[3]);
7732 : 1532025 : operands[4] = gen_lowpart (SImode, operands[4]);
7733 : 1531996 : }
7734 : 153250 : [(set_attr "type" "lea")
7735 : 241 : (set_attr "mode" "SI")])
7736 : 281 :
7737 : 205 : (define_insn_and_split "*lea<mode>_general_4"
7738 : 40 : [(set (match_operand:SWI12 0 "register_operand" "=r")
7739 : 40 : (any_or:SWI12
7740 : 40 : (ashift:SWI12
7741 : 40 : (match_operand:SWI12 1 "register_no_SP_operand" "l")
7742 : 40 : (match_operand 2 "const_0_to_3_operand"))
7743 : 40 : (match_operand 3 "const_int_operand")))]
7744 : 38 : "(!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun))
7745 : 130 : && ((unsigned HOST_WIDE_INT) INTVAL (operands[3])
7746 : 71 : < (HOST_WIDE_INT_1U << INTVAL (operands[2])))"
7747 : 96 : "#"
7748 : 8 : "&& reload_completed"
7749 : 6 : [(set (match_dup 0)
7750 : 6 : (plus:SI
7751 : 96 : (mult:SI (match_dup 1) (match_dup 2))
7752 : 1666 : (match_dup 3)))]
7753 : 14 : {
7754 : 35 : operands[0] = gen_lowpart (SImode, operands[0]);
7755 : 35 : operands[1] = gen_lowpart (SImode, operands[1]);
7756 : 6 : operands[2] = GEN_INT (1 << INTVAL (operands[2]));
7757 : 0 : }
7758 : 0 : [(set_attr "type" "lea")
7759 : 0 : (set_attr "mode" "SI")])
7760 : 6 :
7761 : 6 : (define_insn_and_split "*lea<mode>_general_4"
7762 : 29 : [(set (match_operand:SWI48 0 "register_operand" "=r")
7763 : 6 : (any_or:SWI48
7764 : 29 : (ashift:SWI48
7765 : 29 : (match_operand:SWI48 1 "register_no_SP_operand" "l")
7766 : 29 : (match_operand 2 "const_0_to_3_operand"))
7767 : 29 : (match_operand 3 "const_int_operand")))]
7768 : 4840 : "(unsigned HOST_WIDE_INT) INTVAL (operands[3])
7769 : 4600 : < (HOST_WIDE_INT_1U << INTVAL (operands[2]))"
7770 : 19 : "#"
7771 : 2004 : "&& reload_completed"
7772 : 188 : [(set (match_dup 0)
7773 : 1310 : (plus:SWI48
7774 : 2333 : (mult:SWI48 (match_dup 1) (match_dup 2))
7775 : 2286 : (match_dup 3)))]
7776 : 2056 : "operands[2] = GEN_INT (1 << INTVAL (operands[2]));"
7777 : 2847 : [(set_attr "type" "lea")
7778 : 2067 : (set_attr "mode" "<MODE>")])
7779 : 2908 :
7780 : 2740 : ;; Subtract instructions
7781 : 3614 :
7782 : 1833 : (define_expand "sub<mode>3"
7783 : 1000 : [(set (match_operand:SDWIM 0 "nonimmediate_operand")
7784 : 1833 : (minus:SDWIM (match_operand:SDWIM 1 "nonimmediate_operand")
7785 : 1833 : (match_operand:SDWIM 2 "<general_hilo_operand>")))]
7786 : 1833 : ""
7787 : 1000 : {
7788 : 520606 : ix86_expand_binary_operator (MINUS, <MODE>mode, operands, TARGET_APX_NDD);
7789 : 520606 : DONE;
7790 : 0 : })
7791 : 833 :
7792 : 0 : (define_insn_and_split "*sub<dwi>3_doubleword"
7793 : 1000 : [(set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,r,&r,&r")
7794 : 1000 : (minus:<DWI>
7795 : 1000 : (match_operand:<DWI> 1 "nonimmediate_operand" "0,0,ro,r")
7796 : 0 : (match_operand:<DWI> 2 "x86_64_hilo_general_operand" "r<di>,o,r<di>,o")))
7797 : 0 : (clobber (reg:CC FLAGS_REG))]
7798 : 3939751 : "ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)"
7799 : 0 : "#"
7800 : 13674 : "&& reload_completed"
7801 : 5874 : [(parallel [(set (reg:CC FLAGS_REG)
7802 : 0 : (compare:CC (match_dup 1) (match_dup 2)))
7803 : 169 : (set (match_dup 0)
7804 : 11683 : (minus:DWIH (match_dup 1) (match_dup 2)))])
7805 : 11514 : (parallel [(set (match_dup 3)
7806 : 20931 : (minus:DWIH
7807 : 2433 : (minus:DWIH
7808 : 169 : (match_dup 4)
7809 : 66 : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0)))
7810 : 2499 : (match_dup 5)))
7811 : 517509 : (clobber (reg:CC FLAGS_REG))])]
7812 : 6825 : {
7813 : 5744 : split_double_mode (<DWI>mode, &operands[0], 3, &operands[0], &operands[3]);
7814 : 5705 : if (operands[2] == const0_rtx)
7815 : 518590 : {
7816 : 517509 : if (!rtx_equal_p (operands[0], operands[1]))
7817 : 0 : emit_move_insn (operands[0], operands[1]);
7818 : 518590 : ix86_expand_binary_operator (MINUS, <MODE>mode, &operands[3],
7819 : 0 : TARGET_APX_NDD);
7820 : 0 : DONE;
7821 : 518590 : }
7822 : 0 : }
7823 : 1081 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")])
7824 : 0 :
7825 : 5705 : (define_insn_and_split "*sub<dwi>3_doubleword_zext"
7826 : 5705 : [(set (match_operand:<DWI> 0 "nonimmediate_operand" "=r,o,&r,&r")
7827 : 5705 : (minus:<DWI>
7828 : 5705 : (match_operand:<DWI> 1 "nonimmediate_operand" "0,0,r,o")
7829 : 5705 : (zero_extend:<DWI>
7830 : 5705 : (match_operand:DWIH 2 "nonimmediate_operand" "rm,r,rm,r"))))
7831 : 5705 : (clobber (reg:CC FLAGS_REG))]
7832 : 39878 : "ix86_binary_operator_ok (UNKNOWN, <DWI>mode, operands, TARGET_APX_NDD)"
7833 : 5705 : "#"
7834 : 6489 : "&& reload_completed"
7835 : 5705 : [(parallel [(set (reg:CC FLAGS_REG)
7836 : 6097 : (compare:CC (match_dup 1) (match_dup 2)))
7837 : 5705 : (set (match_dup 0)
7838 : 472 : (minus:DWIH (match_dup 1) (match_dup 2)))])
7839 : 944 : (parallel [(set (match_dup 3)
7840 : 0 : (minus:DWIH
7841 : 0 : (minus:DWIH
7842 : 248 : (match_dup 4)
7843 : 248 : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0)))
7844 : 0 : (const_int 0)))
7845 : 57 : (clobber (reg:CC FLAGS_REG))])]
7846 : 506 : "split_double_mode (<DWI>mode, &operands[0], 2, &operands[0], &operands[3]);"
7847 : 0 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")])
7848 : 5705 :
7849 : 392 : (define_insn "*sub<mode>_1"
7850 : 392 : [(set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,<r>,r,r,r")
7851 : 392 : (minus:SWI
7852 : 392 : (match_operand:SWI 1 "nonimmediate_operand" "0,0,rm,rjM,r")
7853 : 392 : (match_operand:SWI 2 "<general_operand>" "<r><i>,<m>,r,<i>,<m>")))
7854 : 392 : (clobber (reg:CC FLAGS_REG))]
7855 : 2270495 : "ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)"
7856 : 332037 : "@
7857 : 198778 : sub{<imodesuffix>}\t{%2, %0|%0, %2}
7858 : 198778 : sub{<imodesuffix>}\t{%2, %0|%0, %2}
7859 : 584547 : sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
7860 : 589860 : sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
7861 : 589860 : sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
7862 : 864423 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd,apx_ndd")
7863 : 33773 : (set_attr "type" "alu")
7864 : 46027 : (set_attr "mode" "<MODE>")])
7865 : 0 :
7866 : 0 : (define_insn "*subsi_1_zext"
7867 : 25949 : [(set (match_operand:DI 0 "register_operand" "=r,r,r")
7868 : 30729 : (zero_extend:DI
7869 : 16147 : (minus:SI (match_operand:SI 1 "nonimmediate_operand" "0,r,rm")
7870 : 37240 : (match_operand:SI 2 "x86_64_general_operand" "rBMe,rBMe,re"))))
7871 : 4780 : (clobber (reg:CC FLAGS_REG))]
7872 : 13979 : "TARGET_64BIT
7873 : 13004 : && ix86_binary_operator_ok (MINUS, SImode, operands, TARGET_APX_NDD)"
7874 : 5985 : "@
7875 : 12183 : sub{l}\t{%2, %k0|%k0, %2}
7876 : 7559 : sub{l}\t{%2, %1, %k0|%k0, %1, %2}
7877 : 4624 : sub{l}\t{%2, %1, %k0|%k0, %1, %2}"
7878 : 164 : [(set_attr "isa" "*,apx_ndd,apx_ndd")
7879 : 4624 : (set_attr "type" "alu")
7880 : 8 : (set_attr "mode" "SI")])
7881 : 8 :
7882 : 400 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
7883 : 392 : (define_insn_and_split "*sub<mode>_1_slp"
7884 : 392 : [(set (strict_low_part (match_operand:SWI12 0 "register_operand" "+<r>,&<r>"))
7885 : 0 : (minus:SWI12 (match_operand:SWI12 1 "register_operand" "0,!<r>")
7886 : 0 : (match_operand:SWI12 2 "general_operand" "<r>mn,<r>mn")))
7887 : 0 : (clobber (reg:CC FLAGS_REG))]
7888 : 78 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
7889 : 0 : "@
7890 : 242 : sub{<imodesuffix>}\t{%2, %0|%0, %2}
7891 : 5 : #"
7892 : 282 : "&& reload_completed
7893 : 277 : && !(rtx_equal_p (operands[0], operands[1]))"
7894 : 238 : [(set (strict_low_part (match_dup 0)) (match_dup 1))
7895 : 239 : (parallel
7896 : 3 : [(set (strict_low_part (match_dup 0))
7897 : 2 : (minus:SWI12 (match_dup 0) (match_dup 2)))
7898 : 243 : (clobber (reg:CC FLAGS_REG))])]
7899 : 0 : ""
7900 : 236 : [(set_attr "type" "alu")
7901 : 0 : (set_attr "mode" "<MODE>")])
7902 : 1654062 :
7903 : 1 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
7904 : 1858256 : (define_insn_and_split "*subqi_ext<mode>_1_slp"
7905 : 1751645 : [(set (strict_low_part (match_operand:QI 0 "register_operand" "+Q,&Q"))
7906 : 192129 : (minus:QI
7907 : 3266715 : (match_operand:QI 1 "nonimmediate_operand" "0,!qm")
7908 : 3087804 : (subreg:QI
7909 : 1660520 : (match_operator:SWI248 3 "extract_operator"
7910 : 6438 : [(match_operand 2 "int248_register_operand" "Q,Q")
7911 : 22 : (const_int 8)
7912 : 1654082 : (const_int 8)]) 0)))
7913 : 42 : (clobber (reg:CC FLAGS_REG))]
7914 : 11 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
7915 : 1432521 : "@
7916 : 32 : sub{b}\t{%h2, %0|%0, %h2}
7917 : 2 : #"
7918 : 15 : "&& reload_completed
7919 : 15 : && !rtx_equal_p (operands[0], operands[1])"
7920 : 46 : [(set (strict_low_part (match_dup 0)) (match_dup 1))
7921 : 46 : (parallel
7922 : 22 : [(set (strict_low_part (match_dup 0))
7923 : 5 : (minus:QI
7924 : 15 : (match_dup 0)
7925 : 10 : (subreg:QI
7926 : 1432474 : (match_op_dup 3
7927 : 10 : [(match_dup 2) (const_int 8) (const_int 8)]) 0)))
7928 : 1435113 : (clobber (reg:CC FLAGS_REG))])]
7929 : 1432474 : ""
7930 : 327 : [(set_attr "type" "alu")
7931 : 636 : (set_attr "mode" "QI")])
7932 : 104141 :
7933 : 37 : (define_insn_and_split "*subqi_ext<mode>_2_slp"
7934 : 615914 : [(set (strict_low_part (match_operand:QI 0 "register_operand" "+&Q"))
7935 : 615850 : (minus:QI
7936 : 25 : (subreg:QI
7937 : 1 : (match_operator:SWI248 3 "extract_operator"
7938 : 24 : [(match_operand 1 "int248_register_operand" "Q")
7939 : 24 : (const_int 8)
7940 : 0 : (const_int 8)]) 0)
7941 : 24 : (subreg:QI
7942 : 24 : (match_operator:SWI248 4 "extract_operator"
7943 : 0 : [(match_operand 2 "int248_register_operand" "Q")
7944 : 3 : (const_int 8)
7945 : 3 : (const_int 8)]) 0)))
7946 : 3 : (clobber (reg:CC FLAGS_REG))]
7947 : 5 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
7948 : 0 : "#"
7949 : 3 : "&& reload_completed"
7950 : 5 : [(set (strict_low_part (match_dup 0))
7951 : 3 : (subreg:QI
7952 : 1 : (match_op_dup 3
7953 : 2 : [(match_dup 1) (const_int 8) (const_int 8)]) 0))
7954 : 8 : (parallel
7955 : 0 : [(set (strict_low_part (match_dup 0))
7956 : 0 : (minus:QI
7957 : 0 : (match_dup 0)
7958 : 0 : (subreg:QI
7959 : 0 : (match_op_dup 4
7960 : 0 : [(match_dup 2) (const_int 8) (const_int 8)]) 0)))
7961 : 0 : (clobber (reg:CC FLAGS_REG))])]
7962 : 0 : ""
7963 : 0 : [(set_attr "type" "alu")
7964 : 1 : (set_attr "mode" "QI")])
7965 : 3 :
7966 : 4 : (define_insn "*sub<mode>_2"
7967 : 4 : [(set (reg FLAGS_REG)
7968 : 4 : (compare
7969 : 4 : (minus:SWI
7970 : 4 : (match_operand:SWI 1 "nonimmediate_operand" "0,0,rm,r")
7971 : 0 : (match_operand:SWI 2 "<general_operand>" "<r><i>,<m>,r<i>,<m>"))
7972 : 1 : (const_int 0)))
7973 : 0 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,<r>,r,r")
7974 : 1 : (minus:SWI (match_dup 1) (match_dup 2)))]
7975 : 42096 : "ix86_match_ccmode (insn, CCGOCmode)
7976 : 34841 : && ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)"
7977 : 3382 : "@
7978 : 0 : sub{<imodesuffix>}\t{%2, %0|%0, %2}
7979 : 0 : sub{<imodesuffix>}\t{%2, %0|%0, %2}
7980 : 42055 : sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
7981 : 73666 : sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
7982 : 0 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
7983 : 3 : (set_attr "type" "alu")
7984 : 0 : (set_attr "mode" "<MODE>")])
7985 : 0 :
7986 : 0 : (define_insn "*subsi_2_zext"
7987 : 0 : [(set (reg FLAGS_REG)
7988 : 0 : (compare
7989 : 0 : (minus:SI (match_operand:SI 1 "nonimmediate_operand" "0,r,rm")
7990 : 0 : (match_operand:SI 2 "x86_64_general_operand" "rBMe,rBMe,re"))
7991 : 0 : (const_int 0)))
7992 : 0 : (set (match_operand:DI 0 "register_operand" "=r,r,r")
7993 : 0 : (zero_extend:DI
7994 : 0 : (minus:SI (match_dup 1)
7995 : 0 : (match_dup 2))))]
7996 : 5 : "TARGET_64BIT && ix86_match_ccmode (insn, CCGOCmode)
7997 : 5 : && ix86_binary_operator_ok (MINUS, SImode, operands, TARGET_APX_NDD)"
7998 : 7 : "@
7999 : 0 : sub{l}\t{%2, %k0|%k0, %2}
8000 : 0 : sub{l}\t{%2, %1, %k0|%k0, %1, %2}
8001 : 0 : sub{l}\t{%2, %1, %k0|%k0, %1, %2}"
8002 : 0 : [(set_attr "isa" "*,apx_ndd,apx_ndd")
8003 : 0 : (set_attr "type" "alu")
8004 : 3 : (set_attr "mode" "SI")])
8005 : 3200 :
8006 : 3203 : (define_insn "*subqi_ext<mode>_0"
8007 : 3203 : [(set (match_operand:QI 0 "nonimmediate_operand" "=QBn")
8008 : 3 : (minus:QI
8009 : 3203 : (match_operand:QI 1 "nonimmediate_operand" "0")
8010 : 3 : (subreg:QI
8011 : 3 : (match_operator:SWI248 3 "extract_operator"
8012 : 3 : [(match_operand 2 "int248_register_operand" "Q")
8013 : 0 : (const_int 8)
8014 : 147 : (const_int 8)]) 0)))
8015 : 144 : (clobber (reg:CC FLAGS_REG))]
8016 : 0 : ""
8017 : 545 : "sub{b}\t{%h2, %0|%0, %h2}"
8018 : 545 : [(set_attr "addr" "gpr8")
8019 : 0 : (set_attr "type" "alu")
8020 : 208 : (set_attr "mode" "QI")])
8021 : 208 :
8022 : 0 : (define_insn_and_split "*subqi_ext2<mode>_0"
8023 : 0 : [(set (match_operand:QI 0 "register_operand" "=&Q")
8024 : 0 : (minus:QI
8025 : 0 : (subreg:QI
8026 : 0 : (match_operator:SWI248 3 "extract_operator"
8027 : 0 : [(match_operand 1 "int248_register_operand" "Q")
8028 : 0 : (const_int 8)
8029 : 0 : (const_int 8)]) 0)
8030 : 0 : (subreg:QI
8031 : 0 : (match_operator:SWI248 4 "extract_operator"
8032 : 0 : [(match_operand 2 "int248_register_operand" "Q")
8033 : 0 : (const_int 8)
8034 : 0 : (const_int 8)]) 0)))
8035 : 0 : (clobber (reg:CC FLAGS_REG))]
8036 : 0 : ""
8037 : 0 : "#"
8038 : 2 : "&& reload_completed"
8039 : 0 : [(set (match_dup 0)
8040 : 3 : (subreg:QI
8041 : 0 : (match_op_dup 3
8042 : 4 : [(match_dup 1) (const_int 8) (const_int 8)]) 0))
8043 : 4 : (parallel
8044 : 0 : [(set (match_dup 0)
8045 : 0 : (minus:QI
8046 : 17655 : (match_dup 0)
8047 : 17655 : (subreg:QI
8048 : 17655 : (match_op_dup 4
8049 : 17655 : [(match_dup 2) (const_int 8) (const_int 8)]) 0)))
8050 : 0 : (clobber (reg:CC FLAGS_REG))])]
8051 : 11 : ""
8052 : 11 : [(set_attr "type" "alu")
8053 : 0 : (set_attr "mode" "QI")])
8054 : 14 :
8055 : 14 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
8056 : 14 : (define_insn_and_split "*subqi_ext<mode>_1"
8057 : 14 : [(set (zero_extract:SWI248
8058 : 14 : (match_operand 0 "int248_register_operand" "+Q,&Q")
8059 : 14 : (const_int 8)
8060 : 14 : (const_int 8))
8061 : 3 : (subreg:SWI248
8062 : 14 : (minus:QI
8063 : 14 : (subreg:QI
8064 : 14 : (match_operator:SWI248 3 "extract_operator"
8065 : 0 : [(match_operand 1 "int248_register_operand" "0,!Q")
8066 : 0 : (const_int 8)
8067 : 0 : (const_int 8)]) 0)
8068 : 0 : (match_operand:QI 2 "general_operand" "QnBn,QnBn")) 0))
8069 : 0 : (clobber (reg:CC FLAGS_REG))]
8070 : 0 : ""
8071 : 3 : "@
8072 : 0 : sub{b}\t{%2, %h0|%h0, %2}
8073 : 0 : #"
8074 : 3 : "reload_completed
8075 : 12 : && !(rtx_equal_p (operands[0], operands[1]))"
8076 : 12 : [(set (zero_extract:SWI248
8077 : 2 : (match_dup 0) (const_int 8) (const_int 8))
8078 : 0 : (zero_extract:SWI248
8079 : 14 : (match_dup 1) (const_int 8) (const_int 8)))
8080 : 22 : (parallel
8081 : 0 : [(set (zero_extract:SWI248
8082 : 0 : (match_dup 0) (const_int 8) (const_int 8))
8083 : 3 : (subreg:SWI248
8084 : 3 : (minus:QI
8085 : 3 : (subreg:QI
8086 : 0 : (match_op_dup 3
8087 : 0 : [(match_dup 0) (const_int 8) (const_int 8)]) 0)
8088 : 0 : (match_dup 2)) 0))
8089 : 0 : (clobber (reg:CC FLAGS_REG))])]
8090 : 0 : ""
8091 : 2 : [(set_attr "addr" "gpr8")
8092 : 0 : (set_attr "type" "alu")
8093 : 4 : (set_attr "mode" "QI")])
8094 : 4 :
8095 : 4 : ;; Subtract with jump on overflow.
8096 : 4 : (define_expand "subv<mode>4"
8097 : 4 : [(parallel [(set (reg:CCO FLAGS_REG)
8098 : 0 : (eq:CCO
8099 : 2 : (minus:<DPWI>
8100 : 0 : (sign_extend:<DPWI>
8101 : 4 : (match_operand:SWIDWI 1 "nonimmediate_operand"))
8102 : 0 : (match_dup 4))
8103 : 0 : (sign_extend:<DPWI>
8104 : 0 : (minus:SWIDWI (match_dup 1)
8105 : 0 : (match_operand:SWIDWI 2
8106 : 0 : "<general_hilo_operand>")))))
8107 : 0 : (set (match_operand:SWIDWI 0 "register_operand")
8108 : 0 : (minus:SWIDWI (match_dup 1) (match_dup 2)))])
8109 : 2 : (set (pc) (if_then_else
8110 : 0 : (eq (reg:CCO FLAGS_REG) (const_int 0))
8111 : 0 : (label_ref (match_operand 3))
8112 : 0 : (pc)))]
8113 : 0 : ""
8114 : 6762 : {
8115 : 6762 : ix86_fixup_binary_operands_no_copy (MINUS, <MODE>mode, operands,
8116 : 6762 : TARGET_APX_NDD);
8117 : 6762 : if (CONST_SCALAR_INT_P (operands[2]))
8118 : 1638 : operands[4] = operands[2];
8119 : 0 : else
8120 : 5124 : operands[4] = gen_rtx_SIGN_EXTEND (<DPWI>mode, operands[2]);
8121 : 0 : })
8122 : 0 :
8123 : 0 : (define_insn "*subv<mode>4"
8124 : 6762 : [(set (reg:CCO FLAGS_REG)
8125 : 6762 : (eq:CCO (minus:<DWI>
8126 : 2 : (sign_extend:<DWI>
8127 : 2 : (match_operand:SWI 1 "nonimmediate_operand" "0,0,rm,r"))
8128 : 6764 : (sign_extend:<DWI>
8129 : 6762 : (match_operand:SWI 2 "<general_sext_operand>" "<r>We,m,rWe,m")))
8130 : 6762 : (sign_extend:<DWI>
8131 : 6762 : (minus:SWI (match_dup 1) (match_dup 2)))))
8132 : 6762 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,<r>,r,r")
8133 : 7352 : (minus:SWI (match_dup 1) (match_dup 2)))]
8134 : 8732 : "ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)"
8135 : 6762 : "@
8136 : 2 : sub{<imodesuffix>}\t{%2, %0|%0, %2}
8137 : 2 : sub{<imodesuffix>}\t{%2, %0|%0, %2}
8138 : 7837 : sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
8139 : 7837 : sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
8140 : 8708 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
8141 : 2 : (set_attr "type" "alu")
8142 : 0 : (set_attr "mode" "<MODE>")])
8143 : 2 :
8144 : 590 : (define_insn "subv<mode>4_1"
8145 : 590 : [(set (reg:CCO FLAGS_REG)
8146 : 590 : (eq:CCO (minus:<DWI>
8147 : 0 : (sign_extend:<DWI>
8148 : 0 : (match_operand:SWI 1 "nonimmediate_operand" "0,rm"))
8149 : 0 : (match_operand:<DWI> 3 "const_int_operand"))
8150 : 0 : (sign_extend:<DWI>
8151 : 0 : (minus:SWI
8152 : 6762 : (match_dup 1)
8153 : 0 : (match_operand:SWI 2 "x86_64_immediate_operand" "<i>,<i>")))))
8154 : 0 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,r")
8155 : 0 : (minus:SWI (match_dup 1) (match_dup 2)))]
8156 : 719 : "ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)
8157 : 1508 : && CONST_INT_P (operands[2])
8158 : 719 : && INTVAL (operands[2]) == INTVAL (operands[3])"
8159 : 0 : "@
8160 : 0 : sub{<imodesuffix>}\t{%2, %0|%0, %2}
8161 : 6762 : sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
8162 : 8064 : [(set_attr "isa" "*,apx_ndd")
8163 : 8853 : (set_attr "type" "alu")
8164 : 513 : (set_attr "mode" "<MODE>")
8165 : 1026 : (set (attr "length_immediate")
8166 : 0 : (cond [(match_test "IN_RANGE (INTVAL (operands[2]), -128, 127)")
8167 : 0 : (const_string "1")
8168 : 6172 : (match_test "<MODE_SIZE> == 8")
8169 : 2 : (const_string "4")]
8170 : 0 : (const_string "<MODE_SIZE>")))])
8171 : 2 :
8172 : 2 : (define_insn_and_split "*subv<dwi>4_doubleword"
8173 : 6174 : [(set (reg:CCO FLAGS_REG)
8174 : 8362 : (eq:CCO
8175 : 6172 : (minus:<QPWI>
8176 : 6174 : (sign_extend:<QPWI>
8177 : 8336 : (match_operand:<DWI> 1 "nonimmediate_operand" "0,0,ro,r"))
8178 : 2164 : (sign_extend:<QPWI>
8179 : 2162 : (match_operand:<DWI> 2 "nonimmediate_operand" "r,o,r,o")))
8180 : 2164 : (sign_extend:<QPWI>
8181 : 6172 : (minus:<DWI> (match_dup 1) (match_dup 2)))))
8182 : 0 : (set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,r,&r,&r")
8183 : 0 : (minus:<DWI> (match_dup 1) (match_dup 2)))]
8184 : 14722 : "ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)"
8185 : 0 : "#"
8186 : 1452 : "&& reload_completed"
8187 : 726 : [(parallel [(set (reg:CC FLAGS_REG)
8188 : 0 : (compare:CC (match_dup 1) (match_dup 2)))
8189 : 0 : (set (match_dup 0)
8190 : 1841 : (minus:DWIH (match_dup 1) (match_dup 2)))])
8191 : 1448 : (parallel [(set (reg:CCO FLAGS_REG)
8192 : 0 : (eq:CCO
8193 : 0 : (minus:<DWI>
8194 : 0 : (minus:<DWI>
8195 : 0 : (sign_extend:<DWI> (match_dup 4))
8196 : 0 : (ltu:<DWI> (reg:CC FLAGS_REG) (const_int 0)))
8197 : 0 : (sign_extend:<DWI> (match_dup 5)))
8198 : 0 : (sign_extend:<DWI>
8199 : 0 : (minus:DWIH
8200 : 0 : (minus:DWIH
8201 : 0 : (match_dup 4)
8202 : 0 : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0)))
8203 : 0 : (match_dup 5)))))
8204 : 0 : (set (match_dup 3)
8205 : 0 : (minus:DWIH
8206 : 0 : (minus:DWIH
8207 : 0 : (match_dup 4)
8208 : 0 : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0)))
8209 : 0 : (match_dup 5)))])]
8210 : 726 : {
8211 : 726 : split_double_mode (<DWI>mode, &operands[0], 3, &operands[0], &operands[3]);
8212 : 0 : }
8213 : 0 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")])
8214 : 0 :
8215 : 726 : (define_insn_and_split "*subv<dwi>4_doubleword_1"
8216 : 726 : [(set (reg:CCO FLAGS_REG)
8217 : 726 : (eq:CCO
8218 : 726 : (minus:<QPWI>
8219 : 726 : (sign_extend:<QPWI>
8220 : 726 : (match_operand:<DWI> 1 "nonimmediate_operand" "0,ro"))
8221 : 726 : (match_operand:<QPWI> 3 "const_scalar_int_operand"))
8222 : 726 : (sign_extend:<QPWI>
8223 : 726 : (minus:<DWI>
8224 : 726 : (match_dup 1)
8225 : 726 : (match_operand:<DWI> 2 "x86_64_hilo_general_operand" "<di>,<di>")))))
8226 : 726 : (set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,&r")
8227 : 726 : (minus:<DWI> (match_dup 1) (match_dup 2)))]
8228 : 704 : "ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)
8229 : 1066 : && CONST_SCALAR_INT_P (operands[2])
8230 : 1066 : && rtx_equal_p (operands[2], operands[3])"
8231 : 0 : "#"
8232 : 362 : "&& reload_completed"
8233 : 181 : [(parallel [(set (reg:CC FLAGS_REG)
8234 : 0 : (compare:CC (match_dup 1) (match_dup 2)))
8235 : 0 : (set (match_dup 0)
8236 : 362 : (minus:DWIH (match_dup 1) (match_dup 2)))])
8237 : 362 : (parallel [(set (reg:CCO FLAGS_REG)
8238 : 726 : (eq:CCO
8239 : 0 : (minus:<DWI>
8240 : 0 : (minus:<DWI>
8241 : 275 : (sign_extend:<DWI> (match_dup 4))
8242 : 275 : (ltu:<DWI> (reg:CC FLAGS_REG) (const_int 0)))
8243 : 0 : (match_dup 5))
8244 : 28 : (sign_extend:<DWI>
8245 : 28 : (minus:DWIH
8246 : 0 : (minus:DWIH
8247 : 0 : (match_dup 4)
8248 : 0 : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0)))
8249 : 0 : (match_dup 5)))))
8250 : 0 : (set (match_dup 3)
8251 : 0 : (minus:DWIH
8252 : 0 : (minus:DWIH
8253 : 0 : (match_dup 4)
8254 : 0 : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0)))
8255 : 0 : (match_dup 5)))])]
8256 : 181 : {
8257 : 181 : split_double_mode (<DWI>mode, &operands[0], 3, &operands[0], &operands[3]);
8258 : 181 : if (operands[2] == const0_rtx)
8259 : 0 : {
8260 : 2 : if (!rtx_equal_p (operands[0], operands[1]))
8261 : 0 : emit_move_insn (operands[0], operands[1]);
8262 : 2 : emit_insn (gen_subv<mode>4_1 (operands[3], operands[4], operands[5],
8263 : 0 : operands[5]));
8264 : 2 : DONE;
8265 : 0 : }
8266 : 0 : }
8267 : 0 : [(set_attr "isa" "*,apx_ndd")])
8268 : 0 :
8269 : 179 : (define_insn "*subv<mode>4_overflow_1"
8270 : 179 : [(set (reg:CCO FLAGS_REG)
8271 : 726 : (eq:CCO
8272 : 726 : (minus:<DWI>
8273 : 905 : (minus:<DWI>
8274 : 179 : (sign_extend:<DWI>
8275 : 179 : (match_operand:SWI 1 "nonimmediate_operand" "%0,0,rm,r"))
8276 : 179 : (match_operator:<DWI> 4 "ix86_carry_flag_operator"
8277 : 179 : [(match_operand 3 "flags_reg_operand") (const_int 0)]))
8278 : 179 : (sign_extend:<DWI>
8279 : 903 : (match_operand:SWI 2 "<general_sext_operand>" "rWe,m,rWe,m")))
8280 : 179 : (sign_extend:<DWI>
8281 : 179 : (minus:SWI
8282 : 724 : (minus:SWI
8283 : 724 : (match_dup 1)
8284 : 724 : (match_operator:SWI 5 "ix86_carry_flag_operator"
8285 : 724 : [(match_dup 3) (const_int 0)]))
8286 : 724 : (match_dup 2)))))
8287 : 724 : (set (match_operand:SWI 0 "nonimmediate_operand" "=rm,r,r,r")
8288 : 724 : (minus:SWI
8289 : 0 : (minus:SWI
8290 : 724 : (match_dup 1)
8291 : 0 : (match_op_dup 5 [(match_dup 3) (const_int 0)]))
8292 : 179 : (match_dup 2)))]
8293 : 968 : "ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)"
8294 : 0 : "@
8295 : 0 : sbb{<imodesuffix>}\t{%2, %0|%0, %2}
8296 : 0 : sbb{<imodesuffix>}\t{%2, %0|%0, %2}
8297 : 968 : sbb{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
8298 : 968 : sbb{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
8299 : 1936 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
8300 : 0 : (set_attr "type" "alu")
8301 : 0 : (set_attr "mode" "<MODE>")])
8302 : 0 :
8303 : 0 : (define_insn "*subv<mode>4_overflow_2"
8304 : 0 : [(set (reg:CCO FLAGS_REG)
8305 : 0 : (eq:CCO
8306 : 0 : (minus:<DWI>
8307 : 0 : (minus:<DWI>
8308 : 0 : (sign_extend:<DWI>
8309 : 0 : (match_operand:SWI 1 "nonimmediate_operand" "%0,rm"))
8310 : 0 : (match_operator:<DWI> 4 "ix86_carry_flag_operator"
8311 : 0 : [(match_operand 3 "flags_reg_operand") (const_int 0)]))
8312 : 0 : (match_operand:<DWI> 6 "const_int_operand" "n,n"))
8313 : 0 : (sign_extend:<DWI>
8314 : 0 : (minus:SWI
8315 : 0 : (minus:SWI
8316 : : (match_dup 1)
8317 : : (match_operator:SWI 5 "ix86_carry_flag_operator"
8318 : : [(match_dup 3) (const_int 0)]))
8319 : : (match_operand:SWI 2 "x86_64_immediate_operand" "e,e")))))
8320 : : (set (match_operand:SWI 0 "nonimmediate_operand" "=rm,r")
8321 : : (minus:SWI
8322 : : (minus:SWI
8323 : : (match_dup 1)
8324 : 179 : (match_op_dup 5 [(match_dup 3) (const_int 0)]))
8325 : 179 : (match_dup 2)))]
8326 : 358 : "ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)
8327 : 179 : && CONST_INT_P (operands[2])
8328 : 179 : && INTVAL (operands[2]) == INTVAL (operands[6])"
8329 : 0 : "@
8330 : 0 : sbb{<imodesuffix>}\t{%2, %0|%0, %2}
8331 : 624 : sbb{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
8332 : 360 : [(set_attr "isa" "*,apx_ndd")
8333 : 179 : (set_attr "type" "alu")
8334 : 718 : (set_attr "mode" "<MODE>")
8335 : 181 : (set (attr "length_immediate")
8336 : 805 : (if_then_else (match_test "IN_RANGE (INTVAL (operands[2]), -128, 127)")
8337 : 624 : (const_string "1")
8338 : 805 : (const_string "4")))])
8339 : 805 :
8340 : 805 : (define_expand "usubv<mode>4"
8341 : 181 : [(parallel [(set (reg:CC FLAGS_REG)
8342 : 0 : (compare:CC
8343 : 181 : (match_operand:SWI 1 "nonimmediate_operand")
8344 : 0 : (match_operand:SWI 2 "<general_operand>")))
8345 : 0 : (set (match_operand:SWI 0 "register_operand")
8346 : 0 : (minus:SWI (match_dup 1) (match_dup 2)))])
8347 : : (set (pc) (if_then_else
8348 : : (ltu (reg:CC FLAGS_REG) (const_int 0))
8349 : : (label_ref (match_operand 3))
8350 : : (pc)))]
8351 : : ""
8352 : 4302 : "ix86_fixup_binary_operands_no_copy (MINUS, <MODE>mode, operands,
8353 : 624 : TARGET_APX_NDD);")
8354 : :
8355 : : (define_insn "*sub<mode>_3"
8356 : 4302 : [(set (reg FLAGS_REG)
8357 : 4302 : (compare (match_operand:SWI 1 "nonimmediate_operand" "0,0,rm,r")
8358 : 4302 : (match_operand:SWI 2 "<general_operand>" "<r><i>,<m>,r<i>,<m>")))
8359 : 4302 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,<r>i,r,r")
8360 : 4302 : (minus:SWI (match_dup 1) (match_dup 2)))]
8361 : 26033 : "ix86_match_ccmode (insn, CCmode)
8362 : 26033 : && ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)"
8363 : 4439 : "@
8364 : : sub{<imodesuffix>}\t{%2, %0|%0, %2}
8365 : 4302 : sub{<imodesuffix>}\t{%2, %0|%0, %2}
8366 : 20907 : sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
8367 : 20907 : sub{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
8368 : 60367 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
8369 : : (set_attr "type" "alu")
8370 : : (set_attr "mode" "<MODE>")])
8371 : :
8372 : 1990164 : (define_peephole2
8373 : : [(parallel
8374 : 1990164 : [(set (reg:CC FLAGS_REG)
8375 : : (compare:CC (match_operand:SWI 0 "general_reg_operand")
8376 : 4302 : (match_operand:SWI 1 "general_gr_operand")))
8377 : 0 : (set (match_dup 0)
8378 : 0 : (minus:SWI (match_dup 0) (match_dup 1)))])]
8379 : 10071 : "find_regno_note (peep2_next_insn (0), REG_UNUSED, REGNO (operands[0])) != 0"
8380 : 3376 : [(set (reg:CC FLAGS_REG)
8381 : 1990182 : (compare:CC (match_dup 0) (match_dup 1)))])
8382 : 1990182 :
8383 : : (define_peephole2
8384 : 9845 : [(set (match_operand:SWI 0 "general_reg_operand")
8385 : 14147 : (match_operand:SWI 1 "memory_operand"))
8386 : 14147 : (parallel [(set (reg:CC FLAGS_REG)
8387 : 14147 : (compare:CC (match_dup 0)
8388 : 4498912 : (match_operand:SWI 2 "memory_operand")))
8389 : : (set (match_dup 0)
8390 : 4479222 : (minus:SWI (match_dup 0) (match_dup 2)))])
8391 : : (set (match_dup 1) (match_dup 0))]
8392 : 105901 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
8393 : 102235 : && peep2_reg_dead_p (3, operands[0])
8394 : 102235 : && !reg_overlap_mentioned_p (operands[0], operands[1])
8395 : 24 : && !reg_overlap_mentioned_p (operands[0], operands[2])"
8396 : 100597 : [(set (match_dup 0) (match_dup 2))
8397 : 3681 : (parallel [(set (reg:CC FLAGS_REG)
8398 : 3681 : (compare:CC (match_dup 1) (match_dup 0)))
8399 : 3 : (set (match_dup 1)
8400 : 0 : (minus:SWI (match_dup 1) (match_dup 0)))])])
8401 : 3678 :
8402 : 3678 : ;; decl %eax; cmpl $-1, %eax; jne .Lxx; can be optimized into
8403 : 3678 : ;; subl $1, %eax; jnc .Lxx;
8404 : 3685 : (define_peephole2
8405 : 7 : [(parallel
8406 : : [(set (match_operand:SWI 0 "general_reg_operand")
8407 : : (plus:SWI (match_dup 0) (const_int -1)))
8408 : : (clobber (reg FLAGS_REG))])
8409 : : (set (reg:CCZ FLAGS_REG)
8410 : 0 : (compare:CCZ (match_dup 0) (const_int -1)))
8411 : 0 : (set (pc)
8412 : 0 : (if_then_else (match_operator 1 "bt_comparison_operator"
8413 : : [(reg:CCZ FLAGS_REG) (const_int 0)])
8414 : : (match_operand 2)
8415 : : (pc)))]
8416 : 2918 : "peep2_regno_dead_p (3, FLAGS_REG)"
8417 : 1 : [(parallel
8418 : 1140 : [(set (reg:CC FLAGS_REG)
8419 : 1140 : (compare:CC (match_dup 0) (const_int 1)))
8420 : 0 : (set (match_dup 0)
8421 : 2919 : (minus:SWI (match_dup 0) (const_int 1)))])
8422 : 2919 : (set (pc)
8423 : 2918 : (if_then_else (match_dup 3)
8424 : 5837 : (match_dup 2)
8425 : 0 : (pc)))]
8426 : 2918 : {
8427 : 2918 : rtx cc = gen_rtx_REG (CCmode, FLAGS_REG);
8428 : 3392 : operands[3] = gen_rtx_fmt_ee (GET_CODE (operands[1]) == NE
8429 : 0 : ? GEU : LTU, VOIDmode, cc, const0_rtx);
8430 : 0 : })
8431 : :
8432 : : ;; Help combine use borrow flag to test for -1 after dec (add $-1).
8433 : 2918 : (define_insn_and_split "*dec_cmov<mode>"
8434 : 2918 : [(set (match_operand:SWI248 0 "register_operand" "=r")
8435 : 0 : (if_then_else:SWI248
8436 : 0 : (match_operator 1 "bt_comparison_operator"
8437 : 2918 : [(match_operand:SWI248 2 "register_operand" "0") (const_int 0)])
8438 : 2918 : (plus:SWI248 (match_dup 2) (const_int -1))
8439 : 2918 : (match_operand:SWI248 3 "nonimmediate_operand" "rm")))
8440 : 2918 : (clobber (reg:CC FLAGS_REG))]
8441 : 2976 : "TARGET_CMOVE"
8442 : : "#"
8443 : 178 : "&& reload_completed"
8444 : 52 : [(parallel [(set (reg:CC FLAGS_REG)
8445 : 72 : (compare:CC (match_dup 2) (const_int 1)))
8446 : 20 : (set (match_dup 0) (minus:SWI248 (match_dup 2) (const_int 1)))])
8447 : 30 : (set (match_dup 0)
8448 : 145922 : (if_then_else:SWI248 (match_dup 4) (match_dup 0) (match_dup 3)))]
8449 : 5822 : {
8450 : 133186 : rtx cc = gen_rtx_REG (CCCmode, FLAGS_REG);
8451 : 133168 : operands[4] = gen_rtx_fmt_ee (GET_CODE (operands[1]) == NE
8452 : 2918 : ? GEU : LTU, VOIDmode, cc, const0_rtx);
8453 : 112221 : })
8454 : 110034 :
8455 : 18 : (define_insn "*subsi_3_zext"
8456 : 110070 : [(set (reg FLAGS_REG)
8457 : 112934 : (compare (match_operand:SI 1 "nonimmediate_operand" "0,r,rm")
8458 : 2918 : (match_operand:SI 2 "x86_64_general_operand" "rBMe,rBMe,re")))
8459 : 112988 : (set (match_operand:DI 0 "register_operand" "=r,r,r")
8460 : 110034 : (zero_extend:DI
8461 : 110034 : (minus:SI (match_dup 1)
8462 : 110088 : (match_dup 2))))]
8463 : 110074 : "TARGET_64BIT && ix86_match_ccmode (insn, CCmode)
8464 : 54 : && ix86_binary_operator_ok (MINUS, SImode, operands, TARGET_APX_NDD)"
8465 : 2978 : "@
8466 : 109090 : sub{l}\t{%2, %1|%1, %2}
8467 : 111956 : sub{l}\t{%2, %1, %k0|%k0, %1, %2}
8468 : 112406 : sub{l}\t{%2, %1, %k0|%k0, %1, %2}"
8469 : 111956 : [(set_attr "isa" "*,apx_ndd,apx_ndd")
8470 : 112406 : (set_attr "type" "alu")
8471 : 112406 : (set_attr "mode" "SI")])
8472 : 111954 :
8473 : 109488 : ;; Add with carry and subtract with borrow
8474 : 111954 :
8475 : 109488 : (define_insn "@add<mode>3_carry"
8476 : 109486 : [(set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,<r>,r,r")
8477 : 109090 : (plus:SWI
8478 : 109486 : (plus:SWI
8479 : 450 : (match_operator:SWI 4 "ix86_carry_flag_operator"
8480 : 109053 : [(match_operand 3 "flags_reg_operand") (const_int 0)])
8481 : 108603 : (match_operand:SWI 1 "nonimmediate_operand" "%0,0,rm,r"))
8482 : 108657 : (match_operand:SWI 2 "<general_operand>" "<r><i>,<m>,r<i>,<m>")))
8483 : 62012 : (clobber (reg:CC FLAGS_REG))]
8484 : 42625 : "ix86_binary_operator_ok (PLUS, <MODE>mode, operands, TARGET_APX_NDD)"
8485 : 55758 : "@
8486 : 55686 : adc{<imodesuffix>}\t{%2, %0|%0, %2}
8487 : 532 : adc{<imodesuffix>}\t{%2, %0|%0, %2}
8488 : 99817 : adc{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
8489 : 37859 : adc{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
8490 : 80546 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
8491 : 9428 : (set_attr "type" "alu")
8492 : 62010 : (set_attr "use_carry" "1")
8493 : 123968 : (set_attr "pent_pair" "pu")
8494 : 961 : (set_attr "mode" "<MODE>")])
8495 : 39013 :
8496 : 39013 : (define_peephole2
8497 : 55 : [(set (match_operand:SWI 0 "general_reg_operand")
8498 : 61 : (match_operand:SWI 1 "memory_operand"))
8499 : 38961 : (parallel [(set (match_dup 0)
8500 : 39013 : (plus:SWI
8501 : 38961 : (plus:SWI
8502 : 0 : (match_operator:SWI 4 "ix86_carry_flag_operator"
8503 : 36301 : [(match_operand 3 "flags_reg_operand")
8504 : 36301 : (const_int 0)])
8505 : 36301 : (match_dup 0))
8506 : 36301 : (match_operand:SWI 2 "memory_operand")))
8507 : 36301 : (clobber (reg:CC FLAGS_REG))])
8508 : 0 : (set (match_dup 1) (match_dup 0))]
8509 : 0 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
8510 : 13562 : && peep2_reg_dead_p (3, operands[0])
8511 : 13562 : && !reg_overlap_mentioned_p (operands[0], operands[1])
8512 : 6 : && !reg_overlap_mentioned_p (operands[0], operands[2])"
8513 : 0 : [(set (match_dup 0) (match_dup 2))
8514 : 0 : (parallel [(set (match_dup 1)
8515 : 0 : (plus:SWI (plus:SWI (match_op_dup 4
8516 : 0 : [(match_dup 3) (const_int 0)])
8517 : : (match_dup 1))
8518 : : (match_dup 0)))
8519 : : (clobber (reg:CC FLAGS_REG))])])
8520 : :
8521 : 0 : (define_peephole2
8522 : 0 : [(set (match_operand:SWI 0 "general_reg_operand")
8523 : 0 : (match_operand:SWI 1 "memory_operand"))
8524 : 0 : (parallel [(set (match_dup 0)
8525 : 0 : (plus:SWI
8526 : 0 : (plus:SWI
8527 : : (match_operator:SWI 4 "ix86_carry_flag_operator"
8528 : : [(match_operand 3 "flags_reg_operand")
8529 : 0 : (const_int 0)])
8530 : : (match_dup 0))
8531 : 0 : (match_operand:SWI 2 "memory_operand")))
8532 : 0 : (clobber (reg:CC FLAGS_REG))])
8533 : 0 : (set (match_operand:SWI 5 "general_reg_operand") (match_dup 0))
8534 : 0 : (set (match_dup 1) (match_dup 5))]
8535 : 0 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
8536 : 0 : && peep2_reg_dead_p (3, operands[0])
8537 : 0 : && peep2_reg_dead_p (4, operands[5])
8538 : 0 : && !reg_overlap_mentioned_p (operands[0], operands[1])
8539 : 0 : && !reg_overlap_mentioned_p (operands[0], operands[2])
8540 : 0 : && !reg_overlap_mentioned_p (operands[5], operands[1])"
8541 : 0 : [(set (match_dup 0) (match_dup 2))
8542 : 0 : (parallel [(set (match_dup 1)
8543 : 0 : (plus:SWI (plus:SWI (match_op_dup 4
8544 : 0 : [(match_dup 3) (const_int 0)])
8545 : 0 : (match_dup 1))
8546 : 0 : (match_dup 0)))
8547 : 0 : (clobber (reg:CC FLAGS_REG))])])
8548 : 0 :
8549 : 2 : (define_insn "*add<mode>3_carry_0"
8550 : 2 : [(set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m")
8551 : 0 : (plus:SWI
8552 : 0 : (match_operator:SWI 2 "ix86_carry_flag_operator"
8553 : 0 : [(reg FLAGS_REG) (const_int 0)])
8554 : : (match_operand:SWI 1 "nonimmediate_operand" "0")))
8555 : 0 : (clobber (reg:CC FLAGS_REG))]
8556 : 443 : "!MEM_P (operands[0]) || rtx_equal_p (operands[0], operands[1])"
8557 : 784 : "adc{<imodesuffix>}\t{$0, %0|%0, 0}"
8558 : 323 : [(set_attr "type" "alu")
8559 : 323 : (set_attr "use_carry" "1")
8560 : 2102 : (set_attr "pent_pair" "pu")
8561 : 2102 : (set_attr "mode" "<MODE>")])
8562 : 2611 :
8563 : 459 : (define_insn "*add<mode>3_carry_0r"
8564 : : [(set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m")
8565 : 662 : (plus:SWI
8566 : 659 : (match_operator:SWI 2 "ix86_carry_flag_unset_operator"
8567 : 659 : [(reg FLAGS_REG) (const_int 0)])
8568 : 3 : (match_operand:SWI 1 "nonimmediate_operand" "0")))
8569 : 24 : (clobber (reg:CC FLAGS_REG))]
8570 : 48 : "!MEM_P (operands[0]) || rtx_equal_p (operands[0], operands[1])"
8571 : 141 : "sbb{<imodesuffix>}\t{$-1, %0|%0, -1}"
8572 : 0 : [(set_attr "type" "alu")
8573 : 3 : (set_attr "use_carry" "1")
8574 : 148 : (set_attr "pent_pair" "pu")
8575 : 148 : (set_attr "mode" "<MODE>")])
8576 : 168 :
8577 : 11 : (define_insn "*addsi3_carry_zext"
8578 : 3 : [(set (match_operand:DI 0 "register_operand" "=r,r,r")
8579 : 5204 : (zero_extend:DI
8580 : 5204 : (plus:SI
8581 : 0 : (plus:SI (match_operator:SI 3 "ix86_carry_flag_operator"
8582 : 16 : [(reg FLAGS_REG) (const_int 0)])
8583 : 20 : (match_operand:SI 1 "nonimmediate_operand" "%0,r,rm"))
8584 : 0 : (match_operand:SI 2 "x86_64_general_operand" "rBMe,rBMe,re"))))
8585 : 0 : (clobber (reg:CC FLAGS_REG))]
8586 : 2 : "TARGET_64BIT
8587 : 2 : && ix86_binary_operator_ok (PLUS, SImode, operands, TARGET_APX_NDD)"
8588 : 0 : "@
8589 : 1 : adc{l}\t{%2, %k0|%k0, %2}
8590 : 1 : adc{l}\t{%2, %1, %k0|%k0, %1, %2}
8591 : 0 : adc{l}\t{%2, %1, %k0|%k0, %1, %2}"
8592 : 9 : [(set_attr "isa" "*,apx_ndd,apx_ndd")
8593 : 12 : (set_attr "type" "alu")
8594 : 3 : (set_attr "use_carry" "1")
8595 : 9 : (set_attr "pent_pair" "pu")
8596 : 9 : (set_attr "mode" "SI")])
8597 : 9 :
8598 : : (define_insn "*addsi3_carry_zext_0"
8599 : : [(set (match_operand:DI 0 "register_operand" "=r,r")
8600 : : (zero_extend:DI
8601 : 9 : (plus:SI (match_operator:SI 2 "ix86_carry_flag_operator"
8602 : : [(reg FLAGS_REG) (const_int 0)])
8603 : 9 : (match_operand:SI 1 "nonimmediate_operand" "0,rm"))))
8604 : 9 : (clobber (reg:CC FLAGS_REG))]
8605 : 18 : "TARGET_64BIT"
8606 : 9 : "@
8607 : 18 : adc{l}\t{$0, %k0|%k0, 0}
8608 : 9 : adc{l}\t{$0, %1, %k0|%k0, %1, 0}"
8609 : 9 : [(set_attr "isa" "*,apx_ndd")
8610 : 9 : (set_attr "type" "alu")
8611 : 9 : (set_attr "use_carry" "1")
8612 : 9 : (set_attr "pent_pair" "pu")
8613 : 9 : (set_attr "mode" "SI")])
8614 : 9 :
8615 : 9 : (define_insn "*addsi3_carry_zext_0r"
8616 : 9 : [(set (match_operand:DI 0 "register_operand" "=r,r")
8617 : : (zero_extend:DI
8618 : 9 : (plus:SI (match_operator:SI 2 "ix86_carry_flag_unset_operator"
8619 : 3 : [(reg FLAGS_REG) (const_int 0)])
8620 : 3 : (match_operand:SI 1 "nonimmediate_operand" "0,rm"))))
8621 : 3 : (clobber (reg:CC FLAGS_REG))]
8622 : 3 : "TARGET_64BIT"
8623 : 3 : "@
8624 : 3 : sbb{l}\t{$-1, %k0|%k0, -1}
8625 : 0 : sbb{l}\t{$-1, %1, %k0|%k0, %1, -1}"
8626 : 3 : [(set_attr "isa" "*,apx_ndd")
8627 : 3 : (set_attr "type" "alu")
8628 : 5 : (set_attr "use_carry" "1")
8629 : 11 : (set_attr "pent_pair" "pu")
8630 : 11 : (set_attr "mode" "SI")])
8631 : 12 :
8632 : 5 : ;; There is no point to generate ADCX instruction. ADC is shorter and faster.
8633 : 5 :
8634 : 3 : (define_insn "addcarry<mode>"
8635 : 5 : [(set (reg:CCC FLAGS_REG)
8636 : 5 : (compare:CCC
8637 : 5 : (zero_extend:<DWI>
8638 : 2 : (plus:SWI48
8639 : 3 : (plus:SWI48
8640 : 0 : (match_operator:SWI48 5 "ix86_carry_flag_operator"
8641 : 0 : [(match_operand 3 "flags_reg_operand") (const_int 0)])
8642 : 0 : (match_operand:SWI48 1 "nonimmediate_operand" "%0,0,rm,r"))
8643 : 0 : (match_operand:SWI48 2 "nonimmediate_operand" "r,rm,r,m")))
8644 : 0 : (plus:<DWI>
8645 : 0 : (zero_extend:<DWI> (match_dup 2))
8646 : 0 : (match_operator:<DWI> 4 "ix86_carry_flag_operator"
8647 : : [(match_dup 3) (const_int 0)]))))
8648 : : (set (match_operand:SWI48 0 "nonimmediate_operand" "=rm,r,r,r")
8649 : : (plus:SWI48 (plus:SWI48 (match_op_dup 5
8650 : 3 : [(match_dup 3) (const_int 0)])
8651 : 3 : (match_dup 1))
8652 : 3 : (match_dup 2)))]
8653 : 16069 : "ix86_binary_operator_ok (PLUS, <MODE>mode, operands, TARGET_APX_NDD)"
8654 : 3 : "@
8655 : : adc{<imodesuffix>}\t{%2, %0|%0, %2}
8656 : : adc{<imodesuffix>}\t{%2, %0|%0, %2}
8657 : 14693 : adc{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
8658 : 14693 : adc{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
8659 : 29374 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
8660 : 0 : (set_attr "type" "alu")
8661 : 0 : (set_attr "use_carry" "1")
8662 : 0 : (set_attr "pent_pair" "pu")
8663 : 0 : (set_attr "mode" "<MODE>")])
8664 : 0 :
8665 : 0 : (define_peephole2
8666 : 0 : [(parallel [(set (reg:CCC FLAGS_REG)
8667 : 0 : (compare:CCC
8668 : 0 : (zero_extend:<DWI>
8669 : 0 : (plus:SWI48
8670 : 0 : (plus:SWI48
8671 : 0 : (match_operator:SWI48 4 "ix86_carry_flag_operator"
8672 : 0 : [(match_operand 2 "flags_reg_operand")
8673 : 0 : (const_int 0)])
8674 : 0 : (match_operand:SWI48 0 "general_reg_operand"))
8675 : 0 : (match_operand:SWI48 1 "memory_operand")))
8676 : 0 : (plus:<DWI>
8677 : 0 : (zero_extend:<DWI> (match_dup 1))
8678 : 0 : (match_operator:<DWI> 3 "ix86_carry_flag_operator"
8679 : 0 : [(match_dup 2) (const_int 0)]))))
8680 : : (set (match_dup 0)
8681 : 0 : (plus:SWI48 (plus:SWI48 (match_op_dup 4
8682 : : [(match_dup 2) (const_int 0)])
8683 : : (match_dup 0))
8684 : : (match_dup 1)))])
8685 : : (set (match_dup 1) (match_dup 0))]
8686 : 1 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
8687 : 305 : && peep2_reg_dead_p (2, operands[0])
8688 : 304 : && !reg_overlap_mentioned_p (operands[0], operands[1])"
8689 : 0 : [(parallel [(set (reg:CCC FLAGS_REG)
8690 : 1 : (compare:CCC
8691 : 1 : (zero_extend:<DWI>
8692 : 0 : (plus:SWI48
8693 : 0 : (plus:SWI48
8694 : 0 : (match_op_dup 4
8695 : : [(match_dup 2) (const_int 0)])
8696 : : (match_dup 1))
8697 : : (match_dup 0)))
8698 : : (plus:<DWI>
8699 : : (zero_extend:<DWI> (match_dup 0))
8700 : 0 : (match_op_dup 3
8701 : : [(match_dup 2) (const_int 0)]))))
8702 : 0 : (set (match_dup 1)
8703 : 0 : (plus:SWI48 (plus:SWI48 (match_op_dup 4
8704 : 0 : [(match_dup 2) (const_int 0)])
8705 : 0 : (match_dup 1))
8706 : 0 : (match_dup 0)))])])
8707 : 0 :
8708 : 0 : (define_peephole2
8709 : 0 : [(set (match_operand:SWI48 0 "general_reg_operand")
8710 : 0 : (match_operand:SWI48 1 "memory_operand"))
8711 : 0 : (parallel [(set (reg:CCC FLAGS_REG)
8712 : 0 : (compare:CCC
8713 : 0 : (zero_extend:<DWI>
8714 : 0 : (plus:SWI48
8715 : 0 : (plus:SWI48
8716 : 0 : (match_operator:SWI48 5 "ix86_carry_flag_operator"
8717 : 0 : [(match_operand 3 "flags_reg_operand")
8718 : 0 : (const_int 0)])
8719 : 0 : (match_dup 0))
8720 : 0 : (match_operand:SWI48 2 "memory_operand")))
8721 : 0 : (plus:<DWI>
8722 : : (zero_extend:<DWI> (match_dup 2))
8723 : 0 : (match_operator:<DWI> 4 "ix86_carry_flag_operator"
8724 : : [(match_dup 3) (const_int 0)]))))
8725 : : (set (match_dup 0)
8726 : : (plus:SWI48 (plus:SWI48 (match_op_dup 5
8727 : : [(match_dup 3) (const_int 0)])
8728 : : (match_dup 0))
8729 : : (match_dup 2)))])
8730 : : (set (match_dup 1) (match_dup 0))]
8731 : 0 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
8732 : 24 : && peep2_reg_dead_p (3, operands[0])
8733 : 22 : && !reg_overlap_mentioned_p (operands[0], operands[1])
8734 : 46 : && !reg_overlap_mentioned_p (operands[0], operands[2])"
8735 : 0 : [(set (match_dup 0) (match_dup 2))
8736 : 6 : (parallel [(set (reg:CCC FLAGS_REG)
8737 : 6 : (compare:CCC
8738 : 6 : (zero_extend:<DWI>
8739 : : (plus:SWI48
8740 : : (plus:SWI48
8741 : : (match_op_dup 5
8742 : 0 : [(match_dup 3) (const_int 0)])
8743 : 6 : (match_dup 1))
8744 : 6 : (match_dup 0)))
8745 : 0 : (plus:<DWI>
8746 : 0 : (zero_extend:<DWI> (match_dup 0))
8747 : 0 : (match_op_dup 4
8748 : 0 : [(match_dup 3) (const_int 0)]))))
8749 : 0 : (set (match_dup 1)
8750 : 0 : (plus:SWI48 (plus:SWI48 (match_op_dup 5
8751 : 0 : [(match_dup 3) (const_int 0)])
8752 : 0 : (match_dup 1))
8753 : 0 : (match_dup 0)))])])
8754 : 0 :
8755 : 0 : (define_peephole2
8756 : 0 : [(parallel [(set (reg:CCC FLAGS_REG)
8757 : 0 : (compare:CCC
8758 : 0 : (zero_extend:<DWI>
8759 : 0 : (plus:SWI48
8760 : 0 : (plus:SWI48
8761 : 0 : (match_operator:SWI48 4 "ix86_carry_flag_operator"
8762 : 0 : [(match_operand 2 "flags_reg_operand")
8763 : 0 : (const_int 0)])
8764 : : (match_operand:SWI48 0 "general_reg_operand"))
8765 : 0 : (match_operand:SWI48 1 "memory_operand")))
8766 : : (plus:<DWI>
8767 : : (zero_extend:<DWI> (match_dup 1))
8768 : : (match_operator:<DWI> 3 "ix86_carry_flag_operator"
8769 : : [(match_dup 2) (const_int 0)]))))
8770 : : (set (match_dup 0)
8771 : : (plus:SWI48 (plus:SWI48 (match_op_dup 4
8772 : : [(match_dup 2) (const_int 0)])
8773 : : (match_dup 0))
8774 : : (match_dup 1)))])
8775 : : (set (match_operand:QI 5 "general_reg_operand")
8776 : 0 : (ltu:QI (reg:CCC FLAGS_REG) (const_int 0)))
8777 : 0 : (set (match_operand:SWI48 6 "general_reg_operand")
8778 : 0 : (zero_extend:SWI48 (match_dup 5)))
8779 : : (set (match_dup 1) (match_dup 0))]
8780 : 42 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
8781 : 42 : && peep2_reg_dead_p (4, operands[0])
8782 : 42 : && !reg_overlap_mentioned_p (operands[0], operands[1])
8783 : 42 : && !reg_overlap_mentioned_p (operands[0], operands[5])
8784 : 42 : && !reg_overlap_mentioned_p (operands[5], operands[1])
8785 : 42 : && !reg_overlap_mentioned_p (operands[0], operands[6])
8786 : 42 : && !reg_overlap_mentioned_p (operands[6], operands[1])"
8787 : 0 : [(parallel [(set (reg:CCC FLAGS_REG)
8788 : 0 : (compare:CCC
8789 : 0 : (zero_extend:<DWI>
8790 : 0 : (plus:SWI48
8791 : 0 : (plus:SWI48
8792 : 0 : (match_op_dup 4
8793 : 0 : [(match_dup 2) (const_int 0)])
8794 : 0 : (match_dup 1))
8795 : 4184 : (match_dup 0)))
8796 : 4184 : (plus:<DWI>
8797 : 0 : (zero_extend:<DWI> (match_dup 0))
8798 : 304 : (match_op_dup 3
8799 : 607 : [(match_dup 2) (const_int 0)]))))
8800 : 0 : (set (match_dup 1)
8801 : 0 : (plus:SWI48 (plus:SWI48 (match_op_dup 4
8802 : 0 : [(match_dup 2) (const_int 0)])
8803 : 0 : (match_dup 1))
8804 : 0 : (match_dup 0)))])
8805 : 0 : (set (match_dup 5) (ltu:QI (reg:CCC FLAGS_REG) (const_int 0)))
8806 : : (set (match_dup 6) (zero_extend:SWI48 (match_dup 5)))])
8807 : 0 :
8808 : : (define_expand "addcarry<mode>_0"
8809 : : [(parallel
8810 : : [(set (reg:CCC FLAGS_REG)
8811 : : (compare:CCC
8812 : : (plus:SWI48
8813 : : (match_operand:SWI48 1 "nonimmediate_operand")
8814 : : (match_operand:SWI48 2 "x86_64_general_operand"))
8815 : : (match_dup 1)))
8816 : : (set (match_operand:SWI48 0 "nonimmediate_operand")
8817 : : (plus:SWI48 (match_dup 1) (match_dup 2)))])]
8818 : 0 : "ix86_binary_operator_ok (PLUS, <MODE>mode, operands, TARGET_APX_NDD)")
8819 : 0 :
8820 : 0 : (define_insn "*addcarry<mode>_1"
8821 : : [(set (reg:CCC FLAGS_REG)
8822 : : (compare:CCC
8823 : : (zero_extend:<DWI>
8824 : : (plus:SWI48
8825 : : (plus:SWI48
8826 : 1 : (match_operator:SWI48 5 "ix86_carry_flag_operator"
8827 : : [(match_operand 3 "flags_reg_operand") (const_int 0)])
8828 : 1 : (match_operand:SWI48 1 "nonimmediate_operand" "%0,rm"))
8829 : 1 : (match_operand:SWI48 2 "x86_64_immediate_operand" "e,e")))
8830 : 1 : (plus:<DWI>
8831 : 1 : (match_operand:<DWI> 6 "const_scalar_int_operand")
8832 : 1 : (match_operator:<DWI> 4 "ix86_carry_flag_operator"
8833 : 1 : [(match_dup 3) (const_int 0)]))))
8834 : 1 : (set (match_operand:SWI48 0 "nonimmediate_operand" "=rm,r")
8835 : 0 : (plus:SWI48 (plus:SWI48 (match_op_dup 5
8836 : 1 : [(match_dup 3) (const_int 0)])
8837 : 1 : (match_dup 1))
8838 : 1 : (match_dup 2)))]
8839 : 149 : "ix86_binary_operator_ok (PLUS, <MODE>mode, operands, TARGET_APX_NDD)
8840 : 149 : && CONST_INT_P (operands[2])
8841 : 1 : /* Check that operands[6] is operands[2] zero extended from
8842 : 1 : <MODE>mode to <DWI>mode. */
8843 : 272 : && ((<MODE>mode == SImode || INTVAL (operands[2]) >= 0)
8844 : 130 : ? (CONST_INT_P (operands[6])
8845 : 130 : && UINTVAL (operands[6]) == (UINTVAL (operands[2])
8846 : 130 : & GET_MODE_MASK (<MODE>mode)))
8847 : 20 : : (CONST_WIDE_INT_P (operands[6])
8848 : 19 : && CONST_WIDE_INT_NUNITS (operands[6]) == 2
8849 : 19 : && ((unsigned HOST_WIDE_INT) CONST_WIDE_INT_ELT (operands[6], 0)
8850 : : == UINTVAL (operands[2]))
8851 : 19 : && CONST_WIDE_INT_ELT (operands[6], 1) == 0))"
8852 : 0 : "@
8853 : : adc{<imodesuffix>}\t{%2, %0|%0, %2}
8854 : : adc{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
8855 : 145 : [(set_attr "isa" "*,apx_ndd")
8856 : 145 : (set_attr "type" "alu")
8857 : 580 : (set_attr "use_carry" "1")
8858 : : (set_attr "pent_pair" "pu")
8859 : : (set_attr "mode" "<MODE>")
8860 : : (set (attr "length_immediate")
8861 : 2162 : (if_then_else (match_test "IN_RANGE (INTVAL (operands[2]), -128, 127)")
8862 : : (const_string "1")
8863 : : (const_string "4")))])
8864 : :
8865 : 2188 : (define_insn "@sub<mode>3_carry"
8866 : : [(set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,<r>,r,r")
8867 : : (minus:SWI
8868 : : (minus:SWI
8869 : : (match_operand:SWI 1 "nonimmediate_operand" "0,0,rm,r")
8870 : 608 : (match_operator:SWI 4 "ix86_carry_flag_operator"
8871 : 608 : [(match_operand 3 "flags_reg_operand") (const_int 0)]))
8872 : 608 : (match_operand:SWI 2 "<general_operand>" "<r><i>,<m>,r<i>,<m>")))
8873 : : (clobber (reg:CC FLAGS_REG))]
8874 : 12441 : "ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)"
8875 : 23 : "@
8876 : 72 : sbb{<imodesuffix>}\t{%2, %0|%0, %2}
8877 : 71 : sbb{<imodesuffix>}\t{%2, %0|%0, %2}
8878 : 9320 : sbb{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
8879 : 9320 : sbb{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
8880 : 23455 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
8881 : 7844 : (set_attr "type" "alu")
8882 : 303 : (set_attr "use_carry" "1")
8883 : 2 : (set_attr "pent_pair" "pu")
8884 : 305 : (set_attr "mode" "<MODE>")])
8885 : 303 :
8886 : 303 : (define_peephole2
8887 : 303 : [(set (match_operand:SWI 0 "general_reg_operand")
8888 : 303 : (match_operand:SWI 1 "memory_operand"))
8889 : 303 : (parallel [(set (match_dup 0)
8890 : 303 : (minus:SWI
8891 : 0 : (minus:SWI
8892 : 303 : (match_dup 0)
8893 : 303 : (match_operator:SWI 4 "ix86_carry_flag_operator"
8894 : 303 : [(match_operand 3 "flags_reg_operand")
8895 : 303 : (const_int 0)]))
8896 : 303 : (match_operand:SWI 2 "memory_operand")))
8897 : 303 : (clobber (reg:CC FLAGS_REG))])
8898 : 303 : (set (match_dup 1) (match_dup 0))]
8899 : 303 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
8900 : 311 : && peep2_reg_dead_p (3, operands[0])
8901 : 311 : && !reg_overlap_mentioned_p (operands[0], operands[1])
8902 : 319 : && !reg_overlap_mentioned_p (operands[0], operands[2])"
8903 : 303 : [(set (match_dup 0) (match_dup 2))
8904 : 2 : (parallel [(set (match_dup 1)
8905 : 2 : (minus:SWI (minus:SWI (match_dup 1)
8906 : 2 : (match_op_dup 4
8907 : : [(match_dup 3) (const_int 0)]))
8908 : : (match_dup 0)))
8909 : : (clobber (reg:CC FLAGS_REG))])])
8910 : :
8911 : 0 : (define_peephole2
8912 : 0 : [(set (match_operand:SWI 0 "general_reg_operand")
8913 : : (match_operand:SWI 1 "memory_operand"))
8914 : : (parallel [(set (match_dup 0)
8915 : : (minus:SWI
8916 : : (minus:SWI
8917 : : (match_dup 0)
8918 : : (match_operator:SWI 4 "ix86_carry_flag_operator"
8919 : : [(match_operand 3 "flags_reg_operand")
8920 : : (const_int 0)]))
8921 : : (match_operand:SWI 2 "memory_operand")))
8922 : : (clobber (reg:CC FLAGS_REG))])
8923 : : (set (match_operand:SWI 5 "general_reg_operand") (match_dup 0))
8924 : : (set (match_dup 1) (match_dup 5))]
8925 : 0 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
8926 : 0 : && peep2_reg_dead_p (3, operands[0])
8927 : 0 : && peep2_reg_dead_p (4, operands[5])
8928 : 0 : && !reg_overlap_mentioned_p (operands[0], operands[1])
8929 : 0 : && !reg_overlap_mentioned_p (operands[0], operands[2])
8930 : 303 : && !reg_overlap_mentioned_p (operands[5], operands[1])"
8931 : 303 : [(set (match_dup 0) (match_dup 2))
8932 : 303 : (parallel [(set (match_dup 1)
8933 : 0 : (minus:SWI (minus:SWI (match_dup 1)
8934 : 0 : (match_op_dup 4
8935 : : [(match_dup 3) (const_int 0)]))
8936 : : (match_dup 0)))
8937 : : (clobber (reg:CC FLAGS_REG))])])
8938 : 6 :
8939 : : (define_insn "*sub<mode>3_carry_0"
8940 : 6 : [(set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m")
8941 : 6 : (minus:SWI
8942 : 6 : (match_operand:SWI 1 "nonimmediate_operand" "0")
8943 : 6022 : (match_operator:SWI 2 "ix86_carry_flag_operator"
8944 : 631984 : [(reg FLAGS_REG) (const_int 0)])))
8945 : 694122 : (clobber (reg:CC FLAGS_REG))]
8946 : 11623 : "!MEM_P (operands[0]) || rtx_equal_p (operands[0], operands[1])"
8947 : 202 : "sbb{<imodesuffix>}\t{$0, %0|%0, 0}"
8948 : 8 : [(set_attr "type" "alu")
8949 : 12 : (set_attr "use_carry" "1")
8950 : 14 : (set_attr "pent_pair" "pu")
8951 : 400 : (set_attr "mode" "<MODE>")])
8952 : 413 :
8953 : 6 : (define_insn "*sub<mode>3_carry_0r"
8954 : 109 : [(set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m")
8955 : 109 : (minus:SWI
8956 : 1746 : (match_operand:SWI 1 "nonimmediate_operand" "0")
8957 : 1746 : (match_operator:SWI 2 "ix86_carry_flag_unset_operator"
8958 : 6 : [(reg FLAGS_REG) (const_int 0)])))
8959 : 84 : (clobber (reg:CC FLAGS_REG))]
8960 : 131 : "!MEM_P (operands[0]) || rtx_equal_p (operands[0], operands[1])"
8961 : 132 : "adc{<imodesuffix>}\t{$-1, %0|%0, -1}"
8962 : 18 : [(set_attr "type" "alu")
8963 : 12 : (set_attr "use_carry" "1")
8964 : 50 : (set_attr "pent_pair" "pu")
8965 : 44 : (set_attr "mode" "<MODE>")])
8966 : 47 :
8967 : 0 : (define_insn "*subsi3_carry_zext"
8968 : 4 : [(set (match_operand:DI 0 "register_operand" "=r,r,r")
8969 : 4 : (zero_extend:DI
8970 : 1821 : (minus:SI
8971 : : (minus:SI
8972 : 55 : (match_operand:SI 1 "nonimmediate_operand" "0,r,rm")
8973 : 55 : (match_operator:SI 3 "ix86_carry_flag_operator"
8974 : : [(reg FLAGS_REG) (const_int 0)]))
8975 : : (match_operand:SI 2 "x86_64_general_operand" "rBMe,rBMe,re"))))
8976 : : (clobber (reg:CC FLAGS_REG))]
8977 : 10 : "TARGET_64BIT
8978 : 10 : && ix86_binary_operator_ok (MINUS, SImode, operands, TARGET_APX_NDD)"
8979 : 4 : "@
8980 : 1 : sbb{l}\t{%2, %k0|%k0, %2}
8981 : 1 : sbb{l}\t{%2, %1, %k0|%k0, %1, %2}
8982 : 3916 : sbb{l}\t{%2, %1, %k0|%k0, %1, %2}"
8983 : 7082 : [(set_attr "isa" "*,apx_ndd,apx_ndd")
8984 : 3916 : (set_attr "type" "alu")
8985 : 3166 : (set_attr "use_carry" "1")
8986 : 3916 : (set_attr "pent_pair" "pu")
8987 : 3166 : (set_attr "mode" "SI")])
8988 : 1497 :
8989 : 2188 : (define_insn "*subsi3_carry_zext_0"
8990 : 1497 : [(set (match_operand:DI 0 "register_operand" "=r")
8991 : 697 : (zero_extend:DI
8992 : 1503 : (minus:SI
8993 : 2194 : (match_operand:SI 1 "register_operand" "0")
8994 : 1497 : (match_operator:SI 2 "ix86_carry_flag_operator"
8995 : 691 : [(reg FLAGS_REG) (const_int 0)]))))
8996 : 1497 : (clobber (reg:CC FLAGS_REG))]
8997 : 8 : "TARGET_64BIT"
8998 : 1497 : "sbb{l}\t{$0, %k0|%k0, 0}"
8999 : 2204 : [(set_attr "type" "alu")
9000 : 699 : (set_attr "use_carry" "1")
9001 : 16 : (set_attr "pent_pair" "pu")
9002 : 16 : (set_attr "mode" "SI")])
9003 : 16 :
9004 : 16 : (define_insn "*subsi3_carry_zext_0r"
9005 : 16 : [(set (match_operand:DI 0 "register_operand" "=r")
9006 : 16 : (zero_extend:DI
9007 : 16 : (minus:SI
9008 : 16 : (match_operand:SI 1 "register_operand" "0")
9009 : 0 : (match_operator:SI 2 "ix86_carry_flag_unset_operator"
9010 : 16 : [(reg FLAGS_REG) (const_int 0)]))))
9011 : 16 : (clobber (reg:CC FLAGS_REG))]
9012 : 16 : "TARGET_64BIT"
9013 : 16 : "adc{l}\t{$-1, %k0|%k0, -1}"
9014 : 16 : [(set_attr "type" "alu")
9015 : 16 : (set_attr "use_carry" "1")
9016 : 16 : (set_attr "pent_pair" "pu")
9017 : 16 : (set_attr "mode" "SI")])
9018 : 16 :
9019 : 16 : (define_insn "@sub<mode>3_carry_ccc"
9020 : 38 : [(set (reg:CCC FLAGS_REG)
9021 : 38 : (compare:CCC
9022 : 232 : (zero_extend:<DWI> (match_operand:DWIH 1 "register_operand" "0"))
9023 : 38 : (plus:<DWI>
9024 : 22 : (ltu:<DWI> (reg:CC FLAGS_REG) (const_int 0))
9025 : 232 : (zero_extend:<DWI>
9026 : 7 : (match_operand:DWIH 2 "x86_64_sext_operand" "rmWe")))))
9027 : 10 : (clobber (match_scratch:DWIH 0 "=r"))]
9028 : 10 : ""
9029 : 7 : "sbb{<imodesuffix>}\t{%2, %0|%0, %2}"
9030 : 3 : [(set_attr "type" "alu")
9031 : 7 : (set_attr "mode" "<MODE>")])
9032 : 7 :
9033 : 3 : (define_insn "*sub<mode>3_carry_ccc_1"
9034 : 7 : [(set (reg:CCC FLAGS_REG)
9035 : 10 : (compare:CCC
9036 : 7 : (zero_extend:<DWI> (match_operand:DWIH 1 "register_operand" "0"))
9037 : 3 : (plus:<DWI>
9038 : 7 : (ltu:<DWI> (reg:CC FLAGS_REG) (const_int 0))
9039 : 10 : (match_operand:<DWI> 2 "x86_64_dwzext_immediate_operand" "Wf"))))
9040 : 7 : (clobber (match_scratch:DWIH 0 "=r"))]
9041 : 17 : ""
9042 : 82 : {
9043 : 0 : operands[3] = simplify_subreg (<MODE>mode, operands[2], <DWI>mode, 0);
9044 : 76 : return "sbb{<imodesuffix>}\t{%3, %0|%0, %3}";
9045 : : }
9046 : : [(set_attr "type" "alu")
9047 : : (set_attr "mode" "<MODE>")])
9048 : :
9049 : 76 : ;; The sign flag is set from the
9050 : : ;; (compare (match_dup 1) (plus:DWIH (ltu:DWIH ...) (match_dup 2)))
9051 : : ;; result, the overflow flag likewise, but the overflow flag is also
9052 : 16 : ;; set if the (plus:DWIH (ltu:DWIH ...) (match_dup 2)) overflows.
9053 : 16 : (define_insn "@sub<mode>3_carry_ccgz"
9054 : 16 : [(set (reg:CCGZ FLAGS_REG)
9055 : : (unspec:CCGZ [(match_operand:DWIH 1 "register_operand" "0")
9056 : : (match_operand:DWIH 2 "x86_64_general_operand" "rBMe")
9057 : : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0))]
9058 : : UNSPEC_SBB))
9059 : : (clobber (match_scratch:DWIH 0 "=r"))]
9060 : 0 : ""
9061 : : "sbb{<imodesuffix>}\t{%2, %0|%0, %2}"
9062 : 0 : [(set_attr "type" "alu")
9063 : 0 : (set_attr "mode" "<MODE>")])
9064 : 0 :
9065 : 0 : (define_insn "subborrow<mode>"
9066 : 0 : [(set (reg:CCC FLAGS_REG)
9067 : 0 : (compare:CCC
9068 : 0 : (zero_extend:<DWI>
9069 : 0 : (match_operand:SWI48 1 "nonimmediate_operand" "0,0,r,rm"))
9070 : 0 : (plus:<DWI>
9071 : 0 : (match_operator:<DWI> 4 "ix86_carry_flag_operator"
9072 : 0 : [(match_operand 3 "flags_reg_operand") (const_int 0)])
9073 : 0 : (zero_extend:<DWI>
9074 : 0 : (match_operand:SWI48 2 "nonimmediate_operand" "r,rm,rm,r")))))
9075 : 0 : (set (match_operand:SWI48 0 "nonimmediate_operand" "=rm,r,r,r")
9076 : 0 : (minus:SWI48 (minus:SWI48
9077 : 0 : (match_dup 1)
9078 : 0 : (match_operator:SWI48 5 "ix86_carry_flag_operator"
9079 : 0 : [(match_dup 3) (const_int 0)]))
9080 : 0 : (match_dup 2)))]
9081 : 10107 : "ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)"
9082 : 1 : "@
9083 : 0 : sbb{<imodesuffix>}\t{%2, %0|%0, %2}
9084 : 0 : sbb{<imodesuffix>}\t{%2, %0|%0, %2}
9085 : 11039 : sbb{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
9086 : 11039 : sbb{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
9087 : 20928 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
9088 : : (set_attr "type" "alu")
9089 : : (set_attr "use_carry" "1")
9090 : : (set_attr "pent_pair" "pu")
9091 : : (set_attr "mode" "<MODE>")])
9092 : :
9093 : : (define_peephole2
9094 : : [(set (match_operand:SWI48 0 "general_reg_operand")
9095 : : (match_operand:SWI48 1 "memory_operand"))
9096 : : (parallel [(set (reg:CCC FLAGS_REG)
9097 : : (compare:CCC
9098 : : (zero_extend:<DWI> (match_dup 0))
9099 : : (plus:<DWI>
9100 : : (match_operator:<DWI> 4 "ix86_carry_flag_operator"
9101 : : [(match_operand 3 "flags_reg_operand") (const_int 0)])
9102 : : (zero_extend:<DWI>
9103 : : (match_operand:SWI48 2 "memory_operand")))))
9104 : : (set (match_dup 0)
9105 : : (minus:SWI48
9106 : : (minus:SWI48
9107 : : (match_dup 0)
9108 : : (match_operator:SWI48 5 "ix86_carry_flag_operator"
9109 : : [(match_dup 3) (const_int 0)]))
9110 : : (match_dup 2)))])
9111 : : (set (match_dup 1) (match_dup 0))]
9112 : 0 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
9113 : 22 : && peep2_reg_dead_p (3, operands[0])
9114 : 22 : && !reg_overlap_mentioned_p (operands[0], operands[1])
9115 : 44 : && !reg_overlap_mentioned_p (operands[0], operands[2])"
9116 : : [(set (match_dup 0) (match_dup 2))
9117 : 6 : (parallel [(set (reg:CCC FLAGS_REG)
9118 : 6 : (compare:CCC
9119 : 6 : (zero_extend:<DWI> (match_dup 1))
9120 : : (plus:<DWI> (match_op_dup 4
9121 : : [(match_dup 3) (const_int 0)])
9122 : 0 : (zero_extend:<DWI> (match_dup 0)))))
9123 : 0 : (set (match_dup 1)
9124 : 0 : (minus:SWI48 (minus:SWI48 (match_dup 1)
9125 : 0 : (match_op_dup 5
9126 : : [(match_dup 3) (const_int 0)]))
9127 : : (match_dup 0)))])])
9128 : :
9129 : : (define_peephole2
9130 : 42 : [(set (match_operand:SWI48 6 "general_reg_operand")
9131 : : (match_operand:SWI48 7 "memory_operand"))
9132 : 42 : (set (match_operand:SWI48 8 "general_reg_operand")
9133 : 42 : (match_operand:SWI48 9 "memory_operand"))
9134 : 42 : (parallel [(set (reg:CCC FLAGS_REG)
9135 : 42 : (compare:CCC
9136 : 42 : (zero_extend:<DWI>
9137 : 42 : (match_operand:SWI48 0 "general_reg_operand"))
9138 : 42 : (plus:<DWI>
9139 : 42 : (match_operator:<DWI> 4 "ix86_carry_flag_operator"
9140 : 42 : [(match_operand 3 "flags_reg_operand") (const_int 0)])
9141 : 0 : (zero_extend:<DWI>
9142 : 42 : (match_operand:SWI48 2 "general_reg_operand")))))
9143 : 42 : (set (match_dup 0)
9144 : 42 : (minus:SWI48
9145 : 42 : (minus:SWI48
9146 : 42 : (match_dup 0)
9147 : 42 : (match_operator:SWI48 5 "ix86_carry_flag_operator"
9148 : 42 : [(match_dup 3) (const_int 0)]))
9149 : 42 : (match_dup 2)))])
9150 : 42 : (set (match_operand:SWI48 1 "memory_operand") (match_dup 0))]
9151 : 42 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
9152 : 45 : && peep2_reg_dead_p (4, operands[0])
9153 : 45 : && peep2_reg_dead_p (3, operands[2])
9154 : 45 : && !reg_overlap_mentioned_p (operands[0], operands[1])
9155 : 45 : && !reg_overlap_mentioned_p (operands[2], operands[1])
9156 : 45 : && !reg_overlap_mentioned_p (operands[6], operands[9])
9157 : 45 : && (rtx_equal_p (operands[6], operands[0])
9158 : 3 : ? (rtx_equal_p (operands[7], operands[1])
9159 : 0 : && rtx_equal_p (operands[8], operands[2]))
9160 : 3 : : (rtx_equal_p (operands[8], operands[0])
9161 : 3 : && rtx_equal_p (operands[9], operands[1])
9162 : 7 : && rtx_equal_p (operands[6], operands[2])))"
9163 : : [(set (match_dup 0) (match_dup 9))
9164 : 1 : (parallel [(set (reg:CCC FLAGS_REG)
9165 : 1 : (compare:CCC
9166 : 1 : (zero_extend:<DWI> (match_dup 1))
9167 : : (plus:<DWI> (match_op_dup 4
9168 : : [(match_dup 3) (const_int 0)])
9169 : : (zero_extend:<DWI> (match_dup 0)))))
9170 : : (set (match_dup 1)
9171 : 0 : (minus:SWI48 (minus:SWI48 (match_dup 1)
9172 : 0 : (match_op_dup 5
9173 : : [(match_dup 3) (const_int 0)]))
9174 : : (match_dup 0)))])]
9175 : 3 : {
9176 : 3 : if (!rtx_equal_p (operands[6], operands[0]))
9177 : 3 : operands[9] = operands[7];
9178 : : })
9179 : :
9180 : : (define_peephole2
9181 : 3 : [(set (match_operand:SWI48 6 "general_reg_operand")
9182 : 3 : (match_operand:SWI48 7 "memory_operand"))
9183 : 3 : (set (match_operand:SWI48 8 "general_reg_operand")
9184 : 42 : (match_operand:SWI48 9 "memory_operand"))
9185 : 3 : (parallel [(set (reg:CCC FLAGS_REG)
9186 : 3 : (compare:CCC
9187 : 3 : (zero_extend:<DWI>
9188 : 3 : (match_operand:SWI48 0 "general_reg_operand"))
9189 : 42 : (plus:<DWI>
9190 : 3 : (match_operator:<DWI> 4 "ix86_carry_flag_operator"
9191 : 3 : [(match_operand 3 "flags_reg_operand") (const_int 0)])
9192 : 42 : (zero_extend:<DWI>
9193 : 42 : (match_operand:SWI48 2 "general_reg_operand")))))
9194 : 45 : (set (match_dup 0)
9195 : 3 : (minus:SWI48
9196 : 3 : (minus:SWI48
9197 : 3 : (match_dup 0)
9198 : 3 : (match_operator:SWI48 5 "ix86_carry_flag_operator"
9199 : 36 : [(match_dup 3) (const_int 0)]))
9200 : 3 : (match_dup 2)))])
9201 : 3 : (set (match_operand:QI 10 "general_reg_operand")
9202 : : (ltu:QI (reg:CCC FLAGS_REG) (const_int 0)))
9203 : 36 : (set (match_operand:SWI48 11 "general_reg_operand")
9204 : : (zero_extend:SWI48 (match_dup 10)))
9205 : : (set (match_operand:SWI48 1 "memory_operand") (match_dup 0))]
9206 : 0 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
9207 : 1 : && peep2_reg_dead_p (6, operands[0])
9208 : 1 : && peep2_reg_dead_p (3, operands[2])
9209 : 1 : && !reg_overlap_mentioned_p (operands[0], operands[1])
9210 : 1 : && !reg_overlap_mentioned_p (operands[2], operands[1])
9211 : 1 : && !reg_overlap_mentioned_p (operands[6], operands[9])
9212 : 1 : && !reg_overlap_mentioned_p (operands[0], operands[10])
9213 : 1 : && !reg_overlap_mentioned_p (operands[10], operands[1])
9214 : 1 : && !reg_overlap_mentioned_p (operands[0], operands[11])
9215 : 1 : && !reg_overlap_mentioned_p (operands[11], operands[1])
9216 : 1 : && (rtx_equal_p (operands[6], operands[0])
9217 : 1 : ? (rtx_equal_p (operands[7], operands[1])
9218 : 0 : && rtx_equal_p (operands[8], operands[2]))
9219 : 1 : : (rtx_equal_p (operands[8], operands[0])
9220 : 1198 : && rtx_equal_p (operands[9], operands[1])
9221 : 3 : && rtx_equal_p (operands[6], operands[2])))"
9222 : : [(set (match_dup 0) (match_dup 9))
9223 : 0 : (parallel [(set (reg:CCC FLAGS_REG)
9224 : 1200 : (compare:CCC
9225 : 3 : (zero_extend:<DWI> (match_dup 1))
9226 : 3 : (plus:<DWI> (match_op_dup 4
9227 : : [(match_dup 3) (const_int 0)])
9228 : : (zero_extend:<DWI> (match_dup 0)))))
9229 : : (set (match_dup 1)
9230 : : (minus:SWI48 (minus:SWI48 (match_dup 1)
9231 : : (match_op_dup 5
9232 : 69987 : [(match_dup 3) (const_int 0)]))
9233 : 1130055 : (match_dup 0)))])
9234 : 1130057 : (set (match_dup 10) (ltu:QI (reg:CCC FLAGS_REG) (const_int 0)))
9235 : 1130059 : (set (match_dup 11) (zero_extend:SWI48 (match_dup 10)))]
9236 : 3 : {
9237 : 1 : if (!rtx_equal_p (operands[6], operands[0]))
9238 : 1 : operands[9] = operands[7];
9239 : 2 : })
9240 : 2 :
9241 : 2 : (define_expand "subborrow<mode>_0"
9242 : 3 : [(parallel
9243 : 3 : [(set (reg:CC FLAGS_REG)
9244 : 3 : (compare:CC
9245 : 2 : (match_operand:SWI48 1 "nonimmediate_operand")
9246 : 0 : (match_operand:SWI48 2 "<general_operand>")))
9247 : 2 : (set (match_operand:SWI48 0 "register_operand")
9248 : 0 : (minus:SWI48 (match_dup 1) (match_dup 2)))])]
9249 : 0 : "ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)")
9250 : 0 :
9251 : 0 : (define_expand "uaddc<mode>5"
9252 : 0 : [(match_operand:SWI48 0 "register_operand")
9253 : 1 : (match_operand:SWI48 1 "register_operand")
9254 : 1 : (match_operand:SWI48 2 "register_operand")
9255 : 1 : (match_operand:SWI48 3 "register_operand")
9256 : 1 : (match_operand:SWI48 4 "nonmemory_operand")]
9257 : 1 : ""
9258 : 8730 : {
9259 : 17459 : rtx cf = gen_rtx_REG (CCCmode, FLAGS_REG), pat, pat2;
9260 : 8729 : if (operands[4] == const0_rtx)
9261 : 1220 : emit_insn (gen_addcarry<mode>_0 (operands[0], operands[2], operands[3]));
9262 : 1 : else
9263 : 0 : {
9264 : 7509 : ix86_expand_carry (operands[4]);
9265 : 7509 : pat = gen_rtx_LTU (<DWI>mode, cf, const0_rtx);
9266 : 7510 : pat2 = gen_rtx_LTU (<MODE>mode, cf, const0_rtx);
9267 : 7509 : emit_insn (gen_addcarry<mode> (operands[0], operands[2], operands[3],
9268 : 1 : cf, pat, pat2));
9269 : : }
9270 : 8729 : rtx cc = gen_reg_rtx (QImode);
9271 : 8729 : pat = gen_rtx_LTU (QImode, cf, const0_rtx);
9272 : 8729 : emit_insn (gen_rtx_SET (cc, pat));
9273 : 8729 : emit_insn (gen_zero_extendqi<mode>2 (operands[1], cc));
9274 : 8729 : DONE;
9275 : : })
9276 : 0 :
9277 : 0 : (define_expand "usubc<mode>5"
9278 : 0 : [(match_operand:SWI48 0 "register_operand")
9279 : : (match_operand:SWI48 1 "register_operand")
9280 : : (match_operand:SWI48 2 "register_operand")
9281 : : (match_operand:SWI48 3 "register_operand")
9282 : : (match_operand:SWI48 4 "nonmemory_operand")]
9283 : : ""
9284 : 6031 : {
9285 : 6031 : rtx cf, pat, pat2;
9286 : 6031 : if (operands[4] == const0_rtx)
9287 : 0 : {
9288 : 968 : cf = gen_rtx_REG (CCmode, FLAGS_REG);
9289 : 969 : emit_insn (gen_subborrow<mode>_0 (operands[0], operands[2],
9290 : 0 : operands[3]));
9291 : 0 : }
9292 : 0 : else
9293 : 0 : {
9294 : 5064 : cf = gen_rtx_REG (CCCmode, FLAGS_REG);
9295 : 5063 : ix86_expand_carry (operands[4]);
9296 : 5063 : pat = gen_rtx_LTU (<DWI>mode, cf, const0_rtx);
9297 : 5064 : pat2 = gen_rtx_LTU (<MODE>mode, cf, const0_rtx);
9298 : 5064 : emit_insn (gen_subborrow<mode> (operands[0], operands[2], operands[3],
9299 : 1 : cf, pat, pat2));
9300 : 0 : }
9301 : 14689 : rtx cc = gen_reg_rtx (QImode);
9302 : 6031 : pat = gen_rtx_LTU (QImode, cf, const0_rtx);
9303 : 6031 : emit_insn (gen_rtx_SET (cc, pat));
9304 : 6031 : emit_insn (gen_zero_extendqi<mode>2 (operands[1], cc));
9305 : 6031 : DONE;
9306 : : })
9307 : 0 :
9308 : 8730 : (define_mode_iterator CC_CCC [CC CCC])
9309 : 8723 :
9310 : 8723 : ;; Pre-reload splitter to optimize
9311 : 8723 : ;; *setcc_qi followed by *addqi3_cconly_overflow_1 with the same QI
9312 : 8723 : ;; operand and no intervening flags modifications into nothing.
9313 : 8723 : (define_insn_and_split "*setcc_qi_addqi3_cconly_overflow_1_<mode>"
9314 : 8723 : [(set (reg:CCC FLAGS_REG)
9315 : 8722 : (compare:CCC (neg:QI (geu:QI (reg:CC_CCC FLAGS_REG) (const_int 0)))
9316 : 1 : (ltu:QI (reg:CC_CCC FLAGS_REG) (const_int 0))))]
9317 : 8206 : "ix86_pre_reload_split ()"
9318 : 0 : "#"
9319 : 0 : "&& 1"
9320 : 1 : [(const_int 0)]
9321 : 8190 : "emit_note (NOTE_INSN_DELETED); DONE;")
9322 : 3725 :
9323 : 8418 : ;; Set the carry flag from the carry flag.
9324 : 3711 : (define_insn_and_split "*setccc"
9325 : 7422 : [(set (reg:CCC FLAGS_REG)
9326 : 2 : (reg:CCC FLAGS_REG))]
9327 : 212307 : "ix86_pre_reload_split ()"
9328 : 456265972 : "#"
9329 : 465623 : "&& 1"
9330 : 53359841 : [(const_int 0)]
9331 : 0 : "emit_note (NOTE_INSN_DELETED); DONE;")
9332 : 667478 :
9333 : 211916 : ;; Set the carry flag from the carry flag.
9334 : 1067134 : (define_insn_and_split "*setcc_qi_negqi_ccc_1_<mode>"
9335 : 565739 : [(set (reg:CCC FLAGS_REG)
9336 : 6295 : (ltu:CCC (reg:CC_CCC FLAGS_REG) (const_int 0)))]
9337 : 888528 : "ix86_pre_reload_split ()"
9338 : 449718 : "#"
9339 : 5971 : "&& 1"
9340 : 19159 : [(const_int 0)]
9341 : 431849 : "emit_note (NOTE_INSN_DELETED); DONE;")
9342 : 6766 :
9343 : 6111 : ;; Set the carry flag from the carry flag.
9344 : 6111 : (define_insn_and_split "*setcc_qi_negqi_ccc_2_<mode>"
9345 : 447920 : [(set (reg:CCC FLAGS_REG)
9346 : 2534728 : (unspec:CCC [(ltu:QI (reg:CC_CCC FLAGS_REG) (const_int 0))
9347 : 2603838 : (const_int 0)] UNSPEC_CC_NE))]
9348 : 74846 : "ix86_pre_reload_split ()"
9349 : 4861 : "#"
9350 : 300 : "&& 1"
9351 : 57666 : [(const_int 0)]
9352 : 0 : "emit_note (NOTE_INSN_DELETED); DONE;")
9353 : 71 :
9354 : 2528833 : ;; Overflow setting add instructions
9355 : 72 :
9356 : 71 : (define_expand "addqi3_cconly_overflow"
9357 : 2529592 : [(parallel
9358 : 4075100 : [(set (reg:CCC FLAGS_REG)
9359 : 1546338 : (compare:CCC
9360 : 2528763 : (plus:QI
9361 : 2528764 : (match_operand:QI 0 "nonimmediate_operand")
9362 : 3333 : (match_operand:QI 1 "general_operand"))
9363 : 12765 : (match_dup 0)))
9364 : 0 : (clobber (scratch:QI))])]
9365 : 73 : "!(MEM_P (operands[0]) && MEM_P (operands[1]))")
9366 : 15266 :
9367 : 0 : (define_insn "*add<mode>3_cconly_overflow_1"
9368 : 73 : [(set (reg:CCC FLAGS_REG)
9369 : 36 : (compare:CCC
9370 : 6 : (plus:SWI
9371 : 2840005 : (match_operand:SWI 1 "nonimmediate_operand" "%0,r,rm")
9372 : 6 : (match_operand:SWI 2 "<general_operand>" "<g>,<g>,re"))
9373 : 1260512 : (match_dup 1)))
9374 : 1260535 : (clobber (match_scratch:SWI 0 "=<r>,r,r"))]
9375 : 21690 : "!(MEM_P (operands[1]) && MEM_P (operands[2]))"
9376 : 7 : "@
9377 : 1701793 : add{<imodesuffix>}\t{%2, %0|%0, %2}
9378 : 8171 : add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
9379 : 7 : add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
9380 : 1056 : [(set_attr "isa" "*,apx_ndd,apx_ndd")
9381 : 794 : (set_attr "type" "alu")
9382 : 6 : (set_attr "mode" "<MODE>")])
9383 : 107 :
9384 : 107 : (define_insn "@add<mode>3_cc_overflow_1"
9385 : 1053563 : [(set (reg:CCC FLAGS_REG)
9386 : 1053563 : (compare:CCC
9387 : 1053557 : (plus:SWI
9388 : 1053557 : (match_operand:SWI 1 "nonimmediate_operand" "%0,0,rm,rjM,r")
9389 : 1053563 : (match_operand:SWI 2 "<general_operand>" "<r><i>,<m>,r,<i>,<m>"))
9390 : 1053557 : (match_dup 1)))
9391 : 6 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,<r>,r,r,r")
9392 : 1391 : (plus:SWI (match_dup 1) (match_dup 2)))]
9393 : 64281 : "ix86_binary_operator_ok (PLUS, <MODE>mode, operands, TARGET_APX_NDD)"
9394 : 1456 : "@
9395 : : add{<imodesuffix>}\t{%2, %0|%0, %2}
9396 : : add{<imodesuffix>}\t{%2, %0|%0, %2}
9397 : 63935 : add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
9398 : 63935 : add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
9399 : 126273 : add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
9400 : : [(set_attr "isa" "*,*,apx_ndd,apx_ndd,apx_ndd")
9401 : : (set_attr "type" "alu")
9402 : 6 : (set_attr "mode" "<MODE>")])
9403 : 6 :
9404 : 6 : (define_peephole2
9405 : : [(parallel [(set (reg:CCC FLAGS_REG)
9406 : : (compare:CCC
9407 : 0 : (plus:SWI (match_operand:SWI 0 "general_reg_operand")
9408 : 0 : (match_operand:SWI 1 "memory_operand"))
9409 : 0 : (match_dup 0)))
9410 : 0 : (set (match_dup 0) (plus:SWI (match_dup 0) (match_dup 1)))])
9411 : : (set (match_dup 1) (match_dup 0))]
9412 : 0 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
9413 : 26 : && peep2_reg_dead_p (2, operands[0])
9414 : 24 : && !reg_overlap_mentioned_p (operands[0], operands[1])"
9415 : 22 : [(parallel [(set (reg:CCC FLAGS_REG)
9416 : 12 : (compare:CCC
9417 : 12 : (plus:SWI (match_dup 1) (match_dup 0))
9418 : 0 : (match_dup 1)))
9419 : 122 : (set (match_dup 1) (plus:SWI (match_dup 1) (match_dup 0)))])])
9420 : 122 :
9421 : 122 : (define_peephole2
9422 : 26 : [(set (match_operand:SWI 0 "general_reg_operand")
9423 : 172 : (match_operand:SWI 1 "memory_operand"))
9424 : 0 : (parallel [(set (reg:CCC FLAGS_REG)
9425 : 0 : (compare:CCC
9426 : 0 : (plus:SWI (match_dup 0)
9427 : 0 : (match_operand:SWI 2 "memory_operand"))
9428 : 0 : (match_dup 0)))
9429 : 0 : (set (match_dup 0) (plus:SWI (match_dup 0) (match_dup 2)))])
9430 : 0 : (set (match_dup 1) (match_dup 0))]
9431 : 0 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
9432 : 10 : && peep2_reg_dead_p (3, operands[0])
9433 : 10 : && !reg_overlap_mentioned_p (operands[0], operands[1])
9434 : 20 : && !reg_overlap_mentioned_p (operands[0], operands[2])"
9435 : : [(set (match_dup 0) (match_dup 2))
9436 : 0 : (parallel [(set (reg:CCC FLAGS_REG)
9437 : 0 : (compare:CCC
9438 : 0 : (plus:SWI (match_dup 1) (match_dup 0))
9439 : : (match_dup 1)))
9440 : 0 : (set (match_dup 1) (plus:SWI (match_dup 1) (match_dup 0)))])])
9441 : 0 :
9442 : 0 : (define_insn "*addsi3_zext_cc_overflow_1"
9443 : 0 : [(set (reg:CCC FLAGS_REG)
9444 : 0 : (compare:CCC
9445 : 0 : (plus:SI
9446 : 0 : (match_operand:SI 1 "nonimmediate_operand" "%0,r,rm")
9447 : : (match_operand:SI 2 "x86_64_general_operand" "rBMe,rBMe,re"))
9448 : 12 : (match_dup 1)))
9449 : : (set (match_operand:DI 0 "register_operand" "=r,r,r")
9450 : 12 : (zero_extend:DI (plus:SI (match_dup 1) (match_dup 2))))]
9451 : 12 : "TARGET_64BIT
9452 : 12 : && ix86_binary_operator_ok (PLUS, SImode, operands, TARGET_APX_NDD)"
9453 : 12 : "@
9454 : 0 : add{l}\t{%2, %k0|%k0, %2}
9455 : 12 : add{l}\t{%2, %1, %k0|%k0, %1, %2}
9456 : 12 : add{l}\t{%2, %1, %k0|%k0, %1, %2}"
9457 : 12 : [(set_attr "isa" "*,apx_ndd,apx_ndd")
9458 : 12 : (set_attr "type" "alu")
9459 : 12 : (set_attr "mode" "SI")])
9460 : 12 :
9461 : 0 : (define_insn "*add<mode>3_cconly_overflow_2"
9462 : 0 : [(set (reg:CCC FLAGS_REG)
9463 : 0 : (compare:CCC
9464 : 0 : (plus:SWI
9465 : 0 : (match_operand:SWI 1 "nonimmediate_operand" "%0,r,rm")
9466 : 2250925 : (match_operand:SWI 2 "<general_operand>" "<g>,<g>,re"))
9467 : 0 : (match_dup 2)))
9468 : 0 : (clobber (match_scratch:SWI 0 "=<r>,r,r"))]
9469 : 0 : "!(MEM_P (operands[1]) && MEM_P (operands[2]))"
9470 : 2250925 : "@
9471 : 2250925 : add{<imodesuffix>}\t{%2, %0|%0, %2}
9472 : 0 : add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
9473 : 2250937 : add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
9474 : 2250937 : [(set_attr "isa" "*,apx_ndd,apx_ndd")
9475 : 0 : (set_attr "type" "alu")
9476 : 10404 : (set_attr "mode" "<MODE>")])
9477 : 10404 :
9478 : 10404 : (define_insn "*add<mode>3_cc_overflow_2"
9479 : 10404 : [(set (reg:CCC FLAGS_REG)
9480 : : (compare:CCC
9481 : 5077 : (plus:SWI
9482 : 5065 : (match_operand:SWI 1 "nonimmediate_operand" "%0,0,rm,r")
9483 : 4965 : (match_operand:SWI 2 "<general_operand>" "<r><i>,<m>,r<i>,<m>"))
9484 : 4846 : (match_dup 2)))
9485 : 14713 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,<r>,r,r")
9486 : 12 : (plus:SWI (match_dup 1) (match_dup 2)))]
9487 : 286 : "ix86_binary_operator_ok (PLUS, <MODE>mode, operands, TARGET_APX_NDD)"
9488 : 77 : "@
9489 : 12 : add{<imodesuffix>}\t{%2, %0|%0, %2}
9490 : 12 : add{<imodesuffix>}\t{%2, %0|%0, %2}
9491 : 6148 : add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
9492 : 6148 : add{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
9493 : 6126 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
9494 : 12069 : (set_attr "type" "alu")
9495 : 159 : (set_attr "mode" "<MODE>")])
9496 : 6114 :
9497 : 4677 : (define_insn "*addsi3_zext_cc_overflow_2"
9498 : 6041 : [(set (reg:CCC FLAGS_REG)
9499 : 0 : (compare:CCC
9500 : 0 : (plus:SI
9501 : 0 : (match_operand:SI 1 "nonimmediate_operand" "%0,r,rm")
9502 : 0 : (match_operand:SI 2 "x86_64_general_operand" "rBMe,rBMe,re"))
9503 : 0 : (match_dup 2)))
9504 : 0 : (set (match_operand:DI 0 "register_operand" "=r,r,r")
9505 : 0 : (zero_extend:DI (plus:SI (match_dup 1) (match_dup 2))))]
9506 : 14 : "TARGET_64BIT
9507 : 14 : && ix86_binary_operator_ok (PLUS, SImode, operands, TARGET_APX_NDD)"
9508 : 12 : "@
9509 : 0 : add{l}\t{%2, %k0|%k0, %2}
9510 : 0 : add{l}\t{%2, %1, %k0|%k0, %1, %2}
9511 : 0 : add{l}\t{%2, %1, %k0|%k0, %1, %2}"
9512 : 0 : [(set_attr "isa" "*,apx_ndd,apx_ndd")
9513 : 0 : (set_attr "type" "alu")
9514 : 0 : (set_attr "mode" "SI")])
9515 : 0 :
9516 : 0 : (define_insn_and_split "*add<dwi>3_doubleword_cc_overflow_1"
9517 : 0 : [(set (reg:CCC FLAGS_REG)
9518 : 0 : (compare:CCC
9519 : 2965 : (plus:<DWI>
9520 : 2965 : (match_operand:<DWI> 1 "nonimmediate_operand" "%0,0,ro,r,ro,jO,r")
9521 : 2965 : (match_operand:<DWI> 2 "x86_64_hilo_general_operand" "r<di>,o,r,<di>,K,<di>,o"))
9522 : 0 : (match_dup 1)))
9523 : 2965 : (set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,r,&r,&r,&r,&r,&r")
9524 : 2965 : (plus:<DWI> (match_dup 1) (match_dup 2)))]
9525 : 97561 : "ix86_binary_operator_ok (PLUS, <DWI>mode, operands, TARGET_APX_NDD)"
9526 : 2965 : "#"
9527 : 2965 : "&& reload_completed"
9528 : 44608 : [(parallel [(set (reg:CCC FLAGS_REG)
9529 : 4561 : (compare:CCC
9530 : 0 : (plus:DWIH (match_dup 1) (match_dup 2))
9531 : 730 : (match_dup 1)))
9532 : 730 : (set (match_dup 0)
9533 : 2190 : (plus:DWIH (match_dup 1) (match_dup 2)))])
9534 : 112 : (parallel [(set (reg:CCC FLAGS_REG)
9535 : 112 : (compare:CCC
9536 : 172670 : (zero_extend:<DWI>
9537 : 172670 : (plus:DWIH
9538 : 436 : (plus:DWIH
9539 : 148679 : (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0))
9540 : 148679 : (match_dup 4))
9541 : 148825 : (match_dup 5)))
9542 : 0 : (plus:<DWI>
9543 : 148679 : (match_dup 6)
9544 : 148679 : (ltu:<DWI> (reg:CC FLAGS_REG) (const_int 0)))))
9545 : 0 : (set (match_dup 3)
9546 : 1650 : (plus:DWIH
9547 : 1650 : (plus:DWIH (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0))
9548 : 0 : (match_dup 4))
9549 : 396 : (match_dup 5)))])]
9550 : 1992 : {
9551 : 1596 : split_double_mode (<DWI>mode, &operands[0], 3, &operands[0], &operands[3]);
9552 : 1992 : if (operands[2] == const0_rtx)
9553 : 0 : {
9554 : 397 : if (!rtx_equal_p (operands[0], operands[1]))
9555 : 396 : emit_move_insn (operands[0], operands[1]);
9556 : 1 : emit_insn (gen_addcarry<mode>_0 (operands[3], operands[4], operands[5]));
9557 : 1 : DONE;
9558 : 0 : }
9559 : 1595 : if (CONST_INT_P (operands[5]))
9560 : 148 : operands[6] = simplify_unary_operation (ZERO_EXTEND, <DWI>mode,
9561 : 0 : operands[5], <MODE>mode);
9562 : 0 : else
9563 : 1447 : operands[6] = gen_rtx_ZERO_EXTEND (<DWI>mode, operands[5]);
9564 : 0 : }
9565 : 0 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd,apx_ndd,apx_ndd_64,apx_ndd")])
9566 : 0 :
9567 : 0 : ;; x == 0 with zero flag test can be done also as x < 1U with carry flag
9568 : 1595 : ;; test, where the latter is preferrable if we have some carry consuming
9569 : 0 : ;; instruction.
9570 : 0 : ;; For x != 0, we need to use x < 1U with negation of carry, i.e.
9571 : 0 : ;; + (1 - CF).
9572 : 1595 : (define_insn_and_split "*add<mode>3_eq"
9573 : 1595 : [(set (match_operand:SWI 0 "nonimmediate_operand")
9574 : 1595 : (plus:SWI
9575 : 1595 : (plus:SWI
9576 : 1595 : (eq:SWI (match_operand 3 "int_nonimmediate_operand") (const_int 0))
9577 : 1595 : (match_operand:SWI 1 "nonimmediate_operand"))
9578 : 1601 : (match_operand:SWI 2 "<general_operand>")))
9579 : 1595 : (clobber (reg:CC FLAGS_REG))]
9580 : 1644 : "ix86_binary_operator_ok (PLUS, <MODE>mode, operands, TARGET_APX_NDD)
9581 : 1851 : && ix86_pre_reload_split ()"
9582 : 176 : "#"
9583 : 43 : "&& 1"
9584 : 49 : [(set (reg:CC FLAGS_REG)
9585 : 122 : (compare:CC (match_dup 3) (const_int 1)))
9586 : 200 : (parallel [(set (match_dup 0)
9587 : 6 : (plus:SWI
9588 : 232 : (plus:SWI (ltu:SWI (reg:CC FLAGS_REG) (const_int 0))
9589 : 6 : (match_dup 1))
9590 : 463 : (match_dup 2)))
9591 : 463 : (clobber (reg:CC FLAGS_REG))])])
9592 : 150 :
9593 : 6 : (define_insn_and_split "*add<mode>3_ne"
9594 : 1595 : [(set (match_operand:SWI 0 "nonimmediate_operand")
9595 : 6 : (plus:SWI
9596 : 0 : (plus:SWI
9597 : 0 : (ne:SWI (match_operand 3 "int_nonimmediate_operand") (const_int 0))
9598 : 0 : (match_operand:SWI 1 "nonimmediate_operand"))
9599 : 6 : (match_operand:SWI 2 "<immediate_operand>")))
9600 : 6 : (clobber (reg:CC FLAGS_REG))]
9601 : 12 : "CONST_INT_P (operands[2])
9602 : 26 : && (<MODE>mode != DImode
9603 : 20 : || INTVAL (operands[2]) != HOST_WIDE_INT_C (-0x80000000))
9604 : 91 : && ix86_binary_operator_ok (PLUS, <MODE>mode, operands, TARGET_APX_NDD)
9605 : 85 : && ix86_pre_reload_split ()"
9606 : 210 : "#"
9607 : 6 : "&& 1"
9608 : 6 : [(set (reg:CC FLAGS_REG)
9609 : 38 : (compare:CC (match_dup 3) (const_int 1)))
9610 : 78 : (parallel [(set (match_dup 0)
9611 : 148 : (minus:SWI
9612 : 226 : (minus:SWI (match_dup 1)
9613 : : (ltu:SWI (reg:CC FLAGS_REG) (const_int 0)))
9614 : : (match_dup 2)))
9615 : : (clobber (reg:CC FLAGS_REG))])]
9616 : 38 : {
9617 : 38 : operands[2] = gen_int_mode (~INTVAL (operands[2]),
9618 : 22100 : <MODE>mode == DImode ? SImode : <MODE>mode);
9619 : 22100 : })
9620 : 4269 :
9621 : 2073 : (define_insn_and_split "*add<mode>3_eq_0"
9622 : 2111 : [(set (match_operand:SWI 0 "nonimmediate_operand")
9623 : 1595 : (plus:SWI
9624 : 1633 : (eq:SWI (match_operand 2 "int_nonimmediate_operand") (const_int 0))
9625 : 1601 : (match_operand:SWI 1 "<general_operand>")))
9626 : 6 : (clobber (reg:CC FLAGS_REG))]
9627 : 295 : "ix86_unary_operator_ok (PLUS, <MODE>mode, operands)
9628 : 1074 : && ix86_pre_reload_split ()"
9629 : 106 : "#"
9630 : 226 : "&& 1"
9631 : 563 : [(set (reg:CC FLAGS_REG)
9632 : 429 : (compare:CC (match_dup 2) (const_int 1)))
9633 : 1212 : (parallel [(set (match_dup 0)
9634 : 40 : (plus:SWI (ltu:SWI (reg:CC FLAGS_REG) (const_int 0))
9635 : 850 : (match_dup 1)))
9636 : 10 : (clobber (reg:CC FLAGS_REG))])]
9637 : 9003 : {
9638 : 8612 : if (!nonimmediate_operand (operands[1], <MODE>mode))
9639 : 3824 : operands[1] = force_reg (<MODE>mode, operands[1]);
9640 : 4019 : })
9641 : 377 :
9642 : 539 : (define_insn_and_split "*add<mode>3_ne_0"
9643 : 375 : [(set (match_operand:SWI 0 "nonimmediate_operand")
9644 : 24 : (plus:SWI
9645 : 26 : (ne:SWI (match_operand 2 "int_nonimmediate_operand") (const_int 0))
9646 : 435 : (match_operand:SWI 1 "<general_operand>")))
9647 : 38 : (clobber (reg:CC FLAGS_REG))]
9648 : 124 : "ix86_unary_operator_ok (PLUS, <MODE>mode, operands)
9649 : 1315 : && ix86_pre_reload_split ()"
9650 : 48 : "#"
9651 : 69 : "&& 1"
9652 : 69 : [(set (reg:CC FLAGS_REG)
9653 : 360 : (compare:CC (match_dup 2) (const_int 1)))
9654 : 1267 : (parallel [(set (match_dup 0)
9655 : 221 : (minus:SWI (minus:SWI
9656 : 688 : (match_dup 1)
9657 : 16 : (ltu:SWI (reg:CC FLAGS_REG) (const_int 0)))
9658 : 348586 : (const_int -1)))
9659 : 348602 : (clobber (reg:CC FLAGS_REG))])]
9660 : 51009 : {
9661 : 348933 : if (!nonimmediate_operand (operands[1], <MODE>mode))
9662 : 348695 : operands[1] = force_reg (<MODE>mode, operands[1]);
9663 : 13 : })
9664 : 349033 :
9665 : 348995 : (define_insn_and_split "*sub<mode>3_eq"
9666 : 350570 : [(set (match_operand:SWI 0 "nonimmediate_operand")
9667 : 348920 : (minus:SWI
9668 : 350151 : (minus:SWI
9669 : 1575 : (match_operand:SWI 1 "nonimmediate_operand")
9670 : 1911 : (eq:SWI (match_operand 3 "int_nonimmediate_operand")
9671 : 1911 : (const_int 0)))
9672 : 750 : (match_operand:SWI 2 "<general_operand>")))
9673 : 1231 : (clobber (reg:CC FLAGS_REG))]
9674 : 1670 : "ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)
9675 : 1668 : && ix86_pre_reload_split ()"
9676 : 1233 : "#"
9677 : 345 : "&& 1"
9678 : 1646 : [(set (reg:CC FLAGS_REG)
9679 : 11 : (compare:CC (match_dup 3) (const_int 1)))
9680 : 442 : (parallel [(set (match_dup 0)
9681 : 51 : (minus:SWI
9682 : 11 : (minus:SWI (match_dup 1)
9683 : 33 : (ltu:SWI (reg:CC FLAGS_REG) (const_int 0)))
9684 : 0 : (match_dup 2)))
9685 : 0 : (clobber (reg:CC FLAGS_REG))])])
9686 : 0 :
9687 : 0 : (define_insn_and_split "*sub<mode>3_ne"
9688 : 4375 : [(set (match_operand:SWI 0 "nonimmediate_operand")
9689 : 4718 : (plus:SWI
9690 : 637487 : (minus:SWI
9691 : 637488 : (match_operand:SWI 1 "nonimmediate_operand")
9692 : 280 : (ne:SWI (match_operand 3 "int_nonimmediate_operand")
9693 : 373546 : (const_int 0)))
9694 : 281 : (match_operand:SWI 2 "<immediate_operand>")))
9695 : 5 : (clobber (reg:CC FLAGS_REG))]
9696 : 53 : "CONST_INT_P (operands[2])
9697 : 463 : && (<MODE>mode != DImode
9698 : 128 : || INTVAL (operands[2]) != HOST_WIDE_INT_C (-0x80000000))
9699 : 441 : && ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)
9700 : 512 : && ix86_pre_reload_split ()"
9701 : 57 : "#"
9702 : 22 : "&& 1"
9703 : 359 : [(set (reg:CC FLAGS_REG)
9704 : 18 : (compare:CC (match_dup 3) (const_int 1)))
9705 : 392 : (parallel [(set (match_dup 0)
9706 : 0 : (plus:SWI
9707 : 28 : (plus:SWI (ltu:SWI (reg:CC FLAGS_REG) (const_int 0))
9708 : 0 : (match_dup 1))
9709 : 58 : (match_dup 2)))
9710 : 58 : (clobber (reg:CC FLAGS_REG))])]
9711 : 14 : {
9712 : 14 : operands[2] = gen_int_mode (INTVAL (operands[2]) - 1,
9713 : 0 : <MODE>mode == DImode ? SImode : <MODE>mode);
9714 : 0 : })
9715 : 0 :
9716 : : (define_insn_and_split "*sub<mode>3_eq_1"
9717 : 124 : [(set (match_operand:SWI 0 "nonimmediate_operand")
9718 : 14 : (plus:SWI
9719 : 124 : (minus:SWI
9720 : 124 : (match_operand:SWI 1 "nonimmediate_operand")
9721 : 124 : (eq:SWI (match_operand 3 "int_nonimmediate_operand")
9722 : 124 : (const_int 0)))
9723 : 124 : (match_operand:SWI 2 "<immediate_operand>")))
9724 : 110 : (clobber (reg:CC FLAGS_REG))]
9725 : 56 : "CONST_INT_P (operands[2])
9726 : 110 : && (<MODE>mode != DImode
9727 : 110 : || INTVAL (operands[2]) != HOST_WIDE_INT_C (-0x80000000))
9728 : 210 : && ix86_binary_operator_ok (MINUS, <MODE>mode, operands, TARGET_APX_NDD)
9729 : 154 : && ix86_pre_reload_split ()"
9730 : 70 : "#"
9731 : 124 : "&& 1"
9732 : 124 : [(set (reg:CC FLAGS_REG)
9733 : 125 : (compare:CC (match_dup 3) (const_int 1)))
9734 : 168 : (parallel [(set (match_dup 0)
9735 : 110 : (minus:SWI
9736 : 30 : (minus:SWI (match_dup 1)
9737 : : (ltu:SWI (reg:CC FLAGS_REG) (const_int 0)))
9738 : : (match_dup 2)))
9739 : 1325 : (clobber (reg:CC FLAGS_REG))])]
9740 : 1435 : {
9741 : 15 : operands[2] = gen_int_mode (-INTVAL (operands[2]),
9742 : 136200 : <MODE>mode == DImode ? SImode : <MODE>mode);
9743 : 136200 : })
9744 : 14 :
9745 : 6240 : (define_insn_and_split "*sub<mode>3_eq_0"
9746 : 6255 : [(set (match_operand:SWI 0 "nonimmediate_operand")
9747 : 6240 : (minus:SWI
9748 : 6240 : (match_operand:SWI 1 "<general_operand>")
9749 : 6240 : (eq:SWI (match_operand 2 "int_nonimmediate_operand") (const_int 0))))
9750 : 29 : (clobber (reg:CC FLAGS_REG))]
9751 : 257 : "ix86_unary_operator_ok (MINUS, <MODE>mode, operands)
9752 : 388 : && ix86_pre_reload_split ()"
9753 : 865 : "#"
9754 : 28 : "&& 1"
9755 : 31 : [(set (reg:CC FLAGS_REG)
9756 : 133 : (compare:CC (match_dup 2) (const_int 1)))
9757 : 781 : (parallel [(set (match_dup 0)
9758 : 0 : (minus:SWI (match_dup 1)
9759 : 161 : (ltu:SWI (reg:CC FLAGS_REG) (const_int 0))))
9760 : 25 : (clobber (reg:CC FLAGS_REG))])]
9761 : 568 : {
9762 : 2219 : if (!nonimmediate_operand (operands[1], <MODE>mode))
9763 : 1201 : operands[1] = force_reg (<MODE>mode, operands[1]);
9764 : 414 : })
9765 : 6 :
9766 : 172 : (define_insn_and_split "*sub<mode>3_ne_0"
9767 : 6 : [(set (match_operand:SWI 0 "nonimmediate_operand")
9768 : 20 : (minus:SWI
9769 : 26 : (match_operand:SWI 1 "<general_operand>")
9770 : 145 : (ne:SWI (match_operand 2 "int_nonimmediate_operand") (const_int 0))))
9771 : 35 : (clobber (reg:CC FLAGS_REG))]
9772 : 76 : "ix86_unary_operator_ok (MINUS, <MODE>mode, operands)
9773 : 3038 : && ix86_pre_reload_split ()"
9774 : 30 : "#"
9775 : 41 : "&& 1"
9776 : 41 : [(set (reg:CC FLAGS_REG)
9777 : 1162 : (compare:CC (match_dup 2) (const_int 1)))
9778 : 2455 : (parallel [(set (match_dup 0)
9779 : 72 : (plus:SWI (plus:SWI
9780 : 2312 : (ltu:SWI (reg:CC FLAGS_REG) (const_int 0))
9781 : 628 : (match_dup 1))
9782 : 72 : (const_int -1)))
9783 : 6 : (clobber (reg:CC FLAGS_REG))])]
9784 : 1228 : {
9785 : 1213 : if (!nonimmediate_operand (operands[1], <MODE>mode))
9786 : 21 : operands[1] = force_reg (<MODE>mode, operands[1]);
9787 : 57 : })
9788 : 2748336 :
9789 : 1113425 : ;; The patterns that match these are at the end of this file.
9790 : 11 :
9791 : 1113306 : (define_expand "<insn>xf3"
9792 : 3861519 : [(set (match_operand:XF 0 "register_operand")
9793 : 3862675 : (plusminus:XF
9794 : 3862675 : (match_operand:XF 1 "register_operand")
9795 : 3861514 : (match_operand:XF 2 "register_operand")))]
9796 : 3862732 : "TARGET_80387")
9797 : 2748219 :
9798 : 1113379 : (define_expand "<insn>hf3"
9799 : 1113379 : [(set (match_operand:HF 0 "register_operand")
9800 : 2271813 : (plusminus:HF
9801 : 3035817 : (match_operand:HF 1 "register_operand")
9802 : 762972 : (match_operand:HF 2 "nonimmediate_operand")))]
9803 : 2271740 : "TARGET_AVX512FP16")
9804 : 2272307 :
9805 : 505 : (define_expand "<insn><mode>3"
9806 : 51 : [(set (match_operand:MODEF 0 "register_operand")
9807 : 505 : (plusminus:MODEF
9808 : 2271740 : (match_operand:MODEF 1 "register_operand")
9809 : 2271740 : (match_operand:MODEF 2 "nonimmediate_operand")))]
9810 : 2271740 : "(TARGET_80387 && X87_ENABLE_ARITH (<MODE>mode))
9811 : 2271740 : || (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)")
9812 : 2271740 :
9813 : 2272896 : ;; Multiply instructions
9814 : 2272896 :
9815 : 1156 : (define_expand "mul<mode>3"
9816 : 2236918 : [(parallel [(set (match_operand:SWIM248 0 "register_operand")
9817 : 2129963 : (mult:SWIM248
9818 : 2331378 : (match_operand:SWIM248 1 "register_operand")
9819 : 2236847 : (match_operand:SWIM248 2 "<general_operand>")))
9820 : 14863 : (clobber (reg:CC FLAGS_REG))])])
9821 : 1238 :
9822 : : (define_expand "mulqi3"
9823 : 1159 : [(parallel [(set (match_operand:QI 0 "register_operand")
9824 : 14773 : (mult:QI
9825 : 1159 : (match_operand:QI 1 "register_operand")
9826 : 1159 : (match_operand:QI 2 "nonimmediate_operand")))
9827 : 1156 : (clobber (reg:CC FLAGS_REG))])]
9828 : 3 : "TARGET_QIMODE_MATH")
9829 : 1159 :
9830 : 3 : ;; On AMDFAM10
9831 : 0 : ;; IMUL reg32/64, reg32/64, imm8 Direct
9832 : 9105 : ;; IMUL reg32/64, mem32/64, imm8 VectorPath
9833 : 0 : ;; IMUL reg32/64, reg32/64, imm32 Direct
9834 : 1 : ;; IMUL reg32/64, mem32/64, imm32 VectorPath
9835 : 1 : ;; IMUL reg32/64, reg32/64 Direct
9836 : 9102 : ;; IMUL reg32/64, mem32/64 Direct
9837 : 0 : ;;
9838 : 0 : ;; On BDVER1, all above IMULs use DirectPath
9839 : 0 : ;;
9840 : 0 : ;; On AMDFAM10
9841 : 0 : ;; IMUL reg16, reg16, imm8 VectorPath
9842 : 0 : ;; IMUL reg16, mem16, imm8 VectorPath
9843 : 0 : ;; IMUL reg16, reg16, imm16 VectorPath
9844 : 0 : ;; IMUL reg16, mem16, imm16 VectorPath
9845 : : ;; IMUL reg16, reg16 Direct
9846 : : ;; IMUL reg16, mem16 Direct
9847 : : ;;
9848 : 938 : ;; On BDVER1, all HI MULs use DoublePath
9849 : 0 :
9850 : : (define_insn "*mul<mode>3_1"
9851 : : [(set (match_operand:SWIM248 0 "register_operand" "=r,r,r")
9852 : : (mult:SWIM248
9853 : : (match_operand:SWIM248 1 "nonimmediate_operand" "%rm,rm,0")
9854 : : (match_operand:SWIM248 2 "<general_operand>" "K,<i>,<m>r")))
9855 : : (clobber (reg:CC FLAGS_REG))]
9856 : 189836 : "!(MEM_P (operands[1]) && MEM_P (operands[2]))"
9857 : : "@
9858 : 105517 : imul{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
9859 : 105517 : imul{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
9860 : 435081 : imul{<imodesuffix>}\t{%2, %0|%0, %2}"
9861 : 435052 : [(set_attr "type" "imul")
9862 : 753898 : (set_attr "prefix_0f" "0,0,1")
9863 : 316608 : (set (attr "athlon_decode")
9864 : : (cond [(eq_attr "cpu" "athlon")
9865 : : (const_string "vector")
9866 : : (eq_attr "alternative" "1")
9867 : : (const_string "vector")
9868 : 215459 : (and (eq_attr "alternative" "2")
9869 : 0 : (ior (match_test "<MODE>mode == HImode")
9870 : : (match_operand 1 "memory_operand")))
9871 : 0 : (const_string "vector")]
9872 : 215459 : (const_string "direct")))
9873 : 0 : (set (attr "amdfam10_decode")
9874 : 0 : (cond [(and (eq_attr "alternative" "0,1")
9875 : 0 : (ior (match_test "<MODE>mode == HImode")
9876 : 0 : (match_operand 1 "memory_operand")))
9877 : 0 : (const_string "vector")]
9878 : 0 : (const_string "direct")))
9879 : : (set (attr "bdver1_decode")
9880 : 14886 : (if_then_else
9881 : : (match_test "<MODE>mode == HImode")
9882 : : (const_string "double")
9883 : : (const_string "direct")))
9884 : 14886 : (set_attr "mode" "<MODE>")])
9885 : :
9886 : : (define_insn "*mulsi3_1_zext"
9887 : : [(set (match_operand:DI 0 "register_operand" "=r,r,r")
9888 : : (zero_extend:DI
9889 : : (mult:SI (match_operand:SI 1 "nonimmediate_operand" "%rm,rm,0")
9890 : : (match_operand:SI 2 "x86_64_general_operand" "K,e,BMr"))))
9891 : : (clobber (reg:CC FLAGS_REG))]
9892 : 173357 : "TARGET_64BIT
9893 : 28 : && !(MEM_P (operands[1]) && MEM_P (operands[2]))"
9894 : : "@
9895 : 4178 : imul{l}\t{%2, %1, %k0|%k0, %1, %2}
9896 : 172177 : imul{l}\t{%2, %1, %k0|%k0, %1, %2}
9897 : 216 : imul{l}\t{%2, %k0|%k0, %2}"
9898 : 216 : [(set_attr "type" "imul")
9899 : 10 : (set_attr "prefix_0f" "0,0,1")
9900 : 10 : (set (attr "athlon_decode")
9901 : 4 : (cond [(eq_attr "cpu" "athlon")
9902 : 4 : (const_string "vector")
9903 : : (eq_attr "alternative" "1")
9904 : 27952 : (const_string "vector")
9905 : 4 : (and (eq_attr "alternative" "2")
9906 : 4 : (match_operand 1 "memory_operand"))
9907 : : (const_string "vector")]
9908 : 27952 : (const_string "direct")))
9909 : 4 : (set (attr "amdfam10_decode")
9910 : 4 : (cond [(and (eq_attr "alternative" "0,1")
9911 : 4 : (match_operand 1 "memory_operand"))
9912 : : (const_string "vector")]
9913 : 4 : (const_string "direct")))
9914 : 4 : (set_attr "bdver1_decode" "direct")
9915 : 4 : (set_attr "mode" "SI")])
9916 : 2936 :
9917 : 4 : ;;On AMDFAM10 and BDVER1
9918 : 4 : ;; MUL reg8 Direct
9919 : 4 : ;; MUL mem8 Direct
9920 : 2936 :
9921 : : (define_insn "*mulqi3_1"
9922 : : [(set (match_operand:QI 0 "register_operand" "=a")
9923 : : (mult:QI (match_operand:QI 1 "nonimmediate_operand" "%0")
9924 : : (match_operand:QI 2 "nonimmediate_operand" "qm")))
9925 : : (clobber (reg:CC FLAGS_REG))]
9926 : 19490 : "TARGET_QIMODE_MATH
9927 : 19490 : && !(MEM_P (operands[1]) && MEM_P (operands[2]))"
9928 : 15452 : "mul{b}\t%2"
9929 : 4610 : [(set_attr "type" "imul")
9930 : 4610 : (set_attr "length_immediate" "0")
9931 : 76364 : (set (attr "athlon_decode")
9932 : 1730 : (if_then_else (eq_attr "cpu" "athlon")
9933 : 1730 : (const_string "vector")
9934 : 1730 : (const_string "direct")))
9935 : 177181 : (set_attr "amdfam10_decode" "direct")
9936 : 100817 : (set_attr "bdver1_decode" "direct")
9937 : 100817 : (set_attr "mode" "QI")])
9938 : :
9939 : 34 : ;; Multiply with jump on overflow.
9940 : : (define_expand "mulv<mode>4"
9941 : 0 : [(parallel [(set (reg:CCO FLAGS_REG)
9942 : 0 : (eq:CCO (mult:<DWI>
9943 : : (sign_extend:<DWI>
9944 : : (match_operand:SWI248 1 "register_operand"))
9945 : : (match_dup 4))
9946 : 200387 : (sign_extend:<DWI>
9947 : : (mult:SWI248 (match_dup 1)
9948 : : (match_operand:SWI248 2
9949 : : "<general_operand>")))))
9950 : 200387 : (set (match_operand:SWI248 0 "register_operand")
9951 : : (mult:SWI248 (match_dup 1) (match_dup 2)))])
9952 : : (set (pc) (if_then_else
9953 : : (eq (reg:CCO FLAGS_REG) (const_int 0))
9954 : : (label_ref (match_operand 3))
9955 : : (pc)))]
9956 : : ""
9957 : 6008 : {
9958 : 6008 : if (CONST_INT_P (operands[2]))
9959 : : operands[4] = operands[2];
9960 : : else
9961 : 4320 : operands[4] = gen_rtx_SIGN_EXTEND (<DWI>mode, operands[2]);
9962 : : })
9963 : :
9964 : : (define_insn "*mulv<mode>4"
9965 : 2485 : [(set (reg:CCO FLAGS_REG)
9966 : 6008 : (eq:CCO (mult:<DWI>
9967 : 6008 : (sign_extend:<DWI>
9968 : 6008 : (match_operand:SWI48 1 "nonimmediate_operand" "%rm,0"))
9969 : 6008 : (sign_extend:<DWI>
9970 : 6008 : (match_operand:SWI48 2 "x86_64_sext_operand" "We,mr")))
9971 : 6008 : (sign_extend:<DWI>
9972 : 6008 : (mult:SWI48 (match_dup 1) (match_dup 2)))))
9973 : 6008 : (set (match_operand:SWI48 0 "register_operand" "=r,r")
9974 : 6008 : (mult:SWI48 (match_dup 1) (match_dup 2)))]
9975 : 2570 : "!(MEM_P (operands[1]) && MEM_P (operands[2]))"
9976 : 6008 : "@
9977 : : imul{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
9978 : : imul{<imodesuffix>}\t{%2, %0|%0, %2}"
9979 : 4788 : [(set_attr "type" "imul")
9980 : 4788 : (set_attr "prefix_0f" "0,1")
9981 : 5358 : (set (attr "athlon_decode")
9982 : 563 : (cond [(eq_attr "cpu" "athlon")
9983 : 563 : (const_string "vector")
9984 : 563 : (eq_attr "alternative" "0")
9985 : 563 : (const_string "vector")
9986 : 563 : (and (eq_attr "alternative" "1")
9987 : 563 : (match_operand 1 "memory_operand"))
9988 : 563 : (const_string "vector")]
9989 : 563 : (const_string "direct")))
9990 : : (set (attr "amdfam10_decode")
9991 : : (cond [(and (eq_attr "alternative" "1")
9992 : : (match_operand 1 "memory_operand"))
9993 : 6008 : (const_string "vector")]
9994 : : (const_string "direct")))
9995 : : (set_attr "bdver1_decode" "direct")
9996 : : (set_attr "mode" "<MODE>")])
9997 : :
9998 : : (define_insn "*mulvhi4"
9999 : : [(set (reg:CCO FLAGS_REG)
10000 : : (eq:CCO (mult:SI
10001 : : (sign_extend:SI
10002 : 6008 : (match_operand:HI 1 "nonimmediate_operand" "%0"))
10003 : 6008 : (sign_extend:SI
10004 : 6008 : (match_operand:HI 2 "nonimmediate_operand" "mr")))
10005 : : (sign_extend:SI
10006 : : (mult:HI (match_dup 1) (match_dup 2)))))
10007 : : (set (match_operand:HI 0 "register_operand" "=r")
10008 : : (mult:HI (match_dup 1) (match_dup 2)))]
10009 : 7120 : "!(MEM_P (operands[1]) && MEM_P (operands[2]))"
10010 : : "imul{w}\t{%2, %0|%0, %2}"
10011 : : [(set_attr "type" "imul")
10012 : : (set_attr "prefix_0f" "1")
10013 : 674 : (set_attr "athlon_decode" "vector")
10014 : 7139 : (set_attr "amdfam10_decode" "direct")
10015 : 1694 : (set_attr "bdver1_decode" "double")
10016 : 5445 : (set_attr "mode" "HI")])
10017 : 6465 :
10018 : 6465 : (define_insn "*mulv<mode>4_1"
10019 : 6465 : [(set (reg:CCO FLAGS_REG)
10020 : 6465 : (eq:CCO (mult:<DWI>
10021 : 6465 : (sign_extend:<DWI>
10022 : 5445 : (match_operand:SWI248 1 "nonimmediate_operand" "rm,rm"))
10023 : : (match_operand:<DWI> 3 "const_int_operand" "K,i"))
10024 : : (sign_extend:<DWI>
10025 : : (mult:SWI248 (match_dup 1)
10026 : : (match_operand:SWI248 2
10027 : : "<immediate_operand>" "K,<i>")))))
10028 : : (set (match_operand:SWI248 0 "register_operand" "=r,r")
10029 : : (mult:SWI248 (match_dup 1) (match_dup 2)))]
10030 : 1 : "!(MEM_P (operands[1]) && MEM_P (operands[2]))
10031 : 2687 : && CONST_INT_P (operands[2])
10032 : 1033 : && INTVAL (operands[2]) == INTVAL (operands[3])"
10033 : 0 : "imul{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
10034 : : [(set_attr "type" "imul")
10035 : : (set (attr "prefix_0f")
10036 : 6751 : (if_then_else
10037 : 6751 : (match_test "<MODE>mode == HImode")
10038 : 9072 : (const_string "0")
10039 : 0 : (const_string "*")))
10040 : : (set (attr "athlon_decode")
10041 : : (cond [(eq_attr "cpu" "athlon")
10042 : : (const_string "vector")
10043 : 0 : (eq_attr "alternative" "1")
10044 : : (const_string "vector")]
10045 : : (const_string "direct")))
10046 : 0 : (set (attr "amdfam10_decode")
10047 : 0 : (cond [(ior (match_test "<MODE>mode == HImode")
10048 : 0 : (match_operand 1 "memory_operand"))
10049 : 0 : (const_string "vector")]
10050 : : (const_string "direct")))
10051 : : (set (attr "bdver1_decode")
10052 : : (if_then_else
10053 : : (match_test "<MODE>mode == HImode")
10054 : 0 : (const_string "double")
10055 : : (const_string "direct")))
10056 : : (set_attr "mode" "<MODE>")
10057 : 0 : (set (attr "length_immediate")
10058 : 0 : (cond [(eq_attr "alternative" "0")
10059 : 0 : (const_string "1")
10060 : 0 : (match_test "<MODE_SIZE> == 8")
10061 : 0 : (const_string "4")]
10062 : 0 : (const_string "<MODE_SIZE>")))])
10063 : 0 :
10064 : 0 : (define_expand "umulv<mode>4"
10065 : 0 : [(parallel [(set (reg:CCO FLAGS_REG)
10066 : 0 : (eq:CCO (mult:<DWI>
10067 : 0 : (zero_extend:<DWI>
10068 : 0 : (match_operand:SWI248 1
10069 : 1585482 : "nonimmediate_operand"))
10070 : 1735 : (zero_extend:<DWI>
10071 : 6716 : (match_operand:SWI248 2
10072 : 4981 : "nonimmediate_operand")))
10073 : 1578766 : (zero_extend:<DWI>
10074 : 1578766 : (mult:SWI248 (match_dup 1) (match_dup 2)))))
10075 : 0 : (set (match_operand:SWI248 0 "register_operand")
10076 : 0 : (mult:SWI248 (match_dup 1) (match_dup 2)))
10077 : 1578766 : (clobber (scratch:SWI248))])
10078 : 1578766 : (set (pc) (if_then_else
10079 : 1578766 : (eq (reg:CCO FLAGS_REG) (const_int 0))
10080 : 0 : (label_ref (match_operand 3))
10081 : 6602 : (pc)))]
10082 : 6602 : ""
10083 : 1579374 : {
10084 : 1574547 : if (MEM_P (operands[1]) && MEM_P (operands[2]))
10085 : 1573148 : operands[1] = force_reg (<MODE>mode, operands[1]);
10086 : 1572164 : })
10087 : 1572164 :
10088 : 1572164 : (define_insn "*umulv<mode>4"
10089 : 1579374 : [(set (reg:CCO FLAGS_REG)
10090 : 7210 : (eq:CCO (mult:<DWI>
10091 : 7210 : (zero_extend:<DWI>
10092 : 7210 : (match_operand:SWI248 1 "nonimmediate_operand" "%0"))
10093 : 7210 : (zero_extend:<DWI>
10094 : 7210 : (match_operand:SWI248 2 "nonimmediate_operand" "rm")))
10095 : 7210 : (zero_extend:<DWI>
10096 : 7210 : (mult:SWI248 (match_dup 1) (match_dup 2)))))
10097 : : (set (match_operand:SWI248 0 "register_operand" "=a")
10098 : 7210 : (mult:SWI248 (match_dup 1) (match_dup 2)))
10099 : : (clobber (match_scratch:SWI248 3 "=d"))]
10100 : 1892 : "!(MEM_P (operands[1]) && MEM_P (operands[2]))"
10101 : 20 : "mul{<imodesuffix>}\t%2"
10102 : 52 : [(set_attr "type" "imul")
10103 : 52 : (set_attr "length_immediate" "0")
10104 : 9800 : (set (attr "athlon_decode")
10105 : 9800 : (if_then_else (eq_attr "cpu" "athlon")
10106 : 10406 : (const_string "vector")
10107 : 63 : (const_string "double")))
10108 : 137 : (set_attr "amdfam10_decode" "double")
10109 : : (set_attr "bdver1_decode" "direct")
10110 : : (set_attr "mode" "<MODE>")])
10111 : :
10112 : : (define_expand "<u>mulvqi4"
10113 : : [(parallel [(set (reg:CCO FLAGS_REG)
10114 : : (eq:CCO (mult:HI
10115 : : (any_extend:HI
10116 : 1515176221 : (match_operand:QI 1 "nonimmediate_operand"))
10117 : : (any_extend:HI
10118 : 1515183431 : (match_operand:QI 2 "nonimmediate_operand")))
10119 : 1515176221 : (any_extend:HI
10120 : : (mult:QI (match_dup 1) (match_dup 2)))))
10121 : 1515176221 : (set (match_operand:QI 0 "register_operand")
10122 : : (mult:QI (match_dup 1) (match_dup 2)))])
10123 : 692 : (set (pc) (if_then_else
10124 : 692 : (eq (reg:CCO FLAGS_REG) (const_int 0))
10125 : 692 : (label_ref (match_operand 3))
10126 : 692 : (pc)))]
10127 : 7902 : "TARGET_QIMODE_MATH"
10128 : 7902 : {
10129 : 896 : if (MEM_P (operands[1]) && MEM_P (operands[2]))
10130 : 834 : operands[1] = force_reg (QImode, operands[1]);
10131 : 692 : })
10132 : 692 :
10133 : : (define_insn "*<u>mulvqi4"
10134 : 7919 : [(set (reg:CCO FLAGS_REG)
10135 : 903 : (eq:CCO (mult:HI
10136 : 903 : (any_extend:HI
10137 : 903 : (match_operand:QI 1 "nonimmediate_operand" "%0"))
10138 : 903 : (any_extend:HI
10139 : 7573 : (match_operand:QI 2 "nonimmediate_operand" "qm")))
10140 : 6670 : (any_extend:HI
10141 : 7573 : (mult:QI (match_dup 1) (match_dup 2)))))
10142 : 6670 : (set (match_operand:QI 0 "register_operand" "=a")
10143 : 903 : (mult:QI (match_dup 1) (match_dup 2)))]
10144 : 8025 : "TARGET_QIMODE_MATH
10145 : 8025 : && !(MEM_P (operands[1]) && MEM_P (operands[2]))"
10146 : 6670 : "<sgnprefix>mul{b}\t%2"
10147 : 0 : [(set_attr "type" "imul")
10148 : : (set_attr "length_immediate" "0")
10149 : : (set (attr "athlon_decode")
10150 : : (if_then_else (eq_attr "cpu" "athlon")
10151 : : (const_string "vector")
10152 : : (const_string "direct")))
10153 : 9759 : (set_attr "amdfam10_decode" "direct")
10154 : 9759 : (set_attr "bdver1_decode" "direct")
10155 : 9759 : (set_attr "mode" "QI")])
10156 : 108522 :
10157 : 10679 : (define_expand "<u>mul<mode><dwi>3"
10158 : 109442 : [(parallel [(set (match_operand:<DWI> 0 "register_operand")
10159 : 98763 : (mult:<DWI>
10160 : 9221 : (any_extend:<DWI>
10161 : 99737 : (match_operand:DWIH 1 "register_operand"))
10162 : 366 : (any_extend:<DWI>
10163 : 450 : (match_operand:DWIH 2 "nonimmediate_operand"))))
10164 : 450 : (clobber (reg:CC FLAGS_REG))])])
10165 : 450 :
10166 : 450 : (define_expand "<u>mulqihi3"
10167 : 450 : [(parallel [(set (match_operand:HI 0 "register_operand")
10168 : 366 : (mult:HI
10169 : 366 : (any_extend:HI
10170 : 1269 : (match_operand:QI 1 "register_operand"))
10171 : 2001 : (any_extend:HI
10172 : 903 : (match_operand:QI 2 "nonimmediate_operand"))))
10173 : : (clobber (reg:CC FLAGS_REG))])]
10174 : : "TARGET_QIMODE_MATH")
10175 : :
10176 : 120 : (define_insn "*bmi2_umul<mode><dwi>3_1"
10177 : 1887 : [(set (match_operand:DWIH 0 "register_operand" "=r")
10178 : 120 : (mult:DWIH
10179 : 120 : (match_operand:DWIH 2 "register_operand" "%d")
10180 : 120 : (match_operand:DWIH 3 "nonimmediate_operand" "rm")))
10181 : 1464 : (set (match_operand:DWIH 1 "register_operand" "=r")
10182 : 543 : (umul_highpart:DWIH (match_dup 2) (match_dup 3)))]
10183 : 543 : "TARGET_BMI2"
10184 : 543 : "mulx\t{%3, %0, %1|%1, %0, %3}"
10185 : 543 : [(set_attr "type" "imulx")
10186 : 543 : (set_attr "prefix" "vex")
10187 : 423 : (set_attr "mode" "<MODE>")])
10188 : 423 :
10189 : 423 : ;; Tweak *bmi2_umul<mode><dwi>3_1 to eliminate following mov.
10190 : 112 : (define_peephole2
10191 : : [(parallel [(set (match_operand:DWIH 0 "general_reg_operand")
10192 : : (mult:DWIH (match_operand:DWIH 2 "register_operand")
10193 : : (match_operand:DWIH 3 "nonimmediate_operand")))
10194 : 10359 : (set (match_operand:DWIH 1 "general_reg_operand")
10195 : : (umul_highpart:DWIH (match_dup 2) (match_dup 3)))])
10196 : : (set (match_operand:DWIH 4 "general_reg_operand")
10197 : : (match_operand:DWIH 5 "general_reg_operand"))]
10198 : 10372 : "TARGET_BMI2
10199 : 2012 : && ((REGNO (operands[5]) == REGNO (operands[0])
10200 : 1999 : && REGNO (operands[1]) != REGNO (operands[4]))
10201 : 2012 : || (REGNO (operands[5]) == REGNO (operands[1])
10202 : 2011 : && REGNO (operands[0]) != REGNO (operands[4])))
10203 : 2011 : && peep2_reg_dead_p (2, operands[5])"
10204 : 1999 : [(parallel [(set (match_dup 0) (mult:DWIH (match_dup 2) (match_dup 3)))
10205 : 1999 : (set (match_dup 1)
10206 : 1999 : (umul_highpart:DWIH (match_dup 2) (match_dup 3)))])]
10207 : 2011 : {
10208 : 2011 : if (REGNO (operands[5]) == REGNO (operands[0]))
10209 : 0 : operands[0] = operands[4];
10210 : : else
10211 : 12 : operands[1] = operands[4];
10212 : : })
10213 : :
10214 : : (define_insn "*umul<mode><dwi>3_1"
10215 : 1033 : [(set (match_operand:<DWI> 0 "register_operand" "=r,A")
10216 : 12 : (mult:<DWI>
10217 : 14 : (zero_extend:<DWI>
10218 : 14 : (match_operand:DWIH 1 "register_operand" "%d,a"))
10219 : 14 : (zero_extend:<DWI>
10220 : 12 : (match_operand:DWIH 2 "nonimmediate_operand" "rm,rm"))))
10221 : 12 : (clobber (reg:CC FLAGS_REG))]
10222 : 99892 : "!(MEM_P (operands[1]) && MEM_P (operands[2]))"
10223 : 12 : "@
10224 : : #
10225 : : mul{<imodesuffix>}\t%2"
10226 : : [(set_attr "isa" "bmi2,*")
10227 : : (set_attr "type" "imulx,imul")
10228 : 15060 : (set_attr "length_immediate" "*,0")
10229 : 0 : (set (attr "athlon_decode")
10230 : 0 : (cond [(eq_attr "alternative" "1")
10231 : 0 : (if_then_else (eq_attr "cpu" "athlon")
10232 : 15060 : (const_string "vector")
10233 : 12 : (const_string "double"))]
10234 : 12 : (const_string "*")))
10235 : 12 : (set_attr "amdfam10_decode" "*,double")
10236 : : (set_attr "bdver1_decode" "*,direct")
10237 : : (set_attr "prefix" "vex,orig")
10238 : : (set_attr "mode" "<MODE>")])
10239 : :
10240 : : ;; Convert mul to the mulx pattern to avoid flags dependency.
10241 : 12 : (define_split
10242 : 0 : [(set (match_operand:<DWI> 0 "register_operand")
10243 : 12 : (mult:<DWI>
10244 : 12 : (zero_extend:<DWI>
10245 : 133 : (match_operand:DWIH 1 "register_operand"))
10246 : 12 : (zero_extend:<DWI>
10247 : 12 : (match_operand:DWIH 2 "nonimmediate_operand"))))
10248 : 12 : (clobber (reg:CC FLAGS_REG))]
10249 : 63953 : "TARGET_BMI2 && reload_completed
10250 : 46 : && REGNO (operands[1]) == DX_REG"
10251 : 0 : [(parallel [(set (match_dup 3)
10252 : : (mult:DWIH (match_dup 1) (match_dup 2)))
10253 : : (set (match_dup 4)
10254 : : (umul_highpart:DWIH (match_dup 1) (match_dup 2)))])]
10255 : 21 : {
10256 : 21 : split_double_mode (<DWI>mode, &operands[0], 1, &operands[3], &operands[4]);
10257 : :
10258 : 21 : operands[5] = GEN_INT (<MODE_SIZE> * BITS_PER_UNIT);
10259 : : })
10260 : :
10261 : : (define_insn "*mul<mode><dwi>3_1"
10262 : 408 : [(set (match_operand:<DWI> 0 "register_operand" "=A")
10263 : 21 : (mult:<DWI>
10264 : 21 : (sign_extend:<DWI>
10265 : 21 : (match_operand:DWIH 1 "register_operand" "%a"))
10266 : 387 : (sign_extend:<DWI>
10267 : 21 : (match_operand:DWIH 2 "nonimmediate_operand" "rm"))))
10268 : 21 : (clobber (reg:CC FLAGS_REG))]
10269 : 4691 : "!(MEM_P (operands[1]) && MEM_P (operands[2]))"
10270 : 21 : "imul{<imodesuffix>}\t%2"
10271 : 21 : [(set_attr "type" "imul")
10272 : 21 : (set_attr "length_immediate" "0")
10273 : : (set (attr "athlon_decode")
10274 : : (if_then_else (eq_attr "cpu" "athlon")
10275 : : (const_string "vector")
10276 : : (const_string "double")))
10277 : : (set_attr "amdfam10_decode" "double")
10278 : : (set_attr "bdver1_decode" "direct")
10279 : : (set_attr "mode" "<MODE>")])
10280 : 0 :
10281 : : (define_insn "*<u>mulqihi3_1"
10282 : 21 : [(set (match_operand:HI 0 "register_operand" "=a")
10283 : 21 : (mult:HI
10284 : 21 : (any_extend:HI
10285 : 0 : (match_operand:QI 1 "register_operand" "%0"))
10286 : 0 : (any_extend:HI
10287 : 0 : (match_operand:QI 2 "nonimmediate_operand" "qm"))))
10288 : 0 : (clobber (reg:CC FLAGS_REG))]
10289 : 1379 : "TARGET_QIMODE_MATH
10290 : 1479 : && !(MEM_P (operands[1]) && MEM_P (operands[2]))"
10291 : : "<sgnprefix>mul{b}\t%2"
10292 : 421 : [(set_attr "type" "imul")
10293 : 421 : (set_attr "length_immediate" "0")
10294 : 100 : (set (attr "athlon_decode")
10295 : 100 : (if_then_else (eq_attr "cpu" "athlon")
10296 : 100 : (const_string "vector")
10297 : 100 : (const_string "direct")))
10298 : 52169 : (set_attr "amdfam10_decode" "direct")
10299 : 52069 : (set_attr "bdver1_decode" "direct")
10300 : 64793 : (set_attr "mode" "QI")])
10301 : 3589 :
10302 : 3589 : ;; Widening multiplication peephole2s to tweak register allocation.
10303 : 123 : ;; mov imm,%rdx; mov %rdi,%rax; mulq %rdx -> mov imm,%rax; mulq %rdi
10304 : 123 : (define_peephole2
10305 : 26184971 : [(set (match_operand:DWIH 0 "general_reg_operand")
10306 : 123 : (match_operand:DWIH 1 "immediate_operand"))
10307 : 123 : (set (match_operand:DWIH 2 "general_reg_operand")
10308 : 258027 : (match_operand:DWIH 3 "general_reg_operand"))
10309 : 26442963 : (parallel [(set (match_operand:<DWI> 4 "general_reg_operand")
10310 : 26442963 : (mult:<DWI> (zero_extend:<DWI> (match_dup 2))
10311 : 123 : (zero_extend:<DWI> (match_dup 0))))
10312 : 26442840 : (clobber (reg:CC FLAGS_REG))])]
10313 : 26186387 : "REGNO (operands[3]) != AX_REG
10314 : 1639 : && REGNO (operands[0]) != REGNO (operands[2])
10315 : 1639 : && REGNO (operands[0]) != REGNO (operands[3])
10316 : 21263858 : && (REGNO (operands[0]) == REGNO (operands[4])
10317 : 21263858 : || REGNO (operands[0]) == DX_REG
10318 : 892 : || peep2_reg_dead_p (3, operands[0]))"
10319 : 257992 : [(set (match_dup 2) (match_dup 1))
10320 : 40 : (parallel [(set (match_dup 4)
10321 : 84 : (mult:<DWI> (zero_extend:<DWI> (match_dup 2))
10322 : 2748285 : (zero_extend:<DWI> (match_dup 3))))
10323 : 2776928 : (clobber (reg:CC FLAGS_REG))])])
10324 : 119 :
10325 : 40 : ;; mov imm,%rax; mov %rdi,%rdx; mulx %rax -> mov imm,%rdx; mulx %rdi
10326 : 28184 : (define_peephole2
10327 : 1898227 : [(set (match_operand:DWIH 0 "general_reg_operand")
10328 : 1898227 : (match_operand:DWIH 1 "immediate_operand"))
10329 : 1924542 : (set (match_operand:DWIH 2 "general_reg_operand")
10330 : 948 : (match_operand:DWIH 3 "general_reg_operand"))
10331 : 75 : (parallel [(set (match_operand:DWIH 4 "general_reg_operand")
10332 : 2187 : (mult:DWIH (match_dup 2) (match_dup 0)))
10333 : 277110 : (set (match_operand:DWIH 5 "general_reg_operand")
10334 : 277110 : (umul_highpart:DWIH (match_dup 2) (match_dup 0)))])]
10335 : 914 : "REGNO (operands[3]) != DX_REG
10336 : 2191 : && REGNO (operands[0]) != REGNO (operands[2])
10337 : 2191 : && REGNO (operands[0]) != REGNO (operands[3])
10338 : 1282 : && (REGNO (operands[0]) == REGNO (operands[4])
10339 : 1 : || REGNO (operands[0]) == REGNO (operands[5])
10340 : 911 : || peep2_reg_dead_p (3, operands[0]))
10341 : 2191 : && (REGNO (operands[2]) == REGNO (operands[4])
10342 : 1169 : || REGNO (operands[2]) == REGNO (operands[5])
10343 : 914 : || peep2_reg_dead_p (3, operands[2]))"
10344 : 2405 : [(set (match_dup 2) (match_dup 1))
10345 : 2187 : (parallel [(set (match_dup 4)
10346 : 1128 : (mult:DWIH (match_dup 2) (match_dup 3)))
10347 : 1128 : (set (match_dup 5)
10348 : 2187 : (umul_highpart:DWIH (match_dup 2) (match_dup 3)))])])
10349 : 2187 :
10350 : 2187 : ;; Highpart multiplication patterns
10351 : 2187 : (define_insn "<s>mul<mode>3_highpart"
10352 : 2554 : [(set (match_operand:DWIH 0 "register_operand" "=d")
10353 : 910 : (any_mul_highpart:DWIH
10354 : 1277 : (match_operand:DWIH 1 "register_operand" "%a")
10355 : 1277 : (match_operand:DWIH 2 "nonimmediate_operand" "rm")))
10356 : 1277 : (clobber (match_scratch:DWIH 3 "=1"))
10357 : : (clobber (reg:CC FLAGS_REG))]
10358 : 1179 : ""
10359 : 1179 : "<sgnprefix>mul{<imodesuffix>}\t%2"
10360 : 1033 : [(set_attr "type" "imul")
10361 : : (set_attr "length_immediate" "0")
10362 : 1943 : (set (attr "athlon_decode")
10363 : 1943 : (if_then_else (eq_attr "cpu" "athlon")
10364 : 910 : (const_string "vector")
10365 : 1033 : (const_string "double")))
10366 : 1033 : (set_attr "amdfam10_decode" "double")
10367 : : (set_attr "bdver1_decode" "direct")
10368 : 1033 : (set_attr "mode" "<MODE>")])
10369 : :
10370 : 276 : (define_insn "*<s>mulsi3_highpart_zext"
10371 : 276 : [(set (match_operand:DI 0 "register_operand" "=d")
10372 : 0 : (zero_extend:DI
10373 : 276 : (any_mul_highpart:SI
10374 : 276 : (match_operand:SI 1 "register_operand" "%a")
10375 : 276 : (match_operand:SI 2 "nonimmediate_operand" "rm"))))
10376 : 0 : (clobber (match_scratch:SI 3 "=1"))
10377 : 276 : (clobber (reg:CC FLAGS_REG))]
10378 : 276 : "TARGET_64BIT"
10379 : 276 : "<sgnprefix>mul{l}\t%2"
10380 : 0 : [(set_attr "type" "imul")
10381 : 0 : (set_attr "length_immediate" "0")
10382 : 8 : (set (attr "athlon_decode")
10383 : 8 : (if_then_else (eq_attr "cpu" "athlon")
10384 : 1900 : (const_string "vector")
10385 : 1892 : (const_string "double")))
10386 : 0 : (set_attr "amdfam10_decode" "double")
10387 : 0 : (set_attr "bdver1_decode" "direct")
10388 : 0 : (set_attr "mode" "SI")])
10389 : 0 :
10390 : 0 : (define_insn "*<s>muldi3_highpart_1"
10391 : 0 : [(set (match_operand:DI 0 "register_operand" "=d")
10392 : 0 : (truncate:DI
10393 : 0 : (lshiftrt:TI
10394 : 0 : (mult:TI
10395 : 0 : (any_extend:TI
10396 : 0 : (match_operand:DI 1 "nonimmediate_operand" "%a"))
10397 : 0 : (any_extend:TI
10398 : 0 : (match_operand:DI 2 "nonimmediate_operand" "rm")))
10399 : 0 : (const_int 64))))
10400 : 0 : (clobber (match_scratch:DI 3 "=1"))
10401 : 0 : (clobber (reg:CC FLAGS_REG))]
10402 : 0 : "TARGET_64BIT
10403 : 0 : && !(MEM_P (operands[1]) && MEM_P (operands[2]))"
10404 : 0 : "<sgnprefix>mul{q}\t%2"
10405 : 0 : [(set_attr "type" "imul")
10406 : 0 : (set_attr "length_immediate" "0")
10407 : 0 : (set (attr "athlon_decode")
10408 : 0 : (if_then_else (eq_attr "cpu" "athlon")
10409 : 0 : (const_string "vector")
10410 : 0 : (const_string "double")))
10411 : 0 : (set_attr "amdfam10_decode" "double")
10412 : 0 : (set_attr "bdver1_decode" "direct")
10413 : 0 : (set_attr "mode" "DI")])
10414 : 2 :
10415 : 0 : (define_insn "*<s>mulsi3_highpart_zext"
10416 : 2 : [(set (match_operand:DI 0 "register_operand" "=d")
10417 : 2 : (zero_extend:DI (truncate:SI
10418 : 2 : (lshiftrt:DI
10419 : 2 : (mult:DI (any_extend:DI
10420 : 2 : (match_operand:SI 1 "nonimmediate_operand" "%a"))
10421 : 2 : (any_extend:DI
10422 : 2 : (match_operand:SI 2 "nonimmediate_operand" "rm")))
10423 : 2 : (const_int 32)))))
10424 : 0 : (clobber (match_scratch:SI 3 "=1"))
10425 : 2 : (clobber (reg:CC FLAGS_REG))]
10426 : 2 : "TARGET_64BIT
10427 : 2 : && !(MEM_P (operands[1]) && MEM_P (operands[2]))"
10428 : 2 : "<sgnprefix>mul{l}\t%2"
10429 : 2 : [(set_attr "type" "imul")
10430 : 2 : (set_attr "length_immediate" "0")
10431 : 2 : (set (attr "athlon_decode")
10432 : 2 : (if_then_else (eq_attr "cpu" "athlon")
10433 : 2 : (const_string "vector")
10434 : 2 : (const_string "double")))
10435 : 2 : (set_attr "amdfam10_decode" "double")
10436 : 2 : (set_attr "bdver1_decode" "direct")
10437 : 32135 : (set_attr "mode" "SI")])
10438 : 2 :
10439 : 6434 : (define_insn "*<s>mulsi3_highpart_1"
10440 : 6436 : [(set (match_operand:SI 0 "register_operand" "=d")
10441 : 7279 : (truncate:SI
10442 : 0 : (lshiftrt:DI
10443 : 0 : (mult:DI
10444 : 0 : (any_extend:DI
10445 : 0 : (match_operand:SI 1 "nonimmediate_operand" "%a"))
10446 : 0 : (any_extend:DI
10447 : : (match_operand:SI 2 "nonimmediate_operand" "rm")))
10448 : 0 : (const_int 32))))
10449 : 0 : (clobber (match_scratch:SI 3 "=1"))
10450 : 2 : (clobber (reg:CC FLAGS_REG))]
10451 : 2 : "!(MEM_P (operands[1]) && MEM_P (operands[2]))"
10452 : 2 : "<sgnprefix>mul{l}\t%2"
10453 : 0 : [(set_attr "type" "imul")
10454 : 0 : (set_attr "length_immediate" "0")
10455 : : (set (attr "athlon_decode")
10456 : 0 : (if_then_else (eq_attr "cpu" "athlon")
10457 : : (const_string "vector")
10458 : 219 : (const_string "double")))
10459 : 0 : (set_attr "amdfam10_decode" "double")
10460 : 219 : (set_attr "bdver1_decode" "direct")
10461 : 1986 : (set_attr "mode" "SI")])
10462 : 219 :
10463 : 219 : ;; Highpart multiplication peephole2s to tweak register allocation.
10464 : 177396 : ;; mov imm,%rdx; mov %rdi,%rax; imulq %rdx -> mov imm,%rax; imulq %rdi
10465 : 219 : (define_peephole2
10466 : 90399 : [(set (match_operand:SWI48 0 "general_reg_operand")
10467 : 79499 : (match_operand:SWI48 1 "immediate_operand"))
10468 : 219 : (set (match_operand:SWI48 2 "general_reg_operand")
10469 : 219 : (match_operand:SWI48 3 "general_reg_operand"))
10470 : 10900 : (parallel [(set (match_operand:SWI48 4 "general_reg_operand")
10471 : 219 : (any_mul_highpart:SWI48 (match_dup 2) (match_dup 0)))
10472 : 10900 : (clobber (match_dup 2))
10473 : 10900 : (clobber (reg:CC FLAGS_REG))])]
10474 : 9192 : "REGNO (operands[3]) != AX_REG
10475 : 9185 : && REGNO (operands[0]) != REGNO (operands[2])
10476 : 19866 : && REGNO (operands[0]) != REGNO (operands[3])
10477 : 9185 : && (REGNO (operands[0]) == REGNO (operands[4])
10478 : 3076 : || peep2_reg_dead_p (3, operands[0]))"
10479 : 2311 : [(set (match_dup 2) (match_dup 1))
10480 : 474 : (parallel [(set (match_dup 4)
10481 : 2022 : (any_mul_highpart:SWI48 (match_dup 2) (match_dup 3)))
10482 : : (clobber (match_dup 2))
10483 : 388 : (clobber (reg:CC FLAGS_REG))])])
10484 : 388 :
10485 : 699 : (define_peephole2
10486 : 0 : [(set (match_operand:SI 0 "general_reg_operand")
10487 : 0 : (match_operand:SI 1 "immediate_operand"))
10488 : 0 : (set (match_operand:SI 2 "general_reg_operand")
10489 : : (match_operand:SI 3 "general_reg_operand"))
10490 : 219 : (parallel [(set (match_operand:DI 4 "general_reg_operand")
10491 : 219 : (zero_extend:DI
10492 : 219 : (any_mul_highpart:SI (match_dup 2) (match_dup 0))))
10493 : 0 : (clobber (match_dup 2))
10494 : 0 : (clobber (reg:CC FLAGS_REG))])]
10495 : 0 : "TARGET_64BIT
10496 : 0 : && REGNO (operands[3]) != AX_REG
10497 : 0 : && REGNO (operands[0]) != REGNO (operands[2])
10498 : 255 : && REGNO (operands[2]) != REGNO (operands[3])
10499 : 0 : && REGNO (operands[0]) != REGNO (operands[3])
10500 : 255 : && (REGNO (operands[0]) == REGNO (operands[4])
10501 : 255 : || peep2_reg_dead_p (3, operands[0]))"
10502 : 255 : [(set (match_dup 2) (match_dup 1))
10503 : 255 : (parallel [(set (match_dup 4)
10504 : 255 : (zero_extend:DI
10505 : 255 : (any_mul_highpart:SI (match_dup 2) (match_dup 3))))
10506 : 255 : (clobber (match_dup 2))
10507 : 0 : (clobber (reg:CC FLAGS_REG))])])
10508 : 255 :
10509 : 255 : ;; The patterns that match these are at the end of this file.
10510 : 255 :
10511 : 255 : (define_expand "mulxf3"
10512 : 255 : [(set (match_operand:XF 0 "register_operand")
10513 : 255 : (mult:XF (match_operand:XF 1 "register_operand")
10514 : 255 : (match_operand:XF 2 "register_operand")))]
10515 : 255 : "TARGET_80387")
10516 : 255 :
10517 : 255 : (define_expand "mulhf3"
10518 : 255 : [(set (match_operand:HF 0 "register_operand")
10519 : 255 : (mult:HF (match_operand:HF 1 "register_operand")
10520 : 3570547 : (match_operand:HF 2 "nonimmediate_operand")))]
10521 : 255 : "TARGET_AVX512FP16")
10522 : :
10523 : : (define_expand "mul<mode>3"
10524 : 3570547 : [(set (match_operand:MODEF 0 "register_operand")
10525 : 3570547 : (mult:MODEF (match_operand:MODEF 1 "register_operand")
10526 : 3570547 : (match_operand:MODEF 2 "nonimmediate_operand")))]
10527 : 3570547 : "(TARGET_80387 && X87_ENABLE_ARITH (<MODE>mode))
10528 : 3570547 : || (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)")
10529 : :
10530 : 2811354 : ;; Divide instructions
10531 : 2811354 :
10532 : 255 : ;; The patterns that match these are at the end of this file.
10533 : 1130056 :
10534 : 1130056 : (define_expand "divxf3"
10535 : : [(set (match_operand:XF 0 "register_operand")
10536 : 1 : (div:XF (match_operand:XF 1 "register_operand")
10537 : 1 : (match_operand:XF 2 "register_operand")))]
10538 : 3786 : "TARGET_80387")
10539 : :
10540 : 3786 : /* There is no more precision loss than Newton-Rhapson approximation
10541 : 3786 : when using HFmode rcp/rsqrt, so do the transformation directly under
10542 : 3786 : TARGET_RECIP_DIV and fast-math. */
10543 : 3786 : (define_expand "divhf3"
10544 : 3786 : [(set (match_operand:HF 0 "register_operand")
10545 : 3786 : (div:HF (match_operand:HF 1 "register_operand")
10546 : 3786 : (match_operand:HF 2 "nonimmediate_operand")))]
10547 : 0 : "TARGET_AVX512FP16"
10548 : 3786 : {
10549 : 3879 : if (TARGET_RECIP_DIV
10550 : 32 : && optimize_insn_for_speed_p ()
10551 : 32 : && flag_finite_math_only && !flag_trapping_math
10552 : 32 : && flag_unsafe_math_optimizations)
10553 : 3786 : {
10554 : 32 : rtx op = gen_reg_rtx (HFmode);
10555 : 32 : operands[2] = force_reg (HFmode, operands[2]);
10556 : 32 : emit_insn (gen_rcphf2 (op, operands[2]));
10557 : 32 : emit_insn (gen_mulhf3 (operands[0], operands[1], op));
10558 : 32 : DONE;
10559 : 3786 : }
10560 : : })
10561 : 3786 :
10562 : : (define_expand "div<mode>3"
10563 : 61 : [(set (match_operand:MODEF 0 "register_operand")
10564 : 61 : (div:MODEF (match_operand:MODEF 1 "register_operand")
10565 : 61 : (match_operand:MODEF 2 "nonimmediate_operand")))]
10566 : 61 : "(TARGET_80387 && X87_ENABLE_ARITH (<MODE>mode))
10567 : 61 : || (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)"
10568 : 21102 : {
10569 : 21041 : if (<MODE>mode == SFmode
10570 : 17299 : && TARGET_SSE && TARGET_SSE_MATH
10571 : 17153 : && TARGET_RECIP_DIV
10572 : 4 : && optimize_insn_for_speed_p ()
10573 : 4 : && flag_finite_math_only && !flag_trapping_math
10574 : 65 : && flag_unsafe_math_optimizations)
10575 : 61 : {
10576 : 65 : ix86_emit_swdivsf (operands[0], operands[1],
10577 : : operands[2], SFmode);
10578 : 4 : DONE;
10579 : : }
10580 : 3986 : })
10581 : 17438 :
10582 : 3986 : ;; Divmod instructions.
10583 : 25023 :
10584 : 25023 : (define_code_iterator any_div [div udiv])
10585 : 38475 : (define_code_attr paired_mod [(div "mod") (udiv "umod")])
10586 : 17438 :
10587 : 0 : (define_expand "<u>divmod<mode>4"
10588 : 3986 : [(parallel [(set (match_operand:SWIM248 0 "register_operand")
10589 : 17438 : (any_div:SWIM248
10590 : 21037 : (match_operand:SWIM248 1 "register_operand")
10591 : 13452 : (match_operand:SWIM248 2 "nonimmediate_operand")))
10592 : 3986 : (set (match_operand:SWIM248 3 "register_operand")
10593 : 3986 : (<paired_mod>:SWIM248 (match_dup 1) (match_dup 2)))
10594 : 21037 : (clobber (reg:CC FLAGS_REG))])])
10595 : 7589 :
10596 : 13448 : ;; Split with 8bit unsigned divide:
10597 : 3986 : ;; if (dividend an divisor are in [0-255])
10598 : 3986 : ;; use 8bit unsigned integer divide
10599 : 3986 : ;; else
10600 : : ;; use original integer divide
10601 : 12194 : (define_split
10602 : : [(set (match_operand:SWI48 0 "register_operand")
10603 : : (any_div:SWI48 (match_operand:SWI48 2 "register_operand")
10604 : : (match_operand:SWI48 3 "nonimmediate_operand")))
10605 : 7589 : (set (match_operand:SWI48 1 "register_operand")
10606 : 8208 : (<paired_mod>:SWI48 (match_dup 2) (match_dup 3)))
10607 : 7589 : (clobber (reg:CC FLAGS_REG))]
10608 : 150644 : "TARGET_USE_8BIT_IDIV
10609 : 7614 : && TARGET_QIMODE_MATH
10610 : 4011 : && can_create_pseudo_p ()
10611 : 44651 : && !optimize_insn_for_size_p ()"
10612 : 4000 : [(const_int 0)]
10613 : 46963 : "ix86_split_idivmod (<MODE>mode, operands, <u_bool>); DONE;")
10614 : :
10615 : : (define_split
10616 : : [(set (match_operand:DI 0 "register_operand")
10617 : : (zero_extend:DI
10618 : 0 : (any_div:SI (match_operand:SI 2 "register_operand")
10619 : : (match_operand:SI 3 "nonimmediate_operand"))))
10620 : 0 : (set (match_operand:SI 1 "register_operand")
10621 : 187 : (<paired_mod>:SI (match_dup 2) (match_dup 3)))
10622 : 0 : (clobber (reg:CC FLAGS_REG))]
10623 : 280 : "TARGET_64BIT
10624 : 280 : && TARGET_USE_8BIT_IDIV
10625 : 19 : && TARGET_QIMODE_MATH
10626 : 191 : && can_create_pseudo_p ()
10627 : 4 : && !optimize_insn_for_size_p ()"
10628 : 19 : [(const_int 0)]
10629 : 556 : "ix86_split_idivmod (SImode, operands, <u_bool>); DONE;")
10630 : 15 :
10631 : 0 : (define_split
10632 : 0 : [(set (match_operand:DI 1 "register_operand")
10633 : 0 : (zero_extend:DI
10634 : 0 : (<paired_mod>:SI (match_operand:SI 2 "register_operand")
10635 : 0 : (match_operand:SI 3 "nonimmediate_operand"))))
10636 : 0 : (set (match_operand:SI 0 "register_operand")
10637 : 0 : (any_div:SI (match_dup 2) (match_dup 3)))
10638 : 0 : (clobber (reg:CC FLAGS_REG))]
10639 : 88 : "TARGET_64BIT
10640 : 88 : && TARGET_USE_8BIT_IDIV
10641 : 21354 : && TARGET_QIMODE_MATH
10642 : 2 : && can_create_pseudo_p ()
10643 : 5 : && !optimize_insn_for_size_p ()"
10644 : 5 : [(const_int 0)]
10645 : 174 : "ix86_split_idivmod (SImode, operands, <u_bool>); DONE;")
10646 : 21352 :
10647 : : (define_insn_and_split "divmod<mode>4_1"
10648 : : [(set (match_operand:SWI48 0 "register_operand" "=a")
10649 : : (div:SWI48 (match_operand:SWI48 2 "register_operand" "0")
10650 : : (match_operand:SWI48 3 "nonimmediate_operand" "rm")))
10651 : 0 : (set (match_operand:SWI48 1 "register_operand" "=&d")
10652 : 0 : (mod:SWI48 (match_dup 2) (match_dup 3)))
10653 : 0 : (unspec [(const_int 0)] UNSPEC_DIV_ALREADY_SPLIT)
10654 : : (clobber (reg:CC FLAGS_REG))]
10655 : : ""
10656 : : "#"
10657 : 17 : "reload_completed"
10658 : : [(parallel [(set (match_dup 1)
10659 : 17 : (ashiftrt:SWI48 (match_dup 4) (match_dup 5)))
10660 : 1 : (clobber (reg:CC FLAGS_REG))])
10661 : 8 : (parallel [(set (match_dup 0)
10662 : 9 : (div:SWI48 (match_dup 2) (match_dup 3)))
10663 : 8 : (set (match_dup 1)
10664 : 8 : (mod:SWI48 (match_dup 2) (match_dup 3)))
10665 : 8 : (use (match_dup 1))
10666 : 8963 : (clobber (reg:CC FLAGS_REG))])]
10667 : 0 : {
10668 : 24 : operands[5] = GEN_INT (GET_MODE_BITSIZE (<MODE>mode)-1);
10669 : 0 :
10670 : 12 : if (optimize_function_for_size_p (cfun) || TARGET_USE_CLTD)
10671 : 12 : operands[4] = operands[2];
10672 : 0 : else
10673 : 0 : {
10674 : 0 : /* Avoid use of cltd in favor of a mov+shift. */
10675 : 0 : emit_move_insn (operands[1], operands[2]);
10676 : 0 : operands[4] = operands[1];
10677 : 0 : }
10678 : 0 : }
10679 : 0 : [(set_attr "type" "multi")
10680 : 0 : (set_attr "mode" "<MODE>")])
10681 : 14538 :
10682 : 0 : (define_insn_and_split "udivmod<mode>4_1"
10683 : 12 : [(set (match_operand:SWI48 0 "register_operand" "=a")
10684 : 12 : (udiv:SWI48 (match_operand:SWI48 2 "register_operand" "0")
10685 : 12 : (match_operand:SWI48 3 "nonimmediate_operand" "rm")))
10686 : 14526 : (set (match_operand:SWI48 1 "register_operand" "=&d")
10687 : 12 : (umod:SWI48 (match_dup 2) (match_dup 3)))
10688 : 12 : (unspec [(const_int 0)] UNSPEC_DIV_ALREADY_SPLIT)
10689 : 12 : (clobber (reg:CC FLAGS_REG))]
10690 : 12 : ""
10691 : 12 : "#"
10692 : 6 : "reload_completed"
10693 : 12 : [(set (match_dup 1) (const_int 0))
10694 : 6 : (parallel [(set (match_dup 0)
10695 : : (udiv:SWI48 (match_dup 2) (match_dup 3)))
10696 : 6 : (set (match_dup 1)
10697 : 6 : (umod:SWI48 (match_dup 2) (match_dup 3)))
10698 : : (use (match_dup 1))
10699 : 15740 : (clobber (reg:CC FLAGS_REG))])]
10700 : 12 : ""
10701 : 42283 : [(set_attr "type" "multi")
10702 : : (set_attr "mode" "<MODE>")])
10703 : 15740 :
10704 : 9 : (define_insn_and_split "divmodsi4_zext_1"
10705 : 9 : [(set (match_operand:DI 0 "register_operand" "=a")
10706 : 42283 : (zero_extend:DI
10707 : 9 : (div:SI (match_operand:SI 2 "register_operand" "0")
10708 : 9 : (match_operand:SI 3 "nonimmediate_operand" "rm"))))
10709 : 9 : (set (match_operand:SI 1 "register_operand" "=&d")
10710 : 9 : (mod:SI (match_dup 2) (match_dup 3)))
10711 : 9 : (unspec [(const_int 0)] UNSPEC_DIV_ALREADY_SPLIT)
10712 : : (clobber (reg:CC FLAGS_REG))]
10713 : 27 : "TARGET_64BIT"
10714 : 12 : "#"
10715 : 313 : "&& reload_completed"
10716 : 0 : [(parallel [(set (match_dup 1)
10717 : 2 : (ashiftrt:SI (match_dup 4) (match_dup 5)))
10718 : 4 : (clobber (reg:CC FLAGS_REG))])
10719 : 4 : (parallel [(set (match_dup 0)
10720 : 4 : (zero_extend:DI (div:SI (match_dup 2) (match_dup 3))))
10721 : 14 : (set (match_dup 1)
10722 : 8 : (mod:SI (match_dup 2) (match_dup 3)))
10723 : 27267 : (use (match_dup 1))
10724 : 18 : (clobber (reg:CC FLAGS_REG))])]
10725 : 8 : {
10726 : 13 : operands[5] = GEN_INT (GET_MODE_BITSIZE (SImode)-1);
10727 : 27274 :
10728 : 8 : if (optimize_function_for_size_p (cfun) || TARGET_USE_CLTD)
10729 : 2 : operands[4] = operands[2];
10730 : 10 : else
10731 : 0 : {
10732 : 4 : /* Avoid use of cltd in favor of a mov+shift. */
10733 : 0 : emit_move_insn (operands[1], operands[2]);
10734 : 3 : operands[4] = operands[1];
10735 : 41527 : }
10736 : 5 : }
10737 : 5 : [(set_attr "type" "multi")
10738 : 5 : (set_attr "mode" "SI")])
10739 : 41527 :
10740 : 7 : (define_insn_and_split "udivmodsi4_zext_1"
10741 : 3 : [(set (match_operand:DI 0 "register_operand" "=a")
10742 : 0 : (zero_extend:DI
10743 : 5 : (udiv:SI (match_operand:SI 2 "register_operand" "0")
10744 : 0 : (match_operand:SI 3 "nonimmediate_operand" "rm"))))
10745 : 2 : (set (match_operand:SI 1 "register_operand" "=&d")
10746 : 2 : (umod:SI (match_dup 2) (match_dup 3)))
10747 : 4628 : (unspec [(const_int 0)] UNSPEC_DIV_ALREADY_SPLIT)
10748 : 2 : (clobber (reg:CC FLAGS_REG))]
10749 : 6 : "TARGET_64BIT"
10750 : 2 : "#"
10751 : 4632 : "&& reload_completed"
10752 : 0 : [(set (match_dup 1) (const_int 0))
10753 : 2 : (parallel [(set (match_dup 0)
10754 : 150 : (zero_extend:DI (udiv:SI (match_dup 2) (match_dup 3))))
10755 : 14 : (set (match_dup 1)
10756 : 2 : (umod:SI (match_dup 2) (match_dup 3)))
10757 : 2 : (use (match_dup 1))
10758 : 2 : (clobber (reg:CC FLAGS_REG))])]
10759 : 93 : ""
10760 : : [(set_attr "type" "multi")
10761 : : (set_attr "mode" "SI")])
10762 : 2 :
10763 : 95 : (define_insn_and_split "divmodsi4_zext_2"
10764 : 93 : [(set (match_operand:DI 1 "register_operand" "=&d")
10765 : 95 : (zero_extend:DI
10766 : 95 : (mod:SI (match_operand:SI 2 "register_operand" "0")
10767 : 95 : (match_operand:SI 3 "nonimmediate_operand" "rm"))))
10768 : 95 : (set (match_operand:SI 0 "register_operand" "=a")
10769 : 93 : (div:SI (match_dup 2) (match_dup 3)))
10770 : 2 : (unspec [(const_int 0)] UNSPEC_DIV_ALREADY_SPLIT)
10771 : : (clobber (reg:CC FLAGS_REG))]
10772 : 6 : "TARGET_64BIT"
10773 : 2 : "#"
10774 : 4 : "&& reload_completed"
10775 : 0 : [(parallel [(set (match_dup 6)
10776 : 1 : (ashiftrt:SI (match_dup 4) (match_dup 5)))
10777 : 10 : (clobber (reg:CC FLAGS_REG))])
10778 : 2 : (parallel [(set (match_dup 1)
10779 : 2 : (zero_extend:DI (mod:SI (match_dup 2) (match_dup 3))))
10780 : 4 : (set (match_dup 0)
10781 : : (div:SI (match_dup 2) (match_dup 3)))
10782 : 2 : (use (match_dup 6))
10783 : 2 : (clobber (reg:CC FLAGS_REG))])]
10784 : 3 : {
10785 : 2 : operands[5] = GEN_INT (GET_MODE_BITSIZE (SImode)-1);
10786 : 3 : operands[6] = gen_lowpart (SImode, operands[1]);
10787 : 4 :
10788 : 1 : if (optimize_function_for_size_p (cfun) || TARGET_USE_CLTD)
10789 : 3 : operands[4] = operands[2];
10790 : : else
10791 : : {
10792 : : /* Avoid use of cltd in favor of a mov+shift. */
10793 : 0 : emit_move_insn (operands[6], operands[2]);
10794 : 0 : operands[4] = operands[6];
10795 : : }
10796 : 1 : }
10797 : 1 : [(set_attr "type" "multi")
10798 : 1 : (set_attr "mode" "SI")])
10799 : 2 :
10800 : 2 : (define_insn_and_split "udivmodsi4_zext_2"
10801 : 2 : [(set (match_operand:DI 1 "register_operand" "=&d")
10802 : 2 : (zero_extend:DI
10803 : 2 : (umod:SI (match_operand:SI 2 "register_operand" "0")
10804 : 1 : (match_operand:SI 3 "nonimmediate_operand" "rm"))))
10805 : 0 : (set (match_operand:SI 0 "register_operand" "=a")
10806 : 1 : (udiv:SI (match_dup 2) (match_dup 3)))
10807 : 1 : (unspec [(const_int 0)] UNSPEC_DIV_ALREADY_SPLIT)
10808 : 1 : (clobber (reg:CC FLAGS_REG))]
10809 : 3 : "TARGET_64BIT"
10810 : 1 : "#"
10811 : 3 : "&& reload_completed"
10812 : 1 : [(set (match_dup 4) (const_int 0))
10813 : 2 : (parallel [(set (match_dup 1)
10814 : 75 : (zero_extend:DI (umod:SI (match_dup 2) (match_dup 3))))
10815 : 0 : (set (match_dup 0)
10816 : : (udiv:SI (match_dup 2) (match_dup 3)))
10817 : : (use (match_dup 4))
10818 : : (clobber (reg:CC FLAGS_REG))])]
10819 : 71 : "operands[4] = gen_lowpart (SImode, operands[1]);"
10820 : 71 : [(set_attr "type" "multi")
10821 : : (set_attr "mode" "SI")])
10822 : 71 :
10823 : 1 : (define_insn_and_split "*divmod<mode>4"
10824 : 1 : [(set (match_operand:SWIM248 0 "register_operand" "=a")
10825 : 1 : (div:SWIM248 (match_operand:SWIM248 2 "register_operand" "0")
10826 : 1 : (match_operand:SWIM248 3 "nonimmediate_operand" "rm")))
10827 : 1 : (set (match_operand:SWIM248 1 "register_operand" "=&d")
10828 : 1 : (mod:SWIM248 (match_dup 2) (match_dup 3)))
10829 : 1 : (clobber (reg:CC FLAGS_REG))]
10830 : 1 : ""
10831 : 1 : "#"
10832 : 40193 : "reload_completed"
10833 : : [(parallel [(set (match_dup 1)
10834 : 16525 : (ashiftrt:SWIM248 (match_dup 4) (match_dup 5)))
10835 : 1 : (clobber (reg:CC FLAGS_REG))])
10836 : 23488216 : (parallel [(set (match_dup 0)
10837 : 38986 : (div:SWIM248 (match_dup 2) (match_dup 3)))
10838 : 23449229 : (set (match_dup 1)
10839 : 38986 : (mod:SWIM248 (match_dup 2) (match_dup 3)))
10840 : 23449229 : (use (match_dup 1))
10841 : 23449229 : (clobber (reg:CC FLAGS_REG))])]
10842 : 23485849 : {
10843 : 73238 : operands[5] = GEN_INT (GET_MODE_BITSIZE (<MODE>mode)-1);
10844 : 23449230 :
10845 : 23485849 : if (<MODE>mode != HImode
10846 : 23485243 : && (optimize_function_for_size_p (cfun) || TARGET_USE_CLTD))
10847 : 36014 : operands[4] = operands[2];
10848 : 12546774 : else
10849 : 12546774 : {
10850 : 12546774 : /* Avoid use of cltd in favor of a mov+shift. */
10851 : 605 : emit_move_insn (operands[1], operands[2]);
10852 : 12397626 : operands[4] = operands[1];
10853 : 12397625 : }
10854 : 12397625 : }
10855 : 12397625 : [(set_attr "type" "multi")
10856 : 605 : (set_attr "mode" "<MODE>")])
10857 : 36619 :
10858 : 37224 : (define_insn_and_split "*udivmod<mode>4"
10859 : 37224 : [(set (match_operand:SWIM248 0 "register_operand" "=a")
10860 : 37224 : (udiv:SWIM248 (match_operand:SWIM248 2 "register_operand" "0")
10861 : 37224 : (match_operand:SWIM248 3 "nonimmediate_operand" "rm")))
10862 : 37224 : (set (match_operand:SWIM248 1 "register_operand" "=&d")
10863 : 37224 : (umod:SWIM248 (match_dup 2) (match_dup 3)))
10864 : 37224 : (clobber (reg:CC FLAGS_REG))]
10865 : 605 : ""
10866 : 0 : "#"
10867 : 58077 : "reload_completed"
10868 : 36619 : [(set (match_dup 1) (const_int 0))
10869 : 43567 : (parallel [(set (match_dup 0)
10870 : : (udiv:SWIM248 (match_dup 2) (match_dup 3)))
10871 : 57113 : (set (match_dup 1)
10872 : 57113 : (umod:SWIM248 (match_dup 2) (match_dup 3)))
10873 : : (use (match_dup 1))
10874 : 57113 : (clobber (reg:CC FLAGS_REG))])]
10875 : : ""
10876 : 36619 : [(set_attr "type" "multi")
10877 : : (set_attr "mode" "<MODE>")])
10878 : 35684 :
10879 : 35684 : ;; Optimize division or modulo by constant power of 2, if the constant
10880 : 35684 : ;; materializes only after expansion.
10881 : 35684 : (define_insn_and_split "*udivmod<mode>4_pow2"
10882 : 35684 : [(set (match_operand:SWI48 0 "register_operand" "=r")
10883 : 35684 : (udiv:SWI48 (match_operand:SWI48 2 "register_operand" "0")
10884 : 35684 : (match_operand:SWI48 3 "const_int_operand")))
10885 : 35684 : (set (match_operand:SWI48 1 "register_operand" "=r")
10886 : 35684 : (umod:SWI48 (match_dup 2) (match_dup 3)))
10887 : : (clobber (reg:CC FLAGS_REG))]
10888 : 51195 : "IN_RANGE (exact_log2 (UINTVAL (operands[3])), 1, 31)"
10889 : 36619 : "#"
10890 : 36903 : "&& reload_completed"
10891 : 36619 : [(set (match_dup 1) (match_dup 2))
10892 : 1209 : (parallel [(set (match_dup 0) (lshiftrt:<MODE> (match_dup 2) (match_dup 4)))
10893 : 5963 : (clobber (reg:CC FLAGS_REG))])
10894 : 11913 : (parallel [(set (match_dup 1) (and:<MODE> (match_dup 1) (match_dup 5)))
10895 : 2134 : (clobber (reg:CC FLAGS_REG))])]
10896 : 7663 : {
10897 : 37456 : int v = exact_log2 (UINTVAL (operands[3]));
10898 : 1209 : operands[4] = GEN_INT (v);
10899 : 1209 : operands[5] = GEN_INT ((HOST_WIDE_INT_1U << v) - 1);
10900 : 36195 : }
10901 : 35684 : [(set_attr "type" "multi")
10902 : 36065 : (set_attr "mode" "<MODE>")])
10903 : 73469 :
10904 : 181 : (define_insn_and_split "*divmodsi4_zext_1"
10905 : 381 : [(set (match_operand:DI 0 "register_operand" "=a")
10906 : 36576 : (zero_extend:DI
10907 : 0 : (div:SI (match_operand:SI 2 "register_operand" "0")
10908 : 36382 : (match_operand:SI 3 "nonimmediate_operand" "rm"))))
10909 : 37222 : (set (match_operand:SI 1 "register_operand" "=&d")
10910 : 1577 : (mod:SI (match_dup 2) (match_dup 3)))
10911 : 37590 : (clobber (reg:CC FLAGS_REG))]
10912 : 36862 : "TARGET_64BIT"
10913 : 37222 : "#"
10914 : 36858 : "&& reload_completed"
10915 : 1213 : [(parallel [(set (match_dup 1)
10916 : 35511 : (ashiftrt:SI (match_dup 4) (match_dup 5)))
10917 : 1512 : (clobber (reg:CC FLAGS_REG))])
10918 : 35954 : (parallel [(set (match_dup 0)
10919 : 274 : (zero_extend:DI (div:SI (match_dup 2) (match_dup 3))))
10920 : 416 : (set (match_dup 1)
10921 : 264 : (mod:SI (match_dup 2) (match_dup 3)))
10922 : 264 : (use (match_dup 1))
10923 : 274 : (clobber (reg:CC FLAGS_REG))])]
10924 : 1669 : {
10925 : 464 : operands[5] = GEN_INT (GET_MODE_BITSIZE (SImode)-1);
10926 : 460 :
10927 : 276 : if (optimize_function_for_size_p (cfun) || TARGET_USE_CLTD)
10928 : 188 : operands[4] = operands[2];
10929 : 186 : else
10930 : 274 : {
10931 : 1669 : /* Avoid use of cltd in favor of a mov+shift. */
10932 : 1395 : emit_move_insn (operands[1], operands[2]);
10933 : 274 : operands[4] = operands[1];
10934 : 167 : }
10935 : 441 : }
10936 : 274 : [(set_attr "type" "multi")
10937 : : (set_attr "mode" "SI")])
10938 : 2 :
10939 : 1071 : (define_insn_and_split "*udivmodsi4_zext_1"
10940 : 2 : [(set (match_operand:DI 0 "register_operand" "=a")
10941 : 1071 : (zero_extend:DI
10942 : 1071 : (udiv:SI (match_operand:SI 2 "register_operand" "0")
10943 : 1071 : (match_operand:SI 3 "nonimmediate_operand" "rm"))))
10944 : 1071 : (set (match_operand:SI 1 "register_operand" "=&d")
10945 : 1071 : (umod:SI (match_dup 2) (match_dup 3)))
10946 : 1071 : (clobber (reg:CC FLAGS_REG))]
10947 : 1522 : "TARGET_64BIT"
10948 : 1069 : "#"
10949 : 272 : "&& reload_completed"
10950 : 1214 : [(set (match_dup 1) (const_int 0))
10951 : 136 : (parallel [(set (match_dup 0)
10952 : 1 : (zero_extend:DI (udiv:SI (match_dup 2) (match_dup 3))))
10953 : 2 : (set (match_dup 1)
10954 : 0 : (umod:SI (match_dup 2) (match_dup 3)))
10955 : : (use (match_dup 1))
10956 : : (clobber (reg:CC FLAGS_REG))])]
10957 : 2 : ""
10958 : : [(set_attr "type" "multi")
10959 : : (set_attr "mode" "SI")])
10960 : 136 :
10961 : 136 : (define_insn_and_split "*udivmodsi4_pow2_zext_1"
10962 : 136 : [(set (match_operand:DI 0 "register_operand" "=r")
10963 : 136 : (zero_extend:DI
10964 : 136 : (udiv:SI (match_operand:SI 2 "register_operand" "0")
10965 : 136 : (match_operand:SI 3 "const_int_operand"))))
10966 : 136 : (set (match_operand:SI 1 "register_operand" "=r")
10967 : 136 : (umod:SI (match_dup 2) (match_dup 3)))
10968 : 136 : (clobber (reg:CC FLAGS_REG))]
10969 : 1 : "TARGET_64BIT
10970 : 139 : && IN_RANGE (exact_log2 (UINTVAL (operands[3])), 1, 31)"
10971 : 2 : "#"
10972 : 2 : "&& reload_completed"
10973 : 2 : [(set (match_dup 1) (match_dup 2))
10974 : 0 : (parallel [(set (match_dup 0)
10975 : : (zero_extend:DI (lshiftrt:SI (match_dup 2) (match_dup 4))))
10976 : : (clobber (reg:CC FLAGS_REG))])
10977 : : (parallel [(set (match_dup 1) (and:SI (match_dup 1) (match_dup 5)))
10978 : 61 : (clobber (reg:CC FLAGS_REG))])]
10979 : 277 : {
10980 : 141 : int v = exact_log2 (UINTVAL (operands[3]));
10981 : 19 : operands[4] = GEN_INT (v);
10982 : 125 : operands[5] = GEN_INT ((HOST_WIDE_INT_1U << v) - 1);
10983 : 155 : }
10984 : 261 : [(set_attr "type" "multi")
10985 : 136 : (set_attr "mode" "SI")])
10986 : 223 :
10987 : 87 : (define_insn_and_split "*divmodsi4_zext_2"
10988 : 162 : [(set (match_operand:DI 1 "register_operand" "=&d")
10989 : 61 : (zero_extend:DI
10990 : 10 : (mod:SI (match_operand:SI 2 "register_operand" "0")
10991 : 33 : (match_operand:SI 3 "nonimmediate_operand" "rm"))))
10992 : 33 : (set (match_operand:SI 0 "register_operand" "=a")
10993 : 33 : (div:SI (match_dup 2) (match_dup 3)))
10994 : 0 : (clobber (reg:CC FLAGS_REG))]
10995 : 18 : "TARGET_64BIT"
10996 : 10 : "#"
10997 : 28 : "&& reload_completed"
10998 : 10 : [(parallel [(set (match_dup 6)
10999 : 9 : (ashiftrt:SI (match_dup 4) (match_dup 5)))
11000 : 10 : (clobber (reg:CC FLAGS_REG))])
11001 : 45 : (parallel [(set (match_dup 1)
11002 : 0 : (zero_extend:DI (mod:SI (match_dup 2) (match_dup 3))))
11003 : 69 : (set (match_dup 0)
11004 : 35 : (div:SI (match_dup 2) (match_dup 3)))
11005 : 35 : (use (match_dup 6))
11006 : 69 : (clobber (reg:CC FLAGS_REG))])]
11007 : 113 : {
11008 : 122 : operands[5] = GEN_INT (GET_MODE_BITSIZE (SImode)-1);
11009 : 113 : operands[6] = gen_lowpart (SImode, operands[1]);
11010 : 69 :
11011 : 44 : if (optimize_function_for_size_p (cfun) || TARGET_USE_CLTD)
11012 : 44 : operands[4] = operands[2];
11013 : 69 : else
11014 : 104 : {
11015 : 35 : /* Avoid use of cltd in favor of a mov+shift. */
11016 : 69 : emit_move_insn (operands[6], operands[2]);
11017 : 35 : operands[4] = operands[6];
11018 : 104 : }
11019 : 69 : }
11020 : : [(set_attr "type" "multi")
11021 : : (set_attr "mode" "SI")])
11022 : 9 :
11023 : 18 : (define_insn_and_split "*udivmodsi4_zext_2"
11024 : 9 : [(set (match_operand:DI 1 "register_operand" "=&d")
11025 : 18 : (zero_extend:DI
11026 : 18 : (umod:SI (match_operand:SI 2 "register_operand" "0")
11027 : 18 : (match_operand:SI 3 "nonimmediate_operand" "rm"))))
11028 : 18 : (set (match_operand:SI 0 "register_operand" "=a")
11029 : 18 : (udiv:SI (match_dup 2) (match_dup 3)))
11030 : 18 : (clobber (reg:CC FLAGS_REG))]
11031 : 121 : "TARGET_64BIT"
11032 : 18 : "#"
11033 : 77 : "&& reload_completed"
11034 : 35 : [(set (match_dup 4) (const_int 0))
11035 : 43 : (parallel [(set (match_dup 1)
11036 : 9 : (zero_extend:DI (umod:SI (match_dup 2) (match_dup 3))))
11037 : 0 : (set (match_dup 0)
11038 : 0 : (udiv:SI (match_dup 2) (match_dup 3)))
11039 : : (use (match_dup 4))
11040 : : (clobber (reg:CC FLAGS_REG))])]
11041 : 34 : "operands[4] = gen_lowpart (SImode, operands[1]);"
11042 : : [(set_attr "type" "multi")
11043 : 9 : (set_attr "mode" "SI")])
11044 : 34 :
11045 : 34 : (define_insn_and_split "*udivmodsi4_pow2_zext_2"
11046 : 34 : [(set (match_operand:DI 1 "register_operand" "=r")
11047 : 34 : (zero_extend:DI
11048 : 34 : (umod:SI (match_operand:SI 2 "register_operand" "0")
11049 : 34 : (match_operand:SI 3 "const_int_operand"))))
11050 : 34 : (set (match_operand:SI 0 "register_operand" "=r")
11051 : 34 : (udiv:SI (match_dup 2) (match_dup 3)))
11052 : 34 : (clobber (reg:CC FLAGS_REG))]
11053 : 34 : "TARGET_64BIT
11054 : 34 : && IN_RANGE (exact_log2 (UINTVAL (operands[3])), 1, 31)"
11055 : : "#"
11056 : 34 : "&& reload_completed"
11057 : 9 : [(set (match_dup 1) (match_dup 2))
11058 : 9 : (parallel [(set (match_dup 0) (lshiftrt:SI (match_dup 2) (match_dup 4)))
11059 : 9 : (clobber (reg:CC FLAGS_REG))])
11060 : : (parallel [(set (match_dup 1)
11061 : : (zero_extend:DI (and:SI (match_dup 1) (match_dup 5))))
11062 : 1 : (clobber (reg:CC FLAGS_REG))])]
11063 : 1 : {
11064 : 1 : int v = exact_log2 (UINTVAL (operands[3]));
11065 : 16627 : operands[4] = GEN_INT (v);
11066 : 4237 : operands[5] = GEN_INT ((HOST_WIDE_INT_1U << v) - 1);
11067 : 12424 : }
11068 : 12424 : [(set_attr "type" "multi")
11069 : 34552 : (set_attr "mode" "SI")])
11070 : 12168 :
11071 : 12190 : (define_insn "*<u>divmod<mode>4_noext"
11072 : 12246 : [(set (match_operand:SWIM248 0 "register_operand" "=a")
11073 : 12168 : (any_div:SWIM248
11074 : 12134 : (match_operand:SWIM248 2 "register_operand" "0")
11075 : 34 : (match_operand:SWIM248 3 "nonimmediate_operand" "rm")))
11076 : 12126 : (set (match_operand:SWIM248 1 "register_operand" "=d")
11077 : 12126 : (<paired_mod>:SWIM248 (match_dup 2) (match_dup 3)))
11078 : 12126 : (use (match_operand:SWIM248 4 "register_operand" "1"))
11079 : 24235 : (clobber (reg:CC FLAGS_REG))]
11080 : 0 : ""
11081 : 0 : "<sgnprefix>div{<imodesuffix>}\t%3"
11082 : 0 : [(set_attr "type" "idiv")
11083 : 0 : (set_attr "mode" "<MODE>")])
11084 : 0 :
11085 : 0 : (define_insn "*<u>divmodsi4_noext_zext_1"
11086 : 0 : [(set (match_operand:DI 0 "register_operand" "=a")
11087 : 0 : (zero_extend:DI
11088 : 0 : (any_div:SI (match_operand:SI 2 "register_operand" "0")
11089 : 0 : (match_operand:SI 3 "nonimmediate_operand" "rm"))))
11090 : : (set (match_operand:SI 1 "register_operand" "=d")
11091 : 0 : (<paired_mod>:SI (match_dup 2) (match_dup 3)))
11092 : : (use (match_operand:SI 4 "register_operand" "1"))
11093 : : (clobber (reg:CC FLAGS_REG))]
11094 : 142 : "TARGET_64BIT"
11095 : : "<sgnprefix>div{l}\t%3"
11096 : 0 : [(set_attr "type" "idiv")
11097 : 0 : (set_attr "mode" "SI")])
11098 : :
11099 : 2 : (define_insn "*<u>divmodsi4_noext_zext_2"
11100 : 4 : [(set (match_operand:DI 1 "register_operand" "=d")
11101 : 0 : (zero_extend:DI
11102 : 151 : (<paired_mod>:SI (match_operand:SI 2 "register_operand" "0")
11103 : 151 : (match_operand:SI 3 "nonimmediate_operand" "rm"))))
11104 : 151 : (set (match_operand:SI 0 "register_operand" "=a")
11105 : 151 : (any_div:SI (match_dup 2) (match_dup 3)))
11106 : 3 : (use (match_operand:SI 4 "register_operand" "1"))
11107 : 2352 : (clobber (reg:CC FLAGS_REG))]
11108 : 85 : "TARGET_64BIT"
11109 : 2352 : "<sgnprefix>div{l}\t%3"
11110 : 2206 : [(set_attr "type" "idiv")
11111 : 2206 : (set_attr "mode" "SI")])
11112 : 2352 :
11113 : 2352 : ;; Avoid sign-extension (using cdq) for constant numerators.
11114 : 2352 : (define_insn_and_split "*divmodsi4_const"
11115 : 2206 : [(set (match_operand:SI 0 "register_operand" "=&a")
11116 : 144 : (div:SI (match_operand:SI 2 "const_int_operand")
11117 : 2282 : (match_operand:SI 3 "nonimmediate_operand" "rm")))
11118 : 202 : (set (match_operand:SI 1 "register_operand" "=&d")
11119 : 134 : (mod:SI (match_dup 2) (match_dup 3)))
11120 : 69 : (clobber (reg:CC FLAGS_REG))]
11121 : 11106 : "!optimize_function_for_size_p (cfun)"
11122 : 6701 : "#"
11123 : 6932 : "&& reload_completed"
11124 : 2242 : [(set (match_dup 0) (match_dup 2))
11125 : 2206 : (set (match_dup 1) (match_dup 4))
11126 : 2146 : (parallel [(set (match_dup 0)
11127 : 2146 : (div:SI (match_dup 0) (match_dup 3)))
11128 : 2146 : (set (match_dup 1)
11129 : 4292 : (mod:SI (match_dup 0) (match_dup 3)))
11130 : 290767 : (use (match_dup 1))
11131 : 75942 : (clobber (reg:CC FLAGS_REG))])]
11132 : 76002 : {
11133 : 161639 : operands[4] = INTVAL (operands[2]) < 0 ? constm1_rtx : const0_rtx;
11134 : 0 : }
11135 : 161819 : [(set_attr "type" "multi")
11136 : 0 : (set_attr "mode" "SI")])
11137 : 59499 :
11138 : 4352 : (define_expand "divmodqi4"
11139 : 2206 : [(parallel [(set (match_operand:QI 0 "register_operand")
11140 : 22570 : (div:QI
11141 : 78148 : (match_operand:QI 1 "register_operand")
11142 : 78263 : (match_operand:QI 2 "nonimmediate_operand")))
11143 : 4467 : (set (match_operand:QI 3 "register_operand")
11144 : 4467 : (mod:QI (match_dup 1) (match_dup 2)))
11145 : 76002 : (clobber (reg:CC FLAGS_REG))])]
11146 : 2206 : "TARGET_QIMODE_MATH"
11147 : 76002 : {
11148 : 74025 : rtx div, mod;
11149 : 2206 : rtx tmp0, tmp1;
11150 : 73796 :
11151 : 2206 : tmp0 = gen_reg_rtx (HImode);
11152 : 71607 : tmp1 = gen_reg_rtx (HImode);
11153 : 71378 :
11154 : 71378 : /* Extend operands[1] to HImode. Generate 8bit divide. Result is in AX. */
11155 : 71607 : emit_insn (gen_extendqihi2 (tmp1, operands[1]));
11156 : 229 : emit_insn (gen_divmodhiqi3 (tmp0, tmp1, operands[2]));
11157 : 13903 :
11158 : 13903 : /* Extract remainder from AH. */
11159 : 229 : tmp1 = gen_rtx_ZERO_EXTRACT (HImode, tmp0, GEN_INT (8), GEN_INT (8));
11160 : 14132 : tmp1 = lowpart_subreg (QImode, tmp1, HImode);
11161 : 229 : rtx_insn *insn = emit_move_insn (operands[3], tmp1);
11162 : :
11163 : 229 : mod = gen_rtx_MOD (QImode, operands[1], operands[2]);
11164 : 2435 : set_unique_reg_note (insn, REG_EQUAL, mod);
11165 : 2206 :
11166 : 2206 : /* Extract quotient from AL. */
11167 : 229 : insn = emit_move_insn (operands[0], gen_lowpart (QImode, tmp0));
11168 : :
11169 : 229 : div = gen_rtx_DIV (QImode, operands[1], operands[2]);
11170 : 229 : set_unique_reg_note (insn, REG_EQUAL, div);
11171 : 229 :
11172 : 229 : DONE;
11173 : : })
11174 : :
11175 : : (define_expand "udivmodqi4"
11176 : 229 : [(parallel [(set (match_operand:QI 0 "register_operand")
11177 : 229 : (udiv:QI
11178 : 229 : (match_operand:QI 1 "register_operand")
11179 : 229 : (match_operand:QI 2 "nonimmediate_operand")))
11180 : 229 : (set (match_operand:QI 3 "register_operand")
11181 : 229 : (umod:QI (match_dup 1) (match_dup 2)))
11182 : 229 : (clobber (reg:CC FLAGS_REG))])]
11183 : 229 : "TARGET_QIMODE_MATH"
11184 : 326 : {
11185 : 326 : rtx div, mod;
11186 : 326 : rtx tmp0, tmp1;
11187 : :
11188 : 652 : tmp0 = gen_reg_rtx (HImode);
11189 : 326 : tmp1 = gen_reg_rtx (HImode);
11190 : :
11191 : : /* Extend operands[1] to HImode. Generate 8bit divide. Result is in AX. */
11192 : 326 : emit_insn (gen_zero_extendqihi2 (tmp1, operands[1]));
11193 : 326 : emit_insn (gen_udivmodhiqi3 (tmp0, tmp1, operands[2]));
11194 : :
11195 : : /* Extract remainder from AH. */
11196 : 326 : tmp1 = gen_rtx_ZERO_EXTRACT (HImode, tmp0, GEN_INT (8), GEN_INT (8));
11197 : 326 : tmp1 = lowpart_subreg (QImode, tmp1, HImode);
11198 : 326 : rtx_insn *insn = emit_move_insn (operands[3], tmp1);
11199 : :
11200 : 326 : mod = gen_rtx_UMOD (QImode, operands[1], operands[2]);
11201 : 326 : set_unique_reg_note (insn, REG_EQUAL, mod);
11202 : :
11203 : 326 : /* Extract quotient from AL. */
11204 : 326 : insn = emit_move_insn (operands[0], gen_lowpart (QImode, tmp0));
11205 : :
11206 : 326 : div = gen_rtx_UDIV (QImode, operands[1], operands[2]);
11207 : 326 : set_unique_reg_note (insn, REG_EQUAL, div);
11208 : 326 :
11209 : 652 : DONE;
11210 : 326 : })
11211 : 326 :
11212 : 326 : ;; Divide AX by r/m8, with result stored in
11213 : 326 : ;; AL <- Quotient
11214 : 326 : ;; AH <- Remainder
11215 : 326 : ;; Change div/mod to HImode and extend the second argument to HImode
11216 : : ;; so that mode of div/mod matches with mode of arguments. Otherwise
11217 : : ;; combine may fail.
11218 : : (define_insn "<u>divmodhiqi3"
11219 : : [(set (match_operand:HI 0 "register_operand" "=a")
11220 : : (ior:HI
11221 : : (ashift:HI
11222 : : (zero_extend:HI
11223 : : (truncate:QI
11224 : : (mod:HI (match_operand:HI 1 "register_operand" "0")
11225 : : (any_extend:HI
11226 : : (match_operand:QI 2 "nonimmediate_operand" "qm")))))
11227 : : (const_int 8))
11228 : : (zero_extend:HI
11229 : : (truncate:QI
11230 : : (div:HI (match_dup 1) (any_extend:HI (match_dup 2)))))))
11231 : : (clobber (reg:CC FLAGS_REG))]
11232 : 297 : "TARGET_QIMODE_MATH"
11233 : : "<sgnprefix>div{b}\t%2"
11234 : 155 : [(set_attr "type" "idiv")
11235 : 155 : (set_attr "mode" "QI")])
11236 : 757 :
11237 : 757 : ;; We cannot use div/idiv for double division, because it causes
11238 : 134 : ;; "division by zero" on the overflow and that's not what we expect
11239 : 757 : ;; from truncate. Because true (non truncating) double division is
11240 : 22318 : ;; never generated, we can't create this insn anyway.
11241 : 757 : ;
11242 : 134 : ;(define_insn ""
11243 : 159842 : ; [(set (match_operand:SI 0 "register_operand" "=a")
11244 : 22153 : ; (truncate:SI
11245 : 138549 : ; (udiv:DI (match_operand:DI 1 "register_operand" "A")
11246 : 134525 : ; (zero_extend:DI
11247 : 133979 : ; (match_operand:SI 2 "nonimmediate_operand" "rm")))))
11248 : 134299 : ; (set (match_operand:SI 3 "register_operand" "=d")
11249 : 271637 : ; (truncate:SI
11250 : 3679 : ; (umod:DI (match_dup 1) (zero_extend:DI (match_dup 2)))))
11251 : 139 : ; (clobber (reg:CC FLAGS_REG))]
11252 : 139 : ; ""
11253 : 133979 : ; "div{l}\t{%2, %0|%0, %2}"
11254 : 7 : ; [(set_attr "type" "idiv")])
11255 : 133979 :
11256 : 133979 : ;;- Logical AND instructions
11257 : 7 :
11258 : 122827 : ;; On Pentium, "test imm, reg" is pairable only with eax, ax, and al.
11259 : 122827 : ;; Note that this excludes ah.
11260 : :
11261 : : (define_expand "@test<mode>_ccno_1"
11262 : : [(set (reg:CCNO FLAGS_REG)
11263 : : (compare:CCNO
11264 : : (and:SWI48
11265 : : (match_operand:SWI48 0 "nonimmediate_operand")
11266 : : (match_operand:SWI48 1 "<nonmemory_szext_operand>"))
11267 : : (const_int 0)))])
11268 : 820 :
11269 : : (define_expand "testqi_ccz_1"
11270 : : [(set (reg:CCZ FLAGS_REG)
11271 : 820 : (compare:CCZ
11272 : : (and:QI
11273 : : (match_operand:QI 0 "nonimmediate_operand")
11274 : : (match_operand:QI 1 "nonmemory_operand"))
11275 : : (const_int 0)))])
11276 : :
11277 : : (define_insn "*testdi_1"
11278 : : [(set (reg FLAGS_REG)
11279 : : (compare
11280 : : (and:DI
11281 : : (match_operand:DI 0 "nonimmediate_operand" "%r,rm")
11282 : 317 : (match_operand:DI 1 "x86_64_szext_nonmemory_operand" "Z,re"))
11283 : : (const_int 0)))]
11284 : 70140 : "TARGET_64BIT
11285 : 67477 : && ix86_match_ccmode
11286 : 134320 : (insn,
11287 : : /* If we are going to emit testl instead of testq, and the operands[1]
11288 : : constant might have the SImode sign bit set, make sure the sign
11289 : : flag isn't tested, because the instruction will set the sign flag
11290 : : based on bit 31 rather than bit 63. If it isn't CONST_INT,
11291 : : conservatively assume it might have bit 31 set. */
11292 : 67160 : (satisfies_constraint_Z (operands[1])
11293 : 47293 : && (!CONST_INT_P (operands[1])
11294 : 47293 : || val_signbit_known_set_p (SImode, INTVAL (operands[1]))))
11295 : : ? CCZmode : CCNOmode)"
11296 : : "@
11297 : : test{l}\t{%k1, %k0|%k0, %k1}
11298 : : test{q}\t{%1, %0|%0, %1}"
11299 : 150545 : [(set_attr "type" "test")
11300 : 150545 : (set_attr "mode" "SI,DI")])
11301 : 150545 :
11302 : 142 : (define_insn "*testqi_1_maybe_si"
11303 : 137852 : [(set (reg FLAGS_REG)
11304 : 142 : (compare
11305 : 142 : (and:QI
11306 : 142 : (match_operand:QI 0 "nonimmediate_operand" "%qm,qm,r")
11307 : 142 : (match_operand:QI 1 "nonmemory_operand" "q,n,n"))
11308 : 142 : (const_int 0)))]
11309 : 137852 : "ix86_match_ccmode (insn,
11310 : 137994 : CONST_INT_P (operands[1])
11311 : 125191 : && INTVAL (operands[1]) >= 0 ? CCNOmode : CCZmode)"
11312 : 69985 : {
11313 : 69997 : if (get_attr_mode (insn) == MODE_SI)
11314 : : {
11315 : 102 : if (CONST_INT_P (operands[1]) && INTVAL (operands[1]) < 0)
11316 : 0 : operands[1] = GEN_INT (INTVAL (operands[1]) & 0xff);
11317 : 102 : return "test{l}\t{%1, %k0|%k0, %1}";
11318 : : }
11319 : : return "test{b}\t{%1, %0|%0, %1}";
11320 : : }
11321 : : [(set_attr "type" "test")
11322 : : (set (attr "mode")
11323 : : (cond [(eq_attr "alternative" "2")
11324 : : (const_string "SI")
11325 : : (and (match_test "optimize_insn_for_size_p ()")
11326 : : (and (match_operand 0 "ext_QIreg_operand")
11327 : : (match_operand 1 "const_0_to_127_operand")))
11328 : : (const_string "SI")
11329 : : ]
11330 : : (const_string "QI")))
11331 : : (set_attr "pent_pair" "uv,np,np")])
11332 : :
11333 : : (define_insn "*test<mode>_1"
11334 : : [(set (reg FLAGS_REG)
11335 : : (compare
11336 : : (and:SWI124
11337 : : (match_operand:SWI124 0 "nonimmediate_operand" "%<r>m,*a,<r>m")
11338 : : (match_operand:SWI124 1 "<nonmemory_szext_operand>" "<r>,<i>,<i>"))
11339 : : (const_int 0)))]
11340 : 160679 : "ix86_match_ccmode (insn, CCNOmode)"
11341 : : "test{<imodesuffix>}\t{%1, %0|%0, %1}"
11342 : : [(set_attr "type" "test")
11343 : : (set_attr "mode" "<MODE>")
11344 : 161585 : (set_attr "pent_pair" "uv,uv,np")])
11345 : 161585 :
11346 : 172060 : (define_expand "testqi_ext_1_ccno"
11347 : 322616 : [(set (reg:CCNO FLAGS_REG)
11348 : 92513 : (compare:CCNO
11349 : 98588 : (and:QI
11350 : 48457 : (subreg:QI
11351 : 12051 : (zero_extract:HI
11352 : 12051 : (match_operand:HI 0 "register_operand")
11353 : : (const_int 8)
11354 : 11931 : (const_int 8)) 0)
11355 : 11931 : (match_operand:QI 1 "const_int_operand"))
11356 : 11931 : (const_int 0)))])
11357 : 11931 :
11358 : 11931 : (define_insn "*testqi_ext<mode>_1"
11359 : : [(set (reg FLAGS_REG)
11360 : 11898 : (compare
11361 : 11898 : (and:QI
11362 : 11874 : (subreg:QI
11363 : : (match_operator:SWI248 2 "extract_operator"
11364 : 11874 : [(match_operand 0 "int248_register_operand" "Q")
11365 : 11874 : (const_int 8)
11366 : 11874 : (const_int 8)]) 0)
11367 : : (match_operand:QI 1 "general_operand" "QnBn"))
11368 : 11606 : (const_int 0)))]
11369 : 23212 : "ix86_match_ccmode (insn, CCNOmode)"
11370 : : "test{b}\t{%1, %h0|%h0, %1}"
11371 : 11606 : [(set_attr "addr" "gpr8")
11372 : : (set_attr "type" "test")
11373 : 11606 : (set_attr "mode" "QI")])
11374 : 11606 :
11375 : 23212 : (define_insn "*testqi_ext<mode>_2"
11376 : : [(set (reg FLAGS_REG)
11377 : : (compare
11378 : : (and:QI
11379 : : (subreg:QI
11380 : : (match_operator:SWI248 2 "extract_operator"
11381 : : [(match_operand 0 "int248_register_operand" "Q")
11382 : : (const_int 8)
11383 : : (const_int 8)]) 0)
11384 : : (subreg:QI
11385 : : (match_operator:SWI248 3 "extract_operator"
11386 : : [(match_operand 1 "int248_register_operand" "Q")
11387 : : (const_int 8)
11388 : : (const_int 8)]) 0))
11389 : : (const_int 0)))]
11390 : 0 : "ix86_match_ccmode (insn, CCNOmode)"
11391 : 0 : "test{b}\t{%h1, %h0|%h0, %h1}"
11392 : : [(set_attr "type" "test")
11393 : : (set_attr "mode" "QI")])
11394 : 0 :
11395 : 0 : ;; Provide a *testti instruction that STV can implement using ptest.
11396 : 0 : ;; This pattern splits into *andti3_doubleword and *cmpti_doubleword.
11397 : 0 : (define_insn_and_split "*testti_doubleword"
11398 : : [(set (reg:CCZ FLAGS_REG)
11399 : : (compare:CCZ
11400 : : (and:TI (match_operand:TI 0 "register_operand")
11401 : : (match_operand:TI 1 "general_operand"))
11402 : : (const_int 0)))]
11403 : 342 : "TARGET_64BIT
11404 : 342 : && ix86_pre_reload_split ()"
11405 : 0 : "#"
11406 : : "&& 1"
11407 : 142 : [(parallel [(set (match_dup 2) (and:TI (match_dup 0) (match_dup 1)))
11408 : 11014 : (clobber (reg:CC FLAGS_REG))])
11409 : 11014 : (set (reg:CCZ FLAGS_REG) (compare:CCZ (match_dup 2) (const_int 0)))]
11410 : 431849 : {
11411 : 431849 : operands[2] = gen_reg_rtx (TImode);
11412 : 333 : if (!x86_64_hilo_general_operand (operands[1], TImode))
11413 : 431718 : operands[1] = force_reg (TImode, operands[1]);
11414 : 431707 : })
11415 : :
11416 : 431707 : ;; Combine likes to form bit extractions for some tests. Humor it.
11417 : 431849 : (define_insn_and_split "*testqi_ext_3"
11418 : 431849 : [(set (match_operand 0 "flags_reg_operand")
11419 : 142 : (match_operator 1 "compare_operator"
11420 : 387746 : [(zero_extract:SWI248
11421 : 387746 : (match_operand 2 "int_nonimmediate_operand" "rm")
11422 : 142 : (match_operand:QI 3 "const_int_operand")
11423 : 142 : (match_operand:QI 4 "const_int_operand"))
11424 : : (const_int 0)]))]
11425 : : "/* Ensure that resulting mask is zero or sign extended operand. */
11426 : 225961 : INTVAL (operands[4]) >= 0
11427 : 225961 : && ((INTVAL (operands[3]) > 0
11428 : 225961 : && INTVAL (operands[3]) + INTVAL (operands[4]) <= 32)
11429 : 7264 : || (<MODE>mode == DImode
11430 : 142 : && INTVAL (operands[3]) > 32
11431 : 797 : && INTVAL (operands[3]) + INTVAL (operands[4]) == 64))
11432 : 242931 : && ix86_match_ccmode (insn,
11433 : : /* If zero_extract mode precision is the same
11434 : : as len, the SF of the zero_extract
11435 : 142 : comparison will be the most significant
11436 : 142 : extracted bit, but this could be matched
11437 : 142 : after splitting only for pos 0 len all bits
11438 : : trivial extractions. Require CCZmode. */
11439 : 218697 : (GET_MODE_PRECISION (<MODE>mode)
11440 : : == INTVAL (operands[3]))
11441 : : /* Otherwise, require CCZmode if we'd use a mask
11442 : : with the most significant bit set and can't
11443 : 16279 : widen it to wider mode. *testdi_1 also
11444 : : requires CCZmode if the mask has bit
11445 : 16279 : 31 set and all bits above it clear. */
11446 : 234976 : || (INTVAL (operands[3]) + INTVAL (operands[4])
11447 : 16279 : >= 32)
11448 : 16279 : /* We can't widen also if val is not a REG. */
11449 : 234942 : || (INTVAL (operands[3]) + INTVAL (operands[4])
11450 : 218663 : == GET_MODE_PRECISION (GET_MODE (operands[2]))
11451 : 16683 : && !register_operand (operands[2],
11452 : : GET_MODE (operands[2])))
11453 : : /* And we shouldn't widen if
11454 : : TARGET_PARTIAL_REG_STALL. */
11455 : 218369 : || (TARGET_PARTIAL_REG_STALL
11456 : 0 : && (INTVAL (operands[3]) + INTVAL (operands[4])
11457 : 0 : >= (paradoxical_subreg_p (operands[2])
11458 : 0 : && (GET_MODE_CLASS
11459 : : (GET_MODE (SUBREG_REG (operands[2])))
11460 : : == MODE_INT)
11461 : 0 : ? GET_MODE_PRECISION
11462 : 6440 : (GET_MODE (SUBREG_REG (operands[2])))
11463 : 0 : : GET_MODE_PRECISION
11464 : : (GET_MODE (operands[2])))))
11465 : 68928 : ? CCZmode : CCNOmode)"
11466 : : "#"
11467 : : "&& 1"
11468 : 94366 : [(set (match_dup 0) (match_op_dup 1 [(match_dup 2) (const_int 0)]))]
11469 : 197127 : {
11470 : 197127 : rtx val = operands[2];
11471 : 177053 : HOST_WIDE_INT len = INTVAL (operands[3]);
11472 : 177053 : HOST_WIDE_INT pos = INTVAL (operands[4]);
11473 : 94366 : machine_mode mode = GET_MODE (val);
11474 : 36877 :
11475 : 94366 : if (SUBREG_P (val))
11476 : 35651 : {
11477 : 42732 : machine_mode submode = GET_MODE (SUBREG_REG (val));
11478 : 7138 :
11479 : 42789 : /* Narrow paradoxical subregs to prevent partial register stalls. */
11480 : 42675 : if (GET_MODE_BITSIZE (mode) > GET_MODE_BITSIZE (submode)
11481 : 14200 : && GET_MODE_CLASS (submode) == MODE_INT
11482 : 21281 : && (GET_MODE (operands[0]) == CCZmode
11483 : 7138 : || pos + len < GET_MODE_PRECISION (submode)
11484 : 7138 : || REG_P (SUBREG_REG (val))))
11485 : 0 : {
11486 : : val = SUBREG_REG (val);
11487 : 0 : mode = submode;
11488 : 0 : }
11489 : : }
11490 : :
11491 : : /* Small HImode tests can be converted to QImode. */
11492 : 94366 : if (pos + len <= 8
11493 : 94366 : && register_operand (val, HImode))
11494 : : {
11495 : 2030 : rtx nval = gen_lowpart (QImode, val);
11496 : 2030 : if (!MEM_P (nval)
11497 : 0 : || GET_MODE (operands[0]) == CCZmode
11498 : 0 : || pos + len < 8)
11499 : : {
11500 : 94366 : val = nval;
11501 : 94366 : mode = QImode;
11502 : : }
11503 : : }
11504 : :
11505 : 94366 : gcc_assert (pos + len <= GET_MODE_PRECISION (mode));
11506 : :
11507 : : /* If the mask is going to have the sign bit set in the mode
11508 : : we want to do the comparison in and user isn't interested just
11509 : : in the zero flag, then we must widen the target mode. */
11510 : 94366 : if (pos + len == GET_MODE_PRECISION (mode)
11511 : 94366 : && GET_MODE (operands[0]) != CCZmode)
11512 : : {
11513 : 0 : gcc_assert (pos + len < 32 && !MEM_P (val));
11514 : 0 : mode = SImode;
11515 : 0 : val = gen_lowpart (mode, val);
11516 : : }
11517 : :
11518 : 94366 : wide_int mask
11519 : 94366 : = wi::shifted_mask (pos, len, false, GET_MODE_PRECISION (mode));
11520 : :
11521 : 94366 : operands[2] = gen_rtx_AND (mode, val, immed_wide_int_const (mask, mode));
11522 : 94366 : })
11523 : :
11524 : : ;; Split and;cmp (as optimized by combine) into not;test
11525 : 94366 : ;; Except when TARGET_BMI provides andn (*andn_<mode>_ccno).
11526 : 94366 : (define_insn_and_split "*test<mode>_not"
11527 : 94366 : [(set (reg:CCZ FLAGS_REG)
11528 : 94366 : (compare:CCZ
11529 : 94366 : (and:SWI
11530 : 94366 : (not:SWI (match_operand:SWI 0 "register_operand"))
11531 : 94366 : (match_operand:SWI 1 "<nonmemory_szext_operand>"))
11532 : : (const_int 0)))]
11533 : 3526 : "ix86_pre_reload_split ()
11534 : 3560 : && (!TARGET_BMI || !REG_P (operands[1]))"
11535 : 94366 : "#"
11536 : 94366 : "&& 1"
11537 : 95504 : [(set (match_dup 2) (not:SWI (match_dup 0)))
11538 : 5425 : (set (reg:CCZ FLAGS_REG)
11539 : 8893 : (compare:CCZ (and:SWI (match_dup 2) (match_dup 1))
11540 : 2935 : (const_int 0)))]
11541 : 18583 : "operands[2] = gen_reg_rtx (<MODE>mode);")
11542 : 1155 :
11543 : 80644 : ;; Split and;cmp (as optimized by combine) into andn;cmp $0
11544 : 6483 : (define_insn_and_split "*test<mode>_not_doubleword"
11545 : 84755 : [(set (reg:CCZ FLAGS_REG)
11546 : 84755 : (compare:CCZ
11547 : 84755 : (and:DWI
11548 : 84755 : (not:DWI (match_operand:DWI 0 "nonimmediate_operand"))
11549 : 78272 : (match_operand:DWI 1 "nonimmediate_operand"))
11550 : 6487 : (const_int 0)))]
11551 : 78881 : "ix86_pre_reload_split ()"
11552 : : "#"
11553 : 6483 : "&& 1"
11554 : 64 : [(parallel
11555 : 35 : [(set (match_dup 2) (and:DWI (not:DWI (match_dup 0)) (match_dup 1)))
11556 : : (clobber (reg:CC FLAGS_REG))])
11557 : 19 : (set (reg:CCZ FLAGS_REG) (compare:CCZ (match_dup 2) (const_int 0)))]
11558 : 54 : {
11559 : 35 : operands[0] = force_reg (<MODE>mode, operands[0]);
11560 : 6518 : operands[2] = gen_reg_rtx (<MODE>mode);
11561 : 6483 : })
11562 : 6483 :
11563 : : ;; Convert HImode/SImode test instructions with immediate to QImode ones.
11564 : 35 : ;; i386 does not allow to encode test with 8bit sign extended immediate, so
11565 : 131278 : ;; this is relatively important trick.
11566 : 131278 : ;; Do the conversion only post-reload to avoid limiting of the register class
11567 : 131278 : ;; to QI regs.
11568 : 6349 : (define_split
11569 : 131278 : [(set (match_operand 0 "flags_reg_operand")
11570 : 131278 : (match_operator 1 "compare_operator"
11571 : 6314 : [(and (match_operand 2 "QIreg_operand")
11572 : 22593 : (match_operand 3 "const_int_operand"))
11573 : 22593 : (const_int 0)]))]
11574 : 148080 : "reload_completed
11575 : 141766 : && GET_MODE (operands[2]) != QImode
11576 : 71840 : && ((ix86_match_ccmode (insn, CCZmode)
11577 : 65454 : && !(INTVAL (operands[3]) & ~(255 << 8)))
11578 : 54364 : || (ix86_match_ccmode (insn, CCNOmode)
11579 : 54329 : && !(INTVAL (operands[3]) & ~(127 << 8))))"
11580 : 11197 : [(set (match_dup 0)
11581 : 376407 : (match_op_dup 1
11582 : 464536 : [(and:QI
11583 : 35 : (subreg:QI
11584 : 35 : (zero_extract:HI (match_dup 2)
11585 : 35 : (const_int 8)
11586 : : (const_int 8)) 0)
11587 : : (match_dup 3))
11588 : : (const_int 0)]))]
11589 : 11197 : {
11590 : 11197 : operands[2] = gen_lowpart (HImode, operands[2]);
11591 : 11216 : operands[3] = gen_int_mode (INTVAL (operands[3]) >> 8, QImode);
11592 : : })
11593 : 11216 :
11594 : 11216 : (define_split
11595 : 22413 : [(set (match_operand 0 "flags_reg_operand")
11596 : 22413 : (match_operator 1 "compare_operator"
11597 : 19 : [(and (match_operand 2 "nonimmediate_operand")
11598 : 11197 : (match_operand 3 "const_int_operand"))
11599 : 19 : (const_int 0)]))]
11600 : 364068 : "reload_completed
11601 : 248656 : && GET_MODE (operands[2]) != QImode
11602 : 101489 : && (!REG_P (operands[2]) || ANY_QI_REG_P (operands[2]))
11603 : 99326 : && ((ix86_match_ccmode (insn, CCZmode)
11604 : 88057 : && !(INTVAL (operands[3]) & ~255))
11605 : 34043 : || (ix86_match_ccmode (insn, CCNOmode)
11606 : 34043 : && !(INTVAL (operands[3]) & ~127)))"
11607 : 322321 : [(set (match_dup 0)
11608 : 54086 : (match_op_dup 1 [(and:QI (match_dup 2) (match_dup 3))
11609 : : (const_int 0)]))]
11610 : 61140 : {
11611 : 61140 : operands[2] = gen_lowpart (QImode, operands[2]);
11612 : 61140 : operands[3] = gen_int_mode (INTVAL (operands[3]), QImode);
11613 : 14108 : })
11614 : 11197 :
11615 : 18251 : ;; Narrow test instructions with immediate operands that test
11616 : 65283 : ;; memory locations for zero. E.g. testl $0x00aa0000, mem can be
11617 : 54271 : ;; converted to testb $0xaa, mem+2. Reject volatile locations and
11618 : 54271 : ;; targets where reading (possibly unaligned) part of memory
11619 : 54086 : ;; location after a large write to the same address causes
11620 : 54086 : ;; store-to-load forwarding stall.
11621 : 54086 : (define_peephole2
11622 : 108172 : [(set (reg:CCZ FLAGS_REG)
11623 : 54086 : (compare:CCZ
11624 : 54086 : (and:SWI248 (match_operand:SWI248 0 "memory_operand")
11625 : 54086 : (match_operand 1 "const_int_operand"))
11626 : 54086 : (const_int 0)))]
11627 : 55676 : "!TARGET_PARTIAL_MEMORY_READ_STALL && !MEM_VOLATILE_P (operands[0])"
11628 : 54086 : [(set (reg:CCZ FLAGS_REG)
11629 : 55657 : (compare:CCZ (match_dup 2) (const_int 0)))]
11630 : 55661 : {
11631 : 108172 : unsigned HOST_WIDE_INT ival = UINTVAL (operands[1]);
11632 : 75817 : int first_nonzero_byte, bitsize;
11633 : 21731 : rtx new_addr, new_const;
11634 : 22268 : machine_mode new_mode;
11635 : :
11636 : 1590 : if (ival == 0)
11637 : 872 : FAIL;
11638 : 1053 :
11639 : : /* Clear bits outside mode width. */
11640 : 2643 : ival &= GET_MODE_MASK (<MODE>mode);
11641 : 1053 :
11642 : 2643 : first_nonzero_byte = ctz_hwi (ival) / BITS_PER_UNIT;
11643 : 1053 :
11644 : 1053 : ival >>= first_nonzero_byte * BITS_PER_UNIT;
11645 : 0 :
11646 : 1053 : bitsize = sizeof (ival) * BITS_PER_UNIT - clz_hwi (ival);
11647 : :
11648 : 3180 : if (bitsize <= GET_MODE_BITSIZE (QImode))
11649 : : new_mode = QImode;
11650 : 2292 : else if (bitsize <= GET_MODE_BITSIZE (HImode))
11651 : : new_mode = HImode;
11652 : 128 : else if (bitsize <= GET_MODE_BITSIZE (SImode))
11653 : : new_mode = SImode;
11654 : : else
11655 : 7 : new_mode = DImode;
11656 : :
11657 : 3180 : if (GET_MODE_SIZE (new_mode) >= GET_MODE_SIZE (<MODE>mode))
11658 : 872 : FAIL;
11659 : :
11660 : 718 : new_addr = adjust_address (operands[0], new_mode, first_nonzero_byte);
11661 : 718 : new_const = gen_int_mode (ival, new_mode);
11662 : :
11663 : 718 : operands[2] = gen_rtx_AND (new_mode, new_addr, new_const);
11664 : : })
11665 : :
11666 : : ;; %%% This used to optimize known byte-wide and operations to memory,
11667 : 718 : ;; and sometimes to QImode registers. If this is considered useful,
11668 : 718 : ;; it should be done with splitters.
11669 : 718 :
11670 : 718 : (define_expand "and<mode>3"
11671 : 718 : [(set (match_operand:SDWIM 0 "nonimmediate_operand")
11672 : 718 : (and:SDWIM (match_operand:SDWIM 1 "nonimmediate_operand")
11673 : 718 : (match_operand:SDWIM 2 "<general_szext_operand>")))]
11674 : : ""
11675 : 770181 : {
11676 : 770181 : machine_mode mode = <MODE>mode;
11677 : :
11678 : 770181 : if (GET_MODE_SIZE (<MODE>mode) > UNITS_PER_WORD
11679 : 770181 : && !x86_64_hilo_general_operand (operands[2], <MODE>mode))
11680 : 718 : operands[2] = force_reg (<MODE>mode, operands[2]);
11681 : :
11682 : 770181 : if (GET_MODE_SIZE (<MODE>mode) <= UNITS_PER_WORD
11683 : 745054 : && const_int_operand (operands[2], <MODE>mode)
11684 : 605294 : && register_operand (operands[0], <MODE>mode)
11685 : 1370580 : && !(TARGET_ZERO_EXTEND_WITH_AND
11686 : 537 : && optimize_function_for_speed_p (cfun)))
11687 : : {
11688 : 600936 : unsigned HOST_WIDE_INT ival = UINTVAL (operands[2]);
11689 : 187668 :
11690 : 787530 : if (ival == GET_MODE_MASK (SImode))
11691 : 187668 : mode = SImode;
11692 : 583269 : else if (ival == GET_MODE_MASK (HImode))
11693 : 0 : mode = HImode;
11694 : 411919 : else if (ival == GET_MODE_MASK (QImode))
11695 : 187131 : mode = QImode;
11696 : : }
11697 : :
11698 : : if (mode != <MODE>mode)
11699 : 29442 : emit_insn (gen_extend_insn
11700 : 29442 : (operands[0], gen_lowpart (mode, operands[1]),
11701 : : <MODE>mode, mode, 1));
11702 : : else
11703 : 740739 : ix86_expand_binary_operator (AND, <MODE>mode, operands, TARGET_APX_NDD);
11704 : :
11705 : 770181 : DONE;
11706 : : })
11707 : :
11708 : : (define_insn_and_split "*and<dwi>3_doubleword"
11709 : : [(set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,r,&r,&r,&r,&r,&r")
11710 : : (and:<DWI>
11711 : : (match_operand:<DWI> 1 "nonimmediate_operand" "%0,0,ro,r,ro,jO,r")
11712 : : (match_operand:<DWI> 2 "x86_64_hilo_general_operand" "r<di>,o,r,<di>,K,<di>,o")))
11713 : : (clobber (reg:CC FLAGS_REG))]
11714 : 2273587 : "ix86_binary_operator_ok (AND, <DWI>mode, operands, TARGET_APX_NDD)"
11715 : : "#"
11716 : 30298 : "&& reload_completed"
11717 : 15140 : [(const_int:DWIH 0)]
11718 : 519430 : {
11719 : 519430 : bool emit_insn_deleted_note_p = false;
11720 : 79946 :
11721 : 95086 : split_double_mode (<DWI>mode, &operands[0], 3, &operands[0], &operands[3]);
11722 : 79946 :
11723 : 15140 : if (operands[2] == const0_rtx)
11724 : 1889 : emit_move_insn (operands[0], const0_rtx);
11725 : 13251 : else if (operands[2] == constm1_rtx)
11726 : : {
11727 : 586515 : if (!rtx_equal_p (operands[0], operands[1]))
11728 : 4 : emit_move_insn (operands[0], operands[1]);
11729 : : else
11730 : 7476 : emit_insn_deleted_note_p = true;
11731 : 7476 : }
11732 : 583050 : else
11733 : 17262 : ix86_expand_binary_operator (AND, <MODE>mode, &operands[0], TARGET_APX_NDD);
11734 : 583050 :
11735 : 15140 : if (operands[5] == const0_rtx)
11736 : 5573 : emit_move_insn (operands[3], const0_rtx);
11737 : 592617 : else if (operands[5] == constm1_rtx)
11738 : : {
11739 : 600 : if (!rtx_equal_p (operands[3], operands[4]))
11740 : 0 : emit_move_insn (operands[3], operands[4]);
11741 : 600 : else if (emit_insn_deleted_note_p)
11742 : 0 : emit_note (NOTE_INSN_DELETED);
11743 : : }
11744 : : else
11745 : 8967 : ix86_expand_binary_operator (AND, <MODE>mode, &operands[3], TARGET_APX_NDD);
11746 : :
11747 : 15140 : DONE;
11748 : : }
11749 : : [(set_attr "isa" "*,*,apx_ndd,apx_ndd,apx_ndd,apx_ndd_64,apx_ndd")])
11750 : :
11751 : : (define_insn "*anddi_1"
11752 : : [(set (match_operand:DI 0 "nonimmediate_operand" "=r,r,rm,r,r,r,r,r,?k")
11753 : : (and:DI
11754 : : (match_operand:DI 1 "nonimmediate_operand" "%0,r,0,0,rm,rjM,r,qm,k")
11755 : : (match_operand:DI 2 "x86_64_szext_general_operand" "Z,Z,re,m,r,e,m,L,k")))
11756 : : (clobber (reg:CC FLAGS_REG))]
11757 : 565833 : "TARGET_64BIT
11758 : 564907 : && ix86_binary_operator_ok (AND, DImode, operands, TARGET_APX_NDD)"
11759 : : "@
11760 : 119116 : and{l}\t{%k2, %k0|%k0, %k2}
11761 : 298625 : and{l}\t{%k2, %k1, %k0|%k0, %k1, %k2}
11762 : 8263 : and{q}\t{%2, %0|%0, %2}
11763 : 170653 : and{q}\t{%2, %0|%0, %2}
11764 : 162989 : and{q}\t{%2, %1, %0|%0, %1, %2}
11765 : 7664 : and{q}\t{%2, %1, %0|%0, %1, %2}
11766 : 599 : and{q}\t{%2, %1, %0|%0, %1, %2}
11767 : 599 : #
11768 : 0 : #"
11769 : 599 : [(set_attr "isa" "x64,apx_ndd,x64,x64,apx_ndd,apx_ndd,apx_ndd,x64,avx512bw")
11770 : : (set_attr "type" "alu,alu,alu,alu,alu,alu,alu,imovx,msklog")
11771 : : (set_attr "length_immediate" "*,*,*,*,*,*,*,0,*")
11772 : : (set (attr "prefix_rex")
11773 : : (if_then_else
11774 : : (and (eq_attr "type" "imovx")
11775 : : (and (match_test "INTVAL (operands[2]) == 0xff")
11776 : : (match_operand 1 "ext_QIreg_operand")))
11777 : : (const_string "1")
11778 : : (const_string "*")))
11779 : : (set_attr "mode" "SI,SI,DI,DI,DI,DI,DI,SI,DI")])
11780 : :
11781 : : (define_insn_and_split "*anddi_1_btr"
11782 : : [(set (match_operand:DI 0 "nonimmediate_operand" "=rm")
11783 : : (and:DI
11784 : : (match_operand:DI 1 "nonimmediate_operand" "%0")
11785 : : (match_operand:DI 2 "const_int_operand" "n")))
11786 : : (clobber (reg:CC FLAGS_REG))]
11787 : 552010 : "TARGET_64BIT && TARGET_USE_BT
11788 : 544325 : && ix86_binary_operator_ok (AND, DImode, operands)
11789 : 510665 : && IN_RANGE (exact_log2 (~INTVAL (operands[2])), 31, 63)"
11790 : : "#"
11791 : 1187 : "&& reload_completed"
11792 : 2656 : [(parallel [(set (zero_extract:DI (match_dup 0)
11793 : : (const_int 1)
11794 : 18556 : (match_dup 3))
11795 : 18556 : (const_int 0))
11796 : 32739 : (clobber (reg:CC FLAGS_REG))])]
11797 : 296244 : "operands[3] = GEN_INT (exact_log2 (~INTVAL (operands[2])));"
11798 : 30700 : [(set_attr "type" "alu1")
11799 : : (set_attr "prefix_0f" "1")
11800 : 599 : (set_attr "znver1_decode" "double")
11801 : 599 : (set_attr "mode" "DI")])
11802 : 599 :
11803 : 599 : ;; Turn *anddi_1 into *andsi_1_zext if possible.
11804 : 599 : (define_split
11805 : 599 : [(set (match_operand:DI 0 "register_operand")
11806 : 599 : (and:DI (subreg:DI (match_operand:SI 1 "register_operand") 0)
11807 : 599 : (match_operand:DI 2 "x86_64_zext_immediate_operand")))
11808 : 599 : (clobber (reg:CC FLAGS_REG))]
11809 : 3526 : "TARGET_64BIT"
11810 : : [(parallel [(set (match_dup 0)
11811 : 3526 : (zero_extend:DI (and:SI (match_dup 1) (match_dup 2))))
11812 : : (clobber (reg:CC FLAGS_REG))])]
11813 : 3871 : {
11814 : 3871 : if (GET_CODE (operands[2]) == SYMBOL_REF
11815 : 3871 : || GET_CODE (operands[2]) == LABEL_REF)
11816 : 944 : {
11817 : 945 : operands[2] = shallow_copy_rtx (operands[2]);
11818 : 1 : PUT_MODE (operands[2], SImode);
11819 : 102 : }
11820 : 3627 : else if (GET_CODE (operands[2]) == CONST)
11821 : 84 : {
11822 : 84 : /* (const:DI (plus:DI (symbol_ref:DI ("...")) (const_int N))) */
11823 : 1 : operands[2] = copy_rtx (operands[2]);
11824 : 85 : PUT_MODE (operands[2], SImode);
11825 : 85 : PUT_MODE (XEXP (operands[2], 0), SImode);
11826 : 1 : PUT_MODE (XEXP (XEXP (operands[2], 0), 0), SImode);
11827 : 3601 : }
11828 : 3601 : else
11829 : 3524 : operands[2] = gen_lowpart (SImode, operands[2]);
11830 : 3531 : })
11831 : 5 :
11832 : 3526 : ;; See comment for addsi_1_zext why we do use nonimmediate_operand
11833 : 3526 : (define_insn "*andsi_1_zext"
11834 : 3526 : [(set (match_operand:DI 0 "register_operand" "=r,r,r,r")
11835 : 3526 : (zero_extend:DI
11836 : 3526 : (and:SI (match_operand:SI 1 "nonimmediate_operand" "%0,rm,rjM,r")
11837 : 3526 : (match_operand:SI 2 "x86_64_general_operand" "rBMe,r,e,BM"))))
11838 : 3526 : (clobber (reg:CC FLAGS_REG))]
11839 : 22228 : "TARGET_64BIT
11840 : 18250 : && ix86_binary_operator_ok (AND, SImode, operands, TARGET_APX_NDD)"
11841 : 2744 : "@
11842 : 4996 : and{l}\t{%2, %k0|%k0, %2}
11843 : 4996 : and{l}\t{%2, %1, %k0|%k0, %1, %2}
11844 : 151 : and{l}\t{%2, %1, %k0|%k0, %1, %2}
11845 : 151 : and{l}\t{%2, %1, %k0|%k0, %1, %2}"
11846 : 238 : [(set_attr "type" "alu")
11847 : 3764 : (set_attr "isa" "*,apx_ndd,apx_ndd,apx_ndd")
11848 : 3553 : (set_attr "mode" "SI")])
11849 : 3579 :
11850 : 27 : (define_insn "*and<mode>_1"
11851 : 26 : [(set (match_operand:SWI24 0 "nonimmediate_operand" "=rm,r,r,r,r,Ya,?k")
11852 : 26 : (and:SWI24 (match_operand:SWI24 1 "nonimmediate_operand" "%0,0,rm,rjM,r,qm,k")
11853 : 52 : (match_operand:SWI24 2 "<general_operand>" "r<i>,<m>,r,<i>,<m>,L,k")))
11854 : 27 : (clobber (reg:CC FLAGS_REG))]
11855 : 866449 : "ix86_binary_operator_ok (AND, <MODE>mode, operands, TARGET_APX_NDD)"
11856 : 26 : "@
11857 : 261828 : and{<imodesuffix>}\t{%2, %0|%0, %2}
11858 : 261828 : and{<imodesuffix>}\t{%2, %0|%0, %2}
11859 : 795246 : and{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
11860 : 795246 : and{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
11861 : 1534680 : and{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
11862 : 26 : #
11863 : 216141 : #"
11864 : 408898 : [(set (attr "isa")
11865 : 631013 : (cond [(eq_attr "alternative" "2,3,4")
11866 : 176061 : (const_string "apx_ndd")
11867 : 807016 : (eq_attr "alternative" "6")
11868 : 600224 : (if_then_else (eq_attr "mode" "SI")
11869 : 30789 : (const_string "avx512bw")
11870 : 30789 : (const_string "avx512f"))
11871 : 703 : ]
11872 : 31489 : (const_string "*")))
11873 : 30089 : (set_attr "type" "alu,alu,alu,alu,alu,imovx,msklog")
11874 : 700 : (set_attr "length_immediate" "*,*,*,*,*,0,*")
11875 : 700 : (set (attr "prefix_rex")
11876 : : (if_then_else
11877 : 510 : (and (eq_attr "type" "imovx")
11878 : 1268647 : (and (match_test "INTVAL (operands[2]) == 0xff")
11879 : 8 : (match_operand 1 "ext_QIreg_operand")))
11880 : 8 : (const_string "1")
11881 : 8 : (const_string "*")))
11882 : 8 : (set_attr "mode" "<MODE>,<MODE>,<MODE>,<MODE>,<MODE>,SI,<MODE>")])
11883 : 8 :
11884 : 1268647 : (define_insn "*andqi_1"
11885 : : [(set (match_operand:QI 0 "nonimmediate_operand" "=qm,q,r,r,r,?k")
11886 : : (and:QI (match_operand:QI 1 "nonimmediate_operand" "%0,0,0,rm,r,k")
11887 : : (match_operand:QI 2 "general_operand" "qn,m,rn,rn,m,k")))
11888 : : (clobber (reg:CC FLAGS_REG))]
11889 : 452919 : "ix86_binary_operator_ok (AND, QImode, operands, TARGET_APX_NDD)"
11890 : : "@
11891 : 132493 : and{b}\t{%2, %0|%0, %2}
11892 : 132493 : and{b}\t{%2, %0|%0, %2}
11893 : 77 : and{l}\t{%k2, %k0|%k0, %k2}
11894 : 77 : and{b}\t{%2, %1, %0|%0, %1, %2}
11895 : 154 : and{b}\t{%2, %1, %0|%0, %1, %2}
11896 : 191 : #"
11897 : 191 : [(set_attr "type" "alu,alu,alu,alu,alu,msklog")
11898 : 191 : (set_attr "isa" "*,*,*,apx_ndd,apx_ndd,*")
11899 : : (set (attr "mode")
11900 : : (cond [(eq_attr "alternative" "2")
11901 : : (const_string "SI")
11902 : : (and (eq_attr "alternative" "5")
11903 : : (match_test "!TARGET_AVX512DQ"))
11904 : : (const_string "HI")
11905 : : ]
11906 : : (const_string "QI")))
11907 : : ;; Potential partial reg stall on alternative 2.
11908 : : (set (attr "preferred_for_speed")
11909 : : (cond [(eq_attr "alternative" "2")
11910 : : (symbol_ref "!TARGET_PARTIAL_REG_STALL")]
11911 : : (symbol_ref "true")))])
11912 : :
11913 : : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
11914 : : (define_insn_and_split "*<code><mode>_1_slp"
11915 : : [(set (strict_low_part (match_operand:SWI12 0 "register_operand" "+<r>,&<r>"))
11916 : : (any_logic:SWI12 (match_operand:SWI12 1 "nonimmediate_operand" "%0,!<r>")
11917 : : (match_operand:SWI12 2 "general_operand" "<r>mn,<r>mn")))
11918 : : (clobber (reg:CC FLAGS_REG))]
11919 : 2177 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
11920 : 2209 : "@
11921 : 636 : <logic>{<imodesuffix>}\t{%2, %0|%0, %2}
11922 : 636 : #"
11923 : 3322 : "&& reload_completed
11924 : 332748 : && !(rtx_equal_p (operands[0], operands[1])
11925 : 604504 : || rtx_equal_p (operands[0], operands[2]))"
11926 : 18 : [(set (strict_low_part (match_dup 0)) (match_dup 1))
11927 : 349817 : (parallel
11928 : 255339 : [(set (strict_low_part (match_dup 0))
11929 : 1675551 : (any_logic:SWI12 (match_dup 0) (match_dup 2)))
11930 : 1571863 : (clobber (reg:CC FLAGS_REG))])]
11931 : 1832271 : ""
11932 : 1417274 : [(set_attr "type" "alu")
11933 : 1813386 : (set_attr "mode" "<MODE>")])
11934 : 1037315 :
11935 : 1113324 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
11936 : 1115764 : (define_insn_and_split "*<code>qi_ext<mode>_1_slp"
11937 : 3122 : [(set (strict_low_part (match_operand:QI 0 "register_operand" "+Q,&Q"))
11938 : 4178 : (any_logic:QI
11939 : 1074 : (subreg:QI
11940 : 1414715 : (match_operator:SWI248 3 "extract_operator"
11941 : 98 : [(match_operand 2 "int248_register_operand" "Q,Q")
11942 : 57061 : (const_int 8)
11943 : 58032 : (const_int 8)]) 0)
11944 : 252 : (match_operand:QI 1 "nonimmediate_operand" "0,!qm")))
11945 : 69 : (clobber (reg:CC FLAGS_REG))]
11946 : 1408078 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
11947 : 6 : "@
11948 : 85 : <logic>{b}\t{%h2, %0|%0, %h2}
11949 : 1106616 : #"
11950 : 45 : "&& reload_completed
11951 : 61 : && !rtx_equal_p (operands[0], operands[1])"
11952 : 19 : [(set (strict_low_part (match_dup 0)) (match_dup 1))
11953 : 1106559 : (parallel
11954 : 1106547 : [(set (strict_low_part (match_dup 0))
11955 : 30 : (any_logic:QI
11956 : 30 : (subreg:QI
11957 : 285587 : (match_op_dup 3
11958 : 285587 : [(match_dup 2) (const_int 8) (const_int 8)]) 0)
11959 : 414 : (match_dup 0)))
11960 : : (clobber (reg:CC FLAGS_REG))])]
11961 : 16 : ""
11962 : 22 : [(set_attr "type" "alu")
11963 : 10 : (set_attr "mode" "QI")])
11964 : 10 :
11965 : 10 : (define_insn_and_split "*<code>qi_ext<mode>_2_slp"
11966 : 0 : [(set (strict_low_part (match_operand:QI 0 "register_operand" "+&Q"))
11967 : 10 : (any_logic:QI
11968 : 0 : (subreg:QI
11969 : 0 : (match_operator:SWI248 3 "extract_operator"
11970 : 0 : [(match_operand 1 "int248_register_operand" "Q")
11971 : 0 : (const_int 8)
11972 : 0 : (const_int 8)]) 0)
11973 : : (subreg:QI
11974 : : (match_operator:SWI248 4 "extract_operator"
11975 : 0 : [(match_operand 2 "int248_register_operand" "Q")
11976 : : (const_int 8)
11977 : : (const_int 8)]) 0)))
11978 : : (clobber (reg:CC FLAGS_REG))]
11979 : 17 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
11980 : 0 : "#"
11981 : 6 : "&& reload_completed"
11982 : 15 : [(set (strict_low_part (match_dup 0))
11983 : 9 : (subreg:QI
11984 : 0 : (match_op_dup 4
11985 : 2 : [(match_dup 2) (const_int 8) (const_int 8)]) 0))
11986 : 46 : (parallel
11987 : 4 : [(set (strict_low_part (match_dup 0))
11988 : 0 : (any_logic:QI
11989 : 0 : (subreg:QI
11990 : 0 : (match_op_dup 3
11991 : : [(match_dup 1) (const_int 8) (const_int 8)]) 0)
11992 : : (match_dup 0)))
11993 : : (clobber (reg:CC FLAGS_REG))])]
11994 : : ""
11995 : : [(set_attr "type" "alu")
11996 : 1 : (set_attr "mode" "QI")])
11997 : 9 :
11998 : 10 : (define_split
11999 : 10 : [(set (match_operand:SWI248 0 "register_operand")
12000 : 10 : (and:SWI248 (match_operand:SWI248 1 "nonimmediate_operand")
12001 : 10 : (match_operand:SWI248 2 "const_int_operand")))
12002 : 10 : (clobber (reg:CC FLAGS_REG))]
12003 : 357880 : "reload_completed
12004 : 597801 : && (!REG_P (operands[1])
12005 : 597742 : || REGNO (operands[0]) != REGNO (operands[1]))
12006 : 72 : && (UINTVAL (operands[2]) == GET_MODE_MASK (SImode)
12007 : 80 : || UINTVAL (operands[2]) == GET_MODE_MASK (HImode)
12008 : 69 : || UINTVAL (operands[2]) == GET_MODE_MASK (QImode))"
12009 : 7 : [(const_int 0)]
12010 : 9 : {
12011 : 9 : unsigned HOST_WIDE_INT ival = UINTVAL (operands[2]);
12012 : 579260 : machine_mode mode;
12013 : 579251 :
12014 : 579260 : if (ival == GET_MODE_MASK (SImode))
12015 : 9 : mode = SImode;
12016 : 9 : else if (ival == GET_MODE_MASK (HImode))
12017 : 900 : mode = HImode;
12018 : 907 : else if (ival == GET_MODE_MASK (QImode))
12019 : : mode = QImode;
12020 : : else
12021 : 0 : gcc_unreachable ();
12022 : :
12023 : : /* Zero extend to SImode to avoid partial register stalls. */
12024 : 9 : if (<MODE_SIZE> < GET_MODE_SIZE (SImode))
12025 : 0 : operands[0] = gen_lowpart (SImode, operands[0]);
12026 : :
12027 : 9 : emit_insn (gen_extend_insn
12028 : 18 : (operands[0], gen_lowpart (mode, operands[1]),
12029 : 18 : GET_MODE (operands[0]), mode, 1));
12030 : 9 : DONE;
12031 : : })
12032 : :
12033 : : (define_split
12034 : : [(set (match_operand:SWI48 0 "register_operand")
12035 : : (and:SWI48 (match_dup 0)
12036 : 8 : (const_int -65536)))
12037 : : (clobber (reg:CC FLAGS_REG))]
12038 : 494 : "(TARGET_FAST_PREFIX && !TARGET_PARTIAL_REG_STALL)
12039 : 446 : || optimize_function_for_size_p (cfun)"
12040 : 40 : [(set (strict_low_part (match_dup 1)) (const_int 0))]
12041 : 486 : "operands[1] = gen_lowpart (HImode, operands[0]);")
12042 : 8 :
12043 : 359 : (define_split
12044 : 310 : [(set (match_operand:SWI248 0 "any_QIreg_operand")
12045 : 0 : (and:SWI248 (match_dup 0)
12046 : 24 : (const_int -256)))
12047 : 7 : (clobber (reg:CC FLAGS_REG))]
12048 : 730 : "(!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun))
12049 : 294 : && reload_completed"
12050 : 139 : [(set (strict_low_part (match_dup 1)) (const_int 0))]
12051 : 773 : "operands[1] = gen_lowpart (QImode, operands[0]);")
12052 : 486 :
12053 : 593 : (define_split
12054 : 394 : [(set (match_operand:SWI248 0 "QIreg_operand")
12055 : 379 : (and:SWI248 (match_dup 0)
12056 : 486 : (const_int -65281)))
12057 : 287 : (clobber (reg:CC FLAGS_REG))]
12058 : 287 : "(!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun))
12059 : 478 : && reload_completed"
12060 : 1 : [(parallel
12061 : 287 : [(set (zero_extract:HI (match_dup 0)
12062 : 287 : (const_int 8)
12063 : 740 : (const_int 8))
12064 : 477 : (subreg:HI
12065 : 1 : (xor:QI
12066 : 478 : (subreg:QI
12067 : : (zero_extract:HI (match_dup 0)
12068 : : (const_int 8)
12069 : 280 : (const_int 8)) 0)
12070 : : (subreg:QI
12071 : 280 : (zero_extract:HI (match_dup 0)
12072 : 1113446 : (const_int 8)
12073 : 1113166 : (const_int 8)) 0)) 0))
12074 : 1113446 : (clobber (reg:CC FLAGS_REG))])]
12075 : 1113167 : "operands[0] = gen_lowpart (HImode, operands[0]);")
12076 : 280 :
12077 : 76933 : (define_insn "*anddi_2"
12078 : 76934 : [(set (reg FLAGS_REG)
12079 : 76934 : (compare
12080 : 1 : (and:DI
12081 : 76933 : (match_operand:DI 1 "nonimmediate_operand" "%0,0,0,r,rm,r")
12082 : 36251 : (match_operand:DI 2 "x86_64_szext_general_operand" "Z,re,m,Z,re,m"))
12083 : 76933 : (const_int 0)))
12084 : : (set (match_operand:DI 0 "nonimmediate_operand" "=r,rm,r,r,r,r")
12085 : : (and:DI (match_dup 1) (match_dup 2)))]
12086 : 17556 : "TARGET_64BIT
12087 : 16746 : && ix86_match_ccmode
12088 : 16746 : (insn,
12089 : : /* If we are going to emit andl instead of andq, and the operands[2]
12090 : : constant might have the SImode sign bit set, make sure the sign
12091 : : flag isn't tested, because the instruction will set the sign flag
12092 : : based on bit 31 rather than bit 63. If it isn't CONST_INT,
12093 : : conservatively assume it might have bit 31 set. */
12094 : 16746 : (satisfies_constraint_Z (operands[2])
12095 : 12471 : && (!CONST_INT_P (operands[2])
12096 : 12471 : || val_signbit_known_set_p (SImode, INTVAL (operands[2]))))
12097 : : ? CCZmode : CCNOmode)
12098 : 16746 : && ix86_binary_operator_ok (AND, DImode, operands, TARGET_APX_NDD)"
12099 : 1745 : "@
12100 : : and{l}\t{%k2, %k0|%k0, %k2}
12101 : : and{q}\t{%2, %0|%0, %2}
12102 : 27065 : and{q}\t{%2, %0|%0, %2}
12103 : 27065 : and{l}\t{%k2, %k1, %k0|%k0, %k1, %k2}
12104 : 1 : and{q}\t{%2, %1, %0|%0, %1, %2}
12105 : 24670 : and{q}\t{%2, %1, %0|%0, %1, %2}"
12106 : : [(set_attr "type" "alu")
12107 : : (set_attr "isa" "*,*,*,apx_ndd,apx_ndd,apx_ndd")
12108 : : (set_attr "mode" "SI,DI,DI,SI,DI,DI")])
12109 : :
12110 : 2 : ;; See comment for addsi_1_zext why we do use nonimmediate_operand
12111 : : (define_insn "*andsi_2_zext"
12112 : 2 : [(set (reg FLAGS_REG)
12113 : 2 : (compare (and:SI
12114 : 1 : (match_operand:SI 1 "nonimmediate_operand" "%0,rm,r")
12115 : 0 : (match_operand:SI 2 "x86_64_general_operand" "rBMe,re,BM"))
12116 : 1 : (const_int 0)))
12117 : 1 : (set (match_operand:DI 0 "register_operand" "=r,r,r")
12118 : 1 : (zero_extend:DI (and:SI (match_dup 1) (match_dup 2))))]
12119 : 0 : "TARGET_64BIT && ix86_match_ccmode (insn, CCNOmode)
12120 : 1 : && ix86_binary_operator_ok (AND, SImode, operands, TARGET_APX_NDD)"
12121 : 120 : "@
12122 : : and{l}\t{%2, %k0|%k0, %2}
12123 : : and{l}\t{%2, %1, %k0|%k0, %1, %2}
12124 : : and{l}\t{%2, %1, %k0|%k0, %1, %2}"
12125 : : [(set_attr "type" "alu")
12126 : : (set_attr "isa" "*,apx_ndd,apx_ndd")
12127 : : (set_attr "mode" "SI")])
12128 : :
12129 : : (define_insn "*andqi_2_maybe_si"
12130 : 1513 : [(set (reg FLAGS_REG)
12131 : : (compare (and:QI
12132 : : (match_operand:QI 1 "nonimmediate_operand" "%0,0,0,rm,r")
12133 : : (match_operand:QI 2 "general_operand" "qn,m,n,rn,m"))
12134 : 1513 : (const_int 0)))
12135 : 1513 : (set (match_operand:QI 0 "nonimmediate_operand" "=qm,q,r,r,r")
12136 : 1513 : (and:QI (match_dup 1) (match_dup 2)))]
12137 : 24670 : "ix86_binary_operator_ok (AND, QImode, operands, TARGET_APX_NDD)
12138 : 50485 : && ix86_match_ccmode (insn,
12139 : 24302 : CONST_INT_P (operands[2])
12140 : 18817 : && INTVAL (operands[2]) >= 0 ? CCNOmode : CCZmode)"
12141 : 6450 : {
12142 : 7186 : if (get_attr_mode (insn) == MODE_SI)
12143 : : {
12144 : 232 : if (CONST_INT_P (operands[2]) && INTVAL (operands[2]) < 0)
12145 : 10 : operands[2] = GEN_INT (INTVAL (operands[2]) & 0xff);
12146 : 232 : return "and{l}\t{%2, %k0|%k0, %2}";
12147 : 10 : }
12148 : 6228 : if (which_alternative > 2)
12149 : 10 : return "and{b}\t{%2, %1, %0|%0, %1, %2}";
12150 : : return "and{b}\t{%2, %0|%0, %2}";
12151 : 10 : }
12152 : 10 : [(set_attr "type" "alu")
12153 : 10 : (set_attr "isa" "*,*,*,apx_ndd,apx_ndd")
12154 : 10 : (set (attr "mode")
12155 : 10 : (cond [(eq_attr "alternative" "3,4")
12156 : 10 : (const_string "QI")
12157 : : (eq_attr "alternative" "2")
12158 : 10 : (const_string "SI")
12159 : 731323 : (and (match_test "optimize_insn_for_size_p ()")
12160 : : (and (match_operand 0 "ext_QIreg_operand")
12161 : 10 : (match_operand 2 "const_0_to_127_operand")))
12162 : : (const_string "SI")
12163 : 0 : ]
12164 : 0 : (const_string "QI")))
12165 : 723455 : ;; Potential partial reg stall on alternative 2.
12166 : : (set (attr "preferred_for_speed")
12167 : : (cond [(eq_attr "alternative" "2")
12168 : 127733 : (symbol_ref "!TARGET_PARTIAL_REG_STALL")]
12169 : 127733 : (symbol_ref "true")))])
12170 : 127733 :
12171 : : (define_insn "*and<mode>_2"
12172 : : [(set (reg FLAGS_REG)
12173 : : (compare (and:SWI124
12174 : 127733 : (match_operand:SWI124 1 "nonimmediate_operand" "%0,0,rm,r")
12175 : : (match_operand:SWI124 2 "<general_operand>" "<r><i>,<m>,r<i>,<m>"))
12176 : : (const_int 0)))
12177 : : (set (match_operand:SWI124 0 "nonimmediate_operand" "=<r>m,<r>,r,r")
12178 : 127732 : (and:SWI124 (match_dup 1) (match_dup 2)))]
12179 : 41807 : "ix86_match_ccmode (insn, CCNOmode)
12180 : 41807 : && ix86_binary_operator_ok (AND, <MODE>mode, operands, TARGET_APX_NDD)"
12181 : 957 : "@
12182 : : and{<imodesuffix>}\t{%2, %0|%0, %2}
12183 : : and{<imodesuffix>}\t{%2, %0|%0, %2}
12184 : 41515 : and{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
12185 : 41515 : and{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
12186 : 124393 : [(set_attr "type" "alu")
12187 : : (set_attr "isa" "*,*,apx_ndd,apx_ndd")
12188 : 120 : (set_attr "mode" "<MODE>")])
12189 : 120 :
12190 : 120 : (define_insn "*<code>qi_ext<mode>_0"
12191 : : [(set (match_operand:QI 0 "nonimmediate_operand" "=QBn")
12192 : : (any_logic:QI
12193 : : (subreg:QI
12194 : : (match_operator:SWI248 3 "extract_operator"
12195 : : [(match_operand 2 "int248_register_operand" "Q")
12196 : : (const_int 8)
12197 : : (const_int 8)]) 0)
12198 : : (match_operand:QI 1 "nonimmediate_operand" "0")))
12199 : : (clobber (reg:CC FLAGS_REG))]
12200 : : ""
12201 : : "<logic>{b}\t{%h2, %0|%0, %h2}"
12202 : : [(set_attr "addr" "gpr8")
12203 : : (set_attr "type" "alu")
12204 : : (set_attr "mode" "QI")])
12205 : :
12206 : : (define_insn_and_split "*<code>qi_ext2<mode>_0"
12207 : : [(set (match_operand:QI 0 "register_operand" "=&Q")
12208 : : (any_logic:QI
12209 : : (subreg:QI
12210 : : (match_operator:SWI248 3 "extract_operator"
12211 : : [(match_operand 1 "int248_register_operand" "Q")
12212 : : (const_int 8)
12213 : : (const_int 8)]) 0)
12214 : : (subreg:QI
12215 : : (match_operator:SWI248 4 "extract_operator"
12216 : : [(match_operand 2 "int248_register_operand" "Q")
12217 : : (const_int 8)
12218 : : (const_int 8)]) 0)))
12219 : : (clobber (reg:CC FLAGS_REG))]
12220 : : ""
12221 : : "#"
12222 : 6 : "&& reload_completed"
12223 : : [(set (match_dup 0)
12224 : 20 : (subreg:QI
12225 : : (match_op_dup 4
12226 : 12 : [(match_dup 2) (const_int 8) (const_int 8)]) 0))
12227 : 12 : (parallel
12228 : : [(set (match_dup 0)
12229 : : (any_logic:QI
12230 : 96311 : (subreg:QI
12231 : 43 : (match_op_dup 3
12232 : 5369 : [(match_dup 1) (const_int 8) (const_int 8)]) 0)
12233 : 90922 : (match_dup 0)))
12234 : 90922 : (clobber (reg:CC FLAGS_REG))])]
12235 : 34 : ""
12236 : 13 : [(set_attr "type" "alu")
12237 : 49443 : (set_attr "mode" "QI")])
12238 : 49472 :
12239 : 29 : (define_expand "andqi_ext_1"
12240 : 49463 : [(parallel
12241 : 20 : [(set (zero_extract:HI (match_operand:HI 0 "register_operand")
12242 : 1522 : (const_int 8)
12243 : 25 : (const_int 8))
12244 : 494 : (subreg:HI
12245 : 425 : (and:QI
12246 : 25 : (subreg:QI
12247 : 25 : (zero_extract:HI (match_operand:HI 1 "register_operand")
12248 : 20 : (const_int 8)
12249 : 5 : (const_int 8)) 0)
12250 : : (match_operand:QI 2 "const_int_operand")) 0))
12251 : 5 : (clobber (reg:CC FLAGS_REG))])])
12252 : 5 :
12253 : 5 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
12254 : : (define_insn_and_split "*<code>qi_ext<mode>_1"
12255 : 20 : [(set (zero_extract:SWI248
12256 : : (match_operand 0 "int248_register_operand" "+Q,&Q")
12257 : : (const_int 8)
12258 : : (const_int 8))
12259 : : (subreg:SWI248
12260 : : (any_logic:QI
12261 : : (subreg:QI
12262 : : (match_operator:SWI248 3 "extract_operator"
12263 : : [(match_operand 1 "int248_register_operand" "0,!Q")
12264 : : (const_int 8)
12265 : : (const_int 8)]) 0)
12266 : : (match_operand:QI 2 "general_operand" "QnBn,QnBn")) 0))
12267 : 20 : (clobber (reg:CC FLAGS_REG))]
12268 : 20 : ""
12269 : 20 : "@
12270 : : <logic>{b}\t{%2, %h0|%h0, %2}
12271 : : #"
12272 : 12063 : "reload_completed
12273 : 12041 : && !(rtx_equal_p (operands[0], operands[1]))"
12274 : 6 : [(set (zero_extract:SWI248
12275 : 19 : (match_dup 0) (const_int 8) (const_int 8))
12276 : : (zero_extract:SWI248
12277 : 91 : (match_dup 1) (const_int 8) (const_int 8)))
12278 : 72 : (parallel
12279 : 19 : [(set (zero_extract:SWI248
12280 : 19 : (match_dup 0) (const_int 8) (const_int 8))
12281 : 19 : (subreg:SWI248
12282 : 19 : (any_logic:QI
12283 : 19 : (subreg:QI
12284 : 0 : (match_op_dup 3
12285 : 19 : [(match_dup 0) (const_int 8) (const_int 8)]) 0)
12286 : : (match_dup 2)) 0))
12287 : : (clobber (reg:CC FLAGS_REG))])]
12288 : : ""
12289 : : [(set_attr "addr" "gpr8")
12290 : : (set_attr "type" "alu")
12291 : 6 : (set_attr "mode" "QI")])
12292 : 6 :
12293 : 6 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
12294 : 6 : (define_insn_and_split "*<code>qi_ext<mode>_1_cc"
12295 : 6 : [(set (match_operand 4 "flags_reg_operand")
12296 : 6 : (match_operator 5 "compare_operator"
12297 : 6 : [(any_logic:QI
12298 : 6 : (subreg:QI
12299 : 6 : (match_operator:SWI248 3 "extract_operator"
12300 : 0 : [(match_operand 1 "int248_register_operand" "0,!Q")
12301 : : (const_int 8)
12302 : 0 : (const_int 8)]) 0)
12303 : 0 : (match_operand:QI 2 "general_operand" "QnBn,QnBn"))
12304 : 0 : (const_int 0)]))
12305 : 0 : (set (zero_extract:SWI248
12306 : 0 : (match_operand 0 "int248_register_operand" "+Q,&Q")
12307 : 6 : (const_int 8)
12308 : 0 : (const_int 8))
12309 : 0 : (subreg:SWI248
12310 : : (any_logic:QI
12311 : : (subreg:QI
12312 : : (match_op_dup 3
12313 : : [(match_dup 0) (const_int 8) (const_int 8)]) 0)
12314 : : (match_dup 2)) 0))]
12315 : 812 : "ix86_match_ccmode (insn, CCNOmode)"
12316 : : "@
12317 : : <logic>{b}\t{%2, %h0|%h0, %2}
12318 : : #"
12319 : 396 : "&& reload_completed
12320 : 396 : && !(rtx_equal_p (operands[0], operands[1]))"
12321 : 396 : [(set (zero_extract:SWI248
12322 : 0 : (match_dup 0) (const_int 8) (const_int 8))
12323 : : (zero_extract:SWI248
12324 : 6 : (match_dup 1) (const_int 8) (const_int 8)))
12325 : 6 : (parallel
12326 : 6 : [(set (match_dup 4)
12327 : : (match_op_dup 5
12328 : 7756 : [(any_logic:QI
12329 : 7402 : (subreg:QI
12330 : 354 : (match_op_dup 3
12331 : 902 : [(match_dup 0) (const_int 8) (const_int 8)]) 0)
12332 : 908 : (match_dup 2))
12333 : 48 : (const_int 0)]))
12334 : 908 : (set (zero_extract:SWI248
12335 : 956 : (match_dup 0) (const_int 8) (const_int 8))
12336 : 908 : (subreg:SWI248
12337 : 54 : (any_logic:QI
12338 : 908 : (subreg:QI
12339 : 956 : (match_op_dup 3
12340 : 950 : [(match_dup 1) (const_int 8) (const_int 8)]) 0)
12341 : 6 : (match_dup 2)) 0))])]
12342 : 54 : ""
12343 : 54 : [(set_attr "addr" "gpr8")
12344 : 6 : (set_attr "type" "alu")
12345 : 48 : (set_attr "mode" "QI")])
12346 : 54 :
12347 : 54 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
12348 : 8 : (define_insn_and_split "*<code>qi_ext<mode>_2"
12349 : 48 : [(set (zero_extract:SWI248
12350 : 48 : (match_operand 0 "int248_register_operand" "+Q,&Q")
12351 : 48 : (const_int 8)
12352 : 0 : (const_int 8))
12353 : 48 : (subreg:SWI248
12354 : 0 : (any_logic:QI
12355 : 0 : (subreg:QI
12356 : 0 : (match_operator:SWI248 3 "extract_operator"
12357 : 0 : [(match_operand 1 "int248_register_operand" "%0,!Q")
12358 : 0 : (const_int 8)
12359 : 0 : (const_int 8)]) 0)
12360 : : (subreg:QI
12361 : : (match_operator:SWI248 4 "extract_operator"
12362 : : [(match_operand 2 "int248_register_operand" "Q,Q")
12363 : : (const_int 8)
12364 : : (const_int 8)]) 0)) 0))
12365 : 0 : (clobber (reg:CC FLAGS_REG))]
12366 : : ""
12367 : : "@
12368 : : <logic>{b}\t{%h2, %h0|%h0, %h2}
12369 : : #"
12370 : 10 : "reload_completed
12371 : 31 : && !(rtx_equal_p (operands[0], operands[1])
12372 : 3 : || rtx_equal_p (operands[0], operands[2]))"
12373 : 37 : [(set (zero_extract:SWI248
12374 : 3 : (match_dup 0) (const_int 8) (const_int 8))
12375 : : (zero_extract:SWI248
12376 : 30 : (match_dup 1) (const_int 8) (const_int 8)))
12377 : 51 : (parallel
12378 : : [(set (zero_extract:SWI248
12379 : : (match_dup 0) (const_int 8) (const_int 8))
12380 : : (subreg:SWI248
12381 : : (any_logic:QI
12382 : : (subreg:QI
12383 : : (match_op_dup 3
12384 : : [(match_dup 0) (const_int 8) (const_int 8)]) 0)
12385 : : (subreg:QI
12386 : : (match_op_dup 4
12387 : : [(match_dup 2) (const_int 8) (const_int 8)]) 0)) 0))
12388 : : (clobber (reg:CC FLAGS_REG))])]
12389 : : ""
12390 : : [(set_attr "type" "alu")
12391 : : (set_attr "mode" "QI")])
12392 : 0 :
12393 : 0 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
12394 : 3 : (define_insn_and_split "*<code>qi_ext<mode>_3"
12395 : 3 : [(set (zero_extract:SWI248
12396 : 3 : (match_operand 0 "int248_register_operand" "+Q,&Q")
12397 : 3 : (const_int 8)
12398 : 3 : (const_int 8))
12399 : 3 : (match_operator:SWI248 3 "extract_operator"
12400 : 3 : [(any_logic
12401 : 3 : (match_operand 1 "int248_register_operand" "%0,!Q")
12402 : 3 : (match_operand 2 "int248_register_operand" "Q,Q"))
12403 : 0 : (const_int 8)
12404 : 0 : (const_int 8)]))
12405 : 0 : (clobber (reg:CC FLAGS_REG))]
12406 : 21 : "GET_MODE (operands[1]) == GET_MODE (operands[2])"
12407 : 0 : "@
12408 : 0 : <logic>{b}\t{%h2, %h0|%h0, %h2}
12409 : 0 : #"
12410 : 27 : "&& reload_completed
12411 : 21 : && !(rtx_equal_p (operands[0], operands[1])
12412 : 9 : || rtx_equal_p (operands[0], operands[2]))"
12413 : 18 : [(set (zero_extract:SWI248
12414 : 3 : (match_dup 0) (const_int 8) (const_int 8))
12415 : : (zero_extract:SWI248
12416 : 21 : (match_dup 1) (const_int 8) (const_int 8)))
12417 : 42 : (parallel
12418 : : [(set (zero_extract:SWI248
12419 : : (match_dup 0) (const_int 8) (const_int 8))
12420 : 78522 : (match_op_dup 3
12421 : 78522 : [(any_logic (match_dup 4) (match_dup 2))
12422 : : (const_int 8) (const_int 8)]))
12423 : 23523 : (clobber (reg:CC FLAGS_REG))])]
12424 : 23526 : "operands[4] = gen_lowpart (GET_MODE (operands[1]), operands[0]);"
12425 : 23523 : [(set_attr "type" "alu")
12426 : : (set_attr "mode" "QI")])
12427 : 7836 :
12428 : 7836 : ;; Convert wide AND instructions with immediate operand to shorter QImode
12429 : 7836 : ;; equivalents when possible.
12430 : 7836 : ;; Don't do the splitting with memory operands, since it introduces risk
12431 : 7836 : ;; of memory mismatch stalls. We may want to do the splitting for optimizing
12432 : 3 : ;; for size, but that can (should?) be handled by generic code instead.
12433 : 7429 : ;; Don't do the splitting for APX NDD as NDD does not support *h registers.
12434 : 6 : (define_split
12435 : 2254 : [(set (match_operand:SWI248 0 "QIreg_operand")
12436 : 4505 : (and:SWI248 (match_operand:SWI248 1 "register_operand")
12437 : 3 : (match_operand:SWI248 2 "const_int_operand")))
12438 : : (clobber (reg:CC FLAGS_REG))]
12439 : 144747 : "reload_completed
12440 : 460155 : && (!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun))
12441 : 460152 : && !(~INTVAL (operands[2]) & ~(255 << 8))
12442 : 2754 : && !(TARGET_APX_NDD && REGNO (operands[0]) != REGNO (operands[1]))"
12443 : 2709 : [(parallel
12444 : 596705 : [(set (zero_extract:HI (match_dup 0)
12445 : 397822 : (const_int 8)
12446 : 596705 : (const_int 8))
12447 : 3 : (subreg:HI
12448 : 3 : (and:QI
12449 : 0 : (subreg:QI
12450 : 3 : (zero_extract:HI (match_dup 1)
12451 : : (const_int 8)
12452 : : (const_int 8)) 0)
12453 : : (match_dup 2)) 0))
12454 : : (clobber (reg:CC FLAGS_REG))])]
12455 : 2751 : {
12456 : 2751 : operands[0] = gen_lowpart (HImode, operands[0]);
12457 : 2751 : operands[1] = gen_lowpart (HImode, operands[1]);
12458 : 2754 : operands[2] = gen_int_mode (INTVAL (operands[2]) >> 8, QImode);
12459 : 3 : })
12460 : 3 :
12461 : : ;; Since AND can be encoded with sign extended immediate, this is only
12462 : 2751 : ;; profitable when 7th bit is not set.
12463 : 2751 : (define_split
12464 : 2751 : [(set (match_operand:SWI248 0 "any_QIreg_operand")
12465 : 2751 : (and:SWI248 (match_operand:SWI248 1 "general_operand")
12466 : 3306 : (match_operand:SWI248 2 "const_int_operand")))
12467 : 2751 : (clobber (reg:CC FLAGS_REG))]
12468 : 587457 : "reload_completed
12469 : 585107 : && (!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun))
12470 : 585107 : && !(~INTVAL (operands[2]) & ~255)
12471 : 209797 : && !(INTVAL (operands[2]) & 128)
12472 : 955 : && !(TARGET_APX_NDD
12473 : 8 : && !rtx_equal_p (operands[0], operands[1]))"
12474 : 596862 : [(parallel [(set (strict_low_part (match_dup 0))
12475 : 395 : (and:QI (match_dup 1)
12476 : 3 : (match_dup 2)))
12477 : 522475 : (clobber (reg:CC FLAGS_REG))])]
12478 : 522878 : {
12479 : 522878 : operands[0] = gen_lowpart (QImode, operands[0]);
12480 : 403 : operands[1] = gen_lowpart (QImode, operands[1]);
12481 : 522878 : operands[2] = gen_int_mode (INTVAL (operands[2]), QImode);
12482 : 315459 : })
12483 : 837919 :
12484 : : (define_insn_and_split "*andn<dwi>3_doubleword_bmi"
12485 : 59812 : [(set (match_operand:<DWI> 0 "register_operand" "=&r,r,r")
12486 : 59812 : (and:<DWI>
12487 : 60215 : (not:<DWI> (match_operand:<DWI> 1 "register_operand" "r,0,r"))
12488 : 57464 : (match_operand:<DWI> 2 "nonimmediate_operand" "ro,ro,0")))
12489 : 57464 : (clobber (reg:CC FLAGS_REG))]
12490 : 20213 : "TARGET_BMI"
12491 : 57464 : "#"
12492 : 2 : "&& reload_completed"
12493 : 59278 : [(parallel [(set (match_dup 0)
12494 : 168 : (and:DWIH (not:DWIH (match_dup 1)) (match_dup 2)))
12495 : 48769 : (clobber (reg:CC FLAGS_REG))])
12496 : 48769 : (parallel [(set (match_dup 3)
12497 : 48769 : (and:DWIH (not:DWIH (match_dup 4)) (match_dup 5)))
12498 : 48769 : (clobber (reg:CC FLAGS_REG))])]
12499 : 2620 : "split_double_mode (<DWI>mode, &operands[0], 3, &operands[0], &operands[3]);")
12500 : 12247 :
12501 : 14060 : (define_insn_and_split "*andn<mode>3_doubleword"
12502 : 11845 : [(set (match_operand:DWI 0 "register_operand")
12503 : 3527 : (and:DWI
12504 : 15371 : (not:DWI (match_operand:DWI 1 "register_operand"))
12505 : 1 : (match_operand:DWI 2 "nonimmediate_operand")))
12506 : 3527 : (clobber (reg:CC FLAGS_REG))]
12507 : 3913 : "!TARGET_BMI
12508 : 50787 : && ix86_pre_reload_split ()"
12509 : 3913 : "#"
12510 : 387 : "&& 1"
12511 : 477 : [(set (match_dup 3) (not:DWI (match_dup 1)))
12512 : 387 : (parallel [(set (match_dup 0)
12513 : 386 : (and:DWI (match_dup 3) (match_dup 2)))
12514 : 1 : (clobber (reg:CC FLAGS_REG))])]
12515 : 1490 : "operands[3] = gen_reg_rtx (<MODE>mode);")
12516 : 1014 :
12517 : 981 : (define_insn "*andn<mode>_1"
12518 : 33 : [(set (match_operand:SWI48 0 "register_operand" "=r,r,?k")
12519 : 90 : (and:SWI48
12520 : 90 : (not:SWI48 (match_operand:SWI48 1 "register_operand" "r,r,k"))
12521 : 90 : (match_operand:SWI48 2 "nonimmediate_operand" "r,m,k")))
12522 : 1 : (clobber (reg:CC FLAGS_REG))]
12523 : 34201 : "TARGET_BMI || TARGET_AVX512BW"
12524 : 90 : "@
12525 : 104 : andn\t{%2, %1, %0|%0, %1, %2}
12526 : 104 : andn\t{%2, %1, %0|%0, %1, %2}
12527 : 5608 : #"
12528 : 5608 : [(set_attr "isa" "bmi,bmi,avx512bw")
12529 : 5698 : (set_attr "type" "bitmanip,bitmanip,msklog")
12530 : 1 : (set_attr "btver2_decode" "direct, double,*")
12531 : 1 : (set_attr "mode" "<MODE>")])
12532 : 131 :
12533 : 130 : (define_insn "*andn<mode>_1"
12534 : 130 : [(set (match_operand:SWI12 0 "register_operand" "=r,?k")
12535 : : (and:SWI12
12536 : 110 : (not:SWI12 (match_operand:SWI12 1 "register_operand" "r,k"))
12537 : 110 : (match_operand:SWI12 2 "register_operand" "r,k")))
12538 : 170 : (clobber (reg:CC FLAGS_REG))]
12539 : 20 : "TARGET_BMI || TARGET_AVX512BW"
12540 : 9366 : "@
12541 : 91 : andn\t{%k2, %k1, %k0|%k0, %k1, %k2}
12542 : 107 : #"
12543 : 251 : [(set_attr "isa" "bmi,avx512f")
12544 : 282 : (set_attr "type" "bitmanip,msklog")
12545 : 289 : (set_attr "btver2_decode" "direct,*")
12546 : 299 : (set (attr "mode")
12547 : 259 : (cond [(eq_attr "alternative" "0")
12548 : 66 : (const_string "SI")
12549 : 67 : (and (eq_attr "alternative" "1")
12550 : 31 : (match_test "!TARGET_AVX512DQ"))
12551 : 31 : (const_string "HI")
12552 : 0 : ]
12553 : 109 : (const_string "<MODE>")))])
12554 : 78 :
12555 : 0 : (define_insn "*andn_<mode>_ccno"
12556 : 0 : [(set (reg FLAGS_REG)
12557 : 0 : (compare
12558 : 0 : (and:SWI48
12559 : 0 : (not:SWI48 (match_operand:SWI48 1 "register_operand" "r,r"))
12560 : : (match_operand:SWI48 2 "nonimmediate_operand" "r,m"))
12561 : : (const_int 0)))
12562 : 72 : (clobber (match_scratch:SWI48 0 "=r,r"))]
12563 : 271 : "TARGET_BMI && ix86_match_ccmode (insn, CCNOmode)"
12564 : 1653 : "andn\t{%2, %1, %0|%0, %1, %2}"
12565 : 4 : [(set_attr "type" "bitmanip")
12566 : 4 : (set_attr "btver2_decode" "direct, double")
12567 : 0 : (set_attr "mode" "<MODE>")])
12568 : 0 :
12569 : 0 : ;; Split *andnsi_1 after reload with -Oz when not;and is shorter.
12570 : 2275 : (define_split
12571 : 1572 : [(set (match_operand:SI 0 "register_operand")
12572 : 2282 : (and:SI (not:SI (match_operand:SI 1 "register_operand"))
12573 : : (match_operand:SI 2 "nonimmediate_operand")))
12574 : : (clobber (reg:CC FLAGS_REG))]
12575 : 159 : "reload_completed
12576 : 106 : && optimize_insn_for_size_p () && optimize_size > 1
12577 : 2 : && REGNO (operands[0]) == REGNO (operands[1])
12578 : 0 : && LEGACY_INT_REG_P (operands[0])
12579 : 2 : && !REX_INT_REG_P (operands[2])
12580 : 2 : && !reg_overlap_mentioned_p (operands[0], operands[2])"
12581 : 2 : [(set (match_dup 0) (not:SI (match_dup 1)))
12582 : 2 : (parallel [(set (match_dup 0) (and:SI (match_dup 0) (match_dup 2)))
12583 : 2 : (clobber (reg:CC FLAGS_REG))])])
12584 : 2 :
12585 : 0 : ;; Split *andn_si_ccno with -Oz when not;test is shorter.
12586 : 2 : (define_split
12587 : 2749 : [(set (match_operand 0 "flags_reg_operand")
12588 : 1551 : (match_operator 1 "compare_operator"
12589 : 4298 : [(and:SI (not:SI (match_operand:SI 2 "general_reg_operand"))
12590 : 1518 : (match_operand:SI 3 "nonimmediate_operand"))
12591 : 1233 : (const_int 0)]))
12592 : 1233 : (clobber (match_dup 2))]
12593 : 41 : "reload_completed
12594 : 8 : && optimize_insn_for_size_p () && optimize_size > 1
12595 : 21 : && LEGACY_INT_REG_P (operands[2])
12596 : 2 : && !REX_INT_REG_P (operands[3])
12597 : 2 : && !reg_overlap_mentioned_p (operands[2], operands[3])"
12598 : 14 : [(set (match_dup 2) (not:SI (match_dup 2)))
12599 : 2 : (set (match_dup 0) (match_op_dup 1
12600 : : [(and:SI (match_dup 3) (match_dup 2))
12601 : : (const_int 0)]))])
12602 : :
12603 : : ;; Variant 1 of 4: Split ((A | B) ^ A) ^ C as (B & ~A) ^ C.
12604 : 2 : (define_split
12605 : 239700 : [(set (match_operand:SWI48 0 "register_operand")
12606 : 239700 : (xor:SWI48
12607 : : (xor:SWI48
12608 : 0 : (ior:SWI48 (match_operand:SWI48 1 "register_operand")
12609 : 0 : (match_operand:SWI48 2 "nonimmediate_operand"))
12610 : : (match_dup 1))
12611 : : (match_operand:SWI48 3 "nonimmediate_operand")))
12612 : 1 : (clobber (reg:CC FLAGS_REG))]
12613 : 1 : "TARGET_BMI"
12614 : 2 : [(parallel
12615 : 1 : [(set (match_dup 4) (and:SWI48 (not:SWI48 (match_dup 1)) (match_dup 2)))
12616 : 5 : (clobber (reg:CC FLAGS_REG))])
12617 : 1 : (parallel
12618 : 5 : [(set (match_dup 0) (xor:SWI48 (match_dup 4) (match_dup 3)))
12619 : 5 : (clobber (reg:CC FLAGS_REG))])]
12620 : 6 : "operands[4] = gen_reg_rtx (<MODE>mode);")
12621 : 0 :
12622 : 1 : ;; Variant 2 of 4: Split ((A | B) ^ B) ^ C as (A & ~B) ^ C.
12623 : 1 : (define_split
12624 : 1 : [(set (match_operand:SWI48 0 "register_operand")
12625 : 1 : (xor:SWI48
12626 : 1 : (xor:SWI48
12627 : 1 : (ior:SWI48 (match_operand:SWI48 1 "register_operand")
12628 : 1 : (match_operand:SWI48 2 "register_operand"))
12629 : 1 : (match_dup 2))
12630 : 1 : (match_operand:SWI48 3 "nonimmediate_operand")))
12631 : 1 : (clobber (reg:CC FLAGS_REG))]
12632 : 1 : "TARGET_BMI"
12633 : 1 : [(parallel
12634 : : [(set (match_dup 4) (and:SWI48 (not:SWI48 (match_dup 2)) (match_dup 1)))
12635 : : (clobber (reg:CC FLAGS_REG))])
12636 : 4 : (parallel
12637 : 4 : [(set (match_dup 0) (xor:SWI48 (match_dup 4) (match_dup 3)))
12638 : 4 : (clobber (reg:CC FLAGS_REG))])]
12639 : 0 : "operands[4] = gen_reg_rtx (<MODE>mode);")
12640 : 4 :
12641 : 5 : ;; Variant 3 of 4: Split ((A | B) ^ C) ^ A as (B & ~A) ^ C.
12642 : 4 : (define_split
12643 : 0 : [(set (match_operand:SWI48 0 "register_operand")
12644 : 0 : (xor:SWI48
12645 : 0 : (xor:SWI48
12646 : 0 : (ior:SWI48 (match_operand:SWI48 1 "register_operand")
12647 : 0 : (match_operand:SWI48 2 "nonimmediate_operand"))
12648 : 1 : (match_operand:SWI48 3 "nonimmediate_operand"))
12649 : 1 : (match_dup 1)))
12650 : 1 : (clobber (reg:CC FLAGS_REG))]
12651 : 0 : "TARGET_BMI"
12652 : 0 : [(parallel
12653 : 4 : [(set (match_dup 4) (and:SWI48 (not:SWI48 (match_dup 1)) (match_dup 2)))
12654 : 4 : (clobber (reg:CC FLAGS_REG))])
12655 : 4 : (parallel
12656 : 0 : [(set (match_dup 0) (xor:SWI48 (match_dup 4) (match_dup 3)))
12657 : : (clobber (reg:CC FLAGS_REG))])]
12658 : 0 : "operands[4] = gen_reg_rtx (<MODE>mode);")
12659 : 0 :
12660 : 0 : ;; Variant 4 of 4: Split ((A | B) ^ C) ^ B as (A & ~B) ^ C.
12661 : 0 : (define_split
12662 : 0 : [(set (match_operand:SWI48 0 "register_operand")
12663 : 0 : (xor:SWI48
12664 : 0 : (xor:SWI48
12665 : 0 : (ior:SWI48 (match_operand:SWI48 1 "register_operand")
12666 : 0 : (match_operand:SWI48 2 "register_operand"))
12667 : 0 : (match_operand:SWI48 3 "nonimmediate_operand"))
12668 : 0 : (match_dup 2)))
12669 : 0 : (clobber (reg:CC FLAGS_REG))]
12670 : 0 : "TARGET_BMI"
12671 : 4 : [(parallel
12672 : 0 : [(set (match_dup 4) (and:SWI48 (not:SWI48 (match_dup 2)) (match_dup 1)))
12673 : : (clobber (reg:CC FLAGS_REG))])
12674 : 24 : (parallel
12675 : 24 : [(set (match_dup 0) (xor:SWI48 (match_dup 4) (match_dup 3)))
12676 : : (clobber (reg:CC FLAGS_REG))])]
12677 : 24 : "operands[4] = gen_reg_rtx (<MODE>mode);")
12678 : 24 :
12679 : 24 : ;; Logical inclusive and exclusive OR instructions
12680 : 0 :
12681 : 24 : ;; %%% This used to optimize known byte-wide and operations to memory.
12682 : 0 : ;; If this is considered useful, it should be done with splitters.
12683 : 24 :
12684 : 24 : (define_expand "<code><mode>3"
12685 : 24 : [(set (match_operand:SDWIM 0 "nonimmediate_operand")
12686 : 0 : (any_or:SDWIM (match_operand:SDWIM 1 "nonimmediate_operand")
12687 : 0 : (match_operand:SDWIM 2 "<general_operand>")))]
12688 : 0 : ""
12689 : 459179 : {
12690 : 459179 : if (GET_MODE_SIZE (<MODE>mode) > UNITS_PER_WORD
12691 : 459179 : && !x86_64_hilo_general_operand (operands[2], <MODE>mode))
12692 : 0 : operands[2] = force_reg (<MODE>mode, operands[2]);
12693 : :
12694 : 459179 : ix86_expand_binary_operator (<CODE>, <MODE>mode, operands, TARGET_APX_NDD);
12695 : 459179 : DONE;
12696 : 0 : })
12697 : 0 :
12698 : 0 : (define_insn_and_split "*<code><dwi>3_doubleword"
12699 : 0 : [(set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,r,&r,&r,&r,&r,&r")
12700 : 0 : (any_or:<DWI>
12701 : 0 : (match_operand:<DWI> 1 "nonimmediate_operand" "%0,0,ro,r,ro,jO,r")
12702 : 0 : (match_operand:<DWI> 2 "x86_64_hilo_general_operand" "r<di>,o,r,<di>,K,<di>,o")))
12703 : 0 : (clobber (reg:CC FLAGS_REG))]
12704 : 1579292 : "ix86_binary_operator_ok (<CODE>, <DWI>mode, operands, TARGET_APX_NDD)"
12705 : 0 : "#"
12706 : 11050 : "&& reload_completed"
12707 : 5523 : [(const_int:DWIH 0)]
12708 : 401421 : {
12709 : 395898 : /* This insn may disappear completely when operands[2] == const0_rtx
12710 : 25431 : and operands[0] == operands[1], which requires a NOTE_INSN_DELETED. */
12711 : 30954 : bool emit_insn_deleted_note_p = false;
12712 : 86765 :
12713 : 30954 : split_double_mode (<DWI>mode, &operands[0], 3, &operands[0], &operands[3]);
12714 : :
12715 : 5523 : if (operands[2] == const0_rtx)
12716 : 73976 : {
12717 : 460081 : if (!rtx_equal_p (operands[0], operands[1]))
12718 : 0 : emit_move_insn (operands[0], operands[1]);
12719 : 73976 : else
12720 : 76365 : emit_insn_deleted_note_p = true;
12721 : 2389 : }
12722 : 463800 : else if (operands[2] == constm1_rtx)
12723 : 149627 : {
12724 : 385213 : if (<CODE> == IOR)
12725 : 3 : emit_move_insn (operands[0], constm1_rtx);
12726 : 385203 : else
12727 : 385203 : ix86_expand_unary_operator (NOT, <MODE>mode, &operands[0],
12728 : 7 : TARGET_APX_NDD);
12729 : : }
12730 : : else
12731 : 4611 : ix86_expand_binary_operator (<CODE>, <MODE>mode, &operands[0],
12732 : 4611 : TARGET_APX_NDD);
12733 : :
12734 : 5523 : if (operands[5] == const0_rtx)
12735 : : {
12736 : 95 : if (!rtx_equal_p (operands[3], operands[4]))
12737 : 6 : emit_move_insn (operands[3], operands[4]);
12738 : 89 : else if (emit_insn_deleted_note_p)
12739 : 14 : emit_note (NOTE_INSN_DELETED);
12740 : : }
12741 : 5428 : else if (operands[5] == constm1_rtx)
12742 : : {
12743 : 239 : if (<CODE> == IOR)
12744 : 95 : emit_move_insn (operands[3], constm1_rtx);
12745 : : else
12746 : 144 : ix86_expand_unary_operator (NOT, <MODE>mode, &operands[3],
12747 : 144 : TARGET_APX_NDD);
12748 : : }
12749 : : else
12750 : 5189 : ix86_expand_binary_operator (<CODE>, <MODE>mode, &operands[3],
12751 : 5189 : TARGET_APX_NDD);
12752 : :
12753 : 5523 : DONE;
12754 : : }
12755 : : [(set_attr "isa" "*,*,apx_ndd,apx_ndd,apx_ndd,apx_ndd_64,apx_ndd")])
12756 : :
12757 : : (define_insn "*<code><mode>_1"
12758 : : [(set (match_operand:SWI248 0 "nonimmediate_operand" "=rm,r,r,r,r,?k")
12759 : : (any_or:SWI248
12760 : : (match_operand:SWI248 1 "nonimmediate_operand" "%0,0,rm,rjM,r,k")
12761 : : (match_operand:SWI248 2 "<general_operand>" "r<i>,<m>,r,<i>,<m>,k")))
12762 : : (clobber (reg:CC FLAGS_REG))]
12763 : 789069 : "ix86_binary_operator_ok (<CODE>, <MODE>mode, operands, TARGET_APX_NDD)"
12764 : : "@
12765 : 132725 : <logic>{<imodesuffix>}\t{%2, %0|%0, %2}
12766 : 135897 : <logic>{<imodesuffix>}\t{%2, %0|%0, %2}
12767 : 383745 : <logic>{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
12768 : 386917 : <logic>{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
12769 : 3134 : <logic>{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
12770 : 178 : #"
12771 : 3312 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd,apx_ndd,<kmov_isa>")
12772 : 93424 : (set_attr "type" "alu, alu, alu, alu, alu, msklog")
12773 : 93386 : (set_attr "mode" "<MODE>")])
12774 : 38 :
12775 : 13110 : (define_insn_and_split "*notxor<mode>_1"
12776 : 13110 : [(set (match_operand:SWI248 0 "nonimmediate_operand" "=rm,r,r,r,?k")
12777 : : (not:SWI248
12778 : 848 : (xor:SWI248
12779 : 848 : (match_operand:SWI248 1 "nonimmediate_operand" "%0,0,rm,r,k")
12780 : 229 : (match_operand:SWI248 2 "<general_operand>" "r<i>,<m>,r<i>,<m>,k"))))
12781 : 13 : (clobber (reg:CC FLAGS_REG))]
12782 : 2173 : "ix86_binary_operator_ok (XOR, <MODE>mode, operands, TARGET_APX_NDD)"
12783 : 845 : "#"
12784 : 1749 : "&& reload_completed"
12785 : 1587 : [(parallel
12786 : 303 : [(set (match_dup 0)
12787 : 754 : (xor:SWI248 (match_dup 1) (match_dup 2)))
12788 : 1506 : (clobber (reg:CC FLAGS_REG))])
12789 : 2596 : (set (match_dup 0)
12790 : 2217 : (not:SWI248 (match_dup 0)))]
12791 : 622 : {
12792 : 303 : if (MASK_REG_P (operands[0]))
12793 : : {
12794 : 3 : emit_insn (gen_kxnor<mode> (operands[0], operands[1], operands[2]));
12795 : 3 : DONE;
12796 : : }
12797 : : }
12798 : : [(set_attr "isa" "*,*,apx_ndd,apx_ndd,<kmov_isa>")
12799 : : (set_attr "type" "alu, alu, alu, alu, msklog")
12800 : 300 : (set_attr "mode" "<MODE>")])
12801 : 300 :
12802 : 300 : (define_insn_and_split "*iordi_1_bts"
12803 : 300 : [(set (match_operand:DI 0 "nonimmediate_operand" "=rm")
12804 : 300 : (ior:DI
12805 : 300 : (match_operand:DI 1 "nonimmediate_operand" "%0")
12806 : 300 : (match_operand:DI 2 "const_int_operand" "n")))
12807 : : (clobber (reg:CC FLAGS_REG))]
12808 : 89996 : "TARGET_64BIT && TARGET_USE_BT
12809 : 88828 : && ix86_binary_operator_ok (IOR, DImode, operands)
12810 : 110607 : && IN_RANGE (exact_log2 (INTVAL (operands[2])), 31, 63)"
12811 : 41708 : "#"
12812 : 3884 : "&& reload_completed"
12813 : 5514 : [(parallel [(set (zero_extract:DI (match_dup 0)
12814 : 5616 : (const_int 1)
12815 : 260900 : (match_dup 3))
12816 : 153104 : (const_int 1))
12817 : 36617 : (clobber (reg:CC FLAGS_REG))])]
12818 : 23948 : "operands[3] = GEN_INT (exact_log2 (INTVAL (operands[2])));"
12819 : 36317 : [(set_attr "type" "alu1")
12820 : : (set_attr "prefix_0f" "1")
12821 : 2207 : (set_attr "znver1_decode" "double")
12822 : 2207 : (set_attr "mode" "DI")])
12823 : 2207 :
12824 : 4679 : (define_insn_and_split "*xordi_1_btc"
12825 : 2207 : [(set (match_operand:DI 0 "nonimmediate_operand" "=rm")
12826 : 4679 : (xor:DI
12827 : 4679 : (match_operand:DI 1 "nonimmediate_operand" "%0")
12828 : 4679 : (match_operand:DI 2 "const_int_operand" "n")))
12829 : 2207 : (clobber (reg:CC FLAGS_REG))]
12830 : 70200 : "TARGET_64BIT && TARGET_USE_BT
12831 : 72072 : && ix86_binary_operator_ok (XOR, DImode, operands)
12832 : 40364 : && IN_RANGE (exact_log2 (INTVAL (operands[2])), 31, 63)"
12833 : 38849 : "#"
12834 : 4501 : "&& reload_completed"
12835 : 4462 : [(parallel [(set (zero_extract:DI (match_dup 0)
12836 : 2005 : (const_int 1)
12837 : 141428 : (match_dup 3))
12838 : 39159 : (not:DI (zero_extract:DI (match_dup 0)
12839 : 18235 : (const_int 1)
12840 : 8037 : (match_dup 3))))
12841 : 16028 : (clobber (reg:CC FLAGS_REG))])]
12842 : 8782 : "operands[3] = GEN_INT (exact_log2 (INTVAL (operands[2])));"
12843 : : [(set_attr "type" "alu1")
12844 : : (set_attr "prefix_0f" "1")
12845 : 8782 : (set_attr "znver1_decode" "double")
12846 : 4391 : (set_attr "mode" "DI")])
12847 : 8782 :
12848 : 8782 : ;; Optimize a ^ ((a ^ b) & mask) to (~mask & a) | (b & mask)
12849 : 8782 : (define_insn_and_split "*xor2andn"
12850 : 8782 : [(set (match_operand:SWI248 0 "register_operand")
12851 : 8782 : (xor:SWI248
12852 : 4391 : (and:SWI248
12853 : 4391 : (xor:SWI248
12854 : 4391 : (match_operand:SWI248 1 "nonimmediate_operand")
12855 : : (match_operand:SWI248 2 "nonimmediate_operand"))
12856 : : (match_operand:SWI248 3 "nonimmediate_operand"))
12857 : : (match_dup 1)))
12858 : : (clobber (reg:CC FLAGS_REG))]
12859 : 414 : "TARGET_BMI && ix86_pre_reload_split ()"
12860 : 582 : "#"
12861 : 0 : "&& 1"
12862 : 257 : [(parallel [(set (match_dup 4)
12863 : 73 : (and:SWI248
12864 : 325 : (not:SWI248
12865 : 4391 : (match_dup 3))
12866 : 4710 : (match_dup 1)))
12867 : 4391 : (clobber (reg:CC FLAGS_REG))])
12868 : 11931 : (parallel [(set (match_dup 5)
12869 : 15536 : (and:SWI248
12870 : 3605 : (match_dup 3)
12871 : 11931 : (match_dup 2)))
12872 : 11932 : (clobber (reg:CC FLAGS_REG))])
12873 : 43 : (parallel [(set (match_dup 0)
12874 : 11931 : (ior:SWI248
12875 : 42 : (match_dup 4)
12876 : 11538 : (match_dup 5)))
12877 : 11538 : (clobber (reg:CC FLAGS_REG))])]
12878 : 11611 : {
12879 : 11569 : operands[1] = force_reg (<MODE>mode, operands[1]);
12880 : 73 : operands[3] = force_reg (<MODE>mode, operands[3]);
12881 : 77 : operands[4] = gen_reg_rtx (<MODE>mode);
12882 : 119 : operands[5] = gen_reg_rtx (<MODE>mode);
12883 : 0 : })
12884 : 42 :
12885 : : ;; See comment for addsi_1_zext why we do use nonimmediate_operand
12886 : 73 : (define_insn "*<code>si_1_zext"
12887 : 73 : [(set (match_operand:DI 0 "register_operand" "=r,r,r,r")
12888 : 73 : (zero_extend:DI
12889 : 73 : (any_or:SI (match_operand:SI 1 "nonimmediate_operand" "%0,rm,rjM,r")
12890 : 73 : (match_operand:SI 2 "x86_64_general_operand" "rBMe,r,e,BM"))))
12891 : 73 : (clobber (reg:CC FLAGS_REG))]
12892 : 927 : "TARGET_64BIT
12893 : 1677 : && ix86_binary_operator_ok (<CODE>, SImode, operands, TARGET_APX_NDD)"
12894 : 13050 : "@
12895 : 1321 : <logic>{l}\t{%2, %k0|%k0, %2}
12896 : 1321 : <logic>{l}\t{%2, %1, %k0|%k0, %1, %2}
12897 : 3633 : <logic>{l}\t{%2, %1, %k0|%k0, %1, %2}
12898 : 3633 : <logic>{l}\t{%2, %1, %k0|%k0, %1, %2}"
12899 : 7271 : [(set_attr "type" "alu")
12900 : 4979 : (set_attr "isa" "*,apx_ndd,apx_ndd,apx_ndd")
12901 : 1549 : (set_attr "mode" "SI")])
12902 : :
12903 : : (define_insn "*<code>si_1_zext_imm"
12904 : : [(set (match_operand:DI 0 "register_operand" "=r,r")
12905 : : (any_or:DI
12906 : 73 : (zero_extend:DI (match_operand:SI 1 "nonimmediate_operand" "%0,rm"))
12907 : : (match_operand:DI 2 "x86_64_zext_immediate_operand" "Z,Z")))
12908 : : (clobber (reg:CC FLAGS_REG))]
12909 : 50 : "TARGET_64BIT
12910 : 57 : && ix86_binary_operator_ok (<CODE>, SImode, operands, TARGET_APX_NDD)"
12911 : 80729 : "@
12912 : 44 : <logic>{l}\t{%2, %k0|%k0, %2}
12913 : 117 : <logic>{l}\t{%2, %1, %k0|%k0, %1, %2}"
12914 : 39356 : [(set_attr "type" "alu")
12915 : 39356 : (set_attr "isa" "*,apx_ndd")
12916 : 228 : (set_attr "mode" "SI")])
12917 : 30220 :
12918 : 228 : (define_insn "*<code>qi_1"
12919 : 228 : [(set (match_operand:QI 0 "nonimmediate_operand" "=qm,q,r,r,r,?k")
12920 : 697 : (any_or:QI (match_operand:QI 1 "nonimmediate_operand" "%0,0,0,rm,r,k")
12921 : 8839 : (match_operand:QI 2 "general_operand" "qn,m,rn,rn,m,k")))
12922 : 208 : (clobber (reg:CC FLAGS_REG))]
12923 : 316793 : "ix86_binary_operator_ok (<CODE>, QImode, operands, TARGET_APX_NDD)"
12924 : 55903 : "@
12925 : 8766 : <logic>{b}\t{%2, %0|%0, %2}
12926 : 71575 : <logic>{b}\t{%2, %0|%0, %2}
12927 : 96795 : <logic>{l}\t{%k2, %k0|%k0, %k2}
12928 : 78536 : <logic>{b}\t{%2, %1, %0|%0, %1, %2}
12929 : 171355 : <logic>{b}\t{%2, %1, %0|%0, %1, %2}
12930 : 8912 : #"
12931 : 8912 : [(set_attr "isa" "*,*,*,apx_ndd,apx_ndd,avx512f")
12932 : 911 : (set_attr "type" "alu,alu,alu,alu,alu,msklog")
12933 : 8814 : (set (attr "mode")
12934 : 680 : (cond [(eq_attr "alternative" "2")
12935 : 8668 : (const_string "SI")
12936 : 8783 : (and (eq_attr "alternative" "5")
12937 : 8783 : (match_test "!TARGET_AVX512DQ"))
12938 : 0 : (const_string "HI")
12939 : 31 : ]
12940 : : (const_string "QI")))
12941 : : ;; Potential partial reg stall on alternative 2.
12942 : : (set (attr "preferred_for_speed")
12943 : : (cond [(eq_attr "alternative" "2")
12944 : : (symbol_ref "!TARGET_PARTIAL_REG_STALL")]
12945 : : (symbol_ref "true")))])
12946 : :
12947 : : (define_insn_and_split "*notxorqi_1"
12948 : : [(set (match_operand:QI 0 "nonimmediate_operand" "=qm,q,r,r,r,?k")
12949 : : (not:QI
12950 : : (xor:QI (match_operand:QI 1 "nonimmediate_operand" "%0,0,0,rm,r,k")
12951 : : (match_operand:QI 2 "general_operand" "qn,m,rn,rn,m,k"))))
12952 : : (clobber (reg:CC FLAGS_REG))]
12953 : 533 : "ix86_binary_operator_ok (XOR, QImode, operands, TARGET_APX_NDD)"
12954 : 279 : "#"
12955 : 230 : "&& reload_completed"
12956 : 369 : [(parallel
12957 : 115 : [(set (match_dup 0)
12958 : : (xor:QI (match_dup 1) (match_dup 2)))
12959 : : (clobber (reg:CC FLAGS_REG))])
12960 : : (set (match_dup 0)
12961 : 33 : (not:QI (match_dup 0)))]
12962 : 148 : {
12963 : 148 : if (mask_reg_operand (operands[0], QImode))
12964 : 155036 : {
12965 : 150856 : emit_insn (gen_kxnorqi (operands[0], operands[1], operands[2]));
12966 : 15215 : DONE;
12967 : 15214 : }
12968 : 150851 : }
12969 : 1609430 : [(set_attr "isa" "*,*,*,apx_ndd,apx_ndd,avx512f")
12970 : 1609430 : (set_attr "type" "alu,alu,alu,alu,alu,msklog")
12971 : 1524 : (set (attr "mode")
12972 : 1508 : (cond [(eq_attr "alternative" "2")
12973 : 764247 : (const_string "SI")
12974 : 2918 : (and (eq_attr "alternative" "5")
12975 : 601948 : (match_test "!TARGET_AVX512DQ"))
12976 : 601948 : (const_string "HI")
12977 : 114 : ]
12978 : 17520 : (const_string "QI")))
12979 : 17520 : ;; Potential partial reg stall on alternative 2.
12980 : : (set (attr "preferred_for_speed")
12981 : 1 : (cond [(eq_attr "alternative" "2")
12982 : 2 : (symbol_ref "!TARGET_PARTIAL_REG_STALL")]
12983 : : (symbol_ref "true")))])
12984 : 114 :
12985 : : ;; convert (sign_extend:WIDE (any_logic:NARROW (memory, immediate)))
12986 : : ;; to (any_logic:WIDE (sign_extend (memory)), (sign_extend (immediate))).
12987 : 114 : ;; This eliminates sign extension after logic operation.
12988 : 114 :
12989 : 114 : (define_split
12990 : : [(set (match_operand:SWI248 0 "register_operand")
12991 : : (sign_extend:SWI248
12992 : : (any_logic:QI (match_operand:QI 1 "memory_operand")
12993 : : (match_operand:QI 2 "const_int_operand"))))]
12994 : : ""
12995 : 1 : [(set (match_dup 3) (sign_extend:SWI248 (match_dup 1)))
12996 : : (set (match_dup 0) (any_logic:SWI248 (match_dup 3) (match_dup 2)))]
12997 : 37 : "operands[3] = gen_reg_rtx (<MODE>mode);")
12998 : 1 :
12999 : 1 : (define_split
13000 : 38 : [(set (match_operand:SWI48 0 "register_operand")
13001 : 38 : (sign_extend:SWI48
13002 : 1 : (any_logic:HI (match_operand:HI 1 "memory_operand")
13003 : 0 : (match_operand:HI 2 "const_int_operand"))))]
13004 : 1 : ""
13005 : 37 : [(set (match_dup 3) (sign_extend:SWI48 (match_dup 1)))
13006 : 37 : (set (match_dup 0) (any_logic:SWI48 (match_dup 3) (match_dup 2)))]
13007 : 16 : "operands[3] = gen_reg_rtx (<MODE>mode);")
13008 : 37 :
13009 : : (define_split
13010 : 16 : [(set (match_operand:DI 0 "register_operand")
13011 : 37 : (sign_extend:DI
13012 : 16 : (any_logic:SI (match_operand:SI 1 "memory_operand")
13013 : 16 : (match_operand:SI 2 "const_int_operand"))))]
13014 : 32 : "TARGET_64BIT"
13015 : 37 : [(set (match_dup 3) (sign_extend:DI (match_dup 1)))
13016 : 53 : (set (match_dup 0) (any_logic:DI (match_dup 3) (match_dup 2)))]
13017 : 16 : "operands[3] = gen_reg_rtx (DImode);")
13018 : 16 :
13019 : : (define_insn "*<code><mode>_2"
13020 : 16 : [(set (reg FLAGS_REG)
13021 : 16 : (compare (any_or:SWI
13022 : 452 : (match_operand:SWI 1 "nonimmediate_operand" "%0,0,rm,r")
13023 : 493 : (match_operand:SWI 2 "<general_operand>" "<r><i>,<m>,r<i>,<m>"))
13024 : 16 : (const_int 0)))
13025 : 18 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,<r>,r,r")
13026 : 18 : (any_or:SWI (match_dup 1) (match_dup 2)))]
13027 : 116718 : "ix86_match_ccmode (insn, CCNOmode)
13028 : 70984 : && ix86_binary_operator_ok (<CODE>, <MODE>mode, operands, TARGET_APX_NDD)"
13029 : 93 : "@
13030 : 115056 : <logic>{<imodesuffix>}\t{%2, %0|%0, %2}
13031 : 24 : <logic>{<imodesuffix>}\t{%2, %0|%0, %2}
13032 : 49 : <logic>{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}
13033 : 195944 : <logic>{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
13034 : 57234 : [(set_attr "type" "alu")
13035 : 57252 : (set_attr "isa" "*,*,apx_ndd,apx_ndd")
13036 : 113439 : (set_attr "mode" "<MODE>")])
13037 : 34 :
13038 : 18 : ;; See comment for addsi_1_zext why we do use nonimmediate_operand
13039 : 18 : ;; ??? Special case for immediate operand is missing - it is tricky.
13040 : 18 : (define_insn "*<code>si_2_zext"
13041 : 0 : [(set (reg FLAGS_REG)
13042 : 18 : (compare (any_or:SI (match_operand:SI 1 "nonimmediate_operand" "%0,rm,r")
13043 : 3794 : (match_operand:SI 2 "x86_64_general_operand" "rBMe,re,BM"))
13044 : : (const_int 0)))
13045 : 3794 : (set (match_operand:DI 0 "register_operand" "=r,r,r")
13046 : 3794 : (zero_extend:DI (any_or:SI (match_dup 1) (match_dup 2))))]
13047 : 3794 : "TARGET_64BIT && ix86_match_ccmode (insn, CCNOmode)
13048 : 3794 : && ix86_binary_operator_ok (<CODE>, SImode, operands, TARGET_APX_NDD)"
13049 : 3809 : "@
13050 : 9 : <logic>{l}\t{%2, %k0|%k0, %2}
13051 : 3785 : <logic>{l}\t{%2, %1, %k0|%k0, %1, %2}
13052 : 9 : <logic>{l}\t{%2, %1, %k0|%k0, %1, %2}"
13053 : : [(set_attr "type" "alu")
13054 : : (set_attr "isa" "*,apx_ndd,apx_ndd")
13055 : : (set_attr "mode" "SI")])
13056 : 1658 :
13057 : 1658 : (define_insn "*<code>si_2_zext_imm"
13058 : : [(set (reg FLAGS_REG)
13059 : : (compare (any_or:SI
13060 : : (match_operand:SI 1 "nonimmediate_operand" "%0,rm")
13061 : : (match_operand:SI 2 "x86_64_zext_immediate_operand" "Z,Z"))
13062 : : (const_int 0)))
13063 : : (set (match_operand:DI 0 "register_operand" "=r,r")
13064 : : (any_or:DI (zero_extend:DI (match_dup 1)) (match_dup 2)))]
13065 : 0 : "TARGET_64BIT && ix86_match_ccmode (insn, CCNOmode)
13066 : 0 : && ix86_binary_operator_ok (<CODE>, SImode, operands, TARGET_APX_NDD)"
13067 : 0 : "@
13068 : : <logic>{l}\t{%2, %k0|%k0, %2}
13069 : : <logic>{l}\t{%2, %1, %k0|%k0, %1, %2}"
13070 : : [(set_attr "type" "alu")
13071 : : (set_attr "isa" "*,apx_ndd")
13072 : : (set_attr "mode" "SI")])
13073 : :
13074 : 24 : (define_insn "*<code><mode>_3"
13075 : 24 : [(set (reg FLAGS_REG)
13076 : 24 : (compare (any_or:SWI
13077 : : (match_operand:SWI 1 "nonimmediate_operand" "%0")
13078 : : (match_operand:SWI 2 "<general_operand>" "<g>"))
13079 : : (const_int 0)))
13080 : : (clobber (match_scratch:SWI 0 "=<r>"))]
13081 : 12234 : "ix86_match_ccmode (insn, CCNOmode)
13082 : 32117 : && !(MEM_P (operands[1]) && MEM_P (operands[2]))"
13083 : : "<logic>{<imodesuffix>}\t{%2, %0|%0, %2}"
13084 : 19004 : [(set_attr "type" "alu")
13085 : 19004 : (set_attr "mode" "<MODE>")])
13086 : 8583 :
13087 : 9548 : ;; Convert wide OR instructions with immediate operand to shorter QImode
13088 : 33121 : ;; equivalents when possible.
13089 : : ;; Don't do the splitting with memory operands, since it introduces risk
13090 : : ;; of memory mismatch stalls. We may want to do the splitting for optimizing
13091 : : ;; for size, but that can (should?) be handled by generic code instead.
13092 : : ;; Don't do the splitting for APX NDD as NDD does not support *h registers.
13093 : : (define_split
13094 : : [(set (match_operand:SWI248 0 "QIreg_operand")
13095 : : (any_or:SWI248 (match_operand:SWI248 1 "register_operand")
13096 : : (match_operand:SWI248 2 "const_int_operand")))
13097 : : (clobber (reg:CC FLAGS_REG))]
13098 : 39980 : "reload_completed
13099 : 152576 : && (!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun))
13100 : 152576 : && !(INTVAL (operands[2]) & ~(255 << 8))
13101 : 5614 : && !(TARGET_APX_NDD && REGNO (operands[0]) != REGNO (operands[1]))"
13102 : 5176 : [(parallel
13103 : 218098 : [(set (zero_extract:HI (match_dup 0)
13104 : 133527 : (const_int 8)
13105 : 218098 : (const_int 8))
13106 : : (subreg:HI
13107 : : (any_or:QI
13108 : : (subreg:QI
13109 : : (zero_extract:HI (match_dup 1)
13110 : : (const_int 8)
13111 : : (const_int 8)) 0)
13112 : : (match_dup 2)) 0))
13113 : : (clobber (reg:CC FLAGS_REG))])]
13114 : 5614 : {
13115 : : /* Handle the case where INTVAL (operands[2]) == 0. */
13116 : 5614 : if (operands[2] == const0_rtx)
13117 : : {
13118 : 92 : if (!rtx_equal_p (operands[0], operands[1]))
13119 : 0 : emit_move_insn (operands[0], operands[1]);
13120 : : else
13121 : 92 : emit_note (NOTE_INSN_DELETED);
13122 : 92 : DONE;
13123 : : }
13124 : 5522 : operands[0] = gen_lowpart (HImode, operands[0]);
13125 : 5522 : operands[1] = gen_lowpart (HImode, operands[1]);
13126 : 5522 : operands[2] = gen_int_mode (INTVAL (operands[2]) >> 8, QImode);
13127 : : })
13128 : :
13129 : : ;; Since OR can be encoded with sign extended immediate, this is only
13130 : 5522 : ;; profitable when 7th bit is set.
13131 : 5522 : (define_split
13132 : 5522 : [(set (match_operand:SWI248 0 "any_QIreg_operand")
13133 : 5522 : (any_or:SWI248 (match_operand:SWI248 1 "general_operand")
13134 : 5522 : (match_operand:SWI248 2 "const_int_operand")))
13135 : 5522 : (clobber (reg:CC FLAGS_REG))]
13136 : 170033 : "reload_completed
13137 : 164488 : && (!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun))
13138 : 164488 : && !(INTVAL (operands[2]) & ~255)
13139 : 104717 : && (INTVAL (operands[2]) & 128)
13140 : 1782 : && !(TARGET_APX_NDD
13141 : 225 : && !rtx_equal_p (operands[0], operands[1]))"
13142 : 1557 : [(parallel [(set (strict_low_part (match_dup 0))
13143 : : (any_or:QI (match_dup 1)
13144 : : (match_dup 2)))
13145 : 197843 : (clobber (reg:CC FLAGS_REG))])]
13146 : 199625 : {
13147 : 114402 : operands[0] = gen_lowpart (QImode, operands[0]);
13148 : 312221 : operands[1] = gen_lowpart (QImode, operands[1]);
13149 : 1197740 : operands[2] = gen_int_mode (INTVAL (operands[2]), QImode);
13150 : 1195629 : })
13151 : 329 :
13152 : 329 : (define_expand "xorqi_ext_1_cc"
13153 : 5851 : [(parallel
13154 : 7633 : [(set (reg:CCNO FLAGS_REG)
13155 : 5522 : (compare:CCNO
13156 : 1792 : (xor:QI
13157 : 1792 : (subreg:QI
13158 : 1782 : (zero_extract:HI (match_operand:HI 1 "register_operand")
13159 : 1782 : (const_int 8)
13160 : : (const_int 8)) 0)
13161 : 2527 : (match_operand:QI 2 "const_int_operand"))
13162 : : (const_int 0)))
13163 : 2527 : (set (zero_extract:HI (match_operand:HI 0 "register_operand")
13164 : 2527 : (const_int 8)
13165 : 2527 : (const_int 8))
13166 : 2527 : (subreg:HI
13167 : 4309 : (xor:QI
13168 : 1782 : (subreg:QI
13169 : 2527 : (zero_extract:HI (match_dup 1)
13170 : : (const_int 8)
13171 : : (const_int 8)) 0)
13172 : : (match_dup 2)) 0))])])
13173 : :
13174 : 0 : ;; Peephole2 rega = 0; rega op= regb into rega = regb.
13175 : 1084 : (define_peephole2
13176 : : [(parallel [(set (match_operand:SWI 0 "general_reg_operand")
13177 : 1084 : (const_int 0))
13178 : 0 : (clobber (reg:CC FLAGS_REG))])
13179 : 1084 : (parallel [(set (match_dup 0)
13180 : 1084 : (any_or_plus:SWI (match_dup 0)
13181 : 1084 : (match_operand:SWI 1 "<general_operand>")))
13182 : 0 : (clobber (reg:CC FLAGS_REG))])]
13183 : 2814 : "!reg_mentioned_p (operands[0], operands[1])"
13184 : : [(set (match_dup 0) (match_dup 1))])
13185 : 35 :
13186 : 35 : ;; Peephole2 dead instruction in rega = 0; rega op= rega.
13187 : 35 : (define_peephole2
13188 : : [(parallel [(set (match_operand:SWI 0 "general_reg_operand")
13189 : : (const_int 0))
13190 : 0 : (clobber (reg:CC FLAGS_REG))])
13191 : : (parallel [(set (match_dup 0)
13192 : 0 : (any_or_plus:SWI (match_dup 0) (match_dup 0)))
13193 : 0 : (clobber (reg:CC FLAGS_REG))])]
13194 : : ""
13195 : 82 : [(parallel [(set (match_dup 0) (const_int 0))
13196 : 82 : (clobber (reg:CC FLAGS_REG))])])
13197 : 35 :
13198 : 35 : ;; Split DST = (HI<<32)|LO early to minimize register usage.
13199 : 35 : (define_insn_and_split "*concat<mode><dwi>3_1"
13200 : 35 : [(set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,r")
13201 : 70 : (any_or_plus:<DWI>
13202 : : (ashift:<DWI> (match_operand:<DWI> 1 "register_operand" "r,r")
13203 : 546 : (match_operand:QI 2 "const_int_operand"))
13204 : 546 : (zero_extend:<DWI>
13205 : 546 : (match_operand:DWIH 3 "nonimmediate_operand" "r,m"))))]
13206 : 13282 : "INTVAL (operands[2]) == <MODE_SIZE> * BITS_PER_UNIT"
13207 : 0 : "#"
13208 : 0 : "&& reload_completed"
13209 : 0 : [(const_int 0)]
13210 : 3160 : {
13211 : 1580 : split_double_concat (<DWI>mode, operands[0], operands[3],
13212 : 4708 : gen_lowpart (<MODE>mode, operands[1]));
13213 : 7384 : DONE;
13214 : 0 : })
13215 : 0 :
13216 : 0 : (define_insn_and_split "*concat<mode><dwi>3_2"
13217 : 0 : [(set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,r")
13218 : 0 : (any_or_plus:<DWI>
13219 : 0 : (zero_extend:<DWI>
13220 : 233 : (match_operand:DWIH 1 "nonimmediate_operand" "r,m"))
13221 : 233 : (ashift:<DWI> (match_operand:<DWI> 2 "register_operand" "r,r")
13222 : 0 : (match_operand:QI 3 "const_int_operand"))))]
13223 : 0 : "INTVAL (operands[3]) == <MODE_SIZE> * BITS_PER_UNIT"
13224 : 264 : "#"
13225 : 0 : "&& reload_completed"
13226 : 1556 : [(const_int 0)]
13227 : 0 : {
13228 : 0 : split_double_concat (<DWI>mode, operands[0], operands[1],
13229 : 1556 : gen_lowpart (<MODE>mode, operands[2]));
13230 : 0 : DONE;
13231 : 1556 : })
13232 : :
13233 : 0 : (define_insn_and_split "*concat<mode><dwi>3_3"
13234 : : [(set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,r,r,&r,x")
13235 : 0 : (any_or_plus:<DWI>
13236 : 0 : (ashift:<DWI>
13237 : 0 : (zero_extend:<DWI>
13238 : 0 : (match_operand:DWIH 1 "nonimmediate_operand" "r,m,r,m,x"))
13239 : 0 : (match_operand:QI 2 "const_int_operand"))
13240 : 0 : (zero_extend:<DWI>
13241 : 0 : (match_operand:DWIH 3 "nonimmediate_operand" "r,r,m,m,0"))))]
13242 : 201412 : "INTVAL (operands[2]) == <MODE_SIZE> * BITS_PER_UNIT"
13243 : 52 : "#"
13244 : 322 : "&& reload_completed"
13245 : 0 : [(const_int 0)]
13246 : 38768 : {
13247 : 38716 : if (SSE_REG_P (operands[0]))
13248 : 78029 : {
13249 : 156092 : rtx tmp = gen_rtx_REG (V2DImode, REGNO (operands[0]));
13250 : 156 : emit_insn (gen_vec_concatv2di (tmp, operands[3], operands[1]));
13251 : : }
13252 : : else
13253 : 38560 : split_double_concat (<DWI>mode, operands[0], operands[3], operands[1]);
13254 : 38716 : DONE;
13255 : 0 : }
13256 : : [(set_attr "isa" "*,*,*,x64,x64")])
13257 : 0 :
13258 : 0 : (define_insn_and_split "*concat<mode><dwi>3_4"
13259 : 0 : [(set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,r,r,&r")
13260 : 0 : (any_or_plus:<DWI>
13261 : 0 : (zero_extend:<DWI>
13262 : 0 : (match_operand:DWIH 1 "nonimmediate_operand" "r,m,r,m"))
13263 : 0 : (ashift:<DWI>
13264 : 0 : (zero_extend:<DWI>
13265 : 0 : (match_operand:DWIH 2 "nonimmediate_operand" "r,r,m,m"))
13266 : 0 : (match_operand:QI 3 "const_int_operand"))))]
13267 : 38664 : "INTVAL (operands[3]) == <MODE_SIZE> * BITS_PER_UNIT"
13268 : : "#"
13269 : 0 : "&& reload_completed"
13270 : 38664 : [(const_int 0)]
13271 : 0 : {
13272 : 38664 : split_double_concat (<DWI>mode, operands[0], operands[1], operands[2]);
13273 : 204 : DONE;
13274 : 0 : }
13275 : : [(set_attr "isa" "*,*,*,x64")])
13276 : :
13277 : 0 : (define_insn_and_split "*concat<half><mode>3_5"
13278 : : [(set (match_operand:DWI 0 "nonimmediate_operand" "=r,o,o")
13279 : 0 : (any_or_plus:DWI
13280 : 0 : (ashift:DWI (match_operand:DWI 1 "register_operand" "r,r,r")
13281 : 0 : (match_operand:QI 2 "const_int_operand"))
13282 : 0 : (match_operand:DWI 3 "const_scalar_int_operand" "n,n,Wd")))]
13283 : 67780 : "INTVAL (operands[2]) == <MODE_SIZE> * BITS_PER_UNIT / 2
13284 : 227 : && (<MODE>mode == DImode
13285 : 226 : ? CONST_INT_P (operands[3])
13286 : 226 : && (UINTVAL (operands[3]) & ~GET_MODE_MASK (SImode)) == 0
13287 : 1 : : CONST_INT_P (operands[3])
13288 : 1 : ? INTVAL (operands[3]) >= 0
13289 : 0 : : CONST_WIDE_INT_NUNITS (operands[3]) == 2
13290 : 0 : && CONST_WIDE_INT_ELT (operands[3], 1) == 0)
13291 : 176 : && !(CONST_INT_P (operands[3])
13292 : 176 : ? ix86_endbr_immediate_operand (operands[3], VOIDmode)
13293 : 0 : : ix86_endbr_immediate_operand (GEN_INT (CONST_WIDE_INT_ELT (operands[3],
13294 : : 0)),
13295 : 19 : VOIDmode))"
13296 : : "#"
13297 : 0 : "&& reload_completed"
13298 : 371783 : [(const_int 0)]
13299 : 0 : {
13300 : 0 : rtx op3 = simplify_subreg (<HALF>mode, operands[3], <MODE>mode, 0);
13301 : 1628 : split_double_concat (<MODE>mode, operands[0], op3,
13302 : 1838 : gen_lowpart (<HALF>mode, operands[1]));
13303 : 5 : DONE;
13304 : 0 : }
13305 : 1876 : [(set_attr "isa" "*,nox64,x64")])
13306 : 1876 :
13307 : 0 : (define_insn_and_split "*concat<mode><dwi>3_6"
13308 : 1213 : [(set (match_operand:<DWI> 0 "nonimmediate_operand" "=r,o,o,r")
13309 : 1261 : (any_or_plus:<DWI>
13310 : 0 : (ashift:<DWI>
13311 : 0 : (zero_extend:<DWI>
13312 : : (match_operand:DWIH 1 "nonimmediate_operand" "r,r,r,m"))
13313 : 0 : (match_operand:QI 2 "const_int_operand"))
13314 : 0 : (match_operand:<DWI> 3 "const_scalar_int_operand" "n,n,Wd,n")))]
13315 : 5794 : "INTVAL (operands[2]) == <MODE_SIZE> * BITS_PER_UNIT
13316 : 16851 : && (<DWI>mode == DImode
13317 : 0 : ? CONST_INT_P (operands[3])
13318 : 0 : && (UINTVAL (operands[3]) & ~GET_MODE_MASK (SImode)) == 0
13319 : 16907 : : CONST_INT_P (operands[3])
13320 : 16907 : ? INTVAL (operands[3]) >= 0
13321 : 56 : : CONST_WIDE_INT_NUNITS (operands[3]) == 2
13322 : 56 : && CONST_WIDE_INT_ELT (operands[3], 1) == 0)
13323 : 16907 : && !(CONST_INT_P (operands[3])
13324 : 16851 : ? ix86_endbr_immediate_operand (operands[3], VOIDmode)
13325 : 56 : : ix86_endbr_immediate_operand (GEN_INT (CONST_WIDE_INT_ELT (operands[3],
13326 : 0 : 0)),
13327 : 11132 : VOIDmode))"
13328 : 0 : "#"
13329 : 0 : "&& reload_completed"
13330 : 5576 : [(const_int 0)]
13331 : 11132 : {
13332 : 5566 : rtx op3 = simplify_subreg (<MODE>mode, operands[3], <DWI>mode, 0);
13333 : 16699 : split_double_concat (<DWI>mode, operands[0], op3, operands[1]);
13334 : 38964 : DONE;
13335 : 0 : }
13336 : 0 : [(set_attr "isa" "*,nox64,x64,*")])
13337 : 0 :
13338 : : (define_insn_and_split "*concat<mode><dwi>3_7"
13339 : : [(set (match_operand:<DWI> 0 "nonimmediate_operand" "=r,o,o,r")
13340 : : (any_or_plus:<DWI>
13341 : 4336 : (zero_extend:<DWI>
13342 : 4336 : (match_operand:DWIH 1 "nonimmediate_operand" "r,r,r,m"))
13343 : 0 : (match_operand:<DWI> 2 "const_scalar_int_operand" "n,n,Wd,n")))]
13344 : 0 : "<DWI>mode == DImode
13345 : 11176 : ? CONST_INT_P (operands[2])
13346 : 10715 : && (UINTVAL (operands[2]) & GET_MODE_MASK (SImode)) == 0
13347 : 5911 : && !ix86_endbr_immediate_operand (operands[2], VOIDmode)
13348 : 266 : : CONST_WIDE_INT_P (operands[2])
13349 : 156 : && CONST_WIDE_INT_NUNITS (operands[2]) == 2
13350 : 5722 : && CONST_WIDE_INT_ELT (operands[2], 0) == 0
13351 : 116 : && !ix86_endbr_immediate_operand (GEN_INT (CONST_WIDE_INT_ELT (operands[2],
13352 : 5566 : 1)),
13353 : 186 : VOIDmode)"
13354 : 0 : "#"
13355 : 52 : "&& reload_completed"
13356 : 213 : [(const_int 0)]
13357 : 60 : {
13358 : 0 : rtx op2;
13359 : 129 : if (<DWI>mode == DImode)
13360 : 163 : op2 = gen_int_mode (INTVAL (operands[2]) >> 32, <MODE>mode);
13361 : : else
13362 : 34 : op2 = gen_int_mode (CONST_WIDE_INT_ELT (operands[2], 1), <MODE>mode);
13363 : 74367 : split_double_concat (<DWI>mode, operands[0], operands[1], op2);
13364 : 74367 : DONE;
13365 : 186472890 : }
13366 : 458523 : [(set_attr "isa" "*,nox64,x64,*")])
13367 : 186931413 :
13368 : 186931413 : ;; Negation instructions
13369 : 187339978 :
13370 : 186931413 : (define_expand "neg<mode>2"
13371 : 458523 : [(set (match_operand:SDWIM 0 "nonimmediate_operand")
13372 : 186472890 : (neg:SDWIM (match_operand:SDWIM 1 "nonimmediate_operand")))]
13373 : 595616 : ""
13374 : 16152160 : {
13375 : 15743595 : ix86_expand_unary_operator (NEG, <MODE>mode, operands, TARGET_APX_NDD);
13376 : 234664 : DONE;
13377 : 294123 : })
13378 : 127189252 :
13379 : 127189287 : (define_insn_and_split "*neg<dwi>2_doubleword"
13380 : 127191691 : [(set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,&r")
13381 : 408565 : (neg:<DWI> (match_operand:<DWI> 1 "nonimmediate_operand" "0,ro")))
13382 : 126780747 : (clobber (reg:CC FLAGS_REG))]
13383 : 221588 : "ix86_unary_operator_ok (NEG, <DWI>mode, operands, TARGET_APX_NDD)"
13384 : 126793774 : "#"
13385 : 10743 : "&& reload_completed"
13386 : 64067 : [(parallel
13387 : 2661 : [(set (reg:CCC FLAGS_REG)
13388 : 10627 : (unspec:CCC [(match_dup 1) (const_int 0)] UNSPEC_CC_NE))
13389 : 126785431 : (set (match_dup 0) (neg:DWIH (match_dup 1)))])
13390 : 4744 : (parallel
13391 : 126792392 : [(set (match_dup 2)
13392 : 126785431 : (plus:DWIH (plus:DWIH (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0))
13393 : 13932 : (match_dup 3))
13394 : 124650418 : (const_int 0)))
13395 : 52578 : (clobber (reg:CC FLAGS_REG))])
13396 : 3967 : (parallel
13397 : 53264013 : [(set (match_dup 2)
13398 : 53309859 : (neg:DWIH (match_dup 2)))
13399 : 45497 : (clobber (reg:CC FLAGS_REG))])]
13400 : 6124 : "split_double_mode (<DWI>mode, &operands[0], 2, &operands[0], &operands[2]);"
13401 : 0 : [(set_attr "isa" "*,apx_ndd")])
13402 : 2286 :
13403 : 48132 : ;; Convert:
13404 : 2286 : ;; mov %esi, %edx
13405 : 349 : ;; negl %eax
13406 : 4947 : ;; adcl $0, %edx
13407 : 4947 : ;; negl %edx
13408 : 4947 : ;; to:
13409 : 4966 : ;; xorl %edx, %edx
13410 : 2661 : ;; negl %eax
13411 : 4947 : ;; sbbl %esi, %edx
13412 : 2305 :
13413 : 2305 : (define_peephole2
13414 : 4591 : [(set (match_operand:SWI48 0 "general_reg_operand")
13415 : 0 : (match_operand:SWI48 1 "nonimmediate_gr_operand"))
13416 : 19 : (parallel
13417 : 19 : [(set (reg:CCC FLAGS_REG)
13418 : 19 : (unspec:CCC [(match_operand:SWI48 2 "general_reg_operand")
13419 : 19 : (const_int 0)] UNSPEC_CC_NE))
13420 : 19 : (set (match_dup 2) (neg:SWI48 (match_dup 2)))])
13421 : 19 : (parallel
13422 : : [(set (match_dup 0)
13423 : 2680 : (plus:SWI48 (plus:SWI48
13424 : 19 : (ltu:SWI48 (reg:CC FLAGS_REG) (const_int 0))
13425 : 19 : (match_dup 0))
13426 : : (const_int 0)))
13427 : : (clobber (reg:CC FLAGS_REG))])
13428 : : (parallel
13429 : : [(set (match_dup 0)
13430 : : (neg:SWI48 (match_dup 0)))
13431 : 821 : (clobber (reg:CC FLAGS_REG))])]
13432 : 453 : "REGNO (operands[0]) != REGNO (operands[2])
13433 : 1274 : && !reg_mentioned_p (operands[0], operands[1])
13434 : 1274 : && !reg_mentioned_p (operands[2], operands[1])"
13435 : 2661 : [(parallel
13436 : 905 : [(set (reg:CCC FLAGS_REG)
13437 : 84 : (unspec:CCC [(match_dup 2) (const_int 0)] UNSPEC_CC_NE))
13438 : 905 : (set (match_dup 2) (neg:SWI48 (match_dup 2)))])
13439 : 821 : (parallel
13440 : 821 : [(set (match_dup 0)
13441 : 690593 : (minus:SWI48 (minus:SWI48
13442 : 2661 : (match_dup 0)
13443 : 221768 : (ltu:SWI48 (reg:CC FLAGS_REG) (const_int 0)))
13444 : 220947 : (match_dup 1)))
13445 : 221768 : (clobber (reg:CC FLAGS_REG))])]
13446 : 1274 : "ix86_expand_clear (operands[0]);")
13447 : 6168 :
13448 : 5347 : ;; Convert:
13449 : 8196 : ;; xorl %edx, %edx
13450 : 453 : ;; negl %eax
13451 : 2881 : ;; adcl $0, %edx
13452 : 2881 : ;; negl %edx
13453 : 2888 : ;; to:
13454 : 2849 : ;; negl %eax
13455 : 537 : ;; sbbl %edx, %edx // *x86_mov<mode>cc_0_m1
13456 : 2312 :
13457 : 84 : (define_peephole2
13458 : 2319 : [(parallel
13459 : 0 : [(set (match_operand:SWI48 0 "general_reg_operand") (const_int 0))
13460 : 4807616 : (clobber (reg:CC FLAGS_REG))])
13461 : 7 : (parallel
13462 : 891508 : [(set (reg:CCC FLAGS_REG)
13463 : 7 : (unspec:CCC [(match_operand:SWI48 1 "general_reg_operand")
13464 : 186 : (const_int 0)] UNSPEC_CC_NE))
13465 : 265 : (set (match_dup 1) (neg:SWI48 (match_dup 1)))])
13466 : : (parallel
13467 : 460 : [(set (match_dup 0)
13468 : 7 : (plus:SWI48 (plus:SWI48
13469 : 7 : (ltu:SWI48 (reg:CC FLAGS_REG) (const_int 0))
13470 : : (match_dup 0))
13471 : : (const_int 0)))
13472 : : (clobber (reg:CC FLAGS_REG))])
13473 : : (parallel
13474 : : [(set (match_dup 0)
13475 : 0 : (neg:SWI48 (match_dup 0)))
13476 : : (clobber (reg:CC FLAGS_REG))])]
13477 : 98 : "REGNO (operands[0]) != REGNO (operands[1])"
13478 : 0 : [(parallel
13479 : 500 : [(set (reg:CCC FLAGS_REG)
13480 : 500 : (unspec:CCC [(match_dup 1) (const_int 0)] UNSPEC_CC_NE))
13481 : 0 : (set (match_dup 1) (neg:SWI48 (match_dup 1)))])
13482 : 0 : (parallel
13483 : 0 : [(set (match_dup 0)
13484 : 0 : (if_then_else:SWI48 (ltu:SWI48 (reg:CC FLAGS_REG) (const_int 0))
13485 : : (const_int -1)
13486 : 1098462 : (const_int 0)))
13487 : 1098878 : (clobber (reg:CC FLAGS_REG))])])
13488 : 1098462 :
13489 : 47 : (define_insn "*neg<mode>_1"
13490 : 48 : [(set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,r")
13491 : 417 : (neg:SWI (match_operand:SWI 1 "nonimmediate_operand" "0,rm")))
13492 : 416 : (clobber (reg:CC FLAGS_REG))]
13493 : 143302 : "ix86_unary_operator_ok (NEG, <MODE>mode, operands, TARGET_APX_NDD)"
13494 : 3537 : "@
13495 : 24635 : neg{<imodesuffix>}\t%0
13496 : 24266 : neg{<imodesuffix>}\t{%1, %0|%0, %1}"
13497 : 34543 : [(set_attr "type" "negnot")
13498 : 34543 : (set_attr "isa" "*,apx_ndd")
13499 : 44405 : (set_attr "mode" "<MODE>")])
13500 : 46202 :
13501 : 81936 : (define_insn "*negsi_1_zext"
13502 : 2372 : [(set (match_operand:DI 0 "register_operand" "=r,r")
13503 : 4791 : (zero_extend:DI
13504 : 4837 : (neg:SI (match_operand:SI 1 "nonimmediate_operand" "0,rm"))))
13505 : 166 : (clobber (reg:CC FLAGS_REG))]
13506 : 491 : "TARGET_64BIT
13507 : 477 : && ix86_unary_operator_ok (NEG, SImode, operands, TARGET_APX_NDD)"
13508 : 3246 : "@
13509 : 354 : neg{l}\t%k0
13510 : 354 : neg{l}\t{%k1, %k0|%k0, %k1}"
13511 : 2150 : [(set_attr "type" "negnot")
13512 : 2103 : (set_attr "isa" "*,apx_ndd")
13513 : 4403 : (set_attr "mode" "SI")])
13514 : 808 :
13515 : : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
13516 : : (define_insn_and_split "*neg<mode>_1_slp"
13517 : : [(set (strict_low_part (match_operand:SWI12 0 "register_operand" "+<r>,&<r>"))
13518 : : (neg:SWI12 (match_operand:SWI12 1 "register_operand" "0,!<r>")))
13519 : 0 : (clobber (reg:CC FLAGS_REG))]
13520 : 7 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
13521 : 0 : "@
13522 : 48 : neg{<imodesuffix>}\t%0
13523 : 48 : #"
13524 : 61 : "&& reload_completed
13525 : 13 : && !(rtx_equal_p (operands[0], operands[1]))"
13526 : 13 : [(set (strict_low_part (match_dup 0)) (match_dup 1))
13527 : 1 : (parallel
13528 : 307 : [(set (strict_low_part (match_dup 0))
13529 : 307 : (neg:SWI12 (match_dup 0)))
13530 : 51 : (clobber (reg:CC FLAGS_REG))])]
13531 : 10 : ""
13532 : 61 : [(set_attr "type" "negnot")
13533 : 194 : (set_attr "mode" "<MODE>")])
13534 : 194 :
13535 : 51 : (define_insn "*neg<mode>_2"
13536 : 171 : [(set (reg FLAGS_REG)
13537 : 222 : (compare
13538 : 167 : (neg:SWI (match_operand:SWI 1 "nonimmediate_operand" "0,rm"))
13539 : 217 : (const_int 0)))
13540 : 217 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,r")
13541 : 1 : (neg:SWI (match_dup 1)))]
13542 : 122 : "ix86_match_ccmode (insn, CCGOCmode)
13543 : 6373 : && ix86_unary_operator_ok (NEG, <MODE>mode, operands, TARGET_APX_NDD)"
13544 : 100 : "@
13545 : 0 : neg{<imodesuffix>}\t%0
13546 : 0 : neg{<imodesuffix>}\t{%1, %0|%0, %1}"
13547 : 6302 : [(set_attr "type" "negnot")
13548 : 12440 : (set_attr "isa" "*,apx_ndd")
13549 : 1 : (set_attr "mode" "<MODE>")])
13550 : 0 :
13551 : : (define_insn "*negsi_2_zext"
13552 : : [(set (reg FLAGS_REG)
13553 : : (compare
13554 : 51 : (neg:SI (match_operand:SI 1 "nonimmediate_operand" "0,rm"))
13555 : 0 : (const_int 0)))
13556 : 0 : (set (match_operand:DI 0 "register_operand" "=r,r")
13557 : 0 : (zero_extend:DI
13558 : 246 : (neg:SI (match_dup 1))))]
13559 : 0 : "TARGET_64BIT && ix86_match_ccmode (insn, CCGOCmode)
13560 : 0 : && ix86_unary_operator_ok (NEG, SImode, operands, TARGET_APX_NDD)"
13561 : 0 : "@
13562 : 0 : neg{l}\t%k0
13563 : 0 : neg{l}\t{%1, %k0|%k0, %1}"
13564 : : [(set_attr "type" "negnot")
13565 : 51 : (set_attr "isa" "*,apx_ndd")
13566 : 51 : (set_attr "mode" "SI")])
13567 : 0 :
13568 : 0 : (define_insn "*neg<mode>_ccc_1"
13569 : 0 : [(set (reg:CCC FLAGS_REG)
13570 : 0 : (unspec:CCC
13571 : 0 : [(match_operand:SWI 1 "nonimmediate_operand" "0,rm")
13572 : 0 : (const_int 0)] UNSPEC_CC_NE))
13573 : 1 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,r")
13574 : 4765563 : (neg:SWI (match_dup 1)))]
13575 : 1 : ""
13576 : 1 : "@
13577 : 232 : neg{<imodesuffix>}\t%0
13578 : 4765332 : neg{<imodesuffix>}\t{%1, %0|%0, %1}"
13579 : 4765331 : [(set_attr "type" "negnot")
13580 : 4765332 : (set_attr "isa" "*,apx_ndd")
13581 : 4765331 : (set_attr "mode" "<MODE>")])
13582 : 4765331 :
13583 : 4765331 : (define_insn "*neg<mode>_ccc_2"
13584 : 4765331 : [(set (reg:CCC FLAGS_REG)
13585 : 4765331 : (unspec:CCC
13586 : 4765331 : [(match_operand:SWI 1 "nonimmediate_operand" "0,rm")
13587 : 4765331 : (const_int 0)] UNSPEC_CC_NE))
13588 : 0 : (clobber (match_scratch:SWI 0 "=<r>,r"))]
13589 : 1271841 : ""
13590 : 1271841 : "@
13591 : 0 : neg{<imodesuffix>}\t%0
13592 : 25222 : neg{<imodesuffix>}\t{%1, %0|%0, %1}"
13593 : 25222 : [(set_attr "type" "negnot")
13594 : 0 : (set_attr "isa" "*,apx_ndd")
13595 : 2250925 : (set_attr "mode" "<MODE>")])
13596 : 2250925 :
13597 : 2250925 : (define_expand "x86_neg<mode>_ccc"
13598 : 2250925 : [(parallel
13599 : 2250925 : [(set (reg:CCC FLAGS_REG)
13600 : 2250925 : (unspec:CCC [(match_operand:SWI48 1 "register_operand")
13601 : 2250925 : (const_int 0)] UNSPEC_CC_NE))
13602 : 0 : (set (match_operand:SWI48 0 "register_operand")
13603 : 2250925 : (neg:SWI48 (match_dup 1)))])])
13604 : 2250925 :
13605 : 2250925 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
13606 : 2250925 : (define_insn_and_split "*negqi_ext<mode>_1"
13607 : 0 : [(set (zero_extract:SWI248
13608 : 2221428 : (match_operand 0 "int248_register_operand" "+Q,&Q")
13609 : 0 : (const_int 8)
13610 : 895797 : (const_int 8))
13611 : 895797 : (subreg:SWI248
13612 : 0 : (neg:QI
13613 : 895604 : (subreg:QI
13614 : 895604 : (match_operator:SWI248 2 "extract_operator"
13615 : 895604 : [(match_operand 1 "int248_register_operand" "0,!Q")
13616 : 895604 : (const_int 8)
13617 : : (const_int 8)]) 0)) 0))
13618 : 259 : (clobber (reg:CC FLAGS_REG))]
13619 : 259 : ""
13620 : 259 : "@
13621 : 0 : neg{b}\t%h0
13622 : 193 : #"
13623 : 10 : "reload_completed
13624 : 13 : && !(rtx_equal_p (operands[0], operands[1]))"
13625 : 26 : [(set (zero_extract:SWI248
13626 : 1 : (match_dup 0) (const_int 8) (const_int 8))
13627 : 13 : (zero_extract:SWI248
13628 : 4 : (match_dup 1) (const_int 8) (const_int 8)))
13629 : 7 : (parallel
13630 : 8 : [(set (zero_extract:SWI248
13631 : 0 : (match_dup 0) (const_int 8) (const_int 8))
13632 : 0 : (subreg:SWI248
13633 : 0 : (neg:QI
13634 : 0 : (subreg:QI
13635 : 0 : (match_op_dup 2
13636 : 0 : [(match_dup 0) (const_int 8) (const_int 8)]) 0)) 0))
13637 : 0 : (clobber (reg:CC FLAGS_REG))])]
13638 : 0 : ""
13639 : : [(set_attr "type" "negnot")
13640 : : (set_attr "mode" "QI")])
13641 : 1 :
13642 : 1 : ;; Negate with jump on overflow.
13643 : 0 : (define_expand "negv<mode>3"
13644 : 0 : [(parallel [(set (reg:CCO FLAGS_REG)
13645 : 1 : (unspec:CCO
13646 : 1 : [(match_operand:SWI 1 "register_operand")
13647 : 1 : (match_dup 3)] UNSPEC_CC_NE))
13648 : : (set (match_operand:SWI 0 "register_operand")
13649 : : (neg:SWI (match_dup 1)))])
13650 : : (set (pc) (if_then_else
13651 : 0 : (eq (reg:CCO FLAGS_REG) (const_int 0))
13652 : : (label_ref (match_operand 2))
13653 : 0 : (pc)))]
13654 : 0 : ""
13655 : 1 : {
13656 : 0 : operands[3]
13657 : 946 : = gen_int_mode (HOST_WIDE_INT_1U << (GET_MODE_BITSIZE (<MODE>mode) - 1),
13658 : 0 : <MODE>mode);
13659 : 0 : })
13660 : 0 :
13661 : : (define_insn "*negv<mode>3"
13662 : 946 : [(set (reg:CCO FLAGS_REG)
13663 : 946 : (unspec:CCO [(match_operand:SWI 1 "nonimmediate_operand" "0")
13664 : 946 : (match_operand:SWI 2 "const_int_operand")]
13665 : 0 : UNSPEC_CC_NE))
13666 : 0 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m")
13667 : 946 : (neg:SWI (match_dup 1)))]
13668 : 2363 : "ix86_unary_operator_ok (NEG, <MODE>mode, operands)
13669 : 2252 : && mode_signbit_p (<MODE>mode, operands[2])"
13670 : 111 : "neg{<imodesuffix>}\t%0"
13671 : 947 : [(set_attr "type" "negnot")
13672 : 1 : (set_attr "mode" "<MODE>")])
13673 : 1250 :
13674 : 1249 : ;; Optimize *negsi_1 followed by *cmpsi_ccno_1 (PR target/91384)
13675 : 3676 : (define_peephole2
13676 : 0 : [(set (match_operand:SWI 0 "general_reg_operand")
13677 : 0 : (match_operand:SWI 1 "general_reg_operand"))
13678 : 0 : (parallel [(set (match_dup 0) (neg:SWI (match_dup 0)))
13679 : 1 : (clobber (reg:CC FLAGS_REG))])
13680 : 0 : (set (reg:CCZ FLAGS_REG) (compare:CCZ (match_dup 1) (const_int 0)))]
13681 : 1 : ""
13682 : 0 : [(set (match_dup 0) (match_dup 1))
13683 : 946 : (parallel [(set (reg:CCZ FLAGS_REG)
13684 : 80 : (compare:CCZ (neg:SWI (match_dup 0)) (const_int 0)))
13685 : 1 : (set (match_dup 0) (neg:SWI (match_dup 0)))])])
13686 : 0 :
13687 : 1 : ;; Special expand pattern to handle integer mode abs
13688 : 0 :
13689 : 80 : (define_expand "abs<mode>2"
13690 : : [(parallel
13691 : : [(set (match_operand:SDWIM 0 "register_operand")
13692 : 946 : (abs:SDWIM
13693 : 946 : (match_operand:SDWIM 1 "general_operand")))
13694 : 946 : (clobber (reg:CC FLAGS_REG))])]
13695 : 0 : "TARGET_CMOVE
13696 : : && (<MODE>mode != QImode || !TARGET_PARTIAL_REG_STALL)"
13697 : 3438 : {
13698 : 3438 : if (TARGET_EXPAND_ABS)
13699 : 866 : {
13700 : 0 : machine_mode mode = <MODE>mode;
13701 : 7 : operands[1] = force_reg (mode, operands[1]);
13702 : 0 :
13703 : 866 : /* Generate rtx abs using:
13704 : 0 : abs (x) = (((signed) x >> (W-1)) ^ x) - ((signed) x >> (W-1)) */
13705 : 866 :
13706 : 7 : rtx shift_amount = gen_int_mode (GET_MODE_PRECISION (mode) - 1, QImode);
13707 : 7 : rtx shift_dst = expand_simple_binop (mode, ASHIFTRT, operands[1],
13708 : 866 : shift_amount, NULL_RTX,
13709 : 0 : 0, OPTAB_DIRECT);
13710 : 873 : rtx xor_dst = expand_simple_binop (mode, XOR, shift_dst, operands[1],
13711 : 0 : operands[0], 0, OPTAB_DIRECT);
13712 : 7 : rtx minus_dst = expand_simple_binop (mode, MINUS, xor_dst, shift_dst,
13713 : : operands[0], 0, OPTAB_DIRECT);
13714 : 7 : if (!rtx_equal_p (minus_dst, operands[0]))
13715 : 0 : emit_move_insn (operands[0], minus_dst);
13716 : 7 : DONE;
13717 : 1 : }
13718 : : })
13719 : 1 :
13720 : 1 : (define_insn_and_split "*abs<dwi>2_doubleword"
13721 : 1 : [(set (match_operand:<DWI> 0 "register_operand")
13722 : 0 : (abs:<DWI>
13723 : 1 : (match_operand:<DWI> 1 "general_operand")))
13724 : 3432 : (clobber (reg:CC FLAGS_REG))]
13725 : 143 : "TARGET_CMOVE
13726 : 10765 : && ix86_pre_reload_split ()"
13727 : 0 : "#"
13728 : : "&& 1"
13729 : 44 : [(parallel
13730 : 1379 : [(set (reg:CCC FLAGS_REG)
13731 : 1 : (unspec:CCC [(match_dup 1) (const_int 0)] UNSPEC_CC_NE))
13732 : 3507 : (set (match_dup 2) (neg:DWIH (match_dup 1)))])
13733 : 3507 : (parallel
13734 : 3506 : [(set (match_dup 5)
13735 : 75 : (plus:DWIH (plus:DWIH (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0))
13736 : 134 : (match_dup 4))
13737 : 0 : (const_int 0)))
13738 : 0 : (clobber (reg:CC FLAGS_REG))])
13739 : 3403 : (parallel
13740 : 0 : [(set (reg:CCGOC FLAGS_REG)
13741 : 24 : (compare:CCGOC
13742 : 24 : (neg:DWIH (match_dup 5))
13743 : 3379 : (const_int 0)))
13744 : 24 : (set (match_dup 5)
13745 : 0 : (neg:DWIH (match_dup 5)))])
13746 : 3418 : (set (match_dup 0)
13747 : 3379 : (if_then_else:DWIH
13748 : 39 : (ge (reg:CCGOC FLAGS_REG) (const_int 0))
13749 : 39 : (match_dup 2)
13750 : 0 : (match_dup 1)))
13751 : 39 : (set (match_dup 3)
13752 : : (if_then_else:DWIH
13753 : : (ge (reg:CCGOC FLAGS_REG) (const_int 0))
13754 : : (match_dup 5)
13755 : : (match_dup 4)))]
13756 : 170 : {
13757 : 170 : operands[1] = force_reg (<DWI>mode, operands[1]);
13758 : 170 : operands[2] = gen_reg_rtx (<DWI>mode);
13759 : 0 :
13760 : 170 : split_double_mode (<DWI>mode, &operands[0], 3, &operands[0], &operands[3]);
13761 : : })
13762 : :
13763 : : (define_insn_and_split "*nabs<dwi>2_doubleword"
13764 : 170 : [(set (match_operand:<DWI> 0 "register_operand")
13765 : 170 : (neg:<DWI>
13766 : 202 : (abs:<DWI>
13767 : 170 : (match_operand:<DWI> 1 "general_operand"))))
13768 : 202 : (clobber (reg:CC FLAGS_REG))]
13769 : 207 : "TARGET_CMOVE
13770 : 217 : && ix86_pre_reload_split ()"
13771 : 32 : "#"
13772 : 0 : "&& 1"
13773 : 34 : [(parallel
13774 : 205 : [(set (reg:CCC FLAGS_REG)
13775 : 202 : (unspec:CCC [(match_dup 1) (const_int 0)] UNSPEC_CC_NE))
13776 : 170 : (set (match_dup 2) (neg:DWIH (match_dup 1)))])
13777 : 32 : (parallel
13778 : 32 : [(set (match_dup 5)
13779 : : (plus:DWIH (plus:DWIH (ltu:DWIH (reg:CC FLAGS_REG) (const_int 0))
13780 : 32 : (match_dup 4))
13781 : : (const_int 0)))
13782 : : (clobber (reg:CC FLAGS_REG))])
13783 : : (parallel
13784 : : [(set (reg:CCGOC FLAGS_REG)
13785 : : (compare:CCGOC
13786 : : (neg:DWIH (match_dup 5))
13787 : : (const_int 0)))
13788 : 170 : (set (match_dup 5)
13789 : : (neg:DWIH (match_dup 5)))])
13790 : : (set (match_dup 0)
13791 : 32 : (if_then_else:DWIH
13792 : 32 : (lt (reg:CCGOC FLAGS_REG) (const_int 0))
13793 : 32 : (match_dup 2)
13794 : : (match_dup 1)))
13795 : : (set (match_dup 3)
13796 : : (if_then_else:DWIH
13797 : : (lt (reg:CCGOC FLAGS_REG) (const_int 0))
13798 : : (match_dup 5)
13799 : 218 : (match_dup 4)))]
13800 : 170 : {
13801 : 2 : operands[1] = force_reg (<DWI>mode, operands[1]);
13802 : 2 : operands[2] = gen_reg_rtx (<DWI>mode);
13803 : 218 :
13804 : 220 : split_double_mode (<DWI>mode, &operands[0], 3, &operands[0], &operands[3]);
13805 : 0 : })
13806 : 218 :
13807 : 218 : (define_insn_and_split "*abs<mode>2_1"
13808 : 220 : [(set (match_operand:SWI 0 "register_operand")
13809 : 220 : (abs:SWI
13810 : 220 : (match_operand:SWI 1 "general_operand")))
13811 : 388 : (clobber (reg:CC FLAGS_REG))]
13812 : 8631 : "TARGET_CMOVE
13813 : 416 : && (<MODE>mode != QImode || !TARGET_PARTIAL_REG_STALL)
13814 : 13566 : && ix86_pre_reload_split ()"
13815 : 3258 : "#"
13816 : 2823 : "&& 1"
13817 : 3192 : [(parallel
13818 : 3177 : [(set (reg:CCGOC FLAGS_REG)
13819 : 4374 : (compare:CCGOC
13820 : 14604 : (neg:SWI (match_dup 1))
13821 : 17604 : (const_int 0)))
13822 : 30367 : (set (match_dup 2)
13823 : 3335 : (neg:SWI (match_dup 1)))])
13824 : 15470 : (set (match_dup 0)
13825 : 525 : (if_then_else:SWI
13826 : 218 : (ge (reg:CCGOC FLAGS_REG) (const_int 0))
13827 : 170 : (match_dup 2)
13828 : 170 : (match_dup 1)))]
13829 : 1555514 : {
13830 : 1555344 : operands[1] = force_reg (<MODE>mode, operands[1]);
13831 : 1555344 : operands[2] = gen_reg_rtx (<MODE>mode);
13832 : 1552171 : })
13833 : 1552169 :
13834 : 1552228 : (define_insn_and_split "*nabs<mode>2_1"
13835 : 1552361 : [(set (match_operand:SWI 0 "register_operand")
13836 : 1555403 : (neg:SWI
13837 : 3367 : (abs:SWI
13838 : 730807 : (match_operand:SWI 1 "general_operand"))))
13839 : 727499 : (clobber (reg:CC FLAGS_REG))]
13840 : 3318 : "TARGET_CMOVE
13841 : 3175 : && (<MODE>mode != QImode || !TARGET_PARTIAL_REG_STALL)
13842 : 270 : && ix86_pre_reload_split ()"
13843 : 139 : "#"
13844 : 727575 : "&& 1"
13845 : 1 : [(parallel
13846 : 151 : [(set (reg:CCGOC FLAGS_REG)
13847 : 227 : (compare:CCGOC
13848 : 0 : (neg:SWI (match_dup 1))
13849 : 32 : (const_int 0)))
13850 : 3 : (set (match_dup 2)
13851 : 3 : (neg:SWI (match_dup 1)))])
13852 : 3177 : (set (match_dup 0)
13853 : 5016 : (if_then_else:SWI
13854 : 4727 : (lt (reg:CCGOC FLAGS_REG) (const_int 0))
13855 : 710988 : (match_dup 2)
13856 : 5014 : (match_dup 1)))]
13857 : 709990 : {
13858 : 4018 : operands[1] = force_reg (<MODE>mode, operands[1]);
13859 : 690860 : operands[2] = gen_reg_rtx (<MODE>mode);
13860 : 954707 : })
13861 : 7016 :
13862 : 10374 : (define_expand "<code>tf2"
13863 : 7971 : [(set (match_operand:TF 0 "register_operand")
13864 : 1488 : (absneg:TF (match_operand:TF 1 "register_operand")))]
13865 : 1488 : "TARGET_SSE"
13866 : 3517 : "ix86_expand_fp_absneg_operator (<CODE>, TFmode, operands); DONE;")
13867 : 7821 :
13868 : 4604 : (define_insn_and_split "*<code>tf2_1"
13869 : 619 : [(set (match_operand:TF 0 "register_operand" "=x,x,Yv,Yv")
13870 : 3502 : (absneg:TF
13871 : 217 : (match_operand:TF 1 "vector_operand" "0,xBm,Yv,m")))
13872 : 2 : (use (match_operand:TF 2 "vector_operand" "xBm,0,Yvm,Yv"))]
13873 : 4846 : "TARGET_SSE"
13874 : 3188 : "#"
13875 : 72 : "&& reload_completed"
13876 : 3116 : [(set (match_dup 0)
13877 : 1895 : (<absneg_op>:TF (match_dup 1) (match_dup 2)))]
13878 : 1895 : {
13879 : 1968 : if (TARGET_AVX)
13880 : 32 : {
13881 : 6 : if (MEM_P (operands[1]))
13882 : 0 : std::swap (operands[1], operands[2]);
13883 : 59 : }
13884 : 820 : else
13885 : 78581 : {
13886 : 1889 : if (operands_match_p (operands[0], operands[2]))
13887 : 127918 : std::swap (operands[1], operands[2]);
13888 : 79301 : }
13889 : 78540 : }
13890 : 78522 : [(set_attr "isa" "noavx,noavx,avx,avx")])
13891 : 50022 :
13892 : 96531 : (define_insn_and_split "*nabstf2_1"
13893 : 97079 : [(set (match_operand:TF 0 "register_operand" "=x,x,Yv,Yv")
13894 : 97665 : (neg:TF
13895 : 50262 : (abs:TF
13896 : 50626 : (match_operand:TF 1 "vector_operand" "0,xBm,Yv,m"))))
13897 : 50624 : (use (match_operand:TF 2 "vector_operand" "xBm,0,Yvm,Yv"))]
13898 : 1900 : "TARGET_SSE"
13899 : 50023 : "#"
13900 : 1330 : "&& reload_completed"
13901 : 1344 : [(set (match_dup 0)
13902 : 2681 : (ior:TF (match_dup 1) (match_dup 2)))]
13903 : 4692 : {
13904 : 19 : if (TARGET_AVX)
13905 : 0 : {
13906 : 0 : if (MEM_P (operands[1]))
13907 : 0 : std::swap (operands[1], operands[2]);
13908 : : }
13909 : : else
13910 : 587 : {
13911 : 1 : if (operands_match_p (operands[0], operands[2]))
13912 : 0 : std::swap (operands[1], operands[2]);
13913 : 587 : }
13914 : 587 : }
13915 : 587 : [(set_attr "isa" "noavx,noavx,avx,avx")])
13916 : 587 :
13917 : 0 : (define_expand "<code>hf2"
13918 : 587 : [(set (match_operand:HF 0 "register_operand")
13919 : 1 : (absneg:HF (match_operand:HF 1 "register_operand")))]
13920 : 1 : "TARGET_AVX512FP16"
13921 : 91 : "ix86_expand_fp_absneg_operator (<CODE>, HFmode, operands); DONE;")
13922 : 1 :
13923 : 1 : (define_expand "<code><mode>2"
13924 : : [(set (match_operand:X87MODEF 0 "register_operand")
13925 : : (absneg:X87MODEF (match_operand:X87MODEF 1 "register_operand")))]
13926 : : "TARGET_80387 || (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)"
13927 : 27323 : "ix86_expand_fp_absneg_operator (<CODE>, <MODE>mode, operands); DONE;")
13928 : 1 :
13929 : 1 : ;; Changing of sign for FP values is doable using integer unit too.
13930 : : (define_insn "*<code><mode>2_i387_1"
13931 : : [(set (match_operand:X87MODEF 0 "register_operand" "=f,!r")
13932 : : (absneg:X87MODEF
13933 : : (match_operand:X87MODEF 1 "register_operand" "0,0")))
13934 : 11 : (clobber (reg:CC FLAGS_REG))]
13935 : 30741 : "TARGET_80387 && !(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)"
13936 : 3860 : "#")
13937 : 7501 :
13938 : 7501 : (define_split
13939 : 17317 : [(set (match_operand:X87MODEF 0 "fp_register_operand")
13940 : 10139 : (absneg:X87MODEF (match_operand:X87MODEF 1 "fp_register_operand")))
13941 : 10096 : (clobber (reg:CC FLAGS_REG))]
13942 : 15059 : "TARGET_80387 && reload_completed"
13943 : 28686 : [(set (match_dup 0) (absneg:X87MODEF (match_dup 1)))])
13944 : 79932 :
13945 : 27433 : (define_split
13946 : 12799 : [(set (match_operand:X87MODEF 0 "general_reg_operand")
13947 : 11179 : (absneg:X87MODEF (match_operand:X87MODEF 1 "general_reg_operand")))
13948 : 20366 : (clobber (reg:CC FLAGS_REG))]
13949 : 20255 : "TARGET_80387 && reload_completed"
13950 : 25814 : [(const_int 0)]
13951 : 204 : "ix86_split_fp_absneg_operator (<CODE>, <MODE>mode, operands); DONE;")
13952 : 0 :
13953 : 30381 : (define_insn_and_split "*<code>hf2_1"
13954 : 10157 : [(set (match_operand:HF 0 "register_operand" "=Yv")
13955 : 142 : (absneg:HF
13956 : 10157 : (match_operand:HF 1 "register_operand" "Yv")))
13957 : 4903 : (use (match_operand:V8HF 2 "vector_operand" "Yvm"))
13958 : 21816 : (clobber (reg:CC FLAGS_REG))]
13959 : 6945 : "TARGET_AVX512FP16"
13960 : : "#"
13961 : 164 : "&& reload_completed"
13962 : 142 : [(set (match_dup 0)
13963 : 215 : (<absneg_op>:V8HF (match_dup 1) (match_dup 2)))]
13964 : 25612 : {
13965 : 20267 : operands[0] = lowpart_subreg (V8HFmode, operands[0], HFmode);
13966 : 20298 : operands[1] = lowpart_subreg (V8HFmode, operands[1], HFmode);
13967 : 10132 : })
13968 : 10149 :
13969 : 20247 : (define_insn "*<code><mode>2_1"
13970 : 0 : [(set (match_operand:MODEF 0 "register_operand" "=x,x,Yv,f,!r")
13971 : 11 : (absneg:MODEF
13972 : 91 : (match_operand:MODEF 1 "register_operand" "0,x,Yv,0,0")))
13973 : 91 : (use (match_operand:<ssevecmode> 2 "vector_operand" "xBm,0,Yvm,X,X"))
13974 : 60 : (clobber (reg:CC FLAGS_REG))]
13975 : 25581 : "TARGET_80387 || (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)"
13976 : 91 : "#"
13977 : 60 : [(set_attr "isa" "noavx,noavx,avx,*,*")
13978 : 60 : (set (attr "enabled")
13979 : 30944 : (if_then_else
13980 : 30915 : (match_test ("SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH"))
13981 : 194 : (if_then_else
13982 : 31 : (eq_attr "alternative" "3,4")
13983 : 487714 : (symbol_ref "TARGET_MIX_SSE_I387")
13984 : 39747 : (const_string "*"))
13985 : 10041 : (if_then_else
13986 : 260 : (eq_attr "alternative" "3,4")
13987 : 24815 : (symbol_ref "true")
13988 : 8406 : (symbol_ref "false"))))])
13989 : 7096 :
13990 : 8406 : (define_split
13991 : 8406 : [(set (match_operand:MODEF 0 "sse_reg_operand")
13992 : 8707 : (absneg:MODEF
13993 : 22466 : (match_operand:MODEF 1 "sse_reg_operand")))
13994 : 8406 : (use (match_operand:<ssevecmodef> 2 "vector_operand"))
13995 : 0 : (clobber (reg:CC FLAGS_REG))]
13996 : 33945 : "SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH
13997 : 25840 : && reload_completed"
13998 : 25539 : [(set (match_dup 0)
13999 : 25840 : (<absneg_op>:<ssevecmodef> (match_dup 1) (match_dup 2)))]
14000 : 25840 : {
14001 : 51379 : machine_mode mode = <MODE>mode;
14002 : 25840 : machine_mode vmode = <ssevecmodef>mode;
14003 : 301 :
14004 : 25840 : operands[0] = lowpart_subreg (vmode, operands[0], mode);
14005 : 25539 : operands[1] = lowpart_subreg (vmode, operands[1], mode);
14006 : :
14007 : 25840 : if (!TARGET_AVX && operands_match_p (operands[0], operands[2]))
14008 : 1056 : std::swap (operands[1], operands[2]);
14009 : 301 : })
14010 : :
14011 : : (define_split
14012 : 25539 : [(set (match_operand:MODEF 0 "fp_register_operand")
14013 : 25539 : (absneg:MODEF (match_operand:MODEF 1 "fp_register_operand")))
14014 : 25539 : (use (match_operand 2))
14015 : 26195 : (clobber (reg:CC FLAGS_REG))]
14016 : 25539 : "TARGET_80387 && reload_completed"
14017 : 26195 : [(set (match_dup 0) (absneg:MODEF (match_dup 1)))])
14018 : 51078 :
14019 : 656 : (define_split
14020 : 26195 : [(set (match_operand:MODEF 0 "general_reg_operand")
14021 : 0 : (absneg:MODEF (match_operand:MODEF 1 "general_reg_operand")))
14022 : 26195 : (use (match_operand 2))
14023 : 25539 : (clobber (reg:CC FLAGS_REG))]
14024 : 26195 : "TARGET_80387 && reload_completed"
14025 : 26195 : [(const_int 0)]
14026 : 0 : "ix86_split_fp_absneg_operator (<CODE>, <MODE>mode, operands); DONE;")
14027 : 656 :
14028 : 30842 : (define_insn_and_split "*nabs<mode>2_1"
14029 : 30842 : [(set (match_operand:MODEF 0 "register_operand" "=x,x,Yv")
14030 : 33257 : (neg:MODEF
14031 : 16077 : (abs:MODEF
14032 : 64072 : (match_operand:MODEF 1 "register_operand" "0,x,Yv"))))
14033 : 33797 : (use (match_operand:<ssevecmode> 2 "vector_operand" "xBm,0,Yvm"))]
14034 : 17153 : "SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH"
14035 : 17193 : "#"
14036 : 17193 : "&& reload_completed"
14037 : 0 : [(set (match_dup 0)
14038 : 20013 : (ior:<ssevecmodef> (match_dup 1) (match_dup 2)))]
14039 : 0 : {
14040 : 2860 : machine_mode mode = <MODE>mode;
14041 : 2860 : machine_mode vmode = <ssevecmodef>mode;
14042 : 2860 :
14043 : 2860 : operands[0] = lowpart_subreg (vmode, operands[0], mode);
14044 : 0 : operands[1] = lowpart_subreg (vmode, operands[1], mode);
14045 : 2860 :
14046 : 2860 : if (!TARGET_AVX && operands_match_p (operands[0], operands[2]))
14047 : 2860 : std::swap (operands[1], operands[2]);
14048 : 2860 : }
14049 : 2860 : [(set_attr "isa" "noavx,noavx,avx")])
14050 : 2860 :
14051 : 0 : ;; Conditionalize these after reload. If they match before reload, we
14052 : 0 : ;; lose the clobber and ability to use integer instructions.
14053 : 2860 :
14054 : 18074 : (define_insn "*<code><mode>2_i387"
14055 : 2860 : [(set (match_operand:X87MODEF 0 "register_operand" "=f")
14056 : 15214 : (absneg:X87MODEF (match_operand:X87MODEF 1 "register_operand" "0")))]
14057 : 47744 : "TARGET_80387 && reload_completed"
14058 : 15214 : "<absneg_mnemonic>"
14059 : 15214 : [(set_attr "type" "fsgn")
14060 : 15214 : (set_attr "mode" "<MODE>")])
14061 : 64208 :
14062 : 48994 : ;; Copysign instructions
14063 : 48538 :
14064 : 97456 : (define_expand "copysign<mode>3"
14065 : 7329 : [(match_operand:SSEMODEF 0 "register_operand")
14066 : 57846 : (match_operand:SSEMODEF 1 "nonmemory_operand")
14067 : 21264 : (match_operand:SSEMODEF 2 "register_operand")]
14068 : 13264 : "(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
14069 : 12320 : || (TARGET_SSE && (<MODE>mode == TFmode))
14070 : 13264 : || (TARGET_AVX512FP16 && (<MODE>mode ==HFmode))"
14071 : 23192 : "ix86_expand_copysign (operands); DONE;")
14072 : 2500 :
14073 : 2500 : (define_expand "xorsign<mode>3"
14074 : 1556 : [(match_operand:MODEFH 0 "register_operand")
14075 : 3088 : (match_operand:MODEFH 1 "register_operand")
14076 : 1201 : (match_operand:MODEFH 2 "register_operand")]
14077 : 2231 : "(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
14078 : 12 : || <MODE>mode == HFmode"
14079 : 20 : {
14080 : 20 : if (rtx_equal_p (operands[1], operands[2]))
14081 : 4 : emit_insn (gen_abs<mode>2 (operands[0], operands[1]));
14082 : 0 : else
14083 : 16 : ix86_expand_xorsign (operands);
14084 : 20 : DONE;
14085 : 0 : })
14086 : 0 :
14087 : 0 : ;; One complement instructions
14088 : 0 :
14089 : 0 : (define_expand "one_cmpl<mode>2"
14090 : : [(set (match_operand:SDWIM 0 "nonimmediate_operand")
14091 : 23183 : (not:SDWIM (match_operand:SDWIM 1 "nonimmediate_operand")))]
14092 : 0 : ""
14093 : 61057 : {
14094 : 61057 : ix86_expand_unary_operator (NOT, <MODE>mode, operands, TARGET_APX_NDD);
14095 : 61057 : DONE;
14096 : 23183 : })
14097 : 23183 :
14098 : 23183 : (define_insn_and_split "*one_cmpl<dwi>2_doubleword"
14099 : 23183 : [(set (match_operand:<DWI> 0 "nonimmediate_operand" "=ro,&r")
14100 : 23183 : (not:<DWI> (match_operand:<DWI> 1 "nonimmediate_operand" "0,ro")))]
14101 : 218592 : "ix86_unary_operator_ok (NOT, <DWI>mode, operands, TARGET_APX_NDD)"
14102 : 0 : "#"
14103 : 734 : "&& reload_completed"
14104 : 57425 : [(set (match_dup 0)
14105 : 2396 : (not:DWIH (match_dup 1)))
14106 : 0 : (set (match_dup 2)
14107 : 1009 : (not:DWIH (match_dup 3)))]
14108 : 1827 : "split_double_mode (<DWI>mode, &operands[0], 2, &operands[0], &operands[2]);"
14109 : 2570 : [(set_attr "isa" "*,apx_ndd")])
14110 : 1026 :
14111 : 2813 : (define_insn "*one_cmpl<mode>2_1"
14112 : 2404 : [(set (match_operand:SWI248 0 "nonimmediate_operand" "=rm,r,?k")
14113 : 1561 : (not:SWI248 (match_operand:SWI248 1 "nonimmediate_operand" "0,rm,k")))]
14114 : 189517 : "ix86_unary_operator_ok (NOT, <MODE>mode, operands, TARGET_APX_NDD)"
14115 : 682 : "@
14116 : 818 : not{<imodesuffix>}\t%0
14117 : 60681 : not{<imodesuffix>}\t{%1, %0|%0, %1}
14118 : 65899 : #"
14119 : 7221 : [(set_attr "isa" "*,apx_ndd,<kmov_isa>")
14120 : 66266 : (set_attr "type" "negnot,negnot,msklog")
14121 : 66266 : (set_attr "mode" "<MODE>")])
14122 : 72961 :
14123 : 90 : (define_insn "*one_cmplsi2_1_zext"
14124 : 367 : [(set (match_operand:DI 0 "register_operand" "=r,r,?k")
14125 : 866 : (zero_extend:DI
14126 : 866 : (not:SI (match_operand:SI 1 "nonimmediate_operand" "0,rm,k"))))]
14127 : 265 : "TARGET_64BIT
14128 : 216 : && ix86_unary_operator_ok (NOT, SImode, operands, TARGET_APX_NDD)"
14129 : 390 : "@
14130 : 48 : not{l}\t%k0
14131 : 48 : not{l}\t{%1, %k0|%k0, %1}
14132 : 1569 : #"
14133 : 2021 : [(set_attr "isa" "x64,apx_ndd,avx512bw")
14134 : 43 : (set_attr "type" "negnot,negnot,msklog")
14135 : 930 : (set_attr "mode" "SI,SI,SI")])
14136 : 930 :
14137 : 470 : (define_insn "*one_cmplqi2_1"
14138 : 1 : [(set (match_operand:QI 0 "nonimmediate_operand" "=qm,r,r,?k")
14139 : 0 : (not:QI (match_operand:QI 1 "nonimmediate_operand" "0,0,rm,k")))]
14140 : 6329 : "ix86_unary_operator_ok (NOT, QImode, operands, TARGET_APX_NDD)"
14141 : 2234 : "@
14142 : 451 : not{b}\t%0
14143 : : not{l}\t%k0
14144 : 8 : not{b}\t{%1, %0|%0, %1}
14145 : 8 : #"
14146 : 8 : [(set_attr "isa" "*,*,apx_ndd,avx512f")
14147 : 16 : (set_attr "type" "negnot,negnot,negnot,msklog")
14148 : 0 : (set (attr "mode")
14149 : : (cond [(eq_attr "alternative" "1")
14150 : : (const_string "SI")
14151 : 16 : (and (eq_attr "alternative" "3")
14152 : 16 : (match_test "!TARGET_AVX512DQ"))
14153 : 16 : (const_string "HI")
14154 : 32 : ]
14155 : 3 : (const_string "QI")))
14156 : : ;; Potential partial reg stall on alternative 1.
14157 : : (set (attr "preferred_for_speed")
14158 : 6 : (cond [(eq_attr "alternative" "1")
14159 : 6 : (symbol_ref "!TARGET_PARTIAL_REG_STALL")]
14160 : 6 : (symbol_ref "true")))])
14161 : 12 :
14162 : 0 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
14163 : : (define_insn_and_split "*one_cmpl<mode>_1_slp"
14164 : : [(set (strict_low_part (match_operand:SWI12 0 "register_operand" "+<r>,&<r>"))
14165 : : (not:SWI12 (match_operand:SWI12 1 "register_operand" "0,!<r>")))]
14166 : 4 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
14167 : : "@
14168 : : not{<imodesuffix>}\t%0
14169 : 2 : #"
14170 : 6 : "&& reload_completed
14171 : 8 : && !(rtx_equal_p (operands[0], operands[1]))"
14172 : 6 : [(set (strict_low_part (match_dup 0)) (match_dup 1))
14173 : 2 : (set (strict_low_part (match_dup 0))
14174 : 0 : (not:SWI12 (match_dup 0)))]
14175 : 0 : ""
14176 : 4 : [(set_attr "type" "negnot")
14177 : : (set_attr "mode" "<MODE>")])
14178 : 2 :
14179 : 2 : (define_insn "*one_cmpl<mode>2_2"
14180 : 48189 : [(set (reg FLAGS_REG)
14181 : 2 : (compare (not:SWI (match_operand:SWI 1 "nonimmediate_operand" "0,rm"))
14182 : 97 : (const_int 0)))
14183 : 0 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,r")
14184 : 95 : (not:SWI (match_dup 1)))]
14185 : 2 : "ix86_match_ccmode (insn, CCNOmode)
14186 : 62 : && ix86_unary_operator_ok (NOT, <MODE>mode, operands, TARGET_APX_NDD)"
14187 : 0 : "#"
14188 : 0 : [(set_attr "type" "alu1")
14189 : 2 : (set_attr "isa" "*,apx_ndd")
14190 : 2 : (set_attr "mode" "<MODE>")])
14191 : 126 :
14192 : 0 : (define_split
14193 : 0 : [(set (match_operand 0 "flags_reg_operand")
14194 : 0 : (match_operator 2 "compare_operator"
14195 : 0 : [(not:SWI (match_operand:SWI 3 "nonimmediate_operand"))
14196 : 0 : (const_int 0)]))
14197 : 1 : (set (match_operand:SWI 1 "nonimmediate_operand")
14198 : 0 : (not:SWI (match_dup 3)))]
14199 : 49 : "ix86_match_ccmode (insn, CCNOmode)"
14200 : 1 : [(parallel [(set (match_dup 0)
14201 : 33 : (match_op_dup 2 [(xor:SWI (match_dup 3) (const_int -1))
14202 : 1 : (const_int 0)]))
14203 : 48 : (set (match_dup 1)
14204 : 49 : (xor:SWI (match_dup 3) (const_int -1)))])])
14205 : 48 :
14206 : 48 : (define_insn "*one_cmplsi2_2_zext"
14207 : 96 : [(set (reg FLAGS_REG)
14208 : 0 : (compare (not:SI (match_operand:SI 1 "nonimmediate_operand" "0,rm"))
14209 : 0 : (const_int 0)))
14210 : 0 : (set (match_operand:DI 0 "register_operand" "=r,r")
14211 : 0 : (zero_extend:DI (not:SI (match_dup 1))))]
14212 : 0 : "TARGET_64BIT && ix86_match_ccmode (insn, CCNOmode)
14213 : 0 : && ix86_unary_operator_ok (NOT, SImode, operands, TARGET_APX_NDD)"
14214 : 0 : "#"
14215 : 0 : [(set_attr "type" "alu1")
14216 : : (set_attr "isa" "*,apx_ndd")
14217 : : (set_attr "mode" "SI")])
14218 : :
14219 : : (define_split
14220 : : [(set (match_operand 0 "flags_reg_operand")
14221 : 39640 : (match_operator 2 "compare_operator"
14222 : 39640 : [(not:SI (match_operand:SI 3 "nonimmediate_operand"))
14223 : : (const_int 0)]))
14224 : 15358 : (set (match_operand:DI 1 "register_operand")
14225 : 15358 : (zero_extend:DI (not:SI (match_dup 3))))]
14226 : 0 : "ix86_match_ccmode (insn, CCNOmode)"
14227 : 15358 : [(parallel [(set (match_dup 0)
14228 : 0 : (match_op_dup 2 [(xor:SI (match_dup 3) (const_int -1))
14229 : 11841 : (const_int 0)]))
14230 : 11841 : (set (match_dup 1)
14231 : : (zero_extend:DI (xor:SI (match_dup 3) (const_int -1))))])])
14232 : 24 :
14233 : 48 : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
14234 : 80798 : (define_insn_and_split "*one_cmplqi_ext<mode>_1"
14235 : 80798 : [(set (zero_extract:SWI248
14236 : 80798 : (match_operand 0 "int248_register_operand" "+Q,&Q")
14237 : 80798 : (const_int 8)
14238 : 80798 : (const_int 8))
14239 : 80798 : (subreg:SWI248
14240 : 80798 : (not:QI
14241 : 0 : (subreg:QI
14242 : 39 : (match_operator:SWI248 2 "extract_operator"
14243 : 39 : [(match_operand 1 "int248_register_operand" "0,!Q")
14244 : 39 : (const_int 8)
14245 : 39 : (const_int 8)]) 0)) 0))]
14246 : 39 : ""
14247 : 39 : "@
14248 : 0 : not{b}\t%h0
14249 : 39 : #"
14250 : 0 : "reload_completed
14251 : 3 : && !(rtx_equal_p (operands[0], operands[1]))"
14252 : 3 : [(set (zero_extract:SWI248
14253 : 1 : (match_dup 0) (const_int 8) (const_int 8))
14254 : : (zero_extract:SWI248
14255 : 4 : (match_dup 1) (const_int 8) (const_int 8)))
14256 : 7 : (set (zero_extract:SWI248
14257 : : (match_dup 0) (const_int 8) (const_int 8))
14258 : : (subreg:SWI248
14259 : : (not:QI
14260 : : (subreg:QI
14261 : : (match_op_dup 2
14262 : : [(match_dup 0) (const_int 8) (const_int 8)]) 0)) 0))]
14263 : : ""
14264 : : [(set_attr "type" "negnot")
14265 : 0 : (set_attr "mode" "QI")])
14266 : 0 :
14267 : 1 : ;; Shift instructions
14268 : 1 :
14269 : 1 : ;; DImode shifts are implemented using the i386 "shift double" opcode,
14270 : 1 : ;; which is written as "sh[lr]d[lw] imm,reg,reg/mem". If the shift count
14271 : 1 : ;; is variable, then the count is in %cl and the "imm" operand is dropped
14272 : 1 : ;; from the assembler input.
14273 : 32 : ;;
14274 : : ;; This instruction shifts the target reg/mem as usual, but instead of
14275 : 32 : ;; shifting in zeros, bits are shifted in from reg operand. If the insn
14276 : 32 : ;; is a left shift double, bits are taken from the high order bits of
14277 : 32 : ;; reg, else if the insn is a shift right double, bits are taken from the
14278 : 32 : ;; low order bits of reg. So if %eax is "1234" and %edx is "5678",
14279 : 32 : ;; "shldl $8,%edx,%eax" leaves %edx unchanged and sets %eax to "2345".
14280 : 33 : ;;
14281 : 0 : ;; Since sh[lr]d does not change the `reg' operand, that is done
14282 : 32 : ;; separately, making all shifts emit pairs of shift double and normal
14283 : 32 : ;; shift. Since sh[lr]d does not shift more than 31 bits, and we wish to
14284 : 32 : ;; support a 63 bit shift, each shift where the count is in a reg expands
14285 : 32 : ;; to a pair of shifts, a branch, a shift by 32 and a label.
14286 : 32 : ;;
14287 : 32 : ;; If the shift count is a constant, we need never emit more than one
14288 : 32 : ;; shift pair, instead using moves and sign extension for counts greater
14289 : 32 : ;; than 31.
14290 : 32 :
14291 : 32 : (define_expand "ashl<mode>3"
14292 : : [(set (match_operand:SDWIM 0 "<shift_operand>")
14293 : 1 : (ashift:SDWIM (match_operand:SDWIM 1 "<ashl_input_operand>")
14294 : 1 : (match_operand:QI 2 "nonmemory_operand")))]
14295 : 1 : ""
14296 : 830715 : {
14297 : 830715 : ix86_expand_binary_operator (ASHIFT, <MODE>mode, operands, TARGET_APX_NDD);
14298 : 830715 : DONE;
14299 : : })
14300 : 26457 :
14301 : 1 : (define_insn_and_split "*ashl<dwi>3_doubleword_mask"
14302 : : [(set (match_operand:<DWI> 0 "register_operand")
14303 : 32 : (ashift:<DWI>
14304 : 32 : (match_operand:<DWI> 1 "register_operand")
14305 : 26457 : (subreg:QI
14306 : 26458 : (and
14307 : 1 : (match_operand 2 "int248_register_operand" "c")
14308 : 0 : (match_operand 3 "const_int_operand")) 0)))
14309 : 1 : (clobber (reg:CC FLAGS_REG))]
14310 : 27487 : "((INTVAL (operands[3]) & (<MODE_SIZE> * BITS_PER_UNIT)) == 0
14311 : 5094 : || ((INTVAL (operands[3]) & (2 * <MODE_SIZE> * BITS_PER_UNIT - 1))
14312 : : == (2 * <MODE_SIZE> * BITS_PER_UNIT - 1)))
14313 : 8845 : && ix86_pre_reload_split ()"
14314 : 16 : "#"
14315 : 16 : "&& 1"
14316 : 54 : [(parallel
14317 : 16 : [(set (match_dup 6)
14318 : 16 : (ior:DWIH (ashift:DWIH (match_dup 6)
14319 : 3606 : (and:QI (match_dup 2) (match_dup 8)))
14320 : 804300 : (subreg:DWIH
14321 : 28 : (lshiftrt:<DWI> (zero_extend:<DWI> (match_dup 5))
14322 : 16 : (minus:QI (match_dup 9)
14323 : 28 : (and:QI (match_dup 2) (match_dup 8)))) 0)))
14324 : 804286 : (clobber (reg:CC FLAGS_REG))])
14325 : 804258 : (parallel
14326 : 804286 : [(set (match_dup 4)
14327 : 804286 : (ashift:DWIH (match_dup 5) (match_dup 2)))
14328 : 804286 : (clobber (reg:CC FLAGS_REG))])]
14329 : 16 : {
14330 : 804296 : if ((INTVAL (operands[3]) & (<MODE_SIZE> * BITS_PER_UNIT)) != 0)
14331 : 12 : {
14332 : 23 : operands[2] = force_reg (GET_MODE (operands[2]), operands[2]);
14333 : 23 : operands[2] = gen_lowpart (QImode, operands[2]);
14334 : 35 : emit_insn (gen_ashl<dwi>3_doubleword (operands[0], operands[1],
14335 : 0 : operands[2]));
14336 : 35 : DONE;
14337 : : }
14338 : :
14339 : 15 : split_double_mode (<DWI>mode, &operands[0], 2, &operands[4], &operands[6]);
14340 : :
14341 : 31 : operands[8] = GEN_INT (<MODE_SIZE> * BITS_PER_UNIT - 1);
14342 : 31 : operands[9] = GEN_INT (<MODE_SIZE> * BITS_PER_UNIT);
14343 : 16 :
14344 : 15 : if ((INTVAL (operands[3]) & ((<MODE_SIZE> * BITS_PER_UNIT) - 1))
14345 : : != ((<MODE_SIZE> * BITS_PER_UNIT) - 1))
14346 : : {
14347 : 14 : rtx xops[3];
14348 : 14 : xops[0] = gen_reg_rtx (GET_MODE (operands[2]));
14349 : 14 : xops[1] = operands[2];
14350 : 14 : xops[2] = GEN_INT (INTVAL (operands[3])
14351 : 0 : & ((<MODE_SIZE> * BITS_PER_UNIT) - 1));
14352 : 14 : ix86_expand_binary_operator (AND, GET_MODE (operands[2]), xops);
14353 : 14 : operands[2] = xops[0];
14354 : 0 : }
14355 : 0 :
14356 : 15 : operands[2] = force_reg (GET_MODE (operands[2]), operands[2]);
14357 : 15 : operands[2] = gen_lowpart (QImode, operands[2]);
14358 : 0 :
14359 : 15 : if (!rtx_equal_p (operands[6], operands[7]))
14360 : 15 : emit_move_insn (operands[6], operands[7]);
14361 : 0 : })
14362 : 0 :
14363 : 0 : (define_insn_and_split "*ashl<dwi>3_doubleword_mask_1"
14364 : 15 : [(set (match_operand:<DWI> 0 "register_operand")
14365 : 15 : (ashift:<DWI>
14366 : 15 : (match_operand:<DWI> 1 "register_operand")
14367 : 0 : (and:QI
14368 : 15 : (match_operand:QI 2 "register_operand" "c")
14369 : 15 : (match_operand:QI 3 "const_int_operand"))))
14370 : 15 : (clobber (reg:CC FLAGS_REG))]
14371 : 2348 : "((INTVAL (operands[3]) & (<MODE_SIZE> * BITS_PER_UNIT)) == 0
14372 : 2305 : || ((INTVAL (operands[3]) & (2 * <MODE_SIZE> * BITS_PER_UNIT - 1))
14373 : 15 : == (2 * <MODE_SIZE> * BITS_PER_UNIT - 1)))
14374 : 2349 : && ix86_pre_reload_split ()"
14375 : 15 : "#"
14376 : 15 : "&& 1"
14377 : 15 : [(parallel
14378 : 588 : [(set (match_dup 6)
14379 : 587 : (ior:DWIH (ashift:DWIH (match_dup 6)
14380 : 1712 : (and:QI (match_dup 2) (match_dup 8)))
14381 : 322 : (subreg:DWIH
14382 : 15 : (lshiftrt:<DWI> (zero_extend:<DWI> (match_dup 5))
14383 : 15 : (minus:QI (match_dup 9)
14384 : 15 : (and:QI (match_dup 2) (match_dup 8)))) 0)))
14385 : : (clobber (reg:CC FLAGS_REG))])
14386 : : (parallel
14387 : : [(set (match_dup 4)
14388 : 0 : (ashift:DWIH (match_dup 5) (match_dup 2)))
14389 : : (clobber (reg:CC FLAGS_REG))])]
14390 : 1 : {
14391 : 1 : if ((INTVAL (operands[3]) & (<MODE_SIZE> * BITS_PER_UNIT)) != 0)
14392 : 0 : {
14393 : 0 : emit_insn (gen_ashl<dwi>3_doubleword (operands[0], operands[1],
14394 : 0 : operands[2]));
14395 : 0 : DONE;
14396 : 0 : }
14397 : :
14398 : 1 : split_double_mode (<DWI>mode, &operands[0], 2, &operands[4], &operands[6]);
14399 : :
14400 : 1 : operands[8] = GEN_INT (<MODE_SIZE> * BITS_PER_UNIT - 1);
14401 : 1 : operands[9] = GEN_INT (<MODE_SIZE> * BITS_PER_UNIT);
14402 : :
14403 : 1 : if ((INTVAL (operands[3]) & ((<MODE_SIZE> * BITS_PER_UNIT) - 1))
14404 : 15 : != ((<MODE_SIZE> * BITS_PER_UNIT) - 1))
14405 : : {
14406 : 1 : rtx tem = gen_reg_rtx (QImode);
14407 : 1 : emit_insn (gen_andqi3 (tem, operands[2], operands[3]));
14408 : 1 : operands[2] = tem;
14409 : : }
14410 : :
14411 : 16 : if (!rtx_equal_p (operands[6], operands[7]))
14412 : 1 : emit_move_insn (operands[6], operands[7]);
14413 : 15 : })
14414 : :
14415 : : (define_insn "ashl<mode>3_doubleword"
14416 : 1 : [(set (match_operand:DWI 0 "register_operand" "=&r,&r")
14417 : 1 : (ashift:DWI (match_operand:DWI 1 "reg_or_pm1_operand" "0n,r")
14418 : 1 : (match_operand:QI 2 "nonmemory_operand" "<S>c,<S>c")))
14419 : 27 : (clobber (reg:CC FLAGS_REG))]
14420 : 1 : ""
14421 : 27 : "#"
14422 : 27 : [(set_attr "type" "multi")
14423 : 27 : (set_attr "isa" "*,apx_ndd")])
14424 : 27 :
14425 : 27 : (define_split
14426 : 27 : [(set (match_operand:DWI 0 "register_operand")
14427 : 27 : (ashift:DWI (match_operand:DWI 1 "nonmemory_operand")
14428 : 27 : (match_operand:QI 2 "nonmemory_operand")))
14429 : 27 : (clobber (reg:CC FLAGS_REG))]
14430 : 340867 : "epilogue_completed"
14431 : 27 : [(const_int 0)]
14432 : 26 : {
14433 : 0 : if (TARGET_APX_NDD
14434 : 28 : && !rtx_equal_p (operands[0], operands[1])
14435 : 5542 : && REG_P (operands[1]))
14436 : 1 : ix86_split_ashl_ndd (operands, NULL_RTX);
14437 : : else
14438 : 5542 : ix86_split_ashl (operands, NULL_RTX, <MODE>mode);
14439 : 5542 : DONE;
14440 : : })
14441 : :
14442 : : ;; By default we don't ask for a scratch register, because when DWImode
14443 : : ;; values are manipulated, registers are already at a premium. But if
14444 : : ;; we have one handy, we won't turn it away.
14445 : :
14446 : : (define_peephole2
14447 : : [(match_scratch:DWIH 3 "r")
14448 : : (parallel [(set (match_operand:<DWI> 0 "register_operand")
14449 : : (ashift:<DWI>
14450 : : (match_operand:<DWI> 1 "nonmemory_operand")
14451 : : (match_operand:QI 2 "nonmemory_operand")))
14452 : 8355 : (clobber (reg:CC FLAGS_REG))])
14453 : : (match_dup 3)]
14454 : 147196 : "TARGET_CMOVE"
14455 : 5087 : [(const_int 0)]
14456 : 3269 : {
14457 : 8355 : if (TARGET_APX_NDD
14458 : 3 : && !rtx_equal_p (operands[0], operands[1])
14459 : 7170 : && (REG_P (operands[1])))
14460 : 1 : ix86_split_ashl_ndd (operands, operands[3]);
14461 : 2813 : else
14462 : 4355 : ix86_split_ashl (operands, operands[3], <DWI>mode);
14463 : 4357 : DONE;
14464 : 1 : })
14465 : 1 :
14466 : : (define_insn_and_split "*ashl<dwi>3_doubleword_highpart"
14467 : : [(set (match_operand:<DWI> 0 "register_operand" "=r")
14468 : : (ashift:<DWI>
14469 : : (any_extend:<DWI> (match_operand:DWIH 1 "nonimmediate_operand" "rm"))
14470 : : (match_operand:QI 2 "const_int_operand")))
14471 : 456 : (clobber (reg:CC FLAGS_REG))]
14472 : 188721 : "INTVAL (operands[2]) >= <MODE_SIZE> * BITS_PER_UNIT
14473 : 44392 : && INTVAL (operands[2]) < <MODE_SIZE> * BITS_PER_UNIT * 2"
14474 : 455 : "#"
14475 : 3247 : "&& reload_completed"
14476 : 2204 : [(const_int 0)]
14477 : 3245 : {
14478 : 1622 : split_double_mode (<DWI>mode, &operands[0], 1, &operands[0], &operands[3]);
14479 : 2885 : int bits = INTVAL (operands[2]) - (<MODE_SIZE> * BITS_PER_UNIT);
14480 : 8553 : bool op_equal_p = rtx_equal_p (operands[3], operands[1]);
14481 : 3371 : if (bits == 0)
14482 : 1 : {
14483 : 6659 : if (!op_equal_p)
14484 : 5031 : emit_move_insn (operands[3], operands[1]);
14485 : 1543 : }
14486 : 167 : else
14487 : 332 : {
14488 : 232 : if (!op_equal_p && !TARGET_APX_NDD)
14489 : 155262 : emit_move_insn (operands[3], operands[1]);
14490 : 232 : rtx op_tmp = TARGET_APX_NDD ? operands[1] : operands[3];
14491 : 155268 : emit_insn (gen_ashl<mode>3 (operands[3], op_tmp, GEN_INT (bits)));
14492 : 155036 : }
14493 : 156658 : ix86_expand_clear (operands[0]);
14494 : 156658 : DONE;
14495 : 155036 : })
14496 : 155036 :
14497 : 155036 : (define_insn "x86_64_shld"
14498 : : [(set (match_operand:DI 0 "nonimmediate_operand" "+r*m")
14499 : 125491 : (ior:DI (ashift:DI (match_dup 0)
14500 : 125491 : (and:QI (match_operand:QI 2 "nonmemory_operand" "Jc")
14501 : 125491 : (const_int 63)))
14502 : 125491 : (subreg:DI
14503 : : (lshiftrt:TI
14504 : 121473 : (zero_extend:TI
14505 : 121473 : (match_operand:DI 1 "register_operand" "r"))
14506 : 121473 : (minus:QI (const_int 64)
14507 : 123304 : (and:QI (match_dup 2) (const_int 63)))) 0)))
14508 : 121473 : (clobber (reg:CC FLAGS_REG))]
14509 : 248339 : "TARGET_64BIT"
14510 : 1831 : "shld{q}\t{%2, %1, %0|%0, %1, %2}"
14511 : 120682 : [(set_attr "type" "ishift")
14512 : 1831 : (set_attr "prefix_0f" "1")
14513 : 62257 : (set_attr "mode" "DI")
14514 : 62257 : (set_attr "athlon_decode" "vector")
14515 : 62104 : (set_attr "amdfam10_decode" "vector")
14516 : 62104 : (set_attr "bdver1_decode" "vector")])
14517 : 125233 :
14518 : : (define_insn "x86_64_shld_ndd"
14519 : 346 : [(set (match_operand:DI 0 "register_operand" "=r")
14520 : 193 : (ior:DI (ashift:DI (match_operand:DI 1 "nonimmediate_operand" "rm")
14521 : 153 : (and:QI (match_operand:QI 3 "nonmemory_operand" "Jc")
14522 : 346 : (const_int 63)))
14523 : 346 : (subreg:DI
14524 : 346 : (lshiftrt:TI
14525 : 153 : (zero_extend:TI
14526 : 153 : (match_operand:DI 2 "register_operand" "r"))
14527 : 193 : (minus:QI (const_int 64)
14528 : 193 : (and:QI (match_dup 3) (const_int 63)))) 0)))
14529 : : (clobber (reg:CC FLAGS_REG))]
14530 : 346 : "TARGET_APX_NDD"
14531 : : "shld{q}\t{%3, %2, %1, %0|%0, %1, %2, %3}"
14532 : 0 : [(set_attr "type" "ishift")
14533 : 0 : (set_attr "mode" "DI")])
14534 : 1947 :
14535 : 1947 : (define_insn "x86_64_shld_1"
14536 : 1952 : [(set (match_operand:DI 0 "nonimmediate_operand" "+r*m")
14537 : 10 : (ior:DI (ashift:DI (match_dup 0)
14538 : 5 : (match_operand:QI 2 "const_0_to_63_operand"))
14539 : 1942 : (subreg:DI
14540 : 1942 : (lshiftrt:TI
14541 : 1942 : (zero_extend:TI
14542 : 1942 : (match_operand:DI 1 "register_operand" "r"))
14543 : 1942 : (match_operand:QI 3 "const_0_to_255_operand")) 0)))
14544 : 1942 : (clobber (reg:CC FLAGS_REG))]
14545 : 0 : "TARGET_64BIT
14546 : 2339 : && INTVAL (operands[3]) == 64 - INTVAL (operands[2])"
14547 : : "shld{q}\t{%2, %1, %0|%0, %1, %2}"
14548 : 1944 : [(set_attr "type" "ishift")
14549 : 2 : (set_attr "prefix_0f" "1")
14550 : 2 : (set_attr "mode" "DI")
14551 : 1942 : (set_attr "length_immediate" "1")
14552 : 0 : (set_attr "athlon_decode" "vector")
14553 : 0 : (set_attr "amdfam10_decode" "vector")
14554 : 0 : (set_attr "bdver1_decode" "vector")])
14555 : 0 :
14556 : 0 : (define_insn "x86_64_shld_ndd_1"
14557 : 0 : [(set (match_operand:DI 0 "register_operand" "=r")
14558 : 0 : (ior:DI (ashift:DI (match_operand:DI 1 "nonimmediate_operand" "rm")
14559 : 0 : (match_operand:QI 3 "const_0_to_63_operand"))
14560 : 0 : (subreg:DI
14561 : 0 : (lshiftrt:TI
14562 : 0 : (zero_extend:TI
14563 : 0 : (match_operand:DI 2 "register_operand" "r"))
14564 : 0 : (match_operand:QI 4 "const_0_to_255_operand")) 0)))
14565 : 0 : (clobber (reg:CC FLAGS_REG))]
14566 : 2 : "TARGET_APX_NDD
14567 : 2 : && INTVAL (operands[4]) == 64 - INTVAL (operands[3])"
14568 : : "shld{q}\t{%3, %2, %1, %0|%0, %1, %2, %3}"
14569 : 0 : [(set_attr "type" "ishift")
14570 : 0 : (set_attr "mode" "DI")
14571 : 80 : (set_attr "length_immediate" "1")])
14572 : 80 :
14573 : 80 :
14574 : 80 : (define_insn_and_split "*x86_64_shld_shrd_1_nozext"
14575 : 80 : [(set (match_operand:DI 0 "nonimmediate_operand")
14576 : : (ior:DI (ashift:DI (match_operand:DI 4 "nonimmediate_operand")
14577 : : (match_operand:QI 2 "const_0_to_63_operand"))
14578 : : (lshiftrt:DI
14579 : : (match_operand:DI 1 "nonimmediate_operand")
14580 : : (match_operand:QI 3 "const_0_to_63_operand"))))
14581 : : (clobber (reg:CC FLAGS_REG))]
14582 : 474 : "TARGET_64BIT
14583 : 1131 : && INTVAL (operands[3]) == 64 - INTVAL (operands[2])
14584 : 1068 : && ix86_pre_reload_split ()"
14585 : 204 : "#"
14586 : 71 : "&& 1"
14587 : 140 : [(const_int 0)]
14588 : 810 : {
14589 : 490 : if (rtx_equal_p (operands[4], operands[0]))
14590 : 37 : {
14591 : 67 : operands[1] = force_reg (DImode, operands[1]);
14592 : 0 : emit_insn (gen_x86_64_shld_1 (operands[0], operands[1], operands[2], operands[3]));
14593 : : }
14594 : 405 : else if (rtx_equal_p (operands[1], operands[0]))
14595 : : {
14596 : 7 : operands[4] = force_reg (DImode, operands[4]);
14597 : 7 : emit_insn (gen_x86_64_shrd_1 (operands[0], operands[4], operands[3], operands[2]));
14598 : : }
14599 : 398 : else if (TARGET_APX_NDD)
14600 : : {
14601 : 2 : rtx tmp = gen_reg_rtx (DImode);
14602 : 2 : if (MEM_P (operands[4]))
14603 : : {
14604 : 0 : operands[1] = force_reg (DImode, operands[1]);
14605 : 0 : emit_insn (gen_x86_64_shld_ndd_1 (tmp, operands[4], operands[1],
14606 : : operands[2], operands[3]));
14607 : : }
14608 : 2 : else if (MEM_P (operands[1]))
14609 : 2 : emit_insn (gen_x86_64_shrd_ndd_1 (tmp, operands[1], operands[4],
14610 : : operands[3], operands[2]));
14611 : : else
14612 : 0 : emit_insn (gen_x86_64_shld_ndd_1 (tmp, operands[4], operands[1],
14613 : : operands[2], operands[3]));
14614 : 2 : emit_move_insn (operands[0], tmp);
14615 : : }
14616 : : else
14617 : : {
14618 : 396 : operands[1] = force_reg (DImode, operands[1]);
14619 : 396 : rtx tmp = gen_reg_rtx (DImode);
14620 : 396 : emit_move_insn (tmp, operands[4]);
14621 : 396 : emit_insn (gen_x86_64_shld_1 (tmp, operands[1], operands[2], operands[3]));
14622 : 396 : emit_move_insn (operands[0], tmp);
14623 : : }
14624 : 405 : DONE;
14625 : : })
14626 : :
14627 : : (define_insn_and_split "*x86_64_shld_2"
14628 : : [(set (match_operand:DI 0 "nonimmediate_operand")
14629 : : (ior:DI (ashift:DI (match_dup 0)
14630 : : (match_operand:QI 2 "nonmemory_operand"))
14631 : : (lshiftrt:DI (match_operand:DI 1 "register_operand")
14632 : : (minus:QI (const_int 64) (match_dup 2)))))
14633 : : (clobber (reg:CC FLAGS_REG))]
14634 : 0 : "TARGET_64BIT && ix86_pre_reload_split ()"
14635 : : "#"
14636 : 0 : "&& 1"
14637 : 0 : [(parallel [(set (match_dup 0)
14638 : 0 : (ior:DI (ashift:DI (match_dup 0)
14639 : 0 : (and:QI (match_dup 2) (const_int 63)))
14640 : 0 : (subreg:DI
14641 : 0 : (lshiftrt:TI
14642 : 0 : (zero_extend:TI (match_dup 1))
14643 : 0 : (minus:QI (const_int 64)
14644 : 0 : (and:QI (match_dup 2)
14645 : 0 : (const_int 63)))) 0)))
14646 : 0 : (clobber (reg:CC FLAGS_REG))])])
14647 : 0 :
14648 : 0 : (define_insn_and_split "*x86_64_shld_ndd_2"
14649 : 0 : [(set (match_operand:DI 0 "nonimmediate_operand")
14650 : 0 : (ior:DI (ashift:DI (match_operand:DI 1 "nonimmediate_operand")
14651 : 0 : (match_operand:QI 3 "nonmemory_operand"))
14652 : 0 : (lshiftrt:DI (match_operand:DI 2 "register_operand")
14653 : : (minus:QI (const_int 64) (match_dup 3)))))
14654 : : (clobber (reg:CC FLAGS_REG))]
14655 : 0 : "TARGET_APX_NDD
14656 : 0 : && ix86_pre_reload_split ()"
14657 : 0 : "#"
14658 : 0 : "&& 1"
14659 : 0 : [(parallel [(set (match_dup 4)
14660 : 0 : (ior:DI (ashift:DI (match_dup 1)
14661 : 0 : (and:QI (match_dup 3) (const_int 63)))
14662 : 0 : (subreg:DI
14663 : 0 : (lshiftrt:TI
14664 : 0 : (zero_extend:TI (match_dup 2))
14665 : 0 : (minus:QI (const_int 64)
14666 : 0 : (and:QI (match_dup 3)
14667 : 0 : (const_int 63)))) 0)))
14668 : 0 : (clobber (reg:CC FLAGS_REG))
14669 : 0 : (set (match_dup 0) (match_dup 4))])]
14670 : 0 : {
14671 : 0 : operands[4] = gen_reg_rtx (DImode);
14672 : 0 : emit_move_insn (operands[4], operands[0]);
14673 : 0 : })
14674 : 0 :
14675 : : (define_insn "x86_shld"
14676 : 0 : [(set (match_operand:SI 0 "nonimmediate_operand" "+r*m")
14677 : 0 : (ior:SI (ashift:SI (match_dup 0)
14678 : 0 : (and:QI (match_operand:QI 2 "nonmemory_operand" "Ic")
14679 : 0 : (const_int 31)))
14680 : 0 : (subreg:SI
14681 : 0 : (lshiftrt:DI
14682 : 0 : (zero_extend:DI
14683 : 0 : (match_operand:SI 1 "register_operand" "r"))
14684 : 0 : (minus:QI (const_int 32)
14685 : 0 : (and:QI (match_dup 2) (const_int 31)))) 0)))
14686 : 0 : (clobber (reg:CC FLAGS_REG))]
14687 : 0 : ""
14688 : 0 : "shld{l}\t{%2, %1, %0|%0, %1, %2}"
14689 : 0 : [(set_attr "type" "ishift")
14690 : 0 : (set_attr "prefix_0f" "1")
14691 : : (set_attr "mode" "SI")
14692 : : (set_attr "pent_pair" "np")
14693 : : (set_attr "athlon_decode" "vector")
14694 : : (set_attr "amdfam10_decode" "vector")
14695 : : (set_attr "bdver1_decode" "vector")])
14696 : :
14697 : : (define_insn "x86_shld_ndd"
14698 : : [(set (match_operand:SI 0 "nonimmediate_operand" "=r")
14699 : : (ior:SI (ashift:SI (match_operand:SI 1 "nonimmediate_operand" "rm")
14700 : : (and:QI (match_operand:QI 3 "nonmemory_operand" "Ic")
14701 : : (const_int 31)))
14702 : : (subreg:SI
14703 : : (lshiftrt:DI
14704 : : (zero_extend:DI
14705 : : (match_operand:SI 2 "register_operand" "r"))
14706 : : (minus:QI (const_int 32)
14707 : : (and:QI (match_dup 3) (const_int 31)))) 0)))
14708 : 0 : (clobber (reg:CC FLAGS_REG))]
14709 : 0 : "TARGET_APX_NDD"
14710 : 0 : "shld{l}\t{%3, %2, %1, %0|%0, %1, %2, %3}"
14711 : 0 : [(set_attr "type" "ishift")
14712 : 0 : (set_attr "mode" "SI")])
14713 : 167690 :
14714 : 167690 :
14715 : 167690 : (define_insn "x86_shld_1"
14716 : 67 : [(set (match_operand:SI 0 "nonimmediate_operand" "+r*m")
14717 : 4952 : (ior:SI (ashift:SI (match_dup 0)
14718 : 5019 : (match_operand:QI 2 "const_0_to_31_operand"))
14719 : 67 : (subreg:SI
14720 : 399 : (lshiftrt:DI
14721 : 466 : (zero_extend:DI
14722 : 24708 : (match_operand:SI 1 "register_operand" "r"))
14723 : 24708 : (match_operand:QI 3 "const_0_to_63_operand")) 0)))
14724 : 399 : (clobber (reg:CC FLAGS_REG))]
14725 : 78 : "INTVAL (operands[3]) == 32 - INTVAL (operands[2])"
14726 : 306 : "shld{l}\t{%2, %1, %0|%0, %1, %2}"
14727 : 2 : [(set_attr "type" "ishift")
14728 : 2 : (set_attr "prefix_0f" "1")
14729 : 2 : (set_attr "length_immediate" "1")
14730 : 0 : (set_attr "mode" "SI")
14731 : 0 : (set_attr "pent_pair" "np")
14732 : 0 : (set_attr "athlon_decode" "vector")
14733 : : (set_attr "amdfam10_decode" "vector")
14734 : : (set_attr "bdver1_decode" "vector")])
14735 : :
14736 : : (define_insn "x86_shld_ndd_1"
14737 : : [(set (match_operand:SI 0 "register_operand" "=r")
14738 : : (ior:SI (ashift:SI (match_operand:SI 1 "nonimmediate_operand" "rm")
14739 : : (match_operand:QI 3 "const_0_to_31_operand"))
14740 : : (subreg:SI
14741 : : (lshiftrt:DI
14742 : : (zero_extend:DI
14743 : : (match_operand:SI 2 "register_operand" "r"))
14744 : : (match_operand:QI 4 "const_0_to_63_operand")) 0)))
14745 : : (clobber (reg:CC FLAGS_REG))]
14746 : 2 : "TARGET_APX_NDD
14747 : 2 : && INTVAL (operands[4]) == 32 - INTVAL (operands[3])"
14748 : : "shld{l}\t{%3, %2, %1, %0|%0, %1, %2, %3}"
14749 : 0 : [(set_attr "type" "ishift")
14750 : 0 : (set_attr "length_immediate" "1")
14751 : : (set_attr "mode" "SI")])
14752 : :
14753 : :
14754 : : (define_insn_and_split "*x86_shld_shrd_1_nozext"
14755 : 1685 : [(set (match_operand:SI 0 "nonimmediate_operand")
14756 : 1685 : (ior:SI (ashift:SI (match_operand:SI 4 "nonimmediate_operand")
14757 : 1775 : (match_operand:QI 2 "const_0_to_31_operand"))
14758 : 636 : (lshiftrt:SI
14759 : 2978 : (match_operand:SI 1 "nonimmediate_operand")
14760 : : (match_operand:QI 3 "const_0_to_31_operand"))))
14761 : 181 : (clobber (reg:CC FLAGS_REG))]
14762 : 547 : "INTVAL (operands[3]) == 32 - INTVAL (operands[2])
14763 : 189 : && ix86_pre_reload_split ()"
14764 : 78 : "#"
14765 : 27 : "&& 1"
14766 : 50 : [(const_int 0)]
14767 : 134 : {
14768 : 67 : if (rtx_equal_p (operands[4], operands[0]))
14769 : 0 : {
14770 : 0 : operands[1] = force_reg (SImode, operands[1]);
14771 : 0 : emit_insn (gen_x86_shld_1 (operands[0], operands[1], operands[2], operands[3]));
14772 : 0 : }
14773 : 67 : else if (rtx_equal_p (operands[1], operands[0]))
14774 : 0 : {
14775 : 2 : operands[4] = force_reg (SImode, operands[4]);
14776 : 2 : emit_insn (gen_x86_shrd_1 (operands[0], operands[4], operands[3], operands[2]));
14777 : 0 : }
14778 : 65 : else if (TARGET_APX_NDD)
14779 : 0 : {
14780 : 2 : rtx tmp = gen_reg_rtx (SImode);
14781 : 2 : if (MEM_P (operands[4]))
14782 : : {
14783 : 0 : operands[1] = force_reg (SImode, operands[1]);
14784 : 0 : emit_insn (gen_x86_shld_ndd_1 (tmp, operands[4], operands[1],
14785 : : operands[2], operands[3]));
14786 : : }
14787 : 2 : else if (MEM_P (operands[1]))
14788 : 2 : emit_insn (gen_x86_shrd_ndd_1 (tmp, operands[1], operands[4],
14789 : : operands[3], operands[2]));
14790 : : else
14791 : 0 : emit_insn (gen_x86_shld_ndd_1 (tmp, operands[4], operands[1],
14792 : : operands[2], operands[3]));
14793 : 2 : emit_move_insn (operands[0], tmp);
14794 : : }
14795 : : else
14796 : : {
14797 : 63 : operands[1] = force_reg (SImode, operands[1]);
14798 : 63 : rtx tmp = gen_reg_rtx (SImode);
14799 : 63 : emit_move_insn (tmp, operands[4]);
14800 : 63 : emit_insn (gen_x86_shld_1 (tmp, operands[1], operands[2], operands[3]));
14801 : 63 : emit_move_insn (operands[0], tmp);
14802 : : }
14803 : 67 : DONE;
14804 : : })
14805 : :
14806 : : (define_insn_and_split "*x86_shld_2"
14807 : : [(set (match_operand:SI 0 "nonimmediate_operand")
14808 : : (ior:SI (ashift:SI (match_dup 0)
14809 : : (match_operand:QI 2 "nonmemory_operand"))
14810 : : (lshiftrt:SI (match_operand:SI 1 "register_operand")
14811 : : (minus:QI (const_int 32) (match_dup 2)))))
14812 : : (clobber (reg:CC FLAGS_REG))]
14813 : 0 : "TARGET_64BIT && ix86_pre_reload_split ()"
14814 : : "#"
14815 : 0 : "&& 1"
14816 : 0 : [(parallel [(set (match_dup 0)
14817 : 0 : (ior:SI (ashift:SI (match_dup 0)
14818 : 0 : (and:QI (match_dup 2) (const_int 31)))
14819 : 0 : (subreg:SI
14820 : 0 : (lshiftrt:DI
14821 : 0 : (zero_extend:DI (match_dup 1))
14822 : 0 : (minus:QI (const_int 32)
14823 : 0 : (and:QI (match_dup 2)
14824 : 0 : (const_int 31)))) 0)))
14825 : 0 : (clobber (reg:CC FLAGS_REG))])])
14826 : 0 :
14827 : 0 : (define_insn_and_split "*x86_shld_ndd_2"
14828 : 0 : [(set (match_operand:SI 0 "nonimmediate_operand")
14829 : 0 : (ior:SI (ashift:SI (match_operand:SI 1 "nonimmediate_operand")
14830 : 0 : (match_operand:QI 3 "nonmemory_operand"))
14831 : 0 : (lshiftrt:SI (match_operand:SI 2 "register_operand")
14832 : : (minus:QI (const_int 32) (match_dup 3)))))
14833 : : (clobber (reg:CC FLAGS_REG))]
14834 : 0 : "TARGET_APX_NDD
14835 : 0 : && ix86_pre_reload_split ()"
14836 : 0 : "#"
14837 : 0 : "&& 1"
14838 : 0 : [(parallel [(set (match_dup 4)
14839 : 0 : (ior:SI (ashift:SI (match_dup 1)
14840 : : (and:QI (match_dup 3) (const_int 31)))
14841 : : (subreg:SI
14842 : : (lshiftrt:DI
14843 : : (zero_extend:DI (match_dup 2))
14844 : : (minus:QI (const_int 32)
14845 : 564 : (and:QI (match_dup 3)
14846 : 564 : (const_int 31)))) 0)))
14847 : : (clobber (reg:CC FLAGS_REG))
14848 : 271 : (set (match_dup 0) (match_dup 4))])]
14849 : 307 : {
14850 : 4 : operands[4] = gen_reg_rtx (SImode);
14851 : 311 : emit_move_insn (operands[4], operands[0]);
14852 : 1448 : })
14853 : 193 :
14854 : 1005 : (define_expand "@x86_shift<mode>_adj_1"
14855 : 812 : [(set (reg:CCZ FLAGS_REG)
14856 : 193 : (compare:CCZ (and:QI (match_operand:QI 2 "register_operand")
14857 : 412 : (match_dup 4))
14858 : 193 : (const_int 0)))
14859 : 193 : (set (match_operand:SWI48 0 "register_operand")
14860 : 396 : (if_then_else:SWI48 (ne (reg:CCZ FLAGS_REG) (const_int 0))
14861 : 589 : (match_operand:SWI48 1 "register_operand")
14862 : 396 : (match_dup 0)))
14863 : 193 : (set (match_dup 1)
14864 : 343 : (if_then_else:SWI48 (ne (reg:CCZ FLAGS_REG) (const_int 0))
14865 : 0 : (match_operand:SWI48 3 "register_operand")
14866 : 17 : (match_dup 1)))]
14867 : 17 : "TARGET_CMOVE"
14868 : 2230 : "operands[4] = GEN_INT (GET_MODE_BITSIZE (<MODE>mode));")
14869 : 0 :
14870 : : (define_expand "@x86_shift<mode>_adj_2"
14871 : 2230 : [(use (match_operand:SWI48 0 "register_operand"))
14872 : 2230 : (use (match_operand:SWI48 1 "register_operand"))
14873 : 2230 : (use (match_operand:QI 2 "register_operand"))]
14874 : 2230 : ""
14875 : 2872 : {
14876 : 3514 : rtx_code_label *label = gen_label_rtx ();
14877 : 2872 : rtx tmp;
14878 : 2230 :
14879 : 1284 : emit_insn (gen_testqi_ccz_1 (operands[2],
14880 : 642 : GEN_INT (GET_MODE_BITSIZE (<MODE>mode))));
14881 : :
14882 : 2872 : tmp = gen_rtx_REG (CCZmode, FLAGS_REG);
14883 : 642 : tmp = gen_rtx_EQ (VOIDmode, tmp, const0_rtx);
14884 : 642 : tmp = gen_rtx_IF_THEN_ELSE (VOIDmode, tmp,
14885 : : gen_rtx_LABEL_REF (VOIDmode, label),
14886 : : pc_rtx);
14887 : 642 : tmp = emit_jump_insn (gen_rtx_SET (pc_rtx, tmp));
14888 : 0 : JUMP_LABEL (tmp) = label;
14889 : 2230 :
14890 : 642 : emit_move_insn (operands[0], operands[1]);
14891 : 642 : ix86_expand_clear (operands[1]);
14892 : :
14893 : 642 : emit_label (label);
14894 : 2471 : LABEL_NUSES (label) = 1;
14895 : :
14896 : 642 : DONE;
14897 : 2230 : })
14898 : :
14899 : 1829 : ;; Avoid useless masking of count operand.
14900 : 1829 : (define_insn_and_split "*ashl<mode>3_mask"
14901 : 1829 : [(set (match_operand:SWI48 0 "nonimmediate_operand")
14902 : 1829 : (ashift:SWI48
14903 : 1829 : (match_operand:SWI48 1 "nonimmediate_operand")
14904 : 1829 : (subreg:QI
14905 : 2230 : (and
14906 : 2230 : (match_operand 2 "int248_register_operand" "c,r")
14907 : 1829 : (match_operand 3 "const_int_operand")) 0)))
14908 : : (clobber (reg:CC FLAGS_REG))]
14909 : 25350 : "ix86_binary_operator_ok (ASHIFT, <MODE>mode, operands)
14910 : 47010 : && (INTVAL (operands[3]) & (GET_MODE_BITSIZE (<MODE>mode)-1))
14911 : 25295 : == GET_MODE_BITSIZE (<MODE>mode)-1
14912 : 35253 : && ix86_pre_reload_split ()"
14913 : : "#"
14914 : 1228 : "&& 1"
14915 : 5729 : [(parallel
14916 : 552 : [(set (match_dup 0)
14917 : 552 : (ashift:SWI48 (match_dup 1)
14918 : 953 : (match_dup 2)))
14919 : 1257291 : (clobber (reg:CC FLAGS_REG))])]
14920 : 823521 : {
14921 : 2079368 : operands[2] = force_reg (GET_MODE (operands[2]), operands[2]);
14922 : 445725 : operands[2] = gen_lowpart (QImode, operands[2]);
14923 : 1604334 : }
14924 : 1604424 : [(set_attr "isa" "*,bmi2")])
14925 : 894950 :
14926 : 51626 : (define_insn_and_split "*ashl<mode>3_mask_1"
14927 : 47035 : [(set (match_operand:SWI48 0 "nonimmediate_operand")
14928 : 784016 : (ashift:SWI48
14929 : 3580 : (match_operand:SWI48 1 "nonimmediate_operand")
14930 : 90 : (and:QI
14931 : 4501 : (match_operand:QI 2 "register_operand" "c,r")
14932 : 4501 : (match_operand:QI 3 "const_int_operand"))))
14933 : : (clobber (reg:CC FLAGS_REG))]
14934 : 3076 : "ix86_binary_operator_ok (ASHIFT, <MODE>mode, operands)
14935 : 6152 : && (INTVAL (operands[3]) & (GET_MODE_BITSIZE (<MODE>mode)-1))
14936 : 3076 : == GET_MODE_BITSIZE (<MODE>mode)-1
14937 : 2980 : && ix86_pre_reload_split ()"
14938 : 166 : "#"
14939 : 4520 : "&& 1"
14940 : 4522 : [(parallel
14941 : 5232 : [(set (match_dup 0)
14942 : : (ashift:SWI48 (match_dup 1)
14943 : 1 : (match_dup 2)))
14944 : 2 : (clobber (reg:CC FLAGS_REG))])]
14945 : : ""
14946 : : [(set_attr "isa" "*,bmi2")])
14947 : 1082 :
14948 : 731 : (define_insn "*bmi2_ashl<mode>3_1"
14949 : 90510 : [(set (match_operand:SWI48 0 "register_operand" "=r")
14950 : 90510 : (ashift:SWI48 (match_operand:SWI48 1 "nonimmediate_operand" "rm")
14951 : 111238 : (match_operand:SWI48 2 "register_operand" "r")))]
14952 : 115468 : "TARGET_BMI2"
14953 : 60501 : "shlx\t{%2, %1, %0|%0, %1, %2}"
14954 : 705429 : [(set_attr "type" "ishiftx")
14955 : 1898 : (set_attr "mode" "<MODE>")])
14956 : 409242 :
14957 : 409242 : (define_insn "*ashl<mode>3_1"
14958 : 409242 : [(set (match_operand:SWI48 0 "nonimmediate_operand" "=rm,r,r,?k,r")
14959 : : (ashift:SWI48 (match_operand:SWI48 1 "nonimmediate_operand" "0,l,rm,k,rm")
14960 : 395237 : (match_operand:QI 2 "nonmemory_operand" "c<S>,M,r,<KS>,c<S>")))
14961 : 395952 : (clobber (reg:CC FLAGS_REG))]
14962 : 1819288 : "ix86_binary_operator_ok (ASHIFT, <MODE>mode, operands, TARGET_APX_NDD)"
14963 : 1194464 : {
14964 : 236539 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
14965 : 547641 : switch (get_attr_type (insn))
14966 : 22955 : {
14967 : 22955 : case TYPE_LEA:
14968 : 22955 : case TYPE_ISHIFTX:
14969 : 23566 : case TYPE_MSKLOG:
14970 : 43759 : return "#";
14971 : 611 :
14972 : 667293 : case TYPE_ALU:
14973 : 652219 : gcc_assert (operands[2] == const1_rtx);
14974 : 460545 : gcc_assert (rtx_equal_p (operands[0], operands[1]));
14975 : 1005899 : return "add{<imodesuffix>}\t%0, %0";
14976 : 311824 :
14977 : 692481 : default:
14978 : 416950 : if (operands[2] == const1_rtx
14979 : 295884 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
14980 : : /* For NDD form instructions related to TARGET_SHIFT1, the $1
14981 : : immediate do not need to be omitted as assembler will map it
14982 : : to use shorter encoding. */
14983 : 398336 : && !use_ndd)
14984 : : return "sal{<imodesuffix>}\t%0";
14985 : : else
14986 : 397018 : return use_ndd ? "sal{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
14987 : 397018 : : "sal{<imodesuffix>}\t{%2, %0|%0, %2}";
14988 : : }
14989 : : }
14990 : : [(set_attr "isa" "*,*,bmi2,avx512bw,apx_ndd")
14991 : : (set (attr "type")
14992 : : (cond [(eq_attr "alternative" "1")
14993 : 311976 : (const_string "lea")
14994 : : (eq_attr "alternative" "2")
14995 : : (const_string "ishiftx")
14996 : : (eq_attr "alternative" "4")
14997 : : (const_string "ishift")
14998 : : (and (and (match_test "TARGET_DOUBLE_WITH_ADD")
14999 : : (match_operand 0 "register_operand"))
15000 : : (match_operand 2 "const1_operand"))
15001 : : (const_string "alu")
15002 : : (eq_attr "alternative" "3")
15003 : : (const_string "msklog")
15004 : : ]
15005 : : (const_string "ishift")))
15006 : : (set (attr "length_immediate")
15007 : : (if_then_else
15008 : : (ior (eq_attr "type" "alu")
15009 : : (and (eq_attr "type" "ishift")
15010 : : (and (match_operand 2 "const1_operand")
15011 : : (ior (match_test "TARGET_SHIFT1")
15012 : : (match_test "optimize_function_for_size_p (cfun)")))))
15013 : : (const_string "0")
15014 : : (const_string "*")))
15015 : : (set_attr "mode" "<MODE>")])
15016 : :
15017 : : ;; Convert shift to the shiftx pattern to avoid flags dependency.
15018 : : (define_split
15019 : : [(set (match_operand:SWI48 0 "register_operand")
15020 : : (ashift:SWI48 (match_operand:SWI48 1 "nonimmediate_operand")
15021 : : (match_operand:QI 2 "register_operand")))
15022 : : (clobber (reg:CC FLAGS_REG))]
15023 : 73284 : "TARGET_BMI2 && reload_completed"
15024 : 79236 : [(set (match_dup 0)
15025 : 41 : (ashift:SWI48 (match_dup 1) (match_dup 2)))]
15026 : 56 : "operands[2] = gen_lowpart (<MODE>mode, operands[2]);")
15027 : 1265032 :
15028 : 1265032 : (define_insn "*bmi2_ashlsi3_1_zext"
15029 : 1265088 : [(set (match_operand:DI 0 "register_operand" "=r")
15030 : 56 : (zero_extend:DI
15031 : 608430 : (ashift:SI (match_operand:SI 1 "nonimmediate_operand" "rm")
15032 : 56 : (match_operand:SI 2 "register_operand" "r"))))]
15033 : 56 : "TARGET_64BIT && TARGET_BMI2"
15034 : 28448 : "shlx\t{%2, %1, %k0|%k0, %1, %2}"
15035 : 14183 : [(set_attr "type" "ishiftx")
15036 : 14599 : (set_attr "mode" "SI")])
15037 : 43256 :
15038 : : (define_insn "*ashlsi3_1_zext"
15039 : 56 : [(set (match_operand:DI 0 "register_operand" "=r,r,r,r")
15040 : 56 : (zero_extend:DI
15041 : 56 : (ashift:SI (match_operand:SI 1 "nonimmediate_operand" "0,l,rm,rm")
15042 : : (match_operand:QI 2 "nonmemory_operand" "cI,M,r,cI"))))
15043 : : (clobber (reg:CC FLAGS_REG))]
15044 : 2093 : "TARGET_64BIT
15045 : 1969 : && ix86_binary_operator_ok (ASHIFT, SImode, operands, TARGET_APX_NDD)"
15046 : 1510 : {
15047 : 1138 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
15048 : 1123 : switch (get_attr_type (insn))
15049 : 291 : {
15050 : 291 : case TYPE_LEA:
15051 : 218 : case TYPE_ISHIFTX:
15052 : 27 : return "#";
15053 : 59 :
15054 : 763 : case TYPE_ALU:
15055 : 778 : gcc_assert (operands[2] == const1_rtx);
15056 : 44 : return "add{l}\t%k0, %k0";
15057 : 38 :
15058 : 167 : default:
15059 : 123 : if (operands[2] == const1_rtx
15060 : 0 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
15061 : 123 : && !use_ndd)
15062 : : return "sal{l}\t%k0";
15063 : : else
15064 : 123 : return use_ndd ? "sal{l}\t{%2, %1, %k0|%k0, %1, %2}"
15065 : 123 : : "sal{l}\t{%2, %k0|%k0, %2}";
15066 : : }
15067 : : }
15068 : : [(set_attr "isa" "*,*,bmi2,apx_ndd")
15069 : : (set (attr "type")
15070 : : (cond [(eq_attr "alternative" "1")
15071 : 59 : (const_string "lea")
15072 : : (eq_attr "alternative" "2")
15073 : : (const_string "ishiftx")
15074 : : (eq_attr "alternative" "3")
15075 : : (const_string "ishift")
15076 : : (and (match_test "TARGET_DOUBLE_WITH_ADD")
15077 : : (match_operand 2 "const1_operand"))
15078 : : (const_string "alu")
15079 : : ]
15080 : : (const_string "ishift")))
15081 : : (set (attr "length_immediate")
15082 : : (if_then_else
15083 : : (ior (eq_attr "type" "alu")
15084 : : (and (eq_attr "type" "ishift")
15085 : : (and (match_operand 2 "const1_operand")
15086 : : (ior (match_test "TARGET_SHIFT1")
15087 : : (match_test "optimize_function_for_size_p (cfun)")))))
15088 : : (const_string "0")
15089 : : (const_string "*")))
15090 : : (set_attr "mode" "SI")])
15091 : :
15092 : : ;; Convert shift to the shiftx pattern to avoid flags dependency.
15093 : : (define_split
15094 : : [(set (match_operand:DI 0 "register_operand")
15095 : : (zero_extend:DI
15096 : : (ashift:SI (match_operand:SI 1 "nonimmediate_operand")
15097 : : (match_operand:QI 2 "register_operand"))))
15098 : : (clobber (reg:CC FLAGS_REG))]
15099 : 172 : "TARGET_64BIT && TARGET_BMI2 && reload_completed"
15100 : 178 : [(set (match_dup 0)
15101 : 0 : (zero_extend:DI (ashift:SI (match_dup 1) (match_dup 2))))]
15102 : 0 : "operands[2] = gen_lowpart (SImode, operands[2]);")
15103 : 823 :
15104 : 823 : (define_insn "*ashlhi3_1"
15105 : 809 : [(set (match_operand:HI 0 "nonimmediate_operand" "=rm,Yp,?k,r")
15106 : 809 : (ashift:HI (match_operand:HI 1 "nonimmediate_operand" "0,l,k,rm")
15107 : 1632 : (match_operand:QI 2 "nonmemory_operand" "cI,M,Ww,cI")))
15108 : 0 : (clobber (reg:CC FLAGS_REG))]
15109 : 41476 : "ix86_binary_operator_ok (ASHIFT, HImode, operands, TARGET_APX_NDD)"
15110 : 4090 : {
15111 : 19464 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
15112 : 19464 : switch (get_attr_type (insn))
15113 : 37799 : {
15114 : 37799 : case TYPE_LEA:
15115 : 63165 : case TYPE_MSKLOG:
15116 : 81731 : return "#";
15117 : 70643 :
15118 : 0 : case TYPE_ALU:
15119 : 0 : gcc_assert (operands[2] == const1_rtx);
15120 : : return "add{w}\t%0, %0";
15121 : :
15122 : 59 : default:
15123 : 59 : if (operands[2] == const1_rtx
15124 : 63 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
15125 : 111 : && !use_ndd)
15126 : 11 : return "sal{w}\t%0";
15127 : 11 : else
15128 : 19 : return use_ndd ? "sal{w}\t{%2, %1, %0|%0, %1, %2}"
15129 : 19 : : "sal{w}\t{%2, %0|%0, %2}";
15130 : 11 : }
15131 : 0 : }
15132 : 11 : [(set_attr "isa" "*,*,avx512f,apx_ndd")
15133 : : (set (attr "type")
15134 : : (cond [(eq_attr "alternative" "1")
15135 : 62 : (const_string "lea")
15136 : : (eq_attr "alternative" "2")
15137 : : (const_string "msklog")
15138 : : (eq_attr "alternative" "3")
15139 : : (const_string "ishift")
15140 : : (and (and (match_test "TARGET_DOUBLE_WITH_ADD")
15141 : : (match_operand 0 "register_operand"))
15142 : : (match_operand 2 "const1_operand"))
15143 : : (const_string "alu")
15144 : : ]
15145 : : (const_string "ishift")))
15146 : : (set (attr "length_immediate")
15147 : : (if_then_else
15148 : : (ior (eq_attr "type" "alu")
15149 : : (and (eq_attr "type" "ishift")
15150 : : (and (match_operand 2 "const1_operand")
15151 : : (ior (match_test "TARGET_SHIFT1")
15152 : : (match_test "optimize_function_for_size_p (cfun)")))))
15153 : : (const_string "0")
15154 : : (const_string "*")))
15155 : : (set_attr "mode" "HI,SI,HI,HI")])
15156 : :
15157 : : (define_insn "*ashlqi3_1"
15158 : : [(set (match_operand:QI 0 "nonimmediate_operand" "=qm,r,Yp,?k,r")
15159 : : (ashift:QI (match_operand:QI 1 "nonimmediate_operand" "0,0,l,k,rm")
15160 : : (match_operand:QI 2 "nonmemory_operand" "cI,cI,M,Wb,cI")))
15161 : : (clobber (reg:CC FLAGS_REG))]
15162 : 51410 : "ix86_binary_operator_ok (ASHIFT, QImode, operands, TARGET_APX_NDD)"
15163 : 11074 : {
15164 : 14416 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
15165 : 14416 : switch (get_attr_type (insn))
15166 : 3 : {
15167 : 3 : case TYPE_LEA:
15168 : 880 : case TYPE_MSKLOG:
15169 : 880 : return "#";
15170 : 6 :
15171 : 0 : case TYPE_ALU:
15172 : 0 : gcc_assert (operands[2] == const1_rtx);
15173 : 0 : if (REG_P (operands[1]) && !ANY_QI_REGNO_P (REGNO (operands[1])))
15174 : : return "add{l}\t%k0, %k0";
15175 : : else
15176 : 0 : return "add{b}\t%0, %0";
15177 : :
15178 : 62 : default:
15179 : 62 : if (operands[2] == const1_rtx
15180 : 52 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
15181 : 114 : && !use_ndd)
15182 : : {
15183 : 51 : if (get_attr_mode (insn) == MODE_SI)
15184 : : return "sal{l}\t%k0";
15185 : : else
15186 : 51 : return "sal{b}\t%0";
15187 : : }
15188 : : else
15189 : : {
15190 : 11 : if (get_attr_mode (insn) == MODE_SI)
15191 : : return "sal{l}\t{%2, %k0|%k0, %2}";
15192 : : else
15193 : 11 : return use_ndd ? "sal{b}\t{%2, %1, %0|%0, %1, %2}"
15194 : 11 : : "sal{b}\t{%2, %0|%0, %2}";
15195 : : }
15196 : : }
15197 : : }
15198 : : [(set_attr "isa" "*,*,*,avx512dq,apx_ndd")
15199 : : (set (attr "type")
15200 : : (cond [(eq_attr "alternative" "2")
15201 : 13 : (const_string "lea")
15202 : : (eq_attr "alternative" "3")
15203 : : (const_string "msklog")
15204 : : (eq_attr "alternative" "4")
15205 : : (const_string "ishift")
15206 : : (and (and (match_test "TARGET_DOUBLE_WITH_ADD")
15207 : : (match_operand 0 "register_operand"))
15208 : : (match_operand 2 "const1_operand"))
15209 : : (const_string "alu")
15210 : : ]
15211 : : (const_string "ishift")))
15212 : : (set (attr "length_immediate")
15213 : : (if_then_else
15214 : : (ior (eq_attr "type" "alu")
15215 : : (and (eq_attr "type" "ishift")
15216 : : (and (match_operand 2 "const1_operand")
15217 : : (ior (match_test "TARGET_SHIFT1")
15218 : : (match_test "optimize_function_for_size_p (cfun)")))))
15219 : : (const_string "0")
15220 : : (const_string "*")))
15221 : : (set_attr "mode" "QI,SI,SI,QI,QI")
15222 : : ;; Potential partial reg stall on alternative 1.
15223 : : (set (attr "preferred_for_speed")
15224 : : (cond [(eq_attr "alternative" "1,4")
15225 : 17562 : (symbol_ref "!TARGET_PARTIAL_REG_STALL")]
15226 : : (symbol_ref "true")))])
15227 : :
15228 : : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
15229 : : (define_insn_and_split "*ashl<mode>3_1_slp"
15230 : : [(set (strict_low_part (match_operand:SWI12 0 "register_operand" "+<r>,&<r>"))
15231 : : (ashift:SWI12 (match_operand:SWI12 1 "register_operand" "0,!<r>")
15232 : : (match_operand:QI 2 "nonmemory_operand" "cI,cI")))
15233 : 85314 : (clobber (reg:CC FLAGS_REG))]
15234 : 4216 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
15235 : 4169 : {
15236 : 1169 : if (which_alternative)
15237 : 2540 : return "#";
15238 : 80082 :
15239 : 80631 : switch (get_attr_type (insn))
15240 : 55 : {
15241 : 24140 : case TYPE_ALU:
15242 : 1 : gcc_assert (operands[2] == const1_rtx);
15243 : 1688 : return "add{<imodesuffix>}\t%0, %0";
15244 : 1688 :
15245 : 1701 : default:
15246 : 1055242 : if (operands[2] == const1_rtx
15247 : 1055242 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun)))
15248 : 0 : return "sal{<imodesuffix>}\t%0";
15249 : 991348 : else
15250 : 991361 : return "sal{<imodesuffix>}\t{%2, %0|%0, %2}";
15251 : 991348 : }
15252 : 1982696 : }
15253 : 52 : "&& reload_completed
15254 : 39 : && !(rtx_equal_p (operands[0], operands[1]))"
15255 : 991359 : [(set (strict_low_part (match_dup 0)) (match_dup 1))
15256 : 865888 : (parallel
15257 : 1857223 : [(set (strict_low_part (match_dup 0))
15258 : 216948 : (ashift:SWI12 (match_dup 0) (match_dup 2)))
15259 : 3 : (clobber (reg:CC FLAGS_REG))])]
15260 : 774400 : ""
15261 : 799282 : [(set (attr "type")
15262 : : (cond [(and (match_test "TARGET_DOUBLE_WITH_ADD")
15263 : 24893 : (match_operand 2 "const1_operand"))
15264 : 24893 : (const_string "alu")
15265 : 11 : ]
15266 : 1261325 : (const_string "ishift")))
15267 : 1257822 : (set (attr "length_immediate")
15268 : 823975 : (if_then_else
15269 : 1257822 : (ior (eq_attr "type" "alu")
15270 : 1269560 : (and (eq_attr "type" "ishift")
15271 : 3441 : (and (match_operand 2 "const1_operand")
15272 : 3452 : (ior (match_test "TARGET_SHIFT1")
15273 : 6882 : (match_test "optimize_function_for_size_p (cfun)")))))
15274 : 969 : (const_string "0")
15275 : 12718 : (const_string "*")))
15276 : : (set_attr "mode" "<MODE>")])
15277 : 941 :
15278 : 941 : ;; Convert ashift to the lea pattern to avoid flags dependency.
15279 : 941 : (define_split
15280 : 11 : [(set (match_operand:SWI 0 "general_reg_operand")
15281 : 937 : (ashift:SWI (match_operand:SWI 1 "index_reg_operand")
15282 : 937 : (match_operand 2 "const_0_to_3_operand")))
15283 : 926 : (clobber (reg:CC FLAGS_REG))]
15284 : 254895 : "reload_completed
15285 : 333248 : && REGNO (operands[0]) != REGNO (operands[1])"
15286 : 139151 : [(set (match_dup 0)
15287 : 24744 : (mult:<LEAMODE> (match_dup 1) (match_dup 2)))]
15288 : 86675 : {
15289 : 216407 : if (<MODE>mode != <LEAMODE>mode)
15290 : 141274 : {
15291 : 88730 : operands[0] = gen_lowpart (<LEAMODE>mode, operands[0]);
15292 : 88730 : operands[1] = gen_lowpart (<LEAMODE>mode, operands[1]);
15293 : 221479 : }
15294 : 86675 : operands[2] = GEN_INT (1 << INTVAL (operands[2]));
15295 : 0 : })
15296 : 5771 :
15297 : : ;; Convert ashift to the lea pattern to avoid flags dependency.
15298 : 80904 : (define_split
15299 : 490066 : [(set (match_operand:DI 0 "general_reg_operand")
15300 : 80904 : (zero_extend:DI
15301 : 490066 : (ashift:SI (match_operand:SI 1 "index_reg_operand")
15302 : 490066 : (match_operand 2 "const_0_to_3_operand"))))
15303 : 490066 : (clobber (reg:CC FLAGS_REG))]
15304 : 81713 : "TARGET_64BIT && reload_completed
15305 : 809 : && REGNO (operands[0]) != REGNO (operands[1])"
15306 : 409972 : [(set (match_dup 0)
15307 : 13 : (zero_extend:DI (mult:SI (match_dup 1) (match_dup 2))))]
15308 : 446506 : {
15309 : 446519 : operands[1] = gen_lowpart (SImode, operands[1]);
15310 : 365615 : operands[2] = GEN_INT (1 << INTVAL (operands[2]));
15311 : 365602 : })
15312 : :
15313 : 343021 : ;; This pattern can't accept a variable shift count, since shifts by
15314 : 7462 : ;; zero don't affect the flags. We assume that shifts by constant
15315 : 7462 : ;; zero are optimized away.
15316 : 410731 : (define_insn "*ashl<mode>3_cmp"
15317 : 335585 : [(set (reg FLAGS_REG)
15318 : 410731 : (compare
15319 : 410731 : (ashift:SWI (match_operand:SWI 1 "nonimmediate_operand" "0,rm")
15320 : 335585 : (match_operand:QI 2 "<shift_immediate_operand>" "<S>,<S>"))
15321 : 410718 : (const_int 0)))
15322 : 410718 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,r")
15323 : 335584 : (ashift:SWI (match_dup 1) (match_dup 2)))]
15324 : 75170 : "(optimize_function_for_size_p (cfun)
15325 : 9525 : || !TARGET_PARTIAL_FLAG_REG_STALL
15326 : 13 : || (operands[2] == const1_rtx
15327 : 335585 : && (TARGET_SHIFT1
15328 : 0 : || (TARGET_DOUBLE_WITH_ADD && REG_P (operands[0])))))
15329 : 10954 : && ix86_match_ccmode (insn, CCGOCmode)
15330 : 10768 : && ix86_binary_operator_ok (ASHIFT, <MODE>mode, operands, TARGET_APX_NDD)"
15331 : 5277 : {
15332 : 12 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
15333 : 5162 : switch (get_attr_type (insn))
15334 : 10930 : {
15335 : 21696 : case TYPE_ALU:
15336 : 238 : gcc_assert (operands[2] == const1_rtx);
15337 : 0 : return "add{<imodesuffix>}\t%0, %0";
15338 : 0 :
15339 : 4924 : default:
15340 : 4924 : if (operands[2] == const1_rtx
15341 : 0 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
15342 : 4924 : && !use_ndd)
15343 : : return "sal{<imodesuffix>}\t%0";
15344 : : else
15345 : 4924 : return use_ndd ? "sal{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
15346 : 4924 : : "sal{<imodesuffix>}\t{%2, %0|%0, %2}";
15347 : : }
15348 : : }
15349 : : [(set_attr "isa" "*,apx_ndd")
15350 : : (set (attr "type")
15351 : : (cond [(eq_attr "alternative" "1")
15352 : 5150 : (const_string "ishift")
15353 : : (and (and (match_test "TARGET_DOUBLE_WITH_ADD")
15354 : : (match_operand 0 "register_operand"))
15355 : : (match_operand 2 "const1_operand"))
15356 : : (const_string "alu")
15357 : : ]
15358 : : (const_string "ishift")))
15359 : : (set (attr "length_immediate")
15360 : : (if_then_else
15361 : : (ior (eq_attr "type" "alu")
15362 : : (and (eq_attr "type" "ishift")
15363 : : (and (match_operand 2 "const1_operand")
15364 : : (ior (match_test "TARGET_SHIFT1")
15365 : : (match_test "optimize_function_for_size_p (cfun)")))))
15366 : : (const_string "0")
15367 : : (const_string "*")))
15368 : : (set_attr "mode" "<MODE>")])
15369 : :
15370 : : (define_insn "*ashlsi3_cmp_zext"
15371 : : [(set (reg FLAGS_REG)
15372 : : (compare
15373 : : (ashift:SI (match_operand:SI 1 "nonimmediate_operand" "0,rm")
15374 : : (match_operand:QI 2 "const_1_to_31_operand"))
15375 : : (const_int 0)))
15376 : : (set (match_operand:DI 0 "register_operand" "=r,r")
15377 : : (zero_extend:DI (ashift:SI (match_dup 1) (match_dup 2))))]
15378 : 0 : "TARGET_64BIT
15379 : 0 : && (optimize_function_for_size_p (cfun)
15380 : 0 : || !TARGET_PARTIAL_FLAG_REG_STALL
15381 : 0 : || (operands[2] == const1_rtx
15382 : 0 : && (TARGET_SHIFT1
15383 : 0 : || TARGET_DOUBLE_WITH_ADD)))
15384 : 0 : && ix86_match_ccmode (insn, CCGOCmode)
15385 : 0 : && ix86_binary_operator_ok (ASHIFT, SImode, operands, TARGET_APX_NDD)"
15386 : 2 : {
15387 : 0 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
15388 : 0 : switch (get_attr_type (insn))
15389 : : {
15390 : 0 : case TYPE_ALU:
15391 : 0 : gcc_assert (operands[2] == const1_rtx);
15392 : : return "add{l}\t%k0, %k0";
15393 : 0 :
15394 : 0 : default:
15395 : 0 : if (operands[2] == const1_rtx
15396 : 0 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
15397 : 0 : && !use_ndd)
15398 : : return "sal{l}\t%k0";
15399 : : else
15400 : 0 : return use_ndd ? "sal{l}\t{%2, %1, %k0|%k0, %1, %2}"
15401 : 0 : : "sal{l}\t{%2, %k0|%k0, %2}";
15402 : : }
15403 : : }
15404 : : [(set_attr "isa" "*,apx_ndd")
15405 : : (set (attr "type")
15406 : : (cond [(eq_attr "alternative" "1")
15407 : 0 : (const_string "ishift")
15408 : : (and (match_test "TARGET_DOUBLE_WITH_ADD")
15409 : : (match_operand 2 "const1_operand"))
15410 : : (const_string "alu")
15411 : : ]
15412 : : (const_string "ishift")))
15413 : : (set (attr "length_immediate")
15414 : : (if_then_else
15415 : : (ior (eq_attr "type" "alu")
15416 : : (and (eq_attr "type" "ishift")
15417 : : (and (match_operand 2 "const1_operand")
15418 : : (ior (match_test "TARGET_SHIFT1")
15419 : : (match_test "optimize_function_for_size_p (cfun)")))))
15420 : : (const_string "0")
15421 : : (const_string "*")))
15422 : : (set_attr "mode" "SI")])
15423 : :
15424 : : (define_insn "*ashl<mode>3_cconly"
15425 : : [(set (reg FLAGS_REG)
15426 : : (compare
15427 : : (ashift:SWI (match_operand:SWI 1 "nonimmediate_operand" "0,rm")
15428 : : (match_operand:QI 2 "<shift_immediate_operand>" "<S>,<S>"))
15429 : : (const_int 0)))
15430 : : (clobber (match_scratch:SWI 0 "=<r>,r"))]
15431 : 34 : "(optimize_function_for_size_p (cfun)
15432 : 4107 : || !TARGET_PARTIAL_FLAG_REG_STALL
15433 : 0 : || (operands[2] == const1_rtx
15434 : 0 : && (TARGET_SHIFT1
15435 : 0 : || TARGET_DOUBLE_WITH_ADD)))
15436 : 4225 : && ix86_match_ccmode (insn, CCGOCmode)"
15437 : 485 : {
15438 : 535 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
15439 : 929 : switch (get_attr_type (insn))
15440 : 599 : {
15441 : 1503 : case TYPE_ALU:
15442 : 7267 : gcc_assert (operands[2] == const1_rtx);
15443 : : return "add{<imodesuffix>}\t%0, %0";
15444 : :
15445 : 89 : default:
15446 : 89 : if (operands[2] == const1_rtx
15447 : 0 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
15448 : 89 : && !use_ndd)
15449 : : return "sal{<imodesuffix>}\t%0";
15450 : : else
15451 : 89 : return use_ndd ? "sal{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
15452 : 89 : : "sal{<imodesuffix>}\t{%2, %0|%0, %2}";
15453 : : }
15454 : : }
15455 : : [(set_attr "isa" "*,apx_ndd")
15456 : : (set (attr "type")
15457 : : (cond [(eq_attr "alternative" "1")
15458 : 395 : (const_string "ishift")
15459 : : (and (and (match_test "TARGET_DOUBLE_WITH_ADD")
15460 : : (match_operand 0 "register_operand"))
15461 : : (match_operand 2 "const1_operand"))
15462 : : (const_string "alu")
15463 : : ]
15464 : : (const_string "ishift")))
15465 : : (set (attr "length_immediate")
15466 : : (if_then_else
15467 : : (ior (eq_attr "type" "alu")
15468 : : (and (eq_attr "type" "ishift")
15469 : : (and (match_operand 2 "const1_operand")
15470 : : (ior (match_test "TARGET_SHIFT1")
15471 : : (match_test "optimize_function_for_size_p (cfun)")))))
15472 : : (const_string "0")
15473 : : (const_string "*")))
15474 : : (set_attr "mode" "<MODE>")])
15475 : :
15476 : : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
15477 : : (define_insn_and_split "*ashlqi_ext<mode>_1"
15478 : : [(set (zero_extract:SWI248
15479 : : (match_operand 0 "int248_register_operand" "+Q,&Q")
15480 : : (const_int 8)
15481 : : (const_int 8))
15482 : : (subreg:SWI248
15483 : : (ashift:QI
15484 : : (subreg:QI
15485 : : (match_operator:SWI248 3 "extract_operator"
15486 : : [(match_operand 1 "int248_register_operand" "0,!Q")
15487 : : (const_int 8)
15488 : : (const_int 8)]) 0)
15489 : : (match_operand:QI 2 "nonmemory_operand" "cI,cI")) 0))
15490 : : (clobber (reg:CC FLAGS_REG))]
15491 : : ""
15492 : 1 : {
15493 : 1 : if (which_alternative)
15494 : : return "#";
15495 : :
15496 : 1 : switch (get_attr_type (insn))
15497 : : {
15498 : 0 : case TYPE_ALU:
15499 : 0 : gcc_assert (operands[2] == const1_rtx);
15500 : : return "add{b}\t%h0, %h0";
15501 : :
15502 : 1 : default:
15503 : 1 : if (operands[2] == const1_rtx
15504 : 1 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun)))
15505 : 0 : return "sal{b}\t%h0";
15506 : : else
15507 : 1 : return "sal{b}\t{%2, %h0|%h0, %2}";
15508 : : }
15509 : : }
15510 : 2 : "reload_completed
15511 : 2 : && !(rtx_equal_p (operands[0], operands[1]))"
15512 : 2 : [(set (zero_extract:SWI248
15513 : 0 : (match_dup 0) (const_int 8) (const_int 8))
15514 : : (zero_extract:SWI248
15515 : 0 : (match_dup 1) (const_int 8) (const_int 8)))
15516 : 0 : (parallel
15517 : : [(set (zero_extract:SWI248
15518 : : (match_dup 0) (const_int 8) (const_int 8))
15519 : : (subreg:SWI248
15520 : : (ashift:QI
15521 : : (subreg:QI
15522 : : (match_op_dup 3
15523 : : [(match_dup 0) (const_int 8) (const_int 8)]) 0)
15524 : : (match_dup 2)) 0))
15525 : : (clobber (reg:CC FLAGS_REG))])]
15526 : : ""
15527 : : [(set (attr "type")
15528 : 9414866 : (cond [(and (match_test "TARGET_DOUBLE_WITH_ADD")
15529 : 0 : (match_operand 2 "const1_operand"))
15530 : 0 : (const_string "alu")
15531 : 42330 : ]
15532 : 8560038 : (const_string "ishift")))
15533 : 0 : (set (attr "length_immediate")
15534 : 113479 : (if_then_else
15535 : 0 : (ior (eq_attr "type" "alu")
15536 : 0 : (and (eq_attr "type" "ishift")
15537 : 2019081 : (and (match_operand 2 "const1_operand")
15538 : 1865 : (ior (match_test "TARGET_SHIFT1")
15539 : 1898555 : (match_test "optimize_function_for_size_p (cfun)")))))
15540 : 1896690 : (const_string "0")
15541 : 139827 : (const_string "*")))
15542 : 19666 : (set_attr "mode" "QI")])
15543 : 21531 :
15544 : 85 : ;; See comment above `ashl<mode>3' about how this works.
15545 : 120161 :
15546 : 120161 : (define_expand "<insn><mode>3"
15547 : 21166 : [(set (match_operand:SDWIM 0 "<shift_operand>")
15548 : 85 : (any_shiftrt:SDWIM (match_operand:SDWIM 1 "<shift_operand>")
15549 : : (match_operand:QI 2 "nonmemory_operand")))]
15550 : 120161 : ""
15551 : 562895 : {
15552 : 541921 : ix86_expand_binary_operator (<CODE>, <MODE>mode, operands, TARGET_APX_NDD);
15553 : 541921 : DONE;
15554 : : })
15555 : 19253 :
15556 : : ;; Avoid useless masking of count operand.
15557 : 1069492 : (define_insn_and_split "*<insn><mode>3_mask"
15558 : 1069492 : [(set (match_operand:SWI48 0 "nonimmediate_operand")
15559 : 1069492 : (any_shiftrt:SWI48
15560 : 1069492 : (match_operand:SWI48 1 "nonimmediate_operand")
15561 : 1069492 : (subreg:QI
15562 : 1069492 : (and
15563 : 0 : (match_operand 2 "int248_register_operand" "c,r")
15564 : 0 : (match_operand 3 "const_int_operand")) 0)))
15565 : : (clobber (reg:CC FLAGS_REG))]
15566 : 8993 : "ix86_binary_operator_ok (<CODE>, <MODE>mode, operands)
15567 : 18458 : && (INTVAL (operands[3]) & (GET_MODE_BITSIZE (<MODE>mode)-1))
15568 : 9229 : == GET_MODE_BITSIZE (<MODE>mode)-1
15569 : 27431 : && ix86_pre_reload_split ()"
15570 : 0 : "#"
15571 : 73 : "&& 1"
15572 : 862 : [(parallel
15573 : 15714 : [(set (match_dup 0)
15574 : 16711 : (any_shiftrt:SWI48 (match_dup 1)
15575 : 670812 : (match_dup 2)))
15576 : 146180 : (clobber (reg:CC FLAGS_REG))])]
15577 : 128291 : {
15578 : 129209 : operands[2] = force_reg (GET_MODE (operands[2]), operands[2]);
15579 : 16947 : operands[2] = gen_lowpart (QImode, operands[2]);
15580 : 526317 : }
15581 : 527004 : [(set_attr "isa" "*,bmi2")])
15582 : 743 :
15583 : 0 : (define_insn_and_split "*<insn><mode>3_mask_1"
15584 : 687 : [(set (match_operand:SWI48 0 "nonimmediate_operand")
15585 : 526317 : (any_shiftrt:SWI48
15586 : 789 : (match_operand:SWI48 1 "nonimmediate_operand")
15587 : 789 : (and:QI
15588 : 789 : (match_operand:QI 2 "register_operand" "c,r")
15589 : 789 : (match_operand:QI 3 "const_int_operand"))))
15590 : : (clobber (reg:CC FLAGS_REG))]
15591 : 53791 : "ix86_binary_operator_ok (<CODE>, <MODE>mode, operands)
15592 : 54072 : && (INTVAL (operands[3]) & (GET_MODE_BITSIZE (<MODE>mode)-1))
15593 : 53770 : == GET_MODE_BITSIZE (<MODE>mode)-1
15594 : 53624 : && ix86_pre_reload_split ()"
15595 : 53471 : "#"
15596 : 54257 : "&& 1"
15597 : 54276 : [(parallel
15598 : 54274 : [(set (match_dup 0)
15599 : 124 : (any_shiftrt:SWI48 (match_dup 1)
15600 : 305 : (match_dup 2)))
15601 : 418 : (clobber (reg:CC FLAGS_REG))])]
15602 : 398 : ""
15603 : 62 : [(set_attr "isa" "*,bmi2")])
15604 : 103 :
15605 : 21 : (define_insn_and_split "*<insn><dwi>3_doubleword_mask"
15606 : 124 : [(set (match_operand:<DWI> 0 "register_operand")
15607 : 124 : (any_shiftrt:<DWI>
15608 : 124 : (match_operand:<DWI> 1 "register_operand")
15609 : 124 : (subreg:QI
15610 : 103 : (and
15611 : 57111 : (match_operand 2 "int248_register_operand" "c")
15612 : 57193 : (match_operand 3 "const_int_operand")) 0)))
15613 : 57090 : (clobber (reg:CC FLAGS_REG))]
15614 : 57366 : "((INTVAL (operands[3]) & (<MODE_SIZE> * BITS_PER_UNIT)) == 0
15615 : 57398 : || ((INTVAL (operands[3]) & (2 * <MODE_SIZE> * BITS_PER_UNIT - 1))
15616 : 57090 : == (2 * <MODE_SIZE> * BITS_PER_UNIT - 1)))
15617 : 57493 : && ix86_pre_reload_split ()"
15618 : 57111 : "#"
15619 : 21 : "&& 1"
15620 : 105 : [(parallel
15621 : : [(set (match_dup 4)
15622 : : (ior:DWIH (lshiftrt:DWIH (match_dup 4)
15623 : 40 : (and:QI (match_dup 2) (match_dup 8)))
15624 : 40 : (subreg:DWIH
15625 : : (ashift:<DWI> (zero_extend:<DWI> (match_dup 7))
15626 : 64 : (minus:QI (match_dup 9)
15627 : 1193289 : (and:QI (match_dup 2) (match_dup 8)))) 0)))
15628 : 335525 : (clobber (reg:CC FLAGS_REG))])
15629 : 1528814 : (parallel
15630 : 64 : [(set (match_dup 6)
15631 : 325376 : (any_shiftrt:DWIH (match_dup 7) (match_dup 2)))
15632 : 325332 : (clobber (reg:CC FLAGS_REG))])]
15633 : 325312 : {
15634 : 104 : if ((INTVAL (operands[3]) & (<MODE_SIZE> * BITS_PER_UNIT)) != 0)
15635 : 44 : {
15636 : 65 : operands[2] = force_reg (GET_MODE (operands[2]), operands[2]);
15637 : 65 : operands[2] = gen_lowpart (QImode, operands[2]);
15638 : 65 : emit_insn (gen_<insn><dwi>3_doubleword (operands[0], operands[1],
15639 : 44 : operands[2]));
15640 : 65 : DONE;
15641 : 44 : }
15642 : :
15643 : 19 : split_double_mode (<DWI>mode, &operands[0], 2, &operands[4], &operands[6]);
15644 : :
15645 : 19 : operands[8] = GEN_INT (<MODE_SIZE> * BITS_PER_UNIT - 1);
15646 : 19 : operands[9] = GEN_INT (<MODE_SIZE> * BITS_PER_UNIT);
15647 : :
15648 : 19 : if ((INTVAL (operands[3]) & ((<MODE_SIZE> * BITS_PER_UNIT) - 1))
15649 : : != ((<MODE_SIZE> * BITS_PER_UNIT) - 1))
15650 : : {
15651 : 14 : rtx xops[3];
15652 : 14 : xops[0] = gen_reg_rtx (GET_MODE (operands[2]));
15653 : 14 : xops[1] = operands[2];
15654 : 14 : xops[2] = GEN_INT (INTVAL (operands[3])
15655 : : & ((<MODE_SIZE> * BITS_PER_UNIT) - 1));
15656 : 14 : ix86_expand_binary_operator (AND, GET_MODE (operands[2]), xops);
15657 : 14 : operands[2] = xops[0];
15658 : : }
15659 : :
15660 : 19 : operands[2] = force_reg (GET_MODE (operands[2]), operands[2]);
15661 : 19 : operands[2] = gen_lowpart (QImode, operands[2]);
15662 : :
15663 : 19 : if (!rtx_equal_p (operands[4], operands[5]))
15664 : 19 : emit_move_insn (operands[4], operands[5]);
15665 : : })
15666 : :
15667 : : (define_insn_and_split "*<insn><dwi>3_doubleword_mask_1"
15668 : 19 : [(set (match_operand:<DWI> 0 "register_operand")
15669 : 19 : (any_shiftrt:<DWI>
15670 : 19 : (match_operand:<DWI> 1 "register_operand")
15671 : 19 : (and:QI
15672 : 19 : (match_operand:QI 2 "register_operand" "c")
15673 : 19 : (match_operand:QI 3 "const_int_operand"))))
15674 : 19 : (clobber (reg:CC FLAGS_REG))]
15675 : 215 : "((INTVAL (operands[3]) & (<MODE_SIZE> * BITS_PER_UNIT)) == 0
15676 : 99 : || ((INTVAL (operands[3]) & (2 * <MODE_SIZE> * BITS_PER_UNIT - 1))
15677 : 19 : == (2 * <MODE_SIZE> * BITS_PER_UNIT - 1)))
15678 : 188 : && ix86_pre_reload_split ()"
15679 : 19 : "#"
15680 : 19 : "&& 1"
15681 : 25 : [(parallel
15682 : 30 : [(set (match_dup 4)
15683 : 19 : (ior:DWIH (lshiftrt:DWIH (match_dup 4)
15684 : 21 : (and:QI (match_dup 2) (match_dup 8)))
15685 : 23 : (subreg:DWIH
15686 : 19 : (ashift:<DWI> (zero_extend:<DWI> (match_dup 7))
15687 : 19 : (minus:QI (match_dup 9)
15688 : 19 : (and:QI (match_dup 2) (match_dup 8)))) 0)))
15689 : : (clobber (reg:CC FLAGS_REG))])
15690 : 601834 : (parallel
15691 : : [(set (match_dup 6)
15692 : 601834 : (any_shiftrt:DWIH (match_dup 7) (match_dup 2)))
15693 : 601834 : (clobber (reg:CC FLAGS_REG))])]
15694 : 601845 : {
15695 : 601845 : if ((INTVAL (operands[3]) & (<MODE_SIZE> * BITS_PER_UNIT)) != 0)
15696 : : {
15697 : 524698 : emit_insn (gen_<insn><dwi>3_doubleword (operands[0], operands[1],
15698 : 524689 : operands[2]));
15699 : 524698 : DONE;
15700 : 524689 : }
15701 : 524689 :
15702 : 524691 : split_double_mode (<DWI>mode, &operands[0], 2, &operands[4], &operands[6]);
15703 : 524689 :
15704 : 2 : operands[8] = GEN_INT (<MODE_SIZE> * BITS_PER_UNIT - 1);
15705 : 5877 : operands[9] = GEN_INT (<MODE_SIZE> * BITS_PER_UNIT);
15706 : :
15707 : 27 : if ((INTVAL (operands[3]) & ((<MODE_SIZE> * BITS_PER_UNIT) - 1))
15708 : 44 : != ((<MODE_SIZE> * BITS_PER_UNIT) - 1))
15709 : : {
15710 : 2 : rtx tem = gen_reg_rtx (QImode);
15711 : 2 : emit_insn (gen_andqi3 (tem, operands[2], operands[3]));
15712 : 2 : operands[2] = tem;
15713 : : }
15714 : :
15715 : 21 : if (!rtx_equal_p (operands[4], operands[5]))
15716 : 2 : emit_move_insn (operands[4], operands[5]);
15717 : 19 : })
15718 : :
15719 : : (define_insn_and_split "<insn><mode>3_doubleword"
15720 : 2 : [(set (match_operand:DWI 0 "register_operand" "=&r,&r")
15721 : 2 : (any_shiftrt:DWI (match_operand:DWI 1 "register_operand" "0,r")
15722 : 2 : (match_operand:QI 2 "nonmemory_operand" "<S>c,<S>c")))
15723 : 51 : (clobber (reg:CC FLAGS_REG))]
15724 : 2 : ""
15725 : 51 : "#"
15726 : 263784 : "epilogue_completed"
15727 : 51 : [(const_int 0)]
15728 : 8998 : {
15729 : 8998 : if (TARGET_APX_NDD
15730 : 8947 : && !rtx_equal_p (operands[0], operands[1]))
15731 : 0 : ix86_split_rshift_ndd (<CODE>, operands, NULL_RTX);
15732 : 51 : else
15733 : 8947 : ix86_split_<insn> (operands, NULL_RTX, <MODE>mode);
15734 : 8947 : DONE;
15735 : 51 : }
15736 : 49 : [(set_attr "type" "multi")
15737 : 0 : (set_attr "isa" "*,apx_ndd")])
15738 : 49 :
15739 : 2 : ;; By default we don't ask for a scratch register, because when DWImode
15740 : 2 : ;; values are manipulated, registers are already at a premium. But if
15741 : : ;; we have one handy, we won't turn it away.
15742 : :
15743 : : (define_peephole2
15744 : : [(match_scratch:DWIH 3 "r")
15745 : : (parallel [(set (match_operand:<DWI> 0 "register_operand")
15746 : : (any_shiftrt:<DWI>
15747 : 14255 : (match_operand:<DWI> 1 "register_operand")
15748 : : (match_operand:QI 2 "nonmemory_operand")))
15749 : 14255 : (clobber (reg:CC FLAGS_REG))])
15750 : 8046 : (match_dup 3)]
15751 : 191635 : "TARGET_CMOVE"
15752 : 14255 : [(const_int 0)]
15753 : 11216 : {
15754 : 5308 : if (TARGET_APX_NDD
15755 : 11216 : && !rtx_equal_p (operands[0], operands[1]))
15756 : 5310 : ix86_split_rshift_ndd (<CODE>, operands, operands[3]);
15757 : : else
15758 : 11214 : ix86_split_<insn> (operands, operands[3], <DWI>mode);
15759 : 11216 : DONE;
15760 : 2 : })
15761 : :
15762 : : ;; Split truncations of double word right shifts into x86_shrd_1.
15763 : : (define_insn_and_split "<insn><dwi>3_doubleword_lowpart"
15764 : : [(set (match_operand:DWIH 0 "register_operand" "=&r")
15765 : : (subreg:DWIH
15766 : : (any_shiftrt:<DWI> (match_operand:<DWI> 1 "register_operand" "r")
15767 : 2 : (match_operand:QI 2 "const_int_operand")) 0))
15768 : 2 : (clobber (reg:CC FLAGS_REG))]
15769 : 37963 : "UINTVAL (operands[2]) < <MODE_SIZE> * BITS_PER_UNIT"
15770 : : "#"
15771 : 638 : "&& reload_completed"
15772 : 6565 : [(parallel
15773 : : [(set (match_dup 0)
15774 : 6246 : (ior:DWIH (lshiftrt:DWIH (match_dup 0) (match_dup 2))
15775 : 7665 : (subreg:DWIH
15776 : 6701 : (ashift:<DWI> (zero_extend:<DWI> (match_dup 3))
15777 : 6185 : (match_dup 4)) 0)))
15778 : 1329 : (clobber (reg:CC FLAGS_REG))])]
15779 : 6336 : {
15780 : 1281 : split_double_mode (<DWI>mode, &operands[1], 1, &operands[1], &operands[3]);
15781 : 6307 : operands[4] = GEN_INT ((<MODE_SIZE> * BITS_PER_UNIT) - INTVAL (operands[2]));
15782 : 380 : if (!rtx_equal_p (operands[0], operands[1]))
15783 : 399 : emit_move_insn (operands[0], operands[1]);
15784 : 81 : })
15785 : 2 :
15786 : 2 : (define_insn "x86_64_shrd"
15787 : 321 : [(set (match_operand:DI 0 "nonimmediate_operand" "+r*m")
15788 : 2 : (ior:DI (lshiftrt:DI (match_dup 0)
15789 : 0 : (and:QI (match_operand:QI 2 "nonmemory_operand" "Jc")
15790 : 2 : (const_int 63)))
15791 : 319 : (subreg:DI
15792 : 319 : (ashift:TI
15793 : 319 : (zero_extend:TI
15794 : 319 : (match_operand:DI 1 "register_operand" "r"))
15795 : 319 : (minus:QI (const_int 64)
15796 : 319 : (and:QI (match_dup 2) (const_int 63)))) 0)))
15797 : 319 : (clobber (reg:CC FLAGS_REG))]
15798 : 8668 : "TARGET_64BIT"
15799 : : "shrd{q}\t{%2, %1, %0|%0, %1, %2}"
15800 : 0 : [(set_attr "type" "ishift")
15801 : 0 : (set_attr "prefix_0f" "1")
15802 : 98 : (set_attr "mode" "DI")
15803 : 98 : (set_attr "athlon_decode" "vector")
15804 : : (set_attr "amdfam10_decode" "vector")
15805 : 224 : (set_attr "bdver1_decode" "vector")])
15806 : 126 :
15807 : 98 : (define_insn "x86_64_shrd_ndd"
15808 : 126 : [(set (match_operand:DI 0 "register_operand" "=r")
15809 : 224 : (ior:DI (lshiftrt:DI (match_operand:DI 1 "nonimmediate_operand" "rm")
15810 : 126 : (and:QI (match_operand:QI 3 "nonmemory_operand" "Jc")
15811 : 417 : (const_int 63)))
15812 : 540 : (subreg:DI
15813 : 540 : (ashift:TI
15814 : 221 : (zero_extend:TI
15815 : 98 : (match_operand:DI 2 "register_operand" "r"))
15816 : 98 : (minus:QI (const_int 64)
15817 : 123 : (and:QI (match_dup 3) (const_int 63)))) 0)))
15818 : 123 : (clobber (reg:CC FLAGS_REG))]
15819 : 677 : "TARGET_APX_NDD"
15820 : : "shrd{q}\t{%3, %2, %1, %0|%0, %1, %2, %3}"
15821 : 456 : [(set_attr "type" "ishift")
15822 : 198 : (set_attr "mode" "DI")])
15823 : 5826 :
15824 : 6024 :
15825 : 258 : (define_insn "x86_64_shrd_1"
15826 : 6084 : [(set (match_operand:DI 0 "nonimmediate_operand" "+r*m")
15827 : 6084 : (ior:DI (lshiftrt:DI (match_dup 0)
15828 : 5826 : (match_operand:QI 2 "const_0_to_63_operand"))
15829 : 6084 : (subreg:DI
15830 : 5826 : (ashift:TI
15831 : 5826 : (zero_extend:TI
15832 : 0 : (match_operand:DI 1 "register_operand" "r"))
15833 : 5826 : (match_operand:QI 3 "const_0_to_255_operand")) 0)))
15834 : 5826 : (clobber (reg:CC FLAGS_REG))]
15835 : 6310 : "TARGET_64BIT
15836 : 484 : && INTVAL (operands[3]) == 64 - INTVAL (operands[2])"
15837 : 5826 : "shrd{q}\t{%2, %1, %0|%0, %1, %2}"
15838 : 2 : [(set_attr "type" "ishift")
15839 : 2 : (set_attr "prefix_0f" "1")
15840 : 2 : (set_attr "length_immediate" "1")
15841 : 5826 : (set_attr "mode" "DI")
15842 : 5826 : (set_attr "athlon_decode" "vector")
15843 : 0 : (set_attr "amdfam10_decode" "vector")
15844 : 0 : (set_attr "bdver1_decode" "vector")])
15845 : 0 :
15846 : 0 : (define_insn "x86_64_shrd_ndd_1"
15847 : 0 : [(set (match_operand:DI 0 "register_operand" "=r")
15848 : : (ior:DI (lshiftrt:DI (match_operand:DI 1 "nonimmediate_operand" "rm")
15849 : 0 : (match_operand:QI 3 "const_0_to_63_operand"))
15850 : 0 : (subreg:DI
15851 : 0 : (ashift:TI
15852 : 0 : (zero_extend:TI
15853 : 0 : (match_operand:DI 2 "register_operand" "r"))
15854 : 0 : (match_operand:QI 4 "const_0_to_255_operand")) 0)))
15855 : 0 : (clobber (reg:CC FLAGS_REG))]
15856 : 2 : "TARGET_APX_NDD
15857 : 2 : && INTVAL (operands[4]) == 64 - INTVAL (operands[3])"
15858 : 0 : "shrd{q}\t{%3, %2, %1, %0|%0, %1, %2, %3}"
15859 : 0 : [(set_attr "type" "ishift")
15860 : 0 : (set_attr "length_immediate" "1")
15861 : 0 : (set_attr "mode" "DI")])
15862 : 0 :
15863 : 122 :
15864 : 122 : (define_insn_and_split "*x86_64_shrd_shld_1_nozext"
15865 : 122 : [(set (match_operand:DI 0 "nonimmediate_operand")
15866 : : (ior:DI (lshiftrt:DI (match_operand:DI 4 "nonimmediate_operand")
15867 : : (match_operand:QI 2 "const_0_to_63_operand"))
15868 : : (ashift:DI
15869 : : (match_operand:DI 1 "nonimmediate_operand")
15870 : : (match_operand:QI 3 "const_0_to_63_operand"))))
15871 : : (clobber (reg:CC FLAGS_REG))]
15872 : 1017 : "TARGET_64BIT
15873 : 647 : && INTVAL (operands[3]) == 64 - INTVAL (operands[2])
15874 : 608 : && ix86_pre_reload_split ()"
15875 : 383 : "#"
15876 : 72 : "&& 1"
15877 : 194 : [(const_int 0)]
15878 : 396 : {
15879 : 275 : if (rtx_equal_p (operands[4], operands[0]))
15880 : 20 : {
15881 : 38 : operands[1] = force_reg (DImode, operands[1]);
15882 : 0 : emit_insn (gen_x86_64_shrd_1 (operands[0], operands[1], operands[2], operands[3]));
15883 : : }
15884 : 198 : else if (rtx_equal_p (operands[1], operands[0]))
15885 : : {
15886 : 1 : operands[4] = force_reg (DImode, operands[4]);
15887 : 1 : emit_insn (gen_x86_64_shld_1 (operands[0], operands[4], operands[3], operands[2]));
15888 : : }
15889 : 197 : else if (TARGET_APX_NDD)
15890 : : {
15891 : 2 : rtx tmp = gen_reg_rtx (DImode);
15892 : 2 : if (MEM_P (operands[4]))
15893 : : {
15894 : 0 : operands[1] = force_reg (DImode, operands[1]);
15895 : 0 : emit_insn (gen_x86_64_shrd_ndd_1 (tmp, operands[4], operands[1],
15896 : : operands[2], operands[3]));
15897 : : }
15898 : 2 : else if (MEM_P (operands[1]))
15899 : 2 : emit_insn (gen_x86_64_shld_ndd_1 (tmp, operands[1], operands[4],
15900 : : operands[3], operands[2]));
15901 : : else
15902 : 0 : emit_insn (gen_x86_64_shrd_ndd_1 (tmp, operands[4], operands[1],
15903 : : operands[2], operands[3]));
15904 : 2 : emit_move_insn (operands[0], tmp);
15905 : : }
15906 : : else
15907 : : {
15908 : 195 : operands[1] = force_reg (DImode, operands[1]);
15909 : 195 : rtx tmp = gen_reg_rtx (DImode);
15910 : 195 : emit_move_insn (tmp, operands[4]);
15911 : 195 : emit_insn (gen_x86_64_shrd_1 (tmp, operands[1], operands[2], operands[3]));
15912 : 195 : emit_move_insn (operands[0], tmp);
15913 : : }
15914 : 198 : DONE;
15915 : : })
15916 : :
15917 : : (define_insn_and_split "*x86_64_shrd_2"
15918 : : [(set (match_operand:DI 0 "nonimmediate_operand")
15919 : : (ior:DI (lshiftrt:DI (match_dup 0)
15920 : : (match_operand:QI 2 "nonmemory_operand"))
15921 : : (ashift:DI (match_operand:DI 1 "register_operand")
15922 : : (minus:QI (const_int 64) (match_dup 2)))))
15923 : : (clobber (reg:CC FLAGS_REG))]
15924 : 0 : "TARGET_64BIT && ix86_pre_reload_split ()"
15925 : : "#"
15926 : 0 : "&& 1"
15927 : 0 : [(parallel [(set (match_dup 0)
15928 : 0 : (ior:DI (lshiftrt:DI (match_dup 0)
15929 : 0 : (and:QI (match_dup 2) (const_int 63)))
15930 : 0 : (subreg:DI
15931 : 0 : (ashift:TI
15932 : 0 : (zero_extend:TI (match_dup 1))
15933 : 0 : (minus:QI (const_int 64)
15934 : 0 : (and:QI (match_dup 2)
15935 : 0 : (const_int 63)))) 0)))
15936 : 0 : (clobber (reg:CC FLAGS_REG))])])
15937 : 0 :
15938 : 0 : (define_insn_and_split "*x86_64_shrd_ndd_2"
15939 : 0 : [(set (match_operand:DI 0 "nonimmediate_operand")
15940 : 0 : (ior:DI (lshiftrt:DI (match_operand:DI 1 "nonimmediate_operand")
15941 : 0 : (match_operand:QI 3 "nonmemory_operand"))
15942 : 0 : (ashift:DI (match_operand:DI 2 "register_operand")
15943 : : (minus:QI (const_int 64) (match_dup 2)))))
15944 : : (clobber (reg:CC FLAGS_REG))]
15945 : 0 : "TARGET_APX_NDD
15946 : 0 : && ix86_pre_reload_split ()"
15947 : 0 : "#"
15948 : 0 : "&& 1"
15949 : 0 : [(parallel [(set (match_dup 4)
15950 : 0 : (ior:DI (lshiftrt:DI (match_dup 1)
15951 : 0 : (and:QI (match_dup 3) (const_int 63)))
15952 : 0 : (subreg:DI
15953 : 0 : (ashift:TI
15954 : 0 : (zero_extend:TI (match_dup 2))
15955 : 0 : (minus:QI (const_int 64)
15956 : 0 : (and:QI (match_dup 3)
15957 : 0 : (const_int 63)))) 0)))
15958 : 0 : (clobber (reg:CC FLAGS_REG))
15959 : 0 : (set (match_dup 0) (match_dup 4))])]
15960 : 0 : {
15961 : 0 : operands[4] = gen_reg_rtx (DImode);
15962 : 0 : emit_move_insn (operands[4], operands[0]);
15963 : 0 : })
15964 : 0 :
15965 : : (define_insn "x86_shrd"
15966 : 0 : [(set (match_operand:SI 0 "nonimmediate_operand" "+r*m")
15967 : 0 : (ior:SI (lshiftrt:SI (match_dup 0)
15968 : 0 : (and:QI (match_operand:QI 2 "nonmemory_operand" "Ic")
15969 : 0 : (const_int 31)))
15970 : 0 : (subreg:SI
15971 : 0 : (ashift:DI
15972 : 0 : (zero_extend:DI
15973 : 0 : (match_operand:SI 1 "register_operand" "r"))
15974 : 0 : (minus:QI (const_int 32)
15975 : 0 : (and:QI (match_dup 2) (const_int 31)))) 0)))
15976 : 0 : (clobber (reg:CC FLAGS_REG))]
15977 : 0 : ""
15978 : 0 : "shrd{l}\t{%2, %1, %0|%0, %1, %2}"
15979 : 0 : [(set_attr "type" "ishift")
15980 : 0 : (set_attr "prefix_0f" "1")
15981 : : (set_attr "mode" "SI")
15982 : : (set_attr "pent_pair" "np")
15983 : : (set_attr "athlon_decode" "vector")
15984 : : (set_attr "amdfam10_decode" "vector")
15985 : : (set_attr "bdver1_decode" "vector")])
15986 : :
15987 : : (define_insn "x86_shrd_ndd"
15988 : : [(set (match_operand:SI 0 "register_operand" "=r")
15989 : : (ior:SI (lshiftrt:SI (match_operand:SI 1 "nonimmediate_operand" "rm")
15990 : : (and:QI (match_operand:QI 3 "nonmemory_operand" "Ic")
15991 : : (const_int 31)))
15992 : : (subreg:SI
15993 : : (ashift:DI
15994 : : (zero_extend:DI
15995 : : (match_operand:SI 2 "register_operand" "r"))
15996 : : (minus:QI (const_int 32)
15997 : : (and:QI (match_dup 3) (const_int 31)))) 0)))
15998 : 0 : (clobber (reg:CC FLAGS_REG))]
15999 : 0 : "TARGET_APX_NDD"
16000 : 0 : "shrd{l}\t{%3, %2, %1, %0|%0, %1, %2, %3}"
16001 : 0 : [(set_attr "type" "ishift")
16002 : 0 : (set_attr "mode" "SI")])
16003 : 15191 :
16004 : 15191 : (define_insn "x86_shrd_1"
16005 : 15191 : [(set (match_operand:SI 0 "nonimmediate_operand" "+r*m")
16006 : 38 : (ior:SI (lshiftrt:SI (match_dup 0)
16007 : 701 : (match_operand:QI 2 "const_0_to_31_operand"))
16008 : 739 : (subreg:SI
16009 : 20699 : (ashift:DI
16010 : 21147 : (zero_extend:DI
16011 : 21185 : (match_operand:SI 1 "register_operand" "r"))
16012 : 21147 : (match_operand:QI 3 "const_0_to_63_operand")) 0)))
16013 : 486 : (clobber (reg:CC FLAGS_REG))]
16014 : 606 : "INTVAL (operands[3]) == 32 - INTVAL (operands[2])"
16015 : 20661 : "shrd{l}\t{%2, %1, %0|%0, %1, %2}"
16016 : 20663 : [(set_attr "type" "ishift")
16017 : 2 : (set_attr "prefix_0f" "1")
16018 : 2 : (set_attr "length_immediate" "1")
16019 : 20661 : (set_attr "mode" "SI")
16020 : 0 : (set_attr "pent_pair" "np")
16021 : 20661 : (set_attr "athlon_decode" "vector")
16022 : : (set_attr "amdfam10_decode" "vector")
16023 : 166 : (set_attr "bdver1_decode" "vector")])
16024 : 166 :
16025 : : (define_insn "x86_shrd_ndd_1"
16026 : 0 : [(set (match_operand:SI 0 "register_operand" "=r")
16027 : 0 : (ior:SI (lshiftrt:SI (match_operand:SI 1 "nonimmediate_operand" "rm")
16028 : 0 : (match_operand:QI 3 "const_0_to_31_operand"))
16029 : 0 : (subreg:SI
16030 : : (ashift:DI
16031 : : (zero_extend:DI
16032 : : (match_operand:SI 2 "register_operand" "r"))
16033 : : (match_operand:QI 4 "const_0_to_63_operand")) 0)))
16034 : : (clobber (reg:CC FLAGS_REG))]
16035 : 2 : "TARGET_APX_NDD
16036 : 2 : && (INTVAL (operands[4]) == 32 - INTVAL (operands[3]))"
16037 : : "shrd{l}\t{%3, %2, %1, %0|%0, %1, %2, %3}"
16038 : 0 : [(set_attr "type" "ishift")
16039 : 0 : (set_attr "length_immediate" "1")
16040 : : (set_attr "mode" "SI")])
16041 : :
16042 : :
16043 : : (define_insn_and_split "*x86_shrd_shld_1_nozext"
16044 : 1636 : [(set (match_operand:SI 0 "nonimmediate_operand")
16045 : 1636 : (ior:SI (lshiftrt:SI (match_operand:SI 4 "nonimmediate_operand")
16046 : 2205 : (match_operand:QI 2 "const_0_to_31_operand"))
16047 : 412 : (ashift:SI
16048 : 702 : (match_operand:SI 1 "nonimmediate_operand")
16049 : 405 : (match_operand:QI 3 "const_0_to_31_operand"))))
16050 : : (clobber (reg:CC FLAGS_REG))]
16051 : 220 : "INTVAL (operands[3]) == 32 - INTVAL (operands[2])
16052 : 135 : && ix86_pre_reload_split ()"
16053 : 98 : "#"
16054 : 0 : "&& 1"
16055 : 27 : [(const_int 0)]
16056 : 76 : {
16057 : 38 : if (rtx_equal_p (operands[4], operands[0]))
16058 : 0 : {
16059 : 0 : operands[1] = force_reg (SImode, operands[1]);
16060 : 0 : emit_insn (gen_x86_shrd_1 (operands[0], operands[1], operands[2], operands[3]));
16061 : 0 : }
16062 : 38 : else if (rtx_equal_p (operands[1], operands[0]))
16063 : 0 : {
16064 : 1 : operands[4] = force_reg (SImode, operands[4]);
16065 : 1 : emit_insn (gen_x86_shld_1 (operands[0], operands[4], operands[3], operands[2]));
16066 : 0 : }
16067 : 37 : else if (TARGET_APX_NDD)
16068 : 0 : {
16069 : 2 : rtx tmp = gen_reg_rtx (SImode);
16070 : 2 : if (MEM_P (operands[4]))
16071 : : {
16072 : 0 : operands[1] = force_reg (SImode, operands[1]);
16073 : 0 : emit_insn (gen_x86_shrd_ndd_1 (tmp, operands[4], operands[1],
16074 : : operands[2], operands[3]));
16075 : : }
16076 : 2 : else if (MEM_P (operands[1]))
16077 : 2 : emit_insn (gen_x86_shld_ndd_1 (tmp, operands[1], operands[4],
16078 : : operands[3], operands[2]));
16079 : : else
16080 : 0 : emit_insn (gen_x86_shrd_ndd_1 (tmp, operands[4], operands[1],
16081 : : operands[2], operands[3]));
16082 : 2 : emit_move_insn (operands[0], tmp);
16083 : : }
16084 : : else
16085 : : {
16086 : 35 : operands[1] = force_reg (SImode, operands[1]);
16087 : 35 : rtx tmp = gen_reg_rtx (SImode);
16088 : 35 : emit_move_insn (tmp, operands[4]);
16089 : 35 : emit_insn (gen_x86_shrd_1 (tmp, operands[1], operands[2], operands[3]));
16090 : 35 : emit_move_insn (operands[0], tmp);
16091 : : }
16092 : 38 : DONE;
16093 : : })
16094 : :
16095 : : (define_insn_and_split "*x86_shrd_2"
16096 : : [(set (match_operand:SI 0 "nonimmediate_operand")
16097 : : (ior:SI (lshiftrt:SI (match_dup 0)
16098 : : (match_operand:QI 2 "nonmemory_operand"))
16099 : : (ashift:SI (match_operand:SI 1 "register_operand")
16100 : : (minus:QI (const_int 32) (match_dup 2)))))
16101 : : (clobber (reg:CC FLAGS_REG))]
16102 : 0 : "TARGET_64BIT && ix86_pre_reload_split ()"
16103 : : "#"
16104 : 0 : "&& 1"
16105 : 0 : [(parallel [(set (match_dup 0)
16106 : 0 : (ior:SI (lshiftrt:SI (match_dup 0)
16107 : 0 : (and:QI (match_dup 2) (const_int 31)))
16108 : 0 : (subreg:SI
16109 : 0 : (ashift:DI
16110 : 0 : (zero_extend:DI (match_dup 1))
16111 : 0 : (minus:QI (const_int 32)
16112 : 0 : (and:QI (match_dup 2)
16113 : 0 : (const_int 31)))) 0)))
16114 : 0 : (clobber (reg:CC FLAGS_REG))])])
16115 : 0 :
16116 : 0 : (define_insn_and_split "*x86_shrd_ndd_2"
16117 : 0 : [(set (match_operand:SI 0 "nonimmediate_operand")
16118 : 0 : (ior:SI (lshiftrt:SI (match_operand:SI 1 "nonimmediate_operand")
16119 : 0 : (match_operand:QI 3 "nonmemory_operand"))
16120 : 0 : (ashift:SI (match_operand:SI 2 "register_operand")
16121 : : (minus:QI (const_int 32) (match_dup 3)))))
16122 : : (clobber (reg:CC FLAGS_REG))]
16123 : 0 : "TARGET_APX_NDD
16124 : 0 : && ix86_pre_reload_split ()"
16125 : 0 : "#"
16126 : 0 : "&& 1"
16127 : 0 : [(parallel [(set (match_dup 4)
16128 : 0 : (ior:SI (lshiftrt:SI (match_dup 1)
16129 : : (and:QI (match_dup 3) (const_int 31)))
16130 : : (subreg:SI
16131 : : (ashift:DI
16132 : : (zero_extend:DI (match_dup 2))
16133 : : (minus:QI (const_int 32)
16134 : : (and:QI (match_dup 3)
16135 : : (const_int 31)))) 0)))
16136 : : (clobber (reg:CC FLAGS_REG))
16137 : : (set (match_dup 0) (match_dup 4))])]
16138 : 0 : {
16139 : 0 : operands[4] = gen_reg_rtx (SImode);
16140 : 98041 : emit_move_insn (operands[4], operands[0]);
16141 : 5499 : })
16142 : 5499 :
16143 : 96163 : ;; Base name for insn mnemonic.
16144 : 99790 : (define_mode_attr cvt_mnemonic
16145 : 3621 : [(SI "{cltd|cdq}") (DI "{cqto|cqo}")])
16146 : 6 :
16147 : 96169 : (define_insn "ashr<mode>3_cvt"
16148 : 0 : [(set (match_operand:SWI48 0 "nonimmediate_operand" "=*d,rm,r")
16149 : 94439 : (ashiftrt:SWI48
16150 : 94439 : (match_operand:SWI48 1 "nonimmediate_operand" "*a,0,rm")
16151 : 0 : (match_operand:QI 2 "const_int_operand")))
16152 : 13804 : (clobber (reg:CC FLAGS_REG))]
16153 : 837530 : "INTVAL (operands[2]) == GET_MODE_BITSIZE (<MODE>mode)-1
16154 : 122157 : && (TARGET_USE_CLTD || optimize_function_for_size_p (cfun))
16155 : 122157 : && ix86_binary_operator_ok (ASHIFTRT, <MODE>mode, operands, TARGET_APX_NDD)"
16156 : 0 : "@
16157 : 0 : <cvt_mnemonic>
16158 : 10719 : sar{<imodesuffix>}\t{%2, %0|%0, %2}
16159 : 0 : sar{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
16160 : 26 : [(set_attr "isa" "*,*,apx_ndd")
16161 : 0 : (set_attr "type" "imovx,ishift,ishift")
16162 : 278891 : (set_attr "prefix_0f" "0,*,*")
16163 : 278891 : (set_attr "length_immediate" "0,*,*")
16164 : : (set_attr "modrm" "0,1,1")
16165 : 278886 : (set_attr "mode" "<MODE>")])
16166 : 504189 :
16167 : 225303 : (define_insn "*ashrsi3_cvt_zext"
16168 : 278886 : [(set (match_operand:DI 0 "register_operand" "=*d,r,r")
16169 : 278886 : (zero_extend:DI
16170 : 162387 : (ashiftrt:SI (match_operand:SI 1 "nonimmediate_operand" "*a,0,rm")
16171 : 162352 : (match_operand:QI 2 "const_int_operand"))))
16172 : 172266 : (clobber (reg:CC FLAGS_REG))]
16173 : 162402 : "TARGET_64BIT && INTVAL (operands[2]) == 31
16174 : 324094 : && (TARGET_USE_CLTD || optimize_function_for_size_p (cfun))
16175 : 316321 : && ix86_binary_operator_ok (ASHIFTRT, SImode, operands, TARGET_APX_NDD)"
16176 : 475562 : "@
16177 : 337152 : {cltd|cdq}
16178 : 24 : sar{l}\t{%2, %k0|%k0, %2}
16179 : : sar{l}\t{%2, %1, %k0|%k0, %1, %2}"
16180 : : [(set_attr "isa" "*,*,apx_ndd")
16181 : : (set_attr "type" "imovx,ishift,ishift")
16182 : 0 : (set_attr "prefix_0f" "0,*,*")
16183 : 18 : (set_attr "length_immediate" "0,*,*")
16184 : 0 : (set_attr "modrm" "0,1,1")
16185 : 0 : (set_attr "mode" "SI")])
16186 : :
16187 : 18 : (define_expand "@x86_shift<mode>_adj_3"
16188 : 18 : [(use (match_operand:SWI48 0 "register_operand"))
16189 : 18 : (use (match_operand:SWI48 1 "register_operand"))
16190 : 18 : (use (match_operand:QI 2 "register_operand"))]
16191 : 18 : ""
16192 : 37 : {
16193 : 18 : rtx_code_label *label = gen_label_rtx ();
16194 : 37 : rtx tmp;
16195 : :
16196 : 74 : emit_insn (gen_testqi_ccz_1 (operands[2],
16197 : 37 : GEN_INT (GET_MODE_BITSIZE (<MODE>mode))));
16198 : :
16199 : 37 : tmp = gen_rtx_REG (CCZmode, FLAGS_REG);
16200 : 37 : tmp = gen_rtx_EQ (VOIDmode, tmp, const0_rtx);
16201 : 37 : tmp = gen_rtx_IF_THEN_ELSE (VOIDmode, tmp,
16202 : : gen_rtx_LABEL_REF (VOIDmode, label),
16203 : : pc_rtx);
16204 : 37 : tmp = emit_jump_insn (gen_rtx_SET (pc_rtx, tmp));
16205 : 37 : JUMP_LABEL (tmp) = label;
16206 : :
16207 : 37 : emit_move_insn (operands[0], operands[1]);
16208 : 74 : emit_insn (gen_ashr<mode>3_cvt (operands[1], operands[1],
16209 : 37 : GEN_INT (GET_MODE_BITSIZE (<MODE>mode)-1)));
16210 : 37 : emit_label (label);
16211 : 37 : LABEL_NUSES (label) = 1;
16212 : :
16213 : 37 : DONE;
16214 : : })
16215 : :
16216 : : (define_insn "*bmi2_<insn><mode>3_1"
16217 : : [(set (match_operand:SWI48 0 "register_operand" "=r")
16218 : : (any_shiftrt:SWI48 (match_operand:SWI48 1 "nonimmediate_operand" "rm")
16219 : : (match_operand:SWI48 2 "register_operand" "r")))]
16220 : 78 : "TARGET_BMI2"
16221 : : "<shift>x\t{%2, %1, %0|%0, %1, %2}"
16222 : : [(set_attr "type" "ishiftx")
16223 : : (set_attr "mode" "<MODE>")])
16224 : 1358193 :
16225 : 220155 : (define_insn "*ashr<mode>3_1"
16226 : 1138038 : [(set (match_operand:SWI48 0 "nonimmediate_operand" "=rm,r,r")
16227 : 217605 : (ashiftrt:SWI48
16228 : 217605 : (match_operand:SWI48 1 "nonimmediate_operand" "0,rm,rm")
16229 : 898359 : (match_operand:QI 2 "nonmemory_operand" "c<S>,r,c<S>")))
16230 : 41820 : (clobber (reg:CC FLAGS_REG))]
16231 : 381242 : "ix86_binary_operator_ok (ASHIFTRT, <MODE>mode, operands, TARGET_APX_NDD)"
16232 : 1078448 : {
16233 : 75884 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
16234 : 158263 : switch (get_attr_type (insn))
16235 : 679110 : {
16236 : 291902 : case TYPE_ISHIFTX:
16237 : 992688 : return "#";
16238 : 3255 :
16239 : 124709 : default:
16240 : 128020 : if (operands[2] == const1_rtx
16241 : 23744 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
16242 : 145198 : && !use_ndd)
16243 : 3255 : return "sar{<imodesuffix>}\t%0";
16244 : 26 : else
16245 : 107552 : return use_ndd ? "sar{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
16246 : 104318 : : "sar{<imodesuffix>}\t{%2, %0|%0, %2}";
16247 : 21 : }
16248 : : }
16249 : : [(set_attr "isa" "*,bmi2,apx_ndd")
16250 : : (set_attr "type" "ishift,ishiftx,ishift")
16251 : : (set (attr "length_immediate")
16252 : 141836 : (if_then_else
16253 : : (and (match_operand 2 "const1_operand")
16254 : : (ior (match_test "TARGET_SHIFT1")
16255 : : (match_test "optimize_function_for_size_p (cfun)")))
16256 : : (const_string "0")
16257 : : (const_string "*")))
16258 : : (set_attr "mode" "<MODE>")])
16259 : :
16260 : : ;; Specialization of *lshr<mode>3_1 below, extracting the SImode
16261 : : ;; highpart of a DI to be extracted, but allowing it to be clobbered.
16262 : : (define_insn_and_split "*highpartdisi2"
16263 : : [(set (subreg:DI (match_operand:SI 0 "register_operand" "=r,x,?k,r") 0)
16264 : : (lshiftrt:DI (match_operand:DI 1 "nonimmediate_operand" "0,0,k,rm")
16265 : : (const_int 32)))
16266 : : (clobber (reg:CC FLAGS_REG))]
16267 : 3283 : "TARGET_64BIT"
16268 : : "#"
16269 : 222712 : "&& reload_completed"
16270 : 877773 : [(parallel
16271 : 3255 : [(set (match_dup 0) (lshiftrt:DI (match_dup 1) (const_int 32)))
16272 : 212916 : (clobber (reg:CC FLAGS_REG))])]
16273 : 216171 : {
16274 : 428157 : if (SSE_REG_P (operands[0]))
16275 : 248913 : {
16276 : 249860 : rtx tmp = gen_rtx_REG (V4SImode, REGNO (operands[0]));
16277 : 947 : emit_insn (gen_sse_shufps_v4si (tmp, tmp, tmp,
16278 : 248712 : const1_rtx, const1_rtx,
16279 : 248712 : GEN_INT (5), GEN_INT (5)));
16280 : 496948 : DONE;
16281 : : }
16282 : 2308 : operands[0] = gen_rtx_REG (DImode, REGNO (operands[0]));
16283 : : }
16284 : : [(set_attr "isa" "*,*,*,apx_ndd")])
16285 : :
16286 : 2308 :
16287 : 2308 : (define_insn "*lshr<mode>3_1"
16288 : 2308 : [(set (match_operand:SWI48 0 "nonimmediate_operand" "=rm,r,?k,r")
16289 : 2308 : (lshiftrt:SWI48
16290 : 2308 : (match_operand:SWI48 1 "nonimmediate_operand" "0,rm,k,rm")
16291 : : (match_operand:QI 2 "nonmemory_operand" "c<S>,r,<KS>,c<S>")))
16292 : : (clobber (reg:CC FLAGS_REG))]
16293 : 709617 : "ix86_binary_operator_ok (LSHIFTRT, <MODE>mode, operands, TARGET_APX_NDD)"
16294 : 298699 : {
16295 : 172239 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
16296 : 290895 : switch (get_attr_type (insn))
16297 : 29135 : {
16298 : 29135 : case TYPE_ISHIFTX:
16299 : 29135 : case TYPE_MSKLOG:
16300 : 26827 : return "#";
16301 : 51840 :
16302 : 178113 : default:
16303 : 178113 : if (operands[2] == const1_rtx
16304 : 1169253 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
16305 : 195213 : && !use_ndd)
16306 : : return "shr{<imodesuffix>}\t%0";
16307 : 8 : else
16308 : 1313193 : return use_ndd ? "shr{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
16309 : 1313193 : : "shr{<imodesuffix>}\t{%2, %0|%0, %2}";
16310 : 1152169 : }
16311 : 1152169 : }
16312 : 1152161 : [(set_attr "isa" "*,bmi2,avx512bw,apx_ndd")
16313 : 1152169 : (set_attr "type" "ishift,ishiftx,msklog,ishift")
16314 : 1152161 : (set (attr "length_immediate")
16315 : 1278227 : (if_then_else
16316 : : (and (and (match_operand 2 "const1_operand")
16317 : 1138155 : (eq_attr "alternative" "0"))
16318 : 1138155 : (ior (match_test "TARGET_SHIFT1")
16319 : 1138155 : (match_test "optimize_function_for_size_p (cfun)")))
16320 : 1138155 : (const_string "0")
16321 : 1138155 : (const_string "*")))
16322 : 1138155 : (set_attr "mode" "<MODE>")])
16323 : 1138155 :
16324 : 1138155 : ;; Convert shift to the shiftx pattern to avoid flags dependency.
16325 : 1138155 : (define_split
16326 : 1138155 : [(set (match_operand:SWI48 0 "register_operand")
16327 : 1138155 : (any_shiftrt:SWI48 (match_operand:SWI48 1 "nonimmediate_operand")
16328 : 1138155 : (match_operand:QI 2 "register_operand")))
16329 : 1138155 : (clobber (reg:CC FLAGS_REG))]
16330 : 1177577 : "TARGET_BMI2 && reload_completed"
16331 : 43 : [(set (match_dup 0)
16332 : 2689 : (any_shiftrt:SWI48 (match_dup 1) (match_dup 2)))]
16333 : 1196026 : "operands[2] = gen_lowpart (<MODE>mode, operands[2]);")
16334 : 1195935 :
16335 : : (define_insn "*bmi2_<insn>si3_1_zext"
16336 : 707762 : [(set (match_operand:DI 0 "register_operand" "=r")
16337 : 707762 : (zero_extend:DI
16338 : 642258 : (any_shiftrt:SI (match_operand:SI 1 "nonimmediate_operand" "rm")
16339 : 1349574 : (match_operand:SI 2 "register_operand" "r"))))]
16340 : 91 : "TARGET_64BIT && TARGET_BMI2"
16341 : 91 : "<shift>x\t{%2, %1, %k0|%k0, %1, %2}"
16342 : 11976 : [(set_attr "type" "ishiftx")
16343 : 11202 : (set_attr "mode" "SI")])
16344 : 22939 :
16345 : : (define_insn "*<insn>si3_1_zext"
16346 : 91 : [(set (match_operand:DI 0 "register_operand" "=r,r,r")
16347 : 135 : (zero_extend:DI
16348 : 129 : (any_shiftrt:SI (match_operand:SI 1 "nonimmediate_operand" "0,rm,rm")
16349 : 82 : (match_operand:QI 2 "nonmemory_operand" "cI,r,cI"))))
16350 : : (clobber (reg:CC FLAGS_REG))]
16351 : 11249 : "TARGET_64BIT
16352 : 27714 : && ix86_binary_operator_ok (<CODE>, SImode, operands, TARGET_APX_NDD)"
16353 : 9797 : {
16354 : 18553 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
16355 : 18481 : switch (get_attr_type (insn))
16356 : 18342 : {
16357 : 18342 : case TYPE_ISHIFTX:
16358 : 51070 : return "#";
16359 : 83 :
16360 : 19474 : default:
16361 : 19391 : if (operands[2] == const1_rtx
16362 : 1780 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
16363 : 9118 : && !use_ndd)
16364 : : return "<shift>{l}\t%k0";
16365 : : else
16366 : 5724 : return use_ndd ? "<shift>{l}\t{%2, %1, %k0|%k0, %1, %2}"
16367 : 5724 : : "<shift>{l}\t{%2, %k0|%k0, %2}";
16368 : : }
16369 : : }
16370 : : [(set_attr "isa" "*,bmi2,apx_ndd")
16371 : : (set_attr "type" "ishift,ishiftx,ishift")
16372 : : (set (attr "length_immediate")
16373 : 21447 : (if_then_else
16374 : : (and (match_operand 2 "const1_operand")
16375 : : (ior (match_test "TARGET_SHIFT1")
16376 : : (match_test "optimize_function_for_size_p (cfun)")))
16377 : : (const_string "0")
16378 : : (const_string "*")))
16379 : : (set_attr "mode" "SI")])
16380 : :
16381 : : ;; Convert shift to the shiftx pattern to avoid flags dependency.
16382 : : (define_split
16383 : : [(set (match_operand:DI 0 "register_operand")
16384 : : (zero_extend:DI
16385 : : (any_shiftrt:SI (match_operand:SI 1 "nonimmediate_operand")
16386 : : (match_operand:QI 2 "register_operand"))))
16387 : : (clobber (reg:CC FLAGS_REG))]
16388 : 57 : "TARGET_64BIT && TARGET_BMI2 && reload_completed"
16389 : : [(set (match_dup 0)
16390 : 0 : (zero_extend:DI (any_shiftrt:SI (match_dup 1) (match_dup 2))))]
16391 : 0 : "operands[2] = gen_lowpart (SImode, operands[2]);")
16392 : 33 :
16393 : 33 : (define_insn "*ashr<mode>3_1"
16394 : 33 : [(set (match_operand:SWI12 0 "nonimmediate_operand" "=<r>m, r")
16395 : 0 : (ashiftrt:SWI12
16396 : 0 : (match_operand:SWI12 1 "nonimmediate_operand" "0, rm")
16397 : 0 : (match_operand:QI 2 "nonmemory_operand" "c<S>, c<S>")))
16398 : 0 : (clobber (reg:CC FLAGS_REG))]
16399 : 44309 : "ix86_binary_operator_ok (ASHIFTRT, <MODE>mode, operands, TARGET_APX_NDD)"
16400 : 41940 : {
16401 : 29130 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
16402 : 40154 : if (operands[2] == const1_rtx
16403 : 19987 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
16404 : 52447 : && !use_ndd)
16405 : 36502 : return "sar{<imodesuffix>}\t%0";
16406 : 15989 : else
16407 : 25662 : return use_ndd ? "sar{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
16408 : 25662 : : "sar{<imodesuffix>}\t{%2, %0|%0, %2}";
16409 : : }
16410 : : [(set_attr "isa" "*, apx_ndd")
16411 : : (set_attr "type" "ishift")
16412 : : (set (attr "length_immediate")
16413 : 25340 : (if_then_else
16414 : : (and (match_operand 2 "const1_operand")
16415 : 1 : (ior (match_test "TARGET_SHIFT1")
16416 : 1 : (match_test "optimize_function_for_size_p (cfun)")))
16417 : 1 : (const_string "0")
16418 : 1 : (const_string "*")))
16419 : 1 : (set_attr "mode" "<MODE>")])
16420 : 0 :
16421 : 1 : (define_insn "*lshrqi3_1"
16422 : : [(set (match_operand:QI 0 "nonimmediate_operand" "=qm,?k,r")
16423 : : (lshiftrt:QI
16424 : : (match_operand:QI 1 "nonimmediate_operand" "0, k, rm")
16425 : : (match_operand:QI 2 "nonmemory_operand" "cI,Wb,cI")))
16426 : : (clobber (reg:CC FLAGS_REG))]
16427 : 43071 : "ix86_binary_operator_ok (LSHIFTRT, QImode, operands, TARGET_APX_NDD)"
16428 : 26435 : {
16429 : 22854 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
16430 : 22854 : switch (get_attr_type (insn))
16431 : 16322 : {
16432 : 30637 : case TYPE_ISHIFT:
16433 : 46478 : if (operands[2] == const1_rtx
16434 : 44941 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
16435 : 46317 : && !use_ndd)
16436 : : return "shr{b}\t%0";
16437 : : else
16438 : 11695 : return use_ndd ? "shr{b}\t{%2, %1, %0|%0, %1, %2}"
16439 : 11695 : : "shr{b}\t{%2, %0|%0, %2}";
16440 : : case TYPE_MSKLOG:
16441 : : return "#";
16442 : 0 : default:
16443 : 0 : gcc_unreachable ();
16444 : : }
16445 : : }
16446 : : [(set_attr "isa" "*,avx512dq,apx_ndd")
16447 : : (set_attr "type" "ishift,msklog,ishift")
16448 : : (set (attr "length_immediate")
16449 : 6546 : (if_then_else
16450 : : (and (and (match_operand 2 "const1_operand")
16451 : : (eq_attr "alternative" "0"))
16452 : : (ior (match_test "TARGET_SHIFT1")
16453 : : (match_test "optimize_function_for_size_p (cfun)")))
16454 : : (const_string "0")
16455 : : (const_string "*")))
16456 : : (set_attr "mode" "QI")])
16457 : :
16458 : : (define_insn "*lshrhi3_1"
16459 : : [(set (match_operand:HI 0 "nonimmediate_operand" "=rm, ?k, r")
16460 : : (lshiftrt:HI
16461 : : (match_operand:HI 1 "nonimmediate_operand" "0, k, rm")
16462 : : (match_operand:QI 2 "nonmemory_operand" "cI, Ww, cI")))
16463 : : (clobber (reg:CC FLAGS_REG))]
16464 : 23216 : "ix86_binary_operator_ok (LSHIFTRT, HImode, operands, TARGET_APX_NDD)"
16465 : 16116 : {
16466 : 12817 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
16467 : 12817 : switch (get_attr_type (insn))
16468 : 75 : {
16469 : 6621 : case TYPE_ISHIFT:
16470 : 8243 : if (operands[2] == const1_rtx
16471 : 3481 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
16472 : 8477 : && !use_ndd)
16473 : : return "shr{w}\t%0";
16474 : : else
16475 : 4763 : return use_ndd ? "shr{w}\t{%2, %1, %0|%0, %1, %2}"
16476 : 4763 : : "shr{w}\t{%2, %0|%0, %2}";
16477 : : case TYPE_MSKLOG:
16478 : : return "#";
16479 : 0 : default:
16480 : 0 : gcc_unreachable ();
16481 : : }
16482 : : }
16483 : : [(set_attr "isa" "*, avx512f, apx_ndd")
16484 : : (set_attr "type" "ishift,msklog,ishift")
16485 : : (set (attr "length_immediate")
16486 : 39 : (if_then_else
16487 : : (and (and (match_operand 2 "const1_operand")
16488 : : (eq_attr "alternative" "0"))
16489 : : (ior (match_test "TARGET_SHIFT1")
16490 : : (match_test "optimize_function_for_size_p (cfun)")))
16491 : : (const_string "0")
16492 : : (const_string "*")))
16493 : : (set_attr "mode" "HI")])
16494 : :
16495 : : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
16496 : : (define_insn_and_split "*<insn><mode>3_1_slp"
16497 : : [(set (strict_low_part (match_operand:SWI12 0 "register_operand" "+<r>,&<r>"))
16498 : : (any_shiftrt:SWI12 (match_operand:SWI12 1 "register_operand" "0,!<r>")
16499 : : (match_operand:QI 2 "nonmemory_operand" "cI,cI")))
16500 : : (clobber (reg:CC FLAGS_REG))]
16501 : 134 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
16502 : 82 : {
16503 : 45 : if (which_alternative)
16504 : 6 : return "#";
16505 : 0 :
16506 : 44 : if (operands[2] == const1_rtx
16507 : 46 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun)))
16508 : 36 : return "<shift>{<imodesuffix>}\t%0";
16509 : : else
16510 : 8 : return "<shift>{<imodesuffix>}\t{%2, %0|%0, %2}";
16511 : : }
16512 : 93 : "&& reload_completed
16513 : 90 : && !(rtx_equal_p (operands[0], operands[1]))"
16514 : 849713 : [(set (strict_low_part (match_dup 0)) (match_dup 1))
16515 : 46 : (parallel
16516 : 1074828 : [(set (strict_low_part (match_dup 0))
16517 : 602754 : (any_shiftrt:SWI12 (match_dup 0) (match_dup 2)))
16518 : 588232 : (clobber (reg:CC FLAGS_REG))])]
16519 : 588226 : ""
16520 : 588226 : [(set_attr "type" "ishift")
16521 : 1166706 : (set (attr "length_immediate")
16522 : 381819 : (if_then_else
16523 : 6540 : (and (match_operand 2 "const1_operand")
16524 : 711665 : (ior (match_test "TARGET_SHIFT1")
16525 : 699316 : (match_test "optimize_function_for_size_p (cfun)")))
16526 : 2 : (const_string "0")
16527 : 14257 : (const_string "*")))
16528 : 253845 : (set_attr "mode" "<MODE>")])
16529 : 259017 :
16530 : 253843 : ;; This pattern can't accept a variable shift count, since shifts by
16531 : 5176 : ;; zero don't affect the flags. We assume that shifts by constant
16532 : 6644 : ;; zero are optimized away.
16533 : 0 : (define_insn "*<insn><mode>3_cmp"
16534 : : [(set (reg FLAGS_REG)
16535 : : (compare
16536 : : (any_shiftrt:SWI
16537 : : (match_operand:SWI 1 "nonimmediate_operand" "0,rm")
16538 : : (match_operand:QI 2 "<shift_immediate_operand>" "<S>,<S>"))
16539 : 2 : (const_int 0)))
16540 : 2 : (set (match_operand:SWI 0 "nonimmediate_operand" "=<r>m,r")
16541 : 2 : (any_shiftrt:SWI (match_dup 1) (match_dup 2)))]
16542 : 144 : "(optimize_function_for_size_p (cfun)
16543 : 3461 : || !TARGET_PARTIAL_FLAG_REG_STALL
16544 : 0 : || (operands[2] == const1_rtx
16545 : 0 : && TARGET_SHIFT1))
16546 : 3550 : && ix86_match_ccmode (insn, CCGOCmode)
16547 : 2362 : && ix86_binary_operator_ok (<CODE>, <MODE>mode, operands, TARGET_APX_NDD)"
16548 : 1988 : {
16549 : 42 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
16550 : 1936 : if (operands[2] == const1_rtx
16551 : 3894 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
16552 : 8044 : && !use_ndd)
16553 : 1 : return "<shift>{<imodesuffix>}\t%0";
16554 : 1 : else
16555 : 1449 : return use_ndd ? "<shift>{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
16556 : 1449 : : "<shift>{<imodesuffix>}\t{%2, %0|%0, %2}";
16557 : : }
16558 : : [(set_attr "isa" "*,apx_ndd")
16559 : : (set_attr "type" "ishift")
16560 : : (set (attr "length_immediate")
16561 : 1894 : (if_then_else
16562 : : (and (match_operand 2 "const1_operand")
16563 : : (ior (match_test "TARGET_SHIFT1")
16564 : : (match_test "optimize_function_for_size_p (cfun)")))
16565 : : (const_string "0")
16566 : : (const_string "*")))
16567 : : (set_attr "mode" "<MODE>")])
16568 : :
16569 : : (define_insn "*<insn>si3_cmp_zext"
16570 : : [(set (reg FLAGS_REG)
16571 : : (compare
16572 : : (any_shiftrt:SI (match_operand:SI 1 "nonimmediate_operand" "0,rm")
16573 : : (match_operand:QI 2 "const_1_to_31_operand"))
16574 : : (const_int 0)))
16575 : : (set (match_operand:DI 0 "register_operand" "=r,r")
16576 : : (zero_extend:DI (any_shiftrt:SI (match_dup 1) (match_dup 2))))]
16577 : 0 : "TARGET_64BIT
16578 : 0 : && (optimize_function_for_size_p (cfun)
16579 : 0 : || !TARGET_PARTIAL_FLAG_REG_STALL
16580 : 0 : || (operands[2] == const1_rtx
16581 : 0 : && TARGET_SHIFT1))
16582 : 0 : && ix86_match_ccmode (insn, CCGOCmode)
16583 : 0 : && ix86_binary_operator_ok (<CODE>, SImode, operands, TARGET_APX_NDD)"
16584 : 2 : {
16585 : 0 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
16586 : 0 : if (operands[2] == const1_rtx
16587 : 0 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
16588 : 0 : && !use_ndd)
16589 : : return "<shift>{l}\t%k0";
16590 : : else
16591 : 0 : return use_ndd ? "<shift>{l}\t{%2, %1, %k0|%k0, %1, %2}"
16592 : 0 : : "<shift>{l}\t{%2, %k0|%k0, %2}";
16593 : : }
16594 : : [(set_attr "isa" "*,apx_ndd")
16595 : : (set_attr "type" "ishift")
16596 : : (set (attr "length_immediate")
16597 : 0 : (if_then_else
16598 : : (and (match_operand 2 "const1_operand")
16599 : : (ior (match_test "TARGET_SHIFT1")
16600 : : (match_test "optimize_function_for_size_p (cfun)")))
16601 : : (const_string "0")
16602 : : (const_string "*")))
16603 : : (set_attr "mode" "SI")])
16604 : :
16605 : : (define_insn "*<insn><mode>3_cconly"
16606 : : [(set (reg FLAGS_REG)
16607 : : (compare
16608 : : (any_shiftrt:SWI
16609 : : (match_operand:SWI 1 "nonimmediate_operand" "0,rm")
16610 : : (match_operand:QI 2 "<shift_immediate_operand>" "<S>,<S>"))
16611 : : (const_int 0)))
16612 : : (clobber (match_scratch:SWI 0 "=<r>,r"))]
16613 : 235 : "(optimize_function_for_size_p (cfun)
16614 : 11775 : || !TARGET_PARTIAL_FLAG_REG_STALL
16615 : 0 : || (operands[2] == const1_rtx
16616 : 0 : && TARGET_SHIFT1))
16617 : 11910 : && ix86_match_ccmode (insn, CCGOCmode)"
16618 : 5204 : {
16619 : 1397 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
16620 : 6543 : if (operands[2] == const1_rtx
16621 : 211 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
16622 : 5519 : && !use_ndd)
16623 : 22235 : return "<shift>{<imodesuffix>}\t%0";
16624 : : else
16625 : 5097 : return use_ndd
16626 : 5097 : ? "<shift>{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
16627 : 5097 : : "<shift>{<imodesuffix>}\t{%2, %0|%0, %2}";
16628 : : }
16629 : : [(set_attr "isa" "*,apx_ndd")
16630 : : (set_attr "type" "ishift")
16631 : : (set (attr "length_immediate")
16632 : 5184 : (if_then_else
16633 : : (and (match_operand 2 "const1_operand")
16634 : : (ior (match_test "TARGET_SHIFT1")
16635 : : (match_test "optimize_function_for_size_p (cfun)")))
16636 : : (const_string "0")
16637 : : (const_string "*")))
16638 : : (set_attr "mode" "<MODE>")])
16639 : :
16640 : : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
16641 : : (define_insn_and_split "*<insn>qi_ext<mode>_1"
16642 : : [(set (zero_extract:SWI248
16643 : : (match_operand 0 "int248_register_operand" "+Q,&Q")
16644 : : (const_int 8)
16645 : : (const_int 8))
16646 : : (subreg:SWI248
16647 : : (any_shiftrt:QI
16648 : : (subreg:QI
16649 : : (match_operator:SWI248 3 "extract_operator"
16650 : : [(match_operand 1 "int248_register_operand" "0,!Q")
16651 : : (const_int 8)
16652 : : (const_int 8)]) 0)
16653 : : (match_operand:QI 2 "nonmemory_operand" "cI,cI")) 0))
16654 : : (clobber (reg:CC FLAGS_REG))]
16655 : : ""
16656 : 39 : {
16657 : 38 : if (which_alternative)
16658 : : return "#";
16659 : :
16660 : 39 : if (operands[2] == const1_rtx
16661 : 39 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun)))
16662 : 36 : return "<shift>{b}\t%h0";
16663 : : else
16664 : 3 : return "<shift>{b}\t{%2, %h0|%h0, %2}";
16665 : : }
16666 : 80 : "reload_completed
16667 : 79 : && !(rtx_equal_p (operands[0], operands[1]))"
16668 : 79 : [(set (zero_extract:SWI248
16669 : 2471 : (match_dup 0) (const_int 8) (const_int 8))
16670 : : (zero_extract:SWI248
16671 : 0 : (match_dup 1) (const_int 8) (const_int 8)))
16672 : 0 : (parallel
16673 : : [(set (zero_extract:SWI248
16674 : : (match_dup 0) (const_int 8) (const_int 8))
16675 : : (subreg:SWI248
16676 : : (any_shiftrt:QI
16677 : : (subreg:QI
16678 : : (match_op_dup 3
16679 : : [(match_dup 0) (const_int 8) (const_int 8)]) 0)
16680 : : (match_dup 2)) 0))
16681 : : (clobber (reg:CC FLAGS_REG))])]
16682 : : ""
16683 : : [(set_attr "type" "ishift")
16684 : : (set (attr "length_immediate")
16685 : 1 : (if_then_else
16686 : 1 : (and (match_operand 2 "const1_operand")
16687 : 1 : (ior (match_test "TARGET_SHIFT1")
16688 : 1 : (match_test "optimize_function_for_size_p (cfun)")))
16689 : 1 : (const_string "0")
16690 : 1 : (const_string "*")))
16691 : 1 : (set_attr "mode" "QI")])
16692 : 1 :
16693 : 1 : (define_insn_and_split "*extend<dwi>2_doubleword_highpart"
16694 : : [(set (match_operand:<DWI> 0 "register_operand" "=r")
16695 : : (ashiftrt:<DWI>
16696 : : (ashift:<DWI> (match_operand:<DWI> 1 "nonimmediate_operand" "0")
16697 : : (match_operand:QI 2 "const_int_operand"))
16698 : : (match_operand:QI 3 "const_int_operand")))
16699 : : (clobber (reg:CC FLAGS_REG))]
16700 : 17324 : "INTVAL (operands[2]) == INTVAL (operands[3])
16701 : 21106 : && UINTVAL (operands[2]) < <MODE_SIZE> * BITS_PER_UNIT"
16702 : : "#"
16703 : 0 : "&& reload_completed"
16704 : : [(parallel [(set (match_dup 4)
16705 : 2712 : (ashift:DWIH (match_dup 4) (match_dup 2)))
16706 : : (clobber (reg:CC FLAGS_REG))])
16707 : 5424 : (parallel [(set (match_dup 4)
16708 : 10848 : (ashiftrt:DWIH (match_dup 4) (match_dup 2)))
16709 : : (clobber (reg:CC FLAGS_REG))])]
16710 : 2712 : "split_double_mode (<DWI>mode, &operands[0], 1, &operands[0], &operands[4]);")
16711 : :
16712 : : (define_insn_and_split "*extendv2di2_highpart_stv"
16713 : 14919 : [(set (match_operand:V2DI 0 "register_operand" "=v")
16714 : 2712 : (ashiftrt:V2DI
16715 : 14919 : (ashift:V2DI (match_operand:V2DI 1 "nonimmediate_operand" "vm")
16716 : 14919 : (match_operand:QI 2 "const_int_operand"))
16717 : 14919 : (match_operand:QI 3 "const_int_operand")))]
16718 : 12208 : "!TARGET_64BIT && TARGET_STV && TARGET_AVX512VL
16719 : 1 : && INTVAL (operands[2]) == INTVAL (operands[3])
16720 : 2713 : && UINTVAL (operands[2]) < 32"
16721 : 2714 : "#"
16722 : 2712 : "&& reload_completed"
16723 : 2712 : [(set (match_dup 0)
16724 : 0 : (ashift:V2DI (match_dup 1) (match_dup 2)))
16725 : : (set (match_dup 0)
16726 : 2704 : (ashiftrt:V2DI (match_dup 0) (match_dup 2)))])
16727 : 2704 :
16728 : 0 : ;; Rotate instructions
16729 : 0 :
16730 : 2712 : (define_expand "<insn>ti3"
16731 : 0 : [(set (match_operand:TI 0 "register_operand")
16732 : 0 : (any_rotate:TI (match_operand:TI 1 "register_operand")
16733 : 0 : (match_operand:QI 2 "nonmemory_operand")))]
16734 : 2435757 : "TARGET_64BIT"
16735 : 0 : {
16736 : 34 : if (const_1_to_63_operand (operands[2], VOIDmode))
16737 : 2722 : emit_insn (gen_ix86_<insn>ti3_doubleword
16738 : 2438469 : (operands[0], operands[1], operands[2]));
16739 : 2435781 : else if (CONST_INT_P (operands[2]) && INTVAL (operands[2]) == 64)
16740 : 2435757 : {
16741 : 2435760 : operands[1] = force_reg (TImode, operands[1]);
16742 : 2435760 : emit_insn (gen_<insn>64ti2_doubleword (operands[0], operands[1]));
16743 : 2435757 : }
16744 : 2435757 : else
16745 : 2712 : {
16746 : 893973 : rtx amount = force_reg (QImode, operands[2]);
16747 : 893973 : rtx src_lo = gen_lowpart (DImode, operands[1]);
16748 : 893973 : rtx src_hi = gen_highpart (DImode, operands[1]);
16749 : 893973 : rtx tmp_lo = gen_reg_rtx (DImode);
16750 : 21 : rtx tmp_hi = gen_reg_rtx (DImode);
16751 : 242503 : emit_move_insn (tmp_lo, src_lo);
16752 : 484974 : emit_move_insn (tmp_hi, src_hi);
16753 : 2712 : rtx (*shiftd) (rtx, rtx, rtx)
16754 : 0 : = (<CODE> == ROTATE) ? gen_x86_64_shld : gen_x86_64_shrd;
16755 : 2733 : emit_insn (shiftd (tmp_lo, src_hi, amount));
16756 : 21 : emit_insn (shiftd (tmp_hi, src_lo, amount));
16757 : 21 : rtx dst_lo = gen_lowpart (DImode, operands[0]);
16758 : 21 : rtx dst_hi = gen_highpart (DImode, operands[0]);
16759 : 21 : emit_move_insn (dst_lo, tmp_lo);
16760 : 21 : emit_move_insn (dst_hi, tmp_hi);
16761 : 21 : emit_insn (gen_x86_shiftdi_adj_1 (dst_lo, dst_hi, amount, tmp_lo));
16762 : : }
16763 : 34 : DONE;
16764 : 0 : })
16765 : :
16766 : : (define_expand "<insn>di3"
16767 : : [(set (match_operand:DI 0 "shiftdi_operand")
16768 : 0 : (any_rotate:DI (match_operand:DI 1 "shiftdi_operand")
16769 : 0 : (match_operand:QI 2 "nonmemory_operand")))]
16770 : 0 : ""
16771 : 671 : {
16772 : 671 : if (TARGET_64BIT)
16773 : 609 : ix86_expand_binary_operator (<CODE>, DImode, operands, TARGET_APX_NDD);
16774 : 62 : else if (const_1_to_31_operand (operands[2], VOIDmode))
16775 : 60 : emit_insn (gen_ix86_<insn>di3_doubleword
16776 : : (operands[0], operands[1], operands[2]));
16777 : 2 : else if (CONST_INT_P (operands[2]) && INTVAL (operands[2]) == 32)
16778 : : {
16779 : 0 : operands[1] = force_reg (DImode, operands[1]);
16780 : 15 : emit_insn (gen_<insn>32di2_doubleword (operands[0], operands[1]));
16781 : 15 : }
16782 : 15 : else
16783 : 2 : FAIL;
16784 : 15 :
16785 : 703 : DONE;
16786 : : })
16787 : :
16788 : : (define_expand "<insn><mode>3"
16789 : 312 : [(set (match_operand:SWIM124 0 "nonimmediate_operand")
16790 : 312 : (any_rotate:SWIM124 (match_operand:SWIM124 1 "nonimmediate_operand")
16791 : 312 : (match_operand:QI 2 "nonmemory_operand")))]
16792 : 312 : ""
16793 : 7595 : {
16794 : 7595 : ix86_expand_binary_operator (<CODE>, <MODE>mode, operands, TARGET_APX_NDD);
16795 : 7595 : DONE;
16796 : : })
16797 : :
16798 : : ;; Avoid useless masking of count operand.
16799 : : (define_insn_and_split "*<insn><mode>3_mask"
16800 : : [(set (match_operand:SWI 0 "nonimmediate_operand")
16801 : : (any_rotate:SWI
16802 : : (match_operand:SWI 1 "nonimmediate_operand")
16803 : : (subreg:QI
16804 : : (and
16805 : : (match_operand 2 "int248_register_operand" "c")
16806 : : (match_operand 3 "const_int_operand")) 0)))
16807 : 867 : (clobber (reg:CC FLAGS_REG))]
16808 : 1164 : "ix86_binary_operator_ok (<CODE>, <MODE>mode, operands)
16809 : 9184 : && (INTVAL (operands[3]) & (GET_MODE_BITSIZE (<MODE>mode)-1))
16810 : 4592 : == GET_MODE_BITSIZE (<MODE>mode)-1
16811 : 9971 : && ix86_pre_reload_split ()"
16812 : 867 : "#"
16813 : 867 : "&& 1"
16814 : 2391 : [(parallel
16815 : 2771 : [(set (match_dup 0)
16816 : 2771 : (any_rotate:SWI (match_dup 1)
16817 : 24033 : (match_dup 2)))
16818 : 1251 : (clobber (reg:CC FLAGS_REG))])]
16819 : 1524 : {
16820 : 37104 : operands[2] = force_reg (GET_MODE (operands[2]), operands[2]);
16821 : 22053 : operands[2] = gen_lowpart (QImode, operands[2]);
16822 : 16841 : })
16823 : 17148 :
16824 : 307 : (define_split
16825 : 0 : [(set (match_operand:SWI 0 "register_operand")
16826 : 307 : (any_rotate:SWI
16827 : 6794 : (match_operand:SWI 1 "const_int_operand")
16828 : 1524 : (subreg:QI
16829 : 1524 : (and
16830 : 1524 : (match_operand 2 "int248_register_operand")
16831 : 1524 : (match_operand 3 "const_int_operand")) 0)))]
16832 : 64 : "(INTVAL (operands[3]) & (GET_MODE_BITSIZE (<MODE>mode) - 1))
16833 : 0 : == GET_MODE_BITSIZE (<MODE>mode) - 1"
16834 : : [(set (match_dup 4) (match_dup 1))
16835 : 23 : (set (match_dup 0)
16836 : : (any_rotate:SWI (match_dup 4)
16837 : 64 : (subreg:QI (match_dup 2) 0)))]
16838 : 1700 : "operands[4] = gen_reg_rtx (<MODE>mode);")
16839 : 1524 :
16840 : 1524 : (define_insn_and_split "*<insn><mode>3_mask_1"
16841 : 48 : [(set (match_operand:SWI 0 "nonimmediate_operand")
16842 : 48 : (any_rotate:SWI
16843 : 48 : (match_operand:SWI 1 "nonimmediate_operand")
16844 : 48 : (and:QI
16845 : 48 : (match_operand:QI 2 "register_operand" "c")
16846 : 1265 : (match_operand:QI 3 "const_int_operand"))))
16847 : 48 : (clobber (reg:CC FLAGS_REG))]
16848 : 1267 : "ix86_binary_operator_ok (<CODE>, <MODE>mode, operands)
16849 : 1685 : && (INTVAL (operands[3]) & (GET_MODE_BITSIZE (<MODE>mode)-1))
16850 : 1475 : == GET_MODE_BITSIZE (<MODE>mode)-1
16851 : 398 : && ix86_pre_reload_split ()"
16852 : 1217 : "#"
16853 : 48 : "&& 1"
16854 : 1217 : [(parallel
16855 : 70 : [(set (match_dup 0)
16856 : 136 : (any_rotate:SWI (match_dup 1)
16857 : 0 : (match_dup 2)))
16858 : 136 : (clobber (reg:CC FLAGS_REG))])])
16859 : 56472 :
16860 : 45235 : (define_split
16861 : 11285 : [(set (match_operand:SWI 0 "register_operand")
16862 : 11237 : (any_rotate:SWI
16863 : 307 : (match_operand:SWI 1 "const_int_operand")
16864 : 273 : (and:QI
16865 : 273 : (match_operand:QI 2 "register_operand")
16866 : : (match_operand:QI 3 "const_int_operand"))))]
16867 : 52 : "(INTVAL (operands[3]) & (GET_MODE_BITSIZE (<MODE>mode) - 1))
16868 : 0 : == GET_MODE_BITSIZE (<MODE>mode) - 1"
16869 : 49 : [(set (match_dup 4) (match_dup 1))
16870 : 51 : (set (match_dup 0)
16871 : 49 : (any_rotate:SWI (match_dup 4) (match_dup 2)))]
16872 : 7 : "operands[4] = gen_reg_rtx (<MODE>mode);")
16873 : 55 :
16874 : 48 : ;; Implement rotation using two double-precision
16875 : 49 : ;; shift instructions and a scratch register.
16876 : 1 :
16877 : 49 : (define_insn_and_split "ix86_rotl<dwi>3_doubleword"
16878 : 4 : [(set (match_operand:<DWI> 0 "register_operand" "=r")
16879 : 4 : (rotate:<DWI> (match_operand:<DWI> 1 "register_operand" "0")
16880 : 4 : (match_operand:QI 2 "<shift_immediate_operand>" "<S>")))
16881 : 4 : (clobber (reg:CC FLAGS_REG))
16882 : 4 : (clobber (match_scratch:DWIH 3 "=&r"))]
16883 : 3 : ""
16884 : 3 : "#"
16885 : 3 : "reload_completed"
16886 : : [(set (match_dup 3) (match_dup 4))
16887 : 3 : (parallel
16888 : : [(set (match_dup 4)
16889 : 1 : (ior:DWIH (ashift:DWIH (match_dup 4)
16890 : 1 : (and:QI (match_dup 2) (match_dup 6)))
16891 : 4 : (subreg:DWIH
16892 : 3 : (lshiftrt:<DWI> (zero_extend:<DWI> (match_dup 5))
16893 : 3 : (minus:QI (match_dup 7)
16894 : : (and:QI (match_dup 2)
16895 : : (match_dup 6)))) 0)))
16896 : : (clobber (reg:CC FLAGS_REG))])
16897 : 1 : (parallel
16898 : : [(set (match_dup 5)
16899 : 4 : (ior:DWIH (ashift:DWIH (match_dup 5)
16900 : 1 : (and:QI (match_dup 2) (match_dup 6)))
16901 : 4 : (subreg:DWIH
16902 : 4 : (lshiftrt:<DWI> (zero_extend:<DWI> (match_dup 3))
16903 : 1 : (minus:QI (match_dup 7)
16904 : 0 : (and:QI (match_dup 2)
16905 : 1 : (match_dup 6)))) 0)))
16906 : 4 : (clobber (reg:CC FLAGS_REG))])]
16907 : 3 : {
16908 : 0 : operands[6] = GEN_INT (GET_MODE_BITSIZE (<MODE>mode) - 1);
16909 : 3 : operands[7] = GEN_INT (GET_MODE_BITSIZE (<MODE>mode));
16910 : 0 :
16911 : 0 : split_double_mode (<DWI>mode, &operands[0], 1, &operands[4], &operands[5]);
16912 : 1 : })
16913 : :
16914 : : (define_insn_and_split "ix86_rotr<dwi>3_doubleword"
16915 : 0 : [(set (match_operand:<DWI> 0 "register_operand" "=r")
16916 : 0 : (rotatert:<DWI> (match_operand:<DWI> 1 "register_operand" "0")
16917 : 0 : (match_operand:QI 2 "<shift_immediate_operand>" "<S>")))
16918 : 0 : (clobber (reg:CC FLAGS_REG))
16919 : 1 : (clobber (match_scratch:DWIH 3 "=&r"))]
16920 : 1 : ""
16921 : 1 : "#"
16922 : 10 : "reload_completed"
16923 : 0 : [(set (match_dup 3) (match_dup 4))
16924 : 0 : (parallel
16925 : 0 : [(set (match_dup 4)
16926 : 0 : (ior:DWIH (lshiftrt:DWIH (match_dup 4)
16927 : 1 : (and:QI (match_dup 2) (match_dup 6)))
16928 : 0 : (subreg:DWIH
16929 : 1 : (ashift:<DWI> (zero_extend:<DWI> (match_dup 5))
16930 : 1 : (minus:QI (match_dup 7)
16931 : 0 : (and:QI (match_dup 2)
16932 : 1 : (match_dup 6)))) 0)))
16933 : 1 : (clobber (reg:CC FLAGS_REG))])
16934 : 0 : (parallel
16935 : 1 : [(set (match_dup 5)
16936 : 1 : (ior:DWIH (lshiftrt:DWIH (match_dup 5)
16937 : 1 : (and:QI (match_dup 2) (match_dup 6)))
16938 : 1 : (subreg:DWIH
16939 : 1 : (ashift:<DWI> (zero_extend:<DWI> (match_dup 3))
16940 : 1 : (minus:QI (match_dup 7)
16941 : 1 : (and:QI (match_dup 2)
16942 : 1 : (match_dup 6)))) 0)))
16943 : : (clobber (reg:CC FLAGS_REG))])]
16944 : 5 : {
16945 : 10 : operands[6] = GEN_INT (GET_MODE_BITSIZE (<MODE>mode) - 1);
16946 : 10 : operands[7] = GEN_INT (GET_MODE_BITSIZE (<MODE>mode));
16947 : :
16948 : 5 : split_double_mode (<DWI>mode, &operands[0], 1, &operands[4], &operands[5]);
16949 : 1 : })
16950 : 1 :
16951 : 1 : (define_insn_and_split "<insn>32di2_doubleword"
16952 : 5 : [(set (match_operand:DI 0 "register_operand" "=r,r")
16953 : 0 : (any_rotate:DI (match_operand:DI 1 "register_operand" "0,r")
16954 : 5 : (const_int 32)))]
16955 : 13 : "!TARGET_64BIT"
16956 : 5 : "#"
16957 : 1059 : "&& reload_completed"
16958 : 5 : [(set (match_dup 0) (match_dup 3))
16959 : 6 : (set (match_dup 2) (match_dup 1))]
16960 : 343 : {
16961 : 337 : split_double_mode (DImode, &operands[0], 2, &operands[0], &operands[2]);
16962 : 16476 : if (rtx_equal_p (operands[0], operands[1]))
16963 : 1 : {
16964 : 16351 : emit_insn (gen_swapsi (operands[0], operands[2]));
16965 : 1 : DONE;
16966 : 4693 : }
16967 : 4693 : })
16968 : 5 :
16969 : 1 : (define_insn_and_split "<insn>64ti2_doubleword"
16970 : 5 : [(set (match_operand:TI 0 "register_operand" "=r,r")
16971 : 1 : (any_rotate:TI (match_operand:TI 1 "register_operand" "0,r")
16972 : 1 : (const_int 64)))]
16973 : 5 : "TARGET_64BIT"
16974 : 0 : "#"
16975 : 2 : "&& reload_completed"
16976 : 0 : [(set (match_dup 0) (match_dup 3))
16977 : 1 : (set (match_dup 2) (match_dup 1))]
16978 : 0 : {
16979 : 2 : split_double_mode (TImode, &operands[0], 2, &operands[0], &operands[2]);
16980 : 29868 : if (rtx_equal_p (operands[0], operands[1]))
16981 : 1 : {
16982 : 29497 : emit_insn (gen_swapdi (operands[0], operands[2]));
16983 : 16991177 : DONE;
16984 : 16991177 : }
16985 : 1763 : })
16986 : 1053593 :
16987 : 63 : (define_mode_attr rorx_immediate_operand
16988 : 1053594 : [(SI "const_0_to_31_operand")
16989 : 1053657 : (DI "const_0_to_63_operand")])
16990 : 1053600 :
16991 : 1053657 : (define_insn "*bmi2_rorx<mode>3_1"
16992 : 1053593 : [(set (match_operand:SWI48 0 "register_operand" "=r")
16993 : 1053656 : (rotatert:SWI48
16994 : 1053593 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
16995 : 1053656 : (match_operand:QI 2 "<rorx_immediate_operand>" "<S>")))]
16996 : 3325 : "TARGET_BMI2 && !optimize_function_for_size_p (cfun)"
16997 : 1053594 : "rorx\t{%2, %1, %0|%0, %1, %2}"
16998 : 1053594 : [(set_attr "type" "rotatex")
16999 : 1053594 : (set_attr "mode" "<MODE>")])
17000 : 1053594 :
17001 : 1053657 : (define_insn "*<insn><mode>3_1"
17002 : 1053657 : [(set (match_operand:SWI48 0 "nonimmediate_operand" "=rm,r,r")
17003 : 6405 : (any_rotate:SWI48
17004 : 1059998 : (match_operand:SWI48 1 "nonimmediate_operand" "0,rm,rm")
17005 : : (match_operand:QI 2 "nonmemory_operand" "c<S>,<S>,c<S>")))
17006 : 71340 : (clobber (reg:CC FLAGS_REG))]
17007 : 18061 : "ix86_binary_operator_ok (<CODE>, <MODE>mode, operands, TARGET_APX_NDD)"
17008 : 76560 : {
17009 : 72819 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
17010 : 12812 : switch (get_attr_type (insn))
17011 : 1193 : {
17012 : 1257 : case TYPE_ROTATEX:
17013 : 1244 : return "#";
17014 : 57373 :
17015 : 62465 : default:
17016 : 62529 : if (operands[2] == const1_rtx
17017 : 1859 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
17018 : 54161 : && !use_ndd)
17019 : 47142 : return "<rotate>{<imodesuffix>}\t%0";
17020 : 47147 : else
17021 : 3307 : return use_ndd ? "<rotate>{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
17022 : 48515 : : "<rotate>{<imodesuffix>}\t{%2, %0|%0, %2}";
17023 : 45209 : }
17024 : 45208 : }
17025 : 1 : [(set_attr "isa" "*,bmi2,apx_ndd")
17026 : 492 : (set_attr "type" "rotate,rotatex,rotate")
17027 : 492 : (set (attr "preferred_for_size")
17028 : 3185 : (cond [(eq_attr "alternative" "0")
17029 : 497 : (symbol_ref "true")]
17030 : 0 : (symbol_ref "false")))
17031 : 5 : (set (attr "length_immediate")
17032 : 1 : (if_then_else
17033 : : (and (eq_attr "type" "rotate")
17034 : : (and (match_operand 2 "const1_operand")
17035 : : (ior (match_test "TARGET_SHIFT1")
17036 : : (match_test "optimize_function_for_size_p (cfun)"))))
17037 : : (const_string "0")
17038 : : (const_string "*")))
17039 : 1 : (set_attr "mode" "<MODE>")])
17040 : 1 :
17041 : 1 : ;; Convert rotate to the rotatex pattern to avoid flags dependency.
17042 : : (define_split
17043 : : [(set (match_operand:SWI48 0 "register_operand")
17044 : : (rotate:SWI48 (match_operand:SWI48 1 "nonimmediate_operand")
17045 : : (match_operand:QI 2 "const_int_operand")))
17046 : : (clobber (reg:CC FLAGS_REG))]
17047 : 5352 : "TARGET_BMI2 && reload_completed && !optimize_function_for_size_p (cfun)"
17048 : 64 : [(set (match_dup 0)
17049 : 1 : (rotatert:SWI48 (match_dup 1) (match_dup 2)))]
17050 : 65 : {
17051 : 393 : int bitsize = GET_MODE_BITSIZE (<MODE>mode);
17052 : 330 :
17053 : 65 : operands[2] = GEN_INT ((bitsize - INTVAL (operands[2])) % bitsize);
17054 : 0 : })
17055 : 1 :
17056 : 1 : (define_split
17057 : 65 : [(set (match_operand:SWI48 0 "register_operand")
17058 : 65 : (rotatert:SWI48 (match_operand:SWI48 1 "nonimmediate_operand")
17059 : 65 : (match_operand:QI 2 "const_int_operand")))
17060 : 65 : (clobber (reg:CC FLAGS_REG))]
17061 : 4765 : "TARGET_BMI2 && reload_completed && !optimize_function_for_size_p (cfun)"
17062 : 131 : [(set (match_dup 0)
17063 : 64 : (rotatert:SWI48 (match_dup 1) (match_dup 2)))])
17064 : :
17065 : 564 : (define_insn "*bmi2_rorxsi3_1_zext"
17066 : 564 : [(set (match_operand:DI 0 "register_operand" "=r")
17067 : 64 : (zero_extend:DI
17068 : 64 : (rotatert:SI (match_operand:SI 1 "nonimmediate_operand" "rm")
17069 : 1 : (match_operand:QI 2 "const_0_to_31_operand"))))]
17070 : 84 : "TARGET_64BIT && TARGET_BMI2 && !optimize_function_for_size_p (cfun)"
17071 : 1 : "rorx\t{%2, %1, %k0|%k0, %1, %2}"
17072 : 85 : [(set_attr "type" "rotatex")
17073 : 85 : (set_attr "mode" "SI")])
17074 : 134 :
17075 : 130 : (define_insn "*<insn>si3_1_zext"
17076 : : [(set (match_operand:DI 0 "register_operand" "=r,r,r")
17077 : 131 : (zero_extend:DI
17078 : 130 : (any_rotate:SI (match_operand:SI 1 "nonimmediate_operand" "0,rm,rm")
17079 : 131 : (match_operand:QI 2 "nonmemory_operand" "cI,I,cI"))))
17080 : 131 : (clobber (reg:CC FLAGS_REG))]
17081 : 215 : "TARGET_64BIT && ix86_binary_operator_ok (<CODE>, SImode, operands)"
17082 : 1048 : {
17083 : 180 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
17084 : 203 : switch (get_attr_type (insn))
17085 : 144 : {
17086 : 144 : case TYPE_ROTATEX:
17087 : 142 : return "#";
17088 : 784 :
17089 : 163 : default:
17090 : 968 : if (operands[2] == const1_rtx
17091 : 21 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
17092 : 43 : && !use_ndd)
17093 : 2 : return "<rotate>{l}\t%k0";
17094 : 130 : else
17095 : 138 : return use_ndd ? "<rotate>{l}\t{%2, %1, %k0|%k0, %1, %2}"
17096 : 138 : : "<rotate>{l}\t{%2, %k0|%k0, %2}";
17097 : : }
17098 : : }
17099 : 1 : [(set_attr "isa" "*,bmi2,apx_ndd")
17100 : 1 : (set_attr "type" "rotate,rotatex,rotate")
17101 : 1 : (set (attr "preferred_for_size")
17102 : 521 : (cond [(eq_attr "alternative" "0")
17103 : : (symbol_ref "true")]
17104 : 2 : (symbol_ref "false")))
17105 : 2 : (set (attr "length_immediate")
17106 : 2 : (if_then_else
17107 : 2 : (and (eq_attr "type" "rotate")
17108 : 2 : (and (match_operand 2 "const1_operand")
17109 : 0 : (ior (match_test "TARGET_SHIFT1")
17110 : 2 : (match_test "optimize_function_for_size_p (cfun)"))))
17111 : 2 : (const_string "0")
17112 : 2 : (const_string "*")))
17113 : 2 : (set_attr "mode" "SI")])
17114 : 2 :
17115 : 0 : ;; Convert rotate to the rotatex pattern to avoid flags dependency.
17116 : 0 : (define_split
17117 : 2 : [(set (match_operand:DI 0 "register_operand")
17118 : : (zero_extend:DI
17119 : : (rotate:SI (match_operand:SI 1 "nonimmediate_operand")
17120 : : (match_operand:QI 2 "const_int_operand"))))
17121 : 2 : (clobber (reg:CC FLAGS_REG))]
17122 : 2 : "TARGET_64BIT && TARGET_BMI2 && reload_completed
17123 : 2 : && !optimize_function_for_size_p (cfun)"
17124 : 0 : [(set (match_dup 0)
17125 : 0 : (zero_extend:DI (rotatert:SI (match_dup 1) (match_dup 2))))]
17126 : 0 : {
17127 : 77 : int bitsize = GET_MODE_BITSIZE (SImode);
17128 : 77 :
17129 : 77 : operands[2] = GEN_INT ((bitsize - INTVAL (operands[2])) % bitsize);
17130 : : })
17131 : 0 :
17132 : 0 : (define_split
17133 : 0 : [(set (match_operand:DI 0 "register_operand")
17134 : 0 : (zero_extend:DI
17135 : 0 : (rotatert:SI (match_operand:SI 1 "nonimmediate_operand")
17136 : 0 : (match_operand:QI 2 "const_int_operand"))))
17137 : 0 : (clobber (reg:CC FLAGS_REG))]
17138 : 70 : "TARGET_64BIT && TARGET_BMI2 && reload_completed
17139 : 0 : && !optimize_function_for_size_p (cfun)"
17140 : 77 : [(set (match_dup 0)
17141 : 0 : (zero_extend:DI (rotatert:SI (match_dup 1) (match_dup 2))))])
17142 : :
17143 : 1 : (define_insn "*<insn><mode>3_1"
17144 : 1 : [(set (match_operand:SWI12 0 "nonimmediate_operand" "=<r>m,r")
17145 : 2 : (any_rotate:SWI12 (match_operand:SWI12 1 "nonimmediate_operand" "0,rm")
17146 : 0 : (match_operand:QI 2 "nonmemory_operand" "c<S>,c<S>")))
17147 : : (clobber (reg:CC FLAGS_REG))]
17148 : 5313 : "ix86_binary_operator_ok (<CODE>, <MODE>mode, operands, TARGET_APX_NDD)"
17149 : 2412 : {
17150 : 4744 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
17151 : 6661 : if (operands[2] == const1_rtx
17152 : 5788 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
17153 : 8200 : && !use_ndd)
17154 : 4745 : return "<rotate>{<imodesuffix>}\t%0";
17155 : 0 : else
17156 : 2399 : return use_ndd
17157 : 2399 : ? "<rotate>{<imodesuffix>}\t{%2, %1, %0|%0, %1, %2}"
17158 : 2399 : : "<rotate>{<imodesuffix>}\t{%2, %0|%0, %2}";
17159 : 0 : }
17160 : 0 : [(set_attr "isa" "*,apx_ndd")
17161 : 0 : (set_attr "type" "rotate")
17162 : 0 : (set (attr "length_immediate")
17163 : 1918 : (if_then_else
17164 : 0 : (and (match_operand 2 "const1_operand")
17165 : 0 : (ior (match_test "TARGET_SHIFT1")
17166 : 0 : (match_test "optimize_function_for_size_p (cfun)")))
17167 : 0 : (const_string "0")
17168 : : (const_string "*")))
17169 : : (set_attr "mode" "<MODE>")])
17170 : :
17171 : : ;; Alternative 1 is needed to work around LRA limitation, see PR82524.
17172 : 0 : (define_insn_and_split "*<insn><mode>3_1_slp"
17173 : 0 : [(set (strict_low_part (match_operand:SWI12 0 "register_operand" "+<r>,&<r>"))
17174 : 0 : (any_rotate:SWI12 (match_operand:SWI12 1 "register_operand" "0,!<r>")
17175 : : (match_operand:QI 2 "nonmemory_operand" "cI,cI")))
17176 : : (clobber (reg:CC FLAGS_REG))]
17177 : 2 : "!TARGET_PARTIAL_REG_STALL || optimize_function_for_size_p (cfun)"
17178 : 4 : {
17179 : 5 : if (which_alternative)
17180 : 4 : return "#";
17181 : 0 :
17182 : 4 : if (operands[2] == const1_rtx
17183 : 6 : && (TARGET_SHIFT1 || optimize_function_for_size_p (cfun)))
17184 : 0 : return "<rotate>{<imodesuffix>}\t%0";
17185 : 0 : else
17186 : 8 : return "<rotate>{<imodesuffix>}\t{%2, %0|%0, %2}";
17187 : 4 : }
17188 : 12 : "&& reload_completed
17189 : 8 : && !(rtx_equal_p (operands[0], operands[1]))"
17190 : 12 : [(set (strict_low_part (match_dup 0)) (match_dup 1))
17191 : 3 : (parallel
17192 : 216324 : [(set (strict_low_part (match_dup 0))
17193 : 6 : (any_rotate:SWI12 (match_dup 0) (match_dup 2)))
17194 : 6 : (clobber (reg:CC FLAGS_REG))])]
17195 : : ""
17196 : 216324 : [(set_attr "type" "rotate")
17197 : 216324 : (set (attr "length_immediate")
17198 : 216324 : (if_then_else
17199 : 19456 : (and (match_operand 2 "const1_operand")
17200 : 196868 : (ior (match_test "TARGET_SHIFT1")
17201 : 209075 : (match_test "optimize_function_for_size_p (cfun)")))
17202 : 12207 : (const_string "0")
17203 : 33239146 : (const_string "*")))
17204 : 1638816 : (set_attr "mode" "<MODE>")])
17205 : 1441948 :
17206 : 196868 : (define_split
17207 : 34442959 : [(set (match_operand:HI 0 "QIreg_operand")
17208 : 34443144 : (any_rotate:HI (match_dup 0) (const_int 8)))
17209 : 1400866 : (clobber (reg:CC FLAGS_REG))]
17210 : 961 : "reload_completed
17211 : 33043054 : && (TARGET_USE_XCHGB || optimize_function_for_size_p (cfun))"
17212 : 33 : [(parallel [(set (strict_low_part (match_dup 0))
17213 : 32455026 : (bswap:HI (match_dup 0)))
17214 : 32455033 : (clobber (reg:CC FLAGS_REG))])])
17215 : 32455033 :
17216 : 0 : ;; Rotations through carry flag
17217 : 44640 : (define_insn "rcrsi2"
17218 : 44640 : [(set (match_operand:SI 0 "register_operand" "=r,r")
17219 : 69440 : (plus:SI
17220 : 44633 : (lshiftrt:SI (match_operand:SI 1 "nonimmediate_operand" "0,rm")
17221 : 24807 : (const_int 1))
17222 : 44633 : (ashift:SI (ltu:SI (reg:CCC FLAGS_REG) (const_int 0))
17223 : 33 : (const_int 31))))
17224 : 19911 : (clobber (reg:CC FLAGS_REG))]
17225 : 19931 : ""
17226 : 32 : "@
17227 : 32 : rcr{l}\t%0
17228 : 43834 : rcr{l}\t{%1, %0|%0, %1}"
17229 : 43860 : [(set_attr "isa" "*,apx_ndd")
17230 : 26 : (set_attr "type" "ishift1")
17231 : 47 : (set_attr "memory" "none")
17232 : 47 : (set_attr "length_immediate" "0")
17233 : : (set_attr "mode" "SI")])
17234 : 21 :
17235 : : (define_insn "rcrdi2"
17236 : 0 : [(set (match_operand:DI 0 "register_operand" "=r,r")
17237 : 0 : (plus:DI
17238 : : (lshiftrt:DI (match_operand:DI 1 "nonimmediate_operand" "0,rm")
17239 : 26 : (const_int 1))
17240 : 26 : (ashift:DI (ltu:DI (reg:CCC FLAGS_REG) (const_int 0))
17241 : 26 : (const_int 63))))
17242 : : (clobber (reg:CC FLAGS_REG))]
17243 : 2 : "TARGET_64BIT"
17244 : : "@
17245 : 0 : rcr{q}\t%0
17246 : 0 : rcr{q}\t{%1, %0|%0, %1}"
17247 : 0 : [(set_attr "isa" "*,apx_ndd")
17248 : : (set_attr "type" "ishift1")
17249 : 0 : (set_attr "length_immediate" "0")
17250 : 0 : (set_attr "mode" "DI")])
17251 : 9883 :
17252 : 26136 : ;; Versions of sar and shr that set the carry flag.
17253 : 26136 : (define_insn "<insn><mode>3_carry"
17254 : 0 : [(set (reg:CCC FLAGS_REG)
17255 : 21488 : (unspec:CCC [(and:SWI48 (match_operand:SWI48 1 "nonimmediate_operand" "0,rm")
17256 : 0 : (const_int 1))
17257 : 7277 : (const_int 0)] UNSPEC_CC_NE))
17258 : 75 : (set (match_operand:SWI48 0 "register_operand" "=r,r")
17259 : 7202 : (any_shiftrt:SWI48 (match_dup 1) (const_int 1)))]
17260 : 7202 : ""
17261 : 2 : {
17262 : 395 : bool use_ndd = get_attr_isa (insn) == ISA_APX_NDD;
17263 : 395 : if ((TARGET_SHIFT1 || optimize_function_for_size_p (cfun))
17264 : 2 : && !use_ndd)
17265 : 74 : return "<shift>{<imodesuffix>}\t%0";
17266 : 74 : return use_ndd ? "<shift>{<imodesuffix>}\t{$1, %1, %0|%0, %1, 1}"
17267 : 74 : : "<shift>{<imodesuffix>}\t{$1, %0|%0, 1}";
17268 : 74 : }
17269 : : [(set_attr "isa" "*, apx_ndd")
17270 : 74 : (set_attr "type" "ishift1")
17271 : 78 : (set (attr "length_immediate")
17272 : 2557 : (if_then_else
17273 : 153031 : (ior (match_test "TARGET_SHIFT1")
17274 : 4 : (match_test "optimize_function_for_size_p (cfun)"))
17275 : 78 : (const_string "0")
17276 : 78 : (const_string "*")))
17277 : 78 : (set_attr "mode" "<MODE>")])
17278 : 152 :
17279 : 0 : ;; Bit set / bit test instructions
17280 : 78 :
17281 : 74 : ;; %%% bts, btr, btc
17282 : 74 :
17283 : : ;; These instructions are *slow* when applied to memory.
17284 : 74 :
17285 : 74 : (define_code_attr btsc [(ior "bts") (xor "btc")])
17286 : 74 :
17287 : 74 : (define_insn "*<btsc><mode>"
17288 : 74 : [(set (match_operand:SWI48 0 "register_operand" "=r")
17289 : 148 : (any_or:SWI48
17290 : : (ashift:SWI48 (const_int 1)
17291 : 74 : (match_operand:QI 2 "register_operand" "r"))
17292 : 74 : (match_operand:SWI48 1 "register_operand" "0")))
17293 : 74 : (clobber (reg:CC FLAGS_REG))]
17294 : 205 : "TARGET_USE_BT"
17295 : 0 : "<btsc>{<imodesuffix>}\t{%<k>2, %0|%0, %<k>2}"
17296 : 2 : [(set_attr "type" "alu1")
17297 : 2 : (set_attr "prefix_0f" "1")
17298 : 0 : (set_attr "znver1_decode" "double")
17299 : 81 : (set_attr "mode" "<MODE>")])
17300 : 0 :
17301 : 42 : ;; Avoid useless masking of count operand.
17302 : 42 : (define_insn_and_split "*<btsc><mode>_mask"
17303 : 0 : [(set (match_operand:SWI48 0 "register_operand")
17304 : : (any_or:SWI48
17305 : 0 : (ashift:SWI48
17306 : 0 : (const_int 1)
17307 : 0 : (subreg:QI
17308 : : (and
17309 : : (match_operand 1 "int248_register_operand")
17310 : : (match_operand 2 "const_int_operand")) 0))
17311 : : (match_operand:SWI48 3 "register_operand")))
17312 : : (clobber (reg:CC FLAGS_REG))]
17313 : 10 : "TARGET_USE_BT
17314 : 28 : && (INTVAL (operands[2]) & (GET_MODE_BITSIZE (<MODE>mode)-1))
17315 : 14 : == GET_MODE_BITSIZE (<MODE>mode)-1
17316 : 14 : && ix86_pre_reload_split ()"
17317 : 0 : "#"
17318 : 0 : "&& 1"
17319 : 0 : [(parallel
17320 : 7 : [(set (match_dup 0)
17321 : 4 : (any_or:SWI48
17322 : 0 : (ashift:SWI48 (const_int 1)
17323 : 6 : (match_dup 1))
17324 : : (match_dup 3)))
17325 : : (clobber (reg:CC FLAGS_REG))])]
17326 : 7 : {
17327 : 7 : operands[1] = force_reg (GET_MODE (operands[1]), operands[1]);
17328 : 7 : operands[1] = gen_lowpart (QImode, operands[1]);
17329 : : })
17330 : :
17331 : : (define_insn_and_split "*<btsc><mode>_mask_1"
17332 : 7 : [(set (match_operand:SWI48 0 "register_operand")
17333 : 7 : (any_or:SWI48
17334 : 7 : (ashift:SWI48
17335 : 7 : (const_int 1)
17336 : 7 : (and:QI
17337 : 7 : (match_operand:QI 1 "register_operand")
17338 : 7 : (match_operand:QI 2 "const_int_operand")))
17339 : 7 : (match_operand:SWI48 3 "register_operand")))
17340 : 7 : (clobber (reg:CC FLAGS_REG))]
17341 : 4 : "TARGET_USE_BT
17342 : 8 : && (INTVAL (operands[2]) & (GET_MODE_BITSIZE (<MODE>mode)-1))
17343 : 4 : == GET_MODE_BITSIZE (<MODE>mode)-1
17344 : 4 : && ix86_pre_reload_split ()"
17345 : 0 : "#"
17346 : 0 : "&& 1"
17347 : 0 : [(parallel
17348 : 2 : [(set (match_dup 0)
17349 : 7 : (any_or:SWI48
17350 : 7 : (ashift:SWI48 (const_int 1)
17351 : 7 : (match_dup 1))
17352 : : (match_dup 3)))
17353 : : (clobber (reg:CC FLAGS_REG))])])
17354 : 234 :
17355 : 234 : (define_insn "*btr<mode>"
17356 : : [(set (match_operand:SWI48 0 "register_operand" "=r")
17357 : 132 : (and:SWI48
17358 : 14202 : (rotate:SWI48 (const_int -2)
17359 : 132 : (match_operand:QI 2 "register_operand" "r"))
17360 : 14078 : (match_operand:SWI48 1 "register_operand" "0")))
17361 : 101 : (clobber (reg:CC FLAGS_REG))]
17362 : 179 : "TARGET_USE_BT"
17363 : 1492 : "btr{<imodesuffix>}\t{%<k>2, %0|%0, %<k>2}"
17364 : 1492 : [(set_attr "type" "alu1")
17365 : 4 : (set_attr "prefix_0f" "1")
17366 : 101 : (set_attr "znver1_decode" "double")
17367 : 736 : (set_attr "mode" "<MODE>")])
17368 : 1 :
17369 : 102 : ;; Avoid useless masking of count operand.
17370 : 5 : (define_insn_and_split "*btr<mode>_mask"
17371 : 98 : [(set (match_operand:SWI48 0 "register_operand")
17372 : 1 : (and:SWI48
17373 : 98 : (rotate:SWI48
17374 : 98 : (const_int -2)
17375 : 1 : (subreg:QI
17376 : 97 : (and
17377 : 97 : (match_operand 1 "int248_register_operand")
17378 : 97 : (match_operand 2 "const_int_operand")) 0))
17379 : 97 : (match_operand:SWI48 3 "register_operand")))
17380 : : (clobber (reg:CC FLAGS_REG))]
17381 : 0 : "TARGET_USE_BT
17382 : 0 : && (INTVAL (operands[2]) & (GET_MODE_BITSIZE (<MODE>mode)-1))
17383 : 97 : == GET_MODE_BITSIZE (<MODE>mode)-1
17384 : 195 : && ix86_pre_reload_split ()"
17385 : 1 : "#"
17386 : 1 : "&& 1"
17387 : 0 : [(parallel
17388 : 0 : [(set (match_dup 0)
17389 : 0 : (and:SWI48
17390 : 0 : (rotate:SWI48 (const_int -2)
17391 : 0 : (match_dup 1))
17392 : 1 : (match_dup 3)))
17393 : : (clobber (reg:CC FLAGS_REG))])]
17394 : 1 : {
17395 : 0 : operands[1] = force_reg (GET_MODE (operands[1]), operands[1]);
17396 : 0 : operands[1] = gen_lowpart (QImode, operands[1]);
17397 : 1 : })
17398 : 1 :
17399 : 1 : (define_insn_and_split "*btr<mode>_mask_1"
17400 : 0 : [(set (match_operand:SWI48 0 "register_operand")
17401 : 1 : (and:SWI48
17402 : 1 : (rotate:SWI48
17403 : 1 : (const_int -2)
17404 : 1 : (and:QI
17405 : 1 : (match_operand:QI 1 "register_operand")
17406 : 1 : (match_operand:QI 2 "const_int_operand")))
17407 : 1 : (match_operand:SWI48 3 "register_operand")))
17408 : 0 : (clobber (reg:CC FLAGS_REG))]
17409 : 1 : "TARGET_USE_BT
17410 : 1 : && (INTVAL (operands[2]) & (GET_MODE_BITSIZE (<MODE>mode)-1))
17411 : 0 : == GET_MODE_BITSIZE (<MODE>mode)-1
17412 : 0 : && ix86_pre_reload_split ()"
17413 : 0 : "#"
17414 : 0 : "&& 1"
17415 : 0 : [(parallel
17416 : 0 : [(set (match_dup 0)
17417 : 0 : (and:SWI48
17418 : 0 : (rotate:SWI48 (const_int -2)
17419 : 1 : (match_dup 1))
17420 : 1 : (match_dup 3)))
17421 : 1 : (clobber (reg:CC FLAGS_REG))])])
17422 : :
17423 : : (define_insn_and_split "*btr<mode>_1"
17424 : : [(set (match_operand:SWI12 0 "register_operand")
17425 : 0 : (and:SWI12
17426 : : (subreg:SWI12
17427 : 0 : (rotate:SI (const_int -2)
17428 : 1599747 : (match_operand:QI 2 "register_operand")) 0)
17429 : 0 : (match_operand:SWI12 1 "nonimmediate_operand")))
17430 : 1599747 : (clobber (reg:CC FLAGS_REG))]
17431 : 34 : "TARGET_USE_BT && ix86_pre_reload_split ()"
17432 : 0 : "#"
17433 : 1599761 : "&& 1"
17434 : 14 : [(parallel
17435 : 1599760 : [(set (match_dup 0)
17436 : 2 : (and:SI (rotate:SI (const_int -2) (match_dup 2))
17437 : 7 : (match_dup 1)))
17438 : 22 : (clobber (reg:CC FLAGS_REG))])]
17439 : 1170398 : {
17440 : 1170398 : operands[0] = lowpart_subreg (SImode, operands[0], <MODE>mode);
17441 : 13 : operands[1] = force_reg (<MODE>mode, operands[1]);
17442 : 879923 : operands[1] = lowpart_subreg (SImode, operands[1], <MODE>mode);
17443 : 0 : })
17444 : 1014148 :
17445 : 1014148 : (define_insn_and_split "*btr<mode>_2"
17446 : 1014161 : [(set (zero_extract:HI
17447 : 2362088 : (match_operand:SWI12 0 "nonimmediate_operand")
17448 : 1014161 : (const_int 1)
17449 : 134251 : (match_operand:QI 1 "register_operand"))
17450 : 134251 : (const_int 0))
17451 : 2227850 : (clobber (reg:CC FLAGS_REG))]
17452 : 27 : "TARGET_USE_BT && ix86_pre_reload_split ()"
17453 : 95803 : "#"
17454 : 9103 : "&& MEM_P (operands[0])"
17455 : 1354095 : [(set (match_dup 2) (match_dup 0))
17456 : 1013570 : (parallel
17457 : 121339 : [(set (match_dup 3)
17458 : 2 : (and:SI (rotate:SI (const_int -2) (match_dup 1))
17459 : 8434 : (match_dup 4)))
17460 : 30845 : (clobber (reg:CC FLAGS_REG))])
17461 : 114390 : (set (match_dup 0) (match_dup 5))]
17462 : 772 : {
17463 : 738 : operands[2] = gen_reg_rtx (<MODE>mode);
17464 : 31583 : operands[5] = gen_reg_rtx (<MODE>mode);
17465 : 7 : operands[3] = lowpart_subreg (SImode, operands[5], <MODE>mode);
17466 : 5604 : operands[4] = lowpart_subreg (SImode, operands[2], <MODE>mode);
17467 : 94 : })
17468 : 1027 :
17469 : 943 : (define_split
17470 : 94 : [(set (zero_extract:HI
17471 : 0 : (match_operand:SWI12 0 "register_operand")
17472 : 51 : (const_int 1)
17473 : 17 : (match_operand:QI 1 "register_operand"))
17474 : 33 : (const_int 0))
17475 : 20 : (clobber (reg:CC FLAGS_REG))]
17476 : 20 : "TARGET_USE_BT && ix86_pre_reload_split ()"
17477 : 4 : [(parallel
17478 : 6 : [(set (match_dup 0)
17479 : 0 : (and:SI (rotate:SI (const_int -2) (match_dup 1))
17480 : 7 : (match_dup 2)))
17481 : 8 : (clobber (reg:CC FLAGS_REG))])]
17482 : 8 : {
17483 : 0 : operands[2] = lowpart_subreg (SImode, operands[0], <MODE>mode);
17484 : 2402 : operands[0] = lowpart_subreg (SImode, operands[0], <MODE>mode);
17485 : 2395 : })
17486 : :
17487 : 1060 : ;; These instructions are never faster than the corresponding
17488 : 341 : ;; and/ior/xor operations when using immediate operand, so with
17489 : 0 : ;; 32-bit there's no point. But in 64-bit, we can't hold the
17490 : 0 : ;; relevant immediates within the instruction itself, so operating
17491 : 0 : ;; on bits in the high 32-bits of a register becomes easier.
17492 : 0 : ;;
17493 : 7 : ;; These are slow on Nocona, but fast on Athlon64. We do require the use
17494 : 0 : ;; of btrq and btcq for corner cases of post-reload expansion of absdf and
17495 : 7 : ;; negdf respectively, so they can never be disabled entirely.
17496 : 7 :
17497 : 16 : (define_insn "*btsq_imm"
17498 : 9 : [(set (zero_extract:DI (match_operand:DI 0 "nonimmediate_operand" "+rm")
17499 : 9 : (const_int 1)
17500 : 9 : (match_operand:QI 1 "const_0_to_63_operand"))
17501 : 9 : (const_int 1))
17502 : 0 : (clobber (reg:CC FLAGS_REG))]
17503 : 10 : "TARGET_64BIT && (TARGET_USE_BT || reload_completed)"
17504 : 916 : "bts{q}\t{%1, %0|%0, %1}"
17505 : 0 : [(set_attr "type" "alu1")
17506 : 0 : (set_attr "prefix_0f" "1")
17507 : 1 : (set_attr "znver1_decode" "double")
17508 : 1 : (set_attr "mode" "DI")])
17509 : 0 :
17510 : 0 : (define_insn "*btrq_imm"
17511 : 0 : [(set (zero_extract:DI (match_operand:DI 0 "nonimmediate_operand" "+rm")
17512 : 7692957 : (const_int 1)
17513 : 7692956 : (match_operand:QI 1 "const_0_to_63_operand"))
17514 : 1 : (const_int 0))
17515 : 7685542 : (clobber (reg:CC FLAGS_REG))]
17516 : 637 : "TARGET_64BIT && (TARGET_USE_BT || reload_completed)"
17517 : 7685542 : "btr{q}\t{%1, %0|%0, %1}"
17518 : 0 : [(set_attr "type" "alu1")
17519 : 0 : (set_attr "prefix_0f" "1")
17520 : 0 : (set_attr "znver1_decode" "double")
17521 : 68791 : (set_attr "mode" "DI")])
17522 : 68791 :
17523 : 68791 : (define_insn "*btcq_imm"
17524 : 71428 : [(set (zero_extract:DI (match_operand:DI 0 "nonimmediate_operand" "+rm")
17525 : 263139 : (const_int 1)
17526 : 71113 : (match_operand:QI 1 "const_0_to_63_operand"))
17527 : 2447 : (not:DI (zero_extract:DI (match_dup 0) (const_int 1) (match_dup 1))))
17528 : 4966 : (clobber (reg:CC FLAGS_REG))]
17529 : 4976 : "TARGET_64BIT && (TARGET_USE_BT || reload_completed)"
17530 : 11046 : "btc{q}\t{%1, %0|%0, %1}"
17531 : 191225 : [(set_attr "type" "alu1")
17532 : 0 : (set_attr "prefix_0f" "1")
17533 : 1382 : (set_attr "znver1_decode" "double")
17534 : 196245 : (set_attr "mode" "DI")])
17535 : 191450 :
17536 : 6030 : ;; Allow Nocona to avoid these instructions if a register is available.
17537 : 6030 :
17538 : 159 : (define_peephole2
17539 : 22737 : [(match_scratch:DI 2 "r")
17540 : 958 : (parallel [(set (zero_extract:DI
17541 : 775 : (match_operand:DI 0 "nonimmediate_operand")
17542 : 159 : (const_int 1)
17543 : 1847 : (match_operand:QI 1 "const_0_to_63_operand"))
17544 : 1664 : (const_int 1))
17545 : 1410 : (clobber (reg:CC FLAGS_REG))])]
17546 : 2543 : "TARGET_64BIT && !TARGET_USE_BT"
17547 : 224 : [(parallel [(set (match_dup 0)
17548 : 178 : (ior:DI (match_dup 0) (match_dup 3)))
17549 : 183 : (clobber (reg:CC FLAGS_REG))])]
17550 : 126 : {
17551 : 31 : int i = INTVAL (operands[1]);
17552 : :
17553 : 16 : operands[3] = gen_int_mode (HOST_WIDE_INT_1U << i, DImode);
17554 : 32 :
17555 : 310 : if (!x86_64_immediate_operand (operands[3], DImode))
17556 : 310 : {
17557 : 0 : emit_move_insn (operands[2], operands[3]);
17558 : 1419001 : operands[3] = operands[2];
17559 : 1419001 : }
17560 : : })
17561 : 995912 :
17562 : 995912 : (define_peephole2
17563 : 995912 : [(match_scratch:DI 2 "r")
17564 : 995912 : (parallel [(set (zero_extract:DI
17565 : 2804 : (match_operand:DI 0 "nonimmediate_operand")
17566 : 814 : (const_int 1)
17567 : 814 : (match_operand:QI 1 "const_0_to_63_operand"))
17568 : 2804 : (const_int 0))
17569 : 814 : (clobber (reg:CC FLAGS_REG))])]
17570 : 3503 : "TARGET_64BIT && !TARGET_USE_BT"
17571 : 0 : [(parallel [(set (match_dup 0)
17572 : 67 : (and:DI (match_dup 0) (match_dup 3)))
17573 : 864 : (clobber (reg:CC FLAGS_REG))])]
17574 : 855 : {
17575 : 1759 : int i = INTVAL (operands[1]);
17576 : 801 :
17577 : 103 : operands[3] = gen_int_mode (~(HOST_WIDE_INT_1U << i), DImode);
17578 : 103 :
17579 : 0 : if (!x86_64_immediate_operand (operands[3], DImode))
17580 : 813 : {
17581 : 813 : emit_move_insn (operands[2], operands[3]);
17582 : 763 : operands[3] = operands[2];
17583 : 763 : }
17584 : 1125 : })
17585 : 1420454 :
17586 : 1420454 : (define_peephole2
17587 : 1420454 : [(match_scratch:DI 2 "r")
17588 : 1420454 : (parallel [(set (zero_extract:DI
17589 : 1420454 : (match_operand:DI 0 "nonimmediate_operand")
17590 : 0 : (const_int 1)
17591 : 1420454 : (match_operand:QI 1 "const_0_to_63_operand"))
17592 : 1420454 : (not:DI (zero_extract:DI
17593 : 1420454 : (match_dup 0) (const_int 1) (match_dup 1))))
17594 : 0 : (clobber (reg:CC FLAGS_REG))])]
17595 : 3758 : "TARGET_64BIT && !TARGET_USE_BT"
17596 : 1390985 : [(parallel [(set (match_dup 0)
17597 : 1390985 : (xor:DI (match_dup 0) (match_dup 3)))
17598 : 0 : (clobber (reg:CC FLAGS_REG))])]
17599 : 0 : {
17600 : 0 : int i = INTVAL (operands[1]);
17601 : 1947 :
17602 : 1947 : operands[3] = gen_int_mode (HOST_WIDE_INT_1U << i, DImode);
17603 : 1947 :
17604 : 1947 : if (!x86_64_immediate_operand (operands[3], DImode))
17605 : 3894 : {
17606 : 0 : emit_move_insn (operands[2], operands[3]);
17607 : 93 : operands[3] = operands[2];
17608 : 93 : }
17609 : 93 : })
17610 : 0 :
17611 : : ;; %%% bt
17612 : 0 :
17613 : 0 : (define_insn "*bt<mode>"
17614 : 0 : [(set (reg:CCC FLAGS_REG)
17615 : 0 : (compare:CCC
17616 : 5844350 : (zero_extract:SWI48
17617 : 0 : (match_operand:SWI48 0 "nonimmediate_operand" "r,m")
17618 : 5469436 : (const_int 1)
17619 : 5469436 : (match_operand:QI 1 "nonmemory_operand" "q<S>,<S>"))
17620 : 0 : (const_int 0)))]
17621 : 0 : ""
17622 : 5846863 : {
17623 : 5846863 : switch (get_attr_mode (insn))
17624 : : {
17625 : 5588172 : case MODE_SI:
17626 : 5588172 : return "bt{l}\t{%k1, %k0|%k0, %k1}";
17627 : 5546044 :
17628 : 11086885 : case MODE_DI:
17629 : 3608 : return "bt{q}\t{%q1, %0|%0, %q1}";
17630 : 5495105 :
17631 : 0 : default:
17632 : 3942946 : gcc_unreachable ();
17633 : 3942946 : }
17634 : 3942946 : }
17635 : 3942946 : [(set_attr "type" "alu1")
17636 : 3942946 : (set_attr "prefix_0f" "1")
17637 : 3942946 : (set (attr "mode")
17638 : 3946564 : (if_then_else
17639 : 3959146 : (and (match_test "CONST_INT_P (operands[1])")
17640 : 3966668 : (match_test "INTVAL (operands[1]) < 32"))
17641 : 3942946 : (const_string "SI")
17642 : 3942946 : (const_string "<MODE>")))])
17643 : 3942946 :
17644 : 3942946 : (define_insn_and_split "*bt<SWI48:mode>_mask"
17645 : 3942946 : [(set (reg:CCC FLAGS_REG)
17646 : 3942946 : (compare:CCC
17647 : 3942946 : (zero_extract:SWI48
17648 : 3942946 : (match_operand:SWI48 0 "nonimmediate_operand" "r,m")
17649 : 3942946 : (const_int 1)
17650 : 3942946 : (subreg:QI
17651 : 3942946 : (and:SWI248
17652 : 3942946 : (match_operand:SWI248 1 "register_operand")
17653 : 3942946 : (match_operand 2 "const_int_operand")) 0))
17654 : 3942946 : (const_int 0)))]
17655 : 0 : "TARGET_USE_BT
17656 : 3942946 : && (INTVAL (operands[2]) & (GET_MODE_BITSIZE (<SWI48:MODE>mode)-1))
17657 : 0 : == GET_MODE_BITSIZE (<SWI48:MODE>mode)-1
17658 : 0 : && ix86_pre_reload_split ()"
17659 : 0 : "#"
17660 : 3279524 : "&& 1"
17661 : 257250 : [(set (reg:CCC FLAGS_REG)
17662 : 257250 : (compare:CCC
17663 : 3536774 : (zero_extract:SWI48 (match_dup 0) (const_int 1) (match_dup 1))
17664 : 0 : (const_int 0)))]
17665 : 3058382 : "operands[1] = gen_lowpart (QImode, operands[1]);")
17666 : 3058382 :
17667 : 257250 : (define_insn_and_split "*jcc_bt<mode>"
17668 : 0 : [(set (pc)
17669 : 3322304 : (if_then_else (match_operator 0 "bt_comparison_operator"
17670 : 3279524 : [(zero_extract:SWI48
17671 : 0 : (match_operand:SWI48 1 "nonimmediate_operand")
17672 : 1171029 : (const_int 1)
17673 : : (match_operand:QI 2 "nonmemory_operand"))
17674 : 8895115 : (const_int 0)])
17675 : 909843 : (label_ref (match_operand 3))
17676 : 7985272 : (pc)))
17677 : 7985272 : (clobber (reg:CC FLAGS_REG))]
17678 : 31391 : "(TARGET_USE_BT || optimize_function_for_size_p (cfun))
17679 : 34691 : && (CONST_INT_P (operands[2])
17680 : 117960 : ? (INTVAL (operands[2]) < GET_MODE_BITSIZE (<MODE>mode)
17681 : 53888 : && INTVAL (operands[2])
17682 : 53888 : >= (optimize_function_for_size_p (cfun) ? 8 : 32))
17683 : 7995456 : : !memory_operand (operands[1], <MODE>mode))
17684 : 15608 : && ix86_pre_reload_split ()"
17685 : 41054 : "#"
17686 : 41054 : "&& 1"
17687 : 7677 : [(set (reg:CCC FLAGS_REG)
17688 : 3014 : (compare:CCC
17689 : 827 : (zero_extract:SWI48
17690 : 5490 : (match_dup 1)
17691 : 5490 : (const_int 1)
17692 : 33398 : (match_dup 2))
17693 : 31543 : (const_int 0)))
17694 : 0 : (set (pc)
17695 : 2508 : (if_then_else (match_op_dup 0 [(reg:CCC FLAGS_REG) (const_int 0)])
17696 : 0 : (label_ref (match_dup 3))
17697 : 2187 : (pc)))]
17698 : 5490 : {
17699 : 5490 : operands[0] = shallow_copy_rtx (operands[0]);
17700 : 5490 : PUT_CODE (operands[0], reverse_condition (GET_CODE (operands[0])));
17701 : : })
17702 : :
17703 : : ;; Avoid useless masking of bit offset operand.
17704 : 5490 : (define_insn_and_split "*jcc_bt<mode>_mask"
17705 : 5490 : [(set (pc)
17706 : 5490 : (if_then_else (match_operator 0 "bt_comparison_operator"
17707 : 5490 : [(zero_extract:SWI48
17708 : 5490 : (match_operand:SWI48 1 "register_operand")
17709 : 5490 : (const_int 1)
17710 : 5490 : (and:QI
17711 : 5490 : (match_operand:QI 2 "register_operand")
17712 : 5490 : (match_operand 3 "const_int_operand")))
17713 : : (const_int 0)])
17714 : : (label_ref (match_operand 4))
17715 : : (pc)))
17716 : : (clobber (reg:CC FLAGS_REG))]
17717 : 6 : "(TARGET_USE_BT || optimize_function_for_size_p (cfun))
17718 : 76 : && (INTVAL (operands[3]) & (GET_MODE_BITSIZE (<MODE>mode)-1))
17719 : 38 : == GET_MODE_BITSIZE (<MODE>mode)-1
17720 : 5502 : && ix86_pre_reload_split ()"
17721 : 6 : "#"
17722 : 6 : "&& 1"
17723 : 6 : [(set (reg:CCC FLAGS_REG)
17724 : 6 : (compare:CCC
17725 : 12 : (zero_extract:SWI48
17726 : 24 : (match_dup 1)
17727 : 24 : (const_int 1)
17728 : : (match_dup 2))
17729 : 5490 : (const_int 0)))
17730 : 1302858 : (set (pc)
17731 : 1302858 : (if_then_else (match_op_dup 0 [(reg:CCC FLAGS_REG) (const_int 0)])
17732 : : (label_ref (match_dup 4))
17733 : 1719901 : (pc)))]
17734 : 1719907 : {
17735 : 6 : operands[0] = shallow_copy_rtx (operands[0]);
17736 : 1599753 : PUT_CODE (operands[0], reverse_condition (GET_CODE (operands[0])));
17737 : 1603056 : })
17738 : :
17739 : 412471 : ;; Avoid useless masking of bit offset operand.
17740 : 412477 : (define_insn_and_split "*jcc_bt<SWI48:mode>_mask_1"
17741 : 3315 : [(set (pc)
17742 : 16030 : (if_then_else (match_operator 0 "bt_comparison_operator"
17743 : 16030 : [(zero_extract:SWI48
17744 : 16018 : (match_operand:SWI48 1 "register_operand")
17745 : 6 : (const_int 1)
17746 : 4840 : (subreg:QI
17747 : 1543 : (and:SWI248
17748 : 6 : (match_operand:SWI248 2 "register_operand")
17749 : 1039 : (match_operand 3 "const_int_operand")) 0))
17750 : 1039 : (const_int 0)])
17751 : 1033 : (label_ref (match_operand 4))
17752 : 1033 : (pc)))
17753 : 1033 : (clobber (reg:CC FLAGS_REG))]
17754 : 62 : "(TARGET_USE_BT || optimize_function_for_size_p (cfun))
17755 : 1863 : && (INTVAL (operands[3]) & (GET_MODE_BITSIZE (<SWI48:MODE>mode)-1))
17756 : 415 : == GET_MODE_BITSIZE (<SWI48:MODE>mode)-1
17757 : 373 : && ix86_pre_reload_split ()"
17758 : 136 : "#"
17759 : 185 : "&& 1"
17760 : 107 : [(set (reg:CCC FLAGS_REG)
17761 : 173 : (compare:CCC
17762 : 48 : (zero_extract:SWI48
17763 : 243 : (match_dup 1)
17764 : 346 : (const_int 1)
17765 : : (match_dup 2))
17766 : : (const_int 0)))
17767 : 12 : (set (pc)
17768 : 18 : (if_then_else (match_op_dup 0 [(reg:CCC FLAGS_REG) (const_int 0)])
17769 : 6 : (label_ref (match_dup 4))
17770 : : (pc)))]
17771 : 173 : {
17772 : 173 : operands[0] = shallow_copy_rtx (operands[0]);
17773 : 173 : PUT_CODE (operands[0], reverse_condition (GET_CODE (operands[0])));
17774 : 173 : operands[2] = gen_lowpart (QImode, operands[2]);
17775 : 0 : })
17776 : :
17777 : 0 : ;; Help combine recognize bt followed by cmov
17778 : 173 : (define_split
17779 : 173 : [(set (match_operand:SWI248 0 "register_operand")
17780 : 173 : (if_then_else:SWI248
17781 : 173 : (match_operator 5 "bt_comparison_operator"
17782 : 173 : [(zero_extract:SWI48
17783 : 0 : (match_operand:SWI48 1 "register_operand")
17784 : 0 : (const_int 1)
17785 : 0 : (match_operand:QI 2 "register_operand"))
17786 : 173 : (const_int 0)])
17787 : 173 : (match_operand:SWI248 3 "nonimmediate_operand")
17788 : 173 : (match_operand:SWI248 4 "nonimmediate_operand")))]
17789 : 46 : "TARGET_USE_BT && TARGET_CMOVE
17790 : 46 : && !(MEM_P (operands[3]) && MEM_P (operands[4]))
17791 : 46 : && ix86_pre_reload_split ()"
17792 : 0 : [(set (reg:CCC FLAGS_REG)
17793 : 39 : (compare:CCC
17794 : : (zero_extract:SWI48 (match_dup 1) (const_int 1) (match_dup 2))
17795 : 3 : (const_int 0)))
17796 : 179 : (set (match_dup 0)
17797 : : (if_then_else:SWI248 (eq (reg:CCC FLAGS_REG) (const_int 0))
17798 : : (match_dup 3)
17799 : : (match_dup 4)))]
17800 : 46 : {
17801 : 46 : if (GET_CODE (operands[5]) == EQ)
17802 : 42 : std::swap (operands[3], operands[4]);
17803 : : })
17804 : :
17805 : 173 : ;; Help combine recognize bt followed by setc
17806 : 173 : (define_insn_and_split "*bt<mode>_setcqi"
17807 : 219 : [(set (subreg:SWI48 (match_operand:QI 0 "register_operand") 0)
17808 : 46 : (zero_extract:SWI48
17809 : 46 : (match_operand:SWI48 1 "register_operand")
17810 : 46 : (const_int 1)
17811 : 46 : (match_operand:QI 2 "register_operand")))
17812 : 46 : (clobber (reg:CC FLAGS_REG))]
17813 : 3129 : "TARGET_USE_BT && ix86_pre_reload_split ()"
17814 : 46 : "#"
17815 : 234 : "&& 1"
17816 : 337 : [(set (reg:CCC FLAGS_REG)
17817 : 1894 : (compare:CCC
17818 : 1894 : (zero_extract:SWI48 (match_dup 1) (const_int 1) (match_dup 2))
17819 : 325 : (const_int 0)))
17820 : 325 : (set (match_dup 0)
17821 : 1705 : (eq:QI (reg:CCC FLAGS_REG) (const_int 0)))])
17822 : 1531 :
17823 : 1730 : ;; Help combine recognize bt followed by setnc
17824 : 7687 : (define_insn_and_split "*bt<mode>_setncqi"
17825 : : [(set (match_operand:QI 0 "register_operand")
17826 : 1290 : (and:QI
17827 : : (not:QI
17828 : 60 : (subreg:QI
17829 : 35 : (lshiftrt:SWI48 (match_operand:SWI48 1 "register_operand")
17830 : : (match_operand:QI 2 "register_operand")) 0))
17831 : : (const_int 1)))
17832 : 46 : (clobber (reg:CC FLAGS_REG))]
17833 : 88 : "TARGET_USE_BT && ix86_pre_reload_split ()"
17834 : 58 : "#"
17835 : 4 : "&& 1"
17836 : 4 : [(set (reg:CCC FLAGS_REG)
17837 : 11 : (compare:CCC
17838 : 24 : (zero_extract:SWI48 (match_dup 1) (const_int 1) (match_dup 2))
17839 : 18 : (const_int 0)))
17840 : 203 : (set (match_dup 0)
17841 : : (ne:QI (reg:CCC FLAGS_REG) (const_int 0)))])
17842 : 171 :
17843 : 230 : (define_insn_and_split "*bt<mode>_setnc<mode>"
17844 : 230 : [(set (match_operand:SWI48 0 "register_operand")
17845 : 230 : (and:SWI48
17846 : 171 : (not:SWI48
17847 : 66 : (lshiftrt:SWI48 (match_operand:SWI48 1 "register_operand")
17848 : 171 : (match_operand:QI 2 "register_operand")))
17849 : 139 : (const_int 1)))
17850 : 184 : (clobber (reg:CC FLAGS_REG))]
17851 : 170 : "TARGET_USE_BT && ix86_pre_reload_split ()"
17852 : 138 : "#"
17853 : 128 : "&& 1"
17854 : 128 : [(set (reg:CCC FLAGS_REG)
17855 : 143 : (compare:CCC
17856 : 12 : (zero_extract:SWI48 (match_dup 1) (const_int 1) (match_dup 2))
17857 : 2 : (const_int 0)))
17858 : 12 : (set (match_dup 3)
17859 : : (ne:QI (reg:CCC FLAGS_REG) (const_int 0)))
17860 : : (set (match_dup 0) (zero_extend:SWI48 (match_dup 3)))]
17861 : 17 : "operands[3] = gen_reg_rtx (QImode);")
17862 : :
17863 : 126 : ;; Help combine recognize bt followed by setnc (PR target/110588)
17864 : 17 : (define_insn_and_split "*bt<mode>_setncqi_2"
17865 : 350 : [(set (match_operand:QI 0 "register_operand")
17866 : 350 : (eq:QI
17867 : 17 : (zero_extract:SWI48
17868 : 143 : (match_operand:SWI48 1 "register_operand")
17869 : 143 : (const_int 1)
17870 : 143 : (match_operand:QI 2 "register_operand"))
17871 : 17 : (const_int 0)))
17872 : 17 : (clobber (reg:CC FLAGS_REG))]
17873 : 387 : "TARGET_USE_BT && ix86_pre_reload_split ()"
17874 : 34 : "#"
17875 : 2 : "&& 1"
17876 : 252 : [(set (reg:CCC FLAGS_REG)
17877 : 215 : (compare:CCC
17878 : 581 : (zero_extract:SWI48 (match_dup 1) (const_int 1) (match_dup 2))
17879 : 256 : (const_int 0)))
17880 : 193 : (set (match_dup 0)
17881 : 151 : (ne:QI (reg:CCC FLAGS_REG) (const_int 0)))])
17882 : 151 :
17883 : 0 : ;; Help combine recognize bt followed by setc
17884 : 151 : (define_insn_and_split "*bt<mode>_setc<mode>_mask"
17885 : 17 : [(set (match_operand:SWI48 0 "register_operand")
17886 : 151 : (zero_extract:SWI48
17887 : 151 : (match_operand:SWI48 1 "register_operand")
17888 : 164486 : (const_int 1)
17889 : 164486 : (subreg:QI
17890 : 168 : (and:SWI48
17891 : 151 : (match_operand:SWI48 2 "register_operand")
17892 : 0 : (match_operand 3 "const_int_operand")) 0)))
17893 : : (clobber (reg:CC FLAGS_REG))]
17894 : 96 : "TARGET_USE_BT
17895 : 544 : && (INTVAL (operands[3]) & (GET_MODE_BITSIZE (<MODE>mode)-1))
17896 : 304 : == GET_MODE_BITSIZE (<MODE>mode)-1
17897 : 321 : && ix86_pre_reload_split ()"
17898 : 318 : "#"
17899 : 186 : "&& 1"
17900 : 64 : [(set (reg:CCC FLAGS_REG)
17901 : 86 : (compare:CCC
17902 : 61 : (zero_extract:SWI48 (match_dup 1) (const_int 1) (match_dup 2))
17903 : 145 : (const_int 0)))
17904 : 358 : (set (match_dup 3)
17905 : 183 : (eq:QI (reg:CCC FLAGS_REG) (const_int 0)))
17906 : 179 : (set (match_dup 0) (zero_extend:SWI48 (match_dup 3)))]
17907 : 82 : {
17908 : 82 : operands[2] = gen_lowpart (QImode, operands[2]);
17909 : 82 : operands[3] = gen_reg_rtx (QImode);
17910 : 28 : })
17911 : 28 :
17912 : 8 : ;; Store-flag instructions.
17913 : 16196342 :
17914 : 62 : (define_split
17915 : 16196350 : [(set (match_operand:QI 0 "nonimmediate_operand")
17916 : 16196350 : (match_operator:QI 1 "add_comparison_operator"
17917 : 16196350 : [(not:SWI (match_operand:SWI 2 "register_operand"))
17918 : 16196296 : (match_operand:SWI 3 "nonimmediate_operand")]))]
17919 : 16196316 : ""
17920 : 8 : [(set (reg:CCC FLAGS_REG)
17921 : 16195586 : (compare:CCC
17922 : 16195540 : (plus:SWI (match_dup 2) (match_dup 3))
17923 : 8 : (match_dup 2)))
17924 : 8941775 : (set (match_dup 0)
17925 : 8941775 : (match_op_dup 1 [(reg:CCC FLAGS_REG) (const_int 0)]))])
17926 : 8941775 :
17927 : 8 : (define_split
17928 : 8941739 : [(set (match_operand:QI 0 "nonimmediate_operand")
17929 : 8941628 : (match_operator:QI 1 "shr_comparison_operator"
17930 : 8939466 : [(match_operand:DI 2 "register_operand")
17931 : 17775749 : (match_operand 3 "const_int_operand")]))]
17932 : 562 : "TARGET_64BIT
17933 : 491 : && IN_RANGE (exact_log2 (UINTVAL (operands[3]) + 1), 32, 63)"
17934 : 178 : [(set (reg:CCZ FLAGS_REG)
17935 : 8 : (compare:CCZ
17936 : 71 : (lshiftrt:DI (match_dup 2) (match_dup 4))
17937 : 54 : (const_int 0)))
17938 : 125 : (set (match_dup 0)
17939 : 0 : (match_op_dup 1 [(reg:CCZ FLAGS_REG) (const_int 0)]))]
17940 : 227309 : {
17941 : 227238 : enum rtx_code new_code;
17942 : 79 :
17943 : 124 : operands[1] = shallow_copy_rtx (operands[1]);
17944 : 124 : switch (GET_CODE (operands[1]))
17945 : 90 : {
17946 : 71 : case GTU: new_code = NE; break;
17947 : 157 : case LEU: new_code = EQ; break;
17948 : 0 : default: gcc_unreachable ();
17949 : 19 : }
17950 : 146 : PUT_CODE (operands[1], new_code);
17951 : 22 :
17952 : 267 : operands[4] = GEN_INT (exact_log2 (UINTVAL (operands[3]) + 1));
17953 : 0 : })
17954 : 299034 :
17955 : 299083 : ;; For all sCOND expanders, also expand the compare or test insn that
17956 : 3 : ;; generates cc0. Generate an equality comparison if `seq' or `sne'.
17957 : 127 :
17958 : 127 : (define_insn_and_split "*setcc_di_1"
17959 : 127 : [(set (match_operand:DI 0 "register_operand" "=q")
17960 : 71 : (match_operator:DI 1 "ix86_comparison_operator"
17961 : 71 : [(reg FLAGS_REG) (const_int 0)]))]
17962 : 62783 : "TARGET_64BIT && !TARGET_PARTIAL_REG_STALL"
17963 : 15267 : "#"
17964 : 24968 : "&& reload_completed"
17965 : 12546 : [(set (match_dup 2) (match_dup 1))
17966 : 12546 : (set (match_dup 0) (zero_extend:DI (match_dup 2)))]
17967 : 80673 : {
17968 : 80673 : operands[1] = shallow_copy_rtx (operands[1]);
17969 : 20787 : PUT_MODE (operands[1], QImode);
17970 : 14330 : operands[2] = gen_lowpart (QImode, operands[0]);
17971 : 63705 : })
17972 : 1053503 :
17973 : 1053592 : (define_insn_and_split "*setcc_<mode>_1_and"
17974 : 1065925 : [(set (match_operand:SWI24 0 "register_operand" "=q")
17975 : 35 : (match_operator:SWI24 1 "ix86_comparison_operator"
17976 : 874917 : [(reg FLAGS_REG) (const_int 0)]))
17977 : 874952 : (clobber (reg:CC FLAGS_REG))]
17978 : 59105 : "!TARGET_PARTIAL_REG_STALL
17979 : 64556 : && TARGET_ZERO_EXTEND_WITH_AND && optimize_function_for_speed_p (cfun)"
17980 : 887336 : "#"
17981 : 874914 : "&& reload_completed"
17982 : 12422 : [(set (match_dup 2) (match_dup 1))
17983 : 0 : (parallel [(set (match_dup 0) (zero_extend:SWI24 (match_dup 2)))
17984 : 26319 : (clobber (reg:CC FLAGS_REG))])]
17985 : 37266 : {
17986 : 86954 : operands[1] = shallow_copy_rtx (operands[1]);
17987 : 0 : PUT_MODE (operands[1], QImode);
17988 : 2161372 : operands[2] = gen_lowpart (QImode, operands[0]);
17989 : 2173807 : })
17990 : 3759879 :
17991 : 13 : (define_insn_and_split "*setcc_<mode>_1_movzbl"
17992 : 1332558 : [(set (match_operand:SWI24 0 "register_operand" "=q")
17993 : 1320149 : (match_operator:SWI24 1 "ix86_comparison_operator"
17994 : 4972588 : [(reg FLAGS_REG) (const_int 0)]))]
17995 : 5027983 : "!TARGET_PARTIAL_REG_STALL
17996 : 5096695 : && (!TARGET_ZERO_EXTEND_WITH_AND || optimize_function_for_size_p (cfun))"
17997 : 0 : "#"
17998 : 1314671 : "&& reload_completed"
17999 : 35420 : [(set (match_dup 2) (match_dup 1))
18000 : 58492 : (set (match_dup 0) (zero_extend:SWI24 (match_dup 2)))]
18001 : 2365512 : {
18002 : 2400812 : operands[1] = shallow_copy_rtx (operands[1]);
18003 : 112281 : PUT_MODE (operands[1], QImode);
18004 : 104012 : operands[2] = gen_lowpart (QImode, operands[0]);
18005 : 206236 : })
18006 : 2940019 :
18007 : 525047 : (define_insn "*setcc_qi"
18008 : 0 : [(set (match_operand:QI 0 "nonimmediate_operand" "=qm")
18009 : 101966 : (match_operator:QI 1 "ix86_comparison_operator"
18010 : 2482678 : [(reg FLAGS_REG) (const_int 0)]))]
18011 : 2488956 : ""
18012 : 41578 : "set%C1\t%0"
18013 : 32406 : [(set_attr "type" "setcc")
18014 : 67706 : (set_attr "mode" "QI")])
18015 : 411 :
18016 : 2450571 : (define_insn "*setcc_qi_slp"
18017 : 20859 : [(set (strict_low_part (match_operand:QI 0 "register_operand" "+q"))
18018 : 2435823 : (match_operator:QI 1 "ix86_comparison_operator"
18019 : 2470169 : [(reg FLAGS_REG) (const_int 0)]))]
18020 : 2471123 : ""
18021 : 19905 : "set%C1\t%0"
18022 : 2415918 : [(set_attr "type" "setcc")
18023 : 2423732 : (set_attr "mode" "QI")])
18024 : 2414965 :
18025 : 2414965 : ;; In general it is not safe to assume too much about CCmode registers,
18026 : 8768 : ;; so simplify-rtx stops when it sees a second one. Under certain
18027 : 43114 : ;; conditions this is safe on x86, so help combine not create
18028 : 2855247 : ;;
18029 : 2856095 : ;; seta %al
18030 : 2856096 : ;; testb %al, %al
18031 : 35196 : ;; sete %al
18032 : 2855246 :
18033 : 35191 : (define_split
18034 : 183347 : [(set (match_operand:QI 0 "nonimmediate_operand")
18035 : 217693 : (ne:QI (match_operator 1 "ix86_comparison_operator"
18036 : 1 : [(reg FLAGS_REG) (const_int 0)])
18037 : 83 : (const_int 0)))]
18038 : 83 : ""
18039 : 1 : [(set (match_dup 0) (match_dup 1))]
18040 : 386 : {
18041 : 386 : operands[1] = shallow_copy_rtx (operands[1]);
18042 : 0 : PUT_MODE (operands[1], QImode);
18043 : : })
18044 : :
18045 : : (define_split
18046 : 1 : [(set (strict_low_part (match_operand:QI 0 "register_operand"))
18047 : 0 : (ne:QI (match_operator 1 "ix86_comparison_operator"
18048 : 0 : [(reg FLAGS_REG) (const_int 0)])
18049 : 0 : (const_int 0)))]
18050 : 0 : ""
18051 : 1 : [(set (match_dup 0) (match_dup 1))]
18052 : 1 : {
18053 : 0 : operands[1] = shallow_copy_rtx (operands[1]);
18054 : 0 : PUT_MODE (operands[1], QImode);
18055 : : })
18056 : :
18057 : : (define_split
18058 : 0 : [(set (match_operand:QI 0 "nonimmediate_operand")
18059 : 0 : (eq:QI (match_operator 1 "ix86_comparison_operator"
18060 : 0 : [(reg FLAGS_REG) (const_int 0)])
18061 : 0 : (const_int 0)))]
18062 : 0 : ""
18063 : 0 : [(set (match_dup 0) (match_dup 1))]
18064 : 0 : {
18065 : 0 : operands[1] = shallow_copy_rtx (operands[1]);
18066 : 0 : PUT_MODE (operands[1], QImode);
18067 : 0 : PUT_CODE (operands[1],
18068 : 0 : ix86_reverse_condition (GET_CODE (operands[1]),
18069 : 0 : GET_MODE (XEXP (operands[1], 0))));
18070 : 0 :
18071 : 0 : /* Make sure that (a) the CCmode we have for the flags is strong
18072 : 0 : enough for the reversed compare or (b) we have a valid FP compare. */
18073 : 0 : if (! ix86_comparison_operator (operands[1], VOIDmode))
18074 : 0 : FAIL;
18075 : 0 : })
18076 : 0 :
18077 : 0 : (define_split
18078 : 0 : [(set (strict_low_part (match_operand:QI 0 "register_operand"))
18079 : 0 : (eq:QI (match_operator 1 "ix86_comparison_operator"
18080 : 0 : [(reg FLAGS_REG) (const_int 0)])
18081 : 0 : (const_int 0)))]
18082 : 0 : ""
18083 : : [(set (match_dup 0) (match_dup 1))]
18084 : 0 : {
18085 : 0 : operands[1] = shallow_copy_rtx (operands[1]);
18086 : 0 : PUT_MODE (operands[1], QImode);
18087 : 0 : PUT_CODE (operands[1],
18088 : : ix86_reverse_condition (GET_CODE (operands[1]),
18089 : 0 : GET_MODE (XEXP (operands[1], 0))));
18090 : 0 :
18091 : 0 : /* Make sure that (a) the CCmode we have for the flags is strong
18092 : 0 : enough for the reversed compare or (b) we have a valid FP compare. */
18093 : 0 : if (! ix86_comparison_operator (operands[1], VOIDmode))
18094 : 0 : FAIL;
18095 : 0 : })
18096 : 0 :
18097 : 0 : ;; Eliminate redundant compare between set{z,nz} and j{z,nz}:
18098 : 0 : ;; setz %al; test %al,%al; jz <...> -> setz %al; jnz <...> and
18099 : 0 : ;; setnz %al, test %al,%al; jz <...> -> setnz %al; jz <...>.
18100 : 124 : (define_peephole2
18101 : 124 : [(set (match_operand:QI 0 "nonimmediate_operand")
18102 : 0 : (match_operator:QI 1 "bt_comparison_operator"
18103 : 124 : [(reg:CCZ FLAGS_REG) (const_int 0)]))
18104 : 0 : (set (reg:CCZ FLAGS_REG)
18105 : 124 : (compare:CCZ (match_dup 0) (const_int 0)))
18106 : 0 : (set (pc)
18107 : 124 : (if_then_else (match_operator 2 "bt_comparison_operator"
18108 : : [(reg:CCZ FLAGS_REG) (const_int 0)])
18109 : : (match_operand 3)
18110 : : (pc)))]
18111 : 11 : "peep2_regno_dead_p (3, FLAGS_REG)"
18112 : 11 : [(set (match_dup 0)
18113 : 11 : (match_op_dup 1 [(reg:CCZ FLAGS_REG) (const_int 0)]))
18114 : 22 : (set (pc)
18115 : 11 : (if_then_else (match_dup 2)
18116 : 11 : (match_dup 3)
18117 : 11 : (pc)))]
18118 : 4947326 : {
18119 : 22 : if (GET_CODE (operands[1]) == EQ)
18120 : 0 : {
18121 : 22 : operands[2] = shallow_copy_rtx (operands[2]);
18122 : 4947315 : PUT_CODE (operands[2], reverse_condition (GET_CODE (operands[2])));
18123 : 4947304 : }
18124 : 4947304 : })
18125 : 4947304 :
18126 : : ;; The SSE store flag instructions saves 0 or 0xffffffff to the result.
18127 : 3071605 : ;; subsequent logical operations are used to imitate conditional moves.
18128 : 3071605 : ;; 0xffffffff is NaN, but not in normalized form, so we can't represent
18129 : 3071605 : ;; it directly.
18130 : 4723981 :
18131 : 11 : (define_insn "setcc_<mode>_sse"
18132 : 11 : [(set (match_operand:MODEF 0 "register_operand" "=x,x")
18133 : 11 : (match_operator:MODEF 3 "sse_comparison_operator"
18134 : 11 : [(match_operand:MODEF 1 "register_operand" "0,x")
18135 : 11 : (match_operand:MODEF 2 "nonimmediate_operand" "xm,xjm")]))]
18136 : 1940 : "SSE_FLOAT_MODE_P (<MODE>mode)"
18137 : : "@
18138 : : cmp%D3<ssemodesuffix>\t{%2, %0|%0, %2}
18139 : : vcmp%D3<ssemodesuffix>\t{%2, %1, %0|%0, %1, %2}"
18140 : 4754 : [(set_attr "isa" "noavx,avx")
18141 : 4743 : (set_attr "addr" "*,gpr16")
18142 : 4743 : (set_attr "type" "ssecmp")
18143 : : (set_attr "length_immediate" "1")
18144 : : (set_attr "prefix" "orig,vex")
18145 : 11 : (set_attr "mode" "<MODE>")])
18146 : 1260517 :
18147 : 11 : (define_insn "setcc_hf_mask"
18148 : : [(set (match_operand:QI 0 "register_operand" "=k")
18149 : : (unspec:QI
18150 : 1260506 : [(match_operand:HF 1 "register_operand" "v")
18151 : 1260506 : (match_operand:HF 2 "nonimmediate_operand" "vm")
18152 : 1260506 : (match_operand:SI 3 "const_0_to_31_operand")]
18153 : 1260506 : UNSPEC_PCMP))]
18154 : 32 : "TARGET_AVX512FP16"
18155 : 1260506 : "vcmpsh\t{%3, %2, %1, %0|%0, %1, %2, %3}"
18156 : 0 : [(set_attr "type" "ssecmp")
18157 : 1260419 : (set_attr "prefix" "evex")
18158 : 1260419 : (set_attr "mode" "HF")])
18159 : 2857 :
18160 : 2585 :
18161 : 1522 : ;; Basic conditional jump instructions.
18162 : 4379 :
18163 : 1228013 : (define_split
18164 : 1228013 : [(set (pc)
18165 : 0 : (if_then_else
18166 : 4467 : (match_operator 1 "add_comparison_operator"
18167 : 4467 : [(not:SWI (match_operand:SWI 2 "register_operand"))
18168 : 4467 : (match_operand:SWI 3 "nonimmediate_operand")])
18169 : 352 : (label_ref (match_operand 0))
18170 : 4115 : (pc)))]
18171 : 4115 : ""
18172 : : [(set (reg:CCC FLAGS_REG)
18173 : : (compare:CCC
18174 : : (plus:SWI (match_dup 2) (match_dup 3))
18175 : : (match_dup 2)))
18176 : : (set (pc)
18177 : : (if_then_else (match_op_dup 1 [(reg:CCC FLAGS_REG) (const_int 0)])
18178 : 0 : (label_ref (match_operand 0))
18179 : : (pc)))])
18180 : :
18181 : : (define_split
18182 : : [(set (pc)
18183 : : (if_then_else
18184 : : (match_operator 1 "shr_comparison_operator"
18185 : : [(match_operand:DI 2 "register_operand")
18186 : : (match_operand 3 "const_int_operand")])
18187 : 0 : (label_ref (match_operand 0))
18188 : 0 : (pc)))]
18189 : 10536 : "TARGET_64BIT
18190 : 21072 : && IN_RANGE (exact_log2 (UINTVAL (operands[3]) + 1), 32, 63)"
18191 : : [(set (reg:CCZ FLAGS_REG)
18192 : 4342 : (compare:CCZ
18193 : : (lshiftrt:DI (match_dup 2) (match_dup 4))
18194 : : (const_int 0)))
18195 : 0 : (set (pc)
18196 : : (if_then_else (match_op_dup 1 [(reg:CCZ FLAGS_REG) (const_int 0)])
18197 : 0 : (label_ref (match_operand 0))
18198 : 0 : (pc)))]
18199 : 4342 : {
18200 : 78649 : enum rtx_code new_code;
18201 : 0 :
18202 : 78649 : operands[1] = shallow_copy_rtx (operands[1]);
18203 : 78649 : switch (GET_CODE (operands[1]))
18204 : 74307 : {
18205 : 0 : case GTU: new_code = NE; break;
18206 : 3727 : case LEU: new_code = EQ; break;
18207 : 0 : default: gcc_unreachable ();
18208 : 0 : }
18209 : 4342 : PUT_CODE (operands[1], new_code);
18210 : 0 :
18211 : 8684 : operands[4] = GEN_INT (exact_log2 (UINTVAL (operands[3]) + 1));
18212 : 0 : })
18213 : 0 :
18214 : : ;; We ignore the overflow flag for signed branch instructions.
18215 : 4342 :
18216 : 4342 : (define_insn "*jcc"
18217 : 4342 : [(set (pc)
18218 : 4342 : (if_then_else (match_operator 1 "ix86_comparison_operator"
18219 : 4342 : [(reg FLAGS_REG) (const_int 0)])
18220 : 0 : (label_ref (match_operand 0))
18221 : 4342 : (pc)))]
18222 : 4342 : ""
18223 : 4342 : "%!%+j%C1\t%l0"
18224 : 4342 : [(set_attr "type" "ibr")
18225 : 4342 : (set_attr "modrm" "0")
18226 : : (set (attr "length")
18227 : : (if_then_else
18228 : : (and (ge (minus (match_dup 0) (pc))
18229 : 0 : (const_int -126))
18230 : 0 : (lt (minus (match_dup 0) (pc))
18231 : 0 : (const_int 128)))
18232 : 4342 : (const_int 2)
18233 : : (const_int 6)))])
18234 : :
18235 : : ;; In general it is not safe to assume too much about CCmode registers,
18236 : : ;; so simplify-rtx stops when it sees a second one. Under certain
18237 : 4 : ;; conditions this is safe on x86, so help combine not create
18238 : : ;;
18239 : 4 : ;; seta %al
18240 : 4 : ;; testb %al, %al
18241 : 4342 : ;; je Lfoo
18242 : 4342 :
18243 : 4346 : (define_split
18244 : 4 : [(set (pc)
18245 : 0 : (if_then_else (ne (match_operator 0 "ix86_comparison_operator"
18246 : 4 : [(reg FLAGS_REG) (const_int 0)])
18247 : 4 : (const_int 0))
18248 : 4 : (label_ref (match_operand 1))
18249 : 4 : (pc)))]
18250 : 4 : ""
18251 : 4 : [(set (pc)
18252 : 4 : (if_then_else (match_dup 0)
18253 : 4 : (label_ref (match_dup 1))
18254 : 0 : (pc)))]
18255 : 4 : {
18256 : 0 : operands[0] = shallow_copy_rtx (operands[0]);
18257 : 0 : PUT_MODE (operands[0], VOIDmode);
18258 : : })
18259 : :
18260 : : (define_split
18261 : 0 : [(set (pc)
18262 : 4 : (if_then_else (eq (match_operator 0 "ix86_comparison_operator"
18263 : 0 : [(reg FLAGS_REG) (const_int 0)])
18264 : 0 : (const_int 0))
18265 : 0 : (label_ref (match_operand 1))
18266 : : (pc)))]
18267 : : ""
18268 : : [(set (pc)
18269 : : (if_then_else (match_dup 0)
18270 : : (label_ref (match_dup 1))
18271 : 4 : (pc)))]
18272 : 4 : {
18273 : 0 : operands[0] = shallow_copy_rtx (operands[0]);
18274 : 0 : PUT_MODE (operands[0], VOIDmode);
18275 : 0 : PUT_CODE (operands[0],
18276 : : ix86_reverse_condition (GET_CODE (operands[0]),
18277 : : GET_MODE (XEXP (operands[0], 0))));
18278 : :
18279 : 0 : /* Make sure that (a) the CCmode we have for the flags is strong
18280 : : enough for the reversed compare or (b) we have a valid FP compare. */
18281 : 0 : if (! ix86_comparison_operator (operands[0], VOIDmode))
18282 : 0 : FAIL;
18283 : 0 : })
18284 : 0 :
18285 : 0 : ;; Unconditional and other jump instructions
18286 : 0 :
18287 : 0 : (define_insn "jump"
18288 : 0 : [(set (pc)
18289 : 0 : (label_ref (match_operand 0)))]
18290 : 0 : ""
18291 : 0 : "%!jmp\t%l0"
18292 : 0 : [(set_attr "type" "ibr")
18293 : 0 : (set_attr "modrm" "0")
18294 : 0 : (set (attr "length")
18295 : 0 : (if_then_else
18296 : 0 : (and (ge (minus (match_dup 0) (pc))
18297 : 0 : (const_int -126))
18298 : 0 : (lt (minus (match_dup 0) (pc))
18299 : : (const_int 128)))
18300 : : (const_int 2)
18301 : : (const_int 5)))])
18302 : :
18303 : 1311 : (define_expand "indirect_jump"
18304 : 0 : [(set (pc) (match_operand 0 "indirect_branch_operand"))]
18305 : 1311 : ""
18306 : 1311 : {
18307 : 1309 : if (TARGET_X32 || TARGET_INDIRECT_BRANCH_REGISTER)
18308 : 2 : operands[0] = convert_memory_address (word_mode, operands[0]);
18309 : 1311 : cfun->machine->has_local_indirect_jump = true;
18310 : : })
18311 : :
18312 : : (define_insn "*indirect_jump"
18313 : 1311 : [(set (pc) (match_operand:W 0 "indirect_branch_operand" "rBw"))]
18314 : 1311 : ""
18315 : 0 : "* return ix86_output_indirect_jmp (operands[0]);"
18316 : 1311 : [(set (attr "type")
18317 : : (if_then_else (match_test "(cfun->machine->indirect_branch_type
18318 : 1311 : != indirect_branch_keep)")
18319 : 3685 : (const_string "multi")
18320 : 1311 : (const_string "ibr")))
18321 : 4342 : (set_attr "length_immediate" "0")])
18322 : :
18323 : 4342 : (define_expand "tablejump"
18324 : 4342 : [(parallel [(set (pc) (match_operand 0 "indirect_branch_operand"))
18325 : 20774 : (use (label_ref (match_operand 1)))])]
18326 : 4342 : ""
18327 : 20774 : {
18328 : 20774 : /* In PIC mode, the table entries are stored GOT (32-bit) or PC (64-bit)
18329 : 20774 : relative. Convert the relative address to an absolute address. */
18330 : 0 : if (flag_pic)
18331 : 4342 : {
18332 : 17507 : rtx op0, op1;
18333 : 16432 : enum rtx_code code;
18334 : :
18335 : : /* We can't use @GOTOFF for text labels on VxWorks;
18336 : : see gotoff_operand. */
18337 : 1075 : if (TARGET_64BIT || TARGET_VXWORKS_RTP)
18338 : : {
18339 : 564 : code = PLUS;
18340 : 564 : op0 = operands[0];
18341 : 564 : op1 = gen_rtx_LABEL_REF (Pmode, operands[1]);
18342 : : }
18343 : 511 : else if (TARGET_MACHO || HAVE_AS_GOTOFF_IN_DATA)
18344 : : {
18345 : 511 : code = PLUS;
18346 : 511 : op0 = operands[0];
18347 : 511 : op1 = pic_offset_table_rtx;
18348 : : }
18349 : : else
18350 : : {
18351 : : code = MINUS;
18352 : : op0 = pic_offset_table_rtx;
18353 : : op1 = operands[0];
18354 : : }
18355 : :
18356 : 1075 : operands[0] = expand_simple_binop (Pmode, code, op0, op1, NULL_RTX, 0,
18357 : : OPTAB_DIRECT);
18358 : : }
18359 : :
18360 : 16432 : if (TARGET_X32 || TARGET_INDIRECT_BRANCH_REGISTER)
18361 : 4 : operands[0] = convert_memory_address (word_mode, operands[0]);
18362 : 16432 : cfun->machine->has_local_indirect_jump = true;
18363 : : })
18364 : :
18365 : : (define_insn "*tablejump_1"
18366 : 16432 : [(set (pc) (match_operand:W 0 "indirect_branch_operand" "rBw"))
18367 : 16432 : (use (label_ref (match_operand 1)))]
18368 : 16432 : ""
18369 : 17479 : "* return ix86_output_indirect_jmp (operands[0]);"
18370 : : [(set (attr "type")
18371 : 16432 : (if_then_else (match_test "(cfun->machine->indirect_branch_type
18372 : : != indirect_branch_keep)")
18373 : 342052 : (const_string "multi")
18374 : : (const_string "ibr")))
18375 : : (set_attr "length_immediate" "0")])
18376 : :
18377 : : ;; Convert setcc + movzbl to xor + setcc if operands don't overlap.
18378 : 16432 :
18379 : 16432 : (define_peephole2
18380 : 16432 : [(set (match_operand 4 "flags_reg_operand") (match_operand 0))
18381 : : (set (match_operand:QI 1 "register_operand")
18382 : : (match_operator:QI 2 "ix86_comparison_operator"
18383 : : [(reg FLAGS_REG) (const_int 0)]))
18384 : : (set (match_operand 3 "any_QIreg_operand")
18385 : : (zero_extend (match_dup 1)))]
18386 : 59248 : "(peep2_reg_dead_p (3, operands[1])
18387 : 33901 : || operands_match_p (operands[1], operands[3]))
18388 : 59248 : && ! reg_overlap_mentioned_p (operands[3], operands[0])
18389 : 84593 : && peep2_regno_dead_p (0, FLAGS_REG)"
18390 : 25345 : [(set (match_dup 4) (match_dup 0))
18391 : 50690 : (set (strict_low_part (match_dup 5))
18392 : 50690 : (match_dup 2))]
18393 : 76035 : {
18394 : 25345 : operands[5] = gen_lowpart (QImode, operands[3]);
18395 : 50690 : ix86_expand_clear (operands[3]);
18396 : 0 : })
18397 : 25345 :
18398 : 3243 : (define_peephole2
18399 : 28588 : [(parallel [(set (match_operand 5 "flags_reg_operand") (match_operand 0))
18400 : 28588 : (match_operand 4)])
18401 : 28588 : (set (match_operand:QI 1 "register_operand")
18402 : 28588 : (match_operator:QI 2 "ix86_comparison_operator"
18403 : 25345 : [(reg FLAGS_REG) (const_int 0)]))
18404 : 28329 : (set (match_operand 3 "any_QIreg_operand")
18405 : 28329 : (zero_extend (match_dup 1)))]
18406 : 25354 : "(peep2_reg_dead_p (3, operands[1])
18407 : 35663 : || operands_match_p (operands[1], operands[3]))
18408 : 32679 : && ! reg_overlap_mentioned_p (operands[3], operands[0])
18409 : 30210 : && ! reg_overlap_mentioned_p (operands[3], operands[4])
18410 : 30209 : && ! reg_set_p (operands[3], operands[4])
18411 : 30209 : && peep2_regno_dead_p (0, FLAGS_REG)"
18412 : 3674 : [(parallel [(set (match_dup 5) (match_dup 0))
18413 : 29005 : (match_dup 4)])
18414 : 3660 : (set (strict_low_part (match_dup 6))
18415 : : (match_dup 2))]
18416 : 25345 : {
18417 : 29005 : operands[6] = gen_lowpart (QImode, operands[3]);
18418 : 3660 : ix86_expand_clear (operands[3]);
18419 : : })
18420 : 0 :
18421 : 0 : (define_peephole2
18422 : 3660 : [(set (match_operand 6 "flags_reg_operand") (match_operand 0))
18423 : 3660 : (parallel [(set (match_operand 7 "flags_reg_operand") (match_operand 1))
18424 : 7320 : (match_operand 5)])
18425 : 3660 : (set (match_operand:QI 2 "register_operand")
18426 : 7320 : (match_operator:QI 3 "ix86_comparison_operator"
18427 : 7320 : [(reg FLAGS_REG) (const_int 0)]))
18428 : 7320 : (set (match_operand 4 "any_QIreg_operand")
18429 : 7320 : (zero_extend (match_dup 2)))]
18430 : 7454 : "(peep2_reg_dead_p (4, operands[2])
18431 : 7454 : || operands_match_p (operands[2], operands[4]))
18432 : 7454 : && ! reg_overlap_mentioned_p (operands[4], operands[0])
18433 : 7431 : && ! reg_overlap_mentioned_p (operands[4], operands[1])
18434 : 3771 : && ! reg_overlap_mentioned_p (operands[4], operands[5])
18435 : 111 : && ! reg_set_p (operands[4], operands[5])
18436 : 7431 : && refers_to_regno_p (FLAGS_REG, operands[1], (rtx *)NULL)
18437 : 111 : && peep2_regno_dead_p (0, FLAGS_REG)"
18438 : 23 : [(set (match_dup 6) (match_dup 0))
18439 : 111 : (parallel [(set (match_dup 7) (match_dup 1))
18440 : 111 : (match_dup 5)])
18441 : 3660 : (set (strict_low_part (match_dup 8))
18442 : 15 : (match_dup 3))]
18443 : 126 : {
18444 : 3771 : operands[8] = gen_lowpart (QImode, operands[4]);
18445 : 3786 : ix86_expand_clear (operands[4]);
18446 : 3675 : })
18447 : :
18448 : 15 : ;; Similar, but match zero extend with andsi3.
18449 : 126 :
18450 : 111 : (define_peephole2
18451 : 111 : [(set (match_operand 4 "flags_reg_operand") (match_operand 0))
18452 : 222 : (set (match_operand:QI 1 "register_operand")
18453 : 111 : (match_operator:QI 2 "ix86_comparison_operator"
18454 : 222 : [(reg FLAGS_REG) (const_int 0)]))
18455 : 222 : (parallel [(set (match_operand:SI 3 "any_QIreg_operand")
18456 : 222 : (and:SI (match_dup 3) (const_int 255)))
18457 : 222 : (clobber (reg:CC FLAGS_REG))])]
18458 : 222 : "REGNO (operands[1]) == REGNO (operands[3])
18459 : 222 : && ! reg_overlap_mentioned_p (operands[3], operands[0])
18460 : 222 : && peep2_regno_dead_p (0, FLAGS_REG)"
18461 : 222 : [(set (match_dup 4) (match_dup 0))
18462 : 222 : (set (strict_low_part (match_dup 5))
18463 : 222 : (match_dup 2))]
18464 : 111 : {
18465 : 0 : operands[5] = gen_lowpart (QImode, operands[3]);
18466 : 111 : ix86_expand_clear (operands[3]);
18467 : 111 : })
18468 : :
18469 : 111 : (define_peephole2
18470 : 0 : [(parallel [(set (match_operand 5 "flags_reg_operand") (match_operand 0))
18471 : 0 : (match_operand 4)])
18472 : 0 : (set (match_operand:QI 1 "register_operand")
18473 : 0 : (match_operator:QI 2 "ix86_comparison_operator"
18474 : 358356 : [(reg FLAGS_REG) (const_int 0)]))
18475 : 0 : (parallel [(set (match_operand 3 "any_QIreg_operand")
18476 : 280931 : (zero_extend (match_dup 1)))
18477 : 281042 : (clobber (reg:CC FLAGS_REG))])]
18478 : 10170 : "(peep2_reg_dead_p (3, operands[1])
18479 : 111 : || operands_match_p (operands[1], operands[3]))
18480 : 0 : && ! reg_overlap_mentioned_p (operands[3], operands[0])
18481 : 6329 : && ! reg_overlap_mentioned_p (operands[3], operands[4])
18482 : 0 : && ! reg_set_p (operands[3], operands[4])
18483 : 0 : && peep2_regno_dead_p (0, FLAGS_REG)"
18484 : 0 : [(parallel [(set (match_dup 5) (match_dup 0))
18485 : 6329 : (match_dup 4)])
18486 : 0 : (set (strict_low_part (match_dup 6))
18487 : 522 : (match_dup 2))]
18488 : 522 : {
18489 : 522 : operands[6] = gen_lowpart (QImode, operands[3]);
18490 : 522 : ix86_expand_clear (operands[3]);
18491 : 522 : })
18492 : 522 :
18493 : 0 : (define_peephole2
18494 : 3943464 : [(set (match_operand 6 "flags_reg_operand") (match_operand 0))
18495 : 518 : (parallel [(set (match_operand 7 "flags_reg_operand") (match_operand 1))
18496 : 0 : (match_operand 5)])
18497 : 327 : (set (match_operand:QI 2 "register_operand")
18498 : 3943273 : (match_operator:QI 3 "ix86_comparison_operator"
18499 : 3943273 : [(reg FLAGS_REG) (const_int 0)]))
18500 : 327 : (parallel [(set (match_operand 4 "any_QIreg_operand")
18501 : 3942946 : (zero_extend (match_dup 2)))
18502 : 3943273 : (clobber (reg:CC FLAGS_REG))])]
18503 : 327 : "(peep2_reg_dead_p (4, operands[2])
18504 : 3942946 : || operands_match_p (operands[2], operands[4]))
18505 : 0 : && ! reg_overlap_mentioned_p (operands[4], operands[0])
18506 : 0 : && ! reg_overlap_mentioned_p (operands[4], operands[1])
18507 : 40467 : && ! reg_overlap_mentioned_p (operands[4], operands[5])
18508 : 0 : && ! reg_set_p (operands[4], operands[5])
18509 : 40359 : && refers_to_regno_p (FLAGS_REG, operands[1], (rtx *)NULL)
18510 : 219 : && peep2_regno_dead_p (0, FLAGS_REG)"
18511 : 0 : [(set (match_dup 6) (match_dup 0))
18512 : 32432 : (parallel [(set (match_dup 7) (match_dup 1))
18513 : 0 : (match_dup 5)])
18514 : 32432 : (set (strict_low_part (match_dup 8))
18515 : : (match_dup 3))]
18516 : 16283 : {
18517 : 16149 : operands[8] = gen_lowpart (QImode, operands[4]);
18518 : 16283 : ix86_expand_clear (operands[4]);
18519 : : })
18520 : 134 :
18521 : 134 : ;; Call instructions.
18522 : 379 :
18523 : 0 : ;; The predicates normally associated with named expanders are not properly
18524 : 0 : ;; checked for calls. This is a bug in the generic code, but it isn't that
18525 : 19427 : ;; easy to fix. Ignore it for now and be prepared to fix things up.
18526 : 19427 :
18527 : 19427 : ;; P6 processors will jump to the address after the decrement when %esp
18528 : 19427 : ;; is used as a call operand, so they will execute return address as a code.
18529 : 19427 : ;; See Pentium Pro errata 70, Pentium 2 errata A33 and Pentium 3 errata E17.
18530 : 0 :
18531 : 18878 : ;; Register constraint for call instruction.
18532 : 18878 : (define_mode_attr c [(SI "l") (DI "r")])
18533 : 0 :
18534 : 8473 : ;; Call subroutine returning no value.
18535 : 8473 :
18536 : 8473 : (define_expand "call"
18537 : 0 : [(call (match_operand:QI 0)
18538 : 7675 : (match_operand 1))
18539 : 7675 : (use (match_operand 2))]
18540 : 0 : ""
18541 : 3198424 : {
18542 : 7410 : ix86_expand_call (NULL, operands[0], operands[1],
18543 : : operands[2], NULL, false);
18544 : 3198318 : DONE;
18545 : 7304 : })
18546 : 7304 :
18547 : 7304 : (define_expand "sibcall"
18548 : : [(call (match_operand:QI 0)
18549 : : (match_operand 1))
18550 : 0 : (use (match_operand 2))]
18551 : 0 : ""
18552 : 84273 : {
18553 : 84273 : ix86_expand_call (NULL, operands[0], operands[1],
18554 : : operands[2], NULL, true);
18555 : 84273 : DONE;
18556 : : })
18557 : 3191014 :
18558 : : (define_insn "*call"
18559 : : [(call (mem:QI (match_operand:W 0 "call_insn_operand" "<c>BwBz"))
18560 : : (match_operand 1))]
18561 : 9728818 : "!SIBLING_CALL_P (insn)"
18562 : 3517697 : "* return ix86_output_call_insn (insn, operands[0]);"
18563 : 3191014 : [(set_attr "type" "call")])
18564 : 3191014 :
18565 : 3191014 : ;; This covers both call and sibcall since only GOT slot is allowed.
18566 : 6120609 : (define_insn "*call_got_x32"
18567 : 3191014 : [(call (mem:QI (zero_extend:DI
18568 : : (match_operand:SI 0 "GOT_memory_operand" "Bg")))
18569 : : (match_operand 1))]
18570 : 0 : "TARGET_X32"
18571 : 84273 : {
18572 : 84273 : rtx fnaddr = gen_const_mem (DImode, XEXP (operands[0], 0));
18573 : 84273 : return ix86_output_call_insn (insn, fnaddr);
18574 : 84273 : }
18575 : 84273 : [(set_attr "type" "call")])
18576 : 104262 :
18577 : 104262 : ;; Since sibcall never returns, we can only use call-clobbered register
18578 : 0 : ;; as GOT base.
18579 : 535 : (define_insn "*sibcall_GOT_32"
18580 : 448 : [(call (mem:QI
18581 : 535 : (mem:SI (plus:SI
18582 : 87 : (match_operand:SI 0 "register_no_elim_operand" "U")
18583 : 507 : (match_operand:SI 1 "GOT32_symbol_operand"))))
18584 : 507 : (match_operand 2))]
18585 : 507 : "!TARGET_MACHO
18586 : 87 : && !TARGET_64BIT
18587 : 0 : && !TARGET_INDIRECT_BRANCH_REGISTER
18588 : 87 : && SIBLING_CALL_P (insn)"
18589 : 281 : {
18590 : 87 : rtx fnaddr = gen_rtx_PLUS (SImode, operands[0], operands[1]);
18591 : 87 : fnaddr = gen_const_mem (SImode, fnaddr);
18592 : 87 : return ix86_output_call_insn (insn, fnaddr);
18593 : 87 : }
18594 : 87 : [(set_attr "type" "call")])
18595 : 87 :
18596 : 87 : (define_insn "*sibcall"
18597 : 1686 : [(call (mem:QI (match_operand:W 0 "sibcall_insn_operand" "UBsBz"))
18598 : : (match_operand 1))]
18599 : 255722 : "SIBLING_CALL_P (insn)"
18600 : 111071 : "* return ix86_output_call_insn (insn, operands[0]);"
18601 : 109472 : [(set_attr "type" "call")])
18602 : 194737 :
18603 : : (define_insn "*sibcall_memory"
18604 : 83898 : [(call (mem:QI (match_operand:W 0 "memory_operand" "m"))
18605 : : (match_operand 1))
18606 : : (unspec [(const_int 0)] UNSPEC_PEEPSIB)]
18607 : 887 : "!TARGET_X32 && !TARGET_INDIRECT_BRANCH_REGISTER"
18608 : 174 : "* return ix86_output_call_insn (insn, operands[0]);"
18609 : 87 : [(set_attr "type" "call")])
18610 : :
18611 : : (define_peephole2
18612 : 222386 : [(set (match_operand:W 0 "register_operand")
18613 : : (match_operand:W 1 "memory_operand"))
18614 : : (call (mem:QI (match_dup 0))
18615 : 713 : (match_operand 3))]
18616 : 1750 : "!TARGET_X32
18617 : 2463 : && !TARGET_INDIRECT_BRANCH_REGISTER
18618 : 2418 : && SIBLING_CALL_P (peep2_next_insn (1))
18619 : 1513 : && !reg_mentioned_p (operands[0],
18620 : 1513 : CALL_INSN_FUNCTION_USAGE (peep2_next_insn (1)))"
18621 : 713 : [(parallel [(call (mem:QI (match_dup 1))
18622 : 713 : (match_dup 3))
18623 : 0 : (unspec [(const_int 0)] UNSPEC_PEEPSIB)])])
18624 : 713 :
18625 : 713 : (define_peephole2
18626 : 713 : [(set (match_operand:W 0 "register_operand")
18627 : 713 : (match_operand:W 1 "memory_operand"))
18628 : 713 : (unspec_volatile [(const_int 0)] UNSPECV_BLOCKAGE)
18629 : 713 : (call (mem:QI (match_dup 0))
18630 : 713 : (match_operand 3))]
18631 : 713 : "!TARGET_X32
18632 : 713 : && !TARGET_INDIRECT_BRANCH_REGISTER
18633 : 713 : && SIBLING_CALL_P (peep2_next_insn (2))
18634 : 0 : && !reg_mentioned_p (operands[0],
18635 : 0 : CALL_INSN_FUNCTION_USAGE (peep2_next_insn (2)))"
18636 : : [(unspec_volatile [(const_int 0)] UNSPECV_BLOCKAGE)
18637 : : (parallel [(call (mem:QI (match_dup 1))
18638 : : (match_dup 3))
18639 : : (unspec [(const_int 0)] UNSPEC_PEEPSIB)])])
18640 : :
18641 : : (define_expand "call_pop"
18642 : : [(parallel [(call (match_operand:QI 0)
18643 : 713 : (match_operand:SI 1))
18644 : 713 : (set (reg:SI SP_REG)
18645 : 713 : (plus:SI (reg:SI SP_REG)
18646 : : (match_operand:SI 3)))])]
18647 : 126471 : "!TARGET_64BIT"
18648 : 126471 : {
18649 : 126471 : ix86_expand_call (NULL, operands[0], operands[1],
18650 : : operands[2], operands[3], false);
18651 : 252942 : DONE;
18652 : : })
18653 : 126471 :
18654 : 126471 : (define_insn "*call_pop"
18655 : 0 : [(call (mem:QI (match_operand:SI 0 "call_insn_operand" "lBwBz"))
18656 : 0 : (match_operand 1))
18657 : 0 : (set (reg:SI SP_REG)
18658 : 0 : (plus:SI (reg:SI SP_REG)
18659 : 0 : (match_operand:SI 2 "immediate_operand" "i")))]
18660 : 226873 : "!TARGET_64BIT && !SIBLING_CALL_P (insn)"
18661 : 221673 : "* return ix86_output_call_insn (insn, operands[0]);"
18662 : 599 : [(set_attr "type" "call")])
18663 : 599 :
18664 : 0 : (define_insn "*sibcall_pop"
18665 : 2302940 : [(call (mem:QI (match_operand:SI 0 "sibcall_insn_operand" "UBsBz"))
18666 : 0 : (match_operand 1))
18667 : 2302940 : (set (reg:SI SP_REG)
18668 : 0 : (plus:SI (reg:SI SP_REG)
18669 : 0 : (match_operand:SI 2 "immediate_operand" "i")))]
18670 : 0 : "!TARGET_64BIT && SIBLING_CALL_P (insn)"
18671 : 0 : "* return ix86_output_call_insn (insn, operands[0]);"
18672 : : [(set_attr "type" "call")])
18673 : 0 :
18674 : : (define_insn "*sibcall_pop_memory"
18675 : 0 : [(call (mem:QI (match_operand:SI 0 "memory_operand" "Bs"))
18676 : : (match_operand 1))
18677 : : (set (reg:SI SP_REG)
18678 : 0 : (plus:SI (reg:SI SP_REG)
18679 : : (match_operand:SI 2 "immediate_operand" "i")))
18680 : 52030398 : (unspec [(const_int 0)] UNSPEC_PEEPSIB)]
18681 : 0 : "!TARGET_64BIT"
18682 : 0 : "* return ix86_output_call_insn (insn, operands[0]);"
18683 : 0 : [(set_attr "type" "call")])
18684 : 52030398 :
18685 : 52030398 : (define_peephole2
18686 : 52295306 : [(set (match_operand:SI 0 "register_operand")
18687 : 52030398 : (match_operand:SI 1 "memory_operand"))
18688 : 52030398 : (parallel [(call (mem:QI (match_dup 0))
18689 : 52030398 : (match_operand 3))
18690 : 0 : (set (reg:SI SP_REG)
18691 : 51807496 : (plus:SI (reg:SI SP_REG)
18692 : 51292235 : (match_operand:SI 4 "immediate_operand")))])]
18693 : 51292467 : "!TARGET_64BIT && SIBLING_CALL_P (peep2_next_insn (1))
18694 : 0 : && !reg_mentioned_p (operands[0],
18695 : 0 : CALL_INSN_FUNCTION_USAGE (peep2_next_insn (1)))"
18696 : 2050 : [(parallel [(call (mem:QI (match_dup 1))
18697 : 5596719 : (match_dup 3))
18698 : 0 : (set (reg:SI SP_REG)
18699 : 5596719 : (plus:SI (reg:SI SP_REG)
18700 : 515261 : (match_dup 4)))
18701 : 1724969 : (unspec [(const_int 0)] UNSPEC_PEEPSIB)])])
18702 : 5522565 :
18703 : 441107 : (define_peephole2
18704 : 0 : [(set (match_operand:SI 0 "register_operand")
18705 : 5187564 : (match_operand:SI 1 "memory_operand"))
18706 : 106106 : (unspec_volatile [(const_int 0)] UNSPECV_BLOCKAGE)
18707 : 5081458 : (parallel [(call (mem:QI (match_dup 0))
18708 : 5081458 : (match_operand 3))
18709 : 5081458 : (set (reg:SI SP_REG)
18710 : : (plus:SI (reg:SI SP_REG)
18711 : 0 : (match_operand:SI 4 "immediate_operand")))])]
18712 : 0 : "!TARGET_64BIT && SIBLING_CALL_P (peep2_next_insn (2))
18713 : 91399 : && !reg_mentioned_p (operands[0],
18714 : 0 : CALL_INSN_FUNCTION_USAGE (peep2_next_insn (2)))"
18715 : 91399 : [(unspec_volatile [(const_int 0)] UNSPECV_BLOCKAGE)
18716 : 91399 : (parallel [(call (mem:QI (match_dup 1))
18717 : 0 : (match_dup 3))
18718 : : (set (reg:SI SP_REG)
18719 : 0 : (plus:SI (reg:SI SP_REG)
18720 : 347102 : (match_dup 4)))
18721 : 347102 : (unspec [(const_int 0)] UNSPEC_PEEPSIB)])])
18722 : 347102 :
18723 : 0 : ;; Combining simple memory jump instruction
18724 : 0 :
18725 : 0 : (define_peephole2
18726 : 204726 : [(set (match_operand:W 0 "register_operand")
18727 : 204726 : (match_operand:W 1 "memory_operand"))
18728 : 204726 : (set (pc) (match_dup 0))]
18729 : 31 : "!TARGET_X32
18730 : 126502 : && !TARGET_INDIRECT_BRANCH_REGISTER
18731 : 31 : && peep2_reg_dead_p (2, operands[0])"
18732 : 0 : [(set (pc) (match_dup 1))])
18733 : 70 :
18734 : 42 : ;; Call subroutine, returning value in operand 0
18735 : 126499 :
18736 : 126471 : (define_expand "call_value"
18737 : 0 : [(set (match_operand 0)
18738 : 19869 : (call (match_operand:QI 1)
18739 : 146340 : (match_operand 2)))
18740 : 146340 : (use (match_operand 3))]
18741 : 126471 : ""
18742 : 126471 : {
18743 : 2302940 : ix86_expand_call (operands[0], operands[1], operands[2],
18744 : 80949 : operands[3], NULL, false);
18745 : 2383889 : DONE;
18746 : 1507714 : })
18747 : 0 :
18748 : 1426765 : (define_expand "sibcall_value"
18749 : 0 : [(set (match_operand 0)
18750 : 60 : (call (match_operand:QI 1)
18751 : 60 : (match_operand 2)))
18752 : 60 : (use (match_operand 3))]
18753 : 0 : ""
18754 : 33724 : {
18755 : 33724 : ix86_expand_call (operands[0], operands[1], operands[2],
18756 : 23138643 : operands[3], NULL, true);
18757 : 23172367 : DONE;
18758 : 23138643 : })
18759 : 0 :
18760 : : (define_insn "*call_value"
18761 : 0 : [(set (match_operand 0)
18762 : 4765331 : (call (mem:QI (match_operand:W 1 "call_insn_operand" "<c>BwBz"))
18763 : 4765331 : (match_operand 2)))]
18764 : 9124247 : "!SIBLING_CALL_P (insn)"
18765 : 264908 : "* return ix86_output_call_insn (insn, operands[1]);"
18766 : : [(set_attr "type" "callv")])
18767 : :
18768 : 637863 : ;; This covers both call and sibcall since only GOT slot is allowed.
18769 : 2640446 : (define_insn "*call_value_got_x32"
18770 : 637863 : [(set (match_operand 0)
18771 : 671587 : (call (mem:QI
18772 : 637863 : (zero_extend:DI
18773 : 637863 : (match_operand:SI 1 "GOT_memory_operand" "Bg")))
18774 : 637863 : (match_operand 2)))]
18775 : 0 : "TARGET_X32"
18776 : 671587 : {
18777 : 671587 : rtx fnaddr = gen_const_mem (DImode, XEXP (operands[1], 0));
18778 : 671587 : return ix86_output_call_insn (insn, fnaddr);
18779 : 671587 : }
18780 : 671587 : [(set_attr "type" "callv")])
18781 : 705061 :
18782 : 33474 : ;; Since sibcall never returns, we can only use call-clobbered register
18783 : 671587 : ;; as GOT base.
18784 : 639635 : (define_insn "*sibcall_value_GOT_32"
18785 : 639635 : [(set (match_operand 0)
18786 : 639775 : (call (mem:QI
18787 : 140 : (mem:SI (plus:SI
18788 : 272621 : (match_operand:SI 1 "register_no_elim_operand" "U")
18789 : 272481 : (match_operand:SI 2 "GOT32_symbol_operand"))))
18790 : 1782 : (match_operand 3)))]
18791 : 140 : "!TARGET_MACHO
18792 : 598290 : && !TARGET_64BIT
18793 : 597356 : && !TARGET_INDIRECT_BRANCH_REGISTER
18794 : 1214 : && SIBLING_CALL_P (insn)"
18795 : 150 : {
18796 : 150 : rtx fnaddr = gen_rtx_PLUS (SImode, operands[1], operands[2]);
18797 : 140 : fnaddr = gen_const_mem (SImode, fnaddr);
18798 : 140 : return ix86_output_call_insn (insn, fnaddr);
18799 : 166 : }
18800 : 140 : [(set_attr "type" "callv")])
18801 : 166 :
18802 : 140 : (define_insn "*sibcall_value"
18803 : 2421 : [(set (match_operand 0)
18804 : 26 : (call (mem:QI (match_operand:W 1 "sibcall_insn_operand" "UBsBz"))
18805 : 71063 : (match_operand 2)))]
18806 : 98650 : "SIBLING_CALL_P (insn)"
18807 : 73484 : "* return ix86_output_call_insn (insn, operands[1]);"
18808 : 103971 : [(set_attr "type" "callv")])
18809 : 26 :
18810 : 26 : (define_insn "*sibcall_value_memory"
18811 : 29554 : [(set (match_operand 0)
18812 : 8534694 : (call (mem:QI (match_operand:W 1 "memory_operand" "m"))
18813 : 166 : (match_operand 2)))
18814 : 8534860 : (unspec [(const_int 0)] UNSPEC_PEEPSIB)]
18815 : 731 : "!TARGET_X32 && !TARGET_INDIRECT_BRANCH_REGISTER"
18816 : 140 : "* return ix86_output_call_insn (insn, operands[1]);"
18817 : : [(set_attr "type" "callv")])
18818 : :
18819 : : (define_peephole2
18820 : 2303365 : [(set (match_operand:W 0 "register_operand")
18821 : 425 : (match_operand:W 1 "memory_operand"))
18822 : : (set (match_operand 2)
18823 : 425 : (call (mem:QI (match_dup 0))
18824 : 425 : (match_operand 3)))]
18825 : 2307147 : "!TARGET_X32
18826 : 2306722 : && !TARGET_INDIRECT_BRANCH_REGISTER
18827 : 2307147 : && SIBLING_CALL_P (peep2_next_insn (1))
18828 : 990 : && !reg_mentioned_p (operands[0],
18829 : 565 : CALL_INSN_FUNCTION_USAGE (peep2_next_insn (1)))"
18830 : 425 : [(parallel [(set (match_dup 2)
18831 : 2303365 : (call (mem:QI (match_dup 1))
18832 : 2303935 : (match_dup 3)))
18833 : 425 : (unspec [(const_int 0)] UNSPEC_PEEPSIB)])])
18834 : 1420 :
18835 : 425 : (define_peephole2
18836 : 425 : [(set (match_operand:W 0 "register_operand")
18837 : 425 : (match_operand:W 1 "memory_operand"))
18838 : 425 : (unspec_volatile [(const_int 0)] UNSPECV_BLOCKAGE)
18839 : 425 : (set (match_operand 2)
18840 : : (call (mem:QI (match_dup 0))
18841 : : (match_operand 3)))]
18842 : 0 : "!TARGET_X32
18843 : 0 : && !TARGET_INDIRECT_BRANCH_REGISTER
18844 : 0 : && SIBLING_CALL_P (peep2_next_insn (2))
18845 : 0 : && !reg_mentioned_p (operands[0],
18846 : 0 : CALL_INSN_FUNCTION_USAGE (peep2_next_insn (2)))"
18847 : : [(unspec_volatile [(const_int 0)] UNSPECV_BLOCKAGE)
18848 : : (parallel [(set (match_dup 2)
18849 : : (call (mem:QI (match_dup 1))
18850 : 425 : (match_dup 3)))
18851 : 425 : (unspec [(const_int 0)] UNSPEC_PEEPSIB)])])
18852 : 113434 :
18853 : : (define_expand "call_value_pop"
18854 : 113009 : [(parallel [(set (match_operand 0)
18855 : : (call (match_operand:QI 1)
18856 : : (match_operand:SI 2)))
18857 : : (set (reg:SI SP_REG)
18858 : 0 : (plus:SI (reg:SI SP_REG)
18859 : : (match_operand:SI 4)))])]
18860 : 0 : "!TARGET_64BIT"
18861 : 0 : {
18862 : 0 : ix86_expand_call (operands[0], operands[1], operands[2],
18863 : 0 : operands[3], operands[4], false);
18864 : 0 : DONE;
18865 : 0 : })
18866 : 0 :
18867 : 0 : (define_insn "*call_value_pop"
18868 : 0 : [(set (match_operand 0)
18869 : 0 : (call (mem:QI (match_operand:SI 1 "call_insn_operand" "lBwBz"))
18870 : 0 : (match_operand 2)))
18871 : 0 : (set (reg:SI SP_REG)
18872 : 0 : (plus:SI (reg:SI SP_REG)
18873 : 0 : (match_operand:SI 3 "immediate_operand" "i")))]
18874 : 0 : "!TARGET_64BIT && !SIBLING_CALL_P (insn)"
18875 : 0 : "* return ix86_output_call_insn (insn, operands[1]);"
18876 : 0 : [(set_attr "type" "callv")])
18877 : 0 :
18878 : : (define_insn "*sibcall_value_pop"
18879 : 0 : [(set (match_operand 0)
18880 : 0 : (call (mem:QI (match_operand:SI 1 "sibcall_insn_operand" "UBsBz"))
18881 : : (match_operand 2)))
18882 : : (set (reg:SI SP_REG)
18883 : : (plus:SI (reg:SI SP_REG)
18884 : : (match_operand:SI 3 "immediate_operand" "i")))]
18885 : 0 : "!TARGET_64BIT && SIBLING_CALL_P (insn)"
18886 : 0 : "* return ix86_output_call_insn (insn, operands[1]);"
18887 : : [(set_attr "type" "callv")])
18888 : :
18889 : : (define_insn "*sibcall_value_pop_memory"
18890 : 0 : [(set (match_operand 0)
18891 : 7336 : (call (mem:QI (match_operand:SI 1 "memory_operand" "m"))
18892 : 0 : (match_operand 2)))
18893 : 0 : (set (reg:SI SP_REG)
18894 : : (plus:SI (reg:SI SP_REG)
18895 : 7336 : (match_operand:SI 3 "immediate_operand" "i")))
18896 : 7336 : (unspec [(const_int 0)] UNSPEC_PEEPSIB)]
18897 : 0 : "!TARGET_64BIT"
18898 : 7336 : "* return ix86_output_call_insn (insn, operands[1]);"
18899 : 7336 : [(set_attr "type" "callv")])
18900 : 7336 :
18901 : 2541968 : (define_peephole2
18902 : 4069182 : [(set (match_operand:SI 0 "register_operand")
18903 : 2541968 : (match_operand:SI 1 "memory_operand"))
18904 : 0 : (parallel [(set (match_operand 2)
18905 : 1674206 : (call (mem:QI (match_dup 0))
18906 : 1674206 : (match_operand 3)))
18907 : 1666870 : (set (reg:SI SP_REG)
18908 : 7336 : (plus:SI (reg:SI SP_REG)
18909 : 260950 : (match_operand:SI 4 "immediate_operand")))])]
18910 : 260950 : "!TARGET_64BIT && SIBLING_CALL_P (peep2_next_insn (1))
18911 : 5290 : && !reg_mentioned_p (operands[0],
18912 : 5290 : CALL_INSN_FUNCTION_USAGE (peep2_next_insn (1)))"
18913 : 0 : [(parallel [(set (match_dup 2)
18914 : 260950 : (call (mem:QI (match_dup 1))
18915 : 0 : (match_dup 3)))
18916 : 262996 : (set (reg:SI SP_REG)
18917 : 262996 : (plus:SI (reg:SI SP_REG)
18918 : 2046 : (match_dup 4)))
18919 : 232098 : (unspec [(const_int 0)] UNSPEC_PEEPSIB)])])
18920 : 0 :
18921 : 7153 : (define_peephole2
18922 : 7153 : [(set (match_operand:SI 0 "register_operand")
18923 : 7153 : (match_operand:SI 1 "memory_operand"))
18924 : 35977076 : (unspec_volatile [(const_int 0)] UNSPECV_BLOCKAGE)
18925 : 2046 : (parallel [(set (match_operand 2)
18926 : 35977076 : (call (mem:QI (match_dup 0))
18927 : 35977908 : (match_operand 3)))
18928 : 35977908 : (set (reg:SI SP_REG)
18929 : 35977908 : (plus:SI (reg:SI SP_REG)
18930 : 35977076 : (match_operand:SI 4 "immediate_operand")))])]
18931 : 0 : "!TARGET_64BIT && SIBLING_CALL_P (peep2_next_insn (2))
18932 : 1978410 : && !reg_mentioned_p (operands[0],
18933 : 1978410 : CALL_INSN_FUNCTION_USAGE (peep2_next_insn (2)))"
18934 : 0 : [(unspec_volatile [(const_int 0)] UNSPECV_BLOCKAGE)
18935 : 0 : (parallel [(set (match_dup 2)
18936 : 0 : (call (mem:QI (match_dup 1))
18937 : 0 : (match_dup 3)))
18938 : 23522660 : (set (reg:SI SP_REG)
18939 : 38256711 : (plus:SI (reg:SI SP_REG)
18940 : 35422820 : (match_dup 4)))
18941 : 554256 : (unspec [(const_int 0)] UNSPEC_PEEPSIB)])])
18942 : 554256 :
18943 : 209802 : ;; Call subroutine returning any type.
18944 : 0 :
18945 : 198993 : (define_expand "untyped_call"
18946 : 198993 : [(parallel [(call (match_operand 0)
18947 : 0 : (const_int 0))
18948 : 0 : (match_operand 1)
18949 : 197207 : (match_operand 2)])]
18950 : 197207 : ""
18951 : 483 : {
18952 : 7708 : int i;
18953 : 7225 :
18954 : 0 : /* In order to give reg-stack an easier job in validating two
18955 : 5792 : coprocessor registers as containing a possible return value,
18956 : 0 : simply pretend the untyped call returns a complex long double
18957 : 0 : value.
18958 : 5792 :
18959 : 5792 : We can't use SSE_REGPARM_MAX here since callee is unprototyped
18960 : 5792 : and should have the default ABI. */
18961 : 0 :
18962 : 3168 : ix86_expand_call ((TARGET_FLOAT_RETURNS_IN_80387
18963 : 3168 : ? gen_rtx_REG (XCmode, FIRST_FLOAT_REG) : NULL),
18964 : 2066 : operands[0], const0_rtx,
18965 : 3178 : GEN_INT ((TARGET_64BIT
18966 : 0 : ? (ix86_abi == SYSV_ABI
18967 : : ? X86_64_SSE_REGPARM_MAX
18968 : : : X86_64_MS_SSE_REGPARM_MAX)
18969 : : : X86_32_SSE_REGPARM_MAX)
18970 : 2125 : - 1),
18971 : : NULL, false);
18972 : 2125 :
18973 : 4347 : for (i = 0; i < XVECLEN (operands[2], 0); i++)
18974 : : {
18975 : 3864 : rtx set = XVECEXP (operands[2], 0, i);
18976 : 3864 : emit_move_insn (SET_DEST (set), SET_SRC (set));
18977 : : }
18978 : :
18979 : : /* The optimizer does not know that the call sets the function value
18980 : : registers we stored in the result block. We avoid problems by
18981 : : claiming that all hard registers are used and clobbered at this
18982 : : point. */
18983 : 483 : emit_insn (gen_blockage ());
18984 : :
18985 : 483 : DONE;
18986 : : })
18987 : 0 :
18988 : 0 : ;; Prologue and epilogue instructions
18989 : 0 :
18990 : : ;; UNSPEC_VOLATILE is considered to use and clobber all hard registers and
18991 : : ;; all of memory. This blocks insns from being moved across this point.
18992 : :
18993 : : (define_insn "blockage"
18994 : 483 : [(unspec_volatile [(const_int 0)] UNSPECV_BLOCKAGE)]
18995 : : ""
18996 : : ""
18997 : : [(set_attr "length" "0")])
18998 : 483 :
18999 : 483 : ;; Do not schedule instructions accessing memory across this point.
19000 : 483 :
19001 : 483 : (define_expand "memory_blockage"
19002 : 483 : [(set (match_dup 0)
19003 : 483 : (unspec:BLK [(match_dup 0)] UNSPEC_MEMORY_BLOCKAGE))]
19004 : 483 : ""
19005 : 373298 : {
19006 : 373298 : operands[0] = gen_rtx_MEM (BLKmode, gen_rtx_SCRATCH (Pmode));
19007 : 373298 : MEM_VOLATILE_P (operands[0]) = 1;
19008 : : })
19009 : :
19010 : 373298 : (define_insn "*memory_blockage"
19011 : 373298 : [(set (match_operand:BLK 0)
19012 : 746596 : (unspec:BLK [(match_dup 0)] UNSPEC_MEMORY_BLOCKAGE))]
19013 : 373298 : ""
19014 : 746596 : ""
19015 : 373298 : [(set_attr "length" "0")])
19016 : 373298 :
19017 : : ;; As USE insns aren't meaningful after reload, this is used instead
19018 : : ;; to prevent deleting instructions setting registers for PIC code
19019 : 373298 : (define_insn "prologue_use"
19020 : 373298 : [(unspec_volatile [(match_operand 0)] UNSPECV_PROLOGUE_USE)]
19021 : 373298 : ""
19022 : : ""
19023 : : [(set_attr "length" "0")])
19024 : :
19025 : : ;; Insn emitted into the body of a function to return from a function.
19026 : 0 : ;; This is only done if the function's epilogue is known to be simple.
19027 : : ;; See comments for ix86_can_use_return_insn_p in i386.cc.
19028 : 0 :
19029 : 0 : (define_expand "return"
19030 : 0 : [(simple_return)]
19031 : 0 : "ix86_can_use_return_insn_p ()"
19032 : 0 : {
19033 : 0 : if (crtl->args.pops_args)
19034 : : {
19035 : 0 : rtx popc = GEN_INT (crtl->args.pops_args);
19036 : 0 : emit_jump_insn (gen_simple_return_pop_internal (popc));
19037 : 0 : DONE;
19038 : 0 : }
19039 : : })
19040 : :
19041 : : ;; We need to disable this for TARGET_SEH, as otherwise
19042 : : ;; shrink-wrapped prologue gets enabled too. This might exceed
19043 : 0 : ;; the maximum size of prologue in unwind information.
19044 : 0 : ;; Also disallow shrink-wrapping if using stack slot to pass the
19045 : 0 : ;; static chain pointer - the first instruction has to be pushl %esi
19046 : 0 : ;; and it can't be moved around, as we use alternate entry points
19047 : : ;; in that case.
19048 : : ;; Also disallow for ms_hook_prologue functions which have frame
19049 : : ;; pointer set up in function label which is correctly handled in
19050 : : ;; ix86_expand_{prologue|epligoue}() only.
19051 : 41284 :
19052 : : (define_expand "simple_return"
19053 : 41284 : [(simple_return)]
19054 : 3234393 : "!TARGET_SEH && !ix86_static_chain_on_stack && !ix86_function_ms_hook_prologue (cfun->decl)"
19055 : 41284 : {
19056 : 41284 : if (crtl->args.pops_args)
19057 : : {
19058 : 41284 : rtx popc = GEN_INT (crtl->args.pops_args);
19059 : 0 : emit_jump_insn (gen_simple_return_pop_internal (popc));
19060 : 41284 : DONE;
19061 : 41284 : }
19062 : : })
19063 : 1715 :
19064 : : (define_insn "simple_return_internal"
19065 : 1715 : [(simple_return)]
19066 : 41284 : "reload_completed"
19067 : 1568498 : "* return ix86_output_function_return (false);"
19068 : 41284 : [(set_attr "length" "1")
19069 : 41284 : (set_attr "atom_unit" "jeu")
19070 : 237996 : (set_attr "length_immediate" "0")
19071 : 238028 : (set_attr "modrm" "0")])
19072 : 259802 :
19073 : : (define_insn "interrupt_return"
19074 : 259802 : [(simple_return)
19075 : 0 : (unspec [(const_int 0)] UNSPEC_INTERRUPT_RETURN)]
19076 : 84273 : "reload_completed"
19077 : 32 : {
19078 : 120703 : return TARGET_64BIT ? (TARGET_UINTR ? "uiret" : "iretq") : "iret";
19079 : 36398 : })
19080 : 36398 :
19081 : 552 : ;; Used by x86_machine_dependent_reorg to avoid penalty on single byte RET
19082 : 36398 : ;; instruction Athlon and K8 have.
19083 : 36950 :
19084 : : (define_insn "simple_return_internal_long"
19085 : 9 : [(simple_return)
19086 : : (unspec [(const_int 0)] UNSPEC_REP)]
19087 : 3459 : "reload_completed"
19088 : 4002 : "* return ix86_output_function_return (true);"
19089 : 119519 : [(set_attr "length" "2")
19090 : : (set_attr "atom_unit" "jeu")
19091 : 119519 : (set_attr "length_immediate" "0")
19092 : 3458 : (set_attr "prefix_rep" "1")
19093 : 3450 : (set_attr "modrm" "0")])
19094 : :
19095 : 2722 : (define_insn_and_split "simple_return_pop_internal"
19096 : 25559 : [(simple_return)
19097 : 28235 : (use (match_operand:SI 0 "const_int_operand"))]
19098 : 25559 : "reload_completed"
19099 : 2676 : "ret\t%0"
19100 : 2676 : "&& cfun->machine->function_return_type != indirect_branch_keep"
19101 : 28218 : [(const_int 0)]
19102 : 59266 : "ix86_split_simple_return_pop_internal (operands[0]); DONE;"
19103 : 17 : [(set_attr "length" "3")
19104 : 33741 : (set_attr "atom_unit" "jeu")
19105 : 207 : (set_attr "length_immediate" "2")
19106 : 8 : (set_attr "modrm" "0")])
19107 : 215 :
19108 : 16 : (define_expand "simple_return_indirect_internal"
19109 : : [(parallel
19110 : 35591661 : [(simple_return)
19111 : : (use (match_operand 0 "register_operand"))])])
19112 : 35591661 :
19113 : 35591678 : (define_insn "*simple_return_indirect_internal<mode>"
19114 : 35591661 : [(simple_return)
19115 : 38784787 : (use (match_operand:W 0 "register_operand" "r"))]
19116 : 35591678 : "reload_completed"
19117 : 3193117 : "* return ix86_output_indirect_function_return (operands[0]);"
19118 : 33042278 : [(set (attr "type")
19119 : 33163052 : (if_then_else (match_test "(cfun->machine->indirect_branch_type
19120 : 120774 : != indirect_branch_keep)")
19121 : 2138021 : (const_string "multi")
19122 : 2137988 : (const_string "ibr")))
19123 : 2137988 : (set_attr "length_immediate" "0")])
19124 : 1440521 :
19125 : 2010546 : (define_insn "nop"
19126 : 3500763 : [(const_int 0)]
19127 : 1426985 : ""
19128 : 3351139 : "nop"
19129 : 2532867 : [(set_attr "length" "1")
19130 : 600099 : (set_attr "length_immediate" "0")
19131 : 622970 : (set_attr "modrm" "0")])
19132 : 22921 :
19133 : 12076730 : ;; Generate nops. Operand 0 is the number of nops, up to 8.
19134 : 12091890 : (define_insn "nops"
19135 : 12091131 : [(unspec_volatile [(match_operand 0 "const_int_operand")]
19136 : 14501 : UNSPECV_NOPS)]
19137 : 50 : "reload_completed"
19138 : 16867 : {
19139 : 9182 : int num = INTVAL (operands[0]);
19140 : 9208 :
19141 : 9258392 : gcc_assert (IN_RANGE (num, 1, 8));
19142 : 9265674 :
19143 : 237738 : while (num--)
19144 : 9691508 : fputs ("\tnop\n", asm_out_file);
19145 : 432546 :
19146 : 931316 : return "";
19147 : 512221 : }
19148 : 495789 : [(set (attr "length") (symbol_ref "INTVAL (operands[0])"))
19149 : 495739 : (set_attr "length_immediate" "0")
19150 : 242691 : (set_attr "modrm" "0")])
19151 : 235992 :
19152 : 235987 : ;; Pad to 16-byte boundary, max skip in op0. Used to avoid
19153 : 236200 : ;; branch prediction penalty for the third jump in a 16-byte
19154 : 236250 : ;; block on K8.
19155 : 11167 :
19156 : 235937 : (define_insn "pad"
19157 : 279099 : [(unspec_volatile [(match_operand 0)] UNSPECV_ALIGN)]
19158 : 315500 : ""
19159 : 236085 : {
19160 : 272431 : #ifdef ASM_OUTPUT_MAX_SKIP_ALIGN
19161 : 236035 : ASM_OUTPUT_MAX_SKIP_ALIGN (asm_out_file, 4, (int)INTVAL (operands[0]));
19162 : 136233 : #else
19163 : 372268 : /* It is tempting to use ASM_OUTPUT_ALIGN here, but we don't want to do that.
19164 : 372268 : The align insn is used to avoid 3 jump instructions in the row to improve
19165 : 6860449 : branch prediction and the benefits hardly outweigh the cost of extra 8
19166 : 6488181 : nops on the average inserted by full alignment pseudo operation. */
19167 : 6664877 : #endif
19168 : 236022 : return "";
19169 : 6654241 : }
19170 : 235937 : [(set_attr "length" "16")])
19171 : 412645 :
19172 : 235937 : (define_expand "prologue"
19173 : 444642 : [(const_int 0)]
19174 : 412645 : ""
19175 : 1839410 : "ix86_expand_prologue (); DONE;")
19176 : 412645 :
19177 : 0 : (define_expand "set_got"
19178 : 94729 : [(parallel
19179 : 506750 : [(set (match_operand:SI 0 "register_operand")
19180 : 187858 : (unspec:SI [(const_int 0)] UNSPEC_SET_GOT))
19181 : 330260 : (clobber (reg:CC FLAGS_REG))])]
19182 : 94213 : "!TARGET_64BIT"
19183 : 369432 : {
19184 : 275283 : if (flag_pic && !TARGET_VXWORKS_RTP)
19185 : 39368 : ix86_pc_thunk_call_expanded = true;
19186 : 345418 : })
19187 : 384786 :
19188 : 94182 : (define_insn "*set_got"
19189 : 443684 : [(set (match_operand:SI 0 "register_operand" "=r")
19190 : 569858 : (unspec:SI [(const_int 0)] UNSPEC_SET_GOT))
19191 : 432530 : (clobber (reg:CC FLAGS_REG))]
19192 : 377520 : "!TARGET_64BIT"
19193 : 185077 : "* return output_set_got (operands[0], NULL_RTX);"
19194 : 0 : [(set_attr "type" "multi")
19195 : 251822 : (set_attr "length" "12")])
19196 : 251236 :
19197 : 293066 : (define_expand "set_got_labelled"
19198 : 165 : [(parallel
19199 : 251253 : [(set (match_operand:SI 0 "register_operand")
19200 : 290523 : (unspec:SI [(label_ref (match_operand 1))]
19201 : 1285140 : UNSPEC_SET_GOT))
19202 : 992340 : (clobber (reg:CC FLAGS_REG))])]
19203 : 952821 : "!TARGET_64BIT"
19204 : 22564 : {
19205 : 971406 : if (flag_pic && !TARGET_VXWORKS_RTP)
19206 : 273800 : ix86_pc_thunk_call_expanded = true;
19207 : 251485 : })
19208 : 251236 :
19209 : 251236 : (define_insn "*set_got_labelled"
19210 : 343310 : [(set (match_operand:SI 0 "register_operand" "=r")
19211 : 343310 : (unspec:SI [(label_ref (match_operand 1))]
19212 : 251236 : UNSPEC_SET_GOT))
19213 : 0 : (clobber (reg:CC FLAGS_REG))]
19214 : 22680 : "!TARGET_64BIT"
19215 : 251236 : "* return output_set_got (operands[0], operands[1]);"
19216 : 119080 : [(set_attr "type" "multi")
19217 : 273800 : (set_attr "length" "12")])
19218 : 330 :
19219 : 511252 : (define_insn "set_got_rex64"
19220 : 365874 : [(set (match_operand:DI 0 "register_operand" "=r")
19221 : 365874 : (unspec:DI [(const_int 0)] UNSPEC_SET_GOT))]
19222 : 365642 : "TARGET_64BIT"
19223 : 251803 : "lea{q}\t{_GLOBAL_OFFSET_TABLE_(%%rip), %0|%0, _GLOBAL_OFFSET_TABLE_[rip]}"
19224 : 22871 : [(set_attr "type" "lea")
19225 : 274156 : (set_attr "length_address" "4")
19226 : 1392683 : (set_attr "mode" "DI")])
19227 : 1141091 :
19228 : 1163597 : (define_insn "set_rip_rex64"
19229 : 273858 : [(set (match_operand:DI 0 "register_operand" "=r")
19230 : 1159168 : (unspec:DI [(label_ref (match_operand 1))] UNSPEC_SET_RIP))]
19231 : 1495780 : "TARGET_64BIT"
19232 : 273800 : "lea{q}\t{%l1(%%rip), %0|%0, %l1[rip]}"
19233 : 1769273 : [(set_attr "type" "lea")
19234 : 1769273 : (set_attr "length_address" "4")
19235 : 1449387 : (set_attr "mode" "DI")])
19236 : 274107 :
19237 : 274049 : (define_insn "set_got_offset_rex64"
19238 : 273863 : [(set (match_operand:DI 0 "register_operand" "=r")
19239 : 273858 : (unspec:DI
19240 : 274049 : [(label_ref (match_operand 1))]
19241 : 27358 : UNSPEC_SET_GOT_OFFSET))]
19242 : 273916 : "TARGET_LP64"
19243 : 273858 : "movabs{q}\t{$_GLOBAL_OFFSET_TABLE_-%l1, %0|%0, OFFSET FLAT:_GLOBAL_OFFSET_TABLE_-%l1}"
19244 : 274049 : [(set_attr "type" "imov")
19245 : 274107 : (set_attr "length_immediate" "0")
19246 : 274201 : (set_attr "length_address" "8")
19247 : 283293 : (set_attr "mode" "DI")])
19248 : 283141 :
19249 : 273845 : (define_expand "epilogue"
19250 : 282937 : [(const_int 0)]
19251 : 274049 : ""
19252 : 1700878 : "ix86_expand_epilogue (1); DONE;")
19253 : 273800 :
19254 : 282884 : (define_expand "sibcall_epilogue"
19255 : 22877 : [(const_int 0)]
19256 : 22614 : ""
19257 : 390132 : "ix86_expand_epilogue (0); DONE;")
19258 : 274063 :
19259 : 274063 : (define_expand "eh_return"
19260 : 22827 : [(use (match_operand 0 "register_operand"))]
19261 : 251499 : ""
19262 : 273892 : {
19263 : 273892 : rtx tmp, sa = EH_RETURN_STACKADJ_RTX, ra = operands[0];
19264 : 367305 :
19265 : 251437 : /* Tricky bit: we write the address of the handler to which we will
19266 : 367506 : be returning into someone else's stack frame, one word below the
19267 : 367307 : stack address we wish to restore. */
19268 : 367333 : tmp = gen_rtx_PLUS (Pmode, arg_pointer_rtx, sa);
19269 : 458456 : tmp = plus_constant (Pmode, tmp, -UNITS_PER_WORD);
19270 : 458420 : /* Return address is always in word_mode. */
19271 : 458448 : tmp = gen_rtx_MEM (word_mode, tmp);
19272 : 458482 : if (GET_MODE (ra) != word_mode)
19273 : 458426 : ra = convert_to_mode (word_mode, ra, 1);
19274 : 458454 : emit_move_insn (tmp, ra);
19275 : 458454 :
19276 : 458482 : emit_jump_insn (gen_eh_return_internal ());
19277 : 458482 : emit_barrier ();
19278 : 458482 : DONE;
19279 : 207218 : })
19280 : 253585 :
19281 : 297603 : (define_insn_and_split "eh_return_internal"
19282 : 251265 : [(eh_return)]
19283 : 251441 : ""
19284 : 176285 : "#"
19285 : 297602 : "epilogue_completed"
19286 : 1 : [(const_int 0)]
19287 : 261 : "ix86_expand_epilogue (2); DONE;")
19288 : 297807 :
19289 : 223551985 : (define_expand "@leave_<mode>"
19290 : 223552190 : [(parallel
19291 : 223254588 : [(set (reg:W SP_REG) (plus:W (reg:W BP_REG) (match_dup 0)))
19292 : 223551985 : (set (reg:W BP_REG) (mem:W (reg:W BP_REG)))
19293 : 223509259 : (clobber (mem:BLK (scratch)))])]
19294 : 255081 : ""
19295 : 187202433 : "operands[0] = GEN_INT (<MODE_SIZE>);")
19296 : 186728005 :
19297 : 186727977 : (define_insn "*leave"
19298 : 255109 : [(set (reg:SI SP_REG) (plus:SI (reg:SI BP_REG) (const_int 4)))
19299 : 255094 : (set (reg:SI BP_REG) (mem:SI (reg:SI BP_REG)))
19300 : 3681 : (clobber (mem:BLK (scratch)))]
19301 : 248239 : "!TARGET_64BIT"
19302 : 35598884 : "leave"
19303 : 35598889 : [(set_attr "type" "leave")])
19304 : 258464 :
19305 : 226494 : (define_insn "*leave_rex64"
19306 : 476181 : [(set (reg:DI SP_REG) (plus:DI (reg:DI BP_REG) (const_int 8)))
19307 : 224957 : (set (reg:DI BP_REG) (mem:DI (reg:DI BP_REG)))
19308 : 251284 : (clobber (mem:BLK (scratch)))]
19309 : 476338 : "TARGET_64BIT"
19310 : 218456107 : "leave"
19311 : 218456107 : [(set_attr "type" "leave")])
19312 : 218455998 :
19313 : 251242 : ;; Handle -fsplit-stack.
19314 : 6175549 :
19315 : 5924313 : (define_expand "split_stack_prologue"
19316 : 5924313 : [(const_int 0)]
19317 : 237425 : ""
19318 : 439270 : {
19319 : 950617 : ix86_expand_split_stack_prologue ();
19320 : 1945810 : DONE;
19321 : 1686317 : })
19322 : 202351 :
19323 : 1888359 : ;; In order to support the call/return predictor, we use a return
19324 : 2378166 : ;; instruction which the middle-end doesn't see.
19325 : 1686054 : (define_insn "split_stack_return"
19326 : 3812675 : [(unspec_volatile [(match_operand:SI 0 "const_int_operand")]
19327 : 713343 : UNSPECV_SPLIT_STACK_RETURN)]
19328 : 2377857 : ""
19329 : 2377859 : {
19330 : 2176080 : if (operands[0] == const0_rtx)
19331 : 1686010 : return "ret";
19332 : 1888313 : else
19333 : 1912209 : return "ret\t%0";
19334 : 453541 : }
19335 : 299934 : [(set_attr "atom_unit" "jeu")
19336 : 299943 : (set_attr "modrm" "0")
19337 : 850587 : (set (attr "length")
19338 : 453400 : (if_then_else (match_operand:SI 0 "const0_operand")
19339 : 251508 : (const_int 1)
19340 : 272 : (const_int 3)))
19341 : 251508 : (set (attr "length_immediate")
19342 : 453551 : (if_then_else (match_operand:SI 0 "const0_operand")
19343 : 453278 : (const_int 0)
19344 : 453278 : (const_int 2)))])
19345 : 251237 :
19346 : 251499 : ;; If there are operand 0 bytes available on the stack, jump to
19347 : 453379 : ;; operand 1.
19348 : 453278 :
19349 : 251237 : (define_expand "split_stack_space_check"
19350 : 251236 : [(set (pc) (if_then_else
19351 : 251337 : (ltu (minus (reg SP_REG)
19352 : 251236 : (match_operand 0 "register_operand"))
19353 : 251236 : (match_dup 2))
19354 : 162 : (label_ref (match_operand 1))
19355 : 0 : (pc)))]
19356 : 251236 : ""
19357 : 251407 : {
19358 : 251407 : rtx reg = gen_reg_rtx (Pmode);
19359 : 162 :
19360 : 251407 : emit_insn (gen_sub3_insn (reg, stack_pointer_rtx, operands[0]));
19361 : 251424 :
19362 : 251407 : operands[2] = ix86_split_stack_guard ();
19363 : 251407 : ix86_expand_branch (GEU, reg, operands[2], operands[1]);
19364 : 251424 :
19365 : 251433 : DONE;
19366 : 251262 : })
19367 : 251262 :
19368 : 251262 : ;; Bit manipulation instructions.
19369 : 251398 :
19370 : 251398 : (define_expand "ffs<mode>2"
19371 : 162 : [(set (match_dup 2) (const_int -1))
19372 : 162 : (parallel [(set (match_dup 3) (match_dup 4))
19373 : 251398 : (set (match_operand:SWI48 0 "register_operand")
19374 : 251398 : (ctz:SWI48
19375 : 251398 : (match_operand:SWI48 1 "nonimmediate_operand")))])
19376 : 162 : (set (match_dup 0) (if_then_else:SWI48
19377 : 251402 : (eq (match_dup 3) (const_int 0))
19378 : 251402 : (match_dup 2)
19379 : 251240 : (match_dup 0)))
19380 : 251240 : (parallel [(set (match_dup 0) (plus:SWI48 (match_dup 0) (const_int 1)))
19381 : 251402 : (clobber (reg:CC FLAGS_REG))])]
19382 : 251402 : ""
19383 : 251508 : {
19384 : 256377 : machine_mode flags_mode;
19385 : 251398 :
19386 : 0 : if (<MODE>mode == SImode && !TARGET_CMOVE)
19387 : 5193 : {
19388 : 251398 : emit_insn (gen_ffssi2_no_cmove (operands[0], operands [1]));
19389 : 251402 : DONE;
19390 : 251402 : }
19391 : 5185 :
19392 : 251473 : flags_mode = TARGET_BMI ? CCCmode : CCZmode;
19393 : 251398 :
19394 : 251508 : operands[2] = gen_reg_rtx (<MODE>mode);
19395 : 251508 : operands[3] = gen_rtx_REG (flags_mode, FLAGS_REG);
19396 : 251342 : operands[4] = gen_rtx_COMPARE (flags_mode, operands[1], const0_rtx);
19397 : 251473 : })
19398 : 251473 :
19399 : 251311 : (define_insn_and_split "ffssi2_no_cmove"
19400 : 251417 : [(set (match_operand:SI 0 "register_operand" "=r")
19401 : 251473 : (ffs:SI (match_operand:SI 1 "nonimmediate_operand" "rm")))
19402 : 251579 : (clobber (match_scratch:SI 2 "=&q"))
19403 : 343 : (clobber (reg:CC FLAGS_REG))]
19404 : 343 : "!TARGET_CMOVE"
19405 : 251473 : "#"
19406 : 251342 : "&& reload_completed"
19407 : 251504 : [(parallel [(set (match_dup 4) (match_dup 5))
19408 : 251504 : (set (match_dup 0) (ctz:SI (match_dup 1)))])
19409 : 718598 : (set (strict_low_part (match_dup 3))
19410 : 251398 : (eq:QI (match_dup 4) (const_int 0)))
19411 : 261111 : (parallel [(set (match_dup 2) (neg:SI (match_dup 2)))
19412 : 253452 : (clobber (reg:CC FLAGS_REG))])
19413 : 259057 : (parallel [(set (match_dup 0) (ior:SI (match_dup 0) (match_dup 2)))
19414 : 152225 : (clobber (reg:CC FLAGS_REG))])
19415 : 152236 : (parallel [(set (match_dup 0) (plus:SI (match_dup 0) (const_int 1)))
19416 : 403472 : (clobber (reg:CC FLAGS_REG))])]
19417 : 251409 : {
19418 : 251409 : machine_mode flags_mode = TARGET_BMI ? CCCmode : CCZmode;
19419 : 392377 :
19420 : 251515 : operands[3] = gen_lowpart (QImode, operands[2]);
19421 : 391586 : operands[4] = gen_rtx_REG (flags_mode, FLAGS_REG);
19422 : 391575 : operands[5] = gen_rtx_COMPARE (flags_mode, operands[1], const0_rtx);
19423 : 251409 :
19424 : 350226 : ix86_expand_clear (operands[2]);
19425 : 350215 : })
19426 : 350226 :
19427 : 251515 : (define_insn_and_split "*tzcnt<mode>_1"
19428 : 350295 : [(set (reg:CCC FLAGS_REG)
19429 : 99070 : (compare:CCC (match_operand:SWI48 1 "nonimmediate_operand" "rm")
19430 : 350295 : (const_int 0)))
19431 : 251409 : (set (match_operand:SWI48 0 "register_operand" "=r")
19432 : 350296 : (ctz:SWI48 (match_dup 1)))]
19433 : 99092 : "TARGET_BMI"
19434 : 251511 : "tzcnt{<imodesuffix>}\t{%1, %0|%0, %1}";
19435 : 251474 : "&& TARGET_AVOID_FALSE_DEP_FOR_BMI && epilogue_completed
19436 : 251486 : && optimize_function_for_speed_p (cfun)
19437 : 350308 : && !reg_mentioned_p (operands[0], operands[1])"
19438 : 251432 : [(parallel
19439 : 350306 : [(set (reg:CCC FLAGS_REG)
19440 : 251398 : (compare:CCC (match_dup 1) (const_int 0)))
19441 : 350341 : (set (match_dup 0)
19442 : 251413 : (ctz:SWI48 (match_dup 1)))
19443 : 251398 : (unspec [(match_dup 0)] UNSPEC_INSN_FALSE_DEP)])]
19444 : 251409 : "ix86_expand_clear (operands[0]);"
19445 : 350326 : [(set_attr "type" "alu1")
19446 : 350326 : (set_attr "prefix_0f" "1")
19447 : 350295 : (set_attr "prefix_rep" "1")
19448 : 350326 : (set_attr "btver2_decode" "double")
19449 : 350337 : (set_attr "mode" "<MODE>")])
19450 : 350175 :
19451 : 1959736 : ; False dependency happens when destination is only updated by tzcnt,
19452 : 251429 : ; lzcnt or popcnt. There is no false dependency when destination is
19453 : 1959725 : ; also used in source.
19454 : 1860828 : (define_insn "*tzcnt<mode>_1_falsedep"
19455 : 1860828 : [(set (reg:CCC FLAGS_REG)
19456 : 1959725 : (compare:CCC (match_operand:SWI48 1 "nonimmediate_operand" "rm")
19457 : 1959725 : (const_int 0)))
19458 : 1959725 : (set (match_operand:SWI48 0 "register_operand" "=r")
19459 : 251398 : (ctz:SWI48 (match_dup 1)))
19460 : 1570862 : (unspec [(match_operand:SWI48 2 "register_operand" "0")]
19461 : 1822098 : UNSPEC_INSN_FALSE_DEP)]
19462 : 251404 : "TARGET_BMI"
19463 : 1723201 : "tzcnt{<imodesuffix>}\t{%1, %0|%0, %1}";
19464 : 99059 : [(set_attr "type" "alu1")
19465 : 1700942 : (set_attr "prefix_0f" "1")
19466 : 1700947 : (set_attr "prefix_rep" "1")
19467 : 350311 : (set_attr "btver2_decode" "double")
19468 : 350300 : (set_attr "mode" "<MODE>")])
19469 : 1700931 :
19470 : 1700931 : (define_insn "*bsf<mode>_1"
19471 : 1700937 : [(set (reg:CCZ FLAGS_REG)
19472 : 1641853 : (compare:CCZ (match_operand:SWI48 1 "nonimmediate_operand" "rm")
19473 : 1642103 : (const_int 0)))
19474 : 1350636 : (set (match_operand:SWI48 0 "register_operand" "=r")
19475 : 1449789 : (ctz:SWI48 (match_dup 1)))]
19476 : 1741006 : ""
19477 : 1642103 : "bsf{<imodesuffix>}\t{%1, %0|%0, %1}"
19478 : 1741006 : [(set_attr "type" "alu1")
19479 : 1489520 : (set_attr "prefix_0f" "1")
19480 : 1741006 : (set_attr "btver2_decode" "double")
19481 : 291223 : (set_attr "znver1_decode" "vector")
19482 : 1737885 : (set_attr "mode" "<MODE>")])
19483 : 1698228 :
19484 : 1698228 : (define_insn_and_split "ctz<mode>2"
19485 : 1698066 : [(set (match_operand:SWI48 0 "register_operand" "=r")
19486 : 1638867 : (ctz:SWI48
19487 : 1599331 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")))
19488 : 1698222 : (clobber (reg:CC FLAGS_REG))]
19489 : 1446986 : ""
19490 : 1486544 : {
19491 : 1698176 : if (TARGET_BMI)
19492 : 1698142 : return "tzcnt{<imodesuffix>}\t{%1, %0|%0, %1}";
19493 : 1599684 : else if (optimize_function_for_size_p (cfun))
19494 : 1348172 : ;
19495 : 1599671 : else if (TARGET_CPU_P (GENERIC))
19496 : 1348172 : /* tzcnt expands to 'rep bsf' and we can use it even if !TARGET_BMI. */
19497 : 1599663 : return "rep%; bsf{<imodesuffix>}\t{%1, %0|%0, %1}";
19498 : 251481 :
19499 : 1571005 : return "bsf{<imodesuffix>}\t{%1, %0|%0, %1}";
19500 : 1570760 : }
19501 : 253714 : "(TARGET_BMI || TARGET_CPU_P (GENERIC))
19502 : 2532 : && TARGET_AVOID_FALSE_DEP_FOR_BMI && epilogue_completed
19503 : 8267 : && optimize_function_for_speed_p (cfun)
19504 : 259927 : && !reg_mentioned_p (operands[0], operands[1])"
19505 : 1576284 : [(parallel
19506 : 258939 : [(set (match_dup 0)
19507 : 1134207 : (ctz:SWI48 (match_dup 1)))
19508 : 1126911 : (unspec [(match_dup 0)] UNSPEC_INSN_FALSE_DEP)
19509 : 9070 : (clobber (reg:CC FLAGS_REG))])]
19510 : 1134575 : "ix86_expand_clear (operands[0]);"
19511 : 882729 : [(set_attr "type" "alu1")
19512 : 874979 : (set_attr "prefix_0f" "1")
19513 : 1749904 : (set (attr "prefix_rep")
19514 : 772 : (if_then_else
19515 : 259028 : (ior (match_test "TARGET_BMI")
19516 : 772 : (and (not (match_test "optimize_function_for_size_p (cfun)"))
19517 : 251766 : (match_test "TARGET_CPU_P (GENERIC)")))
19518 : 251478 : (const_string "1")
19519 : 258209 : (const_string "0")))
19520 : 251568 : (set_attr "mode" "<MODE>")])
19521 : 251582 :
19522 : 251330 : ; False dependency happens when destination is only updated by tzcnt,
19523 : 251250 : ; lzcnt or popcnt. There is no false dependency when destination is
19524 : 251488 : ; also used in source.
19525 : 251326 : (define_insn "*ctz<mode>2_falsedep"
19526 : 251407 : [(set (match_operand:SWI48 0 "register_operand" "=r")
19527 : 611 : (ctz:SWI48
19528 : 611 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")))
19529 : 251928 : (unspec [(match_operand:SWI48 2 "register_operand" "0")]
19530 : 251262 : UNSPEC_INSN_FALSE_DEP)
19531 : 251398 : (clobber (reg:CC FLAGS_REG))]
19532 : 80 : ""
19533 : 251766 : {
19534 : 251481 : if (TARGET_BMI)
19535 : 251687 : return "tzcnt{<imodesuffix>}\t{%1, %0|%0, %1}";
19536 : 251973 : else if (TARGET_CPU_P (GENERIC))
19537 : 251687 : /* tzcnt expands to 'rep bsf' and we can use it even if !TARGET_BMI. */
19538 : 251687 : return "rep%; bsf{<imodesuffix>}\t{%1, %0|%0, %1}";
19539 : 251687 : else
19540 : 251687 : gcc_unreachable ();
19541 : 251398 : }
19542 : 451 : [(set_attr "type" "alu1")
19543 : 162 : (set_attr "prefix_0f" "1")
19544 : 251398 : (set_attr "prefix_rep" "1")
19545 : 251691 : (set_attr "mode" "<MODE>")])
19546 : 251404 :
19547 : 168 : (define_insn_and_split "*ctzsi2_zext"
19548 : 251398 : [(set (match_operand:DI 0 "register_operand" "=r")
19549 : 168 : (and:DI
19550 : 251404 : (subreg:DI
19551 : 251404 : (ctz:SI
19552 : 251398 : (match_operand:SI 1 "nonimmediate_operand" "rm")) 0)
19553 : 251398 : (const_int 63)))
19554 : 251398 : (clobber (reg:CC FLAGS_REG))]
19555 : 251422 : "TARGET_BMI && TARGET_64BIT"
19556 : 251398 : "tzcnt{l}\t{%1, %k0|%k0, %1}"
19557 : 251422 : "&& TARGET_AVOID_FALSE_DEP_FOR_BMI && epilogue_completed
19558 : 251414 : && optimize_function_for_speed_p (cfun)
19559 : 251406 : && !reg_mentioned_p (operands[0], operands[1])"
19560 : 251256 : [(parallel
19561 : 251402 : [(set (match_dup 0)
19562 : 251406 : (and:DI (subreg:DI (ctz:SI (match_dup 1)) 0) (const_int 63)))
19563 : 251406 : (unspec [(match_dup 0)] UNSPEC_INSN_FALSE_DEP)
19564 : 8 : (clobber (reg:CC FLAGS_REG))])]
19565 : 190 : "ix86_expand_clear (operands[0]);"
19566 : 251422 : [(set_attr "type" "alu1")
19567 : 251422 : (set_attr "prefix_0f" "1")
19568 : 251402 : (set_attr "prefix_rep" "1")
19569 : 166 : (set_attr "mode" "SI")])
19570 : 251408 :
19571 : 166 : ; False dependency happens when destination is only updated by tzcnt,
19572 : 251402 : ; lzcnt or popcnt. There is no false dependency when destination is
19573 : 251236 : ; also used in source.
19574 : 251236 : (define_insn "*ctzsi2_zext_falsedep"
19575 : 251398 : [(set (match_operand:DI 0 "register_operand" "=r")
19576 : 251404 : (and:DI
19577 : 251398 : (subreg:DI
19578 : 251404 : (ctz:SI
19579 : 251398 : (match_operand:SI 1 "nonimmediate_operand" "rm")) 0)
19580 : 251398 : (const_int 63)))
19581 : 251404 : (unspec [(match_operand:DI 2 "register_operand" "0")]
19582 : 251404 : UNSPEC_INSN_FALSE_DEP)
19583 : 251398 : (clobber (reg:CC FLAGS_REG))]
19584 : 251236 : "TARGET_BMI && TARGET_64BIT"
19585 : 251236 : "tzcnt{l}\t{%1, %k0|%k0, %1}"
19586 : 251402 : [(set_attr "type" "alu1")
19587 : 211 : (set_attr "prefix_0f" "1")
19588 : 215 : (set_attr "prefix_rep" "1")
19589 : 251447 : (set_attr "mode" "SI")])
19590 : 251402 :
19591 : 251402 : (define_insn_and_split "*ctzsidi2_<s>ext"
19592 : 251398 : [(set (match_operand:DI 0 "register_operand" "=r")
19593 : 251402 : (any_extend:DI
19594 : 192 : (ctz:SI
19595 : 251402 : (match_operand:SI 1 "nonimmediate_operand" "rm"))))
19596 : 251262 : (clobber (reg:CC FLAGS_REG))]
19597 : 251348 : "TARGET_64BIT"
19598 : 251432 : {
19599 : 251516 : if (TARGET_BMI)
19600 : 246 : return "tzcnt{l}\t{%1, %k0|%k0, %1}";
19601 : 251432 : else if (TARGET_CPU_P (GENERIC)
19602 : 251431 : && !optimize_function_for_size_p (cfun))
19603 : 251880 : /* tzcnt expands to 'rep bsf' and we can use it even if !TARGET_BMI. */
19604 : 237 : return "rep%; bsf{l}\t{%1, %k0|%k0, %1}";
19605 : 251481 : return "bsf{l}\t{%1, %k0|%k0, %1}";
19606 : 516524 : }
19607 : 251570 : "(TARGET_BMI || TARGET_CPU_P (GENERIC))
19608 : 251525 : && TARGET_AVOID_FALSE_DEP_FOR_BMI && epilogue_completed
19609 : 251541 : && optimize_function_for_speed_p (cfun)
19610 : 251337 : && !reg_mentioned_p (operands[0], operands[1])"
19611 : 251520 : [(parallel
19612 : 251551 : [(set (match_dup 0)
19613 : 251398 : (any_extend:DI (ctz:SI (match_dup 1))))
19614 : 251522 : (unspec [(match_dup 0)] UNSPEC_INSN_FALSE_DEP)
19615 : 251440 : (clobber (reg:CC FLAGS_REG))])]
19616 : 251551 : "ix86_expand_clear (operands[0]);"
19617 : 251602 : [(set_attr "type" "alu1")
19618 : 162 : (set_attr "prefix_0f" "1")
19619 : 251465 : (set (attr "prefix_rep")
19620 : 251507 : (if_then_else
19621 : 251467 : (ior (match_test "TARGET_BMI")
19622 : 275 : (and (not (match_test "optimize_function_for_size_p (cfun)"))
19623 : 1258 : (match_test "TARGET_CPU_P (GENERIC)")))
19624 : 248 : (const_string "1")
19625 : 1243 : (const_string "0")))
19626 : 251484 : (set_attr "mode" "SI")])
19627 : 251438 :
19628 : 251236 : (define_insn "*ctzsidi2_<s>ext_falsedep"
19629 : 251276 : [(set (match_operand:DI 0 "register_operand" "=r")
19630 : 251480 : (any_extend:DI
19631 : 251438 : (ctz:SI
19632 : 251464 : (match_operand:SI 1 "nonimmediate_operand" "rm"))))
19633 : 251398 : (unspec [(match_operand:DI 2 "register_operand" "0")]
19634 : 251425 : UNSPEC_INSN_FALSE_DEP)
19635 : 251425 : (clobber (reg:CC FLAGS_REG))]
19636 : 251452 : "TARGET_64BIT"
19637 : 251425 : {
19638 : 251424 : if (TARGET_BMI)
19639 : 251236 : return "tzcnt{l}\t{%1, %k0|%k0, %1}";
19640 : 251262 : else if (TARGET_CPU_P (GENERIC))
19641 : 251398 : /* tzcnt expands to 'rep bsf' and we can use it even if !TARGET_BMI. */
19642 : 251496 : return "rep%; bsf{l}\t{%1, %k0|%k0, %1}";
19643 : 251398 : else
19644 : 251496 : gcc_unreachable ();
19645 : 263814 : }
19646 : 263647 : [(set_attr "type" "alu1")
19647 : 251399 : (set_attr "prefix_0f" "1")
19648 : 251565 : (set_attr "prefix_rep" "1")
19649 : 263165 : (set_attr "mode" "SI")])
19650 : 162 :
19651 : 251377 : (define_insn "bsr_rex64"
19652 : 251236 : [(set (reg:CCZ FLAGS_REG)
19653 : 251398 : (compare:CCZ (match_operand:DI 1 "nonimmediate_operand" "rm")
19654 : 263108 : (const_int 0)))
19655 : 263108 : (set (match_operand:DI 0 "register_operand" "=r")
19656 : 251398 : (minus:DI (const_int 63)
19657 : 262793 : (clz:DI (match_dup 1))))]
19658 : 258575 : "TARGET_64BIT"
19659 : 251398 : "bsr{q}\t{%1, %0|%0, %1}"
19660 : 251398 : [(set_attr "type" "alu1")
19661 : 251442 : (set_attr "prefix_0f" "1")
19662 : 255979 : (set_attr "znver1_decode" "vector")
19663 : 255979 : (set_attr "mode" "DI")])
19664 : 251432 :
19665 : 251270 : (define_insn "bsr_rex64_1"
19666 : 251440 : [(set (match_operand:DI 0 "register_operand" "=r")
19667 : 251398 : (minus:DI (const_int 63)
19668 : 251398 : (clz:DI (match_operand:DI 1 "nonimmediate_operand" "rm"))))
19669 : 251236 : (clobber (reg:CC FLAGS_REG))]
19670 : 251398 : "!TARGET_LZCNT && TARGET_64BIT"
19671 : 162 : "bsr{q}\t{%1, %0|%0, %1}"
19672 : 5356 : [(set_attr "type" "alu1")
19673 : 256430 : (set_attr "prefix_0f" "1")
19674 : 251556 : (set_attr "znver1_decode" "vector")
19675 : 251556 : (set_attr "mode" "DI")])
19676 : 255990 :
19677 : 434636 : (define_insn "bsr_rex64_1_zext"
19678 : 166 : [(set (match_operand:DI 0 "register_operand" "=r")
19679 : 309805 : (zero_extend:DI
19680 : 309805 : (minus:SI (const_int 63)
19681 : 309805 : (subreg:SI
19682 : 251402 : (clz:DI (match_operand:DI 1 "nonimmediate_operand" "rm"))
19683 : 58569 : 0))))
19684 : 10651353 : (clobber (reg:CC FLAGS_REG))]
19685 : 10592950 : "!TARGET_LZCNT && TARGET_64BIT"
19686 : 10651346 : "bsr{q}\t{%1, %0|%0, %1}"
19687 : 10651346 : [(set_attr "type" "alu1")
19688 : 10592950 : (set_attr "prefix_0f" "1")
19689 : 10643888 : (set_attr "znver1_decode" "vector")
19690 : 10592956 : (set_attr "mode" "DI")])
19691 : 10592960 :
19692 : 10643888 : (define_insn "bsr"
19693 : 10643898 : [(set (reg:CCZ FLAGS_REG)
19694 : 10592962 : (compare:CCZ (match_operand:SI 1 "nonimmediate_operand" "rm")
19695 : 10592972 : (const_int 0)))
19696 : 10592804 : (set (match_operand:SI 0 "register_operand" "=r")
19697 : 10643884 : (minus:SI (const_int 31)
19698 : 10643884 : (clz:SI (match_dup 1))))]
19699 : 168 : ""
19700 : 50206 : "bsr{l}\t{%1, %0|%0, %1}"
19701 : 50044 : [(set_attr "type" "alu1")
19702 : 0 : (set_attr "prefix_0f" "1")
19703 : 200 : (set_attr "znver1_decode" "vector")
19704 : 10592966 : (set_attr "mode" "SI")])
19705 : 162 :
19706 : 0 : (define_insn "bsr_1"
19707 : 289674 : [(set (match_operand:SI 0 "register_operand" "=r")
19708 : 289836 : (minus:SI (const_int 31)
19709 : 289836 : (clz:SI (match_operand:SI 1 "nonimmediate_operand" "rm"))))
19710 : 289836 : (clobber (reg:CC FLAGS_REG))]
19711 : 293600 : "!TARGET_LZCNT"
19712 : 289851 : "bsr{l}\t{%1, %0|%0, %1}"
19713 : 293314 : [(set_attr "type" "alu1")
19714 : 293299 : (set_attr "prefix_0f" "1")
19715 : 289851 : (set_attr "znver1_decode" "vector")
19716 : 289851 : (set_attr "mode" "SI")])
19717 : 289689 :
19718 : 289689 : (define_insn "bsr_zext_1"
19719 : 289851 : [(set (match_operand:DI 0 "register_operand" "=r")
19720 : 352281 : (zero_extend:DI
19721 : 352281 : (minus:SI
19722 : 289851 : (const_int 31)
19723 : 330843 : (clz:SI (match_operand:SI 1 "nonimmediate_operand" "rm")))))
19724 : 294782 : (clobber (reg:CC FLAGS_REG))]
19725 : 325912 : "!TARGET_LZCNT && TARGET_64BIT"
19726 : 326093 : "bsr{l}\t{%1, %k0|%k0, %1}"
19727 : 290031 : [(set_attr "type" "alu1")
19728 : 290231 : (set_attr "prefix_0f" "1")
19729 : 326120 : (set_attr "znver1_decode" "vector")
19730 : 325958 : (set_attr "mode" "SI")])
19731 : 325846 :
19732 : 326009 : ; As bsr is undefined behavior on zero and for other input
19733 : 325897 : ; values it is in range 0 to 63, we can optimize away sign-extends.
19734 : 326009 : (define_insn_and_split "*bsr_rex64_2"
19735 : 289948 : [(set (match_operand:DI 0 "register_operand")
19736 : 299383 : (xor:DI
19737 : 312173 : (sign_extend:DI
19738 : 302850 : (minus:SI
19739 : 310500 : (const_int 63)
19740 : 307033 : (subreg:SI (clz:DI (match_operand:DI 1 "nonimmediate_operand"))
19741 : 289786 : 0)))
19742 : 299177 : (const_int 63)))
19743 : 299339 : (clobber (reg:CC FLAGS_REG))]
19744 : 299532 : "!TARGET_LZCNT && TARGET_64BIT && ix86_pre_reload_split ()"
19745 : 289952 : "#"
19746 : 299324 : "&& 1"
19747 : 290100 : [(parallel [(set (reg:CCZ FLAGS_REG)
19748 : 290030 : (compare:CCZ (match_dup 1) (const_int 0)))
19749 : 290004 : (set (match_dup 2)
19750 : 295581 : (minus:DI (const_int 63) (clz:DI (match_dup 1))))])
19751 : 294842 : (parallel [(set (match_dup 0)
19752 : 294155 : (zero_extend:DI (xor:SI (match_dup 3) (const_int 63))))
19753 : 295374 : (clobber (reg:CC FLAGS_REG))])]
19754 : 290458 : {
19755 : 290817 : operands[2] = gen_reg_rtx (DImode);
19756 : 503 : operands[3] = lowpart_subreg (SImode, operands[2], DImode);
19757 : 290623 : })
19758 : 290720 :
19759 : 290115 : (define_insn_and_split "*bsr_2"
19760 : 290098 : [(set (match_operand:DI 0 "register_operand")
19761 : 2009949 : (sign_extend:DI
19762 : 2010046 : (xor:SI
19763 : 290165 : (minus:SI
19764 : 1820551 : (const_int 31)
19765 : 1820563 : (clz:SI (match_operand:SI 1 "nonimmediate_operand")))
19766 : 289989 : (const_int 31))))
19767 : 1820466 : (clobber (reg:CC FLAGS_REG))]
19768 : 290053 : "!TARGET_LZCNT && TARGET_64BIT && ix86_pre_reload_split ()"
19769 : 289952 : "#"
19770 : 1720637 : "&& 1"
19771 : 290060 : [(parallel [(set (reg:CCZ FLAGS_REG)
19772 : 290034 : (compare:CCZ (match_dup 1) (const_int 0)))
19773 : 1720481 : (set (match_dup 2)
19774 : 290126 : (minus:SI (const_int 31) (clz:SI (match_dup 1))))])
19775 : 290126 : (parallel [(set (match_dup 0)
19776 : 1720849 : (zero_extend:DI (xor:SI (match_dup 2) (const_int 31))))
19777 : 1720731 : (clobber (reg:CC FLAGS_REG))])]
19778 : 290166 : "operands[2] = gen_reg_rtx (SImode);")
19779 : 290260 :
19780 : 1720859 : ; Splitters to optimize 64 - __builtin_clzl (x) or 32 - __builtin_clz (x).
19781 : 1720821 : ; Again, as for !TARGET_LZCNT CLZ is UB at zero, CLZ is guaranteed to be
19782 : 1721258 : ; in [0, 63] or [0, 31] range.
19783 : 1720757 : (define_split
19784 : 290494 : [(set (match_operand:SI 0 "register_operand")
19785 : 1720145 : (minus:SI
19786 : 1719904 : (match_operand:SI 2 "const_int_operand")
19787 : 289907 : (xor:SI
19788 : 802559 : (minus:SI (const_int 63)
19789 : 802255 : (subreg:SI
19790 : 802476 : (clz:DI (match_operand:DI 1 "nonimmediate_operand"))
19791 : 1314350 : 0))
19792 : 290183 : (const_int 63))))]
19793 : 804029 : "!TARGET_LZCNT && TARGET_64BIT && ix86_pre_reload_split ()"
19794 : 1309742 : [(set (match_dup 3)
19795 : 292166 : (minus:DI (const_int 63) (clz:DI (match_dup 1))))
19796 : 290209 : (set (match_dup 0)
19797 : 290286 : (plus:SI (match_dup 5) (match_dup 4)))]
19798 : 477116 : {
19799 : 477140 : operands[3] = gen_reg_rtx (DImode);
19800 : 476202 : operands[5] = lowpart_subreg (SImode, operands[3], DImode);
19801 : 477379 : if (INTVAL (operands[2]) == 63)
19802 : 473942 : {
19803 : 475940 : emit_insn (gen_bsr_rex64_1_zext (operands[3], operands[1]));
19804 : 476613 : emit_move_insn (operands[0], operands[5]);
19805 : 291084 : DONE;
19806 : 289904 : }
19807 : 291645 : operands[4] = gen_int_mode (UINTVAL (operands[2]) - 63, SImode);
19808 : 389066 : })
19809 : 290062 :
19810 : 290036 : (define_split
19811 : 291619 : [(set (match_operand:SI 0 "register_operand")
19812 : 291481 : (minus:SI
19813 : 291378 : (match_operand:SI 2 "const_int_operand")
19814 : 291481 : (xor:SI
19815 : 293767 : (minus:SI (const_int 31)
19816 : 291481 : (clz:SI (match_operand:SI 1 "nonimmediate_operand")))
19817 : 293795 : (const_int 31))))]
19818 : 294841 : "!TARGET_LZCNT && ix86_pre_reload_split ()"
19819 : 293664 : [(set (match_dup 3)
19820 : 294841 : (minus:SI (const_int 31) (clz:SI (match_dup 1))))
19821 : 293664 : (set (match_dup 0)
19822 : 293795 : (plus:SI (match_dup 3) (match_dup 4)))]
19823 : 291378 : {
19824 : 293498 : if (INTVAL (operands[2]) == 31)
19825 : 289904 : {
19826 : 292404 : emit_insn (gen_bsr_1 (operands[0], operands[1]));
19827 : 290118 : DONE;
19828 : 291509 : }
19829 : 291088 : operands[3] = gen_reg_rtx (SImode);
19830 : 291219 : operands[4] = gen_int_mode (UINTVAL (operands[2]) - 31, SImode);
19831 : 289949 : })
19832 : 291520 :
19833 : 291378 : (define_split
19834 : 291423 : [(set (match_operand:DI 0 "register_operand")
19835 : 291094 : (minus:DI
19836 : 291088 : (match_operand:DI 2 "const_int_operand")
19837 : 291129 : (xor:DI
19838 : 290927 : (sign_extend:DI
19839 : 290886 : (minus:SI (const_int 63)
19840 : 292233 : (subreg:SI
19841 : 291097 : (clz:DI (match_operand:DI 1 "nonimmediate_operand"))
19842 : 292274 : 0)))
19843 : 292274 : (const_int 63))))]
19844 : 291019 : "!TARGET_LZCNT
19845 : 291135 : && TARGET_64BIT
19846 : 291157 : && ix86_pre_reload_split ()
19847 : 291157 : && ((unsigned HOST_WIDE_INT)
19848 : 291132 : trunc_int_for_mode (UINTVAL (operands[2]) - 63, SImode)
19849 : 291133 : == UINTVAL (operands[2]) - 63)"
19850 : 291134 : [(set (match_dup 3)
19851 : 289773 : (minus:DI (const_int 63) (clz:DI (match_dup 1))))
19852 : 289736 : (set (match_dup 0)
19853 : 291074 : (plus:DI (match_dup 3) (match_dup 4)))]
19854 : 291111 : {
19855 : 291111 : if (INTVAL (operands[2]) == 63)
19856 : 289935 : {
19857 : 294149 : emit_insn (gen_bsr_rex64_1 (operands[0], operands[1]));
19858 : 294149 : DONE;
19859 : 289895 : }
19860 : 292755 : operands[3] = gen_reg_rtx (DImode);
19861 : 292578 : operands[4] = GEN_INT (UINTVAL (operands[2]) - 63);
19862 : 292725 : })
19863 : 289928 :
19864 : 289935 : (define_split
19865 : 289857 : [(set (match_operand:DI 0 "register_operand")
19866 : 290034 : (minus:DI
19867 : 290027 : (match_operand:DI 2 "const_int_operand")
19868 : 290034 : (sign_extend:DI
19869 : 290008 : (xor:SI
19870 : 289858 : (minus:SI (const_int 31)
19871 : 289895 : (clz:SI (match_operand:SI 1 "nonimmediate_operand")))
19872 : 290004 : (const_int 31)))))]
19873 : 289992 : "!TARGET_LZCNT
19874 : 290146 : && TARGET_64BIT
19875 : 290028 : && ix86_pre_reload_split ()
19876 : 290115 : && ((unsigned HOST_WIDE_INT)
19877 : 290120 : trunc_int_for_mode (UINTVAL (operands[2]) - 31, SImode)
19878 : 290075 : == UINTVAL (operands[2]) - 31)"
19879 : 290070 : [(set (match_dup 3)
19880 : 290068 : (zero_extend:DI (minus:SI (const_int 31) (clz:SI (match_dup 1)))))
19881 : 289997 : (set (match_dup 0)
19882 : 290037 : (plus:DI (match_dup 3) (match_dup 4)))]
19883 : 290042 : {
19884 : 290089 : if (INTVAL (operands[2]) == 31)
19885 : 290084 : {
19886 : 290085 : emit_insn (gen_bsr_zext_1 (operands[0], operands[1]));
19887 : 290059 : DONE;
19888 : 17279585 : }
19889 : 290062 : operands[3] = gen_reg_rtx (DImode);
19890 : 17279650 : operands[4] = GEN_INT (UINTVAL (operands[2]) - 31);
19891 : 17279646 : })
19892 : 17279651 :
19893 : 17279646 : (define_expand "clz<mode>2"
19894 : 17279655 : [(parallel
19895 : 17279655 : [(set (reg:CCZ FLAGS_REG)
19896 : 17279655 : (compare:CCZ (match_operand:SWI48 1 "nonimmediate_operand" "rm")
19897 : 290067 : (const_int 0)))
19898 : 12369641 : (set (match_dup 3) (minus:SWI48
19899 : 12369660 : (match_dup 2)
19900 : 12369656 : (clz:SWI48 (match_dup 1))))])
19901 : 12369651 : (parallel
19902 : 290042 : [(set (match_operand:SWI48 0 "register_operand")
19903 : 12369655 : (xor:SWI48 (match_dup 3) (match_dup 2)))
19904 : 12079981 : (clobber (reg:CC FLAGS_REG))])]
19905 : 363 : ""
19906 : 296455 : {
19907 : 12086349 : if (TARGET_LZCNT)
19908 : 12369605 : {
19909 : 290064 : emit_insn (gen_clz<mode>2_lzcnt (operands[0], operands[1]));
19910 : 296130 : DONE;
19911 : 6425 : }
19912 : 308881 : operands[2] = GEN_INT (GET_MODE_BITSIZE (<MODE>mode)-1);
19913 : 302450 : operands[3] = gen_reg_rtx (<MODE>mode);
19914 : 290041 : })
19915 : 294027 :
19916 : 294027 : (define_insn_and_split "clz<mode>2_lzcnt"
19917 : 6714 : [(set (match_operand:SWI48 0 "register_operand" "=r")
19918 : 300414 : (clz:SWI48
19919 : 300414 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")))
19920 : 296428 : (clobber (reg:CC FLAGS_REG))]
19921 : 303361 : "TARGET_LZCNT"
19922 : 296465 : "lzcnt{<imodesuffix>}\t{%1, %0|%0, %1}"
19923 : 296473 : "&& TARGET_AVOID_FALSE_DEP_FOR_BMI && epilogue_completed
19924 : 299070 : && optimize_function_for_speed_p (cfun)
19925 : 292668 : && !reg_mentioned_p (operands[0], operands[1])"
19926 : 296499 : [(parallel
19927 : 381592904 : [(set (match_dup 0)
19928 : 292600 : (clz:SWI48 (match_dup 1)))
19929 : 381599969 : (unspec [(match_dup 0)] UNSPEC_INSN_FALSE_DEP)
19930 : 381592975 : (clobber (reg:CC FLAGS_REG))])]
19931 : 292606 : "ix86_expand_clear (operands[0]);"
19932 : 381300674 : [(set_attr "prefix_rep" "1")
19933 : 505685 : (set_attr "type" "bitmanip")
19934 : 816511 : (set_attr "mode" "<MODE>")])
19935 : 311149 :
19936 : 429833 : ; False dependency happens when destination is only updated by tzcnt,
19937 : 408740 : ; lzcnt or popcnt. There is no false dependency when destination is
19938 : 296447 : ; also used in source.
19939 : 363996 : (define_insn "*clz<mode>2_lzcnt_falsedep"
19940 : 363955 : [(set (match_operand:SWI48 0 "register_operand" "=r")
19941 : 363984 : (clz:SWI48
19942 : 363984 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")))
19943 : 363984 : (unspec [(match_operand:SWI48 2 "register_operand" "0")]
19944 : 1280425 : UNSPEC_INSN_FALSE_DEP)
19945 : 1287163 : (clobber (reg:CC FLAGS_REG))]
19946 : 296735 : "TARGET_LZCNT"
19947 : 1286857 : "lzcnt{<imodesuffix>}\t{%1, %0|%0, %1}"
19948 : 290108 : [(set_attr "prefix_rep" "1")
19949 : 290044 : (set_attr "type" "bitmanip")
19950 : 1280261 : (set_attr "mode" "<MODE>")])
19951 : 289929 :
19952 : 293754 : (define_insn_and_split "*clzsi2_lzcnt_zext"
19953 : 289942 : [(set (match_operand:DI 0 "register_operand" "=r")
19954 : 289808 : (and:DI
19955 : 293733 : (subreg:DI
19956 : 293760 : (clz:SI
19957 : 293749 : (match_operand:SI 1 "nonimmediate_operand" "rm")) 0)
19958 : 293557 : (const_int 63)))
19959 : 289935 : (clobber (reg:CC FLAGS_REG))]
19960 : 289958 : "TARGET_LZCNT && TARGET_64BIT"
19961 : 289942 : "lzcnt{l}\t{%1, %k0|%k0, %1}"
19962 : 293770 : "&& TARGET_AVOID_FALSE_DEP_FOR_BMI && epilogue_completed
19963 : 289897 : && optimize_function_for_speed_p (cfun)
19964 : 289935 : && !reg_mentioned_p (operands[0], operands[1])"
19965 : 289947 : [(parallel
19966 : 289931 : [(set (match_dup 0)
19967 : 289735 : (and:DI (subreg:DI (clz:SI (match_dup 1)) 0) (const_int 63)))
19968 : 289739 : (unspec [(match_dup 0)] UNSPEC_INSN_FALSE_DEP)
19969 : 290018 : (clobber (reg:CC FLAGS_REG))])]
19970 : 290014 : "ix86_expand_clear (operands[0]);"
19971 : 290051 : [(set_attr "prefix_rep" "1")
19972 : 289828 : (set_attr "type" "bitmanip")
19973 : 289810 : (set_attr "mode" "SI")])
19974 : 290126 :
19975 : 290126 : ; False dependency happens when destination is only updated by tzcnt,
19976 : 290126 : ; lzcnt or popcnt. There is no false dependency when destination is
19977 : 290126 : ; also used in source.
19978 : 290122 : (define_insn "*clzsi2_lzcnt_zext_falsedep"
19979 : 290122 : [(set (match_operand:DI 0 "register_operand" "=r")
19980 : 290122 : (and:DI
19981 : 290126 : (subreg:DI
19982 : 290126 : (clz:SI
19983 : 289810 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")) 0)
19984 : 289806 : (const_int 63)))
19985 : 290126 : (unspec [(match_operand:DI 2 "register_operand" "0")]
19986 : 289992 : UNSPEC_INSN_FALSE_DEP)
19987 : 289676 : (clobber (reg:CC FLAGS_REG))]
19988 : 289808 : "TARGET_LZCNT"
19989 : 290120 : "lzcnt{l}\t{%1, %k0|%k0, %1}"
19990 : 290120 : [(set_attr "prefix_rep" "1")
19991 : 290124 : (set_attr "type" "bitmanip")
19992 : 290124 : (set_attr "mode" "SI")])
19993 : 290124 :
19994 : 290120 : (define_insn_and_split "*clzsi2_lzcnt_zext_2"
19995 : 290120 : [(set (match_operand:DI 0 "register_operand" "=r")
19996 : 290120 : (zero_extend:DI
19997 : 290120 : (clz:SI (match_operand:SI 1 "nonimmediate_operand" "rm"))))
19998 : 289804 : (clobber (reg:CC FLAGS_REG))]
19999 : 289804 : "TARGET_LZCNT && TARGET_64BIT"
20000 : 290120 : "lzcnt{l}\t{%1, %k0|%k0, %1}"
20001 : 290120 : "&& TARGET_AVOID_FALSE_DEP_FOR_BMI && epilogue_completed
20002 : 290128 : && optimize_function_for_speed_p (cfun)
20003 : 290120 : && !reg_mentioned_p (operands[0], operands[1])"
20004 : 290120 : [(parallel
20005 : 290144 : [(set (match_dup 0)
20006 : 290120 : (zero_extend:DI (clz:SI (match_dup 1))))
20007 : 290140 : (unspec [(match_dup 0)] UNSPEC_INSN_FALSE_DEP)
20008 : 290010 : (clobber (reg:CC FLAGS_REG))])]
20009 : 290140 : "ix86_expand_clear (operands[0]);"
20010 : 289804 : [(set_attr "prefix_rep" "1")
20011 : 289812 : (set_attr "type" "bitmanip")
20012 : 290128 : (set_attr "mode" "SI")])
20013 : 290128 :
20014 : 290120 : ; False dependency happens when destination is only updated by tzcnt,
20015 : 289804 : ; lzcnt or popcnt. There is no false dependency when destination is
20016 : 290120 : ; also used in source.
20017 : 290120 : (define_insn "*clzsi2_lzcnt_zext_2_falsedep"
20018 : 290120 : [(set (match_operand:DI 0 "register_operand" "=r")
20019 : 289674 : (zero_extend:DI
20020 : 290120 : (clz:SI (match_operand:SWI48 1 "nonimmediate_operand" "rm"))))
20021 : 290120 : (unspec [(match_operand:DI 2 "register_operand" "0")]
20022 : 290120 : UNSPEC_INSN_FALSE_DEP)
20023 : 290120 : (clobber (reg:CC FLAGS_REG))]
20024 : 290120 : "TARGET_LZCNT"
20025 : 289990 : "lzcnt{l}\t{%1, %k0|%k0, %1}"
20026 : 290120 : [(set_attr "prefix_rep" "1")
20027 : 290120 : (set_attr "type" "bitmanip")
20028 : 446 : (set_attr "mode" "SI")])
20029 : 289804 :
20030 : 289804 : (define_int_iterator LT_ZCNT
20031 : 290434 : [(UNSPEC_TZCNT "TARGET_BMI")
20032 : 290229 : (UNSPEC_LZCNT "TARGET_LZCNT")])
20033 : 290251 :
20034 : 290251 : (define_int_attr lt_zcnt
20035 : 290242 : [(UNSPEC_TZCNT "tzcnt")
20036 : 290210 : (UNSPEC_LZCNT "lzcnt")])
20037 : 290464 :
20038 : 2227 : (define_int_attr lt_zcnt_type
20039 : 461 : [(UNSPEC_TZCNT "alu1")
20040 : 289902 : (UNSPEC_LZCNT "bitmanip")])
20041 : 289887 :
20042 : 300516 : ;; Version of lzcnt/tzcnt that is expanded from intrinsics. This version
20043 : 11143 : ;; provides operand size as output when source operand is zero.
20044 : 290160 :
20045 : 300200 : (define_insn_and_split "<lt_zcnt>_<mode>"
20046 : 300218 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20047 : 300182 : (unspec:SWI48
20048 : 290120 : [(match_operand:SWI48 1 "nonimmediate_operand" "rm")] LT_ZCNT))
20049 : 290316 : (clobber (reg:CC FLAGS_REG))]
20050 : 290316 : ""
20051 : 290120 : "<lt_zcnt>{<imodesuffix>}\t{%1, %0|%0, %1}"
20052 : 290332 : "&& TARGET_AVOID_FALSE_DEP_FOR_BMI && epilogue_completed
20053 : 290175 : && optimize_function_for_speed_p (cfun)
20054 : 290175 : && !reg_mentioned_p (operands[0], operands[1])"
20055 : 290153 : [(parallel
20056 : 290175 : [(set (match_dup 0)
20057 : 290120 : (unspec:SWI48 [(match_dup 1)] LT_ZCNT))
20058 : 290321 : (unspec [(match_dup 0)] UNSPEC_INSN_FALSE_DEP)
20059 : 290005 : (clobber (reg:CC FLAGS_REG))])]
20060 : 290175 : "ix86_expand_clear (operands[0]);"
20061 : 290120 : [(set_attr "type" "<lt_zcnt_type>")
20062 : 290386 : (set_attr "prefix_0f" "1")
20063 : 290441 : (set_attr "prefix_rep" "1")
20064 : 185 : (set_attr "mode" "<MODE>")])
20065 : 599 :
20066 : 290273 : ; False dependency happens when destination is only updated by tzcnt,
20067 : 290604 : ; lzcnt or popcnt. There is no false dependency when destination is
20068 : 290233 : ; also used in source.
20069 : 446 : (define_insn "*<lt_zcnt>_<mode>_falsedep"
20070 : 290507 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20071 : 290507 : (unspec:SWI48
20072 : 290191 : [(match_operand:SWI48 1 "nonimmediate_operand" "rm")] LT_ZCNT))
20073 : 290507 : (unspec [(match_operand:SWI48 2 "register_operand" "0")]
20074 : 290120 : UNSPEC_INSN_FALSE_DEP)
20075 : 290497 : (clobber (reg:CC FLAGS_REG))]
20076 : 290497 : ""
20077 : 290497 : "<lt_zcnt>{<imodesuffix>}\t{%1, %0|%0, %1}"
20078 : 290497 : [(set_attr "type" "<lt_zcnt_type>")
20079 : 290552 : (set_attr "prefix_0f" "1")
20080 : 501 : (set_attr "prefix_rep" "1")
20081 : 694 : (set_attr "mode" "<MODE>")])
20082 : 290506 :
20083 : 289804 : (define_insn "<lt_zcnt>_hi"
20084 : 289804 : [(set (match_operand:HI 0 "register_operand" "=r")
20085 : 290120 : (unspec:HI
20086 : 290157 : [(match_operand:HI 1 "nonimmediate_operand" "rm")] LT_ZCNT))
20087 : 290160 : (clobber (reg:CC FLAGS_REG))]
20088 : 290120 : ""
20089 : 290160 : "<lt_zcnt>{w}\t{%1, %0|%0, %1}"
20090 : 290197 : [(set_attr "type" "<lt_zcnt_type>")
20091 : 290197 : (set_attr "prefix_0f" "1")
20092 : 290197 : (set_attr "prefix_rep" "1")
20093 : 290120 : (set_attr "mode" "HI")])
20094 : 290160 :
20095 : 290157 : ;; BMI instructions.
20096 : 290157 :
20097 : 290157 : (define_insn "bmi_bextr_<mode>"
20098 : 290120 : [(set (match_operand:SWI48 0 "register_operand" "=r,r")
20099 : 290120 : (unspec:SWI48 [(match_operand:SWI48 1 "nonimmediate_operand" "r,m")
20100 : 290120 : (match_operand:SWI48 2 "register_operand" "r,r")]
20101 : 290120 : UNSPEC_BEXTR))
20102 : 290120 : (clobber (reg:CC FLAGS_REG))]
20103 : 290314 : "TARGET_BMI"
20104 : 759 : "bextr\t{%2, %1, %0|%0, %1, %2}"
20105 : 810 : [(set_attr "type" "bitmanip")
20106 : 290484 : (set_attr "btver2_decode" "direct, double")
20107 : 290596 : (set_attr "mode" "<MODE>")])
20108 : 290596 :
20109 : 1008 : (define_insn "*bmi_bextr_<mode>_ccz"
20110 : 290519 : [(set (reg:CCZ FLAGS_REG)
20111 : 759 : (compare:CCZ
20112 : 290433 : (unspec:SWI48 [(match_operand:SWI48 1 "nonimmediate_operand" "r,m")
20113 : 290433 : (match_operand:SWI48 2 "register_operand" "r,r")]
20114 : 290433 : UNSPEC_BEXTR)
20115 : 290433 : (const_int 0)))
20116 : 290433 : (clobber (match_scratch:SWI48 0 "=r,r"))]
20117 : 290436 : "TARGET_BMI"
20118 : 290433 : "bextr\t{%2, %1, %0|%0, %1, %2}"
20119 : 289806 : [(set_attr "type" "bitmanip")
20120 : 761 : (set_attr "btver2_decode" "direct, double")
20121 : 290433 : (set_attr "mode" "<MODE>")])
20122 : 290433 :
20123 : 289804 : (define_insn "*bmi_blsi_<mode>"
20124 : 759 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20125 : 290433 : (and:SWI48
20126 : 290433 : (neg:SWI48
20127 : 289804 : (match_operand:SWI48 1 "nonimmediate_operand" "rm"))
20128 : 759 : (match_dup 1)))
20129 : 290433 : (clobber (reg:CC FLAGS_REG))]
20130 : 290644 : "TARGET_BMI"
20131 : 290433 : "blsi\t{%1, %0|%0, %1}"
20132 : 759 : [(set_attr "type" "bitmanip")
20133 : 290433 : (set_attr "btver2_decode" "double")
20134 : 290638 : (set_attr "mode" "<MODE>")])
20135 : 290638 :
20136 : 1185 : (define_insn "*bmi_blsi_<mode>_cmp"
20137 : 290654 : [(set (reg FLAGS_REG)
20138 : 290433 : (compare
20139 : 290340 : (and:SWI48
20140 : 722 : (neg:SWI48 (match_operand:SWI48 1 "nonimmediate_operand" "rm"))
20141 : 290396 : (match_dup 1))
20142 : 290396 : (const_int 0)))
20143 : 290396 : (set (match_operand:SWI48 0 "register_operand" "=r")
20144 : 722 : (and:SWI48 (neg:SWI48 (match_dup 1)) (match_dup 1)))]
20145 : 290396 : "TARGET_BMI && ix86_match_ccmode (insn, CCNOmode)"
20146 : 290396 : "blsi\t{%1, %0|%0, %1}"
20147 : 290396 : [(set_attr "type" "bitmanip")
20148 : 290396 : (set_attr "btver2_decode" "double")
20149 : 290396 : (set_attr "mode" "<MODE>")])
20150 : 722 :
20151 : 290396 : (define_insn "*bmi_blsi_<mode>_ccno"
20152 : 290396 : [(set (reg FLAGS_REG)
20153 : 290396 : (compare
20154 : 290396 : (and:SWI48
20155 : 290396 : (neg:SWI48 (match_operand:SWI48 1 "nonimmediate_operand" "rm"))
20156 : 290396 : (match_dup 1))
20157 : 290396 : (const_int 0)))
20158 : 290396 : (clobber (match_scratch:SWI48 0 "=r"))]
20159 : 290319 : "TARGET_BMI && ix86_match_ccmode (insn, CCNOmode)"
20160 : 290396 : "blsi\t{%1, %0|%0, %1}"
20161 : 290402 : [(set_attr "type" "bitmanip")
20162 : 290402 : (set_attr "btver2_decode" "double")
20163 : 290305 : (set_attr "mode" "<MODE>")])
20164 : 290400 :
20165 : 290400 : (define_insn "*bmi_blsmsk_<mode>"
20166 : 290396 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20167 : 290303 : (xor:SWI48
20168 : 290396 : (plus:SWI48
20169 : 290396 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20170 : 290396 : (const_int -1))
20171 : 290396 : (match_dup 1)))
20172 : 290396 : (clobber (reg:CC FLAGS_REG))]
20173 : 290479 : "TARGET_BMI"
20174 : 290396 : "blsmsk\t{%1, %0|%0, %1}"
20175 : 290396 : [(set_attr "type" "bitmanip")
20176 : 290396 : (set_attr "btver2_decode" "double")
20177 : 290463 : (set_attr "mode" "<MODE>")])
20178 : 290463 :
20179 : 290471 : (define_insn "*bmi_blsr_<mode>"
20180 : 290404 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20181 : 290396 : (and:SWI48
20182 : 290396 : (plus:SWI48
20183 : 290396 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20184 : 290396 : (const_int -1))
20185 : 290396 : (match_dup 1)))
20186 : 290396 : (clobber (reg:CC FLAGS_REG))]
20187 : 291881 : "TARGET_BMI"
20188 : 290396 : "blsr\t{%1, %0|%0, %1}"
20189 : 290396 : [(set_attr "type" "bitmanip")
20190 : 290303 : (set_attr "btver2_decode" "double")
20191 : 291138 : (set_attr "mode" "<MODE>")])
20192 : 291138 :
20193 : 291557 : (define_insn "*bmi_blsr_<mode>_cmp"
20194 : 290415 : [(set (reg:CCZ FLAGS_REG)
20195 : 290415 : (compare:CCZ
20196 : 290415 : (and:SWI48
20197 : 290415 : (plus:SWI48
20198 : 290415 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20199 : 290415 : (const_int -1))
20200 : 290415 : (match_dup 1))
20201 : 290415 : (const_int 0)))
20202 : 290415 : (set (match_operand:SWI48 0 "register_operand" "=r")
20203 : 290415 : (and:SWI48
20204 : 289987 : (plus:SWI48
20205 : 290102 : (match_dup 1)
20206 : 289786 : (const_int -1))
20207 : 289786 : (match_dup 1)))]
20208 : 290022 : "TARGET_BMI"
20209 : 289990 : "blsr\t{%1, %0|%0, %1}"
20210 : 289990 : [(set_attr "type" "bitmanip")
20211 : 289990 : (set_attr "btver2_decode" "double")
20212 : 290034 : (set_attr "mode" "<MODE>")])
20213 : 290034 :
20214 : 289990 : (define_insn "*bmi_blsr_<mode>_ccz"
20215 : 289990 : [(set (reg:CCZ FLAGS_REG)
20216 : 289990 : (compare:CCZ
20217 : 290002 : (and:SWI48
20218 : 290002 : (plus:SWI48
20219 : 290002 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20220 : 290002 : (const_int -1))
20221 : 290002 : (match_dup 1))
20222 : 290002 : (const_int 0)))
20223 : 289686 : (clobber (match_scratch:SWI48 0 "=r"))]
20224 : 290377 : "TARGET_BMI"
20225 : 289990 : "blsr\t{%1, %0|%0, %1}"
20226 : 289990 : [(set_attr "type" "bitmanip")
20227 : 289990 : (set_attr "btver2_decode" "double")
20228 : 289990 : (set_attr "mode" "<MODE>")])
20229 : 289990 :
20230 : 290527 : ;; BMI2 instructions.
20231 : 289990 : (define_expand "bmi2_bzhi_<mode>3"
20232 : 290008 : [(parallel
20233 : 290008 : [(set (match_operand:SWI48 0 "register_operand")
20234 : 290008 : (if_then_else:SWI48
20235 : 290008 : (ne:QI (match_operand:QI 2 "register_operand")
20236 : 290008 : (const_int 0))
20237 : 290008 : (zero_extract:SWI48
20238 : 290008 : (match_operand:SWI48 1 "nonimmediate_operand")
20239 : 334 : (umin:QI (match_dup 2) (match_dup 3))
20240 : 290008 : (const_int 0))
20241 : 290008 : (const_int 0)))
20242 : 334 : (clobber (reg:CC FLAGS_REG))])]
20243 : 334 : "TARGET_BMI2"
20244 : 290074 : {
20245 : 289729 : operands[2] = gen_lowpart (QImode, operands[2]);
20246 : 289758 : operands[3] = GEN_INT (<MODE_SIZE> * BITS_PER_UNIT);
20247 : 289990 : })
20248 : 289990 :
20249 : 289990 : (define_insn "*bmi2_bzhi_<mode>3"
20250 : 289740 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20251 : 290056 : (if_then_else:SWI48
20252 : 290056 : (ne:QI (match_operand:QI 2 "register_operand" "q")
20253 : 382 : (const_int 0))
20254 : 382 : (zero_extract:SWI48
20255 : 290056 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20256 : 290056 : (umin:QI (match_dup 2)
20257 : 290056 : (match_operand:QI 3 "const_int_operand"))
20258 : 289990 : (const_int 0))
20259 : 290056 : (const_int 0)))
20260 : 289990 : (clobber (reg:CC FLAGS_REG))]
20261 : 289933 : "TARGET_BMI2 && INTVAL (operands[3]) == <MODE_SIZE> * BITS_PER_UNIT"
20262 : 289990 : "bzhi\t{%<k>2, %1, %0|%0, %1, %<k>2}"
20263 : 290029 : [(set_attr "type" "bitmanip")
20264 : 355 : (set_attr "prefix" "vex")
20265 : 398 : (set_attr "mode" "<MODE>")])
20266 : 290072 :
20267 : 290194 : (define_insn "*bmi2_bzhi_<mode>3_1_ccz"
20268 : 290070 : [(set (reg:CCZ FLAGS_REG)
20269 : 289990 : (compare:CCZ
20270 : 289990 : (if_then_else:SWI48
20271 : 289990 : (ne:QI (match_operand:QI 2 "register_operand" "r") (const_int 0))
20272 : 289990 : (zero_extract:SWI48
20273 : 289990 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20274 : 290106 : (umin:QI (match_dup 2)
20275 : 290106 : (match_operand:QI 3 "const_int_operand"))
20276 : 290106 : (const_int 0))
20277 : 289990 : (const_int 0))
20278 : 290040 : (const_int 0)))
20279 : 290042 : (clobber (match_scratch:SWI48 0 "=r"))]
20280 : 290045 : "TARGET_BMI2 && INTVAL (operands[3]) == <MODE_SIZE> * BITS_PER_UNIT"
20281 : 290019 : "bzhi\t{%<k>2, %1, %0|%0, %1, %<k>2}"
20282 : 290076 : [(set_attr "type" "bitmanip")
20283 : 290044 : (set_attr "prefix" "vex")
20284 : 290074 : (set_attr "mode" "<MODE>")])
20285 : 290103 :
20286 : 290103 : (define_insn "*bmi2_bzhi_<mode>3_2"
20287 : 290103 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20288 : 290042 : (and:SWI48
20289 : 290074 : (plus:SWI48
20290 : 290071 : (ashift:SWI48 (const_int 1)
20291 : 290071 : (match_operand:QI 2 "register_operand" "r"))
20292 : 290071 : (const_int -1))
20293 : 290042 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")))
20294 : 290042 : (clobber (reg:CC FLAGS_REG))]
20295 : 290095 : "TARGET_BMI2"
20296 : 290042 : "bzhi\t{%<k>2, %1, %0|%0, %1, %<k>2}"
20297 : 290042 : [(set_attr "type" "bitmanip")
20298 : 290042 : (set_attr "prefix" "vex")
20299 : 290046 : (set_attr "mode" "<MODE>")])
20300 : 290046 :
20301 : 290050 : (define_insn "*bmi2_bzhi_<mode>3_3"
20302 : 290106 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20303 : 290106 : (and:SWI48
20304 : 290106 : (not:SWI48
20305 : 289992 : (ashift:SWI48 (const_int -1)
20306 : 290104 : (match_operand:QI 2 "register_operand" "r")))
20307 : 290104 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")))
20308 : 290104 : (clobber (reg:CC FLAGS_REG))]
20309 : 290779 : "TARGET_BMI2"
20310 : 290104 : "bzhi\t{%<k>2, %1, %0|%0, %1, %<k>2}"
20311 : 290104 : [(set_attr "type" "bitmanip")
20312 : 290104 : (set_attr "prefix" "vex")
20313 : 290298 : (set_attr "mode" "<MODE>")])
20314 : 290298 :
20315 : 290429 : (define_insn "*bmi2_bzhi_zero_extendsidi_4"
20316 : 290104 : [(set (match_operand:DI 0 "register_operand" "=r")
20317 : 290104 : (zero_extend:DI
20318 : 290104 : (and:SI
20319 : 290104 : (plus:SI
20320 : 290104 : (ashift:SI (const_int 1)
20321 : 290104 : (match_operand:QI 2 "register_operand" "r"))
20322 : 290104 : (const_int -1))
20323 : 290104 : (match_operand:SI 1 "nonimmediate_operand" "rm"))))
20324 : 290306 : (clobber (reg:CC FLAGS_REG))]
20325 : 290306 : "TARGET_64BIT && TARGET_BMI2"
20326 : 290306 : "bzhi\t{%q2, %q1, %q0|%q0, %q1, %q2}"
20327 : 290306 : [(set_attr "type" "bitmanip")
20328 : 290306 : (set_attr "prefix" "vex")
20329 : 290306 : (set_attr "mode" "DI")])
20330 : 290077 :
20331 : 290265 : (define_insn "*bmi2_bzhi_zero_extendsidi_5"
20332 : 290242 : [(set (match_operand:DI 0 "register_operand" "=r")
20333 : 293941 : (and:DI
20334 : 293939 : (zero_extend:DI
20335 : 294065 : (plus:SI
20336 : 290244 : (ashift:SI (const_int 1)
20337 : 290244 : (match_operand:QI 2 "register_operand" "r"))
20338 : 290244 : (const_int -1)))
20339 : 290244 : (match_operand:DI 1 "nonimmediate_operand" "rm")))
20340 : 290242 : (clobber (reg:CC FLAGS_REG))]
20341 : 290242 : "TARGET_64BIT && TARGET_BMI2"
20342 : 290242 : "bzhi\t{%q2, %q1, %q0|%q0, %q1, %q2}"
20343 : 290040 : [(set_attr "type" "bitmanip")
20344 : 290192 : (set_attr "prefix" "vex")
20345 : 290192 : (set_attr "mode" "DI")])
20346 : 311600 :
20347 : 311600 : (define_insn "bmi2_pdep_<mode>3"
20348 : 290192 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20349 : 306612 : (unspec:SWI48 [(match_operand:SWI48 1 "register_operand" "r")
20350 : 306612 : (match_operand:SWI48 2 "nonimmediate_operand" "rm")]
20351 : 306612 : UNSPEC_PDEP))]
20352 : 290263 : "TARGET_BMI2"
20353 : 306185 : "pdep\t{%2, %1, %0|%0, %1, %2}"
20354 : 306185 : [(set_attr "type" "bitmanip")
20355 : 680342 : (set_attr "prefix" "vex")
20356 : 680419 : (set_attr "mode" "<MODE>")])
20357 : 306318 :
20358 : 664203 : (define_insn "bmi2_pext_<mode>3"
20359 : 674884 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20360 : 674884 : (unspec:SWI48 [(match_operand:SWI48 1 "register_operand" "r")
20361 : 300727 : (match_operand:SWI48 2 "nonimmediate_operand" "rm")]
20362 : 674884 : UNSPEC_PEXT))]
20363 : 290118 : "TARGET_BMI2"
20364 : 298713 : "pext\t{%2, %1, %0|%0, %1, %2}"
20365 : 583453 : [(set_attr "type" "bitmanip")
20366 : 290854 : (set_attr "prefix" "vex")
20367 : 583530 : (set_attr "mode" "<MODE>")])
20368 : 583530 :
20369 : 290046 : ;; TBM instructions.
20370 : 290093 : (define_insn "@tbm_bextri_<mode>"
20371 : 290093 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20372 : 290006 : (zero_extract:SWI48
20373 : 290006 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20374 : 290006 : (match_operand:QI 2 "const_0_to_255_operand")
20375 : 290006 : (match_operand:QI 3 "const_0_to_255_operand")))
20376 : 290006 : (clobber (reg:CC FLAGS_REG))]
20377 : 340681 : "TARGET_TBM"
20378 : 290022 : {
20379 : 290093 : operands[2] = GEN_INT (INTVAL (operands[2]) << 8 | INTVAL (operands[3]));
20380 : 290107 : return "bextr\t{%2, %1, %0|%0, %1, %2}";
20381 : 303935 : }
20382 : 303935 : [(set_attr "type" "bitmanip")
20383 : 340548 : (set_attr "mode" "<MODE>")])
20384 : 290006 :
20385 : 290119 : (define_insn "*tbm_blcfill_<mode>"
20386 : 290072 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20387 : 290072 : (and:SWI48
20388 : 290072 : (plus:SWI48
20389 : 290072 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20390 : 290072 : (const_int 1))
20391 : 290072 : (match_dup 1)))
20392 : 290072 : (clobber (reg:CC FLAGS_REG))]
20393 : 290308 : "TARGET_TBM"
20394 : 289990 : "blcfill\t{%1, %0|%0, %1}"
20395 : 289724 : [(set_attr "type" "bitmanip")
20396 : 289940 : (set_attr "mode" "<MODE>")])
20397 : 290208 :
20398 : 290208 : (define_insn "*tbm_blci_<mode>"
20399 : 290326 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20400 : 289940 : (ior:SWI48
20401 : 289940 : (not:SWI48
20402 : 289940 : (plus:SWI48
20403 : 289940 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20404 : 289945 : (const_int 1)))
20405 : 289945 : (match_dup 1)))
20406 : 289679 : (clobber (reg:CC FLAGS_REG))]
20407 : 289940 : "TARGET_TBM"
20408 : 289940 : "blci\t{%1, %0|%0, %1}"
20409 : 289940 : [(set_attr "type" "bitmanip")
20410 : 289940 : (set_attr "mode" "<MODE>")])
20411 : 289940 :
20412 : 289940 : (define_insn "*tbm_blcic_<mode>"
20413 : 289940 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20414 : 289940 : (and:SWI48
20415 : 289940 : (plus:SWI48
20416 : 289940 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20417 : 289940 : (const_int 1))
20418 : 289940 : (not:SWI48
20419 : 289940 : (match_dup 1))))
20420 : 289940 : (clobber (reg:CC FLAGS_REG))]
20421 : 289960 : "TARGET_TBM"
20422 : 289940 : "blcic\t{%1, %0|%0, %1}"
20423 : 289940 : [(set_attr "type" "bitmanip")
20424 : 289952 : (set_attr "mode" "<MODE>")])
20425 : 289750 :
20426 : 290016 : (define_insn "*tbm_blcmsk_<mode>"
20427 : 290016 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20428 : 289952 : (xor:SWI48
20429 : 289686 : (plus:SWI48
20430 : 289940 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20431 : 289940 : (const_int 1))
20432 : 289940 : (match_dup 1)))
20433 : 289952 : (clobber (reg:CC FLAGS_REG))]
20434 : 289984 : "TARGET_TBM"
20435 : 289952 : "blcmsk\t{%1, %0|%0, %1}"
20436 : 289952 : [(set_attr "type" "bitmanip")
20437 : 289952 : (set_attr "mode" "<MODE>")])
20438 : 289985 :
20439 : 289973 : (define_insn "*tbm_blcs_<mode>"
20440 : 289973 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20441 : 289943 : (ior:SWI48
20442 : 289677 : (plus:SWI48
20443 : 289677 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20444 : 289940 : (const_int 1))
20445 : 289940 : (match_dup 1)))
20446 : 289940 : (clobber (reg:CC FLAGS_REG))]
20447 : 289707 : "TARGET_TBM"
20448 : 289940 : "blcs\t{%1, %0|%0, %1}"
20449 : 289940 : [(set_attr "type" "bitmanip")
20450 : 289940 : (set_attr "mode" "<MODE>")])
20451 : 289708 :
20452 : 289972 : (define_insn "*tbm_blsfill_<mode>"
20453 : 289942 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20454 : 289940 : (ior:SWI48
20455 : 289940 : (plus:SWI48
20456 : 289940 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20457 : 289674 : (const_int -1))
20458 : 289940 : (match_dup 1)))
20459 : 289940 : (clobber (reg:CC FLAGS_REG))]
20460 : 289997 : "TARGET_TBM"
20461 : 289940 : "blsfill\t{%1, %0|%0, %1}"
20462 : 289940 : [(set_attr "type" "bitmanip")
20463 : 289940 : (set_attr "mode" "<MODE>")])
20464 : 290184 :
20465 : 290184 : (define_insn "*tbm_blsic_<mode>"
20466 : 290215 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20467 : 289940 : (ior:SWI48
20468 : 289940 : (plus:SWI48
20469 : 289940 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20470 : 289940 : (const_int -1))
20471 : 289940 : (not:SWI48
20472 : 289940 : (match_dup 1))))
20473 : 289940 : (clobber (reg:CC FLAGS_REG))]
20474 : 289960 : "TARGET_TBM"
20475 : 289940 : "blsic\t{%1, %0|%0, %1}"
20476 : 289940 : [(set_attr "type" "bitmanip")
20477 : 289940 : (set_attr "mode" "<MODE>")])
20478 : 289960 :
20479 : 289960 : (define_insn "*tbm_t1mskc_<mode>"
20480 : 289940 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20481 : 289940 : (ior:SWI48
20482 : 289940 : (plus:SWI48
20483 : 289940 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20484 : 289940 : (const_int 1))
20485 : 289940 : (not:SWI48
20486 : 289940 : (match_dup 1))))
20487 : 289940 : (clobber (reg:CC FLAGS_REG))]
20488 : 289960 : "TARGET_TBM"
20489 : 289940 : "t1mskc\t{%1, %0|%0, %1}"
20490 : 289940 : [(set_attr "type" "bitmanip")
20491 : 289940 : (set_attr "mode" "<MODE>")])
20492 : 289960 :
20493 : 289964 : (define_insn "*tbm_tzmsk_<mode>"
20494 : 289944 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20495 : 289944 : (and:SWI48
20496 : 289944 : (plus:SWI48
20497 : 289678 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")
20498 : 289940 : (const_int -1))
20499 : 289940 : (not:SWI48
20500 : 289940 : (match_dup 1))))
20501 : 289940 : (clobber (reg:CC FLAGS_REG))]
20502 : 289960 : "TARGET_TBM"
20503 : 289940 : "tzmsk\t{%1, %0|%0, %1}"
20504 : 289940 : [(set_attr "type" "bitmanip")
20505 : 289940 : (set_attr "mode" "<MODE>")])
20506 : 289962 :
20507 : 289696 : (define_insn_and_split "popcount<mode>2"
20508 : 289676 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20509 : 289940 : (popcount:SWI48
20510 : 289940 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")))
20511 : 289940 : (clobber (reg:CC FLAGS_REG))]
20512 : 290343 : "TARGET_POPCNT"
20513 : 290012 : {
20514 : 290003 : #if TARGET_MACHO
20515 : 290003 : return "popcnt\t{%1, %0|%0, %1}";
20516 : 290050 : #else
20517 : 290116 : return "popcnt{<imodesuffix>}\t{%1, %0|%0, %1}";
20518 : 290112 : #endif
20519 : 289779 : }
20520 : 290177 : "&& TARGET_AVOID_FALSE_DEP_FOR_BMI && epilogue_completed
20521 : 290009 : && optimize_function_for_speed_p (cfun)
20522 : 290009 : && !reg_mentioned_p (operands[0], operands[1])"
20523 : 290301 : [(parallel
20524 : 289733 : [(set (match_dup 0)
20525 : 289940 : (popcount:SWI48 (match_dup 1)))
20526 : 290102 : (unspec [(match_dup 0)] UNSPEC_INSN_FALSE_DEP)
20527 : 290102 : (clobber (reg:CC FLAGS_REG))])]
20528 : 289999 : "ix86_expand_clear (operands[0]);"
20529 : 289940 : [(set_attr "prefix_rep" "1")
20530 : 289948 : (set_attr "type" "bitmanip")
20531 : 290007 : (set_attr "mode" "<MODE>")])
20532 : 290009 :
20533 : 289999 : ; False dependency happens when destination is only updated by tzcnt,
20534 : 289733 : ; lzcnt or popcnt. There is no false dependency when destination is
20535 : 289733 : ; also used in source.
20536 : 289940 : (define_insn "*popcount<mode>2_falsedep"
20537 : 289940 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20538 : 289940 : (popcount:SWI48
20539 : 289940 : (match_operand:SWI48 1 "nonimmediate_operand" "rm")))
20540 : 289940 : (unspec [(match_operand:SWI48 2 "register_operand" "0")]
20541 : 289940 : UNSPEC_INSN_FALSE_DEP)
20542 : 289940 : (clobber (reg:CC FLAGS_REG))]
20543 : 289972 : "TARGET_POPCNT"
20544 : 289999 : {
20545 : 289999 : #if TARGET_MACHO
20546 : 289733 : return "popcnt\t{%1, %0|%0, %1}";
20547 : 289760 : #else
20548 : 290026 : return "popcnt{<imodesuffix>}\t{%1, %0|%0, %1}";
20549 : 289940 : #endif
20550 : 289940 : }
20551 : 289940 : [(set_attr "prefix_rep" "1")
20552 : 289940 : (set_attr "type" "bitmanip")
20553 : 289971 : (set_attr "mode" "<MODE>")])
20554 : 289971 :
20555 : 289971 : (define_insn_and_split "*popcountsi2_zext"
20556 : 289971 : [(set (match_operand:DI 0 "register_operand" "=r")
20557 : 289971 : (and:DI
20558 : 289971 : (subreg:DI
20559 : 289940 : (popcount:SI
20560 : 289705 : (match_operand:SI 1 "nonimmediate_operand" "rm")) 0)
20561 : 289940 : (const_int 63)))
20562 : 289940 : (clobber (reg:CC FLAGS_REG))]
20563 : 289964 : "TARGET_POPCNT && TARGET_64BIT"
20564 : 289678 : {
20565 : 289948 : #if TARGET_MACHO
20566 : 289948 : return "popcnt\t{%1, %k0|%k0, %1}";
20567 : 289940 : #else
20568 : 289944 : return "popcnt{l}\t{%1, %k0|%k0, %1}";
20569 : 289940 : #endif
20570 : 289940 : }
20571 : 289964 : "&& TARGET_AVOID_FALSE_DEP_FOR_BMI && epilogue_completed
20572 : 289948 : && optimize_function_for_speed_p (cfun)
20573 : 417590 : && !reg_mentioned_p (operands[0], operands[1])"
20574 : 290117 : [(parallel
20575 : 290097 : [(set (match_dup 0)
20576 : 385886 : (and:DI (subreg:DI (popcount:SI (match_dup 1)) 0) (const_int 63)))
20577 : 290093 : (unspec [(match_dup 0)] UNSPEC_INSN_FALSE_DEP)
20578 : 361907 : (clobber (reg:CC FLAGS_REG))])]
20579 : 361911 : "ix86_expand_clear (operands[0]);"
20580 : 361907 : [(set_attr "prefix_rep" "1")
20581 : 367208 : (set_attr "type" "bitmanip")
20582 : 367212 : (set_attr "mode" "SI")])
20583 : 361911 :
20584 : 295398 : ; False dependency happens when destination is only updated by tzcnt,
20585 : 295398 : ; lzcnt or popcnt. There is no false dependency when destination is
20586 : 318747 : ; also used in source.
20587 : 292931 : (define_insn "*popcountsi2_zext_falsedep"
20588 : 317448 : [(set (match_operand:DI 0 "register_operand" "=r")
20589 : 292931 : (and:DI
20590 : 292931 : (subreg:DI
20591 : 292931 : (popcount:SI
20592 : 292931 : (match_operand:SI 1 "nonimmediate_operand" "rm")) 0)
20593 : 290093 : (const_int 63)))
20594 : 290336 : (unspec [(match_operand:DI 2 "register_operand" "0")]
20595 : 290336 : UNSPEC_INSN_FALSE_DEP)
20596 : 290093 : (clobber (reg:CC FLAGS_REG))]
20597 : 290229 : "TARGET_POPCNT && TARGET_64BIT"
20598 : 290097 : {
20599 : 290093 : #if TARGET_MACHO
20600 : 290097 : return "popcnt\t{%1, %k0|%k0, %1}";
20601 : 290097 : #else
20602 : 290101 : return "popcnt{l}\t{%1, %k0|%k0, %1}";
20603 : 290093 : #endif
20604 : 290093 : }
20605 : 290101 : [(set_attr "prefix_rep" "1")
20606 : 290101 : (set_attr "type" "bitmanip")
20607 : 290093 : (set_attr "mode" "SI")])
20608 : 290096 :
20609 : 290096 : (define_insn_and_split "*popcountsi2_zext_2"
20610 : 345740 : [(set (match_operand:DI 0 "register_operand" "=r")
20611 : 345740 : (zero_extend:DI
20612 : 345740 : (popcount:SI (match_operand:SI 1 "nonimmediate_operand" "rm"))))
20613 : 345740 : (clobber (reg:CC FLAGS_REG))]
20614 : 345740 : "TARGET_POPCNT && TARGET_64BIT"
20615 : 290093 : {
20616 : 325479 : #if TARGET_MACHO
20617 : 290101 : return "popcnt\t{%1, %k0|%k0, %1}";
20618 : 325486 : #else
20619 : 325486 : return "popcnt{l}\t{%1, %k0|%k0, %1}";
20620 : 325504 : #endif
20621 : 290108 : }
20622 : 290093 : "&& TARGET_AVOID_FALSE_DEP_FOR_BMI && epilogue_completed
20623 : 295537 : && optimize_function_for_speed_p (cfun)
20624 : 322993 : && !reg_mentioned_p (operands[0], operands[1])"
20625 : 313182 : [(parallel
20626 : 290093 : [(set (match_dup 0)
20627 : 294460 : (zero_extend:DI (popcount:SI (match_dup 1))))
20628 : 290093 : (unspec [(match_dup 0)] UNSPEC_INSN_FALSE_DEP)
20629 : 409208 : (clobber (reg:CC FLAGS_REG))])]
20630 : 409287 : "ix86_expand_clear (operands[0]);"
20631 : 409208 : [(set_attr "prefix_rep" "1")
20632 : 409265 : (set_attr "type" "bitmanip")
20633 : 409265 : (set_attr "mode" "SI")])
20634 : 409208 :
20635 : 409249 : ; False dependency happens when destination is only updated by tzcnt,
20636 : 290093 : ; lzcnt or popcnt. There is no false dependency when destination is
20637 : 290100 : ; also used in source.
20638 : 290107 : (define_insn "*popcountsi2_zext_2_falsedep"
20639 : 346301 : [(set (match_operand:DI 0 "register_operand" "=r")
20640 : 290093 : (zero_extend:DI
20641 : 290093 : (popcount:SI (match_operand:SI 1 "nonimmediate_operand" "rm"))))
20642 : 290093 : (unspec [(match_operand:DI 2 "register_operand" "0")]
20643 : 290093 : UNSPEC_INSN_FALSE_DEP)
20644 : 290093 : (clobber (reg:CC FLAGS_REG))]
20645 : 290093 : "TARGET_POPCNT && TARGET_64BIT"
20646 : 290093 : {
20647 : 290093 : #if TARGET_MACHO
20648 : 290093 : return "popcnt\t{%1, %k0|%k0, %1}";
20649 : 290093 : #else
20650 : 290093 : return "popcnt{l}\t{%1, %k0|%k0, %1}";
20651 : 290733 : #endif
20652 : 290733 : }
20653 : 290733 : [(set_attr "prefix_rep" "1")
20654 : 291205 : (set_attr "type" "bitmanip")
20655 : 290565 : (set_attr "mode" "SI")])
20656 : 290101 :
20657 : 290246 : (define_insn_and_split "*popcounthi2_1"
20658 : 290888 : [(set (match_operand:SI 0 "register_operand")
20659 : 436206 : (popcount:SI
20660 : 436204 : (zero_extend:SI (match_operand:HI 1 "nonimmediate_operand"))))
20661 : 436206 : (clobber (reg:CC FLAGS_REG))]
20662 : 290399 : "TARGET_POPCNT
20663 : 290097 : && ix86_pre_reload_split ()"
20664 : 290136 : "#"
20665 : 436204 : "&& 1"
20666 : 290099 : [(const_int 0)]
20667 : 290097 : {
20668 : 290095 : rtx tmp = gen_reg_rtx (HImode);
20669 : 435978 :
20670 : 435980 : emit_insn (gen_popcounthi2 (tmp, operands[1]));
20671 : 662842 : emit_insn (gen_zero_extendhisi2 (operands[0], tmp));
20672 : 516957 : DONE;
20673 : 663458 : })
20674 : 517003 :
20675 : 517001 : (define_insn_and_split "*popcounthi2_2"
20676 : 516955 : [(set (match_operand:SI 0 "register_operand")
20677 : 693035 : (zero_extend:SI
20678 : 517001 : (popcount:HI (match_operand:HI 1 "nonimmediate_operand"))))
20679 : 546268 : (clobber (reg:CC FLAGS_REG))]
20680 : 516811 : "TARGET_POPCNT
20681 : 538634 : && ix86_pre_reload_split ()"
20682 : 516870 : "#"
20683 : 546129 : "&& 1"
20684 : 546352 : [(const_int 0)]
20685 : 685034 : {
20686 : 516848 : rtx tmp = gen_reg_rtx (HImode);
20687 : 516582 :
20688 : 517258 : emit_insn (gen_popcounthi2 (tmp, operands[1]));
20689 : 516848 : emit_insn (gen_zero_extendhisi2 (operands[0], tmp));
20690 : 516802 : DONE;
20691 : 291313 : })
20692 : 290030 :
20693 : 289986 : (define_insn "popcounthi2"
20694 : 367816 : [(set (match_operand:HI 0 "register_operand" "=r")
20695 : 289984 : (popcount:HI
20696 : 289984 : (match_operand:HI 1 "nonimmediate_operand" "rm")))
20697 : 290851 : (clobber (reg:CC FLAGS_REG))]
20698 : 289957 : "TARGET_POPCNT"
20699 : 289949 : {
20700 : 289940 : #if TARGET_MACHO
20701 : 289943 : return "popcnt\t{%1, %0|%0, %1}";
20702 : 291073 : #else
20703 : 1062488 : return "popcnt{w}\t{%1, %0|%0, %1}";
20704 : 300098 : #endif
20705 : 982090 : }
20706 : 982090 : [(set_attr "prefix_rep" "1")
20707 : 300851 : (set_attr "type" "bitmanip")
20708 : 300141 : (set_attr "mode" "HI")])
20709 : 300189 :
20710 : 300141 : (define_expand "bswapdi2"
20711 : 300098 : [(set (match_operand:DI 0 "register_operand")
20712 : 969264 : (bswap:DI (match_operand:DI 1 "nonimmediate_operand")))]
20713 : 969216 : "TARGET_64BIT"
20714 : 300540 : {
20715 : 312260 : if (!TARGET_MOVBE)
20716 : 300488 : operands[1] = force_reg (DImode, operands[1]);
20717 : 300478 : })
20718 : 300430 :
20719 : 299791 : (define_expand "bswapsi2"
20720 : 300189 : [(set (match_operand:SI 0 "register_operand")
20721 : 300141 : (bswap:SI (match_operand:SI 1 "nonimmediate_operand")))]
20722 : 300141 : ""
20723 : 301889 : {
20724 : 301491 : if (TARGET_MOVBE)
20725 : 300141 : ;
20726 : 301453 : else if (TARGET_BSWAP)
20727 : 301453 : operands[1] = force_reg (SImode, operands[1]);
20728 : 300141 : else
20729 : 300141 : {
20730 : 290338 : rtx x = operands[0];
20731 : 289940 :
20732 : 290962 : emit_move_insn (x, operands[1]);
20733 : 290798 : emit_insn (gen_bswaphi_lowpart (gen_lowpart (HImode, x)));
20734 : 289940 : emit_insn (gen_rotlsi3 (x, x, GEN_INT (16)));
20735 : 289940 : emit_insn (gen_bswaphi_lowpart (gen_lowpart (HImode, x)));
20736 : 289940 : DONE;
20737 : 289941 : }
20738 : 291688 : })
20739 : 291688 :
20740 : 291688 : (define_insn "*bswap<mode>2_movbe"
20741 : 293436 : [(set (match_operand:SWI48 0 "nonimmediate_operand" "=r,r,m")
20742 : 293436 : (bswap:SWI48 (match_operand:SWI48 1 "nonimmediate_operand" "0,m,r")))]
20743 : 300965 : "TARGET_MOVBE
20744 : 291797 : && !(MEM_P (operands[0]) && MEM_P (operands[1]))"
20745 : 289940 : "@
20746 : 300196 : bswap\t%0
20747 : 297359 : movbe{<imodesuffix>}\t{%1, %0|%0, %1}
20748 : 298448 : movbe{<imodesuffix>}\t{%1, %0|%0, %1}"
20749 : 291688 : [(set_attr "type" "bitmanip,imov,imov")
20750 : 291688 : (set_attr "modrm" "0,1,1")
20751 : 291688 : (set_attr "prefix_0f" "*,1,1")
20752 : 289940 : (set_attr "prefix_extra" "*,1,1")
20753 : 289940 : (set_attr "mode" "<MODE>")])
20754 : 289940 :
20755 : 289940 : (define_insn "*bswap<mode>2"
20756 : 290096 : [(set (match_operand:SWI48 0 "register_operand" "=r")
20757 : 290078 : (bswap:SWI48 (match_operand:SWI48 1 "register_operand" "0")))]
20758 : 1772894 : "TARGET_BSWAP"
20759 : 1771502 : "bswap\t%0"
20760 : 1767416 : [(set_attr "type" "bitmanip")
20761 : 1767416 : (set_attr "modrm" "0")
20762 : 1769020 : (set_attr "mode" "<MODE>")])
20763 : 1769020 :
20764 : 1767416 : (define_expand "bswaphi2"
20765 : 1769020 : [(set (match_operand:HI 0 "register_operand")
20766 : 1769020 : (bswap:HI (match_operand:HI 1 "nonimmediate_operand")))]
20767 : 1770503 : "TARGET_MOVBE")
20768 : 1767416 :
20769 : 1767416 : (define_insn "*bswaphi2_movbe"
20770 : 1767416 : [(set (match_operand:HI 0 "nonimmediate_operand" "=Q,r,m")
20771 : 1767416 : (bswap:HI (match_operand:HI 1 "nonimmediate_operand" "0,m,r")))]
20772 : 1767464 : "TARGET_MOVBE
20773 : 1767581 : && !(MEM_P (operands[0]) && MEM_P (operands[1]))"
20774 : 1767533 : "@
20775 : 1767533 : xchg{b}\t{%h0, %b0|%b0, %h0}
20776 : 1767533 : movbe{w}\t{%1, %0|%0, %1}
20777 : 1767533 : movbe{w}\t{%1, %0|%0, %1}"
20778 : 1767533 : [(set_attr "type" "imov")
20779 : 1767533 : (set_attr "modrm" "*,1,1")
20780 : 1767533 : (set_attr "prefix_0f" "*,1,1")
20781 : 1767533 : (set_attr "prefix_extra" "*,1,1")
20782 : 1767533 : (set_attr "pent_pair" "np,*,*")
20783 : 1767533 : (set_attr "athlon_decode" "vector,*,*")
20784 : 1767533 : (set_attr "amdfam10_decode" "double,*,*")
20785 : 1767533 : (set_attr "bdver1_decode" "double,*,*")
20786 : 1767533 : (set_attr "mode" "QI,HI,HI")])
20787 : 1767533 :
20788 : 1767533 : (define_peephole2
20789 : 1767533 : [(set (match_operand:HI 0 "general_reg_operand")
20790 : 1767608 : (bswap:HI (match_dup 0)))]
20791 : 1767533 : "TARGET_MOVBE
20792 : 1767533 : && !(TARGET_USE_XCHGB || optimize_function_for_size_p (cfun))
20793 : 290153 : && peep2_regno_dead_p (0, FLAGS_REG)"
20794 : 1767470 : [(parallel [(set (match_dup 0) (rotate:HI (match_dup 0) (const_int 8)))
20795 : 1767470 : (clobber (reg:CC FLAGS_REG))])])
20796 : 1767470 :
20797 : 290017 : (define_insn "bswaphi_lowpart"
20798 : 1767470 : [(set (strict_low_part (match_operand:HI 0 "register_operand" "+Q,r"))
20799 : 1767395 : (bswap:HI (match_dup 0)))
20800 : 1767395 : (clobber (reg:CC FLAGS_REG))]
20801 : 27952287 : ""
20802 : 27952287 : "@
20803 : 27952287 : xchg{b}\t{%h0, %b0|%b0, %h0}
20804 : 28183064 : rol{w}\t{$8, %0|%0, 8}"
20805 : 28183064 : [(set (attr "preferred_for_size")
20806 : 28183064 : (cond [(eq_attr "alternative" "0")
20807 : 1767395 : (symbol_ref "true")]
20808 : 289940 : (symbol_ref "false")))
20809 : 289940 : (set (attr "preferred_for_speed")
20810 : 4712937 : (cond [(eq_attr "alternative" "0")
20811 : 5901353 : (symbol_ref "TARGET_USE_XCHGB")]
20812 : 6191027 : (symbol_ref "!TARGET_USE_XCHGB")))
20813 : 1768147 : (set_attr "length" "2,4")
20814 : 289940 : (set_attr "mode" "QI,HI")])
20815 : 1478473 :
20816 : 10819720 : (define_expand "paritydi2"
20817 : 1609169 : [(set (match_operand:DI 0 "register_operand")
20818 : 1609169 : (parity:DI (match_operand:DI 1 "register_operand")))]
20819 : 10689024 : "! TARGET_POPCNT"
20820 : 10689099 : {
20821 : 10689099 : rtx scratch = gen_reg_rtx (QImode);
20822 : 10759151 : rtx hipart1 = gen_reg_rtx (SImode);
20823 : 1838274 : rtx lopart1 = gen_reg_rtx (SImode);
20824 : 10689099 : rtx xor1 = gen_reg_rtx (SImode);
20825 : 9211306 : rtx shift2 = gen_reg_rtx (SImode);
20826 : 9210892 : rtx hipart2 = gen_reg_rtx (HImode);
20827 : 1768222 : rtx lopart2 = gen_reg_rtx (HImode);
20828 : 3801140 : rtx xor2 = gen_reg_rtx (HImode);
20829 : 3801065 :
20830 : 1768696 : if (TARGET_64BIT)
20831 : 1768621 : {
20832 : 10647251 : rtx shift1 = gen_reg_rtx (DImode);
20833 : 10647251 : emit_insn (gen_lshrdi3 (shift1, operands[1], GEN_INT (32)));
20834 : 1768696 : emit_move_insn (hipart1, gen_lowpart (SImode, shift1));
20835 : 8412671 : }
20836 : 8412671 : else
20837 : 8956839 : emit_move_insn (hipart1, gen_highpart (SImode, operands[1]));
20838 : 1768621 :
20839 : 1768696 : emit_move_insn (lopart1, gen_lowpart (SImode, operands[1]));
20840 : 1768696 : emit_insn (gen_xorsi3 (xor1, hipart1, lopart1));
20841 : 1768621 :
20842 : 1768696 : emit_insn (gen_lshrsi3 (shift2, xor1, GEN_INT (16)));
20843 : 1768696 : emit_move_insn (hipart2, gen_lowpart (HImode, shift2));
20844 : 1768696 : emit_move_insn (lopart2, gen_lowpart (HImode, xor1));
20845 : 1768696 : emit_insn (gen_xorhi3 (xor2, hipart2, lopart2));
20846 : 1768621 :
20847 : 1768696 : emit_insn (gen_parityhi2_cmp (xor2));
20848 : 1768621 :
20849 : 1768696 : ix86_expand_setcc (scratch, ORDERED,
20850 : 1768621 : gen_rtx_REG (CCmode, FLAGS_REG), const0_rtx);
20851 : 1768621 :
20852 : 1768696 : if (TARGET_64BIT)
20853 : 1768696 : emit_insn (gen_zero_extendqidi2 (operands[0], scratch));
20854 : 1768621 : else
20855 : 1768621 : {
20856 : 1768621 : rtx tmp = gen_reg_rtx (SImode);
20857 : 1768621 :
20858 : 1768621 : emit_insn (gen_zero_extendqisi2 (tmp, scratch));
20859 : 1767278 : emit_insn (gen_zero_extendsidi2 (operands[0], tmp));
20860 : 291283 : }
20861 : 291358 : DONE;
20862 : 291283 : })
20863 : 290650 :
20864 : 291283 : (define_expand "paritysi2"
20865 : 291283 : [(set (match_operand:SI 0 "register_operand")
20866 : 291283 : (parity:SI (match_operand:SI 1 "register_operand")))]
20867 : 290293 : "! TARGET_POPCNT"
20868 : 291360 : {
20869 : 291437 : rtx scratch = gen_reg_rtx (QImode);
20870 : 291360 : rtx shift = gen_reg_rtx (SImode);
20871 : 291360 : rtx hipart = gen_reg_rtx (HImode);
20872 : 291360 : rtx lopart = gen_reg_rtx (HImode);
20873 : 291360 : rtx tmp = gen_reg_rtx (HImode);
20874 : 291283 :
20875 : 291360 : emit_insn (gen_lshrsi3 (shift, operands[1], GEN_INT (16)));
20876 : 1829530 : emit_move_insn (hipart, gen_lowpart (HImode, shift));
20877 : 1829530 : emit_move_insn (lopart, gen_lowpart (HImode, operands[1]));
20878 : 1829410 : emit_insn (gen_xorhi3 (tmp, hipart, lopart));
20879 : 1829307 :
20880 : 1829384 : emit_insn (gen_parityhi2_cmp (tmp));
20881 : 1829307 :
20882 : 1828041 : ix86_expand_setcc (scratch, ORDERED,
20883 : 291214 : gen_rtx_REG (CCmode, FLAGS_REG), const0_rtx);
20884 : 291214 :
20885 : 291214 : emit_insn (gen_zero_extendqisi2 (operands[0], scratch));
20886 : 289871 : DONE;
20887 : 291214 : })
20888 : 291214 :
20889 : 291137 : (define_expand "parityhi2"
20890 : 291137 : [(set (match_operand:HI 0 "register_operand")
20891 : 291137 : (parity:HI (match_operand:HI 1 "register_operand")))]
20892 : 291137 : "! TARGET_POPCNT"
20893 : 291148 : {
20894 : 291159 : rtx scratch = gen_reg_rtx (QImode);
20895 : 337015 : rtx tmp = gen_reg_rtx (HImode);
20896 : 337004 :
20897 : 337015 : emit_move_insn (tmp, operands[1]);
20898 : 337015 : emit_insn (gen_parityhi2_cmp (tmp));
20899 : 337004 :
20900 : 337015 : ix86_expand_setcc (scratch, ORDERED,
20901 : 335661 : gen_rtx_REG (CCmode, FLAGS_REG), const0_rtx);
20902 : 291137 :
20903 : 291148 : emit_insn (gen_zero_extendqihi2 (operands[0], scratch));
20904 : 291148 : DONE;
20905 : 289805 : })
20906 : 291137 :
20907 : 291137 : (define_expand "parityqi2"
20908 : 291148 : [(set (match_operand:QI 0 "register_operand")
20909 : 291148 : (parity:QI (match_operand:QI 1 "register_operand")))]
20910 : 291148 : "! TARGET_POPCNT"
20911 : 291155 : {
20912 : 291144 : emit_insn (gen_parityqi2_cmp (operands[1]));
20913 : 292185 :
20914 : 3304348 : ix86_expand_setcc (operands[0], ORDERED,
20915 : 3304221 : gen_rtx_REG (CCmode, FLAGS_REG), const0_rtx);
20916 : 3304228 : DONE;
20917 : 3303304 : })
20918 : 3303304 :
20919 : 3303304 : (define_insn "parityhi2_cmp"
20920 : 3304221 : [(set (reg:CC FLAGS_REG)
20921 : 3303304 : (unspec:CC [(match_operand:HI 0 "register_operand" "+Q")]
20922 : 3303304 : UNSPEC_PARITY))
20923 : 3303311 : (clobber (match_dup 0))]
20924 : 3303304 : ""
20925 : 3303304 : "xor{b}\t{%h0, %b0|%b0, %h0}"
20926 : 3303311 : [(set_attr "length" "2")
20927 : 3301968 : (set_attr "mode" "QI")])
20928 : 3301968 :
20929 : 1034442 : (define_insn "parityqi2_cmp"
20930 : 1034442 : [(set (reg:CC FLAGS_REG)
20931 : 1034442 : (unspec:CC [(match_operand:QI 0 "register_operand" "q")]
20932 : 4045259 : UNSPEC_PARITY))]
20933 : 1034435 : ""
20934 : 1034435 : "test{b}\t%0, %0"
20935 : 1034435 : [(set_attr "mode" "QI")])
20936 : 1441434 :
20937 : 1034435 : ;; Replace zero_extend:HI followed by parityhi2_cmp with parityqi2_cmp
20938 : 1034435 : (define_peephole2
20939 : 1034435 : [(set (match_operand:HI 0 "register_operand")
20940 : 1034435 : (zero_extend:HI (match_operand:QI 1 "general_reg_operand")))
20941 : 1034435 : (parallel [(set (reg:CC FLAGS_REG)
20942 : 1034435 : (unspec:CC [(match_dup 0)] UNSPEC_PARITY))
20943 : 291017 : (clobber (match_dup 0))])]
20944 : 1034435 : ""
20945 : 1065438 : [(set (reg:CC FLAGS_REG)
20946 : 1065438 : (unspec:CC [(match_dup 1)] UNSPEC_PARITY))])
20947 : 1065438 :
20948 : 1065438 : ;; Eliminate QImode popcount&1 using parity flag
20949 : 1065438 : (define_peephole2
20950 : 1065438 : [(set (match_operand:SI 0 "register_operand")
20951 : 1065438 : (zero_extend:SI (match_operand:QI 1 "general_reg_operand")))
20952 : 1065438 : (parallel [(set (match_operand:SI 2 "register_operand")
20953 : 1065438 : (popcount:SI (match_dup 0)))
20954 : 1065438 : (clobber (reg:CC FLAGS_REG))])
20955 : 1065438 : (set (reg:CCZ FLAGS_REG)
20956 : 1065438 : (compare:CCZ (and:QI (match_operand:QI 3 "register_operand")
20957 : 1065438 : (const_int 1))
20958 : 322020 : (const_int 0)))
20959 : 1065438 : (set (pc) (if_then_else (match_operator 4 "bt_comparison_operator"
20960 : 1065438 : [(reg:CCZ FLAGS_REG)
20961 : 1065438 : (const_int 0)])
20962 : 1065446 : (label_ref (match_operand 5))
20963 : 1065438 : (pc)))]
20964 : 1065454 : "REGNO (operands[2]) == REGNO (operands[3])
20965 : 1065454 : && peep2_reg_dead_p (3, operands[0])
20966 : 1065454 : && peep2_reg_dead_p (3, operands[2])
20967 : 1065454 : && peep2_regno_dead_p (4, FLAGS_REG)"
20968 : 1065446 : [(set (reg:CC FLAGS_REG)
20969 : 1065454 : (unspec:CC [(match_dup 1)] UNSPEC_PARITY))
20970 : 1065454 : (set (pc) (if_then_else (match_op_dup 4 [(reg:CC FLAGS_REG)
20971 : 322148 : (const_int 0)])
20972 : 1065318 : (label_ref (match_dup 5))
20973 : 1065326 : (pc)))]
20974 : 1065326 : {
20975 : 1065326 : operands[4] = shallow_copy_rtx (operands[4]);
20976 : 1065326 : PUT_CODE (operands[4], GET_CODE (operands[4]) == EQ ? UNORDERED : ORDERED);
20977 : 1065318 : })
20978 : 5479296 :
20979 : 1065318 : ;; Eliminate HImode popcount&1 using parity flag
20980 : 1065326 : (define_peephole2
20981 : 1065326 : [(match_scratch:HI 0 "Q")
20982 : 5479304 : (parallel [(set (match_operand:HI 1 "register_operand")
20983 : 5479304 : (popcount:HI
20984 : 5479304 : (match_operand:HI 2 "nonimmediate_operand")))
20985 : 5479304 : (clobber (reg:CC FLAGS_REG))])
20986 : 5479304 : (set (match_operand 3 "register_operand")
20987 : 5479304 : (zero_extend (match_dup 1)))
20988 : 1065326 : (set (reg:CCZ FLAGS_REG)
20989 : 5479238 : (compare:CCZ (and:QI (match_operand:QI 4 "register_operand")
20990 : 5479238 : (const_int 1))
20991 : 5479238 : (const_int 0)))
20992 : 5479238 : (set (pc) (if_then_else (match_operator 5 "bt_comparison_operator"
20993 : 5479230 : [(reg:CCZ FLAGS_REG)
20994 : 5479230 : (const_int 0)])
20995 : 5479230 : (label_ref (match_operand 6))
20996 : 5479230 : (pc)))]
20997 : 1065320 : "REGNO (operands[3]) == REGNO (operands[4])
20998 : 1065328 : && peep2_reg_dead_p (3, operands[1])
20999 : 1065320 : && peep2_reg_dead_p (3, operands[3])
21000 : 1065320 : && peep2_regno_dead_p (4, FLAGS_REG)"
21001 : 1065318 : [(set (match_dup 0) (match_dup 2))
21002 : 5479232 : (parallel [(set (reg:CC FLAGS_REG)
21003 : 1065320 : (unspec:CC [(match_dup 0)] UNSPEC_PARITY))
21004 : 5479230 : (clobber (match_dup 0))])
21005 : 5479230 : (set (pc) (if_then_else (match_op_dup 5 [(reg:CC FLAGS_REG)
21006 : 1065318 : (const_int 0)])
21007 : 5479238 : (label_ref (match_dup 6))
21008 : 5479238 : (pc)))]
21009 : 1065328 : {
21010 : 1065320 : operands[5] = shallow_copy_rtx (operands[5]);
21011 : 1232887 : PUT_CODE (operands[5], GET_CODE (operands[5]) == EQ ? UNORDERED : ORDERED);
21012 : 1065318 : })
21013 : 1065318 :
21014 : 1066007 : ;; Eliminate HImode popcount&1 using parity flag (variant 2)
21015 : 1066011 : (define_peephole2
21016 : 1065320 : [(match_scratch:HI 0 "Q")
21017 : 1065322 : (parallel [(set (match_operand:HI 1 "register_operand")
21018 : 1065322 : (popcount:HI
21019 : 1065322 : (match_operand:HI 2 "nonimmediate_operand")))
21020 : 1065322 : (clobber (reg:CC FLAGS_REG))])
21021 : 1065322 : (set (reg:CCZ FLAGS_REG)
21022 : 1065322 : (compare:CCZ (and:QI (match_operand:QI 3 "register_operand")
21023 : 1065322 : (const_int 1))
21024 : 1065322 : (const_int 0)))
21025 : 1065322 : (set (pc) (if_then_else (match_operator 4 "bt_comparison_operator"
21026 : 1065320 : [(reg:CCZ FLAGS_REG)
21027 : 1065320 : (const_int 0)])
21028 : 1065320 : (label_ref (match_operand 5))
21029 : 1065322 : (pc)))]
21030 : 1065318 : "REGNO (operands[1]) == REGNO (operands[3])
21031 : 1065322 : && peep2_reg_dead_p (2, operands[1])
21032 : 1065318 : && peep2_reg_dead_p (2, operands[3])
21033 : 1065318 : && peep2_regno_dead_p (3, FLAGS_REG)"
21034 : 1065318 : [(set (match_dup 0) (match_dup 2))
21035 : 1065318 : (parallel [(set (reg:CC FLAGS_REG)
21036 : 1065318 : (unspec:CC [(match_dup 0)] UNSPEC_PARITY))
21037 : 1065318 : (clobber (match_dup 0))])
21038 : 1065318 : (set (pc) (if_then_else (match_op_dup 4 [(reg:CC FLAGS_REG)
21039 : 1065318 : (const_int 0)])
21040 : 1065318 : (label_ref (match_dup 5))
21041 : 1065320 : (pc)))]
21042 : 1065318 : {
21043 : 1065318 : operands[4] = shallow_copy_rtx (operands[4]);
21044 : 6534754 : PUT_CODE (operands[4], GET_CODE (operands[4]) == EQ ? UNORDERED : ORDERED);
21045 : 1065318 : })
21046 : 1065318 :
21047 : 1065318 :
21048 : 6534754 : ;; Thread-local storage patterns for ELF.
21049 : 1065318 : ;;
21050 : 6534756 : ;; Note that these code sequences must appear exactly as shown
21051 : 6534756 : ;; in order to allow linker relaxation.
21052 : 6534756 :
21053 : 1065318 : (define_insn "*tls_global_dynamic_32_gnu"
21054 : 5768394 : [(set (match_operand:SI 0 "register_operand" "=a")
21055 : 5768394 : (unspec:SI
21056 : 5768394 : [(match_operand:SI 1 "register_operand" "Yb")
21057 : 5768394 : (match_operand 2 "tls_symbolic_operand")
21058 : 1065318 : (match_operand 3 "constant_call_address_operand" "Bz")
21059 : 1156436 : (reg:SI SP_REG)]
21060 : 1156436 : UNSPEC_TLS_GD))
21061 : 1156436 : (clobber (match_scratch:SI 4 "=d"))
21062 : 1156436 : (clobber (match_scratch:SI 5 "=c"))
21063 : 1156436 : (clobber (reg:CC FLAGS_REG))]
21064 : 1161231 : "!TARGET_64BIT && TARGET_GNU_TLS"
21065 : 1066340 : {
21066 : 1076323 : if (TARGET_SUN_TLS || flag_plt || !HAVE_AS_IX86_TLS_GET_ADDR_GOT)
21067 : 1081187 : output_asm_insn
21068 : 1066450 : ("lea{l}\t{%E2@tlsgd(,%1,1), %0|%0, %E2@tlsgd[%1*1]}", operands);
21069 : 1065428 : else
21070 : 1065428 : output_asm_insn
21071 : 1065318 : ("lea{l}\t{%E2@tlsgd(%1), %0|%0, %E2@tlsgd[%1]}", operands);
21072 : 1066340 : if (TARGET_SUN_TLS)
21073 : 1065318 : #ifdef HAVE_AS_IX86_TLSGDPLT
21074 : 1065428 : return "call\t%a2@tlsgdplt";
21075 : 1065750 : #else
21076 : 1065750 : return "call\t%p3@plt";
21077 : 1065860 : #endif
21078 : 1066662 : if (flag_plt || !HAVE_AS_IX86_TLS_GET_ADDR_GOT)
21079 : 1066772 : return "call\t%P3";
21080 : 1065750 : return "call\t{*%p3@GOT(%1)|[DWORD PTR %p3@GOT[%1]]}";
21081 : 1065750 : }
21082 : 1065750 : [(set_attr "type" "multi")
21083 : 1065640 : (set_attr "length" "12")])
21084 : 1065750 :
21085 : 1065750 : (define_expand "tls_global_dynamic_32"
21086 : 1065750 : [(parallel
21087 : 1065750 : [(set (match_operand:SI 0 "register_operand")
21088 : 324528 : (unspec:SI [(match_operand:SI 2 "register_operand")
21089 : 322342 : (match_operand 1 "tls_symbolic_operand")
21090 : 1065318 : (match_operand 3 "constant_call_address_operand")
21091 : 1065318 : (reg:SI SP_REG)]
21092 : 1065318 : UNSPEC_TLS_GD))
21093 : 1067394 : (clobber (scratch:SI))
21094 : 1067394 : (clobber (scratch:SI))
21095 : 1067394 : (clobber (reg:CC FLAGS_REG))])]
21096 : 1067394 : ""
21097 : 1067394 : "ix86_tls_descriptor_calls_expanded_in_cfun = true;")
21098 : 1067394 :
21099 : 1067394 : (define_insn "*tls_global_dynamic_64_<mode>"
21100 : 1067394 : [(set (match_operand:P 0 "register_operand" "=a")
21101 : 1067394 : (call:P
21102 : 1067394 : (mem:QI (match_operand 2 "constant_call_address_operand" "Bz"))
21103 : 1067394 : (match_operand 3)))
21104 : 1067394 : (unspec:P [(match_operand 1 "tls_symbolic_operand")
21105 : 1067394 : (reg:P SP_REG)]
21106 : 1067394 : UNSPEC_TLS_GD)]
21107 : 1071799 : "TARGET_64BIT"
21108 : 1067746 : {
21109 : 1067394 : if (!TARGET_X32)
21110 : 1065318 : /* The .loc directive has effect for 'the immediately following assembly
21111 : 1065318 : instruction'. So for a sequence:
21112 : 1065318 : .loc f l
21113 : 1065318 : .byte x
21114 : 1065318 : insn1
21115 : 1065318 : the 'immediately following assembly instruction' is insn1.
21116 : 1065318 : We want to emit an insn prefix here, but if we use .byte (as shown in
21117 : 1065318 : 'ELF Handling For Thread-Local Storage'), a preceding .loc will point
21118 : 1065318 : inside the insn sequence, rather than to the start. After relaxation
21119 : 1065318 : of the sequence by the linker, the .loc might point inside an insn.
21120 : 1065318 : Use data16 prefix instead, which doesn't have this problem. */
21121 : 1067745 : fputs ("\tdata16", asm_out_file);
21122 : 1067746 : output_asm_insn
21123 : 1067746 : ("lea{q}\t{%E1@tlsgd(%%rip), %%rdi|rdi, %E1@tlsgd[rip]}", operands);
21124 : 1067746 : if (TARGET_SUN_TLS || flag_plt || !HAVE_AS_IX86_TLS_GET_ADDR_GOT)
21125 : 1069812 : fputs (ASM_SHORT "0x6666\n", asm_out_file);
21126 : 1067394 : else
21127 : 1067404 : fputs (ASM_BYTE "0x66\n", asm_out_file);
21128 : 1067746 : fputs ("\trex64\n", asm_out_file);
21129 : 324448 : if (TARGET_SUN_TLS)
21130 : 1065318 : return "call\t%p2@plt";
21131 : 1067746 : if (flag_plt || !HAVE_AS_IX86_TLS_GET_ADDR_GOT)
21132 : 1067736 : return "call\t%P2";
21133 : 1065318 : return "call\t{*%p2@GOTPCREL(%%rip)|[QWORD PTR %p2@GOTPCREL[rip]]}";
21134 : 1065318 : }
21135 : 1065318 : [(set_attr "type" "multi")
21136 : 1065318 : (set (attr "length")
21137 : 1068062 : (symbol_ref "TARGET_X32 ? 15 : 16"))])
21138 : 1067746 :
21139 : 1065398 : (define_insn "*tls_global_dynamic_64_largepic"
21140 : 775724 : [(set (match_operand:DI 0 "register_operand" "=a")
21141 : 775724 : (call:DI
21142 : 1065318 : (mem:QI (plus:DI (match_operand:DI 2 "register_operand" "b")
21143 : 1065318 : (match_operand:DI 3 "immediate_operand" "i")))
21144 : 1065318 : (match_operand 4)))
21145 : 1065318 : (unspec:DI [(match_operand 1 "tls_symbolic_operand")
21146 : 1065318 : (reg:DI SP_REG)]
21147 : 1065318 : UNSPEC_TLS_GD)]
21148 : 1065318 : "TARGET_64BIT && ix86_cmodel == CM_LARGE_PIC && !TARGET_PECOFF
21149 : 1065318 : && GET_CODE (operands[3]) == CONST
21150 : 1801154 : && GET_CODE (XEXP (operands[3], 0)) == UNSPEC
21151 : 1511480 : && XINT (XEXP (operands[3], 0), 1) == UNSPEC_PLTOFF"
21152 : 1511480 : {
21153 : 322020 : output_asm_insn
21154 : 1065318 : ("lea{q}\t{%E1@tlsgd(%%rip), %%rdi|rdi, %E1@tlsgd[rip]}", operands);
21155 : 1065318 : output_asm_insn ("movabs{q}\t{%3, %%rax|rax, %3}", operands);
21156 : 1065318 : output_asm_insn ("add{q}\t{%2, %%rax|rax, %2}", operands);
21157 : 322020 : return "call\t{*%%rax|rax}";
21158 : 1065318 : }
21159 : 1065318 : [(set_attr "type" "multi")
21160 : 1065318 : (set_attr "length" "22")])
21161 : 2660737 :
21162 : 2660768 : (define_expand "@tls_global_dynamic_64_<mode>"
21163 : 2660737 : [(parallel
21164 : 2371063 : [(set (match_operand:P 0 "register_operand")
21165 : 1065318 : (call:P
21166 : 4458235 : (mem:QI (match_operand 2))
21167 : 4458235 : (const_int 0)))
21168 : 4458235 : (unspec:P [(match_operand 1 "tls_symbolic_operand")
21169 : 4458235 : (reg:P SP_REG)]
21170 : 4458235 : UNSPEC_TLS_GD)])]
21171 : 3714937 : "TARGET_64BIT"
21172 : 3719342 : "ix86_tls_descriptor_calls_expanded_in_cfun = true;")
21173 : 4458235 :
21174 : 4458235 : (define_insn "*tls_local_dynamic_base_32_gnu"
21175 : 4172966 : [(set (match_operand:SI 0 "register_operand" "=a")
21176 : 326425 : (unspec:SI
21177 : 3997693 : [(match_operand:SI 1 "register_operand" "Yb")
21178 : 3997693 : (match_operand 2 "constant_call_address_operand" "Bz")
21179 : 3997693 : (reg:SI SP_REG)]
21180 : 3997693 : UNSPEC_TLS_LD_BASE))
21181 : 3993288 : (clobber (match_scratch:SI 3 "=d"))
21182 : 3708019 : (clobber (match_scratch:SI 4 "=c"))
21183 : 1065318 : (clobber (reg:CC FLAGS_REG))]
21184 : 283017176 : "!TARGET_64BIT && TARGET_GNU_TLS"
21185 : 283017097 : {
21186 : 283017193 : output_asm_insn
21187 : 282273895 : ("lea{l}\t{%&@tlsldm(%1), %0|%0, %&@tlsldm[%1]}", operands);
21188 : 282273929 : if (TARGET_SUN_TLS)
21189 : 283017213 : {
21190 : 283017213 : if (HAVE_AS_IX86_TLSLDMPLT)
21191 : 283017066 : return "call\t%&@tlsldmplt";
21192 : 282273915 : else
21193 : 283017213 : return "call\t%p2@plt";
21194 : 283017213 : }
21195 : 283021762 : if (flag_plt || !HAVE_AS_IX86_TLS_GET_ADDR_GOT)
21196 : 282278204 : return "call\t%P2";
21197 : 283021618 : return "call\t{*%p2@GOT(%1)|[DWORD PTR %p2@GOT[%1]]}";
21198 : 283017083 : }
21199 : 283017196 : [(set_attr "type" "multi")
21200 : 283017083 : (set_attr "length" "11")])
21201 : 283017189 :
21202 : 283021598 : (define_expand "tls_local_dynamic_base_32"
21203 : 283017172 : [(parallel
21204 : 283017083 : [(set (match_operand:SI 0 "register_operand")
21205 : 283017083 : (unspec:SI
21206 : 283021601 : [(match_operand:SI 1 "register_operand")
21207 : 283021687 : (match_operand 2 "constant_call_address_operand")
21208 : 283021581 : (reg:SI SP_REG)]
21209 : 283021687 : UNSPEC_TLS_LD_BASE))
21210 : 283021687 : (clobber (scratch:SI))
21211 : 283021687 : (clobber (scratch:SI))
21212 : 283021471 : (clobber (reg:CC FLAGS_REG))])]
21213 : 283017172 : ""
21214 : 283017176 : "ix86_tls_descriptor_calls_expanded_in_cfun = true;")
21215 : 283017142 :
21216 : 283017218 : (define_insn "*tls_local_dynamic_base_64_<mode>"
21217 : 283017176 : [(set (match_operand:P 0 "register_operand" "=a")
21218 : 283017176 : (call:P
21219 : 283017176 : (mem:QI (match_operand 1 "constant_call_address_operand" "Bz"))
21220 : 283017176 : (match_operand 2)))
21221 : 283017176 : (unspec:P [(reg:P SP_REG)] UNSPEC_TLS_LD_BASE)]
21222 : 283017496 : "TARGET_64BIT"
21223 : 283017303 : {
21224 : 282241769 : output_asm_insn
21225 : 283017066 : ("lea{q}\t{%&@tlsld(%%rip), %%rdi|rdi, %&@tlsld[rip]}", operands);
21226 : 283017303 : if (TARGET_SUN_TLS)
21227 : 283017066 : return "call\t%p1@plt";
21228 : 282274005 : if (flag_plt || !HAVE_AS_IX86_TLS_GET_ADDR_GOT)
21229 : 283017300 : return "call\t%P1";
21230 : 283017066 : return "call\t{*%p1@GOTPCREL(%%rip)|[QWORD PTR %p1@GOTPCREL[rip]]}";
21231 : 283017066 : }
21232 : 283017066 : [(set_attr "type" "multi")
21233 : 283017066 : (set_attr "length" "12")])
21234 : 283017066 :
21235 : 283017303 : (define_insn "*tls_local_dynamic_base_64_largepic"
21236 : 283017066 : [(set (match_operand:DI 0 "register_operand" "=a")
21237 : 283017066 : (call:DI
21238 : 283017066 : (mem:QI (plus:DI (match_operand:DI 1 "register_operand" "b")
21239 : 283017176 : (match_operand:DI 2 "immediate_operand" "i")))
21240 : 283017176 : (match_operand 3)))
21241 : 283017176 : (unspec:DI [(reg:DI SP_REG)] UNSPEC_TLS_LD_BASE)]
21242 : 283017066 : "TARGET_64BIT && ix86_cmodel == CM_LARGE_PIC && !TARGET_PECOFF
21243 : 283017066 : && GET_CODE (operands[2]) == CONST
21244 : 283017066 : && GET_CODE (XEXP (operands[2], 0)) == UNSPEC
21245 : 283017066 : && XINT (XEXP (operands[2], 0), 1) == UNSPEC_PLTOFF"
21246 : 283017066 : {
21247 : 283017066 : output_asm_insn
21248 : 283017066 : ("lea{q}\t{%&@tlsld(%%rip), %%rdi|rdi, %&@tlsld[rip]}", operands);
21249 : 283017066 : output_asm_insn ("movabs{q}\t{%2, %%rax|rax, %2}", operands);
21250 : 283017066 : output_asm_insn ("add{q}\t{%1, %%rax|rax, %1}", operands);
21251 : 283017066 : return "call\t{*%%rax|rax}";
21252 : 283017066 : }
21253 : 283017066 : [(set_attr "type" "multi")
21254 : 283017066 : (set_attr "length" "22")])
21255 : 283166961 :
21256 : 283017129 : (define_expand "@tls_local_dynamic_base_64_<mode>"
21257 : 283017066 : [(parallel
21258 : 283017066 : [(set (match_operand:P 0 "register_operand")
21259 : 283166961 : (call:P
21260 : 283166961 : (mem:QI (match_operand 1))
21261 : 283166961 : (const_int 0)))
21262 : 283166961 : (unspec:P [(reg:P SP_REG)] UNSPEC_TLS_LD_BASE)])]
21263 : 283166961 : "TARGET_64BIT"
21264 : 283167281 : "ix86_tls_descriptor_calls_expanded_in_cfun = true;")
21265 : 283166961 :
21266 : 283017066 : ;; Local dynamic of a single variable is a lose. Show combine how
21267 : 283117970 : ;; to convert that back to global dynamic.
21268 : 283117970 :
21269 : 283085624 : (define_insn_and_split "*tls_local_dynamic_32_once"
21270 : 283017386 : [(set (match_operand:SI 0 "register_operand" "=a")
21271 : 283114222 : (plus:SI
21272 : 283114542 : (unspec:SI [(match_operand:SI 1 "register_operand" "b")
21273 : 282273768 : (match_operand 2 "constant_call_address_operand" "Bz")
21274 : 283105894 : (reg:SI SP_REG)]
21275 : 283017066 : UNSPEC_TLS_LD_BASE)
21276 : 283017085 : (const:SI (unspec:SI
21277 : 282273787 : [(match_operand 3 "tls_symbolic_operand")]
21278 : 283017066 : UNSPEC_DTPOFF))))
21279 : 283017068 : (clobber (match_scratch:SI 4 "=d"))
21280 : 283017068 : (clobber (match_scratch:SI 5 "=c"))
21281 : 282273768 : (clobber (reg:CC FLAGS_REG))]
21282 : 283017066 : ""
21283 : 283017066 : "#"
21284 : 283017386 : ""
21285 : 283017386 : [(parallel
21286 : 283017386 : [(set (match_dup 0)
21287 : 283017066 : (unspec:SI [(match_dup 1) (match_dup 3) (match_dup 2)
21288 : 283017066 : (reg:SI SP_REG)]
21289 : 283017066 : UNSPEC_TLS_GD))
21290 : 282984720 : (clobber (match_dup 4))
21291 : 283017386 : (clobber (match_dup 5))
21292 : 283017136 : (clobber (reg:CC FLAGS_REG))])])
21293 : 283017066 :
21294 : 282985110 : ;; Load and add the thread base pointer from %<tp_seg>:0.
21295 : 283017386 : (define_expand "get_thread_pointer<mode>"
21296 : 283017456 : [(set (match_operand:PTR 0 "register_operand")
21297 : 283017456 : (unspec:PTR [(const_int 0)] UNSPEC_TP))]
21298 : 283017456 : ""
21299 : 283017386 : {
21300 : 283017136 : /* targetm is not visible in the scope of the condition. */
21301 : 283017136 : if (!targetm.have_tls)
21302 : 283017066 : error ("%<__builtin_thread_pointer%> is not supported on this target");
21303 : 283017136 : })
21304 : 283017136 :
21305 : 283017136 : (define_insn_and_split "*load_tp_<mode>"
21306 : 283017139 : [(set (match_operand:PTR 0 "register_operand" "=r")
21307 : 283017139 : (unspec:PTR [(const_int 0)] UNSPEC_TP))]
21308 : 282984790 : ""
21309 : 282984723 : "#"
21310 : 283017136 : ""
21311 : 283017136 : [(set (match_dup 0)
21312 : 283017136 : (match_dup 1))]
21313 : 282987291 : {
21314 : 283019570 : addr_space_t as = DEFAULT_TLS_SEG_REG;
21315 : 283017069 :
21316 : 283019637 : operands[1] = gen_const_mem (<MODE>mode, const0_rtx);
21317 : 283019567 : set_mem_addr_space (operands[1], as);
21318 : 283017066 : })
21319 : 283017066 :
21320 : 283017066 : (define_insn_and_split "*load_tp_x32_zext"
21321 : 283019570 : [(set (match_operand:DI 0 "register_operand" "=r")
21322 : 283019603 : (zero_extend:DI
21323 : 283019570 : (unspec:SI [(const_int 0)] UNSPEC_TP)))]
21324 : 283017073 : "TARGET_X32"
21325 : 283019567 : "#"
21326 : 283017105 : "&& 1"
21327 : 282987260 : [(set (match_dup 0)
21328 : 282987225 : (zero_extend:DI (match_dup 1)))]
21329 : 283017139 : {
21330 : 283017107 : addr_space_t as = DEFAULT_TLS_SEG_REG;
21331 : 283017066 :
21332 : 282984824 : operands[1] = gen_const_mem (SImode, const0_rtx);
21333 : 283017170 : set_mem_addr_space (operands[1], as);
21334 : 283070969 : })
21335 : 283073368 :
21336 : 282984720 : (define_insn_and_split "*add_tp_<mode>"
21337 : 283035335 : [(set (match_operand:PTR 0 "register_operand" "=r")
21338 : 283019543 : (plus:PTR
21339 : 283035335 : (unspec:PTR [(const_int 0)] UNSPEC_TP)
21340 : 283019535 : (match_operand:PTR 1 "register_operand" "0")))
21341 : 283023752 : (clobber (reg:CC FLAGS_REG))]
21342 : 283026217 : ""
21343 : 283023748 : "#"
21344 : 283017070 : ""
21345 : 283023751 : [(parallel
21346 : 283017070 : [(set (match_dup 0)
21347 : 283017066 : (plus:PTR (match_dup 1) (match_dup 2)))
21348 : 283017066 : (clobber (reg:CC FLAGS_REG))])]
21349 : 283018386 : {
21350 : 283018386 : addr_space_t as = DEFAULT_TLS_SEG_REG;
21351 : 283015723 :
21352 : 282987383 : operands[2] = gen_const_mem (<MODE>mode, const0_rtx);
21353 : 282987383 : set_mem_addr_space (operands[2], as);
21354 : 282986099 : })
21355 : 282985278 :
21356 : 282986099 : (define_insn_and_split "*add_tp_x32_zext"
21357 : 282987419 : [(set (match_operand:DI 0 "register_operand" "=r")
21358 : 282986099 : (zero_extend:DI
21359 : 282986063 : (plus:SI (unspec:SI [(const_int 0)] UNSPEC_TP)
21360 : 282986099 : (match_operand:SI 1 "register_operand" "0"))))
21361 : 282987383 : (clobber (reg:CC FLAGS_REG))]
21362 : 282987385 : "TARGET_X32"
21363 : 282986040 : "#"
21364 : 282984722 : "&& 1"
21365 : 283026804 : [(parallel
21366 : 283025459 : [(set (match_dup 0)
21367 : 282984720 : (zero_extend:DI
21368 : 282984720 : (plus:SI (match_dup 1) (match_dup 2))))
21369 : 282986063 : (clobber (reg:CC FLAGS_REG))])]
21370 : 283006562 : {
21371 : 283027974 : addr_space_t as = DEFAULT_TLS_SEG_REG;
21372 : 283027974 :
21373 : 283002846 : operands[2] = gen_const_mem (SImode, const0_rtx);
21374 : 282987070 : set_mem_addr_space (operands[2], as);
21375 : 283002904 : })
21376 : 282987070 :
21377 : 282996540 : ;; The Sun linker took the AMD64 TLS spec literally and can only handle
21378 : 282997824 : ;; %rax as destination of the initial executable code sequence.
21379 : 287039473 : (define_insn "tls_initial_exec_64_sun"
21380 : 287031287 : [(set (match_operand:DI 0 "register_operand" "=a")
21381 : 287039750 : (unspec:DI
21382 : 287039928 : [(match_operand 1 "tls_symbolic_operand")]
21383 : 287039750 : UNSPEC_TLS_IE_SUN))
21384 : 286287160 : (clobber (reg:CC FLAGS_REG))]
21385 : 287029168 : "TARGET_64BIT && TARGET_SUN_TLS"
21386 : 287030452 : {
21387 : 287029346 : output_asm_insn
21388 : 286294912 : ("mov{q}\t{%%fs:0, %0|%0, QWORD PTR fs:0}", operands);
21389 : 287038210 : return "add{q}\t{%a1@gottpoff(%%rip), %0|%0, %a1@gottpoff[rip]}";
21390 : 287038210 : }
21391 : 282993934 : [(set_attr "type" "multi")])
21392 : 287038210 :
21393 : 287038210 : ;; GNU2 TLS patterns can be split.
21394 : 287038210 :
21395 : 282993934 : (define_expand "tls_dynamic_gnu2_32"
21396 : 287038210 : [(set (match_dup 3)
21397 : 287038210 : (plus:SI (match_operand:SI 2 "register_operand")
21398 : 287038210 : (const:SI
21399 : 282993934 : (unspec:SI [(match_operand 1 "tls_symbolic_operand")]
21400 : 287055633 : UNSPEC_TLSDESC))))
21401 : 287028996 : (parallel
21402 : 287028996 : [(set (match_operand:SI 0 "register_operand")
21403 : 282984720 : (unspec:SI [(match_dup 1) (match_dup 3)
21404 : 287028996 : (match_dup 2) (reg:SI SP_REG)]
21405 : 287028996 : UNSPEC_TLSDESC))
21406 : 287028996 : (clobber (reg:CC FLAGS_REG))])]
21407 : 282984720 : "!TARGET_64BIT && TARGET_GNU2_TLS"
21408 : 287028996 : {
21409 : 287028996 : operands[3] = can_create_pseudo_p () ? gen_reg_rtx (Pmode) : operands[0];
21410 : 287028996 : ix86_tls_descriptor_calls_expanded_in_cfun = true;
21411 : 282984720 : })
21412 : 287028996 :
21413 : 287028996 : (define_insn "*tls_dynamic_gnu2_lea_32"
21414 : 287028996 : [(set (match_operand:SI 0 "register_operand" "=r")
21415 : 287028996 : (plus:SI (match_operand:SI 1 "register_operand" "b")
21416 : 287028996 : (const:SI
21417 : 287027653 : (unspec:SI [(match_operand 2 "tls_symbolic_operand")]
21418 : 282986063 : UNSPEC_TLSDESC))))]
21419 : 282986063 : "!TARGET_64BIT && TARGET_GNU2_TLS"
21420 : 282986063 : "lea{l}\t{%E2@TLSDESC(%1), %0|%0, %E2@TLSDESC[%1]}"
21421 : 283864808 : [(set_attr "type" "lea")
21422 : 282986063 : (set_attr "mode" "SI")
21423 : 283127401 : (set_attr "length" "6")
21424 : 283127401 : (set_attr "length_address" "4")])
21425 : 282986063 :
21426 : 283096158 : (define_insn "*tls_dynamic_gnu2_call_32"
21427 : 282986063 : [(set (match_operand:SI 0 "register_operand" "=a")
21428 : 283064977 : (unspec:SI [(match_operand 1 "tls_symbolic_operand")
21429 : 283064977 : (match_operand:SI 2 "register_operand" "0")
21430 : 282986063 : ;; we have to make sure %ebx still points to the GOT
21431 : 282986063 : (match_operand:SI 3 "register_operand" "b")
21432 : 282984720 : (reg:SI SP_REG)]
21433 : 282984720 : UNSPEC_TLSDESC))
21434 : 282986063 : (clobber (reg:CC FLAGS_REG))]
21435 : 311505532 : "!TARGET_64BIT && TARGET_GNU2_TLS"
21436 : 311505532 : "call\t{*%a1@TLSCALL(%2)|[DWORD PTR [%2+%a1@TLSCALL]]}"
21437 : 311505532 : [(set_attr "type" "call")
21438 : 311505532 : (set_attr "length" "2")
21439 : 311505532 : (set_attr "length_address" "0")])
21440 : 311505532 :
21441 : 311505532 : (define_insn_and_split "*tls_dynamic_gnu2_combine_32"
21442 : 311505532 : [(set (match_operand:SI 0 "register_operand" "=&a")
21443 : 311505532 : (plus:SI
21444 : 311505532 : (unspec:SI [(match_operand 3 "tls_modbase_operand")
21445 : 311725077 : (match_operand:SI 4)
21446 : 311505532 : (match_operand:SI 2 "register_operand" "b")
21447 : 311725077 : (reg:SI SP_REG)]
21448 : 311505532 : UNSPEC_TLSDESC)
21449 : 311505532 : (const:SI (unspec:SI
21450 : 311505628 : [(match_operand 1 "tls_symbolic_operand")]
21451 : 311505628 : UNSPEC_DTPOFF))))
21452 : 311505532 : (clobber (reg:CC FLAGS_REG))]
21453 : 311505532 : "!TARGET_64BIT && TARGET_GNU2_TLS"
21454 : 311505628 : "#"
21455 : 311505628 : "&& 1"
21456 : 311505628 : [(set (match_dup 0) (match_dup 5))]
21457 : 311505724 : {
21458 : 311505535 : operands[5] = can_create_pseudo_p () ? gen_reg_rtx (Pmode) : operands[0];
21459 : 311505629 : emit_insn (gen_tls_dynamic_gnu2_32 (operands[5], operands[1], operands[2]));
21460 : 311505533 : })
21461 : 311505628 :
21462 : 311505532 : (define_expand "@tls_dynamic_gnu2_64_<mode>"
21463 : 311505628 : [(set (match_dup 2)
21464 : 311505628 : (unspec:PTR [(match_operand 1 "tls_symbolic_operand")]
21465 : 311505628 : UNSPEC_TLSDESC))
21466 : 311505628 : (parallel
21467 : 311505532 : [(set (match_operand:PTR 0 "register_operand")
21468 : 311506905 : (unspec:PTR [(match_dup 1) (match_dup 2) (reg:PTR SP_REG)]
21469 : 311505532 : UNSPEC_TLSDESC))
21470 : 311505532 : (clobber (reg:CC FLAGS_REG))])]
21471 : 311505532 : "TARGET_64BIT && TARGET_GNU2_TLS"
21472 : 311506922 : {
21473 : 311506922 : operands[2] = can_create_pseudo_p () ? gen_reg_rtx (ptr_mode) : operands[0];
21474 : 311506922 : ix86_tls_descriptor_calls_expanded_in_cfun = true;
21475 : 311506905 : })
21476 : 311506905 :
21477 : 311506905 : (define_insn "*tls_dynamic_gnu2_lea_64_<mode>"
21478 : 311505532 : [(set (match_operand:PTR 0 "register_operand" "=r")
21479 : 311505623 : (unspec:PTR [(match_operand 1 "tls_symbolic_operand")]
21480 : 311505623 : UNSPEC_TLSDESC))]
21481 : 311505631 : "TARGET_64BIT && TARGET_GNU2_TLS"
21482 : 311505685 : "lea%z0\t{%E1@TLSDESC(%%rip), %0|%0, %E1@TLSDESC[rip]}"
21483 : 311505549 : [(set_attr "type" "lea")
21484 : 311505611 : (set_attr "mode" "<MODE>")
21485 : 311505549 : (set_attr "length" "7")
21486 : 311505540 : (set_attr "length_address" "4")])
21487 : 311505557 :
21488 : 311505557 : (define_insn "*tls_dynamic_gnu2_call_64_<mode>"
21489 : 311505557 : [(set (match_operand:PTR 0 "register_operand" "=a")
21490 : 311505549 : (unspec:PTR [(match_operand 1 "tls_symbolic_operand")
21491 : 311505549 : (match_operand:PTR 2 "register_operand" "0")
21492 : 311505549 : (reg:PTR SP_REG)]
21493 : 311505549 : UNSPEC_TLSDESC))
21494 : 311505532 : (clobber (reg:CC FLAGS_REG))]
21495 : 311505555 : "TARGET_64BIT && TARGET_GNU2_TLS"
21496 : 311505532 : "call\t{*%a1@TLSCALL(%2)|[QWORD PTR [%2+%a1@TLSCALL]]}"
21497 : 311505532 : [(set_attr "type" "call")
21498 : 311505532 : (set_attr "length" "2")
21499 : 311505532 : (set_attr "length_address" "0")])
21500 : 311505532 :
21501 : 282984737 : (define_insn_and_split "*tls_dynamic_gnu2_combine_64_<mode>"
21502 : 311505549 : [(set (match_operand:PTR 0 "register_operand" "=&a")
21503 : 311505549 : (plus:PTR
21504 : 311505532 : (unspec:PTR [(match_operand 2 "tls_modbase_operand")
21505 : 282984720 : (match_operand:PTR 3)
21506 : 311505532 : (reg:PTR SP_REG)]
21507 : 311505532 : UNSPEC_TLSDESC)
21508 : 311505532 : (const:PTR (unspec:PTR
21509 : 282984721 : [(match_operand 1 "tls_symbolic_operand")]
21510 : 311505532 : UNSPEC_DTPOFF))))
21511 : 311505533 : (clobber (reg:CC FLAGS_REG))]
21512 : 311505537 : "TARGET_64BIT && TARGET_GNU2_TLS"
21513 : 311505532 : "#"
21514 : 311505533 : "&& 1"
21515 : 311505533 : [(set (match_dup 0) (match_dup 4))]
21516 : 311505535 : {
21517 : 311505534 : operands[4] = can_create_pseudo_p () ? gen_reg_rtx (ptr_mode) : operands[0];
21518 : 311505533 : emit_insn (gen_tls_dynamic_gnu2_64 (ptr_mode, operands[4], operands[1]));
21519 : 311505533 : })
21520 : 311505532 :
21521 : 311505532 : (define_split
21522 : 311505533 : [(match_operand 0 "tls_address_pattern")]
21523 : 311520980 : "TARGET_TLS_DIRECT_SEG_REFS"
21524 : 283000168 : [(match_dup 0)]
21525 : 529710246 : "operands[0] = ix86_rewrite_tls_address (operands[0]);")
21526 : 311505533 :
21527 : 344771474 :
21528 : 316266109 : ;; These patterns match the binary 387 instructions for addM3, subM3,
21529 : 311520980 : ;; mulM3 and divM3. There are three patterns for each of DFmode and
21530 : 496551806 : ;; SFmode. The first is the normal insn, the second the same insn but
21531 : 496551806 : ;; with one operand a conversion, and the third the same insn but with
21532 : 495254439 : ;; the other operand a conversion. The conversion may be SFmode or
21533 : 312818347 : ;; SImode if the target mode DFmode, but only SImode if the target mode
21534 : 312845832 : ;; is SFmode.
21535 : 311548464 :
21536 : 311548464 : ;; Gcc is slightly more smart about handling normal two address instructions
21537 : 312802900 : ;; so use special patterns for add and mull.
21538 : 311505546 :
21539 : 311805273 : (define_insn "*fop_xf_comm_i387"
21540 : 311805273 : [(set (match_operand:XF 0 "register_operand" "=f")
21541 : 328490078 : (match_operator:XF 3 "binary_fp_operator"
21542 : 328505525 : [(match_operand:XF 1 "register_operand" "%0")
21543 : 283072738 : (match_operand:XF 2 "register_operand" "f")]))]
21544 : 311724373 : "TARGET_80387
21545 : 311636369 : && COMMUTATIVE_ARITH_P (operands[3])"
21546 : 313416298 : "* return output_387_binary_op (insn, operands);"
21547 : 284795978 : [(set (attr "type")
21548 : 313295885 : (if_then_else (match_operand:XF 3 "mult_operator")
21549 : 311593536 : (const_string "fmul")
21550 : 311855799 : (const_string "fop")))
21551 : 311505532 : (set_attr "mode" "XF")])
21552 : 326883144 :
21553 : 326795485 : (define_insn "*fop_<mode>_comm"
21554 : 326883144 : [(set (match_operand:MODEF 0 "register_operand" "=f,x,v")
21555 : 311505532 : (match_operator:MODEF 3 "binary_fp_operator"
21556 : 311593191 : [(match_operand:MODEF 1 "nonimmediate_operand" "%0,0,v")
21557 : 311593191 : (match_operand:MODEF 2 "nonimmediate_operand" "fm,xm,vm")]))]
21558 : 313276188 : "((SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
21559 : 311712939 : || (TARGET_80387 && X87_ENABLE_ARITH (<MODE>mode)))
21560 : 313390411 : && COMMUTATIVE_ARITH_P (operands[3])
21561 : 313025879 : && !(MEM_P (operands[1]) && MEM_P (operands[2]))"
21562 : 311813269 : "* return output_387_binary_op (insn, operands);"
21563 : 311879258 : [(set (attr "type")
21564 : 311785857 : (if_then_else (eq_attr "alternative" "1,2")
21565 : 319487478 : (if_then_else (match_operand:MODEF 3 "mult_operator")
21566 : 319700719 : (const_string "ssemul")
21567 : 311505532 : (const_string "sseadd"))
21568 : 311505532 : (if_then_else (match_operand:MODEF 3 "mult_operator")
21569 : 282984720 : (const_string "fmul")
21570 : 283389780 : (const_string "fop"))))
21571 : 311910592 : (set_attr "isa" "*,noavx,avx")
21572 : 311910592 : (set_attr "prefix" "orig,orig,vex")
21573 : 311505532 : (set_attr "mode" "<MODE>")
21574 : 282984720 : (set (attr "enabled")
21575 : 311505532 : (if_then_else
21576 : 312446265 : (match_test ("SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH"))
21577 : 312446265 : (if_then_else
21578 : 283936757 : (eq_attr "alternative" "0")
21579 : 311505532 : (symbol_ref "TARGET_MIX_SSE_I387
21580 : 311505532 : && X87_ENABLE_ARITH (<MODE>mode)")
21581 : 311505532 : (const_string "*"))
21582 : 312718755 : (if_then_else
21583 : 312718755 : (eq_attr "alternative" "0")
21584 : 312718755 : (symbol_ref "true")
21585 : 311505532 : (symbol_ref "false"))))])
21586 : 311505532 :
21587 : 311505532 : (define_insn "*<insn>hf"
21588 : 311947980 : [(set (match_operand:HF 0 "register_operand" "=v")
21589 : 311947980 : (plusminusmultdiv:HF
21590 : 311947980 : (match_operand:HF 1 "nonimmediate_operand" "<comm>v")
21591 : 311505532 : (match_operand:HF 2 "nonimmediate_operand" "vm")))]
21592 : 311509570 : "TARGET_AVX512FP16
21593 : 311509570 : && !(MEM_P (operands[1]) && MEM_P (operands[2]))"
21594 : 312795857 : "v<insn>sh\t{%2, %1, %0|%0, %1, %2}"
21595 : 312795857 : [(set_attr "prefix" "evex")
21596 : 312795857 : (set_attr "mode" "HF")])
21597 : 311505770 :
21598 : 311505770 : (define_insn "*rcpsf2_sse"
21599 : 311505818 : [(set (match_operand:SF 0 "register_operand" "=x,x,x,x")
21600 : 312965629 : (unspec:SF [(match_operand:SF 1 "nonimmediate_operand" "0,x,m,ja")]
21601 : 312965629 : UNSPEC_RCP))]
21602 : 312965647 : "TARGET_SSE && TARGET_SSE_MATH"
21603 : 337455717 : "@
21604 : 337455717 : %vrcpss\t{%d1, %0|%0, %d1}
21605 : 337455717 : %vrcpss\t{%d1, %0|%0, %d1}
21606 : 337456596 : rcpss\t{%1, %d0|%d0, %1}
21607 : 337456472 : vrcpss\t{%1, %d0|%d0, %1}"
21608 : 311506287 : [(set_attr "isa" "*,*,noavx,avx")
21609 : 330013451 : (set_attr "addr" "*,*,*,gpr16")
21610 : 330013451 : (set_attr "type" "sse")
21611 : 330013451 : (set_attr "atom_sse_attr" "rcp")
21612 : 330013451 : (set_attr "btver2_sse_attr" "rcp")
21613 : 330013451 : (set_attr "prefix" "maybe_vex")
21614 : 330013451 : (set_attr "mode" "SF")
21615 : 311505532 : (set_attr "avx_partial_xmm_update" "false,false,true,true")
21616 : 317481261 : (set (attr "preferred_for_speed")
21617 : 317481261 : (cond [(match_test "TARGET_AVX")
21618 : 317481261 : (symbol_ref "true")
21619 : 317481261 : (eq_attr "alternative" "1,2,3")
21620 : 317481261 : (symbol_ref "!TARGET_SSE_PARTIAL_REG_DEPENDENCY")
21621 : 311505532 : ]
21622 : 311666003 : (symbol_ref "true")))])
21623 : 311666003 :
21624 : 311650644 : (define_insn "rcphf2"
21625 : 311650644 : [(set (match_operand:HF 0 "register_operand" "=v,v")
21626 : 311799757 : (unspec:HF [(match_operand:HF 1 "nonimmediate_operand" "v,m")]
21627 : 311550627 : UNSPEC_RCP))]
21628 : 311621032 : "TARGET_AVX512FP16"
21629 : 311505532 : "@
21630 : 311505532 : vrcpsh\t{%d1, %0|%0, %d1}
21631 : 311505532 : vrcpsh\t{%1, %d0|%d0, %1}"
21632 : 311505532 : [(set_attr "type" "sse")
21633 : 311505532 : (set_attr "prefix" "evex")
21634 : 311505532 : (set_attr "mode" "HF")
21635 : 310762234 : (set_attr "avx_partial_xmm_update" "false,true")])
21636 : 311506465 :
21637 : 311506465 : (define_insn "*fop_xf_1_i387"
21638 : 311506465 : [(set (match_operand:XF 0 "register_operand" "=f,f")
21639 : 310763167 : (match_operator:XF 3 "binary_fp_operator"
21640 : 311506650 : [(match_operand:XF 1 "register_operand" "0,f")
21641 : 311506650 : (match_operand:XF 2 "register_operand" "f,0")]))]
21642 : 311505717 : "TARGET_80387
21643 : 311542525 : && !COMMUTATIVE_ARITH_P (operands[3])"
21644 : 311517021 : "* return output_387_binary_op (insn, operands);"
21645 : 311505873 : [(set (attr "type")
21646 : 311505873 : (if_then_else (match_operand:XF 3 "div_operator")
21647 : 311505868 : (const_string "fdiv")
21648 : 312666196 : (const_string "fop")))
21649 : 312566128 : (set_attr "mode" "XF")])
21650 : 313695848 :
21651 : 311579933 : (define_insn "*fop_<mode>_1"
21652 : 312561221 : [(set (match_operand:MODEF 0 "register_operand" "=f,f,x,v")
21653 : 312561221 : (match_operator:MODEF 3 "binary_fp_operator"
21654 : 310762234 : [(match_operand:MODEF 1
21655 : 311505717 : "x87nonimm_ssenomem_operand" "0,fm,0,v")
21656 : 311505717 : (match_operand:MODEF 2
21657 : 311505717 : "nonimmediate_operand" "fm,0,xm,vm")]))]
21658 : 311738456 : "((SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
21659 : 311507480 : || (TARGET_80387 && X87_ENABLE_ARITH (<MODE>mode)))
21660 : 311738456 : && !COMMUTATIVE_ARITH_P (operands[3])
21661 : 311738417 : && !(MEM_P (operands[1]) && MEM_P (operands[2]))"
21662 : 311536320 : "* return output_387_binary_op (insn, operands);"
21663 : 311505717 : [(set (attr "type")
21664 : 311505717 : (if_then_else (eq_attr "alternative" "2,3")
21665 : 312266560 : (if_then_else (match_operand:MODEF 3 "div_operator")
21666 : 312303767 : (const_string "ssediv")
21667 : 312241633 : (const_string "sseadd"))
21668 : 313002476 : (if_then_else (match_operand:MODEF 3 "div_operator")
21669 : 310792627 : (const_string "fdiv")
21670 : 312236167 : (const_string "fop"))))
21671 : 312236167 : (set_attr "isa" "*,*,noavx,avx")
21672 : 311541295 : (set_attr "prefix" "orig,orig,orig,vex")
21673 : 310762234 : (set_attr "mode" "<MODE>")
21674 : 311538740 : (set (attr "enabled")
21675 : 311538740 : (if_then_else
21676 : 31011990 : (match_test ("SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH"))
21677 : 310762419 : (if_then_else
21678 : 31002999 : (eq_attr "alternative" "0,1")
21679 : 311505532 : (symbol_ref "TARGET_MIX_SSE_I387
21680 : 29886117 : && X87_ENABLE_ARITH (<MODE>mode)")
21681 : 310762242 : (const_string "*"))
21682 : 311505532 : (if_then_else
21683 : 311505532 : (eq_attr "alternative" "0,1")
21684 : 30112662 : (symbol_ref "true")
21685 : 311505532 : (symbol_ref "false"))))])
21686 : 29688386 :
21687 : 311505532 : (define_insn "*fop_<X87MODEF:mode>_2_i387"
21688 : 311505532 : [(set (match_operand:X87MODEF 0 "register_operand" "=f")
21689 : 311505532 : (match_operator:X87MODEF 3 "binary_fp_operator"
21690 : 311505532 : [(float:X87MODEF
21691 : 311505532 : (match_operand:SWI24 1 "nonimmediate_operand" "m"))
21692 : 310762234 : (match_operand:X87MODEF 2 "register_operand" "0")]))]
21693 : 310782695 : "TARGET_80387 && X87_ENABLE_FLOAT (<X87MODEF:MODE>mode, <SWI24:MODE>mode)
21694 : 311582904 : && !(SSE_FLOAT_MODE_P (<X87MODEF:MODE>mode) && TARGET_SSE_MATH)
21695 : 310763551 : && (TARGET_USE_<SWI24:MODE>MODE_FIOP
21696 : 310763551 : || optimize_function_for_size_p (cfun))"
21697 : 311585606 : "* return output_387_binary_op (insn, operands);"
21698 : 311507070 : [(set (attr "type")
21699 : 311507070 : (cond [(match_operand:X87MODEF 3 "mult_operator")
21700 : 310840734 : (const_string "fmul")
21701 : 310840906 : (match_operand:X87MODEF 3 "div_operator")
21702 : 310762234 : (const_string "fdiv")
21703 : 311507070 : ]
21704 : 310875053 : (const_string "fop")))
21705 : 311619889 : (set_attr "fp_int_src" "true")
21706 : 311507070 : (set_attr "mode" "<SWI24:MODE>")])
21707 : 311507130 :
21708 : 311507331 : (define_insn "*fop_<X87MODEF:mode>_3_i387"
21709 : 311597730 : [(set (match_operand:X87MODEF 0 "register_operand" "=f")
21710 : 311597730 : (match_operator:X87MODEF 3 "binary_fp_operator"
21711 : 311597730 : [(match_operand:X87MODEF 1 "register_operand" "0")
21712 : 311597730 : (float:X87MODEF
21713 : 311507271 : (match_operand:SWI24 2 "nonimmediate_operand" "m"))]))]
21714 : 311527840 : "TARGET_80387 && X87_ENABLE_FLOAT (<X87MODEF:MODE>mode, <SWI24:MODE>mode)
21715 : 311528937 : && !(SSE_FLOAT_MODE_P (<X87MODEF:MODE>mode) && TARGET_SSE_MATH)
21716 : 311507271 : && (TARGET_USE_<SWI24:MODE>MODE_FIOP
21717 : 311555132 : || optimize_function_for_size_p (cfun))"
21718 : 311529218 : "* return output_387_binary_op (insn, operands);"
21719 : 311543045 : [(set (attr "type")
21720 : 311543045 : (cond [(match_operand:X87MODEF 3 "mult_operator")
21721 : 311543045 : (const_string "fmul")
21722 : 311531398 : (match_operand:X87MODEF 3 "div_operator")
21723 : 311543045 : (const_string "fdiv")
21724 : 311507271 : ]
21725 : 311518642 : (const_string "fop")))
21726 : 311518642 : (set_attr "fp_int_src" "true")
21727 : 311516282 : (set_attr "mode" "<SWI24:MODE>")])
21728 : 311507283 :
21729 : 311507283 : (define_insn "*fop_xf_4_i387"
21730 : 311519435 : [(set (match_operand:XF 0 "register_operand" "=f,f")
21731 : 311519435 : (match_operator:XF 3 "binary_fp_operator"
21732 : 311519435 : [(float_extend:XF
21733 : 311507271 : (match_operand:MODEF 1 "nonimmediate_operand" "fm,0"))
21734 : 311518370 : (match_operand:XF 2 "register_operand" "0,f")]))]
21735 : 311527345 : "TARGET_80387"
21736 : 311519913 : "* return output_387_binary_op (insn, operands);"
21737 : 311517729 : [(set (attr "type")
21738 : 311527323 : (cond [(match_operand:XF 3 "mult_operator")
21739 : 311509417 : (const_string "fmul")
21740 : 311544622 : (match_operand:XF 3 "div_operator")
21741 : 311534034 : (const_string "fdiv")
21742 : 311512797 : ]
21743 : 311512797 : (const_string "fop")))
21744 : 311512797 : (set_attr "mode" "<MODE>")])
21745 : 310772317 :
21746 : 311515539 : (define_insn "*fop_df_4_i387"
21747 : 311516952 : [(set (match_operand:DF 0 "register_operand" "=f,f")
21748 : 311507070 : (match_operator:DF 3 "binary_fp_operator"
21749 : 310762234 : [(float_extend:DF
21750 : 311507070 : (match_operand:SF 1 "nonimmediate_operand" "fm,0"))
21751 : 311507070 : (match_operand:DF 2 "register_operand" "0,f")]))]
21752 : 311515539 : "TARGET_80387 && X87_ENABLE_ARITH (DFmode)
21753 : 311515478 : && !(SSE_FLOAT_MODE_P (DFmode) && TARGET_SSE_MATH)"
21754 : 311516729 : "* return output_387_binary_op (insn, operands);"
21755 : 311507134 : [(set (attr "type")
21756 : 311507134 : (cond [(match_operand:DF 3 "mult_operator")
21757 : 311507158 : (const_string "fmul")
21758 : 311509613 : (match_operand:DF 3 "div_operator")
21759 : 311507158 : (const_string "fdiv")
21760 : 310762322 : ]
21761 : 310784653 : (const_string "fop")))
21762 : 311529489 : (set_attr "mode" "SF")])
21763 : 311530340 :
21764 : 311530340 : (define_insn "*fop_xf_5_i387"
21765 : 311508009 : [(set (match_operand:XF 0 "register_operand" "=f,f")
21766 : 311529705 : (match_operator:XF 3 "binary_fp_operator"
21767 : 311529705 : [(match_operand:XF 1 "register_operand" "0,f")
21768 : 311529705 : (float_extend:XF
21769 : 311508009 : (match_operand:MODEF 2 "nonimmediate_operand" "fm,0"))]))]
21770 : 311535231 : "TARGET_80387"
21771 : 282989588 : "* return output_387_binary_op (insn, operands);"
21772 : 311508549 : [(set (attr "type")
21773 : 311508549 : (cond [(match_operand:XF 3 "mult_operator")
21774 : 282987559 : (const_string "fmul")
21775 : 311512788 : (match_operand:XF 3 "div_operator")
21776 : 311511412 : (const_string "fdiv")
21777 : 311507985 : ]
21778 : 311509005 : (const_string "fop")))
21779 : 311509005 : (set_attr "mode" "<MODE>")])
21780 : 311509079 :
21781 : 311509104 : (define_insn "*fop_df_5_i387"
21782 : 311509073 : [(set (match_operand:DF 0 "register_operand" "=f,f")
21783 : 311509081 : (match_operator:DF 3 "binary_fp_operator"
21784 : 311509127 : [(match_operand:DF 1 "register_operand" "0,f")
21785 : 311508107 : (float_extend:DF
21786 : 311508107 : (match_operand:SF 2 "nonimmediate_operand" "fm,0"))]))]
21787 : 311508999 : "TARGET_80387 && X87_ENABLE_ARITH (DFmode)
21788 : 311508986 : && !(SSE_FLOAT_MODE_P (DFmode) && TARGET_SSE_MATH)"
21789 : 311509046 : "* return output_387_binary_op (insn, operands);"
21790 : 311508107 : [(set (attr "type")
21791 : 282987173 : (cond [(match_operand:DF 3 "mult_operator")
21792 : 311508043 : (const_string "fmul")
21793 : 311508317 : (match_operand:DF 3 "div_operator")
21794 : 311508043 : (const_string "fdiv")
21795 : 282987198 : ]
21796 : 311508018 : (const_string "fop")))
21797 : 282987198 : (set_attr "mode" "SF")])
21798 : 311507929 :
21799 : 311507929 : (define_insn "*fop_xf_6_i387"
21800 : 283148649 : [(set (match_operand:XF 0 "register_operand" "=f,f")
21801 : 311669453 : (match_operator:XF 3 "binary_fp_operator"
21802 : 311669453 : [(float_extend:XF
21803 : 311669453 : (match_operand:MODEF 1 "register_operand" "0,f"))
21804 : 311669668 : (float_extend:XF
21805 : 311669668 : (match_operand:MODEF 2 "nonimmediate_operand" "fm,0"))]))]
21806 : 282987395 : "TARGET_80387"
21807 : 283004974 : "* return output_387_binary_op (insn, operands);"
21808 : 283029669 : [(set (attr "type")
21809 : 282987109 : (cond [(match_operand:XF 3 "mult_operator")
21810 : 311529669 : (const_string "fmul")
21811 : 283011357 : (match_operand:XF 3 "div_operator")
21812 : 283003201 : (const_string "fdiv")
21813 : 311534401 : ]
21814 : 311510021 : (const_string "fop")))
21815 : 311510021 : (set_attr "mode" "<MODE>")])
21816 : 311510021 :
21817 : 311509750 : (define_insn "*fop_df_6_i387"
21818 : 311509750 : [(set (match_operand:DF 0 "register_operand" "=f,f")
21819 : 311509750 : (match_operator:DF 3 "binary_fp_operator"
21820 : 311509750 : [(float_extend:DF
21821 : 282987324 : (match_operand:SF 1 "register_operand" "0,f"))
21822 : 311509535 : (float_extend:DF
21823 : 311509535 : (match_operand:SF 2 "nonimmediate_operand" "fm,0"))]))]
21824 : 311509593 : "TARGET_80387 && X87_ENABLE_ARITH (DFmode)
21825 : 311509593 : && !(SSE_FLOAT_MODE_P (DFmode) && TARGET_SSE_MATH)"
21826 : 311509551 : "* return output_387_binary_op (insn, operands);"
21827 : 311509535 : [(set (attr "type")
21828 : 311509535 : (cond [(match_operand:DF 3 "mult_operator")
21829 : 311509535 : (const_string "fmul")
21830 : 311509546 : (match_operand:DF 3 "div_operator")
21831 : 311509535 : (const_string "fdiv")
21832 : 282987109 : ]
21833 : 282987109 : (const_string "fop")))
21834 : 311509535 : (set_attr "mode" "SF")])
21835 : 311512216 :
21836 : 311512216 : ;; FPU special functions.
21837 : 311512216 :
21838 : 311512216 : ;; This pattern implements a no-op XFmode truncation for
21839 : 311512216 : ;; all fancy i386 XFmode math functions.
21840 : 311512216 :
21841 : 311512216 : (define_insn "truncxf<mode>2_i387_noop_unspec"
21842 : 311512216 : [(set (match_operand:MODEF 0 "nonimmediate_operand" "=mf")
21843 : 311629986 : (unspec:MODEF [(match_operand:XF 1 "register_operand" "f")]
21844 : 311512216 : UNSPEC_TRUNC_NOOP))]
21845 : 311512367 : "TARGET_USE_FANCY_MATH_387"
21846 : 311512227 : "* return output_387_reg_move (insn, operands);"
21847 : 311629986 : [(set_attr "type" "fmov")
21848 : 311629986 : (set_attr "mode" "<MODE>")])
21849 : 311630286 :
21850 : 311512559 : (define_insn "sqrtxf2"
21851 : 311630281 : [(set (match_operand:XF 0 "register_operand" "=f")
21852 : 311512811 : (sqrt:XF (match_operand:XF 1 "register_operand" "0")))]
21853 : 311513263 : "TARGET_USE_FANCY_MATH_387"
21854 : 311587219 : "fsqrt"
21855 : 311512216 : [(set_attr "type" "fpspc")
21856 : 311512305 : (set_attr "mode" "XF")
21857 : 311512249 : (set_attr "athlon_decode" "direct")
21858 : 311512290 : (set_attr "amdfam10_decode" "direct")
21859 : 311512290 : (set_attr "bdver1_decode" "direct")])
21860 : 311512323 :
21861 : 311512290 : (define_insn "*rsqrtsf2_sse"
21862 : 311512249 : [(set (match_operand:SF 0 "register_operand" "=x,x,x,x")
21863 : 311512249 : (unspec:SF [(match_operand:SF 1 "nonimmediate_operand" "0,x,m,ja")]
21864 : 311512249 : UNSPEC_RSQRT))]
21865 : 311512305 : "TARGET_SSE && TARGET_SSE_MATH"
21866 : 311512216 : "@
21867 : 311512216 : %vrsqrtss\t{%d1, %0|%0, %d1}
21868 : 311512216 : %vrsqrtss\t{%d1, %0|%0, %d1}
21869 : 311512340 : rsqrtss\t{%1, %d0|%d0, %1}
21870 : 311512340 : vrsqrtss\t{%1, %d0|%d0, %1}"
21871 : 311512216 : [(set_attr "isa" "*,*,noavx,avx")
21872 : 311512216 : (set_attr "addr" "*,*,*,gpr16")
21873 : 311512216 : (set_attr "type" "sse")
21874 : 311512216 : (set_attr "atom_sse_attr" "rcp")
21875 : 311512216 : (set_attr "btver2_sse_attr" "rcp")
21876 : 311512216 : (set_attr "prefix" "maybe_vex")
21877 : 311512216 : (set_attr "mode" "SF")
21878 : 311512216 : (set_attr "avx_partial_xmm_update" "false,false,true,true")
21879 : 311512216 : (set (attr "preferred_for_speed")
21880 : 311512216 : (cond [(match_test "TARGET_AVX")
21881 : 311512216 : (symbol_ref "true")
21882 : 311512216 : (eq_attr "alternative" "1,2,3")
21883 : 311512216 : (symbol_ref "!TARGET_SSE_PARTIAL_REG_DEPENDENCY")
21884 : 311512216 : ]
21885 : 311512216 : (symbol_ref "true")))])
21886 : 311512216 :
21887 : 311512216 : (define_expand "rsqrtsf2"
21888 : 311512216 : [(set (match_operand:SF 0 "register_operand")
21889 : 311512216 : (unspec:SF [(match_operand:SF 1 "nonimmediate_operand")]
21890 : 311512216 : UNSPEC_RSQRT))]
21891 : 311512216 : "TARGET_SSE && TARGET_SSE_MATH"
21892 : 311512230 : {
21893 : 311512230 : ix86_emit_swsqrtsf (operands[0], operands[1], SFmode, 1);
21894 : 311512230 : DONE;
21895 : 311512216 : })
21896 : 311512216 :
21897 : 311512216 : (define_insn "rsqrthf2"
21898 : 311512216 : [(set (match_operand:HF 0 "register_operand" "=v,v")
21899 : 311512216 : (unspec:HF [(match_operand:HF 1 "nonimmediate_operand" "v,m")]
21900 : 311512216 : UNSPEC_RSQRT))]
21901 : 311512340 : "TARGET_AVX512FP16"
21902 : 311512216 : "@
21903 : 311512254 : vrsqrtsh\t{%d1, %0|%0, %d1}
21904 : 311512216 : vrsqrtsh\t{%1, %d0|%d0, %1}"
21905 : 311512216 : [(set_attr "type" "sse")
21906 : 311512216 : (set_attr "prefix" "evex")
21907 : 311512216 : (set_attr "avx_partial_xmm_update" "false,true")
21908 : 311512216 : (set_attr "mode" "HF")])
21909 : 311512226 :
21910 : 311512226 : (define_insn "sqrthf2"
21911 : 311512216 : [(set (match_operand:HF 0 "register_operand" "=v,v")
21912 : 311512226 : (sqrt:HF
21913 : 311512226 : (match_operand:HF 1 "nonimmediate_operand" "v,m")))]
21914 : 311512300 : "TARGET_AVX512FP16"
21915 : 311512887 : "@
21916 : 311512226 : vsqrtsh\t{%d1, %0|%0, %d1}
21917 : 311512226 : vsqrtsh\t{%1, %d0|%d0, %1}"
21918 : 311512897 : [(set_attr "type" "sse")
21919 : 311514698 : (set_attr "prefix" "evex")
21920 : 311514579 : (set_attr "avx_partial_xmm_update" "false,true")
21921 : 311514579 : (set_attr "mode" "HF")])
21922 : 282989581 :
21923 : 311512887 : (define_insn "*sqrt<mode>2_sse"
21924 : 311512216 : [(set (match_operand:MODEF 0 "register_operand" "=v,v,v")
21925 : 311512216 : (sqrt:MODEF
21926 : 282987109 : (match_operand:MODEF 1 "nonimmediate_operand" "0,v,m")))]
21927 : 311513590 : "SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH"
21928 : 311514058 : "@
21929 : 311512216 : %vsqrt<ssemodesuffix>\t{%d1, %0|%0, %d1}
21930 : 311512216 : %vsqrt<ssemodesuffix>\t{%d1, %0|%0, %d1}
21931 : 311516664 : %vsqrt<ssemodesuffix>\t{%1, %d0|%d0, %1}"
21932 : 311516664 : [(set_attr "type" "sse")
21933 : 311516579 : (set_attr "atom_sse_attr" "sqrt")
21934 : 311516579 : (set_attr "btver2_sse_attr" "sqrt")
21935 : 311519697 : (set_attr "prefix" "maybe_vex")
21936 : 311512216 : (set_attr "avx_partial_xmm_update" "false,false,true")
21937 : 311522428 : (set_attr "mode" "<MODE>")
21938 : 311512216 : (set (attr "preferred_for_speed")
21939 : 311512216 : (cond [(match_test "TARGET_AVX")
21940 : 282987109 : (symbol_ref "true")
21941 : 282997321 : (eq_attr "alternative" "1,2")
21942 : 311522428 : (symbol_ref "!TARGET_SSE_PARTIAL_REG_DEPENDENCY")
21943 : 311522428 : ]
21944 : 311522428 : (symbol_ref "true")))])
21945 : 282997321 :
21946 : 311522428 : (define_expand "sqrt<mode>2"
21947 : 311522428 : [(set (match_operand:MODEF 0 "register_operand")
21948 : 311522428 : (sqrt:MODEF
21949 : 311522428 : (match_operand:MODEF 1 "nonimmediate_operand")))]
21950 : 311512216 : "(TARGET_USE_FANCY_MATH_387 && X87_ENABLE_ARITH (<MODE>mode))
21951 : 311520824 : || (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)"
21952 : 311522777 : {
21953 : 311514169 : if (<MODE>mode == SFmode
21954 : 311521495 : && TARGET_SSE && TARGET_SSE_MATH
21955 : 311521479 : && TARGET_RECIP_SQRT
21956 : 311528622 : && !optimize_function_for_size_p (cfun)
21957 : 311512220 : && flag_finite_math_only && !flag_trapping_math
21958 : 311512891 : && flag_unsafe_math_optimizations)
21959 : 282987109 : {
21960 : 282987113 : ix86_emit_swsqrtsf (operands[0], operands[1], SFmode, 0);
21961 : 311512220 : DONE;
21962 : 311512216 : }
21963 : 311512216 :
21964 : 282989058 : if (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH))
21965 : 311512216 : {
21966 : 311512226 : rtx op0 = gen_reg_rtx (XFmode);
21967 : 311512226 : rtx op1 = gen_reg_rtx (XFmode);
21968 : 282987109 :
21969 : 311512226 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
21970 : 311512226 : emit_insn (gen_sqrtxf2 (op0, op1));
21971 : 311512226 : emit_insn (gen_truncxf<mode>2_i387_noop_unspec (operands[0], op0));
21972 : 311512226 : DONE;
21973 : 311512216 : }
21974 : 311512216 : })
21975 : 311512216 :
21976 : 311512216 : (define_expand "hypot<mode>3"
21977 : 311514155 : [(use (match_operand:MODEF 0 "register_operand"))
21978 : 311511766 : (use (match_operand:MODEF 1 "general_operand"))
21979 : 310770857 : (use (match_operand:MODEF 2 "general_operand"))]
21980 : 310770857 : "TARGET_USE_FANCY_MATH_387
21981 : 310768918 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
21982 : 310920458 : || TARGET_MIX_SSE_I387)
21983 : 310768918 : && flag_finite_math_only
21984 : 310768918 : && flag_unsafe_math_optimizations"
21985 : 310770857 : {
21986 : 310770857 : rtx op0 = gen_reg_rtx (XFmode);
21987 : 310770857 : rtx op1 = gen_reg_rtx (XFmode);
21988 : 310768918 : rtx op2 = gen_reg_rtx (XFmode);
21989 : 310768918 :
21990 : 310768918 : emit_insn (gen_extend<mode>xf2 (op2, operands[2]));
21991 : 282255673 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
21992 : 310782062 :
21993 : 310780780 : emit_insn (gen_mulxf3 (op1, op1, op1));
21994 : 310780780 : emit_insn (gen_mulxf3 (op2, op2, op2));
21995 : 282255673 : emit_insn (gen_addxf3 (op0, op2, op1));
21996 : 282256955 : emit_insn (gen_sqrtxf2 (op0, op0));
21997 : 310780780 :
21998 : 310780780 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
21999 : 310780780 : DONE;
22000 : 282256955 : })
22001 : 310780780 :
22002 : 310780780 : (define_insn "x86_fnstsw_1"
22003 : 310780780 : [(set (match_operand:HI 0 "register_operand" "=a")
22004 : 310780780 : (unspec:HI [(reg:CCFP FPSR_REG)] UNSPEC_FNSTSW))]
22005 : 310781422 : "TARGET_80387"
22006 : 282255673 : "fnstsw\t%0"
22007 : 310780919 : [(set_attr "length" "2")
22008 : 310780919 : (set_attr "mode" "SI")
22009 : 310780919 : (set_attr "unit" "i387")])
22010 : 282255673 :
22011 : 310780919 : (define_insn "fpremxf4_i387"
22012 : 310780919 : [(set (match_operand:XF 0 "register_operand" "=f")
22013 : 310780919 : (unspec:XF [(match_operand:XF 2 "register_operand" "0")
22014 : 310780919 : (match_operand:XF 3 "register_operand" "1")]
22015 : 310855381 : UNSPEC_FPREM_F))
22016 : 310780919 : (set (match_operand:XF 1 "register_operand" "=f")
22017 : 310778530 : (unspec:XF [(match_dup 2) (match_dup 3)]
22018 : 310769057 : UNSPEC_FPREM_U))
22019 : 310843519 : (set (reg:CCFP FPSR_REG)
22020 : 310843519 : (unspec:CCFP [(match_dup 2) (match_dup 3)]
22021 : 310842395 : UNSPEC_C2_FLAG))]
22022 : 310769248 : "TARGET_USE_FANCY_MATH_387"
22023 : 310843568 : "fprem"
22024 : 310843519 : [(set_attr "type" "fpspc")
22025 : 310841131 : (set_attr "znver1_decode" "vector")
22026 : 310843607 : (set_attr "mode" "XF")])
22027 : 310843656 :
22028 : 310769194 : (define_expand "fmodxf3"
22029 : 310773843 : [(use (match_operand:XF 0 "register_operand"))
22030 : 310773843 : (use (match_operand:XF 1 "general_operand"))
22031 : 310773843 : (use (match_operand:XF 2 "general_operand"))]
22032 : 310769106 : "TARGET_USE_FANCY_MATH_387"
22033 : 310773724 : {
22034 : 310769106 : rtx_code_label *label = gen_label_rtx ();
22035 : 282245318 :
22036 : 310770613 : rtx op1 = gen_reg_rtx (XFmode);
22037 : 310769106 : rtx op2 = gen_reg_rtx (XFmode);
22038 : 310769684 :
22039 : 282244487 : emit_move_insn (op2, operands[2]);
22040 : 282244626 : emit_move_insn (op1, operands[1]);
22041 : 310769545 :
22042 : 310769594 : emit_label (label);
22043 : 282244487 : emit_insn (gen_fpremxf4_i387 (op1, op2, op1, op2));
22044 : 282244501 : ix86_emit_fp_unordered_jump (label);
22045 : 310769594 : LABEL_NUSES (label) = 1;
22046 : 310769545 :
22047 : 310769594 : emit_move_insn (operands[0], op1);
22048 : 310768967 : DONE;
22049 : 310769224 : })
22050 : 310769224 :
22051 : 310769221 : (define_expand "fmod<mode>3"
22052 : 310769527 : [(use (match_operand:MODEF 0 "register_operand"))
22053 : 310768918 : (use (match_operand:MODEF 1 "general_operand"))
22054 : 282244114 : (use (match_operand:MODEF 2 "general_operand"))]
22055 : 282243811 : "TARGET_USE_FANCY_MATH_387"
22056 : 282243953 : {
22057 : 310769060 : rtx (*gen_truncxf) (rtx, rtx);
22058 : 282243811 :
22059 : 310772198 : rtx_code_label *label = gen_label_rtx ();
22060 : 310771914 :
22061 : 310772056 : rtx op1 = gen_reg_rtx (XFmode);
22062 : 310772056 : rtx op2 = gen_reg_rtx (XFmode);
22063 : 310771914 :
22064 : 310772056 : emit_insn (gen_extend<mode>xf2 (op2, operands[2]));
22065 : 310772056 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22066 : 310771914 :
22067 : 310772056 : emit_label (label);
22068 : 310772056 : emit_insn (gen_fpremxf4_i387 (op1, op2, op1, op2));
22069 : 282243953 : ix86_emit_fp_unordered_jump (label);
22070 : 282243953 : LABEL_NUSES (label) = 1;
22071 : 310771914 :
22072 : 310771983 : /* Truncate the result properly for strict SSE math. */
22073 : 310772060 : if (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH
22074 : 310772040 : && !TARGET_MIX_SSE_I387)
22075 : 310771918 : gen_truncxf = gen_truncxf<mode>2;
22076 : 282243876 : else
22077 : 282243897 : gen_truncxf = gen_truncxf<mode>2_i387_noop_unspec;
22078 : 310771983 :
22079 : 310772060 : emit_insn (gen_truncxf (operands[0], op1));
22080 : 310772060 : DONE;
22081 : 282243876 : })
22082 : 310771983 :
22083 : 310771918 : (define_insn "fprem1xf4_i387"
22084 : 310771918 : [(set (match_operand:XF 0 "register_operand" "=f")
22085 : 310771918 : (unspec:XF [(match_operand:XF 2 "register_operand" "0")
22086 : 310771918 : (match_operand:XF 3 "register_operand" "1")]
22087 : 310771918 : UNSPEC_FPREM1_F))
22088 : 310771918 : (set (match_operand:XF 1 "register_operand" "=f")
22089 : 310771918 : (unspec:XF [(match_dup 2) (match_dup 3)]
22090 : 310771918 : UNSPEC_FPREM1_U))
22091 : 310771918 : (set (reg:CCFP FPSR_REG)
22092 : 310771918 : (unspec:CCFP [(match_dup 2) (match_dup 3)]
22093 : 310771918 : UNSPEC_C2_FLAG))]
22094 : 310772006 : "TARGET_USE_FANCY_MATH_387"
22095 : 310771918 : "fprem1"
22096 : 310771918 : [(set_attr "type" "fpspc")
22097 : 310771918 : (set_attr "znver1_decode" "vector")
22098 : 310771918 : (set_attr "mode" "XF")])
22099 : 310771918 :
22100 : 310771918 : (define_expand "remainderxf3"
22101 : 310771918 : [(use (match_operand:XF 0 "register_operand"))
22102 : 310772175 : (use (match_operand:XF 1 "general_operand"))
22103 : 310772175 : (use (match_operand:XF 2 "general_operand"))]
22104 : 310772007 : "TARGET_USE_FANCY_MATH_387"
22105 : 310771930 : {
22106 : 310771942 : rtx_code_label *label = gen_label_rtx ();
22107 : 310771918 :
22108 : 310771930 : rtx op1 = gen_reg_rtx (XFmode);
22109 : 310772019 : rtx op2 = gen_reg_rtx (XFmode);
22110 : 310772007 :
22111 : 310771930 : emit_move_insn (op2, operands[2]);
22112 : 310771930 : emit_move_insn (op1, operands[1]);
22113 : 310772007 :
22114 : 310772019 : emit_label (label);
22115 : 310771930 : emit_insn (gen_fprem1xf4_i387 (op1, op2, op1, op2));
22116 : 310771930 : ix86_emit_fp_unordered_jump (label);
22117 : 310771930 : LABEL_NUSES (label) = 1;
22118 : 310771918 :
22119 : 310771930 : emit_move_insn (operands[0], op1);
22120 : 310771930 : DONE;
22121 : 310771918 : })
22122 : 310771918 :
22123 : 310771918 : (define_expand "remainder<mode>3"
22124 : 310763280 : [(use (match_operand:MODEF 0 "register_operand"))
22125 : 282252449 : (use (match_operand:MODEF 1 "general_operand"))
22126 : 282252449 : (use (match_operand:MODEF 2 "general_operand"))]
22127 : 282252449 : "TARGET_USE_FANCY_MATH_387"
22128 : 313571213 : {
22129 : 285060490 : rtx (*gen_truncxf) (rtx, rtx);
22130 : 285060414 :
22131 : 285060566 : rtx_code_label *label = gen_label_rtx ();
22132 : 313571137 :
22133 : 285060490 : rtx op1 = gen_reg_rtx (XFmode);
22134 : 285060490 : rtx op2 = gen_reg_rtx (XFmode);
22135 : 285060414 :
22136 : 306082219 : emit_insn (gen_extend<mode>xf2 (op2, operands[2]));
22137 : 285060490 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22138 : 285060414 :
22139 : 285060490 : emit_label (label);
22140 : 300667091 :
22141 : 285060490 : emit_insn (gen_fprem1xf4_i387 (op1, op2, op1, op2));
22142 : 285060490 : ix86_emit_fp_unordered_jump (label);
22143 : 285060490 : LABEL_NUSES (label) = 1;
22144 : 295760132 :
22145 : 285060414 : /* Truncate the result properly for strict SSE math. */
22146 : 285060490 : if (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH
22147 : 285060490 : && !TARGET_MIX_SSE_I387)
22148 : 295760132 : gen_truncxf = gen_truncxf<mode>2;
22149 : 285060452 : else
22150 : 285060414 : gen_truncxf = gen_truncxf<mode>2_i387_noop_unspec;
22151 : 285060452 :
22152 : 295760170 : emit_insn (gen_truncxf (operands[0], op1));
22153 : 285060490 : DONE;
22154 : 285060452 : })
22155 : 285060414 :
22156 : 295760094 : (define_int_iterator SINCOS
22157 : 285060414 : [UNSPEC_SIN
22158 : 285060414 : UNSPEC_COS])
22159 : 285060414 :
22160 : 295760094 : (define_int_attr sincos
22161 : 285060414 : [(UNSPEC_SIN "sin")
22162 : 285060414 : (UNSPEC_COS "cos")])
22163 : 285060414 :
22164 : 295671087 : (define_insn "<sincos>xf2"
22165 : 285060414 : [(set (match_operand:XF 0 "register_operand" "=f")
22166 : 285060414 : (unspec:XF [(match_operand:XF 1 "register_operand" "0")]
22167 : 285060414 : SINCOS))]
22168 : 289593665 : "TARGET_USE_FANCY_MATH_387
22169 : 285060417 : && flag_unsafe_math_optimizations"
22170 : 285060414 : "f<sincos>"
22171 : 285060414 : [(set_attr "type" "fpspc")
22172 : 295469098 : (set_attr "znver1_decode" "vector")
22173 : 285060520 : (set_attr "mode" "XF")])
22174 : 285060520 :
22175 : 285060414 : (define_expand "<sincos><mode>2"
22176 : 295469204 : [(set (match_operand:MODEF 0 "register_operand")
22177 : 285060558 : (unspec:MODEF [(match_operand:MODEF 1 "general_operand")]
22178 : 285060520 : SINCOS))]
22179 : 285060414 : "TARGET_USE_FANCY_MATH_387
22180 : 295469204 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22181 : 285060520 : || TARGET_MIX_SSE_I387)
22182 : 285060558 : && flag_unsafe_math_optimizations"
22183 : 285060558 : {
22184 : 295469136 : rtx op0 = gen_reg_rtx (XFmode);
22185 : 285060414 : rtx op1 = gen_reg_rtx (XFmode);
22186 : 285060452 :
22187 : 285051814 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22188 : 295455129 : emit_insn (gen_<sincos>xf2 (op0, op1));
22189 : 285060414 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22190 : 285060414 : DONE;
22191 : 285051776 : })
22192 : 295451458 :
22193 : 285060414 : (define_insn "sincosxf3"
22194 : 285060414 : [(set (match_operand:XF 0 "register_operand" "=f")
22195 : 285060414 : (unspec:XF [(match_operand:XF 2 "register_operand" "0")]
22196 : 295451456 : UNSPEC_SINCOS_COS))
22197 : 285060414 : (set (match_operand:XF 1 "register_operand" "=f")
22198 : 285060414 : (unspec:XF [(match_dup 2)] UNSPEC_SINCOS_SIN))]
22199 : 285060420 : "TARGET_USE_FANCY_MATH_387
22200 : 295451462 : && flag_unsafe_math_optimizations"
22201 : 282250060 : "fsincos"
22202 : 285060414 : [(set_attr "type" "fpspc")
22203 : 285060414 : (set_attr "znver1_decode" "vector")
22204 : 295451475 : (set_attr "mode" "XF")])
22205 : 282250079 :
22206 : 285051795 : (define_expand "sincos<mode>3"
22207 : 285060414 : [(use (match_operand:MODEF 0 "register_operand"))
22208 : 295451456 : (use (match_operand:MODEF 1 "register_operand"))
22209 : 285060414 : (use (match_operand:MODEF 2 "general_operand"))]
22210 : 285051776 : "TARGET_USE_FANCY_MATH_387
22211 : 285060414 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22212 : 295451456 : || TARGET_MIX_SSE_I387)
22213 : 285060414 : && flag_unsafe_math_optimizations"
22214 : 285060418 : {
22215 : 285060414 : rtx op0 = gen_reg_rtx (XFmode);
22216 : 295430350 : rtx op1 = gen_reg_rtx (XFmode);
22217 : 285060418 : rtx op2 = gen_reg_rtx (XFmode);
22218 : 285060414 :
22219 : 282250064 : emit_insn (gen_extend<mode>xf2 (op2, operands[2]));
22220 : 292616793 : emit_insn (gen_sincosxf3 (op0, op1, op2));
22221 : 285060418 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22222 : 285060418 : emit_insn (gen_truncxf<mode>2 (operands[1], op1));
22223 : 285060418 : DONE;
22224 : 292616789 : })
22225 : 285060414 :
22226 : 285060414 : (define_insn "fptanxf4_i387"
22227 : 285060414 : [(set (match_operand:SF 0 "register_operand" "=f")
22228 : 295427143 : (match_operand:SF 3 "const1_operand"))
22229 : 285058025 : (set (match_operand:XF 1 "register_operand" "=f")
22230 : 282252449 : (unspec:XF [(match_operand:XF 2 "register_operand" "0")]
22231 : 282252449 : UNSPEC_TAN))]
22232 : 292619180 : "TARGET_USE_FANCY_MATH_387
22233 : 282242168 : && flag_unsafe_math_optimizations"
22234 : 282252449 : "fptan"
22235 : 282250060 : [(set_attr "type" "fpspc")
22236 : 292616789 : (set_attr "znver1_decode" "vector")
22237 : 282243811 : (set_attr "mode" "XF")])
22238 : 282252449 :
22239 : 282252449 : (define_expand "tanxf2"
22240 : 292616789 : [(use (match_operand:XF 0 "register_operand"))
22241 : 282244214 : (use (match_operand:XF 1 "register_operand"))]
22242 : 284624790 : "TARGET_USE_FANCY_MATH_387
22243 : 284624790 : && flag_unsafe_math_optimizations"
22244 : 292610919 : {
22245 : 284624391 : rtx one = gen_reg_rtx (SFmode);
22246 : 284624407 : emit_insn (gen_fptanxf4_i387 (one, operands[0], operands[1],
22247 : 284624411 : CONST1_RTX (SFmode)));
22248 : 294982839 : DONE;
22249 : 282252467 : })
22250 : 282252469 :
22251 : 282252469 : (define_expand "tan<mode>2"
22252 : 292552418 : [(use (match_operand:MODEF 0 "register_operand"))
22253 : 282252484 : (use (match_operand:MODEF 1 "general_operand"))]
22254 : 282252455 : "TARGET_USE_FANCY_MATH_387
22255 : 282252451 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22256 : 292523072 : || TARGET_MIX_SSE_I387)
22257 : 282252453 : && flag_unsafe_math_optimizations"
22258 : 282252450 : {
22259 : 282252451 : rtx op0 = gen_reg_rtx (XFmode);
22260 : 292433096 : rtx op1 = gen_reg_rtx (XFmode);
22261 : 282335130 :
22262 : 282335131 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22263 : 282335131 : emit_insn (gen_tanxf2 (op0, op1));
22264 : 292508390 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22265 : 282335131 : DONE;
22266 : 282335130 : })
22267 : 282332741 :
22268 : 292370289 : (define_insn "atan2xf3"
22269 : 282252449 : [(set (match_operand:XF 0 "register_operand" "=f")
22270 : 282252449 : (unspec:XF [(match_operand:XF 2 "register_operand" "0")
22271 : 282252449 : (match_operand:XF 1 "register_operand" "f")]
22272 : 292351603 : UNSPEC_FPATAN))
22273 : 282252449 : (clobber (match_scratch:XF 3 "=1"))]
22274 : 282252467 : "TARGET_USE_FANCY_MATH_387
22275 : 282243829 : && flag_unsafe_math_optimizations"
22276 : 297331808 : "fpatan"
22277 : 287234283 : [(set_attr "type" "fpspc")
22278 : 287234283 : (set_attr "znver1_decode" "vector")
22279 : 282241475 : (set_attr "mode" "XF")])
22280 : 297331723 :
22281 : 287234328 : (define_expand "atan2<mode>3"
22282 : 287234341 : [(use (match_operand:MODEF 0 "register_operand"))
22283 : 282250126 : (use (match_operand:MODEF 1 "general_operand"))
22284 : 297331302 : (use (match_operand:MODEF 2 "general_operand"))]
22285 : 287234276 : "TARGET_USE_FANCY_MATH_387
22286 : 282250060 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22287 : 282250060 : || TARGET_MIX_SSE_I387)
22288 : 297330707 : && flag_unsafe_math_optimizations"
22289 : 287231887 : {
22290 : 287231886 : rtx op0 = gen_reg_rtx (XFmode);
22291 : 282250062 : rtx op1 = gen_reg_rtx (XFmode);
22292 : 292348797 : rtx op2 = gen_reg_rtx (XFmode);
22293 : 282252450 :
22294 : 287231888 : emit_insn (gen_extend<mode>xf2 (op2, operands[2]));
22295 : 282252451 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22296 : 292345969 :
22297 : 282252451 : emit_insn (gen_atan2xf3 (op0, op1, op2));
22298 : 282252451 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22299 : 282252451 : DONE;
22300 : 292345970 : })
22301 : 282252450 :
22302 : 282252450 : (define_expand "atanxf2"
22303 : 282367982 : [(parallel [(set (match_operand:XF 0 "register_operand")
22304 : 292461260 : (unspec:XF [(match_dup 2)
22305 : 282367982 : (match_operand:XF 1 "register_operand")]
22306 : 282367982 : UNSPEC_FPATAN))
22307 : 282367982 : (clobber (scratch:XF))])]
22308 : 292461260 : "TARGET_USE_FANCY_MATH_387
22309 : 282367982 : && flag_unsafe_math_optimizations"
22310 : 282367988 : "operands[2] = force_reg (XFmode, CONST1_RTX (XFmode));")
22311 : 282367982 :
22312 : 292461260 : (define_expand "atan<mode>2"
22313 : 282367985 : [(use (match_operand:MODEF 0 "register_operand"))
22314 : 282367985 : (use (match_operand:MODEF 1 "general_operand"))]
22315 : 282367985 : "TARGET_USE_FANCY_MATH_387
22316 : 292461262 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22317 : 282367985 : || TARGET_MIX_SSE_I387)
22318 : 282367985 : && flag_unsafe_math_optimizations"
22319 : 282367982 : {
22320 : 292418806 : rtx op0 = gen_reg_rtx (XFmode);
22321 : 282367982 : rtx op1 = gen_reg_rtx (XFmode);
22322 : 282367982 :
22323 : 282367987 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22324 : 292418725 : emit_insn (gen_atanxf2 (op0, op1));
22325 : 282367982 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22326 : 282250061 : DONE;
22327 : 282367986 : })
22328 : 292418081 :
22329 : 282359348 : (define_expand "asinxf2"
22330 : 282250063 : [(set (match_dup 2)
22331 : 282367984 : (mult:XF (match_operand:XF 1 "register_operand")
22332 : 292418079 : (match_dup 1)))
22333 : 282359345 : (set (match_dup 4) (minus:XF (match_dup 3) (match_dup 2)))
22334 : 282250112 : (set (match_dup 5) (sqrt:XF (match_dup 4)))
22335 : 282368033 : (parallel [(set (match_operand:XF 0 "register_operand")
22336 : 282368033 : (unspec:XF [(match_dup 5) (match_dup 1)]
22337 : 282368033 : UNSPEC_FPATAN))
22338 : 282368033 : (clobber (scratch:XF))])]
22339 : 282359395 : "TARGET_USE_FANCY_MATH_387
22340 : 292418128 : && flag_unsafe_math_optimizations"
22341 : 282367981 : {
22342 : 282367982 : int i;
22343 : 282367981 :
22344 : 292418097 : for (i = 2; i < 6; i++)
22345 : 282359347 : operands[i] = gen_reg_rtx (XFmode);
22346 : 282367982 :
22347 : 282367986 : emit_move_insn (operands[3], CONST1_RTX (XFmode));
22348 : 292418076 : })
22349 : 282367986 :
22350 : 282367985 : (define_expand "asin<mode>2"
22351 : 282367987 : [(use (match_operand:MODEF 0 "register_operand"))
22352 : 292418078 : (use (match_operand:MODEF 1 "general_operand"))]
22353 : 282367987 : "TARGET_USE_FANCY_MATH_387
22354 : 282367986 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22355 : 282367987 : || TARGET_MIX_SSE_I387)
22356 : 292417977 : && flag_unsafe_math_optimizations"
22357 : 282367987 : {
22358 : 282359344 : rtx op0 = gen_reg_rtx (XFmode);
22359 : 282359343 : rtx op1 = gen_reg_rtx (XFmode);
22360 : 292417976 :
22361 : 282367985 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22362 : 282367985 : emit_insn (gen_asinxf2 (op0, op1));
22363 : 282359343 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22364 : 292321463 : DONE;
22365 : 282367985 : })
22366 : 282367985 :
22367 : 282359343 : (define_expand "acosxf2"
22368 : 292267271 : [(set (match_dup 2)
22369 : 282367985 : (mult:XF (match_operand:XF 1 "register_operand")
22370 : 282367985 : (match_dup 1)))
22371 : 282367985 : (set (match_dup 4) (minus:XF (match_dup 3) (match_dup 2)))
22372 : 291827941 : (set (match_dup 5) (sqrt:XF (match_dup 4)))
22373 : 282367985 : (parallel [(set (match_operand:XF 0 "register_operand")
22374 : 282367985 : (unspec:XF [(match_dup 1) (match_dup 5)]
22375 : 282367986 : UNSPEC_FPATAN))
22376 : 291707191 : (clobber (scratch:XF))])]
22377 : 282368055 : "TARGET_USE_FANCY_MATH_387
22378 : 282368055 : && flag_unsafe_math_optimizations"
22379 : 282368056 : {
22380 : 291508205 : int i;
22381 : 282368055 :
22382 : 282368060 : for (i = 2; i < 6; i++)
22383 : 282368059 : operands[i] = gen_reg_rtx (XFmode);
22384 : 291501416 :
22385 : 282368057 : emit_move_insn (operands[3], CONST1_RTX (XFmode));
22386 : 282368056 : })
22387 : 282368057 :
22388 : 291459793 : (define_expand "acos<mode>2"
22389 : 282368057 : [(use (match_operand:MODEF 0 "register_operand"))
22390 : 282368057 : (use (match_operand:MODEF 1 "general_operand"))]
22391 : 282368057 : "TARGET_USE_FANCY_MATH_387
22392 : 291439435 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22393 : 282368057 : || TARGET_MIX_SSE_I387)
22394 : 282368057 : && flag_unsafe_math_optimizations"
22395 : 282359415 : {
22396 : 291439435 : rtx op0 = gen_reg_rtx (XFmode);
22397 : 282367985 : rtx op1 = gen_reg_rtx (XFmode);
22398 : 282367986 :
22399 : 282359352 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22400 : 291439434 : emit_insn (gen_acosxf2 (op0, op1));
22401 : 282367985 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22402 : 282367986 : DONE;
22403 : 282367985 : })
22404 : 287282017 :
22405 : 282367985 : (define_expand "sinhxf2"
22406 : 282367986 : [(use (match_operand:XF 0 "register_operand"))
22407 : 282367985 : (use (match_operand:XF 1 "register_operand"))]
22408 : 287282017 : "TARGET_USE_FANCY_MATH_387
22409 : 282367986 : && flag_finite_math_only
22410 : 282367987 : && flag_unsafe_math_optimizations"
22411 : 282367988 : {
22412 : 287276915 : ix86_emit_i387_sinh (operands[0], operands[1]);
22413 : 282367989 : DONE;
22414 : 282368464 : })
22415 : 282368464 :
22416 : 291422875 : (define_expand "sinh<mode>2"
22417 : 282368464 : [(use (match_operand:MODEF 0 "register_operand"))
22418 : 282368464 : (use (match_operand:MODEF 1 "general_operand"))]
22419 : 282368464 : "TARGET_USE_FANCY_MATH_387
22420 : 291420682 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22421 : 282368464 : || TARGET_MIX_SSE_I387)
22422 : 282368466 : && flag_finite_math_only
22423 : 282368465 : && flag_unsafe_math_optimizations"
22424 : 291419521 : {
22425 : 282368467 : rtx op0 = gen_reg_rtx (XFmode);
22426 : 282368466 : rtx op1 = gen_reg_rtx (XFmode);
22427 : 282368466 :
22428 : 290802203 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22429 : 282368464 : emit_insn (gen_sinhxf2 (op0, op1));
22430 : 282368466 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22431 : 282368464 : DONE;
22432 : 288976739 : })
22433 : 282368464 :
22434 : 282359822 : (define_expand "coshxf2"
22435 : 282368463 : [(use (match_operand:XF 0 "register_operand"))
22436 : 286942176 : (use (match_operand:XF 1 "register_operand"))]
22437 : 282368463 : "TARGET_USE_FANCY_MATH_387
22438 : 282359821 : && flag_unsafe_math_optimizations"
22439 : 282368466 : {
22440 : 282740982 : ix86_emit_i387_cosh (operands[0], operands[1]);
22441 : 282368466 : DONE;
22442 : 282359821 : })
22443 : 282368463 :
22444 : 282582269 : (define_expand "cosh<mode>2"
22445 : 282368463 : [(use (match_operand:MODEF 0 "register_operand"))
22446 : 282368463 : (use (match_operand:MODEF 1 "general_operand"))]
22447 : 282368463 : "TARGET_USE_FANCY_MATH_387
22448 : 282582257 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22449 : 282368463 : || TARGET_MIX_SSE_I387)
22450 : 282368463 : && flag_unsafe_math_optimizations"
22451 : 282250545 : {
22452 : 282367985 : rtx op0 = gen_reg_rtx (XFmode);
22453 : 282367985 : rtx op1 = gen_reg_rtx (XFmode);
22454 : 282367988 :
22455 : 282250545 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22456 : 282367985 : emit_insn (gen_coshxf2 (op0, op1));
22457 : 282367985 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22458 : 282367985 : DONE;
22459 : 282367988 : })
22460 : 282367985 :
22461 : 282367985 : (define_expand "tanhxf2"
22462 : 282367985 : [(use (match_operand:XF 0 "register_operand"))
22463 : 282368148 : (use (match_operand:XF 1 "register_operand"))]
22464 : 337120530 : "TARGET_USE_FANCY_MATH_387
22465 : 282368148 : && flag_unsafe_math_optimizations"
22466 : 337002610 : {
22467 : 337002610 : ix86_emit_i387_tanh (operands[0], operands[1]);
22468 : 337120531 : DONE;
22469 : 337121654 : })
22470 : 282369272 :
22471 : 337112849 : (define_expand "tanh<mode>2"
22472 : 282369272 : [(use (match_operand:MODEF 0 "register_operand"))
22473 : 282369444 : (use (match_operand:MODEF 1 "general_operand"))]
22474 : 282369444 : "TARGET_USE_FANCY_MATH_387
22475 : 282369444 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22476 : 282369444 : || TARGET_MIX_SSE_I387)
22477 : 282369444 : && flag_unsafe_math_optimizations"
22478 : 282369445 : {
22479 : 282369444 : rtx op0 = gen_reg_rtx (XFmode);
22480 : 282369444 : rtx op1 = gen_reg_rtx (XFmode);
22481 : 282369445 :
22482 : 282369445 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22483 : 282369444 : emit_insn (gen_tanhxf2 (op0, op1));
22484 : 282369444 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22485 : 282369444 : DONE;
22486 : 282369445 : })
22487 : 282369444 :
22488 : 282369444 : (define_expand "asinhxf2"
22489 : 282369444 : [(use (match_operand:XF 0 "register_operand"))
22490 : 282369444 : (use (match_operand:XF 1 "register_operand"))]
22491 : 282360639 : "TARGET_USE_FANCY_MATH_387
22492 : 282360639 : && flag_finite_math_only
22493 : 282369272 : && flag_unsafe_math_optimizations"
22494 : 282369272 : {
22495 : 282369272 : ix86_emit_i387_asinh (operands[0], operands[1]);
22496 : 282369272 : DONE;
22497 : 282369272 : })
22498 : 282369272 :
22499 : 282369272 : (define_expand "asinh<mode>2"
22500 : 282369272 : [(use (match_operand:MODEF 0 "register_operand"))
22501 : 282370604 : (use (match_operand:MODEF 1 "general_operand"))]
22502 : 282370604 : "TARGET_USE_FANCY_MATH_387
22503 : 282360467 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22504 : 282360467 : || TARGET_MIX_SSE_I387)
22505 : 282370604 : && flag_finite_math_only
22506 : 282251559 : && flag_unsafe_math_optimizations"
22507 : 282251559 : {
22508 : 282370604 : rtx op0 = gen_reg_rtx (XFmode);
22509 : 282370604 : rtx op1 = gen_reg_rtx (XFmode);
22510 : 282370604 :
22511 : 282251559 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22512 : 282370604 : emit_insn (gen_asinhxf2 (op0, op1));
22513 : 282370604 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22514 : 282370604 : DONE;
22515 : 282370604 : })
22516 : 282370604 :
22517 : 282370604 : (define_expand "acoshxf2"
22518 : 282370604 : [(use (match_operand:XF 0 "register_operand"))
22519 : 282360467 : (use (match_operand:XF 1 "register_operand"))]
22520 : 282360467 : "TARGET_USE_FANCY_MATH_387
22521 : 282370604 : && flag_unsafe_math_optimizations"
22522 : 282370604 : {
22523 : 282370604 : ix86_emit_i387_acosh (operands[0], operands[1]);
22524 : 282370604 : DONE;
22525 : 282370604 : })
22526 : 282370604 :
22527 : 282370604 : (define_expand "acosh<mode>2"
22528 : 282370604 : [(use (match_operand:MODEF 0 "register_operand"))
22529 : 282370604 : (use (match_operand:MODEF 1 "general_operand"))]
22530 : 282370604 : "TARGET_USE_FANCY_MATH_387
22531 : 282370604 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22532 : 282370604 : || TARGET_MIX_SSE_I387)
22533 : 282370604 : && flag_unsafe_math_optimizations"
22534 : 282370604 : {
22535 : 282370604 : rtx op0 = gen_reg_rtx (XFmode);
22536 : 282370604 : rtx op1 = gen_reg_rtx (XFmode);
22537 : 282370604 :
22538 : 282370604 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22539 : 282370604 : emit_insn (gen_acoshxf2 (op0, op1));
22540 : 282370604 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22541 : 282370604 : DONE;
22542 : 282370604 : })
22543 : 282370604 :
22544 : 282370604 : (define_expand "atanhxf2"
22545 : 282370604 : [(use (match_operand:XF 0 "register_operand"))
22546 : 282370604 : (use (match_operand:XF 1 "register_operand"))]
22547 : 282370604 : "TARGET_USE_FANCY_MATH_387
22548 : 282370604 : && flag_unsafe_math_optimizations"
22549 : 282370608 : {
22550 : 282370608 : ix86_emit_i387_atanh (operands[0], operands[1]);
22551 : 282370608 : DONE;
22552 : 282370604 : })
22553 : 282370604 :
22554 : 282370604 : (define_expand "atanh<mode>2"
22555 : 282370604 : [(use (match_operand:MODEF 0 "register_operand"))
22556 : 282370604 : (use (match_operand:MODEF 1 "general_operand"))]
22557 : 282370604 : "TARGET_USE_FANCY_MATH_387
22558 : 282370604 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22559 : 282370604 : || TARGET_MIX_SSE_I387)
22560 : 282370604 : && flag_unsafe_math_optimizations"
22561 : 282370608 : {
22562 : 282370604 : rtx op0 = gen_reg_rtx (XFmode);
22563 : 282370604 : rtx op1 = gen_reg_rtx (XFmode);
22564 : 282360634 :
22565 : 282370445 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22566 : 282370441 : emit_insn (gen_atanhxf2 (op0, op1));
22567 : 282361799 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22568 : 282360467 : DONE;
22569 : 282369113 : })
22570 : 282369109 :
22571 : 282360888 : (define_insn "fyl2xxf3_i387"
22572 : 282360467 : [(set (match_operand:XF 0 "register_operand" "=f")
22573 : 282369109 : (unspec:XF [(match_operand:XF 1 "register_operand" "0")
22574 : 282369109 : (match_operand:XF 2 "register_operand" "f")]
22575 : 282369109 : UNSPEC_FYL2X))
22576 : 282369109 : (clobber (match_scratch:XF 3 "=2"))]
22577 : 282360486 : "TARGET_USE_FANCY_MATH_387
22578 : 282360486 : && flag_unsafe_math_optimizations"
22579 : 282369166 : "fyl2x"
22580 : 282369134 : [(set_attr "type" "fpspc")
22581 : 282369227 : (set_attr "znver1_decode" "vector")
22582 : 282360489 : (set_attr "mode" "XF")])
22583 : 282360489 :
22584 : 282369208 : (define_expand "logxf2"
22585 : 282369208 : [(parallel [(set (match_operand:XF 0 "register_operand")
22586 : 282369208 : (unspec:XF [(match_operand:XF 1 "register_operand")
22587 : 282360560 : (match_dup 2)] UNSPEC_FYL2X))
22588 : 282369112 : (clobber (scratch:XF))])]
22589 : 282369109 : "TARGET_USE_FANCY_MATH_387
22590 : 282369109 : && flag_unsafe_math_optimizations"
22591 : 282360473 : {
22592 : 282369192 : operands[2]
22593 : 282360473 : = force_reg (XFmode, standard_80387_constant_rtx (4)); /* fldln2 */
22594 : 282241425 : })
22595 : 282369195 :
22596 : 282369192 : (define_expand "log<mode>2"
22597 : 282369195 : [(use (match_operand:MODEF 0 "register_operand"))
22598 : 282241508 : (use (match_operand:MODEF 1 "general_operand"))]
22599 : 282360553 : "TARGET_USE_FANCY_MATH_387
22600 : 282369117 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22601 : 282369117 : || TARGET_MIX_SSE_I387)
22602 : 282369117 : && flag_unsafe_math_optimizations"
22603 : 282369115 : {
22604 : 282369117 : rtx op0 = gen_reg_rtx (XFmode);
22605 : 282369115 : rtx op1 = gen_reg_rtx (XFmode);
22606 : 282360472 :
22607 : 282369110 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22608 : 282389409 : emit_insn (gen_logxf2 (op0, op1));
22609 : 282360468 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22610 : 282360468 : DONE;
22611 : 282389408 : })
22612 : 282389408 :
22613 : 282270363 : (define_expand "log10xf2"
22614 : 282360470 : [(parallel [(set (match_operand:XF 0 "register_operand")
22615 : 282389411 : (unspec:XF [(match_operand:XF 1 "register_operand")
22616 : 282389411 : (match_dup 2)] UNSPEC_FYL2X))
22617 : 282389408 : (clobber (scratch:XF))])]
22618 : 282389408 : "TARGET_USE_FANCY_MATH_387
22619 : 282389509 : && flag_unsafe_math_optimizations"
22620 : 282389510 : {
22621 : 282389510 : operands[2]
22622 : 282389510 : = force_reg (XFmode, standard_80387_constant_rtx (3)); /* fldlg2 */
22623 : 282389509 : })
22624 : 282389509 :
22625 : 282389509 : (define_expand "log10<mode>2"
22626 : 282389510 : [(use (match_operand:MODEF 0 "register_operand"))
22627 : 282389510 : (use (match_operand:MODEF 1 "general_operand"))]
22628 : 282270465 : "TARGET_USE_FANCY_MATH_387
22629 : 282360467 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22630 : 282360470 : || TARGET_MIX_SSE_I387)
22631 : 282389510 : && flag_unsafe_math_optimizations"
22632 : 282241523 : {
22633 : 282360569 : rtx op0 = gen_reg_rtx (XFmode);
22634 : 282389409 : rtx op1 = gen_reg_rtx (XFmode);
22635 : 282389409 :
22636 : 282389408 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22637 : 282360567 : emit_insn (gen_log10xf2 (op0, op1));
22638 : 282389409 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22639 : 282389409 : DONE;
22640 : 282360467 : })
22641 : 282380766 :
22642 : 282079435 : (define_expand "log2xf2"
22643 : 282079436 : [(parallel [(set (match_operand:XF 0 "register_operand")
22644 : 417362 : (unspec:XF [(match_operand:XF 1 "register_operand")
22645 : 408753 : (match_dup 2)] UNSPEC_FYL2X))
22646 : 417361 : (clobber (scratch:XF))])]
22647 : 282079426 : "TARGET_USE_FANCY_MATH_387
22648 : 417361 : && flag_unsafe_math_optimizations"
22649 : 408721 : "operands[2] = force_reg (XFmode, CONST1_RTX (XFmode));")
22650 : 417408 :
22651 : 282060987 : (define_expand "log2<mode>2"
22652 : 417409 : [(use (match_operand:MODEF 0 "register_operand"))
22653 : 1552385 : (use (match_operand:MODEF 1 "general_operand"))]
22654 : 298634 : "TARGET_USE_FANCY_MATH_387
22655 : 280517564 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22656 : 417680 : || TARGET_MIX_SSE_I387)
22657 : 417680 : && flag_unsafe_math_optimizations"
22658 : 417679 : {
22659 : 298635 : rtx op0 = gen_reg_rtx (XFmode);
22660 : 408719 : rtx op1 = gen_reg_rtx (XFmode);
22661 : 418002 :
22662 : 418002 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22663 : 298634 : emit_insn (gen_log2xf2 (op0, op1));
22664 : 409043 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22665 : 418002 : DONE;
22666 : 418003 : })
22667 : 418002 :
22668 : 418003 : (define_insn "fyl2xp1xf3_i387"
22669 : 418003 : [(set (match_operand:XF 0 "register_operand" "=f")
22670 : 418003 : (unspec:XF [(match_operand:XF 1 "register_operand" "0")
22671 : 418003 : (match_operand:XF 2 "register_operand" "f")]
22672 : 418002 : UNSPEC_FYL2XP1))
22673 : 418002 : (clobber (match_scratch:XF 3 "=2"))]
22674 : 418012 : "TARGET_USE_FANCY_MATH_387
22675 : 418012 : && flag_unsafe_math_optimizations"
22676 : 418003 : "fyl2xp1"
22677 : 418007 : [(set_attr "type" "fpspc")
22678 : 418007 : (set_attr "znver1_decode" "vector")
22679 : 418200 : (set_attr "mode" "XF")])
22680 : 418200 :
22681 : 418346 : (define_expand "log1pxf2"
22682 : 418544 : [(use (match_operand:XF 0 "register_operand"))
22683 : 418200 : (use (match_operand:XF 1 "register_operand"))]
22684 : 418346 : "TARGET_USE_FANCY_MATH_387
22685 : 418545 : && flag_unsafe_math_optimizations"
22686 : 459158 : {
22687 : 418347 : ix86_emit_i387_log1p (operands[0], operands[1]);
22688 : 418201 : DONE;
22689 : 418211 : })
22690 : 418211 :
22691 : 418211 : (define_expand "log1p<mode>2"
22692 : 418201 : [(use (match_operand:MODEF 0 "register_operand"))
22693 : 418003 : (use (match_operand:MODEF 1 "general_operand"))]
22694 : 418002 : "TARGET_USE_FANCY_MATH_387
22695 : 418002 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22696 : 418002 : || TARGET_MIX_SSE_I387)
22697 : 418002 : && flag_unsafe_math_optimizations"
22698 : 418002 : {
22699 : 418002 : rtx op0 = gen_reg_rtx (XFmode);
22700 : 418002 : rtx op1 = gen_reg_rtx (XFmode);
22701 : 298634 :
22702 : 409313 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22703 : 409313 : emit_insn (gen_log1pxf2 (op0, op1));
22704 : 417731 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22705 : 298363 : DONE;
22706 : 417731 : })
22707 : 417731 :
22708 : 417731 : (define_insn "fxtractxf3_i387"
22709 : 417731 : [(set (match_operand:XF 0 "register_operand" "=f")
22710 : 417731 : (unspec:XF [(match_operand:XF 2 "register_operand" "0")]
22711 : 417731 : UNSPEC_XTRACT_FRACT))
22712 : 417740 : (set (match_operand:XF 1 "register_operand" "=f")
22713 : 417740 : (unspec:XF [(match_dup 2)] UNSPEC_XTRACT_EXP))]
22714 : 417744 : "TARGET_USE_FANCY_MATH_387
22715 : 417744 : && flag_unsafe_math_optimizations"
22716 : 417740 : "fxtract"
22717 : 417740 : [(set_attr "type" "fpspc")
22718 : 409051 : (set_attr "znver1_decode" "vector")
22719 : 409157 : (set_attr "mode" "XF")])
22720 : 417837 :
22721 : 417731 : (define_expand "logbxf2"
22722 : 417837 : [(parallel [(set (match_dup 2)
22723 : 409148 : (unspec:XF [(match_operand:XF 1 "register_operand")]
22724 : 417731 : UNSPEC_XTRACT_FRACT))
22725 : 417838 : (set (match_operand:XF 0 "register_operand")
22726 : 417837 : (unspec:XF [(match_dup 1)] UNSPEC_XTRACT_EXP))])]
22727 : 417837 : "TARGET_USE_FANCY_MATH_387
22728 : 417732 : && flag_unsafe_math_optimizations"
22729 : 417837 : "operands[2] = gen_reg_rtx (XFmode);")
22730 : 417838 :
22731 : 417838 : (define_expand "logb<mode>2"
22732 : 417777 : [(use (match_operand:MODEF 0 "register_operand"))
22733 : 417825 : (use (match_operand:MODEF 1 "general_operand"))]
22734 : 409137 : "TARGET_USE_FANCY_MATH_387
22735 : 409137 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22736 : 417782 : || TARGET_MIX_SSE_I387)
22737 : 417732 : && flag_unsafe_math_optimizations"
22738 : 417731 : {
22739 : 409045 : rtx op0 = gen_reg_rtx (XFmode);
22740 : 417731 : rtx op1 = gen_reg_rtx (XFmode);
22741 : 417731 :
22742 : 417731 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22743 : 417731 : emit_insn (gen_logbxf2 (op0, op1));
22744 : 417731 : emit_insn (gen_truncxf<mode>2 (operands[0], op1));
22745 : 409046 : DONE;
22746 : 409046 : })
22747 : 417727 :
22748 : 417731 : (define_expand "ilogbxf2"
22749 : 417731 : [(use (match_operand:SI 0 "register_operand"))
22750 : 409046 : (use (match_operand:XF 1 "register_operand"))]
22751 : 417732 : "TARGET_USE_FANCY_MATH_387
22752 : 417732 : && flag_unsafe_math_optimizations"
22753 : 417734 : {
22754 : 409052 : rtx op0, op1;
22755 : 409046 :
22756 : 417729 : if (optimize_insn_for_size_p ())
22757 : 417728 : FAIL;
22758 : 409042 :
22759 : 409043 : op0 = gen_reg_rtx (XFmode);
22760 : 417728 : op1 = gen_reg_rtx (XFmode);
22761 : 417727 :
22762 : 289998 : emit_insn (gen_fxtractxf3_i387 (op0, op1, operands[1]));
22763 : 417405 : emit_insn (gen_fix_truncxfsi2 (operands[0], op1));
22764 : 417787 : DONE;
22765 : 409103 : })
22766 : 290056 :
22767 : 417404 : (define_expand "ilogb<mode>2"
22768 : 417406 : [(use (match_operand:SI 0 "register_operand"))
22769 : 417406 : (use (match_operand:MODEF 1 "general_operand"))]
22770 : 409103 : "TARGET_USE_FANCY_MATH_387
22771 : 417406 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22772 : 417406 : || TARGET_MIX_SSE_I387)
22773 : 417406 : && flag_unsafe_math_optimizations"
22774 : 409099 : {
22775 : 417537 : rtx op0, op1, op2;
22776 : 417537 :
22777 : 417537 : if (optimize_insn_for_size_p ())
22778 : 408852 : FAIL;
22779 : 417537 :
22780 : 417537 : op0 = gen_reg_rtx (XFmode);
22781 : 298492 : op1 = gen_reg_rtx (XFmode);
22782 : 408719 : op2 = gen_reg_rtx (XFmode);
22783 : 438856 :
22784 : 438856 : emit_insn (gen_extend<mode>xf2 (op2, operands[1]));
22785 : 408719 : emit_insn (gen_fxtractxf3_i387 (op0, op1, op2));
22786 : 408719 : emit_insn (gen_fix_truncxfsi2 (operands[0], op1));
22787 : 438856 : DONE;
22788 : 438856 : })
22789 : 408719 :
22790 : 408724 : (define_insn "*f2xm1xf2_i387"
22791 : 438861 : [(set (match_operand:XF 0 "register_operand" "=f")
22792 : 438861 : (unspec:XF [(match_operand:XF 1 "register_operand" "0")]
22793 : 438861 : UNSPEC_F2XM1))]
22794 : 408756 : "TARGET_USE_FANCY_MATH_387
22795 : 438893 : && flag_unsafe_math_optimizations"
22796 : 319816 : "f2xm1"
22797 : 438856 : [(set_attr "type" "fpspc")
22798 : 408719 : (set_attr "znver1_decode" "vector")
22799 : 439253 : (set_attr "mode" "XF")])
22800 : 409116 :
22801 : 438856 : (define_insn "fscalexf4_i387"
22802 : 409116 : [(set (match_operand:XF 0 "register_operand" "=f")
22803 : 439253 : (unspec:XF [(match_operand:XF 2 "register_operand" "0")
22804 : 409116 : (match_operand:XF 3 "register_operand" "1")]
22805 : 149388 : UNSPEC_FSCALE_FRACT))
22806 : 94546268 : (set (match_operand:XF 1 "register_operand" "=f")
22807 : 94576418 : (unspec:XF [(match_dup 2) (match_dup 3)]
22808 : 94576405 : UNSPEC_FSCALE_EXP))]
22809 : 94576432 : "TARGET_USE_FANCY_MATH_387
22810 : 94545904 : && flag_unsafe_math_optimizations"
22811 : 94576185 : "fscale"
22812 : 94576027 : [(set_attr "type" "fpspc")
22813 : 94576027 : (set_attr "znver1_decode" "vector")
22814 : 94546563 : (set_attr "mode" "XF")])
22815 : 94576687 :
22816 : 94576027 : (define_expand "expNcorexf3"
22817 : 94576700 : [(set (match_dup 3) (mult:XF (match_operand:XF 1 "register_operand")
22818 : 94427518 : (match_operand:XF 2 "register_operand")))
22819 : 94456982 : (set (match_dup 4) (unspec:XF [(match_dup 3)] UNSPEC_FRNDINT))
22820 : 94576494 : (set (match_dup 5) (minus:XF (match_dup 3) (match_dup 4)))
22821 : 94576494 : (set (match_dup 6) (unspec:XF [(match_dup 5)] UNSPEC_F2XM1))
22822 : 94546357 : (set (match_dup 8) (plus:XF (match_dup 6) (match_dup 7)))
22823 : 94456957 : (parallel [(set (match_operand:XF 0 "register_operand")
22824 : 94576494 : (unspec:XF [(match_dup 8) (match_dup 4)]
22825 : 94576481 : UNSPEC_FSCALE_FRACT))
22826 : 94546344 : (set (match_dup 9)
22827 : 94576481 : (unspec:XF [(match_dup 8) (match_dup 4)]
22828 : 94576481 : UNSPEC_FSCALE_EXP))])]
22829 : 94576481 : "TARGET_USE_FANCY_MATH_387
22830 : 94546344 : && flag_unsafe_math_optimizations"
22831 : 94575821 : {
22832 : 94575878 : int i;
22833 : 94575865 :
22834 : 94545832 : for (i = 3; i < 10; i++)
22835 : 94575956 : operands[i] = gen_reg_rtx (XFmode);
22836 : 94545732 :
22837 : 94575874 : emit_move_insn (operands[7], CONST1_RTX (XFmode));
22838 : 94545724 : })
22839 : 94575861 :
22840 : 94545724 : (define_expand "expxf2"
22841 : 94575874 : [(use (match_operand:XF 0 "register_operand"))
22842 : 94545737 : (use (match_operand:XF 1 "register_operand"))]
22843 : 94575874 : "TARGET_USE_FANCY_MATH_387
22844 : 94575874 : && flag_unsafe_math_optimizations"
22845 : 94575883 : {
22846 : 94545733 : rtx op2 = force_reg (XFmode, standard_80387_constant_rtx (5)); /* fldl2e */
22847 : 94575874 :
22848 : 94575870 : emit_insn (gen_expNcorexf3 (operands[0], operands[1], op2));
22849 : 94575870 : DONE;
22850 : 94545737 : })
22851 : 94575874 :
22852 : 94575874 : (define_expand "exp<mode>2"
22853 : 94575874 : [(use (match_operand:MODEF 0 "register_operand"))
22854 : 94545737 : (use (match_operand:MODEF 1 "general_operand"))]
22855 : 94575874 : "TARGET_USE_FANCY_MATH_387
22856 : 94575874 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22857 : 94575874 : || TARGET_MIX_SSE_I387)
22858 : 94545737 : && flag_unsafe_math_optimizations"
22859 : 94575874 : {
22860 : 94575874 : rtx op0 = gen_reg_rtx (XFmode);
22861 : 94575861 : rtx op1 = gen_reg_rtx (XFmode);
22862 : 94545737 :
22863 : 94575861 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22864 : 94545724 : emit_insn (gen_expxf2 (op0, op1));
22865 : 94575861 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22866 : 94545737 : DONE;
22867 : 94575861 : })
22868 : 94545724 :
22869 : 94575861 : (define_expand "exp10xf2"
22870 : 94545724 : [(use (match_operand:XF 0 "register_operand"))
22871 : 94575874 : (use (match_operand:XF 1 "register_operand"))]
22872 : 94575861 : "TARGET_USE_FANCY_MATH_387
22873 : 94575861 : && flag_unsafe_math_optimizations"
22874 : 94545726 : {
22875 : 94575876 : rtx op2 = force_reg (XFmode, standard_80387_constant_rtx (6)); /* fldl2t */
22876 : 94575861 :
22877 : 94575863 : emit_insn (gen_expNcorexf3 (operands[0], operands[1], op2));
22878 : 94545726 : DONE;
22879 : 94575861 : })
22880 : 94575874 :
22881 : 94575861 : (define_expand "exp10<mode>2"
22882 : 94545724 : [(use (match_operand:MODEF 0 "register_operand"))
22883 : 94575861 : (use (match_operand:MODEF 1 "general_operand"))]
22884 : 94575874 : "TARGET_USE_FANCY_MATH_387
22885 : 94575861 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22886 : 94545726 : || TARGET_MIX_SSE_I387)
22887 : 94575861 : && flag_unsafe_math_optimizations"
22888 : 94575861 : {
22889 : 94575863 : rtx op0 = gen_reg_rtx (XFmode);
22890 : 94545726 : rtx op1 = gen_reg_rtx (XFmode);
22891 : 94575863 :
22892 : 94545823 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22893 : 94575960 : emit_insn (gen_exp10xf2 (op0, op1));
22894 : 94545825 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22895 : 94575960 : DONE;
22896 : 94545823 : })
22897 : 94575960 :
22898 : 94545737 : (define_expand "exp2xf2"
22899 : 94456875 : [(use (match_operand:XF 0 "register_operand"))
22900 : 94575874 : (use (match_operand:XF 1 "register_operand"))]
22901 : 94575861 : "TARGET_USE_FANCY_MATH_387
22902 : 94545724 : && flag_unsafe_math_optimizations"
22903 : 94575863 : {
22904 : 94575865 : rtx op2 = force_reg (XFmode, CONST1_RTX (XFmode));
22905 : 94575870 :
22906 : 94545735 : emit_insn (gen_expNcorexf3 (operands[0], operands[1], op2));
22907 : 94575872 : DONE;
22908 : 94575879 : })
22909 : 94575879 :
22910 : 94545742 : (define_expand "exp2<mode>2"
22911 : 94575879 : [(use (match_operand:MODEF 0 "register_operand"))
22912 : 94575879 : (use (match_operand:MODEF 1 "general_operand"))]
22913 : 94575879 : "TARGET_USE_FANCY_MATH_387
22914 : 94426635 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22915 : 94456774 : || TARGET_MIX_SSE_I387)
22916 : 94575861 : && flag_unsafe_math_optimizations"
22917 : 94575861 : {
22918 : 94545726 : rtx op0 = gen_reg_rtx (XFmode);
22919 : 94575863 : rtx op1 = gen_reg_rtx (XFmode);
22920 : 94575863 :
22921 : 94575861 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22922 : 94545724 : emit_insn (gen_exp2xf2 (op0, op1));
22923 : 94575863 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22924 : 94575861 : DONE;
22925 : 94575861 : })
22926 : 94426626 :
22927 : 94456763 : (define_expand "expm1xf2"
22928 : 94575861 : [(set (match_dup 3) (mult:XF (match_operand:XF 1 "register_operand")
22929 : 94582244 : (match_dup 2)))
22930 : 94552107 : (set (match_dup 4) (unspec:XF [(match_dup 3)] UNSPEC_FRNDINT))
22931 : 94582244 : (set (match_dup 5) (minus:XF (match_dup 3) (match_dup 4)))
22932 : 94582244 : (set (match_dup 6) (unspec:XF [(match_dup 5)] UNSPEC_F2XM1))
22933 : 94582244 : (parallel [(set (match_dup 7)
22934 : 94552107 : (unspec:XF [(match_dup 6) (match_dup 4)]
22935 : 94582244 : UNSPEC_FSCALE_FRACT))
22936 : 94582244 : (set (match_dup 8)
22937 : 94582244 : (unspec:XF [(match_dup 6) (match_dup 4)]
22938 : 94552107 : UNSPEC_FSCALE_EXP))])
22939 : 94582244 : (parallel [(set (match_dup 10)
22940 : 94582244 : (unspec:XF [(match_dup 9) (match_dup 8)]
22941 : 94582244 : UNSPEC_FSCALE_FRACT))
22942 : 94552107 : (set (match_dup 11)
22943 : 94582244 : (unspec:XF [(match_dup 9) (match_dup 8)]
22944 : 94582248 : UNSPEC_FSCALE_EXP))])
22945 : 94582244 : (set (match_dup 12) (minus:XF (match_dup 10) (match_dup 9)))
22946 : 94552107 : (set (match_operand:XF 0 "register_operand")
22947 : 94582256 : (plus:XF (match_dup 12) (match_dup 7)))]
22948 : 94582252 : "TARGET_USE_FANCY_MATH_387
22949 : 94582256 : && flag_unsafe_math_optimizations"
22950 : 94552123 : {
22951 : 94582260 : int i;
22952 : 94582252 :
22953 : 94572343 : for (i = 2; i < 13; i++)
22954 : 94436627 : operands[i] = gen_reg_rtx (XFmode);
22955 : 94466724 :
22956 : 94466724 : emit_move_insn (operands[2], standard_80387_constant_rtx (5)); /* fldl2e */
22957 : 94466724 : emit_move_insn (operands[9], CONST1_RTX (XFmode));
22958 : 94436587 : })
22959 : 94466724 :
22960 : 94466724 : (define_expand "expm1<mode>2"
22961 : 94466728 : [(use (match_operand:MODEF 0 "register_operand"))
22962 : 103663041 : (use (match_operand:MODEF 1 "general_operand"))]
22963 : 103693174 : "TARGET_USE_FANCY_MATH_387
22964 : 103693174 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
22965 : 103693174 : || TARGET_MIX_SSE_I387)
22966 : 103663037 : && flag_unsafe_math_optimizations"
22967 : 103693174 : {
22968 : 103693174 : rtx op0 = gen_reg_rtx (XFmode);
22969 : 103693170 : rtx op1 = gen_reg_rtx (XFmode);
22970 : 103663037 :
22971 : 103693170 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
22972 : 103693170 : emit_insn (gen_expm1xf2 (op0, op1));
22973 : 103693170 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
22974 : 103663033 : DONE;
22975 : 103693174 : })
22976 : 103693174 :
22977 : 103693174 : (define_insn "avx512f_scalef<mode>2"
22978 : 103663037 : [(set (match_operand:MODEF 0 "register_operand" "=v")
22979 : 103693174 : (unspec:MODEF
22980 : 103693174 : [(match_operand:MODEF 1 "register_operand" "v")
22981 : 103693174 : (match_operand:MODEF 2 "nonimmediate_operand" "vm")]
22982 : 103663037 : UNSPEC_SCALEF))]
22983 : 103693180 : "TARGET_AVX512F"
22984 : 103693174 : "vscalef<ssemodesuffix>\t{%2, %1, %0|%0, %1, %2}"
22985 : 103693174 : [(set_attr "prefix" "evex")
22986 : 103663037 : (set_attr "mode" "<MODE>")])
22987 : 103693188 :
22988 : 103693192 : (define_expand "ldexpxf3"
22989 : 103693188 : [(match_operand:XF 0 "register_operand")
22990 : 103663033 : (match_operand:XF 1 "register_operand")
22991 : 103695302 : (match_operand:SI 2 "register_operand")]
22992 : 103695306 : "TARGET_USE_FANCY_MATH_387
22993 : 103695302 : && flag_unsafe_math_optimizations"
22994 : 103665175 : {
22995 : 103695312 : rtx tmp1 = gen_reg_rtx (XFmode);
22996 : 103695307 : rtx tmp2 = gen_reg_rtx (XFmode);
22997 : 103695306 :
22998 : 103665170 : emit_insn (gen_floatsixf2 (tmp1, operands[2]));
22999 : 103693180 : emit_insn (gen_fscalexf4_i387 (operands[0], tmp2,
23000 : 103695081 : operands[1], tmp1));
23001 : 103693179 : DONE;
23002 : 103653233 : })
23003 : 94466882 :
23004 : 94466882 : (define_expand "ldexp<mode>3"
23005 : 94466877 : [(use (match_operand:MODEF 0 "register_operand"))
23006 : 94436899 : (use (match_operand:MODEF 1 "general_operand"))
23007 : 94466793 : (use (match_operand:SI 2 "register_operand"))]
23008 : 94466793 : "((TARGET_USE_FANCY_MATH_387
23009 : 94466793 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
23010 : 94436656 : || TARGET_MIX_SSE_I387))
23011 : 94466793 : || (TARGET_AVX512F && TARGET_SSE_MATH))
23012 : 94466793 : && flag_unsafe_math_optimizations"
23013 : 94456770 : {
23014 : 94426699 : /* Prefer avx512f version. */
23015 : 94466727 : if (TARGET_AVX512F && TARGET_SSE_MATH)
23016 : 145015755 : {
23017 : 145015760 : rtx op2 = gen_reg_rtx (<MODE>mode);
23018 : 144985623 : operands[1] = force_reg (<MODE>mode, operands[1]);
23019 : 145015755 :
23020 : 145015764 : emit_insn (gen_floatsi<mode>2 (op2, operands[2]));
23021 : 145015760 : emit_insn (gen_avx512f_scalef<mode>2 (operands[0], operands[1], op2));
23022 : 144985623 : }
23023 : 145015755 : else
23024 : 145015755 : {
23025 : 145015757 : rtx op0 = gen_reg_rtx (XFmode);
23026 : 144985620 : rtx op1 = gen_reg_rtx (XFmode);
23027 : 145015758 :
23028 : 145015757 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
23029 : 94456773 : emit_insn (gen_ldexpxf3 (op0, op1, operands[2]));
23030 : 94426628 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
23031 : 145015750 : }
23032 : 145015757 : DONE;
23033 : 145015747 : })
23034 : 144985614 :
23035 : 145015747 : (define_expand "scalbxf3"
23036 : 145015747 : [(parallel [(set (match_operand:XF 0 " register_operand")
23037 : 145015747 : (unspec:XF [(match_operand:XF 1 "register_operand")
23038 : 144985614 : (match_operand:XF 2 "register_operand")]
23039 : 145015747 : UNSPEC_FSCALE_FRACT))
23040 : 94456763 : (set (match_dup 3)
23041 : 94456763 : (unspec:XF [(match_dup 1) (match_dup 2)]
23042 : 94426630 : UNSPEC_FSCALE_EXP))])]
23043 : 145016281 : "TARGET_USE_FANCY_MATH_387
23044 : 145017455 : && flag_unsafe_math_optimizations"
23045 : 144987316 : "operands[3] = gen_reg_rtx (XFmode);")
23046 : 144987314 :
23047 : 145017451 : (define_expand "scalb<mode>3"
23048 : 145017452 : [(use (match_operand:MODEF 0 "register_operand"))
23049 : 145017452 : (use (match_operand:MODEF 1 "general_operand"))
23050 : 144987315 : (use (match_operand:MODEF 2 "general_operand"))]
23051 : 145017452 : "TARGET_USE_FANCY_MATH_387
23052 : 145017452 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
23053 : 145017451 : || TARGET_MIX_SSE_I387)
23054 : 144987315 : && flag_unsafe_math_optimizations"
23055 : 145017452 : {
23056 : 145017456 : rtx op0 = gen_reg_rtx (XFmode);
23057 : 145017452 : rtx op1 = gen_reg_rtx (XFmode);
23058 : 144987314 : rtx op2 = gen_reg_rtx (XFmode);
23059 : 145017451 :
23060 : 145017451 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
23061 : 144987318 : emit_insn (gen_extend<mode>xf2 (op2, operands[2]));
23062 : 144987315 : emit_insn (gen_scalbxf3 (op0, op1, op2));
23063 : 145017451 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
23064 : 145017451 : DONE;
23065 : 145017456 : })
23066 : 144987318 :
23067 : 145017452 : (define_expand "significandxf2"
23068 : 145017451 : [(parallel [(set (match_operand:XF 0 "register_operand")
23069 : 145017451 : (unspec:XF [(match_operand:XF 1 "register_operand")]
23070 : 144987314 : UNSPEC_XTRACT_FRACT))
23071 : 145017452 : (set (match_dup 2)
23072 : 145017452 : (unspec:XF [(match_dup 1)] UNSPEC_XTRACT_EXP))])]
23073 : 145017452 : "TARGET_USE_FANCY_MATH_387
23074 : 144987314 : && flag_unsafe_math_optimizations"
23075 : 145017455 : "operands[2] = gen_reg_rtx (XFmode);")
23076 : 145017451 :
23077 : 145017451 : (define_expand "significand<mode>2"
23078 : 144987316 : [(use (match_operand:MODEF 0 "register_operand"))
23079 : 145017453 : (use (match_operand:MODEF 1 "general_operand"))]
23080 : 145017453 : "TARGET_USE_FANCY_MATH_387
23081 : 144987316 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
23082 : 144987316 : || TARGET_MIX_SSE_I387)
23083 : 145017451 : && flag_unsafe_math_optimizations"
23084 : 145017451 : {
23085 : 145017453 : rtx op0 = gen_reg_rtx (XFmode);
23086 : 144987314 : rtx op1 = gen_reg_rtx (XFmode);
23087 : 145017451 :
23088 : 145017453 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
23089 : 145017451 : emit_insn (gen_significandxf2 (op0, op1));
23090 : 144987314 : emit_insn (gen_truncxf<mode>2 (operands[0], op0));
23091 : 145017451 : DONE;
23092 : 145017453 : })
23093 : 145017453 :
23094 : 144987316 :
23095 : 145017453 : (define_insn "sse4_1_round<mode>2"
23096 : 144987316 : [(set (match_operand:MODEFH 0 "register_operand" "=x,x,x,v,v")
23097 : 144987318 : (unspec:MODEFH
23098 : 144987316 : [(match_operand:MODEFH 1 "nonimmediate_operand" "0,x,jm,v,m")
23099 : 145017453 : (match_operand:SI 2 "const_0_to_15_operand")]
23100 : 145017451 : UNSPEC_ROUND))]
23101 : 144987543 : "TARGET_SSE4_1"
23102 : 144987444 : "@
23103 : 145017451 : %vround<ssemodesuffix>\t{%2, %d1, %0|%0, %d1, %2}
23104 : 145017451 : %vround<ssemodesuffix>\t{%2, %d1, %0|%0, %d1, %2}
23105 : 144987497 : %vround<ssemodesuffix>\t{%2, %1, %d0|%d0, %1, %2}
23106 : 144987497 : vrndscale<ssemodesuffix>\t{%2, %d1, %0|%0, %d1, %2}
23107 : 145017604 : vrndscale<ssemodesuffix>\t{%2, %1, %d0|%d0, %1, %2}"
23108 : 145017604 : [(set_attr "type" "ssecvt")
23109 : 145017725 : (set_attr "prefix_extra" "1,1,1,*,*")
23110 : 144999516 : (set_attr "length_immediate" "1")
23111 : 145017459 : (set_attr "addr" "*,*,gpr16,*,*")
23112 : 145017551 : (set_attr "prefix" "maybe_vex,maybe_vex,maybe_vex,evex,evex")
23113 : 145017551 : (set_attr "isa" "noavx512f,noavx512f,noavx512f,avx512f,avx512f")
23114 : 144987322 : (set_attr "avx_partial_xmm_update" "false,false,true,false,true")
23115 : 145017459 : (set_attr "mode" "<MODE>")
23116 : 144987322 : (set (attr "preferred_for_speed")
23117 : 144987322 : (cond [(match_test "TARGET_AVX")
23118 : 144987322 : (symbol_ref "true")
23119 : 145017451 : (eq_attr "alternative" "1,2")
23120 : 50591927 : (symbol_ref "!TARGET_SSE_PARTIAL_REG_DEPENDENCY")
23121 : 145017451 : ]
23122 : 144987314 : (symbol_ref "true")))])
23123 : 145017451 :
23124 : 145017451 : (define_insn "rintxf2"
23125 : 145017451 : [(set (match_operand:XF 0 "register_operand" "=f")
23126 : 144987314 : (unspec:XF [(match_operand:XF 1 "register_operand" "0")]
23127 : 145017451 : UNSPEC_FRNDINT))]
23128 : 151240263 : "TARGET_USE_FANCY_MATH_387"
23129 : 151240084 : "frndint"
23130 : 151209947 : [(set_attr "type" "fpspc")
23131 : 151240084 : (set_attr "znver1_decode" "vector")
23132 : 151210095 : (set_attr "mode" "XF")])
23133 : 50592716 :
23134 : 50562431 : (define_expand "rinthf2"
23135 : 6251027 : [(match_operand:HF 0 "register_operand")
23136 : 56781578 : (match_operand:HF 1 "nonimmediate_operand")]
23137 : 145017451 : "TARGET_AVX512FP16"
23138 : 50775670 : {
23139 : 94456771 : emit_insn (gen_sse4_1_roundhf2 (operands[0],
23140 : 145017451 : operands[1],
23141 : 145017451 : GEN_INT (ROUND_MXCSR)));
23142 : 144987322 : DONE;
23143 : 145017451 : })
23144 : 145017451 :
23145 : 145017451 : (define_expand "rint<mode>2"
23146 : 144987314 : [(use (match_operand:MODEF 0 "register_operand"))
23147 : 144987314 : (use (match_operand:MODEF 1 "nonimmediate_operand"))]
23148 : 145017451 : "TARGET_USE_FANCY_MATH_387
23149 : 145017451 : || (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)"
23150 : 94426775 : {
23151 : 94426767 : if (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
23152 : 145017451 : {
23153 : 145017580 : if (TARGET_SSE4_1)
23154 : 144987320 : emit_insn (gen_sse4_1_round<mode>2
23155 : 145017455 : (operands[0], operands[1], GEN_INT (ROUND_MXCSR)));
23156 : 145017455 : else
23157 : 145017578 : ix86_expand_rint (operands[0], operands[1]);
23158 : 144987318 : }
23159 : 145017455 : else
23160 : 145017529 : {
23161 : 145017479 : rtx op0 = gen_reg_rtx (XFmode);
23162 : 144987342 : rtx op1 = gen_reg_rtx (XFmode);
23163 : 144987392 :
23164 : 145017553 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
23165 : 145017479 : emit_insn (gen_rintxf2 (op0, op1));
23166 : 144987342 : emit_insn (gen_truncxf<mode>2_i387_noop_unspec (operands[0], op0));
23167 : 144987392 : }
23168 : 145017678 : DONE;
23169 : 145017455 : })
23170 : 144987318 :
23171 : 144987318 : (define_expand "nearbyintxf2"
23172 : 145017455 : [(set (match_operand:XF 0 "register_operand")
23173 : 145017455 : (unspec:XF [(match_operand:XF 1 "register_operand")]
23174 : 144987318 : UNSPEC_FRNDINT))]
23175 : 144987318 : "TARGET_USE_FANCY_MATH_387
23176 : 145017455 : && !flag_trapping_math")
23177 : 145017455 :
23178 : 144987318 : (define_expand "nearbyinthf2"
23179 : 144987318 : [(match_operand:HF 0 "register_operand")
23180 : 145017455 : (match_operand:HF 1 "nonimmediate_operand")]
23181 : 145017455 : "TARGET_AVX512FP16"
23182 : 144987326 : {
23183 : 144987326 : emit_insn (gen_sse4_1_roundhf2 (operands[0],
23184 : 145017455 : operands[1],
23185 : 145017455 : GEN_INT (ROUND_MXCSR | ROUND_NO_EXC)));
23186 : 144987326 : DONE;
23187 : 144987318 : })
23188 : 145017555 :
23189 : 145017455 : (define_expand "nearbyint<mode>2"
23190 : 144987318 : [(use (match_operand:MODEF 0 "register_operand"))
23191 : 144987418 : (use (match_operand:MODEF 1 "nonimmediate_operand"))]
23192 : 145017530 : "(TARGET_USE_FANCY_MATH_387
23193 : 145017530 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
23194 : 144987393 : || TARGET_MIX_SSE_I387)
23195 : 144987393 : && !flag_trapping_math)
23196 : 145017530 : || (TARGET_SSE4_1 && TARGET_SSE_MATH)"
23197 : 145017469 : {
23198 : 144987318 : if (TARGET_SSE4_1 && TARGET_SSE_MATH)
23199 : 144987318 : emit_insn (gen_sse4_1_round<mode>2
23200 : 145017463 : (operands[0], operands[1], GEN_INT (ROUND_MXCSR
23201 : 145017455 : | ROUND_NO_EXC)));
23202 : 144987318 : else
23203 : 144987326 : {
23204 : 145017477 : rtx op0 = gen_reg_rtx (XFmode);
23205 : 145017469 : rtx op1 = gen_reg_rtx (XFmode);
23206 : 144987326 :
23207 : 144987332 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
23208 : 145017483 : emit_insn (gen_nearbyintxf2 (op0, op1));
23209 : 145017469 : emit_insn (gen_truncxf<mode>2_i387_noop_unspec (operands[0], op0));
23210 : 144987324 : }
23211 : 144987332 : DONE;
23212 : 145017461 : })
23213 : 145017455 :
23214 : 144987318 : (define_expand "roundhf2"
23215 : 144987318 : [(match_operand:HF 0 "register_operand")
23216 : 145017455 : (match_operand:HF 1 "register_operand")]
23217 : 145017455 : "TARGET_AVX512FP16 && !flag_trapping_math && !flag_rounding_math"
23218 : 144987319 : {
23219 : 144987319 : ix86_expand_round_sse4 (operands[0], operands[1]);
23220 : 145017456 : DONE;
23221 : 145017455 : })
23222 : 144987318 :
23223 : 144987318 : (define_expand "round<mode>2"
23224 : 145017455 : [(match_operand:X87MODEF 0 "register_operand")
23225 : 145017455 : (match_operand:X87MODEF 1 "nonimmediate_operand")]
23226 : 145017455 : "(TARGET_USE_FANCY_MATH_387
23227 : 144987318 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
23228 : 145017455 : || TARGET_MIX_SSE_I387)
23229 : 145017455 : && flag_unsafe_math_optimizations
23230 : 145017455 : && (flag_fp_int_builtin_inexact || !flag_trapping_math))
23231 : 144987327 : || (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH
23232 : 145017455 : && !flag_trapping_math && !flag_rounding_math)"
23233 : 144987799 : {
23234 : 145017922 : if (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH
23235 : 144987786 : && !flag_trapping_math && !flag_rounding_math)
23236 : 145017901 : {
23237 : 145017914 : if (TARGET_SSE4_1)
23238 : 145017925 : {
23239 : 144987772 : operands[1] = force_reg (<MODE>mode, operands[1]);
23240 : 145017908 : ix86_expand_round_sse4 (operands[0], operands[1]);
23241 : 145017916 : }
23242 : 145017922 : else if (TARGET_64BIT || (<MODE>mode != DFmode))
23243 : 144987769 : ix86_expand_round (operands[0], operands[1]);
23244 : 145017908 : else
23245 : 144987763 : ix86_expand_rounddf_32 (operands[0], operands[1]);
23246 : 145017908 : }
23247 : 144987755 : else
23248 : 145017892 : {
23249 : 145017904 : operands[1] = force_reg (<MODE>mode, operands[1]);
23250 : 145017914 : ix86_emit_i387_round (operands[0], operands[1]);
23251 : 144987755 : }
23252 : 144988668 : DONE;
23253 : 144988624 : })
23254 : 144990751 :
23255 : 144987755 : (define_insn "lrintxfdi2"
23256 : 145014027 : [(set (match_operand:DI 0 "nonimmediate_operand" "=m")
23257 : 145014027 : (unspec:DI [(match_operand:XF 1 "register_operand" "f")]
23258 : 145014027 : UNSPEC_FIST))
23259 : 144987755 : (clobber (match_scratch:XF 2 "=&f"))]
23260 : 145014105 : "TARGET_USE_FANCY_MATH_387"
23261 : 144988267 : "* return output_fix_trunc (insn, operands, false);"
23262 : 144988257 : [(set_attr "type" "fpspc")
23263 : 145013581 : (set_attr "mode" "DI")])
23264 : 145013556 :
23265 : 145013556 : (define_insn "lrintxf<mode>2"
23266 : 145013593 : [(set (match_operand:SWI24 0 "nonimmediate_operand" "=m")
23267 : 145013589 : (unspec:SWI24 [(match_operand:XF 1 "register_operand" "f")]
23268 : 94452897 : UNSPEC_FIST))]
23269 : 144987354 : "TARGET_USE_FANCY_MATH_387"
23270 : 144987346 : "* return output_fix_trunc (insn, operands, false);"
23271 : 145013116 : [(set_attr "type" "fpspc")
23272 : 94452448 : (set_attr "mode" "<MODE>")])
23273 : 144987350 :
23274 : 145013216 : (define_expand "lroundhf<mode>2"
23275 : 145013146 : [(set (match_operand:SWI248 0 "register_operand")
23276 : 145013144 : (unspec:SWI248 [(match_operand:HF 1 "nonimmediate_operand")]
23277 : 144988414 : UNSPEC_FIX_NOTRUNC))]
23278 : 144987812 : "TARGET_AVX512FP16 && !flag_trapping_math && !flag_rounding_math"
23279 : 145013117 : {
23280 : 144987342 : ix86_expand_lround (operands[0], operands[1]);
23281 : 144988211 : DONE;
23282 : 144990305 : })
23283 : 94452424 :
23284 : 94452424 : (define_expand "lrinthf<mode>2"
23285 : 144988186 : [(set (match_operand:SWI48 0 "register_operand")
23286 : 145002388 : (unspec:SWI48 [(match_operand:HF 1 "nonimmediate_operand")]
23287 : 145024737 : UNSPEC_FIX_NOTRUNC))]
23288 : 144998939 : "TARGET_AVX512FP16")
23289 : 144999805 :
23290 : 145002376 : (define_expand "lrint<MODEF:mode><SWI48:mode>2"
23291 : 145024737 : [(set (match_operand:SWI48 0 "register_operand")
23292 : 145024737 : (unspec:SWI48 [(match_operand:MODEF 1 "nonimmediate_operand")]
23293 : 144999805 : UNSPEC_FIX_NOTRUNC))]
23294 : 145002376 : "SSE_FLOAT_MODE_P (<MODEF:MODE>mode) && TARGET_SSE_MATH")
23295 : 145024737 :
23296 : 145024737 : (define_expand "lround<X87MODEF:mode><SWI248x:mode>2"
23297 : 144999805 : [(match_operand:SWI248x 0 "nonimmediate_operand")
23298 : 145002131 : (match_operand:X87MODEF 1 "register_operand")]
23299 : 145024737 : "(TARGET_USE_FANCY_MATH_387
23300 : 144998986 : && (!(SSE_FLOAT_MODE_P (<X87MODEF:MODE>mode) && TARGET_SSE_MATH)
23301 : 144999805 : || TARGET_MIX_SSE_I387)
23302 : 145002132 : && flag_unsafe_math_optimizations)
23303 : 145024690 : || (SSE_FLOAT_MODE_P (<X87MODEF:MODE>mode) && TARGET_SSE_MATH
23304 : 144998939 : && <SWI248x:MODE>mode != HImode
23305 : 144999571 : && ((<SWI248x:MODE>mode != DImode) || TARGET_64BIT)
23306 : 145002017 : && !flag_trapping_math && !flag_rounding_math)"
23307 : 145024771 : {
23308 : 145024741 : if (SSE_FLOAT_MODE_P (<X87MODEF:MODE>mode) && TARGET_SSE_MATH
23309 : 144999571 : && <SWI248x:MODE>mode != HImode
23310 : 145002041 : && ((<SWI248x:MODE>mode != DImode) || TARGET_64BIT)
23311 : 145024724 : && !flag_trapping_math && !flag_rounding_math)
23312 : 145024724 : ix86_expand_lround (operands[0], operands[1]);
23313 : 144999531 : else
23314 : 145000782 : ix86_emit_i387_round (operands[0], operands[1]);
23315 : 144999019 : DONE;
23316 : 145024690 : })
23317 : 144999531 :
23318 : 145000711 : (define_int_iterator FRNDINT_ROUNDING
23319 : 144998939 : [UNSPEC_FRNDINT_ROUNDEVEN
23320 : 145024690 : UNSPEC_FRNDINT_FLOOR
23321 : 144999531 : UNSPEC_FRNDINT_CEIL
23322 : 145000150 : UNSPEC_FRNDINT_TRUNC])
23323 : 145024690 :
23324 : 94452377 : (define_int_iterator FIST_ROUNDING
23325 : 144999495 : [UNSPEC_FIST_FLOOR
23326 : 145000052 : UNSPEC_FIST_CEIL])
23327 : 145024690 :
23328 : 94452544 : ;; Base name for define_insn
23329 : 144999496 : (define_int_attr rounding_insn
23330 : 145000050 : [(UNSPEC_FRNDINT_ROUNDEVEN "roundeven")
23331 : 144998939 : (UNSPEC_FRNDINT_FLOOR "floor")
23332 : 145024857 : (UNSPEC_FRNDINT_CEIL "ceil")
23333 : 144999574 : (UNSPEC_FRNDINT_TRUNC "btrunc")
23334 : 144999714 : (UNSPEC_FIST_FLOOR "floor")
23335 : 145024857 : (UNSPEC_FIST_CEIL "ceil")])
23336 : 145024938 :
23337 : 144999575 : (define_int_attr rounding
23338 : 144999674 : [(UNSPEC_FRNDINT_ROUNDEVEN "roundeven")
23339 : 94452545 : (UNSPEC_FRNDINT_FLOOR "floor")
23340 : 94452624 : (UNSPEC_FRNDINT_CEIL "ceil")
23341 : 144999598 : (UNSPEC_FRNDINT_TRUNC "trunc")
23342 : 144999674 : (UNSPEC_FIST_FLOOR "floor")
23343 : 94452544 : (UNSPEC_FIST_CEIL "ceil")])
23344 : 94452544 :
23345 : 144999494 : (define_int_attr ROUNDING
23346 : 144999674 : [(UNSPEC_FRNDINT_ROUNDEVEN "ROUNDEVEN")
23347 : 144998939 : (UNSPEC_FRNDINT_FLOOR "FLOOR")
23348 : 94452544 : (UNSPEC_FRNDINT_CEIL "CEIL")
23349 : 144999491 : (UNSPEC_FRNDINT_TRUNC "TRUNC")
23350 : 144999678 : (UNSPEC_FIST_FLOOR "FLOOR")
23351 : 145024857 : (UNSPEC_FIST_CEIL "CEIL")])
23352 : 94452544 :
23353 : 144999495 : ;; Rounding mode control word calculation could clobber FLAGS_REG.
23354 : 144999672 : (define_insn_and_split "frndintxf2_<rounding>"
23355 : 145024857 : [(set (match_operand:XF 0 "register_operand")
23356 : 94452544 : (unspec:XF [(match_operand:XF 1 "register_operand")]
23357 : 144999491 : FRNDINT_ROUNDING))
23358 : 144999671 : (clobber (reg:CC FLAGS_REG))]
23359 : 145024859 : "TARGET_USE_FANCY_MATH_387
23360 : 94453144 : && (flag_fp_int_builtin_inexact || !flag_trapping_math)
23361 : 145000091 : && ix86_pre_reload_split ()"
23362 : 145000533 : "#"
23363 : 145024978 : "&& 1"
23364 : 94452804 : [(const_int 0)]
23365 : 145021228 : {
23366 : 145000918 : ix86_optimize_mode_switching[I387_<ROUNDING>] = 1;
23367 : 145004852 :
23368 : 94432602 : operands[2] = assign_386_stack_local (HImode, SLOT_CW_STORED);
23369 : 145008754 : operands[3] = assign_386_stack_local (HImode, SLOT_CW_<ROUNDING>);
23370 : 144999718 :
23371 : 145003472 : emit_insn (gen_frndintxf2_<rounding>_i387 (operands[0], operands[1],
23372 : 94430925 : operands[2], operands[3]));
23373 : 144999723 : DONE;
23374 : 144999671 : }
23375 : 144998939 : [(set_attr "type" "frndint")
23376 : 94430925 : (set_attr "i387_cw" "<rounding>")
23377 : 144999489 : (set_attr "mode" "XF")])
23378 : 144999671 :
23379 : 144998939 : (define_insn "frndintxf2_<rounding>_i387"
23380 : 94430925 : [(set (match_operand:XF 0 "register_operand" "=f")
23381 : 144999488 : (unspec:XF [(match_operand:XF 1 "register_operand" "0")]
23382 : 144999671 : FRNDINT_ROUNDING))
23383 : 145003238 : (use (match_operand:HI 2 "memory_operand" "m"))
23384 : 94433288 : (use (match_operand:HI 3 "memory_operand" "m"))]
23385 : 144999489 : "TARGET_USE_FANCY_MATH_387
23386 : 144999905 : && (flag_fp_int_builtin_inexact || !flag_trapping_math)"
23387 : 145005601 : "fldcw\t%3\n\tfrndint\n\tfldcw\t%2"
23388 : 94433288 : [(set_attr "type" "frndint")
23389 : 144999721 : (set_attr "i387_cw" "<rounding>")
23390 : 145000201 : (set_attr "mode" "XF")])
23391 : 145006364 :
23392 : 94433772 : (define_expand "<rounding_insn>xf2"
23393 : 144999488 : [(parallel [(set (match_operand:XF 0 "register_operand")
23394 : 144999671 : (unspec:XF [(match_operand:XF 1 "register_operand")]
23395 : 145005601 : FRNDINT_ROUNDING))
23396 : 94433288 : (clobber (reg:CC FLAGS_REG))])]
23397 : 144999488 : "TARGET_USE_FANCY_MATH_387
23398 : 144999671 : && (flag_fp_int_builtin_inexact || !flag_trapping_math)")
23399 : 145005601 :
23400 : 94433322 : (define_expand "<rounding_insn>hf2"
23401 : 144999488 : [(parallel [(set (match_operand:HF 0 "register_operand")
23402 : 144999671 : (unspec:HF [(match_operand:HF 1 "register_operand")]
23403 : 145005635 : FRNDINT_ROUNDING))
23404 : 94433288 : (clobber (reg:CC FLAGS_REG))])]
23405 : 144999487 : "TARGET_AVX512FP16"
23406 : 144999700 : {
23407 : 145005630 : emit_insn (gen_sse4_1_roundhf2 (operands[0], operands[1],
23408 : 94433288 : GEN_INT (ROUND_<ROUNDING> | ROUND_NO_EXC)));
23409 : 144999516 : DONE;
23410 : 94427358 : })
23411 : 145005601 :
23412 : 94433288 : (define_expand "<rounding_insn><mode>2"
23413 : 144999485 : [(parallel [(set (match_operand:MODEF 0 "register_operand")
23414 : 144999675 : (unspec:MODEF [(match_operand:MODEF 1 "register_operand")]
23415 : 145005623 : FRNDINT_ROUNDING))
23416 : 94433284 : (clobber (reg:CC FLAGS_REG))])]
23417 : 144999485 : "(TARGET_USE_FANCY_MATH_387
23418 : 144999701 : && (!(SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)
23419 : 144998939 : || TARGET_MIX_SSE_I387)
23420 : 94433284 : && (flag_fp_int_builtin_inexact || !flag_trapping_math))
23421 : 144999485 : || (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH
23422 : 144999675 : && (TARGET_SSE4_1
23423 : 144998939 : || (ROUND_<ROUNDING> != ROUND_ROUNDEVEN
23424 : 94433284 : && (flag_fp_int_builtin_inexact || !flag_trapping_math))))"
23425 : 145000419 : {
23426 : 145000585 : if (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH
23427 : 145006414 : && (TARGET_SSE4_1
23428 : 94434048 : || (ROUND_<ROUNDING> != ROUND_ROUNDEVEN
23429 : 145000249 : && (flag_fp_int_builtin_inexact || !flag_trapping_math))))
23430 : 144999709 : {
23431 : 145006409 : if (TARGET_SSE4_1)
23432 : 94433336 : emit_insn (gen_sse4_1_round<mode>2
23433 : 144999545 : (operands[0], operands[1],
23434 : 144999643 : GEN_INT (ROUND_<ROUNDING> | ROUND_NO_EXC)));
23435 : 145006013 : else if (TARGET_64BIT || (<MODE>mode != DFmode))
23436 : 94433310 : {
23437 : 144999511 : if (ROUND_<ROUNDING> == ROUND_FLOOR)
23438 : 144999670 : ix86_expand_floorceil (operands[0], operands[1], true);
23439 : 144999513 : else if (ROUND_<ROUNDING> == ROUND_CEIL)
23440 : 145006001 : ix86_expand_floorceil (operands[0], operands[1], false);
23441 : 144999511 : else if (ROUND_<ROUNDING> == ROUND_TRUNC)
23442 : 144999598 : ix86_expand_trunc (operands[0], operands[1]);
23443 : 145005597 : else
23444 : 145005597 : gcc_unreachable ();
23445 : 144999490 : }
23446 : 144999362 : else
23447 : 145005597 : {
23448 : 145005602 : if (ROUND_<ROUNDING> == ROUND_FLOOR)
23449 : 144999433 : ix86_expand_floorceildf_32 (operands[0], operands[1], true);
23450 : 144999318 : else if (ROUND_<ROUNDING> == ROUND_CEIL)
23451 : 144998939 : ix86_expand_floorceildf_32 (operands[0], operands[1], false);
23452 : 145005602 : else if (ROUND_<ROUNDING> == ROUND_TRUNC)
23453 : 144999424 : ix86_expand_truncdf_32 (operands[0], operands[1]);
23454 : 144999313 : else
23455 : 145005597 : gcc_unreachable ();
23456 : 145005597 : }
23457 : 94427106 : }
23458 : 144999302 : else
23459 : 145005899 : {
23460 : 144999057 : rtx op0 = gen_reg_rtx (XFmode);
23461 : 144999493 : rtx op1 = gen_reg_rtx (XFmode);
23462 : 144999276 :
23463 : 145006017 : emit_insn (gen_extend<mode>xf2 (op1, operands[1]));
23464 : 144999057 : emit_insn (gen_frndintxf2_<rounding> (op0, op1));
23465 : 144999493 : emit_insn (gen_truncxf<mode>2_i387_noop_unspec (operands[0], op0));
23466 : 144999276 : }
23467 : 145000175 : DONE;
23468 : 145005597 : })
23469 : 144999375 :
23470 : 144999250 : ;; Rounding mode control word calculation could clobber FLAGS_REG.
23471 : 94433284 : (define_insn_and_split "*fist<mode>2_<rounding>_1"
23472 : 145005597 : [(set (match_operand:SWI248x 0 "nonimmediate_operand")
23473 : 144999337 : (unspec:SWI248x [(match_operand:XF 1 "register_operand")]
23474 : 144999250 : FIST_ROUNDING))
23475 : 94433284 : (clobber (reg:CC FLAGS_REG))]
23476 : 145006434 : "TARGET_USE_FANCY_MATH_387
23477 : 94427278 : && flag_unsafe_math_optimizations
23478 : 94427176 : && ix86_pre_reload_split ()"
23479 : 144999213 : "#"
23480 : 145006504 : "&& 1"
23481 : 144999371 : [(const_int 0)]
23482 : 94427134 : {
23483 : 144999216 : ix86_optimize_mode_switching[I387_<ROUNDING>] = 1;
23484 : 145036537 :
23485 : 145000440 : operands[2] = assign_386_stack_local (HImode, SLOT_CW_STORED);
23486 : 94457141 : operands[3] = assign_386_stack_local (HImode, SLOT_CW_<ROUNDING>);
23487 : 94433509 :
23488 : 145038844 : emit_insn (gen_fist<mode>2_<rounding> (operands[0], operands[1],
23489 : 144999126 : operands[2], operands[3]));
23490 : 144999106 : DONE;
23491 : 145007307 : }
23492 : 145039298 : [(set_attr "type" "fistp")
23493 : 144999728 : (set_attr "i387_cw" "<rounding>")
23494 : 145000556 : (set_attr "mode" "<MODE>")])
23495 : 94437491 :
23496 : 94426788 : (define_insn "fistdi2_<rounding>"
23497 : 144999728 : [(set (match_operand:DI 0 "nonimmediate_operand" "=m")
23498 : 94430483 : (unspec:DI [(match_operand:XF 1 "register_operand" "f")]
23499 : 145009939 : FIST_ROUNDING))
23500 : 94429451 : (use (match_operand:HI 2 "memory_operand" "m"))
23501 : 144999724 : (use (match_operand:HI 3 "memory_operand" "m"))
23502 : 145001028 : (clobber (match_scratch:XF 4 "=&f"))]
23503 : 145007772 : "TARGET_USE_FANCY_MATH_387
23504 : 145007662 : && flag_unsafe_math_optimizations"
23505 : 144999656 : "* return output_fix_trunc (insn, operands, false);"
23506 : 144999734 : [(set_attr "type" "fistp")
23507 : 145006182 : (set_attr "i387_cw" "<rounding>")
23508 : 145006322 : (set_attr "mode" "DI")])
23509 : 144999650 :
23510 : 94426726 : (define_insn "fist<mode>2_<rounding>"
23511 : 94426626 : [(set (match_operand:SWI24 0 "nonimmediate_operand" "=m")
23512 : 144999524 : (unspec:SWI24 [(match_operand:XF 1 "register_operand" "f")]
23513 : 94426698 : FIST_ROUNDING))
23514 : 144999624 : (use (match_operand:HI 2 "memory_operand" "m"))
23515 : 94433284 : (use (match_operand:HI 3 "memory_operand" "m"))]
23516 : 144999524 : "TARGET_USE_FANCY_MATH_387
23517 : 144999596 : && flag_unsafe_math_optimizations"
23518 : 144999623 : "* return output_fix_trunc (insn, operands, false);"
23519 : 145006182 : [(set_attr "type" "fistp")
23520 : 144999524 : (set_attr "i387_cw" "<rounding>")
23521 : 144999664 : (set_attr "mode" "<MODE>")])
23522 : 144999717 :
23523 : 144999542 : (define_expand "l<rounding_insn>xf<mode>2"
23524 : 144999524 : [(parallel [(set (match_operand:SWI248x 0 "nonimmediate_operand")
23525 : 94427513 : (unspec:SWI248x [(match_operand:XF 1 "register_operand")]
23526 : 94426769 : FIST_ROUNDING))
23527 : 145000293 : (clobber (reg:CC FLAGS_REG))])]
23528 : 94426644 : "TARGET_USE_FANCY_MATH_387
23529 : 144999614 : && (!TARGET_SSE_MATH || TARGET_MIX_SSE_I387)
23530 : 94427492 : && flag_unsafe_math_optimizations")
23531 : 145006200 :
23532 : 145000329 : (define_expand "l<rounding_insn>hf<mode>2"
23533 : 145000383 : [(set (match_operand:SWI48 0 "nonimmediate_operand")
23534 : 144999621 : (unspec:SWI48 [(match_operand:HF 1 "register_operand")]
23535 : 145000311 : FIST_ROUNDING))]
23536 : 145006200 : "TARGET_AVX512FP16"
23537 : 144999600 : {
23538 : 144999625 : rtx tmp = gen_reg_rtx (HFmode);
23539 : 144999542 : emit_insn (gen_sse4_1_roundhf2 (tmp, operands[1],
23540 : 94433302 : GEN_INT (ROUND_<ROUNDING> | ROUND_NO_EXC)));
23541 : 94426716 : emit_insn (gen_fix_trunchf<mode>2 (operands[0], tmp));
23542 : 144999639 : DONE;
23543 : 94433302 : })
23544 : 145006200 :
23545 : 94426716 : (define_expand "l<rounding_insn><MODEF:mode><SWI48:mode>2"
23546 : 144999621 : [(parallel [(set (match_operand:SWI48 0 "nonimmediate_operand")
23547 : 145006190 : (unspec:SWI48 [(match_operand:MODEF 1 "register_operand")]
23548 : 145006182 : FIST_ROUNDING))
23549 : 144999596 : (clobber (reg:CC FLAGS_REG))])]
23550 : 94427365 : "SSE_FLOAT_MODE_P (<MODEF:MODE>mode) && TARGET_SSE_MATH
23551 : 145005548 : && (TARGET_SSE4_1 || !flag_trapping_math)"
23552 : 145005618 : {
23553 : 144999032 : if (TARGET_SSE4_1)
23554 : 94426811 : {
23555 : 144998892 : rtx tmp = gen_reg_rtx (<MODEF:MODE>mode);
23556 : 94433284 :
23557 : 94426700 : emit_insn (gen_sse4_1_round<MODEF:mode>2
23558 : 144998987 : (tmp, operands[1], GEN_INT (ROUND_<ROUNDING>
23559 : 94426634 : | ROUND_NO_EXC)));
23560 : 144998892 : emit_insn (gen_fix_trunc<MODEF:mode><SWI48:mode>2
23561 : 94426690 : (operands[0], tmp));
23562 : 144999047 : }
23563 : 145005617 : else if (ROUND_<ROUNDING> == ROUND_FLOOR)
23564 : 144998924 : ix86_expand_lfloorceil (operands[0], operands[1], true);
23565 : 94426750 : else if (ROUND_<ROUNDING> == ROUND_CEIL)
23566 : 94426723 : ix86_expand_lfloorceil (operands[0], operands[1], false);
23567 : 145005549 : else
23568 : 145005480 : gcc_unreachable ();
23569 : 94426691 :
23570 : 145005609 : DONE;
23571 : 145005480 : })
23572 : 145012137 :
23573 : 145005543 : (define_insn "fxam<mode>2_i387"
23574 : 145005539 : [(set (match_operand:HI 0 "register_operand" "=a")
23575 : 145005479 : (unspec:HI
23576 : 145005479 : [(match_operand:X87MODEF 1 "register_operand" "f")]
23577 : 145005567 : UNSPEC_FXAM))]
23578 : 94426790 : "TARGET_USE_FANCY_MATH_387"
23579 : 94426626 : "fxam\n\tfnstsw\t%0"
23580 : 94426650 : [(set_attr "type" "multi")
23581 : 94426690 : (set_attr "length" "4")
23582 : 145035375 : (set_attr "unit" "i387")
23583 : 94463120 : (set_attr "mode" "<MODE>")])
23584 : 145041973 :
23585 : 145005543 : (define_expand "signbittf2"
23586 : 145005585 : [(use (match_operand:SI 0 "register_operand"))
23587 : 145012183 : (use (match_operand:TF 1 "register_operand"))]
23588 : 145005479 : "TARGET_SSE"
23589 : 145005907 : {
23590 : 145005903 : if (TARGET_SSE4_1)
23591 : 145012183 : {
23592 : 145005482 : rtx mask = ix86_build_signbit_mask (TFmode, 0, 0);
23593 : 145005592 : rtx scratch = gen_reg_rtx (QImode);
23594 : 145005972 :
23595 : 94433333 : emit_insn (gen_ptesttf2 (operands[1], mask));
23596 : 94433333 : ix86_expand_setcc (scratch, NE,
23597 : 145005930 : gen_rtx_REG (CCZmode, FLAGS_REG), const0_rtx);
23598 : 94427013 :
23599 : 145012140 : emit_insn (gen_zero_extendqisi2 (operands[0], scratch));
23600 : 94426686 : }
23601 : 145005930 : else
23602 : 145005866 : {
23603 : 145005794 : emit_insn (gen_sse_movmskps (operands[0],
23604 : 145012452 : gen_lowpart (V4SFmode, operands[1])));
23605 : 145005858 : emit_insn (gen_andsi3 (operands[0], operands[0], GEN_INT (0x8)));
23606 : 145005479 : }
23607 : 145005797 : DONE;
23608 : 145005479 : })
23609 : 145005543 :
23610 : 145005479 : (define_expand "signbitxf2"
23611 : 145005479 : [(use (match_operand:SI 0 "register_operand"))
23612 : 145005479 : (use (match_operand:XF 1 "register_operand"))]
23613 : 94426690 : "TARGET_USE_FANCY_MATH_387"
23614 : 145017293 : {
23615 : 145035870 : rtx scratch = gen_reg_rtx (HImode);
23616 : 145012242 :
23617 : 145017357 : emit_insn (gen_fxamxf2_i387 (scratch, operands[1]));
23618 : 145029107 : emit_insn (gen_andsi3 (operands[0],
23619 : 145023951 : gen_lowpart (SImode, scratch), GEN_INT (0x200)));
23620 : 145017398 : DONE;
23621 : 145005535 : })
23622 : 145005479 :
23623 : 145012137 : (define_insn "movmsk_df"
23624 : 145239797 : [(set (match_operand:SI 0 "register_operand" "=r,jr")
23625 : 145005479 : (unspec:SI
23626 : 145005479 : [(match_operand:DF 1 "register_operand" "x,x")]
23627 : 94445098 : UNSPEC_MOVMSK))]
23628 : 94428030 : "SSE_FLOAT_MODE_P (DFmode) && TARGET_SSE_MATH"
23629 : 145005479 : "%vmovmskpd\t{%1, %0|%0, %1}"
23630 : 145017293 : [(set_attr "isa" "noavx,avx")
23631 : 145023951 : (set_attr "type" "ssemov")
23632 : 94445169 : (set_attr "prefix" "maybe_evex")
23633 : 145017364 : (set_attr "mode" "DF")])
23634 : 145017364 :
23635 : 145025213 : ;; Use movmskpd in SSE mode to avoid store forwarding stall
23636 : 145013399 : ;; for 32bit targets and movq+shrq sequence for 64bit targets.
23637 : 145005479 : (define_expand "signbitdf2"
23638 : 94426626 : [(use (match_operand:SI 0 "register_operand"))
23639 : 145013399 : (use (match_operand:DF 1 "register_operand"))]
23640 : 145014242 : "TARGET_USE_FANCY_MATH_387
23641 : 145005479 : || (SSE_FLOAT_MODE_P (DFmode) && TARGET_SSE_MATH)"
23642 : 145007584 : {
23643 : 145007584 : if (SSE_FLOAT_MODE_P (DFmode) && TARGET_SSE_MATH)
23644 : 145006322 : {
23645 : 94427415 : emit_insn (gen_movmsk_df (operands[0], operands[1]));
23646 : 145006268 : emit_insn (gen_andsi3 (operands[0], operands[0], const1_rtx));
23647 : 145007584 : }
23648 : 145012980 : else
23649 : 145005479 : {
23650 : 145005533 : rtx scratch = gen_reg_rtx (HImode);
23651 : 145005479 :
23652 : 145012191 : emit_insn (gen_fxamdf2_i387 (scratch, operands[1]));
23653 : 145005587 : emit_insn (gen_andsi3 (operands[0],
23654 : 145005533 : gen_lowpart (SImode, scratch), GEN_INT (0x200)));
23655 : 145012137 : }
23656 : 144983162 : DONE;
23657 : 94426626 : })
23658 : 94456444 :
23659 : 94463102 : (define_expand "signbitsf2"
23660 : 144974967 : [(use (match_operand:SI 0 "register_operand"))
23661 : 94426626 : (use (match_operand:SF 1 "register_operand"))]
23662 : 94456444 : "TARGET_USE_FANCY_MATH_387
23663 : 94463279 : && !(SSE_FLOAT_MODE_P (SFmode) && TARGET_SSE_MATH)"
23664 : 144981854 : {
23665 : 94426730 : rtx scratch = gen_reg_rtx (HImode);
23666 : 94456444 :
23667 : 94463331 : emit_insn (gen_fxamsf2_i387 (scratch, operands[1]));
23668 : 132551490 : emit_insn (gen_andsi3 (operands[0],
23669 : 94456496 : gen_lowpart (SImode, scratch), GEN_INT (0x200)));
23670 : 94456673 : DONE;
23671 : 94456621 : })
23672 : 123379679 :
23673 : 94456444 : ;; Block operation instructions
23674 : 94456444 :
23675 : 94426803 : (define_insn "cld"
23676 : 114230749 : [(unspec_volatile [(const_int 0)] UNSPECV_CLD)]
23677 : 94463102 : ""
23678 : 94456444 : "cld"
23679 : 94456608 : [(set_attr "length" "1")
23680 : 114230749 : (set_attr "length_immediate" "0")
23681 : 94463154 : (set_attr "modrm" "0")])
23682 : 94456496 :
23683 : 94463154 : (define_expand "cpymem<mode>"
23684 : 114224091 : [(use (match_operand:BLK 0 "memory_operand"))
23685 : 94463102 : (use (match_operand:BLK 1 "memory_operand"))
23686 : 94456444 : (use (match_operand:SWI48 2 "nonmemory_operand"))
23687 : 94463102 : (use (match_operand:SWI48 3 "const_int_operand"))
23688 : 114224039 : (use (match_operand:SI 4 "const_int_operand"))
23689 : 94458082 : (use (match_operand:SI 5 "const_int_operand"))
23690 : 94490497 : (use (match_operand:SI 6 ""))
23691 : 94484628 : (use (match_operand:SI 7 ""))
23692 : 114252223 : (use (match_operand:SI 8 ""))]
23693 : 94484628 : ""
23694 : 94527251 : {
23695 : 94553335 : if (ix86_expand_set_or_cpymem (operands[0], operands[1],
23696 : 114115513 : operands[2], NULL, operands[3],
23697 : 94486328 : operands[4], operands[5],
23698 : 94456444 : operands[6], operands[7],
23699 : 94458082 : operands[8], false))
23700 : 104159591 : DONE;
23701 : 94518743 : else
23702 : 94492833 : FAIL;
23703 : 94517043 : })
23704 : 113754957 :
23705 : 94517043 : ;; Most CPUs don't like single string operations
23706 : 94490497 : ;; Handle this case here to simplify previous expander.
23707 : 94490497 :
23708 : 113753257 : (define_expand "strmov"
23709 : 94460679 : [(set (match_dup 4) (match_operand 3 "memory_operand"))
23710 : 94460679 : (set (match_operand 1 "memory_operand") (match_dup 4))
23711 : 94517043 : (parallel [(set (match_operand 0 "register_operand") (match_dup 5))
23712 : 113753257 : (clobber (reg:CC FLAGS_REG))])
23713 : 94456444 : (parallel [(set (match_operand 2 "register_operand") (match_dup 6))
23714 : 94456444 : (clobber (reg:CC FLAGS_REG))])]
23715 : 94482990 : ""
23716 : 113745750 : {
23717 : 94482990 : /* Can't use this for non-default address spaces. */
23718 : 94456444 : if (!ADDR_SPACE_GENERIC_P (MEM_ADDR_SPACE (operands[3])))
23719 : 94482990 : FAIL;
23720 : 113745750 :
23721 : 94482990 : int piece_size = GET_MODE_SIZE (GET_MODE (operands[1]));
23722 : 94456444 :
23723 : 94456444 : /* If .md ever supports :P for Pmode, these can be directly
23724 : 113719204 : in the pattern above. */
23725 : 94482990 : operands[5] = plus_constant (Pmode, operands[0], piece_size);
23726 : 94456444 : operands[6] = plus_constant (Pmode, operands[2], piece_size);
23727 : 94482990 :
23728 : 113719204 : /* Can't use this if the user has appropriated esi or edi. */
23729 : 94456444 : if ((TARGET_SINGLE_STRINGOP || optimize_insn_for_size_p ())
23730 : 94456444 : && !(fixed_regs[SI_REG] || fixed_regs[DI_REG]))
23731 : 94456444 : {
23732 : 113745750 : emit_insn (gen_strmov_singleop (operands[0], operands[1],
23733 : 94482990 : operands[2], operands[3],
23734 : 94456444 : operands[5], operands[6]));
23735 : 94482990 : DONE;
23736 : 113745750 : }
23737 : 94482990 :
23738 : 94456444 : operands[4] = gen_reg_rtx (GET_MODE (operands[1]));
23739 : 94456444 : })
23740 : 113719204 :
23741 : 94482990 : (define_expand "strmov_singleop"
23742 : 94456444 : [(parallel [(set (match_operand 1 "memory_operand")
23743 : 94482990 : (match_operand 3 "memory_operand"))
23744 : 113719204 : (set (match_operand 0 "register_operand")
23745 : 94456444 : (match_operand 4))
23746 : 94456444 : (set (match_operand 2 "register_operand")
23747 : 94482990 : (match_operand 5))])]
23748 : 113718582 : ""
23749 : 94482990 : {
23750 : 94491098 : if (TARGET_CLD)
23751 : 94456444 : ix86_optimize_mode_switching[X86_DIRFLAG] = 1;
23752 : 113687826 : })
23753 : 94482990 :
23754 : 94456444 : (define_insn "*strmovdi_rex_1"
23755 : 94482990 : [(set (mem:DI (match_operand:P 2 "register_operand" "0"))
23756 : 113687826 : (mem:DI (match_operand:P 3 "register_operand" "1")))
23757 : 94456444 : (set (match_operand:P 0 "register_operand" "=D")
23758 : 94456444 : (plus:P (match_dup 2)
23759 : 94482990 : (const_int 8)))
23760 : 113749026 : (set (match_operand:P 1 "register_operand" "=S")
23761 : 94517644 : (plus:P (match_dup 3)
23762 : 94491098 : (const_int 8)))]
23763 : 94491098 : "TARGET_64BIT
23764 : 113722480 : && !(fixed_regs[SI_REG] || fixed_regs[DI_REG])
23765 : 94482990 : && ix86_check_no_addr_space (insn)"
23766 : 94456444 : "%^movsq"
23767 : 94491098 : [(set_attr "type" "str")
23768 : 113687826 : (set_attr "memory" "both")
23769 : 94517644 : (set_attr "mode" "DI")])
23770 : 94510986 :
23771 : 94456444 : (define_insn "*strmovsi_1"
23772 : 113722480 : [(set (mem:SI (match_operand:P 2 "register_operand" "0"))
23773 : 94456444 : (mem:SI (match_operand:P 3 "register_operand" "1")))
23774 : 94460224 : (set (match_operand:P 0 "register_operand" "=D")
23775 : 94457358 : (plus:P (match_dup 2)
23776 : 113677900 : (const_int 4)))
23777 : 94462188 : (set (match_operand:P 1 "register_operand" "=S")
23778 : 94456444 : (plus:P (match_dup 3)
23779 : 94457358 : (const_int 4)))]
23780 : 113683651 : "!(fixed_regs[SI_REG] || fixed_regs[DI_REG])
23781 : 94456451 : && ix86_check_no_addr_space (insn)"
23782 : 94456444 : "%^movs{l|d}"
23783 : 94482024 : [(set_attr "type" "str")
23784 : 113595116 : (set_attr "memory" "both")
23785 : 94456744 : (set_attr "mode" "SI")])
23786 : 94456444 :
23787 : 94457358 : (define_insn "*strmovhi_1"
23788 : 113536454 : [(set (mem:HI (match_operand:P 2 "register_operand" "0"))
23789 : 94457144 : (mem:HI (match_operand:P 3 "register_operand" "1")))
23790 : 94456444 : (set (match_operand:P 0 "register_operand" "=D")
23791 : 94481940 : (plus:P (match_dup 2)
23792 : 113368734 : (const_int 2)))
23793 : 94481810 : (set (match_operand:P 1 "register_operand" "=S")
23794 : 94456444 : (plus:P (match_dup 3)
23795 : 94481938 : (const_int 2)))]
23796 : 113357715 : "!(fixed_regs[SI_REG] || fixed_regs[DI_REG])
23797 : 94481810 : && ix86_check_no_addr_space (insn)"
23798 : 94483791 : "%^movsw"
23799 : 94484619 : [(set_attr "type" "str")
23800 : 113194578 : (set_attr "memory" "both")
23801 : 94481810 : (set_attr "mode" "HI")])
23802 : 94456444 :
23803 : 94459953 : (define_insn "*strmovqi_1"
23804 : 113142545 : [(set (mem:QI (match_operand:P 2 "register_operand" "0"))
23805 : 94457144 : (mem:QI (match_operand:P 3 "register_operand" "1")))
23806 : 94456444 : (set (match_operand:P 0 "register_operand" "=D")
23807 : 94459953 : (plus:P (match_dup 2)
23808 : 113142827 : (const_int 1)))
23809 : 94457144 : (set (match_operand:P 1 "register_operand" "=S")
23810 : 94456444 : (plus:P (match_dup 3)
23811 : 94459953 : (const_int 1)))]
23812 : 113142675 : "!(fixed_regs[SI_REG] || fixed_regs[DI_REG])
23813 : 94457157 : && ix86_check_no_addr_space (insn)"
23814 : 94456444 : "%^movsb"
23815 : 94459720 : [(set_attr "type" "str")
23816 : 113140231 : (set_attr "memory" "both")
23817 : 94457493 : (set (attr "prefix_rex")
23818 : 94456444 : (if_then_else
23819 : 94459473 : (match_test "<P:MODE>mode == DImode")
23820 : 113141544 : (const_string "0")
23821 : 94457493 : (const_string "*")))
23822 : 94456444 : (set_attr "mode" "QI")])
23823 : 94429421 :
23824 : 113141454 : (define_expand "rep_mov"
23825 : 94456740 : [(parallel [(set (match_operand 4 "register_operand") (const_int 0))
23826 : 94456440 : (set (match_operand 0 "register_operand")
23827 : 94459094 : (match_operand 5))
23828 : 113138017 : (set (match_operand 2 "register_operand")
23829 : 94457139 : (match_operand 6))
23830 : 94456440 : (set (match_operand 1 "memory_operand")
23831 : 94459094 : (match_operand 3 "memory_operand"))
23832 : 113136030 : (use (match_dup 4))])]
23833 : 94457516 : ""
23834 : 94481106 : {
23835 : 94453945 : if (TARGET_CLD)
23836 : 113135196 : ix86_optimize_mode_switching[X86_DIRFLAG] = 1;
23837 : 94457185 : })
23838 : 94456440 :
23839 : 94459047 : (define_insn "*rep_movdi_rex64"
23840 : 113162225 : [(set (match_operand:P 2 "register_operand" "=c") (const_int 0))
23841 : 94481668 : (set (match_operand:P 0 "register_operand" "=D")
23842 : 94481106 : (plus:P (ashift:P (match_operand:P 5 "register_operand" "2")
23843 : 94483710 : (const_int 3))
23844 : 113346448 : (match_operand:P 3 "register_operand" "0")))
23845 : 94481617 : (set (match_operand:P 1 "register_operand" "=S")
23846 : 94481106 : (plus:P (ashift:P (match_dup 5) (const_int 3))
23847 : 94483707 : (match_operand:P 4 "register_operand" "1")))
23848 : 113159861 : (set (mem:BLK (match_dup 3))
23849 : 94481601 : (mem:BLK (match_dup 4)))
23850 : 94481106 : (use (match_dup 5))]
23851 : 94514497 : "TARGET_64BIT
23852 : 113130945 : && !(fixed_regs[CX_REG] || fixed_regs[SI_REG] || fixed_regs[DI_REG])
23853 : 94512843 : && ix86_check_no_addr_space (insn)"
23854 : 94456440 : "%^rep{%;} movsq"
23855 : 94482628 : [(set_attr "type" "str")
23856 : 113074951 : (set_attr "prefix_rep" "1")
23857 : 94456935 : (set_attr "memory" "both")
23858 : 94426626 : (set_attr "mode" "DI")])
23859 : 94457962 :
23860 : 113073994 : (define_insn "*rep_movsi"
23861 : 94456935 : [(set (match_operand:P 2 "register_operand" "=c") (const_int 0))
23862 : 94456440 : (set (match_operand:P 0 "register_operand" "=D")
23863 : 94457962 : (plus:P (ashift:P (match_operand:P 5 "register_operand" "2")
23864 : 113260580 : (const_int 2))
23865 : 94457025 : (match_operand:P 3 "register_operand" "0")))
23866 : 94456440 : (set (match_operand:P 1 "register_operand" "=S")
23867 : 94482528 : (plus:P (ashift:P (match_dup 5) (const_int 2))
23868 : 94451292 : (match_operand:P 4 "register_operand" "1")))
23869 : 94481719 : (set (mem:BLK (match_dup 3))
23870 : 94456440 : (mem:BLK (match_dup 4)))
23871 : 94457744 : (use (match_dup 5))]
23872 : 113092099 : "!(fixed_regs[CX_REG] || fixed_regs[SI_REG] || fixed_regs[DI_REG])
23873 : 94475035 : && ix86_check_no_addr_space (insn)"
23874 : 94478072 : "%^rep{%;} movs{l|d}"
23875 : 94457744 : [(set_attr "type" "str")
23876 : 113073994 : (set_attr "prefix_rep" "1")
23877 : 94456870 : (set_attr "memory" "both")
23878 : 94643026 : (set_attr "mode" "SI")])
23879 : 94457703 :
23880 : 113073994 : (define_insn "*rep_movqi"
23881 : 94456806 : [(set (match_operand:P 2 "register_operand" "=c") (const_int 0))
23882 : 94643026 : (set (match_operand:P 0 "register_operand" "=D")
23883 : 94457703 : (plus:P (match_operand:P 3 "register_operand" "0")
23884 : 113282212 : (match_operand:P 5 "register_operand" "2")))
23885 : 94478438 : (set (match_operand:P 1 "register_operand" "=S")
23886 : 94664658 : (plus:P (match_operand:P 4 "register_operand" "1") (match_dup 5)))
23887 : 94479335 : (set (mem:BLK (match_dup 3))
23888 : 113282061 : (mem:BLK (match_dup 4)))
23889 : 94478438 : (use (match_dup 5))]
23890 : 249206 : "!(fixed_regs[CX_REG] || fixed_regs[SI_REG] || fixed_regs[DI_REG])
23891 : 180150 : && ix86_check_no_addr_space (insn)"
23892 : 18980190 : "%^rep{%;} movsb"
23893 : 172106 : [(set_attr "type" "str")
23894 : 242264 : (set_attr "prefix_rep" "1")
23895 : 52646 : (set_attr "memory" "both")
23896 : 18718648 : (set_attr "mode" "QI")])
23897 : 29951 :
23898 : 216530 : (define_expand "setmem<mode>"
23899 : 35376 : [(use (match_operand:BLK 0 "memory_operand"))
23900 : 18598991 : (use (match_operand:SWI48 1 "nonmemory_operand"))
23901 : 30081 : (use (match_operand:QI 2 "nonmemory_operand"))
23902 : 216530 : (use (match_operand 3 "const_int_operand"))
23903 : 31144 : (use (match_operand:SI 4 "const_int_operand"))
23904 : 17856454 : (use (match_operand:SI 5 "const_int_operand"))
23905 : 30081 : (use (match_operand:SI 6 ""))
23906 : 216400 : (use (match_operand:SI 7 ""))
23907 : 31014 : (use (match_operand:SI 8 ""))]
23908 : 17851713 : ""
23909 : 62337 : {
23910 : 248786 : if (ix86_expand_set_or_cpymem (operands[0], NULL,
23911 : 31014 : operands[1], operands[2],
23912 : 17585317 : operands[3], operands[4],
23913 : 29951 : operands[5], operands[6],
23914 : 29814 : operands[7], operands[8], true))
23915 : 51453 : DONE;
23916 : 17446140 : else
23917 : 41898 : FAIL;
23918 : 216400 : })
23919 : 31014 :
23920 : 17206360 : ;; Most CPUs don't like single string operations
23921 : 29951 : ;; Handle this case here to simplify previous expander.
23922 : 216400 :
23923 : 31013 : (define_expand "strset"
23924 : 17366938 : [(set (match_operand 1 "memory_operand")
23925 : 29951 : (match_operand 2 "register_operand"))
23926 : 216400 : (parallel [(set (match_operand 0 "register_operand")
23927 : 30993 : (match_dup 3))
23928 : 17366938 : (clobber (reg:CC FLAGS_REG))])]
23929 : 29951 : ""
23930 : 223367 : {
23931 : 30993 : /* Can't use this for non-default address spaces. */
23932 : 17187319 : if (!ADDR_SPACE_GENERIC_P (MEM_ADDR_SPACE (operands[1])))
23933 : 29951 : FAIL;
23934 : 216400 :
23935 : 37960 : if (GET_MODE (operands[1]) != GET_MODE (operands[2]))
23936 : 8382222 : operands[1] = adjust_address_nv (operands[1], GET_MODE (operands[2]), 0);
23937 : 29951 :
23938 : 216400 : /* If .md ever supports :P for Pmode, this can be directly
23939 : 1179 : in the pattern above. */
23940 : 8389189 : operands[3] = plus_constant (Pmode, operands[0],
23941 : 43885 : GET_MODE_SIZE (GET_MODE (operands[2])));
23942 : 216400 :
23943 : 30993 : /* Can't use this if the user has appropriated eax or edi. */
23944 : 8382964 : if ((TARGET_SINGLE_STRINGOP || optimize_insn_for_size_p ())
23945 : 36922 : && !(fixed_regs[AX_REG] || fixed_regs[DI_REG]))
23946 : 186586 : {
23947 : 30997 : emit_insn (gen_strset_singleop (operands[0], operands[1], operands[2],
23948 : 17160392 : operands[3]));
23949 : 29907 : DONE;
23950 : 186586 : }
23951 : 1175 : })
23952 : 17343581 :
23953 : 29903 : (define_expand "strset_singleop"
23954 : 6963 : [(parallel [(set (match_operand 1 "memory_operand")
23955 : 37892 : (match_operand 2 "register_operand"))
23956 : 17347379 : (set (match_operand 0 "register_operand")
23957 : 36866 : (match_operand 3))
23958 : 6963 : (unspec [(const_int 0)] UNSPEC_STOS)])]
23959 : 37892 : ""
23960 : 16288946 : {
23961 : 36870 : if (TARGET_CLD)
23962 : 216400 : ix86_optimize_mode_switching[X86_DIRFLAG] = 1;
23963 : 37892 : })
23964 : 11871458 :
23965 : 47620 : (define_insn "*strsetdi_rex_1"
23966 : 216404 : [(set (mem:DI (match_operand:P 1 "register_operand" "0"))
23967 : 30933 : (match_operand:DI 2 "register_operand" "a"))
23968 : 7868597 : (set (match_operand:P 0 "register_operand" "=D")
23969 : 36874 : (plus:P (match_dup 1)
23970 : 223363 : (const_int 8)))
23971 : 37896 : (unspec [(const_int 0)] UNSPEC_STOS)]
23972 : 937474 : "TARGET_64BIT
23973 : 36874 : && !(fixed_regs[AX_REG] || fixed_regs[DI_REG])
23974 : 223367 : && ix86_check_no_addr_space (insn)"
23975 : 30933 : "%^stosq"
23976 : 632388 : [(set_attr "type" "str")
23977 : 10847 : (set_attr "memory" "store")
23978 : 227154 : (set_attr "mode" "DI")])
23979 : 41683 :
23980 : 438627 : (define_insn "*strsetsi_1"
23981 : 10843 : [(set (mem:SI (match_operand:P 1 "register_operand" "0"))
23982 : 227158 : (match_operand:SI 2 "register_operand" "a"))
23983 : 30933 : (set (match_operand:P 0 "register_operand" "=D")
23984 : 10758 : (plus:P (match_dup 1)
23985 : 29907 : (const_int 4)))
23986 : 216404 : (unspec [(const_int 0)] UNSPEC_STOS)]
23987 : 41685 : "!(fixed_regs[AX_REG] || fixed_regs[DI_REG])
23988 : 186592 : && ix86_check_no_addr_space (insn)"
23989 : 93 : "%^stos{l|d}"
23990 : 216400 : [(set_attr "type" "str")
23991 : 1115 : (set_attr "memory" "store")
23992 : 206148 : (set_attr "mode" "SI")])
23993 : 89 :
23994 : 216400 : (define_insn "*strsethi_1"
23995 : 30885 : [(set (mem:HI (match_operand:P 1 "register_operand" "0"))
23996 : 100787675 : (match_operand:HI 2 "register_operand" "a"))
23997 : 29903 : (set (match_operand:P 0 "register_operand" "=D")
23998 : 100807245 : (plus:P (match_dup 1)
23999 : 100620966 : (const_int 2)))
24000 : 19562 : (unspec [(const_int 0)] UNSPEC_STOS)]
24001 : 100620749 : "!(fixed_regs[AX_REG] || fixed_regs[DI_REG])
24002 : 206149 : && ix86_check_no_addr_space (insn)"
24003 : 100591152 : "%^stosw"
24004 : 19562 : [(set_attr "type" "str")
24005 : 51467 : (set_attr "memory" "store")
24006 : 237964 : (set_attr "mode" "HI")])
24007 : 307 :
24008 : 186586 : (define_insn "*strsetqi_1"
24009 : 31905 : [(set (mem:QI (match_operand:P 1 "register_operand" "0"))
24010 : 218402 : (match_operand:QI 2 "register_operand" "a"))
24011 : 32135 : (set (match_operand:P 0 "register_operand" "=D")
24012 : 186586 : (plus:P (match_dup 1)
24013 : 31905 : (const_int 1)))
24014 : 218402 : (unspec [(const_int 0)] UNSPEC_STOS)]
24015 : 35240 : "!(fixed_regs[AX_REG] || fixed_regs[DI_REG])
24016 : 184224 : && ix86_check_no_addr_space (insn)"
24017 : 31905 : "%^stosb"
24018 : 216039 : [(set_attr "type" "str")
24019 : 35226 : (set_attr "memory" "store")
24020 : 0 : (set (attr "prefix_rex")
24021 : 31905 : (if_then_else
24022 : 216039 : (match_test "<P:MODE>mode == DImode")
24023 : 35185 : (const_string "0")
24024 : 0 : (const_string "*")))
24025 : 89 : (set_attr "mode" "QI")])
24026 : 184223 :
24027 : 34373 : (define_expand "rep_stos"
24028 : 184223 : [(parallel [(set (match_operand 1 "register_operand") (const_int 0))
24029 : 31905 : (set (match_operand 0 "register_operand")
24030 : 184223 : (match_operand 4))
24031 : 34086 : (set (match_operand 2 "memory_operand") (const_int 0))
24032 : 184223 : (use (match_operand 3 "register_operand"))
24033 : 31905 : (use (match_dup 1))])]
24034 : 216039 : ""
24035 : 53346 : {
24036 : 19562 : if (TARGET_CLD)
24037 : 31905 : ix86_optimize_mode_switching[X86_DIRFLAG] = 1;
24038 : 216039 : })
24039 : 33784 :
24040 : 184223 : (define_insn "*rep_stosdi_rex64"
24041 : 19651 : [(set (match_operand:P 1 "register_operand" "=c") (const_int 0))
24042 : 19562 : (set (match_operand:P 0 "register_operand" "=D")
24043 : 53346 : (plus:P (ashift:P (match_operand:P 4 "register_operand" "1")
24044 : 203785 : (const_int 3))
24045 : 51467 : (match_operand:P 3 "register_operand" "0")))
24046 : 203785 : (set (mem:BLK (match_dup 3))
24047 : 53346 : (const_int 0))
24048 : 19562 : (use (match_operand:DI 2 "register_operand" "a"))
24049 : 51467 : (use (match_dup 4))]
24050 : 243873 : "TARGET_64BIT
24051 : 73872 : && !(fixed_regs[AX_REG] || fixed_regs[CX_REG] || fixed_regs[DI_REG])
24052 : 243873 : && ix86_check_no_addr_space (insn)"
24053 : 31905 : "%^rep{%;} stosq"
24054 : 216039 : [(set_attr "type" "str")
24055 : 33745 : (set_attr "prefix_rep" "1")
24056 : 184223 : (set_attr "memory" "store")
24057 : 89 : (set_attr "mode" "DI")])
24058 : 184223 :
24059 : 33098 : (define_insn "*rep_stossi"
24060 : 184223 : [(set (match_operand:P 1 "register_operand" "=c") (const_int 0))
24061 : 31905 : (set (match_operand:P 0 "register_operand" "=D")
24062 : 0 : (plus:P (ashift:P (match_operand:P 4 "register_operand" "1")
24063 : 33682 : (const_int 2))
24064 : 203785 : (match_operand:P 3 "register_operand" "0")))
24065 : 51467 : (set (mem:BLK (match_dup 3))
24066 : 235601 : (const_int 0))
24067 : 33496 : (use (match_operand:SI 2 "register_operand" "a"))
24068 : 184223 : (use (match_dup 4))]
24069 : 47263 : "!(fixed_regs[AX_REG] || fixed_regs[CX_REG] || fixed_regs[DI_REG])
24070 : 231397 : && ix86_check_no_addr_space (insn)"
24071 : 81456 : "%^rep{%;} stos{l|d}"
24072 : 184223 : [(set_attr "type" "str")
24073 : 89 : (set_attr "prefix_rep" "1")
24074 : 0 : (set_attr "memory" "store")
24075 : 2342 : (set_attr "mode" "SI")])
24076 : 184223 :
24077 : 107677 : (define_insn "*rep_stosqi"
24078 : 77774 : [(set (match_operand:P 1 "register_operand" "=c") (const_int 0))
24079 : 109230 : (set (match_operand:P 0 "register_operand" "=D")
24080 : 261997 : (plus:P (match_operand:P 3 "register_operand" "0")
24081 : 107677 : (match_operand:P 4 "register_operand" "1")))
24082 : 107588 : (set (mem:BLK (match_dup 3))
24083 : 108978 : (const_int 0))
24084 : 261997 : (use (match_operand:QI 2 "register_operand" "a"))
24085 : 77863 : (use (match_dup 4))]
24086 : 2841 : "!(fixed_regs[AX_REG] || fixed_regs[CX_REG] || fixed_regs[DI_REG])
24087 : 4215 : && ix86_check_no_addr_space (insn)"
24088 : 0 : "%^rep{%;} stosb"
24089 : 0 : [(set_attr "type" "str")
24090 : 214037 : (set_attr "prefix_rep" "1")
24091 : 31188 : (set_attr "memory" "store")
24092 : 0 : (set (attr "prefix_rex")
24093 : 0 : (if_then_else
24094 : 184223 : (match_test "<P:MODE>mode == DImode")
24095 : 30855 : (const_string "0")
24096 : 184225 : (const_string "*")))
24097 : 30487 : (set_attr "mode" "QI")])
24098 : 214712 :
24099 : 31528 : (define_expand "cmpmemsi"
24100 : 184225 : [(set (match_operand:SI 0 "register_operand" "")
24101 : 30489 : (compare:SI (match_operand:BLK 1 "memory_operand" "")
24102 : 214710 : (match_operand:BLK 2 "memory_operand" "") ) )
24103 : 31528 : (use (match_operand 3 "general_operand"))
24104 : 184223 : (use (match_operand 4 "immediate_operand"))]
24105 : 2 : ""
24106 : 292484 : {
24107 : 109302 : if (ix86_expand_cmpstrn_or_cmpmem (operands[0], operands[1],
24108 : 184223 : operands[2], operands[3],
24109 : 89 : operands[4], false))
24110 : 220341 : DONE;
24111 : 12662 : else
24112 : 256366 : FAIL;
24113 : 88 : })
24114 : 203089 :
24115 : 19907 : (define_expand "cmpstrnsi"
24116 : 184223 : [(set (match_operand:SI 0 "register_operand")
24117 : 18990 : (compare:SI (match_operand:BLK 1 "general_operand")
24118 : 203089 : (match_operand:BLK 2 "general_operand")))
24119 : 19871 : (use (match_operand 3 "general_operand"))
24120 : 184896 : (use (match_operand 4 "immediate_operand"))]
24121 : 750 : ""
24122 : 333175 : {
24123 : 149957 : if (ix86_expand_cmpstrn_or_cmpmem (operands[0], operands[1],
24124 : 184223 : operands[2], operands[3],
24125 : 18270 : operands[4], true))
24126 : 18266 : DONE;
24127 : 19197 : else
24128 : 314909 : FAIL;
24129 : 18270 : })
24130 : 18205 :
24131 : 1001 : ;; Produce a tri-state integer (-1, 0, 1) from condition codes.
24132 : 184223 :
24133 : 18208 : (define_expand "cmpintqi"
24134 : 202428 : [(set (match_dup 1)
24135 : 1572 : (gtu:QI (reg:CC FLAGS_REG) (const_int 0)))
24136 : 185773 : (set (match_dup 2)
24137 : 1550 : (ltu:QI (reg:CC FLAGS_REG) (const_int 0)))
24138 : 200878 : (parallel [(set (match_operand:QI 0 "register_operand")
24139 : 12600 : (minus:QI (match_dup 1)
24140 : 184223 : (match_dup 2)))
24141 : 0 : (clobber (reg:CC FLAGS_REG))])]
24142 : 331637 : ""
24143 : 18304 : {
24144 : 195631 : operands[1] = gen_reg_rtx (QImode);
24145 : 22359 : operands[2] = gen_reg_rtx (QImode);
24146 : 189126 : })
24147 : 12600 :
24148 : 319885 : ;; memcmp recognizers. The `cmpsb' opcode does nothing if the count is
24149 : 147491 : ;; zero. Emit extra code to make sure that a zero-length compare is EQ.
24150 : 342349 :
24151 : 149063 : (define_expand "cmpstrnqi_nz_1"
24152 : 369492 : [(parallel [(set (reg:CC FLAGS_REG)
24153 : 136658 : (compare:CC (match_operand 4 "memory_operand")
24154 : 158021 : (match_operand 5 "memory_operand")))
24155 : 142797 : (use (match_operand 2 "register_operand"))
24156 : 180261 : (use (match_operand:SI 3 "immediate_operand"))
24157 : 97 : (clobber (match_operand 0 "register_operand"))
24158 : 206582 : (clobber (match_operand 1 "register_operand"))
24159 : 12010 : (clobber (match_dup 2))])]
24160 : 189927 : ""
24161 : 7318 : {
24162 : 22359 : if (TARGET_CLD)
24163 : 17706 : ix86_optimize_mode_switching[X86_DIRFLAG] = 1;
24164 : 189927 : })
24165 : 7318 :
24166 : 212292 : (define_insn "*cmpstrnqi_nz_1"
24167 : 11890 : [(set (reg:CC FLAGS_REG)
24168 : 0 : (compare:CC (mem:BLK (match_operand:P 4 "register_operand" "0"))
24169 : 1649 : (mem:BLK (match_operand:P 5 "register_operand" "1"))))
24170 : 200884 : (use (match_operand:P 6 "register_operand" "2"))
24171 : 8591 : (use (match_operand:SI 3 "immediate_operand" "i"))
24172 : 184229 : (clobber (match_operand:P 0 "register_operand" "=S"))
24173 : 7308 : (clobber (match_operand:P 1 "register_operand" "=D"))
24174 : 22359 : (clobber (match_operand:P 2 "register_operand" "=c"))]
24175 : 14294 : "!(fixed_regs[CX_REG] || fixed_regs[SI_REG] || fixed_regs[DI_REG])
24176 : 0 : && ix86_check_no_addr_space (insn)"
24177 : 1598 : "%^repz{%;} cmpsb"
24178 : 16655 : [(set_attr "type" "str")
24179 : 6438 : (set_attr "mode" "QI")
24180 : 184223 : (set (attr "prefix_rex")
24181 : 1598 : (if_then_else
24182 : 207590 : (match_test "<P:MODE>mode == DImode")
24183 : 12000 : (const_string "0")
24184 : 190935 : (const_string "*")))
24185 : 1598 : (set_attr "prefix_rep" "1")])
24186 : 201797 :
24187 : 6184 : ;; The same, but the count is not known to not be zero.
24188 : 190062 :
24189 : 2188 : (define_expand "cmpstrnqi_1"
24190 : 184246 : [(parallel [(set (reg:CC FLAGS_REG)
24191 : 10304 : (if_then_else:CC (ne (match_operand 2 "register_operand")
24192 : 190907 : (const_int 0))
24193 : 2143 : (compare:CC (match_operand 4 "memory_operand")
24194 : 184246 : (match_operand 5 "memory_operand"))
24195 : 8537 : (reg:CC FLAGS_REG)))
24196 : 0 : (use (match_operand:SI 3 "immediate_operand"))
24197 : 1237 : (clobber (match_operand 0 "register_operand"))
24198 : 193461 : (clobber (match_operand 1 "register_operand"))
24199 : 8537 : (clobber (match_dup 2))])]
24200 : 0 : ""
24201 : 6941 : {
24202 : 199529 : if (TARGET_CLD)
24203 : 6648 : ix86_optimize_mode_switching[X86_DIRFLAG] = 1;
24204 : 5704 : })
24205 : 1237 :
24206 : 9579 : (define_insn "*cmpstrnqi_1"
24207 : 11820 : [(set (reg:CC FLAGS_REG)
24208 : 5704 : (if_then_else:CC (ne (match_operand:P 6 "register_operand" "2")
24209 : 6885 : (const_int 0))
24210 : 190314 : (compare:CC (mem:BLK (match_operand:P 4 "register_operand" "0"))
24211 : 16188 : (mem:BLK (match_operand:P 5 "register_operand" "1")))
24212 : 5704 : (reg:CC FLAGS_REG)))
24213 : 12616 : (use (match_operand:SI 3 "immediate_operand" "i"))
24214 : 204880 : (clobber (match_operand:P 0 "register_operand" "=S"))
24215 : 16187 : (clobber (match_operand:P 1 "register_operand" "=D"))
24216 : 195678 : (clobber (match_operand:P 2 "register_operand" "=c"))]
24217 : 36529 : "!(fixed_regs[CX_REG] || fixed_regs[SI_REG] || fixed_regs[DI_REG])
24218 : 43790 : && ix86_check_no_addr_space (insn)"
24219 : 10483 : "%^repz{%;} cmpsb"
24220 : 189974 : [(set_attr "type" "str")
24221 : 2003 : (set_attr "mode" "QI")
24222 : 184270 : (set (attr "prefix_rex")
24223 : 4779 : (if_then_else
24224 : 184270 : (match_test "<P:MODE>mode == DImode")
24225 : 2003 : (const_string "0")
24226 : 184270 : (const_string "*")))
24227 : 4779 : (set_attr "prefix_rep" "1")])
24228 : 185297 :
24229 : 1926 : (define_expand "strlen<mode>"
24230 : 193485 : [(set (match_operand:P 0 "register_operand")
24231 : 4703 : (unspec:P [(match_operand:BLK 1 "general_operand")
24232 : 11 : (match_operand:QI 2 "immediate_operand")
24233 : 2005 : (match_operand 3 "immediate_operand")]
24234 : 193474 : UNSPEC_SCAS))]
24235 : 3276 : ""
24236 : 198332 : {
24237 : 15894 : if (ix86_expand_strlen (operands[0], operands[1], operands[2], operands[3]))
24238 : 11 : DONE;
24239 : 4540 : else
24240 : 198321 : FAIL;
24241 : 7525 : })
24242 : 5704 :
24243 : 9406 : (define_expand "strlenqi_1"
24244 : 184259 : [(parallel [(set (match_operand 0 "register_operand")
24245 : 3681 : (match_operand 2))
24246 : 1960 : (clobber (match_operand 1 "register_operand"))
24247 : 4540 : (clobber (reg:CC FLAGS_REG))])]
24248 : 184804 : ""
24249 : 1641 : {
24250 : 186219 : if (TARGET_CLD)
24251 : 4540 : ix86_optimize_mode_switching[X86_DIRFLAG] = 1;
24252 : 23 : })
24253 : 1944 :
24254 : 184781 : (define_insn "*strlenqi_1"
24255 : 5085 : [(set (match_operand:P 0 "register_operand" "=&c")
24256 : 546 : (unspec:P [(mem:BLK (match_operand:P 5 "register_operand" "1"))
24257 : 2019 : (match_operand:QI 2 "register_operand" "a")
24258 : 193996 : (match_operand:P 3 "immediate_operand" "i")
24259 : 5085 : (match_operand:P 4 "register_operand" "0")] UNSPEC_SCAS))
24260 : 184781 : (clobber (match_operand:P 1 "register_operand" "=D"))
24261 : 1474 : (clobber (reg:CC FLAGS_REG))]
24262 : 193451 : "!(fixed_regs[AX_REG] || fixed_regs[CX_REG] || fixed_regs[DI_REG])
24263 : 4540 : && ix86_check_no_addr_space (insn)"
24264 : 184236 : "%^repnz{%;} scasb"
24265 : 1472 : [(set_attr "type" "str")
24266 : 193700 : (set_attr "mode" "QI")
24267 : 18038 : (set (attr "prefix_rex")
24268 : 0 : (if_then_else
24269 : 1471 : (match_test "<P:MODE>mode == DImode")
24270 : 9464 : (const_string "0")
24271 : 4503 : (const_string "*")))
24272 : 184236 : (set_attr "prefix_rep" "1")])
24273 : 15248 :
24274 : 198013 : ;; Peephole optimizations to clean up after cmpstrn*. This should be
24275 : 18024 : ;; handled in combine, but it is not currently up to the task.
24276 : 13528 : ;; When used for their truth value, the cmpstrn* expanders generate
24277 : 1471 : ;; code like this:
24278 : 198013 : ;;
24279 : 18024 : ;; repz cmpsb
24280 : 0 : ;; seta %al
24281 : 1471 : ;; setb %dl
24282 : 184410 : ;; cmpb %al, %dl
24283 : 4496 : ;; jcc label
24284 : 0 : ;;
24285 : 1470 : ;; The intermediate three instructions are unnecessary.
24286 : 193451 :
24287 : 4496 : ;; This one handles cmpstrn*_nz_1...
24288 : 0 : (define_peephole2
24289 : 1469 : [(parallel[
24290 : 193451 : (set (reg:CC FLAGS_REG)
24291 : 4219 : (compare:CC (mem:BLK (match_operand 4 "register_operand"))
24292 : 0 : (mem:BLK (match_operand 5 "register_operand"))))
24293 : 1469 : (use (match_operand 6 "register_operand"))
24294 : 184326 : (use (match_operand:SI 3 "immediate_operand"))
24295 : 3733 : (clobber (match_operand 0 "register_operand"))
24296 : 0 : (clobber (match_operand 1 "register_operand"))
24297 : 1460 : (clobber (match_operand 2 "register_operand"))])
24298 : 193540 : (set (match_operand:QI 7 "register_operand")
24299 : 3731 : (gtu:QI (reg:CC FLAGS_REG) (const_int 0)))
24300 : 184325 : (set (match_operand:QI 8 "register_operand")
24301 : 1460 : (ltu:QI (reg:CC FLAGS_REG) (const_int 0)))
24302 : 193540 : (set (reg FLAGS_REG)
24303 : 3776 : (compare (match_dup 7) (match_dup 8)))
24304 : 193540 : ]
24305 : 1460 : "peep2_reg_dead_p (4, operands[7]) && peep2_reg_dead_p (4, operands[8])"
24306 : 193540 : [(parallel[
24307 : 3639 : (set (reg:CC FLAGS_REG)
24308 : 254988 : (compare:CC (mem:BLK (match_dup 4))
24309 : 1460 : (mem:BLK (match_dup 5))))
24310 : 307411 : (use (match_dup 6))
24311 : 56062 : (use (match_dup 3))
24312 : 254988 : (clobber (match_dup 0))
24313 : 53883 : (clobber (match_dup 1))
24314 : 254988 : (clobber (match_dup 2))])])
24315 : 37485 :
24316 : 288853 : ;; ...and this one handles cmpstrn*_1.
24317 : 1384 : (define_peephole2
24318 : 215382 : [(parallel[
24319 : 34685 : (set (reg:CC FLAGS_REG)
24320 : 260615 : (if_then_else:CC (ne (match_operand 6 "register_operand")
24321 : 38136 : (const_int 0))
24322 : 280426 : (compare:CC (mem:BLK (match_operand 4 "register_operand"))
24323 : 9255 : (mem:BLK (match_operand 5 "register_operand")))
24324 : 260607 : (reg:CC FLAGS_REG)))
24325 : 7042 : (use (match_operand:SI 3 "immediate_operand"))
24326 : 76371 : (clobber (match_operand 0 "register_operand"))
24327 : 9247 : (clobber (match_operand 1 "register_operand"))
24328 : 254899 : (clobber (match_operand 2 "register_operand"))])
24329 : 7074 : (set (match_operand:QI 7 "register_operand")
24330 : 76282 : (gtu:QI (reg:CC FLAGS_REG) (const_int 0)))
24331 : 9102 : (set (match_operand:QI 8 "register_operand")
24332 : 189855 : (ltu:QI (reg:CC FLAGS_REG) (const_int 0)))
24333 : 1317 : (set (reg FLAGS_REG)
24334 : 189855 : (compare (match_dup 7) (match_dup 8)))
24335 : 8973 : ]
24336 : 254899 : "peep2_reg_dead_p (4, operands[7]) && peep2_reg_dead_p (4, operands[8])"
24337 : 12506 : [(parallel[
24338 : 254899 : (set (reg:CC FLAGS_REG)
24339 : 3251 : (if_then_else:CC (ne (match_dup 6)
24340 : 260518 : (const_int 0))
24341 : 1055674 : (compare:CC (mem:BLK (match_dup 4))
24342 : 260518 : (mem:BLK (match_dup 5)))
24343 : 1051659 : (reg:CC FLAGS_REG)))
24344 : 189855 : (use (match_dup 3))
24345 : 1044738 : (clobber (match_dup 0))
24346 : 1292841 : (clobber (match_dup 1))
24347 : 8358 : (clobber (match_dup 2))])])
24348 : 1087613 :
24349 : 1018117 : ;; Conditional move instructions.
24350 : 260518 :
24351 : 8563 : (define_expand "mov<mode>cc"
24352 : 76491 : [(set (match_operand:SWIM 0 "register_operand")
24353 : 1376 : (if_then_else:SWIM (match_operand 1 "comparison_operator")
24354 : 189988 : (match_operand:SWIM 2 "<general_operand>")
24355 : 192472 : (match_operand:SWIM 3 "<general_operand>")))]
24356 : 260518 : ""
24357 : 393842 : "if (ix86_expand_int_movcc (operands)) DONE; else FAIL;")
24358 : 1124 :
24359 : 186986 : ;; Data flow gets confused by our desire for `sbbl reg,reg', and clearing
24360 : 253908 : ;; the register first winds up with `sbbl $0,reg', which is also weird.
24361 : 961 : ;; So just document what we're doing explicitly.
24362 : 185493 :
24363 : 186986 : (define_expand "x86_mov<mode>cc_0_m1"
24364 : 253908 : [(parallel
24365 : 1156 : [(set (match_operand:SWI48 0 "register_operand")
24366 : 185360 : (if_then_else:SWI48
24367 : 190226 : (match_operator:SWI48 2 "ix86_carry_flag_operator"
24368 : 253908 : [(match_operand 1 "flags_reg_operand")
24369 : 1020 : (const_int 0)])
24370 : 1257 : (const_int -1)
24371 : 190226 : (const_int 0)))
24372 : 257148 : (clobber (reg:CC FLAGS_REG))])])
24373 : 732 :
24374 : 2703 : (define_insn "*x86_mov<mode>cc_0_m1"
24375 : 188647 : [(set (match_operand:SWI48 0 "register_operand" "=r")
24376 : 255569 : (if_then_else:SWI48 (match_operator 1 "ix86_carry_flag_operator"
24377 : 599 : [(reg FLAGS_REG) (const_int 0)])
24378 : 2895 : (const_int -1)
24379 : 186963 : (const_int 0)))
24380 : 69649 : (clobber (reg:CC FLAGS_REG))]
24381 : 307945 : ""
24382 : 185361 : "sbb{<imodesuffix>}\t%0, %0"
24383 : 186854 : [(set_attr "type" "alu1")
24384 : 253776 : (set_attr "use_carry" "1")
24385 : 11883 : (set_attr "pent_pair" "pu")
24386 : 297137 : (set_attr "mode" "<MODE>")
24387 : 298674 : (set_attr "length_immediate" "0")])
24388 : 461056 :
24389 : 296387 : (define_insn "*x86_mov<mode>cc_0_m1_se"
24390 : 297137 : [(set (match_operand:SWI48 0 "register_operand" "=r")
24391 : 482910 : (sign_extract:SWI48 (match_operator 1 "ix86_carry_flag_operator"
24392 : 549831 : [(reg FLAGS_REG) (const_int 0)])
24393 : 296360 : (const_int 1)
24394 : 95460 : (const_int 0)))
24395 : 98077 : (clobber (reg:CC FLAGS_REG))]
24396 : 164999 : ""
24397 : 95764 : "sbb{<imodesuffix>}\t%0, %0"
24398 : 280777 : [(set_attr "type" "alu1")
24399 : 284221 : (set_attr "use_carry" "1")
24400 : 164999 : (set_attr "pent_pair" "pu")
24401 : 226 : (set_attr "mode" "<MODE>")
24402 : 1081 : (set_attr "length_immediate" "0")])
24403 : 4525 :
24404 : 69539 : (define_insn "*x86_mov<mode>cc_0_m1_neg"
24405 : 226 : [(set (match_operand:SWI 0 "register_operand" "=<r>")
24406 : 185317 : (neg:SWI (match_operator 1 "ix86_carry_flag_operator"
24407 : 186853 : [(reg FLAGS_REG) (const_int 0)])))
24408 : 69539 : (clobber (reg:CC FLAGS_REG))]
24409 : 103 : ""
24410 : 185304 : "sbb{<imodesuffix>}\t%0, %0"
24411 : 2615 : [(set_attr "type" "alu1")
24412 : 253762 : (set_attr "use_carry" "1")
24413 : 104 : (set_attr "pent_pair" "pu")
24414 : 185264 : (set_attr "mode" "<MODE>")
24415 : 186838 : (set_attr "length_immediate" "0")])
24416 : 253762 :
24417 : 346 : (define_expand "x86_mov<mode>cc_0_m1_neg"
24418 : 185264 : [(parallel
24419 : 366 : [(set (match_operand:SWI48 0 "register_operand")
24420 : 69539 : (neg:SWI48 (ltu:SWI48 (reg:CCC FLAGS_REG) (const_int 0))))
24421 : 104 : (clobber (reg:CC FLAGS_REG))])])
24422 : 185264 :
24423 : 186796 : (define_split
24424 : 69539 : [(set (match_operand:SWI48 0 "register_operand")
24425 : 84 : (neg:SWI48
24426 : 185264 : (leu:SWI48
24427 : 2570 : (match_operand 1 "int_nonimmediate_operand")
24428 : 69539 : (match_operand 2 "const_int_operand"))))]
24429 : 106 : "x86_64_immediate_operand (operands[2], VOIDmode)
24430 : 185272 : && INTVAL (operands[2]) != -1
24431 : 186797 : && INTVAL (operands[2]) != 2147483647"
24432 : 253998 : [(set (reg:CC FLAGS_REG) (compare:CC (match_dup 1) (match_dup 2)))
24433 : 102 : (set (match_dup 0)
24434 : 185500 : (neg:SWI48 (ltu:SWI48 (reg:CC FLAGS_REG) (const_int 0))))]
24435 : 186805 : "operands[2] = GEN_INT (INTVAL (operands[2]) + 1);")
24436 : 253766 :
24437 : 102 : (define_split
24438 : 1053 : [(set (match_operand:SWI 0 "register_operand")
24439 : 2590 : (neg:SWI
24440 : 69547 : (eq:SWI
24441 : 104 : (match_operand 1 "int_nonimmediate_operand")
24442 : 185265 : (const_int 0))))]
24443 : 2497 : ""
24444 : 253770 : [(set (reg:CC FLAGS_REG) (compare:CC (match_dup 1) (const_int 1)))
24445 : 88 : (set (match_dup 0)
24446 : 185247 : (neg:SWI (ltu:SWI (reg:CC FLAGS_REG) (const_int 0))))])
24447 : 186687 :
24448 : 253766 : (define_split
24449 : 96 : [(set (match_operand:SWI 0 "register_operand")
24450 : 868 : (neg:SWI
24451 : 2491 : (ne:SWI
24452 : 253766 : (match_operand 1 "int_nonimmediate_operand")
24453 : 81 : (const_int 0))))]
24454 : 185056 : ""
24455 : 2416 : [(set (reg:CCC FLAGS_REG)
24456 : 69551 : (unspec:CCC [(match_dup 1) (const_int 0)] UNSPEC_CC_NE))
24457 : 175 : (set (match_dup 0)
24458 : 829 : (neg:SWI (ltu:SWI (reg:CCC FLAGS_REG) (const_int 0))))])
24459 : 2408 :
24460 : 253762 : (define_insn "*mov<mode>cc_noc"
24461 : 88 : [(set (match_operand:SWI248 0 "register_operand" "=r,r,r,r")
24462 : 184398 : (if_then_else:SWI248 (match_operator 1 "ix86_comparison_operator"
24463 : 186697 : [(reg FLAGS_REG) (const_int 0)])
24464 : 253762 : (match_operand:SWI248 2 "nonimmediate_operand" "rm,0,rm,r")
24465 : 189 : (match_operand:SWI248 3 "nonimmediate_operand" "0,rm,r,rm")))]
24466 : 658801 : "TARGET_CMOVE && !(MEM_P (operands[2]) && MEM_P (operands[3]))"
24467 : 185468 : "@
24468 : 254372 : cmov%O2%C1\t{%2, %0|%0, %2}
24469 : 92 : cmov%O2%c1\t{%3, %0|%0, %3}
24470 : 1035986 : cmov%O2%C1\t{%2, %3, %0|%0, %3, %2}
24471 : 1221691 : cmov%O2%c1\t{%3, %2, %0|%0, %2, %3}"
24472 : 1513121 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
24473 : 185 : (set_attr "type" "icmov")
24474 : 272 : (set_attr "mode" "<MODE>")])
24475 : 185972 :
24476 : 254271 : (define_insn "*movsicc_noc_zext"
24477 : 336 : [(set (match_operand:DI 0 "register_operand" "=r,r,r,r")
24478 : 184907 : (if_then_else:DI (match_operator 1 "ix86_comparison_operator"
24479 : 187102 : [(reg FLAGS_REG) (const_int 0)])
24480 : 254368 : (zero_extend:DI
24481 : 88 : (match_operand:SI 2 "nonimmediate_operand" "rm,0,rm,r"))
24482 : 184907 : (zero_extend:DI
24483 : 187110 : (match_operand:SI 3 "nonimmediate_operand" "0,rm,r,rm"))))]
24484 : 254279 : "TARGET_64BIT
24485 : 88 : && TARGET_CMOVE && !(MEM_P (operands[2]) && MEM_P (operands[3]))"
24486 : 185012 : "@
24487 : 187207 : cmov%O2%C1\t{%2, %k0|%k0, %2}
24488 : 254376 : cmov%O2%c1\t{%3, %k0|%k0, %3}
24489 : 184816 : cmov%O2%C1\t{%2, %3, %k0|%k0, %3, %2}
24490 : 184915 : cmov%O2%c1\t{%3, %2, %k0|%k0, %2, %3}"
24491 : 187110 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
24492 : 254279 : (set_attr "type" "icmov")
24493 : 76 : (set_attr "mode" "SI")])
24494 : 240 :
24495 : 187110 : (define_insn "*movsicc_noc_zext_1"
24496 : 184805 : [(set (match_operand:DI 0 "nonimmediate_operand" "=r,r,r,r")
24497 : 184881 : (zero_extend:DI
24498 : 184980 : (if_then_else:SI (match_operator 1 "ix86_comparison_operator"
24499 : 1649337 : [(reg FLAGS_REG) (const_int 0)])
24500 : 254279 : (match_operand:SI 2 "nonimmediate_operand" "rm,0,rm,r")
24501 : 184997 : (match_operand:SI 3 "nonimmediate_operand" "0,rm,r,rm"))))]
24502 : 185263 : "TARGET_64BIT
24503 : 187565 : && TARGET_CMOVE && !(MEM_P (operands[2]) && MEM_P (operands[3]))"
24504 : 1531766 : "@
24505 : 1462295 : cmov%O2%C1\t{%2, %k0|%k0, %2}
24506 : 1647258 : cmov%O2%c1\t{%3, %k0|%k0, %3}
24507 : 248288 : cmov%O2%C1\t{%2, %3, %k0|%k0, %3, %2}
24508 : 1671305 : cmov%O2%c1\t{%3, %2, %k0|%k0, %2, %3}"
24509 : 61355 : [(set_attr "isa" "*,*,apx_ndd,apx_ndd")
24510 : 246386 : (set_attr "type" "icmov")
24511 : 1542407 : (set_attr "mode" "SI")])
24512 : 1540295 :
24513 : 50461 :
24514 : 854536 : ;; Don't do conditional moves with memory inputs. This splitter helps
24515 : 905706 : ;; register starved x86_32 by forcing inputs into registers before reload.
24516 : 789513 : (define_split
24517 : 904763 : [(set (match_operand:SWI248 0 "register_operand")
24518 : 235317 : (if_then_else:SWI248 (match_operator 1 "ix86_comparison_operator"
24519 : 669965 : [(reg FLAGS_REG) (const_int 0)])
24520 : 739160 : (match_operand:SWI248 2 "nonimmediate_operand")
24521 : 43582 : (match_operand:SWI248 3 "nonimmediate_operand")))]
24522 : 61929 : "!TARGET_64BIT && TARGET_CMOVE
24523 : 394763 : && TARGET_AVOID_MEM_OPND_FOR_CMOVE
24524 : 409286 : && (MEM_P (operands[2]) || MEM_P (operands[3]))
24525 : 186464 : && can_create_pseudo_p ()
24526 : 184907 : && optimize_insn_for_speed_p ()"
24527 : 448115 : [(set (match_dup 0)
24528 : 262321 : (if_then_else:SWI248 (match_dup 1) (match_dup 2) (match_dup 3)))]
24529 : 191005 : {
24530 : 8734 : operands[2] = force_reg (<MODE>mode, operands[2]);
24531 : 375827 : operands[3] = force_reg (<MODE>mode, operands[3]);
24532 : 308020 : })
24533 : 17760 :
24534 : 2416 : (define_insn "*movqicc_noc"
24535 : 71780 : [(set (match_operand:QI 0 "register_operand" "=r,r,r")
24536 : 71780 : (if_then_else:QI (match_operator 1 "ix86_comparison_operator"
24537 : 1732 : [(reg FLAGS_REG) (const_int 0)])
24538 : 175 : (match_operand:QI 2 "register_operand" "r,0,r")
24539 : 509 : (match_operand:QI 3 "register_operand" "0,r,r")))]
24540 : 250476 : "TARGET_CMOVE && !TARGET_PARTIAL_REG_STALL"
24541 : 509 : "#"
24542 : 22878 : [(set_attr "isa" "*,*,apx_ndd")
24543 : 30170 : (set_attr "type" "icmov")
24544 : 57253 : (set_attr "mode" "QI")])
24545 : 57249 :
24546 : 57415 : (define_split
24547 : 134800 : [(set (match_operand:SWI12 0 "register_operand")
24548 : 58842 : (if_then_else:SWI12 (match_operator 1 "ix86_comparison_operator"
24549 : 35423 : [(reg FLAGS_REG) (const_int 0)])
24550 : 43137 : (match_operand:SWI12 2 "register_operand")
24551 : 93579 : (match_operand:SWI12 3 "register_operand")))]
24552 : 158343 : "TARGET_CMOVE && !TARGET_PARTIAL_REG_STALL
24553 : 158339 : && reload_completed"
24554 : 29004 : [(set (match_dup 0)
24555 : 159149 : (if_then_else:SI (match_dup 1) (match_dup 2) (match_dup 3)))]
24556 : 156934 : {
24557 : 351950 : operands[0] = gen_lowpart (SImode, operands[0]);
24558 : 351385 : operands[2] = gen_lowpart (SImode, operands[2]);
24559 : 421691 : operands[3] = gen_lowpart (SImode, operands[3]);
24560 : 90182 : })
24561 : 67317 :
24562 : 68230 : ;; Don't do conditional moves with memory inputs
24563 : 88779 : (define_peephole2
24564 : 22126 : [(match_scratch:SWI248 4 "r")
24565 : 67316 : (set (match_operand:SWI248 0 "register_operand")
24566 : 69024 : (if_then_else:SWI248 (match_operator 1 "ix86_comparison_operator"
24567 : 159355 : [(reg FLAGS_REG) (const_int 0)])
24568 : 89824 : (match_operand:SWI248 2 "nonimmediate_operand")
24569 : 89614 : (match_operand:SWI248 3 "nonimmediate_operand")))]
24570 : 253901 : "TARGET_CMOVE && TARGET_AVOID_MEM_OPND_FOR_CMOVE
24571 : 89632 : && (MEM_P (operands[2]) || MEM_P (operands[3]))
24572 : 20975 : && optimize_insn_for_speed_p ()"
24573 : 106690 : [(set (match_dup 4) (match_dup 5))
24574 : 21146 : (set (match_dup 0)
24575 : 93390 : (if_then_else:SWI248 (match_dup 1) (match_dup 2) (match_dup 3)))]
24576 : 89614 : {
24577 : 232066 : if (MEM_P (operands[2]))
24578 : 232241 : {
24579 : 184600 : operands[5] = operands[2];
24580 : 21177 : operands[2] = operands[4];
24581 : 206 : }
24582 : 175 : else if (MEM_P (operands[3]))
24583 : 23855 : {
24584 : 22504 : operands[5] = operands[3];
24585 : 0 : operands[3] = operands[4];
24586 : 22679 : }
24587 : 22620 : else
24588 : 0 : gcc_unreachable ();
24589 : 1649 : })
24590 : 22795 :
24591 : 92040 : (define_peephole2
24592 : 21088 : [(match_scratch:SI 4 "r")
24593 : 22505 : (set (match_operand:DI 0 "register_operand")
24594 : 21263 : (if_then_else:DI (match_operator 1 "ix86_comparison_operator"
24595 : 20972 : [(reg FLAGS_REG) (const_int 0)])
24596 : 21088 : (zero_extend:DI
24597 : 20462 : (match_operand:SI 2 "nonimmediate_operand"))
24598 : 685 : (zero_extend:DI
24599 : 70161 : (match_operand:SI 3 "nonimmediate_operand"))))]
24600 : 510 : "TARGET_64BIT
24601 : 510 : && TARGET_CMOVE && TARGET_AVOID_MEM_OPND_FOR_CMOVE
24602 : 685 : && (MEM_P (operands[2]) || MEM_P (operands[3]))
24603 : 510 : && optimize_insn_for_speed_p ()"
24604 : 510 : [(set (match_dup 4) (match_dup 5))
24605 : 510 : (set (match_dup 0)
24606 : 97902 : (if_then_else:DI (match_dup 1)
24607 : 97611 : (zero_extend:DI (match_dup 2))
24608 : 0 : (zero_extend:DI (match_dup 3))))]
24609 : 0 : {
24610 : 97786 : if (MEM_P (operands[2]))
24611 : 167146 : {
24612 : 97727 : operands[5] = operands[2];
24613 : 167262 : operands[2] = operands[4];
24614 : 97902 : }
24615 : 0 : else if (MEM_P (operands[3]))
24616 : 1 : {
24617 : 1 : operands[5] = operands[3];
24618 : 291603 : operands[3] = operands[4];
24619 : 167145 : }
24620 : 97615 : else
24621 : 69536 : gcc_unreachable ();
24622 : 291608 : })
24623 : 360968 :
24624 : 291433 : ;; Eliminate a reg-reg mov by inverting the condition of a cmov (#1).
24625 : 364989 : ;; mov r0,r1; dec r0; mov r2,r3; cmov r0,r2 -> dec r1; mov r0,r3; cmov r0, r1
24626 : 97785 : (define_peephole2
24627 : 355857 : [(set (match_operand:SWI248 0 "general_reg_operand")
24628 : 282301 : (match_operand:SWI248 1 "general_reg_operand"))
24629 : 171166 : (parallel [(set (reg FLAGS_REG) (match_operand 5))
24630 : 267399 : (set (match_dup 0) (match_operand:SWI248 6))])
24631 : 267229 : (set (match_operand:SWI248 2 "general_reg_operand")
24632 : 97615 : (match_operand:SWI248 3 "general_gr_operand"))
24633 : 244838 : (set (match_dup 0)
24634 : 73847 : (if_then_else:SWI248 (match_operator 4 "ix86_comparison_operator"
24635 : 175303 : [(reg FLAGS_REG) (const_int 0)])
24636 : 0 : (match_dup 0)
24637 : 123698 : (match_dup 2)))]
24638 : 407 : "TARGET_CMOVE
24639 : 149850 : && REGNO (operands[2]) != REGNO (operands[0])
24640 : 149845 : && REGNO (operands[2]) != REGNO (operands[1])
24641 : 129289 : && peep2_reg_dead_p (1, operands[1])
24642 : 239 : && peep2_reg_dead_p (4, operands[2])
24643 : 69599 : && !reg_overlap_mentioned_p (operands[0], operands[3])"
24644 : 105068 : [(parallel [(set (match_dup 7) (match_dup 8))
24645 : 167160 : (set (match_dup 1) (match_dup 9))])
24646 : 97800 : (set (match_dup 0) (match_dup 3))
24647 : 167150 : (set (match_dup 0) (if_then_else:SWI248 (match_dup 4)
24648 : 97610 : (match_dup 1)
24649 : 69535 : (match_dup 0)))]
24650 : 28642941 : {
24651 : 167223 : operands[7] = SET_DEST (XVECEXP (PATTERN (peep2_next_insn (1)), 0, 0));
24652 : 967315 : operands[8]
24653 : 967315 : = ix86_replace_reg_with_reg (operands[5], operands[0], operands[1]);
24654 : 967490 : operands[9]
24655 : 219939 : = ix86_replace_reg_with_reg (operands[6], operands[0], operands[1]);
24656 : 845446 : })
24657 : 28615059 :
24658 : 29350152 : ;; Eliminate a reg-reg mov by inverting the condition of a cmov (#2).
24659 : 29419241 : ;; mov r2,r3; mov r0,r1; dec r0; cmov r0,r2 -> dec r1; mov r0,r3; cmov r0, r1
24660 : 27384460 : (define_peephole2
24661 : 1870948 : [(set (match_operand:SWI248 2 "general_reg_operand")
24662 : 1968572 : (match_operand:SWI248 3 "general_gr_operand"))
24663 : 167669 : (set (match_operand:SWI248 0 "general_reg_operand")
24664 : 321784 : (match_operand:SWI248 1 "general_reg_operand"))
24665 : 293631 : (parallel [(set (reg FLAGS_REG) (match_operand 5))
24666 : 97688 : (set (match_dup 0) (match_operand:SWI248 6))])
24667 : 108030 : (set (match_dup 0)
24668 : 136119 : (if_then_else:SWI248 (match_operator 4 "ix86_comparison_operator"
24669 : 136119 : [(reg FLAGS_REG) (const_int 0)])
24670 : 97688 : (match_dup 0)
24671 : 197545 : (match_dup 2)))]
24672 : 98665 : "TARGET_CMOVE
24673 : 167818 : && REGNO (operands[2]) != REGNO (operands[0])
24674 : 98283 : && REGNO (operands[2]) != REGNO (operands[1])
24675 : 167229 : && peep2_reg_dead_p (2, operands[1])
24676 : 128014 : && peep2_reg_dead_p (4, operands[2])
24677 : 97692 : && !reg_overlap_mentioned_p (operands[0], operands[3])
24678 : 98249 : && !reg_mentioned_p (operands[2], operands[6])"
24679 : 1327472 : [(parallel [(set (match_dup 7) (match_dup 8))
24680 : 98072 : (set (match_dup 1) (match_dup 9))])
24681 : 167161 : (set (match_dup 0) (match_dup 3))
24682 : 127390 : (set (match_dup 0) (if_then_else:SWI248 (match_dup 4)
24683 : 97624 : (match_dup 1)
24684 : 29593 : (match_dup 0)))]
24685 : 10003058 : {
24686 : 127394 : operands[7] = SET_DEST (XVECEXP (PATTERN (peep2_next_insn (2)), 0, 0));
24687 : 226409 : operands[8]
24688 : 4 : = ix86_replace_reg_with_reg (operands[5], operands[0], operands[1]);
24689 : 10098489 : operands[9]
24690 : 10098517 : = ix86_replace_reg_with_reg (operands[6], operands[0], operands[1]);
24691 : 361778 : })
24692 : 262594 :
24693 : 9930082 : (define_insn "movhf_mask"
24694 : 9930234 : [(set (match_operand:HF 0 "nonimmediate_operand" "=v,m,v")
24695 : 9973525 : (unspec:HF
24696 : 182311 : [(match_operand:HF 1 "nonimmediate_operand" "m,v,v")
24697 : 9994476 : (match_operand:HF 2 "nonimm_or_0_operand" "0C,0C,0C")
24698 : 109255 : (match_operand:QI 3 "register_operand" "Yk,Yk,Yk")]
24699 : 9246147 : UNSPEC_MOVCC_MASK))]
24700 : 132844 : "TARGET_AVX512FP16"
24701 : 97688 : "@
24702 : 6628274 : vmovsh\t{%1, %0%{%3%}%N2|%0%{%3%}%N2, %1}
24703 : 184673 : vmovsh\t{%1, %0%{%3%}%N2|%0%{%3%}%N2, %1}
24704 : 3685685 : vmovsh\t{%d1, %0%{%3%}%N2|%0%{%3%}%N2, %d1}"
24705 : 3744224 : [(set_attr "type" "ssemov")
24706 : 115138 : (set_attr "prefix" "evex")
24707 : 94338 : (set_attr "mode" "HF")])
24708 : 6635500 :
24709 : 5669274 : (define_expand "movhfcc"
24710 : 6611524 : [(set (match_operand:HF 0 "register_operand")
24711 : 94330 : (if_then_else:HF
24712 : 122419 : (match_operand 1 "comparison_operator")
24713 : 97688 : (match_operand:HF 2 "register_operand")
24714 : 98101 : (match_operand:HF 3 "register_operand")))]
24715 : 167696 : "TARGET_AVX512FP16"
24716 : 98931 : "if (ix86_expand_fp_movcc (operands)) DONE; else FAIL;")
24717 : 97650 :
24718 : 174 : (define_expand "mov<mode>cc"
24719 : 167159 : [(set (match_operand:X87MODEF 0 "register_operand")
24720 : 4 : (if_then_else:X87MODEF
24721 : 167230 : (match_operand 1 "comparison_operator")
24722 : 166 : (match_operand:X87MODEF 2 "register_operand")
24723 : 167216 : (match_operand:X87MODEF 3 "register_operand")))]
24724 : 0 : "(TARGET_80387 && TARGET_CMOVE)
24725 : 167216 : || (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH)"
24726 : 159001 : "if (ix86_expand_fp_movcc (operands)) DONE; else FAIL;")
24727 : 167220 :
24728 : 97614 : (define_insn "*movxfcc_1"
24729 : 167220 : [(set (match_operand:XF 0 "register_operand" "=f,f")
24730 : 97758 : (if_then_else:XF (match_operator 1 "fcmov_comparison_operator"
24731 : 97681 : [(reg FLAGS_REG) (const_int 0)])
24732 : 97610 : (match_operand:XF 2 "register_operand" "f,0")
24733 : 167145 : (match_operand:XF 3 "register_operand" "0,f")))]
24734 : 130223 : "TARGET_80387 && TARGET_CMOVE"
24735 : 5124 : "@
24736 : 0 : fcmov%F1\t{%2, %0|%0, %2}
24737 : 167149 : fcmov%f1\t{%3, %0|%0, %3}"
24738 : 99477 : [(set_attr "type" "fcmov")
24739 : 100784 : (set_attr "mode" "XF")])
24740 : 3131 :
24741 : 100784 : (define_insn "*movdfcc_1"
24742 : 99069 : [(set (match_operand:DF 0 "register_operand" "=f,f,&r,&r,r ,r")
24743 : 168463 : (if_then_else:DF (match_operator 1 "fcmov_comparison_operator"
24744 : 98921 : [(reg FLAGS_REG) (const_int 0)])
24745 : 90301 : (match_operand:DF 2 "nonimmediate_operand"
24746 : 20903 : "f ,0,rm,0 ,rm,0")
24747 : 186604 : (match_operand:DF 3 "nonimmediate_operand"
24748 : 97614 : "0 ,f,0 ,rm,0, rm")))]
24749 : 99376 : "TARGET_80387 && TARGET_CMOVE
24750 : 141323 : && !(MEM_P (operands[2]) && MEM_P (operands[3]))"
24751 : 186715 : "@
24752 : 117067 : fcmov%F1\t{%2, %0|%0, %2}
24753 : 97619 : fcmov%f1\t{%3, %0|%0, %3}
24754 : 98418 : #
24755 : 140072 : #
24756 : 140067 : cmov%O2%C1\t{%2, %0|%0, %2}
24757 : 209600 : cmov%O2%c1\t{%3, %0|%0, %3}"
24758 : 139562 : [(set_attr "isa" "*,*,nox64,nox64,x64,x64")
24759 : 208949 : (set_attr "type" "fcmov,fcmov,multi,multi,icmov,icmov")
24760 : 139421 : (set_attr "mode" "DF,DF,DI,DI,DI,DI")])
24761 : 208949 :
24762 : 139562 : (define_split
24763 : 167154 : [(set (match_operand:DF 0 "general_reg_operand")
24764 : 97619 : (if_then_else:DF (match_operator 1 "fcmov_comparison_operator"
24765 : 69544 : [(reg FLAGS_REG) (const_int 0)])
24766 : 157 : (match_operand:DF 2 "nonimmediate_operand")
24767 : 167145 : (match_operand:DF 3 "nonimmediate_operand")))]
24768 : 98102 : "!TARGET_64BIT && reload_completed"
24769 : 167145 : [(set (match_dup 2)
24770 : 1102 : (if_then_else:SI (match_dup 1) (match_dup 4) (match_dup 5)))
24771 : 168090 : (set (match_dup 3)
24772 : 98555 : (if_then_else:SI (match_dup 1) (match_dup 6) (match_dup 7)))]
24773 : 97610 : {
24774 : 97758 : split_double_mode (DImode, &operands[2], 2, &operands[4], &operands[6]);
24775 : 167145 : split_double_mode (DImode, &operands[0], 1, &operands[2], &operands[3]);
24776 : 97610 : })
24777 : 97610 :
24778 : 97758 : (define_insn "*movsfcc_1_387"
24779 : 167145 : [(set (match_operand:SF 0 "register_operand" "=f,f,r,r")
24780 : 97610 : (if_then_else:SF (match_operator 1 "fcmov_comparison_operator"
24781 : 69535 : [(reg FLAGS_REG) (const_int 0)])
24782 : 148 : (match_operand:SF 2 "nonimmediate_operand" "f,0,rm,0")
24783 : 167145 : (match_operand:SF 3 "nonimmediate_operand" "0,f,0,rm")))]
24784 : 98238 : "TARGET_80387 && TARGET_CMOVE
24785 : 70163 : && !(MEM_P (operands[2]) && MEM_P (operands[3]))"
24786 : 45 : "@
24787 : 167145 : fcmov%F1\t{%2, %0|%0, %2}
24788 : 97610 : fcmov%f1\t{%3, %0|%0, %3}
24789 : 167145 : cmov%O2%C1\t{%2, %0|%0, %2}
24790 : 97758 : cmov%O2%c1\t{%3, %0|%0, %3}"
24791 : 97610 : [(set_attr "type" "fcmov,fcmov,icmov,icmov")
24792 : 0 : (set_attr "mode" "SF,SF,SI,SI")])
24793 : 167145 :
24794 : 97758 : ;; Don't do conditional moves with memory inputs. This splitter helps
24795 : 167145 : ;; register starved x86_32 by forcing inputs into registers before reload.
24796 : 0 : (define_split
24797 : 70247 : [(set (match_operand:MODEF 0 "register_operand")
24798 : 98322 : (if_then_else:MODEF (match_operator 1 "ix86_comparison_operator"
24799 : 167857 : [(reg FLAGS_REG) (const_int 0)])
24800 : 98322 : (match_operand:MODEF 2 "nonimmediate_operand")
24801 : 70247 : (match_operand:MODEF 3 "nonimmediate_operand")))]
24802 : 98849 : "!TARGET_64BIT && TARGET_80387 && TARGET_CMOVE
24803 : 97954 : && TARGET_AVOID_MEM_OPND_FOR_CMOVE
24804 : 97626 : && (MEM_P (operands[2]) || MEM_P (operands[3]))
24805 : 69551 : && can_create_pseudo_p ()
24806 : 148 : && optimize_insn_for_speed_p ()"
24807 : 99112 : [(set (match_dup 0)
24808 : 97610 : (if_then_else:MODEF (match_dup 1) (match_dup 2) (match_dup 3)))]
24809 : 167145 : {
24810 : 705 : operands[2] = force_reg (<MODE>mode, operands[2]);
24811 : 167702 : operands[3] = force_reg (<MODE>mode, operands[3]);
24812 : 98167 : })
24813 : 167145 :
24814 : 97758 : ;; Don't do conditional moves with memory inputs
24815 : 167145 : (define_peephole2
24816 : 16984532 : [(match_scratch:MODEF 4 "r")
24817 : 97612 : (set (match_operand:MODEF 0 "general_reg_operand")
24818 : 17082292 : (if_then_else:MODEF (match_operator 1 "fcmov_comparison_operator"
24819 : 17151677 : [(reg FLAGS_REG) (const_int 0)])
24820 : 16984532 : (match_operand:MODEF 2 "nonimmediate_operand")
24821 : 17054067 : (match_operand:MODEF 3 "nonimmediate_operand")))]
24822 : 17082350 : "(<MODE>mode != DFmode || TARGET_64BIT)
24823 : 167455 : && TARGET_80387 && TARGET_CMOVE
24824 : 17082452 : && TARGET_AVOID_MEM_OPND_FOR_CMOVE
24825 : 69535 : && (MEM_P (operands[2]) || MEM_P (operands[3]))
24826 : 97758 : && optimize_insn_for_speed_p ()"
24827 : 167578 : [(set (match_dup 4) (match_dup 5))
24828 : 17081822 : (set (match_dup 0)
24829 : 167152 : (if_then_else:MODEF (match_dup 1) (match_dup 2) (match_dup 3)))]
24830 : 17081970 : {
24831 : 17151640 : if (MEM_P (operands[2]))
24832 : 97886 : {
24833 : 69750 : operands[5] = operands[2];
24834 : 632 : operands[2] = operands[4];
24835 : 17151381 : }
24836 : 97627 : else if (MEM_P (operands[3]))
24837 : 167169 : {
24838 : 97774 : operands[5] = operands[3];
24839 : 167169 : operands[3] = operands[4];
24840 : 17081839 : }
24841 : 17151381 : else
24842 : 17081986 : gcc_unreachable ();
24843 : 167169 : })
24844 : 16984212 :
24845 : 17053754 : ;; All moves in XOP pcmov instructions are 128 bits and hence we restrict
24846 : 17088369 : ;; the scalar versions to have only XMM registers as operands.
24847 : 104010 :
24848 : 17013196 : ;; XOP conditional move
24849 : 7 : (define_insn "*xop_pcmov_<mode>"
24850 : 12173193 : [(set (match_operand:MODEF 0 "register_operand" "=x")
24851 : 12179422 : (if_then_else:MODEF
24852 : 17019530 : (match_operand:MODEF 1 "register_operand" "x")
24853 : 63152 : (match_operand:MODEF 2 "register_operand" "x")
24854 : 101764 : (match_operand:MODEF 3 "register_operand" "x")))]
24855 : 108004 : "TARGET_XOP"
24856 : 97627 : "vpcmov\t{%1, %3, %2, %0|%0, %2, %3, %1}"
24857 : 160781 : [(set_attr "type" "sse4arg")
24858 : 97776 : (set_attr "mode" "TI")])
24859 : 104026 :
24860 : 97643 : ;; These versions of the min/max patterns are intentionally ignorant of
24861 : 160797 : ;; their behavior wrt -0.0 and NaN (via the commutative operand mark).
24862 : 97774 : ;; Since both the tree-level MAX_EXPR and the rtl-level SMAX operator
24863 : 6064 : ;; are undefined in this condition, we're certain this is correct.
24864 : 0 :
24865 : 63154 : (define_insn "<code><mode>3"
24866 : 97774 : [(set (match_operand:MODEF 0 "register_operand" "=x,v")
24867 : 103564 : (smaxmin:MODEF
24868 : 0 : (match_operand:MODEF 1 "nonimmediate_operand" "%0,v")
24869 : 63154 : (match_operand:MODEF 2 "nonimmediate_operand" "xm,vm")))]
24870 : 99856 : "SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH"
24871 : 103564 : "@
24872 : 97627 : <maxmin_float><ssemodesuffix>\t{%2, %0|%0, %2}
24873 : 160784 : v<maxmin_float><ssemodesuffix>\t{%2, %1, %0|%0, %1, %2}"
24874 : 98538 : [(set_attr "isa" "noavx,avx")
24875 : 6664 : (set_attr "prefix" "orig,vex")
24876 : 97630 : (set_attr "type" "sseadd")
24877 : 160791 : (set_attr "mode" "<MODE>")])
24878 : 97784 :
24879 : 5940 : (define_insn "<code>hf3"
24880 : 0 : [(set (match_operand:HF 0 "register_operand" "=v")
24881 : 160791 : (smaxmin:HF
24882 : 97784 : (match_operand:HF 1 "nonimmediate_operand" "%v")
24883 : 103574 : (match_operand:HF 2 "nonimmediate_operand" "vm")))]
24884 : 43 : "TARGET_AVX512FP16"
24885 : 160791 : "v<maxmin_float>sh\t{%2, %1, %0|%0, %1, %2}"
24886 : 97637 : [(set_attr "prefix" "evex")
24887 : 103574 : (set_attr "type" "sseadd")
24888 : 97758 : (set_attr "mode" "HF")])
24889 : 63204 :
24890 : 154 : ;; These versions of the min/max patterns implement exactly the operations
24891 : 103564 : ;; min = (op1 < op2 ? op1 : op2)
24892 : 97627 : ;; max = (!(op1 < op2) ? op1 : op2)
24893 : 160781 : ;; Their operands are not commutative, and thus they may be used in the
24894 : 82 : ;; presence of -0.0 and NaN.
24895 : 103567 :
24896 : 97630 : (define_insn "*ieee_s<ieee_maxmin>hf3"
24897 : 160781 : [(set (match_operand:HF 0 "register_operand" "=v")
24898 : 97762 : (unspec:HF
24899 : 102913 : [(match_operand:HF 1 "register_operand" "v")
24900 : 97627 : (match_operand:HF 2 "nonimmediate_operand" "vm")]
24901 : 160781 : IEEE_MAXMIN))]
24902 : 97966 : "TARGET_AVX512FP16"
24903 : 100493 : "v<ieee_maxmin>sh\t{%2, %1, %0|%0, %1, %2}"
24904 : 97627 : [(set_attr "prefix" "evex")
24905 : 97627 : (set_attr "type" "sseadd")
24906 : 102637 : (set_attr "mode" "HF")])
24907 : 12764 :
24908 : 0 : (define_insn "*ieee_s<ieee_maxmin><mode>3"
24909 : 97627 : [(set (match_operand:MODEF 0 "register_operand" "=x,v")
24910 : 59 : (unspec:MODEF
24911 : 100493 : [(match_operand:MODEF 1 "register_operand" "0,v")
24912 : 97627 : (match_operand:MODEF 2 "nonimmediate_operand" "xm,vm")]
24913 : 97744 : IEEE_MAXMIN))]
24914 : 4998 : "SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH"
24915 : 100376 : "@
24916 : 97101 : <ieee_maxmin><ssemodesuffix>\t{%2, %0|%0, %2}
24917 : 792 : v<ieee_maxmin><ssemodesuffix>\t{%2, %1, %0|%0, %1, %2}"
24918 : 2405 : [(set_attr "isa" "noavx,avx")
24919 : 4334 : (set_attr "prefix" "orig,maybe_evex")
24920 : 8453 : (set_attr "type" "sseadd")
24921 : 63678 : (set_attr "mode" "<MODE>")])
24922 : 28 :
24923 : 3009 : ;; Operands order in min/max instruction matters for signed zero and NANs.
24924 : 0 : (define_insn_and_split "*ieee_max<mode>3_1"
24925 : 63183 : [(set (match_operand:MODEF 0 "register_operand")
24926 : 28 : (unspec:MODEF
24927 : 3009 : [(match_operand:MODEF 1 "register_operand")
24928 : 0 : (match_operand:MODEF 2 "register_operand")
24929 : 63183 : (lt:MODEF
24930 : 554 : (match_operand:MODEF 3 "register_operand")
24931 : 3010 : (match_operand:MODEF 4 "register_operand"))]
24932 : 526 : UNSPEC_BLENDV))]
24933 : 1205 : "SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH
24934 : 1759 : && (rtx_equal_p (operands[1], operands[3])
24935 : 3034 : && rtx_equal_p (operands[2], operands[4]))
24936 : 581 : && ix86_pre_reload_split ()"
24937 : 62010 : "#"
24938 : 1205 : "&& 1"
24939 : 42122 : [(set (match_dup 0)
24940 : 39637 : (unspec:MODEF
24941 : 101645 : [(match_dup 2)
24942 : 1203 : (match_dup 1)]
24943 : 2484 : UNSPEC_IEEE_MAX))])
24944 : 1 :
24945 : 101645 : (define_insn_and_split "*ieee_min<mode>3_1"
24946 : 1203 : [(set (match_operand:MODEF 0 "register_operand")
24947 : 42118 : (unspec:MODEF
24948 : 0 : [(match_operand:MODEF 1 "register_operand")
24949 : 62009 : (match_operand:MODEF 2 "register_operand")
24950 : 1184 : (lt:MODEF
24951 : 42118 : (match_operand:MODEF 3 "register_operand")
24952 : 1 : (match_operand:MODEF 4 "register_operand"))]
24953 : 62010 : UNSPEC_BLENDV))]
24954 : 40826 : "SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH
24955 : 42124 : && (rtx_equal_p (operands[1], operands[4])
24956 : 4 : && rtx_equal_p (operands[2], operands[3]))
24957 : 62013 : && ix86_pre_reload_split ()"
24958 : 1186 : "#"
24959 : 42118 : "&& 1"
24960 : 39635 : [(set (match_dup 0)
24961 : 101645 : (unspec:MODEF
24962 : 1184 : [(match_dup 2)
24963 : 42118 : (match_dup 1)]
24964 : 0 : UNSPEC_IEEE_MIN))])
24965 : 123776 :
24966 : 62951 : ;; Make two stack loads independent:
24967 : 64408 : ;; fld aa fld aa
24968 : 22290 : ;; fld %st(0) -> fld bb
24969 : 62011 : ;; fmul bb fmul %st(1), %st
24970 : 40825 : ;;
24971 : 42152 : ;; Actually we only match the last two instructions for simplicity.
24972 : 101117 :
24973 : 563 : (define_peephole2
24974 : 1156 : [(set (match_operand 0 "fp_register_operand")
24975 : 2483 : (match_operand 1 "fp_register_operand"))
24976 : 39635 : (set (match_dup 0)
24977 : 40196 : (match_operator 2 "binary_fp_operator"
24978 : 1156 : [(match_dup 0)
24979 : 2483 : (match_operand 3 "memory_operand")]))]
24980 : 39764 : "REGNO (operands[0]) != REGNO (operands[1])"
24981 : 40165 : [(set (match_dup 0) (match_dup 3))
24982 : 41105 : (set (match_dup 0)
24983 : 42253 : (match_op_dup 2
24984 : 6 : [(match_dup 5) (match_dup 4)]))]
24985 : 764 : {
24986 : 41500 : operands[4] = operands[0];
24987 : 42247 : operands[5] = operands[1];
24988 : 39635 :
24989 : 39795 : /* The % modifier is not operational anymore in peephole2's, so we have to
24990 : 40742 : swap the operands manually in the case of addition and multiplication. */
24991 : 42247 : if (COMMUTATIVE_ARITH_P (operands[2]))
24992 : 39739 : std::swap (operands[4], operands[5]);
24993 : 39795 : })
24994 : 40843 :
24995 : 42248 : (define_peephole2
24996 : 375 : [(set (match_operand 0 "fp_register_operand")
24997 : 39894 : (match_operand 1 "fp_register_operand"))
24998 : 40754 : (set (match_dup 0)
24999 : 42119 : (match_operator 2 "binary_fp_operator"
25000 : 39768 : [(match_operand 3 "memory_operand")
25001 : 39796 : (match_dup 0)]))]
25002 : 40751 : "REGNO (operands[0]) != REGNO (operands[1])"
25003 : 42248 : [(set (match_dup 0) (match_dup 3))
25004 : 39765 : (set (match_dup 0)
25005 : 39796 : (match_op_dup 2
25006 : 1112 : [(match_dup 4) (match_dup 5)]))]
25007 : 2612 : {
25008 : 39796 : operands[4] = operands[0];
25009 : 39667 : operands[5] = operands[1];
25010 : 40733 :
25011 : 42119 : /* The % modifier is not operational anymore in peephole2's, so we have to
25012 : 40030 : swap the operands manually in the case of addition and multiplication. */
25013 : 36085344 : if (COMMUTATIVE_ARITH_P (operands[2]))
25014 : 40733 : std::swap (operands[4], operands[5]);
25015 : 42248 : })
25016 : 39796 :
25017 : 36084981 : ;; Conditional addition patterns
25018 : 36085918 : (define_expand "add<mode>cc"
25019 : 36087433 : [(match_operand:SWI 0 "register_operand")
25020 : 36100242 : (match_operand 1 "ordered_comparison_operator")
25021 : 36084981 : (match_operand:SWI 2 "register_operand")
25022 : 40579 : (match_operand:SWI 3 "const_int_operand")]
25023 : 28661336 : ""
25024 : 28683117 : "if (ix86_expand_int_addcc (operands)) DONE; else FAIL;")
25025 : 55370 :
25026 : 41046 : ;; min/max patterns
25027 : 36062419 :
25028 : 36059525 : (define_code_attr maxmin_rel
25029 : 36074755 : [(smax "GE") (smin "LE") (umax "GEU") (umin "LEU")])
25030 : 36060462 :
25031 : 36061977 : (define_expand "<code><mode>3"
25032 : 36059525 : [(parallel
25033 : 39636 : [(set (match_operand:SDWIM 0 "register_operand")
25034 : 60031 : (maxmin:SDWIM
25035 : 61546 : (match_operand:SDWIM 1 "register_operand")
25036 : 69911 : (match_operand:SDWIM 2 "general_operand")))
25037 : 69911 : (clobber (reg:CC FLAGS_REG))])]
25038 : 36060091 : "TARGET_CMOVE
25039 : 42119 : && (<MODE>mode != QImode || !TARGET_PARTIAL_REG_STALL)")
25040 : 337937 :
25041 : 298301 : (define_insn_and_split "*<code><dwi>3_doubleword"
25042 : 308340 : [(set (match_operand:<DWI> 0 "register_operand")
25043 : 42482 : (maxmin:<DWI>
25044 : 69911 : (match_operand:<DWI> 1 "register_operand")
25045 : 69911 : (match_operand:<DWI> 2 "general_operand")))
25046 : 40298 : (clobber (reg:CC FLAGS_REG))]
25047 : 102636 : "TARGET_CMOVE
25048 : 262500 : && ix86_pre_reload_split ()"
25049 : 364 : "#"
25050 : 1534 : "&& 1"
25051 : 70154 : [(set (match_dup 0)
25052 : 110344 : (if_then_else:DWIH (match_dup 6)
25053 : 77568 : (match_dup 1)
25054 : 10282 : (match_dup 2)))
25055 : 31429 : (set (match_dup 3)
25056 : 47293 : (if_then_else:DWIH (match_dup 6)
25057 : 77568 : (match_dup 4)
25058 : 47937 : (match_dup 5)))]
25059 : 8181 : {
25060 : 39547 : operands[2] = force_reg (<DWI>mode, operands[2]);
25061 : 69409 :
25062 : 40183 : split_double_mode (<DWI>mode, &operands[0], 3, &operands[0], &operands[3]);
25063 : 41604 :
25064 : 39547 : rtx cmplo[2] = { operands[1], operands[2] };
25065 : 30688 : rtx cmphi[2] = { operands[4], operands[5] };
25066 : 39816 :
25067 : 42016 : enum rtx_code code = <maxmin_rel>;
25068 : 69409 :
25069 : 69822 : switch (code)
25070 : 39770 : {
25071 : 41802 : case LE: case LEU:
25072 : 69809 : std::swap (cmplo[0], cmplo[1]);
25073 : 69809 : std::swap (cmphi[0], cmphi[1]);
25074 : 39928 : code = swap_condition (code);
25075 : 41555 : /* FALLTHRU */
25076 : 69563 :
25077 : 70553 : case GE: case GEU:
25078 : 40095 : {
25079 : 41968 : bool uns = (code == GEU);
25080 : 70222 : rtx (*sbb_insn) (machine_mode, rtx, rtx, rtx)
25081 : 70232 : = uns ? gen_sub3_carry_ccc : gen_sub3_carry_ccgz;
25082 : 39836 :
25083 : 41968 : emit_insn (gen_cmp_1 (<MODE>mode, cmplo[0], cmplo[1]));
25084 : 69409 :
25085 : 69822 : rtx tmp = gen_rtx_SCRATCH (<MODE>mode);
25086 : 40095 : emit_insn (sbb_insn (<MODE>mode, tmp, cmphi[0], cmphi[1]));
25087 : 41555 :
25088 : 70021 : rtx flags = gen_rtx_REG (uns ? CCCmode : CCGZmode, FLAGS_REG);
25089 : 39547 : operands[6] = gen_rtx_fmt_ee (code, VOIDmode, flags, const0_rtx);
25090 : 39682 :
25091 : 72212 : break;
25092 : 39274 : }
25093 : 39165 :
25094 : 39682 : default:
25095 : 41555 : gcc_unreachable ();
25096 : 39274 : }
25097 : 39134 : })
25098 : 39682 :
25099 : 41555 : (define_insn_and_split "*<code><mode>3_1"
25100 : 115996 : [(set (match_operand:SWI 0 "register_operand")
25101 : 115996 : (maxmin:SWI
25102 : 40095 : (match_operand:SWI 1 "register_operand")
25103 : 41968 : (match_operand:SWI 2 "general_operand")))
25104 : 115996 : (clobber (reg:CC FLAGS_REG))]
25105 : 179455 : "TARGET_CMOVE
25106 : 43527 : && (<MODE>mode != QImode || !TARGET_PARTIAL_REG_STALL)
25107 : 337215 : && ix86_pre_reload_split ()"
25108 : 115996 : "#"
25109 : 140810 : "&& 1"
25110 : 64909 : [(set (match_dup 0)
25111 : 124692 : (if_then_else:SWI (match_dup 3)
25112 : 140633 : (match_dup 1)
25113 : 39681 : (match_dup 2)))]
25114 : 79601 : {
25115 : 124884 : machine_mode mode = <MODE>mode;
25116 : 516790 : rtx cmp_op = operands[2];
25117 : 433722 :
25118 : 347907 : operands[2] = force_reg (mode, cmp_op);
25119 : 23848244 :
25120 : 555698 : enum rtx_code code = <maxmin_rel>;
25121 : 220099 :
25122 : 23653790 : if (cmp_op == const1_rtx)
25123 : 123366 : {
25124 : 23565225 : /* Convert smax (x, 1) into (x > 0 ? x : 1).
25125 : 2020958 : Convert umax (x, 1) into (x != 0 ? x : 1).
25126 : 2021186 : Convert ?min (x, 1) into (x <= 0 ? x : 1). */
25127 : 2039297 : cmp_op = const0_rtx;
25128 : 1428259 : if (code == GE)
25129 : 40131 : code = GT;
25130 : 40352 : else if (code == GEU)
25131 : 1353816 : code = NE;
25132 : 148202 : }
25133 : 249117 : /* Convert smin (x, -1) into (x < 0 ? x : -1). */
25134 : 226985 : else if (cmp_op == constm1_rtx && code == LE)
25135 : 41545 : {
25136 : 264630 : cmp_op = const0_rtx;
25137 : 225157 : code = LT;
25138 : 40021 : }
25139 : 150348 : /* Convert smax (x, -1) into (x >= 0 ? x : -1). */
25140 : 253846 : else if (cmp_op == constm1_rtx && code == GE)
25141 : 189242 : cmp_op = const0_rtx;
25142 : 63746 : else if (cmp_op != const0_rtx)
25143 : 147873 : cmp_op = operands[2];
25144 : 185451 :
25145 : 191790 : machine_mode cmpmode = SELECT_CC_MODE (code, operands[1], cmp_op);
25146 : 83508 : rtx flags = gen_rtx_REG (cmpmode, FLAGS_REG);
25147 : 108281 :
25148 : 191225 : rtx tmp = gen_rtx_COMPARE (cmpmode, operands[1], cmp_op);
25149 : 237924 : emit_insn (gen_rtx_SET (flags, tmp));
25150 : 47139 :
25151 : 216973 : operands[3] = gen_rtx_fmt_ee (code, VOIDmode, flags, const0_rtx);
25152 : 163540 : })
25153 : 133778 :
25154 : 47077 : ;; Avoid clearing a register between a flags setting comparison and its use,
25155 : 216968 : ;; i.e. prefer "xorl %eax,%eax; test/cmp" over "test/cmp; movl $0, %eax".
25156 : 210259 : (define_peephole2
25157 : 129792 : [(set (reg FLAGS_REG) (match_operand 0))
25158 : 217197 : (set (match_operand:SWI 1 "general_reg_operand") (const_int 0))]
25159 : 232004 : "peep2_regno_dead_p (0, FLAGS_REG)
25160 : 248495 : && !reg_overlap_mentioned_p (operands[1], operands[0])"
25161 : 208018 : [(set (match_dup 2) (match_dup 0))]
25162 : 96087 : {
25163 : 95858 : operands[2] = gen_rtx_REG (GET_MODE (operands[0]), FLAGS_REG);
25164 : 57034 : ix86_expand_clear (operands[1]);
25165 : 138284 : })
25166 : 15459 :
25167 : 47040 : ;; When optimizing for size, zeroing memory should use a register.
25168 : 129797 : (define_peephole2
25169 : 206246 : [(match_scratch:SWI48 0 "r")
25170 : 93731 : (set (match_operand:SWI48 1 "memory_operand") (const_int 0))
25171 : 52071 : (set (match_operand:SWI48 2 "memory_operand") (const_int 0))
25172 : 57029 : (set (match_operand:SWI48 3 "memory_operand") (const_int 0))
25173 : 10305 : (set (match_operand:SWI48 4 "memory_operand") (const_int 0))]
25174 : 85095 : "optimize_insn_for_size_p () && peep2_regno_dead_p (0, FLAGS_REG)"
25175 : 46848 : [(const_int 0)]
25176 : 216846 : {
25177 : 58679 : ix86_expand_clear (operands[0]);
25178 : 48725 : emit_move_insn (operands[1], operands[0]);
25179 : 48139 : emit_move_insn (operands[2], operands[0]);
25180 : 48015 : emit_move_insn (operands[3], operands[0]);
25181 : 131135 : ix86_last_zero_store_uid
25182 : 102281 : = INSN_UID (emit_move_insn (operands[4], operands[0]));
25183 : 131148 : DONE;
25184 : 57388 : })
25185 : 129733 :
25186 : 57304 : (define_peephole2
25187 : 10677 : [(match_scratch:SWI48 0 "r")
25188 : 47083 : (set (match_operand:SWI48 1 "memory_operand") (const_int 0))
25189 : 47083 : (set (match_operand:SWI48 2 "memory_operand") (const_int 0))]
25190 : 170455 : "optimize_insn_for_size_p () && peep2_regno_dead_p (0, FLAGS_REG)"
25191 : 483 : [(const_int 0)]
25192 : 60116 : {
25193 : 57748 : ix86_expand_clear (operands[0]);
25194 : 57740 : emit_move_insn (operands[1], operands[0]);
25195 : 54315 : ix86_last_zero_store_uid
25196 : 131572 : = INSN_UID (emit_move_insn (operands[2], operands[0]));
25197 : 130640 : DONE;
25198 : 51205 : })
25199 : 50978 :
25200 : 127303 : (define_peephole2
25201 : 251798 : [(match_scratch:SWI48 0 "r")
25202 : 47075 : (set (match_operand:SWI48 1 "memory_operand") (const_int 0))]
25203 : 540903 : "optimize_insn_for_size_p () && peep2_regno_dead_p (0, FLAGS_REG)"
25204 : 227481 : [(const_int 0)]
25205 : 60358 : {
25206 : 90151 : ix86_expand_clear (operands[0]);
25207 : 80399 : ix86_last_zero_store_uid
25208 : 80288 : = INSN_UID (emit_move_insn (operands[1], operands[0]));
25209 : 80288 : DONE;
25210 : 2093308 : })
25211 : 46835 :
25212 : 140581 : (define_peephole2
25213 : 136962 : [(set (match_operand:SWI48 5 "memory_operand")
25214 : 2093281 : (match_operand:SWI48 0 "general_reg_operand"))
25215 : 2092957 : (set (match_operand:SWI48 1 "memory_operand") (const_int 0))
25216 : 2159236 : (set (match_operand:SWI48 2 "memory_operand") (const_int 0))
25217 : 2093023 : (set (match_operand:SWI48 3 "memory_operand") (const_int 0))
25218 : 2079492 : (set (match_operand:SWI48 4 "memory_operand") (const_int 0))]
25219 : 62396 : "optimize_insn_for_size_p ()
25220 : 47810 : && INSN_UID (peep2_next_insn (0)) == ix86_last_zero_store_uid"
25221 : 807792 : [(const_int 0)]
25222 : 72336 : {
25223 : 124211 : emit_move_insn (operands[5], operands[0]);
25224 : 241580 : emit_move_insn (operands[1], operands[0]);
25225 : 318029 : emit_move_insn (operands[2], operands[0]);
25226 : 71746 : emit_move_insn (operands[3], operands[0]);
25227 : 329997 : ix86_last_zero_store_uid
25228 : 228411 : = INSN_UID (emit_move_insn (operands[4], operands[0]));
25229 : 9194897 : DONE;
25230 : 46764 : })
25231 : 8349995 :
25232 : 8222153 : (define_peephole2
25233 : 8308479 : [(set (match_operand:SWI48 3 "memory_operand")
25234 : 46764 : (match_operand:SWI48 0 "general_reg_operand"))
25235 : 124945 : (set (match_operand:SWI48 1 "memory_operand") (const_int 0))
25236 : 46724 : (set (match_operand:SWI48 2 "memory_operand") (const_int 0))]
25237 : 63939 : "optimize_insn_for_size_p ()
25238 : 50521 : && INSN_UID (peep2_next_insn (0)) == ix86_last_zero_store_uid"
25239 : 123173 : [(const_int 0)]
25240 : 47215 : {
25241 : 47215 : emit_move_insn (operands[3], operands[0]);
25242 : 53986 : emit_move_insn (operands[1], operands[0]);
25243 : 123616 : ix86_last_zero_store_uid
25244 : 123616 : = INSN_UID (emit_move_insn (operands[2], operands[0]));
25245 : 124396 : DONE;
25246 : 9097685 : })
25247 : 123953 :
25248 : 5438417 : (define_peephole2
25249 : 5514866 : [(set (match_operand:SWI48 2 "memory_operand")
25250 : 46764 : (match_operand:SWI48 0 "general_reg_operand"))
25251 : 123173 : (set (match_operand:SWI48 1 "memory_operand") (const_int 0))]
25252 : 114477 : "optimize_insn_for_size_p ()
25253 : 58469 : && INSN_UID (peep2_next_insn (0)) == ix86_last_zero_store_uid"
25254 : 46764 : [(const_int 0)]
25255 : 51092 : {
25256 : 51092 : emit_move_insn (operands[2], operands[0]);
25257 : 68956 : ix86_last_zero_store_uid
25258 : 49625 : = INSN_UID (emit_move_insn (operands[1], operands[0]));
25259 : 125639 : DONE;
25260 : 49021 : })
25261 : 143334 :
25262 : 46764 : ;; Reload dislikes loading constants directly into class_likely_spilled
25263 : 7196684 : ;; hard registers. Try to tidy things up here.
25264 : 7194387 : (define_peephole2
25265 : 123173 : [(set (match_operand:SWI 0 "general_reg_operand")
25266 : 4255172 : (match_operand:SWI 1 "x86_64_general_operand"))
25267 : 4255101 : (set (match_operand:SWI 2 "general_reg_operand")
25268 : 4255101 : (match_dup 0))]
25269 : 324183 : "peep2_reg_dead_p (2, operands[0])"
25270 : 1030411 : [(set (match_dup 2) (match_dup 1))])
25271 : 3040831 :
25272 : 3132224 : ;; Misc patterns (?)
25273 : 123816 :
25274 : 1038678 : ;; This pattern exists to put a dependency on all ebp-based memory accesses.
25275 : 1038638 : ;; Otherwise there will be nothing to keep
25276 : 1120062 : ;;
25277 : 124295 : ;; [(set (reg ebp) (reg esp))]
25278 : 1079164 : ;; [(set (reg esp) (plus (reg esp) (const_int -160000)))
25279 : 1154989 : ;; (clobber (eflags)]
25280 : 1079143 : ;; [(set (mem (plus (reg ebp) (const_int -160000))) (const_int 0))]
25281 : 47330 : ;;
25282 : 13357778 : ;; in proper program order.
25283 : 13434192 :
25284 : 21549546 : (define_insn "@pro_epilogue_adjust_stack_add_<mode>"
25285 : 123731 : [(set (match_operand:P 0 "register_operand" "=r,r")
25286 : 47317 : (plus:P (match_operand:P 1 "register_operand" "0,r")
25287 : 123752 : (match_operand:P 2 "<nonmemory_operand>" "r<i>,l<i>")))
25288 : 123142 : (clobber (reg:CC FLAGS_REG))
25289 : 123731 : (clobber (mem:BLK (scratch)))]
25290 : 47313 : ""
25291 : 1396576 : {
25292 : 1395970 : switch (get_attr_type (insn))
25293 : 123142 : {
25294 : 46724 : case TYPE_IMOV:
25295 : 123142 : return "mov{<imodesuffix>}\t{%1, %0|%0, %1}";
25296 : 0 :
25297 : 1441139 : case TYPE_ALU:
25298 : 1364636 : gcc_assert (rtx_equal_p (operands[0], operands[1]));
25299 : 1441139 : if (x86_maybe_negate_const_int (&operands[2], <MODE>mode))
25300 : 840909 : return "sub{<imodesuffix>}\t{%2, %0|%0, %2}";
25301 : 123227 :
25302 : 46878 : return "add{<imodesuffix>}\t{%2, %0|%0, %2}";
25303 : 123227 :
25304 : 78013 : default:
25305 : 78098 : operands[2] = SET_SRC (XVECEXP (PATTERN (insn), 0, 0));
25306 : 78082 : return "lea{<imodesuffix>}\t{%E2, %0|%0, %E2}";
25307 : 56864 : }
25308 : 46809 : }
25309 : 56864 : [(set (attr "type")
25310 : 46809 : (cond [(and (eq_attr "alternative" "0")
25311 : 9160938 : (not (match_test "TARGET_OPT_AGU")))
25312 : 1168541 : (const_string "alu")
25313 : 10279 : (match_operand:<MODE> 2 "const0_operand")
25314 : 46959 : (const_string "imov")
25315 : 567926 : ]
25316 : 46809 : (const_string "lea")))
25317 : 46724 : (set (attr "length_immediate")
25318 : 46724 : (cond [(eq_attr "type" "imov")
25319 : 46727 : (const_string "0")
25320 : 46727 : (and (eq_attr "type" "alu")
25321 : 0 : (match_operand 2 "const128_operand"))
25322 : 7118 : (const_string "1")
25323 : 47021 : ]
25324 : 30504774 : (const_string "*")))
25325 : 18906665 : (set_attr "mode" "<MODE>")])
25326 : 18906371 :
25327 : 11605242 : (define_insn "@pro_epilogue_adjust_stack_sub_<mode>"
25328 : 7133 : [(set (match_operand:P 0 "register_operand" "=r")
25329 : 11645127 : (minus:P (match_operand:P 1 "register_operand" "0")
25330 : 11651951 : (match_operand:P 2 "register_operand" "r")))
25331 : 11605227 : (clobber (reg:CC FLAGS_REG))
25332 : 11605230 : (clobber (mem:BLK (scratch)))]
25333 : 7118 : ""
25334 : 53854 : "sub{<imodesuffix>}\t{%2, %0|%0, %2}"
25335 : 7118 : [(set_attr "type" "alu")
25336 : 11598109 : (set_attr "mode" "<MODE>")])
25337 : 7118 :
25338 : 46724 : (define_insn "@allocate_stack_worker_probe_<mode>"
25339 : 248750 : [(set (match_operand:P 0 "register_operand" "=a")
25340 : 7920063 : (unspec_volatile:P [(match_operand:P 1 "register_operand" "0")]
25341 : 53842 : UNSPECV_STACK_PROBE))
25342 : 0 : (clobber (reg:CC FLAGS_REG))]
25343 : 241676 : "ix86_target_stack_probe ()"
25344 : 8107841 : "call\t___chkstk_ms"
25345 : 46736 : [(set_attr "type" "multi")
25346 : 80344 : (set_attr "length" "5")])
25347 : 70326 :
25348 : 7906852 : (define_expand "allocate_stack"
25349 : 150599 : [(match_operand 0 "register_operand")
25350 : 104008 : (match_operand 1 "general_operand")]
25351 : 177021 : "ix86_target_stack_probe ()"
25352 : 7798430 : {
25353 : 150586 : rtx x;
25354 : 522829 :
25355 : 499689 : #ifndef CHECK_STACK_LIMIT
25356 : 23693 : #define CHECK_STACK_LIMIT 0
25357 : 70417 : #endif
25358 : 522986 :
25359 : 46724 : if (CHECK_STACK_LIMIT && CONST_INT_P (operands[1])
25360 : 476262 : && INTVAL (operands[1]) < CHECK_STACK_LIMIT)
25361 : 1356212 : x = operands[1];
25362 : 926807 : else
25363 : 1379376 : {
25364 : 1356212 : x = copy_to_mode_reg (Pmode, operands[1]);
25365 : 499689 :
25366 : 903247 : emit_insn (gen_allocate_stack_worker_probe (Pmode, x, x));
25367 : 1379376 : }
25368 : 476137 :
25369 : 46716 : x = expand_simple_binop (Pmode, MINUS, stack_pointer_rtx, x,
25370 : 46716 : stack_pointer_rtx, 0, OPTAB_DIRECT);
25371 : 1371576 :
25372 : 2 : if (x != stack_pointer_rtx)
25373 : 46975 : emit_move_insn (stack_pointer_rtx, x);
25374 : 46948 :
25375 : 46948 : emit_move_insn (operands[0], virtual_stack_dynamic_rtx);
25376 : 46947 : DONE;
25377 : 523075 : })
25378 : 46947 :
25379 : 46948 : (define_expand "probe_stack"
25380 : 1343253 : [(match_operand 0 "memory_operand")]
25381 : 1772434 : ""
25382 : 1819539 : {
25383 : 47105 : emit_insn (gen_probe_stack_1
25384 : 553963 : (word_mode, operands[0], const0_rtx));
25385 : 476263 : DONE;
25386 : 523075 : })
25387 : 46947 :
25388 : 523075 : ;; Use OR for stack probes, this is shorter.
25389 : 523075 : (define_insn "@probe_stack_1_<mode>"
25390 : 0 : [(set (match_operand:W 0 "memory_operand" "=m")
25391 : 476128 : (unspec:W [(match_operand:W 1 "const0_operand")]
25392 : 523075 : UNSPEC_PROBE_STACK))
25393 : 522827 : (clobber (reg:CC FLAGS_REG))]
25394 : 383 : ""
25395 : 841 : "or{<imodesuffix>}\t{%1, %0|%0, %1}"
25396 : 383 : [(set_attr "type" "alu1")
25397 : 483021 : (set_attr "mode" "<MODE>")
25398 : 476516 : (set_attr "length_immediate" "1")])
25399 : 135 :
25400 : 476516 : (define_insn "@adjust_stack_and_probe_<mode>"
25401 : 476133 : [(set (match_operand:P 0 "register_operand" "=r")
25402 : 476381 : (unspec_volatile:P [(match_operand:P 1 "register_operand" "0")]
25403 : 476133 : UNSPECV_PROBE_STACK_RANGE))
25404 : 476381 : (set (reg:P SP_REG)
25405 : 476133 : (minus:P (reg:P SP_REG) (match_operand:P 2 "const_int_operand")))
25406 : 398 : (clobber (reg:CC FLAGS_REG))
25407 : 476283 : (clobber (mem:BLK (scratch)))]
25408 : 476292 : ""
25409 : 476142 : "* return output_adjust_stack_and_probe (operands[0]);"
25410 : 0 : [(set_attr "type" "multi")])
25411 : 476390 :
25412 : 476190 : (define_insn "@probe_stack_range_<mode>"
25413 : 266 : [(set (match_operand:P 0 "register_operand" "=r")
25414 : 476142 : (unspec_volatile:P [(match_operand:P 1 "register_operand" "0")
25415 : 476142 : (match_operand:P 2 "const_int_operand")]
25416 : 476190 : UNSPECV_PROBE_STACK_RANGE))
25417 : 248 : (clobber (reg:CC FLAGS_REG))]
25418 : 476142 : ""
25419 : 476142 : "* return output_probe_stack_range (operands[0], operands[2]);"
25420 : 476390 : [(set_attr "type" "multi")])
25421 : 272 :
25422 : 0 : (define_expand "builtin_setjmp_receiver"
25423 : 476118 : [(label_ref (match_operand 0))]
25424 : 477207 : "!TARGET_64BIT && flag_pic"
25425 : 524 : {
25426 : 476393 : #if TARGET_MACHO
25427 : 476393 : if (TARGET_MACHO)
25428 : 9 : {
25429 : 257 : rtx xops[3];
25430 : 476109 : rtx_code_label *label_rtx = gen_label_rtx ();
25431 : 280 : emit_insn (gen_set_got_labelled (pic_offset_table_rtx, label_rtx));
25432 : 5 : xops[0] = xops[1] = pic_offset_table_rtx;
25433 : 257 : xops[2] = machopic_gen_offset (gen_rtx_LABEL_REF (SImode, label_rtx));
25434 : 0 : ix86_expand_binary_operator (MINUS, SImode, xops);
25435 : 476174 : }
25436 : 0 : else
25437 : 248 : #endif
25438 : 476352 : emit_insn (gen_set_got (pic_offset_table_rtx));
25439 : 476171 : DONE;
25440 : 476104 : })
25441 : 476352 :
25442 : 476352 : (define_expand "save_stack_nonlocal"
25443 : 476352 : [(set (match_operand 0 "memory_operand")
25444 : 0 : (match_operand 1 "register_operand"))]
25445 : 248 : ""
25446 : 478067 : {
25447 : 478067 : rtx stack_slot;
25448 : 0 :
25449 : 1963 : if (flag_cf_protection & CF_RETURN)
25450 : 476352 : {
25451 : 642022 : /* Copy shadow stack pointer to the first slot
25452 : 476104 : and stack pointer to the second slot. */
25453 : 165942 : rtx ssp_slot = adjust_address (operands[0], word_mode, 0);
25454 : 642046 : stack_slot = adjust_address (operands[0], Pmode, UNITS_PER_WORD);
25455 : 1946 :
25456 : 165711 : rtx reg_ssp = force_reg (word_mode, const0_rtx);
25457 : 165683 : emit_insn (gen_rdssp (word_mode, reg_ssp, reg_ssp));
25458 : 41 : emit_move_insn (ssp_slot, reg_ssp);
25459 : 1789 : }
25460 : 1743 : else
25461 : 481674 : stack_slot = adjust_address (operands[0], Pmode, 0);
25462 : 3668834 : emit_move_insn (stack_slot, operands[1]);
25463 : 479534 : DONE;
25464 : 3191014 : })
25465 : 476131 :
25466 : 476104 : (define_expand "restore_stack_nonlocal"
25467 : 476104 : [(set (match_operand 0 "register_operand" "")
25468 : 0 : (match_operand 1 "memory_operand" ""))]
25469 : 27 : ""
25470 : 1385 : {
25471 : 1385 : rtx stack_slot;
25472 : 704997 :
25473 : 706382 : if (flag_cf_protection & CF_RETURN)
25474 : 704997 : {
25475 : 602575 : /* Restore shadow stack pointer from the first slot
25476 : 476104 : and stack pointer from the second slot. */
25477 : 831483 : rtx ssp_slot = adjust_address (operands[1], word_mode, 0);
25478 : 705012 : stack_slot = adjust_address (operands[1], Pmode, UNITS_PER_WORD);
25479 : 476106 :
25480 : 476104 : /* Get the current shadow stack pointer. The code below will check if
25481 : 706382 : SHSTK feature is enabled. If it is not enabled the RDSSP instruction
25482 : 704997 : is a NOP. */
25483 : 13 : rtx reg_ssp = force_reg (word_mode, const0_rtx);
25484 : 228906 : emit_insn (gen_rdssp (word_mode, reg_ssp, reg_ssp));
25485 : 230278 :
25486 : 230278 : /* Compare through subtraction the saved and the current ssp
25487 : 230278 : to decide if ssp has to be adjusted. */
25488 : 228906 : reg_ssp = expand_simple_binop (word_mode, MINUS,
25489 : 706382 : reg_ssp, ssp_slot,
25490 : 476104 : reg_ssp, 1, OPTAB_DIRECT);
25491 : 0 :
25492 : 228893 : /* Compare and jump over adjustment code. */
25493 : 705010 : rtx noadj_label = gen_label_rtx ();
25494 : 705010 : emit_cmp_and_jump_insns (reg_ssp, const0_rtx, EQ, NULL_RTX,
25495 : 704997 : word_mode, 1, noadj_label);
25496 : 228893 :
25497 : 704997 : /* Compute the number of frames to adjust. */
25498 : 228906 : rtx reg_adj = gen_lowpart (ptr_mode, reg_ssp);
25499 : 228906 : rtx reg_adj_neg = expand_simple_unop (ptr_mode, NEG, reg_adj,
25500 : 228893 : NULL_RTX, 1);
25501 : 476104 :
25502 : 13 : reg_adj = expand_simple_binop (ptr_mode, LSHIFTRT, reg_adj_neg,
25503 : 228919 : GEN_INT (exact_log2 (UNITS_PER_WORD)),
25504 : 704997 : reg_adj, 1, OPTAB_DIRECT);
25505 : 704997 :
25506 : 0 : /* Check if number of frames <= 255 so no loop is needed. */
25507 : 228906 : rtx inc_label = gen_label_rtx ();
25508 : 228906 : emit_cmp_and_jump_insns (reg_adj, GEN_INT (255), LEU, NULL_RTX,
25509 : 705128 : ptr_mode, 1, inc_label);
25510 : 705128 :
25511 : 228893 : /* Adjust the ssp in a loop. */
25512 : 705141 : rtx loop_label = gen_label_rtx ();
25513 : 705141 : emit_label (loop_label);
25514 : 705141 : LABEL_NUSES (loop_label) = 1;
25515 : 705128 :
25516 : 705141 : rtx reg_255 = force_reg (word_mode, GEN_INT (255));
25517 : 476248 : emit_insn (gen_incssp (word_mode, reg_255));
25518 : 476235 :
25519 : 705141 : reg_adj = expand_simple_binop (ptr_mode, MINUS,
25520 : 705128 : reg_adj, GEN_INT (255),
25521 : 705128 : reg_adj, 1, OPTAB_DIRECT);
25522 : 228893 :
25523 : 228893 : /* Compare and jump to the loop label. */
25524 : 228906 : emit_cmp_and_jump_insns (reg_adj, GEN_INT (255), GTU, NULL_RTX,
25525 : 228893 : ptr_mode, 1, loop_label);
25526 : 476235 :
25527 : 13 : emit_label (inc_label);
25528 : 706127 : LABEL_NUSES (inc_label) = 1;
25529 : 229879 :
25530 : 476248 : emit_insn (gen_incssp (word_mode, reg_ssp));
25531 : 17 :
25532 : 706363 : emit_label (noadj_label);
25533 : 230128 : LABEL_NUSES (noadj_label) = 1;
25534 : 253 : }
25535 : 229862 : else
25536 : 707469 : stack_slot = adjust_address (operands[1], Pmode, 0);
25537 : 707482 : emit_move_insn (operands[0], stack_slot);
25538 : 231500 : DONE;
25539 : 229862 : })
25540 : 706097 :
25541 : 476235 : (define_expand "stack_protect_set"
25542 : 253 : [(match_operand 0 "memory_operand")
25543 : 706097 : (match_operand 1 "memory_operand")]
25544 : 706097 : ""
25545 : 706304 : {
25546 : 706511 : rtx scratch = gen_reg_rtx (word_mode);
25547 : 229862 :
25548 : 706304 : emit_insn (gen_stack_protect_set_1
25549 : 706097 : (ptr_mode, word_mode, operands[0], operands[1], scratch));
25550 : 706304 : DONE;
25551 : 706100 : })
25552 : 706100 :
25553 : 229862 : (define_insn "@stack_protect_set_1_<PTR:mode>_<W:mode>"
25554 : 229862 : [(set (match_operand:PTR 0 "memory_operand" "=m")
25555 : 706100 : (unspec:PTR [(match_operand:PTR 1 "memory_operand" "m")]
25556 : 706307 : UNSPEC_SP_SET))
25557 : 229862 : (set (match_operand:W 2 "register_operand" "=&r") (const_int 0))
25558 : 229862 : (clobber (reg:CC FLAGS_REG))]
25559 : 706307 : ""
25560 : 230173 : {
25561 : 706304 : output_asm_insn ("mov{<PTR:imodesuffix>}\t{%1, %<PTR:k>2|%<PTR:k>2, %1}",
25562 : 706304 : operands);
25563 : 706405 : output_asm_insn ("mov{<PTR:imodesuffix>}\t{%<PTR:k>2, %0|%0, %<PTR:k>2}",
25564 : 706304 : operands);
25565 : 706198 : if (!TARGET_USE_MOV0 || optimize_insn_for_size_p ())
25566 : 706198 : return "xor{l}\t%k2, %k2";
25567 : 706097 : else
25568 : 706097 : return "mov{l}\t{$0, %k2|%k2, 0}";
25569 : 229862 : }
25570 : 229862 : [(set_attr "type" "multi")])
25571 : 229862 :
25572 : 229862 : ;; Patterns and peephole2s to optimize stack_protect_set_1_<mode>
25573 : 706203 : ;; immediately followed by *mov{s,d}i_internal, where we can avoid
25574 : 706102 : ;; the xor{l} above. We don't split this, so that scheduling or
25575 : 706102 : ;; anything else doesn't separate the *stack_protect_set* pattern from
25576 : 706102 : ;; the set of the register that overwrites the register with a new value.
25577 : 706102 :
25578 : 229867 : (define_peephole2
25579 : 706097 : [(parallel [(set (match_operand:PTR 0 "memory_operand")
25580 : 706097 : (unspec:PTR [(match_operand:PTR 1 "memory_operand")]
25581 : 706097 : UNSPEC_SP_SET))
25582 : 706097 : (set (match_operand 2 "general_reg_operand") (const_int 0))
25583 : 706097 : (clobber (reg:CC FLAGS_REG))])
25584 : 706097 : (set (match_operand 3 "general_reg_operand")
25585 : 706097 : (match_operand 4 "const0_operand"))]
25586 : 706097 : "GET_MODE (operands[2]) == word_mode
25587 : 706101 : && GET_MODE_SIZE (GET_MODE (operands[3])) <= UNITS_PER_WORD
25588 : 706101 : && peep2_reg_dead_p (0, operands[3])
25589 : 706101 : && peep2_reg_dead_p (1, operands[2])"
25590 : 706101 : [(parallel [(set (match_dup 0)
25591 : 706101 : (unspec:PTR [(match_dup 1)] UNSPEC_SP_SET))
25592 : 706101 : (set (match_dup 3) (const_int 0))
25593 : 706101 : (clobber (reg:CC FLAGS_REG))])]
25594 : 706101 : "operands[3] = gen_lowpart (word_mode, operands[3]);")
25595 : 229866 :
25596 : 229866 : (define_insn "*stack_protect_set_2_<mode>_si"
25597 : 706097 : [(set (match_operand:PTR 0 "memory_operand" "=m")
25598 : 706097 : (unspec:PTR [(match_operand:PTR 3 "memory_operand" "m")]
25599 : 706097 : UNSPEC_SP_SET))
25600 : 229866 : (set (match_operand:SI 1 "register_operand" "=&r")
25601 : 706097 : (match_operand:SI 2 "general_operand" "g"))]
25602 : 706099 : "reload_completed"
25603 : 229864 : {
25604 : 229862 : output_asm_insn ("mov{<imodesuffix>}\t{%3, %<k>1|%<k>1, %3}", operands);
25605 : 706099 : output_asm_insn ("mov{<imodesuffix>}\t{%<k>1, %0|%0, %<k>1}", operands);
25606 : 706099 : if (pic_32bit_operand (operands[2], SImode)
25607 : 229864 : || ix86_use_lea_for_mov (insn, operands + 1))
25608 : 706097 : return "lea{l}\t{%E2, %1|%1, %E2}";
25609 : 706097 : else
25610 : 229862 : return "mov{l}\t{%2, %1|%1, %2}";
25611 : 706097 : }
25612 : 706097 : [(set_attr "type" "multi")
25613 : 706097 : (set_attr "length" "24")])
25614 : 706097 :
25615 : 706099 : (define_insn "*stack_protect_set_2_<mode>_di"
25616 : 706097 : [(set (match_operand:PTR 0 "memory_operand" "=m,m,m")
25617 : 706097 : (unspec:PTR [(match_operand:PTR 3 "memory_operand" "m,m,m")]
25618 : 229862 : UNSPEC_SP_SET))
25619 : 229862 : (set (match_operand:DI 1 "register_operand" "=&r,&r,&r")
25620 : 706097 : (match_operand:DI 2 "general_operand" "Z,rem,i"))]
25621 : 229902 : "TARGET_64BIT && reload_completed"
25622 : 706137 : {
25623 : 229862 : output_asm_insn ("mov{<imodesuffix>}\t{%3, %<k>1|%<k>1, %3}", operands);
25624 : 229902 : output_asm_insn ("mov{<imodesuffix>}\t{%<k>1, %0|%0, %<k>1}", operands);
25625 : 229902 : if (pic_32bit_operand (operands[2], DImode))
25626 : 229862 : return "lea{q}\t{%E2, %1|%1, %E2}";
25627 : 706132 : else if (which_alternative == 0)
25628 : 229862 : return "mov{l}\t{%k2, %k1|%k1, %k2}";
25629 : 706127 : else if (which_alternative == 2)
25630 : 229862 : return "movabs{q}\t{%2, %1|%1, %2}";
25631 : 706127 : else if (ix86_use_lea_for_mov (insn, operands + 1))
25632 : 229862 : return "lea{q}\t{%E2, %1|%1, %E2}";
25633 : 476235 : else
25634 : 706097 : return "mov{q}\t{%2, %1|%1, %2}";
25635 : 706097 : }
25636 : 229862 : [(set_attr "type" "multi")
25637 : 706097 : (set_attr "length" "24")])
25638 : 706097 :
25639 : 706138 : (define_peephole2
25640 : 706097 : [(parallel [(set (match_operand:PTR 0 "memory_operand")
25641 : 706097 : (unspec:PTR [(match_operand:PTR 1 "memory_operand")]
25642 : 706097 : UNSPEC_SP_SET))
25643 : 229862 : (set (match_operand 2 "general_reg_operand") (const_int 0))
25644 : 229862 : (clobber (reg:CC FLAGS_REG))])
25645 : 229862 : (set (match_operand:SWI48 3 "general_reg_operand")
25646 : 706097 : (match_operand:SWI48 4 "general_gr_operand"))]
25647 : 706136 : "GET_MODE (operands[2]) == word_mode
25648 : 39 : && peep2_reg_dead_p (0, operands[3])
25649 : 39 : && peep2_reg_dead_p (1, operands[2])"
25650 : 706097 : [(parallel [(set (match_dup 0)
25651 : 706097 : (unspec:PTR [(match_dup 1)] UNSPEC_SP_SET))
25652 : 706097 : (set (match_dup 3) (match_dup 4))])])
25653 : 476235 :
25654 : 229862 : (define_peephole2
25655 : 706097 : [(set (match_operand:SWI48 3 "general_reg_operand")
25656 : 706097 : (match_operand:SWI48 4 "general_gr_operand"))
25657 : 476235 : (parallel [(set (match_operand:PTR 0 "memory_operand")
25658 : 707071 : (unspec:PTR [(match_operand:PTR 1 "memory_operand")]
25659 : 229862 : UNSPEC_SP_SET))
25660 : 229862 : (set (match_operand 2 "general_reg_operand") (const_int 0))
25661 : 707071 : (clobber (reg:CC FLAGS_REG))])]
25662 : 707086 : "GET_MODE (operands[2]) == word_mode
25663 : 707086 : && peep2_reg_dead_p (0, operands[3])
25664 : 229877 : && peep2_reg_dead_p (2, operands[2])
25665 : 707086 : && !reg_mentioned_p (operands[3], operands[0])
25666 : 707101 : && !reg_mentioned_p (operands[3], operands[1])"
25667 : 477209 : [(parallel [(set (match_dup 0)
25668 : 0 : (unspec:PTR [(match_dup 1)] UNSPEC_SP_SET))
25669 : 707071 : (set (match_dup 3) (match_dup 4))])])
25670 : 229862 :
25671 : 229862 : (define_insn "*stack_protect_set_3_<PTR:mode>_<SWI48:mode>"
25672 : 477209 : [(set (match_operand:PTR 0 "memory_operand" "=m")
25673 : 707071 : (unspec:PTR [(match_operand:PTR 3 "memory_operand" "m")]
25674 : 707071 : UNSPEC_SP_SET))
25675 : 707071 : (set (match_operand:SWI48 1 "register_operand" "=&r")
25676 : 477209 : (match_operand:SWI48 2 "address_no_seg_operand" "Ts"))]
25677 : 707071 : ""
25678 : 229926 : {
25679 : 229863 : output_asm_insn ("mov{<PTR:imodesuffix>}\t{%3, %<PTR:k>1|%<PTR:k>1, %3}",
25680 : 477209 : operands);
25681 : 707135 : output_asm_insn ("mov{<PTR:imodesuffix>}\t{%<PTR:k>1, %0|%0, %<PTR:k>1}",
25682 : 707071 : operands);
25683 : 229926 : if (SImode_address_operand (operands[2], VOIDmode))
25684 : 229862 : {
25685 : 707071 : gcc_assert (TARGET_64BIT);
25686 : 707071 : return "lea{l}\t{%E2, %k1|%k1, %E2}";
25687 : 707071 : }
25688 : 707071 : else
25689 : 229862 : return "lea{<SWI48:imodesuffix>}\t{%E2, %1|%1, %E2}";
25690 : 707071 : }
25691 : 707071 : [(set_attr "type" "multi")
25692 : 707071 : (set_attr "length" "24")])
25693 : 707071 :
25694 : 229925 : (define_peephole2
25695 : 229862 : [(parallel [(set (match_operand:PTR 0 "memory_operand")
25696 : 707071 : (unspec:PTR [(match_operand:PTR 1 "memory_operand")]
25697 : 707071 : UNSPEC_SP_SET))
25698 : 707071 : (set (match_operand 2 "general_reg_operand") (const_int 0))
25699 : 229863 : (clobber (reg:CC FLAGS_REG))])
25700 : 707071 : (set (match_operand:SWI48 3 "general_reg_operand")
25701 : 707072 : (match_operand:SWI48 4 "address_no_seg_operand"))]
25702 : 707148 : "GET_MODE (operands[2]) == word_mode
25703 : 229939 : && peep2_reg_dead_p (0, operands[3])
25704 : 229939 : && peep2_reg_dead_p (1, operands[2])"
25705 : 229863 : [(parallel [(set (match_dup 0)
25706 : 707072 : (unspec:PTR [(match_dup 1)] UNSPEC_SP_SET))
25707 : 707072 : (set (match_dup 3) (match_dup 4))])])
25708 : 707071 :
25709 : 707072 : (define_insn "*stack_protect_set_4z_<mode>_di"
25710 : 707072 : [(set (match_operand:PTR 0 "memory_operand" "=m")
25711 : 707072 : (unspec:PTR [(match_operand:PTR 3 "memory_operand" "m")]
25712 : 707072 : UNSPEC_SP_SET))
25713 : 707072 : (set (match_operand:DI 1 "register_operand" "=&r")
25714 : 707072 : (zero_extend:DI (match_operand:SI 2 "nonimmediate_operand" "rm")))]
25715 : 229863 : "TARGET_64BIT && reload_completed"
25716 : 229863 : {
25717 : 707072 : output_asm_insn ("mov{<imodesuffix>}\t{%3, %<k>1|%<k>1, %3}", operands);
25718 : 707072 : output_asm_insn ("mov{<imodesuffix>}\t{%<k>1, %0|%0, %<k>1}", operands);
25719 : 707072 : if (ix86_use_lea_for_mov (insn, operands + 1))
25720 : 707072 : return "lea{l}\t{%E2, %k1|%k1, %E2}";
25721 : 707071 : else
25722 : 707071 : return "mov{l}\t{%2, %k1|%k1, %2}";
25723 : 707071 : }
25724 : 707071 : [(set_attr "type" "multi")
25725 : 707071 : (set_attr "length" "24")])
25726 : 229862 :
25727 : 229862 : (define_insn "*stack_protect_set_4s_<mode>_di"
25728 : 707071 : [(set (match_operand:PTR 0 "memory_operand" "=m")
25729 : 707072 : (unspec:PTR [(match_operand:PTR 3 "memory_operand" "m")]
25730 : 707072 : UNSPEC_SP_SET))
25731 : 707072 : (set (match_operand:DI 1 "register_operand" "=&r")
25732 : 707071 : (sign_extend:DI (match_operand:SI 2 "nonimmediate_operand" "rm")))]
25733 : 707071 : "TARGET_64BIT && reload_completed"
25734 : 707071 : {
25735 : 707071 : output_asm_insn ("mov{<imodesuffix>}\t{%3, %<k>1|%<k>1, %3}", operands);
25736 : 707071 : output_asm_insn ("mov{<imodesuffix>}\t{%<k>1, %0|%0, %<k>1}", operands);
25737 : 707097 : return "movs{lq|x}\t{%2, %1|%1, %2}";
25738 : 229862 : }
25739 : 707097 : [(set_attr "type" "multi")
25740 : 707097 : (set_attr "length" "24")])
25741 : 707097 :
25742 : 229889 : (define_peephole2
25743 : 707097 : [(parallel [(set (match_operand:PTR 0 "memory_operand")
25744 : 707097 : (unspec:PTR [(match_operand:PTR 1 "memory_operand")]
25745 : 707097 : UNSPEC_SP_SET))
25746 : 229862 : (set (match_operand 2 "general_reg_operand") (const_int 0))
25747 : 707097 : (clobber (reg:CC FLAGS_REG))])
25748 : 707097 : (set (match_operand:DI 3 "general_reg_operand")
25749 : 707097 : (any_extend:DI
25750 : 707097 : (match_operand:SI 4 "nonimmediate_gr_operand")))]
25751 : 229888 : "TARGET_64BIT
25752 : 229888 : && GET_MODE (operands[2]) == word_mode
25753 : 229888 : && peep2_reg_dead_p (0, operands[3])
25754 : 707097 : && peep2_reg_dead_p (1, operands[2])"
25755 : 707097 : [(parallel [(set (match_dup 0)
25756 : 707097 : (unspec:PTR [(match_dup 1)] UNSPEC_SP_SET))
25757 : 707097 : (set (match_dup 3)
25758 : 707097 : (any_extend:DI (match_dup 4)))])])
25759 : 707071 :
25760 : 707071 : (define_expand "stack_protect_test"
25761 : 229862 : [(match_operand 0 "memory_operand")
25762 : 229862 : (match_operand 1 "memory_operand")
25763 : 707071 : (match_operand 2)]
25764 : 707071 : ""
25765 : 707291 : {
25766 : 230302 : rtx flags = gen_rtx_REG (CCZmode, FLAGS_REG);
25767 : 707097 :
25768 : 707317 : emit_insn (gen_stack_protect_test_1
25769 : 707097 : (ptr_mode, flags, operands[0], operands[1]));
25770 : 229862 :
25771 : 707291 : emit_jump_insn (gen_cbranchcc4 (gen_rtx_EQ (VOIDmode, flags, const0_rtx),
25772 : 707071 : flags, const0_rtx, operands[2]));
25773 : 707291 : DONE;
25774 : 707071 : })
25775 : 707071 :
25776 : 707071 : (define_insn "@stack_protect_test_1_<mode>"
25777 : 707071 : [(set (match_operand:CCZ 0 "flags_reg_operand")
25778 : 707071 : (unspec:CCZ [(match_operand:PTR 1 "memory_operand" "m")
25779 : 707071 : (match_operand:PTR 2 "memory_operand" "m")]
25780 : 229862 : UNSPEC_SP_TEST))
25781 : 229862 : (clobber (match_scratch:PTR 3 "=&r"))]
25782 : 707071 : ""
25783 : 707279 : {
25784 : 707072 : output_asm_insn ("mov{<imodesuffix>}\t{%1, %3|%3, %1}", operands);
25785 : 230070 : return "sub{<imodesuffix>}\t{%2, %3|%3, %2}";
25786 : 707071 : }
25787 : 707071 : [(set_attr "type" "multi")])
25788 : 707071 :
25789 : 229862 : ;; Avoid redundant prefixes by splitting HImode arithmetic to SImode.
25790 : 743351 : ;; Do not split instructions with mask registers.
25791 : 707071 : (define_split
25792 : 707152 : [(set (match_operand 0 "general_reg_operand")
25793 : 229943 : (match_operator 3 "promotable_binary_operator"
25794 : 707152 : [(match_operand 1 "general_reg_operand")
25795 : 1000618 : (match_operand 2 "aligned_operand")]))
25796 : 707152 : (clobber (reg:CC FLAGS_REG))]
25797 : 12995929 : "! TARGET_PARTIAL_REG_STALL && reload_completed
25798 : 11090208 : && ((GET_MODE (operands[0]) == HImode
25799 : 1087083 : && ((optimize_function_for_speed_p (cfun) && !TARGET_FAST_PREFIX)
25800 : 1000618 : /* ??? next two lines just !satisfies_constraint_K (...) */
25801 : 1087083 : || !CONST_INT_P (operands[2])
25802 : 1065452 : || satisfies_constraint_K (operands[2])))
25803 : 10750370 : || (GET_MODE (operands[0]) == QImode
25804 : 1247712 : && (TARGET_PROMOTE_QImode || optimize_function_for_size_p (cfun))))"
25805 : 1000618 : [(parallel [(set (match_dup 0)
25806 : 707152 : (match_op_dup 3 [(match_dup 1) (match_dup 2)]))
25807 : 707152 : (clobber (reg:CC FLAGS_REG))])]
25808 : 1000618 : {
25809 : 24156381 : operands[0] = gen_lowpart (SImode, operands[0]);
25810 : 24156381 : operands[1] = gen_lowpart (SImode, operands[1]);
25811 : 1000618 : if (GET_CODE (operands[3]) != ASHIFT)
25812 : 24122368 : operands[2] = gen_lowpart (SImode, operands[2]);
25813 : 24152514 : operands[3] = shallow_copy_rtx (operands[3]);
25814 : 24152514 : PUT_MODE (operands[3], SImode);
25815 : 44897657 : })
25816 : 707152 :
25817 : 21728421 : ; Promote the QImode tests, as i386 has encoding of the AND
25818 : 21791944 : ; instruction with 32-bit sign-extended immediate and thus the
25819 : 21544678 : ; instruction size is unchanged, except in the %eax case for
25820 : 1000618 : ; which it is increased by one byte, hence the ! optimize_size.
25821 : 15369438 : (define_split
25822 : 15139495 : [(set (match_operand 0 "flags_reg_operand")
25823 : 707152 : (match_operator 2 "compare_operator"
25824 : 1001533 : [(and (match_operand 3 "aligned_operand")
25825 : 1001533 : (match_operand 4 "const_int_operand"))
25826 : 771590 : (const_int 0)]))
25827 : 707281 : (set (match_operand 1 "register_operand")
25828 : 707281 : (and (match_dup 3) (match_dup 4)))]
25829 : 318039 : "! TARGET_PARTIAL_REG_STALL && reload_completed
25830 : 302881 : && optimize_insn_for_speed_p ()
25831 : 773741 : && ((GET_MODE (operands[1]) == HImode && ! TARGET_FAST_PREFIX)
25832 : 773741 : || (GET_MODE (operands[1]) == QImode && TARGET_PROMOTE_QImode))
25833 : 1000618 : /* Ensure that the operand will remain sign-extended immediate. */
25834 : 1018757 : && ix86_match_ccmode (insn, INTVAL (operands[4]) >= 0 ? CCNOmode : CCZmode)"
25835 : 1071055 : [(parallel [(set (match_dup 0)
25836 : 723767 : (match_op_dup 2 [(and:SI (match_dup 3) (match_dup 4))
25837 : 230074 : (const_int 0)]))
25838 : 857101 : (set (match_dup 1)
25839 : 857101 : (and:SI (match_dup 3) (match_dup 4)))])]
25840 : 396638 : {
25841 : 263173 : operands[4]
25842 : 860807 : = gen_int_mode (INTVAL (operands[4])
25843 : 844192 : & GET_MODE_MASK (GET_MODE (operands[1])), SImode);
25844 : 844192 : operands[1] = gen_lowpart (SImode, operands[1]);
25845 : 844192 : operands[3] = gen_lowpart (SImode, operands[3]);
25846 : 844192 : })
25847 : 844192 :
25848 : 723636 : ; Don't promote the QImode tests, as i386 doesn't have encoding of
25849 : 840774 : ; the TEST instruction with 32-bit sign-extended immediate and thus
25850 : 824159 : ; the instruction size would at least double, which is not what we
25851 : 840774 : ; want even with ! optimize_size.
25852 : 840774 : (define_split
25853 : 480044 : [(set (match_operand 0 "flags_reg_operand")
25854 : 246559 : (match_operator 1 "compare_operator"
25855 : 839984 : [(and (match_operand:HI 2 "aligned_operand")
25856 : 362220 : (match_operand:HI 3 "const_int_operand"))
25857 : 362906 : (const_int 0)]))]
25858 : 741387 : "! TARGET_PARTIAL_REG_STALL && reload_completed
25859 : 251788 : && ! TARGET_FAST_PREFIX
25860 : 229943 : && optimize_insn_for_speed_p ()
25861 : 229944 : /* Ensure that the operand will remain sign-extended immediate. */
25862 : 707022 : && ix86_match_ccmode (insn, INTVAL (operands[3]) >= 0 ? CCNOmode : CCZmode)"
25863 : 495064 : [(set (match_dup 0)
25864 : 707022 : (match_op_dup 1 [(and:SI (match_dup 2) (match_dup 3))
25865 : 707022 : (const_int 0)]))]
25866 : 707665 : {
25867 : 15997340 : operands[3]
25868 : 707032 : = gen_int_mode (INTVAL (operands[3])
25869 : 707024 : & GET_MODE_MASK (GET_MODE (operands[2])), SImode);
25870 : 707034 : operands[2] = gen_lowpart (SImode, operands[2]);
25871 : 723649 : })
25872 : 493707 :
25873 : 723649 : (define_split
25874 : 229953 : [(set (match_operand 0 "register_operand")
25875 : 229953 : (neg (match_operand 1 "register_operand")))
25876 : 707034 : (clobber (reg:CC FLAGS_REG))]
25877 : 822476 : "! TARGET_PARTIAL_REG_STALL && reload_completed
25878 : 779752 : && (GET_MODE (operands[0]) == HImode
25879 : 778525 : || (GET_MODE (operands[0]) == QImode
25880 : 708690 : && (TARGET_PROMOTE_QImode
25881 : 707154 : || optimize_insn_for_size_p ())))"
25882 : 710059 : [(parallel [(set (match_dup 0)
25883 : 820600 : (neg:SI (match_dup 1)))
25884 : 707157 : (clobber (reg:CC FLAGS_REG))])]
25885 : 710066 : {
25886 : 232851 : operands[0] = gen_lowpart (SImode, operands[0]);
25887 : 232861 : operands[1] = gen_lowpart (SImode, operands[1]);
25888 : 707153 : })
25889 : 707153 :
25890 : 707153 : ;; Do not split instructions with mask regs.
25891 : 710070 : (define_split
25892 : 710070 : [(set (match_operand 0 "general_reg_operand")
25893 : 710070 : (not (match_operand 1 "general_reg_operand")))]
25894 : 784053 : "! TARGET_PARTIAL_REG_STALL && reload_completed
25895 : 554096 : && (GET_MODE (operands[0]) == HImode
25896 : 782919 : || (GET_MODE (operands[0]) == QImode
25897 : 708930 : && (TARGET_PROMOTE_QImode
25898 : 707153 : || optimize_insn_for_size_p ())))"
25899 : 710064 : [(set (match_dup 0)
25900 : 816235 : (not:SI (match_dup 1)))]
25901 : 712960 : {
25902 : 712954 : operands[0] = gen_lowpart (SImode, operands[0]);
25903 : 819119 : operands[1] = gen_lowpart (SImode, operands[1]);
25904 : 707167 : })
25905 : 707167 :
25906 : 477224 : ;; RTL Peephole optimizations, run before sched2. These primarily look to
25907 : 710064 : ;; transform a complex memory operation into two memory to register operations.
25908 : 480121 :
25909 : 712961 : ;; Don't push memory operands
25910 : 477224 : (define_peephole2
25911 : 710050 : [(set (match_operand:SWI 0 "push_operand")
25912 : 2897 : (match_operand:SWI 1 "memory_operand"))
25913 : 232840 : (match_scratch:SWI 2 "<r>")]
25914 : 737908 : "!(TARGET_PUSH_MEMORY || optimize_insn_for_size_p ())
25915 : 710050 : && !RTX_FRAME_RELATED_P (peep2_next_insn (0))"
25916 : 481010 : [(set (match_dup 2) (match_dup 1))
25917 : 707153 : (set (match_dup 0) (match_dup 2))])
25918 : 229943 :
25919 : 229957 : ;; We need to handle SFmode only, because DFmode and XFmode are split to
25920 : 707469 : ;; SImode pushes.
25921 : 707469 : (define_peephole2
25922 : 46246102 : [(set (match_operand:SF 0 "push_operand")
25923 : 230245 : (match_operand:SF 1 "memory_operand"))
25924 : 36207009 : (match_scratch:SF 2 "r")]
25925 : 707455 : "!(TARGET_PUSH_MEMORY || optimize_insn_for_size_p ())
25926 : 3531439 : && !RTX_FRAME_RELATED_P (peep2_next_insn (0))"
25927 : 3531742 : [(set (match_dup 2) (match_dup 1))
25928 : 3531439 : (set (match_dup 0) (match_dup 2))])
25929 : 229943 :
25930 : 0 : ;; Don't move an immediate directly to memory when the instruction
25931 : 477211 : ;; gets too big, or if LCP stalls are a problem for 16-bit moves.
25932 : 707153 : (define_peephole2
25933 : 707153 : [(match_scratch:SWI124 1 "<r>")
25934 : 229943 : (set (match_operand:SWI124 0 "memory_operand")
25935 : 1 : (const_int 0))]
25936 : 1009728 : "optimize_insn_for_speed_p ()
25937 : 1004700 : && ((<MODE>mode == HImode
25938 : 719319 : && TARGET_LCP_STALL)
25939 : 515326 : || (!TARGET_USE_MOV0
25940 : 992536 : && TARGET_SPLIT_LONG_MOVES
25941 : 477210 : && get_attr_length (insn) >= ix86_cur_cost ()->large_insn))
25942 : 719318 : && peep2_regno_dead_p (0, FLAGS_REG)"
25943 : 1002093 : [(parallel [(set (match_dup 2) (const_int 0))
25944 : 719318 : (clobber (reg:CC FLAGS_REG))])
25945 : 719317 : (set (match_dup 0) (match_dup 1))]
25946 : 31122860 : "operands[2] = gen_lowpart (SImode, operands[1]);")
25947 : 32067323 :
25948 : 720158 : (define_peephole2
25949 : 32104541 : [(match_scratch:SWI124 2 "<r>")
25950 : 242048 : (set (match_operand:SWI124 0 "memory_operand")
25951 : 990499 : (match_operand:SWI124 1 "immediate_operand"))]
25952 : 1487876 : "optimize_insn_for_speed_p ()
25953 : 979445 : && ((<MODE>mode == HImode
25954 : 524883 : && TARGET_LCP_STALL)
25955 : 1417929 : || (TARGET_SPLIT_LONG_MOVES
25956 : 707153 : && get_attr_length (insn) >= ix86_cur_cost ()->large_insn))"
25957 : 957224 : [(set (match_dup 2) (match_dup 1))
25958 : 708894 : (set (match_dup 0) (match_dup 2))])
25959 : 728838 :
25960 : 740942 : ;; Don't compare memory with zero, load and use a test instead.
25961 : 810743 : (define_peephole2
25962 : 9705140 : [(set (match_operand 0 "flags_reg_operand")
25963 : 767467 : (match_operator 1 "compare_operator"
25964 : 9705140 : [(match_operand:SI 2 "memory_operand")
25965 : 288760 : (const_int 0)]))
25966 : 810838 : (match_scratch:SI 3 "r")]
25967 : 3536633 : "optimize_insn_for_speed_p () && ix86_match_ccmode (insn, CCNOmode)"
25968 : 812589 : [(set (match_dup 3) (match_dup 2))
25969 : 47893811 : (set (match_dup 0) (match_op_dup 1 [(match_dup 3) (const_int 0)]))])
25970 : 998204 :
25971 : 42763911 : ;; NOT is not pairable on Pentium, while XOR is, but one byte longer.
25972 : 42485024 : ;; Don't split NOTs with a displacement operand, because resulting XOR
25973 : 707153 : ;; will not be pairable anyway.
25974 : 3205398 : ;;
25975 : 44850459 : ;; On AMD K6, NOT is vector decoded with memory operand that cannot be
25976 : 11580903 : ;; represented using a modRM byte. The XOR replacement is long decoded,
25977 : 37592688 : ;; so this split helps here as well.
25978 : 48711129 : ;;
25979 : 9656127 : ;; Note: Can't do this as a regular split because we can't get proper
25980 : 719258 : ;; lifetime information then.
25981 : 44850411 :
25982 : 44862516 : (define_peephole2
25983 : 707153 : [(set (match_operand:SWI124 0 "nonimmediate_gr_operand")
25984 : 7543648 : (not:SWI124 (match_operand:SWI124 1 "nonimmediate_gr_operand")))]
25985 : 7558340 : "optimize_insn_for_speed_p ()
25986 : 31072260 : && ((TARGET_NOT_UNPAIRABLE
25987 : 707153 : && (!MEM_P (operands[0])
25988 : 32269266 : || !memory_displacement_operand (operands[0], <MODE>mode)))
25989 : 26141065 : || (TARGET_NOT_VECTORMODE
25990 : 707153 : && long_memory_operand (operands[0], <MODE>mode)))
25991 : 707153 : && peep2_regno_dead_p (0, FLAGS_REG)"
25992 : 21646322 : [(parallel [(set (match_dup 0)
25993 : 708826 : (xor:SWI124 (match_dup 1) (const_int -1)))
25994 : 708775 : (clobber (reg:CC FLAGS_REG))])])
25995 : 708826 :
25996 : 873732 : ;; Non pairable "test imm, reg" instructions can be translated to
25997 : 721824 : ;; "and imm, reg" if reg dies. The "and" form is also shorter (one
25998 : 721824 : ;; byte opcode instead of two, have a short form for byte operands),
25999 : 839929 : ;; so do it for other CPUs as well. Given that the value was dead,
26000 : 736495 : ;; this should not create any new dependencies. Pass on the sub-word
26001 : 29661196 : ;; versions if we're concerned about partial register stalls.
26002 : 759466 :
26003 : 29587199 : (define_peephole2
26004 : 29660666 : [(set (match_operand 0 "flags_reg_operand")
26005 : 29638982 : (match_operator 1 "compare_operator"
26006 : 550758 : [(and:SI (match_operand:SI 2 "register_operand")
26007 : 707072 : (match_operand:SI 3 "immediate_operand"))
26008 : 29619558 : (const_int 0)]))]
26009 : 756300 : "ix86_match_ccmode (insn, CCNOmode)
26010 : 734616 : && (REGNO (operands[2]) != AX_REG
26011 : 732603 : || satisfies_constraint_K (operands[3]))
26012 : 720592 : && peep2_reg_dead_p (1, operands[2])"
26013 : 29608726 : [(parallel
26014 : 739820 : [(set (match_dup 0)
26015 : 4163135 : (match_op_dup 1 [(and:SI (match_dup 2) (match_dup 3))
26016 : 4163135 : (const_int 0)]))
26017 : 728680 : (set (match_dup 2)
26018 : 498818 : (and:SI (match_dup 2) (match_dup 3)))])])
26019 : 29581209 :
26020 : 29581209 : ;; We don't need to handle HImode case, because it will be promoted to SImode
26021 : 798200 : ;; on ! TARGET_PARTIAL_REG_STALL
26022 : 589946 :
26023 : 22248688 : (define_peephole2
26024 : 22299431 : [(set (match_operand 0 "flags_reg_operand")
26025 : 707072 : (match_operator 1 "compare_operator"
26026 : 260579 : [(and:QI (match_operand:QI 2 "register_operand")
26027 : 716175 : (match_operand:QI 3 "immediate_operand"))
26028 : 707069 : (const_int 0)]))]
26029 : 766444 : "! TARGET_PARTIAL_REG_STALL
26030 : 298343 : && ix86_match_ccmode (insn, CCNOmode)
26031 : 775550 : && REGNO (operands[2]) != AX_REG
26032 : 746786 : && peep2_reg_dead_p (1, operands[2])"
26033 : 716175 : [(parallel
26034 : 716175 : [(set (match_dup 0)
26035 : 723919 : (match_op_dup 1 [(and:QI (match_dup 2) (match_dup 3))
26036 : 723919 : (const_int 0)]))
26037 : 716175 : (set (match_dup 2)
26038 : 477207 : (and:QI (match_dup 2) (match_dup 3)))])])
26039 : 716175 :
26040 : 716175 : (define_peephole2
26041 : 716238 : [(set (match_operand 0 "flags_reg_operand")
26042 : 707069 : (match_operator 1 "compare_operator"
26043 : 716175 : [(and:QI
26044 : 811832 : (subreg:QI
26045 : 717370 : (match_operator:SWI248 4 "extract_operator"
26046 : 583165 : [(match_operand 2 "int248_register_operand")
26047 : 486376 : (const_int 8)
26048 : 496614 : (const_int 8)]) 0)
26049 : 496614 : (match_operand 3 "const_int_operand"))
26050 : 477207 : (const_int 0)]))]
26051 : 713350 : "! TARGET_PARTIAL_REG_STALL
26052 : 723588 : && ix86_match_ccmode (insn, CCNOmode)
26053 : 717307 : && REGNO (operands[2]) != AX_REG
26054 : 708123 : && peep2_reg_dead_p (1, operands[2])"
26055 : 732917 : [(parallel
26056 : 707461 : [(set (match_dup 0)
26057 : 707461 : (match_op_dup 1
26058 : 717307 : [(and:QI
26059 : 718331 : (subreg:QI
26060 : 477270 : (match_op_dup 4 [(match_dup 2)
26061 : 477270 : (const_int 8)
26062 : 718331 : (const_int 8)]) 0)
26063 : 996198 : (match_dup 3))
26064 : 708030 : (const_int 0)]))
26065 : 708030 : (set (zero_extract:SWI248 (match_dup 2)
26066 : 766332 : (const_int 8)
26067 : 707141 : (const_int 8))
26068 : 996266 : (subreg:SWI248
26069 : 707141 : (and:QI
26070 : 756162 : (subreg:QI
26071 : 996329 : (match_op_dup 4 [(match_dup 2)
26072 : 997383 : (const_int 8)
26073 : 707338 : (const_int 8)]) 0)
26074 : 755536 : (match_dup 3)) 0))])])
26075 : 477207 :
26076 : 985402 : ;; Don't do logical operations with memory inputs.
26077 : 985402 : (define_peephole2
26078 : 985402 : [(match_scratch:SWI 2 "<r>")
26079 : 985402 : (parallel [(set (match_operand:SWI 0 "register_operand")
26080 : 985402 : (match_operator:SWI 3 "arith_or_logical_operator"
26081 : 985402 : [(match_dup 0)
26082 : 985402 : (match_operand:SWI 1 "memory_operand")]))
26083 : 985402 : (clobber (reg:CC FLAGS_REG))])]
26084 : 723222 : "!(TARGET_READ_MODIFY || optimize_insn_for_size_p ())"
26085 : 985402 : [(set (match_dup 2) (match_dup 1))
26086 : 707073 : (parallel [(set (match_dup 0)
26087 : 985402 : (match_op_dup 3 [(match_dup 0) (match_dup 2)]))
26088 : 707073 : (clobber (reg:CC FLAGS_REG))])])
26089 : 707093 :
26090 : 707093 : (define_peephole2
26091 : 985422 : [(match_scratch:SWI 2 "<r>")
26092 : 2868678 : (parallel [(set (match_operand:SWI 0 "register_operand")
26093 : 2868678 : (match_operator:SWI 3 "arith_or_logical_operator"
26094 : 2590349 : [(match_operand:SWI 1 "memory_operand")
26095 : 709016 : (match_dup 0)]))
26096 : 2590349 : (clobber (reg:CC FLAGS_REG))])]
26097 : 707094 : "!(TARGET_READ_MODIFY || optimize_insn_for_size_p ())"
26098 : 707093 : [(set (match_dup 2) (match_dup 1))
26099 : 707093 : (parallel [(set (match_dup 0)
26100 : 229886 : (match_op_dup 3 [(match_dup 2) (match_dup 0)]))
26101 : 707093 : (clobber (reg:CC FLAGS_REG))])])
26102 : 707093 :
26103 : 707093 : ;; Prefer Load+RegOp to Mov+MemOp. Watch out for cases when
26104 : 229886 : ;; the memory address refers to the destination of the load!
26105 : 2663796 :
26106 : 707093 : (define_peephole2
26107 : 780540 : [(set (match_operand:SWI 0 "general_reg_operand")
26108 : 303333 : (match_operand:SWI 1 "general_reg_operand"))
26109 : 780540 : (parallel [(set (match_dup 0)
26110 : 780540 : (match_operator:SWI 3 "commutative_operator"
26111 : 707093 : [(match_dup 0)
26112 : 780459 : (match_operand:SWI 2 "memory_operand")]))
26113 : 780459 : (clobber (reg:CC FLAGS_REG))])]
26114 : 829633 : "REGNO (operands[0]) != REGNO (operands[1])
26115 : 708615 : && (<MODE>mode != QImode
26116 : 748923 : || any_QIreg_operand (operands[1], QImode))"
26117 : 707093 : [(set (match_dup 0) (match_dup 4))
26118 : 715888 : (parallel [(set (match_dup 0)
26119 : 715888 : (match_op_dup 3 [(match_dup 0) (match_dup 1)]))
26120 : 715888 : (clobber (reg:CC FLAGS_REG))])]
26121 : 756196 : {
26122 : 756196 : operands[4]
26123 : 756196 : = ix86_replace_reg_with_reg (operands[2], operands[0], operands[1]);
26124 : 72802560 : })
26125 : 707093 :
26126 : 34641359 : (define_peephole2
26127 : 34641359 : [(set (match_operand 0 "mmx_reg_operand")
26128 : 6096281 : (match_operand 1 "mmx_reg_operand"))
26129 : 756196 : (set (match_dup 0)
26130 : 36726523 : (match_operator 3 "commutative_operator"
26131 : 36677420 : [(match_dup 0)
26132 : 707093 : (match_operand 2 "memory_operand")]))]
26133 : 707094 : "REGNO (operands[0]) != REGNO (operands[1])"
26134 : 756197 : [(set (match_dup 0) (match_dup 2))
26135 : 756197 : (set (match_dup 0)
26136 : 756196 : (match_op_dup 3 [(match_dup 0) (match_dup 1)]))])
26137 : 756196 :
26138 : 707093 : (define_peephole2
26139 : 526310 : [(set (match_operand 0 "sse_reg_operand")
26140 : 477207 : (match_operand 1 "sse_reg_operand"))
26141 : 36677420 : (set (match_dup 0)
26142 : 36677420 : (match_operator 3 "commutative_operator"
26143 : 707093 : [(match_dup 0)
26144 : 1010532 : (match_operand 2 "memory_operand")]))]
26145 : 1023166 : "REGNO (operands[0]) != REGNO (operands[1])
26146 : 1059635 : /* Punt if operands[1] is %[xy]mm16+ and AVX512BW is not enabled,
26147 : 756196 : as EVEX encoded vpadd[bw], vpmullw, vpmin[su][bw] and vpmax[su][bw]
26148 : 756196 : instructions require AVX512BW and AVX512VL, but with the original
26149 : 707093 : instructions it might require just AVX512VL.
26150 : 707093 : AVX512VL is implied from TARGET_HARD_REGNO_MODE_OK. */
26151 : 719727 : && (!EXT_REX_SSE_REGNO_P (REGNO (operands[1]))
26152 : 707093 : || TARGET_AVX512BW
26153 : 707093 : || GET_MODE_SIZE (GET_MODE_INNER (GET_MODE (operands[0]))) > 2
26154 : 754744 : || logic_operator (operands[3], VOIDmode))"
26155 : 707093 : [(set (match_dup 0) (match_dup 2))
26156 : 767378 : (set (match_dup 0)
26157 : 290183 : (match_op_dup 3 [(match_dup 0) (match_dup 1)]))])
26158 : 719715 :
26159 : 707081 : ; Don't do logical operations with memory outputs
26160 : 707081 : ;
26161 : 277537 : ; These two don't make sense for PPro/PII -- we're expanding a 4-uop
26162 : 36712425 : ; instruction into two 1-uop insns plus a 2-uop insn. That last has
26163 : 36664822 : ; the same decoder scheduling characteristics as the original.
26164 : 754732 :
26165 : 23733699 : (define_peephole2
26166 : 707081 : [(match_scratch:SWI 2 "<r>")
26167 : 860649 : (parallel [(set (match_operand:SWI 0 "memory_operand")
26168 : 860649 : (match_operator:SWI 3 "arith_or_logical_operator"
26169 : 860649 : [(match_dup 0)
26170 : 707081 : (match_operand:SWI 1 "<nonmemory_operand>")]))
26171 : 707081 : (clobber (reg:CC FLAGS_REG))])]
26172 : 811479 : "!(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())"
26173 : 707081 : [(set (match_dup 2) (match_dup 0))
26174 : 707081 : (parallel [(set (match_dup 2)
26175 : 707081 : (match_op_dup 3 [(match_dup 2) (match_dup 1)]))
26176 : 707081 : (clobber (reg:CC FLAGS_REG))])
26177 : 707081 : (set (match_dup 0) (match_dup 2))])
26178 : 707081 :
26179 : 707081 : (define_peephole2
26180 : 791668 : [(match_scratch:SWI 2 "<r>")
26181 : 780528 : (parallel [(set (match_operand:SWI 0 "memory_operand")
26182 : 791668 : (match_operator:SWI 3 "arith_or_logical_operator"
26183 : 718221 : [(match_operand:SWI 1 "<nonmemory_operand>")
26184 : 790565 : (match_dup 0)]))
26185 : 241026 : (clobber (reg:CC FLAGS_REG))])]
26186 : 254763 : "!(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())"
26187 : 315576 : [(set (match_dup 2) (match_dup 0))
26188 : 436527 : (parallel [(set (match_dup 2)
26189 : 242129 : (match_op_dup 3 [(match_dup 1) (match_dup 2)]))
26190 : 254763 : (clobber (reg:CC FLAGS_REG))])
26191 : 4148367 : (set (match_dup 0) (match_dup 2))])
26192 : 3917465 :
26193 : 243623 : ;; Attempt to use arith or logical operations with memory outputs with
26194 : 4124593 : ;; setting of flags.
26195 : 243623 : (define_peephole2
26196 : 3818936 : [(set (match_operand:SWI 0 "register_operand")
26197 : 4048822 : (match_operand:SWI 1 "memory_operand"))
26198 : 4037291 : (parallel [(set (match_dup 0)
26199 : 4038785 : (match_operator:SWI 3 "plusminuslogic_operator"
26200 : 243623 : [(match_dup 0)
26201 : 376893 : (match_operand:SWI 2 "<nonmemory_operand>")]))
26202 : 376893 : (clobber (reg:CC FLAGS_REG))])
26203 : 376893 : (set (match_dup 1) (match_dup 0))
26204 : 243623 : (set (reg FLAGS_REG) (compare (match_dup 0) (const_int 0)))]
26205 : 231035 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
26206 : 243679 : && peep2_reg_dead_p (4, operands[0])
26207 : 231031 : && !reg_overlap_mentioned_p (operands[0], operands[1])
26208 : 231031 : && !reg_overlap_mentioned_p (operands[0], operands[2])
26209 : 230989 : && (<MODE>mode != QImode
26210 : 254763 : || immediate_operand (operands[2], QImode)
26211 : 254763 : || any_QIreg_operand (operands[2], QImode))
26212 : 254805 : && ix86_match_ccmode (peep2_next_insn (3),
26213 : 231031 : (GET_CODE (operands[3]) == PLUS
26214 : 2131 : || GET_CODE (operands[3]) == MINUS)
26215 : 230003 : ? CCGOCmode : CCNOmode)"
26216 : 230003 : [(parallel [(set (match_dup 4) (match_dup 6))
26217 : 236880 : (set (match_dup 1) (match_dup 5))])]
26218 : 24985 : {
26219 : 236876 : operands[4] = SET_DEST (PATTERN (peep2_next_insn (3)));
26220 : 253726 : operands[5]
26221 : 253726 : = gen_rtx_fmt_ee (GET_CODE (operands[3]), GET_MODE (operands[3]),
26222 : 42220 : copy_rtx (operands[1]),
26223 : 269251 : operands[2]);
26224 : 270497 : operands[6]
26225 : 247337 : = gen_rtx_COMPARE (GET_MODE (operands[4]),
26226 : 229999 : copy_rtx (operands[5]),
26227 : 246960 : const0_rtx);
26228 : 246960 : })
26229 : 246960 :
26230 : 246960 : ;; Likewise for cmpelim optimized pattern.
26231 : 246960 : (define_peephole2
26232 : 246960 : [(set (match_operand:SWI 0 "register_operand")
26233 : 246960 : (match_operand:SWI 1 "memory_operand"))
26234 : 247180 : (parallel [(set (reg FLAGS_REG)
26235 : 17953 : (compare (match_operator:SWI 3 "plusminuslogic_operator"
26236 : 17953 : [(match_dup 0)
26237 : 230110 : (match_operand:SWI 2 "<nonmemory_operand>")])
26238 : 230330 : (const_int 0)))
26239 : 230330 : (set (match_dup 0) (match_dup 3))])
26240 : 1323 : (set (match_dup 1) (match_dup 0))]
26241 : 230420 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
26242 : 230729 : && peep2_reg_dead_p (3, operands[0])
26243 : 230703 : && !reg_overlap_mentioned_p (operands[0], operands[1])
26244 : 230703 : && !reg_overlap_mentioned_p (operands[0], operands[2])
26245 : 230483 : && ix86_match_ccmode (peep2_next_insn (1),
26246 : 1476 : (GET_CODE (operands[3]) == PLUS
26247 : 230483 : || GET_CODE (operands[3]) == MINUS)
26248 : 247046 : ? CCGOCmode : CCNOmode)"
26249 : 246960 : [(parallel [(set (match_dup 4) (match_dup 6))
26250 : 18240 : (set (match_dup 1) (match_dup 5))])]
26251 : 230397 : {
26252 : 230770 : operands[4] = SET_DEST (XVECEXP (PATTERN (peep2_next_insn (1)), 0, 0));
26253 : 230856 : operands[5]
26254 : 230483 : = gen_rtx_fmt_ee (GET_CODE (operands[3]), GET_MODE (operands[3]),
26255 : 230243 : copy_rtx (operands[1]), operands[2]);
26256 : 231381 : operands[6]
26257 : 230616 : = gen_rtx_COMPARE (GET_MODE (operands[4]), copy_rtx (operands[5]),
26258 : 230502 : const0_rtx);
26259 : 230502 : })
26260 : 230502 :
26261 : 1495 : ;; Likewise for instances where we have a lea pattern.
26262 : 230875 : (define_peephole2
26263 : 230875 : [(set (match_operand:SWI 0 "register_operand")
26264 : 230502 : (match_operand:SWI 1 "memory_operand"))
26265 : 230110 : (set (match_operand:<LEAMODE> 3 "register_operand")
26266 : 230502 : (plus:<LEAMODE> (match_operand:<LEAMODE> 4 "register_operand")
26267 : 1868 : (match_operand:<LEAMODE> 2 "<nonmemory_operand>")))
26268 : 230875 : (set (match_dup 1) (match_operand:SWI 5 "register_operand"))
26269 : 230110 : (set (reg FLAGS_REG) (compare (match_dup 5) (const_int 0)))]
26270 : 230122 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
26271 : 1180 : && REGNO (operands[4]) == REGNO (operands[0])
26272 : 230952 : && REGNO (operands[5]) == REGNO (operands[3])
26273 : 230952 : && peep2_reg_dead_p (4, operands[3])
26274 : 230933 : && ((REGNO (operands[0]) == REGNO (operands[3]))
26275 : 230933 : || peep2_reg_dead_p (2, operands[0]))
26276 : 230531 : && !reg_overlap_mentioned_p (operands[0], operands[1])
26277 : 230550 : && !reg_overlap_mentioned_p (operands[3], operands[1])
26278 : 230158 : && !reg_overlap_mentioned_p (operands[0], operands[2])
26279 : 230122 : && (<MODE>mode != QImode
26280 : 230122 : || immediate_operand (operands[2], QImode)
26281 : 230110 : || any_QIreg_operand (operands[2], QImode))
26282 : 1635 : && ix86_match_ccmode (peep2_next_insn (3), CCGOCmode)"
26283 : 1476 : [(parallel [(set (match_dup 6) (match_dup 8))
26284 : 1529 : (set (match_dup 1) (match_dup 7))])]
26285 : 230080 : {
26286 : 230080 : operands[6] = SET_DEST (PATTERN (peep2_next_insn (3)));
26287 : 1151 : operands[7]
26288 : 1151 : = gen_rtx_PLUS (<MODE>mode,
26289 : 229989 : copy_rtx (operands[1]),
26290 : 25409186 : gen_lowpart (<MODE>mode, operands[2]));
26291 : 1199 : operands[8]
26292 : 3742580 : = gen_rtx_COMPARE (GET_MODE (operands[6]),
26293 : 3972448 : copy_rtx (operands[7]),
26294 : 3972448 : const0_rtx);
26295 : 231019 : })
26296 : 231019 :
26297 : 231019 : (define_peephole2
26298 : 231067 : [(parallel [(set (match_operand:SWI 0 "register_operand")
26299 : 231067 : (match_operator:SWI 2 "plusminuslogic_operator"
26300 : 231007 : [(match_dup 0)
26301 : 229969 : (match_operand:SWI 1 "memory_operand")]))
26302 : 1488 : (clobber (reg:CC FLAGS_REG))])
26303 : 1768 : (set (match_dup 1) (match_dup 0))
26304 : 2172 : (set (reg FLAGS_REG) (compare (match_dup 0) (const_int 0)))]
26305 : 207190 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
26306 : 1543 : && COMMUTATIVE_ARITH_P (operands[2])
26307 : 1816 : && peep2_reg_dead_p (3, operands[0])
26308 : 1768 : && !reg_overlap_mentioned_p (operands[0], operands[1])
26309 : 1140 : && ix86_match_ccmode (peep2_next_insn (2),
26310 : 1816 : GET_CODE (operands[2]) == PLUS
26311 : 1768 : ? CCGOCmode : CCNOmode)"
26312 : 1103 : [(parallel [(set (match_dup 3) (match_dup 5))
26313 : 1768 : (set (match_dup 1) (match_dup 4))])]
26314 : 1816 : {
26315 : 1768 : operands[3] = SET_DEST (PATTERN (peep2_next_insn (2)));
26316 : 1817 : operands[4]
26317 : 1104 : = gen_rtx_fmt_ee (GET_CODE (operands[2]), GET_MODE (operands[2]),
26318 : 1104 : copy_rtx (operands[1]),
26319 : 1769 : operands[0]);
26320 : 1769 : operands[5]
26321 : 1768 : = gen_rtx_COMPARE (GET_MODE (operands[3]),
26322 : 1022 : copy_rtx (operands[4]),
26323 : 842 : const0_rtx);
26324 : 794 : })
26325 : 794 :
26326 : 794 : ;; Likewise for cmpelim optimized pattern.
26327 : 794 : (define_peephole2
26328 : 129 : [(parallel [(set (reg FLAGS_REG)
26329 : 794 : (compare (match_operator:SWI 2 "plusminuslogic_operator"
26330 : 830 : [(match_operand:SWI 0 "register_operand")
26331 : 794 : (match_operand:SWI 1 "memory_operand")])
26332 : 830 : (const_int 0)))
26333 : 794 : (set (match_dup 0) (match_dup 2))])
26334 : 830 : (set (match_dup 1) (match_dup 0))]
26335 : 687 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
26336 : 107 : && COMMUTATIVE_ARITH_P (operands[2])
26337 : 901 : && peep2_reg_dead_p (2, operands[0])
26338 : 889 : && !reg_overlap_mentioned_p (operands[0], operands[1])
26339 : 853 : && ix86_match_ccmode (peep2_next_insn (0),
26340 : 853 : GET_CODE (operands[2]) == PLUS
26341 : 794 : ? CCGOCmode : CCNOmode)"
26342 : 1216 : [(parallel [(set (match_dup 3) (match_dup 5))
26343 : 842 : (set (match_dup 1) (match_dup 4))])]
26344 : 878 : {
26345 : 188 : operands[3] = SET_DEST (XVECEXP (PATTERN (peep2_next_insn (0)), 0, 0));
26346 : 662 : operands[4]
26347 : 592 : = gen_rtx_fmt_ee (GET_CODE (operands[2]), GET_MODE (operands[2]),
26348 : 1198 : copy_rtx (operands[1]), operands[0]);
26349 : 661 : operands[5]
26350 : 1472 : = gen_rtx_COMPARE (GET_MODE (operands[3]), copy_rtx (operands[4]),
26351 : 129 : const0_rtx);
26352 : 665 : })
26353 : 816 :
26354 : 794 : (define_peephole2
26355 : 875 : [(set (match_operand:SWI12 0 "register_operand")
26356 : 875 : (match_operand:SWI12 1 "memory_operand"))
26357 : 210 : (parallel [(set (match_operand:SI 4 "register_operand")
26358 : 875 : (match_operator:SI 3 "plusminuslogic_operator"
26359 : 875 : [(match_dup 4)
26360 : 794 : (match_operand:SI 2 "nonmemory_operand")]))
26361 : 129 : (clobber (reg:CC FLAGS_REG))])
26362 : 22 : (set (match_dup 1) (match_dup 0))
26363 : 665 : (set (reg FLAGS_REG) (compare (match_dup 0) (const_int 0)))]
26364 : 816 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
26365 : 907 : && REGNO (operands[0]) == REGNO (operands[4])
26366 : 301 : && peep2_reg_dead_p (4, operands[0])
26367 : 940 : && (<MODE>mode != QImode
26368 : 881 : || immediate_operand (operands[2], SImode)
26369 : 795 : || any_QIreg_operand (operands[2], SImode))
26370 : 233 : && !reg_overlap_mentioned_p (operands[0], operands[1])
26371 : 898 : && !reg_overlap_mentioned_p (operands[0], operands[2])
26372 : 898 : && ix86_match_ccmode (peep2_next_insn (3),
26373 : 957 : (GET_CODE (operands[3]) == PLUS
26374 : 957 : || GET_CODE (operands[3]) == MINUS)
26375 : 853 : ? CCGOCmode : CCNOmode)"
26376 : 0 : [(parallel [(set (match_dup 5) (match_dup 7))
26377 : 769 : (set (match_dup 1) (match_dup 6))])]
26378 : 898 : {
26379 : 1002 : operands[5] = SET_DEST (PATTERN (peep2_next_insn (3)));
26380 : 1002 : operands[6]
26381 : 935 : = gen_rtx_fmt_ee (GET_CODE (operands[3]), <MODE>mode,
26382 : 794 : copy_rtx (operands[1]),
26383 : 2551 : gen_lowpart (<MODE>mode, operands[2]));
26384 : 2619 : operands[7]
26385 : 1866 : = gen_rtx_COMPARE (GET_MODE (operands[5]),
26386 : 1049 : copy_rtx (operands[6]),
26387 : 1049 : const0_rtx);
26388 : 1049 : })
26389 : 925 :
26390 : 962 : ;; peephole2 comes before regcprop, so deal also with a case that
26391 : 925 : ;; would be cleaned up by regcprop.
26392 : 1049 : (define_peephole2
26393 : 925 : [(set (match_operand:SWI 0 "register_operand")
26394 : 1012 : (match_operand:SWI 1 "memory_operand"))
26395 : 925 : (parallel [(set (match_dup 0)
26396 : 364 : (match_operator:SWI 3 "plusminuslogic_operator"
26397 : 364 : [(match_dup 0)
26398 : 1029 : (match_operand:SWI 2 "<nonmemory_operand>")]))
26399 : 1029 : (clobber (reg:CC FLAGS_REG))])
26400 : 1029 : (set (match_operand:SWI 4 "register_operand") (match_dup 0))
26401 : 1029 : (set (match_dup 1) (match_dup 4))
26402 : 1029 : (set (reg FLAGS_REG) (compare (match_dup 4) (const_int 0)))]
26403 : 1029 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
26404 : 925 : && peep2_reg_dead_p (3, operands[0])
26405 : 1029 : && peep2_reg_dead_p (5, operands[4])
26406 : 925 : && !reg_overlap_mentioned_p (operands[0], operands[1])
26407 : 7906 : && !reg_overlap_mentioned_p (operands[0], operands[2])
26408 : 7802 : && !reg_overlap_mentioned_p (operands[4], operands[1])
26409 : 7802 : && (<MODE>mode != QImode
26410 : 7802 : || immediate_operand (operands[2], QImode)
26411 : 7802 : || any_QIreg_operand (operands[2], QImode))
26412 : 7802 : && ix86_match_ccmode (peep2_next_insn (4),
26413 : 7241 : (GET_CODE (operands[3]) == PLUS
26414 : 7241 : || GET_CODE (operands[3]) == MINUS)
26415 : 925 : ? CCGOCmode : CCNOmode)"
26416 : 18311 : [(parallel [(set (match_dup 5) (match_dup 7))
26417 : 925 : (set (match_dup 1) (match_dup 6))])]
26418 : 925 : {
26419 : 925 : operands[5] = SET_DEST (PATTERN (peep2_next_insn (4)));
26420 : 1508 : operands[6]
26421 : 1525 : = gen_rtx_fmt_ee (GET_CODE (operands[3]), GET_MODE (operands[3]),
26422 : 925 : copy_rtx (operands[1]),
26423 : 1354 : operands[2]);
26424 : 23573267 : operands[7]
26425 : 23523997 : = gen_rtx_COMPARE (GET_MODE (operands[5]),
26426 : 21527149 : copy_rtx (operands[6]),
26427 : 2097137 : const0_rtx);
26428 : 2047472 : })
26429 : 206478 :
26430 : 1258 : (define_peephole2
26431 : 1241 : [(set (match_operand:SWI12 0 "register_operand")
26432 : 205035 : (match_operand:SWI12 1 "memory_operand"))
26433 : 1066 : (parallel [(set (match_operand:SI 4 "register_operand")
26434 : 1083 : (match_operator:SI 3 "plusminuslogic_operator"
26435 : 205111 : [(match_dup 4)
26436 : 925 : (match_operand:SI 2 "nonmemory_operand")]))
26437 : 162035 : (clobber (reg:CC FLAGS_REG))])
26438 : 162035 : (set (match_operand:SWI12 5 "register_operand") (match_dup 0))
26439 : 162035 : (set (match_dup 1) (match_dup 5))
26440 : 925 : (set (reg FLAGS_REG) (compare (match_dup 5) (const_int 0)))]
26441 : 796 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
26442 : 794 : && REGNO (operands[0]) == REGNO (operands[4])
26443 : 161904 : && peep2_reg_dead_p (3, operands[0])
26444 : 323014 : && peep2_reg_dead_p (5, operands[5])
26445 : 794 : && (<MODE>mode != QImode
26446 : 794 : || immediate_operand (operands[2], SImode)
26447 : 794 : || any_QIreg_operand (operands[2], SImode))
26448 : 161904 : && !reg_overlap_mentioned_p (operands[0], operands[1])
26449 : 161904 : && !reg_overlap_mentioned_p (operands[0], operands[2])
26450 : 148160 : && !reg_overlap_mentioned_p (operands[5], operands[1])
26451 : 15366 : && ix86_match_ccmode (peep2_next_insn (4),
26452 : 15366 : (GET_CODE (operands[3]) == PLUS
26453 : 15366 : || GET_CODE (operands[3]) == MINUS)
26454 : 1208 : ? CCGOCmode : CCNOmode)"
26455 : 7758 : [(parallel [(set (match_dup 6) (match_dup 8))
26456 : 6125 : (set (match_dup 1) (match_dup 7))])]
26457 : 6125 : {
26458 : 1208 : operands[6] = SET_DEST (PATTERN (peep2_next_insn (4)));
26459 : 1208 : operands[7]
26460 : 1208 : = gen_rtx_fmt_ee (GET_CODE (operands[3]), <MODE>mode,
26461 : 1208 : copy_rtx (operands[1]),
26462 : 1208 : gen_lowpart (<MODE>mode, operands[2]));
26463 : 4709 : operands[8]
26464 : 4709 : = gen_rtx_COMPARE (GET_MODE (operands[6]),
26465 : 1208 : copy_rtx (operands[7]),
26466 : 4709 : const0_rtx);
26467 : 410724 : })
26468 : 414225 :
26469 : 1208 : ;; Likewise for cmpelim optimized pattern.
26470 : 2111 : (define_peephole2
26471 : 2111 : [(set (match_operand:SWI 0 "register_operand")
26472 : 1208 : (match_operand:SWI 1 "memory_operand"))
26473 : 2111 : (parallel [(set (reg FLAGS_REG)
26474 : 1208 : (compare (match_operator:SWI 3 "plusminuslogic_operator"
26475 : 1208 : [(match_dup 0)
26476 : 1208 : (match_operand:SWI 2 "<nonmemory_operand>")])
26477 : 1208 : (const_int 0)))
26478 : 1208 : (set (match_dup 0) (match_dup 3))])
26479 : 1208 : (set (match_operand:SWI 4 "register_operand") (match_dup 0))
26480 : 1208 : (set (match_dup 1) (match_dup 4))]
26481 : 1208 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
26482 : 1208 : && peep2_reg_dead_p (3, operands[0])
26483 : 1208 : && peep2_reg_dead_p (4, operands[4])
26484 : 1208 : && !reg_overlap_mentioned_p (operands[0], operands[1])
26485 : 1208 : && !reg_overlap_mentioned_p (operands[0], operands[2])
26486 : 1208 : && !reg_overlap_mentioned_p (operands[4], operands[1])
26487 : 1208 : && ix86_match_ccmode (peep2_next_insn (1),
26488 : 1208 : (GET_CODE (operands[3]) == PLUS
26489 : 1208 : || GET_CODE (operands[3]) == MINUS)
26490 : 1208 : ? CCGOCmode : CCNOmode)"
26491 : 1341 : [(parallel [(set (match_dup 5) (match_dup 7))
26492 : 1208 : (set (match_dup 1) (match_dup 6))])]
26493 : 1208 : {
26494 : 1208 : operands[5] = SET_DEST (XVECEXP (PATTERN (peep2_next_insn (1)), 0, 0));
26495 : 2945 : operands[6]
26496 : 2945 : = gen_rtx_fmt_ee (GET_CODE (operands[3]), GET_MODE (operands[3]),
26497 : 2945 : copy_rtx (operands[1]), operands[2]);
26498 : 2945 : operands[7]
26499 : 1630576 : = gen_rtx_COMPARE (GET_MODE (operands[5]), copy_rtx (operands[6]),
26500 : 1631268 : const0_rtx);
26501 : 1631278 : })
26502 : 1900 :
26503 : 1208 : ;; Special cases for xor, where (x ^= y) != 0 is (misoptimized)
26504 : 1208 : ;; into x = z; x ^= y; x != z
26505 : 1208 : (define_peephole2
26506 : 1208 : [(set (match_operand:SWI 0 "register_operand")
26507 : 1208 : (match_operand:SWI 1 "memory_operand"))
26508 : 1208 : (set (match_operand:SWI 3 "register_operand") (match_dup 0))
26509 : 1208 : (parallel [(set (match_operand:SWI 4 "register_operand")
26510 : 1208 : (xor:SWI (match_dup 4)
26511 : 1208 : (match_operand:SWI 2 "<nonmemory_operand>")))
26512 : 1208 : (clobber (reg:CC FLAGS_REG))])
26513 : 1208 : (set (match_dup 1) (match_dup 4))
26514 : 1208 : (set (reg:CCZ FLAGS_REG)
26515 : 1208 : (compare:CCZ (match_operand:SWI 5 "register_operand")
26516 : 1208 : (match_operand:SWI 6 "<nonmemory_operand>")))]
26517 : 1218 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
26518 : 1218 : && (REGNO (operands[4]) == REGNO (operands[0])
26519 : 1218 : || REGNO (operands[4]) == REGNO (operands[3]))
26520 : 1228 : && (rtx_equal_p (operands[REGNO (operands[4]) == REGNO (operands[0])
26521 : 1218 : ? 3 : 0], operands[5])
26522 : 1218 : ? rtx_equal_p (operands[2], operands[6])
26523 : 1208 : : rtx_equal_p (operands[2], operands[5])
26524 : 1208 : && rtx_equal_p (operands[REGNO (operands[4]) == REGNO (operands[0])
26525 : 1208 : ? 3 : 0], operands[6]))
26526 : 1212 : && peep2_reg_dead_p (4, operands[4])
26527 : 1216 : && peep2_reg_dead_p (5, operands[REGNO (operands[4]) == REGNO (operands[0])
26528 : 1212 : ? 3 : 0])
26529 : 1212 : && !reg_overlap_mentioned_p (operands[0], operands[1])
26530 : 1212 : && !reg_overlap_mentioned_p (operands[0], operands[2])
26531 : 1212 : && !reg_overlap_mentioned_p (operands[3], operands[0])
26532 : 1212 : && !reg_overlap_mentioned_p (operands[3], operands[1])
26533 : 1212 : && !reg_overlap_mentioned_p (operands[3], operands[2])
26534 : 545 : && (<MODE>mode != QImode
26535 : 543 : || immediate_operand (operands[2], QImode)
26536 : 1208 : || any_QIreg_operand (operands[2], QImode))"
26537 : 1630574 : [(parallel [(set (match_dup 7) (match_dup 9))
26538 : 1210 : (set (match_dup 1) (match_dup 8))])]
26539 : 1214 : {
26540 : 1212 : operands[7] = SET_DEST (PATTERN (peep2_next_insn (4)));
26541 : 1229 : operands[8] = gen_rtx_XOR (<MODE>mode, copy_rtx (operands[1]),
26542 : 1225 : operands[2]);
26543 : 1233 : operands[9]
26544 : 1229 : = gen_rtx_COMPARE (GET_MODE (operands[7]),
26545 : 1225 : copy_rtx (operands[8]),
26546 : 1252 : const0_rtx);
26547 : 45539865 : })
26548 : 1208 :
26549 : 563 : (define_peephole2
26550 : 1188 : [(set (match_operand:SWI12 0 "register_operand")
26551 : 45539849 : (match_operand:SWI12 1 "memory_operand"))
26552 : 45539845 : (set (match_operand:SWI12 3 "register_operand") (match_dup 0))
26553 : 45539220 : (parallel [(set (match_operand:SI 4 "register_operand")
26554 : 45539845 : (xor:SI (match_dup 4)
26555 : 1192 : (match_operand:SI 2 "<nonmemory_operand>")))
26556 : 35978264 : (clobber (reg:CC FLAGS_REG))])
26557 : 35978264 : (set (match_dup 1) (match_operand:SWI12 5 "register_operand"))
26558 : 1188 : (set (reg:CCZ FLAGS_REG)
26559 : 1192 : (compare:CCZ (match_operand:SWI12 6 "register_operand")
26560 : 45539839 : (match_operand:SWI12 7 "<nonmemory_operand>")))]
26561 : 1209 : "(TARGET_READ_MODIFY_WRITE || optimize_insn_for_size_p ())
26562 : 45539856 : && (REGNO (operands[5]) == REGNO (operands[0])
26563 : 2448589 : || REGNO (operands[5]) == REGNO (operands[3]))
26564 : 45923077 : && REGNO (operands[5]) == REGNO (operands[4])
26565 : 1220 : && (rtx_equal_p (operands[REGNO (operands[5]) == REGNO (operands[0])
26566 : 1209 : ? 3 : 0], operands[6])
26567 : 1192 : ? (REG_P (operands[2])
26568 : 1209 : ? REG_P (operands[7]) && REGNO (operands[2]) == REGNO (operands[7])
26569 : 1207 : : rtx_equal_p (operands[2], operands[7]))
26570 : 1192 : : (rtx_equal_p (operands[REGNO (operands[5]) == REGNO (operands[0])
26571 : 1188 : ? 3 : 0], operands[7])
26572 : 1188 : && REG_P (operands[2])
26573 : 1188 : && REGNO (operands[2]) == REGNO (operands[6])))
26574 : 1198 : && peep2_reg_dead_p (4, operands[5])
26575 : 1208 : && peep2_reg_dead_p (5, operands[REGNO (operands[5]) == REGNO (operands[0])
26576 : 1202 : ? 3 : 0])
26577 : 1202 : && !reg_overlap_mentioned_p (operands[0], operands[1])
26578 : 1202 : && !reg_overlap_mentioned_p (operands[0], operands[2])
26579 : 1198 : && !reg_overlap_mentioned_p (operands[3], operands[0])
26580 : 1198 : && !reg_overlap_mentioned_p (operands[3], operands[1])
26581 : 1198 : && !reg_overlap_mentioned_p (operands[3], operands[2])
26582 : 1188 : && (<MODE>mode != QImode
26583 : 1196 : || immediate_operand (operands[2], SImode)
26584 : 1201 : || any_QIreg_operand (operands[2], SImode))"
26585 : 1195 : [(parallel [(set (match_dup 8) (match_dup 10))
26586 : 1210 : (set (match_dup 1) (match_dup 9))])]
26587 : 1220 : {
26588 : 1198 : operands[8] = SET_DEST (PATTERN (peep2_next_insn (4)));
26589 : 1198 : operands[9] = gen_rtx_XOR (<MODE>mode, copy_rtx (operands[1]),
26590 : 1200 : gen_lowpart (<MODE>mode, operands[2]));
26591 : 1188 : operands[10]
26592 : 655 : = gen_rtx_COMPARE (GET_MODE (operands[8]),
26593 : 868803 : copy_rtx (operands[9]),
26594 : 868815 : const0_rtx);
26595 : 868815 : })
26596 : 868272 :
26597 : 868807 : ;; Attempt to optimize away memory stores of values the memory already
26598 : 1196 : ;; has. See PR79593.
26599 : 672159 : (define_peephole2
26600 : 536134 : [(set (match_operand 0 "register_operand")
26601 : 536136 : (match_operand 1 "memory_operand"))
26602 : 543 : (set (match_operand 2 "memory_operand") (match_dup 0))]
26603 : 1744310 : "!MEM_VOLATILE_P (operands[1])
26604 : 1773212 : && !MEM_VOLATILE_P (operands[2])
26605 : 1757616 : && rtx_equal_p (operands[1], operands[2])
26606 : 2732 : && !reg_overlap_mentioned_p (operands[0], operands[2])"
26607 : 2049895 : [(set (match_dup 0) (match_dup 1))])
26608 : 2732 :
26609 : 2732 : ;; Attempt to always use XOR for zeroing registers (including FP modes).
26610 : 136342 : (define_peephole2
26611 : 543 : [(set (match_operand 0 "general_reg_operand")
26612 : 1996 : (match_operand 1 "const0_operand"))]
26613 : 2673139 : "GET_MODE_SIZE (GET_MODE (operands[0])) <= UNITS_PER_WORD
26614 : 1337844 : && (! TARGET_USE_MOV0 || optimize_insn_for_size_p ())
26615 : 1336401 : && peep2_regno_dead_p (0, FLAGS_REG)"
26616 : 1996 : [(parallel [(set (match_dup 0) (const_int 0))
26617 : 1996 : (clobber (reg:CC FLAGS_REG))])]
26618 : 2642349 : "operands[0] = gen_lowpart (word_mode, operands[0]);")
26619 : 1321456 :
26620 : 231763 : (define_peephole2
26621 : 1321879 : [(set (strict_low_part (match_operand:SWI12 0 "general_reg_operand"))
26622 : 1552527 : (const_int 0))]
26623 : 27443061 : "(! TARGET_USE_MOV0 || optimize_insn_for_size_p ())
26624 : 28198878 : && peep2_regno_dead_p (0, FLAGS_REG)"
26625 : 27779026 : [(parallel [(set (strict_low_part (match_dup 0)) (const_int 0))
26626 : 201008 : (clobber (reg:CC FLAGS_REG))])])
26627 : 202404 :
26628 : 1321630 : ;; For HI, SI and DI modes, or $-1,reg is smaller than mov $-1,reg.
26629 : 1549020 : (define_peephole2
26630 : 930 : [(set (match_operand:SWI248 0 "general_reg_operand")
26631 : 236703 : (const_int -1))]
26632 : 133791 : "(TARGET_MOVE_M1_VIA_OR || optimize_insn_for_size_p ())
26633 : 44289 : && peep2_regno_dead_p (0, FLAGS_REG)"
26634 : 7326 : [(parallel [(set (match_dup 0) (const_int -1))
26635 : 5145 : (clobber (reg:CC FLAGS_REG))])]
26636 : 71907 : {
26637 : 55482 : if (<MODE_SIZE> < GET_MODE_SIZE (SImode))
26638 : 22657 : operands[0] = gen_lowpart (SImode, operands[0]);
26639 : 23464 : })
26640 : 1711 :
26641 : 15061 : ;; Attempt to convert simple lea to add/shift.
26642 : 122500 : ;; These can be created by move expanders.
26643 : 121630 : ;; Disable PLUS peepholes on TARGET_OPT_AGU, since all
26644 : 152203 : ;; relevant lea instructions were already split.
26645 : 5542 :
26646 : 12472060 : (define_peephole2
26647 : 1135 : [(set (match_operand:SWI48 0 "register_operand")
26648 : 5257 : (plus:SWI48 (match_dup 0)
26649 : 30537 : (match_operand:SWI48 1 "<nonmemory_operand>")))]
26650 : 12514523 : "!TARGET_OPT_AGU
26651 : 35259 : && peep2_regno_dead_p (0, FLAGS_REG)"
26652 : 5085121 : [(parallel [(set (match_dup 0) (plus:SWI48 (match_dup 0) (match_dup 1)))
26653 : 5084988 : (clobber (reg:CC FLAGS_REG))])])
26654 : 15639 :
26655 : 15639 : (define_peephole2
26656 : 1428544 : [(set (match_operand:SWI48 0 "register_operand")
26657 : 150305 : (plus:SWI48 (match_operand:SWI48 1 "<nonmemory_operand>")
26658 : 1321330 : (match_dup 0)))]
26659 : 1364096 : "!TARGET_OPT_AGU
26660 : 1364020 : && peep2_regno_dead_p (0, FLAGS_REG)"
26661 : 1215138 : [(parallel [(set (match_dup 0) (plus:SWI48 (match_dup 0) (match_dup 1)))
26662 : 1851911 : (clobber (reg:CC FLAGS_REG))])])
26663 : 600115 :
26664 : 15506 : (define_peephole2
26665 : 15732 : [(set (match_operand:DI 0 "register_operand")
26666 : 1459823 : (zero_extend:DI
26667 : 1466481 : (plus:SI (match_operand:SI 1 "register_operand")
26668 : 1459916 : (match_operand:SI 2 "nonmemory_operand"))))]
26669 : 42949 : "TARGET_64BIT && !TARGET_OPT_AGU
26670 : 33374 : && REGNO (operands[0]) == REGNO (operands[1])
26671 : 1459415 : && peep2_regno_dead_p (0, FLAGS_REG)"
26672 : 1445343 : [(parallel [(set (match_dup 0)
26673 : 8856 : (zero_extend:DI (plus:SI (match_dup 1) (match_dup 2))))
26674 : 3173 : (clobber (reg:CC FLAGS_REG))])])
26675 : 8816 :
26676 : 15732 : (define_peephole2
26677 : 15648 : [(set (match_operand:DI 0 "register_operand")
26678 : 41296 : (zero_extend:DI
26679 : 3191 : (plus:SI (match_operand:SI 1 "nonmemory_operand")
26680 : 26102 : (match_operand:SI 2 "register_operand"))))]
26681 : 3204 : "TARGET_64BIT && !TARGET_OPT_AGU
26682 : 3204 : && REGNO (operands[0]) == REGNO (operands[2])
26683 : 427 : && peep2_regno_dead_p (0, FLAGS_REG)"
26684 : 44455 : [(parallel [(set (match_dup 0)
26685 : 492 : (zero_extend:DI (plus:SI (match_dup 2) (match_dup 1))))
26686 : 492 : (clobber (reg:CC FLAGS_REG))])])
26687 : 436 :
26688 : 595 : (define_peephole2
26689 : 18766 : [(set (match_operand:SWI48 0 "register_operand")
26690 : 539 : (mult:SWI48 (match_dup 0)
26691 : 18836 : (match_operand:SWI48 1 "const_int_operand")))]
26692 : 18823 : "pow2p_hwi (INTVAL (operands[1]))
26693 : 18823 : && peep2_regno_dead_p (0, FLAGS_REG)"
26694 : 18624 : [(parallel [(set (match_dup 0) (ashift:SWI48 (match_dup 0) (match_dup 1)))
26695 : 18794 : (clobber (reg:CC FLAGS_REG))])]
26696 : 18970 : "operands[1] = GEN_INT (exact_log2 (INTVAL (operands[1])));")
26697 : 306 :
26698 : 316 : (define_peephole2
26699 : 390 : [(set (match_operand:DI 0 "register_operand")
26700 : 390 : (zero_extend:DI
26701 : 382 : (mult:SI (match_operand:SI 1 "register_operand")
26702 : 400 : (match_operand:SI 2 "const_int_operand"))))]
26703 : 21371 : "TARGET_64BIT
26704 : 21297 : && pow2p_hwi (INTVAL (operands[2]))
26705 : 3000 : && REGNO (operands[0]) == REGNO (operands[1])
26706 : 2938 : && peep2_regno_dead_p (0, FLAGS_REG)"
26707 : 3000 : [(parallel [(set (match_dup 0)
26708 : 2938 : (zero_extend:DI (ashift:SI (match_dup 1) (match_dup 2))))
26709 : 2938 : (clobber (reg:CC FLAGS_REG))])]
26710 : 2996 : "operands[2] = GEN_INT (exact_log2 (INTVAL (operands[2])));")
26711 : 3004 :
26712 : 3004 : ;; The ESP adjustments can be done by the push and pop instructions. Resulting
26713 : 2938 : ;; code is shorter, since push is only 1 byte, while add imm, %esp is 3 bytes.
26714 : 2946 : ;; On many CPUs it is also faster, since special hardware to avoid esp
26715 : 175993 : ;; dependencies is present.
26716 : 175993 :
26717 : 175993 : ;; While some of these conversions may be done using splitters, we use
26718 : 176011 : ;; peepholes in order to allow combine_stack_adjustments pass to see
26719 : 175993 : ;; nonobfuscated RTL.
26720 : 2948 :
26721 : 101125 : ;; Convert prologue esp subtractions to push.
26722 : 2948 : ;; We need register to push. In order to keep verify_flow_info happy we have
26723 : 2996 : ;; two choices
26724 : 2978 : ;; - use scratch and clobber it in order to avoid dependencies
26725 : 2996 : ;; - use already live register
26726 : 2978 : ;; We can't use the second way right now, since there is no reliable way how to
26727 : 3026 : ;; verify that given register is live. First choice will also most likely in
26728 : 2930 : ;; fewer dependencies. On the place of esp adjustments it is very likely that
26729 : 2930 : ;; call clobbered registers are dead. We may want to use base pointer as an
26730 : 294 : ;; alternative when no register is available later.
26731 : 294 :
26732 : 2930 : (define_peephole2
26733 : 2930 : [(match_scratch:W 1 "r")
26734 : 2930 : (parallel [(set (reg:P SP_REG)
26735 : 2941 : (plus:P (reg:P SP_REG)
26736 : 4382 : (match_operand:P 0 "const_int_operand")))
26737 : 2941 : (clobber (reg:CC FLAGS_REG))
26738 : 4393 : (clobber (mem:BLK (scratch)))])]
26739 : 1896816 : "(TARGET_SINGLE_PUSH || optimize_insn_for_size_p ())
26740 : 289083 : && INTVAL (operands[0]) == -GET_MODE_SIZE (word_mode)
26741 : 1925467 : && !ix86_red_zone_used"
26742 : 2941 : [(clobber (match_dup 1))
26743 : 2930 : (parallel [(set (mem:W (pre_dec:P (reg:P SP_REG))) (match_dup 1))
26744 : 4393 : (clobber (mem:BLK (scratch)))])])
26745 : 2930 :
26746 : 4393 : (define_peephole2
26747 : 2941 : [(match_scratch:W 1 "r")
26748 : 2941 : (parallel [(set (reg:P SP_REG)
26749 : 2941 : (plus:P (reg:P SP_REG)
26750 : 2930 : (match_operand:P 0 "const_int_operand")))
26751 : 2941 : (clobber (reg:CC FLAGS_REG))
26752 : 2930 : (clobber (mem:BLK (scratch)))])]
26753 : 1833926 : "(TARGET_DOUBLE_PUSH || optimize_insn_for_size_p ())
26754 : 164732 : && INTVAL (operands[0]) == -2*GET_MODE_SIZE (word_mode)
26755 : 1835916 : && !ix86_red_zone_used"
26756 : 2930 : [(clobber (match_dup 1))
26757 : 2930 : (set (mem:W (pre_dec:P (reg:P SP_REG))) (match_dup 1))
26758 : 2930 : (parallel [(set (mem:W (pre_dec:P (reg:P SP_REG))) (match_dup 1))
26759 : 2930 : (clobber (mem:BLK (scratch)))])])
26760 : 2930 :
26761 : 2930 : ;; Convert esp subtractions to push.
26762 : 2930 : (define_peephole2
26763 : 2941 : [(match_scratch:W 1 "r")
26764 : 2941 : (parallel [(set (reg:P SP_REG)
26765 : 2941 : (plus:P (reg:P SP_REG)
26766 : 2930 : (match_operand:P 0 "const_int_operand")))
26767 : 5716 : (clobber (reg:CC FLAGS_REG))])]
26768 : 2340329 : "(TARGET_SINGLE_PUSH || optimize_insn_for_size_p ())
26769 : 467370 : && INTVAL (operands[0]) == -GET_MODE_SIZE (word_mode)
26770 : 2353870 : && !ix86_red_zone_used"
26771 : 5716 : [(clobber (match_dup 1))
26772 : 2930 : (set (mem:W (pre_dec:P (reg:P SP_REG))) (match_dup 1))])
26773 : 5716 :
26774 : 5716 : (define_peephole2
26775 : 5716 : [(match_scratch:W 1 "r")
26776 : 5716 : (parallel [(set (reg:P SP_REG)
26777 : 2930 : (plus:P (reg:P SP_REG)
26778 : 2930 : (match_operand:P 0 "const_int_operand")))
26779 : 5716 : (clobber (reg:CC FLAGS_REG))])]
26780 : 2293797 : "(TARGET_DOUBLE_PUSH || optimize_insn_for_size_p ())
26781 : 372108 : && INTVAL (operands[0]) == -2*GET_MODE_SIZE (word_mode)
26782 : 2319343 : && !ix86_red_zone_used"
26783 : 2930 : [(clobber (match_dup 1))
26784 : 2636 : (set (mem:W (pre_dec:P (reg:P SP_REG))) (match_dup 1))
26785 : 2930 : (set (mem:W (pre_dec:P (reg:P SP_REG))) (match_dup 1))])
26786 : 2930 :
26787 : 2930 : ;; Convert epilogue deallocator to pop.
26788 : 5716 : (define_peephole2
26789 : 5716 : [(match_scratch:W 1 "r")
26790 : 5716 : (parallel [(set (reg:P SP_REG)
26791 : 2930 : (plus:P (reg:P SP_REG)
26792 : 2930 : (match_operand:P 0 "const_int_operand")))
26793 : 2930 : (clobber (reg:CC FLAGS_REG))
26794 : 2930 : (clobber (mem:BLK (scratch)))])]
26795 : 1831231 : "(TARGET_SINGLE_POP || optimize_insn_for_size_p ())
26796 : 1948270 : && INTVAL (operands[0]) == GET_MODE_SIZE (word_mode)"
26797 : 2930 : [(parallel [(set (match_dup 1) (mem:W (post_inc:P (reg:P SP_REG))))
26798 : 2930 : (clobber (mem:BLK (scratch)))])])
26799 : 2930 :
26800 : 2636 : ;; Two pops case is tricky, since pop causes dependency
26801 : 2930 : ;; on destination register. We use two registers if available.
26802 : 2930 : (define_peephole2
26803 : 2930 : [(match_scratch:W 1 "r")
26804 : 2930 : (match_scratch:W 2 "r")
26805 : 2930 : (parallel [(set (reg:P SP_REG)
26806 : 2930 : (plus:P (reg:P SP_REG)
26807 : 2930 : (match_operand:P 0 "const_int_operand")))
26808 : 2930 : (clobber (reg:CC FLAGS_REG))
26809 : 2930 : (clobber (mem:BLK (scratch)))])]
26810 : 1807115 : "(TARGET_DOUBLE_POP || optimize_insn_for_size_p ())
26811 : 1887977 : && INTVAL (operands[0]) == 2*GET_MODE_SIZE (word_mode)"
26812 : 2930 : [(parallel [(set (match_dup 1) (mem:W (post_inc:P (reg:P SP_REG))))
26813 : 2930 : (clobber (mem:BLK (scratch)))])
26814 : 2930 : (set (match_dup 2) (mem:W (post_inc:P (reg:P SP_REG))))])
26815 : 2636 :
26816 : 2930 : (define_peephole2
26817 : 2930 : [(match_scratch:W 1 "r")
26818 : 2930 : (parallel [(set (reg:P SP_REG)
26819 : 2930 : (plus:P (reg:P SP_REG)
26820 : 2930 : (match_operand:P 0 "const_int_operand")))
26821 : 2930 : (clobber (reg:CC FLAGS_REG))
26822 : 2930 : (clobber (mem:BLK (scratch)))])]
26823 : 1806010 : "optimize_insn_for_size_p ()
26824 : 983967 : && INTVAL (operands[0]) == 2*GET_MODE_SIZE (word_mode)"
26825 : 2930 : [(parallel [(set (match_dup 1) (mem:W (post_inc:P (reg:P SP_REG))))
26826 : 2636 : (clobber (mem:BLK (scratch)))])
26827 : 2684 : (set (match_dup 1) (mem:W (post_inc:P (reg:P SP_REG))))])
26828 : 2636 :
26829 : 2684 : ;; Convert esp additions to pop.
26830 : 2684 : (define_peephole2
26831 : 2684 : [(match_scratch:W 1 "r")
26832 : 2684 : (parallel [(set (reg:P SP_REG)
26833 : 2636 : (plus:P (reg:P SP_REG)
26834 : 3106 : (match_operand:P 0 "const_int_operand")))
26835 : 3058 : (clobber (reg:CC FLAGS_REG))])]
26836 : 3384568 : "INTVAL (operands[0]) == GET_MODE_SIZE (word_mode)"
26837 : 2636 : [(set (match_dup 1) (mem:W (post_inc:P (reg:P SP_REG))))])
26838 : 3058 :
26839 : 3058 : ;; Two pops case is tricky, since pop causes dependency
26840 : 3058 : ;; on destination register. We use two registers if available.
26841 : 3058 : (define_peephole2
26842 : 3058 : [(match_scratch:W 1 "r")
26843 : 33124 : (match_scratch:W 2 "r")
26844 : 3058 : (parallel [(set (reg:P SP_REG)
26845 : 33124 : (plus:P (reg:P SP_REG)
26846 : 33124 : (match_operand:P 0 "const_int_operand")))
26847 : 33124 : (clobber (reg:CC FLAGS_REG))])]
26848 : 3377889 : "INTVAL (operands[0]) == 2*GET_MODE_SIZE (word_mode)"
26849 : 33124 : [(set (match_dup 1) (mem:W (post_inc:P (reg:P SP_REG))))
26850 : 33124 : (set (match_dup 2) (mem:W (post_inc:P (reg:P SP_REG))))])
26851 : 3058 :
26852 : 33116 : (define_peephole2
26853 : 3058 : [(match_scratch:W 1 "r")
26854 : 33116 : (parallel [(set (reg:P SP_REG)
26855 : 33116 : (plus:P (reg:P SP_REG)
26856 : 33116 : (match_operand:P 0 "const_int_operand")))
26857 : 33116 : (clobber (reg:CC FLAGS_REG))])]
26858 : 2178096 : "optimize_insn_for_size_p ()
26859 : 1316683 : && INTVAL (operands[0]) == 2*GET_MODE_SIZE (word_mode)"
26860 : 3058 : [(set (match_dup 1) (mem:W (post_inc:P (reg:P SP_REG))))
26861 : 33116 : (set (match_dup 1) (mem:W (post_inc:P (reg:P SP_REG))))])
26862 : 3058 :
26863 : 3058 : ;; Convert compares with 1 to shorter inc/dec operations when CF is not
26864 : 3058 : ;; required and register dies. Similarly for 128 to -128.
26865 : 3058 : (define_peephole2
26866 : 3058 : [(set (match_operand 0 "flags_reg_operand")
26867 : 3058 : (match_operator 1 "compare_operator"
26868 : 3058 : [(match_operand 2 "register_operand")
26869 : 3058 : (match_operand 3 "const_int_operand")]))]
26870 : 4311937 : "(((!TARGET_FUSE_CMP_AND_BRANCH || optimize_insn_for_size_p ())
26871 : 348662 : && incdec_operand (operands[3], GET_MODE (operands[3])))
26872 : 2171891 : || (!TARGET_FUSE_CMP_AND_BRANCH
26873 : 33659 : && INTVAL (operands[3]) == 128))
26874 : 19012 : && ix86_match_ccmode (insn, CCGCmode)
26875 : 17806 : && peep2_reg_dead_p (1, operands[2])"
26876 : 2148195 : [(parallel [(set (match_dup 0)
26877 : 12640 : (match_op_dup 1 [(match_dup 2) (match_dup 3)]))
26878 : 12640 : (clobber (match_dup 2))])])
26879 : 4373 :
26880 : 126705 : ;; Convert imul by three, five and nine into lea
26881 : 128020 : (define_peephole2
26882 : 4373 : [(parallel
26883 : 128020 : [(set (match_operand:SWI48 0 "register_operand")
26884 : 128020 : (mult:SWI48 (match_operand:SWI48 1 "register_operand")
26885 : 128020 : (match_operand:SWI48 2 "const359_operand")))
26886 : 128020 : (clobber (reg:CC FLAGS_REG))])]
26887 : 126705 : "!TARGET_PARTIAL_REG_STALL
26888 : 4373 : || <MODE>mode == SImode
26889 : 3678 : || optimize_function_for_size_p (cfun)"
26890 : 24351 : [(set (match_dup 0)
26891 : 23526 : (plus:SWI48 (mult:SWI48 (match_dup 1) (match_dup 2))
26892 : 41139 : (match_dup 1)))]
26893 : 4043 : "operands[2] = GEN_INT (INTVAL (operands[2]) - 1);")
26894 : 4373 :
26895 : 4373 : (define_peephole2
26896 : 4043 : [(parallel
26897 : 4373 : [(set (match_operand:SWI48 0 "register_operand")
26898 : 4043 : (mult:SWI48 (match_operand:SWI48 1 "nonimmediate_operand")
26899 : 4043 : (match_operand:SWI48 2 "const359_operand")))
26900 : 4043 : (clobber (reg:CC FLAGS_REG))])]
26901 : 4195 : "optimize_insn_for_speed_p ()
26902 : 5358 : && (!TARGET_PARTIAL_REG_STALL || <MODE>mode == SImode)"
26903 : 3058 : [(set (match_dup 0) (match_dup 1))
26904 : 3075 : (set (match_dup 0)
26905 : 3075 : (plus:SWI48 (mult:SWI48 (match_dup 0) (match_dup 2))
26906 : 3075 : (match_dup 0)))]
26907 : 3075 : "operands[2] = GEN_INT (INTVAL (operands[2]) - 1);")
26908 : 4043 :
26909 : 4043 : ;; imul $32bit_imm, mem, reg is vector decoded, while
26910 : 62954 : ;; imul $32bit_imm, reg, reg is direct decoded.
26911 : 4813 : (define_peephole2
26912 : 63267 : [(match_scratch:SWI48 3 "r")
26913 : 4390 : (parallel [(set (match_operand:SWI48 0 "register_operand")
26914 : 4373 : (mult:SWI48 (match_operand:SWI48 1 "memory_operand")
26915 : 3075 : (match_operand:SWI48 2 "immediate_operand")))
26916 : 3695 : (clobber (reg:CC FLAGS_REG))])]
26917 : 5384 : "TARGET_SLOW_IMUL_IMM32_MEM && optimize_insn_for_speed_p ()
26918 : 3075 : && !satisfies_constraint_K (operands[2])"
26919 : 3695 : [(set (match_dup 3) (match_dup 1))
26920 : 3695 : (parallel [(set (match_dup 0) (mult:SWI48 (match_dup 3) (match_dup 2)))
26921 : 3695 : (clobber (reg:CC FLAGS_REG))])])
26922 : 3695 :
26923 : 3058 : (define_peephole2
26924 : 3712 : [(match_scratch:SI 3 "r")
26925 : 61969 : (parallel [(set (match_operand:DI 0 "register_operand")
26926 : 61952 : (zero_extend:DI
26927 : 61952 : (mult:SI (match_operand:SI 1 "memory_operand")
26928 : 3058 : (match_operand:SI 2 "immediate_operand"))))
26929 : 3058 : (clobber (reg:CC FLAGS_REG))])]
26930 : 3058 : "TARGET_64BIT
26931 : 3058 : && TARGET_SLOW_IMUL_IMM32_MEM && optimize_insn_for_speed_p ()
26932 : 3058 : && !satisfies_constraint_K (operands[2])"
26933 : 3058 : [(set (match_dup 3) (match_dup 1))
26934 : 3058 : (parallel [(set (match_dup 0)
26935 : 3058 : (zero_extend:DI (mult:SI (match_dup 3) (match_dup 2))))
26936 : 3058 : (clobber (reg:CC FLAGS_REG))])])
26937 : 3058 :
26938 : 3058 : ;; imul $8/16bit_imm, regmem, reg is vector decoded.
26939 : 3058 : ;; Convert it into imul reg, reg
26940 : 3058 : ;; It would be better to force assembler to encode instruction using long
26941 : 3058 : ;; immediate, but there is apparently no way to do so.
26942 : 3058 : (define_peephole2
26943 : 57278640 : [(parallel [(set (match_operand:SWI248 0 "register_operand")
26944 : 3058 : (mult:SWI248
26945 : 3058 : (match_operand:SWI248 1 "nonimmediate_operand")
26946 : 3058 : (match_operand:SWI248 2 "const_int_operand")))
26947 : 57278640 : (clobber (reg:CC FLAGS_REG))])
26948 : 57278640 : (match_scratch:SWI248 3 "r")]
26949 : 44780 : "TARGET_SLOW_IMUL_IMM8 && optimize_insn_for_speed_p ()
26950 : 3076 : && satisfies_constraint_K (operands[2])"
26951 : 63971 : [(set (match_dup 3) (match_dup 2))
26952 : 57278640 : (parallel [(set (match_dup 0) (mult:SWI248 (match_dup 0) (match_dup 3)))
26953 : 3058 : (clobber (reg:CC FLAGS_REG))])]
26954 : 57278640 : {
26955 : 126671 : if (!rtx_equal_p (operands[0], operands[1]))
26956 : 126671 : emit_move_insn (operands[0], operands[1]);
26957 : 126671 : })
26958 : 45708390 :
26959 : 126671 : ;; After splitting up read-modify operations, array accesses with memory
26960 : 200298 : ;; operands might end up in form:
26961 : 3758 : ;; sall $2, %eax
26962 : 263653 : ;; movl 4(%esp), %edx
26963 : 3064 : ;; addl %edx, %eax
26964 : 510990 : ;; instead of pre-splitting:
26965 : 3058 : ;; sall $2, %eax
26966 : 197337 : ;; addl 4(%esp), %eax
26967 : 197337 : ;; Turn it into:
26968 : 197337 : ;; movl 4(%esp), %edx
26969 : 3058 : ;; leal (%edx,%eax,4), %eax
26970 : 197217 :
26971 : 197217 : (define_peephole2
26972 : 197217 : [(match_scratch:W 5 "r")
26973 : 3058 : (parallel [(set (match_operand 0 "register_operand")
26974 : 175936 : (ashift (match_operand 1 "register_operand")
26975 : 175936 : (match_operand 2 "const_int_operand")))
26976 : 3058 : (clobber (reg:CC FLAGS_REG))])
26977 : 25853 : (parallel [(set (match_operand 3 "register_operand")
26978 : 25853 : (plus (match_dup 0)
26979 : 3058 : (match_operand 4 "x86_64_general_operand")))
26980 : 25853 : (clobber (reg:CC FLAGS_REG))])]
26981 : 19361 : "IN_RANGE (INTVAL (operands[2]), 1, 3)
26982 : 25853 : /* Validate MODE for lea. */
26983 : 49926 : && ((!TARGET_PARTIAL_REG_STALL
26984 : 4336 : && (GET_MODE (operands[0]) == QImode
26985 : 5033 : || GET_MODE (operands[0]) == HImode))
26986 : 4336 : || GET_MODE (operands[0]) == SImode
26987 : 4321 : || (TARGET_64BIT && GET_MODE (operands[0]) == DImode))
26988 : 27828 : && (rtx_equal_p (operands[0], operands[3])
26989 : 3755 : || peep2_reg_dead_p (2, operands[0]))
26990 : 25823 : /* We reorder load and the shift. */
26991 : 5033 : && !reg_overlap_mentioned_p (operands[0], operands[4])"
26992 : 25823 : [(set (match_dup 5) (match_dup 4))
26993 : 25126 : (set (match_dup 0) (match_dup 1))]
26994 : 3058 : {
26995 : 25823 : machine_mode op1mode = GET_MODE (operands[1]);
26996 : 26788 : machine_mode mode = op1mode == DImode ? DImode : SImode;
26997 : 3058 : int scale = 1 << INTVAL (operands[2]);
26998 : 21690 : rtx index = gen_lowpart (word_mode, operands[1]);
26999 : 4023 : rtx base = gen_lowpart (word_mode, operands[5]);
27000 : 4705 : rtx dest = gen_lowpart (mode, operands[3]);
27001 : 3058 :
27002 : 4023 : operands[1] = gen_rtx_PLUS (word_mode, base,
27003 : 3058 : gen_rtx_MULT (word_mode, index, GEN_INT (scale)));
27004 : 4023 : if (mode != word_mode)
27005 : 3058 : operands[1] = gen_rtx_SUBREG (mode, operands[1], 0);
27006 : 3740 :
27007 : 4705 : operands[5] = base;
27008 : 4283 : if (op1mode != word_mode)
27009 : 3740 : operands[5] = gen_lowpart (op1mode, operands[5]);
27010 : 3058 :
27011 : 3740 : operands[0] = dest;
27012 : 3058 : })
27013 : 3740 :
27014 : 3740 : ;; We used to use "int $5", in honor of #BR which maps to interrupt vector 5.
27015 : 4705 : ;; That, however, is usually mapped by the OS to SIGSEGV, which is often
27016 : 4705 : ;; caught for use by garbage collectors and the like. Using an insn that
27017 : 4705 : ;; maps to SIGILL makes it more likely the program will rightfully die.
27018 : 3740 : ;; Keeping with tradition, "6" is in honor of #UD.
27019 : 3058 : (define_insn "trap"
27020 : 3740 : [(trap_if (const_int 1) (const_int 6))]
27021 : 3058 : ""
27022 : 39131 : {
27023 : 3058 : #ifdef HAVE_AS_IX86_UD2
27024 : 40096 : return "ud2";
27025 : 3740 : #else
27026 : 4023 : return ASM_SHORT "0x0b0f";
27027 : 4023 : #endif
27028 : 3058 : }
27029 : 4023 : [(set_attr "length" "2")])
27030 : 3058 :
27031 : 4023 : (define_insn "ud2"
27032 : 3102 : [(unspec_volatile [(const_int 0)] UNSPECV_UD2)]
27033 : 4023 : ""
27034 : 3102 : {
27035 : 3740 : #ifdef HAVE_AS_IX86_UD2
27036 : 3784 : return "ud2";
27037 : 3740 : #else
27038 : 5004 : return ASM_SHORT "0x0b0f";
27039 : 3341 : #endif
27040 : 3058 : }
27041 : 3341 : [(set_attr "length" "2")])
27042 : 3058 :
27043 : 5004 : (define_expand "prefetch"
27044 : 5058 : [(prefetch (match_operand 0 "address_operand")
27045 : 12778 : (match_operand:SI 1 "const_int_operand")
27046 : 12778 : (match_operand:SI 2 "const_int_operand"))]
27047 : 14903 : "TARGET_3DNOW || TARGET_PREFETCH_SSE || TARGET_PRFCHW || TARGET_PREFETCHWT1"
27048 : 12778 : {
27049 : 10832 : bool write = operands[1] != const0_rtx;
27050 : 10832 : int locality = INTVAL (operands[2]);
27051 : 3058 :
27052 : 12732 : gcc_assert (IN_RANGE (locality, 0, 3));
27053 : 3058 :
27054 : 10786 : /* Use 3dNOW prefetch in case we are asking for write prefetch not
27055 : 10503 : supported by SSE counterpart (non-SSE2 athlon machines) or the
27056 : 10503 : SSE prefetch is not available (K6 machines). Otherwise use SSE
27057 : 10503 : prefetch as it allows specifying of locality. */
27058 : 3058 :
27059 : 12449 : if (write)
27060 : 3058 : {
27061 : 10717 : if (TARGET_PREFETCHWT1)
27062 : 3065 : operands[2] = GEN_INT (MAX (locality, 2));
27063 : 3265 : else if (TARGET_PRFCHW)
27064 : 3076 : operands[2] = GEN_INT (3);
27065 : 3382 : else if (TARGET_3DNOW && !TARGET_SSE2)
27066 : 10503 : operands[2] = GEN_INT (3);
27067 : 3382 : else if (TARGET_PREFETCH_SSE)
27068 : 10503 : operands[1] = const0_rtx;
27069 : 3058 : else
27070 : 3058 : {
27071 : 3058 : gcc_assert (TARGET_3DNOW);
27072 : 3058 : operands[2] = GEN_INT (3);
27073 : 3058 : }
27074 : 3058 : }
27075 : 3058 : else
27076 : 3058 : {
27077 : 4790 : if (TARGET_PREFETCH_SSE)
27078 : 3058 : ;
27079 : 2636 : else
27080 : 2636 : {
27081 : 2636 : gcc_assert (TARGET_3DNOW);
27082 : 2707 : operands[2] = GEN_INT (3);
27083 : 2636 : }
27084 : 2636 : }
27085 : 1429401 : })
27086 : 2636 :
27087 : 1429401 : (define_insn "*prefetch_sse"
27088 : 4582 : [(prefetch (match_operand 0 "address_operand" "p")
27089 : 4582 : (const_int 0)
27090 : 2636 : (match_operand:SI 1 "const_int_operand"))]
27091 : 7258 : "TARGET_PREFETCH_SSE"
27092 : 4636 : {
27093 : 6582 : static const char * const patterns[4] = {
27094 : 2636 : "prefetchnta\t%a0", "prefetcht2\t%a0", "prefetcht1\t%a0", "prefetcht0\t%a0"
27095 : 4628 : };
27096 : 2682 :
27097 : 4682 : int locality = INTVAL (operands[1]);
27098 : 4637 : gcc_assert (IN_RANGE (locality, 0, 3));
27099 : 4582 :
27100 : 6582 : return patterns[locality];
27101 : 4582 : }
27102 : 2636 : [(set_attr "type" "sse")
27103 : 2636 : (set_attr "atom_sse_attr" "prefetch")
27104 : 2636 : (set (attr "length_address")
27105 : 2656 : (symbol_ref "memory_address_length (operands[0], false)"))
27106 : 3288 : (set_attr "memory" "none")])
27107 : 2636 :
27108 : 3288 : (define_insn "*prefetch_3dnow"
27109 : 3288 : [(prefetch (match_operand 0 "address_operand" "p")
27110 : 3288 : (match_operand:SI 1 "const_int_operand")
27111 : 2636 : (const_int 3))]
27112 : 2636 : "TARGET_3DNOW || TARGET_PRFCHW || TARGET_PREFETCHWT1"
27113 : 2656 : {
27114 : 2656 : if (operands[1] == const0_rtx)
27115 : 2636 : return "prefetch\t%a0";
27116 : 3368 : else
27117 : 3388 : return "prefetchw\t%a0";
27118 : 2636 : }
27119 : 3368 : [(set_attr "type" "mmx")
27120 : 3368 : (set (attr "length_address")
27121 : 2636 : (symbol_ref "memory_address_length (operands[0], false)"))
27122 : 3372 : (set_attr "memory" "none")])
27123 : 3368 :
27124 : 3368 : (define_insn "*prefetch_prefetchwt1"
27125 : 3368 : [(prefetch (match_operand 0 "address_operand" "p")
27126 : 4753 : (const_int 1)
27127 : 2636 : (const_int 2))]
27128 : 4022 : "TARGET_PREFETCHWT1"
27129 : 3368 : "prefetchwt1\t%a0";
27130 : 3368 : [(set_attr "type" "sse")
27131 : 3368 : (set (attr "length_address")
27132 : 3368 : (symbol_ref "memory_address_length (operands[0], false)"))
27133 : 3368 : (set_attr "memory" "none")])
27134 : 3368 :
27135 : 3413 : (define_insn "prefetchi"
27136 : 9448 : [(unspec_volatile [(match_operand 0 "local_func_symbolic_operand" "p")
27137 : 2667 : (match_operand:SI 1 "const_int_operand")]
27138 : 9448 : UNSPECV_PREFETCHI)]
27139 : 8720 : "TARGET_PREFETCHI && TARGET_64BIT"
27140 : 9452 : {
27141 : 8675 : static const char * const patterns[2] = {
27142 : 9051 : "prefetchit1\t%0", "prefetchit0\t%0"
27143 : 9020 : };
27144 : 2636 :
27145 : 9024 : int locality = INTVAL (operands[1]);
27146 : 2640 : gcc_assert (IN_RANGE (locality, 2, 3));
27147 : 8640 :
27148 : 8644 : return patterns[locality - 2];
27149 : 8640 : }
27150 : 8640 : [(set_attr "type" "sse")
27151 : 8640 : (set (attr "length_address")
27152 : 267518 : (symbol_ref "memory_address_length (operands[0], false)"))
27153 : 295926 : (set_attr "memory" "none")])
27154 : 8717 :
27155 : 4418 : (define_insn "sse4_2_crc32<mode>"
27156 : 4418 : [(set (match_operand:SI 0 "register_operand" "=r")
27157 : 4418 : (unspec:SI
27158 : 4341 : [(match_operand:SI 1 "register_operand" "0")
27159 : 10345 : (match_operand:SWI124 2 "nonimmediate_operand" "<r>m")]
27160 : 10345 : UNSPEC_CRC32))]
27161 : 10492 : "TARGET_CRC32"
27162 : 4341 : "crc32{<imodesuffix>}\t{%2, %0|%0, %2}"
27163 : 4341 : [(set_attr "type" "sselog1")
27164 : 4341 : (set_attr "prefix_rep" "1")
27165 : 4618 : (set_attr "prefix_extra" "1")
27166 : 4618 : (set (attr "prefix_data16")
27167 : 31490 : (if_then_else (match_operand:HI 2)
27168 : 4341 : (const_string "1")
27169 : 102350 : (const_string "*")))
27170 : 102350 : (set (attr "prefix_rex")
27171 : 102350 : (if_then_else (match_operand:QI 2 "ext_QIreg_operand")
27172 : 31213 : (const_string "1")
27173 : 35285 : (const_string "*")))
27174 : 35285 : (set_attr "mode" "SI")])
27175 : 4341 :
27176 : 32029 : (define_insn "sse4_2_crc32di"
27177 : 5244 : [(set (match_operand:DI 0 "register_operand" "=r")
27178 : 31149 : (zero_extend:DI
27179 : 31141 : (unspec:SI
27180 : 32041 : [(match_operand:SI 1 "register_operand" "0")
27181 : 32017 : (match_operand:DI 2 "nonimmediate_operand" "rm")]
27182 : 31138 : UNSPEC_CRC32)))]
27183 : 31138 : "TARGET_64BIT && TARGET_CRC32"
27184 : 4354 : "crc32{q}\t{%2, %0|%0, %2}"
27185 : 31126 : [(set_attr "type" "sselog1")
27186 : 4348 : (set_attr "prefix_rep" "1")
27187 : 4348 : (set_attr "prefix_extra" "1")
27188 : 4348 : (set_attr "mode" "DI")])
27189 : 4341 :
27190 : 31133 : (define_insn "rdpmc"
27191 : 4341 : [(set (match_operand:DI 0 "register_operand" "=A")
27192 : 4348 : (unspec_volatile:DI [(match_operand:SI 1 "register_operand" "c")]
27193 : 4341 : UNSPECV_RDPMC))]
27194 : 4341 : "!TARGET_64BIT"
27195 : 31133 : "rdpmc"
27196 : 31133 : [(set_attr "type" "other")
27197 : 31133 : (set_attr "length" "2")])
27198 : 4349 :
27199 : 4349 : (define_insn "rdpmc_rex64"
27200 : 4341 : [(set (match_operand:DI 0 "register_operand" "=a")
27201 : 4349 : (unspec_volatile:DI [(match_operand:SI 2 "register_operand" "c")]
27202 : 4349 : UNSPECV_RDPMC))
27203 : 4349 : (set (match_operand:DI 1 "register_operand" "=d")
27204 : 4349 : (unspec_volatile:DI [(match_dup 2)] UNSPECV_RDPMC))]
27205 : 4375 : "TARGET_64BIT"
27206 : 4341 : "rdpmc"
27207 : 4341 : [(set_attr "type" "other")
27208 : 4341 : (set_attr "length" "2")])
27209 : 4375 :
27210 : 4375 : (define_insn "rdtsc"
27211 : 4375 : [(set (match_operand:DI 0 "register_operand" "=A")
27212 : 4341 : (unspec_volatile:DI [(const_int 0)] UNSPECV_RDTSC))]
27213 : 4349 : "!TARGET_64BIT"
27214 : 4345 : "rdtsc"
27215 : 4341 : [(set_attr "type" "other")
27216 : 4341 : (set_attr "length" "2")])
27217 : 4341 :
27218 : 4341 : (define_insn "rdtsc_rex64"
27219 : 4341 : [(set (match_operand:DI 0 "register_operand" "=a")
27220 : 4341 : (unspec_volatile:DI [(const_int 0)] UNSPECV_RDTSC))
27221 : 4341 : (set (match_operand:DI 1 "register_operand" "=d")
27222 : 4341 : (unspec_volatile:DI [(const_int 0)] UNSPECV_RDTSC))]
27223 : 4375 : "TARGET_64BIT"
27224 : 4341 : "rdtsc"
27225 : 4341 : [(set_attr "type" "other")
27226 : 4341 : (set_attr "length" "2")])
27227 : 4341 :
27228 : 4341 : (define_insn "rdtscp"
27229 : 4341 : [(set (match_operand:DI 0 "register_operand" "=A")
27230 : 4341 : (unspec_volatile:DI [(const_int 0)] UNSPECV_RDTSCP))
27231 : 4341 : (set (match_operand:SI 1 "register_operand" "=c")
27232 : 4341 : (unspec_volatile:SI [(const_int 0)] UNSPECV_RDTSCP))]
27233 : 4341 : "!TARGET_64BIT"
27234 : 4341 : "rdtscp"
27235 : 4341 : [(set_attr "type" "other")
27236 : 4341 : (set_attr "length" "3")])
27237 : 4377 :
27238 : 4377 : (define_insn "rdtscp_rex64"
27239 : 4377 : [(set (match_operand:DI 0 "register_operand" "=a")
27240 : 4341 : (unspec_volatile:DI [(const_int 0)] UNSPECV_RDTSCP))
27241 : 4341 : (set (match_operand:DI 1 "register_operand" "=d")
27242 : 4341 : (unspec_volatile:DI [(const_int 0)] UNSPECV_RDTSCP))
27243 : 4341 : (set (match_operand:SI 2 "register_operand" "=c")
27244 : 4341 : (unspec_volatile:SI [(const_int 0)] UNSPECV_RDTSCP))]
27245 : 4363 : "TARGET_64BIT"
27246 : 4341 : "rdtscp"
27247 : 4341 : [(set_attr "type" "other")
27248 : 4341 : (set_attr "length" "3")])
27249 : 7726 :
27250 : 7726 : ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
27251 : 4341 : ;;
27252 : 7726 : ;; FXSR, XSAVE and XSAVEOPT instructions
27253 : 7726 : ;;
27254 : 7726 : ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
27255 : 7726 :
27256 : 11111 : (define_insn "fxsave"
27257 : 4341 : [(set (match_operand:BLK 0 "memory_operand" "=m")
27258 : 7726 : (unspec_volatile:BLK [(const_int 0)] UNSPECV_FXSAVE))]
27259 : 4374 : "TARGET_FXSR"
27260 : 7726 : "fxsave\t%0"
27261 : 7726 : [(set_attr "type" "other")
27262 : 11111 : (set_attr "memory" "store")
27263 : 4383 : (set (attr "length")
27264 : 4383 : (symbol_ref "ix86_attr_length_address_default (insn) + 3"))])
27265 : 7726 :
27266 : 7768 : (define_insn "fxsave64"
27267 : 4383 : [(set (match_operand:BLK 0 "memory_operand" "=jm")
27268 : 7726 : (unspec_volatile:BLK [(const_int 0)] UNSPECV_FXSAVE64))]
27269 : 7768 : "TARGET_64BIT && TARGET_FXSR"
27270 : 7768 : "fxsave64\t%0"
27271 : 4383 : [(set_attr "type" "other")
27272 : 4383 : (set_attr "addr" "gpr16")
27273 : 7726 : (set_attr "memory" "store")
27274 : 7726 : (set (attr "length")
27275 : 5420 : (symbol_ref "ix86_attr_length_address_default (insn) + 4"))])
27276 : 7726 :
27277 : 8805 : (define_insn "fxrstor"
27278 : 5420 : [(unspec_volatile [(match_operand:BLK 0 "memory_operand" "m")]
27279 : 8805 : UNSPECV_FXRSTOR)]
27280 : 5450 : "TARGET_FXSR"
27281 : 8461 : "fxrstor\t%0"
27282 : 8461 : [(set_attr "type" "other")
27283 : 7382 : (set_attr "memory" "load")
27284 : 5456 : (set (attr "length")
27285 : 4377 : (symbol_ref "ix86_attr_length_address_default (insn) + 3"))])
27286 : 5456 :
27287 : 5456 : (define_insn "fxrstor64"
27288 : 5456 : [(unspec_volatile [(match_operand:BLK 0 "memory_operand" "jm")]
27289 : 5420 : UNSPECV_FXRSTOR64)]
27290 : 5420 : "TARGET_64BIT && TARGET_FXSR"
27291 : 5420 : "fxrstor64\t%0"
27292 : 4341 : [(set_attr "type" "other")
27293 : 5420 : (set_attr "addr" "gpr16")
27294 : 4341 : (set_attr "memory" "load")
27295 : 4341 : (set (attr "length")
27296 : 4341 : (symbol_ref "ix86_attr_length_address_default (insn) + 4"))])
27297 : 4341 :
27298 : 5420 : (define_int_iterator ANY_XSAVE
27299 : 4341 : [UNSPECV_XSAVE
27300 : 4341 : (UNSPECV_XSAVEOPT "TARGET_XSAVEOPT")
27301 : 4341 : (UNSPECV_XSAVEC "TARGET_XSAVEC")
27302 : 4341 : (UNSPECV_XSAVES "TARGET_XSAVES")])
27303 : 5420 :
27304 : 5499 : (define_int_iterator ANY_XSAVE64
27305 : 5499 : [UNSPECV_XSAVE64
27306 : 4496 : (UNSPECV_XSAVEOPT64 "TARGET_XSAVEOPT")
27307 : 4553 : (UNSPECV_XSAVEC64 "TARGET_XSAVEC")
27308 : 4449 : (UNSPECV_XSAVES64 "TARGET_XSAVES")])
27309 : 4341 :
27310 : 4341 : (define_int_attr xsave
27311 : 4423 : [(UNSPECV_XSAVE "xsave")
27312 : 4496 : (UNSPECV_XSAVE64 "xsave64")
27313 : 4490 : (UNSPECV_XSAVEOPT "xsaveopt")
27314 : 4344 : (UNSPECV_XSAVEOPT64 "xsaveopt64")
27315 : 4344 : (UNSPECV_XSAVEC "xsavec")
27316 : 4344 : (UNSPECV_XSAVEC64 "xsavec64")
27317 : 4344 : (UNSPECV_XSAVES "xsaves")
27318 : 4344 : (UNSPECV_XSAVES64 "xsaves64")])
27319 : 4341 :
27320 : 4344 : (define_int_iterator ANY_XRSTOR
27321 : 4341 : [UNSPECV_XRSTOR
27322 : 4344 : (UNSPECV_XRSTORS "TARGET_XSAVES")])
27323 : 4344 :
27324 : 4344 : (define_int_iterator ANY_XRSTOR64
27325 : 4344 : [UNSPECV_XRSTOR64
27326 : 4415 : (UNSPECV_XRSTORS64 "TARGET_XSAVES")])
27327 : 4415 :
27328 : 4412 : (define_int_attr xrstor
27329 : 4341 : [(UNSPECV_XRSTOR "xrstor")
27330 : 4341 : (UNSPECV_XRSTOR64 "xrstor")
27331 : 4407 : (UNSPECV_XRSTORS "xrstors")
27332 : 4407 : (UNSPECV_XRSTORS64 "xrstors")])
27333 : 4341 :
27334 : 4341 : (define_insn "<xsave>"
27335 : 4341 : [(set (match_operand:BLK 0 "memory_operand" "=m")
27336 : 4341 : (unspec_volatile:BLK
27337 : 4344 : [(match_operand:DI 1 "register_operand" "A")]
27338 : 4344 : ANY_XSAVE))]
27339 : 4344 : "!TARGET_64BIT && TARGET_XSAVE"
27340 : 4341 : "<xsave>\t%0"
27341 : 4341 : [(set_attr "type" "other")
27342 : 4341 : (set_attr "memory" "store")
27343 : 4341 : (set (attr "length")
27344 : 4341 : (symbol_ref "ix86_attr_length_address_default (insn) + 3"))])
27345 : 4341 :
27346 : 4341 : (define_insn "<xsave>_rex64"
27347 : 4341 : [(set (match_operand:BLK 0 "memory_operand" "=jm")
27348 : 4341 : (unspec_volatile:BLK
27349 : 4341 : [(match_operand:SI 1 "register_operand" "a")
27350 : 4341 : (match_operand:SI 2 "register_operand" "d")]
27351 : 4341 : ANY_XSAVE))]
27352 : 4369 : "TARGET_64BIT && TARGET_XSAVE"
27353 : 4341 : "<xsave>\t%0"
27354 : 4341 : [(set_attr "type" "other")
27355 : 4341 : (set_attr "memory" "store")
27356 : 4424 : (set_attr "addr" "gpr16")
27357 : 4424 : (set (attr "length")
27358 : 4424 : (symbol_ref "ix86_attr_length_address_default (insn) + 3"))])
27359 : 4341 :
27360 : 4341 : (define_insn "<xsave>"
27361 : 4341 : [(set (match_operand:BLK 0 "memory_operand" "=jm")
27362 : 4341 : (unspec_volatile:BLK
27363 : 4341 : [(match_operand:SI 1 "register_operand" "a")
27364 : 4341 : (match_operand:SI 2 "register_operand" "d")]
27365 : 4341 : ANY_XSAVE64))]
27366 : 4369 : "TARGET_64BIT && TARGET_XSAVE"
27367 : 4341 : "<xsave>\t%0"
27368 : 4341 : [(set_attr "type" "other")
27369 : 4341 : (set_attr "memory" "store")
27370 : 4424 : (set_attr "addr" "gpr16")
27371 : 4424 : (set (attr "length")
27372 : 4424 : (symbol_ref "ix86_attr_length_address_default (insn) + 4"))])
27373 : 4341 :
27374 : 4341 : (define_insn "<xrstor>"
27375 : 4341 : [(unspec_volatile:BLK
27376 : 4341 : [(match_operand:BLK 0 "memory_operand" "m")
27377 : 4341 : (match_operand:DI 1 "register_operand" "A")]
27378 : 4341 : ANY_XRSTOR)]
27379 : 4341 : "!TARGET_64BIT && TARGET_XSAVE"
27380 : 4341 : "<xrstor>\t%0"
27381 : 4341 : [(set_attr "type" "other")
27382 : 4341 : (set_attr "memory" "load")
27383 : 4341 : (set (attr "length")
27384 : 4341 : (symbol_ref "ix86_attr_length_address_default (insn) + 3"))])
27385 : 4341 :
27386 : 4341 : (define_insn "<xrstor>_rex64"
27387 : 4341 : [(unspec_volatile:BLK
27388 : 4341 : [(match_operand:BLK 0 "memory_operand" "jm")
27389 : 4341 : (match_operand:SI 1 "register_operand" "a")
27390 : 4341 : (match_operand:SI 2 "register_operand" "d")]
27391 : 4341 : ANY_XRSTOR)]
27392 : 4370 : "TARGET_64BIT && TARGET_XSAVE"
27393 : 4341 : "<xrstor>\t%0"
27394 : 4341 : [(set_attr "type" "other")
27395 : 4341 : (set_attr "memory" "load")
27396 : 4388 : (set_attr "addr" "gpr16")
27397 : 4388 : (set (attr "length")
27398 : 4655 : (symbol_ref "ix86_attr_length_address_default (insn) + 3"))])
27399 : 4341 :
27400 : 4447 : (define_insn "<xrstor>64"
27401 : 4447 : [(unspec_volatile:BLK
27402 : 4447 : [(match_operand:BLK 0 "memory_operand" "jm")
27403 : 4447 : (match_operand:SI 1 "register_operand" "a")
27404 : 4447 : (match_operand:SI 2 "register_operand" "d")]
27405 : 4447 : ANY_XRSTOR64)]
27406 : 4476 : "TARGET_64BIT && TARGET_XSAVE"
27407 : 4447 : "<xrstor>64\t%0"
27408 : 4447 : [(set_attr "type" "other")
27409 : 4447 : (set_attr "memory" "load")
27410 : 4494 : (set_attr "addr" "gpr16")
27411 : 4494 : (set (attr "length")
27412 : 4780 : (symbol_ref "ix86_attr_length_address_default (insn) + 4"))])
27413 : 16399 :
27414 : 4608 : (define_insn "xsetbv"
27415 : 16666 : [(unspec_volatile:SI
27416 : 16666 : [(match_operand:SI 0 "register_operand" "c")
27417 : 16666 : (match_operand:DI 1 "register_operand" "A")]
27418 : 16666 : UNSPECV_XSETBV)]
27419 : 16666 : "!TARGET_64BIT && TARGET_XSAVE"
27420 : 16666 : "xsetbv"
27421 : 4608 : [(set_attr "type" "other")])
27422 : 16696 :
27423 : 4718 : (define_insn "xsetbv_rex64"
27424 : 16507 : [(unspec_volatile:SI
27425 : 16664 : [(match_operand:SI 0 "register_operand" "c")
27426 : 16703 : (match_operand:SI 1 "register_operand" "a")
27427 : 16703 : (match_operand:SI 2 "register_operand" "d")]
27428 : 16664 : UNSPECV_XSETBV)]
27429 : 16664 : "TARGET_64BIT && TARGET_XSAVE"
27430 : 109719 : "xsetbv"
27431 : 109719 : [(set_attr "type" "other")])
27432 : 109719 :
27433 : 109790 : (define_insn "xgetbv"
27434 : 109790 : [(set (match_operand:DI 0 "register_operand" "=A")
27435 : 109790 : (unspec_volatile:DI [(match_operand:SI 1 "register_operand" "c")]
27436 : 4341 : UNSPECV_XGETBV))]
27437 : 4521 : "!TARGET_64BIT && TARGET_XSAVE"
27438 : 4450 : "xgetbv"
27439 : 16430 : [(set_attr "type" "other")])
27440 : 19174 :
27441 : 19174 : (define_insn "xgetbv_rex64"
27442 : 7103 : [(set (match_operand:DI 0 "register_operand" "=a")
27443 : 7103 : (unspec_volatile:DI [(match_operand:SI 2 "register_operand" "c")]
27444 : 4341 : UNSPECV_XGETBV))
27445 : 4359 : (set (match_operand:DI 1 "register_operand" "=d")
27446 : 4341 : (unspec_volatile:DI [(match_dup 2)] UNSPECV_XGETBV))]
27447 : 4344 : "TARGET_64BIT && TARGET_XSAVE"
27448 : 4341 : "xgetbv"
27449 : 4344 : [(set_attr "type" "other")])
27450 : 4344 :
27451 : 4435 : ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
27452 : 4435 : ;;
27453 : 4344 : ;; Floating-point instructions for atomic compound assignments
27454 : 4365 : ;;
27455 : 4365 : ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
27456 : 4341 :
27457 : 4344 : ; Clobber all floating-point registers on environment save and restore
27458 : 4341 : ; to ensure that the TOS value saved at fnstenv is valid after fldenv.
27459 : 4344 : (define_insn "fnstenv"
27460 : 4341 : [(set (match_operand:BLK 0 "memory_operand" "=m")
27461 : 2639 : (unspec_volatile:BLK [(const_int 0)] UNSPECV_FNSTENV))
27462 : 4344 : (clobber (reg:XF ST0_REG))
27463 : 4344 : (clobber (reg:XF ST1_REG))
27464 : 4344 : (clobber (reg:XF ST2_REG))
27465 : 2639 : (clobber (reg:XF ST3_REG))
27466 : 4344 : (clobber (reg:XF ST4_REG))
27467 : 4344 : (clobber (reg:XF ST5_REG))
27468 : 4344 : (clobber (reg:XF ST6_REG))
27469 : 2636 : (clobber (reg:XF ST7_REG))]
27470 : 26026 : "TARGET_80387"
27471 : 4341 : "fnstenv\t%0"
27472 : 4341 : [(set_attr "type" "other")
27473 : 4341 : (set_attr "memory" "store")
27474 : 4341 : (set (attr "length")
27475 : 16349 : (symbol_ref "ix86_attr_length_address_default (insn) + 2"))])
27476 : 16349 :
27477 : 27058 : (define_insn "fldenv"
27478 : 27061 : [(unspec_volatile [(match_operand:BLK 0 "memory_operand" "m")]
27479 : 16349 : UNSPECV_FLDENV)
27480 : 27058 : (clobber (reg:XF ST0_REG))
27481 : 39066 : (clobber (reg:XF ST1_REG))
27482 : 27058 : (clobber (reg:XF ST2_REG))
27483 : 39069 : (clobber (reg:XF ST3_REG))
27484 : 16352 : (clobber (reg:XF ST4_REG))
27485 : 4344 : (clobber (reg:XF ST5_REG))
27486 : 4341 : (clobber (reg:XF ST6_REG))
27487 : 4341 : (clobber (reg:XF ST7_REG))]
27488 : 27058 : "TARGET_80387"
27489 : 4341 : "fldenv\t%0"
27490 : 4341 : [(set_attr "type" "other")
27491 : 4341 : (set_attr "memory" "load")
27492 : 4341 : (set (attr "length")
27493 : 18839 : (symbol_ref "ix86_attr_length_address_default (insn) + 2"))])
27494 : 18839 :
27495 : 18839 : (define_insn "fnstsw"
27496 : 18839 : [(set (match_operand:HI 0 "nonimmediate_operand" "=a,m")
27497 : 4341 : (unspec_volatile:HI [(const_int 0)] UNSPECV_FNSTSW))]
27498 : 16349 : "TARGET_80387"
27499 : 5336 : "fnstsw\t%0"
27500 : 5336 : [(set_attr "type" "other,other")
27501 : 5336 : (set_attr "memory" "none,store")
27502 : 4389 : (set (attr "length")
27503 : 62011 : (symbol_ref "ix86_attr_length_address_default (insn) + 2"))])
27504 : 4389 :
27505 : 4627 : (define_insn "fnclex"
27506 : 4627 : [(unspec_volatile [(const_int 0)] UNSPECV_FNCLEX)]
27507 : 19125 : "TARGET_80387"
27508 : 31803324 : "fnclex"
27509 : 4627 : [(set_attr "type" "other")
27510 : 31803324 : (set_attr "memory" "none")
27511 : 31801619 : (set_attr "length" "2")])
27512 : 4654 :
27513 : 4654 : ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
27514 : 4654 : ;;
27515 : 31789851 : ;; LWP instructions
27516 : 31789851 : ;;
27517 : 4341 : ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
27518 : 5554 :
27519 : 5554 : (define_insn "@lwp_llwpcb<mode>"
27520 : 4341 : [(unspec_volatile [(match_operand:P 0 "register_operand" "r")]
27521 : 4341 : UNSPECV_LLWP_INTRINSIC)]
27522 : 4368 : "TARGET_LWP"
27523 : 31789719 : "llwpcb\t%0"
27524 : 31788638 : [(set_attr "type" "lwp")
27525 : 5422 : (set_attr "mode" "<MODE>")
27526 : 5422 : (set_attr "length" "5")])
27527 : 4341 :
27528 : 5422 : (define_insn "@lwp_slwpcb<mode>"
27529 : 5422 : [(set (match_operand:P 0 "register_operand" "=r")
27530 : 4341 : (unspec_volatile:P [(const_int 0)] UNSPECV_SLWP_INTRINSIC))]
27531 : 4359 : "TARGET_LWP"
27532 : 5422 : "slwpcb\t%0"
27533 : 4341 : [(set_attr "type" "lwp")
27534 : 5418 : (set_attr "mode" "<MODE>")
27535 : 2790 : (set_attr "length" "5")])
27536 : 2790 :
27537 : 1709 : (define_insn "@lwp_lwpval<mode>"
27538 : 3173 : [(unspec_volatile [(match_operand:SWI48 0 "register_operand" "r")
27539 : 2790 : (match_operand:SI 1 "nonimmediate_operand" "rm")
27540 : 2790 : (match_operand:SI 2 "const_int_operand")]
27541 : 3871 : UNSPECV_LWPVAL_INTRINSIC)]
27542 : 1738 : "TARGET_LWP"
27543 : 2790 : "lwpval\t{%2, %1, %0|%0, %1, %2}"
27544 : 2790 : [(set_attr "type" "lwp")
27545 : 1709 : (set_attr "mode" "<MODE>")
27546 : 2828 : (set (attr "length")
27547 : 1747 : (symbol_ref "ix86_attr_length_address_default (insn) + 9"))])
27548 : 2828 :
27549 : 3871 : (define_insn "@lwp_lwpins<mode>"
27550 : 1709 : [(set (reg:CCC FLAGS_REG)
27551 : 2798 : (unspec_volatile:CCC [(match_operand:SWI48 0 "register_operand" "r")
27552 : 2798 : (match_operand:SI 1 "nonimmediate_operand" "rm")
27553 : 12 : (match_operand:SI 2 "const_int_operand")]
27554 : 2790 : UNSPECV_LWPINS_INTRINSIC))]
27555 : 2823 : "TARGET_LWP"
27556 : 2790 : "lwpins\t{%2, %1, %0|%0, %1, %2}"
27557 : 4 : [(set_attr "type" "lwp")
27558 : 2790 : (set_attr "mode" "<MODE>")
27559 : 2826 : (set (attr "length")
27560 : 2929 : (symbol_ref "ix86_attr_length_address_default (insn) + 9"))])
27561 : 3907 :
27562 : 59331 : (define_int_iterator RDFSGSBASE
27563 : 60412 : [UNSPECV_RDFSBASE
27564 : 60412 : UNSPECV_RDGSBASE])
27565 : 60412 :
27566 : 61493 : (define_int_iterator WRFSGSBASE
27567 : 59335 : [UNSPECV_WRFSBASE
27568 : 2794 : UNSPECV_WRGSBASE])
27569 : 2794 :
27570 : 1713 : (define_int_attr fsgs
27571 : 2794 : [(UNSPECV_RDFSBASE "fs")
27572 : 2794 : (UNSPECV_RDGSBASE "gs")
27573 : 2790 : (UNSPECV_WRFSBASE "fs")
27574 : 1709 : (UNSPECV_WRGSBASE "gs")])
27575 : 2790 :
27576 : 2790 : (define_insn "rd<fsgs>base<mode>"
27577 : 1709 : [(set (match_operand:SWI48 0 "register_operand" "=r")
27578 : 2790 : (unspec_volatile:SWI48 [(const_int 0)] RDFSGSBASE))]
27579 : 3341 : "TARGET_64BIT && TARGET_FSGSBASE"
27580 : 2790 : "rd<fsgs>base\t%0"
27581 : 2260 : [(set_attr "type" "other")
27582 : 2260 : (set_attr "prefix_0f" "1")
27583 : 2260 : (set_attr "prefix_rep" "1")])
27584 : 2298 :
27585 : 2260 : (define_insn "wr<fsgs>base<mode>"
27586 : 2260 : [(unspec_volatile [(match_operand:SWI48 0 "register_operand" "r")]
27587 : 2260 : WRFSGSBASE)]
27588 : 1709 : "TARGET_64BIT && TARGET_FSGSBASE"
27589 : 2260 : "wr<fsgs>base\t%0"
27590 : 1709 : [(set_attr "type" "other")
27591 : 2260 : (set_attr "prefix_0f" "1")
27592 : 1763 : (set_attr "prefix_rep" "1")])
27593 : 2314 :
27594 : 2314 : (define_insn "ptwrite<mode>"
27595 : 2260 : [(unspec_volatile [(match_operand:SWI48 0 "nonimmediate_operand" "rm")]
27596 : 2256 : UNSPECV_PTWRITE)]
27597 : 2287 : "TARGET_PTWRITE"
27598 : 2256 : "ptwrite\t%0"
27599 : 2256 : [(set_attr "type" "other")
27600 : 2256 : (set_attr "prefix_0f" "1")
27601 : 1740 : (set_attr "prefix_rep" "1")])
27602 : 35 :
27603 : 1740 : (define_insn "@rdrand<mode>"
27604 : 1707 : [(set (match_operand:SWI248 0 "register_operand" "=r")
27605 : 1707 : (unspec_volatile:SWI248 [(const_int 0)] UNSPECV_RDRAND))
27606 : 2 : (set (reg:CCC FLAGS_REG)
27607 : 1705 : (unspec_volatile:CCC [(const_int 0)] UNSPECV_RDRAND))]
27608 : 1726 : "TARGET_RDRND"
27609 : 1705 : "rdrand\t%0"
27610 : 2256 : [(set_attr "type" "other")
27611 : 1705 : (set_attr "prefix_0f" "1")])
27612 : 1769 :
27613 : 1769 : (define_insn "@rdseed<mode>"
27614 : 1705 : [(set (match_operand:SWI248 0 "register_operand" "=r")
27615 : 2257 : (unspec_volatile:SWI248 [(const_int 0)] UNSPECV_RDSEED))
27616 : 2257 : (set (reg:CCC FLAGS_REG)
27617 : 552 : (unspec_volatile:CCC [(const_int 0)] UNSPECV_RDSEED))]
27618 : 1724 : "TARGET_RDSEED"
27619 : 1705 : "rdseed\t%0"
27620 : 1705 : [(set_attr "type" "other")
27621 : 0 : (set_attr "prefix_0f" "1")])
27622 : 1752 :
27623 : 1752 : (define_expand "pause"
27624 : 1705 : [(set (match_dup 0)
27625 : 1705 : (unspec:BLK [(match_dup 0)] UNSPEC_PAUSE))]
27626 : 1705 : ""
27627 : 2357 : {
27628 : 2357 : operands[0] = gen_rtx_MEM (BLKmode, gen_rtx_SCRATCH (Pmode));
27629 : 2357 : MEM_VOLATILE_P (operands[0]) = 1;
27630 : 1705 : })
27631 : 1705 :
27632 : 1705 : ;; Use "rep; nop", instead of "pause", to support older assemblers.
27633 : 1705 : ;; They have the same encoding.
27634 : 1705 : (define_insn "*pause"
27635 : 1705 : [(set (match_operand:BLK 0)
27636 : 2357 : (unspec:BLK [(match_dup 0)] UNSPEC_PAUSE))]
27637 : 1705 : ""
27638 : 1705 : "rep%; nop"
27639 : 1705 : [(set_attr "length" "2")
27640 : 1705 : (set_attr "memory" "unknown")])
27641 : 2357 :
27642 : 2357 : ;; CET instructions
27643 : 2357 : (define_insn "@rdssp<mode>"
27644 : 1705 : [(set (match_operand:SWI48 0 "register_operand" "=r")
27645 : 1705 : (unspec_volatile:SWI48 [(match_operand:SWI48 1 "register_operand" "0")]
27646 : 1705 : UNSPECV_NOP_RDSSP))]
27647 : 1785 : "TARGET_SHSTK || (flag_cf_protection & CF_RETURN)"
27648 : 1727 : "rdssp<mskmodesuffix>\t%0"
27649 : 1705 : [(set_attr "length" "6")
27650 : 1727 : (set_attr "type" "other")])
27651 : 1827 :
27652 : 1865 : (define_insn "@incssp<mode>"
27653 : 22 : [(unspec_volatile [(match_operand:SWI48 0 "register_operand" "r")]
27654 : 1705 : UNSPECV_INCSSP)]
27655 : 1749 : "TARGET_SHSTK || (flag_cf_protection & CF_RETURN)"
27656 : 1705 : "incssp<mskmodesuffix>\t%0"
27657 : 1705 : [(set_attr "length" "4")
27658 : 1705 : (set_attr "type" "other")])
27659 : 1785 :
27660 : 1785 : (define_insn "saveprevssp"
27661 : 1811 : [(unspec_volatile [(const_int 0)] UNSPECV_SAVEPREVSSP)]
27662 : 1724 : "TARGET_SHSTK"
27663 : 1705 : "saveprevssp"
27664 : 0 : [(set_attr "length" "5")
27665 : 1705 : (set_attr "type" "other")])
27666 : 1734 :
27667 : 1734 : (define_insn "rstorssp"
27668 : 1734 : [(unspec_volatile [(match_operand:DI 0 "memory_operand" "m")]
27669 : 1734 : UNSPECV_RSTORSSP)]
27670 : 1734 : "TARGET_SHSTK"
27671 : 1705 : "rstorssp\t%0"
27672 : 1705 : [(set_attr "length" "5")
27673 : 1705 : (set_attr "type" "other")])
27674 : 1724 :
27675 : 19 : (define_insn "@wrss<mode>"
27676 : 1724 : [(unspec_volatile [(match_operand:SWI48 0 "register_operand" "r")
27677 : 1724 : (match_operand:SWI48 1 "memory_operand" "m")]
27678 : 1705 : UNSPECV_WRSS)]
27679 : 1744 : "TARGET_SHSTK"
27680 : 1705 : "wrss<mskmodesuffix>\t%0, %1"
27681 : 1705 : [(set_attr "length" "3")
27682 : 1705 : (set_attr "type" "other")])
27683 : 1744 :
27684 : 1744 : (define_insn "@wruss<mode>"
27685 : 1705 : [(unspec_volatile [(match_operand:SWI48 0 "register_operand" "r")
27686 : 1705 : (match_operand:SWI48 1 "memory_operand" "m")]
27687 : 1705 : UNSPECV_WRUSS)]
27688 : 1744 : "TARGET_SHSTK"
27689 : 1705 : "wruss<mskmodesuffix>\t%0, %1"
27690 : 0 : [(set_attr "length" "4")
27691 : 1705 : (set_attr "type" "other")])
27692 : 1744 :
27693 : 1744 : (define_insn "setssbsy"
27694 : 1705 : [(unspec_volatile [(const_int 0)] UNSPECV_SETSSBSY)]
27695 : 1724 : "TARGET_SHSTK"
27696 : 1705 : "setssbsy"
27697 : 1705 : [(set_attr "length" "4")
27698 : 1705 : (set_attr "type" "other")])
27699 : 1734 :
27700 : 1734 : (define_insn "clrssbsy"
27701 : 29 : [(unspec_volatile [(match_operand:DI 0 "memory_operand" "m")]
27702 : 1734 : UNSPECV_CLRSSBSY)]
27703 : 1734 : "TARGET_SHSTK"
27704 : 1705 : "clrssbsy\t%0"
27705 : 1705 : [(set_attr "length" "4")
27706 : 1705 : (set_attr "type" "other")])
27707 : 294995 :
27708 : 294995 : (define_insn "nop_endbr"
27709 : 294995 : [(unspec_volatile [(const_int 0)] UNSPECV_NOP_ENDBR)]
27710 : 294995 : "(flag_cf_protection & CF_BRANCH)"
27711 : 294995 : {
27712 : 293290 : return TARGET_64BIT ? "endbr64" : "endbr32";
27713 : 0 : }
27714 : 1734 : [(set_attr "length" "4")
27715 : 1734 : (set_attr "length_immediate" "0")
27716 : 1734 : (set_attr "modrm" "0")])
27717 : 88 :
27718 : 1705 : ;; For RTM support
27719 : 1705 : (define_expand "xbegin"
27720 : 1705 : [(set (match_operand:SI 0 "register_operand")
27721 : 0 : (unspec_volatile:SI [(const_int 0)] UNSPECV_XBEGIN))]
27722 : 1705 : "TARGET_RTM"
27723 : 1727 : {
27724 : 1727 : rtx_code_label *label = gen_label_rtx ();
27725 : 1705 :
27726 : 1705 : /* xbegin is emitted as jump_insn, so reload won't be able
27727 : 1705 : to reload its operand. Force the value into AX hard register. */
27728 : 1727 : rtx ax_reg = gen_rtx_REG (SImode, AX_REG);
27729 : 1727 : emit_move_insn (ax_reg, constm1_rtx);
27730 : 1705 :
27731 : 1727 : emit_jump_insn (gen_xbegin_1 (ax_reg, label));
27732 : 1705 :
27733 : 1727 : emit_label (label);
27734 : 1705 : LABEL_NUSES (label) = 1;
27735 : 1705 :
27736 : 1727 : emit_move_insn (operands[0], ax_reg);
27737 : 1705 :
27738 : 1727 : DONE;
27739 : 1705 : })
27740 : 1705 :
27741 : 1705 : (define_insn "xbegin_1"
27742 : 1705 : [(set (pc)
27743 : 1705 : (if_then_else (ne (unspec [(const_int 0)] UNSPEC_XBEGIN_ABORT)
27744 : 1705 : (const_int 0))
27745 : 1705 : (label_ref (match_operand 1))
27746 : 1705 : (pc)))
27747 : 1705 : (set (match_operand:SI 0 "register_operand" "+a")
27748 : 1705 : (unspec_volatile:SI [(match_dup 0)] UNSPECV_XBEGIN))]
27749 : 1727 : "TARGET_RTM"
27750 : 1705 : "xbegin\t%l1"
27751 : 1705 : [(set_attr "type" "other")
27752 : 1705 : (set_attr "length" "6")])
27753 : 1705 :
27754 : 1705 : (define_insn "xend"
27755 : 1705 : [(unspec_volatile [(const_int 0)] UNSPECV_XEND)]
27756 : 1734 : "TARGET_RTM"
27757 : 132354 : "xend"
27758 : 132325 : [(set_attr "type" "other")
27759 : 132354 : (set_attr "length" "3")])
27760 : 132354 :
27761 : 1757 : (define_insn "xabort"
27762 : 20131 : [(unspec_volatile [(match_operand:SI 0 "const_0_to_255_operand")]
27763 : 1757 : UNSPECV_XABORT)]
27764 : 20102 : "TARGET_RTM"
27765 : 1705 : "xabort\t%0"
27766 : 18701 : [(set_attr "type" "other")
27767 : 18701 : (set_attr "length" "3")])
27768 : 1734 :
27769 : 18730 : (define_expand "xtest"
27770 : 18701 : [(set (match_operand:QI 0 "register_operand")
27771 : 1734 : (unspec_volatile:QI [(const_int 0)] UNSPECV_XTEST))]
27772 : 1734 : "TARGET_RTM"
27773 : 15007 : {
27774 : 15036 : emit_insn (gen_xtest_1 ());
27775 : 1705 :
27776 : 15036 : ix86_expand_setcc (operands[0], NE,
27777 : 1705 : gen_rtx_REG (CCZmode, FLAGS_REG), const0_rtx);
27778 : 1734 : DONE;
27779 : 9423 : })
27780 : 1705 :
27781 : 11360 : (define_insn "xtest_1"
27782 : 11360 : [(set (reg:CCZ FLAGS_REG)
27783 : 9423 : (unspec_volatile:CCZ [(const_int 0)] UNSPECV_XTEST))]
27784 : 9471 : "TARGET_RTM"
27785 : 9423 : "xtest"
27786 : 9423 : [(set_attr "type" "other")
27787 : 1705 : (set_attr "length" "3")])
27788 : 9405 :
27789 : 1727 : (define_insn "clwb"
27790 : 9405 : [(unspec_volatile [(match_operand 0 "address_operand" "p")]
27791 : 9383 : UNSPECV_CLWB)]
27792 : 9412 : "TARGET_CLWB"
27793 : 9383 : "clwb\t%a0"
27794 : 9383 : [(set_attr "type" "sse")
27795 : 9383 : (set_attr "atom_sse_attr" "fence")
27796 : 1734 : (set_attr "memory" "unknown")])
27797 : 1753 :
27798 : 1734 : (define_insn "clflushopt"
27799 : 1753 : [(unspec_volatile [(match_operand 0 "address_operand" "p")]
27800 : 9412 : UNSPECV_CLFLUSHOPT)]
27801 : 9431 : "TARGET_CLFLUSHOPT"
27802 : 9402 : "clflushopt\t%a0"
27803 : 1724 : [(set_attr "type" "sse")
27804 : 1724 : (set_attr "atom_sse_attr" "fence")
27805 : 1753 : (set_attr "memory" "unknown")])
27806 : 1734 :
27807 : 1734 : ;; MONITORX and MWAITX
27808 : 1734 : (define_insn "mwaitx"
27809 : 1705 : [(unspec_volatile [(match_operand:SI 0 "register_operand" "c")
27810 : 1705 : (match_operand:SI 1 "register_operand" "a")
27811 : 1705 : (match_operand:SI 2 "register_operand" "b")]
27812 : 1705 : UNSPECV_MWAITX)]
27813 : 1755 : "TARGET_MWAITX"
27814 : 1715 : ;; 64bit version is "mwaitx %rax,%rcx,%rbx". But only lower 32bits are used.
27815 : 1705 : ;; Since 32bit register operands are implicitly zero extended to 64bit,
27816 : 1705 : ;; we only need to set up 32bit registers.
27817 : 1764 : "mwaitx"
27818 : 1764 : [(set_attr "length" "3")])
27819 : 1705 :
27820 : 1705 : (define_insn "@monitorx_<mode>"
27821 : 1705 : [(unspec_volatile [(match_operand:P 0 "register_operand" "a")
27822 : 1705 : (match_operand:SI 1 "register_operand" "c")
27823 : 1705 : (match_operand:SI 2 "register_operand" "d")]
27824 : 1705 : UNSPECV_MONITORX)]
27825 : 1758 : "TARGET_MWAITX"
27826 : 1705 : ;; 64bit version is "monitorx %rax,%rcx,%rdx". But only lower 32bits in
27827 : 1705 : ;; RCX and RDX are used. Since 32bit register operands are implicitly
27828 : 1705 : ;; zero extended to 64bit, we only need to set up 32bit registers.
27829 : 1705 : "%^monitorx"
27830 : 1705 : [(set (attr "length")
27831 : 1705 : (symbol_ref ("(Pmode != word_mode) + 3")))])
27832 : 1705 :
27833 : 1705 : ;; CLZERO
27834 : 1705 : (define_insn "@clzero_<mode>"
27835 : 1705 : [(unspec_volatile [(match_operand: P 0 "register_operand" "a")]
27836 : 1705 : UNSPECV_CLZERO)]
27837 : 1734 : "TARGET_CLZERO"
27838 : 1705 : "clzero"
27839 : 1705 : [(set_attr "length" "3")
27840 : 1705 : (set_attr "memory" "unknown")])
27841 : 1705 :
27842 : 1705 : ;; RDPKRU and WRPKRU
27843 : 1705 :
27844 : 1705 : (define_expand "rdpkru"
27845 : 1705 : [(parallel
27846 : 1705 : [(set (match_operand:SI 0 "register_operand")
27847 : 1705 : (unspec_volatile:SI [(match_dup 1)] UNSPECV_PKU))
27848 : 1705 : (set (match_dup 2) (const_int 0))])]
27849 : 1705 : "TARGET_PKU"
27850 : 1724 : {
27851 : 1724 : operands[1] = force_reg (SImode, const0_rtx);
27852 : 1724 : operands[2] = gen_reg_rtx (SImode);
27853 : 1705 : })
27854 : 1705 :
27855 : 1705 : (define_insn "*rdpkru"
27856 : 1724 : [(set (match_operand:SI 0 "register_operand" "=a")
27857 : 1724 : (unspec_volatile:SI [(match_operand:SI 2 "register_operand" "c")]
27858 : 1705 : UNSPECV_PKU))
27859 : 1724 : (set (match_operand:SI 1 "register_operand" "=d")
27860 : 1705 : (const_int 0))]
27861 : 1743 : "TARGET_PKU"
27862 : 1705 : "rdpkru"
27863 : 1724 : [(set_attr "type" "other")])
27864 : 1705 :
27865 : 1705 : (define_expand "wrpkru"
27866 : 1932 : [(unspec_volatile:SI
27867 : 1705 : [(match_operand:SI 0 "register_operand")
27868 : 1932 : (match_dup 1) (match_dup 2)] UNSPECV_PKU)]
27869 : 147931 : "TARGET_PKU"
27870 : 147950 : {
27871 : 1970 : operands[1] = force_reg (SImode, const0_rtx);
27872 : 1970 : operands[2] = force_reg (SImode, const0_rtx);
27873 : 1951 : })
27874 : 19 :
27875 : 1932 : (define_insn "*wrpkru"
27876 : 1705 : [(unspec_volatile:SI
27877 : 1932 : [(match_operand:SI 0 "register_operand" "a")
27878 : 1951 : (match_operand:SI 1 "register_operand" "d")
27879 : 1970 : (match_operand:SI 2 "register_operand" "c")] UNSPECV_PKU)]
27880 : 1980 : "TARGET_PKU"
27881 : 1970 : "wrpkru"
27882 : 1932 : [(set_attr "type" "other")])
27883 : 1724 :
27884 : 1724 : (define_insn "rdpid"
27885 : 1802 : [(set (match_operand:SI 0 "register_operand" "=r")
27886 : 1724 : (unspec_volatile:SI [(const_int 0)] UNSPECV_RDPID))]
27887 : 1951 : "!TARGET_64BIT && TARGET_RDPID"
27888 : 1932 : "rdpid\t%0"
27889 : 1951 : [(set_attr "type" "other")])
27890 : 1724 :
27891 : 1751 : (define_insn "rdpid_rex64"
27892 : 1759 : [(set (match_operand:DI 0 "register_operand" "=r")
27893 : 1705 : (unspec_volatile:DI [(const_int 0)] UNSPECV_RDPID))]
27894 : 1732 : "TARGET_64BIT && TARGET_RDPID"
27895 : 23727 : "rdpid\t%0"
27896 : 1773 : [(set_attr "type" "other")])
27897 : 23727 :
27898 : 23727 : ;; Intirinsics for > i486
27899 : 23727 :
27900 : 23795 : (define_insn "wbinvd"
27901 : 1773 : [(unspec_volatile [(const_int 0)] UNSPECV_WBINVD)]
27902 : 23766 : ""
27903 : 23766 : "wbinvd"
27904 : 1812 : [(set_attr "type" "other")])
27905 : 23586 :
27906 : 1808 : (define_insn "wbnoinvd"
27907 : 23085 : [(unspec_volatile [(const_int 0)] UNSPECV_WBNOINVD)]
27908 : 1759 : "TARGET_WBNOINVD"
27909 : 23085 : "wbnoinvd"
27910 : 23050 : [(set_attr "type" "other")])
27911 : 23050 :
27912 : 23069 : ;; MOVDIRI and MOVDIR64B
27913 : 23069 :
27914 : 23069 : (define_insn "movdiri<mode>"
27915 : 21364 : [(set (match_operand:SWI48 0 "memory_operand" "=m")
27916 : 23050 : (unspec:SWI48 [(match_operand:SWI48 1 "register_operand" "r")]
27917 : 1705 : UNSPEC_MOVDIRI))]
27918 : 1754 : "TARGET_MOVDIRI"
27919 : 1705 : "movdiri\t{%1, %0|%0, %1}"
27920 : 1705 : [(set_attr "type" "other")])
27921 : 23050 :
27922 : 1753 : (define_insn "@movdir64b_<mode>"
27923 : 1753 : [(set (mem:XI (match_operand:P 0 "register_operand" "r"))
27924 : 1705 : (unspec:XI [(match_operand:XI 1 "memory_operand" "m")]
27925 : 1705 : UNSPEC_MOVDIR64B))]
27926 : 23095 : "TARGET_MOVDIR64B"
27927 : 23050 : "movdir64b\t{%1, %0|%0, %1}"
27928 : 23050 : [(set_attr "type" "other")])
27929 : 1705 :
27930 : 1705 : ;; TSXLDTRK
27931 : 1705 : (define_int_iterator TSXLDTRK [UNSPECV_XSUSLDTRK UNSPECV_XRESLDTRK])
27932 : 1705 : (define_int_attr tsxldtrk [(UNSPECV_XSUSLDTRK "xsusldtrk")
27933 : 1705 : (UNSPECV_XRESLDTRK "xresldtrk")])
27934 : 1705 : (define_insn "<tsxldtrk>"
27935 : 1705 : [(unspec_volatile [(const_int 0)] TSXLDTRK)]
27936 : 1724 : "TARGET_TSXLDTRK"
27937 : 1705 : "<tsxldtrk>"
27938 : 1705 : [(set_attr "type" "other")
27939 : 1705 : (set_attr "length" "4")])
27940 : 1744 :
27941 : 1744 : ;; ENQCMD and ENQCMDS
27942 : 1744 :
27943 : 1724 : (define_int_iterator ENQCMD [UNSPECV_ENQCMD UNSPECV_ENQCMDS])
27944 : 1705 : (define_int_attr enqcmd_sfx [(UNSPECV_ENQCMD "") (UNSPECV_ENQCMDS "s")])
27945 : 1705 :
27946 : 1705 : (define_insn "@enqcmd<enqcmd_sfx>_<mode>"
27947 : 1705 : [(set (reg:CCZ FLAGS_REG)
27948 : 1705 : (unspec_volatile:CCZ [(match_operand:P 0 "register_operand" "r")
27949 : 1705 : (match_operand:XI 1 "memory_operand" "m")]
27950 : 1705 : ENQCMD))]
27951 : 1779 : "TARGET_ENQCMD"
27952 : 1705 : "enqcmd<enqcmd_sfx>\t{%1, %0|%0, %1}"
27953 : 1705 : [(set_attr "type" "other")])
27954 : 1705 :
27955 : 0 : ;; UINTR
27956 : 0 : (define_int_iterator UINTR [UNSPECV_CLUI UNSPECV_STUI])
27957 : 1705 : (define_int_attr uintr [(UNSPECV_CLUI "clui") (UNSPECV_STUI "stui")])
27958 : 1705 :
27959 : 1705 : (define_insn "<uintr>"
27960 : 0 : [(unspec_volatile [(const_int 0)] UINTR)]
27961 : 1725 : "TARGET_UINTR && TARGET_64BIT"
27962 : 1705 : "<uintr>"
27963 : 1705 : [(set_attr "type" "other")
27964 : 0 : (set_attr "length" "4")])
27965 : 1756 :
27966 : 1756 : (define_insn "testui"
27967 : 1725 : [(set (reg:CCC FLAGS_REG)
27968 : 1756 : (unspec_volatile:CCC [(const_int 0)] UNSPECV_TESTUI))]
27969 : 1756 : "TARGET_UINTR && TARGET_64BIT"
27970 : 1705 : "testui"
27971 : 1705 : [(set_attr "type" "other")
27972 : 1705 : (set_attr "length" "4")])
27973 : 1705 :
27974 : 1705 : (define_insn "senduipi"
27975 : 1705 : [(unspec_volatile
27976 : 1705 : [(match_operand:DI 0 "register_operand" "r")]
27977 : 27140 : UNSPECV_SENDUIPI)]
27978 : 27169 : "TARGET_UINTR && TARGET_64BIT"
27979 : 1705 : "senduipi\t%0"
27980 : 83 : [(set_attr "type" "other")
27981 : 1788 : (set_attr "length" "4")])
27982 : 1788 :
27983 : 1738 : ;; WAITPKG
27984 : 33 :
27985 : 1738 : (define_insn "umwait"
27986 : 1705 : [(set (reg:CCC FLAGS_REG)
27987 : 0 : (unspec_volatile:CCC [(match_operand:SI 0 "register_operand" "r")
27988 : 0 : (match_operand:DI 1 "register_operand" "A")]
27989 : 0 : UNSPECV_UMWAIT))]
27990 : 312 : "!TARGET_64BIT && TARGET_WAITPKG"
27991 : 0 : "umwait\t%0"
27992 : 0 : [(set_attr "length" "3")])
27993 : 0 :
27994 : 0 : (define_insn "umwait_rex64"
27995 : 0 : [(set (reg:CCC FLAGS_REG)
27996 : 0 : (unspec_volatile:CCC [(match_operand:SI 0 "register_operand" "r")
27997 : 0 : (match_operand:SI 1 "register_operand" "a")
27998 : 0 : (match_operand:SI 2 "register_operand" "d")]
27999 : 0 : UNSPECV_UMWAIT))]
28000 : 33 : "TARGET_64BIT && TARGET_WAITPKG"
28001 : 101 : "umwait\t%0"
28002 : 0 : [(set_attr "length" "3")])
28003 : 0 :
28004 : 148 : (define_insn "@umonitor_<mode>"
28005 : 148 : [(unspec_volatile [(match_operand:P 0 "register_operand" "r")]
28006 : 141 : UNSPECV_UMONITOR)]
28007 : 171 : "TARGET_WAITPKG"
28008 : 148 : "umonitor\t%0"
28009 : 0 : [(set (attr "length")
28010 : 0 : (symbol_ref ("(Pmode != word_mode) + 3")))])
28011 : 0 :
28012 : 27977 : (define_insn "tpause"
28013 : 0 : [(set (reg:CCC FLAGS_REG)
28014 : 27977 : (unspec_volatile:CCC [(match_operand:SI 0 "register_operand" "r")
28015 : 27977 : (match_operand:DI 1 "register_operand" "A")]
28016 : 27977 : UNSPECV_TPAUSE))]
28017 : 27977 : "!TARGET_64BIT && TARGET_WAITPKG"
28018 : 27977 : "tpause\t%0"
28019 : 27977 : [(set_attr "length" "3")])
28020 : 27977 :
28021 : 4021 : (define_insn "tpause_rex64"
28022 : 31998 : [(set (reg:CCC FLAGS_REG)
28023 : 0 : (unspec_volatile:CCC [(match_operand:SI 0 "register_operand" "r")
28024 : 31995 : (match_operand:SI 1 "register_operand" "a")
28025 : 4021 : (match_operand:SI 2 "register_operand" "d")]
28026 : 31995 : UNSPECV_TPAUSE))]
28027 : 28008 : "TARGET_64BIT && TARGET_WAITPKG"
28028 : 32109 : "tpause\t%0"
28029 : 27974 : [(set_attr "length" "3")])
28030 : 31995 :
28031 : 31995 : (define_insn "cldemote"
28032 : 27974 : [(unspec_volatile[(match_operand 0 "address_operand" "p")]
28033 : 30307 : UNSPECV_CLDEMOTE)]
28034 : 2362 : "TARGET_CLDEMOTE"
28035 : 0 : "cldemote\t%a0"
28036 : 0 : [(set_attr "type" "other")
28037 : 0 : (set_attr "memory" "unknown")])
28038 : 27974 :
28039 : 41 : (define_insn "speculation_barrier"
28040 : 41 : [(unspec_volatile [(const_int 0)] UNSPECV_SPECULATION_BARRIER)]
28041 : 2918145 : ""
28042 : 0 : "lfence"
28043 : 27974 : [(set_attr "type" "other")
28044 : 27993 : (set_attr "length" "3")])
28045 : 2946138 :
28046 : 19 : (define_insn "serialize"
28047 : 2918164 : [(unspec_volatile [(const_int 0)] UNSPECV_SERIALIZE)]
28048 : 19 : "TARGET_SERIALIZE"
28049 : 302 : "serialize"
28050 : 2918145 : [(set_attr "type" "other")
28051 : 2918151 : (set_attr "length" "3")])
28052 : 2918176 :
28053 : 2918151 : (define_insn "patchable_area"
28054 : 37 : [(unspec_volatile [(match_operand 0 "const_int_operand")
28055 : 37 : (match_operand 1 "const_int_operand")]
28056 : 52132 : UNSPECV_PATCHABLE_AREA)]
28057 : 6 : ""
28058 : 111 : {
28059 : 105 : ix86_output_patchable_area (INTVAL (operands[0]),
28060 : 109 : INTVAL (operands[1]) != 0);
28061 : 105 : return "";
28062 : 50 : }
28063 : 157 : [(set (attr "length") (symbol_ref "INTVAL (operands[0])"))
28064 : 451 : (set_attr "length_immediate" "0")
28065 : 4 : (set_attr "modrm" "0")])
28066 : 9121 :
28067 : 4 : (define_insn "hreset"
28068 : 0 : [(unspec_volatile [(match_operand:SI 0 "register_operand" "a")]
28069 : 0 : UNSPECV_HRESET)]
28070 : 31 : "TARGET_HRESET"
28071 : 74 : "hreset\t{$0|0}"
28072 : 78 : [(set_attr "type" "other")
28073 : 74 : (set_attr "length" "4")])
28074 : 147 :
28075 : 147 : ;; Spaceship optimization
28076 : 147 : (define_expand "spaceship<mode>3"
28077 : 151 : [(match_operand:SI 0 "register_operand")
28078 : 151 : (match_operand:MODEF 1 "cmp_fp_expander_operand")
28079 : 652 : (match_operand:MODEF 2 "cmp_fp_expander_operand")]
28080 : 0 : "(TARGET_80387 || (SSE_FLOAT_MODE_P (<MODE>mode) && TARGET_SSE_MATH))
28081 : 103 : && (TARGET_CMOVE || (TARGET_SAHF && TARGET_USE_SAHF))"
28082 : 231 : {
28083 : 171 : ix86_expand_fp_spaceship (operands[0], operands[1], operands[2]);
28084 : 231 : DONE;
28085 : 103 : })
28086 : 103 :
28087 : 0 : (define_expand "spaceshipxf3"
28088 : 0 : [(match_operand:SI 0 "register_operand")
28089 : 0 : (match_operand:XF 1 "nonmemory_operand")
28090 : 0 : (match_operand:XF 2 "nonmemory_operand")]
28091 : 0 : "TARGET_80387 && (TARGET_CMOVE || (TARGET_SAHF && TARGET_USE_SAHF))"
28092 : 4 : {
28093 : 405 : ix86_expand_fp_spaceship (operands[0], operands[1], operands[2]);
28094 : 405 : DONE;
28095 : 4 : })
28096 : 4 :
28097 : 4 : ;; Defined because the generic expand_builtin_issignaling for XFmode
28098 : 4 : ;; only tests for sNaNs, but i387 treats also pseudo numbers as always
28099 : 4 : ;; signaling.
28100 : 0 : (define_expand "issignalingxf2"
28101 : 0 : [(match_operand:SI 0 "register_operand")
28102 : 0 : (match_operand:XF 1 "general_operand")]
28103 : 0 : ""
28104 : 149 : {
28105 : 387 : rtx temp = operands[1];
28106 : 0 : if (!MEM_P (temp))
28107 : 0 : {
28108 : 87 : rtx mem = assign_stack_temp (XFmode, GET_MODE_SIZE (XFmode));
28109 : 325 : emit_move_insn (mem, temp);
28110 : 325 : temp = mem;
28111 : 0 : }
28112 : 149 : rtx ex = adjust_address (temp, HImode, 8);
28113 : 149 : rtx hi = adjust_address (temp, SImode, 4);
28114 : 149 : rtx lo = adjust_address (temp, SImode, 0);
28115 : 387 : rtx val = GEN_INT (HOST_WIDE_INT_M1U << 30);
28116 : 501 : rtx mask = GEN_INT (0x7fff);
28117 : 501 : rtx bit = GEN_INT (HOST_WIDE_INT_1U << 30);
28118 : 149 : /* Expand to:
28119 : 500 : ((ex & mask) && (int) hi >= 0)
28120 : 500 : || ((ex & mask) == mask && ((hi ^ bit) | ((lo | -lo) >> 31)) > val). */
28121 : 500 : rtx nlo = expand_unop (SImode, neg_optab, lo, NULL_RTX, 0);
28122 : 500 : lo = expand_binop (SImode, ior_optab, lo, nlo,
28123 : 500 : NULL_RTX, 1, OPTAB_LIB_WIDEN);
28124 : 500 : lo = expand_shift (RSHIFT_EXPR, SImode, lo, 31, NULL_RTX, 1);
28125 : 500 : temp = expand_binop (SImode, xor_optab, hi, bit,
28126 : 0 : NULL_RTX, 1, OPTAB_LIB_WIDEN);
28127 : 218 : temp = expand_binop (SImode, ior_optab, temp, lo,
28128 : 69 : NULL_RTX, 1, OPTAB_LIB_WIDEN);
28129 : 218 : temp = emit_store_flag_force (gen_reg_rtx (SImode), GTU, temp, val,
28130 : 0 : SImode, 1, 1);
28131 : 218 : ex = expand_binop (HImode, and_optab, ex, mask,
28132 : 0 : NULL_RTX, 1, OPTAB_LIB_WIDEN);
28133 : 182 : rtx temp2 = emit_store_flag_force (gen_reg_rtx (SImode), NE,
28134 : 33 : ex, const0_rtx, SImode, 1, 1);
28135 : 182 : ex = emit_store_flag_force (gen_reg_rtx (SImode), EQ,
28136 : 0 : ex, mask, HImode, 1, 1);
28137 : 149 : temp = expand_binop (SImode, and_optab, temp, ex,
28138 : 0 : NULL_RTX, 1, OPTAB_LIB_WIDEN);
28139 : 149 : rtx temp3 = emit_store_flag_force (gen_reg_rtx (SImode), GE,
28140 : 0 : hi, const0_rtx, SImode, 0, 1);
28141 : 149 : temp2 = expand_binop (SImode, and_optab, temp2, temp3,
28142 : 0 : NULL_RTX, 1, OPTAB_LIB_WIDEN);
28143 : 149 : temp = expand_binop (SImode, ior_optab, temp, temp2,
28144 : 0 : NULL_RTX, 1, OPTAB_LIB_WIDEN);
28145 : 149 : emit_move_insn (operands[0], temp);
28146 : 149 : DONE;
28147 : 0 : })
28148 : 0 :
28149 : 0 : (define_insn "urdmsr"
28150 : 0 : [(set (match_operand:DI 0 "register_operand" "=r")
28151 : 0 : (unspec_volatile:DI
28152 : 0 : [(match_operand:DI 1 "x86_64_szext_nonmemory_operand" "reZ")]
28153 : 0 : UNSPECV_URDMSR))]
28154 : 32 : "TARGET_USER_MSR && TARGET_64BIT"
28155 : 0 : "urdmsr\t{%1, %0|%0, %1}"
28156 : 0 : [(set_attr "prefix" "vex")
28157 : 0 : (set_attr "type" "other")])
28158 : 185 :
28159 : 185 : (define_insn "uwrmsr"
28160 : 0 : [(unspec_volatile
28161 : 185 : [(match_operand:DI 0 "x86_64_szext_nonmemory_operand" "reZ")
28162 : 185 : (match_operand:DI 1 "register_operand" "r")]
28163 : 185 : UNSPECV_UWRMSR)]
28164 : 226 : "TARGET_USER_MSR && TARGET_64BIT"
28165 : 5 : "uwrmsr\t{%1, %0|%0, %1}"
28166 : 0 : [(set_attr "prefix" "vex")
28167 : 14693 : (set_attr "type" "other")])
28168 : 14752 :
28169 : 59 : (define_insn "ldtilecfg"
28170 : 14744 : [(unspec_volatile [(match_operand:XI 0 "memory_operand" "m")]
28171 : 14799 : UNSPECV_LDTILECFG)]
28172 : 14766 : "TARGET_AMX_TILE"
28173 : 0 : "ldtilecfg\t%0"
28174 : 0 : [(set_attr "type" "other")
28175 : 0 : (set_attr "prefix" "maybe_evex")
28176 : 0 : (set_attr "memory" "load")
28177 : 0 : (set_attr "mode" "XI")])
28178 : 0 :
28179 : 0 : (define_insn "sttilecfg"
28180 : 0 : [(set (match_operand:XI 0 "memory_operand" "=m")
28181 : 0 : (unspec_volatile:XI [(const_int 0)] UNSPECV_STTILECFG))]
28182 : 148 : "TARGET_AMX_TILE"
28183 : 37 : "sttilecfg\t%0"
28184 : 0 : [(set_attr "type" "other")
28185 : 0 : (set_attr "prefix" "maybe_evex")
28186 : 60526 : (set_attr "memory" "store")
28187 : 70108 : (set_attr "mode" "XI")])
28188 : 0 :
28189 : 70108 : (include "mmx.md")
28190 : 70108 : (include "sse.md")
28191 : 70108 : (include "sync.md")
28192 : 123047 : /* /home/worker/buildworker/tiber-lcov/build/gcc/config/i386/i386.md not long enough */
28193 : 9582 : /* (content generated from line coverage data) */
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30993 : 491 : /* (content generated from line coverage data) */
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